JP2021105844A - 情報処理装置および情報処理装置の制御方法 - Google Patents

Abstract

【課題】複数のコマンドを１度に扱うプロトコルを用いた際に、同一のキュー位置における複数の記憶装置の各々の応答に応じてホストシステムに応答可能なミラーリングシステムを提供する。【解決手段】不揮発性の第１記憶手段及び第２記憶手段を有する情報処理装置で４００あって、コントローラから受信した少なくとも２つの要求のうち同じ要求に対応する第１保持手段および第２保持手段が保持した各々の記憶手段からの応答に基づいて、同じ要求に対応するコントローラへの応答を送信する第３送信手段と、を有する。【選択図】図６

Description

本発明は、情報処理装置および情報処理装置の制御方法に関する。

近年、ＰＣなどの情報処理装置では、不揮発性メモリを利用したソリッドステートドライブ（ＳＳＤ）を用いることでハードディスドライブ（ＨＤＤ）を用いるよりも高速なデータ転送を可能としている。一方で、これら記憶装置に用いられるインタフェースであるＳｅｒｉａｌ ＡＴＡ（ＳＡＴＡ）は、転送時のデータ・エンコーディングに要する処理時間が増えてレイテンシが大きくなるため、ＳＳＤ本来の転送パフォーマンスを発揮できていなかった。

そこで、さらに近年では汎用バスのＰＣＩ−Ｅｘｐｒｅｓｓ（ＰＣＩｅ）に直接接続でき、ＳＳＤの高速性を活かす新たなプロトコルであるＮｏｎ−Ｖｏｌａｔｉｌｅ Ｍｅｍｏｒｙ Ｅｘｐｒｅｓｓ（ＮＶＭｅ）プロトコルに対応したＳＳＤが登場し始めている。

また、ＨＤＤやＳＳＤなどの記憶媒体の故障に対するデータ保護の仕組みとして、２つの記憶装置を用いてデータを二重化して保存するミラーリング技術が存在する。ミラーリングはブリッジ装置を用いて、ホストからのデータを同時に２つの記憶装置に記録するため、データや記憶装置自体が破損しても他方からのデータコピーで復旧が可能である。図１に示すように、記憶装置１側の書き込み処理（コマンドＢ）が書き込みエラーした際に、記憶装置２側の書き込み処理（コマンドＢ）で書き込まれたデータをブリッジ装置が読取り、記憶装置１へ書き込み直す。また、図２に示すように、記憶装置１と記憶装置２の書き込み処理が共に書き込みエラーとなった際には、正しいデータを持ち合わせていないため、ブリッジ装置での修復が不可能となる。

特許文献１は、システムホストとローカルホストが接続し、ローカルホストとローカルデバイスが接続するブリッジ構成の情報処理装置である。ローカルホストはローカルデバイスへの書き込みの完了応答を受け、システムホストへ書き込み完了応答を通知している。

国際公開第２０１７／１５４９４３号公報

ＮＶＭｅプロトコルでは、１度の処理で複数のコマンドを扱うため、異なるデータの書き込みでエラーが発生することがあり得る。例えば、図３に示す、記憶装置１側のコマンドＢと記憶装置２側のコマンドＣがそれに該当する。図３では、複数のコマンドを１度の書き込み処理とみなして、記憶装置に書き込みエラーがあるという判断でホストシステムへの応答を決めてしまう。そのため、記憶装置１においてエラーが発生し且つ記憶装置２において正常に処理されたコマンドＢと、その逆のコマンドＣに対応するホストシステムへの応答として書き込みエラーを通知することになってしまう。

つまり、従来の構成を適用すると複数のコマンドを１度の書き込み処理として扱ってしまう。さらに、一方の記憶装置への書き込みが成功しており、データ修復可能あるにも関わらずホストシステムに当該書き込み処理に対して書き込みエラーを通知してしまうおそれがある。

本発明は、複数のコマンドを一度に扱うプロトコルを用いた際に、同一のキュー位置における複数の記憶装置の各々の応答に応じてホストシステムに応答可能なミラーリングシステムを提供することを目的とする。

本発明によれば、不揮発性の第１記憶手段および不揮発性の第２記憶手段を有する情報処理装置であって、少なくとも２つの要求をコントローラユニットから受信する第１受信手段と、前記少なくとも２つの要求を受信した順番に前記第１記憶手段に送信する第１送信手段と、前記少なくとも２つの要求を受信した順番に前記第２記憶手段に送信する第２送信手段と、前記少なくとも２つの要求を送信した順番に対応して、前記第１記憶手段から前記少なくとも２つの要求の各々に対応する応答を受信する第２受信手段と、前記少なくとも２つの要求を送信した順番に対応して、前記第２記憶手段から前記少なくとも２つの要求の各々に対応する応答を受信する第３受信手段と、前記第２受信手段が受信した順番に前記少なくとも２つの要求に対応する応答を保持する第１保持手段と、前記第３受信手段が受信した順番に前記少なくとも２つの要求に対応する応答を保持する第２保持手段と、前記少なくとも２つの要求のうち同じ要求に対応する前記第１保持手段および前記第２保持手段が保持した各々の応答に基づいて、前記同じ要求に対応する応答を送信する第３送信手段と、を有することを特徴とする情報処理装置。

本発明によれば、複数のコマンドを一度に扱うプロトコルを用いた際に、複数の記憶装置の同一のキュー位置における複数の記憶装置の各々の応答に応じてホストシステムに応答可能なミラーリングシステムを提供することが可能となる。

従来のミラーリングシステムでの修復可能例 従来のミラーリングシステムでの修復不可能例 ＮＶＭｅにおけるミラーリングシステムの課題説明図 情報処理装置のミラーリングシステムの構成を示すブロック図 ＣＵの詳細ブロック図 ブリッジ装置の詳細ブロック図 第１記憶装置及び第２記憶装置の詳細ブロック図 ミラーリングシステムの動作説明図 ＮＶＭｅコマンドをブリッジ装置に格納するコマンド処理を示すフローチャート ＮＶＭｅコマンドがブリッジ装置に格納された後のコマンド処理を示すフローチャート 記憶装置名称とコマンド通知の関係を示すコマンド処理リスト ＮＶＭｅコマンドの応答がブリッジ装置に格納された後の処理を示すフローチャート 第１記憶装置及び第２記憶装置の応答と修復及び通知の関係を示すリスト ＮＶＭｅにおけるミラーリングシステムの課題説明図 ＮＶＭｅコマンドの応答がブリッジ装置に格納された後の処理を示すフローチャート 第１記憶装置及び第２記憶装置の応答と修復及び通知の関係を示すリスト ミラーリングシステムの応答構成を示すブロック図

添付図面を参照して本発明の実施例を詳しく説明する。なお、以下の実施例は特許請求の範囲に係る発明を限定するものではなく、また実施例で説明されている特徴の組み合わせのすべてが本発明の解決手段に必須のものとは限らない。

（実施例１）
図４は、本実施例に関わる情報処理装置のミラーリングシステムの構成を示すブロック図である。

本実施例の情報処理装置４００は、ミラーリングシステム４を有する。ミラーリングシステム４は、コントローラユニット（以下、ＣＵ４０１）と、ブリッジ装置４０２と、第１記憶装置４０３と第２記憶装置４０４を有する。

ＣＵ４０１は、ブリッジ装置４０２と接続されており、情報処理装置４００の制御コントローラとしての機能を有している。

ブリッジ装置４０２は、ＣＵ４０１と第１記憶装置４０３及び第２記憶装置４０４と接続されており、ＣＵ４０１から第１記憶装置４０３に記憶されるデータを二重化して、第２記憶装置４０４に記憶するミラーリングの機能を有する。

第１記憶装置４０３は、ブリッジ装置４０２と接続されており、ＣＵ４０１で扱うシステムソフトウェアやユーザデータ及びアプリケーションデータ等を格納する。第２記憶装置４０４は、ブリッジ装置４０２と接続されており、第１記憶装置４０３のデータを二重化したバックアップデータを格納する。第１記憶装置４０３と第２記憶装置４０４は、不揮発性の半導体記憶装置であり、例えばＳＳＤである。

図５は、ＣＵ４０１の詳細ブロック図である。情報処理装置４００のコントローラユニットのハードウェア構成を示すブロック図である。本実施例では、情報処理装置４００の例として画像形成装置を示す。画像形成装置は例えばスキャン機能やプリント機能等、複数の機能が一体化された、いわゆるＭＦＰ（多機能型周辺装置）として実現される。情報処理装置４００は、装置全体を制御するＣＵ４０１、操作部５１６、スキャナ５１２、プリンタ５１４を含む。

操作部５１６は、ユーザからのジョブ実行等の指示の入力を受け付けるためのテンキーや各種ハードキー等を含み、また、ユーザへ装置情報やジョブ進捗情報等、または、情報処理装置が実行可能な機能の設定画面を表示する表示パネルを含む。スキャナ５１２は、セットされた原稿上の画像を光学的に読み取る画像入力デバイスである。プリンタ５１４は、画像データに基づいて、印刷用紙等の記録媒体に画像を印刷する画像出力デバイスである。

操作部５１６は、ＣＵ４０１に含まれる操作部インタフェース（Ｉ／Ｆ）５１５に接続される。スキャナ５１２、プリンタ５１４はそれぞれ、コントローラユニット４０１に含まれるスキャナ処理部５１１、プリンタ処理部５１３に接続される。このような構成により、操作部５１６、スキャナ５１２、プリンタ５１４はそれぞれ、ＣＵ４０１から制御されて動作する。

ブリッジ装置４０２、第１記憶装置４０３と第２記憶装置４０４は、後述の図６および図７で詳細を説明する。ＣＵ４０１は、ＣＵ４０１の各ブロックを統括的に制御するＣＰＵ５０１を含む。ＣＰＵ５０１は、システムバス４１７を介して、ＭＥＭ５０４、ＲＯＭ５０３、操作部Ｉ／Ｆ５１５、ネットワークＩ／Ｆ５０７、ファクスＩ／Ｆ５１７、画像処理部５０９、デバイスＩ／Ｆ５１０、ＰＣＩｅＩ／Ｆ５０２と接続される。ＣＰＵ５０１は、ＲＯＭ５０３に記憶された制御プログラム等に基づいて接続される各種デバイスとのアクセスを統括的に制御するとともに、ＣＵ４０１で実行される各種処理についても統括的に制御する。

ＰＣＩｅ−ＩＦ５０２は、ＰＣＩ−Ｅｘｐｒｅｓｓ規格のインタフェースであり、ＣＰＵ５０１からの要求に応じてブリッジ装置４０２をＥｎｄｐｏｉｎｔとして、ブリッジ装置４０２との送受信するデータのやり取りと行う。

ＲＯＭ５０３は、不揮発性メモリであり、ブリッジ装置４０２のブートプログラムや制御プログラム等が格納される。

ＭＥＭ５０４は、汎用的な揮発性のＲＡＭ（ＤＲＡＭ等のメモリ）であり、一時的にデータが格納され、ＣＰＵ５０１のワークメモリとして働く。ＭＥＭ５０４には、Ｎｏｎ−Ｖｏｌａｔｉｌｅ Ｍｅｍｏｒｙ Ｅｘｐｒｅｓｓ（ＮＶＭｅ）プロトコルで使用するＳｕｂｍｉｓｓｉｏｎ Ｑｕｅｕｅ（ＳＱ）５０５及びＣｏｍｐｌｅｔｉｏｎ Ｑｕｅｕｅ（ＣＱ）５０６が構成される。

ＳＱ５０５は、ＭＥＭ５０４上に生成されるリングバッファのキューであり、ＮＶＭｅのコマンドをやり取りするためにＣＰＵ５０１で生成したＮＶＭｅコマンド（要求）が順々に格納される。

ＣＱ５０６は、ＭＥＭ５０４上に生成されるリングバッファのキューであり、Ｅｎｄｐｏｉｎｔであるブリッジ装置４０２からのコマンド処理完了通知が順々に格納される。

操作部Ｉ／Ｆ５１５は、操作部５１６との間で情報の入出力を行うためのインタフェースである。操作部Ｉ／Ｆ５１５は、ＣＰＵ５０１からの指示により、表示用データを操作部５１６へ出力し、また、ユーザが操作部５１６上で入力した情報を、ＣＰＵ５０１へ伝送する。

ネットワークＩ／Ｆ５０７は、有線や無線媒体のＬＡＮと接続され、情報処理装置とＬＡＮで接続された機器との間の情報の入出力を可能にする。ネットワークＩ／Ｆ５０７は、入力された情報を一時的に記憶するメモリに保持する。ネットワークＩ／Ｆ５０７は、ＬＡＮに対応した構成を有し、例えば、無線距離が数十ｃｍ程度の近距離無線通信（ＮｅａｒＦｉｅｌｄＣｏｍｍｕｎｉｃａｔｉｏｎ）に対応した構成を有する場合もある。その場合には、携帯無線端末との間で相互に通信が行われる。

ファックスＩ／Ｆ５１７は、回線と接続され、情報処理装置と回線で接続された機器との間の情報の入出力を可能にする。ファックスＩ／Ｆ５０７は、入力された情報を一時的に記憶するメモリに保持する。

画像処理部５０９は、汎用的な画像処理を実行する。例えば、ＬＡＮを介して外部から取得した画像データに対して、拡大／縮小、回転、変換等の処理を実行する。また、画像処理部５０９は、ＬＡＮを介して受信したＰＤＬコードをビットマップ画像へ展開する処理を実行する。また、画像処理部５０９は、プリンタ処理部５１３を介してプリンタ５１４で出力する場合に、第１記憶装置４０３に圧縮・符号化されて記憶されている画像データをプリンタ処理部５１３で処理可能な形式にするための処理を実行する。

デバイスＩ／Ｆ５１０は、スキャナ処理部５１１およびプリンタ処理部５１３を介してスキャナ５１２やプリンタ５１４に接続され、画像データの同期系／非同期系の変換や、設定値、調整値等を伝送する。また、デバイスＩ／Ｆ５１０は、スキャナ５１２やプリンタ５１４での状態情報をＣＰＵ５０１へ伝送する。その状態情報は、例えば、スキャナ５１２やプリンタ５１４で発生したジャムなどのエラー情報を含む。

スキャナ処理部５１１は、スキャナ５１２で読み取られて入力した読取データに対して、補正、加工、像域分離、変倍、２値化処理などのスキャン機能に対応した各種処理を行う。

スキャナ５１２は、不図示の自動連続原稿給送装置と圧板読取装置を含み、原稿ガラス台に設置された原稿の読取りや、複数枚の原稿の両面読取りなども実行可能である。また、不図示の給送装置カバーの開閉、不図示の原稿カバーの開閉、原稿の有無、原稿サイズ検知等を行うセンサがスキャナ５１２に設けられている。それらのセンサの検知信号やスキャナ５１２の状態情報は、スキャナ処理部５１１とデバイスＩ／Ｆ５１０を介してＣＰＵ５０１へ送信され、ＣＰＵ５０１は、スキャナ５１２でのエラー発生やエラー解除等の状態を認識する。

プリンタ処理部５１３は、プリント出力する画像データに対して、プリンタ５１４の出力特性に対応した出力補正、解像度変換、画像の印刷位置の調整などのプリント機能に対応した処理を行う。プリンタ５１４は、印刷用紙を収納するための１つ以上の不図示の給紙カセットと、トナーを収納するための１つ以上の不図示のトナートレイと、給紙カセットから紙を１枚ずつ逐次給紙可能な不図示の給紙ユニットとを含む。且つ、プリンタ５１４は、給紙した紙にトナーを印字するための不図示のマーキングユニットと、マーキングユニットにより印字されたトナーを熱と圧力により定着させるための不図示の定着ユニットを含む。各給紙カセットの開閉状況や用紙残量、トナートレイの開閉状況、不図示の給紙ユニットカバーの開閉、トナーの有無、給紙中の紙の位置などを検知するセンサがプリンタ５１４に設けられている。センサからの検知信号やプリンタ５１４の状態情報は、プリンタ処理部５１３とデバイスＩ／Ｆ５１０を介してＣＰＵ５０１へ送信され、ＣＰＵ５０１は、プリンタ５１４でのエラー発生やエラー解除等の状態を認識する。

図６は、ブリッジ装置４０２の詳細ブロック図である。

ブリッジ装置４０２は、サブＣＰＵ６０１と、ＰＣＩｅ−ＩＦ６０２、６０３、６０４とＲＯＭ６０５、ＭＥＭ６０６を有する。また、ブリッジ装置４０２は、ＰＣＩｅ−ＩＦ６０２を介してＣＵ４０１と接続され、ＰＣＩｅ−ＩＦ６０３及び６０４を介して第１記憶装置４０３及び第２記憶装置４０４に接続される。

サブＣＰＵ６０１は、ＲＯＭ６０５に記憶された制御プログラム等に基づいて接続されるＣＵ４０１と第１記憶装置４０３及び第２記憶装置４０４とのアクセスを制御する。さらにサブＣＰＵ６０１は、ＣＵ４０１から受信したコマンド群（要求群）を元に各記憶装置用のコマンド群（要求群）を生成する。

ＰＣＩｅ−ＩＦ（Ｄｅｖｉｃｅ）６０２は、ＣＵ４０１をＲｏｏｔＣｏｍｐｌｅｘとして、ＣＵ４０１との送受信するデータのやり取りを行う。ＰＣＩｅ−ＩＦ（Ｈｏｓｔ１）６０３は、第１記憶装置４０３をＥｎｄｐｏｉｎｔとして、記憶装置との送受信するデータのやり取りを行う。ＰＣＩｅ−ＩＦ（Ｈｏｓｔ２）６０４は、第２記憶装置４０４をＥｎｄｐｏｉｎｔとして、記憶装置との送受信するデータのやり取りを行う。

ＲＯＭ６０５は、不揮発性メモリであり、ブリッジ装置４０２のブートプログラムや制御プログラム等が格納される。

ＭＥＭ６０６は、汎用的な揮発性のＲＡＭ（ＤＲＡＭ等のメモリ）であり、一時的にデータが格納され、サブＣＰＵ６０１のワークメモリとして働く。また、ＭＥＭ６０６には、ＮＶＭｅプロトコルで使用するＳＱとＣＱが２組ずつ構成される（ＳＱ６０７、６０９とＣＱ６０８、６１０）。

ＳＱ６０７は、ＭＥＭ６０６上に生成されるリングバッファのキューであり、ＮＶＭｅのコマンドをやり取りするためにブリッジ装置４０２で生成したＮＶＭｅコマンドを順々に格納していく。

ＣＱ６０８は、ＭＥＭ６０６上に生成されるリングバッファのキューであり、Ｅｎｄｐｏｉｎｔである記憶装置からのコマンド完了通知を順々に格納する。

ＳＱ６０９及びＣＱ６１０はＳＱ６０７及びＣＱ６０８と各々同様である。

図７は、第１記憶装置４０３及び第２記憶装置４０４の詳細ブロック図である。

第１記憶装置４０３は、ＳＳＤコントローラ７０１と、ＰＣＩｅ−ＩＦ７０２と、ＤＲＡＭ７０３と、ＮＡＮＤ ＦＬＡＳＨ７０４を有する。また、第１記憶装置４０３は、ＰＣＩｅ−ＩＦ７０２を介して、ブリッジ装置４０２に接続される。また、第２記憶装置４０４は、第１記憶装置４０３と同等の構成であるため第２記憶装置４０４の構成要件である７０５〜７０８の説明を省略する。

ＳＳＤコントローラ７０１は、記憶装置内で実行されるファームウェアを処理するプロセッサや、ＤＲＡＭ７０３を制御するＤＲＡＭコントローラや、ＮＡＮＤ ＦＬＡＳＨ７０４を制御するＮＡＮＤ ＦＬＡＳＨコントローラが搭載されている。

ＰＣＩｅ−ＩＦ７０２は、ブリッジ装置４０２をＲｏｏｔＣｏｍｐｌｅｘとして、ブリッジ装置４０２との送受信するデータのやり取りを行う。

ＤＲＡＭ７０３は、キャッシュ用のメモリであり、ＮＡＮＤ ＦＬＡＳＨ７０４に対してデータを書き込む前に、そのデータを一時的に保持する。

ＮＡＮＤ ＦＬＡＳＨ７０４は、実際にデータを記録するデバイスであり、データの読み書きが行われる。ここで言うデータとは、例えばシステムソフトウェアプログラム、履歴データ、画像データ、テーブルなどである。

なお、第１記憶装置４０３と第２記憶装置４０４には、データの書き込み時には同じデータが両方の記憶装置に記憶されるが、データの読み出し時には、片方の記憶装置から読み出せばよい。以下の説明では、第１記憶装置４０３をマスタの記憶装置、第２記憶装置４０４をスレーブの記憶装置として扱い、マスタの記憶装置からデータの読み出し処理を行う構成とする。

図８のミラーリングシステムの動作説明図を用いて、ミラーリングシステム４の動作を詳細に説明する。

まずＣＵ４０１のＭＥＭ５０４の構成について説明する。ＳＱ５０５は、キューの先頭要素としてＨｅａｄポインタ８０１、キューの末尾要素としてＴａｉｌポインタ８０２を用いてコマンドを管理する。ＣＱ５０６は、キューの先頭要素としてＨｅａｄポインタ８０３、キューの末尾要素はＴａｉｌポインタ８０４を用いてコマンド応答（応答群）を管理する。なお、ＳＱ５０５及びＣＱ５０６には、Ｈｅａｄポインタ８０１（８０３）とＴａｉｌポインタ８０２（８０４）に挟まれたキューにコマンドが格納される。つまり、ＨｅａｄポインタとＴａｉｌポインタが同じ位置にある場合、キューは空であることを示す。

次にブリッジ装置４０２の構成について説明する。ブリッジ装置４０２のＳＱＴＤ８１３は、Ｓｕｂｍｉｓｓｉｏｎ Ｑｕｅｕｅ Ｔａｉｌ Ｄｏｏｒｂｅｌｌの略である。ＣＱＨＤ８１４は、Ｃｏｍｐｌｅｔｉｏｎ Ｑｕｅｕｅ Ｈｅａｄ Ｄｏｏｒｂｅｌｌの略である。

ＳＱＴＤ８１３は、ＣＵ４０１から受け付けたＳＱ５０５のＴａｉｌポインタ８０２の位置情報を記憶し、記憶した位置情報をサブＣＰＵ６０１に通知するためのレジスタである。ＣＱＨＤ８１４は、ＣＵ４０１内のＣＰＵ５０１がブリッジ装置４０２からのコマンド処理完了通知を受けてＣＱ５０６に格納された情報の内容を確認したことをＣＱ５０６のＨｅａｄポインタ８０３の位置情報を更新して通知するレジスタである。なお、ＳＱＴＤ８１３とＣＱＨＤ８１４は、図６に示すＰＣＩｅＩＦ６０２に含まれてもよいし、ブリッジ装置４０２の内部にＳＱＴＤ８１３とＣＱＨＤ８１４を構成するレジスタとして有してもよい。

ＭＥＭ６０６のＳＱ６０７は、ＣＵ４０１のＳＱ５０５からＴａｉｌポインタ８０２の情報を受け付けて、ＳＱ５０５に格納されたコマンドを取得し格納する。そして、ＳＱ６０７は、受け付けた情報をキューの先頭要素としてＨｅａｄポインタ８０５、キューの末尾要素としてＴａｉｌポインタ８０６として管理する。

コマンド格納後、ＳＱ６０７は、第１記憶装置４０３のＳＱＴＤ８１５にＴａｉｌポインタ８０６の情報を通知する。

また、ＣＱ６０８は、キューの先頭要素としてＨｅａｄポインタ８０７、キューの末尾要素はＴａｉｌポインタ８０８を用いて管理される。そして、ＣＱ６０８は、第１記憶装置４０３からのコマンド処理完了通知（応答群）を格納する。そして、ＣＱ６０８に格納されたコマンド処理完了通知をブリッジ装置４０２にて処理し終えると、ＣＱ６０８のＨｅａｄポインタ８０７の位置情報を更新してＣＱＨＤ８１６に通知する。

ＭＥＭ６０６のＳＱ６０９は、ＣＵ４０１のＳＱ５０５からＴａｉｌポインタ８０２の情報を受け付けて、ＳＱ５０５に格納されたコマンドを取得し格納する。そして、ＳＱ６０９は、受け付けた情報をキューの先頭要素としてＨｅａｄポインタ８０９、キューの末尾要素としてＴａｉｌポインタ８１０として管理する。

コマンド格納後、ＳＱ６０９は、第２記憶装置４０４のＳＱＴＤ８１７にＴａｉｌポインタ８１０の情報を通知する。

また、ＣＱ６１０は、キューの先頭要素としてＨｅａｄポインタ８１１、キューの末尾要素はＴａｉｌポインタ８１２を用いて管理される。そして、ＣＱ６１０は、第２記憶装置４０４からのコマンド処理完了通知（応答群）を格納する。そして、ＣＱ６１０に格納されたコマンド処理完了通知をブリッジ装置４０２にて修理し終えると、ＣＱ６１０のＨｅａｄポインタ８１１の位置情報を更新してＣＱＨＤ８１７に通知する。

さらに、第１記憶装置４０３からのコマンド処理完了通知と第２記憶装置４０４からのコマンド処理完了通知をブリッジ装置４０２が共に処理し終えたら、そのコマンド処理完了通知をＣＱ５０６に通知し格納する。

次に第１記憶装置４０３の構成について説明する。

ＳＱＴＤ８１５とＣＱＨＤ８１６は、第１記憶装置４０３内のレジスタである。ＳＱＴＤ８１５は、ＭＥＭ６０６のＳＱ６０７からＴａｉｌポインタ８０６の情報を受け付ける。

ＳＳＤコントローラ７０１は、受け付けたＴａｉｌポインタ８０６の情報を用いて、ＳＱ６０７のＨｅａｄポインタ８０５からＴａｉｌポインタ８０６まで、コマンドを取得して、それらコマンド処理を順に実行する。ＳＳＤコントローラ７０１は、コマンド処理を実行すると、コマンド処理結果を応答としてＣＱ６０８に送信し、格納される。

そして、ＣＱ６０８内に格納されたコマンド処理結果応答をブリッジ装置４０２で結果内容を確認し終えると、ＣＱ６０８のＨｅａｄポインタ８０７の位置情報を更新してＣＱＨＤ８１６へ通知される。

次に第２記憶装置４０４の構成について説明する。

ＳＱＴＤ８１７とＣＱＨＤ８１８は、第２記憶装置４０４内のレジスタである。ＳＱＴＤ８１７は、ＭＥＭ６０６のＳＱ６０９からＴａｉｌポインタ８１０の情報を受け付ける。

ＳＳＤコントローラ７０５は、受け付けたＴａｉｌポインタ８１０の情報を用いて、ＳＱ６０９のＨｅａｄポインタ８０９からＴａｉｌポインタ８１０まで、コマンドを取得して、それらコマンド処理を順に実行する。ＳＳＤコントローラ７０５は、コマンド処理を実行すると、コマンド処理結果を応答としてＣＱ６１０に送信し、格納される。

そして、ＣＱ６１０内に格納されたコマンド処理結果応答をブリッジ装置４０２で結果内容を確認し終えると、ＣＱ６１０のＨｅａｄポインタ８１１の位置情報を更新してＣＱＨＤ８１８へ通知される。

図８に示すミラーリングシステム４でのコマンドの授受について具体例を用いて説明する。

ＣＵ４０１のＣＰＵ５０１は、第１記憶装置４０３に対してＮＶＭｅプロトコルによるＩＯアクセスを行うために、ＮＶＭｅコマンドを作成する。

なお、ＣＰＵ５０１が、ＩＯアクセスを行う状況は、例えば、スキャナ５１２が原稿を読み込むことで生成したデータを第１記憶装置４０３に記憶させる場合や、記憶したデータを読み出して印刷処理を実行する場合がある。また、例えば、ネットワークＩＦを介してＰＤＬデータを受け付けて第１記憶装置４０３にデータを記憶させ、記憶させたデータの読み出し、印刷処理を実行する場合である。さらに、例えば、ファックスＩＦを介してファクシミリデータを受け付けて第１記憶装置４０３にデータを記憶させ、記憶させたデータの読み出し、印刷処理を実行する場合である。これらのような場合には、データを記憶装置に書き込む、またはデータを記憶装置から読み出す必要があるためＣＰＵ５０１が、第１記憶装置４０３に対してＮＶＭｅプロトコルによるＩＯアクセスを実行する。なお、本実施形態において、これらの例に限定はされない。

ＣＰＵ５０１はＮＶＭｅコマンドを作成すると、ＭＥＭ５０４上のＳＱ５０５に順々に格納していく。ＮＶＭｅコマンドを格納する度にＳＱ５０５のＴａｉｌポインタ８０２を更新し、ＳＱ５０５内に格納されているＮＶＭｅコマンドの末尾位置情報を更新していく。

Ｔａｉｌポインタ８０２が更新されると、ＣＵ４０１は新たにＮＶＭｅコマンドが格納されたことをブリッジ装置４０２に通知する。そのため、通知を受け取ったブリッジ装置４０２内のＳＱＴＤ８１３は、ＳＱ５０５の最終Ｔａｉｌポイント８０２の値を書き込む。

ブリッジ装置４０２は、ＣＵ４０１上で新たにＮＶＭｅコマンドが格納されたことをＳＱＴＤ８１３の値が更新されたことにより判断する。

ブリッジ装置４０２は、ＳＱＴＤ８１３の値が更新されると、ＳＱ５０５内のＨｅａｄポインタ８０１位置からＴａｉｌポインタ８０２位置まで、順に各々のポインタの位置に配置されたＮＶＭｅコマンドを引き出す。具体的には、ＮＶＭｅコマンドの読み出しを行うコマンドを送ることで、ＣＵ４０１にＮＶＭｅコマンドを送信させる。

引き出したＮＶＭｅコマンドは、ブリッジ装置４０２内のＭＥＭ６０６のＳＱ６０７（Ｈｏｓｔ１）とＳＱ６０９（Ｈｏｓｔ２）に格納される。

以下、ブリッジ装置４０２内のＳＱ６０７及びＳＱ６０９にＮＶＭｅコマンドを格納するコマンド処理を図９のフローチャートを用いて詳細に説明する。

ブリッジ装置４０２のＳＱＴＤ８１３がＣＵ４０１からＳＱ５０５のＴａｉｌポインタ８０２の位置情報通知（以下、Ｄｏｏｒｂｅｌｌ通知と称する）を受け付けることにより、位置情報が更新される。

位置情報の更新後、ブリッジ装置４０２はＮＶＭｅコマンドの取得を開始し、ブリッジ装置４０２内のＳＱ６０７及びＳＱ６０９に新たなＮＶＭｅコマンドを格納する。図９は、これら流れを示したフローチャートである。

図９は、サブＣＰＵ６０１によって実行され、ブリッジ装置４０２のＳＱＴＤ８１３がＣＵ４０１からのＳＱ５０５のＤｏｏｒｂｅｌｌ通知を受け付けることにより開始する。

Ｓ９０１においてサブＣＰＵ６０１は、ＳＱＴＤ８１３の値が更新されたかを確認する。これによって、ＣＵ４０１のＳＱ５０５に新たなＮＶＭｅコマンドが格納されたかどうかを確認する。ＳＱＴＤ８１３の値が更新していればＳ９０２に進み、更新がなければＳ９０１にとどまる。

Ｓ９０２において、サブＣＰＵ６０１は、ＣＵ４０１上に準備されたＮＶＭｅコマンドをＳＱ５０５からリードすることで１コマンドを引き出し、Ｓ９０３に進む。

Ｓ９０３において、サブＣＰＵ６０１が引き出したＮＶＭｅコマンドを第１記憶装置４０３側のＳＱ６０７に書き込み、Ｓ９０４に進む。Ｓ９０４において、サブＣＰＵ６０１が引き出したＮＶＭｅコマンドを第２記憶装置４０４側のＳＱ３０９に書き込み、Ｓ９０５に進む。

Ｓ９０５は、ブリッジ装置４０２がＣＵ４０１上のＳＱ５０５に準備されたＮＶＭｅコマンドをすべて引き出し切ったかを判断する。コマンドを引き出した際の参照したＳＱ５０５のポインタとＳＱＴ８Ｄ１３の値を確認し、同一値であればＳＱ５０５に格納された最終コマンドを引き出したと判断できる。すべてのコマンドを引き出した場合終了となり、まだコマンドが残っている場合はＳ９０２に戻り、再度コマンドの引き出しを行う。

なお、ステップＳ９０２において、１コマンドずつ複数回に分けて引き出す構成を示したが、すべてのコマンドを１度に引き出して処理を行ってもよいし、複数のコマンドを複数回に分けて引き出す構成でもよい。

図１０のフローチャートを用いて、ブリッジ装置４０２のＳＱ６０７及びＳＱ６０９にＮＶＭｅコマンドが格納された後のコマンド処理を説明する。

Ｓ１００１においてサブＣＰＵ６０１は、ブリッジ装置４０２内のＳＱ（Ｈｏｓｔ１）６０７に、新たなＮＶＭｅコマンドが格納されたかどうかの確認を行う。

具体的にはサブＣＰＵ６０１が、ＳＱ（Ｈｏｓｔ１）６０７のＨｅａｄポインタ８０５とＴａｉｌポインタ８０６の差を確認する。差がある場合には、新たにＮＶＭｅコマンドを格納されたことになり、Ｓ１００２に進む。差がない場合には、新たなＮＶＭｅコマンドが格納されていないことになり、Ｓ１００５に進む。

Ｓ１００２においてサブＣＰＵ６０１は、ブリッジ装置４０２内のＳＱ（Ｈｏｓｔ１）６０７に新たなＮＶＭｅコマンドが格納されたことを第１記憶装置４０３に通知する。サブＣＰＵ６０１は、Ｄｏｏｒｂｅｌｌ通知を使い、ＳＱ（Ｈｏｓｔ１）６０７のＴａｉｌポインタ８０６の位置情報を第１記憶装置４０３のＳＱＴＤ８１５に書き込む。また、サブＣＰＵ６０１は、第１記憶装置４０３にＮＶＭｅコマンド処理依頼をしたことを記憶するために図１１に示すコマンド処理リスト１１００の第１記憶装置通知フラグ１１０３をＯＮ（１とする）にする。

ここで、コマンド処理リスト１１００の説明をする。図１１に示すコマンド処理リストは、各記憶装置を示す記憶装置名称１１０１とコマンド通知の関係を示す１１０２で構成される。

例えば、第２記憶装置に対してコマンド処理の通知を行っている場合、コマンド通知フラグの値１１０４はＯＮ（１）となり、コマンド処理通知を行っていない場合、コマンド通知フラグの値１１０４はＯＦＦ（０）となる。

Ｓ１００３において、第１記憶装置４０３のＳＱＴＤ８１５の値が更新したことで、第１記憶装置４０３のＳＳＤコントローラ７０１により、ＳＱ６０７からＮＶＭｅコマンドの引き出しが行われる。このとき、サブＣＰＵ６０１は、第１記憶装置４０３からコマンドの送信要求を受け、ＳＱ６０７に保持されたＮＶＭｅコマンドを送信する（送信処理）。このときサブＣＰＵ６０１は、複数のコマンドを１度に送信してもよいし、コマンドを１つずつ送信してもよい。そして、ＳＳＤコントローラ７０１は、引き出されたコマンドの内容に則って処理を行い、コマンド処理が終わるごとに、ブリッジ装置４０２内の第１記憶装置４０３側のＣＱ（Ｈｏｓｔ１）６０８にコマンド処理完了の書きこみを行う。そして、第１記憶装置４０３は、全コマンドの処理が完了するとブリッジ装置４０２に割り込みによる通知を行う。

Ｓ１００４においてサブＣＰＵ６０１は、第１記憶装置４０３でのＮＶＭｅコマンド処理が完了したかどうかの判断を行っている。サブＣＰＵ６０１は、第１記憶装置４０３からのＮＶＭｅコマンド処理完了割り込みが発行されているかどうかを確認する。割り込みで完了割り込みが発行されていればコマンド処理リストの第１記憶装置通知フラグをＯＦＦにしてＳ１００５に進み、完了割り込みが発行されていなければＳ１００４にとどまり、第１記憶装置４０３でのコマンド処理の完了を待つ。

Ｓ１００５においてサブＣＰＵ６０１は、ブリッジ装置４０２内のＳＱ（Ｈｏｓｔ２）６０９に、新たなＮＶＭｅコマンドが格納されたかどうかの確認を行う。サブＣＰＵ６０１は、ＳＱ（Ｈｏｓｔ２）６０９のＨｅａｄポインタ８０９とＴａｉｌポインタ８１０の差を確認し、差があれば新たにＮＶＭｅコマンドを格納されたことになる。新たなＮＶＭｅコマンドが格納されていればＳ１００６に進み、新たなＮＶＭｅコマンドが格納されていなければ終了となる。

Ｓ１００６においてサブＣＰＵ６０１は、ブリッジ装置４０２内のＳＱ（Ｈｏｓｔ２）６０９に新たなＮＶＭｅコマンドが格納されたことを第２記憶装置４０４に通知する。サブＣＰＵ６０１は、Ｄｏｏｒｂｅｌｌ通知を使い、ＳＱ（Ｈｏｓｔ２）６０９のＴａｉｌポインタ８１０の位置情報を第２記憶装置４０４のＳＱＴＤ８１７に書き込む。また、サブＣＰＵ６０１は、第２記憶装置４０４にＮＶＭｅコマンド処理依頼をしたことを記憶するためにコマンド処理リスト１１００の第２記憶装置通知フラグ１１０４をＯＮ（１とする）にする。

Ｓ１００７において、第２記憶装置４０４のＳＱＴＤ８１７の値が更新したことで、第２記憶装置４０４のＳＳＤコントローラ７０５により、ＳＱ６０９からＮＶＭｅコマンドの引き出しが行われる。このとき、サブＣＰＵ６０１は、第２記憶装置４０４からコマンドの送信要求を受け、ＳＱ６０９に保持されたＮＶＭｅコマンドを送信（送信処理）する。このとき、サブＣＰＵ６０１は、複数のコマンドを１度に送信してもよいし、コマンドを１つずつ送信してもよい。

そして、ＳＳＤコントローラ７０５によって、引き出したコマンドの内容に則って処理を行い、コマンド処理が終わるごとに、ブリッジ装置４０２内の第２記憶装置４０４側のＣＱ（Ｈｏｓｔ２）６１０にコマンド処理完了の書きこみが行われる。そして、第１記憶装置４０４は、全コマンドの処理が完了するとブリッジ装置４０２に割り込みによる通知を行う。

Ｓ１００８において、サブＣＰＵ６０１は、第２記憶装置４０４でのＮＶＭｅコマンド処理が完了したかどうかの判断を行っている。サブＣＰＵ６０１は、第２記憶装置４０４からのＮＶＭｅコマンド処理完了割り込みが発行されているかどうかを確認する。割り込みで完了割り込みが発行されていればコマンド処理リストの第２記憶装置通知フラグをＯＦＦにして終了となり、完了割り込みが発行されていなければＳ１００８にとどまり、第２記憶装置４０４でのコマンド処理の完了を待つ。

Ｓ１００８までの処理が完了すると、第１記憶装置４０３と第２記憶装置４０４共にＮＶＭｅコマンドが処理され、そのコマンド結果が各々ＣＱ６０８とＣＱ６１０に格納されたこととなる。

図１２のフローチャートを用いて、ブリッジ装置４０２のＣＱ６０８及びＣＱ６１０にＮＶＭｅコマンドのコマンド処理完了情報が書き込まれた後の処理を説明する。図１２は、記憶装置が複数のコマンドにおける記憶処理（データの書き込み処理）を完了すると開始する。

Ｓ１２０１からＳ１２０３にて、ＣＱ６０８及びＣＱ６１０に書込まれたコマンド処理完了情報にエラー処理情報が含まれているかを順々に確認していく。確認した情報は図１３のリビルドリスト１３００で管理される。リビルドリスト１３００は、記憶装置でのエラー処理情報の有無とそれに伴う記憶装置のデータ修復及びＣＵ４０１への通知手段を示す情報が格納される。

ＣＱ１キュー位置１３０１の列は、ＣＱ６０８のポインタ情報を格納する。最初の行にはＣＱ６０８のＨｅａｄポインタ８０７に一致した情報が格納され、最終行のＣＱ６０８のＴａｉｌポインタ８０８の情報まで順々に格納される。

ＣＱ２キュー位置１３０２の列は、ＣＱ６１０のポインタ情報を格納する。最初の行にはＣＱ６１０のＨｅａｄポインタ８１１に一致した情報が格納され、最終行のＣＱ６１０のＴａｉｌポインタ８１２の情報まで順々に格納される。

ＣＱ１エラー情報１３０３の列は、ＣＱ１キュー位置１３０１に格納されている位置情報の箇所のコマンド処理完了情報にエラー処理情報が含まれているかどうかを示す。エラー処理情報がある場合には“１”が書き込まれ、ない場合には“０”が書き込まれる。

ＣＱ２エラー情報１３０４の列は、ＣＱ２キュー位置１３０２に格納されている位置情報の箇所のコマンド処理完了情報にエラー処理情報が含まれているかどうかを示す。エラー処理情報がある場合には“１”が書き込まれ、ない場合には“０”が書き込まれる。

修復処理および通知１３０５の列は、データの修復処理の有無とＣＵ４０１への通知の方法を示す。ＣＱ１エラー情報１３０３とＣＱ２エラー情報１３０４共にエラー処理情報がない場合は、修復処理を行わずＣＵ４０１にマスタ記憶装置であるＣＱ（Ｈｏｓｔ１）６０８のコマンド処理完了情報を通知することを示す“０”が書き込まれる。（リビルドリスト１３００内のアドレス１３１０で示されている行を参照）
ＣＱ１エラー情報１３０３もしくはＣＱ２エラー情報１３０４の一方にエラー処理情報がある場合には修復処理を行いＣＵ４０１に正常な記憶装置のＣＱのコマンド処理完了情報を通知することを示す“１”が書き込まれる。（リビルドリスト１３００内のアドレス１３１１で示されている行を参照）
ＣＱ１エラー情報１３０３とＣＱ２エラー情報１３０４共にエラー処理情報がある場合は、修復処理を行わずＣＵ４０１にマスタ記憶装置であるＣＱ６０８のコマンド処理完了情報を通知することを示す“２”が書き込まれる。（リビルドリスト１３００内の１３１２で示されている行を参照）
記憶装置アドレス１３０６の列は、コマンドが処理を実施した記憶装置のアドレス情報が書き込まれる。

図１２の説明に戻る。Ｓ１２０１において、サブＣＰＵ６０１は、ブリッジ装置４０２内のＣＱ６０８に格納されているコマンド処理完了情報にエラー処理情報が含まれているか確認する。

確認を行ったＣＱ６０８のポインタ情報をＣＱ１キュー位置１３０１に格納する。当該のコマンド処理完了情報にエラー処理情報が含まれている場合には、ＣＱ１エラー情報１３０３にエラーあり（１）を格納し、エラー処理情報が含まれない場合には、エラーなし（０）を格納する。また、コマンドが処理を行った記憶装置のアドレスを記憶装置アドレス１３０６に格納する。

Ｓ１２０２において、サブＣＰＵ６０１は、ブリッジ装置４０２内のＣＱ６１０に格納されているコマンド処理完了情報にエラー処理情報が含まれているか確認する。確認を行ったＣＱ６１０のポインタ情報をＣＱ２キュー位置１３０２に格納する。そして、当該のコマンド処理完了情報にエラー処理情報が含まれている場合には、ＣＱ２エラー情報１３０４にエラーあり（１）を格納し、エラー処理情報が含まれない場合には、エラーなし（０）を格納する。

Ｓ１２０３において、サブＣＰＵ６０１は、ＣＱ６０８とＣＱ６１０のコマンド処理完了情報を全て確認し終えたかを判断するために、確認し終えたコマンド処理完了情報のキューの位置情報とＣＱのＴａｉｌポインタが一致しているか確認する。確認し終えたコマンド処理完了情報のキューの位置情報とＣＱのＴａｉｌポインタが一致している場合は、すべて情報を確認し終えているため、Ｓ１２０４に進む。一致していない場合には、次のコマンド処理完了情報を確認するために、Ｓ１２０１に進む。

Ｓ１２０１からＳ１２０３で、各ＣＱのコマンド処理完了情報にエラー情報を含んでいるかの確認が終わり、その結果からリビルドリスト１３００が作成される。

Ｓ１２０４において、サブＣＰＵ６０１は、作成されたリビルドリスト１３００の修復処理および通知１３０５を参照して、“１”が書き込まれているか否かを確認し、確認結果に応じて遷移する。言い換えると、ＣＱ６０８とＣＱ６１０の同一のキュー位置において、１つの記憶装置のみでエラーが発生したかを確認する。

修復処理および通知１３０５において“１”が書き込まれていない場合、すなわち修復処理および通知１３０５に“０”または“２”が書き込まれている場合は、Ｓ１２０７に進む。言い換えると、ＣＱ１エラー情報１３０３とＣＱ２エラー情報１３０４の両方が“０”である場合と、両方が“１”である場合は、Ｓ１２０７に進む。さらに言い換えると、１つの記憶装置のみでエラーが発生している状況ではない場合はＳ１２０７に進む。

修復処理および通知１３０５において“１”が書き込まれている場合、すなわち修復処理および通知１３０５に“０”または“２”が書き込まれていない場合は、修復処理を実行するためにＳ１２０５に進む。言い換えると、ＣＱ１エラー情報１３０３とＣＱ２エラー情報１３０４のどちらか一方が“０”、他方が“１”である場合に、Ｓ１２０５に進む。さらに言い換えると、１つの記憶装置のみでエラーが発生している場合には、Ｓ１２０５に進む。

Ｓ１２０５において、サブＣＰＵ６０１は、ミラーリングシステムにおいて記憶装置４０４および記憶装置４０３の両方に同じコマンドを送信するミラー状態を解除する。そして、サブＣＰＵ６０１は、ＣＱ６０８とＣＱ６１０の同一のキュー列においてエラーが発生していないＣＱに対応する記憶装置からデータを読み出す。例えば、リビルドリスト１３００のアドレス１３１１の行において、コマンド処理完了情報にエラー処理情報を含まないことを示す“０”が書き込まれたＣＱ６１０に対応する記憶装置４０４のアドレスＢからデータを読み出す。読み出したデータはブリッジ装置４０２内のＭＥＭ６０６を用いて一時保存してもよいし、ブリッジ装置４０２内にリビルド専用のバッファメモリを用意して一時保存してもよい。Ｓ１２０５を終えるとＳ１２０６に遷移する。

Ｓ１２０６において、サブＣＰＵ６０１は、ＣＱ６０８とＣＱ６１０の同一のキュー列においてエラーが発生したＣＱに対応する記憶装置にＳ１２０５にて読み出したデータを書き込む。例えば、リビルドリスト１３００のアドレス１３１１の行において、コマンド処理完了情報にエラー処理情報を含むことを示す“１”が書き込まれたＣＱ６０８に対応する記憶装置４０３のアドレスＢに、Ｓ１２０５の例で読み出したデータを書き込む。Ｓ１２０６を終えるとＳ１２０７に遷移する。

Ｓ１２０７において、サブＣＰＵ６０１は、リビルドリスト１３００の最終行まで修復処理の判定が行われたかを確認する。すべて修復処理の判定が完了している場合には、Ｓ１２０８に進む。判定がすべて完了していない場合には、Ｓ１２０４に進む。

最終行までの修復処理の例を、図１３を用いて説明する。図１３であれば、前述したアドレス１３１１の行において修復処理を行い、アドレス１３１３の行で修復処理を行う。アドレス１３１３の行では、まずコマンド処理完了情報にエラー処理情報を含まないことを示す“０”が書き込まれたＣＱ６０８に対応する記憶装置４０３のアドレスＤからデータを読み出す。そして、コマンド処理完了情報にエラー処理情報を含むことを示す“１”が書き込まれたＣＱ６１０に対応する記憶装置４０３のアドレスＤに、読み出したデータを書き込む。

Ｓ１２０８において、サブＣＰＵ６０１は、ブリッジ装置４０２で持っているコマンド処理完了情報をＣＵ４０１に格納する。ＣＱ６０８またはＣＱ６１０のどちらのコマンド処理完了情報をＣＵ４０１に格納するか判断するために、リビルドリスト１３００の修復処理および通知１３０５を参照する。

リビルドリスト１３００の修復処理および通知１３０５に“０”が書き込まれている場合、ＣＵ４０１のＣＱ５０６にマスタ記憶装置であるＣＱ６０８のコマンド処理完了情報を書き込む。修復処理および通知１３０５に“１”が書き込まれている場合、ＣＵ４０１のＣＱ５０６に正常であることを示す記憶装置のＣＱのコマンド処理完了情報を書き込む。ここで“１”を書き込まない理由は、修復処理によって、記憶装置４０３と記憶装置４０４にデータを正常に記憶することが出来たからである。

修復処理および通知１３０５に“２”が書き込まれている場合、ＣＵ４０１のＣＱ５０６にマスタ記憶装置であるＣＱ６０８のコマンド処理完了情報を書き込む。このとき、マスタ記憶装置のコマンド処理エラー情報を書き込む理由は、記憶装置４０３と記憶装置４０４のどちらもエラーとなっているため、修復処理できないからである。

Ｓ１２０９においてサブＣＰＵ６０１は、記憶装置に対するコマンド処理が完了して、その処理完了通知をすべてＣＵ４０１のＣＱ５０６に書き込み終えたことをＣＵ４０１に通知する。サブＣＰＵ６０１は、割り込みを使用してＣＵ４０１に終了したコマンド処理のコマンド完了情報がＣＱ５０６にすべて書き終えたことを通知する。

Ｓ１２０８のＣＵ４０１のＣＱ５０６への通知の仕方について具体的な説明を図１７（ａ）（ｂ）を用いて行う。図１７は、ミラーリングシステムの応答構成を示すブロック図である。図１７において“×”は、エラーとなるコマンド（応答）を示している。“×”がついていないものは、正常となるコマンド（応答）を示している。図１７では、アドレス１３１０に対応するキューをコマンドＡ、アドレス１３１１に対応するキューをコマンドＢ、アドレス１３１２に対応するキューをコマンドＣ、アドレス１３１３に対応するキューをコマンドＤとする。また各コマンドに対応する応答を応答Ａ〜応答Ｄとする。なお、従来との通知の差分を容易な形で説明するために、アドレス１３１２については、正常となるコマンドであるものとする。その他のコマンドは省略する。

従来の通知の仕方を図１７（ａ）に示す。従来の通知では、１度の書き込み処理に対して応答を行う。そのため従来の通知の仕方を適用すると、次のようになる。サブＣＰＵ６０１は、記憶装置４０３の応答として、応答Ｂにおいてエラーを受ける。また、記憶装置４０４の応答として、応答Ｄにおいてエラーを受ける。そのため、サブＣＰＵ６０１は、ＣＵ４０１に、エラーが生じた旨の応答を１つの応答で返す。そして、ＣＵ４０１は、コマンドＡ、コマンドＢ、コマンドＣ、コマンドＤのリトライを実行する。

一方、本実施例では、図１７（ｂ）に示すようにサブＣＰＵ６０１は、ＣＵ４０１から受信した各コマンドの各々に対して応答を返す。これにより、ＣＵ４０１は、各コマンドの各々に対してエラーか正常かを判断することが可能となる。さらに、本実施例では、図１７（ｂ）に示すようにアドレス１３１１とアドレス１３１３に修復処理を実行し、アドレス１３１１とアドレス１３１３のキュー位置において正常である旨の通知をすることが出来る。そのため、サブＣＰＵ６０１は、ＣＵ４０１に、応答Ａから応答Ｄにおいて正常である旨の通知を返す。

つまり、従来の構成を適用すると、複数のコマンドを１度の書き込み処理として扱ってしまう。さらに、一方の記憶装置への書き込みが成功しており、データ修復可能であるにも関わらずホストシステムに当該書き込み処理に対して書き込みエラーを通知してしまうおそれがある。

しかし、本実施例の構成によれば、サブＣＰＵは、両記憶装置の応答を確認した上でＣＵ４０１に各コマンドに対する応答を送信することが可能となる。そして、データ修復可能なものはデータ修復するためコマンドのリトライを削減することが可能となる。

以上の本実施例の構成によれば、複数のコマンドを一度に扱うプロトコルを用いた際に、複数の記憶装置の同一のキュー位置における複数の記憶装置の各々の応答に応じてホストシステムに応答可能なミラーリングシステムを提供することが可能となる。

（実施例２）
実施例１では、ブリッジ装置４０２に格納されたコマンド処理完了情報のエラー処理情報を基に、リビルドリスト１３００を作成し、１つ１つのコマンド単位で修復を行うか判定していく構成のミラーリングシステムの説明をした。

実施例２では、１度に扱う複数コマンドの中で、同アドレスへの書き込みアクセスが複数あり、その際の書き込みデータが異なる場合の修復方法に関して図１４〜図１６を用いて説明する。図４〜図１１までは実施例１と同様であるため説明を省略する。

図１４に本実施例の具体的な状況図を示す。コマンドＡからコマンドＥはＮＶＭｅプロトコルで１度に扱う１つのコマンド群であり、コマンドＢとコマンドＥは同アドレスへのデータ書き込みであるが、書き込みを行う順番と書き込むデータが異なる。

このような状況下で、ブリッジ装置を介して第１記憶装置と第２記憶装置にコマンド処理を実施する。その結果、第１記憶装置側ではコマンドＢがエラーを起こし、第２記憶装置側ではコマンドＥがエラーを起こした状況を示している。

図１４で示す状況では、コマンドＢで書き込んだデータは、最終的な書き込みを行ったコマンドＥで書き込んだデータで上書きされているので、修復処理ではコマンドＥの修復処理のみを行うように制御する。すなわち、コマンドＢの修復処理はスキップし、コマンドＥの修復処理のみを行う。以下で具体的な方法を説明する。

実施例２において、ブリッジ装置４０２のＣＱ６０８およびＣＱ６１０に各記憶装置のコマンド処理完了情報が書き込まれた後、ブリッジ装置４０２でのデータの修復処理を説明する。本実施例では、図１５を用いて実施例１の図１２との差分を説明する。同様の構成には同様の番号を付して説明を省略する。

Ｓ１５０１において、サブＣＰＵ６０１は、例として図１６（ａ）に示すリビルドリスト１６００ａの修復処理および通知１３０５を参照して、修復処理を実行するものか否かを確認する。具体的には、修復処理および通知１３０５が“１”であるか否かを確認する。なお、実施例１の図１２のように言い換えてもよい。

リビルドリスト１６００ａの確認は、リビルドリスト１６００ａの末尾から確認を行っていく。なお、図１６（ａ）は図１３で説明したリビルドリスト１３００と同じ構成である。

サブＣＰＵ６０１は、リビルドリスト１６００ａの修復処理および通知１３０５を参照し、修復処理を実行することを示す“１”が書き込まれているかを確認する。そして修復処理を実行するもの（“１”が書き込まれているもの）でリビルドリスト内に記憶装置アドレス１３０６が同一アドレスになっているものがあるか否かを判断する。同一アドレスが存在すれば、Ｓ１５０２に進む。同一アドレスが存在しなければ、Ｓ１５０３に進む。言い換えると、ＣＱ６０８とＣＱ６１０の同一のキュー位置で、一方が“１”、他方が“０”の構成が、複数のキュー位置にあり、且つ、複数のキュー位置の中に書き込み先が同一アドレスのキュー位置が有る否かを判断する。

Ｓ１５０２において、サブＣＰＵ６０１は、同一アドレスの修復処理のキュー位置の中で、コマンド処理順が最新以外の物の修復処理および通知１３０５の“１”を“３”に書き換える。言い換えると、同一のアドレスに最後に書き込みを行ったキュー位置に対応する修復および通知１３０５を１として残し、それ以外のキュー位置に対応する修復および通知１３０５を３に書き換える。修復処理および通知１３０５に“３”が書き込まれた場合、修復処理を行わず、ＣＵ４０１に通知するＣＱの情報は正常な記憶装置のＣＱのコマンド処理完了情報（“０”）を通知することを示す。

図１６を用いて具体的に説明する。図１６（ａ）のリビルドリスト１６００ａの末尾から、修復処理を実行することを示す“１”が書き込まれているコマンド処理を確認する。

ここで修復処理および通知に“１”が書き込まれているキュー位置の記憶装置アドレス１３０６を確認する。ここでは、アドレス１６０２がアドレスＢであることを確認する。そして、修復処理および通知に“１”が書き込まれている他のキュー位置を確認し、アドレスＢの有無を確認する。

ここでは、アドレス１６０１がアドレスＢとなっている。これより以前のコマンド処理の中で修復処理を実行するキュー位置で同一アドレスの物があるか確認する。そして、アドレス１６０１は、アドレス１６０２よりも前に書き込みを行っているため、１６０１の行の記憶装置アドレス１３０６に対応する修復処理および通知１３０５の“１”の情報を“３”に書き換える。置き換えた構成を図６（ｂ）に示す。図６（ｂ）では、通知処理及び通知１６０３が“３”に置き換えられている。

Ｓ１５０３において、サブＣＰＵ６０１は、リビルドリスト１６００の最終行から１行目まで同一アドレスの修復処理の物があるかを確認し終えたかを確認する。すべての確認が完了している場合には、Ｓ１５０４に進む。確認がすべて完了していない場合には、Ｓ１５０１に進む。

Ｓ１５０４において、サブＣＰＵ６０１は、作成されたリビルドリスト１６００ｂの修復処理および通知１３０５を参照して、“１”が書き込まれているか否かを確認する。言い換えると、ＣＱ６０８とＣＱ６１０の同一のキュー位置において、１つの記憶装置のみでエラーが発生したかを確認する。

修復処理および通知１３０５において“１”が書き込まれていない場合には、（１つの記憶装置のみでエラーが発生していない場合）、すなわち修復処理および通知１３０５に“０”、“２”または“３”が書き込まれている場合は、Ｓ１２０７に進む。言い換えると、ＣＱ１エラー情報１３０３とＣＱ２エラー情報１３０４の両方が“０”である場合と、両方が“１”である場合には、Ｓ１２０７に進む。さらに、ＣＱ１エラー情報１３０３とＣＱ２エラー情報１３０４の一方が“１”で他方が“０”であり、且つ、対応する記憶装置アドレス１３０６が同じ場合には、Ｓ１２０７に進む。

修復処理および通知１６０５において“１”が書き込まれている場合には、すなわち修復処理および通知１６０５に“０”、“２”または“３”が書き込まれていない場合は、修復処理を実行するためにＳ１２０５に進む。言い換えると、ＣＱ１エラー情報１３０３とＣＱ２エラー情報１３０４の一方が“１”で他方が“０”であり、且つ、対応する記憶装置アドレス１３０６が違う場合には、Ｓ１２０５に進む。さらに言い換えると、１つの記憶装置のみでエラーが発生している場合にＳ１２０５に進む。

Ｓ１５０９は、Ｓ１２０９と同様であるが、スキップしたアドレスＢへの書き込みを指示するコマンドへの応答に対して、サブＣＰＵ６０１が正常に処理した旨のコマンドをＣＵ４０１に返す点で異なる。

以上の本実施例の構成においても、複数のコマンドを一度に扱うプロトコルを用いた際に、複数の記憶装置の同一のキュー位置における複数の記憶装置の各々の応答に応じてホストシステムに応答可能なミラーリングシステムを提供することが可能となる。

（その他の実施形態）
以上、本発明の様々な例と実施形態を示して説明したが、本発明の趣旨と範囲は、本明細書内の特定の説明に限定されるものではない。

本発明は、上述の実施形態の１以上の機能を実現するプログラムを、ネットワーク又は記憶媒体を介してシステム又は装置に供給し、そのシステム又は装置のコンピュータにおける１つ以上のプロセッサがプログラムを読出し実行する処理でも実現可能である。また、１以上の機能を実現する回路（例えば、ＡＳＩＣ）によっても実現可能である。

４０１ ＣＵ
４０２ ブリッジ装置
４０３ 第１記憶装置
４０４ 第２記憶装置

Claims (18)

1. 不揮発性の第１記憶手段および不揮発性の第２記憶手段を有する情報処理装置であって、
   少なくとも２つの要求をコントローラユニットから受信する第１受信手段と、
   前記少なくとも２つの要求を受信した順番に前記第１記憶手段に送信する第１送信手段と、
   前記少なくとも２つの要求を受信した順番に前記第２記憶手段に送信する第２送信手段と、
   前記少なくとも２つの要求を送信した順番に対応して、前記第１記憶手段から前記少なくとも２つの要求の各々に対応する応答を受信する第２受信手段と、
   前記少なくとも２つの要求を送信した順番に対応して、前記第２記憶手段から前記少なくとも２つの要求の各々に対応する応答を受信する第３受信手段と、
   前記第２受信手段が受信した順番に前記少なくとも２つの要求に対応する応答を保持する第１保持手段と、
   前記第３受信手段が受信した順番に前記少なくとも２つの要求に対応する応答を保持する第２保持手段と、
   前記少なくとも２つの要求のうち同じ要求に対応する前記第１保持手段および前記第２保持手段が保持した各々の応答に基づいて、前記同じ要求に対応する応答を送信する第３送信手段と、を有することを特徴とする情報処理装置。
2. 前記第１保持手段が保持した応答および前記第２保持手段が保持した応答にエラーを示す情報が含まれるかを確認する確認手段をさらに有し、
   前記第３送信手段は、前記同じ要求に対応する前記第１保持手段および前記第２保持手段が保持した各々の応答に前記エラーを示す情報が含まれるか否かに応じた前記同じ要求に対する応答を送信することを特徴とする請求項１に記載の情報処理装置。
3. 前記第１受信手段は、前記少なくとも２つの要求として、第１アドレスにデータを記憶させる第１要求および第２アドレスにデータを記憶させる第２要求を少なくとも受信し、
   前記第２受信手段は、少なくとも前記第１要求に対する第１応答および前記第２要求に対する第２応答を、前記第１記憶手段から順番に受信し、
   前記第３受信手段は、少なくとも前記第１要求に対する第３応答および前記第２要求に対する第４応答を、前記第２記憶手段から順番に受信し、
   前記第１保持手段は、少なくとも前記第１応答および前記第２応答を受信した順番に保持し、
   前記第２保持手段は、少なくとも前記第３応答および前記第４応答を受信した順番に保持し、
   前記第３送信手段は、前記第１応答がエラーを示す情報を含まず且つ前記第３応答がエラーを示す情報を含むことに従って、前記第１要求に対してエラーを示す情報を含まない第５応答を前記コントローラユニットに送信することを特徴とする請求項２に記載の情報処理装置。
4. 前記第３送信手段は、前記第２応答がエラーを示す情報を含み且つ前記第４応答がエラーを示す情報を含むことに従って、前記第２要求に対してエラーを示す情報を含む第６応答を前記コントローラユニットに送信することを特徴とする請求項３に記載の情報処理装置。
5. 前記３送信手段が前記第６応答を送信した後、前記第１受信手段は、前記コントローラユニットから第２要求を再び受信することを特徴とする請求項４に記載の情報処理装置。
6. 前記第３送信手段は、前記第２応答または前記第４応答の一方がエラーを示す情報を含み、他方がエラーを示す情報を含まないことに従って、前記第２要求に対してエラーを示す情報を含まない第７応答を前記コントローラユニットに送信することを特徴とする請求項３乃至５のいずれか１項に記載の情報処理装置。
7. 前記第１記憶手段と前記第２記憶手段をミラーリングシステムとしてミラー状態で制御する制御手段を有することを特徴とする請求項３乃至６のいずれか１項に記載の情報処理装置。
8. 前記制御手段は、前記確認手段がエラーを示す情報を確認すると、ミラー状態を解除することを特徴とする請求項７に記載の情報処理装置。
9. 前記制御手段は、
   前記第１応答がエラーを示す情報を含まず且つ前記第３応答がエラーを示す情報を含むことに従って、前記第１要求に対応する前記第１記憶手段の第１アドレスからデータの読み出しを行い、前記第１要求に対応する前記第２記憶手段の第１アドレスに前記第１記憶手段の第１アドレスから読み出したデータを書き込ませることを特徴とする請求項８に記載の情報処理装置。
10. 前記制御手段は、前記第４応答がエラーを示す情報を含まず且つ前記第２応答がエラーを示す情報を含むことに従って、前記第２要求に対応する前記第２記憶手段の第２アドレスからデータの読み出しを行い、前記第２要求に対応する前記第１記憶手段の第２アドレスに前記第２記憶手段の第２アドレスから読み出したデータを書き込ませることを特徴とする請求項９に記載の情報処理装置。
11. 前記第１記憶手段および前記第２記憶手段は、ＳＳＤであることを特徴とする請求項１乃至１０のいずれか１項に記載の情報処理装置。
12. 前記第３送信手段は、前記第１受信手段が受信した要求の各々に対応する応答を送信することを特徴とする請求項１乃至１１のいずれか１項に記載の情報処理装置。
13. 前記第１受信手段が受信した前記少なくとも２つの要求を、受信した順番に保持する第３保持手段を有することを特徴とする請求項１乃至１２のいずれか１項に記載の情報処理装置。
14. 前記コントローラユニットは、プリンタを制御するプリンタ処理部を含むことを特徴とする請求項１乃至１３のいずれか１項に記載の情報処理装置。
15. 前記コントローラユニットは、スキャナを制御するスキャナ処理部を含むことを特徴とする請求項１乃至１４のいずれか１項に記載の情報処理装置。
16. 不揮発性の第１記憶手段と、不揮発性の第２記憶手段と、少なくとも２つの要求をコントローラユニットから受信する第１受信手段と、前記少なくとも２つの要求を受信した順番に前記第１記憶手段に送信する第１送信手段と、前記少なくとも２つの要求を受信した順番に前記第２記憶手段に送信する第２送信手段と、前記少なくとも２つの要求を送信した順番に対応して、前記第１記憶手段から前記少なくとも２つの要求の各々に対応する応答を受信する第２受信手段と、前記少なくとも２つの要求を送信した順番に対応して、前記第２記憶手段から前記少なくとも２つの要求の各々に対応する応答を受信する第３受信手段と、前記第２受信手段が受信した順番に前記少なくとも２つの要求に対応する応答を保持する第１保持手段と、前記第３受信手段が受信した順番に前記少なくとも２つの要求に対応する応答を保持する第２保持手段と、を有する情報処理装置の制御方法であって、
    前記少なくとも２つの要求のうち同じ要求に対応する前記第１保持手段および前記第２保持手段が保持した各々の応答に基づいて、前記同じ要求に対応する応答を送信するステップと、を有することを特徴とする情報処理装置の制御方法。
17. 請求項１６に記載の制御方法を、コンピュータに実行させるためのプログラム。
18. 請求項１７に記載のプログラムを格納したコンピュータで読み取り可能な記憶媒体。

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