JP2021064855A - Electronic control device - Google Patents

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Abstract

To provide an electronic control device that can improve the reliability of a relay function.SOLUTION: An ECU 1 includes external communication ports P1 and P2, CPUs 41 and 51, power supply circuits 43 and 53 that supply power supply voltage to the respective CPUs 41 and 51, an Ethernet switch (hereinafter referred to as a switch) 30, and an abnormality detection unit 45. The switch 30 can send and receive frames via the external communication ports P1 and P2, and can send and receive frames to and from the CPUs 41 and 51, and relays the received frames. The abnormality detection unit 45 detects any abnormality of the CPU 41 and the power supply voltage supplied from the power supply circuit 43 to the CPU 41. When an abnormality is detected by the abnormality detection unit 45, the CPU 51 changes the CPU that controls the switch 30 from the CPU 41 to the CPU 51, and further changes the setting of the switch 30 such that a frame addressed to the CPU 41 is transferred from the switch 30 to the CPU 51.SELECTED DRAWING: Figure 1

Description

本開示は、中継機能を有した電子制御装置に関する。 The present disclosure relates to an electronic control device having a relay function.

例えば車載イーサネットの通信システムにおいては、異なるＶＬＡＮ間のフレームを中継する機能を有した電子制御装置が設けられる。ＶＬＡＮは「Virtual Local Area Network」の略である。下記の特許文献１に示されるように、中継機能を有した電子制御装置は、複数の外部通信ポートと、トランシーバとして機能するデバイスであるＰＨＹと、フレームの中継を行う中継部としてのスイッチと、スイッチを制御する装置（例えば、ＣＰＵ）と、を備える。ＰＨＹは「Physical Layer」の略である。 For example, in an in-vehicle Ethernet communication system, an electronic control device having a function of relaying frames between different VLANs is provided. VLAN is an abbreviation for "Virtual Local Area Network". As shown in Patent Document 1 below, the electronic control device having a relay function includes a plurality of external communication ports, a PHY device that functions as a transceiver, a switch as a relay unit that relays frames, and the like. A device (for example, a CPU) for controlling a switch is provided. PHY is an abbreviation for "Physical Layer".

特開２０１８−７４２４３号公報JP-A-2018-74243

発明者の詳細な検討の結果、下記の課題が見出された。
中継機能を有した電子制御装置において、中継部を制御する処理部が正常に動作しなくなった場合には、中継部の正しい動作が期待できず、延いては、通信システムにおけるフレームの適切な中継及び処理が実現されなくなる可能性が高い。なお、単一故障による通信システムへの影響を低減する手法として、例えば、リング状のトポロジを採用すること等によりネットワークを二重化する手法も考えられるが、車両における部品数やハーネス数の増加を招き易い。 As a result of detailed examination by the inventor, the following problems were found.
In an electronic control device having a relay function, if the processing unit that controls the relay unit does not operate normally, the correct operation of the relay unit cannot be expected, and by extension, an appropriate relay of the frame in the communication system. And there is a high possibility that the processing will not be realized. As a method for reducing the influence of a single failure on the communication system, for example, a method of duplicating the network by adopting a ring-shaped topology can be considered, but this causes an increase in the number of parts and harnesses in the vehicle. easy.

そこで、本開示の１つの局面は、中継機能の信頼性を高めることが可能な電子制御装置を提供する。 Therefore, one aspect of the present disclosure is to provide an electronic control device capable of increasing the reliability of the relay function.

本開示の１つの態様による電子制御装置は、外部装置とフレームを送受信するための少なくとも１つの外部通信ポート（Ｐ１，Ｐ２）と、第１の処理部（４１）と、第２の処理部（５１）と、第１の電源部（４３）と、第２の電源部（５３）と、中継部（３０）と、異常検出部（４５）と、変更部（５１，Ｓ１３０〜Ｓ１５０）と、を備える。 The electronic control device according to one aspect of the present disclosure includes at least one external communication port (P1, P2) for transmitting and receiving a frame to and from an external device, a first processing unit (41), and a second processing unit ( 51), the first power supply unit (43), the second power supply unit (53), the relay unit (30), the abnormality detection unit (45), the change unit (51, S130 to S150), To be equipped.

第１の電源部は、第１の処理部に電源電圧を供給する。第２の電源部は、第２の処理部に電源電圧を供給する。このため、第１の処理部と第２の処理部は、別々の電源電圧で動作することができる。中継部は、少なくとも１つの外部通信ポートを介したフレームの送受信と、第１の処理部及び第２の処理部とのフレームの送受信とが可能であり、受信したフレームの中継を行う。異常検出部は、第１の処理部と、第１の電源部から第１の処理部へ供給される電源電圧との、少なくとも一方の異常を検出する。変更部は、異常検出部により第１の処理部と第１の処理部への電源電圧との少なくとも一方の異常が検出された場合に、中継部を制御する処理部を、第１の処理部から第２の処理部に変更する。更に、変更部は、第１の処理部宛てのフレームが中継部から第２の処理部に転送されるように、中継部の設定を変更する。なお、第１の処理部宛てのフレームとは、第１の処理部を宛先とするフレームである。 The first power supply unit supplies a power supply voltage to the first processing unit. The second power supply unit supplies a power supply voltage to the second processing unit. Therefore, the first processing unit and the second processing unit can operate at different power supply voltages. The relay unit is capable of transmitting and receiving frames via at least one external communication port and transmitting and receiving frames with the first processing unit and the second processing unit, and relays the received frames. The abnormality detection unit detects at least one abnormality of the first processing unit and the power supply voltage supplied from the first power supply unit to the first processing unit. The changing unit is a processing unit that controls a relay unit when an abnormality of at least one of the first processing unit and the power supply voltage to the first processing unit is detected by the abnormality detecting unit. To the second processing unit. Further, the changing unit changes the setting of the relay unit so that the frame addressed to the first processing unit is transferred from the relay unit to the second processing unit. The frame addressed to the first processing unit is a frame addressed to the first processing unit.

このような構成によれば、異常検出部が異常を検出した場合、即ち、第１の処理部が正常に動作しない場合に、第１の処理部に代わって、第２の処理部が中継部を制御することができる。そして、第１の処理部宛てのフレームは、第２の処理部に転送されるため、正常に動作する第２の処理部によって処理されることができる。 According to such a configuration, when the abnormality detection unit detects an abnormality, that is, when the first processing unit does not operate normally, the second processing unit replaces the first processing unit with the relay unit. Can be controlled. Then, since the frame addressed to the first processing unit is transferred to the second processing unit, it can be processed by the second processing unit that operates normally.

よって、当該電子制御装置における中継機能の信頼性を高めることができ、延いては、当該電子制御装置が用いられる通信システムの信頼性を高めることができる。 Therefore, the reliability of the relay function in the electronic control device can be enhanced, and the reliability of the communication system in which the electronic control device is used can be enhanced.

第１実施形態の電子制御装置の構成を示す構成図である。It is a block diagram which shows the structure of the electronic control apparatus of 1st Embodiment. 第１実施形態の電子制御装置で行われる処理のフローチャートである。It is a flowchart of the process performed by the electronic control device of 1st Embodiment. 第１実施形態の電子制御装置の作用を説明する説明図である。It is explanatory drawing explaining the operation of the electronic control apparatus of 1st Embodiment. 第２実施形態の電子制御装置の構成を示す構成図である。It is a block diagram which shows the structure of the electronic control apparatus of 2nd Embodiment. 第３実施形態の電子制御装置の構成を示す構成図である。It is a block diagram which shows the structure of the electronic control device of 3rd Embodiment. 第３実施形態の電子制御装置で、更に行われる処理のフローチャートである。It is a flowchart of the process further performed in the electronic control apparatus of 3rd Embodiment. 第４実施形態の電子制御装置の構成を示す構成図である。It is a block diagram which shows the structure of the electronic control device of 4th Embodiment. 第４実施形態の電子制御装置で、更に行われる処理のフローチャートである。It is a flowchart of the process further performed in the electronic control apparatus of 4th Embodiment.

以下、図面を参照しながら、本開示の実施形態を説明する。
［１．第１実施形態］
［１−１．構成］
図１に示す第１実施形態の電子制御装置（以下、ＥＣＵ）１は、例えば乗用車等の車両に搭載されたイーサネットの通信システムにおいて、少なくとも中継装置として機能するＥＣＵである。このため、ＥＣＵ１は、イーサネットのフレームを中継する機能を有する。イーサネットは、登録商標である。ＥＣＵは「Electronic Control Unit」の略である。 Hereinafter, embodiments of the present disclosure will be described with reference to the drawings.
[1. First Embodiment]
[1-1. Constitution]
The electronic control device (hereinafter, ECU) 1 of the first embodiment shown in FIG. 1 is an ECU that functions as at least a relay device in an Ethernet communication system mounted on a vehicle such as a passenger car. Therefore, the ECU 1 has a function of relaying an Ethernet frame. Ethernet is a registered trademark. ECU is an abbreviation for "Electronic Control Unit".

ＥＣＵ１は、当該ＥＣＵ１の外部に存在する装置（即ち、外部装置）とフレームを送受信するための外部通信ポートＰ１，Ｐ２を備える。外部通信ポートＰ１，Ｐ２には、車両内に配設された通信線Ｌ１，Ｌ２を介して、外部装置としての他のＥＣＵ１１，１２がそれぞれ接続されている。そして、ＥＣＵ１は、外部通信ポートＰ１，Ｐ２毎に、ＰＨＹ２１，２２を備える。 The ECU 1 includes external communication ports P1 and P2 for transmitting and receiving frames to and from a device (that is, an external device) existing outside the ECU 1. Other ECUs 11 and 12 as external devices are connected to the external communication ports P1 and P2 via communication lines L1 and L2 arranged in the vehicle, respectively. Then, the ECU 1 includes PHYs 21 and 22 for each of the external communication ports P1 and P2.

ＰＨＹ２１，２２は、イーサネット通信におけるトランシーバとして機能するデバイスであり、例えば、ＭＤＩ規格の物理層信号とＭＡＣ間通信で使用されるデータリンク層信号との変換を行う。ＭＤＩは「Media Device Interface」の略である。ＭＡＣは「Media Access Control」の略である。 The PHYs 21 and 22 are devices that function as transceivers in Ethernet communication, and for example, convert a physical layer signal of the MDI standard and a data link layer signal used in inter-MAC communication. MDI is an abbreviation for "Media Device Interface". MAC is an abbreviation for "Media Access Control".

ＰＨＹ２１，２２が備える送受信機能のうち、送信機能は、後述するイーサネットスイッチ３０からの送信データを、通信線上で伝送される通信信号に変換して当該ＰＨＹに対応する外部通信ポートへ出力する機能である。受信機能は、当該ＰＨＹに対応する外部通信ポートから入力される通信信号を受信データに変換してイーサネットスイッチ３０に出力する機能である。 Among the transmission / reception functions provided by the PHYs 21 and 22, the transmission function is a function that converts the transmission data from the Ethernet switch 30, which will be described later, into a communication signal transmitted on the communication line and outputs it to the external communication port corresponding to the PHY. is there. The reception function is a function of converting a communication signal input from an external communication port corresponding to the PHY into received data and outputting it to the Ethernet switch 30.

そして、外部通信ポートＰ１は、ＰＨＹ２１を介して、イーサネットスイッチ３０が備える通信ポート３１〜３４のうちの、通信ポート３１に接続されている。また、外部通信ポートＰ２は、ＰＨＹ２２を介して、イーサネットスイッチ３０の通信ポート３２に接続されている。なお、外部通信ポートＰ１，Ｐ２及びＰＨＹ２１，２２の数は、１つ又は３つ以上であっても良い。 Then, the external communication port P1 is connected to the communication port 31 of the communication ports 31 to 34 included in the Ethernet switch 30 via the PHY 21. Further, the external communication port P2 is connected to the communication port 32 of the Ethernet switch 30 via the PHY 22. The number of external communication ports P1, P2 and PHY21,22 may be one or three or more.

ＥＣＵ１は、フレームの中継を行うイーサネットスイッチ（以下、スイッチ）３０と、メイン系回路部４０と、サブ系回路部５０と、備える。
メイン系回路部４０は、処理部としてのＣＰＵ４１と、ＣＰＵ４１によってアクセス可能な記憶装置４２と、電源回路４３と、を備える。電源回路４３は、車両に搭載されているメインバッテリ４４の電圧から一定の電源電圧を生成し、当該電源電圧をＣＰＵ４１と記憶装置４２とのそれぞれに供給する。 The ECU 1 includes an Ethernet switch (hereinafter referred to as a switch) 30 that relays frames, a main system circuit unit 40, and a sub system circuit unit 50.
The main circuit unit 40 includes a CPU 41 as a processing unit, a storage device 42 accessible by the CPU 41, and a power supply circuit 43. The power supply circuit 43 generates a constant power supply voltage from the voltage of the main battery 44 mounted on the vehicle, and supplies the power supply voltage to each of the CPU 41 and the storage device 42.

サブ系回路部５０も、処理部としてのＣＰＵ５１と、ＣＰＵ５１によってアクセス可能な記憶装置５２と、電源回路５３と、を備える。電源回路５３は、車両に搭載されているサブバッテリ５４の電圧から一定の電源電圧を生成し、当該電源電圧をＣＰＵ５１と記憶装置５２とのそれぞれに供給する。サブバッテリ５４は、メインバッテリ４４とは別のバッテリである。 The sub circuit unit 50 also includes a CPU 51 as a processing unit, a storage device 52 accessible by the CPU 51, and a power supply circuit 53. The power supply circuit 53 generates a constant power supply voltage from the voltage of the sub-battery 54 mounted on the vehicle, and supplies the power supply voltage to each of the CPU 51 and the storage device 52. The sub-battery 54 is a battery different from the main battery 44.

なお、メイン系回路部４０において、電源回路４３からＣＰＵ４１と記憶装置４２とのそれぞれには、同じ電圧値の電源電圧が供給されても良いし、異なる電圧値の電源電圧が供給されても良い。同様に、サブ系回路部５０において、電源回路５３からＣＰＵ５１と記憶装置５２とのそれぞれには、同じ電圧値の電源電圧が供給されても良いし、異なる電圧値の電源電圧が供給されても良い。 In the main system circuit unit 40, the power supply circuit 43 may supply a power supply voltage having the same voltage value to each of the CPU 41 and the storage device 42, or may supply power supply voltages having different voltage values. .. Similarly, in the sub system circuit unit 50, a power supply voltage having the same voltage value may be supplied to each of the CPU 51 and the storage device 52 from the power supply circuit 53, or a power supply voltage having a different voltage value may be supplied. good.

記憶装置４２，５２は、例えば半導体メモリでも良いし、ハードディスクや他のディスク型記憶媒体にデータを記憶する装置でも良い。半導体メモリとしては、例えば揮発性のＲＡＭでも良いし、フラッシュメモリ等の書き換え可能な不揮発性メモリでも良い。 The storage devices 42 and 52 may be, for example, semiconductor memories, or may be devices that store data in a hard disk or other disk-type storage medium. The semiconductor memory may be, for example, a volatile RAM or a rewritable non-volatile memory such as a flash memory.

ＣＰＵ４１，５１のそれぞれは、図示が省略されたプログラム用メモリに格納されるプログラムを実行することにより、予め定められた様々な処理を行う。なお、以下では、ＣＰＵ４１のことを、メインＣＰＵ４１とも言う。また、ＣＰＵ５１のことを、サブＣＰＵ５１とも言う。 Each of the CPUs 41 and 51 performs various predetermined processes by executing a program stored in the program memory (not shown). In the following, the CPU 41 will also be referred to as a main CPU 41. The CPU 51 is also referred to as a sub CPU 51.

更に、メイン系回路部４０は、メインＣＰＵ４１に関する異常を検出する機能を有した異常検出部４５を備える。異常検出部４５は、ＷＤＣ監視部４６と、電源監視部４７と、を備える。 Further, the main circuit unit 40 includes an abnormality detection unit 45 having a function of detecting an abnormality related to the main CPU 41. The abnormality detection unit 45 includes a WDC monitoring unit 46 and a power supply monitoring unit 47.

ＷＤＣ監視部４６は、メインＣＰＵ４１が正常であればメインＣＰＵ４１から所定時間以内毎に出力されるはずのＷＤＣ信号を監視する。そして、ＷＤＣ監視部４６は、メインＣＰＵ４１からＷＤＣ信号が出力されない継続時間が、上記所定時間よりも長く設定された閾値時間を超えた場合、あるいはＷＤＣ信号の出力周期が所定時間よりも短くなった場合に、メインＣＰＵ４１が異常であると判定する。メインＣＰＵ４１が異常であると判定されることは、メインＣＰＵ４１の異常が検出されたことに該当する。なお、ＷＤＣは「Watch Dog timer Clear」の略である。 The WDC monitoring unit 46 monitors the WDC signal that should be output from the main CPU 41 every predetermined time if the main CPU 41 is normal. Then, the WDC monitoring unit 46 has a duration in which the WDC signal is not output from the main CPU 41 exceeds the set threshold time longer than the predetermined time, or the output cycle of the WDC signal becomes shorter than the predetermined time. In this case, it is determined that the main CPU 41 is abnormal. Determining that the main CPU 41 is abnormal corresponds to the detection of an abnormality in the main CPU 41. WDC is an abbreviation for "Watch Dog timer Clear".

電源監視部４７は、電源回路４３からメインＣＰＵ４１へ供給される電源電圧を監視し、当該電源電圧の値が所定の正常範囲内でなければ、当該電源電圧が異常であると判定する。電源電圧が異常であると判定されることは、電源電圧の異常が検出されたことに該当する。ＷＤＣ監視部４６によってメインＣＰＵ４１の異常が検出されていなくても、電源監視部４７によってメインＣＰＵ４１への電源電圧の異常が検出された場合には、メインＣＰＵ４１が正常に動作しない可能性がある。 The power supply monitoring unit 47 monitors the power supply voltage supplied from the power supply circuit 43 to the main CPU 41, and if the value of the power supply voltage is not within a predetermined normal range, determines that the power supply voltage is abnormal. Determining that the power supply voltage is abnormal corresponds to the detection of an abnormality in the power supply voltage. Even if the WDC monitoring unit 46 does not detect an abnormality in the main CPU 41, if the power supply monitoring unit 47 detects an abnormality in the power supply voltage to the main CPU 41, the main CPU 41 may not operate normally.

異常検出部４５は、ＷＤＣ監視部４６によりメインＣＰＵ４１の異常が検出されるか、あるいは電源監視部４７によりメインＣＰＵ４１への電源電圧の異常が検出された場合に、メイン系異常が発生したことを示すメイン系異常通知をサブＣＰＵ５１に出力する。ここで言うメイン系異常とは、メインＣＰＵ４１に関する異常であり、本実施形態では、メインＣＰＵ４１の異常又はメインＣＰＵ４１への電源電圧の異常である。 The abnormality detection unit 45 determines that the main system abnormality has occurred when the WDC monitoring unit 46 detects the abnormality of the main CPU 41 or the power supply monitoring unit 47 detects the abnormality of the power supply voltage to the main CPU 41. The indicated main system abnormality notification is output to the sub CPU 51. The main system abnormality referred to here is an abnormality related to the main CPU 41, and in the present embodiment, it is an abnormality of the main CPU 41 or an abnormality of the power supply voltage to the main CPU 41.

異常検出部４５からのメイン系異常通知は、例えばＳＰＩ通信又はＵＡＲＴ通信等のデータ通信による通知であって良い。ＳＰＩは「Serial Peripheral Interface」の略である。ＵＡＲＴは「Universal Asynchronous Receiver/Transmitter」の略である。メイン系異常通知にデータ通信が用いられる場合、サブＣＰＵ５１には、検出された異常がメインＣＰＵ４１の異常と電源電圧の異常との何れであるかを区別して通知しても良い。つまり、メイン系異常通知には、検出された異常を識別可能な識別情報が含まれても良い。また、メイン系異常通知は、信号線の信号レベルによる通知であっても良い。この場合、信号線の信号レベルが、ハイとローとのうちで、予め定められた一方のレベルであれば、異常ありを示すように構成することができる。 The main system abnormality notification from the abnormality detection unit 45 may be a notification by data communication such as SPI communication or UART communication. SPI is an abbreviation for "Serial Peripheral Interface". UART is an abbreviation for "Universal Asynchronous Receiver / Transmitter". When data communication is used for the main system abnormality notification, the sub CPU 51 may be notified by distinguishing whether the detected abnormality is an abnormality of the main CPU 41 or an abnormality of the power supply voltage. That is, the main system abnormality notification may include identification information that can identify the detected abnormality. Further, the main system abnormality notification may be a notification based on the signal level of the signal line. In this case, if the signal level of the signal line is one of high and low, which is predetermined, it can be configured to indicate that there is an abnormality.

異常検出部４５は、例えば、電源回路４３から出力される複数の電源電圧のうち、メインＣＰＵ４１へ供給される電源電圧とは別の電源電圧によって動作するように構成されて良い。また、異常検出部４５は、例えば、電源回路４３，５３とは別の、図示されない電源回路から供給される電源電圧によって動作するように構成されて良い。 The abnormality detection unit 45 may be configured to operate with a power supply voltage different from the power supply voltage supplied to the main CPU 41 among a plurality of power supply voltages output from the power supply circuit 43, for example. Further, the abnormality detection unit 45 may be configured to operate by a power supply voltage supplied from a power supply circuit (not shown), which is different from the power supply circuits 43 and 53, for example.

スイッチ３０は、通信を行うための通信ポート３１〜３４と、当該スイッチ３０を制御するための制御信号が入力される制御用ポート３５と、を備える。
通信ポート３１，３２は、前述したように、ＰＨＹ２１，２２を介して外部通信ポートＰ１，Ｐ２にそれぞれ接続されている。通信ポート３３は、メインＣＰＵ４１に接続されている。通信ポート３４は、サブＣＰＵ５１に接続されている。 The switch 30 includes communication ports 31 to 34 for performing communication and a control port 35 for inputting a control signal for controlling the switch 30.
As described above, the communication ports 31 and 32 are connected to the external communication ports P1 and P2 via PHY21 and 22, respectively. The communication port 33 is connected to the main CPU 41. The communication port 34 is connected to the sub CPU 51.

このため、スイッチ３０は、外部通信ポートＰ１，Ｐ２を介した外部装置（例えばＥＣＵ１１，１２）とのフレームの送受信と、メインＣＰＵ４１及びサブＣＰＵ５１とのフレームの送受信とが可能である。なお、スイッチ３０が備える通信ポート３１〜３４のうち、ＣＰＵ４１，５１に接続される通信ポート３３，３４以外の数は、１つ又は３つ以上であっても良い。 Therefore, the switch 30 can send and receive frames to and from external devices (for example, ECUs 11 and 12) via the external communication ports P1 and P2, and can send and receive frames to and from the main CPU 41 and the sub CPU 51. Of the communication ports 31 to 34 included in the switch 30, the number other than the communication ports 33 and 34 connected to the CPUs 41 and 51 may be one or three or more.

そして、スイッチ３０は、受信したフレームを中継するための中継処理を行う。
例えば、スイッチ３０は、通信ポート３１〜３４の何れかから受信したフレーム（即ち、受信フレーム）内の宛先情報に基づいて、通信ポート３１〜３４の何れかを受信フレームの転送先として選択し、当該選択した通信ポートから受信フレームを送信する。 Then, the switch 30 performs a relay process for relaying the received frame.
For example, the switch 30 selects any of the communication ports 31 to 34 as the transfer destination of the reception frame based on the destination information in the frame (that is, the reception frame) received from any of the communication ports 31 to 34. Receive frames are transmitted from the selected communication port.

宛先情報としては、例えばＭＡＣアドレスが使用されて良い。また、スイッチ３０には、受信フレーム内の宛先情報としてのＭＡＣアドレス（即ち、宛先ＭＡＣアドレス）から、転送先の通信ポートを選択するための情報テーブルとして、ＭＡＣアドレステーブルが記憶されて良い。ＭＡＣアドレステーブルには、通信ポート３１〜３４のそれぞれについて、その通信ポートの先に接続されている装置のＭＡＣアドレスが登録されて良い。 As the destination information, for example, a MAC address may be used. Further, the switch 30 may store a MAC address table as an information table for selecting a transfer destination communication port from the MAC address (that is, the destination MAC address) as the destination information in the reception frame. In the MAC address table, the MAC address of the device connected to the tip of the communication port may be registered for each of the communication ports 31 to 34.

また、スイッチ３０は、制御用ポート３５に入力される制御信号により、当該スイッチ３０の動作に関する複数の内容について設定が可能に構成されている。制御信号によって設定可能な内容としては、例えば、フレームの宛先や、フレームの加工や、通信速度などがある。フレームの加工には、例えばデータを削減することが含まれる。 Further, the switch 30 is configured so that a plurality of contents related to the operation of the switch 30 can be set by a control signal input to the control port 35. The contents that can be set by the control signal include, for example, the destination of the frame, the processing of the frame, and the communication speed. Processing the frame involves, for example, reducing data.

スイッチ３０は、例えば、電源回路４３，５３とは別の、図示されない電源回路から供給される電源電圧によって動作するように構成されて良い。
メインＣＰＵ４１は、スイッチ３０から当該ＣＰＵ４１に転送されたフレームを用いた制御として、例えばロギング制御を行うように構成されている。メインＣＰＵ４１が行うロギング制御は、当該ＣＰＵ４１に転送されたフレームの全て又は一部に含まれるデータを、記憶装置４２に記憶する制御である。 The switch 30 may be configured to operate by a power supply voltage supplied from a power supply circuit (not shown), which is different from the power supply circuits 43 and 53, for example.
The main CPU 41 is configured to perform, for example, logging control as a control using a frame transferred from the switch 30 to the CPU 41. The logging control performed by the main CPU 41 is a control for storing the data included in all or a part of the frames transferred to the CPU 41 in the storage device 42.

サブＣＰＵ５１も、スイッチ３０から当該ＣＰＵ５１に転送されたフレームを用いた制御として、例えばロギング制御を行うように構成されている。サブＣＰＵ５１が行うロギング制御は、当該ＣＰＵ５１に転送されたフレームの全て又は一部に含まれるデータを、記憶装置５２に記憶する制御である。 The sub CPU 51 is also configured to perform, for example, logging control as a control using the frame transferred from the switch 30 to the CPU 51. The logging control performed by the sub CPU 51 is a control for storing the data included in all or a part of the frames transferred to the CPU 51 in the storage device 52.

また、ＣＰＵ４１，５１のそれぞれは、当該ＣＰＵに転送されたフレーム内のデータに基づいて、車両における制御対象を制御するようになっていても良い。制御対象としては、例えば、車両の動力源や、車両周囲を撮影するカメラや、操舵装置や、制動装置等であって良い。 Further, each of the CPUs 41 and 51 may control the control target in the vehicle based on the data in the frame transferred to the CPU. The control target may be, for example, a power source of the vehicle, a camera for photographing the surroundings of the vehicle, a steering device, a braking device, or the like.

更に、ＥＣＵ１は、信号切替部６０を備える。
信号切替部６０は、メインＣＰＵ４１とサブＣＰＵ５１とのうちの一方からスイッチ３０の制御用ポート３５へ制御信号を入力させるように構成された回路である。このため、信号切替部６０は、第１スイッチ６１と、第２スイッチ６２と、を備える。 Further, the ECU 1 includes a signal switching unit 60.
The signal switching unit 60 is a circuit configured to input a control signal from one of the main CPU 41 and the sub CPU 51 to the control port 35 of the switch 30. Therefore, the signal switching unit 60 includes a first switch 61 and a second switch 62.

第１スイッチ６１は、オンすることで、メインＣＰＵ４１からの制御信号をスイッチ３０の制御用ポート３５に入力させる。具体的には、第１スイッチ６１は、オンすることで、メインＣＰＵ４１の端子のうちで制御信号を出力するための端子と、スイッチ３０の制御用ポート３５とを接続させる。 When the first switch 61 is turned on, the control signal from the main CPU 41 is input to the control port 35 of the switch 30. Specifically, when the first switch 61 is turned on, the terminal for outputting the control signal among the terminals of the main CPU 41 and the control port 35 of the switch 30 are connected.

第２スイッチ６２は、オンすることで、サブＣＰＵ５１からの制御信号をスイッチ３０の制御用ポート３５に入力させる。具体的には、第２スイッチ６２は、オンすることで、サブＣＰＵ５１の端子のうちで制御信号を出力するための端子と、スイッチ３０の制御用ポート３５とを接続させる。第１スイッチ６１及び第２スイッチ６２としては、例えば、小信号用のスイッチング素子や、入出力を切り離す機能が備わったレベルシフタ等のバッファＩＣが使用されて良い。スイッチング素子は、例えばバイポーラトランジスタ又はＭＯＳＦＥＴであって良い。 When the second switch 62 is turned on, the control signal from the sub CPU 51 is input to the control port 35 of the switch 30. Specifically, when the second switch 62 is turned on, the terminal for outputting the control signal among the terminals of the sub CPU 51 is connected to the control port 35 of the switch 30. As the first switch 61 and the second switch 62, for example, a buffer IC such as a switching element for a small signal or a level shifter having a function of separating input / output may be used. The switching element may be, for example, a bipolar transistor or MOSFET.

そして、第１スイッチ６１と第２スイッチ６２のオンとオフは、サブＣＰＵ５１が出力する切替指令によって切り替えられる。具体的には、第１スイッチ６１と第２スイッチ６２は、サブＣＰＵ５１からの切替指令によって択一的にオンするように構成されている。 Then, the on / off of the first switch 61 and the second switch 62 is switched by the switching command output from the sub CPU 51. Specifically, the first switch 61 and the second switch 62 are configured to be selectively turned on by a switching command from the sub CPU 51.

切替指令は、例えば、第１スイッチ６１のオン／オフを指令する第１信号と、第２スイッチ６２のオン／オフを指令する第２信号とを、含んで良いが、本実施形態では、切替指令は、１本の信号線によって伝達される単一制御信号である。 The switching command may include, for example, a first signal for commanding on / off of the first switch 61 and a second signal for commanding on / off of the second switch 62, but in the present embodiment, switching may be performed. The command is a single control signal transmitted by a single signal line.

そして、信号切替部６０では、サブＣＰＵ５１からの単一制御信号がハイとローとの一方である通常時レベルならば、第１スイッチ６１と第２スイッチ６２とのうち、第１スイッチ６１がオンする。また、単一制御信号が通常時レベルと異なる方の非通常時レベルならば、第１スイッチ６１と第２スイッチ６２とのうち、第２スイッチ６２がオンする。例えば、第１スイッチ６１及び第２スイッチ６２としてＭＯＳＦＥＴが使用される場合、第１スイッチ６１及び第２スイッチ６２のうち、一方としてはｎチャネル型ＭＯＳＦＥＴが用いられ、他方としてはｐチャネル型ＭＯＳＦＥＴが用いられて良い。 Then, in the signal switching unit 60, if the single control signal from the sub CPU 51 is at the normal level, which is one of high and low, the first switch 61 of the first switch 61 and the second switch 62 is turned on. To do. If the single control signal is at a non-normal time level different from the normal time level, the second switch 62 of the first switch 61 and the second switch 62 is turned on. For example, when MOSFETs are used as the first switch 61 and the second switch 62, an n-channel MOSFET is used as one of the first switch 61 and the second switch 62, and a p-channel MOSFET is used as the other. May be used.

そして、異常検出部４５によりメイン系異常が検出されていない通常時において、サブＣＰＵ５１からの単一制御信号（即ち、切替指令）は、デフォルト値としての上記通常時レベルになる。このため、通常時においては、第１スイッチ６１と第２スイッチ６２とのうち、第１スイッチ６１がオンする。よって、スイッチ３０は、メインＣＰＵ４１によって制御される。 Then, in the normal time when the abnormality detection unit 45 does not detect the main system abnormality, the single control signal (that is, the switching command) from the sub CPU 51 becomes the above-mentioned normal time level as the default value. Therefore, in the normal state, the first switch 61 of the first switch 61 and the second switch 62 is turned on. Therefore, the switch 30 is controlled by the main CPU 41.

また、異常検出部４５によりメイン系異常が検出された場合（即ち、メイン系異常発生時）には、サブＣＰＵ５１から信号切替部６０への単一制御信号が上記非通常時レベルに切り替わる。このため、メイン系異常発生時においては、図３に示すように、第１スイッチ６１と第２スイッチ６２とのうち、第２スイッチ６２がオンする。よって、スイッチ３０は、サブＣＰＵ５１によって制御される。 Further, when the abnormality detection unit 45 detects the main system abnormality (that is, when the main system abnormality occurs), the single control signal from the sub CPU 51 to the signal switching unit 60 is switched to the above-mentioned abnormal time level. Therefore, when an abnormality occurs in the main system, the second switch 62 of the first switch 61 and the second switch 62 is turned on, as shown in FIG. Therefore, the switch 30 is controlled by the sub CPU 51.

なお、ＣＰＵ４１，５１からスイッチ３０の制御用ポート３５への制御信号の伝送には、例えばＳＰＩ通信又はＩ２Ｃ通信が用いられて良い。Ｉ２Ｃは「Inter Integrated Circuit」の略である。 For transmission of the control signal from the CPUs 41 and 51 to the control port 35 of the switch 30, for example, SPI communication or I2C communication may be used. I2C is an abbreviation for "Inter Integrated Circuit".

［１−２．処理］
次に、ＥＣＵ１において、異常検出部４５及びＣＰＵ４１，５１により行われる処理について、図２のフローチャートを用いて説明する。図２に示される処理は、例えば一定時間毎に繰り返し実行される。 [1-2. processing]
Next, the processing performed by the abnormality detection unit 45 and the CPUs 41 and 51 in the ECU 1 will be described with reference to the flowchart of FIG. The process shown in FIG. 2 is repeatedly executed, for example, at regular time intervals.

図２に示すように、ＥＣＵ１では、Ｓ１１０にて、異常検出部４５が、ＷＤＣ監視部４６又は電源監視部４７によってメイン系異常が検出されたか否かを判定する。
異常検出部４５は、上記Ｓ１１０にて、メイン系異常が検出されたと判定した場合には、Ｓ１２０にて、サブＣＰＵ５１へのメイン系異常通知を出力する。つまり、メイン系異常が発生したことをサブＣＰＵ５１に通知する。また、異常検出部４５は、上記Ｓ１１０にて、メイン系異常が検出されていないと判定した場合には、メイン系異常通知を出力しない。そして、この場合には、Ｓ１２０〜Ｓ１５０がスキップされて、後述するＳ１６０の処理が行われる。 As shown in FIG. 2, in the ECU 1, in S110, the abnormality detection unit 45 determines whether or not the main system abnormality is detected by the WDC monitoring unit 46 or the power supply monitoring unit 47.
When the abnormality detection unit 45 determines that the main system abnormality has been detected in S110, the abnormality detection unit 45 outputs a main system abnormality notification to the sub CPU 51 in S120. That is, the sub CPU 51 is notified that the main system abnormality has occurred. Further, when the abnormality detection unit 45 determines in S110 that no main system abnormality has been detected, the abnormality detection unit 45 does not output the main system abnormality notification. Then, in this case, S120 to S150 are skipped, and the processing of S160 described later is performed.

サブＣＰＵ５１は、異常検出部４５からのメイン系異常通知を受けると、Ｓ１３０にて、スイッチ３０を制御するＣＰＵ（即ち、スイッチ制御ＣＰＵ）の変更を行う。具体的には、サブＣＰＵ５１は、信号切替部６０への切替指令としての単一制御信号を、上記通常時レベルから上記非通常時レベルに切り替えることにより、スイッチ制御ＣＰＵを、メインＣＰＵ４１から当該サブＣＰＵ５１に変更する。つまり、メインＣＰＵ４１からの制御信号に代えて、サブＣＰＵ５１からの制御信号が、スイッチ３０の制御用ポート３５に入力されるように、信号切替部６０を切り替える。 Upon receiving the main system abnormality notification from the abnormality detection unit 45, the sub CPU 51 changes the CPU that controls the switch 30 (that is, the switch control CPU) in S130. Specifically, the sub CPU 51 switches the switch control CPU from the main CPU 41 to the sub by switching the single control signal as a switching command to the signal switching unit 60 from the normal time level to the non-normal time level. Change to CPU 51. That is, the signal switching unit 60 is switched so that the control signal from the sub CPU 51 is input to the control port 35 of the switch 30 instead of the control signal from the main CPU 41.

サブＣＰＵ５１は、スイッチ制御ＣＰＵを当該サブＣＰＵ５１に変更した後、Ｓ１４０にて、スイッチ３０がフレームの送受信中であるか否かを判定し、フレームの送受信中であれば、スイッチ３０におけるフレームの送受信が完了するまで待つ。そして、サブＣＰＵ５１は、Ｓ１４０にて、スイッチ３０がフレームの送受信中ではないと判定した場合には、Ｓ１５０に進む。つまり、サブＣＰＵ５１は、スイッチ３０においてフレームの送受信が完了していることを確認してから、Ｓ１５０に進む。なお、サブＣＰＵ５１は、例えば、スイッチ３０の制御用ポート３５から、スイッチ３０の状態を示すステータス情報を読み出し、この読み出したステータス情報により、スイッチ３０がフレームの送受信中であるか否かを判定して良い。 After changing the switch control CPU to the sub CPU 51, the sub CPU 51 determines in S140 whether or not the switch 30 is transmitting / receiving frames, and if the switch 30 is transmitting / receiving frames, the sub CPU 51 transmits / receives frames in the switch 30. Wait until is completed. Then, when the sub CPU 51 determines in S140 that the switch 30 is not transmitting / receiving a frame, the sub CPU 51 proceeds to S150. That is, the sub CPU 51 confirms that the transmission / reception of the frame is completed on the switch 30, and then proceeds to S150. The sub CPU 51 reads, for example, status information indicating the state of the switch 30 from the control port 35 of the switch 30, and determines whether or not the switch 30 is transmitting / receiving a frame based on the read status information. It's okay.

そして、サブＣＰＵ５１は、Ｓ１５０では、スイッチ３０の制御用ポート３５に出力する制御信号により、スイッチ３０におけるフレームの宛先を変更する。具体的には、メインＣＰＵ４１宛てのフレームがスイッチ３０からサブＣＰＵ５１に転送されるように、スイッチ３０の設定を変更する。スイッチ３０は、Ｓ１５０での設定変更により、メインＣＰＵ４１宛てのフレームに含まれる宛先ＭＡＣアドレスを、サブＣＰＵ５１のＭＡＣアドレスに変更するようになっていても良い。 Then, in S150, the sub CPU 51 changes the destination of the frame in the switch 30 by the control signal output to the control port 35 of the switch 30. Specifically, the setting of the switch 30 is changed so that the frame addressed to the main CPU 41 is transferred from the switch 30 to the sub CPU 51. The switch 30 may change the destination MAC address included in the frame addressed to the main CPU 41 to the MAC address of the sub CPU 51 by changing the setting in S150.

その後、サブＣＰＵ５１は、Ｓ１６０にて、スイッチ３０との間のフレームの送受信と、受信フレームに対する前述のロギング制御とを実施する。
また、メイン系異常が検出されていない通常時には、Ｓ１６０では、メインＣＰＵ４１、サブＣＰＵ５１ともに、スイッチ３０との間のフレームの送受信と、受信フレームに対する前述のロギング制御とを実施する。 After that, the sub CPU 51 performs transmission / reception of a frame with / from the switch 30 and the above-mentioned logging control for the received frame in S160.
Further, in the normal time when the main system abnormality is not detected, in S160, both the main CPU 41 and the sub CPU 51 perform the transmission / reception of the frame with the switch 30 and the above-mentioned logging control for the received frame.

異常検出部４５によりメイン系異常が検出された場合には、サブＣＰＵ５１によってＳ１５０の処理が実施されることにより、外部装置（例えばＥＣＵ１１，１２）からメインＣＰＵ４１宛てのフレームは、スイッチ３０によりサブＣＰＵ５１に転送される。また、外部装置からサブＣＰＵ５１宛てのフレームは、引き続きスイッチ３０によりサブＣＰＵ５１に転送される。 When the abnormality detection unit 45 detects a main system abnormality, the sub CPU 51 executes the process of S150, so that the frame from the external device (for example, ECUs 11 and 12) to the main CPU 41 is sent by the switch 30 to the sub CPU 51. Transferred to. Further, the frame from the external device to the sub CPU 51 is continuously transferred to the sub CPU 51 by the switch 30.

よって、メイン系異常が検出された場合、メインＣＰＵ４１は、少なくともロギング制御を行わず、サブＣＰＵ５１は、メインＣＰＵ４１宛てのフレームと、元々サブＣＰＵ５１宛てのフレームとについて、ロギング制御を行う。 Therefore, when an abnormality in the main system is detected, the main CPU 41 does not perform at least logging control, and the sub CPU 51 performs logging control for the frame addressed to the main CPU 41 and the frame originally addressed to the sub CPU 51.

［１−３．効果］
以上詳述した第１実施形態によれば、以下の効果を奏する。
（１ａ）異常検出部４５によりメイン系異常が検出された場合、即ち、メインＣＰＵ４１が正常に動作しない場合に、図３に示すように、信号切替部６０において、第１スイッチ６１がオフに切り替わると共に、第２スイッチ６２がオンに切り替わる。このため、スイッチ制御ＣＰＵが、メインＣＰＵ４１からサブＣＰＵ５１に変更される。よって、正常に動作しないメインＣＰＵ４１に代わって、サブＣＰＵ５１によりスイッチ３０を制御することができる。 [1-3. effect]
According to the first embodiment described in detail above, the following effects are obtained.
(1a) When a main system abnormality is detected by the abnormality detection unit 45, that is, when the main CPU 41 does not operate normally, the first switch 61 is switched off in the signal switching unit 60 as shown in FIG. At the same time, the second switch 62 is switched on. Therefore, the switch control CPU is changed from the main CPU 41 to the sub CPU 51. Therefore, the switch 30 can be controlled by the sub CPU 51 instead of the main CPU 41 that does not operate normally.

そして、サブＣＰＵ５１が図２のＳ１５０の処理を行ってスイッチ３０の設定を変更することにより、メインＣＰＵ４１宛てのフレームがスイッチ３０からサブＣＰＵ５１に転送されるようになる。このため、図３における点線の矢印Ｙ１に示すように、本来ならばメインＣＰＵ４１に転送される外部装置からのフレームが、メインＣＰＵ４１に転送されなくなり、図３における実線の矢印Ｙ２に示すように、サブＣＰＵ５１に転送されるようになる。なお、ここで言う「本来ならば」とは、メイン系異常が検出されていなければ、という意味である。よって、メインＣＰＵ４１宛てのフレームは、サブＣＰＵ５１によって処理されることができる。例えば、メインＣＰＵ４１宛てのフレームは、サブＣＰＵ５１によってロギング制御の対象とされるため、メインＣＰＵ４１宛てのフレームに含まれたデータを、サブ系回路部５０の記憶装置５２に記憶（即ち、ロギング）することができる。 Then, the sub CPU 51 performs the process of S150 in FIG. 2 to change the setting of the switch 30, so that the frame addressed to the main CPU 41 is transferred from the switch 30 to the sub CPU 51. Therefore, as shown by the dotted arrow Y1 in FIG. 3, the frame from the external device that is normally transferred to the main CPU 41 is not transferred to the main CPU 41, and as shown by the solid arrow Y2 in FIG. It will be transferred to the sub CPU 51. In addition, "original" here means that the main system abnormality is not detected. Therefore, the frame addressed to the main CPU 41 can be processed by the sub CPU 51. For example, since the frame addressed to the main CPU 41 is subject to logging control by the sub CPU 51, the data included in the frame addressed to the main CPU 41 is stored (that is, logged) in the storage device 52 of the sub system circuit unit 50. be able to.

従って、ＥＣＵ１における中継機能及びロギング機能の信頼性を高めることができ、延いては、ＥＣＵ１が用いられる通信システムの信頼性を高めることができる。例えば、車両において、走る、曲がる、止まるに関わるデータは常に正確な情報であることが要求されるため、それらのデータを中継したりロギングしたりする役割のＥＣＵについて、信頼性向上が求められている。そして、ＥＣＵ１によれば、こうした信頼性向上の要求に応じることができる。 Therefore, the reliability of the relay function and the logging function in the ECU 1 can be enhanced, and the reliability of the communication system in which the ECU 1 is used can be enhanced. For example, in a vehicle, data related to running, turning, and stopping is always required to be accurate information, so improvement in reliability is required for an ECU that plays a role of relaying and logging such data. There is. Then, according to the ECU 1, it is possible to meet such a demand for reliability improvement.

（１ｂ）異常検出部４５からのメイン系異常通知を受けたサブＣＰＵ５１は、図２の１３０の処理により、スイッチ制御ＣＰＵをメインＣＰＵ４１から当該サブＣＰＵ５１に変更した後、図２のＳ１４０にて、スイッチ３０がフレームの送受信中であるか否かを判定する。そして、サブＣＰＵ５１は、スイッチ３０においてフレームの送受信が完了していることを確認してから、図２のＳ１５０の処理により、スイッチ３０におけるフレームの宛先変更を行う。このため、宛先変更の確実性を向上させることができる。 (1b) The sub CPU 51 that has received the main system abnormality notification from the abnormality detection unit 45 changes the switch control CPU from the main CPU 41 to the sub CPU 51 by the process of 130 in FIG. It is determined whether or not the switch 30 is transmitting / receiving a frame. Then, after confirming that the transmission / reception of the frame has been completed in the switch 30, the sub CPU 51 changes the destination of the frame in the switch 30 by the process of S150 in FIG. Therefore, the certainty of the destination change can be improved.

（１ｃ）メイン系異常通知は、異常検出部４５から、メインＣＰＵ４１を介さずに、サブＣＰＵ５１に出力される。このため、通知の確実性を向上させることができる。
（１ｄ）ネットワークを二重化することなく、冗長化の構成を極力少なくしつつ、信頼性を向上させることができる。 (1c) The main system abnormality notification is output from the abnormality detection unit 45 to the sub CPU 51 without going through the main CPU 41. Therefore, the certainty of notification can be improved.
(1d) It is possible to improve reliability while minimizing the redundancy configuration without duplicating the network.

（１ｅ）物理的な通信パターンの切り替えは行っていないため、信号の劣化を招くことなく、メイン系異常による機能失陥を抑制することができる。
（１ｆ）スイッチ３０の制御用ポート３５に、ＣＰＵ４１，５１のうちの何れか一方のみが電気的に接続される構成であるため、メイン系異常が発生した場合に、メインＣＰＵ４１による影響を受けることなく、サブＣＰＵ５１によってスイッチ３０を制御することができる。 (1e) Since the physical communication pattern is not switched, it is possible to suppress the functional failure due to the abnormality of the main system without causing the deterioration of the signal.
(1f) Since only one of the CPUs 41 and 51 is electrically connected to the control port 35 of the switch 30, it is affected by the main CPU 41 when a main system abnormality occurs. Instead, the switch 30 can be controlled by the sub CPU 51.

なお、上記実施形態では、メインＣＰＵ４１が第１の処理部に相当し、サブＣＰＵ５１が第２の処理部に相当し、電源回路４３が第１の電源部に相当し、電源回路５３が第２の電源部に相当し、スイッチ３０が中継部に相当する。また、サブＣＰＵ５１が変更部として機能する。そして、図２の処理のうち、Ｓ１３０〜Ｓ１５０の処理が、変更部としての処理に相当する。 In the above embodiment, the main CPU 41 corresponds to the first processing unit, the sub CPU 51 corresponds to the second processing unit, the power supply circuit 43 corresponds to the first power supply unit, and the power supply circuit 53 corresponds to the second processing unit. The switch 30 corresponds to the relay unit. Further, the sub CPU 51 functions as a change unit. Then, among the processes of FIG. 2, the processes of S130 to S150 correspond to the processes as the change unit.

［２．第２実施形態］
［２−１．第１実施形態との相違点］
第２実施形態は、基本的な構成は第１実施形態と同様であるため、相違点について以下に説明する。なお、第１実施形態と同じ符号は、同一の構成を示すものであって、先行する説明を参照する。 [2. Second Embodiment]
[2-1. Differences from the first embodiment]
Since the basic configuration of the second embodiment is the same as that of the first embodiment, the differences will be described below. The same reference numerals as those in the first embodiment indicate the same configurations, and the preceding description will be referred to.

図４に示す第２実施形態のＥＣＵ１は、第１実施形態と比較すると、下記の事項が異なる。
ＥＣＵ１は、電源切替部７０を備える。電源切替部７０は、電源回路４３から出力される電源電圧と、電源回路５３から出力される電源電圧との、何れか一方を、スイッチ３０に動作用の電源電圧として供給するように構成された回路である。 The ECU 1 of the second embodiment shown in FIG. 4 differs from the first embodiment in the following items.
The ECU 1 includes a power supply switching unit 70. The power supply switching unit 70 is configured to supply either one of the power supply voltage output from the power supply circuit 43 and the power supply voltage output from the power supply circuit 53 to the switch 30 as a power supply voltage for operation. It is a circuit.

そして、電源切替部７０には、サブＣＰＵ５１から信号切替部６０に出力される切替指令としての単一制御信号が入力される。電源切替部７０は、サブＣＰＵ５１からの単一制御信号が前述の通常時レベルである場合には、電源回路４３からの電源電圧をスイッチ３０に供給する。また、電源切替部７０は、サブＣＰＵ５１からの単一制御信号が前述の非通常時レベルである場合には、電源回路５３からの電源電圧をスイッチ３０に供給する。 Then, a single control signal as a switching command output from the sub CPU 51 to the signal switching unit 60 is input to the power supply switching unit 70. When the single control signal from the sub CPU 51 is at the above-mentioned normal level, the power switching unit 70 supplies the power supply voltage from the power supply circuit 43 to the switch 30. Further, the power supply switching unit 70 supplies the power supply voltage from the power supply circuit 53 to the switch 30 when the single control signal from the sub CPU 51 is at the above-mentioned non-normal time level.

このため、異常検出部４５によりメイン系異常が検出されていない通常時において、スイッチ３０には、電源切替部７０を介して、電源回路４３からの電源電圧が動作用の電源電圧として供給される。また、異常検出部４５によりメイン系異常が検出された場合において、スイッチ３０には、電源切替部７０を介して、電源回路５３からの電源電圧が動作用の電源電圧として供給される。 Therefore, in the normal time when the abnormality detection unit 45 does not detect the main system abnormality, the power supply voltage from the power supply circuit 43 is supplied to the switch 30 as the power supply voltage for operation via the power supply switching unit 70. .. When the abnormality detection unit 45 detects a main system abnormality, the power supply voltage from the power supply circuit 53 is supplied to the switch 30 as the power supply voltage for operation via the power supply switching unit 70.

［２−２．効果］
以上詳述した第２実施形態によれば、前述した第１実施形態と同様の効果を奏し、更に、以下の効果を奏する。 [2-2. effect]
According to the second embodiment described in detail above, the same effect as that of the first embodiment described above is obtained, and the following effects are further obtained.

（２ａ）異常検出部４５によりメイン系異常が検出された場合には、スイッチ３０に電源電圧を供給する電源部としての電源回路が、メイン系回路部４０における電源回路４３から、当該電源回路４３とは別の電源回路に変更される。なお、この第２実施形態において、電源回路４３から変更される別の電源回路は、サブ系回路部５０の電源回路５３であるが、電源回路４３，５３とは別に用意された電源回路であっても良い。 (2a) When the abnormality detection unit 45 detects a main system abnormality, the power supply circuit as the power supply unit for supplying the power supply voltage to the switch 30 is changed from the power supply circuit 43 in the main system circuit unit 40 to the power supply circuit 43. It will be changed to a different power supply circuit. In the second embodiment, another power supply circuit changed from the power supply circuit 43 is the power supply circuit 53 of the sub system circuit unit 50, but is a power supply circuit prepared separately from the power supply circuits 43 and 53. You may.

メイン系異常のうち、メインＣＰＵ４１への電源電圧の異常が電源監視部４７によって検出された場合には、電源回路４３自体に異常が発生している可能性がある。また、メイン系異常のうち、メインＣＰＵ４１の異常がＷＤＣ監視部４６によって検出された場合にも、メインＣＰＵ４１への電源電圧が異常である可能性があり、延いては、電源回路４３自体に異常が生じている可能性がある。このため、メイン系異常が検出された場合には、スイッチ３０に電源電圧を供給する電源回路が、電源回路４３から他の電源回路に変更されるようになっている。よって、スイッチ３０への確実な電源供給を実現し易い。 If the power supply monitoring unit 47 detects an abnormality in the power supply voltage to the main CPU 41 among the main system abnormalities, there is a possibility that the power supply circuit 43 itself has an abnormality. Further, among the main system abnormalities, when the abnormality of the main CPU 41 is detected by the WDC monitoring unit 46, there is a possibility that the power supply voltage to the main CPU 41 is abnormal, and by extension, the power supply circuit 43 itself is abnormal. May have occurred. Therefore, when an abnormality in the main system is detected, the power supply circuit that supplies the power supply voltage to the switch 30 is changed from the power supply circuit 43 to another power supply circuit. Therefore, it is easy to realize a reliable power supply to the switch 30.

（２ｂ）スイッチ３０に電源電圧を供給する電源回路は、メイン系回路部４０の電源回路４３から、サブ系回路部５０の電源回路５３に変更される。このため、電源回路４３，５３とは別の電源回路を特別に用意しておく必要がなく、ＥＣＵ１における回路規模を抑制することができる。 (2b) The power supply circuit that supplies the power supply voltage to the switch 30 is changed from the power supply circuit 43 of the main system circuit unit 40 to the power supply circuit 53 of the sub system circuit unit 50. Therefore, it is not necessary to specially prepare a power supply circuit different from the power supply circuits 43 and 53, and the circuit scale in the ECU 1 can be suppressed.

なお、電源回路４３，５３のそれぞれからスイッチ３０には、ＣＰＵ４１，５１に供給される電源電圧と同じ電圧値の電源電圧が供給されても良いし、異なる電圧値の電源電圧が供給されても良い。 The switch 30 may be supplied with a power supply voltage having the same voltage value as the power supply voltage supplied to the CPUs 41 and 51 from each of the power supply circuits 43 and 53, or may be supplied with a power supply voltage having a different voltage value. good.

［３．第３実施形態］
［３−１．第１実施形態との相違点］
第３実施形態は、基本的な構成は第２実施形態と同様であるため、相違点について以下に説明する。なお、第１及び第２実施形態と同じ符号は、同一の構成を示すものであって、先行する説明を参照する。 [3. Third Embodiment]
[3-1. Differences from the first embodiment]
Since the basic configuration of the third embodiment is the same as that of the second embodiment, the differences will be described below. The same reference numerals as those of the first and second embodiments indicate the same configurations, and the preceding description will be referred to.

図５に示す第３実施形態のＥＣＵ１は、第２実施形態と比較すると、下記〈３−１ａ〉〜〈３−１ｃ〉の事項が異なる。
〈３−１ａ〉異常検出部４５からサブＣＰＵ５１へのメイン系異常通知には、検出された（即ち、発生した）異常を識別可能な識別情報が含まる。 The ECU 1 of the third embodiment shown in FIG. 5 is different from the second embodiment in the following items <3-1a> to <3-1c>.
<3-1a> The main system abnormality notification from the abnormality detection unit 45 to the sub CPU 51 includes identification information capable of identifying the detected (that is, generated) abnormality.

〈３−１ｂ〉サブＣＰＵ５１から電源切替部７０には、信号切替部６０への切替指令とは別の電源切替指令が出力される。電源切替指令は、電源切替部７０に対して、電源回路４３からの電源電圧と、電源回路５３からの電源電圧との、何れを選択して出力するかを指令できれば、どのような形態の信号でも良い。本実施形態では、電源切替指令として、例えば１本の信号線によって伝達される単一制御信号が用いられている。以下では、電源切替部７０への電源切替指令としての単一制御信号を、信号切替部６０への切替指令としての単一制御信号と区別するために、電源切替信号という。 <3-1b> A power switching command different from the switching command to the signal switching unit 60 is output from the sub CPU 51 to the power switching unit 70. The power supply switching command is a signal of any form as long as it can instruct the power supply switching unit 70 to select and output the power supply voltage from the power supply circuit 43 or the power supply voltage from the power supply circuit 53. But it's okay. In the present embodiment, for example, a single control signal transmitted by one signal line is used as the power supply switching command. Hereinafter, in order to distinguish the single control signal as the power switching command to the power switching unit 70 from the single control signal as the switching command to the signal switching unit 60, it is referred to as a power switching signal.

そして、電源切替部７０は、サブＣＰＵ５１からの電源切替信号がハイとローとの一方である通常時レベルの場合には、電源回路４３からの電源電圧をスイッチ３０に供給する。また、電源切替部７０は、サブＣＰＵ５１からの電源切替信号が通常時レベルと異なる方の非通常時レベルである場合には、電源回路５３からの電源電圧をスイッチ３０に供給する。 Then, the power supply switching unit 70 supplies the power supply voltage from the power supply circuit 43 to the switch 30 when the power supply switching signal from the sub CPU 51 is at the normal level, which is one of high and low. Further, when the power supply switching signal from the sub CPU 51 is a non-normal time level different from the normal time level, the power supply switching unit 70 supplies the power supply voltage from the power supply circuit 53 to the switch 30.

〈３−１ｃ〉サブＣＰＵ５１は、異常検出部４５からのメイン系異常通知を受けた場合に、図２のＳ１３０の処理を行うと共に、図６の処理も行う。
図６に示すように、サブＣＰＵ５１は、Ｓ２１０にて、メイン系異常通知に含まれる異常の識別情報に基づいて、発生した異常がメインＣＰＵ４１への電源電圧の異常であるか否かを判定する。 <3-1c> When the sub CPU 51 receives the main system abnormality notification from the abnormality detection unit 45, the sub CPU 51 performs the processing of S130 in FIG. 2 and also the processing of FIG.
As shown in FIG. 6, the sub CPU 51 determines in S210 whether or not the generated abnormality is an abnormality of the power supply voltage to the main CPU 41 based on the abnormality identification information included in the main system abnormality notification. ..

サブＣＰＵ５１は、発生した異常がメインＣＰＵ４１への電源電圧の異常ではないと判定した場合には、そのまま当該図６の処理を終了するが、発生した異常がメインＣＰＵ４１への電源電圧の異常であると判定した場合には、Ｓ２２０に進む。 When the sub CPU 51 determines that the generated abnormality is not an abnormality of the power supply voltage to the main CPU 41, the sub CPU 51 ends the process of FIG. 6 as it is, but the generated abnormality is an abnormality of the power supply voltage to the main CPU 41. If it is determined, the process proceeds to S220.

そして、サブＣＰＵ５１は、Ｓ２２０では、電源切替部７０への電源切替信号をデフォルト値としての通常時レベルから、非通常時レベルに切り替えることにより、スイッチ３０に電源電圧を供給する電源回路を、電源回路４３から電源回路５３に変更する。 Then, in S220, the sub CPU 51 powers the power supply circuit that supplies the power supply voltage to the switch 30 by switching the power supply switching signal to the power supply switching unit 70 from the normal time level as the default value to the non-normal time level. The circuit 43 is changed to the power supply circuit 53.

［３−２．効果］
以上詳述した第３実施形態によれば、前述した第２実施形態の効果を奏し、さらに、以下の効果を奏する。 [3-2. effect]
According to the third embodiment described in detail above, the effect of the above-mentioned second embodiment is obtained, and the following effects are further obtained.

メイン系異常のうち、メインＣＰＵ４１への電源電圧の異常が検出された場合にだけ、スイッチ３０に電源電圧を供給する電源回路が、電源回路４３から電源回路５３に変更される。このため、電源回路４３とメインＣＰＵ４１とのうち、メインＣＰＵ４１の動作だけが異常になった場合には、電源回路４３からスイッチ３０に引き続き電源電圧が供給されることなり、電源回路の変更が実施される機会を少なくすることができる。 The power supply circuit that supplies the power supply voltage to the switch 30 is changed from the power supply circuit 43 to the power supply circuit 53 only when an abnormality in the power supply voltage to the main CPU 41 is detected among the main system abnormalities. Therefore, when only the operation of the main CPU 41 of the power supply circuit 43 and the main CPU 41 becomes abnormal, the power supply voltage is continuously supplied from the power supply circuit 43 to the switch 30, and the power supply circuit is changed. You can reduce the chances of being done.

［４．第４実施形態］
［４−１．第１実施形態との相違点］
第４実施形態は、基本的な構成は第１実施形態と同様であるため、相違点について以下に説明する。なお、第１実施形態と同じ符号は、同一の構成を示すものであって、先行する説明を参照する。 [4. Fourth Embodiment]
[4-1. Differences from the first embodiment]
Since the basic configuration of the fourth embodiment is the same as that of the first embodiment, the differences will be described below. The same reference numerals as those in the first embodiment indicate the same configurations, and the preceding description will be referred to.

図７に示す第４実施形態のＥＣＵ１は、第１実施形態と比較すると、下記〈４−１ａ〉〜〈４−１ｃ〉の事項が異なる。
〈４−１ａ〉サブ系回路部５０は、メイン系回路部４０と同様に、異常検出部５５を備える。以下では、異常検出部５５のことを、メイン系回路部４０の異常検出部４５と区別するために、サブ系異常検出部５５とも言う。 The ECU 1 of the fourth embodiment shown in FIG. 7 is different from the first embodiment in the following items <4-1a> to <4-1c>.
<4-1a> The sub system circuit unit 50 includes an abnormality detection unit 55, similarly to the main system circuit unit 40. Hereinafter, the abnormality detection unit 55 is also referred to as a sub system abnormality detection unit 55 in order to distinguish it from the abnormality detection unit 45 of the main system circuit unit 40.

サブ系異常検出部５５は、ＷＤＣ監視部５６と、電源監視部５７と、を備える。
ＷＤＣ監視部５６は、サブＣＰＵ５１が正常であればサブＣＰＵ５１から所定時間以内毎に出力されるはずのＷＤＣ信号を監視する。そして、ＷＤＣ監視部５６は、サブＣＰＵ５１からＷＤＣ信号が出力されない継続時間が、上記所定時間よりも長く設定された閾値時間を超えた場合、あるいはＷＤＣ信号の出力周期が所定時間よりも短くなった場合に、サブＣＰＵ５１が異常であると判定する。サブＣＰＵ５１が異常であると判定されることは、サブＣＰＵ５１の異常が検出されたことに該当する。 The sub system abnormality detection unit 55 includes a WDC monitoring unit 56 and a power supply monitoring unit 57.
The WDC monitoring unit 56 monitors the WDC signal that should be output from the sub CPU 51 every predetermined time if the sub CPU 51 is normal. Then, when the duration during which the WDC signal is not output from the sub CPU 51 exceeds the set threshold time longer than the predetermined time, the WDC monitoring unit 56 has the output cycle of the WDC signal shorter than the predetermined time. In this case, it is determined that the sub CPU 51 is abnormal. Determining that the sub CPU 51 is abnormal corresponds to the detection of an abnormality in the sub CPU 51.

電源監視部５７は、電源回路５３からサブＣＰＵ５１へ供給される電源電圧を監視し、当該電源電圧の値が所定の正常範囲内でなければ、当該電源電圧が異常であると判定する。ＷＤＣ監視部５６によってサブＣＰＵ５１の異常が検出されていなくても、電源監視部５７によってサブＣＰＵ５１への電源電圧の異常が検出された場合には、サブＣＰＵ５１が正常に動作しない可能性がある。 The power supply monitoring unit 57 monitors the power supply voltage supplied from the power supply circuit 53 to the sub CPU 51, and if the value of the power supply voltage is not within a predetermined normal range, determines that the power supply voltage is abnormal. Even if the WDC monitoring unit 56 does not detect an abnormality in the sub CPU 51, if the power supply monitoring unit 57 detects an abnormality in the power supply voltage to the sub CPU 51, the sub CPU 51 may not operate normally.

そして、サブ系異常検出部５５は、ＷＤＣ監視部５６によりサブＣＰＵ５１の異常が検出されるか、あるいは電源監視部５７によりサブＣＰＵ５１への電源電圧の異常が検出された場合に、サブ系異常が発生したことを示すサブ系異常通知を出力する。ここで言うサブ系異常とは、サブＣＰＵ５１に関する異常であり、本実施形態では、サブＣＰＵ５１の異常又はサブＣＰＵ５１への電源電圧の異常である。 Then, when the WDC monitoring unit 56 detects the abnormality of the sub CPU 51 or the power supply monitoring unit 57 detects the abnormality of the power supply voltage to the sub CPU 51, the sub system abnormality detecting unit 55 causes the sub system abnormality. Outputs a sub system error notification indicating that it has occurred. The sub system abnormality referred to here is an abnormality related to the sub CPU 51, and in the present embodiment, it is an abnormality of the sub CPU 51 or an abnormality of the power supply voltage to the sub CPU 51.

サブ系異常検出部５５からのサブ系異常通知は、例えばＳＰＩ通信又はＵＡＲＴ通信等のデータ通信による通知であって良い。サブ系異常通知にデータ通信が用いられる場合、サブ系異常通知には、検出された異常を識別可能な識別情報が含まれても良い。また、サブ系異常通知は、信号線の信号レベルによる通知であっても良い。この場合、信号線の信号レベルが、ハイとローとのうちで、予め定められた一方のレベルであれば、異常ありを示すように構成することができる。 The sub system abnormality notification from the sub system abnormality detection unit 55 may be a notification by data communication such as SPI communication or UART communication. When data communication is used for the sub system abnormality notification, the sub system abnormality notification may include identification information that can identify the detected abnormality. Further, the sub system abnormality notification may be a notification based on the signal level of the signal line. In this case, if the signal level of the signal line is one of high and low, which is predetermined, it can be configured to indicate that there is an abnormality.

そして、サブ系異常検出部５５からのサブ系異常通知は、後述する遮断用スイッチ７２と、メインＣＰＵ４１とに入力されるようになっている。
なお、サブ系異常検出部５５は、例えば、電源回路５３から出力される複数の電源電圧のうち、サブＣＰＵ５１へ供給される電源電圧とは別の電源電圧によって動作するように構成されて良い。また、サブ系異常検出部５５は、例えば、電源回路４３，５３とは別の、図示されない電源回路から供給される電源電圧によって動作するように構成されて良い。 Then, the sub system abnormality notification from the sub system abnormality detection unit 55 is input to the cutoff switch 72 and the main CPU 41, which will be described later.
The sub system abnormality detection unit 55 may be configured to operate with a power supply voltage different from the power supply voltage supplied to the sub CPU 51 among a plurality of power supply voltages output from the power supply circuit 53, for example. Further, the sub system abnormality detection unit 55 may be configured to operate by a power supply voltage supplied from a power supply circuit (not shown), which is different from the power supply circuits 43 and 53, for example.

〈４−１ｂ〉ＥＣＵ１は、遮断用スイッチ７２を更に備える。遮断用スイッチ７２は、サブＣＰＵ５１から信号切替部６０へ切替指令を伝達するための信号線（以下、切替指令用信号線）上に設けられている。 <4-1b> The ECU 1 further includes a cutoff switch 72. The cutoff switch 72 is provided on a signal line for transmitting a switching command from the sub CPU 51 to the signal switching unit 60 (hereinafter referred to as a switching command signal line).

遮断用スイッチ７２のデフォルトの状態はオンである。そして、遮断用スイッチ７２には、オフの指令として、サブ系異常検出部５５からのサブ系異常通知が入力される。このため、遮断用スイッチ７２は、サブ系異常検出部５５からサブ系異常通知が出力されると、オンからオフに切り替わって、切替指令用信号線を遮断する。切替指令用信号線が遮断されることで、サブＣＰＵ５１から信号切替部６０への切替指令の伝達が遮断される。 The default state of the shutoff switch 72 is on. Then, the sub system abnormality notification from the sub system abnormality detection unit 55 is input to the cutoff switch 72 as an off command. Therefore, when the sub system abnormality detection unit 55 outputs the sub system abnormality notification, the cutoff switch 72 switches from on to off and cuts off the switching command signal line. By blocking the switching command signal line, the transmission of the switching command from the sub CPU 51 to the signal switching unit 60 is blocked.

そして、切替指令用信号線は、遮断用スイッチ７２のオフによって遮断された場合には、信号切替部６０に入力される切替指令としての単一制御信号が前述の通常時レベルに固定されるように構成されている。 Then, when the switching command signal line is cut off by turning off the cutoff switch 72, the single control signal as the switching command input to the signal switching unit 60 is fixed to the above-mentioned normal time level. It is configured in.

よって、サブ系異常検出部５５からサブ系異常通知が出力されて、遮断用スイッチ７２がオフした場合には、サブＣＰＵ５１から出力される切替指令に関わらず、信号切替部６０では、第１スイッチ６１と第２スイッチ６２とのうち、第１スイッチ６１がオンする。このため、スイッチ制御ＣＰＵは、メインＣＰＵ４１に固定される。つまり、スイッチ制御ＣＰＵが、サブＣＰＵ５１によって変更されてしまうことが阻止される。 Therefore, when the sub system abnormality detection unit 55 outputs the sub system abnormality notification and the cutoff switch 72 is turned off, the signal switching unit 60 has the first switch regardless of the switching command output from the sub CPU 51. Of 61 and the second switch 62, the first switch 61 is turned on. Therefore, the switch control CPU is fixed to the main CPU 41. That is, the switch control CPU is prevented from being changed by the sub CPU 51.

〈４−１ｃ〉ＥＣＵ１では、サブ系異常検出部５５及びメインＣＰＵ４１によって、図８に示す処理も行われる。図８に示される処理は、例えば一定時間毎に繰り返し実行される。 <4-1c> In the ECU 1, the process shown in FIG. 8 is also performed by the sub system abnormality detection unit 55 and the main CPU 41. The process shown in FIG. 8 is repeatedly executed, for example, at regular time intervals.

図８に示すように、ＥＣＵ１では、Ｓ３１０にて、サブ系異常検出部５５が、ＷＤＣ監視部５６又は電源監視部５７によってサブ系異常が検出されたか否かを判定する。
サブ系異常検出部５５は、上記Ｓ３１０にて、サブ系異常が検出されたと判定した場合には、Ｓ３２０にて、メインＣＰＵ４１及び遮断用スイッチ７２へのサブ系異常通知を出力する。 As shown in FIG. 8, in the ECU 1, in S310, the sub system abnormality detection unit 55 determines whether or not the sub system abnormality is detected by the WDC monitoring unit 56 or the power supply monitoring unit 57.
When the sub system abnormality detection unit 55 determines that the sub system abnormality has been detected in S310, the sub system abnormality detection unit 55 outputs a sub system abnormality notification to the main CPU 41 and the shutoff switch 72 in S320.

サブ系異常検出部５５からサブ系異常通知が出力されることにより、遮断用スイッチ７２がオフして、サブＣＰＵ５１から信号切替部６０への切替指令の伝達が遮断される。詳しくは、切替指令としての単一制御信号のうち、非通常時レベルの単一制御信号の伝達が遮断される。 When the sub system abnormality detection unit 55 outputs the sub system abnormality notification, the cutoff switch 72 is turned off, and the transmission of the switching command from the sub CPU 51 to the signal switching unit 60 is cut off. Specifically, among the single control signals as the switching command, the transmission of the single control signal at the abnormal normal level is cut off.

また、メインＣＰＵ４１は、サブ系異常検出部５５からのサブ系異常通知を受けると、Ｓ３３０にて、スイッチ３０がフレームの送受信中であるか否かを判定し、フレームの送受信中であれば、スイッチ３０におけるフレームの送受信が完了するまで待つ。そして、メインＣＰＵ４１は、Ｓ３３０にて、スイッチ３０がフレームの送受信中ではないと判定した場合には、Ｓ３４０に進む。つまり、メインＣＰＵ４１は、スイッチ３０においてフレームの送受信が完了していることを確認してから、Ｓ３４０に進む。なお、メインＣＰＵ４１は、例えば、スイッチ３０の制御用ポート３５から、スイッチ３０の状態を示すステータス情報を読み出し、この読み出したステータス情報により、スイッチ３０がフレームの送受信中であるか否かを判定して良い。 Further, when the main CPU 41 receives the sub system abnormality notification from the sub system abnormality detection unit 55, the main CPU 41 determines in S330 whether or not the switch 30 is transmitting / receiving frames, and if it is transmitting / receiving frames, Wait until the transmission / reception of the frame on the switch 30 is completed. Then, when the main CPU 41 determines in S330 that the switch 30 is not transmitting / receiving a frame, the main CPU 41 proceeds to S340. That is, the main CPU 41 confirms that the transmission / reception of the frame is completed on the switch 30, and then proceeds to S340. The main CPU 41 reads, for example, status information indicating the state of the switch 30 from the control port 35 of the switch 30, and determines whether or not the switch 30 is transmitting / receiving a frame based on the read status information. It's okay.

そして、メインＣＰＵ４１は、Ｓ３４０では、スイッチ３０の制御用ポート３５に出力する制御信号により、スイッチ３０におけるフレームの宛先を変更する。具体的には、サブＣＰＵ５１宛てのフレームがスイッチ３０からメインＣＰＵ４１に転送されるように、スイッチ３０の設定を変更する。スイッチ３０は、Ｓ３４０での設定変更により、サブＣＰＵ５１宛てのフレームに含まれる宛先ＭＡＣアドレスを、メインＣＰＵ４１のＭＡＣアドレスに変更するようになっていても良い。 Then, in S340, the main CPU 41 changes the destination of the frame in the switch 30 by the control signal output to the control port 35 of the switch 30. Specifically, the setting of the switch 30 is changed so that the frame addressed to the sub CPU 51 is transferred from the switch 30 to the main CPU 41. The switch 30 may change the destination MAC address included in the frame addressed to the sub CPU 51 to the MAC address of the main CPU 41 by changing the setting in S340.

メインＣＰＵ４１は、Ｓ３４０の処理を行った場合には、スイッチ３０から、元々メインＣＰＵ４１宛てのフレームと、本来ならばサブＣＰＵ５１宛てのフレームとを、受信することになる。そして、受信した各フレームについて例えばロギング制御を行う。ここで言う「本来ならば」とは、サブ系異常が検出されていなければ、という意味である。 When the processing of S340 is performed, the main CPU 41 receives a frame originally addressed to the main CPU 41 and a frame originally addressed to the sub CPU 51 from the switch 30. Then, for example, logging control is performed for each received frame. "Originally" here means that no sub-system abnormality has been detected.

また、サブ系異常検出部５５は、上記Ｓ３１０にて、サブ系異常が検出されていないと判定した場合には、サブ系異常通知を出力しない。そして、この場合には、Ｓ３２０〜Ｓ３４０がスキップされる。 Further, when the sub system abnormality detection unit 55 determines in S310 that no sub system abnormality has been detected, the sub system abnormality detection unit 55 does not output the sub system abnormality notification. Then, in this case, S320 to S340 are skipped.

［４−２．効果］
以上詳述した第４実施形態によれば、前述した第１実施形態の効果を奏し、さらに、以下の効果を奏する。 [4-2. effect]
According to the fourth embodiment described in detail above, the effects of the above-mentioned first embodiment are exhibited, and the following effects are further achieved.

（４ａ）サブ系異常検出部５５によってサブ系異常が検出された場合には、サブＣＰＵ５１によってスイッチ制御ＣＰＵが変更されることが阻止される。よって、正常に動作しないサブＣＰＵ５１によって、スイッチ制御ＣＰＵが誤ってメインＣＰＵ４１からサブＣＰＵ５１に変更されてしまうことを、抑制することができる。 (4a) When the sub system abnormality is detected by the sub system abnormality detection unit 55, the sub CPU 51 prevents the switch control CPU from being changed. Therefore, it is possible to prevent the switch control CPU from being accidentally changed from the main CPU 41 to the sub CPU 51 by the sub CPU 51 that does not operate normally.

（４ｂ）サブ系異常検出部５５によってサブ系異常が検出された場合には、遮断用スイッチ７２がオフして、サブＣＰＵ５１から信号切替部６０への切替指令の伝達が遮断されことにより、サブＣＰＵ５１によるスイッチ制御ＣＰＵの変更が阻止される。このため、スイッチ制御ＣＰＵの変更阻止の確実性を向上させることができる。 (4b) When a sub system abnormality is detected by the sub system abnormality detection unit 55, the cutoff switch 72 is turned off to block the transmission of the switching command from the sub CPU 51 to the signal switching unit 60, so that the sub system abnormality is detected. The change of the switch control CPU by the CPU 51 is prevented. Therefore, it is possible to improve the certainty of preventing the change of the switch control CPU.

（４ｃ）サブ系異常検出部５５からのサブ系異常通知は、メインＣＰＵ４１を介さずに、遮断用スイッチ７２に出力される。このため、異常になったメインＣＰＵ４１が遮断用スイッチ７２をオフしてしまい、正常なサブＣＰＵ５１による信号切替部６０及びスイッチ３０の制御が不能になってしまうことを、回避することができる。 (4c) The sub system abnormality notification from the sub system abnormality detection unit 55 is output to the cutoff switch 72 without going through the main CPU 41. Therefore, it is possible to prevent the abnormal main CPU 41 from turning off the cutoff switch 72, which makes it impossible for the normal sub CPU 51 to control the signal switching unit 60 and the switch 30.

（４ｄ）サブ系異常検出部５５からのサブ系異常通知は、遮断用スイッチ７２だけでなく、メインＣＰＵ４１にも入力される。そして、メインＣＰＵ４１は、サブ系異常通知を受けた場合に、図８のＳ３４０の処理を行ってスイッチ３０の設定を変更することにより、サブＣＰＵ５１宛てのフレームがスイッチ３０からメインＣＰＵ４１に転送されるようにする。このため、本来ならばサブＣＰＵ５１に転送される外部装置からのフレームが、メインＣＰＵ４１に転送されるようになる。 (4d) The sub system abnormality notification from the sub system abnormality detection unit 55 is input not only to the cutoff switch 72 but also to the main CPU 41. Then, when the main CPU 41 receives the sub system abnormality notification, the frame addressed to the sub CPU 51 is transferred from the switch 30 to the main CPU 41 by performing the process of S340 in FIG. 8 and changing the setting of the switch 30. To do so. Therefore, the frame from the external device, which is normally transferred to the sub CPU 51, is transferred to the main CPU 41.

よって、サブＣＰＵ５１宛てのフレームは、正常なメインＣＰＵ４１によって処理されることができる。例えば、サブＣＰＵ５１宛てのフレームが、メインＣＰＵ４１に受信されてロギング制御の対象とされることにより、サブＣＰＵ５１宛てのフレームに含まれたデータが、メイン系回路部４０の記憶装置４２に記憶（即ち、ロギング）される。よって、データの消失を抑制することができる。 Therefore, the frame addressed to the sub CPU 51 can be processed by the normal main CPU 41. For example, when the frame addressed to the sub CPU 51 is received by the main CPU 41 and is subject to logging control, the data included in the frame addressed to the sub CPU 51 is stored in the storage device 42 of the main system circuit unit 40 (that is,). , Logging). Therefore, data loss can be suppressed.

なお、上記第４実施形態では、メイン系回路部４０の異常検出部４５が第１の異常検出部に相当し、サブ系回路部５０の異常検出部（即ち、サブ系異常検出部）５５が第２の異常検出部に相当し、遮断用スイッチ７２が阻止部に相当する。また、信号切替部６０への切替指令としての単一制御信号のうち、非通常時レベルの単一制御信号が、「第２の処理部からの制御信号が信号切替部によって中継部に入力されるようにするための切替指令」に相当する。サブＣＰＵ５１は、図２のＳ１３０〜Ｓ１５０の処理を行うことで、第１の変更部として機能する。メインＣＰＵ４１は、図８のＳ３４０の処理を行うことで、第２の変更部として機能する。 In the fourth embodiment, the abnormality detection unit 45 of the main system circuit unit 40 corresponds to the first abnormality detection unit, and the abnormality detection unit (that is, the sub system abnormality detection unit) 55 of the sub system circuit unit 50 corresponds to the first abnormality detection unit. It corresponds to the second abnormality detection unit, and the cutoff switch 72 corresponds to the blocking unit. Further, among the single control signals as the switching command to the signal switching unit 60, the single control signal at the abnormal normal level is "the control signal from the second processing unit is input to the relay unit by the signal switching unit. Corresponds to the "switching command". The sub CPU 51 functions as a first change unit by performing the processes of S130 to S150 of FIG. The main CPU 41 functions as a second change unit by performing the process of S340 in FIG.

一方、上記第４実施形態の構成及び処理は、第２実施形態及び第３実施形態に対しても適用して良い。
［５．他の実施形態］
以上、本開示の実施形態について説明したが、本開示は上述の実施形態に限定されることなく、種々変形して実施することができる。 On the other hand, the configuration and processing of the fourth embodiment may be applied to the second embodiment and the third embodiment.
[5. Other embodiments]
Although the embodiments of the present disclosure have been described above, the present disclosure is not limited to the above-described embodiments, and can be implemented in various modifications.

例えば、異常検出部４５は、ＷＤＣ監視部４６と電源監視部４７との一方だけを備えても良い。異常検出部５５も、ＷＤＣ監視部５６と電源監視部５７との一方だけを備えても良い。 For example, the abnormality detection unit 45 may include only one of the WDC monitoring unit 46 and the power supply monitoring unit 47. The abnormality detection unit 55 may also include only one of the WDC monitoring unit 56 and the power supply monitoring unit 57.

また、ＥＣＵ１にイーサネットとは別の通信プロトコルの通信線が接続され、当該通信線を介して受信されたデータも記憶装置４２，５２にロギングされて良い。別の通信プロトコルとしては、例えばＣＡＮ（即ち、Controller Area Network）又はＬＩＮ（即ち、Local Interconnect Network）であって良い。ＣＡＮは登録商標である。 Further, a communication line having a communication protocol different from Ethernet may be connected to the ECU 1, and data received via the communication line may also be logged in the storage devices 42 and 52. Another communication protocol may be, for example, CAN (ie, Controller Area Network) or LIN (ie, Local Interconnect Network). CAN is a registered trademark.

また、ＣＰＵ、電源回路及び記憶装置を備える回路部の数は、２つに限らず、３つ以上であっても良い。そして、３つ以上の回路部のうちの少なくとも２つが、前述したメイン回路部４０とサブ系回路部５０との関係になっていれば良い。 Further, the number of circuit units including the CPU, the power supply circuit, and the storage device is not limited to two, and may be three or more. Then, at least two of the three or more circuit units may have a relationship between the main circuit unit 40 and the sub system circuit unit 50 described above.

また、本開示に記載のＥＣＵ１及びその手法は、コンピュータプログラムにより具体化された一つ乃至は複数の機能を実行するようにプログラムされたプロセッサ及びメモリを構成することによって提供された専用コンピュータにより、実現されてもよい。あるいは、本開示に記載のＥＣＵ１及びその手法は、一つ以上の専用ハードウェア論理回路によってプロセッサを構成することによって提供された専用コンピュータにより、実現されてもよい。もしくは、本開示に記載のＥＣＵ１及びその手法は、一つ乃至は複数の機能を実行するようにプログラムされたプロセッサ及びメモリと一つ以上のハードウェア論理回路によって構成されたプロセッサとの組み合わせにより構成された一つ以上の専用コンピュータにより、実現されてもよい。また、コンピュータプログラムは、コンピュータにより実行されるインストラクションとして、コンピュータ読み取り可能な非遷移有形記録媒体に記憶されてもよい。ＥＣＵ１に含まれる各部の機能を実現する手法には、必ずしもソフトウェアが含まれている必要はなく、その全部の機能が、一つあるいは複数のハードウェアを用いて実現されてもよい。 Further, the ECU 1 and its method described in the present disclosure are provided by a dedicated computer provided by configuring a processor and memory programmed to perform one or more functions embodied by a computer program. It may be realized. Alternatively, the ECU 1 and its method described in the present disclosure may be realized by a dedicated computer provided by configuring the processor with one or more dedicated hardware logic circuits. Alternatively, the ECU 1 and its method described in the present disclosure are configured by a combination of a processor and memory programmed to perform one or more functions and a processor composed of one or more hardware logic circuits. It may be realized by one or more dedicated computers. The computer program may also be stored on a computer-readable non-transitional tangible recording medium as an instruction executed by the computer. The method for realizing the functions of each part included in the ECU 1 does not necessarily include software, and all the functions may be realized by using one or a plurality of hardware.

また、上記実施形態における１つの構成要素が有する複数の機能を、複数の構成要素によって実現したり、１つの構成要素が有する１つの機能を、複数の構成要素によって実現したりしてもよい。また、複数の構成要素が有する複数の機能を、１つの構成要素によって実現したり、複数の構成要素によって実現される１つの機能を、１つの構成要素によって実現したりしてもよい。また、上記実施形態の構成の一部を省略してもよい。また、上記実施形態の構成の少なくとも一部を、他の上記実施形態の構成に対して付加又は置換してもよい。 Further, a plurality of functions possessed by one component in the above embodiment may be realized by a plurality of components, or one function possessed by one component may be realized by a plurality of components. Further, a plurality of functions possessed by the plurality of components may be realized by one component, or one function realized by the plurality of components may be realized by one component. Further, a part of the configuration of the above embodiment may be omitted. In addition, at least a part of the configuration of the above embodiment may be added or replaced with the configuration of the other above embodiment.

また、上述したＥＣＵ１の他、当該ＥＣＵ１を構成要素とするシステム、当該ＥＣＵ１としてコンピュータを機能させるためのプログラム、このプログラムを記録した半導体メモリ等の非遷移的実体的記録媒体、中継部の制御方法など、種々の形態で本開示を実現することもできる。 Further, in addition to the above-mentioned ECU 1, a system having the ECU 1 as a component, a program for operating a computer as the ECU 1, a non-transitional substantive recording medium such as a semiconductor memory in which this program is recorded, and a control method of a relay unit. The present disclosure can also be realized in various forms such as.

１…ＥＣＵ、Ｐ１，Ｐ２…外部通信ポート、３０…イーサネットスイッチ、４１…メインＣＰＵ、５１…サブＣＰＵ、４３…電源回路、５３…電源回路、４５…異常検出部。 1 ... ECU, P1, P2 ... External communication port, 30 ... Ethernet switch, 41 ... Main CPU, 51 ... Sub CPU, 43 ... Power supply circuit, 53 ... Power supply circuit, 45 ... Abnormality detection unit.

Claims (8)

外部装置とフレームを送受信するための少なくとも１つの外部通信ポート（Ｐ１，Ｐ２）と、
第１の処理部（４１）と、
第２の処理部（５１）と、
前記第１の処理部へ電源電圧を供給するように構成された第１の電源部（４３）と、
前記第２の処理部へ電源電圧を供給するように構成された第２の電源部（５３）と、
前記少なくとも１つの外部通信ポートを介したフレームの送受信と、前記第１の処理部及び前記第２の処理部とのフレームの送受信とが可能であり、受信したフレームの中継を行うように構成された中継部（３０）と、
前記第１の処理部と、前記第１の電源部から前記第１の処理部へ供給される前記電源電圧との、少なくとも一方の異常を検出するように構成された異常検出部（４５）と、
前記異常検出部により前記第１の処理部と前記第１の処理部への前記電源電圧との少なくとも一方の異常が検出された場合に、前記中継部を制御する処理部を、前記第１の処理部から前記第２の処理部に変更すると共に、前記第１の処理部宛てのフレームが前記中継部から前記第２の処理部に転送されるように前記中継部の設定を変更するように構成された変更部（５１，Ｓ１３０〜Ｓ１５０）と、を備える、
電子制御装置。 At least one external communication port (P1, P2) for sending and receiving frames to and from an external device,
The first processing unit (41) and
The second processing unit (51) and
A first power supply unit (43) configured to supply a power supply voltage to the first processing unit, and
A second power supply unit (53) configured to supply a power supply voltage to the second processing unit, and
It is possible to send and receive frames via the at least one external communication port and to send and receive frames to and from the first processing unit and the second processing unit, and the received frames are relayed. With the relay part (30)
An abnormality detection unit (45) configured to detect at least one abnormality of the first processing unit and the power supply voltage supplied from the first power supply unit to the first processing unit. ,
When at least one abnormality of the first processing unit and the power supply voltage to the first processing unit is detected by the abnormality detecting unit, the processing unit that controls the relay unit is the first processing unit. The setting of the relay unit is changed so that the frame addressed to the first processing unit is transferred from the relay unit to the second processing unit while changing from the processing unit to the second processing unit. A configured change unit (51, S130 to S150) is provided.
Electronic control device. 請求項１に記載の電子制御装置であって、
前記変更部は、
前記中継部を制御する処理部を、前記第１の処理部から前記第２の処理部に変更した後、前記中継部においてフレームの送受信が完了していることを確認してから、前記第１の処理部宛てのフレームが前記中継部から前記第２の処理部に転送されるように前記中継部の設定を変更するように構成されている、
電子制御装置。 The electronic control device according to claim 1.
The changed part
After changing the processing unit that controls the relay unit from the first processing unit to the second processing unit, it is confirmed that the transmission / reception of the frame is completed in the relay unit, and then the first processing unit is used. The setting of the relay unit is changed so that the frame addressed to the processing unit is transferred from the relay unit to the second processing unit.
Electronic control device. 請求項１又は請求項２に記載の電子制御装置であって、
前記異常検出部は、第１の異常検出部（４５）であり、
前記第２の処理部が、前記変更部として機能するように構成されており、
更に、前記第２の処理部と、前記第２の電源部から前記第２の処理部へ供給される前記電源電圧との、少なくとも一方の異常を検出するように構成された第２の異常検出部（５５）と、
前記第２の異常検出部により前記第２の処理部と前記第２の処理部への前記電源電圧との少なくとも一方の異常が検出された場合に、前記中継部を制御する処理部が前記第２の処理部によって変更されることを、阻止するように構成された阻止部（７２）と、を備える、
電子制御装置。 The electronic control device according to claim 1 or 2.
The abnormality detection unit is the first abnormality detection unit (45).
The second processing unit is configured to function as the modified unit.
Further, a second abnormality detection configured to detect at least one abnormality of the second processing unit and the power supply voltage supplied from the second power supply unit to the second processing unit. Department (55) and
When at least one abnormality of the second processing unit and the power supply voltage to the second processing unit is detected by the second abnormality detecting unit, the processing unit that controls the relay unit is the second processing unit. It comprises a blocking unit (72) configured to prevent modification by the processing unit of 2.
Electronic control device. 請求項３に記載の電子制御装置であって、
前記中継部を制御するための制御信号を、前記第１の処理部と前記第２の処理部とのうちの一方から前記中継部に入力させるように構成された信号切替部（６０）、を更に備え、
前記変更部として機能する前記第２の処理部は、
前記第２の処理部からの前記制御信号が前記信号切替部によって前記中継部に入力されるようにするための切替指令を、前記信号切替部に出力することにより、前記中継部を制御する処理部を、前記第１の処理部から前記第２の処理部に変更するように構成され、
前記阻止部は、
前記第２の処理部から前記信号切替部への前記切替指令の伝達を遮断することにより、前記中継部を制御する処理部が前記第２の処理部によって変更されることを阻止するように構成されている、
電子制御装置。 The electronic control device according to claim 3.
A signal switching unit (60) configured to input a control signal for controlling the relay unit to the relay unit from one of the first processing unit and the second processing unit. Further prepare
The second processing unit that functions as the change unit is
A process of controlling the relay unit by outputting a switching command for inputting the control signal from the second processing unit to the relay unit by the signal switching unit to the signal switching unit. The unit is configured to change from the first processing unit to the second processing unit.
The blocking part
By blocking the transmission of the switching command from the second processing unit to the signal switching unit, the processing unit that controls the relay unit is prevented from being changed by the second processing unit. Has been
Electronic control device. 請求項３又は請求項４に記載の電子制御装置であって、
前記変更部は、第１の変更部（５１，Ｓ１３０〜Ｓ１５０）であり、
更に、前記第２の異常検出部により前記第２の処理部と前記第２の処理部への前記電源電圧との少なくとも一方の異常が検出された場合に、前記第２の処理部宛てのフレームが前記中継部から前記第１の処理部に転送されるように前記中継部の設定を変更するように構成された第２の変更部（４１，Ｓ３４０）、を備える、
電子制御装置。 The electronic control device according to claim 3 or 4.
The changed part is a first changed part (51, S130 to S150).
Further, when an abnormality of at least one of the second processing unit and the power supply voltage to the second processing unit is detected by the second abnormality detecting unit, a frame addressed to the second processing unit is detected. A second change unit (41, S340) configured to change the setting of the relay unit so that the relay unit is transferred from the relay unit to the first processing unit.
Electronic control device. 請求項１ないし請求項５の何れか１項に記載の電子制御装置であって、
前記異常検出部により前記第１の処理部と前記第１の処理部への前記電源電圧との少なくとも一方の異常が検出された場合に、前記中継部に電源電圧を供給する電源部が、前記第１の電源部から、前記第１の電源部とは別の電源部に変更される、
電子制御装置。 The electronic control device according to any one of claims 1 to 5.
When the abnormality detection unit detects at least one abnormality of the first processing unit and the power supply voltage to the first processing unit, the power supply unit that supplies the power supply voltage to the relay unit is described. The first power supply unit is changed to a power supply unit different from the first power supply unit.
Electronic control device. 請求項６に記載の電子制御装置であって、
前記異常検出部は、少なくとも前記第１の処理部へ供給される前記電源電圧の異常を検出するように構成され、
前記異常検出部により前記第１の処理部への前記電源電圧の異常が検出された場合に、前記中継部に電源電圧を供給する電源部が、前記第１の電源部から前記別の電源部に変更される、
電子制御装置。 The electronic control device according to claim 6.
The abnormality detection unit is configured to detect an abnormality in the power supply voltage supplied to at least the first processing unit.
When an abnormality in the power supply voltage to the first processing unit is detected by the abnormality detection unit, the power supply unit that supplies the power supply voltage to the relay unit changes from the first power supply unit to the other power supply unit. To be changed to
Electronic control device. 請求項６又は請求項７に記載の電子制御装置であって、
前記別の電源部は、前記第２の電源部である、
電子制御装置。 The electronic control device according to claim 6 or 7.
The other power supply unit is the second power supply unit.
Electronic control device.
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Citations (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001298459A (en) * 2000-04-12 2001-10-26 Nec Corp System changeover device
JP2003524905A (en) * 1998-04-03 2003-08-19 ヴァーティカル・ネットワークス・インコーポレーテッド System and method for transmitting voice and data using intelligent bridge TDM and packet bus
JP2007067540A (en) * 2005-08-29 2007-03-15 Mitsubishi Electric Corp Dual system switch
JP2009166549A (en) * 2008-01-11 2009-07-30 Denso Corp Electronic control device for vehicle
JP2009184423A (en) * 2008-02-04 2009-08-20 Denso Corp Vehicular electronic control unit
JP2009194787A (en) * 2008-02-18 2009-08-27 Hitachi Kokusai Electric Inc Gateway apparatus
WO2012102170A1 (en) * 2011-01-25 2012-08-02 アラクサラネットワークス株式会社 Network relay system and network relay device
WO2013058179A1 (en) * 2011-10-19 2013-04-25 日本電信電話株式会社 Optical network system
JP2016060413A (en) * 2014-09-19 2016-04-25 日立オートモティブシステムズ株式会社 Vehicular electronic control unit and control method
WO2017056688A1 (en) * 2015-09-29 2017-04-06 日立オートモティブシステムズ株式会社 Monitoring system and vehicle control device
JP2017229030A (en) * 2016-06-24 2017-12-28 富士通株式会社 Vm changeover program, information processing device and vm changeover method

Patent Citations (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2003524905A (en) * 1998-04-03 2003-08-19 ヴァーティカル・ネットワークス・インコーポレーテッド System and method for transmitting voice and data using intelligent bridge TDM and packet bus
JP2001298459A (en) * 2000-04-12 2001-10-26 Nec Corp System changeover device
JP2007067540A (en) * 2005-08-29 2007-03-15 Mitsubishi Electric Corp Dual system switch
JP2009166549A (en) * 2008-01-11 2009-07-30 Denso Corp Electronic control device for vehicle
JP2009184423A (en) * 2008-02-04 2009-08-20 Denso Corp Vehicular electronic control unit
JP2009194787A (en) * 2008-02-18 2009-08-27 Hitachi Kokusai Electric Inc Gateway apparatus
WO2012102170A1 (en) * 2011-01-25 2012-08-02 アラクサラネットワークス株式会社 Network relay system and network relay device
WO2013058179A1 (en) * 2011-10-19 2013-04-25 日本電信電話株式会社 Optical network system
JP2016060413A (en) * 2014-09-19 2016-04-25 日立オートモティブシステムズ株式会社 Vehicular electronic control unit and control method
WO2017056688A1 (en) * 2015-09-29 2017-04-06 日立オートモティブシステムズ株式会社 Monitoring system and vehicle control device
JP2017229030A (en) * 2016-06-24 2017-12-28 富士通株式会社 Vm changeover program, information processing device and vm changeover method

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
沖田 英樹 ほか: "経路制御部の冗長化によるルータ高可用化方式 Highly Available Network Node with Redundant Routing Mod", 電子情報通信学会技術研究報告 ＶＯＬ．１０３ ＮＯ．６２４ IEICE TECHNICAL REPORT, JPN6022050474, 22 January 2004 (2004-01-22), JP, pages 43 - 46, ISSN: 0004931418 *

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