JP2020086676A - デジタル回路システム、電源電圧調整方法、及び電源電圧調整プログラム - Google Patents
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Abstract
Description
前記周辺デバイスは、前記デジタル回路システム内に設けられ、又は前記デジタル回路システムと通信可能に接続されており、
前記制御部は、
前記周辺デバイスが使用されているかどうかを判定するデバイス使用状態判定部と、
前記周辺デバイスが使用されていない期間に、前記周辺デバイスから前記制御部へ送信される信号の既知のビット列を受信する送受信部と、
前記ビット列からビットエラーを検出し、BER(Bit Error Rate)を算出するBER計側部と、
計測したBERを基に前記周辺デバイスの動作状態を判定する信号状態判定部と、
判定結果を基に前記周辺デバイスに最小限の電源電圧を供給するように、前記デバイス電源へと送出するフィードバック電源を調節する電源電圧調整部と、を有することを特徴とする
デジタル回路システム、を提供する。
図2は、本発明の第2実施形態に係るシステムの構成を示す機能ブロック図である。
図3は本発明の第1実施形態、第2実施形態における制御部の電源電圧調整のフローである。
図4は、本発明の第3実施形態に係るシステムの構成を示す機能ブロック図である。
図5は、本発明の第4実施形態に係るシステムの構成を示す機能ブロック図である。
ここで、本発明のデジタル回路システムが情報処理装置である場合について、図6を用いて説明する。図6は、情報処理装置100の制御ハードウェアブロック図を示す図である。
10,10B 周辺デバイス
10C 記憶デバイス(周辺デバイス)
20 周辺デバイス電源(デバイス電源)
30,30A,30B,30C 制御部(電源電圧調整部)
31 送受信部
32 デバイス使用状態判定部
33 受信エラー検出部
34 BER算出部
35 BER状態判定部(信号状態判定部)
36 電源電圧調整部
37 タイムアウト検知部
38 BER加算部
39 リセット部
300 BER計側部
40,40B,40C 学習データ記憶部(不揮発性メモリ)
50 ステートマシン
60 システム電源
70 ウォッチドッグ
100 情報処理装置(デジタル回路システム)
11 マイコン(コンピュータ)
12 プログラム読取装置
13 HDD(不揮発性メモリ)
14 マウス(周辺デバイス)
15 キーボード(周辺デバイス)
16 ディスプレイ(周辺デバイス)
21 CPU(制御部)
22 RAM(記憶デバイス)
23 ROM
24 DISK
25 NIC
200 プリンタ
Claims (8)
- 周辺デバイスに電源電圧を供給するデバイス電源と、前記周辺デバイスを制御し、前記周辺デバイスと通信する制御部と、を備えるデジタル回路システムにおいて、
前記周辺デバイスは、前記デジタル回路システム内に設けられ、又は前記デジタル回路システムと通信可能に接続されており、
前記制御部は、
前記周辺デバイスが使用されているかどうかを判定するデバイス使用状態判定部と、
前記周辺デバイスが使用されていない期間に、前記周辺デバイスから前記制御部へ送信される信号の既知のビット列を受信する送受信部と、
前記ビット列からビットエラーを検出し、BER(Bit Error Rate)を算出するBER計側部と、
計測したBERを基に前記周辺デバイスの動作状態を判定する信号状態判定部と、
判定結果を基に前記周辺デバイスに最小限の電源電圧を供給するように、前記デバイス電源へと送出するフィードバック電源を調節する電源電圧調整部と、を有することを特徴とする
デジタル回路システム。 - 前記制御部は、前記周辺デバイスが使用されていない期間に、前記周辺デバイスが動作を停止した場合に、タイムアウトを検知するタイムアウト検知部を有し、
タイムアウトが発生した際には、前記周辺デバイスをリセットし、BERを一定値加算することで、電源電圧を上昇させることを特徴とする
請求項1に記載のデジタル回路システム。 - 算出された前記BER及び決定した電源電圧を逐次記憶する不揮発性メモリを有する、
請求項2に記載のデジタル回路システム。 - 前記周辺デバイスが使用されていない期間に、電源電圧の低下に起因して、前記制御部が異常動作した場合にリセット信号を送出するウォッチドッグを、さらに備えており、
前記ウォッチドッグは前記制御部から所定の時間以上応答がなかったときに、リセット信号を送出することによって前記制御部を異常動作から復帰させることを特徴とする
請求項1〜3のいずれか一項に記載のデジタル回路システム。 - 前記デジタル回路システムは、前記周辺デバイスの機能がすぐに実行できるスタンバイモード、及び前記スタンバイモードよりも電力の消費が少なく利用できる機能を制限する省エネモードを含む、複数の動作モードが設定可能であり、
前記周辺デバイスを現在の動作モードを保持するステートマシンをさらに備えており、
前記制御部は、前記ステートマシンから動作モード情報を受信し、動作モード毎に個別にBERを計算することによって、動作モード毎の消費電流量の差分を考慮して、前記電源電圧を最適化することを特徴とする
請求項1〜4のいずれか一項に記載のデジタル回路システム。 - 前記制御部の前記信号状態判定部及び前記電源電圧調整部において
算出された前記BERが所定範囲下限値以下の場合は、マージン有りと判定し、電源電圧を低下させ、
前記BERが所定範囲内の場合は、限界値であると判定し、電源電圧を維持させ、
前記BERが所定範囲上限値以上の場合は、エラー過多と判定し、電源電圧を上昇させるように制御することを特徴とする
請求項1〜5のいずれか一項に記載のデジタル回路システム。 - 1又は複数の周辺デバイスと、前記周辺デバイスに電源電圧を供給するデバイス電源と、
前記周辺デバイスを制御し、前記周辺デバイスと通信する制御部と、を備えるデジタル回路システムにおいて、
前記制御部は、
前記周辺デバイスが使用されているかどうかを検出するステップと、
前記周辺デバイスが使用されていない期間に、前記周辺デバイスから前記制御部へ送信される信号の既知のビット列を受信するステップと、
前記ビット列からBERを計測するBER計測ステップと、
計測したBERを基に前記周辺デバイスの動作状態を判定するステップと、
判定結果を基に、前記周辺デバイスに最小限の電源電圧を供給する前記デバイス電源へと送出するフィードバック電源を調節するステップと、を有することを特徴とする
デジタル回路システムにおける電源電圧調整方法。 - 1又は複数の周辺デバイスと通信し、前記周辺デバイスに電源電圧を供給するデバイス電源に電源電圧をフィードバックするコンピュータによって、実行する電源電圧調整プログラムであって、
前記周辺デバイスを制御し、前記周辺デバイスと通信する制御部と、を備えるデジタル回路システムにおいて、
前記制御部は、
前記周辺デバイスが使用されているかどうかを検出する処理と、
前記周辺デバイスが使用されていない期間に、前記周辺デバイスから前記制御部へ送信される信号の既知のビット列を受信する処理と、
前記ビット列からBERを計測するBER計測ステップと、
計測したBERを基に前記周辺デバイスの動作状態を判定する処理と、
判定結果を基に、前記周辺デバイスに最小限の電源電圧を供給する前記デバイス電源へと送出するフィードバック電源を調節する処理と、を有することを特徴とする
電源電圧調整プログラム。
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JP2018216891A JP7211028B2 (ja) | 2018-11-19 | 2018-11-19 | デジタル回路システム、電源電圧調整方法、及び電源電圧調整プログラム |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005252571A (ja) * | 2004-03-03 | 2005-09-15 | Matsushita Electric Ind Co Ltd | 無線通信装置およびその電源制御方法 |
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2018
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