JP2020065119A - 逐次型a/d変換回路及び逐次型a/d変換方法 - Google Patents
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Abstract
Description
20 フィルタ
30 バッファ回路
40 入力端子
50、70A、70B A/D変換部
51、51A、51B 比較器
52、52A、52B 演算回路
60、60A、60B 指定制御部
80 逐次型A/D変換回路
Claims (10)
- A/D変換対象のアナログ入力信号をサンプリングして蓄積するための少なくとも2つ以上のコンデンサと、
前記コンデンサに蓄積された電位を用いてA/D変換を行うA/D変換部と、
各コンデンサ毎に異なって定められた終了値ビットの値に応じてそれぞれのコンデンサでサンプリングを行わせると共に、終了値が最も少ないコンデンサから指定をして前記A/D変換部にA/D変換を行わせ、指定したコンデンサについて終了値となる毎に、次に終了値が少ないコンデンサを指定して前記A/D変換部にA/D変換を行わせる処理を行う指定制御部と
を具備することを特徴とする逐次型A/D変換回路。 - A/D変換部が1つであることを特徴とする請求項1に記載の逐次型A/D変換回路。
- A/D変換部がコンデンサとペアで複数設けられ、
前記指定制御部によってコンデンサが指定されると、このコンデンサとペアのA/D変換部がA/D変換を行い、A/D変換の情報を次に指定されたコンデンサとペアのA/D変換部へ送ることを特徴とする請求項1に記載の逐次型A/D変換回路。 - A/D変換部は、コンデンサの電位と閾値を比較する比較器と、
前記比較器の比較結果に基づきA/D変換のビット値を得る演算回路と
を具備することを特徴とする請求項1乃至3のいずれか1項に記載の逐次型A/D変換回路。 - 最上位ビットから所定の範囲の上位ビットを得る場合に、比較器において閾値に誤判定許容範囲を持たせて比較を行う冗長型の処理方式により比較を行うことを特徴とする請求項4に記載の逐次型A/D変換回路。
- A/D変換対象のアナログ入力信号をサンプリングして蓄積するための少なくとも2つ以上のコンデンサと、前記コンデンサに蓄積された電位を用いてA/D変換を行うA/D変換部とを備え、逐次型によりA/D変換を行う逐次型A/D変換方法において、
各コンデンサ毎に異なって定められた終了値ビットの値に応じてそれぞれのコンデンサでサンプリングを行わせ、
終了値が最も少ないコンデンサから指定をして前記A/D変換部にA/D変換を行わせ、
指定したコンデンサについて終了値となる毎に、次に終了値が少ないコンデンサを指定して前記A/D変換部にA/D変換を行わせる
ことを特徴とする逐次型A/D変換方法。 - A/D変換部が1つであることを特徴とする請求項6に記載の逐次型A/D変換方法。
- A/D変換部がコンデンサとペアで複数設けられ、
コンデンサが指定されると、このコンデンサとペアのA/D変換部によりA/D変換を行い、
A/D変換の情報を次に指定されたコンデンサとペアのA/D変換部へ送ることを特徴とする請求項6に記載の逐次型A/D変換方法。 - A/D変換部では、比較器によりコンデンサの電位と閾値を比較し、
演算回路により前記比較器の比較結果に基づきA/D変換のビット値を得る
ことを特徴とする請求項6乃至8のいずれか1項に記載の逐次型A/D変換方法。 - 最上位ビットから所定の範囲の上位ビットを得る場合に、比較器において閾値に誤判定許容範囲を持たせて比較を行う冗長型の処理方式により比較を行うことを特徴とする請求項9に記載の逐次型A/D変換方法。
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