JP2016513896A - 逐次干渉除去(sic)をサポートするための前方誤り訂正(fec) - Google Patents
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Abstract
Description
101 セル
102 セル
110 送信ポイント(TP)
120 送信ポイント(TP)
131 受信機
132 受信機
133 受信機
134 受信機
200 従来のFECアーキテクチャ
210 情報モジュール
215 情報ビット
230 FECコードモジュール
235 FECビット
240 インターリーバモジュール
250 データ・ストリーム
251 リソースブロック
252 リソースブロック
253 リソースブロック
300 FECアーキテクチャ
310 情報モジュール
315 情報ビット
320 FECコード−1モジュール
325 FECビット
326 FECビットの第1のセット
327 FECビットの第2のセット
328 FECビットの第3のセット
331 FEC2次コードモジュール
332 FEC2次コードモジュール
333 FEC2次コードモジュール
335 FECビット
336 FECビットのセット
337 FECビットのセット
338 FECビットのセット
341 インターリーバモジュール
342 インターリーバモジュール
343 インターリーバモジュール
350 データストリーム
356 リソースブロック
357 リソースブロック
358 リソースブロック
400 FECアーキテクチャ
410 情報モジュール
415 情報ビット
416 情報ビットの第1のセット
417 情報ビットの第2のセット
418 情報ビットの第3のセット
431 FECコードモジュール
432 FECコードモジュール
433 FECコードモジュール
435 FECビット
436 FECビット
437 FECビット
438 FECビット
441 インターリーバ
442 インターリーバ
443 インターリーバ
450 データストリーム
456 リソースブロック
457 リソースブロック
458 リソースブロック
500 FECアーキテクチャ
510 情報モジュール
515 情報ビット
520 FECコード−1
525 FECビット
526 FECビットの第1のセット
527 FECビットの第2のセット
528 FECビットの第3のセット
530 2次FECコードモジュール
535 FECビット
536 FECビットのセット
537 FECビットのセット
538 FECビットのセット
541 インターリーバ
542 インターリーバ
543 インターリーバ
550 データストリーム
556 リソースブロック
557 リソースブロック
558 リソースブロック
700 従来のLDPC符号化方式
710 リソースブロック
711 引数ビット
712 引数ビット
720 リソースブロック
721 パリティビット
722 パリティビット
730 リソースブロック
731 引数ビット
800 LDPC方式
810 リソースブロック
820 リソースブロック
821 パリティビット
822 パリティビット
830 リソースブロック
900 パリティビット
904 プロセッサ
906 メモリ
910 セルラーインタフェース
912 補足無線インタフェース
914 補足インタフェース
Claims (20)
- 符号化方法であって、
情報ビットのストリームを取得するステップと、
前記情報ビットのストリームを複数の前方誤り訂正(FEC)コードブロックに符号化するステップであって、各FECコードブロックは独立して復号可能である、ステップと、
前記複数のFECコードブロックを複数のリソースブロックにマッピングするステップであって、各FECコードブロックは前記リソースブロックのうちの単一のリソースブロックにマッピングされる、ステップと、
FECコードブロックのリソースブロックへの前記マッピングに従って、前記複数のFECコードブロックをデータストリームとして送信するステップと
を有する方法。 - 前記情報ビットのストリームを複数の前方誤り訂正(FEC)コードブロックに符号化するステップは、
第1のFECコードを使用して、前記情報ビットのストリームをFECビットのストリームに符号化するステップと、
前記FECビットのストリームをFECビットの複数のサブセットに分割するステップと、
複数の2次FECコードのうちの一意の一つを使用してFECビットの各サブセットを符号化して、前記複数のFECコードブロックのうちの対応する一つを取得するステップと
を有する、請求項1に記載の方法。 - 前記第1のFECコードと前記複数の2次FECコードとが結合してFECプロダクトコードを形成する、請求項2に記載の方法。
- 前記複数の2次FECコードのうちの少なくともいくつかは、異なる符号化レートを利用する、請求項2に記載の方法。
- 前記FECビットのサブセットのうちの少なくともいくつかは、異なる数のFECビットを有する、請求項2に記載の方法。
- 前記情報ビットのストリームを複数の前方誤り訂正(FEC)コードブロックに符号化するステップは、
第1のFECコードを使用して、前記情報ビットのストリームをFECビットのストリームに符号化するステップと、
前記FECビットのストリームをFECビットの複数のサブセットに分割するステップと、
単一の2次FECコードを使用してFECビットの各サブセットを符号化して、前記複数のFECコードブロックのうちの対応する一つを取得するステップと
を有する、請求項1に記載の方法。 - 前記第1のFECコードと前記単一の2次FECコードとが結合してFECプロダクトコード形成する、請求項6に記載の方法。
- 前記単一の2次FECコードは、ローカルに復号可能なFECコードブロックを生成するように構成される、請求項6に記載の方法。
- 前記単一の2次FECコードは、畳み込みコードである、請求項6に記載の方法。
- 前記複数のFECコードブロックを前記複数のリソースブロックにマッピングするステップは、
前記複数のFECコードブロックのそれぞれを一意の仮想リソースブロック(VRB)に割り当てるステップ
を有する、請求項1に記載の方法。 - 前記複数のFECコードブロックをデータストリームとして送信するステップは、
FECコードブロックのリソースブロックへの前記マッピングに従って、前記複数のFECコードブロックのそれぞれを複数の物理リソースブロック(PRB)のうちの一意の一つにインターリーブするステップであって、前記複数のFECコードブロックのうちの対応する一つの各ビットは共有PRB内で搬送される、ステップ
を有する、請求項1に記載の方法。 - 装置であって、
プロセッサと、
前記プロセッサによる実行のためのプログラムを格納するコンピュータ可読記憶媒体とを有し、前記プログラムは、
情報ビットのストリームを取得するための命令と、
前記情報ビットのストリームを複数の前方誤り訂正(FEC)コードブロックに符号化するための命令であって、各FECコードブロックは独立して復号可能である、命令と、
前記複数のFECコードブロックを複数のリソースブロックにマッピングするための命令であって、各FECコードブロックは前記複数のリソースブロックのうちの単一のリソースブロックにマッピングされる、命令と、
前記複数のFECコードブロックの前記複数のリソースブロックへの前記マッピングに従って、前記複数のFECコードブロックをデータストリームとして送信するための命令と
を含む、装置。 - 符号化方法であって、
情報ビットのストリームを取得するステップと、
前記情報ビットのストリームを複数の低密度パリティ検査(LDPC)コードブロックに符号化するステップであって、前記複数のLDPCコードブロックのそれぞれは、そのうちの少なくとも25パーセントが内側ピアリングパリティビットである、パリティビットを有する、ステップと、
前記複数のLDPCコードブロックを複数のリソースブロックにマッピングするステップであって、各LDPCコードブロックは前記リソースブロックのうちの単一のリソースブロックにマッピングされる、ステップと、
LDPCコードブロックのリソースブロックへの前記マッピングに従って、前記複数のLDPCコードブロックをデータストリームとして送信するステップと
を有する方法。 - 前記内側ピアリングパリティビットは、対応するLDPCコードブロック内で搬送される情報によって完全に決定される値を有する、請求項13に記載の方法。
- 前記内側ピアリングパリティビットは、その各々が対応するLDPCコードブロック内でのみ延伸するパリティ検査リンクによって決定される値を有する、請求項13に記載の方法。
- 前記複数のLDPCコードブロックを前記複数のリソースブロックにマッピングするステップは、
前記複数のLDPCコードブロックを複数の仮想リソースブロック(VRB)に割り当てるステップであって、前記複数のLDPCコードブロックのそれぞれは前記複数のVRBのうちの一意の一つに割り当てられる、ステップ
を有する、請求項13に記載の方法。 - 前記複数のLDPCコードブロックを前記データストリームとして送信するステップは、
前記複数のLDPCコードブロックのそれぞれを前記データストリームによって搬送される複数の物理リソースブロック(PRB)のうちの一意の一つにインターリーブするステップであって、一定のLDPCコードブロックの各ビットは前記PRBのうちの共通の一つ内で搬送される、ステップ
を有する、請求項13に記載の方法。 - 装置であって、
プロセッサと、
前記プロセッサによる実行のためのプログラムを格納するコンピュータ可読記憶媒体とを有し、前記プログラムは、
情報ビットのストリームを取得するための命令と、
前記情報ビットのストリームを複数の低密度パリティ検査(LDPC)コードブロックに符号化するための命令であって、前記複数のLDPCコードブロックのそれぞれは、そのうちの少なくとも25パーセントが内側ピアリングパリティビットである、パリティビットを有する、命令と、
前記複数のLDPCコードブロックを複数のリソースブロックにマッピングするための命令であって、各LDPCコードブロックは前記リソースブロックのうちの単一のリソースブロックにマッピングされる、命令と、
LDPCコードブロックのリソースブロックへの前記マッピングに従って、前記複数のLDPCコードブロックをデータストリームとして送信するための命令と
を含む装置。 - 前記内側ピアリングパリティビットは、対応するLDPCコードブロック内で搬送される情報によって完全に決定される値を有する、請求項18に記載の装置。
- 前記内側ピアリングパリティビットは、その各々が対応するLDPCコードブロック内でのみ延伸するパリティ検査リンクによって決定される値を有する、請求項18に記載の装置。
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Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN110007296B (zh) * | 2018-01-04 | 2020-10-23 | 中国科学院声学研究所 | 一种基于引导信号修正的时域干扰抵消方法 |
CN112398765B (zh) * | 2019-08-15 | 2021-10-01 | 华为技术有限公司 | 一种信号处理方法、接收机及数字处理芯片 |
Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0799454A (ja) * | 1993-09-28 | 1995-04-11 | Sharp Corp | 回路共用型誤り訂正符号処理回路 |
JP2005073189A (ja) * | 2003-08-28 | 2005-03-17 | Sony Corp | 符号化装置及び符号化方法、復号装置及び復号方法、並びにコンピュータ・プログラム |
JP2006303906A (ja) * | 2005-04-20 | 2006-11-02 | Mitsubishi Electric Corp | 符号化装置、復号化装置及び通信システム |
JP2009542042A (ja) * | 2006-05-12 | 2009-11-26 | ノキア コーポレイション | 固定および可変の構成部分を有する区分されたダウンリンク共有制御チャネルを提供する装置、方法およびコンピュータ・プログラム製品 |
US20110161771A1 (en) * | 2009-12-29 | 2011-06-30 | Industrial Technology Research Institute | Method and apparatus for providing resource unit based data block partition |
JP2011151545A (ja) * | 2010-01-20 | 2011-08-04 | Nec Corp | 通信装置および受信方法、並びにプログラム |
Family Cites Families (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4330767B2 (ja) * | 2000-06-26 | 2009-09-16 | 株式会社エヌ・ティ・ティ・ドコモ | 自動再送要求を行う通信方法及び基地局装置 |
US20030039226A1 (en) * | 2001-08-24 | 2003-02-27 | Kwak Joseph A. | Physical layer automatic repeat request (ARQ) |
US6700867B2 (en) * | 2001-12-20 | 2004-03-02 | Motorola, Inc. | Method and system for reduced memory hybrid automatic repeat request |
JPWO2007080727A1 (ja) | 2005-12-09 | 2009-06-11 | 三菱電機株式会社 | 通信方法および通信装置 |
US20080069074A1 (en) * | 2006-09-18 | 2008-03-20 | Interdigital Technology Corporation | Successive interference cancellation for multi-codeword transmissions |
US7661038B2 (en) * | 2006-10-09 | 2010-02-09 | Intel Corporation | Link adaptation for retransmission error-control technique transmissions |
US7890059B2 (en) * | 2007-05-01 | 2011-02-15 | Broadcom Corporation | Successive interference cancellation in code division multiple access system using variable interferer weights |
KR101505193B1 (ko) * | 2007-06-18 | 2015-03-23 | 삼성전자주식회사 | 직교주파수분할다중접속방식의 이동 통신시스템에서 심볼전송 방법 및 장치 |
JP2011507362A (ja) | 2007-12-14 | 2011-03-03 | パナソニック株式会社 | 無線通信装置およびパンクチャリング方法 |
CN102111240A (zh) * | 2009-12-29 | 2011-06-29 | 财团法人工业技术研究院 | 数据区块分割方法及装置与数据译码方法及装置 |
US8839078B2 (en) | 2010-03-05 | 2014-09-16 | Samsung Electronics Co., Ltd. | Application layer FEC framework for WiGig |
US8924831B2 (en) * | 2011-08-26 | 2014-12-30 | Texas Instruments Incorporated | Systems and methods for network coding using convolutional codes |
-
2013
- 2013-03-06 US US13/787,554 patent/US9246514B2/en not_active Expired - Fee Related
-
2014
- 2014-03-05 BR BR112015021784A patent/BR112015021784A8/pt not_active Application Discontinuation
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Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0799454A (ja) * | 1993-09-28 | 1995-04-11 | Sharp Corp | 回路共用型誤り訂正符号処理回路 |
JP2005073189A (ja) * | 2003-08-28 | 2005-03-17 | Sony Corp | 符号化装置及び符号化方法、復号装置及び復号方法、並びにコンピュータ・プログラム |
JP2006303906A (ja) * | 2005-04-20 | 2006-11-02 | Mitsubishi Electric Corp | 符号化装置、復号化装置及び通信システム |
JP2009542042A (ja) * | 2006-05-12 | 2009-11-26 | ノキア コーポレイション | 固定および可変の構成部分を有する区分されたダウンリンク共有制御チャネルを提供する装置、方法およびコンピュータ・プログラム製品 |
US20110161771A1 (en) * | 2009-12-29 | 2011-06-30 | Industrial Technology Research Institute | Method and apparatus for providing resource unit based data block partition |
JP2011151545A (ja) * | 2010-01-20 | 2011-08-04 | Nec Corp | 通信装置および受信方法、並びにプログラム |
Non-Patent Citations (2)
Title |
---|
SAMANTHA R. SUMMERSON ET AL.: "Covolutional Network Codes for Reliable Point-to-Point Wireless Communication", SIGNALS, SYSTEMS AND COMPUTERS(ASILOMAR), 2012 CONFERENCE RECORD OF THE FORTY SIXTH ASILOMAR CONFERE, JPN6016034784, 7 November 2012 (2012-11-07), pages 1918 - 1921, XP032351208, ISSN: 0003396718, DOI: 10.1109/ACSSC.2012.6489372 * |
YU-CHUAN FANG ET AL.: "E-MBS Resource Partition for the IEEE 802.16m/D3 Amendment(16.9.1)", IEEE C802.16M-09/2971, JPN6016034783, 31 December 2009 (2009-12-31), ISSN: 0003396717 * |
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