JP2015534178A - アドレスマッピング - Google Patents
アドレスマッピング Download PDFInfo
- Publication number
- JP2015534178A JP2015534178A JP2015532071A JP2015532071A JP2015534178A JP 2015534178 A JP2015534178 A JP 2015534178A JP 2015532071 A JP2015532071 A JP 2015532071A JP 2015532071 A JP2015532071 A JP 2015532071A JP 2015534178 A JP2015534178 A JP 2015534178A
- Authority
- JP
- Japan
- Prior art keywords
- mapping
- unit
- memory
- units
- data
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 238000013507 mapping Methods 0.000 title claims abstract description 308
- 230000015654 memory Effects 0.000 claims abstract description 202
- 238000000034 method Methods 0.000 claims abstract description 44
- 230000008859 change Effects 0.000 claims description 4
- 230000004044 response Effects 0.000 claims description 3
- 238000012544 monitoring process Methods 0.000 claims 1
- 238000007726 management method Methods 0.000 description 22
- 230000003321 amplification Effects 0.000 description 9
- 238000003199 nucleic acid amplification method Methods 0.000 description 9
- 230000008901 benefit Effects 0.000 description 6
- 241000053227 Themus Species 0.000 description 5
- 230000001788 irregular Effects 0.000 description 4
- 239000007787 solid Substances 0.000 description 4
- 238000003491 array Methods 0.000 description 3
- 230000008569 process Effects 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- 230000002123 temporal effect Effects 0.000 description 2
- 238000013500 data storage Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000013467 fragmentation Methods 0.000 description 1
- 238000006062 fragmentation reaction Methods 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 230000002085 persistent effect Effects 0.000 description 1
- 230000007480 spreading Effects 0.000 description 1
- 230000003068 static effect Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/0223—User address space allocation, e.g. contiguous or non contiguous base addressing
- G06F12/023—Free address space management
- G06F12/0238—Memory management in non-volatile memory, e.g. resistive RAM or ferroelectric memory
- G06F12/0246—Memory management in non-volatile memory, e.g. resistive RAM or ferroelectric memory in block erasable memory, e.g. flash memory
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/0223—User address space allocation, e.g. contiguous or non contiguous base addressing
- G06F12/0292—User address space allocation, e.g. contiguous or non contiguous base addressing using tables or multilevel address translation means
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/08—Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
- G06F12/10—Address translation
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F2212/00—Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
- G06F2212/72—Details relating to flash memory management
- G06F2212/7201—Logical to physical mapping or translation of blocks or pages
Abstract
Description
本開示は、アドレスマッピングのための方法、メモリユニット、および装置を含む。1つの方法は、いくつかの論理アドレスに対応する論理−物理マッピングデータを有するマッピングユニットを提供することを含む。マッピングユニットは、自身と関連付けられた可変データユニット種類を有し、可変データユニット種類によって定義されたサイズを有するいくつかの物理データユニットのメモリ上の位置を示すマッピングデータを含む第1の部分およびマッピングユニットが属するマッピングユニット群のいくつかの他のマッピングユニットのメモリ上の位置を示すマッピングデータを含む第2の部分を含む。
Claims (40)
- アドレスマッピングのための方法であって、
いくつかの論理アドレスに対応する論理−物理マッピングデータを有するマッピングユニットを提供することを含み、前記マッピングユニットは、自身と関連付けられた可変データユニット種類を有し、
前記可変データユニット種類によって定義されたサイズを有するいくつかの物理データユニットのメモリ上の位置を示すマッピングデータを含む、第1の部分と、
前記マッピングユニットが属するマッピングユニット群のいくつかの他のマッピングユニットの前記メモリ上の位置を示すマッピングデータを含む、第2の部分と、を含む、アドレスマッピングのための方法。 - 前記方法が、前記いくつかの論理アドレスのうちの1つ以上に対応する前記論理−物理マッピングデータの変化に応答して前記マッピングユニットを更新することを含む、請求項1に記載の方法。
- 前記方法が、ホスト入力/出力(I/O)作業負荷を監視することと、前記マッピングユニットと関連付けられた前記可変データユニットサイズを、前記ホストI/O作業負荷に少なくとも部分的に基づいて調節することと、を含む、請求項1に記載の方法。
- 前記マッピングユニットと関連付けられた前記可変データユニットサイズを調節することが、前記第1の部分によってマッピングされる前記いくつかの物理データユニットの量を調節することを含む、請求項3に記載の方法。
- 前記方法が、いくつかのマッピングユニット群を提供することを含み、前記いくつかのマッピングユニット群の各々が、同一の数のマッピングユニットを含む、請求項1に記載の方法。
- 各々のそれぞれのマッピングユニットが同一の数の非重複論理アドレスに対応するように、前記いくつかのマッピングユニット群を提供することを含む、請求項5に記載の方法。
- 前記マッピングユニット群の前記いくつかの他のマッピングユニットの前記メモリ上の位置を示す最新マッピングデータを、
前記マッピングユニット群の前記マッピングユニットのうちの現在最新の1つであって、前記いくつかのマッピングユニットの前記メモリ上の物理的位置を指示する最新インジケータを含む、現在最新の1つを決定することと、
前記メモリに次に書き込まれる、前記マッピングユニット群のマッピングユニットであって、前記いくつかのマッピングユニットの前記メモリ上の物理的位置を指示する無効インジケータを含む、マッピングユニットを決定することと、
次に前記メモリに書き込まれる前記マッピングユニットをメモリに書き込むことに先立って、次に前記メモリに書き込まれる前記マッピングユニットに対応する前記無効インジケータを、前記マッピングユニット群の前記マッピングユニットのうちの前記現在最新の1つに対応する前記最新インジケータと交換することと、
によって維持することを含む、請求項1〜6のいずれか一項に記載の方法。 - 前記マッピングユニット群の前記マッピングユニットのうちの前記現在最新の1つを決定することが、前記マッピングユニット群の前記マッピングユニットのうちのどれが前記メモリに最新に書き込まれたかを決定することを含む、請求項7に記載の方法。
- 前記方法が、前記マッピングユニット群の前記マッピングユニットと関連付けられた前記可変データユニット種類を示す属性データを、前記第2の部分に提供することをさらに含む、請求項1〜6のいずれか一項に記載の方法。
- 前記方法が、
前記可変データユニット種類が、前記第1の部分に対応する前記マッピングデータのために用いられるスペースの量が固定量のスペース未満であるようなものである場合に、前記固定量のスペースの少なくとも一部分を用いて、前記可変データユニット種類によって定義された前記サイズ以外のサイズを有する物理データユニットを指示するインジケータを提供することを含む、請求項1〜6のいずれか一項に記載の方法。 - アドレスマッピングのための方法であって、
いくつかのマッピングユニットをメモリ上に記憶することであって、前記いくつかのマッピングユニットは各々、いくつかの論理アドレスデータに対応する論理−物理マッピングデータおよび自身と関連付けられた可変データユニット種類を含み、前記いくつかのマッピングユニットの各々のそれぞれの1つが、
前記可変データユニット種類によって定義されたサイズを有する物理データユニットの位置を示すマッピングデータを含む、第1の部分と、
前記いくつかのマッピングユニットの前記それぞれの1つが属するマッピングユニット群のいくつかの他のマッピングユニットの前記メモリ上の位置を示すマッピングデータを含む、第2の部分と、を含む、記憶することと、
書き込み指令と関連付けられ、前記いくつかのマッピングユニットのうちの特定の1つに対応する論理アドレスに基づいて、前記メモリ上に記憶された前記いくつかのマッピングユニットのうちの前記特定の1つにアクセスすることと、を含む、アドレスマッピングのための方法。 - 前記方法が、前記いくつかのマッピングユニットのうちの前記特定の1つに対応する現在の可変データユニット種類を決定することを含み、現在の可変データユニット種類が、前記いくつかのマッピングユニットのうちの前記特定の1つによってマッピングされたいくつかの物理データユニットのデータユニットサイズを示す、請求項11に記載の方法。
- 前記方法が、前記更新された特定のマッピングユニットを前記メモリに書き込むことに先立って、前記いくつかのマッピングユニットのうちの前記アクセスされた特定の1つを更新することを含む、請求項12に記載の方法。
- 前記いくつかのマッピングユニットのうちの前記アクセスされた特定の1つを更新することが、
前記マッピングユニットのうちの前記アクセスされた特定の1つが属するマッピングユニット群の最新に更新されたマッピングユニットを決定することと、
前記マッピングユニットのうちの前記アクセスされた特定の1つの前記第2の部分に対応する前記マッピングデータを、前記最新に更新されたマッピングユニットの前記第2の部分に対応する前記マッピングデータと交換し、それにより、前記更新された特定のマッピングユニットが、前記マッピングユニット群の前記最新に更新されたマッピングユニットになるようにすることと、を含む、請求項13に記載の方法。 - ホストの入/出力(I/O)作業負荷に基づいて、前記いくつかのマッピングユニットのうちの少なくとも1つの現在の可変データユニット種類を調節することを含む、請求項11〜13のいずれか一項に記載の方法。
- 前記方法が、前記書き込み指令をホストから受信することを含む、請求項11〜13のいずれか一項に記載の方法。
- 各々のマッピングユニットの前記第1の部分が、固定量のスペースを含み、前記可変データユニット種類によって定義された前記サイズ以外のサイズを有する物理データユニットの位置を示すために、前記固定量のスペースの少なくとも一部分を割り当てることを含む、請求項11〜13のいずれか一項に記載の方法。
- 前記可変データユニット種類によって定義された前記サイズ以外のサイズを有する物理データユニットの位置を示すために、前記固定量のスペースの前記少なくとも一部分を、前記可変データユニット種類に基づいて割り当てることをさらに含む、請求項11〜13のいずれか一項に記載の方法。
- 前記第2の部分が、各々が前記マッピングユニット群の前記いくつかのマッピングユニットのそれぞれ1つに対応するいくつかのエントリを有するマッピングテーブルを含み、前記いくつかのエントリのうちの少なくとも1つが、マッピングユニットの前記メモリ上の位置を指示するよりもむしろ、前記メモリ上の物理データユニットを直接指示するインジケータを提供する、請求項11〜13のいずれか一項に記載の方法。
- 装置であって、
各々が、自身と関連付けられたいくつかの可変データユニット種類のうちの1つの可変データユニット種類を有する、いくつかのマッピングユニットを記憶する、メモリであって、前記可変データユニット種類が、前記それぞれのマッピングユニットによってマッピングされたデータユニットサイズを定義する、メモリと、
前記メモリに連結され、
ホストから受信された書き込み指令と関連付けられた論理アドレスに基づいて特定のマッピングユニットにアクセスすることと、
前記特定のマッピングユニットの一部分を更新することであって、前記一部分が、前記特定のマッピングユニットの前記可変データユニット種類によって定義されたサイズを有する物理データユニットの位置を示すマッピングデータを含む、更新することと、を行うように構成される、コントローラと、を備える、装置。 - 前記特定のマッピングユニットが、前記特定のマッピングユニットが属するマッピングユニット群のいくつかのマッピングユニットの各々の前記メモリ上の位置を示すマッピングデータを含む、別の部分を含む、請求項20に記載の装置。
- 前記別の部分の前記マッピングデータが、マッピングユニットテーブルを含み、前記コントローラが、前記マッピングユニットテーブルを前記マッピングユニット群の別のマッピングユニットの現在最新のマッピングユニットテーブルと交換することによって、前記マッピングユニットテーブルを更新するように構成される、請求項21に記載の装置。
- 前記コントローラが、
前記マッピングユニットテーブルを前記別のマッピングユニットの前記現在最新のマッピングユニットテーブルと交換した後で、前記特定のマッピングユニットをメモリに書き込むことと、
次いで、前記特定のマッピングユニットの前記交換されたマッピングユニットテーブルにアクセスすることによって、前記マッピングユニット群の異なるマッピングユニットの前記メモリ上の位置を決定することと、を行うように構成される、請求項22に記載の装置。 - 前記いくつかのマッピングユニットが、いくつかのマッピングユニット群中に編成され、
前記いくつかのマッピングユニットの各々が、同一の量のデータをマッピングし、
特定のマッピングユニット群内の前記マッピングユニットの各々が、同一の量のデータをマッピングし、
前記いくつかのマッピングユニットの各々が、固定量の利用可能データスペースを有し、前記固定量の使用可能データスペースが、それぞれのマッピングユニットが属する前記マッピングユニット群の前記マッピングユニットの各々の前記物理的位置を示すマッピングユニットテーブルを含む、一部分を含む、請求項20〜23のいずれか一項に記載の装置。 - 前記いくつかのマッピングユニットのうちの少なくとも1つが、直接データユニット(DDU)マッピングユニットである、請求項20〜23のいずれか一項に記載の装置。
- 前記いくつかのマッピングユニットが、いくつかのマッピングユニット群中に編成され、
前記マッピングユニット群のうちの少なくとも1つが、全ての直接データユニット(DDU)マッピングユニットを含み、
前記マッピングユニット群のうちの前記少なくとも1つのマッピングユニットの少なくとも一部分が、前記マッピングユニット群のうちの前記少なくとも1つによってマッピングされた前記論理スペースに対する上書きと関連付けられたマッピング更新を維持するために用いられる、請求項20〜23のいずれか一項に記載の装置。 - 前記いくつかのマッピングユニットのうちの少なくとも1つが、パケット直接データユニットであって、前記パケット直接データユニットに対応する物理データユニットがマッピングされる、媒体の特定の種類を示す媒体種類情報を含む管理情報を含む、パケット直接データユニットである、請求項20〜23のいずれか一項に記載の装置。
- 前記コントローラが、前記メモリの媒体種類とは異なる種類を有する媒体上に記憶される少なくとも1つのマッピングユニットにアクセスするように構成される、請求項20〜23のいずれか一項に記載の装置。
- 装置であって、
各々が関連付けられた可変データユニット種類を有する、いくつかのマッピングユニットを記憶する、メモリと、
メモリユニット管理構成要素であって、
ホストの入/出力(I/O)作業負荷を監視することと、
前記ホストの前記I/O作業負荷に基づいて、前記いくつかのマッピングユニットのうちの少なくとも1つの前記可変データユニット種類を調節すべきかどうかを決定することと、を行うように構成される、メモリユニット管理構成要素と、を備える、装置。 - 前記いくつかのマッピングユニットの各々が、
前記可変データユニット種類によって定義されたサイズを有する物理データユニットの位置を示すマッピングデータを含む、第1の部分と、
前記いくつかのマッピングユニットの前記それぞれ1つが属するマッピングユニット群のいくつかの他のマッピングユニットの前記メモリ上の位置を示すマッピングデータを含む、第2の部分と、を含む、請求項29に記載の装置。 - ホストの入/出力(I/O)作業負荷を監視するように構成されるメモリユニット管理構成要素が、前記いくつかのマッピングユニットの各々によってマッピングされた前記論理アドレスに対応する書き込み指令のサイズを追跡するように構成される、メモリユニット管理構成要素を含む、請求項29に記載の装置。
- 前記ホストの前記I/O作業負荷に基づいて、前記いくつかのマッピングユニットのうちの少なくとも1つの前記可変データユニット種類を調節すべきかどうかを決定するように構成される、メモリユニット管理構成要素が、前記可変データユニット種類によって定義されたデータユニットサイズが減少するように、前記可変データユニット種類を調節すべきかどうかを決定するように構成されるメモリユニット管理構成要素を含む、請求項29に記載の装置。
- 前記ホストの前記I/O作業負荷に基づいて、前記いくつかのマッピングユニットのうちの少なくとも1つの前記可変データユニット種類を調節すべきかどうかを決定するように構成される、メモリユニット管理構成要素が、前記可変データユニット種類によって定義されたデータユニットサイズが増加するように、前記可変データユニット種類を調節すべきかどうかを決定するように構成されるメモリユニット管理構成要素を含む、請求項29に記載の装置。
- 前記コントローラが、
前記いくつかのメモリユニットのうちの特定の1つを前記メモリから回収することと、
前記特定のメモリユニットのデータユニットマッピングテーブルを更新することと、
前記特定のメモリユニットを前記メモリに書き戻すことに先立って、前記特定のメモリユニットのメモリユニットマッピングテーブルを更新することと、を行うように構成される、請求項29に記載の装置。 - 前記データユニットマッピングテーブルが、前記可変データユニット種類によって定義されたサイズを有する物理データユニットの前記メモリ上の位置に対する、ポインタを含み、前記メモリユニットマッピングテーブルが、前記特定のメモリユニットが属するメモリユニット群の前記メモリユニットの各々の前記可変データユニット種類を示す、請求項34に記載の装置。
- 前記メモリユニット管理構成要素が、前記メモリを含むメモリシステム上に置かれる、請求項29〜35のいずれか一項に記載の装置。
- 前記メモリユニット管理構成要素が、前記メモリに連結されたコントローラ上に置かれる、請求項29〜35のいずれか一項に記載の装置。
- 自身と関連付けられた可変データユニット種類を有し、固定量の利用可能記憶スペースを含む、マッピングユニットであって、前記固定量の利用可能記憶スペースが、
いくつかの論理アドレスと関連付けられたいくつかの物理データユニットに対応する、マッピングデータを含む、第1の部分であって、前記マッピングデータが対応する前記いくつかの物理データユニットが、前記可変データユニット種類によって定義されたデータユニットサイズに依存する、第1の部分と、
前記マッピングユニットおよび、前記マッピングユニットが属するマッピングユニット群のいくつかの他のマッピングユニットの各々に対応する、マッピングデータを含む、第2の部分と、を含み、前記マッピングデータが、
前記マッピングユニットと、前記マッピングユニット群の前記いくつかの他のマッピングユニットの各々との前記メモリ上の位置に対応するアドレスと、
前記マッピングユニットと、前記マッピングユニット群の前記他のマッピングユニットの各々との前記可変データユニット種類を示す属性データと、を含む、マッピングユニット。 - 前記可変データユニット種類が調節可能であり、ホストの入/出力(I/O)作業負荷に基づいて調節されるように構成される、請求項38に記載のマッピングユニット。
- 前記第1の部分および前記第2の部分のために用いられる前記固定量の利用可能記憶スペースの量が、調節可能であり、
前記マッピングユニットと関連付けられたベースデータユニットサイズと、
前記いくつかの論理アドレスと関連付けられた前記いくつかの物理データユニットと、
前記マッピングユニットによってマッピングされたデータの総量と、
に基づいて調節されるように構成される、請求項38〜39のいずれか一項に記載のマッピングユニット。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US13/616,175 US10282286B2 (en) | 2012-09-14 | 2012-09-14 | Address mapping using a data unit type that is variable |
US13/616,175 | 2012-09-14 | ||
PCT/US2013/059645 WO2014043459A1 (en) | 2012-09-14 | 2013-09-13 | Address mapping |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2015534178A true JP2015534178A (ja) | 2015-11-26 |
JP6109316B2 JP6109316B2 (ja) | 2017-04-05 |
Family
ID=50275726
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2015532071A Active JP6109316B2 (ja) | 2012-09-14 | 2013-09-13 | アドレスマッピング |
Country Status (6)
Country | Link |
---|---|
US (1) | US10282286B2 (ja) |
EP (1) | EP2895958B1 (ja) |
JP (1) | JP6109316B2 (ja) |
KR (1) | KR101852668B1 (ja) |
CN (1) | CN104641356B (ja) |
WO (1) | WO2014043459A1 (ja) |
Families Citing this family (21)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US9417803B2 (en) | 2011-09-20 | 2016-08-16 | Apple Inc. | Adaptive mapping of logical addresses to memory devices in solid state drives |
KR101979735B1 (ko) * | 2012-11-02 | 2019-05-17 | 삼성전자 주식회사 | 비휘발성 메모리 시스템 및 이와 통신하는 호스트 |
KR20160070920A (ko) * | 2014-12-10 | 2016-06-21 | 에스케이하이닉스 주식회사 | 맵 테이블을 갖는 컨트롤러 및 반도체 메모리 장치를 포함하는 메모리 시스템 및 그것의 동작 방법 |
TWI575374B (zh) * | 2015-08-04 | 2017-03-21 | 群聯電子股份有限公司 | 映射表格更新方法、記憶體儲存裝置及記憶體控制電路單元 |
US10095413B2 (en) * | 2016-01-28 | 2018-10-09 | Toshiba Memory Corporation | Memory system with address translation between a logical address and a physical address |
KR102532581B1 (ko) * | 2016-03-17 | 2023-05-17 | 에스케이하이닉스 주식회사 | 메모리 장치를 포함하는 메모리 시스템 및 그의 동작 방법 |
US20170315924A1 (en) * | 2016-04-29 | 2017-11-02 | Netapp, Inc. | Dynamically Sizing a Hierarchical Tree Based on Activity |
KR20180019419A (ko) | 2016-08-16 | 2018-02-26 | 삼성전자주식회사 | 메모리 컨트롤러, 메모리 시스템 및 그 동작방법 |
US10459644B2 (en) | 2016-10-28 | 2019-10-29 | Western Digital Techologies, Inc. | Non-volatile storage system with integrated compute engine and optimized use of local fast memory |
US10565123B2 (en) | 2017-04-10 | 2020-02-18 | Western Digital Technologies, Inc. | Hybrid logical to physical address translation for non-volatile storage devices with integrated compute module |
KR20180121733A (ko) * | 2017-04-28 | 2018-11-08 | 에스케이하이닉스 주식회사 | 데이터 저장 장치 및 그것의 동작 방법 |
US10534718B2 (en) | 2017-07-31 | 2020-01-14 | Micron Technology, Inc. | Variable-size table for address translation |
JP2019056981A (ja) | 2017-09-19 | 2019-04-11 | 東芝メモリ株式会社 | メモリシステム |
US10877898B2 (en) * | 2017-11-16 | 2020-12-29 | Alibaba Group Holding Limited | Method and system for enhancing flash translation layer mapping flexibility for performance and lifespan improvements |
US10970205B2 (en) * | 2018-05-31 | 2021-04-06 | Micron Technology, Inc. | Logical-to-physical data structures for tracking logical block addresses indicative of a collision |
US10795576B2 (en) * | 2018-11-01 | 2020-10-06 | Micron Technology, Inc. | Data relocation in memory |
US10901912B2 (en) * | 2019-01-28 | 2021-01-26 | Western Digital Technologies, Inc. | Flash translation layer table for unaligned host writes |
CN110532201B (zh) * | 2019-08-23 | 2021-08-31 | 北京浪潮数据技术有限公司 | 一种元数据处理方法及装置 |
US11556481B2 (en) * | 2019-08-29 | 2023-01-17 | Micron Technology, Inc. | Increased efficiency obfuscated logical-to-physical map management |
US11429531B2 (en) * | 2020-02-03 | 2022-08-30 | EMC IP Holding Company LLC | Changing page size in an address-based data storage system |
US20230409470A1 (en) * | 2022-06-15 | 2023-12-21 | Western Digital Technologies, Inc. | Scratchpad cache for gaming and iot hosts |
Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09282111A (ja) * | 1996-04-15 | 1997-10-31 | Internatl Business Mach Corp <Ibm> | 半導体メモリ装置及びその制御方法 |
JP2004199605A (ja) * | 2002-12-20 | 2004-07-15 | Matsushita Electric Ind Co Ltd | 半導体メモリカードおよび管理情報更新方法 |
US7278008B1 (en) * | 2004-01-30 | 2007-10-02 | Nvidia Corporation | Virtual address translation system with caching of variable-range translation clusters |
JP2010521718A (ja) * | 2007-12-28 | 2010-06-24 | 株式会社東芝 | 半導体記憶装置及びその制御方法、コントローラ、情報処理装置 |
JP2012141944A (ja) * | 2010-12-16 | 2012-07-26 | Toshiba Corp | メモリシステム |
JP2012174086A (ja) * | 2011-02-23 | 2012-09-10 | Hitachi Ltd | 記憶装置およびそれを搭載した計算機 |
Family Cites Families (30)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US537521A (en) | 1895-04-16 | Circular sawing machine | ||
EP0508577A1 (en) | 1991-03-13 | 1992-10-14 | International Business Machines Corporation | Address translation mechanism |
US6625081B2 (en) | 2001-08-13 | 2003-09-23 | Micron Technology, Inc. | Synchronous flash memory with virtual segment architecture |
US6906961B2 (en) | 2003-06-24 | 2005-06-14 | Micron Technology, Inc. | Erase block data splitting |
US7206915B2 (en) | 2004-06-03 | 2007-04-17 | Emc Corp | Virtual space manager for computer having a physical address extension feature |
US20060004941A1 (en) | 2004-06-30 | 2006-01-05 | Shah Hemal V | Method, system, and program for accessesing a virtualized data structure table in cache |
US20060184719A1 (en) * | 2005-02-16 | 2006-08-17 | Sinclair Alan W | Direct data file storage implementation techniques in flash memories |
KR100706242B1 (ko) | 2005-02-07 | 2007-04-11 | 삼성전자주식회사 | 메모리 시스템 및 그것의 런 단위 어드레스 매핑 테이블 구성 방법 |
US7409489B2 (en) * | 2005-08-03 | 2008-08-05 | Sandisk Corporation | Scheduling of reclaim operations in non-volatile memory |
KR100764750B1 (ko) | 2006-10-16 | 2007-10-08 | 삼성전자주식회사 | 유연한 어드레스 맵핑 스킴을 갖는 플래시 메모리 장치 |
TW200832440A (en) * | 2007-01-25 | 2008-08-01 | Genesys Logic Inc | Flash memory translation layer system |
US9396103B2 (en) * | 2007-06-08 | 2016-07-19 | Sandisk Technologies Llc | Method and system for storage address re-mapping for a memory device |
US7934072B2 (en) | 2007-09-28 | 2011-04-26 | Lenovo (Singapore) Pte. Ltd. | Solid state storage reclamation apparatus and method |
CN101241472B (zh) * | 2008-03-07 | 2010-12-22 | 威盛电子股份有限公司 | 映射管理方法及系统 |
US8321652B2 (en) | 2008-08-01 | 2012-11-27 | Infineon Technologies Ag | Process and method for logical-to-physical address mapping using a volatile memory device in solid state disks |
KR101618634B1 (ko) * | 2009-01-07 | 2016-05-09 | 삼성전자주식회사 | 비휘발성 메모리와, 이의 페이지 동적할당장치 및 페이지 매핑장치와, 이의 페이지 동적할당방법 및 페이지 매핑방법 |
US8255661B2 (en) * | 2009-11-13 | 2012-08-28 | Western Digital Technologies, Inc. | Data storage system comprising a mapping bridge for aligning host block size with physical block size of a data storage device |
EP2518913B1 (en) * | 2009-12-24 | 2013-12-11 | Huawei Technologies Co., Ltd. | Generic mapping procedure (gmp) mapping method, gmp de-mapping method and devices therefor |
GB2478727B (en) * | 2010-03-15 | 2013-07-17 | Advanced Risc Mach Ltd | Translation table control |
US20110283048A1 (en) * | 2010-05-11 | 2011-11-17 | Seagate Technology Llc | Structured mapping system for a memory device |
US8341340B2 (en) * | 2010-07-21 | 2012-12-25 | Seagate Technology Llc | Multi-tier address mapping in flash memory |
US20120023144A1 (en) | 2010-07-21 | 2012-01-26 | Seagate Technology Llc | Managing Wear in Flash Memory |
CN101930404B (zh) * | 2010-08-27 | 2012-11-21 | 威盛电子股份有限公司 | 存储装置及其操作方法 |
US8417914B2 (en) * | 2011-01-06 | 2013-04-09 | Micron Technology, Inc. | Memory address translation |
WO2012161659A1 (en) * | 2011-05-24 | 2012-11-29 | Agency For Science, Technology And Research | A memory storage device, and a related zone-based block management and mapping method |
US8694754B2 (en) * | 2011-09-09 | 2014-04-08 | Ocz Technology Group, Inc. | Non-volatile memory-based mass storage devices and methods for writing data thereto |
KR101289931B1 (ko) * | 2011-09-23 | 2013-07-25 | 한양대학교 산학협력단 | 다양한 블록 크기를 지원하는 주소 사상을 사용하여 플래시 메모리 내에 데이터를 저장하는 방법 및 장치 |
US20130103889A1 (en) * | 2011-10-25 | 2013-04-25 | Ocz Technology Group Inc. | Page-buffer management of non-volatile memory-based mass storage devices |
US9069657B2 (en) * | 2011-12-12 | 2015-06-30 | Apple Inc. | LBA bitmap usage |
US9213633B2 (en) * | 2013-04-30 | 2015-12-15 | Seagate Technology Llc | Flash translation layer with lower write amplification |
-
2012
- 2012-09-14 US US13/616,175 patent/US10282286B2/en active Active
-
2013
- 2013-09-13 KR KR1020157009168A patent/KR101852668B1/ko active IP Right Grant
- 2013-09-13 CN CN201380048147.1A patent/CN104641356B/zh active Active
- 2013-09-13 EP EP13836722.2A patent/EP2895958B1/en active Active
- 2013-09-13 JP JP2015532071A patent/JP6109316B2/ja active Active
- 2013-09-13 WO PCT/US2013/059645 patent/WO2014043459A1/en unknown
Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09282111A (ja) * | 1996-04-15 | 1997-10-31 | Internatl Business Mach Corp <Ibm> | 半導体メモリ装置及びその制御方法 |
JP2004199605A (ja) * | 2002-12-20 | 2004-07-15 | Matsushita Electric Ind Co Ltd | 半導体メモリカードおよび管理情報更新方法 |
US7278008B1 (en) * | 2004-01-30 | 2007-10-02 | Nvidia Corporation | Virtual address translation system with caching of variable-range translation clusters |
JP2010521718A (ja) * | 2007-12-28 | 2010-06-24 | 株式会社東芝 | 半導体記憶装置及びその制御方法、コントローラ、情報処理装置 |
JP2012141944A (ja) * | 2010-12-16 | 2012-07-26 | Toshiba Corp | メモリシステム |
JP2012174086A (ja) * | 2011-02-23 | 2012-09-10 | Hitachi Ltd | 記憶装置およびそれを搭載した計算機 |
Also Published As
Publication number | Publication date |
---|---|
CN104641356B (zh) | 2018-07-13 |
CN104641356A (zh) | 2015-05-20 |
EP2895958A4 (en) | 2016-04-06 |
KR101852668B1 (ko) | 2018-06-04 |
WO2014043459A1 (en) | 2014-03-20 |
US10282286B2 (en) | 2019-05-07 |
EP2895958B1 (en) | 2019-12-25 |
US20140082323A1 (en) | 2014-03-20 |
EP2895958A1 (en) | 2015-07-22 |
JP6109316B2 (ja) | 2017-04-05 |
KR20150054964A (ko) | 2015-05-20 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP6109316B2 (ja) | アドレスマッピング | |
US10649657B2 (en) | Log-based storage for different data types in non-volatile memory | |
US11593259B2 (en) | Directed sanitization of memory | |
US10761777B2 (en) | Tiered storage using storage class memory | |
US9880766B2 (en) | Storage medium storing control program, method of controlling information processing device, information processing system, and information processing device | |
US10739996B1 (en) | Enhanced garbage collection | |
CN111033477B (zh) | 逻辑到物理映射 | |
JP5458419B2 (ja) | メモリブロックの選択 | |
JP2019020788A (ja) | メモリシステムおよび制御方法 | |
US20150186259A1 (en) | Method and apparatus for storing data in non-volatile memory | |
TW201626382A (zh) | 用於快取壓縮資料之設備、系統及方法 | |
JP2014505297A (ja) | メモリアドレス変換 | |
JP2018101411A (ja) | データストレージデバイスおよびその操作方法 | |
US10592427B2 (en) | Logical to physical table fragments | |
CN111512290A (zh) | 文件页表管理技术 | |
TWI718710B (zh) | 資料儲存裝置以及非揮發式記憶體控制方法 | |
CN112130749A (zh) | 数据储存装置以及非挥发式存储器控制方法 | |
KR20220119348A (ko) | 분할된 저장장치에서의 스냅샷 관리 | |
WO2014149859A1 (en) | Data tag sharing from host to storage systems | |
TWI713032B (zh) | 資料儲存裝置以及非揮發式記憶體控制方法 | |
Ko et al. | Study on garbage collection schemes for flash-based linux swap system | |
US20230236737A1 (en) | Storage Controller Managing Different Types Of Blocks, Operating Method Thereof, And Operating Method Of Storage Device Including The Same | |
TWI724550B (zh) | 資料儲存裝置以及非揮發式記憶體控制方法 | |
Vishwakarma et al. | Enhancing eMMC using multi-stream technique |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20160523 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20160607 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20160905 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20161129 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20161228 |
|
A911 | Transfer to examiner for re-examination before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20170113 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20170207 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20170307 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 6109316 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |