JP2015200690A - Micro lens substrate, and electro-optic device - Google Patents

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昇平 山路
Shohei Yamaji
昇平 山路
博一 鮎川
Hirokazu Ayukawa
博一 鮎川
二村 徹
Toru Futamura
徹 二村
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Abstract

PROBLEM TO BE SOLVED: To provide a micro lens substrate which can improve light collection efficiency, and an electro-optic device.SOLUTION: A micro lens substrate comprises a first translucent layer 51a formed along a curved face of a micro lens, and a second translucent layer 51b that covers the first translucent layer 51a and has a refractive index different from that of the first translucent layer 51a.

Description

本発明は、マイクロレンズ基板、及び電気光学装置に関する。   The present invention relates to a microlens substrate and an electro-optical device.

上記電気光学装置として、例えば、画素電極をスイッチング制御する素子としてトランジスターを画素ごとに備えたアクティブ駆動方式の液晶装置が知られている。液晶装置は、例えば、直視型ディスプレイやライトバルブなどにおいて用いられる。   As the electro-optical device, for example, an active drive type liquid crystal device including a transistor for each pixel as an element for controlling switching of a pixel electrode is known. The liquid crystal device is used in, for example, a direct view display or a light valve.

このような液晶装置は、例えば、特許文献1に記載のように、光の利用効率を高めるため、液晶装置の各画素に対応する位置に微小なマイクロレンズを設けたマイクロレンズ基板を有する。   For example, as described in Patent Document 1, such a liquid crystal device includes a microlens substrate provided with a microlens at a position corresponding to each pixel of the liquid crystal device in order to increase the light use efficiency.

マイクロレンズ基板の製造方法は、例えば、基材上にレジスト材料(樹脂材料)を塗布し、樹脂材料をパターニングした後、高温ベークによるリフローを行うことにより凸状の曲面を有したレジストパターンを形成する。その後、このレジストパターンをマスクとして基板及びレジストパターンをエッチングすることにより、マイクロレンズの形状を基材に転写したマイクロレンズ基板を形成することができる。   For example, a microlens substrate is manufactured by applying a resist material (resin material) on a base material, patterning the resin material, and then performing reflow by high-temperature baking to form a resist pattern having a convex curved surface. To do. Thereafter, by etching the substrate and the resist pattern using the resist pattern as a mask, a microlens substrate in which the shape of the microlens is transferred to the base material can be formed.

特開平10−206605号公報Japanese Patent Laid-Open No. 10-206605

しかしながら、マイクロレンズの製造過程で、隣り合うマイクロレンズ間にマイクロレンズとして機能しない隙間が生じる場合がある。これにより、マイクロレンズによる集光効率が低下するという課題がある。   However, there may be a gap that does not function as a microlens between adjacent microlenses during the manufacturing process of the microlens. Thereby, there exists a subject that the condensing efficiency by a microlens falls.

本発明の態様は、上記課題の少なくとも一部を解決するためになされたものであり、以下の形態又は適用例として実現することが可能である。   An aspect of the present invention has been made to solve at least a part of the above problems, and can be realized as the following forms or application examples.

[適用例1]本適用例に係るマイクロレンズ基板は、レンズの曲面に沿って形成された第1透光性層と、前記第1透光性層を覆い、前記第1透光性層とは異なる屈折率を有する第2透光性層と、を備えたことを特徴とする。   Application Example 1 A microlens substrate according to this application example includes a first light-transmitting layer formed along a curved surface of a lens, the first light-transmitting layer, the first light-transmitting layer, And a second translucent layer having a different refractive index.

本適用例によれば、第1透光性層を覆うように屈折率の異なる第2透光性層を配置してレンズの曲面を構成するので、第1透光性層では未完成のレンズの形状を、第2透光性層で補うことが可能となる。よって、正規のレンズの曲面に近いマイクロレンズを提供することができる。更に、第1透光性層と第2透光性層との屈折率を異ならせるので、マイクロレンズによる集光効率を高めることができる。   According to this application example, the second light-transmitting layer having a different refractive index is arranged to cover the first light-transmitting layer to form the curved surface of the lens, and thus the lens that is not completed in the first light-transmitting layer. This shape can be supplemented by the second translucent layer. Therefore, a microlens close to the curved surface of a regular lens can be provided. Furthermore, since the refractive indexes of the first light transmissive layer and the second light transmissive layer are made different from each other, the light collection efficiency by the microlens can be increased.

[適用例2]上記適用例に係るマイクロレンズ基板において、前記第1透光性層の上に配置された前記第2透光性層を含むマイクロレンズは、凸型のマイクロレンズであることが好ましい。   Application Example 2 In the microlens substrate according to the application example, the microlens including the second light-transmitting layer disposed on the first light-transmitting layer may be a convex microlens. preferable.

本適用例によれば、第1透光性層を覆うように第2透光性層を配置するので、隣り合う凸型のマイクロレンズの間の隙間をなくし、正規のレンズの曲面に近いマイクロレンズを提供することができる。   According to this application example, since the second light-transmitting layer is disposed so as to cover the first light-transmitting layer, the gap between adjacent convex microlenses is eliminated, and the microscopic surface close to the curved surface of the regular lens is obtained. A lens can be provided.

[適用例3]上記適用例に係るマイクロレンズ基板において、前記第1透光性層の屈折率は、前記第2透光性層の屈折率より大きいことが好ましい。   Application Example 3 In the microlens substrate according to the application example described above, it is preferable that the refractive index of the first light transmissive layer is larger than the refractive index of the second light transmissive layer.

本適用例によれば、第1透光性層を覆う第2透光性層の屈折率の方が小さいので、凸型のマイクロレンズにおいて、光を集光させることができる。   According to this application example, since the refractive index of the second light-transmitting layer covering the first light-transmitting layer is smaller, light can be condensed in the convex microlens.

[適用例4]上記適用例に係るマイクロレンズ基板において、前記第1透光性層及び前記第2透光性層を含む前記凸型のマイクロレンズと、凹型のマイクロレンズとが対向するように配置されていることが好ましい。   Application Example 4 In the microlens substrate according to the application example, the convex microlens including the first light-transmitting layer and the second light-transmitting layer are opposed to the concave microlens. It is preferable that they are arranged.

本適用例によれば、凸型のマイクロレンズと凹型のマイクロレンズとが一対になるように配置されたダブルマイクロレンズ構造になっているので、より光を集光させやすくすることができる。   According to this application example, since the double microlens structure in which the convex microlens and the concave microlens are arranged in a pair is provided, the light can be more easily collected.

[適用例5]本適用例に係る電気光学装置は、上記に記載のマイクロレンズ基板を備えることを特徴とする。   Application Example 5 An electro-optical device according to this application example includes the microlens substrate described above.

本適用例によれば、上記マイクロレンズ基板を備えるので、集光効率を高めることが可能な電気光学装置を提供することができる。   According to this application example, since the microlens substrate is provided, it is possible to provide an electro-optical device capable of increasing the light collection efficiency.

液晶装置の構成を示す概略斜視図。FIG. 2 is a schematic perspective view illustrating a configuration of a liquid crystal device. 液晶装置のうちマイクロレンズ基板の構成を示す概略斜視図。The schematic perspective view which shows the structure of a microlens board | substrate among liquid crystal devices. 液晶パネルの構成を示す模式平面図。The schematic plan view which shows the structure of a liquid crystal panel. 図3に示す液晶パネルのH−H’線に沿う模式断面図。FIG. 4 is a schematic cross-sectional view taken along the line H-H ′ of the liquid crystal panel shown in FIG. 3. 液晶パネルの電気的な構成を示す等価回路図。FIG. 3 is an equivalent circuit diagram illustrating an electrical configuration of the liquid crystal panel. 液晶パネルのうち主に画素の構造を示す模式断面図。FIG. 2 is a schematic cross-sectional view mainly showing a pixel structure in a liquid crystal panel. マイクロレンズ基板を備える液晶装置の構造を示す模式断面図。FIG. 3 is a schematic cross-sectional view illustrating a structure of a liquid crystal device including a microlens substrate. 液晶装置の製造方法を工程順に示すフローチャート。5 is a flowchart showing a method for manufacturing a liquid crystal device in the order of steps. 液晶装置のうちマイクロレンズ基板の製造方法を工程順に示す模式断面図。The schematic cross section which shows the manufacturing method of a microlens board | substrate among liquid crystal devices in order of a process. 液晶装置のうちマイクロレンズ基板の製造方法を工程順に示す模式断面図。The schematic cross section which shows the manufacturing method of a microlens board | substrate among liquid crystal devices in order of a process. 液晶装置のうちマイクロレンズ基板の製造方法を工程順に示す模式断面図。The schematic cross section which shows the manufacturing method of a microlens board | substrate among liquid crystal devices in order of a process. 投射型表示装置の構成を示す概略図。Schematic which shows the structure of a projection type display apparatus. 変形例のマイクロレンズ基板を備えた液晶装置の構成を示す模式断面図。FIG. 6 is a schematic cross-sectional view illustrating a configuration of a liquid crystal device including a microlens substrate according to a modification.

以下、本発明を具体化した実施形態について図面に従って説明する。なお、使用する図面は、説明する部分が認識可能な状態となるように、適宜拡大または縮小して表示している。   DESCRIPTION OF EXEMPLARY EMBODIMENTS Hereinafter, embodiments of the invention will be described with reference to the drawings. Note that the drawings to be used are appropriately enlarged or reduced so that the part to be described can be recognized.

なお、以下の形態において、例えば「基板上に」と記載された場合、基板の上に接するように配置される場合、または基板の上に他の構成物を介して配置される場合、または基板の上に一部が接するように配置され、一部が他の構成物を介して配置される場合を表すものとする。   In the following embodiments, for example, when “on the substrate” is described, the substrate is disposed so as to be in contact with the substrate, or is disposed on the substrate via another component, or the substrate. It is assumed that a part is arranged so as to be in contact with each other and a part is arranged via another component.

本実施形態では、電気光学装置の一例として、薄膜トランジスター(TFT:Thin Film Transistor)を画素のスイッチング素子として備えたアクティブマトリックス型の液晶装置を例に挙げて説明する。この液晶装置は、例えば、投射型表示装置(液晶プロジェクター)の光変調素子(液晶ライトバルブ)として好適に用いることができるものである。   In this embodiment, as an example of an electro-optical device, an active matrix liquid crystal device including a thin film transistor (TFT) as a pixel switching element will be described as an example. This liquid crystal device can be suitably used, for example, as a light modulation element (liquid crystal light valve) of a projection display device (liquid crystal projector).

<電気光学装置としての液晶装置、及びマイクロレンズ基板の構成>
図1は、液晶装置の構成を示す概略斜視図である。図2は、液晶装置のうちマイクロレンズ基板の構成を示す概略斜視図である。以下、液晶装置、及びマイクロレンズ基板の構成を、図1及び図2を参照しながら説明する。
<Configuration of liquid crystal device as electro-optical device and microlens substrate>
FIG. 1 is a schematic perspective view showing the configuration of the liquid crystal device. FIG. 2 is a schematic perspective view showing a configuration of a microlens substrate in the liquid crystal device. Hereinafter, configurations of the liquid crystal device and the microlens substrate will be described with reference to FIGS. 1 and 2.

図1に示すように、本実施形態の液晶装置1は、液晶パネル100と、マイクロレンズ基板50と、を備えている。液晶パネル100は、素子基板10と、素子基板10の光入射側に配置された、マイクロレンズ基板50の一部を含む対向基板20を備えている。   As shown in FIG. 1, the liquid crystal device 1 of this embodiment includes a liquid crystal panel 100 and a microlens substrate 50. The liquid crystal panel 100 includes an element substrate 10 and a counter substrate 20 including a part of the microlens substrate 50 disposed on the light incident side of the element substrate 10.

図2に示すように、マイクロレンズ基板50は、光の入射側に配置される入射側レンズ層41と、光の出射側に配置される出射側レンズ層42と、入射側レンズ層41と出射側レンズ層42との間に配置されたパス層43と、入射側レンズ層41とパス層43との間に配置された第1マイクロレンズ44と、パス層43と出射側レンズ層42との間に配置された第2マイクロレンズ51と、を備えている。   As shown in FIG. 2, the microlens substrate 50 includes an incident side lens layer 41 disposed on the light incident side, an exit side lens layer 42 disposed on the light exit side, and the incident side lens layer 41 and the exit. A path layer 43 disposed between the side lens layer 42, a first microlens 44 disposed between the incident side lens layer 41 and the path layer 43, and the path layer 43 and the exit side lens layer 42. And a second microlens 51 disposed therebetween.

第2マイクロレンズ51は、第1透光性層51aと、第1透光性層51aと出射側レンズ層42との間に配置された第2透光性層51bと、によって構成されている。   The second microlens 51 includes a first light transmissive layer 51 a and a second light transmissive layer 51 b disposed between the first light transmissive layer 51 a and the emission side lens layer 42. .

<液晶装置を構成する液晶パネルの構成>
図3は、液晶パネルの構成を示す模式平面図である。図4は、図3に示す液晶パネルのH−H’線に沿う模式断面図である。図5は、液晶パネルの電気的な構成を示す等価回路図である。以下、液晶パネルの構成を、図3〜図5を参照しながら説明する。
<Configuration of the liquid crystal panel constituting the liquid crystal device>
FIG. 3 is a schematic plan view showing the configuration of the liquid crystal panel. 4 is a schematic cross-sectional view taken along the line HH ′ of the liquid crystal panel shown in FIG. FIG. 5 is an equivalent circuit diagram showing an electrical configuration of the liquid crystal panel. Hereinafter, the configuration of the liquid crystal panel will be described with reference to FIGS.

図3及び図4に示すように、本実施形態の液晶パネル100は、対向するように配置された素子基板10および対向基板20と、これら一対の基板10,20によって挟持された液晶層15とを有する。素子基板10を構成する基板としての第1基材10aは、例えば、ガラス基板、石英基板などの透明基板が用いられている。   As shown in FIGS. 3 and 4, the liquid crystal panel 100 of the present embodiment includes an element substrate 10 and a counter substrate 20 that are arranged to face each other, and a liquid crystal layer 15 that is sandwiched between the pair of substrates 10 and 20. Have For example, a transparent substrate such as a glass substrate or a quartz substrate is used as the first base material 10a as a substrate constituting the element substrate 10.

素子基板10は対向基板20よりも大きく、両基板10,20は、対向基板20の外周に沿って配置されたシール材14を介して接合されている。平面視で環状に設けられたシール材14の内側で、素子基板10は対向基板20の間に正または負の誘電異方性を有する液晶が封入されて液晶層15を構成している。シール材14は、例えば熱硬化性又は紫外線硬化性のエポキシ樹脂などの接着剤が採用されている。シール材14には、一対の基板の間隔を一定に保持するためのスペーサー(図示省略)が混入されている。   The element substrate 10 is larger than the counter substrate 20, and both the substrates 10, 20 are bonded together via a seal material 14 disposed along the outer periphery of the counter substrate 20. In the element substrate 10, liquid crystal having positive or negative dielectric anisotropy is sealed between the opposing substrates 20 inside the sealing material 14 provided in an annular shape in plan view, thereby forming a liquid crystal layer 15. For the sealing material 14, for example, an adhesive such as a thermosetting or ultraviolet curable epoxy resin is employed. Spacers (not shown) are mixed in the sealing material 14 to keep the distance between the pair of substrates constant.

シール材14の内縁より内側には、複数の画素Pが配列した表示領域Eが設けられている。表示領域Eは、表示に寄与する複数の画素Pに加えて、複数の画素Pを囲むように配置されたダミー画素を含むとしてもよい。また、図3及び図4では図示を省略したが、表示領域Eにおいて複数の画素Pをそれぞれ平面的に区分する遮光層(ブラックマトリックス:BM)が対向基板20に設けられている。   A display area E in which a plurality of pixels P are arranged is provided inside the inner edge of the sealing material 14. The display area E may include dummy pixels arranged so as to surround the plurality of pixels P in addition to the plurality of pixels P contributing to display. Although not shown in FIGS. 3 and 4, a light shielding layer (black matrix: BM) that divides a plurality of pixels P in a plane in the display area E is provided on the counter substrate 20.

素子基板10の1辺部に沿ったシール材14と該1辺部との間に、データ線駆動回路22が設けられている。また、該1辺部に対向する他の1辺部に沿ったシール材14と表示領域Eとの間に、検査回路25が設けられている。さらに、該1辺部と直交し互いに対向する他の2辺部に沿ったシール材14と表示領域Eとの間に走査線駆動回路24が設けられている。該1辺部と対向する他の1辺部に沿ったシール材14と検査回路25との間には、2つの走査線駆動回路24を繋ぐ複数の配線29が設けられている。   A data line driving circuit 22 is provided between the sealing material 14 along one side of the element substrate 10 and the one side. Further, an inspection circuit 25 is provided between the sealing material 14 and the display area E along the other one side facing the one side. Further, a scanning line driving circuit 24 is provided between the sealing material 14 and the display area E along the other two sides that are orthogonal to the one side and face each other. A plurality of wirings 29 connecting the two scanning line driving circuits 24 are provided between the sealing material 14 and the inspection circuit 25 along the other one side facing the one side.

対向基板20における環状に配置されたシール材14と表示領域Eとの間には、遮光部材としての遮光層18(見切り部)が設けられている。遮光層18は、例えば、遮光性の金属あるいは金属酸化物などからなり、遮光層18の内側が複数の画素Pを有する表示領域Eとなっている。なお、図3では図示を省略したが、表示領域Eにおいても複数の画素Pを平面的に区分する遮光層が設けられている。   A light shielding layer 18 (parting part) as a light shielding member is provided between the sealing material 14 arranged in a ring shape on the counter substrate 20 and the display area E. The light shielding layer 18 is made of, for example, a light shielding metal or metal oxide, and the inside of the light shielding layer 18 is a display region E having a plurality of pixels P. Although not shown in FIG. 3, the display region E is also provided with a light shielding layer that divides a plurality of pixels P in a plane.

これらデータ線駆動回路22、走査線駆動回路24に繋がる配線は、該1辺部に沿って配列した複数の外部接続用端子35に接続されている。以降、該1辺部に沿った方向をX方向とし、該1辺部と直交し互いに対向する他の2辺部に沿った方向をY方向として説明する。   Wirings connected to the data line driving circuit 22 and the scanning line driving circuit 24 are connected to a plurality of external connection terminals 35 arranged along the one side. Hereinafter, the direction along the one side will be referred to as the X direction, and the direction along the other two sides orthogonal to the one side and facing each other will be described as the Y direction.

図4に示すように、第1基材10aの液晶層15側の表面には、画素Pごとに設けられた透光性の画素電極27およびスイッチング素子である薄膜トランジスター(TFT:Thin Film Transistor、以降、「TFT30」と呼称する)と、信号配線と、これらを覆う配向膜28とが形成されている。   As shown in FIG. 4, on the surface of the first base material 10a on the liquid crystal layer 15 side, a transparent pixel electrode 27 provided for each pixel P and a thin film transistor (TFT: Thin Film Transistor, which is a switching element) are provided. Hereinafter, it is referred to as “TFT 30”), signal wirings, and an alignment film 28 covering them.

また、TFT30における半導体層に光が入射してスイッチング動作が不安定になることを防ぐ遮光構造が採用されている。本発明における素子基板10は、少なくとも画素電極27、TFT30、配向膜28を含むものである。   In addition, a light shielding structure is employed that prevents light from entering the semiconductor layer in the TFT 30 to make the switching operation unstable. The element substrate 10 in the present invention includes at least the pixel electrode 27, the TFT 30, and the alignment film 28.

対向基板20の液晶層15側の表面には、遮光層18と、これを覆うように成膜された絶縁層33と、絶縁層33を覆うように設けられた対向電極31と、対向電極31を覆う配向膜32とが設けられている。本発明における対向基板20は、少なくとも絶縁層33、対向電極31、配向膜32を含むものである。   On the surface of the counter substrate 20 on the liquid crystal layer 15 side, the light shielding layer 18, the insulating layer 33 formed so as to cover the light shielding layer 18, the counter electrode 31 provided so as to cover the insulating layer 33, and the counter electrode 31 And an alignment film 32 is provided. The counter substrate 20 in the present invention includes at least an insulating layer 33, a counter electrode 31, and an alignment film 32.

遮光層18は、図3に示すように、表示領域Eを取り囲むと共に、平面的に走査線駆動回路24、検査回路25と重なる位置に設けられている(図示簡略)。これにより対向基板20側からこれらの駆動回路を含む周辺回路に入射する光を遮蔽して、周辺回路が光によって誤動作することを防止する役目を果たしている。また、不必要な迷光が表示領域Eに入射しないように遮蔽して、表示領域Eの表示における高いコントラストを確保している。   As shown in FIG. 3, the light shielding layer 18 surrounds the display area E and is provided at a position where the scanning line driving circuit 24 and the inspection circuit 25 overlap in a plan view (illustration is simplified). Thus, the light incident on the peripheral circuit including these drive circuits from the counter substrate 20 side is shielded, and the peripheral circuit is prevented from malfunctioning due to the light. Further, unnecessary stray light is shielded from entering the display area E, and high contrast in the display of the display area E is ensured.

絶縁層33は、例えば酸化シリコンなどの無機材料からなり、光透過性を有して遮光層18を覆うように設けられている。このような絶縁層33の形成方法としては、例えばプラズマCVD(Chemical Vapor Deposition)法などを用いて成膜する方法が挙げられる。   The insulating layer 33 is made of an inorganic material such as silicon oxide, for example, and is provided so as to cover the light shielding layer 18 with light transmittance. As a method of forming such an insulating layer 33, for example, a method of forming a film using a plasma CVD (Chemical Vapor Deposition) method or the like can be cited.

対向電極31は、例えばITOなどの透明導電膜からなり、絶縁層33を覆うと共に、図3に示すように対向基板20の四隅に設けられた上下導通部26により素子基板10側の配線に電気的に接続している。   The counter electrode 31 is made of a transparent conductive film such as ITO, for example, covers the insulating layer 33, and electrically connects the wiring on the element substrate 10 side by the vertical conduction portions 26 provided at the four corners of the counter substrate 20 as shown in FIG. Connected.

画素電極27を覆う配向膜28、および対向電極31を覆う配向膜32は、液晶装置1の光学設計に基づいて選定される。例えば、気相成長法を用いてSiOx(酸化シリコン)などの無機材料を成膜して、負の誘電異方性を有する液晶分子に対して略垂直配向させた無機配向膜が挙げられる。   The alignment film 28 covering the pixel electrode 27 and the alignment film 32 covering the counter electrode 31 are selected based on the optical design of the liquid crystal device 1. For example, an inorganic alignment film formed by depositing an inorganic material such as SiOx (silicon oxide) using a vapor deposition method and substantially vertically aligning with liquid crystal molecules having negative dielectric anisotropy can be given.

このような液晶装置1は透過型であって、電圧が印加されない時の画素Pの透過率が電圧印加時の透過率よりも大きいノーマリーホワイトや、電圧が印加されない時の画素Pの透過率が電圧印加時の透過率よりも小さいノーマリーブラックモードの光学設計が採用される。光の入射側と射出側とにそれぞれ偏光素子が光学設計に応じて配置されて用いられる。   Such a liquid crystal device 1 is of a transmissive type, and the transmittance of the pixel P when the voltage is not applied is larger than the transmittance when the voltage is applied, or the transmittance of the pixel P when the voltage is not applied. A normally black mode optical design is employed, which is smaller than the transmittance when a voltage is applied. Polarizing elements are arranged and used according to the optical design on the light incident side and the light exit side, respectively.

図5に示すように、液晶パネル100は、少なくとも表示領域Eにおいて互いに絶縁されて直交する複数の走査線3aおよび複数のデータ線6aと、共通電位配線としての容量線3bとを有する。走査線3aが延在する方向がX方向であり、データ線6aが延在する方向がY方向である。   As shown in FIG. 5, the liquid crystal panel 100 includes a plurality of scanning lines 3a and a plurality of data lines 6a that are insulated from each other and orthogonal to each other in at least the display region E, and a capacitor line 3b as a common potential wiring. The direction in which the scanning line 3a extends is the X direction, and the direction in which the data line 6a extends is the Y direction.

走査線3aとデータ線6aならびに容量線3bと、これらの信号線類により区分された領域に、画素電極27と、TFT30と、容量素子16とが設けられ、これらが画素Pの画素回路を構成している。   A pixel electrode 27, a TFT 30, and a capacitive element 16 are provided in a region divided by the scanning line 3a, the data line 6a, the capacitive line 3b, and these signal lines, and these constitute a pixel circuit of the pixel P. doing.

走査線3aはTFT30のゲートに電気的に接続され、データ線6aはTFT30のデータ線側ソースドレイン領域(ソース領域)に電気的に接続されている。画素電極27は、TFT30の画素電極側ソースドレイン領域(ドレイン領域)に電気的に接続されている。   The scanning line 3 a is electrically connected to the gate of the TFT 30, and the data line 6 a is electrically connected to the data line side source / drain region (source region) of the TFT 30. The pixel electrode 27 is electrically connected to the pixel electrode side source / drain region (drain region) of the TFT 30.

データ線6aは、データ線駆動回路22(図3参照)に接続されており、データ線駆動回路22から供給される画像信号D1,D2,…,Dnを画素Pに供給する。走査線3aは、走査線駆動回路24(図3参照)に接続されており、走査線駆動回路24から供給される走査信号SC1,SC2,…,SCmを各画素Pに供給する。   The data line 6a is connected to the data line driving circuit 22 (see FIG. 3), and supplies image signals D1, D2,..., Dn supplied from the data line driving circuit 22 to the pixels P. The scanning line 3a is connected to the scanning line driving circuit 24 (see FIG. 3), and supplies the scanning signals SC1, SC2,..., SCm supplied from the scanning line driving circuit 24 to each pixel P.

データ線駆動回路22からデータ線6aに供給される画像信号D1〜Dnは、この順に線順次で供給してもよく、互いに隣り合う複数のデータ線6a同士に対してグループごとに供給してもよい。走査線駆動回路24は、走査線3aに対して、走査信号SC1〜SCmを所定のタイミングで供給する。   The image signals D1 to Dn supplied from the data line driving circuit 22 to the data lines 6a may be supplied line-sequentially in this order, or may be supplied for each of a plurality of adjacent data lines 6a for each group. Good. The scanning line driving circuit 24 supplies the scanning signals SC1 to SCm to the scanning line 3a at a predetermined timing.

液晶パネル100は、スイッチング素子であるTFT30が走査信号SC1〜SCmの入力により一定期間だけオン状態とされることで、データ線6aから供給される画像信号D1〜Dnが所定のタイミングで画素電極27に書き込まれる構成となっている。そして、画素電極27を介して液晶層15に書き込まれた所定レベルの画像信号D1〜Dnは、画素電極27と液晶層15を介して対向配置された対向電極31との間で一定期間保持される。   In the liquid crystal panel 100, the TFT 30 serving as a switching element is turned on for a predetermined period by the input of the scanning signals SC1 to SCm, so that the image signals D1 to Dn supplied from the data line 6a are supplied to the pixel electrode 27 at a predetermined timing. It is the structure written in. The predetermined level of the image signals D1 to Dn written to the liquid crystal layer 15 through the pixel electrode 27 is held for a certain period between the pixel electrode 27 and the counter electrode 31 disposed to face the liquid crystal layer 15. The

保持された画像信号D1〜Dnがリークするのを防止するため、画素電極27と対向電極31との間に形成される液晶容量と並列に容量素子16が接続されている。容量素子16は、TFT30の画素電極側ソースドレイン領域と容量線3bとの間に設けられている。   In order to prevent the held image signals D1 to Dn from leaking, the capacitive element 16 is connected in parallel with the liquid crystal capacitance formed between the pixel electrode 27 and the counter electrode 31. The capacitive element 16 is provided between the pixel electrode side source / drain region of the TFT 30 and the capacitive line 3b.

<液晶パネルを構成する画素の構成>
図6は、液晶パネルのうち主に画素の構造を示す模式断面図である。以下、液晶パネルのうち画素の構造を、図6を参照しながら説明する。なお、図6は、各構成要素の断面的な位置関係を示すものであり、明示可能な尺度で表されている。
<Configuration of pixels constituting liquid crystal panel>
FIG. 6 is a schematic cross-sectional view mainly showing the structure of a pixel in the liquid crystal panel. Hereinafter, the pixel structure of the liquid crystal panel will be described with reference to FIG. FIG. 6 shows the cross-sectional positional relationship of each component, and is represented on a scale that can be clearly shown.

図6に示すように、液晶パネル100は、素子基板10と、これに対向配置される対向基板20とを備えている。素子基板10を構成する第1基材10aは、上記したように、例えば、石英基板等によって構成されている。   As shown in FIG. 6, the liquid crystal panel 100 includes an element substrate 10 and a counter substrate 20 disposed to face the element substrate 10. As described above, the first base material 10a configuring the element substrate 10 is configured by, for example, a quartz substrate.

図6に示すように、第1基材10a上には、例えば、Al(アルミニウム)、Ti(チタン)、Cr(クロム)、W(タングステン)等の材料を含む下側遮光層3cが形成されている。下側遮光層3cは、平面的に格子状にパターニングされており、各画素Pの開口領域を規定している。なお、下側遮光層3cは、導電性を有し、走査線3aの一部として機能するようにしてもよい。第1基材10a及び下側遮光層3c上には、酸化シリコン等からなる下地絶縁層11aが形成されている。   As shown in FIG. 6, a lower light-shielding layer 3c containing a material such as Al (aluminum), Ti (titanium), Cr (chromium), W (tungsten) is formed on the first base material 10a. ing. The lower light-shielding layer 3c is patterned in a lattice shape in a plane, and defines the opening area of each pixel P. Note that the lower light shielding layer 3c may have conductivity and function as a part of the scanning line 3a. A base insulating layer 11a made of silicon oxide or the like is formed on the first base material 10a and the lower light shielding layer 3c.

下地絶縁層11a上には、TFT30及び走査線3a等が形成されている。TFT30は、例えば、LDD(Lightly Doped Drain)構造を有しており、ポリシリコン(高純度の多結晶シリコン)等からなる半導体層30aと、半導体層30a上に形成されたゲート絶縁層11gと、ゲート絶縁層11g上に形成されたポリシリコン膜等からなるゲート電極30gとを有する。走査線3aは、ゲート電極30gとしても機能する。   On the base insulating layer 11a, the TFT 30, the scanning line 3a, and the like are formed. The TFT 30 has, for example, an LDD (Lightly Doped Drain) structure, and includes a semiconductor layer 30a made of polysilicon (high-purity polycrystalline silicon), a gate insulating layer 11g formed on the semiconductor layer 30a, A gate electrode 30g made of a polysilicon film or the like formed on the gate insulating layer 11g. The scanning line 3a also functions as the gate electrode 30g.

半導体層30aは、例えば、リン(P)イオン等のN型の不純物イオンが注入されることにより、N型のTFT30として形成されている。具体的には、半導体層30aは、チャネル領域30cと、データ線側LDD領域30s1と、データ線側ソースドレイン領域30sと、画素電極側LDD領域30d1と、画素電極側ソースドレイン領域30dとを備えている。   The semiconductor layer 30a is formed as an N-type TFT 30 by implanting N-type impurity ions such as phosphorus (P) ions. Specifically, the semiconductor layer 30a includes a channel region 30c, a data line side LDD region 30s1, a data line side source / drain region 30s, a pixel electrode side LDD region 30d1, and a pixel electrode side source / drain region 30d. ing.

チャネル領域30cには、ボロン(B)イオン等のP型の不純物イオンがドープされている。その他の領域(30s1,30s,30d1,30d)には、リン(P)イオン等のN型の不純物イオンがドープされている。このように、TFT30は、N型のTFTとして形成されている。   The channel region 30c is doped with P-type impurity ions such as boron (B) ions. The other regions (30s1, 30s, 30d1, 30d) are doped with N-type impurity ions such as phosphorus (P) ions. Thus, the TFT 30 is formed as an N-type TFT.

ゲート電極30g及びゲート絶縁層11g上には、酸化シリコン等からなる第1層間絶縁層11bが形成されている。第1層間絶縁層11b上には、容量素子16が設けられている。具体的には、TFT30の画素電極側ソースドレイン領域30d及び画素電極27に電気的に接続された画素電位側容量電極としての第1容量電極16aと、固定電位側容量電極としての容量線3b(第2容量電極16b)の一部とが、誘電体膜16cを介して対向配置されることにより、容量素子16が形成されている。   A first interlayer insulating layer 11b made of silicon oxide or the like is formed on the gate electrode 30g and the gate insulating layer 11g. A capacitive element 16 is provided on the first interlayer insulating layer 11b. Specifically, the first capacitor electrode 16a as the pixel potential side capacitor electrode electrically connected to the pixel electrode side source / drain region 30d and the pixel electrode 27 of the TFT 30, and the capacitor line 3b (as the fixed potential side capacitor electrode). A part of the second capacitor electrode 16b) is disposed to face the dielectric film 16c, whereby the capacitor element 16 is formed.

誘電体膜16cは、例えば、シリコン窒化膜である。第2容量電極16b(容量線3b)は、例えば、Ti(チタン)、Cr(クロム)、W(タングステン)、Ta(タンタル)、Mo(モリブデン)等の高融点金属のうち少なくとも一つを含む、金属単体、合金、金属シリサイド、ポリシリサイド、これらを積層したもの等からなる。或いは、Al(アルミニウム)膜から形成することも可能である。   The dielectric film 16c is, for example, a silicon nitride film. The second capacitor electrode 16b (capacitor line 3b) includes at least one of refractory metals such as Ti (titanium), Cr (chromium), W (tungsten), Ta (tantalum), and Mo (molybdenum). , Metal simple substance, alloy, metal silicide, polysilicide, and a laminate of these. Alternatively, it can be formed from an Al (aluminum) film.

第1容量電極16aは、例えば、導電性のポリシリコン膜からなり容量素子16の画素電位側容量電極として機能する。ただし、第1容量電極16aは、容量線3bと同様に、金属又は合金を含む単一層膜又は多層膜から構成してもよい。第1容量電極16aは、画素電位側容量電極としての機能のほか、コンタクトホールCNT1,CNT3,CNT4を介して、画素電極27とTFT30の画素電極側ソースドレイン領域30d(ドレイン領域)とを中継接続する機能を有する。   The first capacitor electrode 16 a is made of, for example, a conductive polysilicon film and functions as a pixel potential side capacitor electrode of the capacitor element 16. However, the first capacitor electrode 16a may be composed of a single layer film or a multilayer film containing a metal or an alloy, like the capacitor line 3b. In addition to functioning as a pixel potential side capacitance electrode, the first capacitance electrode 16a relay-connects the pixel electrode 27 and the pixel electrode side source / drain region 30d (drain region) of the TFT 30 via contact holes CNT1, CNT3, and CNT4. It has the function to do.

容量素子16上には、第2層間絶縁層11cを介してデータ線6aが形成されている。データ線6aは、ゲート絶縁層11g、第1層間絶縁層11b、誘電体膜16c、及び第2層間絶縁層11cに開孔されたコンタクトホールCNT2を介して、半導体層30aのデータ線側ソースドレイン領域30s(ソース領域)に電気的に接続されている。   A data line 6a is formed on the capacitive element 16 via the second interlayer insulating layer 11c. The data line 6a is connected to the data line side source / drain of the semiconductor layer 30a through the contact hole CNT2 formed in the gate insulating layer 11g, the first interlayer insulating layer 11b, the dielectric film 16c, and the second interlayer insulating layer 11c. It is electrically connected to the region 30s (source region).

データ線6aの上層には、第3層間絶縁層11dを介して画素電極27が形成されている。第3層間絶縁層11dは、例えば、シリコンの酸化物や窒化物からなり、TFT30が設けられた領域を覆うことによって生じる表面の凸部を平坦化する平坦化処理が施される。平坦化処理の方法としては、例えば化学的機械的研磨処理(Chemical Mechanical Polishing:CMP処理)やスピンコート処理などが挙げられる。第3層間絶縁層11dには、コンタクトホールCNT4が形成されている。   A pixel electrode 27 is formed on the data line 6a via a third interlayer insulating layer 11d. The third interlayer insulating layer 11d is made of, for example, silicon oxide or nitride, and is subjected to a flattening process for flattening the convex portions on the surface generated by covering the region where the TFT 30 is provided. Examples of the planarization method include chemical mechanical polishing (CMP) and spin coating. A contact hole CNT4 is formed in the third interlayer insulating layer 11d.

画素電極27は、コンタクトホールCNT4,CNT3を介して第1容量電極16aに接続されることにより、半導体層30aの画素電極側ソースドレイン領域30d(ドレイン領域)に電気的に接続されている。なお、画素電極27は、例えば、ITO膜等の透明導電性膜から形成されている。   The pixel electrode 27 is electrically connected to the pixel electrode side source / drain region 30d (drain region) of the semiconductor layer 30a by being connected to the first capacitor electrode 16a via the contact holes CNT4 and CNT3. The pixel electrode 27 is formed of a transparent conductive film such as an ITO film, for example.

画素電極27及び隣り合う画素電極27間の第3層間絶縁層11d上には、酸化シリコン(SiO2)などの無機材料を斜方蒸着した配向膜28が設けられている。配向膜28上には、シール材14(図3及び図4参照)により囲まれた空間に液晶等が封入された液晶層15が設けられている。 On the third interlayer insulating layer 11d between the pixel electrode 27 and the adjacent pixel electrode 27, an alignment film 28 obtained by obliquely depositing an inorganic material such as silicon oxide (SiO 2 ) is provided. On the alignment film 28, a liquid crystal layer 15 in which liquid crystal or the like is sealed in a space surrounded by the sealing material 14 (see FIGS. 3 and 4) is provided.

一方、第2基材(出射側レンズ層42)上(液晶層15側)には、例えば、PSG膜(リンをドーピングした酸化シリコン)などからなる絶縁層33が設けられている。絶縁層33上には、その全面に渡って対向電極31が設けられている。対向電極31上には、酸化シリコン(SiO2)などの無機材料を斜方蒸着した配向膜32が設けられている。対向電極31は、上述の画素電極27と同様に、例えばITO膜等の透明導電性膜からなる。 On the other hand, an insulating layer 33 made of, for example, a PSG film (phosphorus-doped silicon oxide) or the like is provided on the second base material (outgoing side lens layer 42) (on the liquid crystal layer 15 side). On the insulating layer 33, the counter electrode 31 is provided over the entire surface. On the counter electrode 31, an alignment film 32 is formed by obliquely depositing an inorganic material such as silicon oxide (SiO 2 ). The counter electrode 31 is made of a transparent conductive film such as an ITO film, for example, like the pixel electrode 27 described above.

液晶層15は、画素電極27と対向電極31との間で電界が生じていない状態で配向膜28,32によって所定の配向状態をとる。シール材14は、素子基板10及び対向基板20を貼り合わせるための、例えば光硬化性樹脂や熱硬化性樹脂からなる接着剤であり、素子基板10と対向基板20の距離を所定値とするためのグラスファイバー或いはガラスビーズ等のスペーサーが混入されている。   The liquid crystal layer 15 takes a predetermined alignment state by the alignment films 28 and 32 in a state where no electric field is generated between the pixel electrode 27 and the counter electrode 31. The sealing material 14 is an adhesive made of, for example, a photo-curing resin or a thermosetting resin for bonding the element substrate 10 and the counter substrate 20, and sets the distance between the element substrate 10 and the counter substrate 20 to a predetermined value. Spacers such as glass fiber or glass beads are mixed.

<電気光学装置としての液晶装置の構成>
図7は、マイクロレンズ基板を備える液晶装置の構造を示す模式断面図である。以下、マイクロレンズ基板を備える液晶装置の構造を、図7を参照しながら説明する。なお、図7に示す液晶装置は、図4などに示した液晶パネルの詳細な部材を適宜省略して図示している。
<Configuration of liquid crystal device as electro-optical device>
FIG. 7 is a schematic cross-sectional view showing the structure of a liquid crystal device including a microlens substrate. Hereinafter, the structure of a liquid crystal device including a microlens substrate will be described with reference to FIG. Note that the liquid crystal device illustrated in FIG. 7 is illustrated by appropriately omitting detailed members of the liquid crystal panel illustrated in FIG.

図7に示すように、液晶装置1は、液晶パネル100とマイクロレンズ基板50とを備えている。本実施形態では、液晶パネル100のうち対向基板20の一部は、マイクロレンズ基板50の出射側レンズ層42の一部と重複して構成されている。   As shown in FIG. 7, the liquid crystal device 1 includes a liquid crystal panel 100 and a microlens substrate 50. In the present embodiment, a part of the counter substrate 20 in the liquid crystal panel 100 is configured to overlap with a part of the exit side lens layer 42 of the microlens substrate 50.

入射側レンズ層41には、パス層43との界面に凹状の第1マイクロレンズ44が形成されている。複数の第1マイクロレンズ44は、入射側レンズ層41においてマトリックス状に配置されている。入射側レンズ層41は、例えば、石英で構成されている。石英の屈折率(n)は、例えば、1.46である。   The incident side lens layer 41 is formed with a concave first microlens 44 at the interface with the pass layer 43. The plurality of first microlenses 44 are arranged in a matrix in the incident side lens layer 41. The incident side lens layer 41 is made of, for example, quartz. The refractive index (n) of quartz is 1.46, for example.

入射側レンズ層41の凹部44aには、透光性層が形成されており、酸窒化シリコン(SiON)が充填されている。酸窒化シリコン(SiON)の屈折率(n1)は、1.55〜1.70程度である。   A translucent layer is formed in the concave portion 44a of the incident side lens layer 41 and filled with silicon oxynitride (SiON). The refractive index (n1) of silicon oxynitride (SiON) is about 1.55 to 1.70.

入射側レンズ層41及び第1マイクロレンズ44上(液晶層15側)には、パス層43が配置されている。パス層43は、入射側レンズ層41と出射側レンズ層42との距離を調整するために配置されている。パス層43の材質は、酸化シリコン(SiO2)である。酸化シリコンの屈折率(n2)は、1.46〜1.52程度である。 A pass layer 43 is disposed on the incident side lens layer 41 and the first microlens 44 (on the liquid crystal layer 15 side). The pass layer 43 is disposed to adjust the distance between the incident side lens layer 41 and the output side lens layer 42. The material of the pass layer 43 is silicon oxide (SiO 2 ). The refractive index (n2) of silicon oxide is about 1.46 to 1.52.

パス層43の上(液晶層15側)には、第2マイクロレンズ51を構成する第1透光性層51aが配置されている。隣り合う第1透光性層51a間には、レンズ形状とならない隙間が存在する場合がある。隙間が存在すると、光の利用効率が低下する。第1透光性層51aの材質は、酸窒化シリコン(SiON)である。酸窒化シリコンの屈折率(n3)は、1.55〜1.70程度である。   On the pass layer 43 (on the liquid crystal layer 15 side), a first light-transmissive layer 51a that constitutes the second microlens 51 is disposed. There may be a gap that does not have a lens shape between the adjacent first light-transmitting layers 51a. If there is a gap, the light utilization efficiency decreases. The material of the first light transmissive layer 51a is silicon oxynitride (SiON). The refractive index (n3) of silicon oxynitride is about 1.55 to 1.70.

第1透光性層51a及びパス層43を覆うように、第2マイクロレンズ51を構成する第2透光性層51bが配置されている。第2透光性層51bは、レンズ形状とならない未完成な第1透光性層51a間の形状を、正規のレンズ形状に形成するために、第1透光性層51aを覆うように配置されている。第2透光性層51bの材質は、酸窒化シリコン(SiON)である。酸窒化シリコン(n4)の屈折率は、1.55〜1.70程度である。   A second translucent layer 51b that constitutes the second microlens 51 is disposed so as to cover the first translucent layer 51a and the pass layer 43. The second translucent layer 51b is disposed so as to cover the first translucent layer 51a in order to form a shape between the incomplete first translucent layers 51a that does not have a lens shape into a regular lens shape. Has been. The material of the second light transmissive layer 51b is silicon oxynitride (SiON). The refractive index of silicon oxynitride (n4) is about 1.55 to 1.70.

第2透光性層51b上(液晶層15側)には、対向基板20の一部としても構成される出射側レンズ層42が配置されている。出射側レンズ層42の材質は、酸化シリコン(SiO2)である。酸化シリコンの屈折率(n5)は、1.46〜1.52程度である。なお、第1透光性層51aの屈折率n3と第2透光性層51bの屈折率n4との関係は、多少添加する成分等を調整して、n4<n3となることが好ましい。 On the second light transmissive layer 51b (on the liquid crystal layer 15 side), an emission side lens layer 42 configured also as a part of the counter substrate 20 is disposed. The material of the exit side lens layer 42 is silicon oxide (SiO 2 ). The refractive index (n5) of silicon oxide is about 1.46 to 1.52. The relationship between the refractive index n3 of the first translucent layer 51a and the refractive index n4 of the second translucent layer 51b is preferably such that n4 <n3 by adjusting some components to be added.

なお、屈折率n、n1、n2、n3、n4、n5の関係は、以下の通りである。
n5<n4<n3
n1≠n3
n1>n2
The relationship between the refractive indexes n, n1, n2, n3, n4, and n5 is as follows.
n5 <n4 <n3
n1 ≠ n3
n1> n2

マイクロレンズ基板50の光出射側には、上記した液晶パネル100が配置される。光は、マイクロレンズ基板50を通過して、液晶パネル100の対向基板20側から入射し、素子基板10側から出射する。   The liquid crystal panel 100 described above is disposed on the light exit side of the microlens substrate 50. The light passes through the microlens substrate 50, enters from the counter substrate 20 side of the liquid crystal panel 100, and exits from the element substrate 10 side.

マイクロレンズ基板50は、その使用時には、2つのマイクロレンズ(第1マイクロレンズ44及び第2マイクロレンズ51を含むダブルマイクロレンズ)が、例えば、素子基板10の各画素Pに対応するように配置される。従って、マイクロレンズに入射する入射光は、マイクロレンズの屈折作用により、素子基板10における各画素Pに向けて集光される。   When the microlens substrate 50 is used, two microlenses (double microlens including the first microlens 44 and the second microlens 51) are arranged so as to correspond to each pixel P of the element substrate 10, for example. The Therefore, the incident light incident on the microlens is condensed toward each pixel P in the element substrate 10 by the refraction action of the microlens.

<液晶装置(マイクロレンズ基板)の製造方法>
図8は、液晶装置の製造方法を工程順に示すフローチャートである。図9〜図11は、液晶装置のうちマイクロレンズ基板の製造方法を工程順に示す模式断面図である。以下、液晶装置の製造方法を、図8〜図11を参照しながら説明する。
<Manufacturing method of liquid crystal device (microlens substrate)>
FIG. 8 is a flowchart showing a method of manufacturing the liquid crystal device in the order of steps. 9 to 11 are schematic cross-sectional views illustrating a method of manufacturing a microlens substrate in the liquid crystal device in the order of steps. Hereinafter, a method for manufacturing the liquid crystal device will be described with reference to FIGS.

最初に、素子基板10側の製造方法を説明する。まず、ステップS11では、石英基板などからなる第1基材10a上にTFT30などを形成する。具体的には、周知の成膜技術、フォトリソグラフィ技術、及びエッチング技術を用いて形成する。以降、これらが形成された層を回路層(図示せず)と称して簡略化して説明する。   First, a manufacturing method on the element substrate 10 side will be described. First, in step S11, the TFT 30 and the like are formed on the first base material 10a made of a quartz substrate or the like. Specifically, it is formed by using a well-known film formation technique, photolithography technique, and etching technique. Hereinafter, the layer in which these are formed will be simply referred to as a circuit layer (not shown).

ステップS12では、画素電極27を形成する。具体的には、TFT30などを含む回路層(図示せず)の上に、周知の成膜技術、フォトリソグラフィ技術、及びエッチング技術を用いて、ITOなどからなる画素電極27を形成する。   In step S12, the pixel electrode 27 is formed. Specifically, the pixel electrode 27 made of ITO or the like is formed on a circuit layer (not shown) including the TFT 30 and the like by using a well-known film formation technique, photolithography technique, and etching technique.

ステップS13では、画素電極27を覆うように配向膜28を形成する。配向膜28の製造方法としては、例えば、酸化シリコン(SiO2)などの無機材料を斜方蒸着する斜方蒸着法が用いられる。 In step S <b> 13, the alignment film 28 is formed so as to cover the pixel electrode 27. As a manufacturing method of the alignment film 28, for example, an oblique deposition method in which an inorganic material such as silicon oxide (SiO 2 ) is obliquely deposited is used.

次に、対向基板20側の製造方法を説明する。まず、ステップS21では、マイクロレンズ基板50を形成する。具体的には、図9〜図11を参照しながら説明する。   Next, a manufacturing method on the counter substrate 20 side will be described. First, in step S21, the microlens substrate 50 is formed. Specifically, this will be described with reference to FIGS.

図9(a)に示す工程では、第2基材20a上(液晶層15側)に酸化膜53(高温酸化膜、HTO:High Temperature Oxide(例えば、700℃〜1100℃程度のアニール処理を施した酸化膜))を形成し、酸化膜53上にポリシリコン膜54を形成する。酸化膜53は、例えば、第2基材20aよりエッチングレートが早い、CVD(Chemical Vapor Deposition)法によって形成された酸化シリコンが用いられる。ポリシリコン膜54は、後にマスクとして用いられる。   9A, an oxide film 53 (high temperature oxide film, HTO: High Temperature Oxide (for example, annealing at about 700 ° C. to 1100 ° C.) is performed on the second substrate 20a (the liquid crystal layer 15 side). And a polysilicon film 54 is formed on the oxide film 53. For the oxide film 53, for example, silicon oxide formed by a CVD (Chemical Vapor Deposition) method having an etching rate faster than that of the second base material 20a is used. The polysilicon film 54 is used later as a mask.

図9(b)に示す工程では、ポリシリコン膜54に開口孔54aを形成する。具体的には、図示しないレジストパターンをマスクとして、画素Pに対応する位置のポリシリコン膜54をエッチングして、複数の開口孔54aを形成する。開口孔54aの大きさは、後のエッチング工程で凹部44aを広げることから、画素Pの開口領域より小さく形成する。これにより、開口孔54aを有するマスク54bが完成する。   In the step shown in FIG. 9B, an opening hole 54 a is formed in the polysilicon film 54. Specifically, using a resist pattern (not shown) as a mask, the polysilicon film 54 at a position corresponding to the pixel P is etched to form a plurality of opening holes 54a. The size of the opening hole 54a is smaller than the opening region of the pixel P because the recess 44a is expanded in a later etching process. Thereby, the mask 54b having the opening hole 54a is completed.

ポリシリコン膜からなるマスク54bはエッチングされない条件を用いる。エッチング液は、例えば、フッ酸である。   The mask 54b made of a polysilicon film uses a condition that is not etched. The etchant is, for example, hydrofluoric acid.

図9(c)に示す工程では、マスク54bの開口孔54aを介して、酸化膜53及び第2基材20aに第1のエッチング処理を施し、酸化膜53を開孔し、第2基材20aに凹部44aを形成する。エッチング処理は、ドライエッチング処理(異方性エッチング)である。酸化膜53の役割として、エッチングレートを調整することにより、第2基材20aに形成される凹部44aの横幅や深さを変えることができる。   In the step shown in FIG. 9C, the oxide film 53 and the second base material 20a are subjected to the first etching process through the opening hole 54a of the mask 54b to open the oxide film 53, and the second base material. A recess 44a is formed in 20a. The etching process is a dry etching process (anisotropic etching). By adjusting the etching rate as the role of the oxide film 53, the lateral width and depth of the recess 44a formed in the second base material 20a can be changed.

次に、マスク54bを介して、酸化膜53及び第2基材20aに第2のエッチング処理を施す。第2のエッチング処理は、ウエットエッチング処理(等方性エッチング)である。これにより、酸化膜53の開口孔が広がると共に、第2基材20aの凹部44aが等方的に広がる。その結果、第2基材20aにレンズ形状の凹部44aが形成される。   Next, a second etching process is performed on the oxide film 53 and the second base material 20a through the mask 54b. The second etching process is a wet etching process (isotropic etching). Thereby, the opening hole of the oxide film 53 is widened, and the concave portion 44a of the second base material 20a is isotropically widened. As a result, a lens-shaped recess 44a is formed in the second substrate 20a.

図9(d)に示す工程では、ポリシリコン膜54からなるマスク54b及び酸化膜53を除去する。   In the step shown in FIG. 9D, the mask 54b and the oxide film 53 made of the polysilicon film 54 are removed.

図10(e)に示す工程では、凹部44aに透光性層の一例であるレンズ層44bを充填する。レンズ層44bは、酸窒化シリコン(SiON)である。レンズ層44bの製造方法としては、CVD法及びCMP(Chemical Mechanical Polishing)研磨などを用いて形成する。これにより、第1マイクロレンズ44が完成する。   In the step shown in FIG. 10E, the concave portion 44a is filled with a lens layer 44b which is an example of a translucent layer. The lens layer 44b is silicon oxynitride (SiON). As a manufacturing method of the lens layer 44b, it is formed using a CVD method, CMP (Chemical Mechanical Polishing) polishing, or the like. Thereby, the first microlens 44 is completed.

図10(f)に示す工程では、第2基材20a及び第1マイクロレンズ44を覆うようにパス層43を形成する。パス層43は、第1マイクロレンズ44と第2マイクロレンズ51との距離を確保するために用いられる。言い換えれば、光の集光が可能な距離に調整する。パス層43は、酸化シリコン(SiO2)である。パス層43の製造方法としては、CVD法などが挙げられる。 In the step shown in FIG. 10 (f), the pass layer 43 is formed so as to cover the second base material 20 a and the first microlenses 44. The pass layer 43 is used to secure a distance between the first microlens 44 and the second microlens 51. In other words, the distance is adjusted so that light can be collected. The pass layer 43 is silicon oxide (SiO 2 ). Examples of the method for manufacturing the pass layer 43 include a CVD method.

図10(g)に示す工程では、パス層43の上に、凸型の第2マイクロレンズ51を形成するべく前駆体層51cを成膜する。その後、前駆体層51c上にレジスト膜51eを成膜する。前駆体層51cの材質は、酸窒化シリコン(SiON)である。レジスト膜51eは、例えば、熱変形性のレジストである。   In the step shown in FIG. 10G, a precursor layer 51 c is formed on the pass layer 43 in order to form the convex second microlens 51. Thereafter, a resist film 51e is formed on the precursor layer 51c. The material of the precursor layer 51c is silicon oxynitride (SiON). The resist film 51e is, for example, a thermally deformable resist.

図10(h)に示す工程では、第2マイクロレンズ51を形成するためのレジストパターン51e1を形成する。レジストパターン51e1を形成する方法は、フォトリソグラフィ技術を用いる。これにより、第1マイクロレンズ44の平面的な位置に対応して、方形状のレジストパターン51e1が形成される。   In the step shown in FIG. 10H, a resist pattern 51e1 for forming the second microlens 51 is formed. As a method for forming the resist pattern 51e1, a photolithography technique is used. Thereby, a rectangular resist pattern 51e1 is formed corresponding to the planar position of the first microlens 44.

図11(i)に示す工程では、方形状のレジストパターン51e1から曲面形状のレジストパターン51e2に形成する。具体的には、レジストパターン51e1が熱変形性のレジストから構成されているので、加熱(ベーク)することにより溶融し、表面張力によって略半球状のレジストパターン51e2にリフローすることができる。加熱温度は、例えば、100℃〜250℃程度である。   In the step shown in FIG. 11I, the resist pattern 51e1 having a curved surface is formed from the resist pattern 51e1 having a square shape. Specifically, since the resist pattern 51e1 is composed of a heat-deformable resist, it can be melted by heating (baking) and reflowed into a substantially hemispherical resist pattern 51e2 by surface tension. The heating temperature is, for example, about 100 ° C to 250 ° C.

図11(j)に示す工程では、曲面形状のレジストパターン51e2をマスクとして、酸窒化シリコンにドライエッチング又はウエットエッチング処理を施して、第1透光性層51aを形成する。具体的には、図11(i)に示すように、前駆体層51c(SiON)にエッチング処理を施すと、前駆体層51cが食刻され、その厚みが減少する。このとき、一緒にレジストパターン51e2も食刻される。   In the step shown in FIG. 11J, the first light-transmitting layer 51a is formed by subjecting silicon oxynitride to dry etching or wet etching using the curved resist pattern 51e2 as a mask. Specifically, as shown in FIG. 11I, when the precursor layer 51c (SiON) is subjected to an etching process, the precursor layer 51c is etched and the thickness thereof is reduced. At this time, the resist pattern 51e2 is also etched.

このとき、前駆体層51cとレジストパターン51e2とのエッチングレートが同じになるようにする。これにより、レジストパターン51e2の形状を、前駆体層51cに転写することが可能となり、第1透光性層51a(マイクロレンズ)を形成することができる。この際、隣り合うマイクロレンズ(第1透光性層51a)間に隙間が生じる場合がある。これにより、光の利用効率が低下する恐れがある。   At this time, the etching rates of the precursor layer 51c and the resist pattern 51e2 are made the same. Thereby, the shape of the resist pattern 51e2 can be transferred to the precursor layer 51c, and the first light-transmissive layer 51a (microlens) can be formed. At this time, a gap may be generated between adjacent microlenses (first light-transmissive layer 51a). As a result, the light utilization efficiency may be reduced.

図11(k)に示す工程では、第2マイクロレンズ51の形状が所望の形状になるように形成する。具体的には、第1透光性層51a及びパス層43を覆うように第2透光性層51bを成膜する。第2透光性層51bの材質は、酸窒化シリコン(SiON)である。なお、第1透光性層51aの屈折率n3と第2透光性層51bの屈折率n4との屈折率は異なる。本実施形態の場合、n4<n3であることが好ましい。   In the step shown in FIG. 11K, the second microlens 51 is formed so as to have a desired shape. Specifically, the second light transmissive layer 51 b is formed so as to cover the first light transmissive layer 51 a and the pass layer 43. The material of the second light transmissive layer 51b is silicon oxynitride (SiON). In addition, the refractive index n3 of the 1st translucent layer 51a and the refractive index n4 of the 2nd translucent layer 51b differ. In this embodiment, it is preferable that n4 <n3.

第2透光性層51bの製造方法としては、例えば、CVD法を用いることができる。このように、第1透光性層51aを覆うように第2透光性層51bを形成して所望のレンズ形状にすることにより、隣り合う第2マイクロレンズ51間に隙間がなくなる。これにより、光の利用効率を高めることができる。   As a method for manufacturing the second light transmissive layer 51b, for example, a CVD method can be used. As described above, by forming the second light-transmitting layer 51b so as to cover the first light-transmitting layer 51a and forming a desired lens shape, there is no gap between the adjacent second microlenses 51. Thereby, the utilization efficiency of light can be improved.

図11(l)に示す工程では、第2マイクロレンズ51を覆うように出射側レンズ層42を成膜して、マイクロレンズ基板50を完成させる。出射側レンズ層42の材質は、酸化シリコン(SiO2)である。 In the step shown in FIG. 11L, the emission side lens layer 42 is formed so as to cover the second microlens 51, and the microlens substrate 50 is completed. The material of the exit side lens layer 42 is silicon oxide (SiO 2 ).

ステップS22では、マイクロレンズ基板50の上に、周知の成膜技術、フォトリソグラフィ技術及びエッチング技術を用いて、対向電極31を形成する。具体的には、ITOなどの透明導電性膜をスパッタし、これをエッチングすることによって形成することができる。   In step S <b> 22, the counter electrode 31 is formed on the microlens substrate 50 using a well-known film formation technique, photolithography technique, and etching technique. Specifically, it can be formed by sputtering a transparent conductive film such as ITO and etching it.

ステップS23では、対向電極31上に配向膜32を形成する。配向膜32の製造方法は、配向膜28と場合と同様であり、例えば、斜方蒸着法を用いて形成する。以上により、対向基板20側が完成する。次に、素子基板10と対向基板20とを貼り合わせる方法を説明する。   In step S <b> 23, the alignment film 32 is formed on the counter electrode 31. The method of manufacturing the alignment film 32 is the same as that of the alignment film 28, and is formed by using, for example, oblique vapor deposition. Thus, the counter substrate 20 side is completed. Next, a method for bonding the element substrate 10 and the counter substrate 20 will be described.

ステップS31では、素子基板10上にシール材14を塗布する。具体的には、素子基板10と、例えばディスペンサー(吐出装置でも可能)との相対的な位置関係を変化させて、素子基板10における表示領域Eの周縁部に(表示領域Eを囲むように)シール材14を塗布する。   In step S <b> 31, the sealing material 14 is applied on the element substrate 10. Specifically, the relative positional relationship between the element substrate 10 and, for example, a dispenser (which may be a discharge device) is changed, and the peripheral area of the display area E on the element substrate 10 (so as to surround the display area E). The sealing material 14 is applied.

シール材14としては、例えば、紫外線硬化型エポキシ樹脂が挙げられる。なお、紫外線などの光硬化型樹脂に限定されず、熱硬化型樹脂などを用いるようにしてもよい。また、シール材14には、例えば、素子基板10と対向基板20との間隔(ギャップ或いはセルギャップ)を所定値とするためのスペーサー等のギャップ材が含まれている。   Examples of the sealing material 14 include an ultraviolet curable epoxy resin. In addition, it is not limited to photocurable resins, such as an ultraviolet-ray, You may make it use a thermosetting resin. Further, the sealing material 14 includes, for example, a gap material such as a spacer for setting a distance (gap or cell gap) between the element substrate 10 and the counter substrate 20 to a predetermined value.

ステップS32では、シール材14で囲まれた中に液晶を滴下する。詳しくは、シール材14で囲まれた領域に液晶を滴下する(ODF(One Drop Fill)方式)。滴下する方法としては、例えば、インクジェットヘッドなどを用いることができる。また、液晶は、シール材14によって囲まれた領域(表示領域E)の中央部に滴下することが望ましい。   In step S <b> 32, the liquid crystal is dropped inside the seal material 14. Specifically, the liquid crystal is dropped onto an area surrounded by the sealing material 14 (ODF (One Drop Fill) method). As a dropping method, for example, an ink jet head can be used. Further, it is desirable that the liquid crystal is dropped on the central portion of the region (display region E) surrounded by the sealing material 14.

ステップS33では、素子基板10と対向基板20とを貼り合わせる。具体的には、素子基板10に塗布されたシール材14を介して素子基板10と対向基板20とを貼り合わせる。より具体的には、互いの基板10,20の平面的な縦方向や横方向の位置精度を確保しながら行う。以上により、液晶装置1が完成する。   In step S33, the element substrate 10 and the counter substrate 20 are bonded together. Specifically, the element substrate 10 and the counter substrate 20 are bonded together via the sealing material 14 applied to the element substrate 10. More specifically, it is performed while ensuring the positional accuracy in the vertical and horizontal directions of the substrates 10 and 20. Thus, the liquid crystal device 1 is completed.

<電子機器の構成>
次に、上記液晶装置を備えた投射型表示装置について、図12を参照しながら説明する。図12は、投射型表示装置の構成を示す概略図である。
<Configuration of electronic equipment>
Next, a projection display device including the liquid crystal device will be described with reference to FIG. FIG. 12 is a schematic diagram illustrating a configuration of a projection display device.

図12に示すように、本実施形態の投射型表示装置1000は、システム光軸Lに沿って配置された偏光照明装置1100と、光分離素子としての2つのダイクロイックミラー1104,1105と、3つの反射ミラー1106,1107,1108と、5つのリレーレンズ1201,1202,1203,1204,1205と、3つの光変調手段としての透過型の液晶ライトバルブ1210,1220,1230と、光合成素子としてのクロスダイクロイックプリズム1206と、投射レンズ1207とを備えている。   As shown in FIG. 12, the projection display apparatus 1000 according to the present embodiment includes a polarization illumination device 1100 arranged along the system optical axis L, two dichroic mirrors 1104 and 1105 as light separation elements, and three Reflective mirrors 1106, 1107, 1108, five relay lenses 1201, 1202, 1203, 1204, 1205, three transmissive liquid crystal light valves 1210, 1220, 1230 as light modulation means, and a cross dichroic as a light combiner A prism 1206 and a projection lens 1207 are provided.

偏光照明装置1100は、超高圧水銀灯やハロゲンランプなどの白色光源からなる光源としてのランプユニット1101と、インテグレーターレンズ1102と、偏光変換素子1103とから概略構成されている。   The polarized light illumination device 1100 is generally configured by a lamp unit 1101 as a light source composed of a white light source such as an ultra-high pressure mercury lamp or a halogen lamp, an integrator lens 1102, and a polarization conversion element 1103.

ダイクロイックミラー1104は、偏光照明装置1100から射出された偏光光束のうち、赤色光(R)を反射させ、緑色光(G)と青色光(B)とを透過させる。もう1つのダイクロイックミラー1105は、ダイクロイックミラー1104を透過した緑色光(G)を反射させ、青色光(B)を透過させる。   The dichroic mirror 1104 reflects red light (R) and transmits green light (G) and blue light (B) among the polarized light beams emitted from the polarization illumination device 1100. Another dichroic mirror 1105 reflects the green light (G) transmitted through the dichroic mirror 1104 and transmits the blue light (B).

ダイクロイックミラー1104で反射した赤色光(R)は、反射ミラー1106で反射した後にリレーレンズ1205を経由して液晶ライトバルブ1210に入射する。ダイクロイックミラー1105で反射した緑色光(G)は、リレーレンズ1204を経由して液晶ライトバルブ1220に入射する。ダイクロイックミラー1105を透過した青色光(B)は、3つのリレーレンズ1201,1202,1203と2つの反射ミラー1107,1108とからなる導光系を経由して液晶ライトバルブ1230に入射する。   The red light (R) reflected by the dichroic mirror 1104 is reflected by the reflection mirror 1106 and then enters the liquid crystal light valve 1210 via the relay lens 1205. Green light (G) reflected by the dichroic mirror 1105 enters the liquid crystal light valve 1220 via the relay lens 1204. The blue light (B) transmitted through the dichroic mirror 1105 enters the liquid crystal light valve 1230 via a light guide system including three relay lenses 1201, 1202, 1203 and two reflection mirrors 1107, 1108.

液晶ライトバルブ1210,1220,1230は、クロスダイクロイックプリズム1206の色光ごとの入射面に対してそれぞれ対向配置されている。液晶ライトバルブ1210,1220,1230に入射した色光は、映像情報(映像信号)に基づいて変調されクロスダイクロイックプリズム1206に向けて射出される。   The liquid crystal light valves 1210, 1220, and 1230 are disposed to face the incident surfaces of the cross dichroic prism 1206 for each color light. The color light incident on the liquid crystal light valves 1210, 1220, and 1230 is modulated based on video information (video signal) and emitted toward the cross dichroic prism 1206.

このプリズムは、4つの直角プリズムが貼り合わされ、その内面に赤色光を反射する誘電体多層膜と青色光を反射する誘電体多層膜とが十字状に形成されている。これらの誘電体多層膜によって3つの色光が合成されて、カラー画像を表す光が合成される。合成された光は、投射光学系である投射レンズ1207によってスクリーン1300上に投射され、画像が拡大されて表示される。   In this prism, four right-angle prisms are bonded together, and a dielectric multilayer film that reflects red light and a dielectric multilayer film that reflects blue light are formed in a cross shape on the inner surface thereof. The three color lights are synthesized by these dielectric multilayer films, and the light representing the color image is synthesized. The synthesized light is projected on the screen 1300 by the projection lens 1207 which is a projection optical system, and the image is enlarged and displayed.

液晶ライトバルブ1210は、上述した液晶装置1が適用されたものである。液晶装置1は、色光の入射側と射出側とにおいてクロスニコルに配置された一対の偏光素子の間に隙間を置いて配置されている。他の液晶ライトバルブ1220,1230も同様である。   The liquid crystal light valve 1210 is one to which the liquid crystal device 1 described above is applied. The liquid crystal device 1 is arranged with a gap between a pair of polarizing elements arranged in crossed Nicols on the incident side and the emission side of colored light. The same applies to the other liquid crystal light valves 1220 and 1230.

このような投射型表示装置1000には、液晶ライトバルブ1210,1220,1230を用いているので、高い信頼性を得ることができる。   Since the liquid crystal light valves 1210, 1220, and 1230 are used in such a projection display device 1000, high reliability can be obtained.

なお、液晶装置1が搭載される電子機器としては、投射型表示装置1000の他、CCD(Charge Coupled Device)などの受光素子、ヘッドアップディスプレイ(HUD)、ヘッドマウントディスプレイ(HMD)、スマートフォン、EVF(Electrical View Finder)、モバイルミニプロジェクター、電子ブック、携帯電話、モバイルコンピューター、デジタルカメラ、デジタルビデオカメラ、ディスプレイ、車載機器、オーディオ機器、露光装置や照明機器など各種電子機器に用いることができる。   As the electronic device on which the liquid crystal device 1 is mounted, in addition to the projection display device 1000, a light receiving element such as a CCD (Charge Coupled Device), a head-up display (HUD), a head-mounted display (HMD), a smartphone, EVF (Electrical View Finder), mobile mini projectors, electronic books, mobile phones, mobile computers, digital cameras, digital video cameras, displays, in-vehicle devices, audio devices, exposure devices, lighting devices, and various other electronic devices.

以上詳述したように、本実施形態のマイクロレンズ基板50及び液晶装置1によれば、以下に示す効果が得られる。   As described above in detail, according to the microlens substrate 50 and the liquid crystal device 1 of the present embodiment, the following effects can be obtained.

(1)本実施形態のマイクロレンズ基板50によれば、第1透光性層51aを覆うように屈折率の異なる第2透光性層51bを配置してマイクロレンズの曲面を構成するので、第1透光性層51aでは未完成なマイクロレンズの形状を、第2透光性層51bで補うことが可能となる。言い換えれば、隣り合う第2マイクロレンズ51間の隙間をなくすことができる。よって、正規のマイクロレンズの曲面に近い第2マイクロレンズ51を提供することができる。更に、第1透光性層51aと第2透光性層51bとの屈折率を異ならせるので、第2マイクロレンズ51による集光効率を高めることができる。加えて、狭画素ピッチになった場合、レンズ形状を作りこむことが可能となるので、高精細化を実現することができる。   (1) According to the microlens substrate 50 of the present embodiment, the second light-transmitting layer 51b having a different refractive index is disposed so as to cover the first light-transmitting layer 51a, thereby forming the curved surface of the microlens. In the first light transmissive layer 51a, the shape of an incomplete microlens can be supplemented by the second light transmissive layer 51b. In other words, the gap between the adjacent second microlenses 51 can be eliminated. Therefore, it is possible to provide the second microlens 51 close to the curved surface of a regular microlens. Furthermore, since the refractive index of the 1st translucent layer 51a and the 2nd translucent layer 51b is varied, the condensing efficiency by the 2nd micro lens 51 can be improved. In addition, since the lens shape can be created when the pixel pitch becomes narrow, high definition can be realized.

(2)本実施形態のマイクロレンズ基板50によれば、第1透光性層51aを覆う第2透光性層51bの屈折率の方が小さいので、凸型の第2マイクロレンズ51において、光を集光させることができる。また、凸型の第2マイクロレンズ51と凹型の第1マイクロレンズ44とが一対になるように対向配置されたダブルマイクロレンズ構造になっているので、更なる光利用効率を高めることができる。   (2) According to the microlens substrate 50 of the present embodiment, since the refractive index of the second light transmissive layer 51b covering the first light transmissive layer 51a is smaller, in the convex second microlens 51, Light can be collected. In addition, since the second microlens 51 having the convex shape and the first microlens 44 having the concave shape are arranged so as to face each other in a pair, the light utilization efficiency can be further increased.

(3)本実施形態の液晶装置1によれば、上記マイクロレンズ基板50を備えるので、集光効率を高めることが可能な液晶装置1を提供することができる。   (3) According to the liquid crystal device 1 of the present embodiment, since the microlens substrate 50 is provided, it is possible to provide the liquid crystal device 1 that can increase the light collection efficiency.

なお、本発明の態様は、上記した実施形態に限られるものではなく、請求の範囲及び明細書全体から読み取れる発明の要旨あるいは思想に反しない範囲で適宜変更可能であり、本発明の態様の技術範囲に含まれるものである。また、以下のような形態で実施することもできる。   The aspect of the present invention is not limited to the above-described embodiment, and can be appropriately changed without departing from the spirit or idea of the invention that can be read from the claims and the entire specification. It is included in the range. Moreover, it can also implement with the following forms.

(変形例1)
上記したように、マイクロレンズ基板は、対向配置された2つのマイクロレンズ(第1マイクロレンズ44、第2マイクロレンズ51)を備えた形態に限定されず、第2マイクロレンズ51のみを備えた液晶装置であってもよい。図13は、変形例のマイクロレンズ基板150を備えた液晶装置101の構成を示す模式断面図である。
(Modification 1)
As described above, the microlens substrate is not limited to the form including the two microlenses (the first microlens 44 and the second microlens 51) arranged to face each other, but the liquid crystal including only the second microlens 51. It may be a device. FIG. 13 is a schematic cross-sectional view illustrating a configuration of a liquid crystal device 101 including a modified microlens substrate 150.

変形例のマイクロレンズ基板150は、パス層43上(液晶層15側)に、第1透光性層51aと第2透光性層51bとを有する第2マイクロレンズ51が配置されている。   In the microlens substrate 150 of the modified example, the second microlens 51 having the first light transmissive layer 51a and the second light transmissive layer 51b is disposed on the pass layer 43 (the liquid crystal layer 15 side).

これによれば、第1マイクロレンズ44を有しないものの、第2マイクロレンズ51の形状が正規の形状に近づけて形成されているので、集光効率が高められる液晶装置101を提供することができる。   According to this, although the first microlens 44 is not provided, since the shape of the second microlens 51 is formed close to a regular shape, it is possible to provide the liquid crystal device 101 that can improve the light collection efficiency. .

(変形例2)
上記したように、凸型の第2マイクロレンズ51を2層にして正規のマイクロレンズの形状に造り込むことに限定されず、例えば、凹型のマイクロレンズを2層にして正規のマイクロレンズの形状に造り込むようにしてもよい。
(Modification 2)
As described above, the present invention is not limited to forming a regular microlens with two layers of convex second microlenses 51; for example, the shape of a regular microlens with two layers of concave microlenses. You may make it build in.

3a…走査線、3b…容量線、3c…下側遮光層、CNT1〜CNT4…コンタクトホール、6a…データ線、10…素子基板、10a…第1基材、11a…下地絶縁層、11b…第1層間絶縁層、11c…第2層間絶縁層、11d…第3層間絶縁層、11g…ゲート絶縁層、14…シール材、15…液晶層、16…容量素子、16a…第1容量電極、16b…第2容量電極、16c…誘電体膜、18…遮光層、20…対向基板、20a…第2基材、22…データ線駆動回路、24…走査線駆動回路、25…検査回路、26…上下導通部、27…画素電極、28,32…配向膜、29…配線、30…TFT、30a…半導体層、30c…チャネル領域、30d…画素電極側ソースドレイン領域、30d1…画素電極側LDD領域、30g…ゲート電極、30s…データ線側ソースドレイン領域、30s1…データ線側LDD領域、31…対向電極、33…絶縁層、35…外部接続用端子、41…入射側レンズ層、42…出射側レンズ層、43…パス層、44…第1マイクロレンズ、44a…凹部、44b…レンズ層、50…マイクロレンズ基板、51…第2マイクロレンズ、51a…第1透光性層、51b…第2透光性層、51c…前駆体層、51e…レジスト膜、51e1…レジストパターン、51e2…レジストパターン、53…酸化膜、54…ポリシリコン膜、54a…開口孔、54b…マスク、100…液晶パネル、101…液晶装置、150…マイクロレンズ基板、1000…投射型表示装置、1100…偏光照明装置、1101…ランプユニット、1102…インテグレーターレンズ、1103…偏光変換素子、1104,1105…ダイクロイックミラー、1106,1107,1108…反射ミラー、1201,1202,1203,1204,1205…リレーレンズ、1206…クロスダイクロイックプリズム、1207…投射レンズ、1210,1220,1230…液晶ライトバルブ、1300…スクリーン。   3a ... scanning line, 3b ... capacitance line, 3c ... lower light shielding layer, CNT1 to CNT4 ... contact hole, 6a ... data line, 10 ... element substrate, 10a ... first substrate, 11a ... underlying insulating layer, 11b ... first DESCRIPTION OF SYMBOLS 1 interlayer insulation layer, 11c ... 2nd interlayer insulation layer, 11d ... 3rd interlayer insulation layer, 11g ... Gate insulation layer, 14 ... Sealing material, 15 ... Liquid crystal layer, 16 ... Capacitance element, 16a ... 1st capacitance electrode, 16b 2nd capacitance electrode 16c Dielectric film 18 Light shielding layer 20 Counter substrate 20a Second substrate 22 Data line drive circuit 24 Scan line drive circuit 25 Inspection circuit 26 Vertical conduction portion, 27... Pixel electrode, 28 and 32... Orientation film, 29 .. wiring, 30... TFT, 30 a... Semiconductor layer, 30 c... Channel region, 30 d. 30g ... 30 s... Data line side source / drain region, 30 s 1... Data line side LDD region, 31 .. Counter electrode, 33 .. Insulating layer, 35 .. External connection terminal, 41. , 43 ... pass layer, 44 ... first microlens, 44a ... recess, 44b ... lens layer, 50 ... microlens substrate, 51 ... second microlens, 51a ... first translucent layer, 51b ... second translucent 51c ... precursor layer, 51e ... resist film, 51e1 ... resist pattern, 51e2 ... resist pattern, 53 ... oxide film, 54 ... polysilicon film, 54a ... open hole, 54b ... mask, 100 ... liquid crystal panel, 101 ... Liquid crystal device, 150 ... Microlens substrate, 1000 ... Projection type display device, 1100 ... Polarized illumination device, 1101 ... Lamp unit, 1102 ... Integral Motor lens 1103 ... polarization conversion element 1104 1105 dichroic mirror 1106 1107 1108 reflection mirror 1201 1202 1203 1204 1205 relay lens 1206 cross dichroic prism 1207 projection lens 1210 1220, 1230 ... Liquid crystal light valve, 1300 ... Screen.

Claims (5)

第1透光性層と、
前記第1透光性層のレンズ曲面に沿って形成され、前記第1透光性層とは異なる屈折率を有する第2透光性層と、
を備えたことを特徴とするマイクロレンズ基板。
A first light transmissive layer;
A second translucent layer formed along a lens curved surface of the first translucent layer and having a refractive index different from that of the first translucent layer;
A microlens substrate comprising:
請求項1に記載のマイクロレンズ基板であって、
前記第1透光性層の上に配置された前記第2透光性層を含むマイクロレンズは、凸型のマイクロレンズであることを特徴とするマイクロレンズ基板。
The microlens substrate according to claim 1,
The microlens substrate, wherein the microlens including the second translucent layer disposed on the first translucent layer is a convex microlens.
請求項1又は請求項2に記載のマイクロレンズ基板であって、
前記第1透光性層の屈折率は、前記第2透光性層の屈折率より大きいことを特徴とするマイクロレンズ基板。
The microlens substrate according to claim 1 or 2,
The microlens substrate according to claim 1, wherein a refractive index of the first light transmissive layer is larger than a refractive index of the second light transmissive layer.
請求項2又は請求項3に記載のマイクロレンズ基板であって、
前記第1透光性層及び前記第2透光性層を含む前記凸型のマイクロレンズと、凹型のマイクロレンズとが対向するように配置されていることを特徴とするマイクロレンズ基板。
The microlens substrate according to claim 2 or 3, wherein
A microlens substrate, wherein the convex microlens including the first translucent layer and the second translucent layer is disposed so as to face a concave microlens.
請求項1乃至請求項4のいずれか一項に記載のマイクロレンズ基板を備えることを特徴とする電気光学装置。   An electro-optical device comprising the microlens substrate according to claim 1.
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2018146878A (en) * 2017-03-08 2018-09-20 カンタツ株式会社 Lens element and image capturing lens unit
JP2021033110A (en) * 2019-08-27 2021-03-01 セイコーエプソン株式会社 Electro-optical device manufacturing method, electro-optical device, and electronic apparatus
JP2021060516A (en) * 2019-10-08 2021-04-15 セイコーエプソン株式会社 Method for manufacturing electro-optical device, electro-optical device, and electronic apparatus

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2018146878A (en) * 2017-03-08 2018-09-20 カンタツ株式会社 Lens element and image capturing lens unit
CN108572424A (en) * 2017-03-08 2018-09-25 康达智株式会社 Lens member and pick-up lens unit
US10545350B2 (en) 2017-03-08 2020-01-28 Kantatsu Co., Ltd. Lens element and imaging lens unit
JP2021033110A (en) * 2019-08-27 2021-03-01 セイコーエプソン株式会社 Electro-optical device manufacturing method, electro-optical device, and electronic apparatus
JP2021060516A (en) * 2019-10-08 2021-04-15 セイコーエプソン株式会社 Method for manufacturing electro-optical device, electro-optical device, and electronic apparatus

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