JP2015041171A - 信号処理装置 - Google Patents
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Abstract
【解決手段】信号処理装置は、第1の信号〜第5の信号の順に取得する第1のパターン160、及び第iの信号〜第5の信号、第1の信号〜第(i−1)の信号の順(ただし、i=1の場合は第1のパターン160と同じ順、i=2の場合は第2の信号〜第5の信号、第1の信号、i=5の場合は第5の信号、第1の信号〜第4の信号の順)に取得する第2のパターン161を交互に繰り返すことで、第1の信号〜第5の信号を取得する基本周期は変えずに、それぞれの信号が取得される取得周期を変更する制御部を備えて概略構成されている。
【選択図】図2
Description
実施の形態に係る信号処理装置は、第1の信号乃至第nの信号(nは3以上の整数)の順に取得する第1のパターン、及び第iの信号乃至第nの信号、第1の信号乃至第(i−1)の信号の順(ただし、i=1の場合は第1のパターンと同じ順、i=2の場合は第2の信号乃至第nの信号、第1の信号の順、i=nの場合は第nの信号、第1の信号乃至第(n−1)の信号の順)に取得する第2のパターン、を交互に繰り返すことで、第1の信号乃至第nの信号を取得する基本周期は変えずに、それぞれの信号が取得される取得周期を変更する信号取得部を備えて概略構成されている。
(信号処理装置1の構成)
図1は、第1の実施の形態に係る信号処理装置のブロック図である。本実施の形態に係る信号処理装置1は、図1に示すように、取得された第1の信号S1〜第5の信号S5に予め定められた処理を施して、処理した結果である処理情報S50を電磁気的に接続された電子機器(含む電子回路)に出力するように概略構成されている。
制御部10は、例えば、記憶されたプログラムに従って、取得した信号等に演算、加工等を行うCPU(Central Processing Unit)、半導体メモリであるRAM(Random Access Memory)及びROM(Read Only Memory)等から構成されるマイクロコンピュータである。このROMには、例えば、制御部10が動作するためのプログラムが格納されている。RAMは、例えば、一時的に演算結果等を格納する記憶領域として用いられる。
切替部12は、例えば、入力する複数の信号から選択された信号としての第jの信号Sjを出力するように構成されたマルチプレクサである。なお、本実施の形態におけるjは、1以上5以下の整数である。
信号処理部14は、入力した第1の信号S1〜第5の信号S5を処理した処理値S30を生成し、制御部10に出力するように構成されている。
第1の記憶部16は、例えば、半導体メモリを用いた記憶装置である。この第1の記憶部16に記憶された第1のパターン160は、制御部10に読み込まれることにより、第1の信号S1〜第5の信号S5の順に信号を取得するように切替部12を制御させることが可能となるように構成されている。
第2の記憶部18は、例えば、半導体メモリを用いた記憶装置である。この第2の記憶部18が記憶する蓄積情報180は、例えば、時系列的に蓄積された第1の信号S1の複数の処理値S30、第2の信号S2の複数の処理値S30、第3の信号S3の複数の処理値S30、第4の信号S4の複数の処理値S30、及び第5の信号S5の複数の処理値S30を含んで構成されている。
クロック信号生成部20は、信号処理装置1が動作するための基準となるクロック信号S40を生成するように構成されている。制御部10は、このクロック信号S40に基づいた基本周期で、第1の信号S1〜第5の信号S5を取得するように構成されている。
カウント部22は、制御部10の制御に基づいてカウント値x及びカウント値yのカウントアップ及びリセットを行うように構成されている。カウントアップは、カウント値x及びカウント値yを+1増加させることで行われる。
通信部24は、例えば、信号処理装置1と電磁気的に接続された電子機器と通信を行うことが可能となるように構成されている。
図2(a)〜(f)は、第1の実施の形態に係る信号処理装置の動作を説明するための概略図である。この図2(a)は、一例として、信号処理装置1が影響を受ける不可避的な周期的なノイズの波形を示している。図2(b)は、第1の信号S1を取得するタイミングを示す矩形波、(c)は、第2の信号S2を取得するタイミングを示す矩形波、(d)は、第3の信号S3を取得するタイミングを示す矩形波、(e)は、第4の信号S4を取得するタイミングを示す矩形波、及び(f)は、第5の信号S5を取得するタイミングを示す矩形波を示している。信号の取得は、図2(b)〜(f)に示す矩形波の立ち上がりで行われるものとする。
まず、信号処理装置1の制御部10は、電力が供給された後、第1の記憶部16から第1のパターン160を読み出し、第1のパターン160を実行する(S1)。
第1の実施の形態に係る信号処理装置1は、不可避的に信号に付加された周期的なノイズによる信号の振幅の変化を抑制すると共に処理の負荷を抑制することができる。具体的には、信号処理装置1は、第1のパターン160と第2のパターン161を交互に繰り返すことにより、基本周期は変えずに、それぞれの信号が取得される取得周期が変更されるので、信号を同じ周期で取得する場合と比べて、取得した信号の平均を算出する平均化処理により、容易に信号の振幅の変化を抑制し、ノイズの影響を抑制することができる。
第2の実施の形態は、静電容量式のタッチセンサからの信号を処理する点で第1の実施の形態と異なっている。
図5(a)〜(k)は、第2の実施の形態に係る信号処理装置の動作を説明するための概略図である。この図5(a)は、一例として、信号処理装置1が影響を受ける周期的なノイズの波形を示している。図5(b)〜(k)は、第1の電極41〜第10の電極50の第1の信号S1〜第10の信号S10を取得するタイミングを示す矩形波を示している。
まず、信号処理装置1の制御部10は、電力が供給された後、第1の記憶部16から第1のパターン160を読み出し、第1のパターン160を実行する(S1)。
第2の実施の形態に係る信号処理装置1は、周期的なノイズが、静電容量を示す第1の信号S1〜第10の信号S10に付加された場合であっても、それぞれの信号を取得する取得周期を変更することができるので、ノイズの影響による操作の誤判定を抑制すると共に、周期を変更するものと比べて、処理の負荷が小さくて済み、低コストで製造することができる。
10…制御部
12…切替部
14…信号処理部
16…第1の記憶部
18…第2の記憶部
20…クロック信号生成部
22…カウント部
24…通信部
41〜50…第1の電極〜第10の電極
160…第1のパターン
161…第2のパターン
180…蓄積情報
220…カウント情報
Claims (6)
- 第1の信号乃至第nの信号(nは3以上の整数)の順に取得する第1のパターン、及び第iの信号乃至前記第nの信号、前記第1の信号乃至第(i−1)の信号の順(ただし、i=1の場合は前記第1のパターンと同じ順、i=2の場合は第2の信号乃至前記第nの信号、前記第1の信号の順、i=nの場合は前記第nの信号、前記第1の信号乃至第(n−1)の信号の順)に取得する第2のパターン、を交互に繰り返すことで、前記第1の信号乃至前記第nの信号を取得する基本周期は変えずに、それぞれの信号が取得される取得周期を変更する信号取得部を備えた信号処理装置。
- 前記第1のパターン及び前記第2のパターンを記憶する第1の記憶部を有する、
請求項1に記載の信号処理装置。 - 前記第1の信号乃至前記第nの信号が入力し、前記信号取得部の制御に基づいて前記信号取得部との接続を切り替えて前記第1の信号乃至前記第nの信号から選ばれた信号を前記信号取得部に出力する切替部を有する、
請求項1又は2に記載の信号処理装置。 - 前記切替部から出力された前記選ばれた信号を処理して得られた処理値を前記信号取得部に出力する信号処理部を有する、
請求項3に記載の信号処理装置。 - 前記信号処理部から出力された前記処理値を前記第1の信号乃至前記第nの信号に関連付けて時系列的に蓄積した蓄積情報を記憶する第2の記憶部を有する、
請求項4に記載の信号処理装置。 - 前記信号取得部は、前記第2の記憶部に記憶された前記蓄積情報に基づいて前記第1の信号乃至前記第nの信号に関連付けられた前記処理値の平均値を算出する、
請求項5に記載の信号処理装置。
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JP2009535742A (ja) * | 2006-05-02 | 2009-10-01 | アップル インコーポレイテッド | マルチポイントタッチ表面コントローラ |
JP2012221423A (ja) * | 2011-04-13 | 2012-11-12 | Japan Display West Co Ltd | タッチ検出機能付き表示パネルおよびその駆動方法、駆動回路、ならびに電子機器 |
WO2013069289A1 (ja) * | 2011-11-11 | 2013-05-16 | パナソニック株式会社 | タッチパネル装置 |
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