JP2014160066A - 帯域幅を最大化しバイアス制御を提供するための低インピーダンスインターフェース回路 - Google Patents
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Abstract
【解決手段】ASIC120は、フロントエンド回路410に動作可能に結合されており、離散的アナログ信号の組合せに基づいてヒット信号を生成するように構成されている時間判定回路420と、フロントエンド回路410に動作可能に結合されており、離散的アナログ信号の各々に基づいて合計エネルギー出力信号を生成し、離散的アナログ信号の各々に基づいて合計行出力信号および合計列出力信号を生成するように構成されているエネルギー判定回路430とをさらに含む。合計エネルギー出力信号は光検出器のアレイ内の検出した放射のエネルギーレベルを表し、合計行出力信号および合計列出力信号は、放射を検出したロケーションを表す。
【選択図】図5
Description
12 近位端
14 遠位端
16 MRI構成要素
18 PET撮像構成要素
20 ベッド(またはテーブル)
24 勾配磁場コイルアセンブリ
26 分極主磁石
28 RFコイルアセンブリ
30 検出器
40 コンピュータシステム
50 制御システム
52 コントローラ
54 通信ネットワーク
100 PETデータ取得システム
110 SiPM
112 アノード出力
120 ASIC
122 タイミング信号
124 エネルギー信号
126 位置信号
410 フロントエンド回路
412 増幅器
414 ライン
416 ライン
417 ライン
418 ライン
420 時間判定回路
422 出力
430 エネルギー判定回路
431 重み
432 エネルギー情報出力
433 重み
434 位置情報出力
435 重み
440 バイアス生成回路
442 DAC
510 バイアス電圧
512 抵抗器
514 ダイオード
516 キャパシタ
Claims (10)
- 陽電子放射断層撮影(PET)撮像システム内の光検出器のアレイとインターフェースするためのマルチチャネル特定用途向け集積回路(ASIC)であって、該ASICは、
前記光検出器のアレイに結合され、そこから複数の離散的アナログ信号を受信するように構成されているフロントエンド回路と、
前記フロントエンド回路に動作可能に結合されており、前記離散的アナログ信号の組合せに基づいてヒット信号を生成するように構成されている時間判定回路であって、前記ヒット信号は、前記光検出器のアレイが放射を検出したという指示を表す、時間判定回路と、
前記フロントエンド回路に動作可能に結合されており、前記離散的アナログ信号の各々に基づいて合計エネルギー出力信号を生成し、ならびに、前記離散的アナログ信号の各々に基づいて合計行出力信号および合計列出力信号を生成するように構成されているエネルギー判定回路であって、前記合計エネルギー出力信号は、前記光検出器のアレイ内の前記検出した放射のエネルギーレベルを表し、前記合計行出力信号および合計列出力信号は、前記光検出器のアレイ内の前記放射を検出したロケーションを表す、エネルギー判定回路と
を備える、ASIC。 - 前記フロントエンド回路と前記時間判定回路との間に動作可能に結合されている第1のチャネルと、
各々が前記フロントエンド回路と前記エネルギー判定回路との間に動作可能に結合されている複数の第2のチャネルと
をさらに備える、請求項1記載のASIC。 - 前記フロントエンド回路は、
前記第1のチャネルを使用して前記離散的アナログ信号の組合せを前記時間判定回路に転送し、
前記複数の第2のチャネルのうちの対応するものを使用して前記離散的アナログ信号の各々を前記エネルギー判定回路に転送するようにさらに構成されている、請求項2記載のASIC。 - 前記フロントエンド回路は、
前記光検出器のアレイ内の1つの光検出器のアノードに動作可能に結合されているフロントエンド入力と、
カレントミラーと、
前記フロントエンド入力と前記カレントミラーとの間に動作可能に結合されているフィードバックネットワークと、
前記フロントエンド入力に動作可能に結合されている反転入力、バイアス電圧に動作可能に結合されている非反転入力、および出力を有する増幅器と、
前記フロントエンド入力に動作可能に結合されているソース、前記カレントミラーに動作可能に結合されているシンク、および前記増幅器の前記出力に動作可能に結合されているゲートを有するトランジスタと、
前記カレントミラーおよび前記第1のチャネルに動作可能に結合されている第1のフロントエンド出力と、
前記複数の第2のチャネルのうちの対応するものに動作可能に結合されている第2のフロントエンド出力と
をさらに備える、請求項3記載のASIC。 - 前記フロントエンド回路は、複数のバイアス電圧を使用して前記アレイ内の個々の光検出器をイネーブルおよびディセーブルするようにさらに構成されている、請求項4記載のASIC。
- 前記フロントエンド回路に動作可能に結合されており、前記複数のバイアス電圧を生成するように構成されているバイアス回路をさらに備える、請求項5記載のASIC。
- 前記バイアス回路は、マルチチャネルデジタル−アナログ変換器を含む、請求項6記載のASIC。
- 前記フロントエンド回路は、前記光検出器のアレイ内の各光検出器のアノードに結合されている、請求項1記載のASIC。
- 前記フロントエンド回路に動作可能に結合されており、該フロントエンド回路を介して前記アレイ内の個々の光検出器をイネーブルおよびディセーブルするように構成されているコントローラをさらに備える、請求項1記載のASIC。
- 前記フォトダイオードのアレイは、ガイガーモードアバランシェフォトダイオードのアレイを含む、請求項1記載のASIC。
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