JP2014060344A - Semiconductor module manufacturing method and semiconductor module - Google Patents
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Abstract
Description
本発明は、半導体チップがモールド樹脂層中に封止され、半導体チップの放熱を行う放熱板がモールド樹脂層の下面に露出した構成を具備する半導体モジュールに関する。 The present invention relates to a semiconductor module having a configuration in which a semiconductor chip is sealed in a mold resin layer, and a heat radiating plate for radiating heat from the semiconductor chip is exposed on the lower surface of the mold resin layer.
一般に、半導体チップが使用される際には、半導体チップが金属板上に搭載された構造が絶縁性のモールド樹脂層中に封止され、モールド樹脂層から端子となるリードが導出した構成をもつ半導体モジュールとされる。ここで、特に半導体チップがパワー半導体チップ(パワーMOSFETやIGBT等)である場合には、半導体チップからの放熱が効率的に行われることが要求される。この放熱は、主に半導体チップを搭載する金属板を介してなされる。この金属板自身を一つの端子として使用することもできる。一方、モールド樹脂層の下面と半導体チップ等とを電気的に絶縁する構成とする場合もある。こうした場合においても、放熱のために、モールド樹脂層の下面には金属で構成された放熱板を設けることが好ましい。この場合には、半導体チップを搭載する金属板と放熱板とが電気的に絶縁され、かつこれらの間における熱伝導効率が高くなることが要求される。 In general, when a semiconductor chip is used, a structure in which the semiconductor chip is mounted on a metal plate is sealed in an insulating mold resin layer, and a lead serving as a terminal is derived from the mold resin layer. A semiconductor module is used. Here, in particular, when the semiconductor chip is a power semiconductor chip (power MOSFET, IGBT, etc.), it is required that heat dissipation from the semiconductor chip be performed efficiently. This heat dissipation is mainly performed through a metal plate on which a semiconductor chip is mounted. This metal plate itself can also be used as one terminal. On the other hand, the lower surface of the mold resin layer may be electrically insulated from the semiconductor chip and the like. Even in such a case, it is preferable to provide a heat sink made of metal on the lower surface of the mold resin layer for heat dissipation. In this case, it is required that the metal plate on which the semiconductor chip is mounted and the heat radiating plate are electrically insulated and the heat conduction efficiency between them is increased.
図5は、この構成の半導体モジュール90の一例を模式的に示す上面図(a)、そのA−A方向の断面図(b)である。この半導体モジュール90においては、半導体チップ91、92がはんだ層93を介してそれぞれダイパッド(金属板)94、95の表面に搭載されている。このダイパッド94、95の裏面は、接着樹脂層96と絶縁樹脂層97を介して放熱板98に接合されている。ダイパッド94、95の一部は平面視(図5(a))において左右に突出した形態とされ、それぞれこの半導体モジュール90におけるリード端子の一つとされる。また、ダイパッド94、95と電気的に独立したリード端子99も設けられる。半導体チップ91、92とダイパッド94、95、リード端子99の間の電気的接続は、ボンディングワイヤ100を接続することによってなされる。これにより、この半導体モジュール90においては、半導体チップ91、92を用いて電気回路が構成され、かつその入出力が各リード端子を用いて行われる。
FIG. 5 is a top view (a) schematically showing an example of the
図5(b)に示されるように、半導体チップ91、92等はモールド樹脂層101の中に封止され、放熱板98の下面がモールド樹脂層101の下面に露出する形態とされる。図5(a)においては、モールド樹脂層101を透視した上面図が示されている。なお、図5に示された構成は従来の構造を模式的にしており、実際にはリード端子の数はより多く、半導体チップとリード端子間の接続もより複雑である。
As shown in FIG. 5B, the
この構成においては、放熱性を高めるために放熱板98の露出した裏面(図5中の下面)を介して半導体チップ91、92からの放熱が行われる。このため、放熱板98を構成する金属は、熱伝導率の高い銅とされる場合が多い。
In this configuration, heat is radiated from the
銅やその合金の表面は非常に不安定で腐食や酸化が発生しやすいため、一般に、銅等の金属板の表面には腐食や酸化防止のために各種のコーティングが施されて使用される場合が多い。例えば、特許文献1には、鋼板の表面に対して各種の処理、例えばシリケート処理(シリケート化合物層を表面に形成する処理)を行うことが記載されている。また、特許文献2には、多層配線基板における銅配線に対してシリケート処理を行い、層間絶縁膜(シリコン酸化膜等)との間の密着性を高めることが記載されている。 Since the surface of copper and its alloys is very unstable and prone to corrosion and oxidation, the surface of a metal plate such as copper is generally used with various coatings applied to prevent corrosion and oxidation. There are many. For example, Patent Document 1 describes performing various treatments, for example, silicate treatment (treatment for forming a silicate compound layer on the surface) on the surface of a steel sheet. Further, Patent Document 2 describes that a silicate treatment is performed on a copper wiring in a multilayer wiring board to improve the adhesion with an interlayer insulating film (silicon oxide film or the like).
前記の半導体モジュール90において用いられる放熱板98においては、酸化や腐食を抑制する、あるいは放熱性を高める観点からは、上記のようなシリケート処理は有効である。しかしながら、一方で、こうした表面処理が施された場合においては、また、特許文献2に記載の層間絶縁膜(シリコン酸化膜等)と銅(配線)との間とは異なり、エポキシ樹脂等の樹脂材料で構成されたモールド樹脂層101等と放熱板98との間の密着性は悪くなった。このため、こうした処理が放熱板に対して行われた半導体モジュールの信頼性は低くなった。
In the
すなわち、裏面に露出した放熱板による高い放熱性と、高い信頼性とを兼ね備える半導体モジュールを得ることは困難であった。 That is, it has been difficult to obtain a semiconductor module that has both high heat dissipation by the heat sink exposed on the back surface and high reliability.
本発明は、かかる問題点に鑑みてなされたものであり、上記問題点を解決する発明を提供することを目的とする。 The present invention has been made in view of such problems, and an object thereof is to provide an invention that solves the above problems.
本発明は、上記課題を解決すべく、以下に掲げる構成とした。
本発明の半導体モジュールの製造方法は、半導体チップがモールド樹脂層中に封止され、前記モールド樹脂層の下面において放熱板の下面を露出させた構成を具備する半導体モジュールの製造方法であって、前記放熱板の主体となる金属板の下面においてシリケート化合物を含むシリケート層を形成し、かつ前記金属板の側面には前記シリケート層を形成しないように前記放熱板を製造する放熱板製造工程と、前記シリケート層が形成された前記放熱板の下面が露出するように、前記放熱板の上面側において前記半導体チップを封止するように前記モールド樹脂層を形成するモールド工程と、を具備することを特徴とする。
本発明の半導体モジュールの製造方法は、前記放熱板製造工程において、前記放熱板よりも大きな金属平板における一方の主面において前記シリケート層を形成した後に、前記金属平板を切断することによって前記放熱板を得ることを特徴とする。
本発明の半導体モジュールの製造方法は、前記放熱板製造工程において、前記シリケート層を構成する材料が揮発性溶媒に熔解された塗布液を前記金属平板に塗布することによって、前記シリケート層を形成することを特徴とする。
本発明の半導体モジュールの製造方法は、前記モールド工程の前に、前記半導体チップをリードフレームに搭載するチップ搭載工程と、前記リードフレームの下面を前記放熱板の上面に絶縁樹脂層を介して接合する接合工程と、を具備することを特徴とする。
本発明の半導体モジュールの製造方法は、前記モールド工程の後で、前記モールド樹脂層を構成する材料が前記放熱板の下面の表面において硬化した部分を剥離除去することを特徴とする。
本発明の半導体モジュールは、前記半導体モジュールの製造方法によって製造されたことを特徴とする。
本発明の半導体モジュールは、半導体チップがモールド樹脂層中に封止され、前記モールド樹脂層の下面において放熱板の下面を露出させた構成を具備する半導体モジュールであって、前記放熱板は、その主体となる金属板の下面においてシリケート化合物を含むシリケート層が形成され、かつ前記金属板の側面には前記シリケート層が形成されないことを特徴とする。
本発明の半導体モジュールは、前記モールド樹脂層中において、前記半導体チップがリードフレームに搭載され、前記リードフレームの下面が前記放熱板の上面に絶縁樹脂層を介して接合されたことを特徴とする。
In order to solve the above problems, the present invention has the following configurations.
The method for producing a semiconductor module of the present invention is a method for producing a semiconductor module comprising a configuration in which a semiconductor chip is sealed in a mold resin layer, and the lower surface of the heat sink is exposed on the lower surface of the mold resin layer, Forming a silicate layer containing a silicate compound on the lower surface of the metal plate as a main body of the heat sink, and manufacturing the heat sink so as not to form the silicate layer on the side surface of the metal plate; and Forming a mold resin layer so as to seal the semiconductor chip on the upper surface side of the heat sink so that the lower surface of the heat sink on which the silicate layer is formed is exposed. Features.
In the method of manufacturing a semiconductor module according to the present invention, in the heat sink manufacturing step, the heat sink is formed by cutting the metal flat plate after forming the silicate layer on one main surface of the metal flat plate larger than the heat sink. It is characterized by obtaining.
In the method of manufacturing a semiconductor module according to the present invention, in the heat sink manufacturing step, the silicate layer is formed by applying a coating solution in which a material constituting the silicate layer is dissolved in a volatile solvent to the metal flat plate. It is characterized by that.
In the semiconductor module manufacturing method of the present invention, before the molding step, a chip mounting step of mounting the semiconductor chip on a lead frame, and a lower surface of the lead frame are joined to an upper surface of the heat sink via an insulating resin layer. And a joining step.
The method for manufacturing a semiconductor module according to the present invention is characterized in that, after the molding step, a portion where the material constituting the mold resin layer is cured on the surface of the lower surface of the heat sink is peeled and removed.
The semiconductor module of the present invention is manufactured by the method for manufacturing a semiconductor module.
The semiconductor module of the present invention is a semiconductor module having a configuration in which a semiconductor chip is sealed in a mold resin layer, and the lower surface of the heat sink is exposed on the lower surface of the mold resin layer, A silicate layer containing a silicate compound is formed on the lower surface of the main metal plate, and the silicate layer is not formed on the side surface of the metal plate.
The semiconductor module of the present invention is characterized in that, in the mold resin layer, the semiconductor chip is mounted on a lead frame, and the lower surface of the lead frame is joined to the upper surface of the heat sink via an insulating resin layer. .
本発明は以上のように構成されているので、裏面に露出した放熱板による高い放熱性と、高い信頼性とを兼ね備える半導体モジュールを得ることができる。 Since this invention is comprised as mentioned above, the semiconductor module which combines the high heat dissipation by the heat sink exposed on the back surface, and high reliability can be obtained.
以下、本発明の実施の形態となる半導体モジュールの製造方法について説明する。ここで製造される半導体モジュールの構造は、放熱板以外については図5に記載のものと同様である。すなわち、半導体チップが搭載されたダイパッドが、絶縁層を介して放熱板に接合された構成がモールド樹脂層中に形成されている。放熱板の裏面(ダイパッドが接合された面と反対側の面)は、モールド樹脂層の裏面に露出し、ここで半導体チップからの放熱が行われる。 Hereinafter, a method for manufacturing a semiconductor module according to an embodiment of the present invention will be described. The structure of the semiconductor module manufactured here is the same as that shown in FIG. 5 except for the heat sink. That is, a structure in which a die pad on which a semiconductor chip is mounted is joined to a heat sink via an insulating layer is formed in the mold resin layer. The back surface of the heat radiating plate (the surface opposite to the surface on which the die pad is bonded) is exposed on the back surface of the mold resin layer, where heat is radiated from the semiconductor chip.
図1は、この半導体モジュール10の模式的な断面図である。この半導体モジュール10においては、半導体チップ11、12がはんだ層13を介してそれぞれダイパッド(金属板)14、15の表面に搭載されている。このダイパッド14、15の裏面は、接着樹脂層16と絶縁樹脂層17を介して放熱板18に接合されている。ダイパッド14、15の一部は平面視において突出した形態とされ、それぞれこの半導体モジュール10におけるリード端子の一つとされる。また、ダイパッド14、15と電気的に独立したリード端子(図示せず)も設けられる。半導体チップ11、12とダイパッド14、15、リード端子の間の電気的接続は、ボンディングワイヤ19を接続することによってなされる。これらの構造はモールド樹脂層20の中に封止され、放熱板18の下面がモールド樹脂層20から露出する形態とされる。この半導体モジュール10の平面構造は図5に示された半導体モジュール90と同様であり、使用された放熱板18の構成が、半導体モジュール90における放熱板98と異なる。
FIG. 1 is a schematic cross-sectional view of the
図1に示されるように、この放熱板18においては、その主体である銅板(金属板)181の裏面(下面)においてのみシリケート層182が形成されている。図1における銅板181の上面、側面にはシリケート層182は形成されていない。銅板181の厚さは例えば400μm程度、シリケート層182の厚さはこれと比べて無視できる程度の例えば0.3μm程度とすることができる。
As shown in FIG. 1, in the
図2(a)〜(f)は、この半導体モジュール10の製造方法の一例の工程断面図である。
2A to 2F are process cross-sectional views illustrating an example of a method for manufacturing the
まず、断面形状が図2(a)で示された形状とされたダイパッド(金属板)14、15が準備される。図2(a)では断面形状が示されており、図におけるダイパッド14、15の屈曲した部分の下側の部分は平面状とされ、ここに半導体チップが搭載できる形態とされる。その平面形状は、図5(a)と同様である。また、ダイパッド14、15は、図中に示された範囲では分離して示されているが、実際には図示された範囲外においてこれらは連結されており、一体化されている。モールド工程後に、この連結部分は切断分離される。
First, die pads (metal plates) 14 and 15 having a cross-sectional shape shown in FIG. 2A are prepared. FIG. 2A shows a cross-sectional shape, and the lower portion of the bent portion of the
次に、図2(b)に示されるように、ダイパッド14、15の上に半導体チップ11、12をそれぞれはんだ層13によって接合する(チップ搭載工程)。更に、ボンディングワイヤ19によって、半導体チップ11、12とダイパッド14、15、リード端子の間の電気的接続を行う。
Next, as shown in FIG. 2B, the semiconductor chips 11 and 12 are joined to the
一方、図2(c)に示されるように、銅板181の裏面(下面)においてのみシリケート層182が形成された放熱板18を準備する(放熱板製造工程)。放熱板製造工程の詳細については後述する。
On the other hand, as shown in FIG. 2C, a
次に、図2(d)に示されるように、放熱板18の上面(シリケート層182が形成されない側の面)に、絶縁樹脂層17,接着樹脂層16を順次形成する。ここで、絶縁樹脂層17、接着樹脂層16は共に熱硬化性樹脂(例えばエポキシ樹脂)で構成することができるが、絶縁樹脂層17は硬化した状態とし、接着樹脂層16は未硬化の状態とする。このためには、例えば未硬化のエポキシ樹脂を放熱板18の上面に塗布後硬化させて絶縁樹脂層17とし、その上に未硬化のエポキシ樹脂を塗布して接着樹脂層16とすることができる。
Next, as shown in FIG. 2D, an insulating
この状態で、図2(e)に示されるように、図2(b)の構造におけるダイパッド14、15の下面側を接着樹脂層16に熱圧着して接着樹脂層16を硬化させ、放熱板18側とダイパッド14、15側とを接合する(接合工程)。
In this state, as shown in FIG. 2 (e), the lower surfaces of the
その後、図2(f)に示される形態で、半導体チップ11、12等がその中に封止され、かつ放熱板18の下面がモールド樹脂層20の下面で露出するように、モールド樹脂層20を形成する(モールド工程)。モールド層20は例えばエポキシ樹脂で構成され、トランスファーモールド、インジェクションモールド等の方法で図2(f)の形状として形成することができる。これによって、図1の構造の半導体モジュール10が製造される。なお、実際にはダイパッド14、15が多数組配列されて一体化されたリードフレームが用いられ、これを用いて上記の工程が行われ、同時に多数の半導体モジュール10が製造された後で、個々の半導体モジュール10が切断分離される。
Thereafter, in the form shown in FIG. 2 (f), the
上記の製造方法は、図2(c)に示された放熱板18が用いられる以外については、従来の製造方法、すなわち図5の半導体モジュール90を製造する製造方法と同様である。
The above manufacturing method is the same as the conventional manufacturing method, that is, the manufacturing method for manufacturing the
次に、上記の放熱板製造工程について説明する。図3(a)〜(c)は、この工程を説明する断面図である。まず、図2(c)における銅板181が多数枚得られる程度の広い面積の銅で構成された銅平板(金属平板)200を準備する。この銅平板200に対して、例えば特開2007−163754号公報に示される薄膜を、図3(b)におけるシリケート層182として形成する。
Next, the heat sink manufacturing process will be described. 3A to 3C are cross-sectional views illustrating this process. First, a copper flat plate (metal flat plate) 200 made of copper having a wide area to the extent that
具体的には、特開2007−163754号公報に示されるように、例えば、表面がポリオルガノシロキサン化合物等のシリケート化合物で覆われた微粒子がトリアセチルセルロース等の有機材料をバインダー中に分散して形成された層を、シリケート層182とする。ここで、微粒子としては、メチル(メタ)アクリレート等の有機材料からなる微粒子、シリカ、アルミナ等の無機材料からなる微粒子等を用いることができる。例えば、これらの成分が更に揮発性溶媒(2−メトキシエタノール等)で希釈混合された塗布液を銅平板200にスピン塗布した後に焼成することによって、このシリケート層182を形成することができる。なお、特開2007−163754号公報に記載の技術においてこの薄膜は光学的な反射防止膜として使用されているが、上記のシリケート層182には光学的な機能は要求されない。このため、シリケート層182が透明である必要はない。
Specifically, as disclosed in JP-A-2007-163754, for example, fine particles whose surface is covered with a silicate compound such as a polyorganosiloxane compound are dispersed in an organic material such as triacetyl cellulose in a binder. The formed layer is a
例えばスピン塗布によってシリケート層182を形成する場合には、シリケート層182を図3(b)における銅平板200の下面側においてのみ容易に形成することができる。このため、図3(b)の形態を容易に実現することができる。その膜厚は、塗布液の粘度やスピン塗布条件で設定することができ、例えばシリケート層182の厚さを1μm以下とすることができる。その後、必要に応じて乾燥や焼成を行うことにより、固化したシリケート層182を得ることができる。
For example, when the
次に、図3(c)に示されるように、ブレード300を用いて図3(b)の状態とされた銅平板200を所望の大きさに切断し、放熱板18とすることができる。放熱板18は、図3(b)の状態とされた銅平板200から多数枚得ることができる。あるいは、銅平板200を破断加工することによって個々の放熱板18を得ることもできる。
Next, as shown in FIG. 3 (c), the copper
図3(c)の状態において、この放熱板18の下面においてのみ シリケート層182が形成されており、他の面(上面、切断されて形成された側面)には、シリケート層182は形成されない。このため、図1における放熱板18の下面側の酸化や腐食を抑制し、安定した放熱特性を得ることができる。一方、この放熱板18を図2に示された製造方法において用いた際の、その上面にはシリケート層182が形成されないため、図2(d)における絶縁樹脂層17との間の接合強度を高くすることができる。また、放熱板18の側面にもシリケート層182が形成されないため、図2(f)におけるモールド樹脂層20と放熱板18ととの間の接合強度も高くすることができる。特に、放熱板18の側面が切断加工あるいは破断加工等によって形成された場合、切断面となる側面は平坦ではなく小さな凹凸が多く形成されている。このため、この小さな凹凸がくさびとなり、放熱板18の側面とモールド樹脂層20との間の接合強度が高まる。
In the state shown in FIG. 3C, the
また、上記のようシリケート層182を形成する際にスピン塗布を用いることにより、銅平板200に悪影響を与えず、特定の面にシリケート層182を容易に形成することができる。この放熱板18を用いることにより、この半導体モジュール10の信頼性を高めることができる。
Further, by using spin coating when forming the
更に、上記の構成の放熱板18を用いることによって、放熱効率の高い半導体モジュール10を特に高い歩留まりで製造することができる。この点について、以下に説明する。図2(f)においては、形成されたモールド樹脂層20が理想的に形成された形状が示されているが、実際には、安定してこうした状態を実現することは難しい。図4は、モールド樹脂層20を形成する際の一般的な状態を詳細に説明する断面図である。
Furthermore, by using the
ここで、モールド工程において、モールド樹脂層20は例えばトランスファーモールドによって形成されるが、この際、モールド樹脂層20を構成する樹脂材料は、実際には放熱板18の下面側にも回り込む場合がある。このため、一般的には、図4(a)に示されるように、放熱板18の外周近辺の下側にもこの樹脂材料は回り込んで固化し、モールド樹脂層20は、放熱板18の下面外周付近を覆う形状となる場合が多い。特に、図4(a)では放熱板18の下面は単純化して平坦であるように記載しているが、実際には放熱板18は図4(a)中で下側に凸となるように湾曲する場合が多い。こうした場合には、放熱板18の下面の端部は、中央部よりも図4(a)中で高くなる、すなわち、モールド樹脂層20の下面から内側に引き込んだ形態となり、放熱板18の下面の端部はモールド樹脂層20の下面よりも例えば20μm程度引き込んだ形状となる。放熱板18におけるこの引き込んだ領域が樹脂材料(モールド樹脂層20)で覆われ、図4(a)の形態となりやすい。モールド樹脂層20の熱伝導率は放熱板18(銅板181)と比べて非常に小さいため、こうした状態においては、放熱に寄与する実効面積が減少し、放熱効率が低下する。
Here, in the molding process, the
しかしながら、シリケート層182とモールド樹脂層20との間の密着性は低いために、図4(b)に示されるように、放熱板18の下面の外周近辺でモールド樹脂層20がシリケート層182と接した部分の接着強度は低く、バリ21として容易に剥離させることができる。このため、この部分を剥離除去し、図4(c)に示されるように放熱板18の下面全体を露出させることができる。これによって、放熱板18の下面全体を放熱に寄与させることができる。図4(c)ではバリ21が除去されたことによって段差が生じているように記載されているが、前記の通り、実際にはこの段差は高々20μm程度であるため、放熱板18やモールド樹脂層20の厚さと比べて無視できる程度であり、実用上の問題はない。
However, since the adhesion between the
すなわち、上記の放熱板18を用いた場合には、モールド層20を形成した状態で図4(a)に示される状態となった場合でも、図4(c)の状態を容易に実現することができるため、放熱効率の高い半導体モジュール10を高い歩留まりで製造することができる。
That is, when the
更に、この半導体モジュール10を使用する際には、放熱板18の下面がシリコーングリスを介して金属ブロック等に接合させる場合が多い。こうした場合に、シリケート層182と類似の材料で構成されたシリコーングリスのシリケート層182(放熱板18)に対する濡れ性は高くなる。このため、この観点からも高い放熱効率を得ることができる。
Further, when the
なお、シリケート層182の代わりに、同様に銅板181表面の酸化や腐食を抑制できる層を代わりに用いることもできる。ただし、前記の通り、スピン塗布によって特定の表面に容易に形成することができる特開2007−163754号公報に記載されたシリケート薄膜を用いることが特に好ましい。放熱板の主体として銅板の代わりに他の金属板を用いた場合でも同様であるが、熱伝導率が高い銅板あるいは銅合金の板を用いることが特に好ましい。
Instead of the
また、上記の例では、銅板181の下面にのみシリケート層182を形成し上面には形成しないものとしたが、シリケート層との間の接着強度が高い材料で絶縁樹脂層が構成される場合には、シリケート層を上面にも形成することが好ましい。この場合において、銅板の下面、上面の両方にシリケート層を形成することは容易である。また、この場合においても側面にはシリケート層が形成されないことが好ましく、これも上記の放熱板製造工程によって容易に実現することができる。
In the above example, the
なお、上記の構成においては、放熱板18が半導体チップ11、12(リードフレーム14、15)と電気的に絶縁されるものとしたが、放熱板とこれらとの間が電気的に接続され、放熱板を電極として用いる場合であっても、上記の構成が有効であることは明らかである。この場合には、例えば放熱板下面のシリケート層を部分的に除去することによって、銅板にはんだ付けを行うことができる。部分的に加熱することによって、この除去を行うこともできる。
In the above configuration, the
10、90 半導体モジュール
11、12、91、92 半導体チップ
13、93 はんだ層
14、15、94、95 ダイパッド
16、96 接着樹脂層
17、97 絶縁樹脂層
18、98 放熱板
19、100 ボンディングワイヤ
20、101 モールド樹脂層
21 バリ
99 リード端子
181 銅板(金属板:放熱板)
182 シリケート層(放熱板)
200 銅平板(金属平板)
300 ブレード
10, 90
182 Silicate layer (heat sink)
200 Copper flat plate (metal flat plate)
300 blades
Claims (8)
前記放熱板の主体となる金属板の下面においてシリケート化合物を含むシリケート層を形成し、かつ前記金属板の側面には前記シリケート層を形成しないように前記放熱板を製造する放熱板製造工程と、
前記シリケート層が形成された前記放熱板の下面が露出するように、前記放熱板の上面側において前記半導体チップを封止するように前記モールド樹脂層を形成するモールド工程と、
を具備することを特徴とする半導体モジュールの製造方法。 A method for producing a semiconductor module comprising a semiconductor chip sealed in a mold resin layer, wherein the lower surface of the heat sink is exposed at the lower surface of the mold resin layer,
Forming a silicate layer containing a silicate compound on the lower surface of the metal plate as a main body of the heat sink, and manufacturing the heat sink so as not to form the silicate layer on the side surface of the metal plate; and
A molding step of forming the mold resin layer so as to seal the semiconductor chip on the upper surface side of the heat sink so that the lower surface of the heat sink on which the silicate layer is formed is exposed;
A method for manufacturing a semiconductor module, comprising:
前記放熱板よりも大きな金属平板における一方の主面において前記シリケート層を形成した後に、前記金属平板を切断することによって前記放熱板を得ることを特徴とする請求項1に記載の半導体モジュールの製造方法。 In the heat sink manufacturing process,
2. The semiconductor module according to claim 1, wherein the heat radiating plate is obtained by cutting the metal flat plate after forming the silicate layer on one main surface of the metal flat plate larger than the heat radiating plate. Method.
前記シリケート層を構成する材料が揮発性溶媒に熔解された塗布液を前記金属平板に塗布することによって、前記シリケート層を形成することを特徴とする請求項2に記載の半導体モジュールの製造方法。 In the heat sink manufacturing process,
3. The method of manufacturing a semiconductor module according to claim 2, wherein the silicate layer is formed by applying a coating solution in which a material constituting the silicate layer is dissolved in a volatile solvent to the metal flat plate.
前記半導体チップをリードフレームに搭載するチップ搭載工程と、
前記リードフレームの下面を前記放熱板の上面に絶縁樹脂層を介して接合する接合工程と、
を具備することを特徴とする請求項1から請求項3までのいずれか1項に記載の半導体モジュールの製造方法。 Before the molding process,
A chip mounting step of mounting the semiconductor chip on a lead frame;
A bonding step of bonding the lower surface of the lead frame to the upper surface of the heat sink via an insulating resin layer;
4. The method of manufacturing a semiconductor module according to claim 1, further comprising:
前記モールド樹脂層を構成する材料が前記放熱板の下面の表面において硬化した部分を剥離除去することを特徴とする請求項1から請求項4までのいずれか1項に記載の半導体モジュールの製造方法。 After the molding process,
5. The method of manufacturing a semiconductor module according to claim 1, wherein a portion of the material constituting the mold resin layer is peeled off and removed from a cured surface of the lower surface of the heat radiating plate. 6. .
前記放熱板は、その主体となる金属板の下面においてシリケート化合物を含むシリケート層が形成され、かつ前記金属板の側面には前記シリケート層が形成されないことを特徴とする半導体モジュール。 A semiconductor module having a configuration in which a semiconductor chip is sealed in a mold resin layer and the lower surface of the heat sink is exposed on the lower surface of the mold resin layer,
The semiconductor module according to claim 1, wherein a silicate layer containing a silicate compound is formed on a lower surface of a metal plate as a main component of the heat radiating plate, and the silicate layer is not formed on a side surface of the metal plate.
前記半導体チップがリードフレームに搭載され、前記リードフレームの下面が前記放熱板の上面に絶縁樹脂層を介して接合されたことを特徴とする請求項7に記載の半導体モジュール。 In the mold resin layer,
The semiconductor module according to claim 7, wherein the semiconductor chip is mounted on a lead frame, and a lower surface of the lead frame is bonded to an upper surface of the heat sink via an insulating resin layer.
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Application Number | Priority Date | Filing Date | Title |
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CN201310016378.6A CN103681376A (en) | 2012-09-19 | 2013-01-16 | Semiconductor module manufacturing method and semiconductor module |
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Application Number | Priority Date | Filing Date | Title |
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