JP2013219242A - Semiconductor thin film and manufacturing method of the same - Google Patents

Semiconductor thin film and manufacturing method of the same Download PDF

Info

Publication number
JP2013219242A
JP2013219242A JP2012089446A JP2012089446A JP2013219242A JP 2013219242 A JP2013219242 A JP 2013219242A JP 2012089446 A JP2012089446 A JP 2012089446A JP 2012089446 A JP2012089446 A JP 2012089446A JP 2013219242 A JP2013219242 A JP 2013219242A
Authority
JP
Japan
Prior art keywords
raw material
doping
thin film
semiconductor layer
semiconductor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2012089446A
Other languages
Japanese (ja)
Other versions
JP5833491B2 (en
Inventor
Takuya Hoshi
拓也 星
Hiroki Sugiyama
弘樹 杉山
Haruki Yokoyama
春喜 横山
Kenji Kurishima
賢二 栗島
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nippon Telegraph and Telephone Corp
Original Assignee
Nippon Telegraph and Telephone Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Telegraph and Telephone Corp filed Critical Nippon Telegraph and Telephone Corp
Priority to JP2012089446A priority Critical patent/JP5833491B2/en
Publication of JP2013219242A publication Critical patent/JP2013219242A/en
Application granted granted Critical
Publication of JP5833491B2 publication Critical patent/JP5833491B2/en
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Landscapes

  • Bipolar Transistors (AREA)
  • Chemical Vapour Deposition (AREA)

Abstract

PROBLEM TO BE SOLVED: To enable doping of C with a high concentration in a state capable of obtaining an intended In composition.SOLUTION: A compound semiconductor shin film manufacturing method comprises: supplying an In material, a Ga material, an As material and an Sb material on a substrate to crystal growing a compound semiconductor including In, Ga, As and Sb in step S101; and following above-described step S101, newly starting supply of a halomethane C doping material in addition to supply of the In material, the Ga material, the As material and the Sb material to continue the crystal growth of the compound semiconductor in step S102. By doing this, a thin film of the compound semiconductor which includes In, Ga, As and Sb and which is changed to be a p-type by doping of carbide can be formed on the substrate.

Description

本発明は、In,Ga,As,およびSbを含み、炭素がドーピングされてp型とされた化合物半導体からなる半導体薄膜およびその製造方法に関するものである。   The present invention relates to a semiconductor thin film made of a compound semiconductor containing In, Ga, As, and Sb and doped with carbon to be p-type, and a method for manufacturing the same.

通信の高速化、大容量化に対する要求が高まっており、ヘテロ接合バイポーラトランジスタ(Hetero-junction Bipolar Transistor;HBT)などの高周波半導体トランジスタの性能向上が求められている。特に近年では、従来の高速化のトレンドの他に、集積回路レベルおよびデバイスレベルでの消費電力の低減が求められている。   There is an increasing demand for high-speed communication and large capacity, and there is a demand for improved performance of high-frequency semiconductor transistors such as heterojunction bipolar transistors (HBTs). Particularly in recent years, in addition to the conventional trend of higher speed, reduction of power consumption at the integrated circuit level and the device level is required.

これらのトランジスタは、抵抗率を107Ω・cm以上にまで高抵抗化したFe添加InP基板を用い、この基板の上に格子整合するInGaAs,InAlAs,AlInGaAsSb,InAlGaP,InAlGaAsPなどの材料を用い、有機金属化学気相成長法(MOVPE)や分子線エピタキシャル成長法(MBE)などの手法により作製された半導体層より構成されるのが一般である。 These transistors use an Fe-doped InP substrate whose resistivity is increased to 10 7 Ω · cm or more, and materials such as InGaAs, InAlAs, AlInGaAsSb, InAlGaP, and InAlGaAsP that are lattice-matched on this substrate, In general, the semiconductor layer is composed of a semiconductor layer manufactured by a technique such as metal organic chemical vapor deposition (MOVPE) or molecular beam epitaxy (MBE).

集積回路の低消費電力化には、HBTのベース層にバンドギャップの狭い(狭バンドギャップ)の材料を用いることが有効である。InP基板と比較的格子定数の近い、狭バンドギャップ材料として、InGaAsSbおよびInAlGaAsSbがある。これらの材料は、従来よりHBTのベース層として既に広く用いられているInGaAsと比較してもバンドギャップが小さい。このような狭バンドギャップ材料をHBTのベース層に適用することで、ベース-エミッタ間の内臓電位が小さくなるため、トランジスタの動作電圧を下げることができる。従って、このようなHBTを用いた機能性電気回路を作製した際、回路全体の消費電力低下が期待できる。   In order to reduce the power consumption of an integrated circuit, it is effective to use a material having a narrow band gap (narrow band gap) for the base layer of the HBT. InGaAsSb and InAlGaAsSb are narrow band gap materials having a lattice constant relatively close to that of the InP substrate. These materials have a smaller band gap than InGaAs, which has been widely used as a base layer for HBT. By applying such a narrow band gap material to the base layer of the HBT, the built-in potential between the base and the emitter is reduced, so that the operating voltage of the transistor can be lowered. Therefore, when a functional electric circuit using such an HBT is manufactured, a reduction in power consumption of the entire circuit can be expected.

ところで、上述したトランジスタにおいては、高周波特性を高めるために、高濃度にn型やp型にドーピングされた層が一般に用いられる。例えば、InP基板上に形成したnpn型のHBTなどにおいては、ベース層には1019cm-3以上の高濃度にp型ドープしたInGaAsやGaAsSbなどの材料を用いるのが一般である。HBTに限らず、例えばMOSFETなどの電界効果型トランジスタにおいても、ソース・ドレインとなる半導体層には、ソース抵抗・ドレイン抵抗低減のため、高濃度にドーピングが行われる場合がある。 By the way, in the above-described transistor, a layer doped with a high concentration of n-type or p-type is generally used in order to improve high-frequency characteristics. For example, in an npn type HBT formed on an InP substrate, it is common to use a material such as InGaAs or GaAsSb doped at a high concentration of 10 19 cm −3 or higher for the base layer. In addition to the HBT, for example, in a field effect transistor such as a MOSFET, a semiconductor layer serving as a source / drain may be doped at a high concentration in order to reduce the source resistance / drain resistance.

従って、狭バンドギャップ材料であるInGaAsSbやInAlGaAsSbを上述したようにトランジスタに適用するためには、高濃度p型ドーピングが必要である。しかし、これらの四元以上の混晶材料系においては、高濃度p型ドーピングを行い、高い正孔濃度を得ることがきわめて難しい。この理由について、以下に説明する。   Therefore, in order to apply InGaAsSb or InAlGaAsSb, which is a narrow band gap material, to a transistor as described above, high-concentration p-type doping is necessary. However, in these quaternary or higher mixed crystal material systems, it is extremely difficult to obtain a high hole concentration by performing high-concentration p-type doping. The reason for this will be described below.

GaAsSbやInGaAsでは、広く一般的に用いられるp型ドーパントとしては炭素(C)が挙げられる。CはInGaAsSbやInAlGaAsSbにおいても同様にp型伝導を示すことが知られている。Cドーピングを行う原料としては、多くの場合、四塩化炭素(CCl4)や四臭化炭素(CBr4)などのハロメタン系原料が用いられる。 In GaAsSb and InGaAs, a widely used p-type dopant is carbon (C). C is also known to exhibit p-type conduction in InGaAsSb and InAlGaAsSb as well. In many cases, a halomethane-based material such as carbon tetrachloride (CCl 4 ) or carbon tetrabromide (CBr 4 ) is used as a material for performing C doping.

しかしハロメタン系原料は、原料中に塩素(Cl)や臭素(Br)などのハロゲン元素が含まれるため、結晶成長の際に同時にエッチング反応が起こることが知られている。このエッチング効果により、結晶成長の際に半導体薄膜として取り込まれる固相の組成は、ドーピングを行っていない場合と比べて変動する。このようなエッチング効果による固相組成の変動は、半導体薄膜の固相組成の制御性や再現性を低下させる要因となりうる。   However, it is known that the halomethane-based raw material contains an etching reaction simultaneously with crystal growth because the raw material contains a halogen element such as chlorine (Cl) or bromine (Br). Due to this etching effect, the composition of the solid phase taken in as a semiconductor thin film during crystal growth varies as compared with the case where no doping is performed. Such a change in the solid phase composition due to the etching effect can be a factor that reduces the controllability and reproducibility of the solid phase composition of the semiconductor thin film.

エッチング効果は、固相を構成する元素によって度合いが異なるが、InとGaとで比較した場合は、Inの方がGaよりもエッチング効果の影響を受けやすい(非特許文献1参照)。従って、InGaAsSbにハロメタン系原料によってCドーピングを行うと、固相In組成が減少してしまう。このため、In組成を所望の値とした状態で、高濃度にCドーピングをおない、高い成功濃度を得ることが容易ではない。   Although the degree of the etching effect varies depending on the elements constituting the solid phase, when In and Ga are compared, In is more susceptible to the etching effect than Ga (see Non-Patent Document 1). Accordingly, when C doping is performed on InGaAsSb with a halomethane-based material, the solid phase In composition is reduced. For this reason, it is not easy to obtain a high success concentration without C doping at a high concentration in a state where the In composition is set to a desired value.

また、多くのIII−V族化合物半導体において、材料の混晶化により、ドーピングの効率が低下することが知られている。InGaAsSbにおいても同様に、固相In組成がInGaAsとGaAsSbの中間程度の領域、すなわち固相In組成xが0.2<x<0.3程度の範囲に近づくにつれて、正孔濃度は著しく減少する。   Further, in many III-V group compound semiconductors, it is known that doping efficiency decreases due to mixed crystallization of materials. Similarly, in InGaAsSb, as the solid-phase In composition is in the middle of InGaAs and GaAsSb, that is, as the solid-phase In composition x approaches 0.2 <x <0.3, the hole concentration decreases significantly. .

C以外の元素を用いたドーピングの試みもなされている。例えば、MBE法によりベリリウム(Be)ドーピングを行うことで、1019cm-3程度の高い正孔濃度のInGaAsSb薄膜が形成されたことが報告されている。また、ドーパントとして亜鉛(Zn)を用いる方法も考えられる。 Attempts to dope using elements other than C have also been made. For example, it has been reported that an InGaAsSb thin film having a high hole concentration of about 10 19 cm −3 is formed by performing beryllium (Be) doping by the MBE method. A method using zinc (Zn) as a dopant is also conceivable.

しかし、これらの材料はいずれもII族の元素であり、ドーピングによってIII族であるInおよびGaのサイトに入る。このため、V族サイトに入るCを用いる場合と比べて、ドーピングした元素が半導体層中を拡散しやすく、特に半導体層のヘテロ接合界面の急峻性などを低下させ、所望のトランジスタ特性が得られない場合がある。また、これらのドーピング元素の拡散の影響により、トランジスタの長期的な信頼性が劣化してしまう場合もある。さらに、Znに関しては、半導体薄膜を形成する結晶成長装置の内部(成膜室)に残存し、例えば、亜鉛をドープしない半導体薄膜の形成に影響を及ぼす場合がある。   However, these materials are all Group II elements, and enter Group III and In sites by doping. For this reason, compared with the case of using C entering the group V site, the doped element is easily diffused in the semiconductor layer, and in particular, the steepness of the heterojunction interface of the semiconductor layer is reduced, and desired transistor characteristics can be obtained. There may not be. In addition, the long-term reliability of the transistor may deteriorate due to the influence of diffusion of these doping elements. Further, Zn remains in the inside of the crystal growth apparatus (film formation chamber) for forming a semiconductor thin film, and may affect the formation of a semiconductor thin film not doped with zinc, for example.

K. Tateno et. al. , "Carbon Doping and Etching in GaxIn1-xAsyP1-y on GaAs Substrates Using CBr4 by Metalorganic Chemical Vapor Deposition", Journal of Electronic Materials, vol.28, pp.63-68, 1999.K. Tateno et.al., "Carbon Doping and Etching in GaxIn1-xAsyP1-y on GaAs Substrates Using CBr4 by Metalorganic Chemical Vapor Deposition", Journal of Electronic Materials, vol.28, pp.63-68, 1999.

以上に説明したように、まず、HBTやFETなどのトランジスタにおいて、必要な層のドーピング濃度が不十分であると、接触抵抗が高くなり、デバイスの高周波特性が低下してしまう場合がある。特にHBTにおいては、ベース層が十分高い正孔濃度を有していないと、ベース層のシート抵抗が増大し、高い最大発振周波数が得られない。   As described above, first, in a transistor such as an HBT or FET, if the required layer doping concentration is insufficient, the contact resistance increases, and the high-frequency characteristics of the device may deteriorate. Particularly in HBT, if the base layer does not have a sufficiently high hole concentration, the sheet resistance of the base layer increases and a high maximum oscillation frequency cannot be obtained.

しかしながら、InGaAsSbなどのような混晶材料においては、ドーピング効率が著しく低下してしまうため、高濃度ドーピングが難しいという問題がある。上述したように、ドーピング原料にハロメタン系原料を用いCをドーピングする場合、エッチング効果によりInGaAsSbの固相組成制御が難しい。特にGaとInとでは、Inの方がエッチング効果が大きいことから、In組成が低下してしまい、高In組成CドープInGaAsSbを得るのが難しい。   However, a mixed crystal material such as InGaAsSb has a problem that it is difficult to perform high-concentration doping because the doping efficiency is significantly reduced. As described above, when C is doped using a halomethane-based material as a doping material, it is difficult to control the solid phase composition of InGaAsSb due to the etching effect. In particular, in Ga and In, since In has a larger etching effect, the In composition is lowered, and it is difficult to obtain a high In composition C-doped InGaAsSb.

また前述したように、C以外のドーパントを用いる手法も考えられるが、III族サイトに入るドーパントは固相中の元素の拡散が起こりやすく、界面急峻性の劣化およびデバイスの長期的な信頼性の低下が引き起こされる。またZnをドーパントとして用いる場合は、成膜室内などにおけるZnの残存により、成膜における環境が変動してしまうという別の問題も発生する場合がある。   Further, as described above, a method using a dopant other than C is also conceivable, but the dopant entering the III site is likely to cause diffusion of elements in the solid phase, resulting in deterioration of interface steepness and long-term reliability of the device. A decline is caused. In the case where Zn is used as a dopant, another problem that the environment for film formation fluctuates due to the remaining Zn in the film formation chamber or the like may occur.

本発明は、以上のような問題点を解消するためになされたものであり、所望のIn組成が得られる状態で、高濃度にCがドープできるようにすることを目的とする。   The present invention has been made to solve the above problems, and an object of the present invention is to allow C to be doped at a high concentration in a state where a desired In composition can be obtained.

本発明に係る半導体薄膜の形成方法は、In原料,Ga原料,As原料,およびSb原料を供給することを含む第1条件で化合物半導体を基板の上に堆積する第1工程と、第1工程に引き続いて、In原料,Ga原料,As原料,およびSb原料を供給することを含む第2条件で化合物半導体を基板の上に堆積する第2工程とを少なくとも備え、第1条件および第2条件の一方は、他方に比較してハロメタン系の炭素ドーピング原料の供給量を少なくし、基板の上に、In,Ga,As,およびSbを含み、炭素がドーピングされてp型とされた化合物半導体の薄膜を形成する。   A method for forming a semiconductor thin film according to the present invention includes a first step of depositing a compound semiconductor on a substrate under a first condition including supplying an In source, a Ga source, an As source, and an Sb source, and a first step. And a second step of depositing a compound semiconductor on the substrate under a second condition including supplying an In raw material, a Ga raw material, an As raw material, and an Sb raw material. The first condition and the second condition One of these is a compound semiconductor in which the supply amount of the halomethane-based carbon doping raw material is reduced as compared with the other, and the substrate contains In, Ga, As, and Sb and is doped with carbon to be p-type. The thin film is formed.

上記半導体薄膜の形成方法において、第1条件および第2条件は、In原料,Ga原料,As原料,およびSb原料の供給量を同一とすればよい。また、炭素ドーピング原料は、四塩化炭素または四臭化炭素であればよい。   In the method for forming a semiconductor thin film, the first condition and the second condition may be the same supply amounts of the In material, Ga material, As material, and Sb material. The carbon doping raw material may be carbon tetrachloride or carbon tetrabromide.

また、本発明に係る半導体薄膜は、基板の上に互いに接して積層された第1半導体層および第2半導体層から構成された半導体薄膜であって、第1半導体層は、第2半導体層より低いIn組成とされた状態でIn,Ga,As,およびSbを含んで構成され、炭素のドーピングによる正孔濃度が第2半導体層より高い値とされ、 第2半導体層は、In,Ga,As,およびSbを含んで構成され、炭素のドーピングによる正孔濃度が第1半導体層より低い値とされている。なお、第1半導体層は、GaAsSb,InGaAsSb,AlGaAsSb,およびInAlGaAsSbのいずれかであり、第2半導体層は、InGaAsSbおよびInAlGaAsSbのいずれかであればよい。   The semiconductor thin film according to the present invention is a semiconductor thin film composed of a first semiconductor layer and a second semiconductor layer stacked on and in contact with each other on a substrate, and the first semiconductor layer is formed from the second semiconductor layer. It is configured to contain In, Ga, As, and Sb in a low In composition, and the hole concentration due to carbon doping is higher than that of the second semiconductor layer. The second semiconductor layer includes In, Ga, It is configured to include As and Sb, and the hole concentration due to carbon doping is lower than that of the first semiconductor layer. The first semiconductor layer may be any of GaAsSb, InGaAsSb, AlGaAsSb, and InAlGaAsSb, and the second semiconductor layer may be any of InGaAsSb and InAlGaAsSb.

以上説明したことにより、本発明によれば、所望のIn組成が得られる状態で、高濃度にCがドープできるようになるという優れた効果が得られる。   As described above, according to the present invention, it is possible to obtain an excellent effect that C can be doped at a high concentration in a state where a desired In composition can be obtained.

図1は、本発明の実施の形態における半導体薄膜の製造方法を説明するためのフローチャートである。FIG. 1 is a flowchart for explaining a method of manufacturing a semiconductor thin film according to an embodiment of the present invention. 図2は、本発明の実施の形態における半導体薄膜の他の製造方法を説明するためのフローチャートである。FIG. 2 is a flowchart for explaining another method for manufacturing a semiconductor thin film according to the embodiment of the present invention. 図3は、III族原料の供給比に対するInGaAsSbの固相In組成の変化を示す特性図である。FIG. 3 is a characteristic diagram showing a change in the solid phase In composition of InGaAsSb with respect to the supply ratio of the group III raw material. 図4は、CBr4の供給量を変化させた2つの条件における、III族原料の供給比に対するInGaAsSbの固相In組成の変化を示す特性図である。FIG. 4 is a characteristic diagram showing the change in the solid phase In composition of InGaAsSb with respect to the supply ratio of the group III raw material under two conditions where the supply amount of CBr 4 was changed. 図5は、単純にCBr4を供給してInGaAsSbを結晶成長したときの、固相In組成の変化に対するInGaAsSbの正孔濃度の変化を示す特性図である。Figure 5 is a characteristic diagram showing simply supplies a CBr 4 when the InGaAsSb and crystal growth, the change in the hole concentration in the InGaAsSb to changes in the solid phase In composition. 図6は、本発明の実施の形態における半導体薄膜の製造方法を説明するシーケンス図である。FIG. 6 is a sequence diagram illustrating a method for manufacturing a semiconductor thin film according to an embodiment of the present invention. 図7は、本発明の実施の形態における半導体薄膜の構成例を模式的に示す断面図である。FIG. 7 is a cross-sectional view schematically showing a configuration example of the semiconductor thin film in the embodiment of the present invention. 図8は、本発明の実施の形態における半導体薄膜の他の製造方法を説明するシーケンス図である。FIG. 8 is a sequence diagram illustrating another method for manufacturing a semiconductor thin film according to an embodiment of the present invention.

以下、本発明の実施の形態について図を参照して説明する。図1は、本発明の実施の形態における半導体薄膜の製造方法を説明するためのフローチャートである。この製造方法は、まず、ステップS101で、基板の上に、In原料,Ga原料,As原料,およびSb原料を供給してIn,Ga,As,およびSbを含む化合物半導体を結晶成長する。   Hereinafter, embodiments of the present invention will be described with reference to the drawings. FIG. 1 is a flowchart for explaining a method of manufacturing a semiconductor thin film according to an embodiment of the present invention. In this manufacturing method, first, in step S101, an In raw material, a Ga raw material, an As raw material, and an Sb raw material are supplied onto a substrate to grow a compound semiconductor containing In, Ga, As, and Sb.

上述したステップS101に引き続き、ステップS102で、In原料,Ga原料,As原料,およびSb原料の供給とともに、新たにハロメタン系の炭素(C)ドーピング原料の供給を開始し、化合物半導体の結晶成長を継続する。   Subsequent to Step S101 described above, in Step S102, the supply of In raw material, Ga raw material, As raw material, and Sb raw material is started, and supply of a halomethane-based carbon (C) doping raw material is newly started, and crystal growth of a compound semiconductor is started. continue.

これにより、基板の上に、In,Ga,As,およびSbを含み、炭素がドーピングされてp型とされた化合物半導体の薄膜が形成できる。このように、化合物半導体の堆積を行うことで、In,Ga,As,およびSbを含むp型の化合物半導体薄膜を、所望のIn組成が得られ、かつ、高濃度にCがドープされた状態にすることができる。   Thereby, a thin film of a compound semiconductor containing In, Ga, As, and Sb and doped with carbon to be p-type can be formed on the substrate. Thus, by depositing a compound semiconductor, a p-type compound semiconductor thin film containing In, Ga, As, and Sb can be obtained with a desired In composition and with a high concentration of C doped. Can be.

ここで、上述では、ステップS101では、Cドーピング材料の供給をせず、ステップS102で、Cドーピング材料の供給を行うようにしたが、これに限るものではない。本発明は、第1工程で、In原料,Ga原料,As原料,およびSb原料を供給することを含む第1条件で化合物半導体を基板の上に堆積し、第2工程で、第1工程に引き続いて、In原料,Ga原料,As原料,およびSb原料を供給することを含む第2条件で化合物半導体を基板の上に堆積する中で、第1条件および第2条件の一方は、他方に比較してハロメタン系の炭素ドーピング原料の供給量を少なくすることが重要である。   Here, in the above description, the C doping material is not supplied in Step S101 and the C doping material is supplied in Step S102. However, the present invention is not limited to this. The present invention deposits a compound semiconductor on a substrate under a first condition including supplying an In raw material, a Ga raw material, an As raw material, and an Sb raw material in the first step, and the second step in the first step. Subsequently, in depositing the compound semiconductor on the substrate under the second condition including supplying the In raw material, the Ga raw material, the As raw material, and the Sb raw material, one of the first condition and the second condition is changed to the other. In comparison, it is important to reduce the supply amount of the halomethane-based carbon doping raw material.

従って、まず、第1工程で、基板の上に、In原料,Ga原料,As原料,およびSb原料に加え、ハロメタン系のCドーピング原料を供給し、In,Ga,As,およびSbを含む、炭素がドーピングされたp型の化合物半導体を結晶成長する。これに引き続き、第2工程で、Cドーピング原料の供給を停止し、In原料,Ga原料,As原料,およびSb原料の供給は継続して化合物半導体の結晶成長を継続してもよい。なお、Cドーピング原料を供給している状態では、この供給量の条件によっては、堆積される化合物半導体中に、Inがほとんど取り込まれない状態が発生する。しかしながら、Cドーピング原料を供給せずに堆積している段階では、所望とする組成にInが含まれた状態とすることができる。この点については、後述する。   Therefore, first, in the first step, in addition to the In raw material, the Ga raw material, the As raw material, and the Sb raw material, a halomethane-based C doping raw material is supplied on the substrate, and includes In, Ga, As, and Sb. A p-type compound semiconductor doped with carbon is crystal-grown. Subsequently, in the second step, the supply of the C doping material may be stopped, and the supply of the In material, Ga material, As material, and Sb material may be continued to continue crystal growth of the compound semiconductor. In a state where the C doping raw material is supplied, depending on the supply amount condition, a state where In is hardly taken into the deposited compound semiconductor occurs. However, in a stage where deposition is performed without supplying the C doping raw material, a desired composition can contain In. This point will be described later.

また、上述した2つの工程を交互に繰り返すことで、目的とするp型の化合物半導体薄膜を形成してもよい。例えば、図2のフローチャートに示すように、まず、ステップS201で、In原料,Ga原料,As原料,およびSb原料に加え、ハロメタン系のCドーピング原料を供給し、In,Ga,As,およびSbを含む、炭素がドーピングされた第1半導体層を形成する。   Alternatively, the target p-type compound semiconductor thin film may be formed by alternately repeating the two steps described above. For example, as shown in the flowchart of FIG. 2, first, in step S201, in addition to the In raw material, the Ga raw material, the As raw material, and the Sb raw material, a halomethane-based C doping raw material is supplied, and In, Ga, As, and Sb are supplied. A first semiconductor layer doped with carbon is formed.

引き続き、ステップS202で、Cドーピング原料の供給を停止し、In原料,Ga原料,As原料,およびSb原料の供給は継続し、第1半導体層の上に第2半導体層を形成する。次に、ステップS203で、規定の回数を繰り返したことを判断し、規定の回数を繰り返すまで、ステップS201およびステップS202を繰り返す。これにより、第1半導体層と第2半導体層が交互に複数層積層された状態で、所望のIn組成が得られ、かつ、高濃度にCがドープされたIn,Ga,As,およびSbを含むp型の化合物半導体薄膜が形成される。   Subsequently, in step S202, the supply of the C doping material is stopped, the supply of the In material, the Ga material, the As material, and the Sb material is continued, and the second semiconductor layer is formed on the first semiconductor layer. Next, in step S203, it is determined that the specified number of times has been repeated, and steps S201 and S202 are repeated until the specified number of times is repeated. Thereby, in a state where a plurality of first semiconductor layers and second semiconductor layers are alternately stacked, a desired In composition is obtained, and In, Ga, As, and Sb doped with C at a high concentration are obtained. A p-type compound semiconductor thin film is formed.

以下、InGaAsSbを例にとり、ハロメタン系材料による炭素ドープによる固相中のIn組成の変化について説明する。まず、InGaAsSbに対してハロメタン系原料によって単純にCドープを行った実験の結果について、図3を用いて説明する。図3は、III族原料の供給比に対するInGaAsSbの固相In組成の変化を示す特性図である。この実験では、結晶成長を減圧MOCVD法により行い、原料にはトリエチルガリウム(TEGa)、トリメチルインジウム(TMIn)、アルシン(AsH3)、トリメチルアンチモン(TMSb)を用いた。また、ドーピング原料にはCBr4を用いた。また、原料の供給モル比は、全V族元素の供給モル流量が、全III族元素の供給モル流量よりも大きくなるような条件で行った。 Hereinafter, taking InGaAsSb as an example, a change in the In composition in the solid phase due to carbon doping with a halomethane-based material will be described. First, the result of an experiment in which InGaAsSb is simply C-doped with a halomethane-based material will be described with reference to FIG. FIG. 3 is a characteristic diagram showing a change in the solid phase In composition of InGaAsSb with respect to the supply ratio of the group III raw material. In this experiment, crystal growth was performed by a low pressure MOCVD method, and triethylgallium (TEGa), trimethylindium (TMIn), arsine (AsH 3 ), and trimethylantimony (TMSb) were used as raw materials. CBr 4 was used as a doping material. The feed molar ratio of the raw materials was set under the condition that the supply molar flow rate of all group V elements was larger than the supply molar flow rate of all group III elements.

図3に示されているように、ドーピング原料を供給しない場合(白三角)、固相In組成は、III族原料供給比の増大に対して比例的に増大する傾向にあった。このような傾向は、III−V族半導体結晶の結晶成長においては一般的に得られる。これに対し、ドーピング原料を供給した場合(黒丸)、III族原料供給比に対して固相In組成は比例関係ではなく、Inがほとんど固相に取り込まれない領域が存在した。特に、III族原料供給比が小さい領域では、固相In組成が0.1より小さくなり、Inが含まれない状態で薄膜が形成される場合があることが判明した。   As shown in FIG. 3, when no doping material was supplied (white triangle), the solid phase In composition tended to increase in proportion to the increase in the group III material supply ratio. Such a tendency is generally obtained in the crystal growth of a group III-V semiconductor crystal. On the other hand, when the doping raw material was supplied (black circle), the solid phase In composition was not proportional to the group III raw material supply ratio, and there was a region where In was hardly taken into the solid phase. In particular, in the region where the Group III raw material supply ratio is small, the solid phase In composition is smaller than 0.1, and it has been found that a thin film may be formed without containing In.

これは、ドーピング原料であるCBr4の分解過程で生じるBrが、InGaAsSbに対してエッチング効果を持っており、エッチングの度合いが、Inの方がGaよりも大きいためである。CBr4などのハロメタン系の炭素ドーピング原料を導入すると、エッチング効果が発現され、このエッチング過程においてInの脱離量がGaよりも多くなる。この結果として、固相のIn組成がドーピングを行っていない場合よりも小さくなる。 This is because Br generated in the decomposition process of CBr 4 as a doping material has an etching effect on InGaAsSb, and the degree of etching is larger for In than for Ga. When a halomethane-based carbon doping material such as CBr 4 is introduced, an etching effect is exhibited, and the amount of In desorbed is larger than Ga during this etching process. As a result, the In composition of the solid phase becomes smaller than that when no doping is performed.

このような現象は、Cドーピングに用いる原料が、形成する半導体層に対してエッチング効果を持っていれば本質的に起こりうる現象である。例えば多くのハロメタン系原料は、Cドーピングの原料として用いることができ、かつ同様のエッチング効果が起こりうる。   Such a phenomenon is essentially a phenomenon that can occur if the material used for C doping has an etching effect on the semiconductor layer to be formed. For example, many halomethane-based materials can be used as a C-doping material, and the same etching effect can occur.

次に、ハロメタン系の炭素ドーピング原料の供給量変化に対するInGaAsSbの固相In組成の変化について調査した結果について説明する。図4は、CBr4の供給量を変化させた2つの条件における、III族原料の供給比に対するInGaAsSbの固相In組成の変化を示す特性図である。図4では、ドーピング原料の供給量を1.5倍に増大させた実験結果を示した。図4において、黒丸に対し、黒四角が、ドーピング原料の供給量を1.5倍にした状態を示している。ドーピング原料供給量を増大させると、Inがほとんど固相中に取り込まれない条件が、広いIII族供給原料比の領域に対して発生している。 Next, the result of investigating the change in the solid phase In composition of InGaAsSb with respect to the change in the supply amount of the halomethane-based carbon doping material will be described. FIG. 4 is a characteristic diagram showing the change in the solid phase In composition of InGaAsSb with respect to the supply ratio of the group III raw material under two conditions where the supply amount of CBr 4 was changed. FIG. 4 shows an experimental result in which the supply amount of the doping material is increased 1.5 times. In FIG. 4, the black square indicates a state where the supply amount of the doping raw material is 1.5 times that of the black circle. When the supply amount of the doping material is increased, a condition in which In is hardly taken into the solid phase is generated for a wide group III feed material ratio region.

次に、単純にCBr4を供給してInGaAsSbを結晶成長した場合の、正孔濃度と固相In組成との関係について調査した結果について図5を用いて説明する。図5は、単純にCBr4を供給してInGaAsSbを結晶成長したときの、固相In組成の変化に対するInGaAsSbの正孔濃度の変化を示す特性図である。 Next, the results of investigating the relationship between the hole concentration and the solid phase In composition when CBr 4 is simply supplied and InGaAsSb is grown will be described with reference to FIG. Figure 5 is a characteristic diagram showing simply supplies a CBr 4 when the InGaAsSb and crystal growth, the change in the hole concentration in the InGaAsSb to changes in the solid phase In composition.

薄膜の形成時の結晶成長条件は、図3,図4の結果を得た実験の場合と同様である。図5の白四角に示すように、ドーピング原料供給量が一定の場合、固相In組成の増大に伴い正孔濃度は著しく低下していた。また、図5の黒四角に示すように、半導体薄膜形成時のドーピング原料供給量を1.5倍に増大させたとしても、正孔濃度を大幅に増大させることはできなかった。一方、固相In組成が小さい領域では、正孔濃度は、同様の条件で成長したInを含まないGaAsSbの場合(図5中の矢視線で示す値)と同程度の比較的高い値を維持できた。   The crystal growth conditions at the time of forming the thin film are the same as those in the experiment in which the results shown in FIGS. As shown by the white squares in FIG. 5, when the doping raw material supply amount is constant, the hole concentration is significantly reduced as the solid phase In composition increases. Further, as shown by the black squares in FIG. 5, the hole concentration could not be significantly increased even when the doping material supply amount at the time of forming the semiconductor thin film was increased 1.5 times. On the other hand, in the region where the solid phase In composition is small, the hole concentration maintains a relatively high value similar to that in the case of GaAsSb not containing In grown under the same conditions (value indicated by the arrow in FIG. 5). did it.

以上に説明したように、In原料,Ga原料,As原料,およびSb原料に加え、ハロメタン系のCドーピング原料を供給し、InGaAsSbを結晶成長させようとする場合、Cドーピング原料の供給量を増加させると、成長している膜中のIn組成を所望とする状態にすることができない場合が存在することが分かる。言い換えると、単純にCドーピング原料を供給する結晶成長では、高い正孔濃度と所望とするIn組成とを同時に得ることができないことが分かる。   As described above, in addition to the In raw material, Ga raw material, As raw material, and Sb raw material, when supplying a halomethane-based C doping raw material to grow InGaAsSb crystals, the supply amount of the C doping raw material is increased. It can be seen that there are cases where the In composition in the growing film cannot be brought into a desired state. In other words, it can be seen that a high hole concentration and a desired In composition cannot be obtained at the same time by crystal growth in which a C doping material is simply supplied.

次に、InGaAsSbを例にとり、高い正孔濃度と所望とするIn組成とを同時に得ることができる原料供給について説明する。まず、各原料の供給について、図6のシーケンス図を用いて説明する。供給する原料は、Ga原料,In原料,As原料,Sb原料,およびドーピング原料である。   Next, taking InGaAsSb as an example, the raw material supply capable of simultaneously obtaining a high hole concentration and a desired In composition will be described. First, supply of each raw material is demonstrated using the sequence diagram of FIG. The raw materials to be supplied are Ga raw material, In raw material, As raw material, Sb raw material, and doping raw material.

まず、時刻T1において、Ga原料,In原料,As原料,Sb原料,およびドーピング原料の供給を開始し、半導体基板の上に対する成膜を開始する。ここで、III族元素の原料であるGa原料およびIn原料の供給比は、図3および図4に示した、ドーピング原料を供給した状態ではInがほとんど取り込まれない範囲内を選ぶ。次いで、時刻T2において、ドーピング原料の供給を停止し、この状態を時刻T3まで継続する。この時刻T1からT3までの周期P1の間、ドーピング原料以外のGa原料,In原料,As原料,およびSb原料の供給量は変化させない。   First, at time T1, supply of Ga source, In source, As source, Sb source, and doping source is started, and film formation on the semiconductor substrate is started. Here, the supply ratio of the Ga raw material and In raw material, which are Group III element raw materials, is selected within the range where In is hardly taken in with the doping raw material supplied as shown in FIGS. Next, at time T2, the supply of the doping material is stopped, and this state is continued until time T3. During the period P1 from time T1 to time T3, the supply amount of the Ga material, In material, As material, and Sb material other than the doping material is not changed.

周期P1の中で、時刻T1から時刻T2の間は、ドーピング原料を供給しているので、成長している層中(固相)にほとんどInは取り込まれないが、一方で高濃度にCがドープされて高い正孔濃度が得られる。次に、時刻T2から時刻T3の間は、ドーピング原料が供給されていないので、原料III族供給比とほぼ比例した状態のIn組成で、InGaAsSb層が得られ、一方で炭素はほぼアンドープの状態となる。このようにすることで、高濃度にCがドープされて低In組成の第1半導体層が時刻T1から時刻T2の間に形成され、ノンドープで所望のIn組成の第2半導体層が時刻T2から時刻T3の間に形成される。このような時刻T1から時刻T3までの間隔P1を1周期とし、同様にしてドーピング原料供給の停止および開始を繰り返す。   In period P1, since doping material is supplied from time T1 to time T2, almost no In is taken into the growing layer (solid phase), while C is highly concentrated. Doping provides a high hole concentration. Next, since the doping raw material is not supplied from time T2 to time T3, an InGaAsSb layer is obtained with an In composition that is substantially proportional to the raw material group III supply ratio, while carbon is substantially undoped. It becomes. By doing so, a first semiconductor layer having a low In composition is formed between time T1 and time T2 by doping C at a high concentration, and a non-doped second semiconductor layer having a desired In composition is formed from time T2. It is formed during time T3. The interval P1 from the time T1 to the time T3 is set as one cycle, and similarly, the stop and start of the doping material supply are repeated.

以上のシーケンスに従って成膜することで、図7の断面図に示すように、Cがドープされて高い正孔濃度が得られたp型のInGaAsSb薄膜704が、半導体基板701の上に形成される。半導体基板701の上には、高濃度にCがドープされて低In組成の第1半導体層702と、ノンドープで所望のIn組成の第2半導体層703とが、交互に積層されてInGaAsSb薄膜704が構成されている。   By forming the film according to the above sequence, a p-type InGaAsSb thin film 704 doped with C and having a high hole concentration is formed on the semiconductor substrate 701 as shown in the sectional view of FIG. . On the semiconductor substrate 701, a first semiconductor layer 702 having a low In composition, doped with C at a high concentration, and a second semiconductor layer 703 having a desired In composition, which is non-doped, are alternately stacked to form an InGaAsSb thin film 704. Is configured.

上述した本実施の形態における半導体薄膜の固相In組成xと正孔濃度pについて、以下に説明する。第1半導体層の固相In組成をx1とし、第2半導体層の固相In組成をx2とする。いま、上述したInGaAsSb薄膜704を構成する第1半導体層702の合計の厚さをd1とし、第2半導体層703の合計の厚さをd2とすれば、InGaAsSb薄膜704における固相In組成xは、次の式(1)で表される。 The solid phase In composition x and the hole concentration p of the semiconductor thin film in the present embodiment described above will be described below. Solid phase In composition of the first semiconductor layer and x 1, the solid phase In composition of the second semiconductor layer and x 2. Now, assuming that the total thickness of the first semiconductor layer 702 constituting the InGaAsSb thin film 704 described above is d 1 and the total thickness of the second semiconductor layer 703 is d 2 , the solid phase In composition in the InGaAsSb thin film 704 x is represented by the following formula (1).

x=d11/(d1+d2)+d22/(d1+d2)・・・(1) x = d 1 x 1 / (d 1 + d 2 ) + d 2 x 2 / (d 1 + d 2 ) (1)

第1半導体層702は、ほとんどInが取り込まれない領域で結晶成長を行っているため、固相In組成x1はほぼ0(x1≒0)である。一方、第2半導体層703は、III族原料供給比に対して固相In組成が比例関係にある領域で結晶成長を行っているため、固相In組成x2は、ほぼIII族原料供給モル比(RIII)である(x2≒RIII)。従って近似的には、次の式(2)が得られる。 Since the first semiconductor layer 702 performs crystal growth in a region where almost no In is taken in, the solid-phase In composition x 1 is substantially 0 (x 1 ≈0). On the other hand, since the second semiconductor layer 703 performs crystal growth in a region where the solid phase In composition is proportional to the group III source supply ratio, the solid phase In composition x 2 is approximately equal to the group III source supply mole. The ratio (R III ) (x 2 ≈R III ). Accordingly, the following expression (2) is obtained approximately.

x≒d22/(d1+d2
≒d2III/(d1+d2)・・・(2)
x≈d 2 x 2 / (d 1 + d 2 )
≒ d 2 R III / (d 1 + d 2 ) (2)

次に正孔濃度について考える。第1半導体層702の正孔濃度をp1、第2半導体層703の正孔濃度をp2とすると、同様の類推により、InGaAsSb薄膜704の正孔濃度は次の式(3)で与えられる。 Next, the hole concentration is considered. When the hole concentration of the first semiconductor layer 702 is p 1 and the hole concentration of the second semiconductor layer 703 is p 2 , the hole concentration of the InGaAsSb thin film 704 is given by the following equation (3) by the similar analogy. .

p=d11/(d1+d2)+d22/(d1+d2)・・・(3) p = d 1 p 1 / (d 1 + d 2 ) + d 2 p 2 / (d 1 + d 2 ) (3)

第2半導体層703は、結晶成長の最中にドーピング原料を供給していないので、ほぼp2≒0である。従って、半導体薄膜の正孔濃度pは近似的には次の式(4)で表される。 Since the second semiconductor layer 703 does not supply a doping material during crystal growth, p 2 ≈0. Therefore, the hole concentration p of the semiconductor thin film is approximately expressed by the following equation (4).

p≒d11/(d1+d2)・・・(4) p≈d 1 p 1 / (d 1 + d 2 ) (4)

従って、Ga原料およびIn原料を、III族原料供給比RIIIが十分高くなるよう設定し、またドーピング原料を第1半導体層702の正孔濃度p1が十分高くなるよう設定し、図6に示したような原料供給シーケンスにより半導体薄膜を形成すれば、式1および式2で規定される固相In組成および正孔濃度が実現できる。さらに簡単に、第1半導体層702と第2半導体層703の層厚d1およびd2を等しい層厚に設定すれば、固相In組成および正孔濃度は、次の式(5)および式(6)で表される。 Therefore, the Ga material and the In material are set so that the Group III material supply ratio R III is sufficiently high, and the doping material is set so that the hole concentration p 1 of the first semiconductor layer 702 is sufficiently high, and FIG. If the semiconductor thin film is formed by the raw material supply sequence as shown, the solid phase In composition and the hole concentration defined by the formulas 1 and 2 can be realized. More simply, if the layer thicknesses d 1 and d 2 of the first semiconductor layer 702 and the second semiconductor layer 703 are set to the same layer thickness, the solid phase In composition and the hole concentration are expressed by the following equations (5) and (5): It is represented by (6).

x≒RIII/2・・・(5)
p≒p1/2・・・(6)
x≈R III / 2 (5)
p ≒ p 1/2 ··· ( 6)

一例ではあるが、RIII=0.3とし、また第1半導体層702の正孔濃度をp1=1×1020cm-3となるような条件のもと、図6に示すような原料供給シーケンスにて結晶成長を行い、第1半導体層702および第2半導体層703の層厚を等しい値に設定すれば、固相In組成x=0.15、ドーピング濃度p=5×1019cm-3のInGaAsSb薄膜704が得られる。 As an example, under the conditions that R III = 0.3 and the hole concentration of the first semiconductor layer 702 is p 1 = 1 × 10 20 cm −3 , the raw material as shown in FIG. If crystal growth is performed in the supply sequence and the thicknesses of the first semiconductor layer 702 and the second semiconductor layer 703 are set to the same value, the solid phase In composition x = 0.15 and the doping concentration p = 5 × 10 19 cm. -3 of InGaAsSb thin film 704 is obtained.

ところで、図6を用いた説明では、ドーピング原料の供給を、成膜開始と同時に開始し、途中でドーピング原料の供給を停止したが、これに限るものではなく、成膜開始時にはドーピング原料の供給はせず、1つの周期の中の途中からドーピング原料の供給を開始してもよい。例えば、時刻T1では、ドーピング原料の供給を開始せず、時刻T2でドーピング原料の供給を開始し、時刻T3でドーピング原料の供給を停止してもよい。このようにしても上述同様に、所望とするIn組成で、高い正孔濃度のInGaAsSb半導体薄膜が得られる。   By the way, in the description using FIG. 6, the supply of the doping material is started simultaneously with the start of the film formation, and the supply of the doping material is stopped in the middle. However, the present invention is not limited to this. Instead, the supply of the doping material may be started in the middle of one cycle. For example, the supply of the doping material may not be started at time T1, the supply of the doping material may be started at time T2, and the supply of the doping material may be stopped at time T3. Even in this way, as described above, an InGaAsSb semiconductor thin film having a desired In composition and a high hole concentration can be obtained.

また、上述では、ドーピング原料の供給を停止し、また、各周期を等しい時間としたが、これに限るものではない。例えば、図8のシーケンス図に示すように、原料供給を行ってもよい。なお、前述同様に、供給する原料は、Ga原料,In原料,As原料,Sb原料,およびドーピング原料である。   In the above description, the supply of the doping material is stopped and each period is set to the same time. However, the present invention is not limited to this. For example, as shown in the sequence diagram of FIG. As described above, the raw materials to be supplied are Ga raw material, In raw material, As raw material, Sb raw material, and doping raw material.

まず、時刻T’1において、Ga原料,In原料,As原料,Sb原料,およびドーピング原料の供給を開始し、半導体基板の上に対する成膜を開始する。ドーピング原料の供給量は任意とすればよい。次いで、時刻T’2において、ドーピング原料の供給を減少させ、この状態を時刻T’3まで継続する。時刻T’1からT’3までの周期P2の間、ドーピング原料以外のGa原料,In原料,As原料,およびSb原料の供給量は変化させない。ここでは、T’1−T’2におけるドーピング原料の供給に対し、T’2−T’3におけるドーピング原料の供給を減らす(変化させる)ことが重要である。   First, at time T′1, the supply of the Ga material, In material, As material, Sb material, and doping material is started, and film formation on the semiconductor substrate is started. The supply amount of the doping material may be arbitrary. Next, at time T′2, the supply of the doping material is decreased, and this state is continued until time T′3. During the period P2 from time T′1 to T′3, the supply amounts of Ga raw material, In raw material, As raw material, and Sb raw material other than the doping raw material are not changed. Here, it is important to reduce (change) the supply of the doping material at T′2-T′3 with respect to the supply of the doping material at T′1-T′2.

周期P2の中で、時刻T’1から時刻T’2の間は、ドーピング原料を高濃度に供給しているので、成長している層中(固相)にほとんどInは取り込まれないが、一方で高濃度にCがドープされて高い正孔濃度が得られる。次に、時刻T’2から時刻T’3の間は、ドーピング原料の供給量が減少しているので、Inが取り込まれたInGaAsSb層が得られ、一方で炭素はほぼ低濃度のドープ状態となる。このように、1つの周期の中で、ドーピング原料の供給量を変化させることで、高濃度にCがドープされて低In組成の第1半導体層が時刻T’1から時刻T’2の間に形成され、ノンドープで所望のIn組成の第2半導体層が時刻T’2から時刻T’3の間に形成される。   In the period P2, between time T′1 and time T′2, the doping material is supplied at a high concentration, so that almost no In is taken into the growing layer (solid phase). On the other hand, a high hole concentration is obtained by doping C at a high concentration. Next, between time T′2 and time T′3, since the supply amount of the doping material is decreased, an InGaAsSb layer into which In is incorporated is obtained, while carbon is in a substantially low concentration doped state. Become. In this way, by changing the supply amount of the doping material in one period, the first semiconductor layer having a low In composition is doped between C at a high concentration between time T′1 and time T′2. A second semiconductor layer of a desired In composition that is non-doped is formed between time T′2 and time T′3.

このような時刻T’1から時刻T’3までの間隔P2を第1周期とし、次の第2周期のP3では、時間を変化させる。例えば、時刻T’3から時刻T’4までを時刻T’1から時刻T’2までより長くし、また、時刻T’4から時刻T’5までを時刻T’2から時刻T’3までより長くしてもよい。このように、各周期の間隔を変化させてもよい。   The interval P2 from time T'1 to time T'3 is set as the first period, and time is changed in the next second period P3. For example, time T′3 to time T′4 is longer than time T′1 to time T′2, and time T′4 to time T′5 is from time T′2 to time T′3. It may be longer. In this way, the interval of each cycle may be changed.

上述したシーケンスにより形成したInGaAsSb半導体薄膜の固相In組成xと正孔濃度pについて説明する。固相組成については、式(1)と同様に決定される。第1半導体層を形成する際のドーピング原料の供給量を、必ずしもInが取り込まれない領域を用いる必要はないため、x1≒0のような近似はできず、式(1)のようなより一般化された式を用いる方がよい。また、正孔濃度についても同様である。第2半導体層においてもドーピングを行っているため、第2半導体層の正孔濃度p2はp2≒0の近似はできない。従って半導体薄膜の正孔濃度は、より一般化された式(3)を用いる方がよい。 The solid phase In composition x and the hole concentration p of the InGaAsSb semiconductor thin film formed by the above-described sequence will be described. About a solid-phase composition, it determines similarly to Formula (1). Since it is not necessary to use a region in which In is not taken in for the supply amount of the doping raw material when forming the first semiconductor layer, approximation such as x1≈0 cannot be performed, and more general expression (1) can be obtained. It is better to use the generalized formula. The same applies to the hole concentration. Since doping is also performed in the second semiconductor layer, the hole concentration p 2 of the second semiconductor layer cannot be approximated to p 2 ≈0. Therefore, it is better to use the more general formula (3) for the hole concentration of the semiconductor thin film.

上述した実施の形態における製造方法によれば、基板の上に互いに接して積層された第1半導体層および第2半導体層から構成された半導体薄膜であって、第2半導体層より低いIn組成とされた状態でIn,Ga,As,およびSbを含んで構成され、炭素のドーピングによる正孔濃度が第2半導体層より高い値とされた第1半導体層と、In,Ga,As,およびSbを含んで構成され、炭素のドーピングによる正孔濃度が第1半導体層より低い値とされている第2半導体層とが、基板の上に互いに接して積層された半導体薄膜が得られる。例えば、第1半導体層は、正孔濃度が、1×1019cm-3より高く、第2半導体層は、正孔濃度が、1×1019cm-3より低くなっていればよい。また、第1半導体層は、例えば、固相In組成が0.1より小さくなっていればよい。 According to the manufacturing method in the above-described embodiment, the semiconductor thin film is composed of the first semiconductor layer and the second semiconductor layer stacked on and in contact with each other on the substrate, and has an In composition lower than that of the second semiconductor layer. A first semiconductor layer that is configured to contain In, Ga, As, and Sb, and has a higher hole concentration due to carbon doping than the second semiconductor layer, and In, Ga, As, and Sb. And a semiconductor thin film in which a hole concentration due to carbon doping is lower than that of the first semiconductor layer is stacked on the substrate in contact with each other. For example, the first semiconductor layer may have a hole concentration higher than 1 × 10 19 cm −3 , and the second semiconductor layer may have a hole concentration lower than 1 × 10 19 cm −3 . The first semiconductor layer only needs to have a solid phase In composition smaller than 0.1, for example.

ここで、第1半導体層は、GaAsSb,InGaAsSb,AlGaAsSb,およびInAlGaAsSbのいずれかであればよい。正孔濃度がより高濃度の第1半導体層では、前述したように、Inが取り込まれない状態で形成される場合もある。また、第2半導体層は、InGaAsSbおよびInAlGaAsSbのいずれかであればよい。   Here, the first semiconductor layer may be any one of GaAsSb, InGaAsSb, AlGaAsSb, and InAlGaAsSb. As described above, the first semiconductor layer having a higher hole concentration may be formed in a state where In is not taken in. The second semiconductor layer may be either InGaAsSb or InAlGaAsSb.

以上に説明したように、本発明では、In,Ga,As,およびSbを含む化合物半導体薄膜を形成するための、In原料,Ga原料,As原料,およびSb原料の供給過程で、p型を発現させるためのハロメタン系のCドーピング原料の供給量を、時系列的に増減させるようにした。この結果、本発明によれば、所望のIn組成が得られる状態で、高濃度にCがドープできるようになる。   As described above, in the present invention, the p-type is formed in the supply process of the In raw material, the Ga raw material, the As raw material, and the Sb raw material for forming the compound semiconductor thin film containing In, Ga, As, and Sb. The supply amount of the halomethane-based C doping raw material for the expression was increased or decreased in time series. As a result, according to the present invention, C can be doped at a high concentration in a state where a desired In composition can be obtained.

なお、本発明は以上に説明した実施の形態に限定されるものではなく、本発明の技術的思想内で、当分野において通常の知識を有する者により、多くの変形および組み合わせが実施可能であることは明白である。例えば、上述では、主に、ドーピング原料としてCBr4を用いた場合について説明したが、これに限るものではない。In、Ga、As,Sbを含む混晶系材料に対するエッチング効果は、ハロゲン系元素に起因するものであり、例えばCCl4などの他のハロメタン原料を用いても同様である。 The present invention is not limited to the embodiment described above, and many modifications and combinations can be implemented by those having ordinary knowledge in the art within the technical idea of the present invention. It is obvious. For example, in the above description, the case where CBr 4 is mainly used as a doping material has been described. However, the present invention is not limited to this. The etching effect on the mixed crystal material containing In, Ga, As, and Sb is attributed to the halogen-based element, and the same is true when other halomethane raw materials such as CCl 4 are used.

また、上述した実施の形態では、InGaAsSbを例に説明したが、これに限るものではなく、例えば、上述したように、InAlGaAsSbに対しても同様の効果が得られる。   In the above-described embodiment, InGaAsSb has been described as an example. However, the present invention is not limited to this. For example, as described above, the same effect can be obtained for InAlGaAsSb.

また、本発明における製造方法で得られる半導体薄膜は、デバイスを構成する半導体層として用いればよい。例えば、一例ではあるが、HBTのベース層として、本発明による半導体薄膜を用いることが可能である。例えば、高抵抗なInPからなる半導体基板上に、サブコレクタ層、コレクタ層を形成した後、本発明による半導体薄膜をベース層として形成し、この後、ベース層の上にエミッタ層を形成することで、高性能なHBTを得ることができる。   Further, the semiconductor thin film obtained by the manufacturing method in the present invention may be used as a semiconductor layer constituting the device. For example, as an example, the semiconductor thin film according to the present invention can be used as the base layer of the HBT. For example, after forming a subcollector layer and a collector layer on a semiconductor substrate made of high resistance InP, a semiconductor thin film according to the present invention is formed as a base layer, and then an emitter layer is formed on the base layer. Thus, a high-performance HBT can be obtained.

また、第1工程と第2工程との周期および周期の繰り返し数は、前述した実施の形態に限るものではない。例えば、HBTのベース層への応用を考えた場合、半導体薄膜の少数キャリアの輸送特性が最大限引き出せる周期および周期の繰り返し数を適宜に設定して用いればよい。また、本発明は、既に公知の技術として広く用いられている、超格子構造を用いた変調ドーピング技術の効果もあるが、この場合面内移動度が最大限になるように周期および周期の繰り返し数が最適化される。このように、適用するデバイスの構造に対し、周期および周期の繰り返し数は、適宜に設定して最適化させればよい。いずれにしても、第1工程と第2工程とを行えば、本発明の効果は得られる。   Further, the cycle of the first step and the second step and the number of repetitions of the cycle are not limited to the above-described embodiment. For example, when application to the base layer of HBT is considered, the period and the number of repetitions of the period may be appropriately set and used so that the minority carrier transport characteristics of the semiconductor thin film can be maximized. The present invention also has the effect of the modulation doping technique using a superlattice structure, which is widely used as a known technique. In this case, the period and the period are repeated so that the in-plane mobility is maximized. The number is optimized. In this manner, the period and the number of repetitions of the period may be appropriately set and optimized for the structure of the device to be applied. In any case, the effects of the present invention can be obtained by performing the first step and the second step.

また、上述した実施の形態では、第1工程から第2工程への移行において、急峻にドーピング原料の供給量を変更したが、これに限るものではない。例えば、第1工程から第2工程への移行において、徐々にドーピング原料の供給量を減少させるようにしてもよく、徐々にドーピング原料の供給量を増加させるようにしてもよい。また、周期を繰り返す場合、全体として、ドーピング原料の供給量が、時間の変化に対して正弦波のように変化する状態としてもよい。   In the above-described embodiment, the supply amount of the doping material is changed steeply in the transition from the first process to the second process, but the present invention is not limited to this. For example, in the transition from the first step to the second step, the supply amount of the doping material may be gradually decreased, or the supply amount of the doping material may be gradually increased. Further, when the cycle is repeated, as a whole, the supply amount of the doping material may be changed like a sine wave with respect to time.

701…半導体基板、702…第1半導体層、703…第2半導体層、704…InGaAsSb薄膜。   701 ... Semiconductor substrate, 702 ... First semiconductor layer, 703 ... Second semiconductor layer, 704 ... InGaAsSb thin film.

Claims (5)

In原料,Ga原料,As原料,およびSb原料を供給することを含む第1条件で化合物半導体を基板の上に堆積する第1工程と、
前記第1工程に引き続いて、In原料,Ga原料,As原料,およびSb原料を供給することを含む第2条件で化合物半導体を前記基板の上に堆積する第2工程と
を少なくとも備え、
前記第1条件および前記第2条件の一方は、他方に比較してハロメタン系の炭素ドーピング原料の供給量を少なくし、
前記基板の上に、In,Ga,As,およびSbを含み、炭素がドーピングされてp型とされた化合物半導体の薄膜を形成することを特徴とする半導体薄膜の形成方法。
A first step of depositing a compound semiconductor on a substrate under a first condition including supplying an In source, a Ga source, an As source, and an Sb source;
Subsequent to the first step, at least a second step of depositing a compound semiconductor on the substrate under a second condition including supplying an In raw material, a Ga raw material, an As raw material, and an Sb raw material,
One of the first condition and the second condition reduces the supply amount of the halomethane-based carbon doping raw material compared to the other,
A method of forming a semiconductor thin film, comprising: forming a p-type compound semiconductor thin film containing In, Ga, As, and Sb and doped with carbon on the substrate.
請求項1記載の半導体薄膜の形成方法において、
前記第1条件および前記第2条件は、In原料,Ga原料,As原料,およびSb原料の供給量を同一とすることを特徴とする半導体薄膜の形成方法。
In the formation method of the semiconductor thin film of Claim 1,
The method for forming a semiconductor thin film characterized in that the first condition and the second condition are the same in amounts of supply of an In material, a Ga material, an As material, and an Sb material.
請求項1または2記載の半導体薄膜の形成方法において、
前記炭素ドーピング原料は、四塩化炭素または四臭化炭素であることを特徴とする半導体薄膜の形成方法。
In the formation method of the semiconductor thin film of Claim 1 or 2,
The method for forming a semiconductor thin film, wherein the carbon doping raw material is carbon tetrachloride or carbon tetrabromide.
基板の上に互いに接して積層された第1半導体層および第2半導体層から構成された半導体薄膜であって、
前記第1半導体層は、前記第2半導体層より低いIn組成とされた状態でIn,Ga,As,およびSbを含んで構成され、炭素のドーピングによる正孔濃度が前記第2半導体層より高い値とされ、
前記第2半導体層は、In,Ga,As,およびSbを含んで構成され、炭素のドーピングによる正孔濃度が前記第1半導体層より低い値とされている
ことを特徴とする半導体薄膜。
A semiconductor thin film composed of a first semiconductor layer and a second semiconductor layer laminated in contact with each other on a substrate,
The first semiconductor layer includes In, Ga, As, and Sb in a lower In composition than the second semiconductor layer, and has a higher hole concentration due to carbon doping than the second semiconductor layer. Value,
The second semiconductor layer includes In, Ga, As, and Sb, and has a hole concentration due to carbon doping lower than that of the first semiconductor layer.
請求項4記載の半導体薄膜において、
前記第1半導体層は、GaAsSb,InGaAsSb,AlGaAsSb,およびInAlGaAsSbのいずれかであり、
前記第2半導体層は、InGaAsSbおよびInAlGaAsSbのいずれかである
ことを特徴とする半導体薄膜。
The semiconductor thin film according to claim 4,
The first semiconductor layer is one of GaAsSb, InGaAsSb, AlGaAsSb, and InAlGaAsSb,
The semiconductor thin film, wherein the second semiconductor layer is either InGaAsSb or InAlGaAsSb.
JP2012089446A 2012-04-10 2012-04-10 Manufacturing method of semiconductor thin film Active JP5833491B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2012089446A JP5833491B2 (en) 2012-04-10 2012-04-10 Manufacturing method of semiconductor thin film

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2012089446A JP5833491B2 (en) 2012-04-10 2012-04-10 Manufacturing method of semiconductor thin film

Publications (2)

Publication Number Publication Date
JP2013219242A true JP2013219242A (en) 2013-10-24
JP5833491B2 JP5833491B2 (en) 2015-12-16

Family

ID=49591005

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2012089446A Active JP5833491B2 (en) 2012-04-10 2012-04-10 Manufacturing method of semiconductor thin film

Country Status (1)

Country Link
JP (1) JP5833491B2 (en)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014203941A (en) * 2013-04-04 2014-10-27 日本電信電話株式会社 Heterojunction bipolar transistor and manufacturing method therefor
JP2015099859A (en) * 2013-11-19 2015-05-28 日本電信電話株式会社 Method for manufacturing semiconductor thin film and heterojunction bipolar transistor
JP2015211044A (en) * 2014-04-23 2015-11-24 日本電信電話株式会社 InGaSb MULTILAYER STRUCTURE SUBSTRATE FOR LAMINATION
CN113646906A (en) * 2019-04-09 2021-11-12 杜鹏 Superlattice absorber for detector

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002544666A (en) * 1999-05-05 2002-12-24 エイチアールエル ラボラトリーズ,エルエルシー Formation of ohmic contact to InP using non-stoichiometric InP layer
JP2010050176A (en) * 2008-08-20 2010-03-04 Nippon Telegr & Teleph Corp <Ntt> Method for manufacturing compound semiconductor, method for manufacturing semiconductor light-receiving element, compound semiconductor, and the semiconductor light-receiving element
JP2011009330A (en) * 2009-06-24 2011-01-13 Nippon Telegr & Teleph Corp <Ntt> Heterojunction bipolar transistor
JP2011040677A (en) * 2009-08-18 2011-02-24 Japan Science & Technology Agency Semiconductor laminated structure
JP2011243675A (en) * 2010-05-17 2011-12-01 Nippon Telegr & Teleph Corp <Ntt> Avalanche photodiode

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002544666A (en) * 1999-05-05 2002-12-24 エイチアールエル ラボラトリーズ,エルエルシー Formation of ohmic contact to InP using non-stoichiometric InP layer
JP2010050176A (en) * 2008-08-20 2010-03-04 Nippon Telegr & Teleph Corp <Ntt> Method for manufacturing compound semiconductor, method for manufacturing semiconductor light-receiving element, compound semiconductor, and the semiconductor light-receiving element
JP2011009330A (en) * 2009-06-24 2011-01-13 Nippon Telegr & Teleph Corp <Ntt> Heterojunction bipolar transistor
JP2011040677A (en) * 2009-08-18 2011-02-24 Japan Science & Technology Agency Semiconductor laminated structure
JP2011243675A (en) * 2010-05-17 2011-12-01 Nippon Telegr & Teleph Corp <Ntt> Avalanche photodiode

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
JPN6015022352; 星拓也 他: '19a-TW-6 InP基板上CドープInxGa1-xAs1-ySby のMOCVD成長 Carbon-doped InxGa1' 2010年春季第57回応用物理学関係連合講演会講演予稿集 , 20100303, p.15-099, 応用物理学会 *

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014203941A (en) * 2013-04-04 2014-10-27 日本電信電話株式会社 Heterojunction bipolar transistor and manufacturing method therefor
JP2015099859A (en) * 2013-11-19 2015-05-28 日本電信電話株式会社 Method for manufacturing semiconductor thin film and heterojunction bipolar transistor
JP2015211044A (en) * 2014-04-23 2015-11-24 日本電信電話株式会社 InGaSb MULTILAYER STRUCTURE SUBSTRATE FOR LAMINATION
CN113646906A (en) * 2019-04-09 2021-11-12 杜鹏 Superlattice absorber for detector
CN113646906B (en) * 2019-04-09 2024-06-04 杜鹏 Superlattice absorber for detector

Also Published As

Publication number Publication date
JP5833491B2 (en) 2015-12-16

Similar Documents

Publication Publication Date Title
JP2003297849A (en) Heterojunction bipolar transistor and manufacture method therefor
JP3368452B2 (en) Compound semiconductor device and method of manufacturing the same
JP5833491B2 (en) Manufacturing method of semiconductor thin film
JP5108694B2 (en) Thin film crystal wafer having pn junction and method for manufacturing the same
WO2020009020A1 (en) Tunnel field-effect transistor
WO2015182593A1 (en) Epitaxial wafer for heterojunction bipolar transistor, and heterojunction bipolar transistor
JP2013021024A (en) Transistor element
CN100350577C (en) Gallium-indium-nitride-arsenide based epitaxial wafer and hetero-field effect transistor using the same, and its manufacturing method
JP2007258258A (en) Nitride semiconductor element, and its structure and forming method
JP6200375B2 (en) Epitaxial wafer for heterojunction bipolar transistor and heterojunction bipolar transistor
JP6096569B2 (en) Method for manufacturing heterojunction bipolar transistor
JP2007103925A (en) Semiconductor device and method for manufacturing the same
JP2008103546A (en) Group iii-v compound semiconductor element, and group iii-v compound semiconductor epitaxial wafer
JP2004214576A (en) Hetero-bipolar transistor
JP2004140038A (en) Method for manufacturing thin film crystal wafer, semiconductor device and its manufacturing method
JP3502267B2 (en) Manufacturing method of bipolar transistor
CN117012814B (en) Epitaxial structure of InP-based heterojunction bipolar transistor and preparation method thereof
JP5543302B2 (en) Compound semiconductor wafer manufacturing method and compound semiconductor device
JP4158683B2 (en) Epitaxial wafer for heterojunction bipolar transistor
JP2017011264A (en) Semiconductor substrate, method of producing semiconductor substrate, and heterojunction bipolar transistor
JP5301507B2 (en) Compound semiconductor epitaxial substrate
JP6193738B2 (en) Method for producing semiconductor thin film and heterojunction bipolar transistor
JP2006019378A (en) Semiconductor device
JP2003086603A (en) THIN FILM CRYSTAL WAFER HAVING pn JUNCTION AND ITS MANUFACTURING METHOD
TW201707090A (en) Epitaxial wafer for hetero-junction bipolar transistor, and hetero-junction bipolar transistor

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20140704

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20150521

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20150609

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20150806

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20151027

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20151029

R150 Certificate of patent or registration of utility model

Ref document number: 5833491

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150