JP2012533800A5 - - Google Patents

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【０００２】
多くのストレージシステムにおいて、ターゲット装置は、フレームをホストに転送しているときにコリジョンが発生した場合の優先順位を有する。これらの場合、コマンドがキュー（待ち行列）に入っているとき（例えば、ファーストパーティ直接メモリアクセス（Ｆｉｒｓｔ Ｐａｒｔｙ Ｄｉｒｅｃｔ Ｍｅｍｏｒｙ Ａｃｃｅｓｓ）などを使用して）、いったん前記ターゲットが直接メモリアクセス（ｐａｒｔｙ ｄｉｒｅｃｔ ｍｅｍｏｒｙ ａｃｃｅｓｓ：ＤＭＡ）セットアップフレーム情報構造（ｆｒａｍｅ ｉｎｆｏｒｍａｔｉｏｎ ｓｔｒｕｃｔｕｒｅ：ＦＩＳ）を送信してデータフェーズに入ると、前記ホストは通常いかなるコマンドも前記ターゲット装置に送信できなくなる。
前記ドライブが速くデータをフェッチ（取得）することができる場合、次に前記ホストは最大キュー長と同等の数のいくつかのコマンドを前記ドライブに送信することができ得る。前記ドライブは、次にＤＭＡセットアップ、データ、ＤＭＡセットアップ、データなどを前記フレーム間に全くブレークを入れずに戻す。これにより、前記ホストはこれ以上のコマンドを送信することができなくなる。
これらの場合、前記ドライブのキュー長は、最大キュー長からゼロへ、ゼロから最大キュー長に戻り、そして再びゼロへと振動する。これはパフォーマンスに悪影響を及ぼす。このように、従来技術に関連するこれらおよび／またはその他の問題に対処する必要性が存在する。
この出願の発明に関連する先行技術文献情報としては、以下のものがある（国際出願日以降国際段階で引用された文献及び他国に国内移行した際に引用された文献を含む）。
【先行技術文献】
【特許文献】
【０００３】
【特許文献１】 米国特許第５８８１２２９号明細書
【特許文献２】 米国特許第７１２０７２９号明細書
【特許文献３】 米国特許第７１０３７３２号明細書
【特許文献４】 米国特許第７０９６３１３号明細書
【特許文献５】 米国特許第７０３５９６７号明細書
【特許文献６】 米国特許第６９８５９９２号明細書
【特許文献７】 米国特許第６９７３５３１号明細書
【特許文献８】 米国特許第６８３１８６５号明細書
【特許文献９】 米国特許第６０００００６号明細書
【特許文献１０】 米国特許第５９５６４７３号明細書
【特許文献１１】 米国特許第５６２１６８７号明細書
【特許文献１２】 米国特許第５５６８４２３号明細書
【特許文献１３】 米国特許第７０３２０８７号明細書
【特許文献１４】 米国特許第７００００６３号明細書
【特許文献１５】 米国特許第６９４８０２６号明細書
【特許文献１６】 米国特許第６９２５５２３号明細書
【特許文献１７】 米国特許第６９１４８５３号明細書
【特許文献１８】 米国特許第６７３２２２１号明細書
【特許文献１９】 米国特許第６６９４４０２号明細書
【特許文献２０】 米国特許第６５３９４５３号明細書
【特許文献２１】 米国特許第６４０５２９５号明細書
【特許文献２２】 米国特許第６２３０２３３号明細書
【特許文献２３】 米国特許第６１５４８０８号明細書
【特許文献２４】 米国特許第５９６３９７０号明細書
【特許文献２５】 米国特許第５８３５９３５号明細書
【特許文献２６】 米国特許第５８１９３０７号明細書
【特許文献２７】 米国特許第５５６８６２６号明細書
【特許文献２８】 米国特許第５５４４３５６号明細書
【特許文献２９】 米国特許第５４８５５９５号明細書
【特許文献３０】 米国特許第７７４７８１３号明細書
【特許文献３１】 米国特許第７８０９９００号明細書
【特許文献３２】 米国特許第７８４９２７５号明細書
【特許文献３３】 米国特許第７９０３４８６号明細書
【特許文献３４】 米国特許第７６２０７４７号明細書
【特許文献３５】 米国特許第７９０４６１９号明細書
【特許文献３６】 米国特許第７５４９０１３号明細書
【特許文献３７】 米国特許第７９０４６７２号明細書
【特許文献３８】 米国特許第７００３６２３号明細書
【特許文献３９】 米国特許第７９０４７６４号明細書
【特許文献４０】 米国特許第７２２２２１４号明細書
【特許文献４１】 米国特許第６６００６１４号明細書
【特許文献４２】 米国特許第７８２７３２０号明細書
【特許文献４３】 米国特許第６０８５２４８号明細書
【特許文献４４】 米国特許第６９２８４９４号明細書
【特許文献４５】 米国特許第７６３１１２８号明細書
【特許文献４６】 米国特許第７８２７３２０号明細書
【特許文献４７】 米国特許出願公開第２００５／０１６６０１４号明細書
【特許文献４８】 米国特許出願公開第２００６／０２１８４３７号明細書
【特許文献４９】 米国特許出願公開第２００８／０２９４８０１号明細書
【特許文献５０】 米国特許出願公開第２００３／００４１２１４号明細書
【特許文献５１】 米国特許出願公開第２００８／０２８２０３１号明細書
【特許文献５２】 米国特許出願公開第２００８／００９００２１号明細書
【特許文献５３】 米国特許出願公開第２０１０／０２５０８３０号明細書
【特許文献５４】 米国特許出願公開第２００８／０２３３７９８号明細書
【特許文献５５】 米国特許出願公開第２００８／０２９４８１３号明細書
【特許文献５６】 米国特許出願公開第２０１１／００４１０３９号明細書
【特許文献５７】 米国特許出願公開第２００９／００９４４０９号明細書
【特許文献５８】 米国特許出願公開第２０１１／００４１００５号明細書
【特許文献５９】 米国特許出願公開第２０１１／００１６２３９号明細書
【特許文献６０】 米国特許出願公開第２００９／０１２５６４５号明細書
【特許文献６１】 米国特許出願公開第２００８／０２８２０３１号明細書
【特許文献６２】 米国特許出願公開第２０１１／００２２７６５号明細書
【特許文献６３】 米国特許出願公開第２０１０／０１１５１８９号明細書
【特許文献６４】 米国特許出願公開第２００９／０３００２５９号明細書
【特許文献６５】 米国特許出願公開第２００３／００４１２１４号明細書
【特許文献６６】 米国特許出願公開第２０１１／００８３０４７号明細書
【特許文献６７】 米国特許出願公開第２０１０／０１０６９０５号明細書
【特許文献６８】 米国特許出願公開第２０１０／００１７６５０号明細書
【特許文献６９】 米国特許出願公開第２００８／０２９４８０１号明細書
【特許文献７０】 米国特許出願公開第２０１１／０１２５９５６号明細書
【特許文献７１】 米国特許出願公開第２０１０／００６７１３３号明細書
【特許文献７２】 米国特許出願公開第２０１０／００３７００１号明細書
【特許文献７３】 米国特許出願公開第２００６／０２１８４３７号明細書
【特許文献７４】 米国特許出願公開第２００９／０１３８６７１号明細書
【特許文献７５】 米国特許出願公開第２０１０／００１７５８８号明細書
【特許文献７６】 米国特許出願公開第２０１０／００１７８０７号明細書
【特許文献７７】 米国特許出願公開第２０１０／００１７５６６号明細書
【特許文献７８】 米国特許出願公開第２０１１／０００４７２２号明細書
【特許文献７９】 米国特許出願公開第２０１０／００６４０９３号明細書
【特許文献８０】 米国特許出願公開第２０１０／０１４６２３６号明細書
【特許文献８１】 米国特許出願公開第２０１０／０２５１００９号明細書
【特許文献８２】 米国特許出願公開第２００８／０１４１０５４号明細書
【特許文献８３】 米国特許出願公開第２０１１／０１６７１９９号明細書
【特許文献８４】 米国特許出願公開第２０１０／００６４０９６号明細書
【特許文献８５】 米国特許出願公開第２００８／０００５３９８号明細書
【特許文献８６】 米国特許出願公開第２００６／０２０９６８４号明細書
【特許文献８７】 米国特許出願公開第２００５／０１６６０１４号明細書
【特許文献８８】 米国特許出願公開第２０１０／０２５０８２９号明細書
【特許文献８９】 米国特許出願公開第２０１０／０２５０８３０号明細書
【特許文献９０】 米国特許出願公開第２０１１／００４１０３９号明細書
【特許文献９１】 米国特許出願公開第２０１１／０００４７２２号明細書
【特許文献９２】 米国特許出願公開第２０１０／００１７６５０号明細書
【特許文献９３】 米国特許出願公開第２００９／００９４４０９号明細書
【特許文献９４】 米国特許出願公開第２００８／０２９４８１３号明細書
【特許文献９５】 米国特許出願公開第２００８／０２９４８０１号明細書
【特許文献９６】 米国特許出願公開第２００８／０００５３９８号明細書
【特許文献９７】 米国特許出願公開第２００６／０２１８４３７号明細書
【特許文献９８】 米国特許出願公開第２００５／０１６６０１４号明細書
【特許文献９９】 国際公開第２０１１／００８９６３号
【特許文献１００】 国際公開第２０１１／００８９６３号
【非特許文献】
【０００４】
【非特許文献１】 Ｉｎｔｅｒｎａｔｉｏｎａｌ Ｓｅａｒｃｈ Ｒｅｐｏｒｔ ｆｏｒ ＰＣＴｌＵＳ２０１０／０４２１４７， ｍａｉｌｅｄ Ｍａｒｃｈ ２４， ２０１１，９ ｐａｇｅｓ
【非特許文献２】 Ｉｎｔｅｌ Ｘ２５−Ｅ ＳＡＴＡ Ｓｏｌｉｄ Ｓｔａｔｅ Ｄｒｉｖｅ， Ｍａｙ ２００９， Ｄｏｃｕｍｅｎｔ Ｏｒｄｅｒ Ｎｏ． ３１９９８４−００５ＵＳ， Ｉｎｔｅｌ， ａｓ ｃｉｔｅｄ ｂｙ ｔｈｅ Ｅｘａｍｉｎｅｒ ｉｎ ａ Ｊｕｎｅ ７， ２０１１ ｏｆｆｉｃｅ ａｃｔｉｏｎ ｉｎ Ｕ．Ｓ． Ｐａｔｅｎｔ Ａｐｐｌｉｃａｔｉｏｎ Ｓｅｒｉａｌ Ｎｏ． １２５７３７９２， ２４ ｐａｇｅｓ
【非特許文献３】 ＲＥＮ， Ｊｉｎ ａｎｄ ＹＡＮＧ， Ｑｉｎｇ； "Ｉ−ＣＡＳＨ： Ｉｎｔｅｌｌｉｇｅｎｔｌｙ Ｃｏｕｐｌｅｄ Ａｒｒａｙ ｏｆ ＳＳＤ ａｎｄ ＨＤＤ" ｉｎ Ｔｈｅ １７ｔｈ ＩＥＥＥ Ｉｎｔｅｒｎａｔｉｏｎａｌ
【非特許文献４】 Ｓｙｍｐｏｓｉｕｍ ｏｎ Ｈｉｇｈ Ｐｅｒｆｏｒｍａｎｃｅ Ｃｏｍｐｕｔｅｒ Ａｒｃｈｉｔｅｃｔｕｒｅ， ２０１１ （ＨＰＣＡ'ＩＩ）， Ｓａｎ Ａｎｔｏｎｉｏ， ＴＸ， ＵＳＡ Ｆｅｂ ２０１１， １２ ｐａｇｅｓ， ｐｐ ２７８−２９８
【非特許文献５】 Ｓｅｒｉａｌ ＡＴＡ ＮＳＳＤ （ＮＡＮＤ ｂａｓｅｄ Ｓｏｌｉｄ Ｓｔａｔｅ Ｄｒｉｖｅ）， Ｊｕｌｙ ２００８， Ｓａｍｓｕｎｇ，ａｓ ｃｉｔｅｄ ｂｙ ｔｈｅ Ｅｘａｍｉｎｅｒ ｉｎ ａ Ｊｕｎｅ ７，２０１１ ｏｆｆｉｃｅ ａｃｔｉｏｎ ｉｎ Ｕ．Ｓ． Ｐａｔｅｎｔ Ａｐｐｌｉｃａｔｉｏｎ Ｓｅｒｉａｌ Ｎｏ． １２５７３７９２ Ｒｅｖｉｓｉｏｎ １．０， ３９ ｐａｇｅｓ
【非特許文献６】 ＨＵＦＦＭＡＮ， Ａｍｂｅｒ ａｎｄ ＣＬＡＲＫ， Ｊｏｎｉ； "Ｓｅｒｉａｌ ＡＴＡ Ｎａｔｉｖｅ Ｃｏｍｍａｎｄ Ｑｕｅｕｉｎｇ， Ａｎ Ｅｘｃｉｔｉｎｇ Ｎｅｗ Ｐｅｒｆｏｒｍａｎｃｅ Ｆｅａｔｕｒｅ ｆｏｒ Ｓｅｒｉａｌ ＡＴＡ"， Ａ Ｊｏｉｎｔ Ｗｈｉｔｅｐａｐｅｒ Ｂｙ： Ｉｎｔｅｌ Ｃｏｒｐｏｒａｔｉｏｎ ａｎｄ Ｓｅａｇａｔｅ Ｔｅｃｈｎｏｌｏｇｙ， Ｊｕｌｙ ２００３， Ｕｎｉｔｅｄ Ｓｔａｔｅｓ， １２ ｐａｇｅｓ
【非特許文献７】 ＯＬＳＯＮ． Ａｌａｎ Ｒａｎｄ Ｄｅｎｉｓ Ｊ Ｌａｎｇｌｏｉｓ． Ｓｏｌｉｄ Ｓｔａｔｅ Ｄｒｉｖｅｓ Ｄａｔａ Ｒｅｌｉａｂｉｌｉｔｙ ａｎｄ Ｌｉｆｅｔｉｍｅ， Ａｐｒｉｌ ７， ２００８， Ｉｍａｔｉｏｎ， ２７ ｐａｇｅｓ
【非特許文献８】 "Ｓｅｒｉａｌ ＡＴＡ ＩＩ Ｎａｔｉｖｅ Ｃｏｍｍａｎｄ Ｑｕｅｕｉｎｇ Ｏｖｅｒｖｉｅｗ"， Ａｐｐｌｉｃａｔｉｏｎ Ｎｏｔｅ， Ａｐｒｉｌ ２００３， Ｏｒｄｅｒ Ｎｏ． ２５２６６４−００２， Ｉｎｔｅｌ Ｃｏｒｐｏｒａｔｉｏｎ， Ｕｎｉｔｅｄ Ｓｔａｔｅｓ， ２１ ｐａｇｅｓ
【非特許文献９】 Ｏｃｔｏｂｅｒ ７，２０１１ Ｌｉｓｔ ｏｆ Ａｒｔ Ｒｅｊｅｃｔｉｏｎｓ ｉｎ Ｃａｓｅｓ Ｒｅｌａｔｅｄ ｔｏ Ｄｏｃｋｅｔ Ｎｏ． ＳＡＦＩ Ｐ０３１， １ ｐａｇｅ
【発明の概要】
【課題を解決するための手段】

Claims (21)

  1. 方法であって、
    ドライブが、１若しくはそれ以上のコマンドをホスト装置から受信する工程であって、前記ホスト装置と前記ドライブは直接メモリアクセス（ＤＭＡ）データフェーズを有するストレージプロトコルを介して通信するものであり、前記ドライブは前記ホスト装置による追加のコマンドの送信を阻止することを可能とするものである、前記受信する工程と、
    前記ホスト装置に送信する情報をキューに入れる工程と、
    ドライブの状態関数として、現在のホストの信号に依存せずに、前記ホスト装置に送信する前記情報にギャップを挿入するかを決定する工程であって、前記ギャップは連続する２つのＤＭＡデータフェーズの各データ間に挿入され、それにより、前記ホスト装置はドライブに追加のコマンドを送信することができるものである、前記決定する工程と、
    前記決定する工程の決定に基づいて、ギャップを挿入する、またはギャップを挿入しない工程と、
    を有し、
    前記ドライブの状態関数は、前記ドライブの現在のキュー長の関数を含むものである
    方法。
  2. 請求項１記載の方法において、前記ホストに送信する情報は、セットアップ情報および前記１若しくはそれ以上のコマンドのうちの少なくとも１つに関連付けられたデータを含むものである方法。
  3. 請求項２記載の方法において、前記セットアップ情報は、直接メモリアクセス（ｄｉｒｅｃｔ ｍｅｍｏｒｙ ａｃｃｅｓｓ：ＤＭＡ）フレーム情報構造（ｆｒａｍｅ ｉｎｆｏｒｍａｔｉｏｎ ｓｔｒｕｃｔｕｒｅ：ＦＩＳ）を含むものである方法。
  4. 請求項２記載の方法において、前記セットアップ情報は、セット・デバイス・ビットＦＩＳを含むものである方法。
  5. 請求項２記載の方法において、時間遅延が、前記セットアップ情報を送信する前に挿入されるものである方法。
  6. 請求項２記載の方法において、時間遅延が、前記セットアップ情報を送信した後に挿入されるものである方法。
  7. 請求項１記載の方法において、さらに、
    前記ドライブが、時間遅延の間に前記追加のコマンドを前記ホスト装置から受信する工程を有するものである方法。
  8. 請求項１記載の方法において、前記ギャップを挿入する工程は、前記情報が前記ホスト装置に送信されている間に時間遅延を挿入する工程を含むものである方法。
  9. 請求項１記載の方法において、前記ギャップは、現在のキュー長がゼロと等しい時には挿入されないものである方法。
  10. 請求項１記載の方法において、前記ドライブの状態関数は、前のコマンドを受信してからの経過時間の関数を含むものである方法。
  11. 請求項８記載の方法において、前記時間遅延の時間長は、前記ドライブの現在のキュー長に基づくものである方法。
  12. 請求項８記載の方法において、前記時間遅延の時間長は、前記ドライブが前のコマンドを受信してからの経過時間に基づくものである方法。
  13. 請求項１記載の方法において、時間遅延の時間長または前記時間遅延が挿入される時点のうちの少なくとも１つは、リアルタイムで決定されるものである方法。
  14. 請求項１記載の方法において、時間遅延の時間長または前記時間遅延が挿入される時点のうちの少なくとも１つは、所定値である方法。
  15. 請求項１記載の方法において、前記ホストに送信する前記情報はセットアップ情報を含み、このセットアップ情報は時間遅延が当該セットアップ情報に後続することを示す追加の情報を含むものである方法。
  16. 請求項１記載の方法において、ホストに送信する前記情報はステータス情報を含み、時間遅延が当該ステータス情報を送信する前に挿入されるものである方法。
  17. 請求項１記載の方法において、前記ギャップを挿入する工程は、追加情報を挿入する工程を含むものである方法。
  18. 請求項１記載の方法において、前記ホスト装置は、前記ギャップに先立って前記ギャップについて通知されるものである方法。
  19. 請求項１記載の方法において、前記ドライブはシリアルＡＴＡ（Ｓｅｒｉａｌ ＡＴＡ：ＳＡＴＡ）ドライブを含むものである方法。
  20. コンピュータ可読媒体に組み込まれたコンピュータプログラム製品であって、
    ドライブが、１若しくはそれ以上のコマンドをホスト装置から受信するコンピュータコードであって、前記ホスト装置と前記ドライブがＤＭＡデータフェーズを有するストレージプロトコルを介して通信するものであり、前記ドライブは前記ホスト装置による追加のコマンドの送信を阻止することができるものである、前記受信するコンピュータコードと、
    前記ホスト装置に送る情報をキュー（待ち行列）に入れるコンピュータコードと、
    ドライブの現在のキュー長の関数として、現在のホストの信号に依存せずに、前記ホスト装置に送信する前記情報にギャップを挿入するかを決定するコンピュータコードであって、前記ギャップは連続する２つのＤＭＡデータフェーズの各データ間に挿入され、それにより、前記ホスト装置はドライブに追加のコマンドを送信することができるものである、前記決定するコンピュータコードと、
    前記決定される条件に基づいて、ギャップを挿入する、またはギャップを挿入しないコンピュータコードと
    を有するコンピュータプログラム製品。
  21. １若しくはそれ以上のコマンドをホスト装置から受信することができるものであるドライブであって、前記ホスト装置と前記ドライブはＤＭＡデータフェーズを有するストレージプロトコルを介して通信することができるものであり、前記ドライブは前記ホスト装置による追加のコマンドの送信を阻止することができるものである、前記ドライブと、
    前記ホスト装置に送る情報をキュー（待ち行列）に入れることができるものであるバッファーと、
    前記バッファーの現在のキュー長の関数として、現在のホストの信号に依存せずに、前記ホスト装置に送信する前記情報にギャップを挿入するかを決定することができるものであるコントローラであって、前記ギャップは連続する２つのＤＭＡデータフェーズの各データ間に挿入され、それにより、前記ホスト装置はドライブに追加のコマンドを送信することができるものであり、前記コントローラは、さらに、前記決定される条件に基づいて、ギャップを挿入する、またはギャップを挿入しないことができるものであるコントローラと
    を有する装置。
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