JP2012525779A - 動的構成可能anrフィルタおよび信号処理トポロジー - Google Patents
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Abstract
Description
および第2の複数のフィルタ、ならびにDACの間の相互接続を構成するステップをさらに含むことができる。
を有するクロスオーバが形成されるよう、少なくとも第2および第3のデジタルフィルタが協同することになる係数を使用してこれらの第2および第3のデジタルフィルタを構成するステップが含まれており、第1のセットのANR設定によって規定されるANR設定を第2のセットのANR設定によって規定されるANR設定に変更するステップには、クロスオーバ周波数を変更するために、第2および第3のデジタルフィルタのフィルタ係数を構成するステップが含まれている。
よって規定されるANR設定に変更するようになされている。
フィードバックアンチノイズ音、フィードフォワードアンチノイズ音、およびパススルーオーディオのうちの1つまたは複数を音響的に出力する音響ドライバ190を駆動するのに十分な大きさに増幅される。
102 ヘッドバンド
112 キャビティ
115 イヤカップリング
117 通路
119 別のキャビティ
120 フィードバックマイクロフォン
125 アナログVGA
130 フィードフォワードマイクロフォン
135 アナログVGA
140 通信マイクロフォン
142 マイクロフォンブーム
145 アナログVGA
170 記憶デバイス
180 電源
190 音響ドライバ
200 フィードバックベースのANRの経路
210 アナログデジタル変換器(ADC)
220 VGA
230 加算ノード
240 VGA
250、350、450、520、550 フィルタバンク(フィルタブロック)
545a、545b プログラム可能電力スイッチ
551、657、659 転換可能デジタルフィルタ(転換可能フィルタ)
554 四次フィルタ
558 FIRフィルタ
620a、620b、620c バッファ
625 フィルタ設定
662a、662b、662x、667a、667b、667x 遅延エレメント
663a、663b、663c、663x、668a、668b、668x 重み付けエレメント
664 加算ノード
665a、665b、665c 電力導体
3500a フィルタトポロジー
Claims (82)
- パーソナルANRデバイスであって、
第1のイヤピースと、
前記第1のイヤピース内に配置された第1のフィードバックマイクロフォンと、
前記パーソナルANRデバイスの外部部分に配置された第1のフィードフォワードマイクロフォンと、
前記第1のイヤピース内に配置された第1の音響ドライバと、
第1のANR回路であって、
前記第1のフィードバックマイクロフォンから第1のフィードバック基準信号を受け取り、
少なくとも前記第1のフィードバック基準信号を表すデジタルデータから第1のフィードバック対雑音音響を生成し、
前記第1のフィードフォワードマイクロフォンから第1のフィードフォワード基準信号を受け取り、
少なくとも前記第1のフィードフォワード基準信号を表すデジタルデータから第1のフィードフォワード対雑音音響を生成し、
音響源からパススルーオーディオ信号を受け取り、
少なくとも前記パススルーオーディオ信号を表すデジタルデータから第1の修正パススルーオーディオ音響を生成し、かつ、
前記第1の音響ドライバによって音響的に出力されることになる、前記第1のフィードバック対雑音音響、前記第1のフィードフォワード対雑音音響および前記第1の修正パススルーオーディオ音響を伝える第1の出力信号を出力する
ように構造化された第1のANR回路と
を備えたパーソナルANRデバイス。 - 第2のイヤピースと、
前記第2のイヤピース内に配置された第2のフィードバックマイクロフォンと、
前記第1のイヤピース内に配置された第2の音響ドライバと
をさらに備えた、請求項1に記載のパーソナルANRデバイス。 - 前記第1のANR回路が、
前記第2のフィードバックマイクロフォンから第2のフィードバック基準信号を受け取り、
少なくとも前記第2のフィードバック基準信号を表すデジタルデータから第2のフィードバック対雑音音響を生成し、
少なくとも前記第1のフィードフォワード基準信号を表すデジタルデータから第2のフィードフォワード対雑音音響を生成し、
少なくとも前記パススルーオーディオ信号を表すデジタルデータから第2の修正パススルーオーディオ音響を生成し、かつ、
前記第2の音響ドライバによって音響的に出力されることになる、前記第2のフィードバック対雑音音響、前記第2のフィードフォワード対雑音音響および前記第2の修正パススルーオーディオ音響を伝える第2の出力信号を出力する
ようにさらに構造化される、請求項2に記載のパーソナルANRデバイス。 - 前記パーソナルANRデバイスの外部部分に配置された第2のフィードフォワードマイクロフォンをさらに備え、前記第1のANR回路が、
前記第2のフィードバックマイクロフォンから第2のフィードバック基準信号を受け取り、
少なくとも前記第2のフィードバック基準信号を表すデジタルデータから第2のフィードバック対雑音音響を生成し、
前記第2のフィードフォワードマイクロフォンから第2のフィードフォワード基準信号を受け取り、
少なくとも前記第2のフィードフォワード基準信号を表すデジタルデータから第2のフィードフォワード対雑音音響を生成し、
少なくとも前記パススルーオーディオ信号を表すデジタルデータから第2の修正パススルーオーディオ音響を生成し、かつ、
前記第2の音響ドライバによって音響的に出力されることになる、前記第2のフィードバック対雑音音響、前記第2のフィードフォワード対雑音音響および前記第2の修正パススルーオーディオ音響を伝える第2の出力信号を出力する
ようにさらに構造化される、請求項2に記載のパーソナルANRデバイス。 - 前記パーソナルANRデバイスの外部部分に配置された第2のフィードフォワードマイクロフォンと、
第2のANR回路であって、
前記第2のフィードバックマイクロフォンから第2のフィードバック基準信号を受け取り、
少なくとも前記第2のフィードバック基準信号を表すデジタルデータから第2のフィードバック対雑音音響を生成し、
前記第2のフィードフォワードマイクロフォンから第2のフィードフォワード基準信号を受け取り、
少なくとも前記第2のフィードフォワード基準信号を表すデジタルデータから第2のフィードフォワード対雑音音響を生成し、
前記音響源から前記パススルーオーディオ信号を受け取り、
少なくとも前記パススルーオーディオ信号を表すデジタルデータから第2の修正パススルーオーディオ音響を生成し、かつ、
前記第2の音響ドライバによって音響的に出力されることになる、前記第2のフィードバック対雑音音響、前記第2のフィードフォワード対雑音音響および前記第2の修正パススルーオーディオ音響を伝える第2の信号を出力する
ように構造化された第2のANR回路と
をさらに備えた、請求項2に記載のパーソナルANRデバイス。 - 前記音響源をさらに備え、前記音響源が前記パーソナルANRデバイス内に配置されたオーディオプレイバックデバイスである、請求項1に記載のパーソナルANRデバイス。
- 前記音響源をさらに備え、前記音響源が前記パーソナルANRデバイスの一部分に配置された通信マイクロフォンである、請求項1に記載のパーソナルANRデバイス。
- フィードバックANR通路と、フィードフォワードANR通路と、パススルーオーディオ通路とを有する信号処理トポロジーを備えたANR回路であって、
フィードバックマイクロフォンからフィードバック基準信号を受け取り、
少なくとも前記フィードバック基準信号を表すデジタルデータから前記フィードバックANR通路内にフィードバック対雑音音響を生成し、
フィードフォワードマイクロフォンからフィードフォワード基準信号を受け取り、
少なくとも前記フィードフォワード基準信号を表すデジタルデータから前記フィードフォワードANR通路内にフィードフォワード対雑音音響を生成し、
音響源からパススルーオーディオ信号を受け取り、
前記パススルーオーディオ信号を表すデジタルデータから前記パススルーオーディオ通路内に修正パススルーオーディオ音響を生成し、
前記フィードバックANR通路からの前記フィードバック対雑音音響、前記フィードフォワードANR通路からの前記フィードフォワード対雑音音響、および前記パススルーオーディオ通路からの前記修正パススルーオーディオ音響を結合し、かつ、
音響ドライバによって音響的に出力されることになる、結合された前記フィードバック対雑音音響、前記フィードフォワード対雑音音響および前記修正パススルーオーディオ音響を伝える出力信号を出力する
ように構造化されるANR回路。 - 前記ANR回路が、前記フィードフォワード対雑音音響が前記フィードバック対雑音音響と結合されるポイントを、前記フィードバックANR通路およびフィードフォワードANR通路を結合することができる前記フィードバックANR通路に沿った少なくとも第1の位置と、前記フィードバックANR通路およびフィードフォワードANR通路を結合することができる前記フィードバックANR通路に沿った第2の位置との間で選択することができるようにさらに構造化される、請求項8に記載のANR回路。
- 前記ANR回路が、前記修正パススルーオーディオ音響が前記フィードバック対雑音音響と結合されるポイントを、前記フィードバックANR通路およびパススルーオーディオ通路を結合することができる前記フィードバックANR通路に沿った少なくとも第1の位置と、前記フィードバックANR通路およびパススルーオーディオ通路を結合することができる前記フィードバックANR通路に沿った第2の位置との間で選択することができるようにさらに構造化される、請求項8に記載のANR回路。
- 前記フィードバックANR通路が、前記フィードバック基準信号を表すデジタルデータから前記フィードバック対雑音音響を少なくとも生成するための第1のフィルタブロックとして動作させることができる第1の複数のフィルタを備え、前記フィードバックANR通路に沿った前記第1の位置が前記第1の複数のフィルタの入力の前段に存在し、また、前記フィードバックANR通路に沿った前記第2の位置が前記第1の複数のフィルタの出力の後段に存在する、請求項10に記載のANR回路。
- 前記パススルーオーディオ通路が、前記修正パススルーオーディオ音響を選択可能なクロスオーバ周波数でより高い周波数音響およびより低い周波数音響に少なくとも分割し、かつ、前記より低い周波数音響を前記第1の位置へ経路指定し、また、前記より高い周波数音響を前記第2の位置へ経路指定するように動作させることができる第2のフィルタブロックとして動作させることができる第2の複数のフィルタを備え、前記修正パススルーオーディオ音響全体が前記第1および第2の位置のうちのいずれかに経路指定されるように前記選択可能クロスオーバ周波数を選択することができる、請求項11に記載のANR回路。
- 前記出力信号をモニタリングする圧縮コントローラと、
前記圧縮コントローラによって動作させることができる第1のVGAであって、第1の出力信号中のクリッピングが差し迫っている兆候を前記圧縮コントローラが検出すると、少なくとも前記フィードバック対雑音音響の振幅を小さくする第1のVGAと
をさらに備えた、請求項8に記載のANR回路。 - 前記ANR回路が、前記修正パススルーオーディオ音響が前記フィードバック対雑音音響と結合されるポイントを、前記第1のVGAによって前記フィードバック対雑音音響の振幅と共に前記修正パススルーオーディオ音響の振幅を小さくすることができる前記第1のVGAの入力の前段の前記フィードバックANR通路に沿った第1の位置と、前記第1のVGAによって前記修正パススルーオーディオ音響の前記振幅を小さくすることができないよう、前記第1のVGAの出力の後段の前記フィードバックANR通路に沿った第2の位置との間で選択することができるようにさらに構造化される、請求項13に記載のANR回路。
- 前記圧縮コントローラによって動作させることができる第2のVGAであって、前記第1の出力信号中のクリッピングの発生を前記圧縮コントローラが検出すると、少なくとも前記フィードフォワード対雑音音響の振幅を小さくする第2のVGAをさらに備えた、請求項13に記載のANR回路。
- 前記出力信号をモニタリングする圧縮コントローラと、
前記圧縮コントローラによって動作させることができる第1のVGAであって、第1の出力信号中のクリッピングが差し迫っている兆候を前記圧縮コントローラが検出すると、前記フィードバック基準信号によって表されるフィードバック基準音響の振幅を小さくする第1のVGAと、
前記圧縮コントローラによって動作させることができる第2のVGAであって、前記第1の出力信号中のクリッピングが差し迫っている兆候を前記圧縮コントローラが検出すると、前記フィードフォワード基準信号によって表されるフィードフォワード基準音響の振幅を小さくする第2のVGAと
をさらに備えた、請求項8に記載のANR回路。 - ANRをパーソナルANRデバイスのイヤピースの中に提供するための動的構成可能ANR回路を動作させる方法であって、
前記ANR回路の第1のADC、第1のセットのANR設定によって規定される量の第1の複数のデジタルフィルタ、および前記ANR回路のDACを第1の通路に組み込むステップと、
前記ANR回路の第2のADC、前記第1のセットのANR設定によって規定される量の第2の複数のデジタルフィルタ、および前記DACを第2の通路に組み込むステップと、
前記第1のセットのANR設定によって規定されるデジタルフィルタのタイプを、前記ANR回路によってサポートされるデジタルフィルタの複数のタイプの中から、前記第1および第2の複数のデジタルフィルタの個々のデジタルフィルタ毎に選択するステップと、
音響を表すデジタルデータが前記第1の通路を通って前記第1のADCから少なくとも前記第1の複数のデジタルフィルタを通って前記DACへ流れ、音響を表すデジタルデータが前記第2の通路を通って前記第2のADCから少なくとも前記第2の複数のデジタルフィルタを通って前記DACへ流れ、かつ、前記第1および第2の通路の両方からのデジタルデータが前記DACに流れる前に結合されるよう、前記第1および第2の通路が、前記第1の通路に沿った第1の位置および前記第2の通路に沿った第2の位置で結合されるように、少なくとも前記第1および第2のADC、前記第1および第2の複数のデジタルフィルタ、ならびに前記DACの間の相互接続を構成することにより、前記第1のセットのANR設定によって規定される信号処理トポロジーを採択するステップと、
前記第1のセットのANR設定によって規定されるフィルタ係数を使用して、前記第1および第2の複数のデジタルフィルタの個々のデジタルフィルタを構成するステップと、
デジタルデータが前記第1のANR設定によって規定される前記第1および第2の通路のうちの少なくとも一方の少なくとも一部を通って流れるデータ転送速度を設定するステップと、
前記イヤピースの中にANRを提供するために、前記第1および第2のADC、前記第1および第2の複数のデジタルフィルタ、ならびに前記DACを動作させるステップと、
前記第1のセットのANR設定によって規定されるANR設定を、前記第1および第2の通路のうちの少なくとも一方の少なくとも一部に沿ったデジタルデータの転送と同期して、第2のセットのANR設定によって規定されるANR設定に変更するステップと
を含む方法。 - 前記ANR回路の第3のADC、第1のセットのANR設定によって規定される量の第3の複数のデジタルフィルタ、および前記DACを第3の通路に組み込むステップと、
前記第1のセットのANR設定によって規定されるデジタルフィルタのタイプを、前記ANR回路によってサポートされるデジタルフィルタの複数のタイプの中から、前記第3の複数のデジタルフィルタの個々のデジタルフィルタ毎に選択するステップと、
前記第1のセットのANR設定によって規定される信号処理トポロジーを採択するステップであって、音響を表すデジタルデータが前記第3の通路を通って前記第3のADCから少なくとも前記第3の複数のデジタルフィルタを通って前記DACへ流れ、かつ、前記第3の通路ならびに前記第1および第2の通路のうちの一方からのデジタルデータが前記DACに流れる前に結合されるよう、前記第3の通路が、前記第3の通路に沿った第3の位置ならびに前記第1および第2の通路のうちの一方に沿った第4の位置で前記第1および第2の通路のうちの一方に結合されるように、第3のADC、前記第3の複数のデジタルフィルタおよび前記DACの間の相互接続を構成するステップをさらに含むステップと、
前記第1のセットのANR設定によって規定されるフィルタ係数を使用して、前記第3の複数のデジタルフィルタの個々のデジタルフィルタを構成するステップと、
前記イヤピースの中にANRを提供するために、前記第1および第2のADC、前記第1および第2の複数のデジタルフィルタ、ならびに前記DACを動作させるステップと共に、前記第3のADCおよび前記第3の複数のデジタルフィルタを動作させるステップと
をさらに含む、請求項17に記載の方法。 - 電力源から利用することができる電力の量をモニタリングするステップであって、前記電力源から利用することができる電力の量が減少すると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが実施され、また、前記第1のANR設定によって画定される前記信号処理トポロジーの相互接続、前記第1のANR設定によって規定されるデジタルフィルタの選択、前記第1のANR設定によって規定されるフィルタ係数、および前記第1のANR設定によって規定されるデータ転送速度のうちの少なくとも1つを変更するステップを含むステップをさらに含む、請求項17に記載の方法。
- デジタルデータによって表される音響の特性をモニタリングするステップであって、前記特性が変化すると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが実施され、また、前記第1のANR設定によって画定される前記信号処理トポロジーの相互接続、前記第1のANR設定によって規定されるデジタルフィルタの選択、前記第1のANR設定によって規定されるフィルタ係数、および前記第1のANR設定によって規定されるデータ転送速度のうちの少なくとも1つを変更するステップを含むステップをさらに含む、請求項17に記載の方法。
- 前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップにより、前記構成可能ANR回路によって提供されるANRの程度が小さくなり、また、前記構成可能ANR回路が前記構成可能ANR回路に結合されている電源から消費する電力が少なくなる、請求項20に記載の方法。
- 前記構成可能ANR回路によって出力される音響の所望の品質および前記構成可能ANR回路によって提供されるANRの所望の品質のうちの1つを維持するために、前記第2のセットのANR設定のうちの少なくとも1つのANR設定を選択するステップをさらに含む、請求項21に記載の方法。
- 前記ANR回路に結合されている外部処理デバイスからの前記第2のセットのANR設定の受取りを待機するステップであって、前記外部処理デバイスから前記第2のセットのANR設定を受け取ると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが実施されるステップをさらに含む、請求項17に記載の方法。
- 前記第1のセットのANR設定によって規定される信号処理トポロジーを採択するステップが、
前記第1の通路にVGAを配置するために、前記第1のADC、前記第1の複数のデジタルフィルタ、前記DACおよび前記VGAの間の相互接続を構成するステップと、
前記第1のセットのANR設定によって規定される利得設定を使用して前記VGAを構成するステップと、
前記イヤピースの中にANRを提供するために、前記第1および第2のADC、前記第1および第2の複数のデジタルフィルタ、ならびに前記DACを動作させるステップと共に前記VGAを動作させるステップと
をさらに含み、
前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、前記第2のセットのANR設定によって規定される利得設定を使用して前記VGAを構成するステップを含む、請求項17に記載の方法。 - 少なくともフィードバックANR対雑音音響のクリッピングの事実が検出されると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが実施される、請求項24に記載の方法。
- 前記第1のセットのANR設定が、前記第1および第2の通路が結合される、前記第1の通路に沿った第3の位置および前記第2の通路に沿った第4の位置を規定し、
前記第1のセットのANR設定が、前記第1の通路に沿った前記第1の位置および第2の通路に沿った前記第2の位置で前記第1の通路に結合される第1の分岐を前記第2の通路内に生成し、かつ、前記第1の通路に沿った前記第3の位置および前記第2の通路に沿った前記第4の位置で前記第1の通路に結合される第2の分岐を前記第2の通路内に生成する分岐を前記第2の通路内に規定し、また、
前記第1のセットのANR設定によって規定される信号処理トポロジーを採択するステップが、前記第2の通路の前記第1および第2の分岐を生成するために、前記第1および第2のADC、前記第1および第2の複数のフィルタ、ならびに前記DACの間の相互接続を構成するステップをさらに含む、
請求項17に記載の方法。 - 前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、前記第2の通路を変更して前記第2の分岐を除去するために、前記第1および第2のADC、前記第1および第2の複数のフィルタ、ならびに前記DACの間の相互接続のうちの少なくとも1つを変更するステップを含み、それにより前記第1および第2の通路が、前記第1の通路に沿った前記第1の位置および前記第2の通路に沿った前記第2の位置のみで結合されるよう、前記第2の通路内の前記分岐が不足している他の信号処理トポロジーが採択される、請求項26に記載の方法。
- デジタルデータが前記第1の通路の少なくとも一部を通って流れるデータ転送速度を設定するステップが、デジタルデータが前記第1および第2の通路の両方をその全体にわたって通って流れる第1のデータ転送速度を設定するステップを含む、請求項17に記載の方法。
- 前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、デジタルデータが前記第2の通路の一部を通って流れる速度を、デジタルデータが前記第1の通路を通って流れる速度に対して遅くするために、前記第2の通路の前記部分のデータ転送速度を前記第1のデータ転送速度より遅い第2のデータ転送速度に変更するステップを含む、請求項28に記載の方法。
- ANR回路を備えた装置であって、前記ANR回路が、
第1のADCと、
第2のADCと、
DACと、
処理デバイスと、
命令シーケンスを記憶する記憶装置であって、前記命令シーケンスが前記処理デバイスによって実行されると、前記処理デバイスが、
前記第1のADC、第1のセットのANR設定によって規定される量の第1の複数のデジタルフィルタ、および前記DACを第1の通路に組み込み、
前記第2のADC、前記第1のセットのANR設定によって規定される量の第2の複数のデジタルフィルタ、および前記DACを第2の通路に組み込み、
前記第1のセットのANR設定によって規定されるデジタルフィルタのタイプを、前記ANR回路によってサポートされるデジタルフィルタの複数のタイプの中から、前記第1および第2の複数のデジタルフィルタの個々のデジタルフィルタ毎に選択し、
音響を表すデジタルデータが前記第1の通路を通って前記第1のADCから少なくとも前記第1の複数のデジタルフィルタを通って前記DACへ流れ、音響を表すデジタルデータが前記第2の通路を通って前記第2のADCから少なくとも前記第2の複数のデジタルフィルタを通って前記DACへ流れ、かつ、前記第1および第2の通路の両方からの前記デジタルデータが前記DACに流れる前に結合されるよう、前記第1および第2の通路が、前記第1の通路に沿った第1の位置および前記第2の通路に沿った第2の位置で結合されるように、少なくとも前記第1および第2のADC、前記第1および第2の複数のデジタルフィルタ、ならびに前記DACの間の相互接続を構成することによって、前記第1のセットのANR設定によって規定される信号処理トポロジーを採択し、
前記第1のセットのANR設定によって規定されるフィルタ係数を使用して、前記第1および第2の複数のデジタルフィルタの個々のデジタルフィルタを構成し、
デジタルデータが前記第1のANR設定によって規定される前記第1および第2の通路のうちの少なくとも一方の少なくとも一部を通って流れるデータ転送速度を設定し、
イヤピースの中にANRを提供するために、前記第1および第2のADC、前記第1および第2の複数のデジタルフィルタ、ならびに前記DACを動作させ、かつ、
前記第1のセットのANR設定によって規定されるANR設定を、前記第1および第2の通路のうちの少なくとも一方の少なくとも一部に沿ったデジタルデータの転送と同期して、第2のセットのANR設定によって規定されるANR設定に変更する
ことになる記憶装置と
を備えた装置。 - 複数のタイプのデジタルフィルタを画定する複数のフィルタルーチンが前記記憶装置に記憶され、
前記複数のフィルタルーチンの個々のフィルタルーチンが、前記処理デバイスによって実行されると、選択されたタイプのデジタルフィルタのフィルタ計算を前記処理デバイスが実施することになる命令シーケンスを含み、また、
前記処理デバイスが、さらに、前記複数のフィルタルーチンのうちの、前記第1のセットのANR設定によって規定されるタイプのデジタルフィルタを画定しているフィルタルーチンに基づいて、前記第1および第2の複数のデジタルフィルタの個々のデジタルフィルタを具体化する
請求項30に記載の装置。 - 前記処理デバイスが、前記第1および第2のADC、前記処理デバイスによって具体化される前記第1および第2の複数のデジタルフィルタの個々のデジタルフィルタ、ならびに前記DACの間でデジタルデータを直接転送する、請求項31に記載の装置。
- 前記処理デバイスが、DMAデバイスを動作させて、前記第1および第2のADCの少なくともサブセット、前記処理デバイスによって具体化される前記第1および第2の複数のデジタルフィルタの個々のデジタルフィルタ、ならびに前記DACの間でデジタルデータを転送する、請求項31に記載の装置。
- 前記ANR回路が、前記ANR回路に結合されている電力源から利用することができる電力の量をモニタすることができるインタフェースをさらに備え、前記処理デバイスが、さらに、
前記電力源から利用することができる電力の量をモニタし、かつ、
前記電力源から利用することができる電力の量が減少すると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更し、前記変更が、前記第1のANR設定によって画定される前記信号処理トポロジーの相互接続、前記第1のANR設定によって規定されるデジタルフィルタの選択、前記第1のANR設定によって規定されるフィルタ係数、および前記第1のANR設定によって規定されるデータ転送速度のうちの少なくとも1つの変更を含む
請求項30に記載の装置。 - 前記処理デバイスが、さらに、
デジタルデータによって表される音響の特性をモニタし、かつ、
前記特性が変化すると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更し、前記変更が、前記第1のANR設定によって画定される前記信号処理トポロジーの相互接続、前記第1のANR設定によって規定されるデジタルフィルタの選択、前記第1のANR設定によって規定されるフィルタ係数、および前記第1のANR設定によって規定されるデータ転送速度のうちの少なくとも1つの変更を含む
請求項30に記載の装置。 - 前記第1のセットのANR設定によって規定されるANR設定の前記第2のセットのANR設定によって規定されるANR設定への変更により、構成可能ANR回路によって提供されるANRの程度が小さくなり、また、前記構成可能ANR回路が前記構成可能ANR回路に結合されている電源から消費する電力が少なくなる、請求項35に記載の装置。
- 前記処理デバイスが、さらに、前記構成可能ANR回路によって出力される音響の所望の品質および前記構成可能ANR回路によって提供されるANRの所望の品質のうちの1つを維持するために、前記第2のセットのANR設定のうちの少なくとも1つのANR設定を選択する、請求項36に記載の装置。
- 前記ANR回路の外部の外部処理デバイスをさらに備え、
前記ANR回路が、前記ANR回路を前記外部処理デバイスに結合するインタフェースをさらに備え、
前記ANR回路の前記処理デバイスが、さらに、
前記外部処理デバイスからの前記第2のセットのANR設定の受取りを待機し、かつ、
前記インタフェースを介して前記外部処理デバイスから前記第2のセットのANR設定を受け取ると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する
請求項30に記載の装置。 - 前記処理デバイスが、さらに、
前記第1のADC、前記第1の複数のデジタルフィルタ、前記DACおよびVGAの間の相互接続を構成し、
前記第1のセットのANR設定によって規定される利得設定を使用して前記VGAを構成し、
前記イヤピースの中にANRを提供するために、前記第1および第2のADC、前記第1および第2の複数のデジタルフィルタ、ならびに前記DACと共に前記VGAを動作させ、
前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するようになされている前記処理デバイスが、前記第2のセットのANR設定によって規定される利得設定を使用して前記VGAを構成するようになされている処理デバイスを備えた
請求項30に記載の装置。 - 少なくともフィードバックANR対雑音音響のクリッピングの事実が検出されると、前記処理デバイスが、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する、請求項39に記載の装置。
- ANRをパーソナルANRデバイスのイヤピースの中に提供するための動的構成可能ANR回路を動作させる方法であって、
第1のセットのANR設定によって規定される量の複数のデジタルフィルタを、前記ANRの準備に関連するデジタルデータが通って前記ANR回路内を流れる通路に沿って配置されたフィルタブロックの中に組み込むステップと、
第1のセットのANR設定によって規定されるデジタルフィルタのタイプを、前記ANR回路によってサポートされるデジタルフィルタの複数のタイプの中からデジタルフィルタ毎に選択するステップと、
個々の前記デジタルフィルタの間の相互接続を構成することによって、前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを前記フィルタブロック内に採択するステップと、
前記第1のセットのANR設定によって規定されるフィルタ係数を使用してデジタルフィルタの各々を構成するステップと、
デジタルデータが前記第1のANR設定によって規定される複数の前記デジタルフィルタのうちの少なくとも1つを通って流れるデータ転送速度を設定するステップと、
前記ANR回路をイネーブルして前記イヤピースの中にANRを提供するために前記フィルタブロックを動作させるステップと、
前記第1のセットのANR設定によって規定されるANR設定を、前記通路の少なくとも一部を介したデジタルデータの転送と同期して、第2のセットのANR設定によって規定されるANR設定に変更するステップと
を含む方法。 - 前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、
前記第1のANR設定によって規定される前記フィルタブロックトポロジーの相互接続
複数のデジタルフィルタのうちの1つに対する、前記第1のセットのANR設定によって規定されるデジタルフィルタのタイプの選択
前記複数のデジタルフィルタの前記第1のANR設定によって規定されるデジタルフィルタの量
前記第1のANR設定によって規定されるフィルタ係数
および前記第1のANR設定によって規定されるデータ転送速度
のうちの少なくとも1つを変更するステップを含む、請求項41に記載の方法。 - 電力源から利用することができる電力の量をモニタリングするステップであって、前記電力源から利用することができる電力の量が減少すると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが実施されるステップをさらに含む、請求項41に記載の方法。
- デジタルデータによって表される音響の特性をモニタリングするステップであって、前記特性が変化すると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが実施されるステップをさらに含む、請求項41に記載の方法。
- 前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップにより、前記構成可能ANR回路によって提供されるANRの程度が小さくなり、また、前記構成可能ANR回路が前記構成可能ANR回路に結合されている電源から消費する電力が少なくなる、請求項44に記載の方法。
- 前記ANR回路に結合されている外部処理デバイスからの前記第2のセットのANR設定の受取りを待機するステップであって、前記外部処理デバイスから前記第2のセットのANR設定を受け取ると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが実施されるステップをさらに含む、請求項41に記載の方法。
- 前記ANR回路によって提供される前記ANRがフィードバックベースANRを含み、また、
少なくとも前記フィードバックベースANRに不安定性の事実が検出されると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが実施され、また、安定性を回復するために、前記変更ステップが、前記第1のANR設定によって規定されるフィルタ係数を前記第2のANR設定によって規定されるフィルタ係数に変更するステップを含む
請求項41に記載の方法。 - 前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを採択するステップが、加算ノードを前記フィルタブロックの中に組み込むステップ、および前記第1のセットのANR設定によって規定されるように前記デジタルフィルタおよび前記加算ノードの間の相互接続を構成するステップをさらに含み、それにより前記複数のデジタルフィルタのうちの少なくとも2つの出力が前記加算ノードで結合され、また、
前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、前記第1のANR設定によって規定される前記フィルタブロックトポロジーの相互接続を変更するステップを含み、それにより前記加算ノードおよび前記少なくとも2つのデジタルフィルタのうちの一方が除去される
請求項41に記載の方法。 - 前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを採択するステップが、前記複数のデジタルフィルタのうちの第1のデジタルフィルタ、第2のデジタルフィルタおよび第3のデジタルフィルタの間の相互接続を構成するステップであって、前記第1のデジタルフィルタの出力が前記第2および第3のデジタルフィルタの入力に結合され、それにより前記第1、第2および第3のデジタルフィルタを通るデジタルデータの流れに分岐が形成されるステップをさらに含み、また、
前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、前記第1のANR設定によって規定される前記フィルタブロックトポロジーの相互接続を変更するステップを含み、それにより前記第1および第2のデジタルフィルタから前記第3のデジタルフィルタの結合が解除される
請求項41に記載の方法。 - 前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを採択するステップが、前記複数のデジタルフィルタのうちの第1のデジタルフィルタ、第2のデジタルフィルタおよび第3のデジタルフィルタの間の相互接続を構成するステップであって、前記第1のデジタルフィルタの出力が前記第2および第3のデジタルフィルタの入力に結合され、それにより前記第1、第2および第3のデジタルフィルタを通るデジタルデータの流れに分岐が形成されるステップをさらに含み、また、
前記第1のセットのANR設定によって規定されるフィルタ係数を使用して個々の前記デジタルフィルタを構成するステップが、選択されたクロスオーバ周波数を有するクロスオーバを少なくとも前記第2および第3のデジタルフィルタが協同して形成することになる係数を使用して前記第2および第3のデジタルフィルタを構成するステップを含む
請求項41に記載の方法。 - 前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、前記クロスオーバ周波数を変更するために前記第2および第3のデジタルフィルタのフィルタ係数を構成するステップを含む、請求項50に記載の方法。
- 前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、複数の前記デジタルフィルタのうちの選択されたタイプのデジタルフィルタを、同じ選択されたタイプの他のデジタルフィルタに置き換えるステップであって、複数の前記デジタルフィルタのうちの前記選択されたタイプのデジタルフィルタが第1のビット幅でフィルタ係数をサポートし、かつ、動作中、第1の割合で電力を消費し、また、前記他のデジタルフィルタが前記第1のビット幅より狭い第2のビット幅で同じフィルタ係数をサポートし、かつ、動作中、前記第1の割合より小さい第2の割合で電力を消費するステップを含む、請求項41に記載の方法。
- デジタルデータが前記第1のANR設定によって規定される複数の前記デジタルフィルタのうちの少なくとも1つを通って流れるデータ転送速度を設定するステップが、デジタルデータが前記デジタルフィルタの入力にクロック入力される第1のデータ転送速度であって、前記第1のデータ転送速度で前記デジタルフィルタの出力からデジタルデータがクロック出力される第1のデータ転送速度を設定するステップを含み、また、
前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、
デジタルデータが前記デジタルフィルタの出力からクロック出力される第2のデータ転送速度を設定するステップであって、前記第2のデータ転送速度が前記第1のデータ転送速度とは異なるステップと、
前記第1のデータ転送速度と第2のデータ転送速度の間で転換するための前記デジタルフィルタの係数を設定するステップと
を含む、請求項41に記載の方法。 - ANR回路を備えた装置であって、前記ANR回路が、
ADCと、
DACと、
処理デバイスと、
命令シーケンスを記憶する記憶装置であって、前記命令シーケンスが前記処理デバイスによって実行されると、前記処理デバイスが、
第1のセットのANR設定によって規定される量の複数のデジタルフィルタを、前記ADCから前記DACまで延在している、ANRの提供に関連するデジタルデータが通って前記ANR回路内を流れる通路に沿って配置されたフィルタブロックの中に組み込み、
第1のセットのANR設定によって規定されるデジタルフィルタのタイプを、前記ANR回路によってサポートされるデジタルフィルタの複数のタイプの中からデジタルフィルタ毎に選択し、
個々の前記デジタルフィルタの間の相互接続を構成することによって、前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを前記フィルタブロック内に採択し、
前記第1のセットのANR設定によって規定されるフィルタ係数を使用して個々の前記デジタルフィルタを構成し、
デジタルデータが前記第1のANR設定によって規定される複数の前記デジタルフィルタのうちの少なくとも1つを通って流れるデータ転送速度を設定し、
前記ANR回路がANRを提供することができるよう、前記DACを介して前記ANR回路によって出力されるアナログ信号によって表される対雑音音響を引き出すためにANR回路が前記ADCを介して受け取るアナログ信号によって表される基準音響を使用して、前記ADC、前記フィルタブロックおよび前記DACを動作させ、かつ、
前記第1のセットのANR設定によって規定されるANR設定を、前記通路の少なくとも一部を介したデジタルデータの転送と同期して、第2のセットのANR設定によって規定されるANR設定に変更する
ことになる記憶装置と
を備えた装置。 - 前記複数のタイプのデジタルフィルタを画定する複数のフィルタルーチンが前記記憶装置に記憶され、
前記複数のフィルタルーチンの個々のフィルタルーチンが、前記処理デバイスによって実行されると、あるタイプのデジタルフィルタのフィルタ計算を前記処理デバイスが実施することになる命令シーケンスを含み、また、
前記処理デバイスが、さらに、
前記複数のデジタルフィルタを組み込み、また、前記第1のセットのANR設定によってデジタルフィルタ毎に規定されるデジタルフィルタのタイプに従って前記複数のフィルタルーチンから選択されるフィルタルーチンに基づいて個々のデジタルフィルタを少なくとも具体化することにより、デジタルフィルタ毎にデジタルフィルタのタイプを選択し、かつ、
前記フィルタブロックトポロジーを採択し、また、デジタルデータを前記ADC、前記デジタルフィルタおよび前記DACの間で少なくとも転送することにより、前記ADC、前記フィルタブロックおよび前記DACを動作させる
請求項54に記載の装置。 - 前記処理デバイスが、前記ADC、前記デジタルフィルタおよび前記DACの間でデジタルデータを直接転送する、請求項55に記載の装置。
- 前記処理デバイスが、DMAデバイスを動作させて、前記ADCの少なくともサブセット、前記デジタルフィルタおよび前記DACの間でデジタルデータを転送する、請求項55に記載の装置。
- 前記処理デバイスが、
前記第1のANR設定によって規定される前記フィルタブロックトポロジーの相互接続
前記複数のデジタルフィルタのうちの1つに対する前記第1のセットのANR設定によって規定されるデジタルフィルタのタイプの選択
前記複数のデジタルフィルタの前記第1のANR設定によって規定されるデジタルフィルタの量
前記第1のANR設定によって規定されるフィルタ係数
および前記第1のANR設定によって規定されるデータ転送速度
のうちの少なくとも1つを変更することにより、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する、請求項54に記載の装置。 - 前記ANR回路が、前記ANR回路に結合されている電力源から利用することができる電力の量をモニタすることができるインタフェースをさらに備え、前記処理デバイスが、さらに、
前記電力源から利用することができる電力の量をモニタし、かつ、
前記電力源から利用することができる電力の量が減少すると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する
請求項54に記載の装置。 - 前記処理デバイスが、さらに、
デジタルデータによって表される音響の特性をモニタし、かつ、
前記特性が変化すると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する
請求項54に記載の装置。 - 前記第1のセットのANR設定によって規定されるANR設定の前記第2のセットのANR設定によって規定されるANR設定への変更により、構成可能ANR回路によって提供されるANRの程度が小さくなり、また、前記構成可能ANR回路が前記構成可能ANR回路に結合されている電源から消費する電力が少なくなる、請求項60に記載の装置。
- 前記構成可能ANR回路によって出力される音響の予め選択された程度の品質を維持するために、前記第2のセットのANR設定のうちの少なくとも1つのANR設定を選択するステップをさらに含む、請求項61に記載の装置。
- 前記ANR回路の外部の外部処理デバイスをさらに備え、
前記ANR回路が、前記ANR回路を前記外部処理デバイスに結合するインタフェースをさらに備え、
前記処理デバイスが、さらに、
前記外部処理デバイスからの前記第2のセットのANR設定の受取りを待機し、かつ、
前記インタフェースを介して前記外部処理デバイスから前記第2のセットのANR設定を受け取ると、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する
請求項54に記載の装置。 - 前記ANR回路によって提供される前記ANRがフィードバックベースANRを含み、また、
前記処理デバイスが、さらに、
少なくとも前記フィードバックベースANRの不安定性の事実の検出を待機し、かつ、
少なくとも前記フィードバックベースANRの不安定性の事実が検出されると、安定性を回復するために、前記第1のANR設定によって規定されるフィルタ係数を前記第2のANR設定によって規定されるフィルタ係数に変更することにより、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する
請求項54に記載の装置。 - 前記処理デバイスが、さらに、
加算ノードを前記フィルタブロックの中に少なくとも組み込み、かつ、前記第1のセットのANR設定によって規定されるように前記デジタルフィルタおよび前記加算ノードの間の相互接続を構成することにより、前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを採択し、それにより前記複数のデジタルフィルタのうちの少なくとも2つの出力が前記加算ノードで結合され、また、
前記第1のANR設定によって規定される前記フィルタブロックトポロジーの相互接続を少なくとも変更することにより、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更し、それにより前記加算ノードおよび前記少なくとも2つのデジタルフィルタのうちの一方が除去される
請求項54に記載の装置。 - 前記処理デバイスが、さらに、
前記複数のデジタルフィルタのうちの第1のデジタルフィルタ、第2のデジタルフィルタおよび第3のデジタルフィルタの間の相互接続を少なくとも構成し、それにより前記第1のデジタルフィルタの出力を前記第2および第3のデジタルフィルタの入力に結合して、前記第1、第2および第3のデジタルフィルタを通るデジタルデータの流れに分岐を形成することにより、前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを採択し、また、
前記第1のANR設定によって規定される前記フィルタブロックトポロジーの相互接続を少なくとも変更し、それにより前記第1および第2のデジタルフィルタから前記第3のデジタルフィルタの結合を解除することにより、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する
請求項54に記載の装置。 - 前記処理デバイスが、さらに、
前記複数のデジタルフィルタのうちの第1のデジタルフィルタ、第2のデジタルフィルタおよび第3のデジタルフィルタの間の相互接続を少なくとも構成し、それにより前記第1のデジタルフィルタの出力を前記第2および第3のデジタルフィルタの入力に結合して、前記第1、第2および第3のデジタルフィルタを通るデジタルデータの流れに分岐を形成することにより、前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを採択し、また、
選択されたクロスオーバ周波数を有するクロスオーバを少なくとも前記第2および第3のデジタルフィルタが協同して形成することになる係数を使用して前記第2および第3のデジタルフィルタを少なくとも構成することにより、前記第1のセットのANR設定によって規定されるフィルタ係数を使用して個々の前記デジタルフィルタを構成する
請求項54に記載の装置。 - 前記処理デバイスが、さらに、前記クロスオーバ周波数を変更するために前記第2および第3のデジタルフィルタのフィルタ係数を少なくとも構成することにより、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する、請求項67に記載の装置。
- 前記処理デバイスが、さらに、複数の前記デジタルフィルタのうちの選択されたタイプのデジタルフィルタを、同じ選択されたタイプの他のデジタルフィルタに少なくとも置き換えることにより、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更し、複数の前記デジタルフィルタのうちの前記選択されたタイプのデジタルフィルタが第1のビット幅でフィルタ係数をサポートし、かつ、動作中、第1の割合で電力を消費し、また、前記他のデジタルフィルタが前記第1のビット幅より狭い第2のビット幅で同じフィルタ係数をサポートし、かつ、動作中、前記第1の割合より小さい第2の割合で電力を消費する、請求項54に記載の装置。
- 前記処理デバイスが、さらに、
デジタルデータが前記デジタルフィルタの入力にクロック入力される第1のデータ転送速度であって、前記第1のデータ転送速度で前記デジタルフィルタの出力からデジタルデータがクロック出力される第1のデータ転送速度を少なくとも設定することにより、デジタルデータが前記第1のANR設定によって規定される複数の前記デジタルフィルタのうちの少なくとも1つを通って流れるデータ転送速度を設定し、また、
少なくとも、
デジタルデータが前記デジタルフィルタの出力からクロック出力される、前記第1のデータ転送速度とは異なる第2のデータ転送速度を設定し、かつ、
前記第1のデータ転送速度と第2のデータ転送速度の間で転換するための前記デジタルフィルタの係数を設定する
ことにより、前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更する
請求項54に記載の装置。 - 転換可能フィルタであって、
第1の遅延エレメントと、
前記第1の遅延エレメントに結合された第1の重み付けエレメントであって、前記転換可能フィルタが変換にゼロを導入することができるよう、前記第1の遅延エレメントと協同する第1の重み付けエレメントと、
前記第1の遅延エレメントおよび前記第1の重み付けエレメントに結合され、前記第1の遅延エレメントおよび前記第1の重み付けエレメントに電力を供給するための第1の電力導体と、
第2の遅延エレメントと、
前記第2の遅延エレメントに結合された第2の重み付けエレメントであって、前記転換可能フィルタが前記変換に極を導入することができるよう、前記第2の遅延エレメントと協同する第2の重み付けエレメントと、
前記第2の遅延エレメントおよび前記第2の重み付けエレメントに結合され、前記第2の遅延エレメントおよび前記第2の重み付けエレメントに電力を供給するための第2の電力導体であって、前記第2の電力導体を介して前記第2の遅延エレメントおよび前記第2の重み付けエレメントに電力を供給しないことによってディジタルフィルタをFIRフィルタとして動的に構成し、または、前記第2の電力導体を介して前記第2の遅延エレメントおよび前記第2の重み付けエレメントに電力を供給することによってディジタルフィルタをIIRフィルタとして動的に構成することができるよう、前記第2の遅延エレメントおよび前記第2の重み付けエレメントに電力を選択的に供給することができる第2の電力導体と
を備えた転換可能フィルタ。 - 前記第1の電力導体に結合された第3の遅延エレメントと、
前記第1の電力導体に結合され、かつ、前記第3の遅延エレメントに結合された第3の重み付けエレメントであって、前記転換可能フィルタが前記変換にもう1つのゼロを導入することができるよう、前記第3の遅延エレメントと協同する第3の重み付けエレメントと、
前記第2の電力導体に結合された第4の遅延エレメントと、
前記第2の電力導体に結合され、かつ、前記第4の遅延エレメントに結合された第4の重み付けエレメントであって、前記転換可能フィルタが前記変換にもう1つの極を導入することができるよう、また、前記第2の電力導体を介して前記第2および第4の遅延エレメントならびに前記第2および第4の重み付けエレメントに電力が供給されている場合には四次フィルタとして前記転換可能フィルタを動作させることができるよう、前記第4の遅延エレメントと協同する第4の重み付けエレメントと
をさらに備えた、請求項71に記載の転換可能フィルタ。 - 第3の遅延エレメントと、
前記第3の遅延エレメントに結合された第3の重み付けエレメントであって、前記転換可能フィルタが前記変換にもう1つのゼロを導入することができるよう、前記第3の遅延エレメントと協同する第3の重み付けエレメントと、
前記第3の遅延エレメントおよび前記第3の重み付けエレメントに結合された、前記第3の遅延エレメントおよび前記第3の重み付けエレメントに電力を供給するための第3の電力導体であって、前記第3の電力導体を介して前記第3の遅延エレメントおよび前記第3の重み付けエレメントに電力が供給されない場合のより低い次数のフィルタ、または前記第3の電力導体を介して前記第3の遅延エレメントおよび前記第3の重み付けエレメントに電力が供給される場合のより高い次数のフィルタのいずれかとして前記デジタルフィルタを動的に構成することができるよう、前記第3の遅延エレメントおよび前記第3の重み付けエレメントに電力を選択的に供給することができる第3の電力導体と
をさらに備えた、請求項71に記載の転換可能フィルタ。 - 前記第3の電力導体に結合された第4の遅延エレメントと、
前記第3の電力導体に結合され、かつ、前記第4の遅延エレメントに結合された第4の重み付けエレメントであって、前記第3の電力導体を介して前記第4の遅延エレメントおよび第4の重み付けエレメントに電力が供給されない場合のより低い次数のフィルタ、または前記第3の電力導体を介して前記第4の遅延エレメントおよび前記第4の重み付けエレメントに電力が供給される場合のより高い次数のフィルタのいずれかとして前記デジタルフィルタを動的に構成することができるよう、前記第4の遅延エレメントと協同する第4の重み付けエレメントと
をさらに備えた、請求項73に記載の転換可能フィルタ。 - デジタルフィルタを動的に構成する方法であって、前記デジタルフィルタをデジタルフィルタの複数のタイプのうちの任意の1つとして動作させることができるよう、前記デジタルフィルタの少なくとも1つの遅延エレメントおよび少なくとも1つの重み付けエレメントに選択的に電力を供給するステップを含む方法。
- 前記少なくとも1つの遅延エレメントおよび前記少なくとも1つの重み付けエレメントが、協同して変換に極を導入するよう、前記デジタルフィルタ内で結合され、
前記少なくとも1つの遅延エレメントおよび前記少なくとも1つの重み付けエレメントに電力を供給するステップにより、前記デジタルフィルタをIIRフィルタとして動作させることができ、また、
前記少なくとも1つの遅延エレメントおよび前記少なくとも1つの重み付けエレメントに電力を供給しないステップにより、前記変換に極を導入することができない前記デジタルフィルタにすることができる
請求項75に記載の方法。 - 前記少なくとも1つの遅延エレメントおよび前記少なくとも1つの重み付けエレメントに電力を供給するステップにより、前記デジタルフィルタを四次フィルタとして動作させることができ、また、前記少なくとも1つの遅延エレメントおよび前記少なくとも1つの重み付けエレメントに電力を供給しないステップによって前記デジタルフィルタが制限され、それにより2つのタップのみを備えたFIRフィルタとして動作させることができる、請求項76に記載の方法。
- 協同して変換にゼロを導入するよう、前記少なくとも1つの遅延エレメントおよび前記少なくとも1つの重み付けエレメントが前記デジタルフィルタ内で結合され、
前記少なくとも1つの遅延エレメントおよび前記少なくとも1つの重み付けエレメントに電力を供給するステップにより、前記デジタルフィルタをより高い次数のFIRフィルタとして動作させることができ、また、
前記少なくとも1つの遅延エレメントおよび前記少なくとも1つの重み付けエレメントに電力を供給しないステップによって前記デジタルフィルタが制限され、それによりより低い次数のFIRフィルタとして動作させることができる
請求項75に記載の方法。 - ANRをパーソナルANRデバイスのイヤピースの中に提供するための動的構成可能ANR回路を動作させる方法であって、
第1のセットのANR設定によって規定される量の複数のデジタルフィルタを、前記ANRの準備に関連するデジタルデータが通って前記ANR回路内を流れる通路に沿って配置されたフィルタブロックの中に組み込むステップと、
個々の前記デジタルフィルタの間の相互接続を構成することによって、前記第1のセットのANR設定によって規定されるフィルタブロックトポロジーを前記フィルタブロック内に採択するステップと、
第1のセットのANR設定によって規定されるデジタルフィルタのタイプを、前記ANR回路によってサポートされるデジタルフィルタの複数のタイプの中からデジタルフィルタ毎に選択するステップと、
個々のデジタルフィルタをデジタルフィルタ毎に規定されるタイプのデジタルフィルタとして動作させることができるように構成するために、個々のデジタルフィルタの電力導体を構成するステップと
を含む方法。 - 前記第1のセットのANR設定によって規定されるフィルタ係数を使用して前記デジタルフィルタの各々を構成するステップと、
デジタルデータが前記第1のANR設定によって規定される複数の前記デジタルフィルタのうちの少なくとも1つを通って流れるデータ転送速度を設定するステップと
をさらに含む、請求項79に記載の方法。 - 前記ANR回路をイネーブルして前記イヤピースの中にANRを提供するために前記フィルタブロックを動作させるステップと、
前記第1のセットのANR設定によって規定されるANR設定を、前記通路の少なくとも一部を介したデジタルデータの転送と同期して、第2のセットのANR設定によって規定されるANR設定に変更するステップと
をさらに含む、請求項80に記載の方法。 - 前記第1のセットのANR設定によって規定されるANR設定を前記第2のセットのANR設定によって規定されるANR設定に変更するステップが、
前記第1のANR設定によって規定される前記フィルタブロックトポロジーの相互接続を変更するステップと、
複数の前記デジタルフィルタのうちの1つに対する前記第1のセットのANR設定によって規定されるデジタルフィルタのタイプの選択を変更するステップであって、デジタルフィルタのタイプの選択を変更するステップが、前記複数のデジタルフィルタのうちの1つのデジタルフィルタの電力導体を構成するステップであって、そのデジタルフィルタのための電力導体が既に構成されているその前のタイプのデジタルフィルタとは異なるタイプのデジタルフィルタとして動作させることができるようにそのデジタルフィルタを構成するステップを含むステップと、
前記複数のデジタルフィルタの前記第1のANR設定によって規定されるデジタルフィルタの量を変更するステップと、
前記第1のANR設定によって規定されるフィルタ係数を変更するステップと、
前記第1のANR設定によって規定されるデータ転送速度を変更するステップ
のうちの少なくとも1つを含む、請求項81に記載の方法。
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