JP2012109582A - Manufacturing method for semiconductor device and manufacturing method for display device - Google Patents

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Abstract

PROBLEM TO BE SOLVED: To provide a method for manufacturing a highly reliable semiconductor device by improving the utilization efficiency of material and by simplifying the manufacturing process.SOLUTION: The manufacturing method comprises the steps of forming a conductive layer on a substrate, forming a light-transmitting layer on the conductive layer, delivering a femtosecond laser onto the light-transmitting layer, and selectively removing the conductive layer and the light-transmitting layer. The conductive layer and the light-transmitting layer may be removed so that an end of the conductive layer is located inside as compared with an end of the light-transmitting layer. Before the delivery of the femtosecond laser, a surface of the light-transmitting layer may be subjected to liquid repellent treatment.

Description

本発明は、フェムト秒レーザを用いたコンタクトホール開口を利用した半導体素子の作製
方法に関する。また、半導体素子を有する半導体装置の作製方法に関する。
The present invention relates to a method for manufacturing a semiconductor element using a contact hole opening using a femtosecond laser. Further, the present invention relates to a method for manufacturing a semiconductor device including a semiconductor element.

薄膜トランジスタ(以下、「TFT」とも記す。)及びそれを用いた電子回路は、半導体
、絶縁膜及び導電膜などの各種薄膜を基板上に積層し、適宜フォトリソグラフィ技術によ
り所定のコンタクトホールを形成して製造されている。フォトリソグラフィ技術とは、フ
ォトマスクと呼ばれる透明な平板面上に光を通さない材料で形成した回路等のパターンを
、光を利用して目的とする基板上に転写する技術であり、半導体集積回路等の製造工程に
おいて広く用いられている。そして、フォトリソグラフィ技術を用いて基板上に転写され
たパターンをマスクとして、コンタクトホールとなるべき部分に存在する絶縁膜、半導体
膜、金属膜等をエッチング除去することで所望の位置にコンタクトホールを形成すること
ができる。
A thin film transistor (hereinafter also referred to as “TFT”) and an electronic circuit using the thin film transistor are formed by laminating various thin films such as a semiconductor, an insulating film, and a conductive film on a substrate, and appropriately forming a predetermined contact hole by a photolithography technique. Manufactured. Photolithographic technology is a technology that uses a light to transfer a circuit pattern or other pattern formed on a transparent flat plate called a photomask onto a target substrate. It is widely used in the manufacturing process. Then, using the pattern transferred onto the substrate using photolithography as a mask, the insulating film, semiconductor film, metal film, etc. existing in the portion to be the contact hole are removed by etching to form a contact hole at a desired position. Can be formed.

従来のフォトリソグラフィ技術を用いた製造工程では、フォトレジストと呼ばれる感光性
の有機樹脂材料を用いて形成されるマスクパターンの取り扱いだけでも、露光、現像、焼
成、剥離といった多段階の工程が必要になる。従って、フォトリソグラフィ工程の回数が
増える程、製造コストは必然的に上がってしまうことになる。このような問題点を改善す
るために、フォトリソグラフィ工程を削減してTFTを製造することが試みられている(
例えば、特許文献1参照)。特許文献1では、フォトリソグラフィ工程によって形成され
たレジストマスクを、一回用いた後、膨潤により体積膨張をさせて異なる形状のレジスト
マスクとして再び用いている。
In the manufacturing process using the conventional photolithography technology, a multi-step process such as exposure, development, baking, and peeling is required only for handling a mask pattern formed using a photosensitive organic resin material called a photoresist. Become. Therefore, the manufacturing cost inevitably increases as the number of photolithography processes increases. In order to improve such problems, attempts have been made to manufacture TFTs by reducing the photolithography process (
For example, see Patent Document 1). In Patent Document 1, after a resist mask formed by a photolithography process is used once, it is subjected to volume expansion by swelling and used again as a resist mask having a different shape.

特開2000−133636号公報JP 2000-133636 A

しかしながら、該フォトリソグラフィ工程を用いると、感光剤塗布、パターニング、現像
処理、エッチング処理、及び剥離処理と少なくとも5つの処理工程を行う必要があるため
、工程終了まで時間がかかり、生産量が低下してしまう。また、感光剤のレジストや現像
に使用する現像液、さらに剥離で使用する剥離液等、さまざまな薬品を使用するため、工
程中に有害な廃液が生じ、薬品の原価のみならず、廃液の処分費が製造費用に上積みされ
てしまう。さらには、場合によっては、該薬品による環境汚染も考えられる。
However, when this photolithography process is used, it is necessary to perform at least five processing steps including photosensitizing agent coating, patterning, development processing, etching processing, and stripping processing. End up. In addition, since various chemicals such as a resist for photosensitizers, a developer used for development, and a stripper used for peeling are used, harmful waste liquid is generated during the process. Expenses are added to manufacturing costs. Furthermore, depending on the case, environmental pollution by the chemical may be considered.

また、該フォトリソグラフィ工程を用いて形成されたコンタクトホールに形成される導電
層の形状不良は、コンタクトホールを介して接続される導電層間の接触不良につながり、
得られる半導体装置の歩留まりや信頼性を低下させる原因となる。特に、回路を形成する
ための配線層を形成する際、配線層の接触不良は、ショートなど電気的特性に悪影響を与
える。
In addition, a defective shape of the conductive layer formed in the contact hole formed using the photolithography process leads to a poor contact between the conductive layers connected through the contact hole,
This may cause a decrease in yield and reliability of the obtained semiconductor device. In particular, when forming a wiring layer for forming a circuit, poor contact of the wiring layer adversely affects electrical characteristics such as a short circuit.

本発明は、TFT及びそれを用いる半導体装置並びにTFTによって形成される表示装置
の製造工程において、フォトリソグラフィ工程を削減し、さらに工程を簡略化し、生産能
力を向上させる技術を提供することを課題とする。また、本発明は、それらの表示装置を
構成する配線等の構成物を、所望の形状で制御性よく形成する方法を提供することも目的
とする。
It is an object of the present invention to provide a technique for reducing the photolithography process, simplifying the process, and improving the production capacity in the manufacturing process of the TFT, the semiconductor device using the TFT, and the display device formed by the TFT. To do. Another object of the present invention is to provide a method for forming a component such as a wiring constituting the display device in a desired shape with good controllability.

本発明は、フェムト秒レーザを用いて絶縁層及び導電層に開口部(コンタクトホール)を
形成し、該開口部に液状の導電性材料を吐出することにより該開口部を覆う導電層を形成
することを特徴とする。
In the present invention, an opening (contact hole) is formed in an insulating layer and a conductive layer using a femtosecond laser, and a conductive layer covering the opening is formed by discharging a liquid conductive material into the opening. It is characterized by that.

本発明の半導体装置の作製方法は、基板上に導電層を形成し、前記導電層上に光透過層を
形成し、前記光透過層上からフェムト秒レーザを照射して、前記導電層及び前記光透過層
を選択的に除去することを特徴とする。
In the method for manufacturing a semiconductor device of the present invention, a conductive layer is formed over a substrate, a light transmissive layer is formed over the conductive layer, and a femtosecond laser is irradiated from the light transmissive layer. The light transmitting layer is selectively removed.

本発明の半導体装置の作製方法は、基板上に導電層を形成し、前記導電層上に光透過層を
形成し、前記光透過層上からフェムト秒レーザを照射して、前記導電層及び前記光透過層
を選択的に除去して前記導電膜及び前記光透過層に開口部を形成し、前記開口部に液状の
導電性材料を滴下することを特徴とする。
In the method for manufacturing a semiconductor device of the present invention, a conductive layer is formed over a substrate, a light transmissive layer is formed over the conductive layer, and a femtosecond laser is irradiated from the light transmissive layer. A light transmissive layer is selectively removed to form an opening in the conductive film and the light transmissive layer, and a liquid conductive material is dropped into the opening.

本発明の半導体装置の作製方法において、前記導電層の端部は、前記光透過層の端部より
内側に配置されるように前記導電層及び前記光透過層を除去されていてもよい。
In the method for manufacturing a semiconductor device of the present invention, the conductive layer and the light transmission layer may be removed so that the end portion of the conductive layer is disposed inside the end portion of the light transmission layer.

本発明の半導体装置の作製方法は、基板上に第1の導電層を形成し、前記第1の導電層上
に光透過層を形成し、前記光透過層上からフェムト秒レーザを照射して、前記第1の導電
層及び前記光透過層を選択的に除去して前記第1の導電膜及び前記光透過層に開口部を形
成し、前記開口部に液状の導電性材料を滴下して、前記第1の導電層と電気的に接続する
第2の導電層を形成することを特徴とする。
In a method for manufacturing a semiconductor device of the present invention, a first conductive layer is formed over a substrate, a light transmission layer is formed over the first conductive layer, and a femtosecond laser is irradiated from the light transmission layer. The first conductive layer and the light transmission layer are selectively removed to form openings in the first conductive film and the light transmission layers, and a liquid conductive material is dropped into the openings. A second conductive layer electrically connected to the first conductive layer is formed.

本発明の半導体装置の作製方法において、前記第1の導電層の端部は、前記光透過層の端
部より内側に配置されるように前記第1の導電層及び前記光透過層を除去されていてもよ
い。
In the method for manufacturing a semiconductor device of the present invention, the first conductive layer and the light transmission layer are removed so that the end portion of the first conductive layer is disposed inside the end portion of the light transmission layer. It may be.

本発明の半導体装置の作製方法において、前記光透過層表面に撥液処理を行ってもよい。 In the method for manufacturing a semiconductor device of the present invention, a liquid repellent treatment may be performed on the surface of the light transmission layer.

本発明は表示機能を有する装置である表示装置にも用いることができ、本発明を用いる表
示装置には、エレクトロルミネセンス(以下「EL」ともいう。)と呼ばれる発光を発現
する有機物、無機物、若しくは有機物と無機物の混合物を含む層を、電極間に介在させた
発光素子とTFTとが接続された発光表示装置や、液晶材料を有する液晶素子を表示素子
として用いる液晶表示装置などがある。
The present invention can also be used for a display device that is a device having a display function. The display device using the present invention includes an organic substance, an inorganic substance, and an organic substance that emits light called electroluminescence (hereinafter also referred to as “EL”). Alternatively, there are a light-emitting display device in which a light-emitting element in which a layer containing a mixture of an organic substance and an inorganic substance is interposed between electrodes and a TFT are connected, and a liquid crystal display device in which a liquid crystal element having a liquid crystal material is used as a display element.

上記構成において開口を形成する導電層としてクロム、モリブデン、ニッケル、チタン、
コバルト、銅、又はアルミニウムのうち一種又は複数を用いて形成することができる。ま
た、開口を形成する光透過層はフェムト秒レーザを透過する材料、例えば透光性の有機樹
脂などを用いて形成することができる。
In the above structure, chromium, molybdenum, nickel, titanium,
One or more of cobalt, copper, and aluminum can be used. The light-transmitting layer that forms the opening can be formed using a material that transmits a femtosecond laser, such as a light-transmitting organic resin.

本発明により、複雑なフォトリソグラフィ工程を軽減し、簡略化された工程で半導体装置
を作製することができるので、材料のロスが少なく、コストダウンも達成できる。よって
高性能、高信頼性の表示装置を歩留まりよく作製することができる。
According to the present invention, a complicated photolithography process can be reduced and a semiconductor device can be manufactured through a simplified process, so that material loss is small and cost reduction can be achieved. Therefore, a high-performance and highly reliable display device can be manufactured with high yield.

本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明に適応可能な発光素子の断面構造を説明する図である。It is a figure explaining the cross-section of the light emitting element which can be applied to this invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明に適応可能な発光素子の等価回路を説明する図である。It is a figure explaining the equivalent circuit of the light emitting element which can be applied to this invention. 本発明の半導体装置の作製方法を説明する断面図である。8A to 8D are cross-sectional views illustrating a method for manufacturing a semiconductor device of the present invention. 本発明に適応可能な電気泳動素子の断面構造を説明する図である。It is a figure explaining the cross-sectional structure of the electrophoretic element which can be applied to this invention. 本発明の表示パネルにおいて走査線側駆動回路をTFTで形成する場合の回路構成を説明する図。4A and 4B each illustrate a circuit structure in the case where a scan line side driver circuit is formed using TFTs in a display panel of the present invention; 本発明の表示パネルにおいて走査線側駆動回路をTFTで形成する場合の回路構成を説明する図(シフトレジスタ回路)。4A and 4B illustrate a circuit structure in the case where a scan line driver circuit is formed using TFTs in a display panel of the present invention (shift register circuit). 本発明の表示パネルにおいて走査線側駆動回路をTFTで形成する場合の回路構成を説明する図(バッファ回路)。4A and 4B illustrate a circuit configuration in the case where a scan line side driver circuit is formed using TFTs in a display panel of the present invention (buffer circuit). 本発明の半導体装置を説明する上面図である。It is a top view illustrating a semiconductor device of the present invention. 本発明の半導体装置を説明する上面図である。It is a top view illustrating a semiconductor device of the present invention. 本発明の半導体装置を用いた電子機器を説明する斜視図である。FIG. 11 is a perspective view illustrating an electronic device using the semiconductor device of the invention. 本発明の半導体装置を用いた電子機器を説明する図である。FIG. 11 illustrates an electronic device using a semiconductor device of the present invention.

本発明の実施の形態について、図面を用いて詳細に説明する。但し、本発明は以下の説明
に限定されず、本発明の趣旨及びその範囲から逸脱することなくその形態及び詳細を様々
に変更し得ることは当業者であれば容易に理解される。従って、本発明は以下に示す実施
の形態の記載内容に限定して解釈されるものではない。なお、以下に説明する本発明の構
成において、同一部分又は同様な機能を有する部分には同一の符号を異なる図面間で共通
して用い、その繰り返しの説明は省略する。
Embodiments of the present invention will be described in detail with reference to the drawings. However, the present invention is not limited to the following description, and it is easily understood by those skilled in the art that modes and details can be variously changed without departing from the spirit and scope of the present invention. Therefore, the present invention should not be construed as being limited to the description of the embodiments below. Note that in structures of the present invention described below, the same portions or portions having similar functions are denoted by the same reference numerals in different drawings, and description thereof is not repeated.

(実施の形態1)
本実施の形態では、フェムト秒レーザを用いて開口部(コンタクトホール)を形成し、該
開口部に液状の導電性材料を吐出することにより該開口部を覆う導電層を形成する方法に
ついて説明する。
(Embodiment 1)
In this embodiment, a method for forming a conductive layer that covers an opening by forming an opening (contact hole) using a femtosecond laser and discharging a liquid conductive material into the opening is described. .

まず、基板720上に導電層721を形成する(図1(A))。なお、導電層721とし
て例えば、チタン(Ti)、アルミニウム(Al)、タンタル(Ta)、タングステン(
W)、モリブデン(Mo)、銅(Cu)、クロム(Cr)、ネオジム(Nd)、鉄(Fe
)、ニッケル(Ni)、コバルト(Co)、ルテニウム(Ru)、ロジウム(Rh)、パ
ラジウム(Pd)、オスミウム(Os)、イリジウム(Ir)、銀(Ag)、金(Au)
、白金(Pt)、カドミウム(Cd)、亜鉛(Zn)、珪素(Si)、ゲルマニウム(G
e)、ジルコニウム(Zr)、バリウム(Ba)から選ばれた元素を含む材料からなる層
を単層又は積層形成して用いることができる。
First, the conductive layer 721 is formed over the substrate 720 (FIG. 1A). As the conductive layer 721, for example, titanium (Ti), aluminum (Al), tantalum (Ta), tungsten (
W), molybdenum (Mo), copper (Cu), chromium (Cr), neodymium (Nd), iron (Fe
), Nickel (Ni), cobalt (Co), ruthenium (Ru), rhodium (Rh), palladium (Pd), osmium (Os), iridium (Ir), silver (Ag), gold (Au)
Platinum (Pt), cadmium (Cd), zinc (Zn), silicon (Si), germanium (G
e) A layer made of a material containing an element selected from zirconium (Zr) and barium (Ba) can be used as a single layer or a stacked layer.

次に、導電層721上に光透過層722を形成する(図1(A))。ここで、光透過層7
22としてはレーザ光を透過する材料で形成された薄膜であれば特に限定されない。例え
ば、透光性の有機樹脂などを用いて形成することができる。また、光透過層722表面に
撥液処理を行ってもよい。
Next, a light-transmitting layer 722 is formed over the conductive layer 721 (FIG. 1A). Here, the light transmission layer 7
22 is not particularly limited as long as it is a thin film formed of a material that transmits laser light. For example, it can be formed using a light-transmitting organic resin or the like. Further, the surface of the light transmission layer 722 may be subjected to a liquid repellent treatment.

次に、光透過層722上からフェムト秒レーザを照射する(図1(B))。光透過層72
2表面にフェムト秒レーザを照射することにより導電層721及び光透過層722を選択
的に除去することが可能である(図1(C))。つまり、導電層721及び光透過層72
2に選択的に開口部725を形成することができる。ここでフェムト秒レーザの焦点は、
光透過層722又は導電層721中に位置するように調整する。なお、基板の起伏により
焦点の位置が変わる場合にはオートフォーカス機能を光学系に付与してもよい。なお、フ
ェムト秒レーザの焦点を光透過層722中に位置するようにフェムト秒レーザを照射した
場合でも、該光透過層722は薄膜であるため該光透過層722のみを選択的に除去する
ことは困難である。従って、下層の導電層721もともに除去され、導電層721及び光
透過層722が開口された開口部725が形成される。また、このようにフェムト秒レー
ザを照射して開口部を形成した場合、開口部725において絶縁層722の端部が導電層
721の端部より内側に形成されるように形成することもできる。このような形状とする
ことで開口部の口径を小さく保ったまま、導電層721の露出面積を増やすことができる
。このように、導電層721及び光透過層722を積層させフェムト秒レーザで開口を形
成することにより口径の小さな開口部を形成するこができる。このような開口部であって
も、導電性樹脂材料を用いてコンタクトを形成することにより、良好な接続構造を形成す
ることができる。
Next, a femtosecond laser is irradiated from above the light transmission layer 722 (FIG. 1B). Light transmission layer 72
The conductive layer 721 and the light-transmitting layer 722 can be selectively removed by irradiating the two surfaces with femtosecond laser (FIG. 1C). That is, the conductive layer 721 and the light transmissive layer 72.
The opening 725 can be selectively formed in the area 2. Where the focus of the femtosecond laser is
Adjustment is performed so that the light transmission layer 722 or the conductive layer 721 is located. Note that if the focal position changes due to the undulation of the substrate, an autofocus function may be added to the optical system. Even when the femtosecond laser is irradiated so that the focal point of the femtosecond laser is located in the light transmission layer 722, the light transmission layer 722 is a thin film, so that only the light transmission layer 722 is selectively removed. It is difficult. Accordingly, the lower conductive layer 721 is also removed, and an opening 725 in which the conductive layer 721 and the light transmission layer 722 are opened is formed. Further, when the opening is formed by irradiating the femtosecond laser in this manner, the end of the insulating layer 722 in the opening 725 can be formed inside the end of the conductive layer 721. With such a shape, the exposed area of the conductive layer 721 can be increased while the aperture diameter is kept small. In this manner, an opening with a small diameter can be formed by stacking the conductive layer 721 and the light transmission layer 722 and forming the opening with a femtosecond laser. Even in such an opening, a good connection structure can be formed by forming a contact using a conductive resin material.

なお、フェムト秒レーザは、パルス幅がフェムト秒(10−15秒)台で発振するレーザ
(フェムト秒レーザともいう)を射出するレーザ発振器を用いて照射する。該レーザ発振
器として用いることができるのは、Sapphire、YAG、セラミックスYAG、セ
ラミックスY、KGW、KYW、MgSiO、YLF、YVO、GdVO
などの結晶に、Nd、Yb、Cr、Ti、Ho、Erなどのドーパントを添加したレーザ
などが挙げられる。
Note that the femtosecond laser is irradiated using a laser oscillator that emits a laser (also referred to as a femtosecond laser) that oscillates at a pulse width in the femtosecond ( 10-15 seconds) range. Sapphire, YAG, ceramics YAG, ceramics Y 2 O 3 , KGW, KYW, Mg 2 SiO 4 , YLF, YVO 4 , GdVO 4 can be used as the laser oscillator.
For example, a laser in which a dopant such as Nd, Yb, Cr, Ti, Ho, Er, or the like is added to a crystal such as.

本実施の形態において、レーザ光によって選択的に開口部725を形成することができる
のでマスク層を形成しなくてもよく工程及び材料を削減することができる。またフェムト
秒レーザを用いることにより、非常に小さいスポットに集光できるので、加工すべき導電
層及び絶縁層を所定の形状に高い精度で加工できる。かつ短時間で瞬間的に加熱されるの
で、加工領域以外の領域をほとんど加熱しなくてもよいという利点がある。また、フェム
ト秒レーザを用いることにより、光を透過する(光をほとんど吸収しない)物質に対して
の加工を容易に行うことが可能であり。また、異なる材料が多層に積層された膜を単一の
工程で加工することが可能である。
In this embodiment mode, the opening 725 can be selectively formed by laser light; therefore, a mask and a layer need not be formed, and processes and materials can be reduced. Further, since a femtosecond laser can be used to focus light on a very small spot, a conductive layer and an insulating layer to be processed can be processed into a predetermined shape with high accuracy. And since it heats instantaneously in a short time, there exists an advantage that it is almost unnecessary to heat areas other than a process area | region. Further, by using a femtosecond laser, it is possible to easily process a material that transmits light (absorbs almost no light). In addition, a film in which different materials are stacked in multiple layers can be processed in a single process.

次に、開口部725に液状の導電性材料724を滴下する(図1(D))。ここでは、特
定の目的に調合された組成物の液滴を選択的に吐出(噴出)して所定のパターンに導電層
などを形成することが可能な、液滴吐出(噴出)法(その方式によっては、インクジェッ
ト法とも呼ばれる。)を用いる。開口部725に構成物形成材料を含む液状の導電性材料
(液滴)724を吐出し、焼成、乾燥等を行って固定化し所望なパターンの導電層726
を形成する(図1(E))。
Next, a liquid conductive material 724 is dropped into the opening 725 (FIG. 1D). Here, a droplet discharge (spout) method (its method) that can selectively discharge (spout) droplets of a composition prepared for a specific purpose to form a conductive layer or the like in a predetermined pattern. Depending on the ink jet method). A liquid conductive material (droplet) 724 containing a composition forming material is discharged into the opening 725 and fixed by firing, drying, or the like, and a conductive layer 726 having a desired pattern.
(FIG. 1E).

ここで、液滴吐出法に用いる液滴吐出装置の一態様を図2に示す。液滴吐出手段1403
の個々のヘッド1405、ヘッド1412は制御手段1407に接続され、それがコンピ
ュータ1410で制御することにより予めプログラミングされたパターンに描画すること
ができる。描画するタイミングは、例えば、基板1400上に形成されたマーカー141
1を基準に行えば良い。或いは、基板1400の縁を基準にして基準点を確定させても良
い。これを撮像手段1404で検出し、画像処理手段1409にてデジタル信号に変換し
たものをコンピュータ1410で認識して制御信号を発生させて制御手段1407に送る
。撮像手段1404としては、電荷結合素子(CCD)や相補型金属酸化物半導体を利用
したイメージセンサなどを用いることができる。勿論、基板1400上に形成されるべき
パターンの情報は記憶媒体1408に格納されたものであり、この情報を基にして制御手
段1407に制御信号を送り、液滴吐出手段1403の個々のヘッド1405、ヘッド1
412を個別に制御することができる。吐出する材料は、材料供給源1413、材料供給
源1414より配管を通してヘッド1405、ヘッド1412にそれぞれ供給される。
Here, one mode of a droplet discharge apparatus used for the droplet discharge method is shown in FIG. Droplet discharge means 1403
The individual heads 1405 and 1412 are connected to the control means 1407, and can be drawn in a pre-programmed pattern under the control of the computer 1410. The drawing timing is, for example, the marker 141 formed on the substrate 1400.
1 may be used as a reference. Alternatively, the reference point may be determined based on the edge of the substrate 1400. This is detected by the imaging means 1404, converted into a digital signal by the image processing means 1409, is recognized by the computer 1410, a control signal is generated, and sent to the control means 1407. As the imaging unit 1404, a charge coupled device (CCD), an image sensor using a complementary metal oxide semiconductor, or the like can be used. Of course, the information on the pattern to be formed on the substrate 1400 is stored in the storage medium 1408. Based on this information, a control signal is sent to the control means 1407, and each head 1405 of the droplet discharge means 1403 is sent. , Head 1
412 can be controlled individually. The material to be discharged is supplied from the material supply source 1413 and the material supply source 1414 to the head 1405 and the head 1412 through piping.

ヘッド1405内部は、点線1406が示すように液状の材料を充填する空間と、吐出口
であるノズルを有する構造となっている。図示しないが、ヘッド1412もヘッド140
5と同様な内部構造を有する。ヘッド1405とヘッド1412のノズルを異なるサイズ
で設けると、異なる材料を異なる幅で同時に描画することができる。一つのヘッドで、導
電性材料や有機、無機材料などをそれぞれ吐出し、描画することができ、層間膜のような
広領域に描画する場合は、スループットを向上させるため複数のノズルより同材料を同時
に吐出し、描画することができる。大型基板を用いる場合、ヘッド1405、ヘッド14
12は基板上を、矢印の方向に自在に走査し、描画する領域を自由に設定することができ
、同じパターンを一枚の基板に複数描画することができる。
The inside of the head 1405 has a structure having a space filled with a liquid material as indicated by a dotted line 1406 and a nozzle that is a discharge port. Although not shown, the head 1412 is also the head 140.
5 has the same internal structure. When the nozzles of the head 1405 and the head 1412 are provided in different sizes, different materials can be drawn simultaneously with different widths. With one head, conductive material, organic material, inorganic material, etc. can be discharged and drawn respectively. When drawing in a wide area like an interlayer film, the same material is used from multiple nozzles to improve throughput. It is possible to discharge and draw at the same time. When a large substrate is used, the head 1405 and the head 14
No. 12 can freely scan the substrate in the direction of the arrow to freely set the drawing area, and a plurality of the same pattern can be drawn on one substrate.

液滴吐出法を用いて導電層を形成する場合、粒子状に加工された導電性材料を含む組成物
を吐出し、焼成によって融合や融着接合させ固化することで導電層を形成する。このよう
に導電性材料を含む組成物を吐出し、焼成することによって形成された導電層(または絶
縁層)においては、スパッタ法などで形成した導電層(または絶縁層)が、多くは柱状構
造を示すのに対し、多くの粒界を有する多結晶状態を示すことが多い。
In the case of forming a conductive layer by using a droplet discharge method, a conductive layer is formed by discharging a composition containing a conductive material processed into a particulate form and fusing or fusion-bonding and solidifying by firing. In such a conductive layer (or insulating layer) formed by discharging and baking a composition containing a conductive material, the conductive layer (or insulating layer) formed by sputtering or the like is mostly a columnar structure. In many cases, a polycrystalline state having many grain boundaries is exhibited.

本実施の形態では、フェムト秒レーザを用いて光透過層722に開口部725を形成して
、液滴吐出法により該開口部725に導電層726を形成する。これにより、複雑なフォ
トリソグラフィ工程を行うことなく開口部を形成することができ、かつ該導電層726は
該開口部の形状に左右されず絶縁層下の導電層721と良好な電気的コンタクトをとるこ
とができる。例えば、開口部725において、絶縁層722の端部が導電層721の端部
より内側に形成されている(開口部が逆テーパ形状)場合や開口部が狭い場合でも、導電
層726は開口部に液状の導電性材料を吐出して形成されるため、導電層721と良好な
電気的コンタクトをとることができる。
In this embodiment, an opening 725 is formed in the light transmission layer 722 using a femtosecond laser, and the conductive layer 726 is formed in the opening 725 by a droplet discharge method. Accordingly, an opening can be formed without performing a complicated photolithography process, and the conductive layer 726 can be in good electrical contact with the conductive layer 721 under the insulating layer regardless of the shape of the opening. Can take. For example, in the opening portion 725, the conductive layer 726 has an opening portion even when the end portion of the insulating layer 722 is formed inside the end portion of the conductive layer 721 (the opening portion has a reverse taper shape) or the opening portion is narrow. Since the liquid conductive material is discharged on the surface, good electrical contact with the conductive layer 721 can be obtained.

また、本実施の形態において、光透過層722にフェムト秒レーザを照射する前に光透過
層722表面に撥液処理を行っていてもよい。光透過層722表面に撥液処理を行うこと
により、開口部725に導電層726を形成する際に、液状の導電性材料(液滴)724
が、開口部725に入らず光透過層722表面に堆積するのを防ぐことができ、より精度
良く導電性材料724を開口部725に流入させることができる。
In this embodiment mode, a liquid repellent treatment may be performed on the surface of the light transmitting layer 722 before the light transmitting layer 722 is irradiated with the femtosecond laser. When the conductive layer 726 is formed in the opening 725 by performing a liquid repellent treatment on the surface of the light transmission layer 722, a liquid conductive material (droplet) 724 is formed.
However, deposition on the surface of the light transmission layer 722 without entering the opening 725 can be prevented, and the conductive material 724 can flow into the opening 725 with higher accuracy.

(実施の形態2)
本実施の形態では、実施の形態1の方法を用いた半導体装置の作製方法について、図3を
用いて説明する。
(Embodiment 2)
In this embodiment, a method for manufacturing a semiconductor device using the method of Embodiment 1 will be described with reference to FIGS.

ここでは、半導体装置として、逆スタガ型薄膜トランジスタ(逆スタガ型TFT)を用い
て説明する。なお、逆スタガ型薄膜トランジスタに限らず、順スタガ型薄膜トランジスタ
、コプレナー型薄膜トランジスタ、ダイオード、MOSトランジスタ等の半導体素子を作
製することでもできる。
Here, the semiconductor device is described using an inverted staggered thin film transistor (an inverted staggered TFT). Note that not only the inverted staggered thin film transistor but also a semiconductor element such as a forward staggered thin film transistor, a coplanar thin film transistor, a diode, or a MOS transistor can be manufactured.

まず、基板100上にゲート電極層182を形成する(図3(A))。基板100は、バ
リウムホウケイ酸ガラス、アルミノホウケイ酸ガラス等からなるガラス基板、石英基板、
金属基板、又は本作製工程の処理温度に耐えうる耐熱性を有するプラスチック基板を用い
ることができる。また、基板100の表面が平坦化されるようにCMP法などによって、
研磨しても良い。なお、基板100上に、絶縁層を形成してもよい。絶縁層は、CVD法
、プラズマCVD法、スパッタリング法、スピンコート法等の種々の方法により、珪素を
含む酸化物材料、窒化物材料を用いて、単層又は積層して形成される。この絶縁層は、形
成しなくても良いが、基板100からの汚染物質などを遮断する効果がある。
First, the gate electrode layer 182 is formed over the substrate 100 (FIG. 3A). The substrate 100 includes a glass substrate made of barium borosilicate glass, alumino borosilicate glass, etc., a quartz substrate,
A metal substrate or a plastic substrate having heat resistance that can withstand the processing temperature in this manufacturing process can be used. Further, by a CMP method or the like so that the surface of the substrate 100 is planarized,
It may be polished. Note that an insulating layer may be formed over the substrate 100. The insulating layer is formed as a single layer or a stacked layer using an oxide material or a nitride material containing silicon by various methods such as a CVD method, a plasma CVD method, a sputtering method, and a spin coating method. This insulating layer may not be formed, but has an effect of blocking contaminants from the substrate 100.

ゲート電極層182は、例えばスパッタリング法、PVD法(Physical Vap
or Deposition)、減圧CVD法(LPCVD法)、またはプラズマCVD
法等のCVD法(Chemical Vapor Deposition)などを用いて
導電層を形成した後、フォトリソグラフィー工程により選択的に導電層をエッチングする
ことで形成することができる。また、ゲート電極層182を形成する導電性材料として、
Ag、Au、Ni、Pt、Pd、Ir、Rh、Ta、W、Ti、Mo、Al、Cuから選
ばれた元素、又は前記元素を主成分とする合金材料もしくは化合物材料を用いることがで
きる。また、リン等の不純物元素をドーピングした多結晶シリコン膜に代表される半導体
膜や、AgPdCu合金を用いてもよい。また、単層構造でも複数層の構造でもよく、例
えば、窒化タングステン(WN)膜とモリブデン(Mo)膜との2層構造としてもよいし
、膜厚50nmのタングステン膜、膜厚500nmのアルミニウムとシリコンの合金(A
l−Si)膜、膜厚30nmの窒化チタン膜を順次積層した3層構造としてもよい。また
、3層構造とする場合、第1の導電膜のタングステンに代えて窒化タングステンを用いて
もよいし、第2の導電膜のアルミニウムとシリコンの合金(Al−Si)膜に代えてアル
ミニウムとチタンの合金膜(Al−Ti)を用いてもよいし、第3の導電膜の窒化チタン
膜に代えてチタン膜を用いてもよい。
The gate electrode layer 182 is formed by, for example, a sputtering method or a PVD method (Physical Vap.
or Deposition), low pressure CVD (LPCVD), or plasma CVD
After the conductive layer is formed using a CVD method (Chemical Vapor Deposition) such as a method, the conductive layer can be selectively etched by a photolithography process. As a conductive material for forming the gate electrode layer 182,
An element selected from Ag, Au, Ni, Pt, Pd, Ir, Rh, Ta, W, Ti, Mo, Al, and Cu, or an alloy material or a compound material containing the element as a main component can be used. Alternatively, a semiconductor film typified by a polycrystalline silicon film doped with an impurity element such as phosphorus, or an AgPdCu alloy may be used. Alternatively, a single-layer structure or a multi-layer structure may be used, for example, a two-layer structure of a tungsten nitride (WN) film and a molybdenum (Mo) film, a tungsten film with a thickness of 50 nm, aluminum with a thickness of 500 nm, and Silicon alloy (A
(l-Si) film and a titanium nitride film having a thickness of 30 nm may be sequentially stacked. In the case of a three-layer structure, tungsten nitride may be used instead of tungsten of the first conductive film, or aluminum instead of the aluminum and silicon alloy (Al-Si) film of the second conductive film. A titanium alloy film (Al—Ti) may be used, or a titanium film may be used instead of the titanium nitride film of the third conductive film.

本実施の形態ではゲート電極層は組成物を選択的に吐出して形成する。このように選択的
にゲート電極層を形成すると加工の工程が簡略化する効果がある。
In this embodiment mode, the gate electrode layer is formed by selectively discharging a composition. When the gate electrode layer is selectively formed in this way, there is an effect that the processing step is simplified.

次に、基板100及びゲート電極層182上にゲート絶縁層180を形成する(図3(A
))。ゲート絶縁層180としては、珪素の酸化物材料又は窒化物材料等の材料で形成す
ればよく、積層でも単層でもよい。本実施の形態では、窒化珪素膜、酸化珪素膜の2層の
積層を用いる。またそれらや、酸化窒化珪素膜の単層、3層以上からなる積層でも良い。
好適には、緻密な膜質を有する窒化珪素膜を用いるとよい。また、液滴吐出法で形成され
る導電層に銀や銅などを用いる場合、その上にバリア膜として窒化珪素膜やNiB膜を形
成すると、不純物の拡散を防ぎ、表面を平坦化する効果がある。なお、低い成膜温度でゲ
ートリーク電流の少ない緻密な絶縁膜を形成するには、アルゴンなどの希ガス元素を反応
ガスに含ませ、形成される絶縁膜中に混入させると良い。ここでは、プラズマCVD法に
より、50〜200nmの窒化珪素層を形成する。
Next, a gate insulating layer 180 is formed over the substrate 100 and the gate electrode layer 182 (FIG. 3A).
)). The gate insulating layer 180 may be formed of a material such as a silicon oxide material or a nitride material, and may be a stacked layer or a single layer. In this embodiment, a two-layer stack of a silicon nitride film and a silicon oxide film is used. Alternatively, a single layer of silicon oxynitride film or a stack of three or more layers may be used.
A silicon nitride film having a dense film quality is preferably used. In addition, when silver or copper is used for a conductive layer formed by a droplet discharge method, if a silicon nitride film or a NiB film is formed thereon as a barrier film, diffusion of impurities can be prevented and the surface can be planarized. is there. Note that in order to form a dense insulating film with low gate leakage current at a low deposition temperature, a rare gas element such as argon is preferably contained in a reaction gas and mixed into the formed insulating film. Here, a 50-200 nm silicon nitride layer is formed by plasma CVD.

次に、基板100のゲート絶縁層180上に半導体層185aを形成する。半導体層18
5aを形成する材料は、シランやゲルマンに代表される半導体材料ガスを用いて気相成長
法やスパッタリング法で作製されるアモルファス半導体(以下「AS」ともいう。)、該
非晶質半導体を光エネルギーや熱エネルギーを利用して結晶化させた多結晶半導体、或い
はセミアモルファス(微結晶若しくはマイクロクリスタルとも呼ばれる。「SAS」とも
いう。)半導体などを用いることができる。なお、半導体層185aは、調整された組成
物の液滴を微細な孔から吐出して所定の形状の層を形成する液滴吐出法を用いて形成する
ことができる。また、印刷法を用いて形成してもよい。また、CVD法、PVD法、塗布
法等により基板上に半導体層を形成した後、フォトリソグラフィー工程により選択的に導
電層をエッチングして、半導体層185aを形成してもよい。
Next, the semiconductor layer 185 a is formed over the gate insulating layer 180 of the substrate 100. Semiconductor layer 18
The material for forming 5a is an amorphous semiconductor (hereinafter also referred to as “AS”) manufactured by a vapor deposition method or a sputtering method using a semiconductor material gas typified by silane or germane. Alternatively, a polycrystalline semiconductor crystallized using heat energy or a semi-amorphous (also referred to as microcrystal or microcrystal; also referred to as “SAS”) semiconductor can be used. Note that the semiconductor layer 185a can be formed by a droplet discharge method in which a droplet of the adjusted composition is discharged from a minute hole to form a layer having a predetermined shape. Moreover, you may form using a printing method. Alternatively, the semiconductor layer 185a may be formed by forming a semiconductor layer over a substrate by a CVD method, a PVD method, a coating method, or the like, and then selectively etching the conductive layer by a photolithography process.

アモルファス半導体としては、代表的には水素化アモルファスシリコン、結晶性半導体と
しては代表的にはポリシリコンなどがあげられる。ポリシリコン(多結晶シリコン)には
、800℃以上のプロセス温度を経て形成されるポリシリコンを主材料として用いた所謂
高温ポリシリコンや、600℃以下のプロセス温度で形成されるポリシリコンを主材料と
して用いた所謂低温ポリシリコン、また結晶化を促進する元素などを添加し結晶化させた
ポリシリコンなどを含んでいる。もちろん、セミアモルファス半導体又は半導体層の一部
に結晶相を含む半導体を用いることもできる。
A typical example of an amorphous semiconductor is hydrogenated amorphous silicon, and a typical example of a crystalline semiconductor is polysilicon. Polysilicon (polycrystalline silicon) is mainly made of so-called high-temperature polysilicon using polysilicon formed through a process temperature of 800 ° C. or higher as a main material, or polysilicon formed at a process temperature of 600 ° C. or lower. And so-called low-temperature polysilicon, and polysilicon crystallized by adding an element that promotes crystallization. Needless to say, a semi-amorphous semiconductor or a semiconductor containing a crystal phase in part of a semiconductor layer can also be used.

なお、SASは、非晶質と結晶構造(単結晶、多結晶を含む)の中間的な構造を有し、自
由エネルギー的に安定な第3の状態を有する半導体であって、短距離秩序を持ち格子歪み
を有する結晶質な領域を含んでいる。少なくとも膜中の一部の領域には、0.5〜20n
mの結晶領域を観測することが出来、珪素を主成分とする場合にはラマンスペクトルが5
20cm−1よりも低波数側にシフトしている。X線回折では珪素結晶格子に由来すると
される(111)、(220)の回折ピークが観測される。未結合手(ダングリングボン
ド)を終端化するため水素またはハロゲンを少なくとも1原子%またはそれ以上含ませて
いる。SASは、珪素を含む気体をグロー放電分解(プラズマCVD)して形成する。珪
素を含む気体としては、SiH、その他にもSi、SiHCl、SiHCl
、SiCl、SiFなどを用いることが可能である。またF、GeFを混合さ
せても良い。この珪素を含む気体をH、又は、HとHe、Ar、Kr、Neから選ば
れた一種または複数種の希ガス元素で希釈しても良い。希釈率は2〜1000倍の範囲、
圧力は概略0.1Pa〜133Paの範囲、電源周波数は1MHz〜120MHz、好ま
しくは13MHz〜60MHzである。基板加熱温度は300℃以下が好ましく、100
〜200℃の基板加熱温度でも形成可能である。ここで、主に成膜時に取り込まれる不純
物元素として、酸素、窒素、炭素などの大気成分に由来する不純物は1×1020cm
以下とすることが望ましく、特に、酸素濃度は5×1019cm−3以下、好ましくは
1×1019cm−3以下となるようにすることが好ましい。また、ヘリウム、アルゴン
、クリプトン、ネオンなどの希ガス元素を含ませて格子歪みをさらに助長させることで安
定性が増し良好なSASが得られる。また半導体層としてフッ素系ガスより形成されるS
AS層に水素系ガスより形成されるSAS層を積層してもよい。
Note that a SAS is a semiconductor having an intermediate structure between amorphous and crystalline structures (including single crystals and polycrystals) and having a third state that is stable in terms of free energy, and has a short-range order. It includes a crystalline region having a lattice strain. At least in a part of the film, 0.5 to 20 n
The crystal region of m can be observed. When silicon is the main component, the Raman spectrum is 5
It is shifted to the lower wave number side than 20 cm −1 . In X-ray diffraction, diffraction peaks of (111) and (220) that are derived from the silicon crystal lattice are observed. In order to terminate dangling bonds (dangling bonds), hydrogen or halogen is contained at least 1 atomic% or more. SAS is formed by glow discharge decomposition (plasma CVD) of a gas containing silicon. Examples of the gas containing silicon include SiH 4 , Si 2 H 6 , SiH 2 Cl 2 , and SiHCl.
3 , SiCl 4 , SiF 4 or the like can be used. Further, F 2 and GeF 4 may be mixed. The gas containing silicon may be diluted with H 2 , or H 2 and one or more kinds of rare gas elements selected from He, Ar, Kr, and Ne. Dilution rate ranges from 2 to 1000 times,
The pressure is in the range of approximately 0.1 Pa to 133 Pa, and the power supply frequency is 1 MHz to 120 MHz, preferably 13 MHz to 60 MHz. The substrate heating temperature is preferably 300 ° C. or less, and 100
It can be formed even at a substrate heating temperature of ˜200 ° C. Here, as an impurity element mainly taken in during film formation, impurities derived from atmospheric components such as oxygen, nitrogen, and carbon are 1 × 10 20 cm −.
The oxygen concentration is desirably 3 or less, and in particular, the oxygen concentration is preferably 5 × 10 19 cm −3 or less, more preferably 1 × 10 19 cm −3 or less. Further, by adding a rare gas element such as helium, argon, krypton, or neon to further promote lattice distortion, stability is improved and a favorable SAS can be obtained. Further, S formed from a fluorine-based gas as a semiconductor layer.
A SAS layer formed from a hydrogen-based gas may be stacked on the AS layer.

半導体層に、結晶性半導体層を用いる場合、その結晶性半導体層の作製方法は、各種方法
(レーザ結晶化法、熱結晶化法、またはニッケルなどの結晶化を助長する元素を用いた熱
結晶化法等)を用いれば良い。また、SASである微結晶半導体をレーザ照射して結晶化
し、結晶性を高めることもできる。結晶化を助長する元素を導入しない場合は、非晶質珪
素膜にレーザ光を照射する前に、窒素雰囲気下500℃で1時間加熱することによって非
晶質珪素膜の含有水素濃度を1×1020atoms/cm以下にまで放出させる。こ
れは水素を多く含んだ非晶質珪素膜にレーザ光を照射すると非晶質珪素膜が破壊されてし
まうからである。
When a crystalline semiconductor layer is used for the semiconductor layer, the crystalline semiconductor layer can be manufactured by various methods (laser crystallization, thermal crystallization, or thermal crystallization using an element that promotes crystallization such as nickel. Or the like) may be used. In addition, a microcrystalline semiconductor that is a SAS can be crystallized by laser irradiation to improve crystallinity. In the case where an element for promoting crystallization is not introduced, the amorphous silicon film is heated at 500 ° C. for 1 hour in a nitrogen atmosphere before irradiating the amorphous silicon film with laser light, whereby the concentration of hydrogen contained in the amorphous silicon film is set to 1 ×. Release to 10 20 atoms / cm 3 or less. This is because the amorphous silicon film is destroyed when the amorphous silicon film containing a large amount of hydrogen is irradiated with laser light.

非晶質半導体層への金属元素の導入の仕方としては、当該金属元素を非晶質半導体層の表
面又はその内部に存在させ得る手法であれば特に限定はなく、例えばスパッタ法、CVD
法、プラズマ処理法(プラズマCVD法も含む)、吸着法、金属塩の溶液を塗布する方法
を使用することができる。このうち溶液を用いる方法は簡便であり、金属元素の濃度調整
が容易であるという点で有用である。また、このとき非晶質半導体層の表面の濡れ性を改
善し、非晶質半導体層の表面全体に水溶液を行き渡らせるため、酸素雰囲気中でのUV光
の照射、熱酸化法、ヒドロキシラジカルを含むオゾン水又は過酸化水素による処理等によ
り、酸化膜を成膜することが望ましい。
The method of introducing the metal element into the amorphous semiconductor layer is not particularly limited as long as the metal element can be present on the surface of the amorphous semiconductor layer or inside the amorphous semiconductor layer. For example, sputtering, CVD
Methods, plasma treatment methods (including plasma CVD methods), adsorption methods, and metal salt solution coating methods can be used. Among these, the method using a solution is simple and useful in that the concentration of the metal element can be easily adjusted. At this time, in order to improve the wettability of the surface of the amorphous semiconductor layer and to spread the aqueous solution over the entire surface of the amorphous semiconductor layer, irradiation with UV light in an oxygen atmosphere, thermal oxidation method, hydroxy radical It is desirable to form an oxide film by treatment with ozone water or hydrogen peroxide.

非晶質半導体層の結晶化は、熱処理とレーザ光照射による結晶化を組み合わせてもよく、
熱処理やレーザ光照射を単独で、複数回行っても良い。また、結晶性半導体層を、直接基
板にプラズマ法により形成しても良い。
The crystallization of the amorphous semiconductor layer may be a combination of heat treatment and crystallization by laser light irradiation.
Heat treatment and laser light irradiation may be performed several times independently. Alternatively, the crystalline semiconductor layer may be directly formed over the substrate by a plasma method.

また、半導体として有機半導体材料を用い、印刷法、ディスペンサ法、スプレー法、スピ
ン塗布法、液滴吐出法などで形成することができる。この場合、上記エッチング工程が必
要ないため、工程数を削減することが可能である。有機半導体としては、低分子材料、高
分子材料などが用いられ、有機色素、導電性高分子材料などの材料も用いることができる
。本発明に用いる有機半導体材料としては、その骨格が共役二重結合から構成されるπ電
子共役系の高分子材料が望ましい。代表的には、ポリチオフェン、ポリフルオレン、ポリ
(3−アルキルチオフェン)、ポリチオフェン誘導体、ペンタセン等の可溶性の高分子材
料を用いることができる。
Alternatively, an organic semiconductor material can be used as a semiconductor, and it can be formed by a printing method, a dispenser method, a spray method, a spin coating method, a droplet discharge method, or the like. In this case, the number of processes can be reduced because the etching process is not necessary. As the organic semiconductor, a low molecular material, a polymer material, or the like is used, and materials such as an organic dye or a conductive polymer material can also be used. The organic semiconductor material used in the present invention is preferably a π-electron conjugated polymer material whose skeleton is composed of conjugated double bonds. Typically, a soluble polymer material such as polythiophene, polyfluorene, poly (3-alkylthiophene), a polythiophene derivative, or pentacene can be used.

その他にも本発明に用いることができる有機半導体材料としては、可溶性の前駆体を成膜
した後で処理することにより半導体層を形成することができる材料がある。なお、このよ
うな有機半導体材料としては、ポリチエニレンビニレン、ポリ(2,5−チエニレンビニ
レン)、ポリアセチレン、ポリアセチレン誘導体、ポリアリレンビニレンなどがある。
In addition, as an organic semiconductor material that can be used in the present invention, there is a material that can form a semiconductor layer by processing after forming a soluble precursor. Examples of such an organic semiconductor material include polythienylene vinylene, poly (2,5-thienylene vinylene), polyacetylene, a polyacetylene derivative, and polyarylene vinylene.

前駆体を有機半導体に変換する際には、加熱処理だけではなく塩化水素ガスなどの反応触
媒を添加することがなされる。また、これらの可溶性有機半導体材料を溶解させる代表的
な溶媒としては、トルエン、キシレン、クロロベンゼン、ジクロロベンゼン、アニソール
、クロロフォルム、ジクロロメタン、γブチルラクトン、ブチルセルソルブ、シクロヘキ
サン、NMP(N−メチル−2−ピロリドン)、シクロヘキサノン、2−ブタノン、ジオ
キサン、ジメチルホルムアミド(DMF)または、THF(テトラヒドロフラン)などを
適用することができる。
When converting the precursor into an organic semiconductor, a reaction catalyst such as hydrogen chloride gas is added as well as heat treatment. Typical solvents for dissolving these soluble organic semiconductor materials include toluene, xylene, chlorobenzene, dichlorobenzene, anisole, chloroform, dichloromethane, γ-butyllactone, butyl cellosolve, cyclohexane, NMP (N-methyl-2) -Pyrrolidone), cyclohexanone, 2-butanone, dioxane, dimethylformamide (DMF), THF (tetrahydrofuran), or the like can be applied.

次に、半導体層185a上に一導電型を有する半導体層186を形成する(図3(B))
。一導電型を有する半導体層186は、ソース領域及びドレイン領域として機能するもの
である。なお、一導電型を有する半導体膜は必要に応じて形成すればよく、n型を付与す
る不純物元素(P、As)を有するn型を有する半導体膜やp型を付与する不純物元素(
B)を有するp型を有する半導体膜を形成することができる。また、一導電型を有する半
導体層186は、調整された組成物の液滴を微細な孔から吐出して所定の形状の層を形成
する液滴吐出法を用いて形成してもよいし、印刷法を用いて形成してもよい。また、CV
D法、PVD法、塗布法等により基板上に形成した後、フォトリソグラフィー工程により
選択的にエッチングして、一導電型を有する半導体層186を形成してもよい。
Next, a semiconductor layer 186 having one conductivity type is formed over the semiconductor layer 185a (FIG. 3B).
. The semiconductor layer 186 having one conductivity type functions as a source region and a drain region. Note that a semiconductor film having one conductivity type may be formed as necessary, and an n-type semiconductor film having an n-type impurity element (P, As) or a p-type impurity element (
A p-type semiconductor film having B) can be formed. Further, the semiconductor layer 186 having one conductivity type may be formed by a droplet discharge method in which a droplet of the adjusted composition is discharged from a fine hole to form a layer having a predetermined shape. You may form using a printing method. Also, CV
The semiconductor layer 186 having one conductivity type may be formed by being selectively etched by a photolithography process after being formed over the substrate by a D method, a PVD method, a coating method, or the like.

次に、一導電型を有する半導体層186上に配線187を形成する(図3(C))。配線
187の形成方法としては、液滴吐出法により導電性ペーストを滴下し焼成して形成する
ことができる。また、印刷法を用いて形成してもよい。また、CVD法、PVD法、塗布
法等により基板上に導電層を形成した後、フォトリソグラフィー工程により当該導電層を
選択的にエッチングして、配線187を形成してもよい。
Next, a wiring 187 is formed over the semiconductor layer 186 having one conductivity type (FIG. 3C). As a method for forming the wiring 187, a conductive paste can be dropped and baked by a droplet discharge method. Moreover, you may form using a printing method. Alternatively, after forming a conductive layer over the substrate by a CVD method, a PVD method, a coating method, or the like, the wiring 187 may be formed by selectively etching the conductive layer through a photolithography process.

配線187は、ソース電極層又はドレイン電極層として機能し、一導電型を有する半導体
層186と電気的に接続している。配線187を形成する導電性材料としては、Ag(銀
)、Au(金)、Cu(銅)、W(タングステン)、Al(アルミニウム)等の金属の粒
子を主成分とした組成物を用いることができる。また、透光性を有するインジウム錫酸化
物(ITO)、酸化珪素を含むインジウム錫酸化物(ITSO)、有機インジウム、有機
スズ、酸化亜鉛、窒化チタンなどを組み合わせても良い。
The wiring 187 functions as a source electrode layer or a drain electrode layer and is electrically connected to the semiconductor layer 186 having one conductivity type. As a conductive material for forming the wiring 187, a composition mainly composed of metal particles such as Ag (silver), Au (gold), Cu (copper), W (tungsten), Al (aluminum) is used. Can do. Alternatively, light-transmitting indium tin oxide (ITO), indium tin oxide containing silicon oxide (ITSO), organic indium, organic tin, zinc oxide, titanium nitride, or the like may be combined.

また、液滴吐出法を用いて形成することで、スピンコート法などによる全面塗布形成に比
べ、材料のロスが防げ、コストダウンが可能になる。
In addition, by using the droplet discharge method, material loss can be prevented and costs can be reduced as compared with the entire surface coating formation by a spin coating method or the like.

次に、配線187上に絶縁層183を形成する(図3(D))。絶縁層183の材料とし
ては、レーザ光を透過する材料で形成された光透過層であれば特に限定されない。例えば
、無機材料(酸化珪素、窒化珪素、酸化窒化珪素、窒化酸化珪素など)、感光性または非
感光性の有機材料(有機樹脂材料)(ポリイミド、アクリル、ポリアミド、ポリイミドア
ミド、レジスト、ベンゾシクロブテンなど)、低誘電率材料などの一種、もしくは複数種
からなる膜、またはこれらの膜の積層などを用いることができる。また、シロキサン材料
を用いてもよい。また、絶縁層183表面に撥液処理を行っていてもよい。
Next, an insulating layer 183 is formed over the wiring 187 (FIG. 3D). The material of the insulating layer 183 is not particularly limited as long as it is a light transmitting layer formed of a material that transmits laser light. For example, inorganic materials (silicon oxide, silicon nitride, silicon oxynitride, silicon nitride oxide, etc.), photosensitive or non-photosensitive organic materials (organic resin materials) (polyimide, acrylic, polyamide, polyimide amide, resist, benzocyclobutene Etc.), one kind of a low dielectric constant material, etc., or a film comprising a plurality of kinds, or a laminate of these films can be used. A siloxane material may also be used. Further, the surface of the insulating layer 183 may be subjected to a liquid repellent treatment.

次に、絶縁層183に開口部184を形成する(図3(E))。本実施の形態では、実施
の形態1で示したように所望の位置にフェムト秒レーザを照射することにより配線187
及び絶縁層183の所望の位置に開口部184を形成することができる。
Next, an opening 184 is formed in the insulating layer 183 (FIG. 3E). In this embodiment mode, as shown in Embodiment Mode 1, the wiring 187 is irradiated with a femtosecond laser at a desired position.
The opening 184 can be formed at a desired position of the insulating layer 183.

次に、開口部184に、導電性材料を含む組成物を吐出して電極層181を形成する(図
3(E)、(F))。組成物を選択的に吐出して電極層を形成すると加工の工程が簡略化
する効果がある。
Next, a composition containing a conductive material is discharged into the opening 184 to form the electrode layer 181 (FIGS. 3E and 3F). Forming the electrode layer by selectively discharging the composition has an effect of simplifying the processing step.

なお、電極層181は、その表面が平坦化されるように、CMP法、ポリビニルアルコー
ル系の多孔質体で拭浄し、研磨しても良い。またCMP法を用いた研磨後に、電極層18
1の表面に紫外線照射、酸素プラズマ処理などを行ってもよい。
Note that the electrode layer 181 may be wiped with a CMP method or a polyvinyl alcohol-based porous body and polished so that the surface thereof is planarized. In addition, after polishing using the CMP method, the electrode layer 18
The surface of 1 may be subjected to ultraviolet irradiation, oxygen plasma treatment, or the like.

以上の工程により、基板100上に形成されたボトムゲート型のTFT188と電極層1
81とが接続された半導体素子が完成する。
Through the above steps, the bottom gate TFT 188 formed on the substrate 100 and the electrode layer 1 are formed.
A semiconductor device connected to the semiconductor device 81 is completed.

本実施の形態では、フェムト秒レーザを用いて、絶縁層183に開口部184を形成して
、液滴吐出法により該開口部184に電極層181を形成する。本実施の形態では、フェ
ムト秒レーザを用いて開口部を形成しているため、従来であれば複雑なフォトリソグラフ
ィ工程を行う必要がある導電層と絶縁層への開口部の形成において、フォトリソグラフィ
工程を用いることなく単一な工程で開口部を形成することができる。かつ、液滴吐出法を
用いて開口部を覆う電極層を形成しているため、該電極層181は該開口部の形状に左右
されず絶縁層下の配線187と良好な電気的コンタクトをとることができる。例えば、開
口部184において、絶縁層183の端部が配線187の端部より内側に形成されている
(開口部が逆テーパ形状)場合や開口部が狭い場合でも、電極層181は開口部に液状の
導電性材料を吐出して形成されるため、配線187と良好な電気的コンタクトをとること
ができる。
In this embodiment, an opening 184 is formed in the insulating layer 183 using a femtosecond laser, and the electrode layer 181 is formed in the opening 184 by a droplet discharge method. In this embodiment mode, since the opening is formed using a femtosecond laser, photolithography is conventionally used to form the opening in the conductive layer and the insulating layer, which require a complicated photolithography process. The opening can be formed in a single process without using a process. In addition, since the electrode layer covering the opening is formed using a droplet discharge method, the electrode layer 181 is in good electrical contact with the wiring 187 under the insulating layer regardless of the shape of the opening. be able to. For example, in the opening 184, the electrode layer 181 is formed in the opening even when the end of the insulating layer 183 is formed inside the end of the wiring 187 (the opening is reversely tapered) or the opening is narrow. Since it is formed by discharging a liquid conductive material, good electrical contact with the wiring 187 can be obtained.

また、本実施の形態において、絶縁層183にフェムト秒レーザを照射する前に絶縁層1
83表面に撥液処理を行っていてもよい。絶縁層183表面に撥液処理を行うことにより
、開口部184に電極層181を形成する際に、液状の導電性材料(液滴)が、開口部1
84に入らず絶縁層183表面に堆積するのを防ぐことができ、より精度良く導電性材料
を開口部184に流入させることができる。
In this embodiment mode, before the insulating layer 183 is irradiated with the femtosecond laser, the insulating layer 1
83 may be subjected to a liquid repellent treatment. When the electrode layer 181 is formed in the opening 184 by performing a liquid repellent treatment on the surface of the insulating layer 183, the liquid conductive material (droplet) is formed in the opening 1.
84, it can be prevented from being deposited on the surface of the insulating layer 183 without entering 84, and the conductive material can flow into the opening 184 with higher accuracy.

本実施の形態に示す半導体装置の作製方法を用いることにより、複雑なフォトリソグラフ
ィ工程を用いることなく配線間の開口(コンタクトホール)を形成することができ、かつ
配線の電気的コンタクトを良好にとることができる。よって、材料のロスが少なく、高性
能、高信頼性の半導体装置を歩留まりよく作製することができる。
By using the method for manufacturing a semiconductor device described in this embodiment, an opening (contact hole) between wirings can be formed without using a complicated photolithography step, and electrical contact between the wirings can be satisfactorily achieved. be able to. Therefore, a high-performance and highly reliable semiconductor device with little material loss can be manufactured with high yield.

(実施の形態3)
本実施の形態では、薄膜トランジスタに接続される導電層を有する半導体装置の作製方法
について、図4を用いて説明する。ここでは、半導体装置として液晶表示パネルを形成す
る。また、図4においては、液晶表示パネルの一画素の断面図を示して、以下説明する。
(Embodiment 3)
In this embodiment, a method for manufacturing a semiconductor device having a conductive layer connected to a thin film transistor will be described with reference to FIGS. Here, a liquid crystal display panel is formed as the semiconductor device. FIG. 4 is a cross-sectional view of one pixel of the liquid crystal display panel, which will be described below.

図4(A)に示すように、基板100上に実施の形態2で示す薄膜トランジスタ188、
及び薄膜トランジスタ188覆う絶縁層190を形成する。ここでは塗布法により組成物
を塗布し焼成してポリイミドで形成される絶縁層190を形成する。
As shown in FIG. 4A, a thin film transistor 188 described in Embodiment 2 is formed over a substrate 100,
Then, an insulating layer 190 covering the thin film transistor 188 is formed. Here, the composition is applied by a coating method and baked to form the insulating layer 190 formed of polyimide.

次に、絶縁層190の一部を実施の形態1で示す手法によりフェムト秒レーザを用いて開
口部を設け、開口部を有する絶縁層190を形成する。この後、配線187の表面に形成
される酸化物を除去してもよい。
Next, an opening is provided in part of the insulating layer 190 using a femtosecond laser by the method described in Embodiment 1, so that the insulating layer 190 having the opening is formed. Thereafter, oxide formed on the surface of the wiring 187 may be removed.

次に、図4(B)に示すように、開口部及び絶縁層190の表面に配線187に接続する
導電層192を形成する。なお、導電層192は画素電極として機能し、液滴吐出法を用
いて選択的に形成する。透光性を有する導電層192を形成することで後に透過型発光表
示パネルを作製することができる。また、導電層192として、Ag(銀)、Au(金)
、Cu(銅))、W(タングステン)、Al(アルミニウム)等の反射性を有する導電層
を形成することで、後に反射型発光表示パネルを作製することができる。さらには、上記
透光性を有する導電層及び反射性を有する導電層を一画素ごとに形成することで、半透過
型表示パネルを作製することができる。
Next, as illustrated in FIG. 4B, a conductive layer 192 connected to the wiring 187 is formed over the opening and the surface of the insulating layer 190. Note that the conductive layer 192 functions as a pixel electrode and is selectively formed by a droplet discharge method. By forming the light-transmitting conductive layer 192, a transmissive light-emitting display panel can be manufactured later. Further, as the conductive layer 192, Ag (silver), Au (gold)
, Cu (copper)), W (tungsten), Al (aluminum), and the like, a reflective light-emitting display panel can be manufactured later by forming a conductive layer having reflectivity. Furthermore, a transflective display panel can be manufactured by forming the light-transmitting conductive layer and the reflective conductive layer for each pixel.

なお、図4(B)に示すように、配線187の表面において配線187及び導電層192
が接するように開口部を形成することができる。
Note that as illustrated in FIG. 4B, the wiring 187 and the conductive layer 192 are formed on the surface of the wiring 187.
An opening can be formed so as to be in contact with each other.

また、図4(C)に示すように、一導電型を有する半導体層186の表面で一導電型を有
する半導体層186及び導電層192が接するように開口部を形成することができる。
4C, an opening can be formed so that the semiconductor layer 186 having one conductivity type and the conductive layer 192 are in contact with the surface of the semiconductor layer 186 having one conductivity type.

以上の工程により、アクティブマトリクス基板を形成することができる。 Through the above steps, an active matrix substrate can be formed.

次に、印刷法やスピンコート法により、絶縁膜を成膜し、ラビングを行って配向膜193
を形成する(図4(D))。なお、配向膜193は、斜方蒸着法により形成することもで
きる。
Next, an insulating film is formed by printing or spin coating, and rubbing is performed to align the alignment film 193.
Is formed (FIG. 4D). Note that the alignment film 193 can also be formed by oblique deposition.

次に、配向膜264、第2の画素電極(対向電極)263、及び着色層262が設けられ
た対向基板261において、画素部の周辺の領域に液滴吐出法により閉ループ状のシール
材(図示しない。)を形成する。シール材には、フィラーが混入されていてもよく、さら
に、対向基板261にはカラーフィルタや遮蔽膜(ブラックマトリクス)などが形成され
ていても良い。
Next, in the counter substrate 261 provided with the alignment film 264, the second pixel electrode (counter electrode) 263, and the coloring layer 262, a closed loop sealing material (illustration is made) by a droplet discharge method in a region around the pixel portion. Not). A filler may be mixed in the sealing material, and a color filter, a shielding film (black matrix), or the like may be formed on the counter substrate 261.

次に、ディスペンサ式(滴下式)により、シール材で形成された閉ループ内側に、液晶材
料を滴下したのち、真空中で、対向基板とアクティブマトリクス基板とを貼り合わせ、紫
外線硬化を行って、液晶材料が充填された液晶層265を形成する。なお、液晶層265
を形成する方法として、ディスペンサ式(滴下式)の代わりに、対向基板を貼り合わせて
から毛細管現象を用いて液晶材料を注入するディップ式(汲み上げ式)を用いることがで
きる。
Next, after the liquid crystal material is dropped inside the closed loop formed of the sealing material by a dispenser type (dropping type), the counter substrate and the active matrix substrate are bonded together in a vacuum, and ultraviolet curing is performed, thereby liquid crystal A liquid crystal layer 265 filled with the material is formed. The liquid crystal layer 265
As a method for forming the film, a dip type (pumping type) in which a liquid crystal material is injected by using a capillary phenomenon after the counter substrate is bonded can be used instead of the dispenser type (dropping type).

この後、走査線、信号線の接続端子部に、接続導電層を介して配線基板、代表的にはFP
C(Flexible Print Circuitを貼り付ける。以上の工程により、
液晶表示パネルを形成することができる。
After that, the wiring board, typically FP, is connected to the connection terminal portion of the scanning line and the signal line through the connection conductive layer.
C (Flexible Print Circuit is pasted. By the above process,
A liquid crystal display panel can be formed.

なお、本実施の形態ではTN型の液晶パネルについて示しているが、上記のプロセスは他
の方式の液晶パネルに対しても同様に適用することができる。例えば、ガラス基板と平行
に電界を印加して液晶を配向させる横電界方式の液晶パネルに本実施の形態を適用するこ
とができる。また、VA(Vertical Alignment)方式の液晶パネルに
本実施の形態を適用することができる。
Note that although a TN liquid crystal panel is described in this embodiment mode, the above process can be similarly applied to other types of liquid crystal panels. For example, the present embodiment can be applied to a horizontal electric field type liquid crystal panel in which an electric field is applied in parallel with a glass substrate to align liquid crystals. Further, the present embodiment can be applied to a VA (Vertical Alignment) liquid crystal panel.

図5と図6は、VA型液晶パネルの画素構造を示している。図5は平面図であり、図中に
示す切断線I−Jに対応する断面構造を図6に表している。以下の説明ではこの両図を参
照して説明する。
5 and 6 show the pixel structure of the VA liquid crystal panel. FIG. 5 is a plan view, and FIG. 6 shows a cross-sectional structure corresponding to the cutting line I-J shown in the drawing. The following description will be given with reference to both the drawings.

この画素構造は、一つの画素に複数の画素電極が有り、それぞれの画素電極にTFTが接
続されている。各TFTは、異なるゲート信号で駆動されるように構成されている。すな
わち、マルチドメイン設計された画素において、個々の画素電極に印加する信号を、独立
して制御する構成を有している。
In this pixel structure, a single pixel has a plurality of pixel electrodes, and a TFT is connected to each pixel electrode. Each TFT is configured to be driven by a different gate signal. In other words, a multi-domain designed pixel has a configuration in which signals applied to individual pixel electrodes are controlled independently.

画素電極層1624は開口(コンタクトホール)1623により、配線層1618でTF
T1628と接続している。また、画素電極層1626は開口(コンタクトホール)16
27により、配線層1619でTFT1629と接続している。TFT1628のゲート
配線層1602と、TFT1629のゲート電極層1603には、異なるゲート信号を与
えることができるように分離されている。一方、データ線として機能する配線層1616
は、TFT1628とTFT1629で共通に用いられている。
The pixel electrode layer 1624 has an opening (contact hole) 1623 and a wiring layer 1618 TF.
It is connected to T1628. The pixel electrode layer 1626 has an opening (contact hole) 16.
27, the wiring layer 1619 is connected to the TFT 1629. The gate wiring layer 1602 of the TFT 1628 and the gate electrode layer 1603 of the TFT 1629 are separated so that different gate signals can be given. On the other hand, the wiring layer 1616 functioning as a data line.
Are commonly used by the TFT 1628 and the TFT 1629.

画素電極層1624と画素電極層1626は、2工程による液滴吐出工程を用いて、実施
の形態1と同様に作製する。具体的には、第1の液滴吐出工程により画素電極層のパター
ンの輪郭に沿って第1の導電性材料を吐出し、枠状の第1の導電層を形成する。枠状の第
1の導電層内部を充填するように第2の導電性材料を含む組成物を吐出し、第2の導電層
を形成する。第1の導電層及び第2の導電層は連続的な画素電極層として用いることがで
き、画素電極層1624、1626を形成することができる。このように本発明を用いる
と、工程が簡略化し、材料のロスが防げるので、低コストで生産性良く表示装置を作製す
ることができる。
The pixel electrode layer 1624 and the pixel electrode layer 1626 are manufactured in a manner similar to that in Embodiment 1 by using a droplet discharge step by two steps. Specifically, the first conductive material is discharged along the contour of the pattern of the pixel electrode layer in the first droplet discharge step, thereby forming a frame-shaped first conductive layer. A composition containing the second conductive material is discharged so as to fill the inside of the frame-shaped first conductive layer, thereby forming the second conductive layer. The first conductive layer and the second conductive layer can be used as continuous pixel electrode layers, and the pixel electrode layers 1624 and 1626 can be formed. In this manner, when the present invention is used, the process can be simplified and material loss can be prevented; thus, a display device can be manufactured at low cost with high productivity.

画素電極層1624と画素電極層1626の形状は異なっており、スリット1625によ
って分離されている。V字型に広がる画素電極層1624の外側を囲むように画素電極層
1626が形成されている。画素電極層1624と画素電極層1626に印加する電圧の
タイミングを、TFT1628及びTFT1629により異ならせることで、液晶の配向
を制御している。対向基板1601には、遮光膜1632、着色層1636、対向電極層
1640が形成されている。また、着色層1636と対向電極層1640の間には平坦化
膜1637が形成され、液晶の配向乱れを防いでいる。図7に対向基板側の構造を示す。
対向電極層1640は異なる画素間で共通化されている電極であるが、スリット1641
が形成されている。このスリット1641と、画素電極層1624及び画素電極層162
6側のスリット1625とを交互に咬み合うように配置することで、斜め電界が効果的に
発生させて液晶の配向を制御することができる。これにより、液晶が配向する方向を場所
によって異ならせることができ、視野角を広げている。
The pixel electrode layer 1624 and the pixel electrode layer 1626 have different shapes and are separated by a slit 1625. A pixel electrode layer 1626 is formed so as to surround the outside of the V-shaped pixel electrode layer 1624. The timing of the voltage applied to the pixel electrode layer 1624 and the pixel electrode layer 1626 is varied depending on the TFT 1628 and the TFT 1629, thereby controlling the alignment of the liquid crystal. A counter substrate 1601 is provided with a light-blocking film 1632, a coloring layer 1636, and a counter electrode layer 1640. In addition, a planarization film 1637 is formed between the coloring layer 1636 and the counter electrode layer 1640 to prevent alignment disorder of the liquid crystal. FIG. 7 shows a structure on the counter substrate side.
The counter electrode layer 1640 is an electrode shared by different pixels, but the slit 1641
Is formed. The slit 1641, the pixel electrode layer 1624, and the pixel electrode layer 162
By disposing the six-side slits 1625 so as to alternately engage with each other, an oblique electric field can be effectively generated to control the alignment of the liquid crystal. Thereby, the direction in which the liquid crystal is aligned can be varied depending on the location, and the viewing angle is widened.

このように、画素電極層として有機化合物と無機化合物を複合化させた複合材料を用いて
液晶パネルを製造することができる。このような画素電極を用いることにより、インジウ
ムを主成分とする透明導電膜を使う必要がなく、原材料面でのボトルネックを解消するこ
とができる。
Thus, a liquid crystal panel can be manufactured using a composite material in which an organic compound and an inorganic compound are combined as the pixel electrode layer. By using such a pixel electrode, it is not necessary to use a transparent conductive film containing indium as a main component, and a bottleneck in terms of raw materials can be eliminated.

本実施例は、上記の実施の形態と適宜自由に組み合わせることができる。 This embodiment can be freely combined with the above embodiment modes as appropriate.

なお、静電破壊防止のための保護回路、代表的にはダイオードなどを、接続端子とソース
配線(ゲート配線)の間または画素部に設けてもよい。この場合、上記したTFTと同様
の工程で作製し、画素部のゲート配線層とダイオードのドレイン又はソース配線層とを接
続することにより、静電破壊を防止することができる。
Note that a protection circuit for preventing electrostatic breakdown, typically a diode or the like, may be provided between the connection terminal and the source wiring (gate wiring) or in the pixel portion. In this case, it is possible to prevent electrostatic breakdown by manufacturing in the same process as the above TFT and connecting the gate wiring layer of the pixel portion and the drain or source wiring layer of the diode.

本実施の形態に示す液晶表示パネルの作製方法を用いることにより、複雑なフォトリソグ
ラフィ工程を用いることなく配線間の開口(コンタクトホール)を形成することができ、
かつ配線の電気的コンタクトを良好にとることができる。よって、材料のロスが少なく、
高性能、高信頼性の液晶表示パネルを歩留まりよく作製することができる。
By using the manufacturing method of the liquid crystal display panel described in this embodiment, an opening (contact hole) between wirings can be formed without using a complicated photolithography process,
In addition, the electrical contact of the wiring can be satisfactorily taken. Therefore, there is little loss of material,
A high-performance and highly reliable liquid crystal display panel can be manufactured with high yield.

(実施の形態4)
本実施例では、薄膜トランジスタに接続される導電層を有する半導体装置の作製方法につ
いて説明する。ここでは、導電層として画素電極を形成し、半導体装置として発光表示パ
ネルを形成する。さらに、図8においては、発光表示パネルの一画素を示して、以下説明
する。
(Embodiment 4)
In this embodiment, a method for manufacturing a semiconductor device having a conductive layer connected to a thin film transistor will be described. Here, a pixel electrode is formed as a conductive layer, and a light-emitting display panel is formed as a semiconductor device. Further, FIG. 8 shows one pixel of the light emitting display panel, which will be described below.

まず、図8(A)に示すように、基板100上に実施の形態2で示した薄膜トランジスタ
188、及び薄膜トランジスタ188を覆い、且つフェムト秒レーザを用いて開口した開
口部を有する絶縁層191を形成する。
First, as illustrated in FIG. 8A, the thin film transistor 188 described in Embodiment 2 and the insulating layer 191 having an opening which is opened using a femtosecond laser are formed over the substrate 100. To do.

次に、図8(B)に示すように、実施の形態1又は実施の形態2と同様に配線187に接
続する導電層201を形成する。なお、導電層201は画素電極として機能する。
Next, as illustrated in FIG. 8B, a conductive layer 201 connected to the wiring 187 is formed in a manner similar to that of Embodiment 1 or 2. Note that the conductive layer 201 functions as a pixel electrode.

次に、図8(C)に示すように、画素電極として機能する導電層201の端部を覆う絶縁
層202を形成する。このような絶縁層としては、絶縁層191及び導電層201上に図
示しない絶縁層を形成し、当該絶縁層にフェムト秒レーザを照射して導電層201上の絶
縁層を除去することで形成することができる。
Next, as illustrated in FIG. 8C, an insulating layer 202 which covers an end portion of the conductive layer 201 functioning as a pixel electrode is formed. Such an insulating layer is formed by forming an insulating layer (not shown) over the insulating layer 191 and the conductive layer 201 and irradiating the insulating layer with a femtosecond laser to remove the insulating layer over the conductive layer 201. be able to.

次に、導電層201の露出部及び絶縁層202の一部に発光物質を有する層203を形成
し、その上に画素電極として機能する導電層204を形成する。以上の工程により導電層
201、発光物質を有する層203、及び導電層204で構成される発光素子205を形
成することができる。
Next, a layer 203 having a light-emitting substance is formed over the exposed portion of the conductive layer 201 and part of the insulating layer 202, and a conductive layer 204 functioning as a pixel electrode is formed thereover. Through the above steps, the light-emitting element 205 including the conductive layer 201, the layer 203 having a light-emitting substance, and the conductive layer 204 can be formed.

ここで、発光素子205の構造について説明する。 Here, the structure of the light-emitting element 205 will be described.

発光物質を含む層203に、有機化合物を用いた発光機能を担う層(以下、発光層343
と示す。)を形成することで、発光素子205は有機EL素子として機能する。
A layer having a light emitting function using an organic compound (hereinafter referred to as a light emitting layer 343) is used for the layer 203 containing a light emitting substance.
It shows. The light emitting element 205 functions as an organic EL element.

発光性の有機化合物としては、例えば、9,10−ジ(2−ナフチル)アントラセン(略
称:DNA)、2−tert−ブチル−9,10−ジ(2−ナフチル)アントラセン(略
称:t−BuDNA)、4,4’−ビス(2,2−ジフェニルビニル)ビフェニル(略称
:DPVBi)、クマリン30、クマリン6、クマリン545、クマリン545T、ペリ
レン、ルブレン、ペリフランテン、2,5,8,11−テトラ(tert−ブチル)ペリ
レン(略称:TBP)、9,10−ジフェニルアントラセン(略称:DPA)、5,12
−ジフェニルテトラセン、4−(ジシアノメチレン)−2−メチル−6−[p−(ジメチ
ルアミノ)スチリル]−4H−ピラン(略称:DCM1)、4−(ジシアノメチレン)−
2−メチル−6−[2−(ジュロリジン−9−イル)エテニル]−4H−ピラン(略称:
DCM2)、4−(ジシアノメチレン)−2,6−ビス[p−(ジメチルアミノ)スチリ
ル]−4H−ピラン(略称:BisDCM)等が挙げられる。また、ビス[2−(4’,
6’−ジフルオロフェニル)ピリジナト−N,C](ピコリナト)イリジウム(略称:
FIrpic)、ビス{2−[3’,5’−ビス(トリフルオロメチル)フェニル]ピリ
ジナト−N,C}(ピコリナト)イリジウム(略称:Ir(CFppy)(pic
))、トリス(2−フェニルピリジナト−N,C)イリジウム(略称:Ir(ppy)
)、(アセチルアセトナト)ビス(2−フェニルピリジナト−N,C)イリジウム(
略称:Ir(ppy)(acac))、(アセチルアセトナト)ビス[2−(2’−チ
エニル)ピリジナト−N,C]イリジウム(略称:Ir(thp)(acac))、
(アセチルアセトナト)ビス(2−フェニルキノリナト−N,C)イリジウム(略称:
Ir(pq)(acac))、(アセチルアセトナト)ビス[2−(2’−ベンゾチエ
ニル)ピリジナト−N,C]イリジウム(略称:Ir(btp)(acac))など
の燐光を放出できる化合物用いることもできる。
Examples of the light-emitting organic compound include 9,10-di (2-naphthyl) anthracene (abbreviation: DNA) and 2-tert-butyl-9,10-di (2-naphthyl) anthracene (abbreviation: t-BuDNA). ), 4,4′-bis (2,2-diphenylvinyl) biphenyl (abbreviation: DPVBi), coumarin 30, coumarin 6, coumarin 545, coumarin 545T, perylene, rubrene, periflanthene, 2,5,8,11-tetra (Tert-butyl) perylene (abbreviation: TBP), 9,10-diphenylanthracene (abbreviation: DPA), 5,12
-Diphenyltetracene, 4- (dicyanomethylene) -2-methyl-6- [p- (dimethylamino) styryl] -4H-pyran (abbreviation: DCM1), 4- (dicyanomethylene)-
2-Methyl-6- [2- (julolidin-9-yl) ethenyl] -4H-pyran (abbreviation:
DCM2), 4- (dicyanomethylene) -2,6-bis [p- (dimethylamino) styryl] -4H-pyran (abbreviation: BisDCM) and the like. Also, screw [2- (4 ′,
6′-difluorophenyl) pyridinato-N, C 2 ] (picolinato) iridium (abbreviation:
FIrpic), bis {2- [3 ′, 5′-bis (trifluoromethyl) phenyl] pyridinato-N, C 2 } (picolinato) iridium (abbreviation: Ir (CF 3 ppy) 2 (pic
)), Tris (2-phenylpyridinato-N, C 2 ) iridium (abbreviation: Ir (ppy))
3 ), (acetylacetonato) bis (2-phenylpyridinato-N, C 2 ) iridium (
Abbreviations: Ir (ppy) 2 (acac)), (acetylacetonato) bis [2- (2′-thienyl) pyridinato-N, C 3 ] iridium (abbreviation: Ir (thp) 2 (acac)),
(Acetylacetonato) bis (2-phenylquinolinato-N, C 2 ) iridium (abbreviation:
Ir (pq) 2 (acac)), (acetylacetonato) bis [2- (2′-benzothienyl) pyridinato-N, C 3 ] iridium (abbreviation: Ir (btp) 2 (acac)), etc. Compounds that can be released can also be used.

また、図9(A)に示すように、第1の導電層201上に正孔注入材料で形成される正孔
注入層341、正孔輸送性材料で形成される正孔輸送層342、発光性の有機化合物で形
成される発光層343、電子輸送性材料で形成される電子輸送層344、電子注入性材料
で形成される電子注入層345により形成された発光材料を含む層318、及び第2の導
電層204で発光素子205を形成してもよい。
As shown in FIG. 9A, a hole injection layer 341 formed of a hole injection material, a hole transport layer 342 formed of a hole transport material, and light emission on the first conductive layer 201. A light-emitting layer 343 formed of an organic compound, an electron transport layer 344 formed of an electron-transport material, a layer 318 containing a light-emitting material formed of an electron injection layer 345 formed of an electron-inject material, and The light-emitting element 205 may be formed using two conductive layers 204.

正孔輸送性材料は、フタロシアニン(略称:HPc)、銅フタロシアニン(略称:Cu
Pc)、バナジルフタロシアニン(略称:VOPc)の他、4,4’,4’’−トリス(
N,N−ジフェニルアミノ)トリフェニルアミン(略称:TDATA)、4,4’,4’
’−トリス[N−(3−メチルフェニル)−N−フェニルアミノ]トリフェニルアミン(
略称:MTDATA)、1,3,5−トリス[N,N−ジ(m−トリル)アミノ]ベンゼ
ン(略称:m−MTDAB)、N,N’−ジフェニル−N,N’−ビス(3−メチルフェ
ニル)−1,1’−ビフェニル−4,4’−ジアミン(略称:TPD)、4,4’−ビス
[N−(1−ナフチル)−N−フェニルアミノ]ビフェニル(略称:NPB)、4,4’
−ビス{N−[4−ジ(m−トリル)アミノ]フェニル−N−フェニルアミノ}ビフェニ
ル(略称:DNTPD)、4,4’−ビス[N−(4−ビフェニリル)−N−フェニルア
ミノ]ビフェニル(略称:BBPB)、4,4’,4’’−トリ(N−カルバゾリル)ト
リフェニルアミン(略称:TCTA)などが挙げられるが、これらに限定されることはな
い。また、上述した化合物の中でも、TDATA、MTDATA、m−MTDAB、TP
D、NPB、DNTPD、BBPB、TCTA、NPBなどに代表される芳香族アミン化
合物は、正孔を発生しやすく、有機化合物として好適な化合物群である。ここに述べた物
質は、主に10−6cm/Vs以上の正孔移動度を有する物質である。
The hole transporting material includes phthalocyanine (abbreviation: H 2 Pc), copper phthalocyanine (abbreviation: Cu
Pc), vanadyl phthalocyanine (abbreviation: VOPc), 4,4 ′, 4 ″ -tris (
N, N-diphenylamino) triphenylamine (abbreviation: TDATA), 4,4 ′, 4 ′
'-Tris [N- (3-methylphenyl) -N-phenylamino] triphenylamine (
Abbreviation: MTDATA), 1,3,5-tris [N, N-di (m-tolyl) amino] benzene (abbreviation: m-MTDAB), N, N′-diphenyl-N, N′-bis (3- Methylphenyl) -1,1′-biphenyl-4,4′-diamine (abbreviation: TPD), 4,4′-bis [N- (1-naphthyl) -N-phenylamino] biphenyl (abbreviation: NPB), 4,4 '
-Bis {N- [4-di (m-tolyl) amino] phenyl-N-phenylamino} biphenyl (abbreviation: DNTPD), 4,4′-bis [N- (4-biphenylyl) -N-phenylamino] Biphenyl (abbreviation: BBPB), 4,4 ′, 4 ″ -tri (N-carbazolyl) triphenylamine (abbreviation: TCTA), and the like are exemplified, but the invention is not limited thereto. Among the compounds described above, TDATA, MTDATA, m-MTDAB, TP
Aromatic amine compounds typified by D, NPB, DNTPD, BBPB, TCTA, NPB, and the like are easy to generate holes and are a group of compounds suitable as organic compounds. The substances described here are mainly substances having a hole mobility of 10 −6 cm 2 / Vs or higher.

正孔注入性材料は、上記正孔輸送性材料の他、導電性高分子化合物に化学ドーピングを施
した材料もあり、ポリスチレンスルホン酸(略称:PSS)をドープしたポリエチレンジ
オキシチオフェン(略称:PEDOT)やポリアニリン(略称:PAni)などを用いる
こともできる。また、酸化モリブデン(MoO)、酸化バナジウム(VO)、酸化ニ
ッケル(NiO)などの無機半導体の薄膜や、酸化アルミニウム(Al)などの
無機絶縁体の超薄膜も有効である。
As the hole injecting material, there is a material obtained by chemically doping a conductive polymer compound in addition to the above hole transporting material. Polyethylenedioxythiophene (abbreviation: PEDOT) doped with polystyrene sulfonic acid (abbreviation: PSS). ) And polyaniline (abbreviation: PAni) can also be used. Also effective are inorganic semiconductor thin films such as molybdenum oxide (MoO x ), vanadium oxide (VO x ), nickel oxide (NiO x ), and ultra-thin films of inorganic insulators such as aluminum oxide (Al 2 O 3 ). .

ここで、電子輸送性材料は、トリス(8−キノリノラト)アルミニウム(略称:Alq
)、トリス(4−メチル−8−キノリノラト)アルミニウム(略称:Almq)、ビス
(10−ヒドロキシベンゾ[h]−キノリナト)ベリリウム(略称:BeBq)、ビス
(2−メチル−8−キノリノラト)−4−フェニルフェノラト−アルミニウム(略称:B
Alq)等キノリン骨格またはベンゾキノリン骨格を有する金属錯体等からなる材料を用
いることができる。また、この他、ビス[2−(2−ヒドロキシフェニル)ベンゾオキサ
ゾラト]亜鉛(略称:Zn(BOX))、ビス[2−(2−ヒドロキシフェニル)ベン
ゾチアゾラト]亜鉛(略称:Zn(BTZ))などのオキサゾール系、チアゾール系配
位子を有する金属錯体などの材料も用いることができる。さらに、金属錯体以外にも、2
−(4−ビフェニリル)−5−(4−tert−ブチルフェニル)−1,3,4−オキサ
ジアゾール(略称:PBD)、1,3−ビス[5−(p−tert−ブチルフェニル)−
1,3,4−オキサジアゾール−2−イル]ベンゼン(略称:OXD−7)、3−(4−
tert−ブチルフェニル)−4−フェニル−5−(4−ビフェニリル)−1,2,4−
トリアゾール(略称:TAZ)、3−(4−tert−ブチルフェニル)−4−(4−エ
チルフェニル)−5−(4−ビフェニリル)−1,2,4−トリアゾール(略称:p−E
tTAZ)、バソフェナントロリン(略称:BPhen)、バソキュプロイン(略称:B
CP)等を用いることができる。ここに述べた物質は、主に10−6cm/Vs以上の
電子移動度を有する物質である。
Here, the electron transporting material is tris (8-quinolinolato) aluminum (abbreviation: Alq 3).
), Tris (4-methyl-8-quinolinolato) aluminum (abbreviation: Almq 3 ), bis (10-hydroxybenzo [h] -quinolinato) beryllium (abbreviation: BeBq 2 ), bis (2-methyl-8-quinolinolato) -4-phenylphenolato-aluminum (abbreviation: B
A material made of a metal complex having a quinoline skeleton or a benzoquinoline skeleton such as Alq) can be used. In addition, bis [2- (2-hydroxyphenyl) benzoxazolate] zinc (abbreviation: Zn (BOX) 2 ), bis [2- (2-hydroxyphenyl) benzothiazolate] zinc (abbreviation: Zn (BTZ) A material such as a metal complex having an oxazole-based or thiazole-based ligand such as 2 ) can also be used. In addition to metal complexes, 2
-(4-biphenylyl) -5- (4-tert-butylphenyl) -1,3,4-oxadiazole (abbreviation: PBD), 1,3-bis [5- (p-tert-butylphenyl)-
1,3,4-oxadiazol-2-yl] benzene (abbreviation: OXD-7), 3- (4-
tert-butylphenyl) -4-phenyl-5- (4-biphenylyl) -1,2,4-
Triazole (abbreviation: TAZ), 3- (4-tert-butylphenyl) -4- (4-ethylphenyl) -5- (4-biphenylyl) -1,2,4-triazole (abbreviation: p-E)
tTAZ), bathophenanthroline (abbreviation: BPhen), bathocuproin (abbreviation: B)
CP) or the like can be used. The substances mentioned here are mainly substances having an electron mobility of 10 −6 cm 2 / Vs or higher.

電子注入材料としては、上述した電子輸送性材料の他に、LiF、CsFなどのアルカリ
金属ハロゲン化物や、CaFのようなアルカリ土類ハロゲン化物、LiOなどのアル
カリ金属酸化物のような絶縁体の超薄膜がよく用いられる。また、リチウムアセチルアセ
トネート(略称:Li(acac)や8−キノリノラト−リチウム(略称:Liq)など
のアルカリ金属錯体も有効である。さらに、上述した電子輸送性材料と、Mg、Li、C
s等の仕事関数の小さい金属とを共蒸着等により混合した材料を使用することもできる。
Examples of the electron injection material include alkali metal halides such as LiF and CsF, alkaline earth halides such as CaF 2 , and alkali metal oxides such as Li 2 O in addition to the electron transport materials described above. Insulator ultrathin films are often used. In addition, alkali metal complexes such as lithium acetylacetonate (abbreviation: Li (acac) and 8-quinolinolato-lithium (abbreviation: Liq) are also effective. Further, the above-described electron transporting materials, Mg, Li, C
It is also possible to use a material in which a metal having a small work function such as s is mixed by co-evaporation or the like.

また、図9(B)に示すように、第1の導電層201、有機化合物及び有機化合物に対し
て電子受容性を有する無機化合物で形成される正孔輸送層346、発光性の有機化合物で
形成される発光層343、及び発光性の有機化合物に対して電子供与性を有する無機化合
物で形成される電子輸送層347により形成された発光材料を含む層318、並びに第2
の導電層204で発光素子205を形成してもよい。
9B, the first conductive layer 201, a hole transport layer 346 formed of an organic compound and an inorganic compound having an electron-accepting property with respect to the organic compound, and a light-emitting organic compound are used. A light-emitting layer 343 formed and a layer 318 containing a light-emitting material formed by an electron-transport layer 347 formed of an inorganic compound having an electron-donating property with respect to the light-emitting organic compound;
The light-emitting element 205 may be formed using the conductive layer 204.

発光性の有機化合物、及び発光性の有機化合物に対して電子受容性を有する無機化合物で
形成される正孔輸送層346は、有機化合物として、上記した正孔輸送性の有機化合物を
適宜用いて形成する。また、無機化合物として、有機化合物から電子を受け取りやすいも
のであれば何であってもよく、種々の金属酸化物または金属窒化物が可能であるが、周期
表第4族乃至第12族のいずれかの遷移金属酸化物が電子受容性を示しやすく好適である
。具体的には、酸化チタン、酸化ジルコニウム、酸化バナジウム、酸化モリブデン、酸化
タングステン、酸化レニウム、酸化ルテニウム、酸化亜鉛などが挙げられる。また、上述
した金属酸化物の中でも、周期表第4族乃至第8族のいずれかの遷移金属酸化物は電子受
容性の高いものが多く、好ましい一群である。特に酸化バナジウム、酸化モリブデン、酸
化タングステン、酸化レニウムは真空蒸着が可能で扱いやすいため、好適である。
The hole-transport layer 346 formed using a light-emitting organic compound and an inorganic compound having an electron-accepting property with respect to the light-emitting organic compound appropriately uses the above-described hole-transport organic compound as the organic compound. Form. The inorganic compound may be anything as long as it can easily receive electrons from an organic compound, and various metal oxides or metal nitrides can be used. Any one of Groups 4 to 12 of the periodic table can be used. These transition metal oxides are preferable because they easily exhibit electron accepting properties. Specific examples include titanium oxide, zirconium oxide, vanadium oxide, molybdenum oxide, tungsten oxide, rhenium oxide, ruthenium oxide, and zinc oxide. Among the metal oxides described above, any of the transition metal oxides in Groups 4 to 8 of the periodic table has a high electron accepting property and is a preferred group. Vanadium oxide, molybdenum oxide, tungsten oxide, and rhenium oxide are particularly preferable because they can be vacuum-deposited and are easy to handle.

発光性の有機化合物、及び発光性の有機化合物に対して電子供与性を有する無機化合物で
形成される電子輸送層347は、有機化合物として上記した電子輸送性の有機化合物を適
宜用いて形成する。また、無機化合物として、有機化合物から電子を与えやすいものであ
れば何であってもよく、種々の金属酸化物または金属窒化物が可能であるが、アルカリ金
属酸化物、アルカリ土類金属酸化物、希土類金属酸化物、アルカリ金属窒化物、アルカリ
土類金属窒化物、希土類金属窒化物が電子供与性を示しやすく好適である。具体的には、
酸化リチウム、酸化ストロンチウム、酸化バリウム、酸化エルビウム、窒化リチウム、窒
化マグネシウム、窒化カルシウム、窒化イットリウム、窒化ランタンなどが挙げられる。
特に酸化リチウム、酸化バリウム、窒化リチウム、窒化マグネシウム、窒化カルシウムは
真空蒸着が可能で扱いやすいため、好適である。
The electron-transport layer 347 formed using a light-emitting organic compound and an inorganic compound having an electron-donating property with respect to the light-emitting organic compound is formed using the above-described electron-transport organic compound as appropriate as the organic compound. In addition, the inorganic compound may be anything as long as it easily gives electrons from an organic compound, and various metal oxides or metal nitrides are possible. Alkali metal oxides, alkaline earth metal oxides, Rare earth metal oxides, alkali metal nitrides, alkaline earth metal nitrides, and rare earth metal nitrides are preferred because they easily exhibit electron donating properties. In particular,
Examples thereof include lithium oxide, strontium oxide, barium oxide, erbium oxide, lithium nitride, magnesium nitride, calcium nitride, yttrium nitride, and lanthanum nitride.
In particular, lithium oxide, barium oxide, lithium nitride, magnesium nitride, and calcium nitride are preferable because they can be vacuum-deposited and are easy to handle.

発光性の有機化合物及び無機化合物で形成される電子輸送層347又は正孔輸送層346
は、電子注入・輸送特性が優れているため、第1の導電層201、第2の導電層204共
に、ほとんど仕事関数の制限を受けることなく、種々の材料を用いることができる。また
駆動電圧を低減することが可能である。
Electron transport layer 347 or hole transport layer 346 formed of a light-emitting organic compound and an inorganic compound
Since the electron injection / transport characteristics are excellent, various materials can be used for both the first conductive layer 201 and the second conductive layer 204 with almost no work function limitation. In addition, the driving voltage can be reduced.

また、発光物質を含む層203として、無機化合物を用いた発光機能を担う層(以下、発
光層349という。)を有することで、発光素子205は無機EL素子として機能する。
無機EL素子は、その素子構成により、分散型無機EL素子と薄膜型無機EL素子とに分
類される。前者は、発光材料の粒子をバインダ中に分散させた発光物質を含む層を有し、
後者は、発光材料の薄膜からなる発光物質を含む層を有している点に違いはあるが、高電
界で加速された電子を必要とする点では共通である。なお、得られる発光のメカニズムと
しては、ドナー準位とアクセプター準位を利用するドナー−アクセプター再結合型発光と
、金属イオンの内殻電子遷移を利用する局在型発光とがある。分散型無機ELではドナー
−アクセプター再結合型発光、薄膜型無機EL素子では局在型発光である場合が多い。以
下に、無機EL素子の構造について示す。
In addition, the light-emitting element 205 functions as an inorganic EL element by including a layer having a light-emitting function using an inorganic compound (hereinafter referred to as a light-emitting layer 349) as the layer 203 containing a light-emitting substance.
Inorganic EL elements are classified into a dispersion-type inorganic EL element and a thin-film inorganic EL element depending on the element structure. The former has a layer containing a luminescent material in which particles of a luminescent material are dispersed in a binder,
The latter is different in that it has a layer containing a luminescent material made of a thin film of a luminescent material, but is common in that it requires electrons accelerated in a high electric field. Note that the obtained light emission mechanism includes donor-acceptor recombination light emission using a donor level and an acceptor level, and localized light emission using inner-shell electron transition of a metal ion. In many cases, dispersion-type inorganic EL emits donor-acceptor recombination light emission, and thin-film inorganic EL element emits localized light emission. The structure of the inorganic EL element is shown below.

本実施の形態で用いることのできる発光材料は、母体材料と発光中心となる不純物元素と
で構成される。含有させる不純物元素を変化させることで、様々な色の発光を得ることが
できる。発光材料の作製方法としては、固相法や液相法(共沈法)などの様々な方法を用
いることができる。また、噴霧熱分解法、複分解法、プレカーサーの熱分解反応による方
法、逆ミセル法やこれらの方法と高温焼成を組み合わせた方法、凍結乾燥法などの液相法
なども用いることができる。
A light-emitting material that can be used in this embodiment mode includes a base material and an impurity element that serves as a light-emission center. By changing the impurity element to be contained, light emission of various colors can be obtained. As a method for manufacturing the light-emitting material, various methods such as a solid phase method and a liquid phase method (coprecipitation method) can be used. Also, spray pyrolysis method, metathesis method, precursor thermal decomposition method, reverse micelle method, method combining these methods with high temperature firing, liquid phase method such as freeze-drying method, etc. can be used.

固相法は、母体材料と、不純物元素又は不純物元素を含む化合物を秤量し、乳鉢で混合、
電気炉で加熱、焼成を行い反応させ、母体材料に不純物元素を含有させる方法である。焼
成温度は、700〜1500℃が好ましい。温度が低すぎる場合は固相反応が進まず、温
度が高すぎる場合は母体材料が分解してしまうからである。なお、粉末状態で焼成を行っ
てもよいが、ペレット状態で焼成を行うことが好ましい。比較的高温での焼成を必要とす
るが、簡単な方法であるため、生産性がよく大量生産に適している。
In the solid phase method, a base material and an impurity element or a compound containing an impurity element are weighed and mixed in a mortar.
This is a method in which an impurity element is contained in the base material by reacting by heating and baking in an electric furnace. The firing temperature is preferably 700 to 1500 ° C. This is because the solid phase reaction does not proceed when the temperature is too low, and the base material is decomposed when the temperature is too high. In addition, although baking may be performed in a powder state, it is preferable to perform baking in a pellet state. Although firing at a relatively high temperature is required, it is a simple method, so it has high productivity and is suitable for mass production.

液相法(共沈法)は、母体材料又は母体材料を含む化合物と、不純物元素又は不純物元素
を含む化合物を溶液中で反応させ、乾燥させた後、焼成を行う方法である。発光材料の粒
子が均一に分布し、粒径が小さく低い焼成温度でも反応が進むことができる。
The liquid phase method (coprecipitation method) is a method in which a base material or a compound containing the base material and an impurity element or a compound containing the impurity element are reacted in a solution, dried, and then fired. The particles of the luminescent material are uniformly distributed, and the reaction can proceed even at a low firing temperature with a small particle size.

無機EL素子の発光材料に用いる母体材料としては、硫化物、酸化物、窒化物を用いるこ
とができる。硫化物としては、例えば、硫化亜鉛(ZnS)、硫化カドミウム(CdS)
、硫化カルシウム(CaS)、硫化イットリウム(Y)、硫化ガリウム(Ga
)、硫化ストロンチウム(SrS)、硫化バリウム(BaS)等を用いることができる
。また、酸化物としては、例えば、酸化亜鉛(ZnO)、酸化イットリウム(Y
等を用いることができる。また、窒化物としては、例えば、窒化アルミニウム(AlN)
、窒化ガリウム(GaN)、窒化インジウム(InN)等を用いることができる。さらに
、セレン化亜鉛(ZnSe)、テルル化亜鉛(ZnTe)等も用いることができ、硫化カ
ルシウム−ガリウム(CaGa)、硫化ストロンチウム−ガリウム(SrGa
)、硫化バリウム−ガリウム(BaGa)等の3元系の混晶であってもよい。
As a base material used for a light-emitting material of an inorganic EL element, sulfide, oxide, or nitride can be used. Examples of sulfides include zinc sulfide (ZnS) and cadmium sulfide (CdS).
, Calcium sulfide (CaS), yttrium sulfide (Y 2 S 3 ), gallium sulfide (Ga 2 S)
3 ), strontium sulfide (SrS), barium sulfide (BaS), or the like can be used. Examples of the oxide include zinc oxide (ZnO) and yttrium oxide (Y 2 O 3 ).
Etc. can be used. Moreover, as nitride, for example, aluminum nitride (AlN)
Gallium nitride (GaN), indium nitride (InN), or the like can be used. Furthermore, zinc selenide (ZnSe), zinc telluride (ZnTe), and the like can also be used, such as calcium sulfide-gallium sulfide (CaGa 2 S 4 ), strontium sulfide-gallium (SrGa 2 S).
4 ) or a ternary mixed crystal such as barium sulfide-gallium sulfide (BaGa 2 S 4 ).

局在型発光の発光中心として、マンガン(Mn)、銅(Cu)、サマリウム(Sm)、テ
ルビウム(Tb)、エルビウム(Er)、ツリウム(Tm)、ユーロピウム(Eu)、セ
リウム(Ce)、プラセオジウム(Pr)などを用いることができる。なお、電荷補償と
して、フッ素(F)、塩素(Cl)などのハロゲン元素が添加されていてもよい。
As emission centers of localized emission, manganese (Mn), copper (Cu), samarium (Sm), terbium (Tb), erbium (Er), thulium (Tm), europium (Eu), cerium (Ce), praseodymium (Pr) or the like can be used. Note that a halogen element such as fluorine (F) or chlorine (Cl) may be added as charge compensation.

一方、ドナー−アクセプター再結合型発光の発光中心として、ドナー準位を形成する第1
の不純物元素及びアクセプター準位を形成する第2の不純物元素を含む発光材料を用いる
ことができる。第1の不純物元素は、例えば、フッ素(F)、塩素(Cl)、アルミニウ
ム(Al)等を用いることができる。第2の不純物元素としては、例えば、銅(Cu)、
銀(Ag)等を用いることができる。
On the other hand, as a light emission center of donor-acceptor recombination light emission, a first donor level is formed.
And a light-emitting material including a second impurity element which forms an acceptor level. As the first impurity element, for example, fluorine (F), chlorine (Cl), aluminum (Al), or the like can be used. As the second impurity element, for example, copper (Cu),
Silver (Ag) or the like can be used.

ドナー−アクセプター再結合型発光の発光材料を固相法を用いて合成する場合、母体材料
と、第1の不純物元素又は第1の不純物元素を含む化合物と、第2の不純物元素又は第2
の不純物元素を含む化合物をそれぞれ秤量し、乳鉢で混合した後、電気炉で加熱、焼成を
行う。母体材料としては、上述した母体材料を用いることができ、第1の不純物元素又は
第1の不純物元素を含む化合物としては、例えば、フッ素(F)、塩素(Cl)、硫化ア
ルミニウム(Al)等を用いることができる。また、第2の不純物元素又は第2の
不純物元素を含む化合物としては、例えば、銅(Cu)、銀(Ag)、硫化銅(Cu
)、硫化銀(AgS)等を用いることができる。焼成温度は、700〜1500℃が好
ましい。温度が低すぎる場合は固相反応が進まず、温度が高すぎる場合は母体材料が分解
してしまうからである。なお、粉末状態で焼成を行ってもよいが、ペレット状態で焼成を
行うことが好ましい。
In the case where a light-emitting material for donor-acceptor recombination light emission is synthesized using a solid-phase method, a base material, a first impurity element or a compound containing the first impurity element, a second impurity element, or a second impurity element
Each of the compounds containing the impurity element is weighed and mixed in a mortar, and then heated and fired in an electric furnace. As the base material, the above-described base material can be used, and examples of the first impurity element or the compound containing the first impurity element include fluorine (F), chlorine (Cl), and aluminum sulfide (Al 2 S). 3 ) etc. can be used. Examples of the second impurity element or the compound containing the second impurity element include copper (Cu), silver (Ag), and copper sulfide (Cu 2 S).
), Silver sulfide (Ag 2 S), and the like can be used. The firing temperature is preferably 700 to 1500 ° C. This is because the solid phase reaction does not proceed when the temperature is too low, and the base material is decomposed when the temperature is too high. In addition, although baking may be performed in a powder state, it is preferable to perform baking in a pellet state.

また、固相反応を利用する場合の不純物元素として、第1の不純物元素と第2の不純物元
素で構成される化合物を組み合わせて用いてもよい。この場合、不純物元素が拡散されや
すく、固相反応が進みやすくなるため、均一な発光材料を得ることができる。さらに、余
分な不純物元素が入らないため、純度の高い発光材料が得ることができる。第1の不純物
元素と第2の不純物元素で構成される化合物としては、例えば、塩化銅(CuCl)、塩
化銀(AgCl)等を用いることができる。
In addition, as an impurity element in the case of using a solid phase reaction, a compound including a first impurity element and a second impurity element may be used in combination. In this case, since the impurity element is easily diffused and the solid-phase reaction easily proceeds, a uniform light emitting material can be obtained. Further, since no extra impurity element is contained, a light-emitting material with high purity can be obtained. As the compound including the first impurity element and the second impurity element, for example, copper chloride (CuCl), silver chloride (AgCl), or the like can be used.

なお、これらの不純物元素の濃度は、母体材料に対して0.01〜10atom%であれ
ばよく、好ましくは0.05〜5atom%の範囲である。
Note that the concentration of these impurity elements may be 0.01 to 10 atom% with respect to the base material, and is preferably in the range of 0.05 to 5 atom%.

図9(C)は、発光物質を含む層203が第1の絶縁層、発光層349、及び第2の絶縁
層350で構成される無機EL素子の断面を示す。
FIG. 9C illustrates a cross section of an inorganic EL element in which the layer 203 containing a light-emitting substance includes a first insulating layer, a light-emitting layer 349, and a second insulating layer 350.

薄膜型無機ELの場合、発光層349は、上記発光材料を含む層であり、抵抗加熱蒸着法
、電子ビーム蒸着(EB蒸着)法等の真空蒸着法、スパッタリング法等の物理気相成長法
(PVD)、有機金属CVD法、ハイドライド輸送減圧CVD法等の化学気相成長法(C
VD)、原子エピタキシ法(ALE)等を用いて形成することができる。
In the case of a thin-film inorganic EL, the light emitting layer 349 is a layer containing the above light emitting material, and is a physical vapor deposition method (such as a resistance heating vapor deposition method, a vacuum vapor deposition method such as an electron beam vapor deposition (EB vapor deposition) method) Chemical vapor deposition (C) such as PVD), metal organic chemical vapor deposition, hydride transport low pressure CVD
VD), atomic epitaxy (ALE), or the like.

第1の絶縁層348及び第2の絶縁層350は、特に限定されることはないが、絶縁耐性
が高く、緻密な膜質であることが好ましく、さらには、誘電率が高いことが好ましい。例
えば、酸化シリコン(SiO)、酸化イットリウム(Y)、酸化チタン(TiO
)、酸化アルミニウム(Al2O)、酸化ハフニウム(HfO)、酸化タンタル(
Ta)、チタン酸バリウム(BaTiO)、チタン酸ストロンチウム(SrTi
)、チタン酸鉛(PbTiO)、窒化シリコン(Si)、酸化ジルコニウム
(ZrO)等やこれらの混合膜又は2種以上の積層を用いることができる。第1の絶縁
層348及び第2の絶縁層350は、スパッタリング、蒸着、CVD等により成膜するこ
とができる。膜厚は特に限定されることはないが、好ましくは10〜1000nmの範囲
である。なお、本実施の形態の発光素子は、必ずしもホットエレクトロンを必要とはしな
いため、薄膜にすることもでき、駆動電圧を低下できる長所を有する。好ましくは、50
0nm以下の膜厚、より好ましくは100nm以下の膜厚であることが好ましい。
The first insulating layer 348 and the second insulating layer 350 are not particularly limited. However, the first insulating layer 348 and the second insulating layer 350 have high insulation resistance, preferably have a dense film quality, and preferably have a high dielectric constant. For example, silicon oxide (SiO 2 ), yttrium oxide (Y 2 O 3 ), titanium oxide (TiO 2 )
2), aluminum oxide (Al2O 3), hafnium oxide (HfO 2), tantalum oxide (
Ta 2 O 5 ), barium titanate (BaTiO 3 ), strontium titanate (SrTi)
O 3 ), lead titanate (PbTiO 3 ), silicon nitride (Si 3 N 4 ), zirconium oxide (ZrO 2 ), etc., a mixed film thereof, or a laminate of two or more kinds can be used. The first insulating layer 348 and the second insulating layer 350 can be formed by sputtering, vapor deposition, CVD, or the like. The film thickness is not particularly limited, but is preferably in the range of 10 to 1000 nm. Note that the light-emitting element of this embodiment mode does not necessarily require hot electrons, and thus can be formed into a thin film and has an advantage that a driving voltage can be reduced. Preferably 50
The film thickness is preferably 0 nm or less, more preferably 100 nm or less.

なお、図示しないが、発光層349と絶縁層348、350、又は発光層349と導電層
201、319の間にバッファ層を設けても良い。このバッファ層はキャリアの注入を容
易にし、かつ両層の混合を抑制する役割をもつ。バッファ層としては、特に限定されるこ
とはないが、例えば、発光層の母体材料であるZnS、ZnSe、ZnTe、CdS、S
rS、BaS等、又はCuS、CuS、又はハロゲン化アルカリであるLiF、CaF
、BaF、MgF等を用いることができる。
Note that although not illustrated, a buffer layer may be provided between the light-emitting layer 349 and the insulating layers 348 and 350 or between the light-emitting layer 349 and the conductive layers 201 and 319. This buffer layer has a role of facilitating carrier injection and suppressing mixing of both layers. Although it does not specifically limit as a buffer layer, For example, it is ZnS, ZnSe, ZnTe, CdS, S which are the base materials of a light emitting layer.
rS, BaS, etc., or CuS, Cu 2 S, or LiF or CaF which is an alkali halide
2 , BaF 2 , MgF 2 or the like can be used.

また、図9(D)に示すように、発光物質を含む層203が発光層349及び第1の絶縁
層348で構成されてもよい。この場合、図9(D)においては、第1の絶縁層348は
第2の導電層204及び発光層349の間に設けられている形態を示す。なお、第1の絶
縁層348は第1の導電層201及び発光層349の間に設けられていてもよい。
In addition, as illustrated in FIG. 9D, the layer 203 containing a light-emitting substance may be formed using a light-emitting layer 349 and a first insulating layer 348. In this case, FIG. 9D illustrates a mode in which the first insulating layer 348 is provided between the second conductive layer 204 and the light-emitting layer 349. Note that the first insulating layer 348 may be provided between the first conductive layer 201 and the light-emitting layer 349.

さらには、発光物質を含む層203が、発光層349のみで構成されてもよい。即ち、第
1の導電層201、発光物質を含む層203、第2の導電層204で発光素子205を構
成してもよい。
Further, the layer 203 containing a light-emitting substance may be formed using only the light-emitting layer 349. That is, the light-emitting element 205 may be formed using the first conductive layer 201, the layer 203 containing a light-emitting substance, and the second conductive layer 204.

分散型無機ELの場合、粒子状の発光材料をバインダ中に分散させ膜状の発光物質を含む
層を形成する。粒子状に加工する。発光材料の作製方法によって、十分に所望の大きさの
粒子が得られない場合は、乳鉢等で粉砕などによって粒子状に加工すればよい。バインダ
とは、粒状の発光材料を分散した状態で固定し、発光物質を含む層としての形状に保持す
るための物質である。発光材料は、バインダによって発光物質を含む層中に均一に分散し
固定される。
In the case of a dispersion type inorganic EL, a particulate luminescent material is dispersed in a binder to form a layer containing a film-like luminescent substance. Process into particles. When particles having a desired size cannot be obtained sufficiently by the method for manufacturing a light emitting material, the particles may be processed into particles by pulverization or the like in a mortar or the like. The binder is a substance for fixing a granular light emitting material in a dispersed state and holding it in a shape as a layer containing a light emitting substance. The light emitting material is uniformly dispersed and fixed in the layer containing the light emitting substance by the binder.

分散型無機ELの場合、発光物質を含む層の形成方法は、選択的に発光物質を含む層を形
成できる液滴吐出法や、印刷法(スクリーン印刷やオフセット印刷など)、スピンコート
法などの塗布法、ディッピング法、ディスペンサ法などを用いることもできる。膜厚は特
に限定されることはないが、好ましくは、10〜1000nmの範囲である。また、発光
材料及びバインダを含む発光物質を含む層において、発光材料の割合は50wt%以上8
0wt%以下とするよい。
In the case of a dispersion-type inorganic EL, a method for forming a layer containing a light-emitting substance includes a droplet discharge method that can selectively form a layer containing a light-emitting substance, a printing method (such as screen printing or offset printing), and a spin coating method. An application method, a dipping method, a dispenser method, or the like can also be used. The film thickness is not particularly limited, but is preferably in the range of 10 to 1000 nm. In the layer containing the light-emitting material and the light-emitting substance including the binder, the ratio of the light-emitting material is 50 wt% or more and 8
It may be 0 wt% or less.

図9(E)における素子は、第1の導電層201、発光物質を含む層203、第2の導電
層204を有し、発光物質を含む層203が、発光材料352がバインダ351に分散さ
れた発光層及び絶縁層348で構成される。なお、絶縁層348は、図9(E)において
は、第2の導電層204に接する構造となっているが、第1の導電層201に接する構造
でもよい。また、素子は、第1の導電層201及び第2の導電層204それぞれに接する
絶縁層を有してもよい。さらには、素子は、第1の導電層201及び第2の導電層204
に接する絶縁層を有さなくてもよい。
The element in FIG. 9E includes a first conductive layer 201, a layer 203 containing a light-emitting substance, and a second conductive layer 204. In the layer 203 containing a light-emitting substance, a light-emitting material 352 is dispersed in a binder 351. A light emitting layer and an insulating layer 348. Note that the insulating layer 348 has a structure in contact with the second conductive layer 204 in FIG. 9E, but may have a structure in contact with the first conductive layer 201. The element may include an insulating layer in contact with each of the first conductive layer 201 and the second conductive layer 204. Further, the element includes a first conductive layer 201 and a second conductive layer 204.
It is not necessary to have an insulating layer in contact with.

本実施の形態に用いることのできるバインダとしては、有機材料や無機材料の絶縁材料を
用いることができる。また、有機材料及び無機材料の混合材料を用いてもよい。有機絶縁
材料としては、シアノエチルセルロース系樹脂のように、比較的誘電率の高いポリマーや
、ポリエチレン、ポリプロピレン、ポリスチレン系樹脂、シリコーン樹脂、エポキシ樹脂
、フッ化ビニリデンなどの樹脂を用いることができる。また、芳香族ポリアミド、ポリベ
ンゾイミダゾール(polybenzimidazole)などの耐熱性高分子、又はシ
ロキサン樹脂を用いてもよい。なお、シロキサン樹脂とは、Si−O−Si結合を含む樹
脂に相当する。シロキサンは、シリコン(Si)と酸素(O)との結合で骨格構造が構成
される。置換基として、少なくとも水素を含む有機基(例えばアルキル基、芳香族炭化水
素)が用いられる。置換基として、フルオロ基を用いてもよい。または置換基として、少
なくとも水素を含む有機基と、フルオロ基とを用いてもよい。また、ポリビニルアルコー
ル、ポリビニルブチラールなどのビニル樹脂、フェノール樹脂、ノボラック樹脂、アクリ
ル樹脂、メラミン樹脂、ウレタン樹脂、オキサゾール樹脂(ポリベンゾオキサゾール)等
の樹脂材料を用いてもよい。また光硬化型などを用いることができる。これらの樹脂に、
チタン酸バリウム(BaTiO)やチタン酸ストロンチウム(SrTiO)などの高
誘電率の微粒子を適度に混合して誘電率を調整することもできる。
As a binder that can be used in this embodiment, an insulating material such as an organic material or an inorganic material can be used. Further, a mixed material of an organic material and an inorganic material may be used. As the organic insulating material, a polymer having a relatively high dielectric constant such as a cyanoethyl cellulose resin, or a resin such as polyethylene, polypropylene, polystyrene resin, silicone resin, epoxy resin, or vinylidene fluoride can be used. Alternatively, a heat-resistant polymer such as aromatic polyamide, polybenzimidazole, or siloxane resin may be used. Note that a siloxane resin corresponds to a resin including a Si—O—Si bond. Siloxane has a skeleton structure formed of a bond of silicon (Si) and oxygen (O). As a substituent, an organic group containing at least hydrogen (for example, an alkyl group or an aromatic hydrocarbon) is used. A fluoro group may be used as a substituent. Alternatively, an organic group containing at least hydrogen and a fluoro group may be used as a substituent. Moreover, resin materials such as vinyl resins such as polyvinyl alcohol and polyvinyl butyral, phenol resins, novolac resins, acrylic resins, melamine resins, urethane resins, and oxazole resins (polybenzoxazole) may be used. Moreover, a photocuring type etc. can be used. To these resins,
The dielectric constant can be adjusted by appropriately mixing fine particles having a high dielectric constant such as barium titanate (BaTiO 3 ) and strontium titanate (SrTiO 3 ).

また、バインダに用いる無機絶縁材料としては、酸化珪素(SiO)、窒化珪素(Si
)、酸素及び窒素を含む珪素、窒化アルミニウム(AlN)、酸素及び窒素を含むア
ルミニウムまたは酸化アルミニウム(Al)、酸化チタン(TiO)、BaTi
、SrTiO、チタン酸鉛(PbTiO)、ニオブ酸カリウム(KNbO)、
ニオブ酸鉛(PbNbO)、酸化タンタル(Ta)、タンタル酸バリウム(Ba
Ta)、タンタル酸リチウム(LiTaO)、酸化イットリウム(Y)、
酸化ジルコニウム(ZrO)、ZnSその他の無機絶縁性材料を含む物質から選ばれた
材料で形成することができる。有機材料に、誘電率の高い無機材料を含ませる(添加等に
よって)ことによって、発光材料及びバインダよりなる発光物質を含む層の誘電率をより
制御することができ、より誘電率を大きくすることができる。
As the inorganic insulating material used for the binder, silicon oxide (SiO x ), silicon nitride (Si
N x), silicon containing oxygen and nitrogen, aluminum nitride (AlN), aluminum or aluminum oxide containing oxygen and nitrogen (Al 2 O 3), titanium oxide (TiO 2), BaTi
O 3 , SrTiO 3 , lead titanate (PbTiO 3 ), potassium niobate (KNbO 3 ),
Lead niobate (PbNbO 3 ), tantalum oxide (Ta 2 O 5 ), barium tantalate (Ba
Ta 2 O 6 ), lithium tantalate (LiTaO 3 ), yttrium oxide (Y 2 O 3 ),
It can be formed of a material selected from substances including zirconium oxide (ZrO 2 ), ZnS, and other inorganic insulating materials. By including an inorganic material having a high dielectric constant in the organic material (by addition or the like), the dielectric constant of the layer containing the light emitting material including the light emitting material and the binder can be further controlled, and the dielectric constant can be further increased. Can do.

作製工程において、発光材料はバインダを含む溶液中に分散されるが本実施の形態に用い
ることのできるバインダを含む溶液の溶媒としては、バインダ材料が溶解し、発光層を形
成する方法(各種ウエットプロセス)及び所望の膜厚に適した粘度の溶液を作製できるよ
うな溶媒を適宜選択すればよい。有機溶媒等を用いることができ、例えばバインダとして
シロキサン樹脂を用いる場合は、プロピレングリコールモノメチルエーテル、プロピレン
グリコールモノメチルエーテルアセテート(PGMEAともいう)、3−メトシキ−3メ
チル−1−ブタノール(MMBともいう)などを用いることができる。
In the manufacturing process, the light-emitting material is dispersed in a solution containing a binder, but as a solvent for the solution containing the binder that can be used in this embodiment mode, a method of forming a light-emitting layer by dissolving the binder material (various wet types) A solvent capable of producing a solution having a viscosity suitable for the process) and a desired film thickness may be appropriately selected. For example, when a siloxane resin is used as a binder, propylene glycol monomethyl ether, propylene glycol monomethyl ether acetate (also referred to as PGMEA), 3-methoxy-3-methyl-1-butanol (also referred to as MMB) can be used. Etc. can be used.

無機EL発光素子は、発光物質を含む層を狭持する一対の電極間に電圧を印加することで
発光が得られるが、直流駆動又は交流駆動のいずれにおいても動作することができる。
Inorganic EL light-emitting elements can emit light by applying a voltage between a pair of electrodes sandwiching a layer containing a light-emitting substance, but can operate in either DC driving or AC driving.

ここでは、赤色を表示する発光素子として、第1の画素電極として機能する第2の導電層
として膜厚125nmの酸化珪素を含むITO層を形成する。また、発光層として、DN
TPDを50nm、NPBを10nm、ビス[2,3−ビス(4−フルオロフェニル)キ
ノキサリナト]イリジウム(アセチルアセトナート)(略称:Ir(Fdpq)(ac
ac))が添加されたNPBを30nm、Alqを30nm、Alqを30nm、及
びLiFを1nm積層して形成する。第2の画素電極として機能する第3の導電層として
、膜厚200nmのAl層を形成する。
Here, as a light-emitting element that displays red, an ITO layer containing silicon oxide with a thickness of 125 nm is formed as the second conductive layer functioning as the first pixel electrode. As the light emitting layer, DN
TPD 50 nm, NPB 10 nm, bis [2,3-bis (4-fluorophenyl) quinoxalinato] iridium (acetylacetonate) (abbreviation: Ir (Fdpq) 2 (ac
ac)) is 30nm to NPB, which is added, 30nm of Alq 3, 30nm and Alq 3, and LiF and formed by 1nm laminated. As the third conductive layer functioning as the second pixel electrode, an Al layer having a thickness of 200 nm is formed.

また、緑色を表示する発光素子として、第1の画素電極として機能する第2の導電層とし
て膜厚125nmの酸化珪素を含むITO層を形成する。また、発光層として、DNTP
Dを50nm、NPBを10nm、クマリン545T(C545T)が添加されたAlq
を40nm、Alqを30nm、及びLiFを1nm積層して形成する。第2の画素
電極として機能する第3の導電層として、膜厚200nmのAl層を形成する。
As a light-emitting element that displays green, an ITO layer containing silicon oxide with a thickness of 125 nm is formed as the second conductive layer functioning as the first pixel electrode. In addition, as a light emitting layer, DNTP
Alq with D = 50 nm, NPB = 10 nm, and Coumarin 545T (C545T) added
3 is formed by laminating 40 nm, Alq 3 by 30 nm, and LiF by 1 nm. As the third conductive layer functioning as the second pixel electrode, an Al layer having a thickness of 200 nm is formed.

また、青色を表示する発光素子として、第1の画素電極として機能する第2の導電層とし
て膜厚125nmの酸化珪素を含むITO層を形成する。また、発光層として、DNTP
Dを50nm、NPBを10nm、2,5,8,11−テトラ(tert−ブチル)ペリ
レン(略称:TBP)が添加された、9−[4−(N−カルバゾリル)]フェニル−10
−フェニルアントラセン(略称:CzPA:)を30nm、Alqを30nm、及びL
iFを1nm積層して形成する。第2の画素電極として機能する第3の導電層として、膜
厚200nmのAl層を形成する。
As a light-emitting element that displays blue, an ITO layer containing silicon oxide with a thickness of 125 nm is formed as the second conductive layer functioning as the first pixel electrode. In addition, as a light emitting layer, DNTP
9- [4- (N-carbazolyl)] phenyl-10 to which D is 50 nm, NPB is 10 nm, and 2,5,8,11-tetra (tert-butyl) perylene (abbreviation: TBP) is added.
- phenyl anthracene (abbreviation: CzPA 30 nm to :), 30 nm and Alq 3, and L
iF is formed by laminating 1 nm. As the third conductive layer functioning as the second pixel electrode, an Al layer having a thickness of 200 nm is formed.

次に、導電層204上に保護膜を形成することが好ましい。 Next, a protective film is preferably formed over the conductive layer 204.

この後、走査線、信号線の接続端子部に、接続導電層を介して配線基板、代表的にはFP
C(Flexible Print Circuitを貼り付ける。以上の工程により、
発光表示パネルを形成することができる。
After that, the wiring board, typically FP, is connected to the connection terminal portion of the scanning line and the signal line through the connection conductive layer.
C (Flexible Print Circuit is pasted. By the above process,
A light-emitting display panel can be formed.

なお、静電破壊防止のための保護回路、代表的にはダイオードなどを、接続端子とソース
配線(ゲート配線)の間または画素部に設けてもよい。
Note that a protection circuit for preventing electrostatic breakdown, typically a diode or the like, may be provided between the connection terminal and the source wiring (gate wiring) or in the pixel portion.

ここで、図9(A)及び(B)で示す発光素子を有する発光表示パネルにおいて、基板1
00側に放射する場合、つまり下方放射を行う場合について、図10(A)を用いて説明
する。この場合、薄膜トランジスタ188に電気的に接続するように、ソース電極層又は
ドレイン電極として機能する配線187に接して、透光性を有する導電層484、発光物
質を含む層485、遮光性または反射性を有する導電層486が順に積層される。光が透
過する基板100は少なくとも可視領域の光に対して透光性を有する必要がある。
Here, in the light-emitting display panel having the light-emitting elements shown in FIGS.
A case of radiating toward 00 side, that is, a case of performing downward radiation will be described with reference to FIG. In this case, the conductive layer 484 having a light-transmitting property, the layer 485 containing a light-emitting substance, a light-blocking property or a reflective property are in contact with the wiring 187 functioning as a source electrode layer or a drain electrode so as to be electrically connected to the thin film transistor 188. A conductive layer 486 having layers is stacked in order. The substrate 100 through which light is transmitted needs to be transparent to at least light in the visible region.

次に、基板100と反対側に放射する場合、つまり上方放射を行う場合について、図10
(B)を用いて説明する。薄膜トランジスタ188は、前述した薄膜トランジスタの同様
に形成することができる。薄膜トランジスタ188に電気的に接続するソース電極層又は
ドレイン電極として機能する配線187が遮光性または反射性を有する導電層463と接
し、電気的に接続する。遮光性または反射性を有する導電層463、発光物質を含む層4
64、透光性を有する導電層465が順に積層される。導電層463は遮光性または反射
性を有する金属層であり、発光素子から放射される光を矢印の上面に反射する。なお、遮
光性または反射性を有する導電層463上に透光性を有する導電層を形成してもよい。発
光素子から放出する光は第2の導電層465を透過して放出されるので、透光性を有する
導電層465は、少なくとも可視領域において透光性を有する材料で形成する。
Next, in the case of radiating to the side opposite to the substrate 100, that is, in the case of emitting upward, FIG.
A description will be given using (B). The thin film transistor 188 can be formed in a manner similar to that of the thin film transistor described above. A wiring 187 functioning as a source electrode layer or a drain electrode electrically connected to the thin film transistor 188 is in contact with and electrically connected to the conductive layer 463 having a light-blocking property or a reflective property. A light-blocking or reflective conductive layer 463 and a layer 4 containing a light-emitting substance
64, a light-transmitting conductive layer 465 is sequentially stacked. The conductive layer 463 is a light-blocking or reflective metal layer, and reflects light emitted from the light-emitting element to the upper surface of the arrow. Note that a light-transmitting conductive layer may be formed over the light-blocking or reflective conductive layer 463. Since light emitted from the light-emitting element is emitted through the second conductive layer 465, the light-transmitting conductive layer 465 is formed using a light-transmitting material at least in the visible region.

次に、光が基板100側とその反対側の両側に放射する場合、つまり両方放射を行う場合
について、図10(C)を用いて説明する。薄膜トランジスタ188の半導体層に電気的
に接続するソース電極層又はドレイン電極として機能する配線187に、第1の透光性を
有する導電層472が電気的に接続している。第1の透光性を有する導電層472、発光
物質を含む層473、第2の透光性を有する導電層474が順に積層される。このとき、
第1の透光性を有する導電層472と第2の透光性を有する導電層474のどちらも少な
くとも可視領域において透光性を有する材料、又は光を透過できる厚さで形成すると、両
方放射が実現する。この場合、光が透過する絶縁層や基板100も少なくとも可視領域の
光に対して透光性を有する必要がある。
Next, the case where light is emitted to both sides of the substrate 100 and the opposite side, that is, the case where both are emitted will be described with reference to FIG. A conductive layer 472 having a first light-transmitting property is electrically connected to a wiring 187 functioning as a source electrode layer or a drain electrode which is electrically connected to the semiconductor layer of the thin film transistor 188. A conductive layer 472 having a first light-transmitting property, a layer 473 containing a light-emitting substance, and a conductive layer 474 having a second light-transmitting property are sequentially stacked. At this time,
When both the conductive layer 472 having the first light-transmitting property and the conductive layer 474 having the second light-transmitting property are formed with a light-transmitting material or a thickness that can transmit light at least in the visible region, Is realized. In this case, the insulating layer that transmits light and the substrate 100 also need to have a light-transmitting property with respect to at least light in the visible region.

ここで、図9(A)及び(B)で示す発光素子を有する発光表示パネルの画素回路、及び
その動作構成について、図11を用いて説明する。発光表示パネルの動作構成は、ビデオ
信号がデジタルの表示装置において、画素に入力されるビデオ信号が電圧で規定されるの
ものと、電流で規定されるものとがある。ビデオ信号が電圧によって規定されるものには
、発光素子に印加される電圧が一定のもの(CVCV)と、発光素子に印加される電流が
一定のもの(CVCC)とがある。また、ビデオ信号が電流によって規定されるものには
、発光素子に印加される電圧が一定のもの(CCCV)と、発光素子に印加される電流が
一定のもの(CCCC)とがある。本実施例では、CVCV動作をする画素を図11(A
)及び(B)用いて説明する。また、CVCC動作をする画素を図11(C)を用いて説
明する。
Here, a pixel circuit of a light-emitting display panel including the light-emitting elements illustrated in FIGS. 9A and 9B and an operation structure thereof will be described with reference to FIGS. There are two types of operation configurations of the light-emitting display panel, in which a video signal input to a pixel is defined by voltage and a current is defined by current in a display device in which a video signal is digital. There are two types of video signals defined by voltage, one having a constant voltage applied to the light emitting element (CVCV) and one having a constant current applied to the light emitting element (CVCC). In addition, a video signal is defined by current, there are a constant voltage applied to the light emitting element (CCCV) and a constant current applied to the light emitting element (CCCC). In this embodiment, the pixel performing the CVCV operation is shown in FIG.
) And (B). A pixel that performs the CVCC operation will be described with reference to FIG.

図11(A)及び(B)に示す画素は、列方向に信号線3710及び電源線3711、行
方向に走査線3714が配置される。また、スイッチング用TFT3701、駆動用TF
T3703、容量素子3702及び発光素子3705を有する。
In the pixel shown in FIGS. 11A and 11B, a signal line 3710 and a power supply line 3711 are arranged in the column direction, and a scanning line 3714 is arranged in the row direction. Also, switching TFT 3701, driving TF
T3703, a capacitor 3702, and a light-emitting element 3705 are included.

なお、スイッチング用TFT3701及び駆動用TFT3703は、オンしているときは
線形領域で動作する。また駆動用TFT3703は発光素子3705に電圧を印加するか
否かを制御する役目を有する。両TFTは同じ導電型を有していると作製工程上好ましい
。また駆動用TFT3703には、エンハンスメント型だけでなく、ディプリーション型
のTFTを用いてもよい。また、駆動用TFT3703のチャネル幅Wとチャネルと長L
の比(W/L)は、TFTの移動度にもよるが1〜1000であることが好ましい。W/
Lが大きいほど、TFTの電気特性が向上する。
Note that the switching TFT 3701 and the driving TFT 3703 operate in a linear region when turned on. The driving TFT 3703 has a role of controlling whether or not a voltage is applied to the light emitting element 3705. Both TFTs preferably have the same conductivity type in terms of manufacturing process. The driving TFT 3703 may be a depletion type TFT as well as an enhancement type. Further, the channel width W, channel and length L of the driving TFT 3703
The ratio (W / L) is preferably 1 to 1000, depending on the mobility of the TFT. W /
The larger L is, the better the electrical characteristics of the TFT.

図11(A)、(B)に示す画素において、スイッチング用TFT3701は、画素に対
するビデオ信号の入力を制御するものであり、スイッチング用TFT3701がオンとな
ると、画素内にビデオ信号が入力される。すると、容量素子3702にそのビデオ信号の
電圧が保持される。
In the pixel shown in FIGS. 11A and 11B, the switching TFT 3701 controls input of a video signal to the pixel. When the switching TFT 3701 is turned on, the video signal is input into the pixel. Then, the voltage of the video signal is held in the capacitor 3702.

図11(A)において、電源線3711がVssで発光素子3705の対向電極がVdd
の場合、発光素子の対向電極は陽極であり、駆動用TFT3703に接続される電極は陰
極である。この場合、駆動用TFT3703の特性バラツキによる輝度ムラを抑制するこ
とが可能である。
In FIG. 11A, the power supply line 3711 is Vss and the counter electrode of the light emitting element 3705 is Vdd.
In this case, the counter electrode of the light emitting element is an anode, and the electrode connected to the driving TFT 3703 is a cathode. In this case, luminance unevenness due to characteristic variations of the driving TFT 3703 can be suppressed.

図11(A)において、電源線3711がVddで発光素子3705の対向電極がVss
の場合、発光素子の対向電極は陰極であり、駆動用TFT3703に接続される電極は陽
極である。この場合、Vddより電圧の高いビデオ信号を信号線3710に入力すること
により、容量素子3702にそのビデオ信号の電圧が保持され、駆動用TFT3703が
線形領域で動作するので、TFTのバラツキによる輝度ムラを改善することが可能である
In FIG. 11A, the power supply line 3711 is Vdd and the counter electrode of the light emitting element 3705 is Vss.
In this case, the counter electrode of the light emitting element is a cathode, and the electrode connected to the driving TFT 3703 is an anode. In this case, when a video signal having a voltage higher than Vdd is input to the signal line 3710, the voltage of the video signal is held in the capacitor 3702, and the driving TFT 3703 operates in a linear region. It is possible to improve.

図11(B)に示す画素は、TFT3706と走査線3715を追加している以外は、図
11(A)に示す画素構成と同じである。
The pixel shown in FIG. 11B has the same pixel structure as that shown in FIG. 11A except that a TFT 3706 and a scanning line 3715 are added.

TFT3706は、新たに配置された走査線3715によりオン又はオフが制御される。
TFT3706がオンとなると、容量素子3702に保持された電荷は放電し、駆動用T
FT3703がオフとなる。つまり、TFT3706の配置により、強制的に発光素子3
705に電流が流れない状態を作ることができる。そのためTFT3706を消去用のT
FTと呼ぶことができる。従って、図11(B)の構成は、全ての画素に対する信号の書
き込みを待つことなく、書き込み期間の開始と同時又は直後に点灯期間を開始することが
できるため、発光のデューティ比を向上することが可能となる。
The TFT 3706 is controlled to be turned on or off by a newly arranged scanning line 3715.
When the TFT 3706 is turned on, the electric charge held in the capacitor 3702 is discharged, and the driving T
FT 3703 is turned off. In other words, the light emitting element 3 is forcibly arranged by the arrangement of the TFT 3706.
A state in which no current flows through 705 can be created. For this reason, the TFT 3706 is used for erasing T.
It can be called FT. Accordingly, the structure in FIG. 11B can improve the light emission duty ratio because the lighting period can be started simultaneously with or immediately after the start of the writing period without waiting for signal writing to all the pixels. Is possible.

上記動作構成を有する画素において、発光素子3705の電流値は、線形領域で動作する
駆動用TFT3703により決定することができる。上記構成により、TFTの特性のバ
ラツキを抑制することが可能であり、TFT特性のバラツキに起因した発光素子の輝度ム
ラを改善して、画質を向上させた表示装置を提供することができる。
In the pixel having the above operation configuration, the current value of the light-emitting element 3705 can be determined by the driving TFT 3703 that operates in a linear region. With the above structure, variation in TFT characteristics can be suppressed, and luminance unevenness of a light-emitting element due to variation in TFT characteristics can be improved, so that a display device with improved image quality can be provided.

次に、CVCC動作をする画素を図11(C)を用いて説明する。図11(C)に示す画
素は、図11(A)に示す画素構成に、電源線3712、電流制御用TFT3704が設
けられている。なお、図11(C)に示す画素において、駆動用TFT3703のゲート
電極を、行方向に配置された電源線3712を、列方向に配置された電源線3712に接
続してもよい。
Next, a pixel that performs the CVCC operation will be described with reference to FIG. In the pixel illustrated in FIG. 11C, a power supply line 3712 and a current control TFT 3704 are provided in the pixel configuration illustrated in FIG. Note that in the pixel illustrated in FIG. 11C, the gate electrode of the driving TFT 3703 may be connected to the power supply line 3712 arranged in the row direction with the power supply line 3712 arranged in the column direction.

なお、スイッチング用TFT3701は線形領域で動作し、駆動用TFT3703は飽
和領域で動作する。また駆動用TFT3703は発光素子3705に流れる電流値を制御
する役目を有し、電流制御用TFT3704は飽和領域で動作し発光素子3705に対す
る電流の供給を制御する役目を有する。
Note that the switching TFT 3701 operates in a linear region, and the driving TFT 3703 operates in a saturation region. The driving TFT 3703 has a role of controlling a current value flowing through the light emitting element 3705, and the current controlling TFT 3704 has a role of operating in a saturation region and controlling supply of current to the light emitting element 3705.

なお、図11(A)及び(B)に示される画素でも、CVCC動作をすることは可能であ
る。また、図11(C)に示される動作構成を有する画素は、図11(A)及び(B)と
同様に、発光素子の電流の流れる方向によって、Vdd及びVssを適宜変えることが可
能である。
Note that the CVCC operation can be performed even in the pixels shown in FIGS. In addition, in the pixel having the operation configuration illustrated in FIG. 11C, Vdd and Vss can be changed as appropriate depending on the direction in which the current of the light-emitting element flows, as in FIGS. 11A and 11B. .

上記構成を有する画素は、電流制御用TFT3704が線形領域で動作するために、電流
制御用TFT3704のVgsの僅かな変動は、発光素子3705の電流値に影響を及ぼ
さない。つまり、発光素子3705の電流値は、飽和領域で動作する駆動用TFT370
3により決定することができる。上記構成により、TFTの特性バラツキに起因した発光
素子の輝度ムラを改善して、画質を向上させた表示装置を提供することができる。
In the pixel having the above structure, since the current control TFT 3704 operates in a linear region, a slight change in Vgs of the current control TFT 3704 does not affect the current value of the light emitting element 3705. That is, the current value of the light emitting element 3705 is the driving TFT 370 operating in the saturation region.
3 can be determined. With the above structure, it is possible to provide a display device in which luminance unevenness of a light-emitting element due to variation in TFT characteristics is improved and image quality is improved.

特に、非晶質半導体等を有する薄膜トランジスタを形成する場合、駆動用TFTの半導体
膜の面積を大きくすると、TFTのバラツキの低減が可能であるため好ましい。また、図
11(A)及び図11(B)に示す画素は、TFTの数が少ないため開口率を増加させる
ことが可能である。
In particular, in the case of forming a thin film transistor having an amorphous semiconductor or the like, it is preferable to increase the area of the semiconductor film of the driving TFT because the variation of the TFT can be reduced. In addition, the pixel shown in FIGS. 11A and 11B can increase the aperture ratio because the number of TFTs is small.

なお、容量素子3702を設けた構成を示したが、本発明はこれに限定されず、ビデオ信
号を保持する容量がゲート容量などで、まかなうことが可能な場合には、容量素子370
2を設けなくてもよい。
Note that although a structure including the capacitor 3702 is shown, the present invention is not limited to this, and the capacitor 370 can be used when a capacitor for holding a video signal can be covered by a gate capacitor or the like.
2 may not be provided.

また、薄膜トランジスタの半導体層が非晶質半導体膜で形成される場合は、しきい値がシ
フトしやすいため、しきい値を補正する回路を画素内又は画素周辺に設けることが好まし
い。
In addition, when the semiconductor layer of the thin film transistor is formed using an amorphous semiconductor film, a threshold value is likely to shift. Therefore, a circuit for correcting the threshold value is preferably provided in or around the pixel.

このようなアクティブマトリクス型の発光装置は、画素密度が増えた場合、各画素にTF
Tが設けられているため低電圧駆動でき、有利であると考えられている。一方、パッシブ
マトリクス型の発光装置を形成することもできる。パッシブマトリクス型の発光装置は、
各画素にTFTが設けられていないため、高開口率となる。
Such an active matrix light-emitting device has a TF for each pixel when the pixel density increases.
Since T is provided, it can be driven at a low voltage, which is considered advantageous. On the other hand, a passive matrix light-emitting device can also be formed. Passive matrix light emitting devices
Since each pixel is not provided with a TFT, the aperture ratio is high.

また、本発明の表示装置において、画面表示の駆動方法は特に限定されず、例えば、点順
次駆動方法や線順次駆動方法や面順次駆動方法などを用いればよい。代表的には、線順次
駆動方法とし、時分割階調駆動方法や面積階調駆動方法を適宜用いればよい。また、表示
装置のソース線に入力する映像信号は、アナログ信号であってもよいし、デジタル信号で
あってもよく、適宜、映像信号に合わせて駆動回路などを設計すればよい。
In the display device of the present invention, the screen display driving method is not particularly limited. For example, a dot sequential driving method, a line sequential driving method, a surface sequential driving method, or the like may be used. Typically, a line sequential driving method is used, and a time-division gray scale driving method or an area gray scale driving method may be used as appropriate. The video signal input to the source line of the display device may be an analog signal or a digital signal, and a drive circuit or the like may be designed in accordance with the video signal as appropriate.

以上のように、多様な画素回路を採用することができる。 As described above, various pixel circuits can be employed.

本実施の形態に示す発光表示パネルの作製方法を用いることにより、複雑なフォトリソグ
ラフィ工程を用いることなく配線間の開口(コンタクトホール)を形成することができ、
かつ配線の電気的コンタクトを良好にとることができる。よって、材料のロスが少なく、
高性能、高信頼性の発光表示パネルを歩留まりよく作製することができる。
By using the method for manufacturing the light-emitting display panel described in this embodiment, an opening (contact hole) between wirings can be formed without using a complicated photolithography process.
In addition, the electrical contact of the wiring can be satisfactorily taken. Therefore, there is little loss of material,
A high-performance and highly reliable light-emitting display panel can be manufactured with high yield.

(実施の形態5)
本実施の形態では、半導体装置の代表例を、図12及び図13を用いて説明する。電気泳
動素子とは、マイクロカプセルの中にプラスとマイナスに帯電した黒と白の粒子を閉じ込
めた物を第1の導電層及び第2の導電層の間に配置し、第1の導電層及び第2の導電層に
電位差を生じさせて黒と白の粒子を電極間で移動させて表示を行う素子である。
(Embodiment 5)
In this embodiment, a typical example of a semiconductor device will be described with reference to FIGS. An electrophoretic element is a microcapsule in which a positive and negative charged black and white particle is confined between a first conductive layer and a second conductive layer. This is an element that performs display by causing a potential difference in the second conductive layer to move black and white particles between electrodes.

図12に示すように、基板100上に実施の形態2で示す薄膜トランジスタ188、及び
薄膜トランジスタ188を覆い、且つフェムト秒レーザを用いて形成した開口部を有する
絶縁層191を形成する。
As illustrated in FIG. 12, the thin film transistor 188 described in Embodiment 2 and the insulating layer 191 having an opening formed using a femtosecond laser are formed over the substrate 100.

次に、配線187に接続する第1の導電層1181を形成する。なお、第1の導電層11
81は画素電極として機能する。ここでは、液滴吐出法を用いて選択的にアルニウムを用
いて第1の導電層1181を形成する。
Next, a first conductive layer 1181 connected to the wiring 187 is formed. The first conductive layer 11
Reference numeral 81 functions as a pixel electrode. Here, the first conductive layer 1181 is formed selectively using aluminum by a droplet discharge method.

また、基板1172上に第2の導電層1173を形成する。第2の導電層1173も平行
に形成することが好ましい。ここでは、酸化亜鉛を用いて第2の導電層1173を形成す
る。
In addition, a second conductive layer 1173 is formed over the substrate 1172. The second conductive layer 1173 is also preferably formed in parallel. Here, the second conductive layer 1173 is formed using zinc oxide.

次に、基板100及び基板1172をシール材で貼り合わせる。このとき、第1の導電層
1181及び第2の導電層1173の間にマイクロカプセル1170を分散させて、基板
100及び基板1172の間に電気泳動素子を形成する。基板100及び基板1172は
、第1の導電層11811及び第2の導電層1173が交差するように、シール材を用い
て貼りあわせる。また、電気泳動素子は、第1の導電層1181、マイクロカプセル11
70、第2の導電層1173で構成される。また、マイクロカプセル1170はバインダ
により第1の導電層11811及び第2の導電層1173の間に固定される。
Next, the substrate 100 and the substrate 1172 are attached to each other with a sealant. At this time, the microcapsules 1170 are dispersed between the first conductive layer 1181 and the second conductive layer 1173, so that an electrophoretic element is formed between the substrate 100 and the substrate 1172. The substrate 100 and the substrate 1172 are attached to each other with a sealant so that the first conductive layer 11811 and the second conductive layer 1173 intersect. The electrophoretic element includes a first conductive layer 1181 and a microcapsule 11.
70 and the second conductive layer 1173. The microcapsule 1170 is fixed between the first conductive layer 11811 and the second conductive layer 1173 with a binder.

次に、マイクロカプセルの構造について、図13を用いて示す。図13(A)及び(B)
に示すように、マイクロカプセル1170は微細な透明容器1174内に透明の分散媒1
176及び帯電した黒色粒子1175a及び白色粒子1175bが分散される。なお、黒
色粒子1175aの代わりに、青色粒子、赤色粒子、緑色粒子、黄色粒子、青緑粒子、赤
紫粒子を用いても良い。さらには、図13(C)及び(D)に示すように、微細な透明容
器1331内に着色した分散媒1333及び白色粒子1332が分散されるマイクロカプ
セル1330を用いてもよい。なお、着色した分散媒1333は、黒色、青色、赤色、緑
色、黄色、青緑色、赤紫色のいずれかに着色している。また、一画素に青色粒子、赤色粒
子、緑色粒子が分散されるマイクロカプセルをそれぞれ設けることで、カラー表示するこ
とができる。また、黄色粒子、青緑粒子、赤紫粒子が分散されるマイクロカプセルをそれ
ぞれ設けることで、カラー表示することができる。また、一画素に青色、赤色、緑色の分
散媒を有するマイクロカプセルを配列して設けることで、カラー表示することができる。
また、一画素に黄色、青緑色、赤紫色の分散媒を有するマイクロカプセルを配列して設け
ることで、カラー表示することができる。
Next, the structure of the microcapsule will be described with reference to FIG. 13A and 13B
As shown in FIG. 2, the microcapsule 1170 has a transparent dispersion medium 1 in a fine transparent container 1174.
176 and charged black particles 1175a and white particles 1175b are dispersed. Instead of the black particles 1175a, blue particles, red particles, green particles, yellow particles, blue green particles, and red purple particles may be used. Further, as shown in FIGS. 13C and 13D, a microcapsule 1330 in which a colored dispersion medium 1333 and white particles 1332 are dispersed in a fine transparent container 1331 may be used. Note that the colored dispersion medium 1333 is colored in any one of black, blue, red, green, yellow, blue-green, and magenta. Further, by providing each pixel with microcapsules in which blue particles, red particles, and green particles are dispersed, color display can be performed. In addition, by providing microcapsules in which yellow particles, blue-green particles, and red-violet particles are dispersed, color display can be performed. Further, color display can be performed by arranging microcapsules having blue, red, and green dispersion media in one pixel.
In addition, color display can be performed by arranging microcapsules having yellow, blue-green, and magenta dispersion media in one pixel.

次に、電気泳動素子を用いた表示方法を示す。具体的には、図13(A)及び(B)を用
いて、二色の粒子を有するマイクロカプセル1170の表示方法について示す。ここでは
、二色の粒子として白色粒子及び黒色粒子を用い、また透明な分散媒を有するマイクロカ
プセルについて示す。なお、二色の粒子の黒色粒子の代わりに他の色の粒子を用いてもよ
い。
Next, a display method using an electrophoretic element will be described. Specifically, a display method of the microcapsule 1170 having two-color particles is described with reference to FIGS. Here, a microcapsule using white particles and black particles as two-color particles and having a transparent dispersion medium is shown. Note that particles of other colors may be used instead of the black particles of the two colors.

マイクロカプセル1170において、黒色粒子1175aがプラスに帯電されているもの
とし、白色粒子1175bがマイナスに帯電されているものとし、第1の導電層1171
及び第2の導電層1173に電界を印加する。ここでは、第2の導電層から第1の導電層
の方向へ電界が印加されると、図13(A)に示すように、第2の導電層1173側に黒
色粒子1175aが泳動し、第1の導電層1171側に白色粒子1175bが泳動する。
この結果、マイクロカプセルを第1の導電層1171側から見た場合には、白色に観察さ
れ、第2の導電層1173側から見た場合には黒色に観察される。
In the microcapsule 1170, the black particles 1175a are positively charged, the white particles 1175b are negatively charged, and the first conductive layer 1171 is charged.
An electric field is applied to the second conductive layer 1173. Here, when an electric field is applied in the direction from the second conductive layer to the first conductive layer, as shown in FIG. 13A, the black particles 1175a migrate to the second conductive layer 1173 side, and the first White particles 1175b migrate to one conductive layer 1171 side.
As a result, when the microcapsule is viewed from the first conductive layer 1171 side, it is observed as white, and when viewed from the second conductive layer 1173 side, it is observed as black.

一方、第1の導電層1171から第2の導電層1173の方向へ電界が印加されると、図
13(B)に示すように、第1の導電層1171側に黒色粒子1175aが泳動し、第2
の導電層1173側に白色粒子1175bが泳動する。この結果、マイクロカプセルを第
1の導電層1171側から見た場合には、白色に観察され、第2の導電層1173側から
見た場合には黒色に観察される。
On the other hand, when an electric field is applied in the direction from the first conductive layer 1171 to the second conductive layer 1173, the black particles 1175a migrate to the first conductive layer 1171 side as shown in FIG. Second
The white particles 1175b migrate to the conductive layer 1173 side. As a result, when the microcapsule is viewed from the first conductive layer 1171 side, it is observed as white, and when viewed from the second conductive layer 1173 side, it is observed as black.

次に、白色粒子を有し、且つ着色された分散媒を有するマイクロカプセル1330の表示
方法について示す。ここでは、分散媒が黒色に着色された例を示すが、他の色に着色され
た分散媒を用いても同様である。
Next, a display method of the microcapsule 1330 including white particles and a colored dispersion medium is described. Here, an example in which the dispersion medium is colored in black is shown, but the same applies even when a dispersion medium colored in another color is used.

マイクロカプセル1330において、白色粒子1332がマイナスに帯電されているもの
とし、第1の導電層1171及び第2の導電層1173に電界を印加する。ここでは、第
2の導電層から第1の導電層の方向へ電界が印加されると、図13(C)に示すように、
第1の導電層1171側に白色粒子1175bが泳動する。この結果、マイクロカプセル
を第1の導電層1171側から見た場合には、白色に観察され、第2の導電層1173側
から見た場合には黒色に観察される。
In the microcapsule 1330, the white particles 1332 are negatively charged, and an electric field is applied to the first conductive layer 1171 and the second conductive layer 1173. Here, when an electric field is applied from the second conductive layer toward the first conductive layer, as shown in FIG.
White particles 1175b migrate to the first conductive layer 1171 side. As a result, when the microcapsule is viewed from the first conductive layer 1171 side, it is observed as white, and when viewed from the second conductive layer 1173 side, it is observed as black.

一方、第1の導電層から第2の導電層の方向へ電界が印加されると、図13(D)に示す
ように、第2の導電層1173側に白色粒子1175bが泳動する、この結果、マイクロ
カプセルを第1の導電層1171側から見た場合には、白色に観察され、第2の導電層1
173側から見た場合には黒色に観察される。
On the other hand, when an electric field is applied in the direction from the first conductive layer to the second conductive layer, white particles 1175b migrate to the second conductive layer 1173 side as shown in FIG. When the microcapsule is viewed from the first conductive layer 1171 side, the microcapsule is observed as white, and the second conductive layer 1
When viewed from the 173 side, it is observed as black.

ここで、電気泳動素子を用いて説明したが、この代わりにツイストボール表示方式を用い
た表示装置を用いてもよい。ツイストボール表示方式とは、白と黒に塗り分けられた球形
粒子を第1の導電層及び第2の導電層の間に配置し、第1の導電層及び第2の導電層に電
位差を生じさせての球形粒子の向きを制御することにより、表示を行う方法である。
Here, the electrophoretic element has been described, but a display device using a twisting ball display method may be used instead. In the twisting ball display method, spherical particles that are separately painted in white and black are arranged between the first conductive layer and the second conductive layer, and a potential difference is generated between the first conductive layer and the second conductive layer. In this method, display is performed by controlling the orientation of the spherical particles.

また、薄膜トランジスタの代わりに、スイッチング素子としてMIM(Metal−In
sulator−Metal)、ダイオード等を用いることもできる。
Further, instead of a thin film transistor, MIM (Metal-In) is used as a switching element.
Sulator-Metal), a diode, or the like can also be used.

電気泳動素子を有する表示装置やツイストボール表示方式の表示装置は、電界効果トラン
ジスタを取り去った後も長期にわたって、電界印加時と同様の状態を保持する。よって、
電源を切っても表示状態を維持することが可能である。このため低消費電力が可能で有る
A display device having an electrophoretic element or a display device using a twisting ball display system maintains the same state as when an electric field is applied for a long time after the field effect transistor is removed. Therefore,
The display state can be maintained even when the power is turned off. For this reason, low power consumption is possible.

以上の工程により、電気泳動素子を含む半導体装置を作製することができる。 Through the above steps, a semiconductor device including an electrophoretic element can be manufactured.

本実施の形態に示す電気泳動素子を含む半導体装置の作製方法を用いることにより、複雑
なフォトリソグラフィ工程を用いることなく配線間の開口(コンタクトホール)を形成す
ることができ、かつ配線の電気的コンタクトを良好にとることができる。よって、材料の
ロスが少なく、高性能、高信頼性の電気泳動素子を含む半導体装置を歩留まりよく作製す
ることができる。
By using the method for manufacturing a semiconductor device including an electrophoretic element described in this embodiment, an opening (contact hole) between wirings can be formed without using a complicated photolithography process, and electrical wiring can be electrically connected. Good contact can be made. Thus, a semiconductor device including a high-performance and highly reliable electrophoretic element with little material loss can be manufactured with high yield.

(実施の形態6)
実施の形態3〜5によって作製される表示パネル(EL表示パネル、液晶表示パネル、電
気泳動表示パネル)において、半導体層を非晶質半導体、又はSASで形成し、走査線側
の駆動回路を基板上に形成する例を示す。
(Embodiment 6)
In a display panel (an EL display panel, a liquid crystal display panel, or an electrophoretic display panel) manufactured according to Embodiments 3 to 5, a semiconductor layer is formed using an amorphous semiconductor or SAS, and a driver circuit on the scanning line side is used as a substrate The example formed above is shown.

図14は、1〜15cm/V・secの電界効果移動度が得られるSASを使ったnチ
ャネル型のTFTで構成する走査線側駆動回路のブロック図を示している。
FIG. 14 shows a block diagram of a scanning line side driving circuit constituted by an n-channel TFT using SAS that can obtain a field effect mobility of 1 to 15 cm 2 / V · sec.

図14において8500で示すブロックが1段分のサンプリングパルスを出力するパルス
出力回路に相当し、シフトレジスタはn個のパルス出力回路により構成される。8501
はバッファ回路であり、その先に画素8502が接続される。
In FIG. 14, a block denoted by reference numeral 8500 corresponds to a pulse output circuit that outputs a sampling pulse for one stage, and the shift register includes n pulse output circuits. 8501
Is a buffer circuit to which a pixel 8502 is connected.

図15は、パルス出力回路8500の具体的な構成を示したものであり、nチャネル型の
TFT8601〜8612で回路が構成されている。このとき、SASを使ったnチャネ
ル型のTFTの動作特性を考慮して、TFTのサイズを決定すれば良い。例えば、チャネ
ル長を8μmとすると、チャネル幅は10〜80μmの範囲で設定することができる。
FIG. 15 shows a specific structure of the pulse output circuit 8500, and the circuit is composed of n-channel TFTs 8601 to 8612. At this time, the size of the TFT may be determined in consideration of the operating characteristics of the n-channel TFT using SAS. For example, if the channel length is 8 μm, the channel width can be set in the range of 10 to 80 μm.

また、バッファ回路8501の具体的な構成を図16に示す。バッファ回路も同様にnチ
ャネル型のTFT8620〜8635で構成されている。このとき、SASを使ったnチ
ャネル型のTFTの動作特性を考慮して、TFTのサイズを決定すれば良い。例えば、チ
ャネル長を10μmとすると、チャネル幅は10〜1800μmの範囲で設定することと
なる。
A specific structure of the buffer circuit 8501 is shown in FIG. Similarly, the buffer circuit includes n-channel TFTs 8620 to 8635. At this time, the size of the TFT may be determined in consideration of the operating characteristics of the n-channel TFT using SAS. For example, if the channel length is 10 μm, the channel width is set in the range of 10 to 1800 μm.

このような回路を実現するには、TFT相互を配線によって接続する必要がある。 In order to realize such a circuit, it is necessary to connect the TFTs by wiring.

以上のようにして、表示パネルに駆動回路を組み入れることができる。 As described above, a driver circuit can be incorporated in the display panel.

次に、上記実施例に示した表示パネルへの駆動回路の実装について、図17を用いて説明
する。
Next, mounting of a driver circuit on the display panel described in the above embodiment will be described with reference to FIGS.

図17(A)に示すように、画素部1701の周辺にソース線駆動回路1702、及びゲ
ート線駆動回路1703a、1703bを実装する。図17(A)では、ソース線駆動回
路1702、及びゲート線駆動回路1703a、1703b等として、公知の異方性導電
接着剤、及び異方性導電フィルムを用いた実装方法、COG方式、ワイヤボンディング方
法、並びに半田バンプを用いたリフロー処理等により、基板1700上にICチップ17
05を実装する。ここでは、COG方式を用いる。そして、FPC(フレキシブルプリン
トサーキット)1706を介して、ICチップと外部回路とを接続する。
As shown in FIG. 17A, a source line driver circuit 1702 and gate line driver circuits 1703a and 1703b are mounted around the pixel portion 1701. In FIG. 17A, as a source line driver circuit 1702 and gate line driver circuits 1703a and 1703b, a mounting method using a known anisotropic conductive adhesive and an anisotropic conductive film, a COG method, wire bonding The IC chip 17 is formed on the substrate 1700 by a method and a reflow process using a solder bump.
05 is implemented. Here, the COG method is used. Then, the IC chip and an external circuit are connected through an FPC (flexible printed circuit) 1706.

なお、ソース線駆動回路1702の一部、例えばアナログスイッチを基板上に形成し、か
つその他の部分を別途ICチップで実装してもよい。
Note that a part of the source line driver circuit 1702, for example, an analog switch may be formed over the substrate, and the other part may be separately mounted using an IC chip.

また、図17(B)に示すように、SASや結晶性半導体でTFTを形成する場合、画素
部1701とゲート線駆動回路1703a、1703b等を基板上に形成し、ソース線駆
動回路1702等を別途ICチップとして実装する場合がある。図17(B)において、
ソース線駆動回路1702として、COG方式により、基板1700上にICチップ17
05を実装する。そして、FPC1706を介して、ICチップと外部回路とを接続する
As shown in FIG. 17B, when a TFT is formed using a SAS or a crystalline semiconductor, the pixel portion 1701, gate line driver circuits 1703a and 1703b, and the like are formed over the substrate, and the source line driver circuit 1702 and the like are formed. It may be mounted as an IC chip separately. In FIG. 17B,
As the source line driver circuit 1702, the IC chip 17 is formed on the substrate 1700 by the COG method.
05 is implemented. Then, the IC chip and an external circuit are connected via the FPC 1706.

なお、ソース線駆動回路1702の一部、例えばアナログスイッチを基板上に形成し、か
つその他の部分を別途ICチップで実装してもよい。
Note that a part of the source line driver circuit 1702, for example, an analog switch may be formed over the substrate, and the other part may be separately mounted using an IC chip.

さらに、図17(C)に示すように、COG方式に代えて、TAB方式によりソース線駆
動回路1702等を実装する場合がある。そして、FPC1706を介して、ICチップ
と外部回路とを接続する。図17(C)において、ソース線駆動回路をTAB方式により
実装しているが、ゲート線駆動回路をTAB方式により実装してもよい。
Further, as shown in FIG. 17C, a source line driver circuit 1702 and the like may be mounted by a TAB method instead of the COG method. Then, the IC chip and an external circuit are connected via the FPC 1706. Although the source line driver circuit is mounted by a TAB method in FIG. 17C, the gate line driver circuit may be mounted by a TAB method.

ICチップをTAB方式により実装すると、基板に対して画素部を大きく設けることがで
き、狭額縁化を達成することができる。
When the IC chip is mounted by the TAB method, a pixel portion can be provided larger than the substrate, and a narrow frame can be achieved.

ICチップは、シリコンウェハを用いて形成するが、ICチップの代わりにガラス基板上
に回路を形成したIC(以下、ドライバICと表記する)を設けてもよい。ICチップは
、円形のシリコンウェハからICチップを取り出すため、母体基板形状に制約がある。一
方ドライバICは、母体基板がガラスであり、形状に制約がないため、生産性を高めるこ
とができる。そのため、ドライバICの形状寸法は自由に設定することができる。例えば
、ドライバICの長辺の長さを15〜80mmとして形成すると、ICチップを実装する
場合と比較し、必要な数を減らすことができる。その結果、接続端子数を低減することが
でき、製造上の歩留まりを向上させることができる。
The IC chip is formed using a silicon wafer, but an IC (hereinafter referred to as a driver IC) in which a circuit is formed on a glass substrate may be provided instead of the IC chip. Since an IC chip is taken out from a circular silicon wafer, the shape of the base substrate is limited. On the other hand, the driver IC has a mother substrate made of glass and has no restriction in shape, so that productivity can be improved. Therefore, the shape of the driver IC can be set freely. For example, when the length of the long side of the driver IC is 15 to 80 mm, the required number can be reduced as compared with the case where the IC chip is mounted. As a result, the number of connection terminals can be reduced, and the manufacturing yield can be improved.

ドライバICは、基板上に形成された結晶質半導体を用いて形成することができ、結晶質
半導体は連続発振型のレーザビーム又は周波数10MHz以上のパルスレーザを照射する
ことで形成するとよい。連続発振型のレーザビームを照射して得られる半導体膜は、結晶
欠陥が少なく、大粒径の結晶粒を有する。その結果、このような半導体膜を有するトラン
ジスタは、移動度や応答速度が良好となり、高速駆動が可能となり、ドライバICに好適
である。
The driver IC can be formed using a crystalline semiconductor formed over a substrate, and the crystalline semiconductor is preferably formed by irradiation with a continuous wave laser beam or a pulse laser with a frequency of 10 MHz or more. A semiconductor film obtained by irradiation with a continuous wave laser beam has few crystal defects and large crystal grains. As a result, a transistor having such a semiconductor film has favorable mobility and response speed, can be driven at high speed, and is suitable for a driver IC.

次に、上記実施例で示される表示パネルを有するモジュールについて、図18を用いて説
明する。図18は表示パネル9801と、回路基板9802を組み合わせたモジュールを
示している。回路基板9802には、例えば、コントロール回路9804や信号分割回路
9805などが形成されている。また、表示パネル9801と回路基板9802とは、接
続配線9803で接続されている。表示パネル9801に実施例1乃至3で示すような、
液晶表示パネル、発光表示パネル、電気泳動表示パネル等を適宜用いることができる。
Next, a module having the display panel shown in the above embodiment will be described with reference to FIG. FIG. 18 shows a module in which a display panel 9801 and a circuit board 9802 are combined. On the circuit board 9802, for example, a control circuit 9804, a signal dividing circuit 9805, and the like are formed. In addition, the display panel 9801 and the circuit board 9802 are connected by a connection wiring 9803. As shown in Embodiments 1 to 3 on the display panel 9801,
A liquid crystal display panel, a light-emitting display panel, an electrophoretic display panel, or the like can be used as appropriate.

この表示パネル9801は、発光素子が各画素に設けられた画素部9806と、走査線駆
動回路9807、選択された画素にビデオ信号を供給する信号線駆動回路9808を備え
ている。画素部9806の構成は、実施の形態3乃至5と同様である。また、走査線駆動
回路9807や信号線駆動回路9808は、異方性導電接着剤、及び異方性導電フィルム
を用いた実装方法、COG方式、ワイヤボンディング方法、並びに半田バンプを用いたリ
フロー処理等の手法により、基板上にICチップで形成される走査線駆動回路9807、
信号線駆動回路9808を実装する。
This display panel 9801 includes a pixel portion 9806 in which a light-emitting element is provided in each pixel, a scanning line driver circuit 9807, and a signal line driver circuit 9808 that supplies a video signal to a selected pixel. The structure of the pixel portion 9806 is similar to that in Embodiment Modes 3 to 5. The scanning line driver circuit 9807 and the signal line driver circuit 9808 are a mounting method using an anisotropic conductive adhesive and an anisotropic conductive film, a COG method, a wire bonding method, a reflow process using a solder bump, and the like. The scanning line driving circuit 9807 formed with an IC chip on the substrate by the method of
A signal line driver circuit 9808 is mounted.

本実施例により、歩留まり高く表示パネルを有するモジュールを形成することが可能であ
る。
According to this embodiment, a module having a display panel can be formed with high yield.

(実施の形態7)
上記実施の形態や示される半導体装置を有する電子機器として、テレビジョン装置(単に
テレビ、又はテレビジョン受信機ともよぶ)、デジタルカメラ、デジタルビデオカメラ、
携帯電話装置(単に携帯電話機、携帯電話ともよぶ)、PDA等の携帯情報端末、携帯型
ゲーム機、コンピュータ用のモニター、コンピュータ、カーオーディオ等の音響再生装置
、家庭用ゲーム機等の記録媒体を備えた画像再生装置等が挙げられる。その具体例につい
て、図19を参照して説明する。
(Embodiment 7)
As electronic devices each including the semiconductor device described in the above embodiment and the present invention, a television device (also simply referred to as a television or a television receiver), a digital camera, a digital video camera,
Recording media such as mobile phone devices (simply called mobile phones and mobile phones), personal digital assistants such as PDAs, portable game machines, computer monitors, computers, sound reproduction devices such as car audio, and home game machines And an image reproducing apparatus provided. A specific example will be described with reference to FIG.

図19(A)に示す携帯情報端末は、本体9201、表示部9202等を含んでいる。表
示部9202に、上記実施の形態に示すものを適用することにより、高性能な携帯情報端
末を容易に作製することができる。
A portable information terminal illustrated in FIG. 19A includes a main body 9201, a display portion 9202, and the like. By applying the display portion 9202 to the one described in the above embodiment, a high-performance portable information terminal can be easily manufactured.

図19(B)に示すデジタルビデオカメラは、表示部9701、表示部9702等を含ん
でいる。表示部9701に、上記実施の形態に示すものを適用することにより、高性能な
デジタルビデオカメラを容易に作製することができる。
A digital video camera shown in FIG. 19B includes a display portion 9701, a display portion 9702, and the like. By applying the display portion 9701 to any of the above embodiments, a high-performance digital video camera can be easily manufactured.

図19(C)に示す携帯端末は、本体9101、表示部9102等を含んでいる。表示部
9102に、上記実施の形態に示すものを適用することにより、高性能な携帯端末を容易
に作製することができる。
A portable terminal illustrated in FIG. 19C includes a main body 9101, a display portion 9102, and the like. By applying the display portion 9102 to any of the above embodiments, a high-performance portable terminal can be easily manufactured.

図19(D)に示す携帯型のテレビジョン装置は、本体9301、表示部9302等を含
んでいる。表示部9302に、上記実施の形態に示すものを適用することにより、高性能
な携帯型のテレビジョン装置を容易に作製することができる。このようなテレビジョン装
置は携帯電話などの携帯端末に搭載する小型のものから、持ち運びをすることができる中
型のもの、また、大型のもの(例えば40インチ以上)まで、幅広く適用することができ
る。
A portable television device shown in FIG. 19D includes a main body 9301, a display portion 9302, and the like. By applying the display portion 9302 to the one described in the above embodiment, a high-performance portable television device can be easily manufactured. Such a television device can be widely applied from a small one mounted on a portable terminal such as a cellular phone to a medium-sized one that can be carried and a large one (for example, 40 inches or more). .

図19(E)に示す携帯型のコンピュータは、本体9401、表示部9402等を含んで
いる。表示部9402に、上記実施の形態に示すものを適用することにより、高性能な携
帯型のコンピュータを容易に作製することができる。
A portable computer shown in FIG. 19E includes a main body 9401, a display portion 9402, and the like. By applying the display portion 9402 to any of the above embodiments, a high-performance portable computer can be easily manufactured.

図19(F)に示すテレビジョン装置は、本体9601、表示部9602等を含んでいる
。表示部9602に、上記実施の形態に示すものを適用することにより、高性能なテレビ
ジョン装置を容易に作製することができる。
A television set illustrated in FIG. 19F includes a main body 9601, a display portion 9602, and the like. By applying the display portion 9602 to the display portion 9602, a high-performance television device can be easily manufactured.

ここで、テレビジョン装置の構成について、図20を用いて説明する。 Here, a configuration of the television device will be described with reference to FIG.

図20は、テレビジョン装置の主要な構成を示すブロック図である。チューナ9511は
映像信号と音声信号を受信する。映像信号は、映像検波回路9512と、そこから出力さ
れる信号を赤、緑、青の各色に対応した色信号に変換する映像信号処理回路9513と、
その映像信号をドライバICの入力仕様に変換するためのコントロール回路9514によ
り処理される。コントロール回路9514は、表示パネル9515の走査線駆動回路95
16と信号線駆動回路9517にそれぞれ信号が出力する。デジタル駆動する場合には、
信号線側に信号分割回路9518を設け、入力デジタル信号をm個に分割して供給する構
成としても良い。
FIG. 20 is a block diagram illustrating a main configuration of a television device. A tuner 9511 receives a video signal and an audio signal. The video signal includes a video detection circuit 9512, a video signal processing circuit 9513 that converts a signal output from the video detection circuit 9512 into a color signal corresponding to each color of red, green, and blue,
The video signal is processed by a control circuit 9514 for converting the input signal into the input specification of the driver IC. The control circuit 9514 is a scanning line driving circuit 95 of the display panel 9515.
16 and the signal line driver circuit 9517 respectively. When driving digitally,
A signal dividing circuit 9518 may be provided on the signal line side so that an input digital signal is divided into m pieces and supplied.

なお、テレビジョン装置を構成する各回路には、上記実施の形態で示したTFTを用いる
ことができる。上記実施の形態に示すTFTは、フェムト秒レーザを用いることにより複
雑なフォトリソグラフィ工程を用いることなく配線間の開口(コンタクトホール)を形成
することができ、かつ配線の電気的コンタクトを良好にとることができる。よって、材料
のロスが少なく、高性能、高信頼性なテレビジョン装置を歩留まりよく作製することがで
きる。
Note that the TFT described in any of the above embodiments can be used for each circuit included in the television device. The TFT described in any of the above embodiments can form an opening (contact hole) between wirings without using a complicated photolithography process by using a femtosecond laser, and can have excellent electrical contact between the wirings. be able to. Therefore, a high-performance and highly reliable television device with low material loss can be manufactured with high yield.

図20において、チューナ9511で受信した信号のうち、音声信号は音声検波回路95
21に送られ、その出力は音声信号処理回路9522を経てスピーカー9523に供給さ
れる。制御回路9524は受信局(受信周波数)や音量の制御情報を入力部9525から
受け、チューナ9511や音声信号処理回路9522に信号を送出する。
In FIG. 20, among the signals received by the tuner 9511, the audio signal is the audio detection circuit 95.
21, and the output is supplied to the speaker 9523 through the audio signal processing circuit 9522. The control circuit 9524 receives control information on the receiving station (reception frequency) and volume from the input unit 9525 and sends a signal to the tuner 9511 and the audio signal processing circuit 9522.

このテレビジョン装置は、表示パネル9515を含んで構成されることにより、テレビジ
ョン装置の低消費電力を図ることが可能である。
This television device includes the display panel 9515, whereby low power consumption of the television device can be achieved.

なお、本発明はテレビ受像機に限定されず、パーソナルコンピュータのモニターをはじめ
、鉄道の駅や空港などにおける情報表示盤や、街頭における広告表示盤など特に大面積の
表示媒体として様々な用途に適用することができる。
Note that the present invention is not limited to a television receiver, and is applicable to various uses as a display medium of a particularly large area such as a monitor of a personal computer, an information display board in a railway station or airport, an advertisement display board in a street, etc. can do.

720 基板
721 導電層
722 光透過層
724 導電性材料
725 開口部
726 導電層
720 Substrate 721 Conductive layer 722 Light transmission layer 724 Conductive material 725 Opening 726 Conductive layer

Claims (23)

基板上に第1の導電層を形成し、
前記第1の導電層上に絶縁層を形成し、
レーザを照射することにより、前記第1の導電層及び前記絶縁層に開口部を形成し、
前記開口部に導電性材料を含む組成物を吐出して、前記第1の導電層と電気的に接続する第2の導電層を形成することを特徴とする半導体装置の作製方法。
Forming a first conductive layer on the substrate;
Forming an insulating layer on the first conductive layer;
By irradiating with a laser, an opening is formed in the first conductive layer and the insulating layer,
A method for manufacturing a semiconductor device, wherein a composition containing a conductive material is discharged into the opening to form a second conductive layer that is electrically connected to the first conductive layer.
請求項1において、
前記開口部において前記絶縁層の端部を、前記第1の導電層の端部より内側に形成することを特徴とする半導体装置の作製方法。
In claim 1,
A method for manufacturing a semiconductor device, wherein an end portion of the insulating layer is formed inside the opening portion from an end portion of the first conductive layer.
請求項1または請求項2において、
前記レーザを照射する前に、前記絶縁層の表面に撥液処理を行うことを特徴とする半導体装置の作製方法。
In claim 1 or claim 2,
A method for manufacturing a semiconductor device, wherein a liquid repellent treatment is performed on a surface of the insulating layer before the laser irradiation.
請求項1乃至請求項3のいずれか一において、
前記絶縁層は透光性を有することを特徴とする半導体装置の作製方法。
In any one of Claim 1 thru | or 3,
The method for manufacturing a semiconductor device, wherein the insulating layer has a light-transmitting property.
請求項1乃至請求項4のいずれか一において、
前記レーザはフェムト秒レーザであることを特徴とする半導体装置の作製方法。
In any one of Claims 1 thru | or 4,
The method for manufacturing a semiconductor device, wherein the laser is a femtosecond laser.
請求項5において、
前記フェムト秒レーザはSapphire、YAG、セラミックスYAG、セラミックスY、KGW、KYW、MgSiO、YLF、YVO、又はGdVOのいずれかの結晶に、Nd、Yb、Cr、Ti、Ho、又はErのいずれかのドーパントを添加したレーザであることを特徴とする半導体装置の作製方法。
In claim 5,
The femtosecond laser is formed of any one of Sapphire, YAG, ceramics YAG, ceramics Y 2 O 3 , KGW, KYW, Mg 2 SiO 4 , YLF, YVO 4 , or GdVO 4 , with Nd, Yb, Cr, Ti, A method for manufacturing a semiconductor device, which is a laser to which a dopant of either Ho or Er is added.
基板上に第1の薄膜トランジスタと第2の薄膜トランジスタを形成し、
前記第1の薄膜トランジスタ上に第1の配線を形成し、
前記第2の薄膜トランジスタ上に第2の配線を形成し、
前記第1の配線と前記第2の配線上に絶縁層を形成し、
レーザを照射することにより、前記第1の配線及び前記絶縁層に第1の開口部と、前記第2の配線及び前記絶縁層に第2の開口部を形成し、
前記第1の開口部と前記第2の開口部に導電性材料を含む組成物を吐出して、前記第1の開口部に第1の画素電極、前記第2の開口部に第2の画素電極を形成し、
前記第1の画素電極は、前記第1の配線を介して前記第1の薄膜トランジスタと電気的に接続し、
前記第2の画素電極は、前記第2の配線を介して前記第2の薄膜トランジスタと電気的に接続し、
前記第1の画素電極と前記第2の画素電極は液晶の配向を制御することを特徴とする表示装置の作製方法。
Forming a first thin film transistor and a second thin film transistor on a substrate;
Forming a first wiring on the first thin film transistor;
Forming a second wiring on the second thin film transistor;
Forming an insulating layer on the first wiring and the second wiring;
By irradiating with a laser, a first opening is formed in the first wiring and the insulating layer, and a second opening is formed in the second wiring and the insulating layer,
A composition containing a conductive material is discharged into the first opening and the second opening, and the first pixel electrode is discharged to the first opening and the second pixel is discharged to the second opening. Forming electrodes,
The first pixel electrode is electrically connected to the first thin film transistor through the first wiring;
The second pixel electrode is electrically connected to the second thin film transistor through the second wiring;
A method for manufacturing a display device, wherein the first pixel electrode and the second pixel electrode control alignment of liquid crystal.
請求項7において、
前記第1の開口部における前記絶縁層の端部を、前記第1の配線の端部より内側に形成し、
前記第2の開口部における前記絶縁層の端部を、前記第2の配線の端部より内側に形成することを特徴とする表示装置の作製方法。
In claim 7,
Forming an end portion of the insulating layer in the first opening portion inside an end portion of the first wiring;
A method for manufacturing a display device, wherein an end portion of the insulating layer in the second opening is formed inside an end portion of the second wiring.
請求項7または請求項8において、
前記第1の画素電極と前記第2の画素電極はスリットにより分離されていることを特徴とする表示装置の作製方法。
In claim 7 or claim 8,
The method for manufacturing a display device, wherein the first pixel electrode and the second pixel electrode are separated by a slit.
基板上にゲート電極層を形成し、
前記ゲート電極層上にゲート絶縁層を形成し、
前記ゲート絶縁層上に第1の半導体層を形成し、
前記第1の半導体層上に一導電型を有する第2の半導体層を形成し、
前記第2の半導体層上に前記第2の半導体層と電気的に接続する配線を形成し、
前記配線上に絶縁層を形成し、
レーザを照射することにより、前記配線及び前記絶縁層に開口部を形成し、
前記開口部に導電性材料を含む組成物を吐出して、前記配線と電気的に接続する電極層を形成することを特徴とする表示装置の作製方法。
Forming a gate electrode layer on the substrate;
Forming a gate insulating layer on the gate electrode layer;
Forming a first semiconductor layer on the gate insulating layer;
Forming a second semiconductor layer having one conductivity type on the first semiconductor layer;
Forming a wiring electrically connected to the second semiconductor layer on the second semiconductor layer;
Forming an insulating layer on the wiring;
By irradiating with a laser, an opening is formed in the wiring and the insulating layer,
A method for manufacturing a display device, wherein an electrode layer electrically connected to the wiring is formed by discharging a composition containing a conductive material into the opening.
基板上に薄膜トランジスタを形成し、
前記薄膜トランジスタ上に配線を形成し、
前記配線上に絶縁層を形成し、
レーザを照射することにより、前記配線及び前記絶縁層に開口部を形成し、
前記開口部に導電性材料を含む組成物と吐出して、前記配線を介して前記薄膜トランジスタと電気的に接続する画素電極を形成し、
前記画素電極上にマイクロカプセルを設け、
前記マイクロカプセル上に導電層を形成することを特徴とする表示装置の作製方法。
A thin film transistor is formed on the substrate,
Forming a wiring on the thin film transistor;
Forming an insulating layer on the wiring;
By irradiating with a laser, an opening is formed in the wiring and the insulating layer,
Discharging a composition containing a conductive material in the opening to form a pixel electrode electrically connected to the thin film transistor through the wiring;
A microcapsule is provided on the pixel electrode,
A method for manufacturing a display device, comprising forming a conductive layer over the microcapsule.
請求項10または請求項11において、
前記開口部における前記絶縁層の端部を、前記配線の端部より内側に形成することを特徴とする表示装置の作製方法。
In claim 10 or claim 11,
A method for manufacturing a display device, wherein an end portion of the insulating layer in the opening is formed inside an end portion of the wiring.
請求項7乃至請求項12のいずれか一において、
前記レーザを照射する前に、前記絶縁層の表面に撥液処理を行うことを特徴とする表示装置の作製方法。
In any one of Claims 7 to 12,
A method for manufacturing a display device, wherein a liquid repellent treatment is performed on a surface of the insulating layer before the laser irradiation.
請求項7乃至請求項13のいずれか一において、
前記絶縁層は透光性を有することを特徴とする表示装置の作製方法。
In any one of Claims 7 thru | or 13,
The method for manufacturing a display device, wherein the insulating layer has a light-transmitting property.
請求項7乃至請求項14のいずれか一において、
前記レーザはフェムト秒レーザであることを特徴とする表示装置の作製方法。
In any one of Claims 7 thru | or 14,
The method for manufacturing a display device, wherein the laser is a femtosecond laser.
請求項15において、
前記フェムト秒レーザは、Sapphire、YAG、セラミックスYAG、セラミックスY、KGW、KYW、MgSiO、YLF、YVO、又はGdVOのいずれかの結晶に、Nd、Yb、Cr、Ti、Ho、又はErのいずれかのドーパントを添加したレーザであることを特徴とする表示装置の作製方法。
In claim 15,
The femtosecond laser is formed of any one of Sapphire, YAG, ceramics YAG, ceramics Y 2 O 3 , KGW, KYW, Mg 2 SiO 4 , YLF, YVO 4 , or GdVO 4 , with Nd, Yb, Cr, Ti A method for manufacturing a display device, which is a laser to which a dopant of any one of H, Ho, and Er is added.
基板上に薄膜トランジスタを形成し、
前記薄膜トランジスタ上に配線を形成し、
前記配線上に第1の絶縁層を形成し、
第1のレーザを照射することにより、前記配線及び前記第1の絶縁層に開口部を形成し、
前記開口部に導電性材料を含む組成物を吐出して、前記配線を介して前記薄膜トランジスタと電気的に接続する画素電極を形成し、
前記画素電極上に第2の絶縁層を形成し、
第2のレーザを照射することにより、前記画素電極を露出させ、
前記画素電極の露出部及び前記第2の絶縁層上の一部に発光物質を有する層を形成し、
前記発光物質を有する層上に導電層を形成することを特徴とする表示装置の作製方法。
A thin film transistor is formed on the substrate,
Forming a wiring on the thin film transistor;
Forming a first insulating layer on the wiring;
By irradiating the first laser, an opening is formed in the wiring and the first insulating layer,
A composition containing a conductive material is discharged into the opening to form a pixel electrode that is electrically connected to the thin film transistor through the wiring.
Forming a second insulating layer on the pixel electrode;
By irradiating the second laser, the pixel electrode is exposed,
Forming a layer having a light emitting material on a part of the exposed portion of the pixel electrode and the second insulating layer;
A manufacturing method of a display device, wherein a conductive layer is formed over the layer including the light-emitting substance.
請求項17において、
前記開口部における前記第1の絶縁層の端部を、前記配線の端部より内側に形成することを特徴とする表示装置の作製方法。
In claim 17,
A manufacturing method of a display device, wherein an end portion of the first insulating layer in the opening is formed inside an end portion of the wiring.
請求項17または請求項18において、
前記第1のレーザを照射する前に、前記第2の絶縁層の表面に撥液処理を行うことを特徴とする表示装置の作製方法。
In claim 17 or claim 18,
A method for manufacturing a display device, wherein a liquid repellent treatment is performed on a surface of the second insulating layer before the first laser irradiation.
請求項17乃至請求項19のいずれか一において、
前記第2のレーザを照射する前に、前記第2の絶縁層の表面に撥液処理を行うことを特徴とする表示装置の作製方法。
In any one of Claims 17-19,
A method for manufacturing a display device, wherein a liquid repellent treatment is performed on a surface of the second insulating layer before the second laser irradiation.
請求項17乃至請求項20のいずれか一において、
前記第1の絶縁層及び前記第2の絶縁層の少なくとも一方は透光性を有することを特徴とする表示装置の作製方法。
In any one of claims 17 to 20,
A method for manufacturing a display device, wherein at least one of the first insulating layer and the second insulating layer has a light-transmitting property.
請求項17乃至請求項21のいずれか一において、
前記第1のレーザ及び第2のレーザの少なくとも一方はフェムト秒レーザであることを特徴とする表示装置の作製方法。
In any one of Claims 17 to 21,
A method for manufacturing a display device, wherein at least one of the first laser and the second laser is a femtosecond laser.
請求項22において、
前記フェムト秒レーザは、Sapphire、YAG、セラミックスYAG、セラミックスY、KGW、KYW、MgSiO、YLF、YVO、又はGdVOのいずれかの結晶に、Nd、Yb、Cr、Ti、Ho、又はErのいずれかのドーパントを添加したレーザであることを特徴とする表示装置の作製方法。
In claim 22,
The femtosecond laser is formed of any one of Sapphire, YAG, ceramics YAG, ceramics Y 2 O 3 , KGW, KYW, Mg 2 SiO 4 , YLF, YVO 4 , or GdVO 4 , with Nd, Yb, Cr, Ti A method for manufacturing a display device, which is a laser to which a dopant of any one of H, Ho, and Er is added.
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