JP2011258962A - Photovoltaic device, tft and i-type semiconductor layer forming method - Google Patents

Photovoltaic device, tft and i-type semiconductor layer forming method Download PDF

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隆治 近藤
Masafumi Sano
政史 佐野
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享 林
Akira Sakai
明 酒井
Shotaro Okabe
正太郎 岡部
Shuichiro Sugiyama
秀一郎 杉山
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Abstract

PROBLEM TO BE SOLVED: To provide a silicon-based thin film having a short tact time, high deposition rate and superior characteristics to offer a low-cost, high-performance thin film and a semiconductor element including the silicon-based thin film, and to provide a semiconductor element made from the silicon-based thin film, exhibitting superior sticking properties and environmental resistance.SOLUTION: In an interface region between an i-type semiconductor layer and a p-type or n-type semiconductor layer which is a ground layer for the i-type semiconductor layer, a crystallite in an interface region 1.0 nm and over to 20 nm from the boundary face between the i-type semiconductor layer and the p-type or n-type semiconductor layer is preferentially oriented to (100) plane. The orientation on (220) plane, which is a ratio of a diffraction intensity on (220) plane relative to the whole diffraction intensity by an X-ray or electron beam of the crystallite in a thickness direction of the i-type semiconductor layer, is small on the side of the p-type or n-type semiconductor layer which is a ground layer for the i-type semiconductor layer and changes in a gradually increasing manner as distanced away from the ground layer.

Description

本発明はシリコン系薄膜からなり半導体接合を有する半導体素子、及びシリコン系薄膜の形成方法に関するものである。   The present invention relates to a semiconductor element made of a silicon-based thin film and having a semiconductor junction, and a method for forming a silicon-based thin film.

pin接合を有する光起電力素子において実質的に光吸収層として機能するi型半導体層を結晶相を含むi型半導体層とした場合には、アモルファスの場合に問題になるステブラー−ロンスキー(Staebler−Wronski)効果による光劣化現象を抑制することができるメリットがあるために、i型半導体層を結晶相を含む構成とすることは効果的である。また高精細高輝度の液晶パネルのためには高移動度のTFTが求められているが、結晶相のシリコンTFTは、非晶質相のシリコンTFTに比べて2桁以上大きな移動度を持つために、TFT特性が大幅に向上し、TFTのゲート幅を微細化しても、回路動作に必要な電流値を十分に確保することができ、非晶質のシリコンTFTと比べて画素ピッチを細かくとることができるために、装置の小型化、高精細化が比較的容易になる。   When an i-type semiconductor layer that substantially functions as a light absorption layer in a photovoltaic device having a pin junction is an i-type semiconductor layer containing a crystal phase, a Stebler-Lonsky (Staebler- Since there is a merit that the light deterioration phenomenon due to the Wronski effect can be suppressed, it is effective that the i-type semiconductor layer includes a crystal phase. In addition, high-mobility TFTs are required for high-definition, high-brightness liquid crystal panels, but crystalline silicon TFTs have a mobility that is two orders of magnitude greater than amorphous-phase silicon TFTs. In addition, the TFT characteristics are greatly improved, and even if the gate width of the TFT is reduced, a current value necessary for circuit operation can be sufficiently secured, and the pixel pitch is made finer than that of an amorphous silicon TFT. Therefore, downsizing and high definition of the device are relatively easy.

以上のことを背景に、結晶相を含むシリコン系薄膜について、さまざまな取り組みが行なわれている。   Against this background, various efforts have been made on silicon-based thin films containing crystal phases.

高周波プラズマCVD法は、大面積化や低温形成が容易であり、プロセススループットが向上する点からも、シリコン系薄膜の量産化に対してすぐれた方法の一つである。シリコン系薄膜を製品へと応用した例として太陽電池やカラー液晶TFTなどがあげられるが、普及を進めるためにはさらなる低コスト化、高性能化が必要である。そのためには、高周波プラズマCVD法に関する技術の確立は重要な技術課題の一つとなっている。   The high-frequency plasma CVD method is one of excellent methods for mass production of silicon-based thin films from the viewpoint of easy area enlargement and low-temperature formation and improved process throughput. Examples of the application of silicon-based thin films to products include solar cells and color liquid crystal TFTs, but further cost reduction and higher performance are necessary in order to promote widespread use. For that purpose, the establishment of the technology relating to the high-frequency plasma CVD method has become one of the important technical issues.

結晶質シリコン系薄膜層に関しては、(220)面を成長面としたものとして、特許文献1に、(220)の回折強度の割合が全回折強度の割合の30%以上であることを特徴としたシリコン系薄膜が開示されている。   With respect to the crystalline silicon-based thin film layer, the (220) plane is used as the growth plane, and Patent Document 1 is characterized in that the ratio of the diffraction intensity of (220) is 30% or more of the ratio of the total diffraction intensity. A silicon-based thin film is disclosed.

また、i型半導体層が微結晶シリコンからなるpin接合を有する半導体層を有するものの一例として、前記i型半導体内部の結晶の配向性が層の深さ方向で変化している光起電力素子が特許文献2に開示されている。   In addition, as an example of an i-type semiconductor layer having a semiconductor layer having a pin junction made of microcrystalline silicon, there is a photovoltaic element in which the crystal orientation in the i-type semiconductor is changed in the depth direction of the layer. It is disclosed in Patent Document 2.

特開平11−310495号公報JP-A-11-310495 特開平11−233803号公報JP-A-11-233803

前述のようにすでに開示されているシリコン系薄膜は優れた特性を示すものであるが、特許文献1のシリコン系薄膜では(220)面が優先配向したシリコン系薄膜ではあるものの、配向性の分布については触れられていない。また特許文献2のシリコン系薄膜では、(220)面に優先配向されたシリコン系薄膜については触れられていない。   As described above, the silicon-based thin film already disclosed exhibits excellent characteristics. However, the silicon-based thin film disclosed in Patent Document 1 is a silicon-based thin film in which the (220) plane is preferentially oriented. Is not mentioned. Further, in the silicon thin film of Patent Document 2, the silicon thin film preferentially oriented in the (220) plane is not mentioned.

本発明は、さらなる低コストで、優れた性能をもつシリコン系薄膜を提供するために、タクトタイムが短くて、さらなる高速の成膜速度で特性のすぐれたシリコン系薄膜と、それを含む半導体素子。さらにこのシリコン系薄膜を用いた密着性、耐環境性などに優れた半導体素子を提供することを目的としている。   In order to provide a silicon-based thin film having excellent performance at a lower cost, the present invention provides a silicon-based thin film having a short tact time and excellent characteristics at a further high deposition rate, and a semiconductor device including the same . It is another object of the present invention to provide a semiconductor element having excellent adhesion and environmental resistance using the silicon-based thin film.

本発明は、基板上にシリコン原子を主成分としたp型半導体層と、i型半導体層と、n型半導体層とを備えたpin型の半導体接合を少なくとも1組含む光起電力素子であって、前記i型半導体層が微結晶と、1.0×1019atoms/cm以上2.5×1020atoms/cm以下のフッ素原子と、を含み、前記i型半導体層と前記i型半導体層の下地層である前記p型半導体層またはn型半導体層との界面領域であって前記i型半導体層と前記p型半導体層またはn型半導体層との界面から1.0nm以上20nm以下の界面領域の微結晶が(100)面に優先配向しており、前記i型半導体層の層厚方向における前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合である(220)面の配向性が前記i型半導体層の下地層である前記p型半導体層又は前記n型半導体層側では小さく、前記下地層から離れるに伴って大きくなるように変化することを特徴とする光起電力素子を提供する。また本発明は、基板上にゲート電極、ゲート絶縁膜、活性層、コンタクト層、ソース電極、ドレイン電極とを有するTFTであって、前記ゲート電極と前記活性層との間に前記ゲート絶縁膜が配され、前記活性層と前記ソース電極又は前記ドレイン電極との間に前記コンタクト層が配されており、前記活性層は微結晶と、1.0×1019atoms/cm以上2.5×1020atoms/cm以下のフッ素原子と、を含み、前記活性層と前記活性層の下地層である前記ゲート絶縁層との界面領域であって前記活性層と前記ゲート絶縁層との界面から1.0nm以上20nm以下の界面領域の微結晶が(100)面に優先配向しており、前記活性層の層厚方向における前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合である(220)面の配向性が前記ゲート絶縁膜側では小さく、前記ゲート絶縁膜から離れるに伴って大きくなるように変化することを特徴とするTFTを提供する。 The present invention is a photovoltaic device including at least one set of a pin-type semiconductor junction including a p-type semiconductor layer containing silicon atoms as a main component, an i-type semiconductor layer, and an n-type semiconductor layer on a substrate. The i-type semiconductor layer includes microcrystals and fluorine atoms of 1.0 × 10 19 atoms / cm 3 to 2.5 × 10 20 atoms / cm 3 , and the i-type semiconductor layer and the i An interface region between the p-type semiconductor layer and the n-type semiconductor layer, which is a base layer of the p-type semiconductor layer, and 1.0 nm to 20 nm from the interface between the i-type semiconductor layer and the p-type semiconductor layer or the n-type semiconductor layer The microcrystals in the following interface region are preferentially oriented in the (100) plane, and the diffraction intensity of the (220) plane by the X-rays or electron beams of the microcrystal in the layer thickness direction of the i-type semiconductor layer with respect to the total diffraction intensity It is a ratio (22 (0) The orientation of the plane is small on the p-type semiconductor layer or n-type semiconductor layer side, which is the base layer of the i-type semiconductor layer, and changes so as to increase with distance from the base layer. A photovoltaic device is provided. The present invention also provides a TFT having a gate electrode, a gate insulating film, an active layer, a contact layer, a source electrode, and a drain electrode on a substrate, wherein the gate insulating film is interposed between the gate electrode and the active layer. The contact layer is disposed between the active layer and the source electrode or the drain electrode, and the active layer includes microcrystals, 1.0 × 10 19 atoms / cm 3 or more and 2.5 × 10 20 atoms / cm 3 or less of fluorine atoms, and is an interface region between the active layer and the gate insulating layer that is a base layer of the active layer, from the interface between the active layer and the gate insulating layer Microcrystals in the interface region of 1.0 nm or more and 20 nm or less are preferentially oriented in the (100) plane, and diffraction of the (220) plane by X-rays or electron beams of the microcrystals in the layer thickness direction of the active layer. There is provided a TFT characterized in that the orientation of the (220) plane, which is the ratio of the intensity to the total diffraction intensity, is small on the gate insulating film side and increases as the distance from the gate insulating film increases.

本発明は、シリコン系薄膜からなる半導体接合を有する半導体素子において、前記シリコン系薄膜の少なくともひとつが微結晶を含んでおり、前記微結晶を含むシリコン系薄膜が、真空容器内に、水素化シリコン、フッ素化シリコンガスの少なくとも一方と、水素を含む原料ガスを導入し、前記真空容器内の高周波導入部に高周波を導入して、高周波プラズマ法を用いて前記真空容器内に導入した基板上に形成された微結晶を含むシリコン系薄膜であって、前記基板の加熱手段が前記基板に対して前記微結晶を含むシリコン系薄膜の形成面とは反対側に配置され、前記加熱手段の出力を前記微結晶を含むシリコン系薄膜の形成とともに低下させることを特徴とした半導体素子を提供する。   According to the present invention, in a semiconductor device having a semiconductor junction made of a silicon-based thin film, at least one of the silicon-based thin films contains microcrystals, and the silicon-based thin film containing the microcrystals is contained in a silicon hydride in a vacuum vessel. Introducing at least one of a fluorinated silicon gas and a source gas containing hydrogen, introducing a high frequency into a high frequency introducing portion in the vacuum vessel, and introducing the high frequency into the vacuum vessel using a high frequency plasma method A silicon-based thin film containing microcrystals formed, wherein the substrate heating means is disposed on the opposite side of the substrate from the surface on which the silicon-based thin film containing microcrystals is formed, and the output of the heating means is Provided is a semiconductor device characterized in that the semiconductor element is lowered with the formation of the silicon-based thin film containing the microcrystal.

本発明は、p型半導体層、n型半導体層又は絶縁層から選択される下地層の上に微結晶を含んだシリコン原子を主成分とするi型半導体層の形成方法であって、真空容器内に水素化シリコン、フッ素化シリコンガスの少なくとも一方と、水素を含む原料ガスとを導入し、前記水素化シリコン、フッ素化シリコンガスの少なくとも一方又は前記水素を含む原料ガス流量の比率を変化させて、エッチング効果の低い雰囲気で、水素を成長面に供給することにより、前記i型半導体層が1.0×1019atoms/cm3以上2.5×1020atoms/cm以下のフッ素原子を含み、前記i型半導体層と前記i型半導体層の下地層である前記p型半導体層またはn型半導体層との界面領域であって前記i型半導体層と前記p型半導体層またはn型半導体層との界面から1.0nm以上20nm以下の界面領域の微結晶が(100)面に優先配向しており、前記i型半導体層の膜厚方向における前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合である(220)面の配向性が前記シリコン系薄膜の形成初期には小さく、膜の堆積に伴って大きくなるように変化させることを特徴とするi型半導体層の形成方法を提供する。 The present invention relates to a method for forming an i-type semiconductor layer containing silicon atoms containing microcrystals as a main component on a base layer selected from a p-type semiconductor layer, an n-type semiconductor layer, or an insulating layer, and a vacuum vessel At least one of silicon hydride and fluorinated silicon gas and a source gas containing hydrogen are introduced, and at least one of the silicon hydride and fluorinated silicon gas or the ratio of the flow rate of the source gas containing hydrogen is changed. Then, by supplying hydrogen to the growth surface in an atmosphere with a low etching effect, the i-type semiconductor layer can contain fluorine atoms of 1.0 × 10 19 atoms / cm 3 or more and 2.5 × 10 20 atoms / cm 3 or less. An interface region between the i-type semiconductor layer and the p-type semiconductor layer or the n-type semiconductor layer that is a base layer of the i-type semiconductor layer, the i-type semiconductor layer and the p-type semiconductor layer. The crystallites in the interface region of 1.0 nm or more and 20 nm or less from the interface with the n-type semiconductor layer are preferentially oriented in the (100) plane, and the X-rays or electrons of the microcrystal in the film thickness direction of the i-type semiconductor layer The orientation of the (220) plane, which is the ratio of the diffraction intensity of the (220) plane by the line to the total diffraction intensity, is small at the initial stage of formation of the silicon-based thin film, and is changed so as to increase as the film is deposited. A method for forming an i-type semiconductor layer is provided.

本発明は、微結晶を含んだシリコン系薄膜の形成方法であって、前記微結晶を含むシリコン系薄膜が、真空容器内に、水素化シリコン、フッ素化シリコンガスの少なくとも一方と、水素を含む原料ガスを導入し、前記真空容器内の高周波導入部に高周波を導入して、高周波プラズマ法を用いて前記真空容器内に導入した基板上に形成された微結晶を含むシリコン系薄膜の形成方法であって、前記基板の加熱手段が前記基板に対して前記微結晶を含むシリコン系薄膜の形成面とは反対側に配置され、前記加熱手段の出力を前記微結晶を含むシリコン系薄膜の形成とともに低下させることを特徴としたシリコン系薄膜の形成方法を提供する。   The present invention is a method for forming a silicon-based thin film containing microcrystals, wherein the silicon-based thin film containing microcrystals contains hydrogen in at least one of silicon hydride and fluorinated silicon gas in a vacuum vessel. A method of forming a silicon-based thin film including microcrystals formed on a substrate introduced into a vacuum vessel by introducing a source gas, introducing a high frequency into a high frequency introduction portion in the vacuum vessel, and introducing the high frequency plasma method into the vacuum vessel The heating means for the substrate is disposed on the opposite side of the substrate from the formation surface of the silicon-based thin film containing the microcrystals, and the output of the heating means is used to form the silicon-based thin film containing the microcrystals. The present invention also provides a method for forming a silicon-based thin film, which is characterized by being lowered together.

前記半導体素子が、基板上にシリコン原子を主成分とした第一の導電型を示す半導体層、i型半導体層、第二の導電型を示す半導体層が順次積層されたpin型の半導体接合を少なくとも1組含む光起電力素子であって、前記i型半導体層の少なくともひとつが微結晶を含んだシリコン系薄膜を含み、前記シリコン系薄膜中の前記微結晶の配向性が、前記シリコン系薄膜の膜厚方向で変化することが好ましい。前記微結晶を含むシリコン系薄膜と、前記シリコン系薄膜に対して光入射側に配置されている導電形を示す半導体層の間に、非晶質シリコン層を配置したことが好ましい。前記微結晶を含むシリコン系薄膜と、前記第二の導電形を示す半導体層の間に、非晶質シリコン層を配置することが好ましい。前記非晶質シリコン層の膜厚が30nm以下であることが好ましい。前記微結晶の配向性の変化は、前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合が、前記シリコン系薄膜の膜厚方向で変化することであることが好ましい。前記微結晶の配向性の変化が、前記微結晶を含むシリコン系薄膜における、前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合が、成膜初期において相対的に小さいことが好ましい。前記微結晶の配向性の変化が連続的であることが好ましい。前記微結晶を含むシリコン系薄膜が、前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合が80%以上である領域を含むことが好ましい。前記微結晶を含むシリコン系薄膜中で、(110)面の優先配向をしている微結晶が、前記基板に対して鉛直方向に伸びた柱状の形状をしていることが好ましい。前記微結晶を含むシリコン系薄膜の界面領域の微結晶が(100)面の優先配向をしていることが好ましい。前記界面領域の微結晶が概球状の形状をしていることが好ましい。前記界面領域の厚さが1.0nm以上20nm以下であることが好ましい。前記微結晶を含むシリコン系薄膜が、酸素原子、炭素原子、窒素原子の少なくともひとつを含み、それらの総量が1.5×1018atoms/cm以上5.0×1019atoms/cm以下であることが好ましい。前記微結晶を含むシリコン系薄膜が、1.0×1019atoms/cm以上2.5×1020atoms/cm以下のフッ素原子を含むことが好ましい。前記微結晶を含むシリコン系薄膜が、真空容器内に水素化シリコン、フッ素化シリコンガスの少なくとも一方と、水素を含む原料ガスを導入し、前記真空容器内の高周波導入部に高周波を導入して、前記真空容器内に導入した基板上に前記シリコン系薄膜を形成する高周波プラズマCVD法によって行なわれたものであることが好ましい。前記微結晶を含むシリコン系薄膜を形成する過程で、前記原料ガス中のガス流量の比率を変化させることが好ましい。前記原料ガスを前記真空容器内に複数のガス導入部を用いて導入し、前記複数のガス導入部のうち少なくともひとつは他とは異なったガス流量比の原料ガスを流していることが好ましい。前記高周波の周波数が10MHz以上10GHz以下であることが好ましい。前記高周波の周波数が20MHz以上300MHz以下であることが好ましい。前記高周波導入部と前記基板との距離が3mm以上30mm以下であることが好ましい。前記微結晶を含むシリコン系薄膜を形成する際の圧力が100Pa(0.75Torr)以上5000Pa(37.5Torr)以下であることが好ましい。前記微結晶を含むシリコン系薄膜を形成する際の前記原料ガスの滞留時間が、0.01秒以上10秒以下であることが好ましい。前記微結晶を含むシリコン系薄膜を形成する際の前記原料ガスの滞留時間が、0.1秒以上3秒以下であることが好ましい。 The semiconductor element has a pin-type semiconductor junction in which a semiconductor layer having a first conductivity type mainly composed of silicon atoms, an i-type semiconductor layer, and a semiconductor layer having a second conductivity type are sequentially stacked on a substrate. A photovoltaic device comprising at least one set, wherein at least one of the i-type semiconductor layers includes a silicon-based thin film containing microcrystals, and the orientation of the microcrystals in the silicon-based thin film is It is preferable to change in the film thickness direction. It is preferable that an amorphous silicon layer is disposed between the silicon-based thin film containing the microcrystals and the semiconductor layer having a conductivity type disposed on the light incident side with respect to the silicon-based thin film. It is preferable to dispose an amorphous silicon layer between the silicon-based thin film containing microcrystals and the semiconductor layer exhibiting the second conductivity type. The film thickness of the amorphous silicon layer is preferably 30 nm or less. The change in orientation of the microcrystal is that the ratio of the diffraction intensity of the (220) plane by the X-ray or electron beam of the microcrystal to the total diffraction intensity changes in the film thickness direction of the silicon-based thin film. preferable. The change in the orientation of the microcrystal is such that the ratio of the diffraction intensity of the (220) plane by the X-ray or electron beam of the microcrystal to the total diffraction intensity in the silicon-based thin film containing the microcrystal is relatively small in the initial stage of film formation. Is preferably small. The change in orientation of the microcrystals is preferably continuous. It is preferable that the silicon-based thin film containing the microcrystal includes a region where the ratio of the diffraction intensity of the (220) plane by the X-ray or electron beam of the microcrystal to the total diffraction intensity is 80% or more. In the silicon-based thin film containing the microcrystals, it is preferable that the microcrystals having a preferential orientation of the (110) plane have a columnar shape extending in the vertical direction with respect to the substrate. It is preferable that the microcrystal in the interface region of the silicon-based thin film containing the microcrystal has a (100) plane preferential orientation. It is preferable that the crystallites in the interface region have a substantially spherical shape. The interface region preferably has a thickness of 1.0 nm or more and 20 nm or less. The silicon-based thin film including the microcrystal includes at least one of oxygen atom, carbon atom, and nitrogen atom, and the total amount thereof is 1.5 × 10 18 atoms / cm 3 or more and 5.0 × 10 19 atoms / cm 3 or less. It is preferable that It is preferable that the silicon-based thin film including the microcrystal includes fluorine atoms of 1.0 × 10 19 atoms / cm 3 or more and 2.5 × 10 20 atoms / cm 3 or less. The silicon-based thin film containing microcrystals introduces a source gas containing at least one of silicon hydride and fluorinated silicon gas and hydrogen into a vacuum vessel, and introduces a high frequency into a high frequency introduction portion in the vacuum vessel. It is preferable that the etching be performed by a high-frequency plasma CVD method for forming the silicon-based thin film on a substrate introduced into the vacuum vessel. In the process of forming the silicon-based thin film containing the microcrystals, it is preferable to change the ratio of the gas flow rate in the source gas. It is preferable that the source gas is introduced into the vacuum vessel using a plurality of gas introduction units, and at least one of the plurality of gas introduction units flows a source gas having a gas flow ratio different from the others. The high frequency is preferably 10 MHz or more and 10 GHz or less. The high frequency is preferably 20 MHz or more and 300 MHz or less. It is preferable that a distance between the high-frequency introducing portion and the substrate is 3 mm or more and 30 mm or less. The pressure for forming the silicon-based thin film containing the microcrystals is preferably 100 Pa (0.75 Torr) or more and 5000 Pa (37.5 Torr) or less. The residence time of the source gas when forming the silicon-based thin film containing the microcrystals is preferably 0.01 seconds or longer and 10 seconds or shorter. The residence time of the source gas when forming the silicon-based thin film containing the microcrystals is preferably from 0.1 seconds to 3 seconds.

シリコン系薄膜からなる半導体接合を有する半導体素子において、前記シリコン系薄膜の少なくともひとつが微結晶を含んでおり、前記微結晶を含んだシリコン系薄膜中の前記微結晶の配向性が、前記微結晶を含んだシリコン系薄膜中の膜厚方向で変化することを特徴とした半導体素子では、良好な電気特性をもち、密着性、耐環境性に優れた半導体素子を、低コストで形成することができる。   In a semiconductor element having a semiconductor junction made of a silicon-based thin film, at least one of the silicon-based thin films contains microcrystals, and the orientation of the microcrystals in the silicon-based thin film containing the microcrystals is determined by the microcrystals. In a semiconductor element characterized by changing in the film thickness direction in a silicon-based thin film containing silicon, it is possible to form a semiconductor element having good electrical characteristics and excellent adhesion and environmental resistance at low cost. it can.

本発明の半導体素子を含む光起電力素子の一例を示す模式的な断面図である。It is typical sectional drawing which shows an example of the photovoltaic element containing the semiconductor element of this invention. 本発明の半導体素子及び光起電力素子を製造する堆積膜形成装置の一例を示す模式的な断面図である。It is typical sectional drawing which shows an example of the deposited film formation apparatus which manufactures the semiconductor element and photovoltaic element of this invention. 本発明の半導体素子を含む半導体層の一例を示す模式的な断面図である。It is typical sectional drawing which shows an example of the semiconductor layer containing the semiconductor element of this invention. 本発明の半導体素子を含む光起電力素子の一例を示す模式的な断面図である。It is typical sectional drawing which shows an example of the photovoltaic element containing the semiconductor element of this invention. 本発明の半導体素子を含む光起電力素子の一例を示す模式的な断面図である。It is typical sectional drawing which shows an example of the photovoltaic element containing the semiconductor element of this invention. 本発明の半導体素子及び光起電力素子を製造する堆積膜形成装置の一例を示す模式的な断面図である。It is typical sectional drawing which shows an example of the deposited film formation apparatus which manufactures the semiconductor element and photovoltaic element of this invention. 本発明の半導体素子を含む光起電力素子の一例を示す模式的な断面図である。It is typical sectional drawing which shows an example of the photovoltaic element containing the semiconductor element of this invention. 本発明の半導体素子を含むTFTの一例を示す模式的な断面図である。It is typical sectional drawing which shows an example of TFT containing the semiconductor element of this invention.

前述した課題を解決するために鋭意研究を重ねた結果本発明者は、シリコン系薄膜からなる半導体接合を有する半導体素子において、前記シリコン系薄膜の少なくともひとつが微結晶を含んでおり、前記微結晶を含んだシリコン系薄膜中の前記微結晶の配向性が、前記微結晶を含んだシリコン系薄膜中の膜厚方向で変化することを特徴とした半導体素子では、良好な電気特性をもち、密着性、耐環境性に優れた半導体素子を、低コストで形成することが可能になったことを見出した。   As a result of intensive research in order to solve the above-described problems, the present inventor has found that in a semiconductor element having a semiconductor junction made of a silicon-based thin film, at least one of the silicon-based thin films contains a microcrystal, and the microcrystal The semiconductor element characterized in that the orientation of the microcrystals in the silicon-based thin film containing silicon changes in the film thickness direction in the silicon-based thin film containing the microcrystals. The present inventors have found that it is possible to form a semiconductor element having excellent properties and environmental resistance at low cost.

上記の構成にすることにより、以下の作用がある。   The above-described configuration has the following effects.

結晶相のシリコンは、非晶質相のシリコンと比較して、Si−Si結合の欠陥密度が低く、熱力学的に非平衡状態にある非晶質相のシリコンと比較して、キャリアの移動度が大きく、再結合寿命が長いといった特性を有し、さらに長時間にわたる特性の安定性に優れ、また高温多湿などの環境下においても、その特性が変化しにくいという特長を有する。そのため、シリコン系薄膜からなる半導体接合を有する半導体素子において、たとえば光起電力素子やTFTなどに結晶相を含んだシリコン系薄膜を用いることにより、より優れた特性をもち、かつ安定性に優れた半導体素子の形成できる可能性がある。   Crystalline silicon has a lower defect density of Si-Si bonds than amorphous phase silicon, and carrier transfer compared to amorphous phase silicon in a thermodynamically non-equilibrium state. It has the characteristics that it has a large degree of recombination and has a long recombination life, and is excellent in stability of characteristics over a long period of time. In addition, it has the characteristics that the characteristics hardly change even in an environment such as high temperature and high humidity. Therefore, in a semiconductor element having a semiconductor junction made of a silicon-based thin film, for example, a silicon-based thin film containing a crystal phase is used for a photovoltaic element, a TFT, or the like, thereby providing superior characteristics and excellent stability. There is a possibility that a semiconductor element can be formed.

一方で、結晶相を含むシリコン系薄膜をi型半導体層に採用した場合の問題点として、結晶粒界が多数キャリア、少数キャリア双方に影響を与えて性能を劣化させることが考えられる。結晶粒界の影響を抑制するためには、i型半導体層内の結晶粒径を大きくして結晶粒界密度を低下させることが有効な手段の一つであると考えられる。   On the other hand, as a problem when a silicon-based thin film containing a crystal phase is adopted for the i-type semiconductor layer, it is conceivable that the crystal grain boundary affects both the majority carrier and the minority carrier to deteriorate the performance. In order to suppress the influence of the crystal grain boundary, it is considered that one of effective means is to increase the crystal grain size in the i-type semiconductor layer and reduce the crystal grain boundary density.

結晶粒径を大きくするための手段としては、結晶核の発生を抑制し、結晶の配向性を高めることが好ましいものである。ランダムな結晶方位で膜の形成が進行した場合には、成長の過程でそれぞれの結晶粒が衝突しあい相対的に結晶粒の大きさが小さくなると考えられるが、特定の方位に配向させ、さらに結晶核の形成を制御して成長の方向性をそろえることで、結晶粒同士のランダムな衝突を抑制することができ、その結果結晶粒径をより大きくすることが可能であると考えられる。また一方、シリコン系薄膜内に内部ストレスが生じた場合には、バンドプロファイルの歪が生じたり、キャリア発生層における光照射時の電界が低下する領域が発生したり、またTFTにおいては、スイッチングのオフ時に流れるリーク電流が増加してしまうなどの問題が生じる。ここで、シリコン系薄膜、特にシリコン系薄膜の界面領域においては、堆積膜の形成の過程において膜厚方向でその配向性を変化させることで、シリコン系薄膜内の内部ストレスをより低減することができるために好ましいものである。内部ストレスを低減できる理由としては、界面領域と、シリコン系薄膜の内部領域で異なる機械的な応力環境に対して、配向性を変化させ、Si−Si結合の方向性を変えることができるためであると考えられる。   As a means for increasing the crystal grain size, it is preferable to suppress the generation of crystal nuclei and improve the crystal orientation. When film formation proceeds with random crystal orientation, each crystal grain collides with each other during the growth process, and the size of the crystal grain is considered to be relatively small. By controlling the formation of nuclei and aligning the growth direction, random collisions between crystal grains can be suppressed, and as a result, the crystal grain size can be increased. On the other hand, when internal stress is generated in the silicon-based thin film, band profile distortion occurs, a region where the electric field in the carrier generation layer is lowered during light irradiation occurs, and in the TFT, switching occurs. There arises a problem such as an increase in leakage current flowing at the off time. Here, in the interface region of the silicon-based thin film, particularly the silicon-based thin film, the internal stress in the silicon-based thin film can be further reduced by changing the orientation in the film thickness direction in the process of forming the deposited film. This is preferable because it is possible. The reason why the internal stress can be reduced is that the orientation can be changed and the direction of the Si-Si bond can be changed for different mechanical stress environments in the interface region and the internal region of the silicon-based thin film. It is believed that there is.

ここで、ダイヤモンド構造をとる結晶性シリコンにおいては、(220)面は、面内の原子密度が最も高く、成長最表面内のシリコン原子は、4本の結合手のうち3本を他のシリコン原子と共有結合で結合されている構造のため、この面を成長面とした場合に、微結晶内、及び微結晶相互の密着性及び耐候性の良好なシリコン系薄膜を形成することができるものと考えられ、好ましいものである。また、アクティブマトリクス方液晶装置のデバイスとして逆スタガー型のTFTを用いる場合に、活性層のオーミックコンタクト層と接する領域を(220)面に優先配向した微結晶を含むシリコン系薄膜とすることにより、その形成過程におけるオーミックコンタクト層のドライエッチ時に、活性層をエッチングすることなく、オーミックコンタクト層を完全に除去することが、窒化膜などのエッチングストッパー材などを用いることなく可能になる。これは、(220)面が耐エッチング性に富むことに起因する。ASTMカードから、無配向の結晶性シリコンでは、低角側から11反射分の回折強度の総和に対する(220)面の回折強度の割合は約23%であり、(220)面の回折強度の割合が23%を上回る構造は、この面方向に配向性を有することになる。特に(220)面の回折強度の割合が80%以上である領域を含む構造においては、上記の効果がより促進され特に好ましいものである。   Here, in crystalline silicon having a diamond structure, the (220) plane has the highest in-plane atomic density, and the silicon atoms in the outermost surface of growth have three of the four bonds in the other silicon. A structure in which a silicon-based thin film with good adhesion and weather resistance in microcrystals and between microcrystals can be formed when this plane is used as a growth plane because of the structure in which atoms are covalently bonded. It is considered that it is preferable. In addition, when an inverted stagger type TFT is used as a device of an active matrix liquid crystal device, a region in contact with the ohmic contact layer of the active layer is a silicon thin film containing microcrystals preferentially oriented in the (220) plane, During the dry etching of the ohmic contact layer during the formation process, it is possible to completely remove the ohmic contact layer without etching the active layer without using an etching stopper material such as a nitride film. This is because the (220) plane is rich in etching resistance. From the ASTM card, in the non-oriented crystalline silicon, the ratio of the diffraction intensity of the (220) plane to the sum of the diffraction intensity of 11 reflections from the low angle side is about 23%, and the ratio of the diffraction intensity of the (220) plane A structure having more than 23% has orientation in this plane direction. In particular, in a structure including a region where the ratio of the diffraction intensity of the (220) plane is 80% or more, the above effect is further promoted, which is particularly preferable.

上記述べたことを総合すると、シリコン系薄膜に含まれる微結晶の配向性がシリコン系薄膜の膜厚方向で変化し、かつ前記微結晶が(220)面に優先配向している領域を含む構成が好ましいものと思われる。   In summary, the orientation of the microcrystal contained in the silicon-based thin film changes in the film thickness direction of the silicon-based thin film, and the microcrystal includes a region preferentially oriented in the (220) plane. Seems to be preferable.

第一の導電型を示す半導体層、i型半導体層、第二の導電型を示す半導体層が順次積層されたpin型の半導体接合光起電力素子においては、前記微結晶を含むシリコン系薄膜と、前記シリコン系薄膜に対して光入射側に配置されている導電形を示す半導体層の間に、非晶質シリコン層を配置することにより、開放電圧を増大する効果があるため好ましいものである。同時に界面近傍のバンドプロファイルを改善し、キャリアの再結合を防止し、より多くのキャリアを取り出すことができる効果がある。さらには、導電型層からのドーパント原子が、i型半導体層内部に拡散することを防止する。また前記非晶質シリコン層に含まれる水素濃度を、前記微結晶を含むシリコン系薄膜との界面方向で大きくすることで、界面近傍に発生する応力を緩和する効果があると思われるので好ましいものである。これは、水素濃度の高い領域においては水素原子を含んだクラスター領域が形成され、界面を挟んだ両方の構造の不一致に起因する内部応力を吸収する機能が高まるためであると考えられる。ここで、前記非晶質シリコン層の膜厚が大きすぎると、光照射による膜の劣化の影響が光起電力素子の特性として現れてくるので、前記非晶質シリコン層の膜厚は30nm以下であることが好ましいものである。   In a pin-type semiconductor junction photovoltaic device in which a semiconductor layer having a first conductivity type, an i-type semiconductor layer, and a semiconductor layer having a second conductivity type are sequentially stacked, a silicon-based thin film containing the microcrystals, It is preferable to dispose an amorphous silicon layer between the semiconductor layers showing the conductivity type arranged on the light incident side with respect to the silicon-based thin film, because there is an effect of increasing the open-circuit voltage. . At the same time, there is an effect that the band profile near the interface is improved, carrier recombination is prevented, and more carriers can be taken out. Furthermore, the dopant atoms from the conductive type layer are prevented from diffusing into the i-type semiconductor layer. In addition, it is preferable that the concentration of hydrogen contained in the amorphous silicon layer is increased in the interface direction with the silicon-based thin film containing the microcrystals, so that it is considered that there is an effect of relieving stress generated in the vicinity of the interface. It is. This is considered to be because a cluster region containing hydrogen atoms is formed in a region having a high hydrogen concentration, and the function of absorbing internal stress due to the mismatch between both structures sandwiching the interface is enhanced. Here, if the film thickness of the amorphous silicon layer is too large, the influence of the film deterioration due to light irradiation appears as a characteristic of the photovoltaic element. Therefore, the film thickness of the amorphous silicon layer is 30 nm or less. It is preferable that.

結晶相を含むシリコン系薄膜を、高周波を用いたプラズマCVD法により形成する方法は、固相反応と比較してプロセス時間が短く、プロセス温度も低くすることが可能なため、基板の選択範囲が広がり、よりガラス基板やステンレス基板などの安価な材料を採用することが可能になるために、低コスト化に有利である。特に、pin接合を有する光起電力素子において、膜厚の大きなi型半導体層に適用することで、この効果は大きく発揮される。特にi型半導体層が、2.0nm/秒以上の成膜速度で形成できるのは好ましいものである。   The method of forming a silicon-based thin film containing a crystalline phase by plasma CVD using high frequency can shorten the process time and lower the process temperature compared to the solid-phase reaction. Since it becomes possible to use inexpensive materials such as glass substrates and stainless steel substrates, it is advantageous for cost reduction. In particular, in a photovoltaic element having a pin junction, this effect is greatly exerted when applied to an i-type semiconductor layer having a large film thickness. In particular, it is preferable that the i-type semiconductor layer can be formed at a deposition rate of 2.0 nm / second or more.

ここで配向性をもつシリコン系薄膜を高周波プラズマCVD法で形成する場合には、シリコン系薄膜の堆積に寄与する活性種に加えて、エッチングに寄与する活性種もある雰囲気下で形成が行なわれていると考えることができる。そして、形成された膜表面の相対的に結合力の弱いSi−Si結合をエッチングしながら膜の堆積が進むことで、特定の面を優先配向面としたシリコン系薄膜の形成が可能になるものと考えられる。ここで、配向度の制御は、これらの活性種の制御によって行なうことができるものである。   Here, when forming an oriented silicon-based thin film by the high-frequency plasma CVD method, the formation is performed in an atmosphere where there are active species contributing to etching in addition to active species contributing to the deposition of the silicon-based thin film. Can be considered. Then, by depositing the film while etching the Si-Si bond having a relatively weak bonding force on the surface of the formed film, it becomes possible to form a silicon-based thin film having a specific plane as a preferential orientation plane. it is conceivable that. Here, the degree of orientation can be controlled by controlling these active species.

このような反応機構で膜の形成を行なう場合には、膜の形成初期には(220)配向性を持つ結晶核密度が小さいことが望まれる。(220)配向性をもつ結晶核密度が高いと、その結晶核を起点としたシリコン系薄膜の形成が行なわれることによって、シリコン系薄膜全体の結晶粒が相対的に小さくなってしまうと考えられる。また、界面領域において配向度が高くなる雰囲気下で膜の形成を行なった場合には、すなわち、エッチング効果が高い雰囲気下で膜の形成を行なった場合には、下地層に対してもダメージを与えることが懸念される。そのために微結晶を含んだシリコン系薄膜の形成初期においては、高い結晶性を確保しながら、(220)面の配向性が相対的に小さい構成にすることが好ましいものである。   When the film is formed by such a reaction mechanism, it is desired that the crystal nucleus density having (220) orientation is small at the initial stage of film formation. When the density of crystal nuclei having (220) orientation is high, the formation of a silicon-based thin film starting from the crystal nuclei is considered to result in relatively small crystal grains in the entire silicon-based thin film. . In addition, when the film is formed in an atmosphere in which the degree of orientation is high in the interface region, that is, when the film is formed in an atmosphere having a high etching effect, the underlying layer is also damaged. Concerned about giving. Therefore, in the initial stage of formation of the silicon-based thin film containing microcrystals, it is preferable that the orientation of the (220) plane is relatively small while ensuring high crystallinity.

ここで、相対的にエッチング効果の小さな雰囲気下では、(100)面の成長は(220)面に比較して大きな成長速度を持つと思われるために、(220)面に配向する結晶核密度を小さくし、かつ高い結晶化度を両立することが可能になるため、前記微結晶を含むシリコン系薄膜の界面領域の微結晶が(100)面の優先配向をしていることが好ましいものである。また、特にTFTでは、ゲート絶縁膜と接する領域に電導度が高い領域を形成することができ、さらに平滑度の高い表面を形成することができるために特に好ましいものである。上記の効果を発現するためには、前記界面領域の膜厚は1.0nm以上20nm以下であることが好ましいものである。   Here, in an atmosphere with a relatively small etching effect, the growth of the (100) plane seems to have a higher growth rate than the (220) plane, and thus the density of crystal nuclei oriented in the (220) plane It is preferable that the microcrystals in the interface region of the silicon-based thin film containing the microcrystals have a (100) plane preferential orientation. is there. In particular, a TFT is particularly preferable because a region with high conductivity can be formed in a region in contact with the gate insulating film and a surface with high smoothness can be formed. In order to exhibit the above effects, the film thickness of the interface region is preferably 1.0 nm or more and 20 nm or less.

また、界面における密着性、内部ストレスを緩和するために、界面領域の微結晶の外形が、特定の方位を持たない概球状の形状をしていることが好ましいものである。   In order to alleviate adhesion and internal stress at the interface, it is preferable that the outer shape of the microcrystal in the interface region has a substantially spherical shape having no specific orientation.

界面領域に引き続いた領域におけるシリコン系薄膜内の微結晶は、界面領域の(220)面に配向した結晶核を種結晶として、界面領域よりも大きな(220)面の配向性を有しているのが好ましいものである。光起電力素子においては、微結晶がキャリアの走行方向に柱状構造をしているのが、キャリアの走行性が良好になりより好ましいものである。   The microcrystal in the silicon-based thin film in the region subsequent to the interface region has a larger (220) plane orientation than the interface region using the crystal nucleus oriented in the (220) plane of the interface region as a seed crystal. Is preferred. In the photovoltaic element, it is more preferable that the microcrystals have a columnar structure in the carrier traveling direction because the carrier traveling property is improved.

また前記微結晶を含むシリコン系薄膜が、酸素原子、炭素原子、窒素原子の少なくともひとつを含むと、結晶粒界のボイド状の空間に配置されることにより構造安定性を高めるために好ましいものである。また、結晶粒界の抵抗を高めることにより、リーク電流の発生を抑制することが可能になる。さらにその理由の詳細は明らかではないが、成長面における新たなる結晶核の発生を抑制するために、微結晶の断面サイズの均一性を高める効果があるために好ましいものである。これらの効果は、酸素原子、炭素原子、窒素原子の総量が1.5×1018atoms/cm以上で効果的に出現する。ここで、酸素原子、炭素原子、窒素原子の総量が多すぎると、微結晶のバルク内に取り込まれ、結晶性を低下させる。酸素原子、炭素原子、窒素原子の総量は、5.0×1019atoms/cm以下であることが好ましい範囲である。 Further, when the silicon-based thin film containing microcrystals contains at least one of an oxygen atom, a carbon atom, and a nitrogen atom, it is preferable for increasing the structural stability by being disposed in a void-like space at the grain boundary. is there. In addition, it is possible to suppress the occurrence of leakage current by increasing the resistance of the crystal grain boundary. Furthermore, although the details of the reason are not clear, it is preferable because it has the effect of improving the uniformity of the cross-sectional size of the microcrystals in order to suppress the generation of new crystal nuclei on the growth surface. These effects appear effectively when the total amount of oxygen atoms, carbon atoms, and nitrogen atoms is 1.5 × 10 18 atoms / cm 3 or more. Here, when there are too many total amounts of an oxygen atom, a carbon atom, and a nitrogen atom, it will be taken in into the bulk of a microcrystal and crystallinity will be reduced. The total amount of oxygen atoms, carbon atoms, and nitrogen atoms is preferably in the range of 5.0 × 10 19 atoms / cm 3 or less.

また前記微結晶を含むシリコン系薄膜が、フッ素原子を含むと、微結晶の粒界のパシベーションが効率良く行なわれ、またまた電気陰性度の大きなフッ素原子により、微結晶粒界に顕在化しているシリコン原子のダングリングボンドが不活性化されるため好ましいものである。フッ素原子の量としては、1.0×1019atoms/cm以上2.5×1020atoms/cm以下が好ましい範囲としてあげられる。 In addition, when the silicon-based thin film containing microcrystals contains fluorine atoms, passivation of the grain boundaries of the microcrystals is efficiently performed, and silicon that is manifested in the crystallite grain boundaries by fluorine atoms having a large electronegativity This is preferable because dangling bonds of atoms are inactivated. The amount of fluorine atoms is preferably 1.0 × 10 19 atoms / cm 3 or more and 2.5 × 10 20 atoms / cm 3 or less.

真空容器内に原料ガスを導入し、前記真空容器内に導入した基板上に高周波プラズマCVD法を用いてシリコン系薄膜を形成する方法において、高周波導入部と基板の距離を近づけることにより、放電空間体積当りのプラズマ密度が増大し、堆積膜形成に寄与する反応種を高密度で形成させることが可能になり、成膜速度のより高速化が実現できると考えられる。   In a method of forming a silicon-based thin film using a high frequency plasma CVD method on a substrate introduced into the vacuum vessel by introducing a source gas into the vacuum vessel, the discharge space is reduced by reducing the distance between the high frequency introduction portion and the substrate. It is considered that the plasma density per volume increases, and reactive species contributing to the formation of the deposited film can be formed at a high density, so that the film formation rate can be further increased.

一方で、高周波導入部と基板の距離を近づけたときには、プラズマ中の電子密度が増大し、それに伴ないイオンの発生量が増加することが考えられる。イオンは放電空間内のシース領域において静電引力によって加速されるため、イオン衝撃としてバルク内の原子配置を歪ませたり、膜中にボイドを形成する要因となり、高品質のシリコン系薄膜形成のための障害となったり、下地層との密着性や、耐環境性を低下させることなどが考えられる。ここで、成膜空間内の圧力を増大させることにより、プラズマ中のイオンは、他のイオン、活性種などとの衝突機会が増加することにより、イオンの衝撃力が低下し、またイオンの量そのものを減少させたりすることが可能になると考えられ、相対的にイオン衝撃が低下することが期待できる。   On the other hand, it is conceivable that when the distance between the high-frequency introducing portion and the substrate is reduced, the electron density in the plasma increases and the amount of ions generated increases accordingly. Since ions are accelerated by electrostatic attraction in the sheath region in the discharge space, it causes distortion of the atomic arrangement in the bulk as an ion bombardment and causes voids to be formed in the film. It may be a hindrance to the surface, adhesion to the underlying layer, and environmental resistance may be reduced. Here, by increasing the pressure in the film formation space, ions in the plasma are reduced in impact force by increasing the chance of collision with other ions and active species, and the amount of ions. It is considered that it is possible to reduce the ion bombardment, and it can be expected that ion bombardment is relatively lowered.

ここで、原料ガスに水素化シリコン、フッ素化シリコン及び水素を含んだ原料ガスを用いた高周波プラズマCVD法では、SiF(0≦n、m≦4)、HF、F、Hなどの活性種の生成が考えられる。これらの活性種を含むプラズマ雰囲気は、シリコン系薄膜の堆積に寄与する活性種に加えて、エッチングに寄与する活性種もある点が特徴であると思われる。このため、膜表面の相対的に結合力の弱いSi−Si結合をエッチングしながら膜の堆積が進むことで、アモルファスの領域の少ない結晶化度の大きなシリコン系薄膜の形成が可能になると考えられる。また、エッチングの過程では、結合が切断されることに伴ないラジカルが形成され、構造緩和が促進されるため、より低温のプロセス温度下での良質なシリコン系薄膜の形成が可能になると考えられる。 Here, in the high frequency plasma CVD method using a source gas containing silicon hydride, fluorinated silicon, and hydrogen as a source gas, SiF n H m (0 ≦ n, m ≦ 4), HF, F, H, etc. The generation of active species can be considered. The plasma atmosphere containing these active species seems to be characterized in that there are active species that contribute to etching in addition to active species that contribute to the deposition of silicon-based thin films. For this reason, it is considered that the formation of a silicon-based thin film with a small degree of crystallinity and a small amorphous region is possible by depositing the film while etching Si-Si bonds having a relatively weak bonding force on the film surface. . Moreover, in the process of etching, radicals are formed as the bonds are broken, and structural relaxation is promoted. Therefore, it is considered that a high-quality silicon-based thin film can be formed at a lower process temperature. .

ここで、原料ガスにフッ素化シリコン及び水素を含んだ原料ガスを用いた高周波プラズマCVD法では、フッ素化シリコンに水素を加えることによって形成されるSiFH、SiFHなどの、水素を含むフッ素化シラン系活性種を形成することで、高速成膜が可能になると考えられる。前記SiFH、SiFHなどの、水素を含むフッ素化シラン系活性種を形成するためには、フッ素化シリコンを効率よく分解してSiFを形成することが重要であり、さらに形成されたSiFと活性化水素による活発な反応過程が重要なものであると考えられる。特にプラズマ中に十分なSiFが存在することが特に重要であると考えられる。 Here, in the high frequency plasma CVD method using a source gas containing fluorinated silicon and hydrogen as a source gas, fluorine containing hydrogen such as SiF 2 H and SiFH 2 formed by adding hydrogen to fluorinated silicon. It is considered that high-speed film formation is possible by forming a silane-based active species. In order to form fluorinated silane-based active species containing hydrogen, such as SiF 2 H and SiFH 2 , it is important to efficiently decompose fluorinated silicon to form SiF, and the formed SiF The active reaction process with activated hydrogen is considered to be important. In particular, it is considered that the presence of sufficient SiF in the plasma is particularly important.

上記のような配向性と結晶化度を持つシリコン系薄膜の形成を、堆積しつつエッチングも行ないながら、トータルとして高速成膜で実現するためには、プラズマプロセスの制御が重要な技術課題となる。ここで、SiFと活性化水素による活発な反応過程を行なうためには、前述のように放電空間体積当りのプラズマ密度が増大させることが重要であるが、プラズマ中の電子密度が増大した雰囲気の中で、より多くの活性化水素を形成するためには、水素分子の枯渇を抑制するように原料ガスの導入をする必要がある。さらにプラズマ中でSiHやSiHなどのラジカル密度が増大した場合には、これを核とした結晶化が、放電空間中及び、堆積膜表面において起こりやすくなるために、ポリシランなどの反応副生成物の形成や、結晶粒径拡大に対する阻害要因として働いてしまうために、SiHやSiHなどのラジカル密度も抑制させる必要がある。これらのことを達成するためには、原料ガスの分解を進めながら、新たな原料ガスの供給を活発にし、SiHやSiHなどのラジカルを消滅を促進させる2次反応を活発に行なわせることが効果的であると考えられる。 Controlling the plasma process is an important technical issue in order to achieve the formation of a silicon-based thin film having the above-described orientation and crystallinity by high-speed film formation as a whole while depositing and etching. . Here, in order to perform an active reaction process with SiF and activated hydrogen, it is important to increase the plasma density per discharge space volume as described above, but in an atmosphere with an increased electron density in the plasma. Among them, in order to form more activated hydrogen, it is necessary to introduce a source gas so as to suppress depletion of hydrogen molecules. Further, when the radical density of SiH, SiH 2 or the like increases in the plasma, crystallization with this as a nucleus tends to occur in the discharge space and on the surface of the deposited film. Therefore, it is necessary to suppress the radical density of SiH, SiH 2 and the like. In order to achieve these, it is necessary to actively supply a new source gas while promoting the decomposition of the source gas, and to actively carry out a secondary reaction that promotes the extinction of radicals such as SiH and SiH 2. It is considered effective.

ここで、プラズマのパラメータとして、プラズマの生起している放電空間の体積をV(m)、前記原料ガスの流量をQ(cm/min(normal))、放電空間の圧力をP(Pa)としたときに、τ=592×V×P/Qで定義される滞留時間τ(秒)と、プラズマの発光強度を、プラズマ制御のパラメータとして着目することで、所望のプラズマ雰囲気をもつプラズマの生起が可能になると考えられる。高品質なシリコン系薄膜を得るためには、高周波導入部と基板の距離、圧力といった上記のパラメータに加えて、滞留時間を制御することが重要であると考えられる。 Here, as parameters of the plasma, the volume of the discharge space in which the plasma is generated is V (m 3 ), the flow rate of the source gas is Q (cm 3 / min (normal)), and the pressure of the discharge space is P (Pa ), The residence time τ (seconds) defined by τ = 592 × V × P / Q and the emission intensity of the plasma as the parameters of the plasma control, so that a plasma having a desired plasma atmosphere is obtained. It is thought that the occurrence of In order to obtain a high-quality silicon-based thin film, it is considered important to control the residence time in addition to the above parameters such as the distance between the high-frequency introducing portion and the substrate and the pressure.

以上のことを鑑み、本発明者が鋭意検討を重ねた結果、欠陥密度の少ない優れた特性のシリコン系薄膜をさらなる高速度で成膜するためには、前記高周波導入部と前記基板との距離が3mm以上30mm以下であり、放電空間内の圧力が90Pa(0.68Torr)以上1.5×10Pa(113Torr)以下であり、前記プラズマの生起している放電空間の体積をV(m)、前記原料ガスの流量をQ(cm/min(normal))、放電空間の圧力をP(Pa)としたときに、τ=592×V×P/Qで定義される滞留時間τを、0.01秒以上10秒以下の領域において、SiHやSiHなどのラジカル密度が抑制でき、所望のシリコン系薄膜の形成が可能であることを見出したものである。ここで周波数が10MHz〜10GHzの高周波を用いたCVD法で形成する方法は好ましいものである。さらにプラズマ中の電子温度を抑制し、かつ大面積で均一なプラズマが形成されやすいために20MHz〜300MHzの高周波を用いたCVD法で形成する方法は特に好ましいものである。 In view of the above, as a result of extensive studies by the inventor, in order to form a silicon-based thin film having a low defect density and excellent characteristics at a higher speed, the distance between the high-frequency introducing portion and the substrate Is not less than 3 mm and not more than 30 mm, the pressure in the discharge space is not less than 90 Pa (0.68 Torr) and not more than 1.5 × 10 4 Pa (113 Torr), and the volume of the discharge space in which the plasma is generated is V (m 3 ) When the flow rate of the source gas is Q (cm 3 / min (normal)) and the pressure of the discharge space is P (Pa), the residence time τ defined by τ = 592 × V × P / Q In the region of 0.01 seconds or more and 10 seconds or less, it has been found that the radical density of SiH or SiH 2 can be suppressed and a desired silicon-based thin film can be formed. Here, a method of forming by a CVD method using a high frequency of 10 MHz to 10 GHz is preferable. Furthermore, a method of forming by a CVD method using a high frequency of 20 MHz to 300 MHz is particularly preferable because an electron temperature in the plasma is suppressed and a uniform plasma having a large area is easily formed.

また光起電力素子などのデバイスの形成時に、上記された範囲においてはプラズマ雰囲気中の水素による還元作用によって下地層の成分、膜質、特性などが変質してしまうのを抑制し、下地への悪影響を排除することができる。下地層として酸化亜鉛などの金属の酸化物からなる透明導電膜を用いた場合には、還元による透明導電膜の透過率の低下、それにともなう光起電力素子の特性の低下を防止できるので、特に効果的である。   In addition, when forming devices such as photovoltaic elements, it is possible to suppress the deterioration of the composition, film quality, characteristics, etc. of the underlying layer due to the reducing action of hydrogen in the plasma atmosphere within the above-mentioned range. Can be eliminated. In the case where a transparent conductive film made of a metal oxide such as zinc oxide is used as the underlayer, it is possible to prevent a decrease in the transmittance of the transparent conductive film due to the reduction, and a decrease in the characteristics of the photovoltaic element due to the reduction. It is effective.

さらに別の作用としては、シリコン系薄膜と下地層との密着性が向上することがあげられる。これは、SiFH、SiFHラジカルの活発な表面拡散により、表面近傍の応力歪みを常に緩和させながら堆積膜が形成されるために、この効果が発現されるのではないかと思われる。とくに、シリコン系薄膜中の配向度が膜厚方向で変化する構成においては、とくに効果的であると思われる。また、水素分圧が相対的に高まるために、結晶粒界のパシベーション効果が高まり結晶粒界の不活性化が促進され、シリコンネットワーク中に組み込まれた水素原子の急激な離脱が抑制され、シリコンネットワーク内の不規則領域の発生に起因する塑性流動や、それにともったクラックや凝集の発生を防ぐことができるために、膜質や密着性に優れたシリコン系薄膜の形成が可能になり、このシリコン系薄膜を含んだ構成にすることによって、耐環境性に優れた光起電力素子を提供することができると考えられる。 Another effect is that the adhesion between the silicon-based thin film and the underlying layer is improved. This is because the deposited film is formed while the stress strain in the vicinity of the surface is always relaxed by the active surface diffusion of the SiF 2 H and SiFH 2 radicals. This is particularly effective in a configuration in which the degree of orientation in the silicon-based thin film changes in the film thickness direction. In addition, since the hydrogen partial pressure is relatively increased, the passivation effect of the crystal grain boundary is increased, the inactivation of the crystal grain boundary is promoted, and the rapid detachment of hydrogen atoms incorporated in the silicon network is suppressed, and silicon Since it is possible to prevent plastic flow due to the occurrence of irregular regions in the network and the occurrence of cracks and aggregation, it is possible to form silicon-based thin films with excellent film quality and adhesion. It is considered that a photovoltaic device excellent in environmental resistance can be provided by adopting a configuration including a system thin film.

下地への影響や密着性、耐環境性、光劣化率の低減の効果の点に鑑みると、圧力が100Pa(0.75Torr)以上5000Pa(37.5Torr)以下、滞留時間が0.1秒以上3秒以下がより好ましい範囲としてあげられる。   In view of the influence on the groundwork, adhesion, environmental resistance, and the effect of reducing the light degradation rate, the pressure is 100 Pa (0.75 Torr) or more and 5000 Pa (37.5 Torr) or less, and the residence time is 0.1 seconds or more. A preferable range is 3 seconds or less.

シリコン系薄膜の形成の過程で原料ガス中のガス流量の比率を変化させることで、プラズマ中の堆積に寄与する活性種と、エッチングに寄与する活性種の比率を制御することが可能になり、シリコン系薄膜中の微結晶の配向性を制御することが可能になる。配向性の高いプラズマ雰囲気を形成するためには、フッ素化シリコンガスと水素の系においては原料ガス中のフッ素化シリコンガスの分圧を高め、水素化シリコンガスと水素の系においては原料ガス中の水素の分圧を高め、フッ素化シリコンガスと水素化シリコンガスの混合系においては、フッ素化シリコンガスの分圧を高める条件下で実現することが可能である。膜を堆積していく過程でプラズマ雰囲気を変化させる手段としては、導入する原料ガス中の流量比を変化させる方法や、ロール・ツー・ロール法のような、プラズマ空間を基板が移動する成膜法では、プラズマ中の各活性種の密度に分布をつけることで行なうこともできる。その方法としては、ひとつのプラズマ空間中に複数のガス導入部から原料ガスを導入し、そのうちの少なくともひとつは他とは異なったガス流量比の原料ガスを流す方法などが好ましいものである。   By changing the ratio of the gas flow rate in the raw material gas during the formation of the silicon-based thin film, it becomes possible to control the ratio of active species that contribute to deposition in plasma and active species that contribute to etching, It becomes possible to control the orientation of the microcrystals in the silicon-based thin film. In order to form a highly oriented plasma atmosphere, in the fluorinated silicon gas and hydrogen system, the partial pressure of the fluorinated silicon gas in the source gas is increased, and in the silicon hydride gas and hydrogen system, in the source gas In the mixed system of fluorinated silicon gas and silicon hydride gas, the hydrogen partial pressure can be realized under the condition of increasing the partial pressure of fluorinated silicon gas. As a means of changing the plasma atmosphere in the process of depositing the film, a method in which the substrate moves in the plasma space, such as a method of changing the flow rate ratio in the introduced source gas or a roll-to-roll method, is used. In the method, it is also possible to distribute the density of each active species in the plasma. As such a method, a method of introducing a raw material gas from a plurality of gas introduction portions into one plasma space and flowing a raw material gas having a gas flow rate ratio different from that of at least one of them is preferable.

高周波を用いたプラズマCVD法で結晶相を含むシリコン系薄膜を形成する場合には、堆積膜形成表面における吸着、離脱、引き抜き、打ち込み、表面拡散などの反応過程を好ましく進めるために、堆積膜形成表面の温度管理を適切に行なわなければならない。そのためには、結晶相を含むシリコン系薄膜を形成する前に、抵抗加熱ヒーターやランプヒーターなどの加熱手段を用いて、直接あるいは間接的に基板表面を加熱しておく必要がある。一方でプラズマを生起することは、プラズマからの活性種の衝撃などにより、基板表面温度を上昇させる要因となる。特に、高周波導入部と基板の距離を近づけたり、放電空間体積当りのプラズマ密度を増大させるように高周波パワーを増大させた場合にはこのことが顕著になる。基板の成膜表面の温度が高くなりすぎると表面の各反応過程のバランスが乱れ、結晶核の形成による結晶粒界密度の上昇、結晶性の低下、パシベーションによる粒界の不活性化が不十分になるなどが起こる。また、成膜に寄与する活性種の制御が乱れることによって、結晶相の配向性の制御も乱れることになる。   When a silicon-based thin film containing a crystalline phase is formed by plasma CVD using high frequency, a deposited film is formed to favor the reaction process such as adsorption, detachment, drawing, implantation, and surface diffusion on the deposited film formation surface. The surface temperature must be properly controlled. For this purpose, it is necessary to heat the substrate surface directly or indirectly using a heating means such as a resistance heater or a lamp heater before forming a silicon-based thin film containing a crystal phase. On the other hand, the generation of plasma is a factor that raises the substrate surface temperature due to the impact of active species from the plasma. This is particularly noticeable when the high frequency power is increased so that the distance between the high frequency introducing portion and the substrate is reduced or the plasma density per discharge space volume is increased. If the temperature of the substrate deposition surface becomes too high, the balance of the reaction processes on the surface will be disturbed, the crystal grain boundary density will increase due to the formation of crystal nuclei, the crystallinity will decrease, and the inactivation of grain boundaries due to passivation will be insufficient. Happen. In addition, when the control of active species contributing to film formation is disturbed, the control of crystal phase orientation is also disturbed.

ここで、基板の温度を、前記基板に対して前記微結晶を含むシリコン系薄膜の形成面とは反対側に配置された加熱手段を用いて制御する場合には、前記加熱手段の出力を前記微結晶を含むシリコン系薄膜の形成とともに低下させることは、成膜表面の過剰加熱を抑制できるので好ましいものである。ここで、ロール・ツー・ロール法のような、プラズマ空間を基板が移動する成膜法では、前記基板の搬送方向に配置された複数の前記加熱手段の出力を、堆積膜形成の過程に応じて変化させることが好ましい。具体的には、成膜開始直前の位置のヒーターの出力が最も高く、搬送の下流方向に向かって配置されているヒーターの出力を徐々に低下させる方法、あるいは成膜中のヒーターの少なくとも一部の出力をゼロにする方法などが好ましいものである。   Here, when the temperature of the substrate is controlled using a heating unit disposed on the opposite side of the surface of the silicon-based thin film containing the microcrystals with respect to the substrate, the output of the heating unit is Decreasing with the formation of a silicon-based thin film containing microcrystals is preferable because excessive heating of the film formation surface can be suppressed. Here, in the film forming method in which the substrate moves in the plasma space, such as the roll-to-roll method, the outputs of the plurality of heating means arranged in the transport direction of the substrate depend on the process of forming the deposited film. It is preferable to change them. Specifically, the output of the heater at the position immediately before the start of film formation is the highest, and a method of gradually reducing the output of the heater arranged in the downstream direction of conveyance, or at least a part of the heater during film formation For example, a method of making the output of zero is zero.

次に本発明の半導体素子として光起電力素子を例にあげ、その構成要素について説明する。   Next, taking a photovoltaic element as an example of the semiconductor element of the present invention, its constituent elements will be described.

図1は本発明の光起電力素子の一例を示す模式的な断面図である。図中101は基板、102は半導体層、103は第二の透明導電層、104は集電電極である。また、101−1は基体、101−2は金属層、101−3は第一の透明導電層である。これらは基板101の構成部材である。   FIG. 1 is a schematic cross-sectional view showing an example of the photovoltaic element of the present invention. In the figure, 101 is a substrate, 102 is a semiconductor layer, 103 is a second transparent conductive layer, and 104 is a collecting electrode. Reference numeral 101-1 denotes a substrate, 101-2 denotes a metal layer, and 101-3 denotes a first transparent conductive layer. These are constituent members of the substrate 101.

(基体)
基体101−1としては、金属、樹脂、ガラス、セラミックス、半導体バルク等からなる板状部材やシート状部材が好適に用いられる。その表面には微細な凸凹を有していてもよい。透明基体を用いて基体側から光が入射する構成としてもよい。また、基体を長尺の形状とすることによってロール・ツー・ロール法を用いた連続成膜を行うことができる。特にステンレス、ポリイミド等の可撓性を有する材料は基体101−1の材料として好適である。
(Substrate)
As the substrate 101-1, a plate-like member or sheet-like member made of metal, resin, glass, ceramics, semiconductor bulk, or the like is preferably used. The surface may have fine irregularities. It is good also as a structure which light injects from the base | substrate side using a transparent base | substrate. Moreover, continuous film formation using a roll-to-roll method can be performed by making the base into a long shape. In particular, a flexible material such as stainless steel or polyimide is suitable as the material of the base 101-1.

(金属層)
金属層101−2は電極としての役割と、基体101−1にまで到達した光を反射して半導体層102で再利用させる反射層としての役割とを有する。その材料としては、Al、Cu、Ag、Au、CuMg、AlSi等を好適に用いることができる。その形成方法としては、蒸着、スパッタ、電析、印刷等の方法が好適である。金属層101−2は、その表面に凸凹を有することが好ましい。それにより反射光の半導体層102内での光路長を伸ばし、短絡電流を増大させることができる。基体101−1が導電性を有する場合には金属層101−2は形成しなくてもよい。
(Metal layer)
The metal layer 101-2 has a role as an electrode and a role as a reflection layer that reflects light reaching the base 101-1 and reuses it in the semiconductor layer 102. As the material, Al, Cu, Ag, Au, CuMg, AlSi or the like can be suitably used. As the formation method, methods such as vapor deposition, sputtering, electrodeposition, and printing are suitable. It is preferable that the metal layer 101-2 has an uneven surface. Thereby, the optical path length of the reflected light in the semiconductor layer 102 can be extended, and the short circuit current can be increased. When the base 101-1 has conductivity, the metal layer 101-2 may not be formed.

(第一の透明導電層)
第一の透明導電層101−3は、入射光及び反射光の乱反射を増大し、半導体層102内での光路長を伸ばす役割を有する。また、金属層101−2の元素が半導体層102へ拡散あるいはマイグレーションを起こし、光起電力素子がシャントすることを防止する役割を有する。さらに、適度な抵抗をもつことにより、半導体層のピンホール等の欠陥によるショートを防止する役割を有する。さらに、第一の透明導電層101−3は、金属層101−2と同様にその表面に凸凹を有していることが望ましい。第一の透明導電層101−3は、ZnO、ITO等の導電性酸化物からなることが好ましく、蒸着、スパッタ、CVD、電析等の方法を用いて形成されることが好ましい。これらの導電性酸化物に導電率を変化させる物質を添加してもよい。
(First transparent conductive layer)
The first transparent conductive layer 101-3 has a role of increasing the irregular reflection of incident light and reflected light and extending the optical path length in the semiconductor layer 102. In addition, the element of the metal layer 101-2 has a role of preventing the photovoltaic element from being shunted due to diffusion or migration to the semiconductor layer 102. Furthermore, it has a role of preventing a short circuit due to a defect such as a pinhole in the semiconductor layer by having an appropriate resistance. Furthermore, it is desirable that the first transparent conductive layer 101-3 has irregularities on the surface thereof, like the metal layer 101-2. The first transparent conductive layer 101-3 is preferably made of a conductive oxide such as ZnO or ITO, and is preferably formed using a method such as vapor deposition, sputtering, CVD, or electrodeposition. A substance that changes the conductivity may be added to these conductive oxides.

また、酸化亜鉛層の形成方法としては、スパッタ、電析等の方法、あるいはこれらの方法を組み合わせて形成されることが好ましい。   Moreover, as a formation method of a zinc oxide layer, it is preferable to form it combining methods, such as sputtering and electrodeposition, or these methods.

スパッタ法によって酸化亜鉛膜を形成する条件は、方法やガスの種類と流量、内圧、投入電力、成膜速度、基板温度等が大きく影響を及ぼす。例えばDCマグネトロンスパッタ法で、酸化亜鉛ターゲットを用いて酸化亜鉛膜を形成する場合には、ガスの種類としてはAr、Ne、Kr、Xe、Hg、Oなどがあげられ、流量は、装置の大きさと排気速度によって異なるが、例えば成膜空間の容積が20リットルの場合、1sccmから100sccmが望ましい。また成膜時の内圧は1×10−4Torrから0.1Torrが望ましい。投入電力は、ターゲットの大きさにもよるが、直径15cmの場合、10Wから100KWが望ましい。また基板温度は、成膜速度によって好適な範囲が異なるが、1μm/hで成膜する場合は、70℃から450℃であることが望ましい。 The conditions for forming a zinc oxide film by sputtering are greatly affected by the method, gas type and flow rate, internal pressure, input power, deposition rate, substrate temperature, and the like. For example, in the case of forming a zinc oxide film using a zinc oxide target by DC magnetron sputtering, examples of the gas include Ar, Ne, Kr, Xe, Hg, O 2 , and the flow rate is For example, when the volume of the film formation space is 20 liters, 1 sccm to 100 sccm is desirable, although it varies depending on the size and the exhaust speed. The internal pressure during film formation is preferably 1 × 10 −4 Torr to 0.1 Torr. The input power depends on the size of the target, but is preferably 10 W to 100 KW when the diameter is 15 cm. Further, the preferred range of the substrate temperature varies depending on the film forming speed, but when the film is formed at 1 μm / h, it is preferably 70 ° C. to 450 ° C.

また電析法によって酸化亜鉛膜を形成する条件は、耐腐食性容器内に、硝酸イオン、亜鉛イオンを含んだ水溶液を用いるのが好ましい。硝酸イオン、亜鉛イオンの濃度は、0.001mol/lから1.0mol/lの範囲にあるのが望ましく、0.01mol/lから0.5mol/lの範囲にあるのがより望ましく、0.1mol/lから0.25mol/lの範囲にあるのがさらに望ましい。硝酸イオン、亜鉛イオンの供給源としては特に限定するものではなく、両方のイオンの供給源である硝酸亜鉛でもよいし、硝酸イオンの供給源である硝酸アンモニウムなどの水溶性の硝酸塩と、亜鉛イオンの供給源である硫酸亜鉛などの亜鉛塩の混合物であってもよい。さらに、これらの水溶液に、異常成長を抑制したり密着性を向上させるために、炭水化物を加えることも好ましいものである。炭水化物の種類は特に限定されるものではないが、グルコース(ブドウ糖)、フルクトース(果糖)などの単糖類、マルトース(麦芽糖)、サッカロース(ショ糖)などの二糖類、デキストリン、デンプンなどの多糖類などや、これらを混合したものを用いることができる。水溶液中の炭水化物の量は、炭水化物の種類にもよるが概ね、0.001g/lから300g/lの範囲にあるのが望ましく、0.005g/lから100g/lの範囲にあるのがより望ましく、0.01g/lから60g/lの範囲にあることがさらに望ましい。電析法により酸化亜鉛膜を堆積する場合には、前記の水溶液中に酸化亜鉛膜を堆積する基体を陰極にし、亜鉛、白金、炭素などを陽極とするのが好ましい。このとき負荷抵抗を通して流れる電流密度は、10mA/dmから10A/dmであることが好ましい。   As a condition for forming the zinc oxide film by the electrodeposition method, it is preferable to use an aqueous solution containing nitrate ions and zinc ions in a corrosion-resistant container. The concentration of nitrate ions and zinc ions is preferably in the range of 0.001 mol / l to 1.0 mol / l, more preferably in the range of 0.01 mol / l to 0.5 mol / l, and More desirably, it is in the range of 1 mol / l to 0.25 mol / l. The source of nitrate ions and zinc ions is not particularly limited, and zinc nitrate, which is the source of both ions, may be used, or water-soluble nitrates such as ammonium nitrate, which is the source of nitrate ions, and zinc ions. It may be a mixture of zinc salts such as zinc sulfate as a supply source. Furthermore, it is also preferable to add carbohydrates to these aqueous solutions in order to suppress abnormal growth or improve adhesion. The type of carbohydrate is not particularly limited, but monosaccharides such as glucose (fructose) and fructose (fructose), disaccharides such as maltose (malt sugar) and saccharose (sucrose), polysaccharides such as dextrin and starch, etc. Or what mixed these can be used. The amount of carbohydrate in the aqueous solution is generally preferably in the range of 0.001 g / l to 300 g / l, more preferably in the range of 0.005 g / l to 100 g / l, depending on the type of carbohydrate. Desirably, it is further desirable to be in the range of 0.01 g / l to 60 g / l. When depositing a zinc oxide film by the electrodeposition method, it is preferable to use the substrate on which the zinc oxide film is deposited in the aqueous solution as a cathode and zinc, platinum, carbon, or the like as an anode. At this time, the density of the current flowing through the load resistance is preferably 10 mA / dm to 10 A / dm.

(基板)
以上の方法により、基体101−1上に必要に応じて、金属層101−2、第一の透明導電層101−3を積層して基板101を形成する。また、素子の集積化を容易にするために、基板101に中間層として絶縁層を設けてもよい。
(substrate)
The substrate 101 is formed by laminating the metal layer 101-2 and the first transparent conductive layer 101-3 on the base 101-1, as necessary, by the above method. In order to facilitate the integration of elements, an insulating layer may be provided as an intermediate layer on the substrate 101.

(半導体層)
本発明のシリコン系薄膜がその一部を構成する半導体層102の主たる材料としてはSiが用いられる。Siに加えて、SiとC又はGeとの合金を用いても構わない。半導体層をp型半導体層とするにはIII属元素、n型半導体層とするにはV属元素を含有する。p型層及びn型層の電気特性としては、活性化エネルギーが0.2eV以下のものが好ましく、0.1eV以下のものが最適である。また比抵抗としては100Ωcm以下が好ましく、1Ωcm以下が最適である。スタックセル(pin接合を複数有する光起電力素子)の場合、光入射側に近いpin接合のi型半導体層はバンドギャップが広く、遠いpin接合になるに随いバンドギャップが狭くなるのが好ましい。光入射側のドープ層(p型層もしくはn型層)は光吸収の少ない結晶性の半導体か、又はバンドギャップの広い半導体が適している。
(Semiconductor layer)
Si is used as a main material of the semiconductor layer 102 that constitutes a part of the silicon-based thin film of the present invention. In addition to Si, an alloy of Si and C or Ge may be used. To make the semiconductor layer a p-type semiconductor layer, a group III element is contained. To make the semiconductor layer an n-type semiconductor layer, a group V element is contained. As the electrical characteristics of the p-type layer and the n-type layer, those having an activation energy of 0.2 eV or less are preferable, and those having an activation energy of 0.1 eV or less are optimal. The specific resistance is preferably 100 Ωcm or less, and most preferably 1 Ωcm or less. In the case of a stack cell (photovoltaic element having a plurality of pin junctions), the pin junction i-type semiconductor layer close to the light incident side preferably has a wide band gap, and the band gap is preferably narrowed as the far pin junction is formed. . The doped layer (p-type layer or n-type layer) on the light incident side is preferably a crystalline semiconductor with little light absorption or a semiconductor with a wide band gap.

本発明の構成要素である半導体層102についてさらに説明を加えると、図3は本発明の光起電力素子の一例として、一組のpin接合をもつ半導体層102を示す模式的な断面図である。図中102−1は第一の導電型を示す半導体層であり、さらに、本発明のシリコン系薄膜からなるi型半導体層102−2、第二の導電型を示す半導体層102−3を積層する。pin接合を複数持つ半導体層においては、そのなかのうちの少なくとも一つが前記の構成であることが好ましい。   To further explain the semiconductor layer 102 which is a component of the present invention, FIG. 3 is a schematic cross-sectional view showing a semiconductor layer 102 having a pair of pin junctions as an example of the photovoltaic element of the present invention. . In the figure, reference numeral 102-1 denotes a semiconductor layer having a first conductivity type, and further, an i-type semiconductor layer 102-2 made of a silicon-based thin film of the present invention and a semiconductor layer 102-3 having a second conductivity type are stacked. To do. In a semiconductor layer having a plurality of pin junctions, at least one of them preferably has the above structure.

pin接合を2組積層したスタックセルの例としては、i型シリコン系半導体層の組み合わせとして、光入射側から(アモルファスシリコン半導体層、微結晶を含んだシリコン半導体層)、(微結晶を含んだシリコン半導体層、微結晶を含んだシリコン半導体層)となるものがあげられる。また、pin接合を3組積層した光起電力素子の例としてはi型シリコン系半導体層の組み合わせとして、光入射側から(アモルファスシリコン半導体層、微結晶を含んだシリコン半導体層、微結晶を含んだシリコン半導体層)、(アモルファスシリコン半導体層、微結晶を含んだシリコン半導体層、アモルファスシリコンゲルマニウム半導体層)、となるものなどがあげられる。i型半導体層としては光(630nm)の吸収係数(α)が5000cm−1以上、ソーラーシミュレーター(AM1.5、100mW/cm)による擬似太陽光照射化の光伝導度(σp)が10×10−5S/cm以上、暗伝導度(σd)が10×10−6S/cm以下、コンスタントフォトカレントメソッド(CPM)によるアーバックエナジーが55meV以下であるのが好ましい。i型半導体層としては、わずかにp型、n型になっているものでも使用することができる。またi型半導体層にシリコンゲルマニウム半導体層を用いた場合には、界面準位低減や開放電圧を高める目的で、p/i界面、n/i界面の少なくともどちらか一方に、ゲルマニウムを含有していないi型半導体層を挿入した構成をとってもよい。 As an example of a stack cell in which two pairs of pin junctions are stacked, as a combination of i-type silicon semiconductor layers, from the light incident side (amorphous silicon semiconductor layer, silicon semiconductor layer including microcrystals), (including microcrystals) A silicon semiconductor layer or a silicon semiconductor layer containing microcrystals). Further, as an example of a photovoltaic element in which three pairs of pin junctions are stacked, as a combination of i-type silicon-based semiconductor layers, an amorphous silicon semiconductor layer, a silicon semiconductor layer including microcrystals, and microcrystals are included from the light incident side. Silicon semiconductor layer), (amorphous silicon semiconductor layer, silicon semiconductor layer containing microcrystals, amorphous silicon germanium semiconductor layer), and the like. As an i-type semiconductor layer, the absorption coefficient (α) of light (630 nm) is 5000 cm −1 or more, and the photoconductivity (σp) of simulated sunlight irradiation by a solar simulator (AM1.5, 100 mW / cm 2 ) is 10 ×. It is preferable that it is 10 −5 S / cm or more, the dark conductivity (σd) is 10 × 10 −6 S / cm or less, and the Urbach energy by the constant photocurrent method (CPM) is 55 meV or less. As the i-type semiconductor layer, even a slightly p-type or n-type layer can be used. When a silicon germanium semiconductor layer is used for the i-type semiconductor layer, germanium is contained in at least one of the p / i interface and the n / i interface for the purpose of reducing the interface state and increasing the open-circuit voltage. A configuration in which no i-type semiconductor layer is inserted may be employed.

(半導体層の形成方法)
本発明のシリコン系薄膜及び半導体層102を形成するには、高周波プラズマCVD法が適している。以下、高周波プラズマCVD法によって半導体層102を形成する手順の好適な例を示す。
(Method for forming semiconductor layer)
A high-frequency plasma CVD method is suitable for forming the silicon-based thin film and the semiconductor layer 102 of the present invention. Hereinafter, a preferred example of a procedure for forming the semiconductor layer 102 by the high-frequency plasma CVD method will be described.

減圧状態にできる半導体形成用真空容器内を所定の堆積圧力に減圧する。   The inside of the vacuum chamber for semiconductor formation that can be in a reduced pressure state is reduced to a predetermined deposition pressure.

堆積室内に原料ガス、希釈ガス等の材料ガスを導入し、堆積室内を真空ポンプによって排気しつつ、堆積室内を所定の堆積圧力に設定する。   A material gas such as a source gas or a dilution gas is introduced into the deposition chamber, and the deposition chamber is set to a predetermined deposition pressure while the deposition chamber is evacuated by a vacuum pump.

基板101をヒーターによって所定の温度に設定する。   The substrate 101 is set to a predetermined temperature by a heater.

高周波電源によって発振された高周波を前記堆積室に導入する。前記堆積室への導入方法は、高周波がマイクロ波の場合には導波管によって導き石英、アルミナ、窒化アルミニウムなどの誘電体窓を介して堆積室内に導入したり、高周波がVHFやRFの場合には同軸ケーブルによって導き、金属電極を介して堆積室内に導入したりする方法がある。   A high frequency oscillated by a high frequency power supply is introduced into the deposition chamber. When the high frequency is microwave, the introduction method into the deposition chamber is guided by a waveguide and introduced into the deposition chamber through a dielectric window such as quartz, alumina, aluminum nitride, or the high frequency is VHF or RF. In this method, there is a method in which the light is guided by a coaxial cable and introduced into the deposition chamber through a metal electrode.

堆積室内にプラズマを生起させて原料ガスを分解し、堆積室内に配置された基板101上に堆積膜を形成する。この手順を必要に応じて複数回繰り返して半導体層102を形成する。   Plasma is generated in the deposition chamber to decompose the source gas, and a deposited film is formed on the substrate 101 disposed in the deposition chamber. This procedure is repeated a plurality of times as necessary to form the semiconductor layer 102.

半導体層102の形成条件としては、堆積室内の基板温度は100〜450℃、圧力は0.067Pa(0.5mTorr)〜1.5×10Pa(113Torr)、高周波パワー密度は0.001〜2W/cmが好適な条件としてあげられる。さらに本発明のシリコン系薄膜を形成する場合には、高周波導入部と前記基板との距離が3mm以上30mm以下、圧力が100Pa(0.75Torr)以上5000Pa(37.5Torr)以下、プラズマの生起している放電空間の体積をV(m)、前記原料ガスの流量をQ(cm/min(normal))、放電空間の圧力をP(Pa)としたときに、τ=592×V×P/Qで定義される滞留時間τが、0.01秒以上10秒以下であるようにすることが必要である。また、高周波パワー密度としては0.05〜2W/cmが好適な条件である。 The formation conditions of the semiconductor layer 102 are as follows: the substrate temperature in the deposition chamber is 100 to 450 ° C., the pressure is 0.067 Pa (0.5 mTorr) to 1.5 × 10 4 Pa (113 Torr), and the high frequency power density is 0.001 to 0.001. 2 W / cm 3 is a suitable condition. Further, when the silicon-based thin film of the present invention is formed, the distance between the high-frequency introducing portion and the substrate is 3 mm or more and 30 mm or less, the pressure is 100 Pa (0.75 Torr) or more and 5000 Pa (37.5 Torr) or less, and plasma is generated. When the volume of the discharge space is V (m 3 ), the flow rate of the source gas is Q (cm 3 / min (normal)), and the pressure of the discharge space is P (Pa), τ = 592 × V × It is necessary that the residence time τ defined by P / Q is 0.01 seconds or more and 10 seconds or less. Moreover, 0.05-2 W / cm < 3 > is a suitable condition as a high frequency power density.

本発明のシリコン系薄膜及び半導体層102の形成に適した原料ガスとしては、SiF、SiH、SiHF、Siなどのフッ素化シリコン、SiH、Si等の水素化シリコン化合物、合金系にする場合にはさらに、GeHやCHなどのようにGeやCを含有したガス化しうる化合物を水素ガスで希釈して堆積室内に導入することが望ましい。さらにHeなどの不活性ガスを添加してもよい。さらに窒素、酸素等を含有したガス化しうる化合物を原料ガス乃至希釈ガスとして添加してもよい。半導体層をp型層とするためのドーパントガスとしてはB、BF等が用いられる。また、半導体層をn型層とするためのドーパントガスとしては、PH、PF等が用いられる。結晶相の薄膜や、SiC等の光吸収が少ないかバンドギャップの広い層を堆積する場合には、原料ガスに対する希釈ガスの割合を増やし、比較的高いパワー密度の高周波を導入するのが好ましい。 Examples of the source gas suitable for forming the silicon-based thin film and the semiconductor layer 102 of the present invention include fluorinated silicon such as SiF 4 , SiH 2 F 2 , SiH 3 F, and Si 2 F 6 , SiH 4 , Si 2 H 6, and the like. In the case of using a silicon hydride compound or alloy system, it is desirable to introduce a gasifiable compound containing Ge or C, such as GeH 4 or CH 4 , into the deposition chamber after being diluted with hydrogen gas. Further, an inert gas such as He may be added. Further, a gasifiable compound containing nitrogen, oxygen or the like may be added as a source gas or a dilution gas. B 2 H 6 , BF 3 or the like is used as a dopant gas for making the semiconductor layer a p-type layer. As the dopant gas to the semiconductor layer and the n-type layer, PH 3, PF 3 or the like is used. In the case of depositing a crystal phase thin film or a layer with low light absorption or wide band gap such as SiC, it is preferable to increase the ratio of the dilution gas to the source gas and introduce a high frequency with a relatively high power density.

(第二の透明導電層)
第二の透明導電層103は、光入射側の電極であるとともに、その膜厚を適当に設定することにより反射防止膜の役割をかねることができる。第二の透明導電層103は、半導体層102の吸収可能な波長領域において高い透過率を有することと、抵抗率が低いことが要求される。好ましくは550nmにおける透過率が80%以上、より好ましくは85%以上であることが望ましい。抵抗率は5×10−3Ωcm以下、より好ましくは1×10−3Ωcm以下であることが好ましい。第二の透明導電層103の材料としては、ITO、ZnO、In等を好適に用いることができる。その形成方法としては、蒸着、CVD、スプレー、スピンオン、浸漬などの方法が好適である。これらの材料に導電率を変化させる物質を添加してもよい。
(Second transparent conductive layer)
The second transparent conductive layer 103 is an electrode on the light incident side, and can also serve as an antireflection film by appropriately setting its film thickness. The second transparent conductive layer 103 is required to have a high transmittance in the wavelength region that can be absorbed by the semiconductor layer 102 and to have a low resistivity. The transmittance at 550 nm is preferably 80% or more, and more preferably 85% or more. The resistivity is preferably 5 × 10 −3 Ωcm or less, more preferably 1 × 10 −3 Ωcm or less. As a material of the second transparent conductive layer 103, ITO, ZnO, In 2 O 3 or the like can be suitably used. As the formation method, methods such as vapor deposition, CVD, spraying, spin-on, and immersion are suitable. You may add the substance which changes electrical conductivity to these materials.

(集電電極)
集電電極104は集電効率を向上するために透明電極103上に設けられる。その形成方法として、マスクを用いてスパッタによって電極パターンの金属を形成する方法や、導電性ペーストあるいは半田ペーストを印刷する方法、金属線を導電性ペーストで固着する方法などが好適である。
(Collector electrode)
The collecting electrode 104 is provided on the transparent electrode 103 in order to improve the collecting efficiency. As the formation method, a method of forming a metal of an electrode pattern by sputtering using a mask, a method of printing a conductive paste or a solder paste, a method of fixing a metal wire with a conductive paste, and the like are suitable.

なお、必要に応じて光起電力素子の両面に保護層を形成することがある。同時に光起電力素子の裏面(光入射側と反射側)などに鋼板等の補教材を併用してもよい。   In addition, a protective layer may be formed on both surfaces of the photovoltaic element as necessary. At the same time, a supplementary teaching material such as a steel plate may be used together on the back surface (light incident side and reflection side) of the photovoltaic element.

以下の実施例では、半導体素子として太陽電池とTFTとを例に挙げて本発明を具体的にするが、これらの実施例は本発明の内容を何ら限定するものではない。   In the following examples, the present invention will be specifically described by taking solar cells and TFTs as examples of semiconductor elements. However, these examples do not limit the contents of the present invention.

[実施例1]
図2に示した堆積膜形成装置201を用い、以下の手順で図4に示した光起電力素子を形成した。図4は本発明のシリコン系薄膜を有する光起電力素子の一例を示す模式的な断面図である。図中、図1と同様の部材には同じ符号を付して説明を省略する。この光起電力素子の半導体層は、アモルファスn型半導体層102−1Aと微結晶i型半導体層102−2Aと微結晶p型半導体層102−3Aとからなっている。すなわち、この光起電力素子はいわゆるpin型シングルセル光起電力素子である。
[Example 1]
Using the deposited film forming apparatus 201 shown in FIG. 2, the photovoltaic element shown in FIG. 4 was formed by the following procedure. FIG. 4 is a schematic cross-sectional view showing an example of a photovoltaic element having the silicon-based thin film of the present invention. In the figure, members similar to those in FIG. The semiconductor layer of this photovoltaic element is composed of an amorphous n-type semiconductor layer 102-1A, a microcrystalline i-type semiconductor layer 102-2A, and a microcrystalline p-type semiconductor layer 102-3A. That is, this photovoltaic element is a so-called pin type single cell photovoltaic element.

図2は、本発明のシリコン系薄膜及び光起電力素子を製造する堆積膜形成装置の一例を示す模式的な断面図である。図2に示す堆積膜形成装置201は、基板送り出し容器202、半導体形成用真空容器211〜218、基板巻き取り容器203が、ガスゲート221〜229を介して結合することによって構成されている。この堆積膜形成装置201には、各容器及び各ガスゲートを貫いて帯状の導電性基板204がセットされる。帯状の導電性基板204は、基板送り出し容器202に設置されたボビンから巻き出され、基板巻き取り容器203で別のボビンに巻き取られる。   FIG. 2 is a schematic cross-sectional view showing an example of a deposited film forming apparatus for producing the silicon-based thin film and the photovoltaic element of the present invention. The deposited film forming apparatus 201 shown in FIG. 2 includes a substrate delivery container 202, semiconductor formation vacuum containers 211 to 218, and a substrate winding container 203 that are connected through gas gates 221 to 229. In this deposited film forming apparatus 201, a strip-shaped conductive substrate 204 is set through each container and each gas gate. The strip-shaped conductive substrate 204 is unwound from a bobbin installed in the substrate feed container 202 and is wound on another bobbin by the substrate take-up container 203.

半導体形成用真空容器211〜218は、それぞれプラズマ生起領域を形成する堆積室を有している。概堆積室は、プラズマの生起している放電空間を、前記導電性基板と前記高周波導入部で上下を限定し、高周波導入部を取り囲むように設置された放電板で横方向を限定するように構成されている。   Each of the semiconductor forming vacuum vessels 211 to 218 has a deposition chamber for forming a plasma generation region. In the general deposition chamber, the discharge space in which the plasma is generated is limited by the conductive substrate and the high-frequency introduction part, and the horizontal direction is limited by a discharge plate installed so as to surround the high-frequency introduction part. It is configured.

該堆積室内の平板状の高周波導入部241〜248には、高周波電源251〜258から高周波電力を印加することによってグロー放電を生起させ、それによって原料ガスを分解し導電性基板204上に半導体層を堆積させる。高周波導入部241〜248は、導電性基板204と対向しており、不図示の高さ調整機構が具備されている。前記高さ調整機構により、前記導電性基板と高周波導入部との間の距離を変えることができ、同時に放電空間の体積を変えることができる。また、各半導体形成用真空容器211〜218には、原料ガスや希釈ガスを導入するためのガス導入管231〜238が接続されている。   Glow discharge is caused by applying high-frequency power from high-frequency power sources 251 to 258 in the plate-like high-frequency introduction portions 241 to 248 in the deposition chamber, thereby decomposing the source gas and forming a semiconductor layer on the conductive substrate 204. To deposit. The high frequency introducing portions 241 to 248 are opposed to the conductive substrate 204 and are provided with a height adjusting mechanism (not shown). The height adjustment mechanism can change the distance between the conductive substrate and the high-frequency introduction unit, and can simultaneously change the volume of the discharge space. Further, gas introduction pipes 231 to 238 for introducing a source gas and a dilution gas are connected to the respective semiconductor forming vacuum vessels 211 to 218.

図2に示した堆積膜形成装置201は、半導体形成用真空容器を8個具備しているが、以下の実施例においては、すべての半導体形成用真空容器でグロー放電を生起させる必要はなく、製造する光起電力素子の層構成にあわせて各容器でのグロー放電の有無を選択することができる。また、各半導体形成用真空容器には、各堆積室内での導電性基板204と放電空間との接触面積を調整するための、不図示の成膜領域調整板が設けられている。   The deposited film forming apparatus 201 shown in FIG. 2 includes eight semiconductor forming vacuum vessels. However, in the following embodiments, it is not necessary to cause glow discharge in all the semiconductor forming vacuum vessels. The presence or absence of glow discharge in each container can be selected according to the layer structure of the photovoltaic element to be manufactured. Each vacuum chamber for semiconductor formation is provided with a film formation region adjusting plate (not shown) for adjusting the contact area between the conductive substrate 204 and the discharge space in each deposition chamber.

まず、光起電力素子形成に先立って、シリコン系薄膜の配向性の確認実験を行なった。ステンレス(SUS430BA)からなる帯状の基体(幅50cm、長さ200m、厚さ0.125mm)を十分に脱脂、洗浄し、不図示の連続スパッタリング装置に装着し、Ag電極をターゲットとして、厚さ100nmのAg薄膜をスパッタ蒸着させた。さらにZnOターゲットを用いて、厚さ1.2μmのZnO薄膜をAg薄膜の上にスパッタ蒸着し、帯状の導電性基板204を形成した。   First, prior to the formation of the photovoltaic element, an experiment for confirming the orientation of the silicon thin film was performed. A strip-shaped substrate (width 50 cm, length 200 m, thickness 0.125 mm) made of stainless steel (SUS430BA) is sufficiently degreased and washed, and mounted on a continuous sputtering apparatus (not shown), with an Ag electrode as a target and a thickness of 100 nm. An Ag thin film was deposited by sputtering. Further, a ZnO thin film having a thickness of 1.2 μm was sputter-deposited on the Ag thin film using a ZnO target to form a strip-shaped conductive substrate 204.

次に基板送り出し容器202に、導電性基板204を巻いたボビンを装着し、導電性基板204を搬入側のガスゲート、半導体形成用真空容器211、212、213、214、215、216、217、218、搬出側のガスゲートを介し、基板巻き取り容器203まで通し、帯状の導電性基板204がたるまないように張力調整を行った。そして、基板送り出し容器202、半導体形成用真空容器211、212、213、214、215、216、217、218、基板巻き取り容器203を不図示の真空ポンプからなる真空排気系により、6.7×10−4Pa(5×10−6Torr)以下まで充分に真空排気した。 Next, the bobbin around which the conductive substrate 204 is wound is mounted on the substrate delivery container 202, and the conductive substrate 204 is loaded into the gas gate, semiconductor forming vacuum containers 211, 212, 213, 214, 215, 216, 217, and 218. Then, the tension was adjusted so that the belt-shaped conductive substrate 204 would not sag through the gas gate on the carry-out side to the substrate winding container 203. Then, the substrate delivery container 202, the semiconductor formation vacuum containers 211, 212, 213, 214, 215, 216, 217, 218, and the substrate winding container 203 are 6.7 × by a vacuum exhaust system including a vacuum pump (not shown). The vacuum exhaust was sufficiently performed to 10 −4 Pa (5 × 10 −6 Torr) or less.

次に、真空排気系を作動させつつ、半導体形成用真空容器212へガス導入管232から原料ガス及び希釈ガスを供給した。ここで半導体形成用真空容器212内の堆積室は、長手方向の長さが1m、横幅は50cmのものを用いた。また、半導体形成用真空容器212以外の半導体形成用真空容器にはガス導入管から200cm/min(normal)のHガスを供給し、同時に不図示の各ゲートガス供給管から、各ガスゲートにゲートガスとして500cm/min(normal)のHガスを供給した。この状態で真空排気系の排気能力を調整して、半導体形成用真空容器212内の圧力を所定の圧力に調整した。形成条件は表1の212の形成条件に示す通りである。 Next, the source gas and the dilution gas were supplied from the gas introduction pipe 232 to the semiconductor formation vacuum vessel 212 while operating the vacuum exhaust system. Here, the deposition chamber in the semiconductor forming vacuum vessel 212 was 1 m in length in the longitudinal direction and 50 cm in width. In addition, a semiconductor forming vacuum vessel other than the semiconductor forming vacuum vessel 212 is supplied with 200 cm 3 / min (normal) of H 2 gas from a gas introduction tube, and simultaneously, a gate gas is supplied from each gate gas supply tube (not shown) to each gas gate. As a result, 500 cm 3 / min (normal) of H 2 gas was supplied. In this state, the exhaust capacity of the vacuum exhaust system was adjusted to adjust the pressure in the semiconductor formation vacuum vessel 212 to a predetermined pressure. The formation conditions are as shown in the formation conditions of 212 in Table 1.

半導体形成用真空容器212内の圧力が安定したところで、基板送り出し容器202から基板巻き取り容器203の方向に、導電性基板204の移動を開始した。   When the pressure in the semiconductor formation vacuum vessel 212 was stabilized, the movement of the conductive substrate 204 in the direction from the substrate delivery vessel 202 to the substrate take-up vessel 203 was started.

次に、半導体形成用真空容器212内の高周波導入部242に高周波電源252より高周波を導入し、高さ調整機構により前記導電性基板と高周波導入部との間の距離を9mmとして、半導体形成用真空容器212内の堆積室内にグロー放電を生起し、導電性基板204上に、シリコン系薄膜を1μm形成した。ここで、半導体形成用真空容器212には周波数60MHzの高周波を、パワー密度が400mW/cmになるように調整しながらAl製の金属電極からなる高周波導入部242から導入した(比較例1−1)。 Next, a high frequency is introduced from a high frequency power source 252 into the high frequency introducing portion 242 in the semiconductor forming vacuum vessel 212, and the distance between the conductive substrate and the high frequency introducing portion is set to 9 mm by a height adjusting mechanism. A glow discharge was generated in the deposition chamber in the vacuum vessel 212, and a 1 μm silicon-based thin film was formed on the conductive substrate 204. Here, a high frequency with a frequency of 60 MHz was introduced into the semiconductor forming vacuum vessel 212 from a high frequency introducing portion 242 made of an Al metal electrode while adjusting the power density to be 400 mW / cm 3 (Comparative Example 1- 1).

次に、半導体形成用真空容器213内の高周波導入部243に高周波電源253より高周波を導入し、高さ調整機構により前記導電性基板と高周波導入部との間の距離を9mmとして、半導体形成用真空容器213内の堆積室内にグロー放電を生起し、導電性基板204上に、シリコン系薄膜を1μm形成した。形成条件は表1の213の形成条件に示す通りである。ここで、半導体形成用真空容器213には周波数60MHzの高周波を、パワー密度が300mW/cmになるように調整しながらAl製の金属電極からなる高周波導入部243から導入した(比較例1−2)。 Next, a high frequency is introduced from a high frequency power source 253 into the high frequency introducing portion 243 in the semiconductor forming vacuum vessel 213, and the distance between the conductive substrate and the high frequency introducing portion is set to 9 mm by a height adjusting mechanism. A glow discharge was generated in the deposition chamber in the vacuum vessel 213, and a 1 μm silicon-based thin film was formed on the conductive substrate 204. The forming conditions are as shown in the forming conditions 213 in Table 1. Here, a high frequency of 60 MHz was introduced into the semiconductor forming vacuum vessel 213 from a high frequency introducing portion 243 made of an Al metal electrode while adjusting the power density to be 300 mW / cm 3 (Comparative Example 1- 2).

形成したそれぞれのシリコン系薄膜をエックス線回折装置により回折ピークを測定したところ、比較例1−1のシリコン系薄膜は、(400)の回折強度が最大強度となっており、低角側から11反射分の回折強度の総和に対する(400)の回折強度の割合が80%となっており、比較例1−1のシリコン系薄膜は(100)面に優先配向していることが確認できた。また比較例1−2のシリコン系薄膜は、(220)の回折強度が最大強度となっており、低角側から11反射分の回折強度の総和に対する(220)の回折強度の割合が90%となっており、比較例1−2のシリコン系薄膜は(110)面に優先配向していることが確認できた。   When the diffraction peak of each formed silicon-based thin film was measured with an X-ray diffractometer, the silicon-based thin film of Comparative Example 1-1 had a maximum diffraction intensity of (400), and 11 reflections from the low angle side. The ratio of the diffraction intensity of (400) to the total diffraction intensity of the minute was 80%, and it was confirmed that the silicon-based thin film of Comparative Example 1-1 was preferentially oriented in the (100) plane. In addition, the silicon-based thin film of Comparative Example 1-2 has the maximum diffraction intensity of (220), and the ratio of the diffraction intensity of (220) to the total sum of the diffraction intensity of 11 reflections from the low angle side is 90%. It was confirmed that the silicon-based thin film of Comparative Example 1-2 was preferentially oriented in the (110) plane.

次に光起電力素子の作成を行なった。真空排気系を作動させつつ、半導体形成用真空容器211、212、213、215へガス導入管231、232、233、235から原料ガス及び希釈ガスを供給した。ここで半導体形成用真空容器212、213内の放電室は、長手方向の長さが1m、横幅は50cmのものを用いた。また、半導体形成用真空容器211、212、213、215以外の半導体形成用真空容器にはガス導入管から200cm/min(normal)のHガスを供給し、同時に不図示の各ゲートガス供給管から、各ガスゲートにゲートガスとして500sccmのHガスを供給した。この状態で真空排気系の排気能力を調整して、半導体形成用真空容器211、212、213、215内の圧力を所定の圧力に調整した。形成条件は表1に示す通りである。 Next, a photovoltaic element was prepared. The source gas and the dilution gas were supplied from the gas introduction pipes 231, 232, 233, and 235 to the semiconductor forming vacuum vessels 211, 212, 213, and 215 while operating the vacuum exhaust system. Here, the discharge chambers in the semiconductor forming vacuum vessels 212 and 213 are those having a length of 1 m in the longitudinal direction and a width of 50 cm. In addition, a semiconductor forming vacuum vessel other than the semiconductor forming vacuum vessels 211, 212, 213, and 215 is supplied with 200 cm 3 / min (normal) of H 2 gas from a gas introduction tube, and at the same time, each gate gas supply tube (not shown). Then, 500 sccm of H 2 gas was supplied to each gas gate as a gate gas. In this state, the evacuation capacity of the evacuation system was adjusted to adjust the pressure in the semiconductor formation vacuum vessels 211, 212, 213, and 215 to a predetermined pressure. The formation conditions are as shown in Table 1.

半導体形成用真空容器211、212、213、215内の圧力が安定したところで、基板送り出し容器202から基板巻き取り容器203の方向に、導電性基板204の移動を開始した。   When the pressure in the semiconductor forming vacuum vessels 211, 212, 213, and 215 was stabilized, the movement of the conductive substrate 204 was started in the direction from the substrate delivery container 202 to the substrate winding container 203.

次に、半導体形成用真空容器211、212、213、215内の高周波導入部241、242、243、245に高周波電源251、252、253、255より高周波を導入し、半導体形成用真空容器211、212、213、215内の堆積室内にグロー放電を生起し、導電性基板204上に、アモルファスn型半導体層(膜厚30nm)、i型半導体層(膜厚1.5μm)、微結晶p型半導体層(膜厚10nm)を形成し光起電力素子を形成した。ここでi型半導体層は、トータルの膜厚が1.5μmとなるようにし、半導体形成用真空容器212、213内の成膜領域調整板を調整して、表2に示すようにそれぞれの半導体形成用真空容器で形成されるシリコン系薄膜の膜厚を調整した。(比較例1−3、実施例1−1、1−2、1−3、1−4)。   Next, a high frequency is introduced from the high frequency power sources 251, 252, 253, 255 into the high frequency introducing portions 241, 242, 243, 245 in the semiconductor forming vacuum vessels 211, 212, 213, 215, and the semiconductor forming vacuum vessel 211, A glow discharge is generated in the deposition chambers 212, 213, and 215, and an amorphous n-type semiconductor layer (thickness 30 nm), an i-type semiconductor layer (thickness 1.5 μm), and microcrystalline p-type are formed on the conductive substrate 204. A semiconductor layer (film thickness: 10 nm) was formed to form a photovoltaic element. Here, the i-type semiconductor layer has a total film thickness of 1.5 μm, and the film formation region adjusting plates in the semiconductor forming vacuum vessels 212 and 213 are adjusted, so that the respective semiconductors as shown in Table 2 are prepared. The film thickness of the silicon-based thin film formed in the forming vacuum vessel was adjusted. (Comparative Example 1-3, Examples 1-1, 1-2, 1-3, 1-4).

ここで、半導体形成用真空容器211には周波数13.56MHz、パワー密度5mW/cmの高周波電力をAl製の金属電極からなる高周波導入部241から、半導体形成用真空容器212、213には上記のシリコン系薄膜と同様に、半導体形成用真空容器214には周波数13.56MHz、パワー密度30mW/cmの高周波電力をAl製の金属電極からなる高周波導入部244から導入した。 Here, high-frequency power having a frequency of 13.56 MHz and a power density of 5 mW / cm 3 is applied to the semiconductor-forming vacuum vessel 211 from the high-frequency introducing portion 241 made of an Al metal electrode, and the semiconductor-forming vacuum vessels 212 and 213 are connected to the above. Similarly to the silicon-based thin film, high-frequency power having a frequency of 13.56 MHz and a power density of 30 mW / cm 3 was introduced into the semiconductor forming vacuum vessel 214 from a high-frequency introduction unit 244 made of an Al metal electrode.

次に不図示の連続モジュール化装置を用いて、形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した。   Next, the formed strip-shaped photovoltaic device was processed into a 36 cm × 22 cm solar cell module using a continuous modularization apparatus (not shown).

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。また碁盤目テープ法(切り傷の隙間間隔1mm、ます目の数100)を用いて導電性基板と半導体層との間の密着性を調べた。結果を表2に示す。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). In addition, the adhesion between the conductive substrate and the semiconductor layer was examined using a cross-cut tape method (a gap between cuts of 1 mm, a number of squares of 100). The results are shown in Table 2.

さらに実施例1−1の光起電力素子の断面TEM観察を行ったところ、i型半導体層中は半導体形成容器212で形成した領域においては微結晶の形状は球状をしており、半導体形成容器213で形成した領域においては微結晶の形状は基板に対して鉛直に伸びた柱状の形状をしていることがわかった。また、それぞの光起電力素子において、i型半導体層まで形成した形成したサンプルのRHEED図形から、それぞれのi型半導体層の表面層は(110)面に優先配向していることが確認できた。   Further, when the cross-sectional TEM observation of the photovoltaic element of Example 1-1 was performed, the shape of the microcrystal in the region formed by the semiconductor formation container 212 in the i-type semiconductor layer was spherical, and the semiconductor formation container It was found that in the region formed by 213, the shape of the microcrystals was a columnar shape extending perpendicularly to the substrate. Moreover, in each photovoltaic device, it can be confirmed from the RHEED pattern of the sample formed up to the i-type semiconductor layer that the surface layer of each i-type semiconductor layer is preferentially oriented in the (110) plane. It was.

以上のことより、本発明の半導体素子を含む太陽電池は優れた特性をもつことがわかる。(100)面が優先配向している領域が1.0nm以上20nm以下のものは、特に優れていた。   From the above, it can be seen that the solar cell including the semiconductor element of the present invention has excellent characteristics. The region in which the (100) plane is preferentially oriented is particularly excellent when the region is 1.0 nm or more and 20 nm or less.

[実施例2]
図2に示した堆積膜形成装置201を用い、以下の手順で図5に示した光起電力素子を形成した。図5は本発明のシリコン系薄膜を有する光起電力素子の一例を示す模式的な断面図である。図中、図1と同様の部材には同じ符号を付して説明を省略する。この光起電力素子の半導体層は、アモルファスn型半導体層102−1Aと微結晶i型半導体層102−2Aと非晶質シリコン層102−10と微結晶p型半導体層102−3Aとからなっている。すなわち、この光起電力素子はいわゆるpin型シングルセル光起電力素子である。
[Example 2]
Using the deposited film forming apparatus 201 shown in FIG. 2, the photovoltaic element shown in FIG. 5 was formed by the following procedure. FIG. 5 is a schematic cross-sectional view showing an example of a photovoltaic element having the silicon-based thin film of the present invention. In the figure, members similar to those in FIG. The semiconductor layer of this photovoltaic element is composed of an amorphous n-type semiconductor layer 102-1A, a microcrystalline i-type semiconductor layer 102-2A, an amorphous silicon layer 102-10, and a microcrystalline p-type semiconductor layer 102-3A. ing. That is, this photovoltaic element is a so-called pin type single cell photovoltaic element.

次に、半導体形成用真空容器211〜215内の高周波導入部241〜245に高周波電源251〜255より高周波を導入し、半導体形成用真空容器211〜215内の堆積室内にグロー放電を生起し、導電性基板204上に、アモルファスn型半導体層(膜厚30nm)、微結晶i型半導体層(膜厚1.5μm)、非晶質シリコン層、微結晶p型半導体層(膜厚10nm)を形成し光起電力素子を形成した。   Next, a high frequency is introduced from the high frequency power sources 251 to 255 into the high frequency introducing portions 241 to 245 in the semiconductor forming vacuum vessels 211 to 215 to cause glow discharge in the deposition chamber in the semiconductor forming vacuum vessels 211 to 215, An amorphous n-type semiconductor layer (thickness 30 nm), a microcrystalline i-type semiconductor layer (thickness 1.5 μm), an amorphous silicon layer, and a microcrystalline p-type semiconductor layer (thickness 10 nm) are formed over the conductive substrate 204. A photovoltaic element was formed.

ここで、半導体形成用真空容器211、212、213、215内の条件は、実施例1−2と同様にし、半導体形成用真空容器214内の条件は表3に示す。また半導体形成用真空容器214には周波数100MHzの高周波を、パワー密度が100mW/cmになるように調整しながらAl製の金属電極からなる高周波導入部245から導入した。ここで半導体形成用真空容器214内の成膜領域調整板により、表4に膜厚ごとに光起電力素子を形成した。次に不図示の連続モジュール化装置を用いて、形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した(実施例2−1、2−2、2−3、2−4)。 Here, the conditions in the vacuum vessels 211, 212, 213, and 215 for semiconductor formation are the same as in Example 1-2, and the conditions in the vacuum vessel 214 for semiconductor formation are shown in Table 3. Further, a high frequency with a frequency of 100 MHz was introduced into the semiconductor forming vacuum vessel 214 from a high frequency introducing portion 245 made of an Al metal electrode while adjusting the power density to be 100 mW / cm 3 . Here, a photovoltaic element was formed for each film thickness in Table 4 using a film formation region adjusting plate in the semiconductor forming vacuum vessel 214. Next, the formed strip-shaped photovoltaic device was processed into a 36 cm × 22 cm solar cell module using a continuous modularization apparatus (not shown) (Examples 2-1, 2-2, 2-3, 2-4). ).

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。またあらかじめ初期光電変換効率を測定しておいた太陽電池モジュールを50℃に保持した状態で、AM1.5、100mW/cmの擬似太陽光を500時間照射した後に、再度光電変換効率を測定し、光劣化試験による光電変換効率の変化を調べたこれらの結果を表4に示す。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). In addition, the solar cell module whose initial photoelectric conversion efficiency was measured in advance was kept at 50 ° C., and after irradiating the artificial sunlight of AM1.5, 100 mW / cm 2 for 500 hours, the photoelectric conversion efficiency was measured again. Table 4 shows the results of examining the change in photoelectric conversion efficiency by the photodegradation test.

以上のことより、本発明の半導体素子を含む太陽電池は優れた特性をもつことがわかる。また非晶質シリコン層が30nm以下のものは、特に優れていた。   From the above, it can be seen that the solar cell including the semiconductor element of the present invention has excellent characteristics. The amorphous silicon layer having a thickness of 30 nm or less was particularly excellent.

[実施例3]
図2に示した堆積膜形成装置201を用い、図4に示した光起電力素子を形成した。
[Example 3]
The photovoltaic element shown in FIG. 4 was formed using the deposited film forming apparatus 201 shown in FIG.

形成方法は、半導体形成用真空容器213内に導入するSiFガスを表5に示すように酸素を導入したものを用いた以外は実施例1−2と同様の方法で行なった。次に不図示の連続モジュール化装置を用いて、形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した(実施例3−1、3−2、3−3、3−4)。 The formation method was performed in the same manner as in Example 1-2, except that SiF 4 gas introduced into the semiconductor forming vacuum vessel 213 was used with oxygen introduced as shown in Table 5. Next, the formed strip-shaped photovoltaic device was processed into a 36 cm × 22 cm solar cell module using a continuous modularization apparatus (not shown) (Examples 3-1, 3-2, 3-3, 3-4). ).

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。またあらかじめ初期光電変換効率を測定しておいた太陽電池モジュールを、温度85℃、湿度85%の暗所に設置し30分保持、その後70分かけて温度−20℃まで下げ30分保持、再び70分かけて温度85℃m湿度85%まで戻す、このサイクルを100回繰り返した後に再度光電変換効率を測定し、温湿度試験による光電変換効率の変化を調べた。またそれぞれの太陽電池モジュールのSIMS測定を行い、半導体形成用真空容器213で形成したシリコン系薄膜に含まれる酸素濃度を評価した。これらの結果を表6に示す。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). Also, the solar cell module whose initial photoelectric conversion efficiency has been measured in advance is placed in a dark place at a temperature of 85 ° C. and a humidity of 85% and held for 30 minutes, and then lowered to −20 ° C. over 70 minutes and held for 30 minutes. The temperature was returned to 85 ° C. and humidity 85% over 70 minutes. After repeating this cycle 100 times, the photoelectric conversion efficiency was measured again, and the change in the photoelectric conversion efficiency by the temperature and humidity test was examined. Moreover, the SIMS measurement of each solar cell module was performed, and the oxygen concentration contained in the silicon-type thin film formed with the vacuum vessel 213 for semiconductor formation was evaluated. These results are shown in Table 6.

またそれぞれの太陽電池モジュールの断面断面TEM観察を行ったところ、i型半導体層中は半導体形成容器212で形成した領域においては微結晶の形状は球状をしており、半導体形成容器213で形成した領域においては微結晶の形状は基板に対して鉛直に伸びた柱状の形状をしており、実施例3−1、3−2、3−3の太陽電池モジュールの概柱状形状は、実施例1−2、実施例3−4のものと比べて、柱状形状サイズの均一性に特に優れていることがわかった。   Further, when a cross-sectional cross-sectional TEM observation of each solar cell module was performed, in the region formed by the semiconductor formation container 212 in the i-type semiconductor layer, the shape of the microcrystal was spherical, and the semiconductor formation container 213 was formed. In the region, the shape of the microcrystals is a columnar shape extending perpendicularly to the substrate, and the approximate columnar shape of the solar cell modules of Examples 3-1, 3-2, and 3-3 is that of Example 1. -2, compared with the thing of Example 3-4, it turned out that it is especially excellent in the uniformity of columnar shape size.

以上のことより、本発明の半導体素子を含む太陽電池は優れた特性をもつことがわかる。また膜中の酸素濃度が、1.5×1018atoms/cm以上5.0×1019atoms/cm以下のものは、特に優れていた。 From the above, it can be seen that the solar cell including the semiconductor element of the present invention has excellent characteristics. The oxygen concentration in the film was particularly excellent when the oxygen concentration was 1.5 × 10 18 atoms / cm 3 or more and 5.0 × 10 19 atoms / cm 3 or less.

[実施例4]
図2に示した堆積膜形成装置201を用い、図4に示した光起電力素子を形成した。
[Example 4]
The photovoltaic element shown in FIG. 4 was formed using the deposited film forming apparatus 201 shown in FIG.

形成方法は、半導体形成用真空容器213内に導入する原料ガスを表7に示すものを用いた以外は実施例1−2と同様の方法で行なった。次に不図示の連続モジュール化装置を用いて、形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した(実施例4−1、4−2、4−3、4−4、4−5)。   The forming method was performed in the same manner as in Example 1-2 except that the raw material gas introduced into the semiconductor forming vacuum vessel 213 was the one shown in Table 7. Next, the formed strip-shaped photovoltaic device was processed into a 36 cm × 22 cm solar cell module using a continuous modularization apparatus (not shown) (Examples 4-1, 4-2, 4-3, 4-4). 4-5).

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。またあらかじめ初期光電変換効率を測定しておいた太陽電池モジュールを、温度85℃、湿度85%の暗所に設置し30分保持、その後70分かけて温度−20℃まで下げ30分保持、再び70分かけて温度85℃m湿度85%まで戻す、このサイクルを100回繰り返した後に再度光電変換効率を測定し、温湿度試験による光電変換効率の変化を調べた。またそれぞれの太陽電池モジュールのSIMS測定を行い、半導体形成用真空容器213で形成したシリコン系薄膜に含まれるフッ素濃度を評価した。これらの結果を表7に示す。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). Also, the solar cell module whose initial photoelectric conversion efficiency has been measured in advance is placed in a dark place at a temperature of 85 ° C. and a humidity of 85% and held for 30 minutes, and then lowered to −20 ° C. over 70 minutes and held for 30 minutes. The temperature was returned to 85 ° C. and humidity 85% over 70 minutes. After repeating this cycle 100 times, the photoelectric conversion efficiency was measured again, and the change in the photoelectric conversion efficiency by the temperature and humidity test was examined. Moreover, the SIMS measurement of each solar cell module was performed, and the fluorine density | concentration contained in the silicon-type thin film formed with the vacuum vessel 213 for semiconductor formation was evaluated. These results are shown in Table 7.

以上のことより、本発明の半導体素子を含む太陽電池は優れた特性をもつことがわかる。膜中のフッ素濃度が1.0×1019atoms/cm以上2.5×1020atoms/cm以下のものは特に優れていた。 From the above, it can be seen that the solar cell including the semiconductor element of the present invention has excellent characteristics. Those having a fluorine concentration in the film of 1.0 × 10 19 atoms / cm 3 or more and 2.5 × 10 20 atoms / cm 3 or less were particularly excellent.

[実施例5]
図2に示した堆積膜形成装置201を用い、図4に示した光起電力素子を形成した。
[Example 5]
The photovoltaic element shown in FIG. 4 was formed using the deposited film forming apparatus 201 shown in FIG.

形成方法は、半導体形成用真空容器213内でi型半導体層を形成するときに導電性基板の搬送を停止して、半導体形成用真空容器213内に導入するガスの流量比を表8に示すように変化させながら(220)の配向性を成膜方向に徐々に大きくするように変化させるように行ない、それ以外は実施例2−2と同様の方法で行なった。ここで成膜途中の各ガスの流量は、成膜開始時の流量から成膜終了時の流量にむけて直線的に変化させるように行なった。次に不図示の連続モジュール化装置を用いて、形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した(実施例5)。   Table 8 shows the flow rate ratio of gases introduced into the semiconductor formation vacuum vessel 213 by stopping the transport of the conductive substrate when forming the i-type semiconductor layer in the semiconductor formation vacuum vessel 213. While changing in such a manner, the orientation of (220) was changed so as to gradually increase in the film forming direction, and the other processes were performed in the same manner as in Example 2-2. Here, the flow rate of each gas during film formation was changed linearly from the flow rate at the start of film formation to the flow rate at the end of film formation. Next, the formed strip-shaped photovoltaic element was processed into a 36 cm × 22 cm solar cell module using a continuous modularization apparatus (not shown) (Example 5).

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。実施例5の太陽電池モジュールは、実施例2−2の太陽電池モジュールと比較して、1.1倍の光電変換効率であることがわかった。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). The solar cell module of Example 5 was found to have a photoelectric conversion efficiency 1.1 times that of the solar cell module of Example 2-2.

以上のことより、本発明の半導体素子を含む太陽電池は優れた特性を持つことがわかる。   From the above, it can be seen that the solar cell including the semiconductor element of the present invention has excellent characteristics.

[実施例6]
図6に示した堆積膜形成装置201を用い、図4に示した光起電力素子を形成した。
[Example 6]
The photovoltaic element shown in FIG. 4 was formed using the deposited film forming apparatus 201 shown in FIG.

形成方法は、半導体形成用真空容器213内に接続するガス導入管を2系統とし(ガス導入管233−1、233−2)、ガス導入管233−1をガス導入管233−2に対して導電性基板の搬送方向に対して上流側に配置し、それぞれのガス導入管から流す各原料ガスの流量比を表9に示すように変えて、半導体形成用真空容器213内のプラズマ中の活性種の密度を導電性基板の搬送方向で変化させるように行ない、それ以外は実施例2−2と同様の方法で行なった。形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した(実施例6)。   In the formation method, two gas introduction pipes connected to the semiconductor forming vacuum vessel 213 (gas introduction pipes 233-1 and 233-2) and the gas introduction pipe 233-1 to the gas introduction pipe 233-2 are used. The activity in the plasma in the vacuum chamber 213 for semiconductor formation is changed by changing the flow rate ratio of each source gas flowing from each gas introduction pipe as shown in Table 9 on the upstream side with respect to the transport direction of the conductive substrate. The seed density was changed in the direction of conveyance of the conductive substrate, and the other processes were performed in the same manner as in Example 2-2. The formed strip-shaped photovoltaic element was processed into a 36 cm × 22 cm solar cell module (Example 6).

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。実施例6の太陽電池モジュールは、実施例2−2の太陽電池モジュールと比較して、1.15倍の光電変換効率であることがわかった。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). The solar cell module of Example 6 was found to have a photoelectric conversion efficiency of 1.15 times that of the solar cell module of Example 2-2.

以上のことより、本発明の半導体素子を含む太陽電池は優れた特性を持つことがわかる。   From the above, it can be seen that the solar cell including the semiconductor element of the present invention has excellent characteristics.

[実施例7]
図2に示した堆積膜形成装置201を用い、図4に示した光起電力素子を形成した。
[Example 7]
The photovoltaic element shown in FIG. 4 was formed using the deposited film forming apparatus 201 shown in FIG.

形成方法は、半導体形成用真空容器213内のランプヒーターの温度調整により、半導体形成用真空容器213内の成膜温度を成膜開始時に高く(搬送上流の位置の温度が高く)、成膜終了時に低く(搬送下流の位置の温度が低く)なるように行い、それ以外は実施例2−2と同様の方法で行なった。半導体形成用真空容器213での形成条件を表10に示す。形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した(実施例7)。   In the formation method, the temperature of the lamp heater in the semiconductor formation vacuum vessel 213 is adjusted to increase the film formation temperature in the semiconductor formation vacuum vessel 213 at the start of film formation (the temperature at the upstream position of the transfer is high), and the film formation ends. It was performed in a manner similar to Example 2-2, except that the temperature was sometimes lowered (the temperature at the downstream position of the conveyance was low). Table 10 shows the formation conditions in the semiconductor forming vacuum vessel 213. The formed strip-shaped photovoltaic element was processed into a 36 cm × 22 cm solar cell module (Example 7).

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。実施例6の太陽電池モジュールは、実施例2−2の太陽電池モジュールと比較して、1.25倍の光電変換効率であることがわかった。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). The solar cell module of Example 6 was found to have a photoelectric conversion efficiency of 1.25 times that of the solar cell module of Example 2-2.

以上のことより、本発明の半導体素子を含む太陽電池は優れた特性を持つことがわかる。   From the above, it can be seen that the solar cell including the semiconductor element of the present invention has excellent characteristics.

[実施例8]
図2に示した堆積膜形成装置201を用い、図4に示した光起電力素子を形成した。
[Example 8]
The photovoltaic element shown in FIG. 4 was formed using the deposited film forming apparatus 201 shown in FIG.

形成の方法は、半導体形成用真空容器212、213内の高さ調整機構により前記導電性基板と高周波導入部との間の距離を表11に示すように変えながら行い、それ以外は実施例2−2と同様の方法で行なった。形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した。   The forming method is performed while changing the distance between the conductive substrate and the high-frequency introducing portion as shown in Table 11 by the height adjusting mechanism in the semiconductor forming vacuum vessels 212 and 213, and otherwise the second embodiment. -2 in the same manner. The formed strip-shaped photovoltaic element was processed into a 36 cm × 22 cm solar cell module.

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。結果を表10に示す。ここで、距離が2mmのi型半導体層は、膜厚の均一性が悪く、太陽電池モジュールごとの光電変換効率のばらつきが大きかった。そして、導電性基板と高周波導入部間の距離が3mm以上30mm以下の太陽電池モジュールの光電変換効率が優れていた。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). The results are shown in Table 10. Here, the i-type semiconductor layer with a distance of 2 mm had a poor film thickness uniformity and a large variation in photoelectric conversion efficiency for each solar cell module. And the photoelectric conversion efficiency of the solar cell module whose distance between a conductive substrate and a high frequency introduction part is 3 mm or more and 30 mm or less was excellent.

以上のことより、本発明の半導体素子を含む太陽電池は優れた特性を持つことがわかる。   From the above, it can be seen that the solar cell including the semiconductor element of the present invention has excellent characteristics.

[実施例9]
図2に示した堆積膜形成装置201を用い、図4に示した光起電力素子を形成した。
[Example 9]
The photovoltaic element shown in FIG. 4 was formed using the deposited film forming apparatus 201 shown in FIG.

形成の方法は、半導体用真空容器213内の圧力を表12に示すように変えながら行い、それ以外は実施例2−2と同様の方法で行なった。形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した。   The formation was performed while changing the pressure in the semiconductor vacuum vessel 213 as shown in Table 12, and the other methods were performed in the same manner as in Example 2-2. The formed strip-shaped photovoltaic element was processed into a 36 cm × 22 cm solar cell module.

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定した。また碁盤目テープ法(切り傷の隙間間隔1mm、ます目の数100)を用いて導電性基板と半導体層との間の密着性を調べた。またあらかじめ初期光電変換効率を測定しておいた太陽電池モジュールを、温度85℃、湿度85%の暗所に設置し30分保持、その後70分かけて温度−20℃まで下げ30分保持、再び70分かけて温度85℃m湿度85%まで戻す、このサイクルを100回繰り返した後に再度光電変換効率を測定し、温湿度試験による光電変換効率の変化を調べた。これらの結果を表12に示す。 The photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ). In addition, the adhesion between the conductive substrate and the semiconductor layer was examined using a cross-cut tape method (a gap between cuts of 1 mm, a number of squares of 100). Also, the solar cell module whose initial photoelectric conversion efficiency has been measured in advance is placed in a dark place at a temperature of 85 ° C. and a humidity of 85% and held for 30 minutes, and then lowered to −20 ° C. over 70 minutes and held for 30 minutes. The temperature was returned to 85 ° C. and humidity 85% over 70 minutes. After repeating this cycle 100 times, the photoelectric conversion efficiency was measured again, and the change in the photoelectric conversion efficiency by the temperature and humidity test was examined. These results are shown in Table 12.

表12より、半導体形成容器213内の圧力が、90Pa以上15000Pa以下で作製した光起電力素子を含む太陽電池モジュールは、光電変換効率、はがれ試験、温湿度試験、の各項目ですぐれており、特に、100Pa以上5000Pa以下で作製した光起電力素子を含む太陽電池モジュールは、特にはがれ試験に優れた特長を持つことがわかる。以上のことから本発明の半導体素子を含む太陽電池モジュールは、優れた特長を持つことがわかる。   From Table 12, the solar cell module including the photovoltaic element produced at a pressure in the semiconductor formation container 213 of 90 Pa or more and 15000 Pa or less is excellent in each item of photoelectric conversion efficiency, peeling test, temperature and humidity test, In particular, it can be seen that a solar cell module including a photovoltaic element manufactured at 100 Pa or more and 5000 Pa or less has excellent characteristics particularly in a peeling test. From the above, it can be seen that the solar cell module including the semiconductor element of the present invention has excellent features.

[実施例10]
図2に示した堆積膜形成装置201を用い、図4に示した光起電力素子を形成した。
[Example 10]
The photovoltaic element shown in FIG. 4 was formed using the deposited film forming apparatus 201 shown in FIG.

形成の方法は、半導体用真空容器212、213内の滞留時間を表13に示すように変えながら行い、それ以外は実施例2−2と同様の方法で行なった。形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した。   The formation was performed while changing the residence time in the semiconductor vacuum vessels 212 and 213 as shown in Table 13, and the other methods were performed in the same manner as in Example 2-2. The formed strip-shaped photovoltaic element was processed into a 36 cm × 22 cm solar cell module.

表13より、半導体形成容器212内の滞留時間が、0.1秒以上10秒以下で作製した光起電力素子を含む太陽電池モジュールは、光電変換効率、はがれ試験、温湿度試験、光劣化率の各項目ですぐれており、特に、0.2秒以上3.0秒以下で作製した光起電力素子を含む太陽電池モジュールは、特にはがれ試験に優れた特長を持つことがわかる。以上のことから本発明の半導体素子を含む太陽電池モジュールは、優れた特長を持つことがわかる。   From Table 13, the solar cell module including the photovoltaic element manufactured with a residence time in the semiconductor formation container 212 of 0.1 second to 10 seconds is photoelectric conversion efficiency, peeling test, temperature / humidity test, photo deterioration rate. In particular, it can be seen that the solar cell module including the photovoltaic element manufactured in 0.2 seconds or more and 3.0 seconds or less has particularly excellent characteristics in the peeling test. From the above, it can be seen that the solar cell module including the semiconductor element of the present invention has excellent features.

[実施例11]
図2に示した堆積膜形成装置201を用い、以下の手順で図5に示した光起電力素子を形成した。図7は本発明のシリコン系薄膜を有する光起電力素子の一例を示す模式的な断面図である。図中、図1と同様の部材には同じ符号を付して説明を省略する。この光起電力素子の半導体層は、アモルファスn型半導体層102−1A、102−4、微結晶i型半導体層102−2A、アモルファスi型半導体層102−5。非晶質シリコン層102−10と微結晶p型半導体層102−3A、102−6とからなっている。すなわち、この光起電力素子はいわゆるpinpin型ダブルセル光起電力素子である。
[Example 11]
Using the deposited film forming apparatus 201 shown in FIG. 2, the photovoltaic element shown in FIG. 5 was formed by the following procedure. FIG. 7 is a schematic cross-sectional view showing an example of a photovoltaic element having the silicon-based thin film of the present invention. In the figure, members similar to those in FIG. The semiconductor layers of this photovoltaic element are amorphous n-type semiconductor layers 102-1A and 102-4, a microcrystalline i-type semiconductor layer 102-2A, and an amorphous i-type semiconductor layer 102-5. It consists of an amorphous silicon layer 102-10 and microcrystalline p-type semiconductor layers 102-3A and 102-6. That is, this photovoltaic element is a so-called pinpin type double cell photovoltaic element.

実施例1と同様に、帯状の導電性基板204を作成し、堆積膜形成装置201に装着し、基板送り出し容器202、半導体形成用真空容器211、212、213、214、215、216、217、218、基板巻き取り容器203を不図示の真空ポンプからなる真空排気系により、6.7×10−4Pa(5×10−6Torr)以下まで充分に真空排気した。 Similarly to the first embodiment, a strip-shaped conductive substrate 204 is prepared and mounted on the deposition film forming apparatus 201, and the substrate delivery container 202, semiconductor forming vacuum containers 211, 212, 213, 214, 215, 216, 217, 218. The substrate winding container 203 was sufficiently evacuated to 6.7 × 10 −4 Pa (5 × 10 −6 Torr) or less by an evacuation system including a vacuum pump (not shown).

次に、真空排気系を作動させつつ、半導体形成用真空容器211〜218へガス導入管231〜238から原料ガス及び希釈ガスを供給した。ここで半導体形成用真空容器212、213内の放電室は、長手方向の長さが1m、横幅は50cmのものを用いた。また不図示の各ゲートガス供給管から、各ガスゲートにゲートガスとして500sccmのHガスを供給した。この状態で真空排気系の排気能力を調整して、半導体形成用真空容器211〜216内の圧力を所定の圧力に調整した。形成条件は半導体形成用真空容器211から215に関しては実施例2−2と同様の方法で行い、半導体形成用真空容器216〜218に関しては表14に示す通りである。 Next, the source gas and the dilution gas were supplied from the gas introduction pipes 231 to 238 to the semiconductor forming vacuum vessels 211 to 218 while operating the vacuum exhaust system. Here, the discharge chambers in the semiconductor forming vacuum vessels 212 and 213 are those having a length of 1 m in the longitudinal direction and a width of 50 cm. Further, 500 sccm of H 2 gas was supplied as a gate gas from each gate gas supply pipe (not shown) to each gas gate. In this state, the exhaust capacity of the vacuum exhaust system was adjusted to adjust the pressure in the semiconductor forming vacuum vessels 211 to 216 to a predetermined pressure. The formation conditions for the semiconductor forming vacuum vessels 211 to 215 are the same as in Example 2-2, and the semiconductor forming vacuum vessels 216 to 218 are as shown in Table 14.

半導体形成用真空容器211〜218内の圧力が安定したところで、基板送り出し容器202から基板巻き取り容器203の方向に、導電性基板204の移動を開始した。   When the pressure in the semiconductor formation vacuum vessels 211 to 218 was stabilized, the conductive substrate 204 started to move from the substrate delivery container 202 toward the substrate take-up container 203.

次に、半導体形成用真空容器211〜218内の高周波導入部241〜248に高周波電源251〜258より高周波を導入し、半導体形成用真空容器211〜218内の堆積室内にグロー放電を生起し、導電性基板204上に、アモルファスn型半導体層(膜厚30nm)、微結晶i型半導体層(膜厚2.0μm)、微結晶p型半導体層(膜厚10nm)、アモルファスn型半導体層(膜厚30nm)、アモルファスi型半導体層(膜厚300nm)、微結晶p型半導体層(膜厚10nm)を形成し光起電力素子を形成した。ここで微結晶i型半導体層のうち、半導体形成用真空容器212内で10nm形成した。ここで、半導体形成用真空容器211、216には周波数13.56MHz、パワー密度5mW/cmの高周波電力をAl製の金属電極からなる高周波導入部241、246から、半導体形成用真空容器212には、周波数60MHzの高周波を、パワー密度が400mW/cmになるように調整しながらAl製の金属電極からなる高周波導入部242から、半導体形成用真空容器213には、周波数60MHzの高周波を、パワー密度が300mW/cmになるように調整しながらAl製の金属電極からなる高周波導入部243から、半導体形成用真空容器214、217には、周波数100MHzの高周波を、パワー密度が100mW/cmになるように調整しながらAl製の金属電極からなる高周波導入部244、247から、半導体形成用真空容器215、218には周波数13.56MHz、パワー密度30mW/cmの高周波電力をAl製の金属電極からなる高周波導入部245、248から導入した。次に不図示の連続モジュール化装置を用いて、形成した帯状の光起電力素子を36cm×22cmの太陽電池モジュールに加工した。 Next, a high frequency is introduced from the high frequency power sources 251 to 258 into the high frequency introducing portions 241 to 248 in the semiconductor forming vacuum vessels 211 to 218 to cause glow discharge in the deposition chambers in the semiconductor forming vacuum vessels 211 to 218, On the conductive substrate 204, an amorphous n-type semiconductor layer (thickness 30 nm), a microcrystalline i-type semiconductor layer (thickness 2.0 μm), a microcrystalline p-type semiconductor layer (thickness 10 nm), an amorphous n-type semiconductor layer ( A photovoltaic element was formed by forming an amorphous i-type semiconductor layer (film thickness 300 nm) and a microcrystalline p-type semiconductor layer (film thickness 10 nm). Here, 10 nm of the microcrystalline i-type semiconductor layer was formed in the semiconductor forming vacuum vessel 212. Here, high-frequency power having a frequency of 13.56 MHz and a power density of 5 mW / cm 3 is supplied to the semiconductor-forming vacuum vessels 211 and 216 from the high-frequency introducing portions 241 and 246 made of Al metal electrodes to the semiconductor-forming vacuum vessel 212. The high frequency of 60 MHz is fed from the high frequency introducing portion 242 made of an Al metal electrode while adjusting the high frequency of the frequency of 60 MHz so that the power density is 400 mW / cm 3 . While adjusting the power density to be 300 mW / cm 3 , a high frequency of 100 MHz and a power density of 100 mW / cm are applied to the semiconductor forming vacuum vessels 214 and 217 from the high frequency introducing portion 243 made of an Al metal electrode. The high-frequency introduction portions 244 and 247 made of Al metal electrodes while being adjusted to 3 The high-frequency power having a frequency of 13.56 MHz and a power density of 30 mW / cm 3 was introduced into the semiconductor formation vacuum vessels 215 and 218 from the high-frequency introduction portions 245 and 248 made of Al metal electrodes. Next, the formed strip-shaped photovoltaic device was processed into a 36 cm × 22 cm solar cell module using a continuous modularization apparatus (not shown).

以上のようにして作成した太陽電池モジュールの光電変換効率をソーラーシミュレーター(AM1.5、100mW/cm)を用いて測定したところ、実施例2−2におけるシングルの太陽電池モジュールに比べて光電変換効率の値は1.2倍を示した。またはがれ試験、温湿度試験においても良好な結果を示し、以上のことから、本発明の半導体素子を含む太陽電池モジュールは優れた特長を持つことがわかる。 When the photoelectric conversion efficiency of the solar cell module prepared as described above was measured using a solar simulator (AM1.5, 100 mW / cm 2 ), photoelectric conversion was performed as compared with the single solar cell module in Example 2-2. The efficiency value was 1.2 times. Or a favorable result was shown also in the peeling test and the temperature / humidity test, and it can be seen from the above that the solar cell module including the semiconductor element of the present invention has excellent features.

[実施例12]
以下の手順で逆スタガー型のTFTを形成した。図8は本発明の半導体素子を有する逆スタガー型のTFTの一例を示す模式的な断面図である。絶縁性の基板としてガラス基板301を用い、この上にゲート電極302が形成され、さらにゲート絶縁膜303、アンドープのシリコン層からなる活性層304、活性層304上のソース、ドレイン領域に低抵抗のn型非晶質シリコンからなるオーミックコンタクト層305、さらにソース、ドレイン電極306が形成される構成からなる。
[Example 12]
An inverted stagger type TFT was formed by the following procedure. FIG. 8 is a schematic cross-sectional view showing an example of an inverted stagger type TFT having the semiconductor element of the present invention. A glass substrate 301 is used as an insulating substrate, a gate electrode 302 is formed thereon, a gate insulating film 303, an active layer 304 made of an undoped silicon layer, and a low resistance in the source and drain regions on the active layer 304. The structure is such that an ohmic contact layer 305 made of n + -type amorphous silicon, and further source and drain electrodes 306 are formed.

まずガラス基板301上に、スパッタ法によりMo−Ta合金膜層を形成し、パターニングしてゲート電極302を形成した。つぎにCVD法により、シリコン酸化膜からなるゲート絶縁膜303を形成した。その後、図2の半導体形成用真空容器212内にガラス基板をセットして、実施例1の(100)面に優先配向したシリコン系薄膜を15nm形成し、次に半導体形成用真空容器213内にガラス基板をセットして、実施例1の(110)面に優先配向したシリコン系薄膜を65nm形成し、あわせて80nmの活性層304を形成した。次に半導体形成用真空容器211内にガラス基板をセットしてn型非晶質シリコンからなるオーミックコンタクト層305を堆積し、リソグラフィ工程を経てパターニングした。さらに、金属膜の形成とパターニングを行なって、ソース、ドレイン電極306を形成した。最後に、CFとOの混合ガスを用いてソース、ドレイン電極306間に露出しているオーミックコンタクト層305をエッチングして、TFTを形成した(実施例12)。 First, a Mo—Ta alloy film layer was formed on a glass substrate 301 by a sputtering method and patterned to form a gate electrode 302. Next, a gate insulating film 303 made of a silicon oxide film was formed by a CVD method. Thereafter, a glass substrate is set in the semiconductor forming vacuum vessel 212 of FIG. 2 to form a 15 nm thick silicon-based thin film preferentially oriented on the (100) plane of Example 1, and then in the semiconductor forming vacuum vessel 213. A glass substrate was set, a silicon-based thin film preferentially oriented on the (110) plane of Example 1 was formed to 65 nm, and an active layer 304 of 80 nm was formed together. Next, a glass substrate was set in the semiconductor forming vacuum vessel 211, an ohmic contact layer 305 made of n + -type amorphous silicon was deposited, and patterned through a lithography process. Further, a metal film was formed and patterned to form a source / drain electrode 306. Finally, the ohmic contact layer 305 exposed between the source and drain electrodes 306 was etched using a mixed gas of CF 4 and O 2 to form a TFT (Example 12).

活性層304を非晶質シリコン層で80nm形成した以外は実施例12と同様の方法でTFTを形成した(比較例12−1)。   A TFT was formed in the same manner as in Example 12 except that the active layer 304 was formed of an amorphous silicon layer with a thickness of 80 nm (Comparative Example 12-1).

活性層304を(100)面に優先配向したシリコン系薄膜のみで80nm形成した以外は実施例12と同様の方法でTFTを形成した(比較例12−2)。   A TFT was formed in the same manner as in Example 12 except that the active layer 304 was formed with only a silicon thin film preferentially oriented on the (100) plane and having a thickness of 80 nm (Comparative Example 12-2).

実施例12のTFTは、オーミックコンタクト層305のエッチングを行なったときに活性層304の過剰エッチングは起こらなかったが、比較例のTFTでは過剰エッチングが起こり活性層の薄膜化、膜厚の不均一化が起こった。特に比較例12−1のTFTでは過剰エッチングが大きく起こった。またエッチングダメージにより、活性層中にリークパスが発生し、オフ電流の値が実施例12と比較して大きくなった。   In the TFT of Example 12, overetching of the active layer 304 did not occur when the ohmic contact layer 305 was etched, but in the TFT of the comparative example, overetching occurred and the active layer was thinned and the film thickness was not uniform. Happened. In particular, excessive etching occurred greatly in the TFT of Comparative Example 12-1. Further, due to etching damage, a leak path was generated in the active layer, and the value of the off current was larger than that in Example 12.

以上のことから、本発明の半導体素子を含むTFTは優れた特長を持つことがわかる。   From the above, it can be seen that the TFT including the semiconductor element of the present invention has excellent features.

Figure 2011258962
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Figure 2011258962
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光電変換効率は、比較例1−3の値を1に規格化したもの。
はがれ試験は、剥れたます目の数が◎0、○1〜2、△3〜10、×10〜100を意味する
The photoelectric conversion efficiency is a value obtained by standardizing the value of Comparative Example 1-3 to 1.
The peeling test means that the number of peeled eyes is ◎ 0, ◯ 1-2, △ 3-10, x10-100

Figure 2011258962
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Figure 2011258962
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光電変換効率、光劣化率は実施例2−1の値を1に規格化したもの。 The photoelectric conversion efficiency and the light deterioration rate are those obtained by standardizing the value of Example 2-1 to 1.

Figure 2011258962
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それぞれの値は、導電性基板と高周波導入部間の距離3mmのときの値を1に規格化したもの。 Each value is standardized to 1 when the distance between the conductive substrate and the high-frequency introduction portion is 3 mm.

Figure 2011258962
Figure 2011258962

光電変換効率は、半導体形成容器213内の圧力が50Paのときの値を1に規格化した値
はがれ試験は、剥れたます目の数が◎0、○1〜2、△3〜10、×10〜100を意味する
温湿度試験は、(試験後の光電変換効率)/(試験前の光電変換効率)の値
The photoelectric conversion efficiency is a value obtained by standardizing the value when the pressure in the semiconductor formation container 213 is 50 Pa to 1. In the peeling test, the number of peeled-off meshes is ◎ 0, ○ 1-2, △ 3-10, The temperature and humidity test, which means × 10-100, is the value of (photoelectric conversion efficiency after test) / (photoelectric conversion efficiency before test)

Figure 2011258962
Figure 2011258962

光電変換効率は、半導体形成容器212、213内の滞留時間が0.008秒のときの値を1に規格化した値
はがれ試験は、剥れたます目の数が◎0、○1〜2、△3〜10、×10〜100を意味する
温湿度試験は、(試験後の光電変換効率)/(試験前の光電変換効率)の値
The photoelectric conversion efficiency is a value obtained by standardizing the value when the residence time in the semiconductor formation containers 212 and 213 is 0.008 seconds to 1. In the peeling test, the number of peeled eyes is ◎ 0, ○ 1-2 , Δ3-10, × 10-100 means temperature / humidity test, (photoelectric conversion efficiency after test) / (photoelectric conversion efficiency before test)

Figure 2011258962
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101 基板
101−1 基体
101−2 金属層
101−3 第一の透明導電層
102 半導体層
102−1 第一の導電型を示す半導体層
102−1A アモルファスn型半導体層
102−2 i型半導体層
102−2A 微結晶i型半導体層
102−3 第二の導電型を示す半導体層
102−3A 微結晶p型半導体層
102−4 アモルファスn型半導体層
102−5 アモルファスi型半導体層
102−6 微結晶p型半導体層
102−10 非晶質シリコン層
103 透明電極
104 集電電極
201 堆積膜形成装置
202 基板送り出し容器
203 基板巻き取り容器
204 導電性基板
211〜218 半導体形成用真空容器
221〜229 ガスゲート
231〜238 ガス導入管
233−1、233−2 ガス導入管
241〜248 高周波導入部
251〜258 高周波電源
301 ガラス基板
302 ゲート電極
303 ゲート絶縁膜
304 活性層
305 オーミックコンタクト層
306 ソース、ドレイン電極
DESCRIPTION OF SYMBOLS 101 Substrate 101-1 Base body 101-2 Metal layer 101-3 First transparent conductive layer 102 Semiconductor layer 102-1 Semiconductor layer 102-1A amorphous n-type semiconductor layer 102-2 i-type semiconductor layer 102-2A Microcrystalline i-type semiconductor layer 102-3 Semiconductor layer exhibiting second conductivity type 102-3A Microcrystalline p-type semiconductor layer 102-4 Amorphous n-type semiconductor layer 102-5 Amorphous i-type semiconductor layer 102-6 Crystalline p-type semiconductor layer 102-10 Amorphous silicon layer 103 Transparent electrode 104 Current collecting electrode 201 Deposited film forming apparatus 202 Substrate delivery container 203 Substrate winding container 204 Conductive substrate 211-218 Vacuum chamber for semiconductor formation 221-229 Gas gate 231 to 238 Gas introduction pipes 233-1 and 233-2 Gas introduction pipes 241 to 248 High Wave introduction portion 251 to 258 high-frequency power source 301 glass substrate 302 gate electrode 303 gate insulating film 304 active layer 305 ohmic contact layer 306 source and drain electrodes

Claims (9)

基板上にシリコン原子を主成分としたp型半導体層と、i型半導体層と、n型半導体層とを備えたpin型の半導体接合を少なくとも1組含む光起電力素子であって、
前記i型半導体層と前記i型半導体層の下地層である前記p型半導体層またはn型半導体層との界面領域であって前記i型半導体層と前記p型半導体層またはn型半導体層との界面から1.0nm以上20nm以下の界面領域の微結晶が(100)面に優先配向しており、
前記i型半導体層の層厚方向における前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合である(220)面の配向性が前記i型半導体層の下地層である前記p型半導体層又は前記n型半導体層側では小さく、前記下地層から離れるに伴って大きくなるように変化することを特徴とする光起電力素子。
A photovoltaic device comprising at least one set of a pin-type semiconductor junction comprising a p-type semiconductor layer containing silicon atoms as a main component, an i-type semiconductor layer, and an n-type semiconductor layer on a substrate,
An interface region between the i-type semiconductor layer and the p-type semiconductor layer or the n-type semiconductor layer which is a base layer of the i-type semiconductor layer, the i-type semiconductor layer and the p-type semiconductor layer or the n-type semiconductor layer; The crystallites in the interface region from 1.0 nm to 20 nm from the interface are preferentially oriented in the (100) plane,
The orientation of the (220) plane, which is the ratio of the diffraction intensity of the (220) plane by the X-ray or electron beam of the microcrystal in the layer thickness direction of the i-type semiconductor layer to the total diffraction intensity, is an underlayer of the i-type semiconductor layer The photovoltaic element according to claim 1, wherein the photovoltaic element is small on the p-type semiconductor layer or n-type semiconductor layer side and changes so as to increase with distance from the base layer.
前記微結晶を含むi型半導体層と、前記i型半導体層に対して光入射側に配置されている導電型を示す半導体層との間に、非晶質シリコン層を配置したことを特徴とする請求項1に記載の光起電力素子。   An amorphous silicon layer is disposed between the i-type semiconductor layer containing microcrystals and a semiconductor layer having a conductivity type disposed on the light incident side with respect to the i-type semiconductor layer. The photovoltaic device according to claim 1. 前記非晶質シリコン層の膜厚が30nm以下であることを特徴とする請求項2に記載の光起電力素子。   The photovoltaic element according to claim 2, wherein the amorphous silicon layer has a thickness of 30 nm or less. 前記微結晶を含むi型半導体層が、前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合が80%以上である領域を含むことを特徴とする請求項1に記載の光起電力素子。   The i-type semiconductor layer including the microcrystal includes a region in which the ratio of the diffraction intensity of the (220) plane by the X-ray or electron beam of the microcrystal to the total diffraction intensity is 80% or more. The photovoltaic element as described in. 前記微結晶を含むi型半導体層中で、(110)面の優先配向をしている微結晶が、前記基板に対して鉛直方向に伸びた柱状の形状をしていることを特徴とする請求項1に記載の光起電力素子。   The microcrystal having a preferential orientation of (110) plane in the i-type semiconductor layer including the microcrystal has a columnar shape extending in a vertical direction with respect to the substrate. Item 2. The photovoltaic device according to Item 1. 前記界面領域の微結晶が概球状の形状をしていることを特徴とする請求項1に記載の光起電力素子。   The photovoltaic element according to claim 1, wherein the crystallites in the interface region have a substantially spherical shape. 前記微結晶を含むi型半導体層が、酸素原子、炭素原子、窒素原子の少なくともひとつを含み、それらの総量が1.5×1018atoms/cm以上5.0×1019atoms/cm以下であることを特徴とする請求項1に記載の光起電力素子。 The i-type semiconductor layer including the microcrystal includes at least one of an oxygen atom, a carbon atom, and a nitrogen atom, and the total amount thereof is 1.5 × 10 18 atoms / cm 3 or more and 5.0 × 10 19 atoms / cm 3. The photovoltaic element according to claim 1, wherein: 基板上にゲート電極、ゲート絶縁膜、活性層、コンタクト層、ソース電極、ドレイン電極とを有するTFTであって、
前記ゲート電極と前記活性層との間に前記ゲート絶縁膜が配され、前記活性層と前記ソース電極又は前記ドレイン電極との間に前記コンタクト層が配されており、
前記活性層と前記活性層の下地層である前記ゲート絶縁層との界面領域であって前記活性層と前記ゲート絶縁層との界面から1.0nm以上20nm以下の界面領域の微結晶が(100)面に優先配向しており、
前記活性層の層厚方向における前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合である(220)面の配向性が前記ゲート絶縁膜側では小さく、前記ゲート絶縁膜から離れるに伴って大きくなるように変化することを特徴とするTFT。
A TFT having a gate electrode, a gate insulating film, an active layer, a contact layer, a source electrode, and a drain electrode on a substrate,
The gate insulating film is disposed between the gate electrode and the active layer, and the contact layer is disposed between the active layer and the source electrode or the drain electrode,
There are microcrystals in an interface region between the active layer and the gate insulating layer which is an underlayer of the active layer, the interface region being 1.0 nm or more and 20 nm or less from the interface between the active layer and the gate insulating layer (100 ) Is preferentially oriented to the surface,
The orientation of the (220) plane, which is the ratio of the diffraction intensity of the (220) plane by X-rays or electron beams of the microcrystal in the layer thickness direction of the active layer to the total diffraction intensity, is small on the gate insulating film side, and the gate A TFT that changes so as to increase with distance from an insulating film.
p型半導体層、n型半導体層又は絶縁層から選択される下地層の上に微結晶を含んだシリコン原子を主成分とするi型半導体層の形成方法であって、真空容器内に水素化シリコン、フッ素化シリコンガスの少なくとも一方と、水素を含む原料ガスとを導入し、
前記水素化シリコン、フッ素化シリコンガスの少なくとも一方又は前記水素を含む原料ガス流量の比率を変化させて、エッチング効果の低い雰囲気で、水素を成長面に供給することにより、
前記i型半導体層と前記i型半導体層の下地層である前記p型半導体層またはn型半導体層との界面領域であって前記i型半導体層と前記p型半導体層またはn型半導体層との界面から1.0nm以上20nm以下の界面領域の微結晶が(100)面に優先配向しており、
前記i型半導体層の膜厚方向における前記微結晶のエックス線または電子線による(220)面の回折強度の全回折強度に対する割合である(220)面の配向性が前記シリコン系薄膜の形成初期には小さく、膜の堆積に伴って大きくなるように変化させることを特徴とするi型半導体層の形成方法。
A method of forming an i-type semiconductor layer containing silicon atoms containing microcrystals as a main component on a base layer selected from a p-type semiconductor layer, an n-type semiconductor layer, or an insulating layer, and hydrogenating the vacuum container Introducing at least one of silicon and fluorinated silicon gas and a source gas containing hydrogen;
By changing the ratio of the raw material gas flow rate containing at least one of the silicon hydride and fluorinated silicon gas or the hydrogen, and supplying hydrogen to the growth surface in an atmosphere having a low etching effect,
An interface region between the i-type semiconductor layer and the p-type semiconductor layer or the n-type semiconductor layer which is a base layer of the i-type semiconductor layer, the i-type semiconductor layer and the p-type semiconductor layer or the n-type semiconductor layer; The crystallites in the interface region from 1.0 nm to 20 nm from the interface are preferentially oriented in the (100) plane,
The orientation of the (220) plane, which is the ratio of the diffraction intensity of the (220) plane by the X-ray or electron beam of the microcrystal in the film thickness direction of the i-type semiconductor layer to the total diffraction intensity, is at the initial stage of formation of the silicon-based thin film. The method for forming an i-type semiconductor layer is characterized in that it is small and changes so as to increase as the film is deposited.
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