JP2011228946A - パルス変調回路 - Google Patents
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Abstract
【解決手段】パルス変調回路1Aは、間欠的な高周波信号を生成するための回路であって、一対のトランジスタQ3,Q4を含む差動回路20と、トランジスタQ3,Q4のうち一方のトランジスタQ3と直列に接続され、差動信号を出力する一対のトランジスタQ1,Q2を含む差動回路10と、差動回路10から出力された差動信号を各ゲートに受ける一対のトランジスタQ7,Q8を含む差動回路40とを備える。一対のトランジスタQ1,Q2のゲートには相補的なRF信号Srf1,Srf2が入力され、一対のトランジスタQ3,Q4の各ゲートには相補的なパルス信号Sp1,Sp2が入力される。
【選択図】図1
Description
図1は、本発明の第1実施形態に係るパルス変調回路1Aの構成を示す回路図である。本実施形態のパルス変調回路1Aは、間欠的な(パルス状の)高周波信号を生成するための回路であって、具体的には、バースト信号によりRF信号のオン/オフを行うパルスレーダ用信号源回路(バースト信号発生回路)である。図1に示すように、パルス変調回路1Aは、差動回路10,20及び40を備える。また、パルス変調回路1Aは、2つのソースフォロワ回路31及び32、並びに4つの電流源11〜14を備える。
図7は、本発明の第2実施形態に係るパルス変調回路1Bの構成を示す回路図である。第1実施形態のパルス変調回路1A(図1)と異なる点は、このパルス変調回路1Bが、3つのトランジスタQ9,Q10及びQ11を更に備える点である。なお、他の構成については第1実施形態と同様なので、詳細な説明を省略する。
図9は、本発明の第3実施形態に係るパルス変調回路1Cの構成を示す回路図である。第1実施形態のパルス変調回路1A(図1)と異なる点は、このパルス変調回路1Cが、3つのトランジスタQ11,Q12及びQ13を更に備える点である。なお、他の構成については第1実施形態と同様なので、詳細な説明を省略する。
図10は、本発明の第4実施形態に係るパルス変調回路1Dの構成を示す回路図である。第1実施形態のパルス変調回路1A(図1)と異なる点は、このパルス変調回路1Dが、第5の差動回路70を更に備える点である。なお、他の構成については第1実施形態と同様なので、詳細な説明を省略する。
トランジスタQ14及びQ15は、トランジスタQ1及びQ2のうち差動回路10が接続されていないトランジスタQ2の一方の電流端子(ドレイン)と直列に接続される。
Claims (5)
- 間欠的な高周波信号を生成するためのパルス変調回路であって、
一対の第1のトランジスタを含む第1の差動回路と、
前記一対の第1のトランジスタのうち一方の前記第1のトランジスタの一方の電流端子と直列に接続され、差動信号を出力する一対の第2のトランジスタを含む第2の差動回路と、
前記第2の差動回路から出力された前記差動信号を各制御端子に受ける一対の第3のトランジスタを含む第3の差動回路と
を備え、
前記一対の第1のトランジスタ及び前記一対の第2のトランジスタのうち一方の各制御端子に相補的な高周波信号が入力され、他方の各制御端子に相補的なパルス信号が入力されることを特徴とする、パルス変調回路。 - 一対の第4のトランジスタを含む第4の差動回路を更に備え、
前記一対の第4のトランジスタのうち一方の前記第4のトランジスタが前記一対の第2のトランジスタのうち一方の前記第2のトランジスタと並列に接続されており、他方の前記第4のトランジスタが前記一対の第2のトランジスタのうち他方の前記第2のトランジスタと並列に接続されており、
前記一方の第4のトランジスタの制御端子には前記一方の第2のトランジスタの制御端子に入力される前記高周波信号とは逆相で同周期の高周波信号が入力され、前記他方の第4のトランジスタの制御端子には前記他方の第2のトランジスタの制御端子に入力される前記高周波信号とは逆相で同周期の高周波信号が入力されていることを特徴とする、請求項1に記載のパルス変調回路。 - 前記一対の第4のトランジスタと直列に接続された第6のトランジスタを更に備え、
前記第6のトランジスタの制御端子にはローレベルの直流信号が入力されることを特徴とする、請求項3に記載のパルス変調回路。 - 一対の第4のトランジスタを含む第4の差動回路と当該一対の第4のトランジスタと直列に接続された第6のトランジスタを更に備えており、
当該一対の第4のトランジスタは前記一対の第1のトランジスタの出力を受けその位相を反転して前記第1のトランジスタの出力に戻しており、
前記第6のトランジスタの制御端子にはローレベルの直流信号が入力されることを特徴とする、請求項1に記載のパルス変調回路。 - 前記一対の第1のトランジスタのうち他方の前記第1のトランジスタの一方の電流端子と直列に接続される一対の第5のトランジスタを含む第5の差動回路を更に備え、
前記一対の第5のトランジスタのうち一方の前記第5のトランジスタの制御端子にハイレベルの直流信号が入力され、他方の前記第5のトランジスタの制御端子にローレベルの直流信号が入力されることを特徴とする、請求項1〜4のいずれか一項に記載のパルス変調回路。
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JP2010097103A JP2011228946A (ja) | 2010-04-20 | 2010-04-20 | パルス変調回路 |
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2010
- 2010-04-20 JP JP2010097103A patent/JP2011228946A/ja active Pending
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