JP2011082570A - Method of manufacturing group iii nitride semiconductor light emitting device - Google Patents

Method of manufacturing group iii nitride semiconductor light emitting device Download PDF

Info

Publication number
JP2011082570A
JP2011082570A JP2011002985A JP2011002985A JP2011082570A JP 2011082570 A JP2011082570 A JP 2011082570A JP 2011002985 A JP2011002985 A JP 2011002985A JP 2011002985 A JP2011002985 A JP 2011002985A JP 2011082570 A JP2011082570 A JP 2011082570A
Authority
JP
Japan
Prior art keywords
layer
buffer layer
substrate
group iii
iii nitride
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2011002985A
Other languages
Japanese (ja)
Inventor
Taisuke Yokoyama
泰典 横山
Hisayuki Miki
久幸 三木
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Resonac Holdings Corp
Original Assignee
Showa Denko KK
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Showa Denko KK filed Critical Showa Denko KK
Priority to JP2011002985A priority Critical patent/JP2011082570A/en
Publication of JP2011082570A publication Critical patent/JP2011082570A/en
Pending legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32245Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/44Structure, shape, material or disposition of the wire connectors prior to the connecting process
    • H01L2224/45Structure, shape, material or disposition of the wire connectors prior to the connecting process of an individual wire connector
    • H01L2224/45001Core members of the connector
    • H01L2224/45099Material
    • H01L2224/451Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof
    • H01L2224/45138Material with a principal constituent of the material being a metal or a metalloid, e.g. boron (B), silicon (Si), germanium (Ge), arsenic (As), antimony (Sb), tellurium (Te) and polonium (Po), and alloys thereof the principal constituent melting at a temperature of greater than or equal to 950°C and less than 1550°C
    • H01L2224/45144Gold (Au) as principal constituent
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48257Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a die pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/49Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
    • H01L2224/491Disposition
    • H01L2224/49105Connecting at different heights
    • H01L2224/49107Connecting at different heights on the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/13Discrete devices, e.g. 3 terminal devices
    • H01L2924/1304Transistor
    • H01L2924/1305Bipolar Junction Transistor [BJT]

Abstract

<P>PROBLEM TO BE SOLVED: To provide a method of manufacturing a group III nitride semiconductor light emitting device having superior light emission characteristics, the method being capable of forming a buffer layer on a substrate using a reactive sputter method and growing a group III nitride semiconductor superior in crystallinity thereon. <P>SOLUTION: The method is a method in which a buffer layer 12 including at least a group III nitride compound is laminated on a substrate 11 including sapphire and an n-type semiconductor layer 14, a light emitting layer 15, and a p-type semiconductor layer 16 are laminated sequentially on the buffer layer 12, wherein within a chamber of a sputter device, a temperature at which the substrate is heated is set to or higher than the film formation temperature of the buffer layer 12 and a dummy discharge is caused, and then under a condition that the achieved degree of vacuum within the chamber of the sputter device is 2×10<SP>-5</SP>Pa or less, the buffer layer 12 is formed from AlN using the reactive sputter method using a gas including a metal Al material and nitrogen elements. <P>COPYRIGHT: (C)2011,JPO&INPIT

Description

本発明は、発光ダイオード(LED)、レーザダイオード(LD)、電子デバイス等に、好適に用いられ、一般式AlGaInN(0≦a≦1、0≦b≦1、0≦c≦1、a+b+c=1)で表されるIII族窒化物半導体が積層されてなるIII族窒化物半導体発光素子の製造方法に関する。 The present invention is a light emitting diode (LED), a laser diode (LD), a electronic device, etc., suitably used, formula Al a Ga b In c N ( 0 ≦ a ≦ 1,0 ≦ b ≦ 1,0 ≦ The present invention relates to a method for manufacturing a group III nitride semiconductor light-emitting device in which group III nitride semiconductors represented by c ≦ 1, a + b + c = 1) are stacked.

III族窒化物半導体は、可視光から紫外光領域の範囲に相当するエネルギーの直接遷移型のバンドギャップを有し、発光効率に優れていることから、発光ダイオード(LED)やレーザダイオード(LD)等の半導体発光素子として製品化され、各種用途で使用されている。また、電子デバイスに用いた場合でも、III族窒化物半導体は、従来のIII−V族化合物半導体を用いた場合に比べて優れた特性が得られるポテンシャルを有している。   Group III nitride semiconductors have a direct transition type band gap of energy corresponding to the range from visible light to ultraviolet light, and are excellent in luminous efficiency. Therefore, light emitting diodes (LEDs) and laser diodes (LDs) It is commercialized as a semiconductor light emitting device such as, and is used in various applications. Even when used in an electronic device, the group III nitride semiconductor has a potential for obtaining superior characteristics as compared with the case of using a conventional group III-V compound semiconductor.

このようなIII族窒化物半導体は、一般的に、トリメチルガリウム、トリメチルアルミニウムおよびアンモニアを原料として、有機金属化学気相成長(MOCVD)法によって製造されている。MOCVD法は、キャリアガスに原料の蒸気を含ませて基板表面に運搬し、加熱された基板の表面で原料を分解させることにより、結晶を成長させる方法である。   Such group III nitride semiconductors are generally manufactured by metal organic chemical vapor deposition (MOCVD) using trimethylgallium, trimethylaluminum and ammonia as raw materials. The MOCVD method is a method in which a vapor of a raw material is contained in a carrier gas and conveyed to the substrate surface, and the raw material is decomposed on the surface of the heated substrate to grow crystals.

従来、III族窒化物半導体の単結晶ウェーハは市販されておらず、III族窒化物半導体としては、異なる材料の単結晶ウェーハ上に結晶を成長させて得る方法が一般的である。このような、異種基板と、その上にエピタキシャル成長させるIII族窒化物半導体結晶との間には、大きな格子不整合が存在する。例えば、サファイア(Al)基板上に窒化ガリウム(GaN)を成長させた場合、両者の間には16%の格子不整合が存在し、SiC基板上に窒化ガリウムを成長させた場合には、両者の間に6%の格子不整合が存在する。一般に、上述のような大きな格子不整合が存在する場合、基板上に結晶を直接エピタキシャル成長させることが困難となり、また、成長させた場合であっても結晶性の良好な結晶が得られないという問題がある。 Conventionally, group III nitride semiconductor single crystal wafers are not commercially available, and group III nitride semiconductors are generally obtained by growing crystals on single crystal wafers of different materials. There is a large lattice mismatch between such a heterogeneous substrate and a group III nitride semiconductor crystal epitaxially grown thereon. For example, when gallium nitride (GaN) is grown on a sapphire (Al 2 O 3 ) substrate, there is a 16% lattice mismatch between the two, and when gallium nitride is grown on a SiC substrate. There is a 6% lattice mismatch between the two. In general, when there is a large lattice mismatch as described above, it is difficult to epitaxially grow a crystal directly on a substrate, and a crystal with good crystallinity cannot be obtained even when grown. There is.

そこで、有機金属化学気相成長(MOCVD)法により、サファイア単結晶基板もしくはSiC単結晶基板の上に、III族窒化物半導体結晶をエピタキシャル成長させる際、まず、基板上に窒化アルミニウム(AlN)や窒化アルミニウムガリウム(AlGaN)からなる低温バッファ層と呼ばれる層を積層し、その上に高温でIII族窒化物半導体結晶をエピタキシャル成長させる方法が提案されており、一般に行われている(例えば、特許文献1、2)。   Therefore, when a group III nitride semiconductor crystal is epitaxially grown on a sapphire single crystal substrate or SiC single crystal substrate by metal organic chemical vapor deposition (MOCVD), first, aluminum nitride (AlN) or nitride is formed on the substrate. A method of stacking a layer called a low-temperature buffer layer made of aluminum gallium (AlGaN) and epitaxially growing a group III nitride semiconductor crystal on the layer at a high temperature has been proposed (for example, Patent Document 1, 2).

しかしながら、特許文献1及び2に記載された方法では、基本的に、基板とその上に成長されるIII族窒化物半導体結晶との間が格子整合していないため、成長した結晶の内部に、表面に向かって伸びる貫通転位と呼ばれる転位を内包した状態となる。このため、結晶に歪みが生じてしまい、構造を適正化しなければ充分な発光強度を得ることができず、また、生産性が低下してしまう等の問題があった。   However, in the methods described in Patent Documents 1 and 2, basically, since there is no lattice matching between the substrate and the group III nitride semiconductor crystal grown on the substrate, the inside of the grown crystal, It becomes a state including dislocations called threading dislocations extending toward the surface. For this reason, the crystals are distorted, and there is a problem that sufficient light emission intensity cannot be obtained unless the structure is optimized, and the productivity is lowered.

また、上記バッファ層をMOCVD以外の方法で成膜する技術も提案されている。例えば、高周波スパッタで成膜したバッファ層上に、MOCVDによって同じ組成の結晶を成長させる方法が提案されている(例えば、特許文献3)。しかしながら、特許文献3に記載の方法では、基板上に、安定して良好な結晶を積層することができないという問題がある。   A technique for forming the buffer layer by a method other than MOCVD has also been proposed. For example, a method of growing crystals having the same composition by MOCVD on a buffer layer formed by high-frequency sputtering has been proposed (for example, Patent Document 3). However, the method described in Patent Document 3 has a problem that a good crystal cannot be stably stacked on the substrate.

そこで、安定して良好な結晶を得るため、バッファ層を成長させた後、アンモニアと水素からなる混合ガス中でアニールする方法(例えば、特許文献4)や、バッファ層を400℃以上の温度で、DCスパッタによって成膜する方法(例えば、特許文献5)等が提案されている。
また、サファイア基板上に、所定の酸素組成比及び窒素組成比とされた酸窒化アルミニウム層を形成し、この酸窒化アルミニウム層の上にp形不純物が導入された窒化物半導体からなるバッファ層を形成し、さらに、このバッファ層上に窒化物半導体薄膜を形成する方法が提案されている(例えば、特許文献6)。
Therefore, in order to obtain a stable and good crystal, after growing the buffer layer, annealing is performed in a mixed gas composed of ammonia and hydrogen (for example, Patent Document 4), or the buffer layer is heated at a temperature of 400 ° C. or higher. A method of forming a film by DC sputtering (for example, Patent Document 5) has been proposed.
Further, an aluminum oxynitride layer having a predetermined oxygen composition ratio and nitrogen composition ratio is formed on the sapphire substrate, and a buffer layer made of a nitride semiconductor into which a p-type impurity is introduced on the aluminum oxynitride layer is provided. A method of forming a nitride semiconductor thin film on the buffer layer has been proposed (for example, Patent Document 6).

特許第3026087号公報Japanese Patent No. 3026087 特開平4−297023号公報Japanese Patent Laid-Open No. 4-297003 特公平5−86646号公報Japanese Patent Publication No. 5-86646 特許第3440873号公報Japanese Patent No. 3440873 特許第3700492号公報Japanese Patent No. 3700492 特開2006−4970号公報JP 2006-4970 A

上記特許文献3〜6に記載されたようなスパッタ法を用いて基板上にバッファ層を形成した場合、スパッタ装置のチャンバ内壁に付着した水分等の酸素含有物がスパッタによって内壁から叩き出され、基板上にバッファ層を成膜する際に不可避的に混入する。このため、スパッタ法を用いて形成されたバッファ層は、少なくとも一定以上、例えば、2%程度の範囲で酸素を含有する膜となる。
しかしながら、本発明者等が鋭意検討したところ、バッファ層中の酸素濃度が、例えば1%を越えると、このバッファ層上に積層されるIII族窒化物半導体の結晶性が低下し、III族窒化物半導体からなる発光素子の発光特性が低下する場合があった。
When the buffer layer is formed on the substrate using the sputtering method as described in Patent Documents 3 to 6, oxygen-containing substances such as moisture attached to the inner wall of the chamber of the sputtering apparatus are knocked out of the inner wall by sputtering, When the buffer layer is formed on the substrate, it is inevitably mixed. For this reason, the buffer layer formed by the sputtering method is a film containing oxygen in at least a certain range, for example, in a range of about 2%.
However, as a result of intensive studies by the present inventors, when the oxygen concentration in the buffer layer exceeds, for example, 1%, the crystallinity of the group III nitride semiconductor laminated on the buffer layer decreases, and the group III nitride In some cases, the light emitting characteristics of a light emitting element made of a physical semiconductor deteriorate.

本発明は上記問題に鑑みてなされたものであり、優れた発光特性を有するIII族窒化物半導体発光素子を得ることが可能なIII族窒化物半導体発光素子の製造方法を提供することを目的とする。   The present invention has been made in view of the above problems, and an object of the present invention is to provide a method for producing a group III nitride semiconductor light emitting device capable of obtaining a group III nitride semiconductor light emitting device having excellent light emission characteristics. To do.

本発明は以下に関する。
[1] サファイアからなる基板上に、少なくともIII族窒化物化合物からなるバッファ層を積層し、該バッファ層上に、n型半導体層、発光層及びp型半導体層を順次積層するIII族窒化物半導体発光素子の製造方法であって、スパッタ装置のチャンバ内において、基板加熱用の設定温度をバッファ層の成膜温度と同じかそれ以上としてダミー放電を行ない、その後、スパッタ装置のチャンバ内の到達真空度を2×10−5Pa以下の条件として、金属Al原料と窒素元素を含んだガスとを用いた反応性スパッタ法を用いて、バッファ層をAlNから形成することを特徴とするIII族窒化物半導体発光素子の製造方法。
[2] 前記バッファ層を、RFスパッタ法によって形成することを特徴とする上記[1]に記載のIII族窒化物半導体発光素子の製造方法。
[3] 前記バッファ層を、前記基板の温度を400〜800℃の範囲として形成することを特徴とする上記[1]または[2]に記載のIII族窒化物半導体発光素子の製造方法。
The present invention relates to the following.
[1] A group III nitride in which a buffer layer made of at least a group III nitride compound is stacked on a substrate made of sapphire, and an n-type semiconductor layer, a light emitting layer, and a p-type semiconductor layer are sequentially stacked on the buffer layer. A method of manufacturing a semiconductor light emitting device, wherein a dummy discharge is performed with a set temperature for heating a substrate equal to or higher than a film formation temperature of a buffer layer in a chamber of a sputtering apparatus, and then reaching the chamber of the sputtering apparatus The buffer layer is formed of AlN by using a reactive sputtering method using a metal Al raw material and a gas containing a nitrogen element under a vacuum degree of 2 × 10 −5 Pa or less. A method for manufacturing a nitride semiconductor light emitting device.
[2] The method for producing a group III nitride semiconductor light-emitting device according to [1], wherein the buffer layer is formed by an RF sputtering method.
[3] The method for producing a group III nitride semiconductor light-emitting device according to the above [1] or [2], wherein the buffer layer is formed at a temperature of the substrate of 400 to 800 ° C.

本発明のIII族窒化物半導体発光素子の製造方法によれば、スパッタ装置のチャンバ内において、基板加熱用の設定温度をバッファ層の成膜温度と同じかそれ以上としてダミー放電を行ない、その後、スパッタ装置のチャンバ内の到達真空度を2×10−5Pa以下の条件として、金属Al原料と窒素元素を含んだガスとを用いた反応性スパッタ法を用いて、バッファ層をAlNから形成する方法を採用している。これにより、基板上に形成されるバッファ層が酸素を含有し、かつ、バッファ層中の酸素濃度を1原子%以下とすることができるので、このバッファ層上に積層されるIII族窒化物半導体の結晶性が向上する。従って、優れた発光特性を有するIII族窒化物半導体発光素子を製造することが可能となる。 According to the method for manufacturing a group III nitride semiconductor light emitting device of the present invention, in the chamber of the sputtering apparatus, dummy discharge is performed with the set temperature for substrate heating equal to or higher than the film formation temperature of the buffer layer, and then The buffer layer is formed from AlN by a reactive sputtering method using a metal Al raw material and a gas containing nitrogen element under the condition that the ultimate vacuum in the chamber of the sputtering apparatus is 2 × 10 −5 Pa or less. The method is adopted. As a result, the buffer layer formed on the substrate contains oxygen, and the oxygen concentration in the buffer layer can be reduced to 1 atomic% or less. Therefore, the group III nitride semiconductor laminated on the buffer layer The crystallinity of the is improved. Therefore, a group III nitride semiconductor light emitting device having excellent light emission characteristics can be manufactured.

本発明に係るIII族窒化物半導体発光素子の一例を模式的に説明する図であり、積層半導体の断面構造を示す概略図である。It is a figure which illustrates typically an example of the group III nitride semiconductor light-emitting device based on this invention, and is the schematic which shows the cross-section of a laminated semiconductor. 本発明に係るIII族窒化物半導体発光素子の一例を模式的に説明する図であり、平面構造を示す概略図である。It is a figure which illustrates typically an example of the group III nitride semiconductor light-emitting device based on this invention, and is the schematic which shows a planar structure. 本発明に係るIII族窒化物半導体発光素子の一例を模式的に説明する図であり、断面構造を示す概略図である。It is a figure which illustrates typically an example of the group III nitride semiconductor light-emitting device concerning the present invention, and is a schematic diagram showing a section structure. 本発明に係るIII族窒化物半導体発光素子を用いて構成したランプを模式的に説明する概略図である。It is the schematic explaining typically the lamp | ramp comprised using the group III nitride semiconductor light-emitting device based on this invention. 本発明に係るIII族窒化物半導体発光素子の製造方法の一例を模式的に説明する図であり、チャンバ内にターゲットが備えられたスパッタ装置の構造を示す概略図である。It is a figure which illustrates typically an example of the manufacturing method of the group III nitride semiconductor light-emitting device based on this invention, and is the schematic which shows the structure of the sputtering device with which the target was provided in the chamber. 本発明に係るIII族窒化物半導体発光素子の実施例について説明する図であり、バッファ層中の組成を示すグラフである。It is a figure explaining the Example of the group III nitride semiconductor light-emitting device based on this invention, and is a graph which shows the composition in a buffer layer. 本発明に係るIII族窒化物半導体発光素子の製造方法の実施例について説明する図であり、(a)は、ダミー放電の回数とバッファ層中の酸素濃度との関係を示すグラフ、(b)は、チャンバ内の到達真空度とバッファ層中の酸素濃度との関係を示すグラフである。It is a figure explaining the Example of the manufacturing method of the group III nitride semiconductor light-emitting device based on this invention, (a) is a graph which shows the relationship between the frequency | count of dummy discharge, and the oxygen concentration in a buffer layer, (b) These are graphs showing the relationship between the ultimate vacuum in the chamber and the oxygen concentration in the buffer layer.

以下に、本発明に係るIII族窒化物半導体発光素子の製造方法の一実施形態について、図1〜7を適宜参照しながら説明する。   Hereinafter, an embodiment of a method for producing a group III nitride semiconductor light-emitting device according to the present invention will be described with reference to FIGS.

[III族窒化物半導体発光素子]
まず、本実施形態の製造方法によって得られるIII族窒化物半導体発光素子(以下、発光素子と略称することがある)について説明する。本実施形態の発光素子1は、サファイアからなる基板11上に、少なくともIII族窒化物化合物からなるバッファ層12が積層され、該バッファ層12上に、n型半導体層14、発光層15及びp型半導体層15が順次積層されてなる構成とされている。また、本実施形態で説明する発光素子1は、バッファ層12が反応性スパッタ法によって形成されるものであり、バッファ層12が酸素を含有し、かつ、バッファ層12中の酸素濃度が1原子%以下とされている。
[Group III nitride semiconductor light emitting device]
First, a group III nitride semiconductor light emitting device (hereinafter sometimes abbreviated as a light emitting device) obtained by the manufacturing method of the present embodiment will be described. In the light emitting device 1 of the present embodiment, a buffer layer 12 made of at least a group III nitride compound is stacked on a substrate 11 made of sapphire, and an n-type semiconductor layer 14, a light emitting layer 15, and p are stacked on the buffer layer 12. The type semiconductor layers 15 are sequentially stacked. In the light-emitting element 1 described in this embodiment, the buffer layer 12 is formed by reactive sputtering, the buffer layer 12 contains oxygen, and the oxygen concentration in the buffer layer 12 is 1 atom. % Or less.

<発光素子の積層構造>
図1は、本発明に係るIII族窒化物半導体発光素子の一例を説明するための図であり、基板上にIII族窒化物半導体が形成された積層半導体の一例を示す概略断面図である。
図1に示す積層半導体10は、基板11上にIII族窒化物化合物からなるバッファ層12が積層され、該バッファ層12上に、n型半導体層14、発光層15、及びp型半導体層16が順次積層されてなる半導体層20が形成されている。本実施形態のバッファ層12は、詳細を後述する反応性スパッタ法によって形成される層であり、酸素濃度が1原子%以下とされている。
そして、上述の積層半導体10には、図2の平面図及び図3の断面図に示す例のように、p型半導体層16上に透光性正極17が積層され、その上に正極ボンディングパッド18が形成されるとともに、n型半導体層14のn型コンタクト層14bに形成された露出領域14dに負極19が積層され、本実施形態の発光素子1が構成される。
以下、本実施形態のIII族窒化物半導体発光素子の積層構造について詳述する。
<Laminated structure of light emitting element>
FIG. 1 is a diagram for explaining an example of a group III nitride semiconductor light emitting device according to the present invention, and is a schematic cross-sectional view showing an example of a stacked semiconductor in which a group III nitride semiconductor is formed on a substrate.
In the laminated semiconductor 10 shown in FIG. 1, a buffer layer 12 made of a group III nitride compound is laminated on a substrate 11, and an n-type semiconductor layer 14, a light emitting layer 15, and a p-type semiconductor layer 16 are formed on the buffer layer 12. A semiconductor layer 20 is sequentially formed. The buffer layer 12 of this embodiment is a layer formed by a reactive sputtering method to be described in detail later, and has an oxygen concentration of 1 atomic% or less.
In the laminated semiconductor 10 described above, a translucent positive electrode 17 is laminated on a p-type semiconductor layer 16 as shown in the plan view of FIG. 2 and the cross-sectional view of FIG. 18 is formed, and the negative electrode 19 is laminated on the exposed region 14d formed in the n-type contact layer 14b of the n-type semiconductor layer 14, thereby forming the light-emitting element 1 of the present embodiment.
Hereinafter, the laminated structure of the group III nitride semiconductor light emitting device of this embodiment will be described in detail.

『基板』
本実施形態では、基板11の材料としてサファイアを用いる。
一般に、III族窒化物半導体結晶が積層される基板の材料としては、例えば、サファイア、SiC、シリコン、酸化亜鉛、酸化マグネシウム、酸化マンガン、酸化ジルコニウム、酸化マンガン亜鉛鉄、酸化マグネシウムアルミニウム、ホウ化ジルコニウム、酸化ガリウム、酸化インジウム、酸化リチウムガリウム、酸化リチウムアルミニウム、酸化ネオジウムガリウム、酸化ランタンストロンチウムアルミニウムタンタル、酸化ストロンチウムチタン、酸化チタン、ハフニウム、タングステン、モリブデン等、III族窒化物半導体結晶が表面にエピタキシャル成長される基板材料が選択して用いられる。この中でも、サファイア、SiC等の六方晶構造を有する材料を基板に用いることが、結晶性の良好なIII族窒化物半導体を積層できる点で好ましく、サファイアを用いることが最も好ましい。
また、基板の大きさとしては、通常は直径2インチ程度のものが用いられるが、本発明のIII族窒化物半導体では、直径4〜6インチの基板を使用することも可能である。
"substrate"
In this embodiment, sapphire is used as the material of the substrate 11.
Generally, as a material for a substrate on which a group III nitride semiconductor crystal is laminated, for example, sapphire, SiC, silicon, zinc oxide, magnesium oxide, manganese oxide, zirconium oxide, manganese zinc iron oxide, magnesium aluminum oxide, zirconium boride Group III nitride semiconductor crystals such as gallium oxide, indium oxide, lithium gallium oxide, lithium aluminum oxide, neodymium gallium oxide, lanthanum strontium aluminum tantalum, strontium titanium oxide, titanium oxide, hafnium, tungsten, molybdenum etc. are epitaxially grown on the surface A substrate material is selected and used. Among these, it is preferable to use a material having a hexagonal crystal structure such as sapphire or SiC for the substrate because a group III nitride semiconductor with good crystallinity can be stacked, and it is most preferable to use sapphire.
In addition, as the size of the substrate, a substrate having a diameter of about 2 inches is usually used. However, in the group III nitride semiconductor of the present invention, a substrate having a diameter of 4 to 6 inches can be used.

なお、アンモニアを使用せずにバッファ層を成膜するとともに、アンモニアを使用する方法で後述のn型半導体層を構成する下地層を成膜することにより、上記基板材料の内、高温でアンモニアに接触することで化学的な変性を引き起こすことが知られている酸化物基板や金属基板等を用いた場合には、本実施形態のバッファ層がコート層として作用するので、基板の化学的な変質を防ぐ点で効果的である。また、一般的に、スパッタ法は基板の温度を低く抑えることが可能なので、高温で分解してしまう性質を持つ材料からなる基板を用いた場合でも、基板11にダメージを与えることなく基板上への各層の成膜が可能である。   In addition, while forming a buffer layer without using ammonia, and forming a base layer constituting an n-type semiconductor layer described later by a method using ammonia, the substrate material is formed into ammonia at a high temperature. When an oxide substrate or a metal substrate that is known to cause chemical modification by contact is used, the buffer layer of this embodiment functions as a coating layer, so that chemical modification of the substrate is performed. It is effective in preventing. In general, since the sputtering method can keep the substrate temperature low, even when a substrate made of a material that decomposes at a high temperature is used, the substrate 11 is not damaged. These layers can be formed.

『バッファ層』
本実施形態の積層半導体10は、サファイアからなる基板11上に、反応性スパッタ法で形成され、少なくともIII族窒化物化合物からなるバッファ層12が設けられている。バッファ層12は、金属Al原料と窒素元素を含んだガスとをプラズマで活性化させる反応性スパッタ法によって形成することができる。
本実施形態のような、プラズマ化した金属原料を用いた方法で成膜された膜は、配向が得られ易いという作用がある。
"Buffer layer"
The laminated semiconductor 10 of this embodiment is formed by reactive sputtering on a substrate 11 made of sapphire, and a buffer layer 12 made of at least a group III nitride compound is provided. The buffer layer 12 can be formed by a reactive sputtering method in which a metal Al raw material and a gas containing a nitrogen element are activated by plasma.
A film formed by a method using a plasma metal raw material as in this embodiment has an effect that alignment is easily obtained.

このようなバッファ層をなすIII族窒化物化合物の結晶は、六方晶系の結晶構造を持ち、成膜条件をコントロールすることにより、単結晶膜とすることができる。また、III族窒化物化合物の結晶は、上記成膜条件をコントロールすることにより、六角柱を基本とした集合組織からなる柱状結晶とすることも可能である。なお、ここで説明する柱状結晶とは、隣接する結晶粒との間に結晶粒界を形成して隔てられており、それ自体は縦断面形状として柱状になっている結晶のことをいう。   The group III nitride compound crystal forming such a buffer layer has a hexagonal crystal structure, and can be formed into a single crystal film by controlling the film formation conditions. Further, the group III nitride compound crystal can be formed into a columnar crystal having a texture based on a hexagonal column by controlling the film forming conditions. Note that the columnar crystal described here is a crystal which is separated by forming a crystal grain boundary between adjacent crystal grains, and is itself a columnar shape as a longitudinal sectional shape.

バッファ層12は、単結晶構造であることが、バッファ機能の面から好ましい。上述したように、III族窒化物化合物の結晶は六方晶系の結晶を有し、六角柱を基本とした組織を形成する。III族窒化物化合物の結晶は、成膜等の条件を制御することにより、面内方向にも成長した結晶を成膜することが可能となる。このような単結晶構造を有するバッファ層12を基板11上に成膜した場合、バッファ層12のバッファ機能が有効に作用するため、その上に成膜されるIII族窒化物半導体の層は、良好な配向性及び結晶性を持つ結晶膜となる。   The buffer layer 12 preferably has a single crystal structure from the viewpoint of the buffer function. As described above, the group III nitride compound crystal has a hexagonal crystal and forms a structure based on a hexagonal column. The crystal of the group III nitride compound can be formed as a crystal grown in the in-plane direction by controlling conditions such as film formation. When the buffer layer 12 having such a single crystal structure is formed on the substrate 11, the buffer function of the buffer layer 12 effectively acts. Therefore, the group III nitride semiconductor layer formed thereon is A crystal film having good orientation and crystallinity is obtained.

バッファ層12の膜厚は、10〜500nmの範囲とされていることが好ましい。バッファ層12の膜厚をこの範囲とすることにより、良好な配向性を有し、また、バッファ層12上にIII族窒化物半導体からなる各層を成膜する際に、コート層として有効に機能するバッファ層12が得られる。
バッファ層12の膜厚が10nm未満だと、上述したコート層としての機能が充分でなくなる虞がある。また、500nmを超える膜厚でバッファ層12を形成した場合、コート層としての機能には変化が無いのにも関わらず成膜処理時間が長くなり、生産性が低下する虞がある。
また、バッファ層12の膜厚は、20〜100nmの範囲とされていることがより好ましい。
The thickness of the buffer layer 12 is preferably in the range of 10 to 500 nm. By setting the film thickness of the buffer layer 12 in this range, it has good orientation and functions effectively as a coating layer when each layer made of a group III nitride semiconductor is formed on the buffer layer 12. The buffer layer 12 is obtained.
If the thickness of the buffer layer 12 is less than 10 nm, the above-described function as a coat layer may not be sufficient. Further, when the buffer layer 12 is formed with a film thickness exceeding 500 nm, the film forming process time becomes long despite the fact that the function as the coat layer is not changed, and the productivity may be lowered.
The film thickness of the buffer layer 12 is more preferably in the range of 20 to 100 nm.

本実施形態では、バッファ層12がAlNからなる組成であることが好ましい。
一般に、基板上に積層させるバッファ層としては、Alを含有する組成とされていることが好ましく、一般式AlGaInNで表されるIII族窒化物化合物であれば、如何なる材料でも用いることができ、さらに、V族としてAsやPが含有される組成とすることもできる。なかでも、バッファ層を、Alを含んだ組成とした場合、GaAlNとすることが好ましく、この場合には、Alの組成が50%以上とされていることがより好ましい。また、バッファ層12は、AlNからなる構成とすることが最も好ましい。
In the present embodiment, it is preferable that the buffer layer 12 has a composition made of AlN.
In general, the buffer layer to be laminated on the substrate preferably has a composition containing Al, and any material can be used as long as it is a group III nitride compound represented by the general formula AlGaInN. The composition may contain As or P as group V. In particular, when the buffer layer has a composition containing Al, it is preferably GaAlN. In this case, the Al composition is more preferably 50% or more. The buffer layer 12 is most preferably configured with AlN.

また、バッファ層12を構成する材料としては、III族窒化物半導体と同じ結晶構造を有するものを用いることができるが、格子の長さが後述の下地層を構成するIII族窒化物半導体に近いものが好ましく、特に周期表のIIIa族元素の窒化物が好適である。   In addition, as a material constituting the buffer layer 12, a material having the same crystal structure as that of the group III nitride semiconductor can be used, but the length of the lattice is close to that of the group III nitride semiconductor constituting the underlayer described later. And nitrides of group IIIa elements of the periodic table are particularly preferred.

バッファ層12は、酸素を含有し、かつ、バッファ層12中の酸素濃度が1原子%以下とされていることが好ましい。
バッファ層中の酸素濃度が1原子%を超えると、膜中の酸素が多くなり過ぎ、基板とバッファ層との間の格子定数の整合性が低下し、バッファ層としての機能が低下するものと推察される。
本実施形態のように、バッファ層を反応性スパッタ法によって形成した場合、スパッタ装置のチャンバ(図5の符号41参照)の内壁に付着した水分等の酸素含有物が、スパッタ成膜処理の際にチャンバの内壁からチャンバ内空間に叩き出され、基板上に成膜されるバッファ層中に酸素が混入する。このため、スパッタ法を用いて形成されたバッファ層は、少なくとも一定以上の酸素を含有する膜となるが、バッファ層12をAlNで構成した場合には、上記範囲(上限濃度:1原子%)で少量の酸素を含有することにより、サファイアからなる基板の格子定数に近づき、基板とバッファ層との間の格子定数の整合性が向上し、バッファ層の配向性が向上する。これにより、バッファ層上に形成されるIII族窒化物半導体の結晶性を向上させることができる。ここで、バッファ層12に含有される酸素の量は、上記上限値に示すように低濃度で良く、バッファ層12は、ごく少量の酸素を含有することにより上記効果が得られる。
また、バッファ層12中の酸素濃度は、原子%で0.8%以下とされていることがより好ましい。
The buffer layer 12 preferably contains oxygen, and the oxygen concentration in the buffer layer 12 is preferably 1 atomic% or less.
If the oxygen concentration in the buffer layer exceeds 1 atomic%, the amount of oxygen in the film becomes excessive, the lattice constant matching between the substrate and the buffer layer is reduced, and the function as the buffer layer is reduced. Inferred.
When the buffer layer is formed by the reactive sputtering method as in this embodiment, oxygen-containing substances such as moisture adhering to the inner wall of the chamber (see reference numeral 41 in FIG. 5) of the sputtering apparatus are generated during the sputtering film forming process. Then, oxygen is mixed into the buffer layer which is struck from the inner wall of the chamber into the chamber inner space and formed on the substrate. For this reason, the buffer layer formed using the sputtering method is a film containing at least a certain amount of oxygen. However, when the buffer layer 12 is made of AlN, the above range (upper concentration: 1 atomic%) By containing a small amount of oxygen, the lattice constant of the substrate made of sapphire is approached, the consistency of the lattice constant between the substrate and the buffer layer is improved, and the orientation of the buffer layer is improved. Thereby, the crystallinity of the group III nitride semiconductor formed on the buffer layer can be improved. Here, the amount of oxygen contained in the buffer layer 12 may be a low concentration as shown in the above upper limit value, and the buffer layer 12 can obtain the above effect by containing a very small amount of oxygen.
The oxygen concentration in the buffer layer 12 is more preferably 0.8% or less in atomic percent.

本実施形態では、バッファ層12中に含有される酸素の濃度を上記範囲に制御することにより、AlNからなるバッファ層12とサファイアからなる基板11との格子整合性が向上するので、バッファ層12が配向性に優れた層となる。このようなバッファ層12上に形成されるIII族窒化物半導体は結晶性に優れた層となるので、発光特性に優れたIII族窒化物半導体発光素子を実現できる。   In this embodiment, the lattice matching between the buffer layer 12 made of AlN and the substrate 11 made of sapphire is improved by controlling the concentration of oxygen contained in the buffer layer 12 within the above range. Becomes a layer having excellent orientation. Since the group III nitride semiconductor formed on the buffer layer 12 is a layer having excellent crystallinity, a group III nitride semiconductor light emitting device having excellent light emission characteristics can be realized.

本実施形態では、バッファ層12の膜内における酸素濃度分布が略均一とされていることが好ましい。
バッファ層12の膜内において、酸素がむらなく均一に分布されることにより、上述したような、基板11との格子整合性をより向上させることができる。これにより、バッファ層12上のIII族窒化物半導体の結晶性をより一層向上させることができ、ひいては、より発光特性に優れたIII族窒化物半導体発光素子を実現できる。
In the present embodiment, it is preferable that the oxygen concentration distribution in the buffer layer 12 is substantially uniform.
In the film of the buffer layer 12, oxygen is evenly distributed uniformly, so that the lattice matching with the substrate 11 as described above can be further improved. As a result, the crystallinity of the group III nitride semiconductor on the buffer layer 12 can be further improved, and as a result, a group III nitride semiconductor light emitting device with more excellent emission characteristics can be realized.

『半導体層』
図1に示すように、本実施形態の積層半導体10は、基板11上に、上述のようなバッファ層12を介して、III族窒化物系半導体からなり、n型半導体層14、発光層15及びp型半導体層16から構成される半導体層20が積層されてなる。また、図示例の積層半導体10は、n型半導体層14に備えられた下地層14aがバッファ層12上に積層されている。
"Semiconductor layer"
As shown in FIG. 1, the laminated semiconductor 10 of the present embodiment is made of a group III nitride semiconductor on a substrate 11 via the buffer layer 12 as described above, and includes an n-type semiconductor layer 14 and a light emitting layer 15. And the semiconductor layer 20 comprised from the p-type semiconductor layer 16 is laminated | stacked. Further, in the illustrated stacked semiconductor 10, the base layer 14 a provided in the n-type semiconductor layer 14 is stacked on the buffer layer 12.

III族窒化物半導体としては、例えば、一般式AlGaIn1−A(0≦X≦1、0≦Y≦1、0≦Z≦1で且つ、X+Y+Z=1。記号Mは窒素(N)とは別の第V族元素を表し、0≦A<1である。)で表わされる窒化ガリウム系化合物半導体が多数知られており、本発明においても、それら周知の窒化ガリウム系化合物半導体を含めて一般式AlGaIn1−A(0≦X≦1、0≦Y≦1、0≦Z≦1で且つ、X+Y+Z=1。記号Mは窒素(N)とは別の第V族元素を表し、0≦A<1である。)で表わされる窒化ガリウム系化合物半導体を何ら制限なく用いることができる。 The group III nitride semiconductor, for example, and by the general formula Al X Ga Y In Z N 1 -A M A (0 ≦ X ≦ 1,0 ≦ Y ≦ 1,0 ≦ Z ≦ 1, X + Y + Z = 1. Symbol M represents a group V element different from nitrogen (N), and 0 ≦ A <1.) Many gallium nitride-based compound semiconductors are known. and the general formula Al X Ga Y in Z N 1 -a M a (0 ≦ X ≦ 1,0 ≦ Y ≦ 1,0 ≦ Z ≦ 1 , including the gallium compound semiconductor, X + Y + Z = 1 . symbol M nitrogen A gallium nitride-based compound semiconductor represented by (V) represents another group V element and 0 ≦ A <1) can be used without any limitation.

窒化ガリウム系化合物半導体は、Al、GaおよびIn以外に他のIII族元素を含有することができ、必要に応じてGe、Si、Mg、Ca、Zn、Be、P及びAs等の元素を含有することもできる。さらに、意図的に添加した元素に限らず、成膜条件等に依存して必然的に含まれる不純物、並びに原料、反応管材質に含まれる微量不純物を含む場合もある。   Gallium nitride compound semiconductors can contain other group III elements in addition to Al, Ga, and In, and contain elements such as Ge, Si, Mg, Ca, Zn, Be, P, and As as necessary. You can also Furthermore, it is not limited to the element added intentionally, but may include impurities that are inevitably included depending on the film forming conditions and the like, as well as trace impurities that are included in the raw materials and reaction tube materials.

「n型半導体層」
n型半導体層14は、通常、前記バッファ層12上に積層され、下地層14a、n型コンタクト層14b及びn型クラッド層14cから構成される。なお、n型コンタクト層は、下地層、及び/又は、n型クラッド層を兼ねることが可能であるが、下地層が、n型コンタクト層を兼ねることも可能である。
"N-type semiconductor layer"
The n-type semiconductor layer 14 is usually laminated on the buffer layer 12, and is composed of a base layer 14a, an n-type contact layer 14b, and an n-type cladding layer 14c. The n-type contact layer can also serve as the base layer and / or the n-type cladding layer, but the base layer can also serve as the n-type contact layer.

{下地層}
本実施形態の下地層14aはIII族窒化物半導体からなり、従来公知のMOCVD法によってバッファ層12上に積層して成膜される。
下地層14aの材料としては、必ずしも基板11上に成膜されたバッファ層12と同じである必要はなく、異なる材料を用いても構わないが、AlGa1―yN層(0≦y≦1、好ましくは0≦y≦0.5、さらに好ましくは0≦y≦0.1)から構成されることが好ましい。
{Underlayer}
The underlayer 14a of this embodiment is made of a group III nitride semiconductor, and is deposited on the buffer layer 12 by a conventionally known MOCVD method.
The material of the underlayer 14a is not necessarily the same as that of the buffer layer 12 formed on the substrate 11, and a different material may be used, but an Al y Ga 1-y N layer (0 ≦ y ≦ 1, preferably 0 ≦ y ≦ 0.5, more preferably 0 ≦ y ≦ 0.1).

下地層14aに用いる材料としては、Gaを含むIII族窒化物化合物、即ちGaN系化合物半導体が用いられ、特に、AlGaN、又はGaNを好適に用いることができる。
また、バッファ層12をAlNからなる柱状結晶の集合体として形成した場合には、下地層14aがバッファ層12の結晶性をそのまま引き継がないように、マイグレーションによって転位をループ化させる必要があるが、このような材料としても上記Gaを含むGaN系化合物半導体が挙げられ、特に、AlGaN、又はGaNが好適である。
As a material used for the underlayer 14a, a group III nitride compound containing Ga, that is, a GaN-based compound semiconductor is used, and in particular, AlGaN or GaN can be preferably used.
When the buffer layer 12 is formed as an aggregate of columnar crystals made of AlN, it is necessary to loop dislocations by migration so that the underlying layer 14a does not inherit the crystallinity of the buffer layer 12 as it is. Examples of such a material include the GaN-based compound semiconductor containing Ga, and AlGaN or GaN is particularly preferable.

下地層14aの膜厚は、0.1〜8μmの範囲とすることが、結晶性の良好な下地層が得られる点で好ましく、0.1〜2μmの範囲とすることが、成膜に要する工程時間を短縮でき、生産性が向上する点でより好ましい。   The film thickness of the underlayer 14a is preferably in the range of 0.1 to 8 μm from the viewpoint of obtaining an underlayer with good crystallinity, and in the range of 0.1 to 2 μm is required for film formation. It is more preferable in that the process time can be shortened and productivity is improved.

下地層14aは、必要に応じて、n型不純物が1×1017〜1×1019個/cmの範囲内でドープされた構成としても良いが、アンドープ(<1×1017個/cm)の構成とすることもでき、アンドープの方が良好な結晶性を維持できる点で好ましい。
基板11が導電性である場合には、下地層14aにドーパントをドープして導電性とすることにより、発光素子の上下に電極を形成することができる。一方、基板11に絶縁性の材料を用いる場合には、発光素子の同じ面に正極及び負極の各電極が設けられたチップ構造をとることになるので、下地層14aはドープしない結晶とした方が、結晶性が良好となるので好ましい。n型不純物としては、特に限定されないが、例えば、Si、GeおよびSn等が挙げられ、好ましくはSiおよびGeが挙げられる。
The underlayer 14a may have a configuration in which n-type impurities are doped in the range of 1 × 10 17 to 1 × 10 19 atoms / cm 3 as necessary, but may be undoped (<1 × 10 17 atoms / cm 3 ), and undoped is preferable in that good crystallinity can be maintained.
In the case where the substrate 11 is conductive, electrodes can be formed above and below the light emitting element by doping the base layer 14a with a dopant to make it conductive. On the other hand, when an insulating material is used for the substrate 11, a chip structure in which the positive electrode and the negative electrode are provided on the same surface of the light emitting element is employed. However, since crystallinity becomes favorable, it is preferable. Although it does not specifically limit as an n-type impurity, For example, Si, Ge, Sn, etc. are mentioned, Preferably Si and Ge are mentioned.

{n型コンタクト層}
本実施形態のn型コンタクト層14bはIII族窒化物半導体からなり、MOCVD法、又はスパッタ法によって下地層14a上に積層して成膜される。
n型コンタクト層14bとしては、下地層14aと同様にAlGa1―XN層(0≦x≦1、好ましくは0≦x≦0.5、さらに好ましくは0≦x≦0.1)から構成されることが好ましい。また、n型不純物がドープされていることが好ましく、n型不純物を1×1017〜1×1019個/cm、好ましくは1×1018〜1×1019個/cmの濃度で含有すると、負極との良好なオーミック接触の維持、クラック発生の抑制、良好な結晶性の維持の点で好ましい。n型不純物としては、特に限定されないが、例えば、Si、GeおよびSn等が挙げられ、好ましくはSiおよびGeである。成長温度は下地層と同様である。また、上述したように、n型コンタクト層14bは、下地層を兼ねた構成とすることもできる。
{N-type contact layer}
The n-type contact layer 14b of the present embodiment is made of a group III nitride semiconductor, and is deposited on the base layer 14a by MOCVD or sputtering.
As the n-type contact layer 14b, an Al X Ga 1-X N layer (0 ≦ x ≦ 1, preferably 0 ≦ x ≦ 0.5, and more preferably 0 ≦ x ≦ 0.1) as in the base layer 14a. It is preferable that it is comprised. Moreover, it is preferable that the n-type impurity is doped, and the n-type impurity has a concentration of 1 × 10 17 to 1 × 10 19 atoms / cm 3 , preferably 1 × 10 18 to 1 × 10 19 atoms / cm 3 . When contained, it is preferable in terms of maintaining good ohmic contact with the negative electrode, suppressing crack generation, and maintaining good crystallinity. Although it does not specifically limit as an n-type impurity, For example, Si, Ge, Sn, etc. are mentioned, Preferably it is Si and Ge. The growth temperature is the same as that of the underlayer. Further, as described above, the n-type contact layer 14b can also be configured to serve also as a base layer.

下地層14a及びn型コンタクト層14bを構成する窒化ガリウム系化合物半導体は同一組成であることが好ましく、これらの合計の膜厚を0.1〜20μm、好ましくは0.5〜15μm、さらに好ましくは1〜12μmの範囲に設定することが好ましい。膜厚がこの範囲であると、半導体の結晶性が良好に維持される。   The gallium nitride-based compound semiconductor constituting the underlayer 14a and the n-type contact layer 14b preferably has the same composition, and the total film thickness thereof is 0.1 to 20 μm, preferably 0.5 to 15 μm, more preferably It is preferable to set in the range of 1 to 12 μm. When the film thickness is within this range, the crystallinity of the semiconductor is maintained satisfactorily.

{n型クラッド層}
上述のn型コンタクト層14bと詳細を後述する発光層15との間には、n型クラッド層14cを設けることが好ましい。n型クラッド層14cを設けることにより、n型コンタクト層14bの最表面に生じた平坦性の悪化を改善することができる。n型クラッド層14cは、MOCVD法等を用いて、AlGaN、GaN、GaInN等により成膜することが可能である。また、これらの構造のヘテロ接合や複数回積層した超格子構造としてもよい。GaInNとする場合には、発光層15のGaInNのバンドギャップよりも大きくすることが望ましいことは言うまでもない。
{N-type cladding layer}
It is preferable to provide an n-type cladding layer 14c between the above-described n-type contact layer 14b and the light emitting layer 15 whose details will be described later. By providing the n-type cladding layer 14c, it is possible to improve the deterioration of flatness generated on the outermost surface of the n-type contact layer 14b. The n-type cladding layer 14c can be formed of AlGaN, GaN, GaInN, or the like using the MOCVD method or the like. Alternatively, a heterojunction of these structures or a superlattice structure in which a plurality of layers are stacked may be used. Needless to say, in the case of using GaInN, it is desirable to make it larger than the band gap of GaInN of the light emitting layer 15.

n型クラッド層14cの膜厚は、特に限定されないが、好ましくは5〜500nmの範囲であり、より好ましくは5〜100nmの範囲である。
また、n型クラッド層14cのn型ドープ濃度は1×1017〜1×1020個/cmの範囲とされていることが好ましく、より好ましくは1×1018〜1×1019個/cmの範囲である。ドープ濃度がこの範囲であると、良好な結晶性の維持および発光素子の動作電圧低減の点で好ましい。
The film thickness of the n-type cladding layer 14c is not particularly limited, but is preferably in the range of 5 to 500 nm, more preferably in the range of 5 to 100 nm.
Further, the n-type doping concentration of the n-type cladding layer 14c is preferably in the range of 1 × 10 17 to 1 × 10 20 pieces / cm 3 , more preferably 1 × 10 18 to 1 × 10 19 pieces / cm 3. It is in the range of cm 3 . A doping concentration within this range is preferable in terms of maintaining good crystallinity and reducing the operating voltage of the light emitting element.

「発光層」
発光層15は、n型半導体層14上に積層されるとともに、後述のp型半導体層16がその上に積層される層であり、従来公知のMOCVD法等を用いて成膜することができる。また、発光層15は、図1に示すように、窒化ガリウム系化合物半導体からなる障壁層15aと、インジウムを含有する窒化ガリウム系化合物半導体からなる井戸層15bとが交互に繰り返して積層されてなり、図示例では、n型半導体層14側及びp型半導体層16側に障壁層15aが配される順で積層して形成されている。
"Light emitting layer"
The light emitting layer 15 is laminated on the n-type semiconductor layer 14 and a p-type semiconductor layer 16 to be described later, and can be formed by using a conventionally known MOCVD method or the like. . Further, as shown in FIG. 1, the light emitting layer 15 is formed by alternately and alternately stacking a barrier layer 15a made of a gallium nitride compound semiconductor and a well layer 15b made of a gallium nitride compound semiconductor containing indium. In the illustrated example, the barrier layers 15a are stacked in the order in which they are arranged on the n-type semiconductor layer 14 side and the p-type semiconductor layer 16 side.

障壁層15aとしては、例えば、インジウムを含有した窒化ガリウム系化合物半導体からなる井戸層15bよりもバンドギャップエネルギーが大きいAlGa1−cN(0≦c<0.3)等の窒化ガリウム系化合物半導体を、好適に用いることができる。
また、井戸層15bには、インジウムを含有する窒化ガリウム系化合物半導体として、例えば、Ga1−sInN(0<s<0.4)等の窒化ガリウムインジウムを用いることができる。
As the barrier layer 15a, for example, a gallium nitride-based material such as Al c Ga 1-c N (0 ≦ c <0.3) having a larger band gap energy than the well layer 15b made of a gallium nitride-based compound semiconductor containing indium. A compound semiconductor can be suitably used.
Furthermore, the well layer 15b can be formed using indium as the semiconductor gallium nitride-based compound containing, for example, can be used Ga 1-s In s N ( 0 <s <0.4) GaN such as indium.

また、発光層15全体の膜厚としては、特に限定されない。例えば、発光層15の膜厚は、1〜500nmの範囲であることが好ましく、100nm前後の膜厚であればより好ましい。膜厚が上記範囲であると、発光出力の向上に寄与する。   Further, the film thickness of the entire light emitting layer 15 is not particularly limited. For example, the thickness of the light emitting layer 15 is preferably in the range of 1 to 500 nm, and more preferably about 100 nm. When the film thickness is in the above range, it contributes to the improvement of the light emission output.

「p型半導体層」
p型半導体層16は、通常、p型クラッド層16a及びp型コンタクト層16bから構成され、MOCVD法、又は反応性スパッタ法を用いて成膜されてなる。また、p型コンタクト層がp型クラッド層を兼ねる構成とすることもできる。
"P-type semiconductor layer"
The p-type semiconductor layer 16 is usually composed of a p-type cladding layer 16a and a p-type contact layer 16b, and is formed by using the MOCVD method or the reactive sputtering method. Further, the p-type contact layer can also serve as the p-type cladding layer.

本実施形態のp型半導体層16は、導電性をp型に制御するためのp型不純物が添加されてなる。p型不純物としては、特に限定されないが、Mgを用いることが好ましく、また、同様にZnを用いることも可能である。
また、p型半導体層16全体の膜厚としては、特に限定されないが、好ましくは0.05〜1μmの範囲である。
The p-type semiconductor layer 16 of the present embodiment is added with a p-type impurity for controlling the conductivity to be p-type. Although it does not specifically limit as a p-type impurity, It is preferable to use Mg and it is also possible to use Zn similarly.
The film thickness of the entire p-type semiconductor layer 16 is not particularly limited, but is preferably in the range of 0.05 to 1 μm.

{p型クラッド層}
p型クラッド層16aとしては、発光層15のバンドギャップエネルギーより大きくなる組成であり、発光層15へのキャリアの閉じ込めができるものであれば特に限定されないが、好ましくは、AlGa1−dN(0<d≦0.4、好ましくは0.1≦d≦0.3)のものが挙げられる。p型クラッド層16aが、このようなAlGaNからなると、発光層15へのキャリアの閉じ込めの点で好ましい。
p型クラッド層16aの膜厚は、特に限定されないが、好ましくは1〜400nmであり、より好ましくは5〜100nmである。
{P-type cladding layer}
The p-type cladding layer 16a is not particularly limited as long as it has a composition larger than the band gap energy of the light emitting layer 15 and can confine carriers in the light emitting layer 15. Preferably, the Al d Ga 1-d is used. N (0 <d ≦ 0.4, preferably 0.1 ≦ d ≦ 0.3). When the p-type cladding layer 16a is made of such AlGaN, it is preferable in terms of confining carriers in the light emitting layer 15.
The thickness of the p-type cladding layer 16a is not particularly limited, but is preferably 1 to 400 nm, and more preferably 5 to 100 nm.

p型クラッド層16aにp型不純物を添加することによって得られるp型ドーパント濃度は、1×1018〜5×1021個/cmの範囲とされていることが好ましく、より好ましくは1×1019〜5×1020個/cmである。p型ドーパント濃度が上記範囲であると、結晶性を低下させることなく良好なp型結晶が得られる。 The p-type dopant concentration obtained by adding p-type impurities to the p-type cladding layer 16a is preferably in the range of 1 × 10 18 to 5 × 10 21 atoms / cm 3 , more preferably 1 × 10 19 to 5 × 10 20 pieces / cm 3 . When the p-type dopant concentration is in the above range, a good p-type crystal can be obtained without reducing the crystallinity.

{p型コンタクト層}
p型コンタクト層16bとしては、少なくともAlGa1−eN(0≦e<0.5、好ましくは0≦e≦0.2、より好ましくは0≦e≦0.1)を含んでなる窒化ガリウム系化合物半導体層である。Al組成が上記範囲であると、良好な結晶性の維持およびpオーミック電極(後述の透光性電極17を参照)との良好なオーミック接触の点で好ましい。
p型コンタクト層16bの膜厚は、特に限定されないが、10〜500nmが好ましく、より好ましくは50〜200nmである。膜厚がこの範囲であると、発光出力の点で好ましい。
{P-type contact layer}
The p-type contact layer 16b includes at least Al e Ga 1-e N (0 ≦ e <0.5, preferably 0 ≦ e ≦ 0.2, more preferably 0 ≦ e ≦ 0.1). This is a gallium nitride compound semiconductor layer. When the Al composition is in the above range, it is preferable in terms of maintaining good crystallinity and good ohmic contact with a p-ohmic electrode (see translucent electrode 17 described later).
Although the film thickness of the p-type contact layer 16b is not specifically limited, 10-500 nm is preferable, More preferably, it is 50-200 nm. When the film thickness is within this range, it is preferable in terms of light emission output.

また、p型コンタクト層16bにp型不純物を添加することによって得られるp型ドーパント濃度は、1×1018〜1×1021個/cmの範囲とされていると、良好なオーミック接触の維持、クラック発生の防止、良好な結晶性の維持の点で好ましく、より好ましくは5×1019〜5×1020個/cmの範囲である。 In addition, when the p-type dopant concentration obtained by adding the p-type impurity to the p-type contact layer 16b is in the range of 1 × 10 18 to 1 × 10 21 atoms / cm 3 , good ohmic contact can be obtained. It is preferable in terms of maintenance, prevention of generation of cracks, and maintenance of good crystallinity, and more preferably in the range of 5 × 10 19 to 5 × 10 20 pieces / cm 3 .

本実施形態の半導体層20は、上述したように、少なくとも酸素を含有してなり、その酸素濃度が原子%で1%以下とされたバッファ層12上に形成されたものなので、結晶性に優れたIII族窒化物半導体からなる層とすることができる。従って、発光特性に優れたIII族窒化物半導体発光素子を実現することができる。   As described above, the semiconductor layer 20 of the present embodiment contains at least oxygen, and is formed on the buffer layer 12 having an oxygen concentration of 1% or less in atomic%, so that it has excellent crystallinity. Further, the layer can be made of a group III nitride semiconductor. Therefore, a group III nitride semiconductor light emitting device having excellent light emission characteristics can be realized.

『透光性正極』
透光性正極17は、上述した積層半導体10のp型半導体層16(p型コンタクト層16b)上に形成される透光性の電極である。
透光性正極17の材質としては、特に限定されず、ITO(In−SnO)、AZO(ZnO−Al)、IZO(In−ZnO)、GZO(ZnO−Ga)等の材料を、この技術分野でよく知られた慣用の手段で設けることができる。また、その構造も、従来公知の構造を含めて如何なる構造のものも何ら制限なく用いることができる。
また、透光性正極17は、Mgがドープされたp型半導体層16上のほぼ全面を覆うように形成しても構わないし、隙間を開けて格子状や樹形状に形成しても良い。
"Translucent positive electrode"
The translucent positive electrode 17 is a translucent electrode formed on the p-type semiconductor layer 16 (p-type contact layer 16b) of the laminated semiconductor 10 described above.
The material of the translucent positive electrode 17 is not particularly limited, but ITO (In 2 O 3 —SnO 2 ), AZO (ZnO—Al 2 O 3 ), IZO (In 2 O 3 —ZnO), GZO (ZnO— Materials such as Ga 2 O 3 ) can be provided by conventional means well known in the art. In addition, any structure including a conventionally known structure can be used without any limitation.
The translucent positive electrode 17 may be formed so as to cover almost the entire surface of the p-type semiconductor layer 16 doped with Mg, or may be formed in a lattice shape or a tree shape with a gap.

『正極ボンディングパッド及び負極』
正極ボンディングパッド18は、上述の透光性正極17上に形成される電極である。
正極ボンディングパッド18の材料としては、Au、Al、Ni及びCu等を用いた各種構造が周知であり、これら周知の材料、構造のものを何ら制限無く用いることができる。
正極ボンディングパッド18の厚さは、100〜1000nmの範囲内であることが好ましい。また、ボンディングパッドの特性上、厚い方が、ボンダビリティーが高くなるため、正極ボンディングパッド18の厚さは300nm以上とすることがより好ましい。さらに、製造コストの観点から500nm以下とすることが好ましい。
“Positive electrode bonding pad and negative electrode”
The positive electrode bonding pad 18 is an electrode formed on the translucent positive electrode 17 described above.
As the material of the positive electrode bonding pad 18, various structures using Au, Al, Ni, Cu, and the like are well known, and these well-known materials and structures can be used without any limitation.
The thickness of the positive electrode bonding pad 18 is preferably in the range of 100 to 1000 nm. In addition, in view of the characteristics of the bonding pad, the thicker one has higher bondability, so the thickness of the positive electrode bonding pad 18 is more preferably 300 nm or more. Furthermore, it is preferable to set it as 500 nm or less from a viewpoint of manufacturing cost.

負極19は、基板11上に、n型半導体層14、発光層15及びp型半導体層16が順次積層された半導体層において、n型半導体層14のn型コンタクト層14bに接するように形成される。
このため、負極19を設ける際は、p型半導体層16、発光層15及びn型半導体層14の一部を除去することにより、n型コンタクト層14bの露出領域14dを形成し、この上に負極19を形成する。
負極19の材料としては、各種組成および構造の負極が周知であり、これら周知の負極を何ら制限無く用いることができ、この技術分野でよく知られた慣用の手段で設けることができる。
The negative electrode 19 is formed to be in contact with the n-type contact layer 14 b of the n-type semiconductor layer 14 in the semiconductor layer in which the n-type semiconductor layer 14, the light emitting layer 15, and the p-type semiconductor layer 16 are sequentially stacked on the substrate 11. The
For this reason, when the negative electrode 19 is provided, an exposed region 14d of the n-type contact layer 14b is formed by removing a part of the p-type semiconductor layer 16, the light emitting layer 15 and the n-type semiconductor layer 14, and on this, A negative electrode 19 is formed.
As the material of the negative electrode 19, negative electrodes having various compositions and structures are well known, and these known negative electrodes can be used without any limitation, and can be provided by conventional means well known in this technical field.

以上説明したような、本実施形態のIII族窒化物半導体発光素子1によれば、反応性スパッタ法によって形成されるバッファ層12中の酸素濃度が1原子%以下とされていることにより、バッファ層12上に積層されるIII族窒化物半導体からなる半導体層20の結晶性が向上するので、優れた発光特性を有するものとなる。   According to the group III nitride semiconductor light emitting device 1 of the present embodiment as described above, the oxygen concentration in the buffer layer 12 formed by the reactive sputtering method is set to 1 atomic% or less. Since the crystallinity of the semiconductor layer 20 made of a group III nitride semiconductor laminated on the layer 12 is improved, it has excellent light emission characteristics.

[III族窒化物半導体発光素子の製造方法]
本実施形態のIII族窒化物半導体発光素子の製造方法は、サファイアからなる基板11上に、少なくともIII族窒化物化合物からなるバッファ層12を積層し、該バッファ層12上に、n型半導体層14、発光層15及びp型半導体層16を順次積層する方法であり、スパッタ装置40のチャンバ41内において、基板加熱用の設定温度をバッファ層12の成膜温度と同じかそれ以上としてダミー放電を行ない、その後、スパッタ装置40のチャンバ41内の到達真空度を2×10−5Pa以下の条件として、金属Al原料と窒素元素を含んだガスとを用いた反応性スパッタ法を用いて、バッファ層12をAlNから形成する方法である。
[Method for Producing Group III Nitride Semiconductor Light-Emitting Device]
In the method for manufacturing a group III nitride semiconductor light emitting device of this embodiment, a buffer layer 12 made of at least a group III nitride compound is stacked on a substrate 11 made of sapphire, and an n-type semiconductor layer is formed on the buffer layer 12. 14 is a method of sequentially stacking the light emitting layer 15 and the p-type semiconductor layer 16, and in the chamber 41 of the sputtering apparatus 40, dummy discharge is performed with the set temperature for heating the substrate equal to or higher than the film formation temperature of the buffer layer 12. After that, using a reactive sputtering method using a metal Al raw material and a gas containing nitrogen element under the condition that the ultimate vacuum in the chamber 41 of the sputtering apparatus 40 is 2 × 10 −5 Pa or less, In this method, the buffer layer 12 is formed of AlN.

本実施形態の製造方法では、基板11上にIII族窒化物半導体の結晶をエピタキシャル成長させ、図1に示すような積層半導体10を形成する際、まず、基板11上にバッファ層12を成膜し、その上に半導体層20を形成する。本実施形態では、バッファ層12を、金属Al原料と窒素元素を含んだガスとをプラズマで活性化させる反応性スパッタ法によってAlNから形成し、その上に、n型半導体層14の下地層14aをMOCVD法によって形成した後、n型コンタクト層14bをスパッタ法で形成し、その上のn型クラッド層14c及び発光層15の各層をMOCVD法で形成し、そして、p型半導体層16をスパッタ法で形成する方法を例に挙げて説明する。   In the manufacturing method of the present embodiment, when a group III nitride semiconductor crystal is epitaxially grown on the substrate 11 to form the stacked semiconductor 10 as shown in FIG. 1, first, the buffer layer 12 is formed on the substrate 11. A semiconductor layer 20 is formed thereon. In the present embodiment, the buffer layer 12 is formed of AlN by a reactive sputtering method in which a metal Al raw material and a gas containing nitrogen element are activated by plasma, and an underlying layer 14a of the n-type semiconductor layer 14 is formed thereon. Is formed by the MOCVD method, the n-type contact layer 14b is formed by the sputtering method, the n-type cladding layer 14c and the light emitting layer 15 thereon are formed by the MOCVD method, and the p-type semiconductor layer 16 is sputtered. A method of forming by the method will be described as an example.

そして、本実施形態の製造方法では、図2の平面図及び図3の断面図に例示するように、 上述の積層半導体10のp型半導体層16上に透光性正極17を積層し、その上に正極ボンディングパッド18を形成するとともに、n型半導体層14のn型コンタクト層14bに形成された露出領域14dに負極19を積層する。
以下、本実施形態のIII族窒化物半導体発光素子の製造方法における各条件及び手順について詳述する。
And in the manufacturing method of this embodiment, the translucent positive electrode 17 is laminated | stacked on the p-type semiconductor layer 16 of the above-mentioned laminated semiconductor 10, as illustrated in the top view of FIG. 2, and sectional drawing of FIG. A positive electrode bonding pad 18 is formed thereon, and a negative electrode 19 is laminated on the exposed region 14 d formed in the n-type contact layer 14 b of the n-type semiconductor layer 14.
Hereinafter, each condition and procedure in the manufacturing method of the group III nitride semiconductor light emitting device of this embodiment will be described in detail.

『基板の前処理』
本実施形態では、基板11を反応器の中に導入した後、バッファ層12を形成する前に、スパッタ法等の方法を用いて前処理を行うことが望ましい。具体的には、基板11をArやNのプラズマ中に曝す事によって表面を整えることができる。例えば、ArガスやNガスなどのプラズマを基板11表面に作用させる逆スパッタにより、基板11表面に付着した有機物や酸化物を除去することができる。この場合、基板11とチャンバとの間に電圧を印加すれば、プラズマ粒子が効率的に基板11に作用する。このような前処理を基板11に施すことにより、基板11の表面11a全面にバッファ層12を成膜することができ、その上に成膜される膜の結晶性を高めることが可能となる。
また、基板11には、上述のような逆スパッタによる前処理を行なう前に、湿式の前処理を施すことがより好ましい。
"Pretreatment of substrate"
In the present embodiment, it is desirable to perform pretreatment using a method such as sputtering after introducing the substrate 11 into the reactor and before forming the buffer layer 12. Specifically, the surface can be prepared by exposing the substrate 11 to Ar or N 2 plasma. For example, organic matter and oxide attached to the surface of the substrate 11 can be removed by reverse sputtering in which plasma such as Ar gas or N 2 gas is applied to the surface of the substrate 11. In this case, if a voltage is applied between the substrate 11 and the chamber, the plasma particles efficiently act on the substrate 11. By applying such pretreatment to the substrate 11, the buffer layer 12 can be formed over the entire surface 11a of the substrate 11, and the crystallinity of the film formed thereon can be improved.
Further, it is more preferable that the substrate 11 is subjected to a wet pretreatment before the pretreatment by reverse sputtering as described above.

また、基板11への前処理は、上述した逆スパッタのような、イオン成分と、電荷を持たないラジカル成分とが混合された雰囲気で行なわれるプラズマ処理で行なうことが好ましい。
ここで、基板の表面からコンタミ等を除去する際、例えば、イオン成分等を単独で基板表面に供給した場合には、エネルギーが強すぎて基板表面にダメージを与えてしまい、基板上に成長させる結晶の品質を低下させてしまうという問題がある。
本実施形態では、基板11への前処理として、上述のようなイオン成分とラジカル成分とが混合された雰囲気で行なわれるプラズマ処理を用い、基板11に適度なエネルギーを持つ反応種を作用させることにより、基板11表面にダメージを与えずにコンタミ等の除去を行なうことが可能となる。このような効果が得られるメカニズムとしては、イオン成分の割合が少ないプラズマを用いることで基板表面に与えるダメージが抑制されることと、基板表面にプラズマを作用させることによって効果的にコンタミを除去できること等が考えられる。
The pretreatment of the substrate 11 is preferably performed by plasma treatment performed in an atmosphere in which an ion component and a radical component having no charge are mixed, such as the reverse sputtering described above.
Here, when removing contaminants and the like from the surface of the substrate, for example, when an ionic component or the like is supplied to the substrate surface alone, the energy is too strong and the substrate surface is damaged and grown on the substrate. There is a problem that the quality of the crystal is lowered.
In the present embodiment, plasma processing performed in an atmosphere in which an ionic component and a radical component are mixed as described above is used as a pretreatment for the substrate 11, and a reactive species having appropriate energy is allowed to act on the substrate 11. This makes it possible to remove contamination and the like without damaging the surface of the substrate 11. As a mechanism for obtaining such an effect, damage to the substrate surface is suppressed by using plasma with a small proportion of ion components, and contamination can be effectively removed by causing plasma to act on the substrate surface. Etc. are considered.

『バッファ層の形成』
本実施形態では、バッファ層12を形成するにあたり、まず、スパッタ装置40のチャンバ41内において、基板加熱用の設定温度をバッファ層12の成膜温度と同じかそれ以上としてダミー放電を行なう。その後、スパッタ装置40のチャンバ41内の到達真空度を2×10−5Pa以下の条件として、金属Al原料と窒素元素を含んだガスとを用いた反応性スパッタ法を用いて、バッファ層12をAlNから形成する方法としている。
"Formation of buffer layer"
In the present embodiment, when forming the buffer layer 12, first, dummy discharge is performed in the chamber 41 of the sputtering apparatus 40 with the set temperature for substrate heating equal to or higher than the film formation temperature of the buffer layer 12. Thereafter, the buffer layer 12 is formed by a reactive sputtering method using a metal Al raw material and a gas containing nitrogen element under the condition that the ultimate vacuum in the chamber 41 of the sputtering apparatus 40 is 2 × 10 −5 Pa or less. Is formed from AlN.

「反応性スパッタ法による成膜」
基板11の表面に対し、上記前処理を施した後、スパッタ装置40(図5参照)のチャンバ41内にアルゴン及び窒素元素含有ガスを導入し、基板11を500℃程度に加温する。そして、基板11側に高周波バイアスを印加するとともに、III族金属原料として金属Alが用いられたAlターゲット側にパワーを印加してチャンバ41内にプラズマを発生させ、チャンバ41内の圧力を一定に保ちながら、基板11上にAlNからなるバッファ層12を成膜する。
バッファ層12を基板11上に成膜する方法としては、反応性スパッタ法の他、例えば、MOCVD法、パルスレーザーデポジション(PLD)法、パルス電子線堆積(PED)法等が挙げられ、適宜選択して用いることができるが、反応性スパッタ法が最も簡便で量産にも適しているため、好適な方法である。
"Deposition by reactive sputtering"
After the pretreatment is performed on the surface of the substrate 11, argon and nitrogen element-containing gas is introduced into the chamber 41 of the sputtering apparatus 40 (see FIG. 5), and the substrate 11 is heated to about 500 ° C. Then, a high frequency bias is applied to the substrate 11 side, and power is applied to the Al target side in which metal Al is used as a group III metal raw material to generate plasma in the chamber 41 so that the pressure in the chamber 41 is kept constant. While maintaining, a buffer layer 12 made of AlN is formed on the substrate 11.
Examples of the method for forming the buffer layer 12 on the substrate 11 include a reactive sputtering method, a MOCVD method, a pulse laser deposition (PLD) method, a pulsed electron beam deposition (PED) method, and the like. The reactive sputtering method is the most convenient and suitable for mass production, but it is a suitable method.

(スパッタ装置)
図5に示す例のスパッタ装置40では、金属ターゲット47の下方(図5の下方)にマグネット42が配され、該マグネット42が図示略の駆動装置によって金属ターゲット47の下方で揺動する。チャンバ41には窒素ガス、及びアルゴンガスが供給され、ヒータ44に取り付けられた基板11上に、バッファ層が成膜される。この際、上述のようにマグネット42が金属ターゲット47の下方で揺動しているため、チャンバ41内に閉じ込められたプラズマが移動し、基板11の表面11aの他、側面に対しても、むらなくバッファ層を成膜することが可能となる。
(Sputtering equipment)
In the sputtering apparatus 40 shown in FIG. 5, a magnet 42 is disposed below the metal target 47 (downward in FIG. 5), and the magnet 42 swings below the metal target 47 by a driving device (not shown). Nitrogen gas and argon gas are supplied to the chamber 41, and a buffer layer is formed on the substrate 11 attached to the heater 44. At this time, since the magnet 42 is swung below the metal target 47 as described above, the plasma confined in the chamber 41 moves, and the surface of the substrate 11 is uneven as well as the side surface. Thus, it is possible to form a buffer layer.

バッファ層をスパッタ法で成膜する方法としては、RFスパッタ法又はDCスパッタ法が挙げられる。ここで、本発明に係る製造方法のように反応性スパッタ法を用い、窒素元素含有ガスとして窒素ガスを用いて成膜を行なう場合、窒素がターゲット(金属材料)表面に吸着することが知られている(Mat.Res.Soc.Symp.Proc. Vol.68、357、1986を参照)。一般に、金属材料のターゲットを用いてスパッタする場合、DCスパッタ法を用いることが成膜効率の点で好ましいが、連続的に放電させるDCスパッタ法では、窒素がターゲットに付着することによってターゲット表面のチャージアップ(帯電)を招き、成膜速度が安定しない可能性がある。このため、本発明に係る製造方法では、RFスパッタ法、又は、DCスパッタ法の中でもパルス的にバイアスを与えることができるパルスDCスパッタを用いることが好ましく、このようなスパッタ方法で処理可能なスパッタ装置を使用することが好ましい。   Examples of the method for forming the buffer layer by sputtering include RF sputtering and DC sputtering. Here, when a reactive sputtering method is used as in the manufacturing method according to the present invention and a film is formed using nitrogen gas as a nitrogen element-containing gas, it is known that nitrogen is adsorbed on the target (metal material) surface. (See Mat. Res. Soc. Symp. Proc. Vol. 68, 357, 1986). In general, when sputtering using a metal target, it is preferable to use a DC sputtering method from the viewpoint of film formation efficiency. However, in the DC sputtering method in which continuous discharge is performed, nitrogen adheres to the target and the surface of the target is Charge up (charging) may be caused, and the film formation rate may not be stable. For this reason, in the manufacturing method according to the present invention, it is preferable to use pulsed DC sputtering that can be biased in a pulse manner among RF sputtering and DC sputtering, and sputtering that can be processed by such a sputtering method. It is preferred to use an apparatus.

また、バッファ層12をスパッタ法によって成膜する場合、窒素を含んだガスをリアクタ内に流通させるリアクティブスパッタ法を用いて成膜することが、反応を制御することで結晶性を良好に保つことができ、その良好な結晶性を安定に再現することができる点でより好ましく、このようなリアクティブスパッタ方法で処理可能なスパッタ装置を採用することが好ましい。   Further, when the buffer layer 12 is formed by sputtering, the film is formed by using the reactive sputtering method in which a gas containing nitrogen is circulated in the reactor, so that the crystallinity can be kept good by controlling the reaction. It is more preferable in that the good crystallinity can be stably reproduced, and it is preferable to employ a sputtering apparatus that can be processed by such a reactive sputtering method.

また、RFスパッタ法が採用されたスパッタ装置を用いる場合には、チャージアップを回避する方法として、マグネットの位置をターゲット内で移動させることが好ましい。具体的な運動の方法は、使用するスパッタ装置によって選択することができ、揺動させたり、回転運動させたりすることができる。 図5に例示するスパッタ装置40では、ターゲット47の下方にマグネット42が備えられ、このマグネット42がターゲット47の下方で回転運動できる構成とされている。   Further, when using a sputtering apparatus employing an RF sputtering method, it is preferable to move the position of the magnet within the target as a method for avoiding charge-up. A specific motion method can be selected depending on the sputtering apparatus to be used, and can be swung or rotated. In the sputtering apparatus 40 illustrated in FIG. 5, a magnet 42 is provided below the target 47, and the magnet 42 is configured to be able to rotate under the target 47.

また、反応性スパッタ法においては、磁場内にプラズマを閉じ込めることによって効率を向上させる技術が一般的に用いられている。この際、ターゲットを偏り無く使用するための方法としては、上述したスパッタ装置40のように、カソードのマグネット42の位置をターゲット47内で移動させつつ成膜するRFスパッタ法を用いることが好ましい。このような場合の具体的なマグネットの運動方法としては、使用するスパッタ装置によって適宜選択することができ、例えば、マグネットを揺動させたり、又は回転運動させたりすることができる。   In reactive sputtering, a technique for improving efficiency by confining plasma in a magnetic field is generally used. At this time, as a method for using the target without unevenness, it is preferable to use an RF sputtering method in which film formation is performed while moving the position of the cathode magnet 42 within the target 47 as in the above-described sputtering apparatus 40. A specific magnet movement method in such a case can be appropriately selected depending on the sputtering apparatus to be used. For example, the magnet can be swung or rotated.

また、詳細を後述するが、チャンバ41内には、できるだけ不純物を残さないことが好ましく、特に、チャンバ41の内壁に付着する酸素含有物を出来る限り低減しておくことが好ましいため、スパッタ装置40のチャンバ41内の到達真空度は、2×10−5Pa以下の条件とすることがより好ましい。 Although details will be described later, it is preferable that impurities are not left in the chamber 41 as much as possible. In particular, it is preferable to reduce oxygen-containing substances adhering to the inner wall of the chamber 41 as much as possible. The ultimate vacuum in the chamber 41 is more preferably 2 × 10 −5 Pa or less.

また、バッファ層12は、基板11の側面を覆うようにして形成することが好ましく、基板11の側面及び裏面を覆うようにして形成することが最も好ましい。
しかしながら、従来のスパッタ装置並びに成膜方法でバッファ層を成膜した場合、最大で6回から8回程度の成膜処理を行う必要があり、長時間の工程となってしまう。これ以外の成膜方法としては、基板を保持せずにチャンバ内に設置することにより、基板全面に成膜する方法も考えられるが、基板を加熱する必要がある場合には装置が複雑になる虞がある。
そこで、例えば、基板を揺動させたり又は回転運動させたりすることが可能なスパッタ装置を用いることにより、基板の位置を、成膜材料のスパッタ方向に対して変更させつつ、成膜することが可能となる。このようなスパッタ装置並びに成膜方法とすることにより、基板の表面及び側面を一度の工程で成膜することが可能となり、次いで基板裏面への成膜工程を行うことにより、計2回の工程で基板全面を覆うことが可能となる。
The buffer layer 12 is preferably formed so as to cover the side surface of the substrate 11, and most preferably formed so as to cover the side surface and the back surface of the substrate 11.
However, when the buffer layer is formed by a conventional sputtering apparatus and film formation method, it is necessary to perform the film formation process about 6 to 8 times at the maximum, which is a long process. As another film forming method, a method of forming a film on the entire surface of the substrate by placing it in the chamber without holding the substrate can be considered, but the apparatus becomes complicated when it is necessary to heat the substrate. There is a fear.
Therefore, for example, by using a sputtering apparatus capable of swinging or rotating the substrate, it is possible to form a film while changing the position of the substrate with respect to the sputtering direction of the film forming material. It becomes possible. By using such a sputtering apparatus and a film forming method, it becomes possible to form the surface and side surfaces of the substrate in a single step, and then performing the film forming step on the back surface of the substrate, a total of two steps. It becomes possible to cover the entire surface of the substrate.

また、スパッタ装置を、成膜材料源が大きな面積の発生源(ターゲット)から生じる構成とし、且つ、材料の発生位置を移動させることにより、基板を移動させずに基板全面に成膜することが可能な構成としても良い。このような装置の一つとして、図5に示すスパッタ装置40のような、マグネットを揺動させたり又は回転運動させたりすることにより、カソードのマグネットの位置をターゲット内で移動させつつ成膜するRFスパッタ法を用いた装置が挙げられる。また、このようなRFスパッタ法で成膜を行なう場合、基板側とカソード側の両方を移動させる装置を採用しても良い。さらに、材料の発生源であるカソード(図5のターゲット皿43参照)を基板近傍に配することにより、発生するプラズマを、基板に対してビーム状に供給するのではなく、基板を包み込むように供給するような構成とすれば、基板表面及び側面の同時成膜が可能となる。   In addition, the sputtering apparatus is configured so that the film formation material source is generated from a generation source (target) having a large area, and by moving the material generation position, the film can be formed on the entire surface of the substrate without moving. A possible configuration is also possible. As one of such apparatuses, film formation is performed while moving the position of the cathode magnet in the target by swinging or rotating the magnet as in the sputtering apparatus 40 shown in FIG. An apparatus using an RF sputtering method can be given. In addition, when film formation is performed by such an RF sputtering method, an apparatus that moves both the substrate side and the cathode side may be employed. Furthermore, by arranging a cathode (see the target dish 43 in FIG. 5), which is a material generation source, in the vicinity of the substrate, the generated plasma is not supplied to the substrate in the form of a beam, but is wrapped around the substrate. If it is configured to supply, simultaneous film formation on the substrate surface and side surfaces is possible.

(窒素元素含有ガス雰囲気)
本実施形態で用いる窒素元素含有ガスとしては、一般に知られている窒素化合物を何ら制限されることなく用いることができるが、アンモニアや窒素(N)は取り扱いが簡単であるとともに、比較的安価で入手可能であることから好ましい。
アンモニアは分解効率が良好であり、高い成長速度で成膜することが可能であるが、反応性や毒性が高いため、除害設備やガス検知器が必要となり、また、反応装置に使用する部材の材料を化学的に安定性の高いものにする必要がある。
また、窒素(N)を原料として用いた場合には、装置としては簡便なものを用いることができるが、高い反応速度は得られない。しかしながら、窒素を電界や熱等により分解してから装置に導入する方法とすれば、アンモニアよりは成膜速度は低いものの、工業生産的に利用可能な程度の成膜速度を得ることができるため、装置コストとの兼ね合いを考えると、窒素(N)は最も好適な窒素源である。
(Nitrogen element-containing gas atmosphere)
As the nitrogen element-containing gas used in the present embodiment, generally known nitrogen compounds can be used without any limitation, but ammonia and nitrogen (N 2 ) are easy to handle and relatively inexpensive. It is preferable because it is available at
Ammonia has good decomposition efficiency and can be deposited at a high growth rate. However, because of its high reactivity and toxicity, it requires a detoxification facility and a gas detector. It is necessary to make these materials chemically stable.
In addition, when nitrogen (N 2 ) is used as a raw material, a simple apparatus can be used, but a high reaction rate cannot be obtained. However, if nitrogen is decomposed by an electric field or heat and then introduced into the apparatus, the film formation rate is lower than that of ammonia, but a film formation rate that can be used for industrial production can be obtained. Considering the balance with the apparatus cost, nitrogen (N 2 ) is the most preferable nitrogen source.

窒素元素を含むガス中における窒素のガス分率、つまり、窒素(N)とArの流量に対する窒素流量の比は、窒素が20%超であることが好ましい。窒素が20%以下だと、窒素の存在量が少なく基板11上に金属が析出してしまい、バッファ層12としてIII族窒化物化合物に求められる結晶構造とならない。また、窒素が99%を上回る流量比だと、Arの量が少な過ぎ、スパッタレートが大幅に低下してしまうので好ましくない。また、窒素を含むガス中における窒素のガス分率は、40%以上95%以下の範囲であることがより好ましく、60%以上80%以下の範囲であることが最も好ましい。 The gas fraction of nitrogen in the gas containing nitrogen element, that is, the ratio of the nitrogen flow rate to the flow rate of nitrogen (N 2 ) and Ar is preferably greater than 20%. If the nitrogen content is 20% or less, the amount of nitrogen present is small and metal is deposited on the substrate 11, so that the crystal structure required for the group III nitride compound as the buffer layer 12 is not obtained. Further, if the flow rate ratio of nitrogen exceeds 99%, the amount of Ar is too small and the sputtering rate is greatly reduced, which is not preferable. The nitrogen gas fraction in the gas containing nitrogen is more preferably in the range of 40% to 95%, and most preferably in the range of 60% to 80%.

本実施形態では、活性な窒素反応種を高濃度で基板11上に供給することにより、基板11上におけるマイグレーションを抑制することができ、これにより、自己組織化を抑え、バッファ層12を適正に単結晶組織とすることが可能となる。バッファ層12において、単結晶からなる組織を適正にコントロールすることにより、その上に積層されるGaN(III族窒化物半導体)からなる半導体層の結晶性を良好に制御することができる。   In the present embodiment, by supplying active nitrogen reactive species to the substrate 11 at a high concentration, migration on the substrate 11 can be suppressed, thereby suppressing self-organization and appropriately setting the buffer layer 12. A single crystal structure can be obtained. In the buffer layer 12, the crystallinity of the semiconductor layer made of GaN (Group III nitride semiconductor) stacked thereon can be favorably controlled by appropriately controlling the structure made of single crystal.

(チャンバ内圧力)
反応性スパッタ法を用いてバッファ層12を成膜する際のチャンバ41内の圧力は、0.2Pa以上であることが好ましい。このチャンバ41内の圧力が0.2Pa未満だと、発生する反応種の持つ運動エネルギーが大きくなりすぎ、形成されるバッファ層の膜質が不十分となる。また、チャンバ41内の圧力の上限は特に限定されないが、0.8Pa以上になると、膜の配向に寄与する二量体荷電粒子がプラズマ中の荷電粒子の相互作用を受けるようになるため、チャンバ41内の圧力は0.2〜0.8Paの範囲とすることが好ましい。
(Internal chamber pressure)
The pressure in the chamber 41 when the buffer layer 12 is formed using the reactive sputtering method is preferably 0.2 Pa or more. When the pressure in the chamber 41 is less than 0.2 Pa, the kinetic energy of the generated reactive species becomes too large, and the film quality of the formed buffer layer becomes insufficient. Further, the upper limit of the pressure in the chamber 41 is not particularly limited. However, when the pressure is 0.8 Pa or more, the dimer charged particles contributing to the film orientation come to receive the interaction of the charged particles in the plasma. The pressure in 41 is preferably in the range of 0.2 to 0.8 Pa.

(スパッタ装置の到達真空度)
本実施形態の製造方法では、バッファ層12の形成に用いるスパッタ装置40のチャンバ41内の到達真空度を、2×10−5Pa以下の条件とし、チャンバ41内をこの範囲の真空度とした後、バッファ層12を形成することが好ましい。
上述したように、反応性スパッタ法を用いてバッファ層を形成した場合、スパッタ装置40のチャンバ41の内壁に付着した水分等の酸素含有物が、スパッタ成膜処理の際にチャンバ41の内壁から叩き出され、基板11上に成膜されるバッファ層12の膜中に酸素が不可避的に混入する。このような酸素含有物は、主として、チャンバ41のメンテナンスを行うために大気開放した際、大気中の酸素や水分がチャンバ41内に侵入し、内壁に付着することによって生じるものと考えられる。
(Degree of ultimate vacuum of sputtering equipment)
In the manufacturing method of the present embodiment, the ultimate vacuum in the chamber 41 of the sputtering apparatus 40 used for forming the buffer layer 12 is set to 2 × 10 −5 Pa or less, and the vacuum in this range is set to the chamber 41. Thereafter, the buffer layer 12 is preferably formed.
As described above, when the buffer layer is formed by using the reactive sputtering method, oxygen-containing substances such as moisture adhering to the inner wall of the chamber 41 of the sputtering apparatus 40 are released from the inner wall of the chamber 41 during the sputtering film forming process. Oxygen is inevitably mixed into the film of the buffer layer 12 which is knocked out and formed on the substrate 11. It is considered that such oxygen-containing materials are mainly generated when oxygen or moisture in the atmosphere enters the chamber 41 and adheres to the inner wall when the chamber 41 is opened to the atmosphere for maintenance.

本発明者等が鋭意研究したところ、AlNからなるバッファ層12は、スパッタ時に酸素が混入することで膜中に少量(低濃度)の酸素を含有することにより、サファイアからなる基板11の格子定数に近づき、基板11とバッファ層12との間の格子定数の整合性が向上し、バッファ層12の配向性が向上する効果が得られることが明らかとなった。
しかしながら、その一方で、基板上に形成されるバッファ層に大量の酸素が混入し、膜中の酸素濃度が高くなり過ぎた場合(1原子%超)には、基板とバッファ層との間の格子定数の整合性が低下し、バッファ層の配向性が低下してしまう。つまり、スパッタ装置のチャンバ内壁に大量の酸素含有物が付着した場合には、スパッタ時に大量の酸素がバッファ層の膜中に混入してしまい、上記問題が発生する。
As a result of intensive studies by the present inventors, the buffer layer 12 made of AlN contains a small amount (low concentration) of oxygen in the film due to oxygen being mixed during sputtering, so that the lattice constant of the substrate 11 made of sapphire is obtained. It became clear that the lattice constant matching between the substrate 11 and the buffer layer 12 was improved, and the effect of improving the orientation of the buffer layer 12 was obtained.
However, on the other hand, when a large amount of oxygen is mixed in the buffer layer formed on the substrate and the oxygen concentration in the film becomes too high (over 1 atomic%), the space between the substrate and the buffer layer is low. The lattice constant matching is lowered, and the orientation of the buffer layer is lowered. That is, when a large amount of oxygen-containing material adheres to the inner wall of the chamber of the sputtering apparatus, a large amount of oxygen is mixed into the film of the buffer layer at the time of sputtering, and the above problem occurs.

本実施形態では、バッファ層12の形成に用いるスパッタ装置40のチャンバ41内の到達真空度を2×10−5Pa以下の条件とし、チャンバ41内をこの範囲の真空度としてチャンバ41内の酸素含有物を充分に吸引することにより、チャンバ41の内壁に付着する酸素含有物並びにチャンバ41内の空間に存在する酸素含有物を除去して低減した後、バッファ層12を形成する方法としている。
これにより、AlNからなるバッファ層12を、1原子%以下という低濃度の酸素が含有された状態として形成することができるので、サファイアからなる基板11との間の格子整合性が向上し、配向性に優れた層となる。従って、このバッファ層12上に形成されるIII族窒化物半導体からなる半導体層20の結晶性が向上し、優れた発光特性を備える発光素子1が得られる。
In the present embodiment, the ultimate vacuum in the chamber 41 of the sputtering apparatus 40 used for forming the buffer layer 12 is set to 2 × 10 −5 Pa or less, and the oxygen in the chamber 41 is set to a vacuum in this range. The buffer layer 12 is formed after the content is sufficiently sucked to remove and reduce the oxygen content adhering to the inner wall of the chamber 41 and the oxygen content present in the space in the chamber 41.
Thereby, since the buffer layer 12 made of AlN can be formed in a state containing oxygen at a low concentration of 1 atomic% or less, the lattice matching with the substrate 11 made of sapphire is improved, and the orientation is improved. It becomes a layer with excellent properties. Therefore, the crystallinity of the semiconductor layer 20 made of a group III nitride semiconductor formed on the buffer layer 12 is improved, and the light emitting device 1 having excellent light emission characteristics can be obtained.

(ダミー放電)
本実施形態の製造方法では、上述の到達真空度をより向上させるため、バッファ層12のスパッタ成膜処理を行なう前に、スパッタ装置40のチャンバ41内において、成膜処理を伴わないダミー放電を行なうことが好ましい。
ダミー放電の方法としては、成膜処理と同様の放電プログラムを、基板を導入せずに行う方法が一般的である。このような方法でダミー放電を行なうことにより、如何なる成分が、如何なる機構で不純物として叩き出されてくるのかが明らかでなくとも、成膜を行う条件で湧出される不純物を、予め叩き出すことが可能となる。
(Dummy discharge)
In the manufacturing method of this embodiment, in order to further improve the above-mentioned ultimate vacuum, before performing the sputtering film forming process of the buffer layer 12, dummy discharge without film forming process is performed in the chamber 41 of the sputtering apparatus 40. It is preferable to do so.
As a dummy discharge method, a method of performing a discharge program similar to the film forming process without introducing a substrate is common. By performing a dummy discharge in this way, it is possible to preliminarily discharge impurities that are springed out under the conditions for film formation, even if it is not clear what components are knocked out as impurities by what mechanism. It becomes possible.

また、このようなダミー放電は、通常の成膜条件と同様の条件として行う方法よりも、さらに不純物を叩き出し易い条件に設定して行なうことも可能である。このような条件としては、例えば、基板加熱用の設定温度を高めに設定し(図5のスパッタ装置40におけるヒータ44参照)、この設定温度をバッファ層12の成膜温度と同じかそれ以上としてダミー放電を行なうことで、プラズマを発生させるためのパワーを高めに設定する等の条件が挙げられる。
またさらに、上述のようなダミー放電は、チャンバ41内の吸引と同時に行なうことも可能である。
Also, such dummy discharge can be performed under conditions that make it easier to knock out impurities than a method that is performed under the same conditions as normal film formation conditions. As such a condition, for example, the set temperature for substrate heating is set high (see the heater 44 in the sputtering apparatus 40 in FIG. 5), and this set temperature is set equal to or higher than the film forming temperature of the buffer layer 12. By performing the dummy discharge, conditions such as setting the power for generating plasma high can be mentioned.
Furthermore, the dummy discharge as described above can be performed simultaneously with the suction in the chamber 41.

上述のようなダミー放電を行なうことにより、成膜前のチャンバ41内の到達真空度をより高めることにより、チャンバ41の内壁や空間中に存在する酸素含有物を、より確実に除去して低減することが可能となる。従って、基板11とバッファ層12との格子整合性がさらに向上し、バッファ層12の配向性をより高めることが可能となる。   By performing dummy discharge as described above, the ultimate vacuum in the chamber 41 before film formation is further increased, so that oxygen-containing substances present in the inner wall and space of the chamber 41 are more reliably removed and reduced. It becomes possible to do. Therefore, the lattice matching between the substrate 11 and the buffer layer 12 is further improved, and the orientation of the buffer layer 12 can be further increased.

(成膜速度)
バッファ層12を成膜する際の成膜速度は、0.01nm/s〜10nm/sの範囲とすることが好ましい。成膜速度が0.01nm/s未満だと、膜が層とならずに島状に成長してしまい、基板11の表面を覆うことができなくなる虞がある。成膜速度が10nm/sを超えると、膜が結晶体とならずに非晶質となってしまう。
(Deposition rate)
The film formation rate when forming the buffer layer 12 is preferably in the range of 0.01 nm / s to 10 nm / s. If the deposition rate is less than 0.01 nm / s, the film grows in an island shape without forming a layer, and there is a possibility that the surface of the substrate 11 cannot be covered. When the deposition rate exceeds 10 nm / s, the film does not become a crystalline substance but becomes amorphous.

(基板温度)
バッファ層12を成膜する際の基板11の温度は、室温〜1000℃の範囲とすることが好ましく、400〜800℃の範囲とすることがより好ましい。基板11の温度が上記下限未満だと、バッファ層12が基板11全面を覆うことができず、基板11表面が露出する虞がある。基板11の温度が上記上限を超えると、金属原料のマイグレーションが活発となり、バッファ層12としては不適である。なお、本発明で説明する室温とは、工程の環境等にも影響される温度であるが、具体的な温度としては、0〜30℃の範囲である。
(Substrate temperature)
The temperature of the substrate 11 when forming the buffer layer 12 is preferably in the range of room temperature to 1000 ° C., and more preferably in the range of 400 to 800 ° C. If the temperature of the substrate 11 is lower than the lower limit, the buffer layer 12 cannot cover the entire surface of the substrate 11 and the surface of the substrate 11 may be exposed. When the temperature of the substrate 11 exceeds the above upper limit, migration of the metal raw material becomes active and is not suitable as the buffer layer 12. In addition, although the room temperature demonstrated by this invention is a temperature influenced also by the environment of a process etc., as a specific temperature, it is the range of 0-30 degreeC.

(ターゲット)
III族金属原料と窒素元素を含んだガスとをプラズマによって活性化させる反応性スパッタ法を用いて、バッファ層として混晶を成膜する際には、例えば、Al等を含む金属材料の混合物(必ずしも、合金を形成していなくても構わない)をターゲットとして用いる方法もあるし、異なる材料からなる2つのターゲットを用意して同時にスパッタする方法としても良い。例えば、一定の組成の膜を成膜する場合には混合材料のターゲットを用い、組成の異なる何種類かの膜を成膜する場合には複数のターゲットをチャンバ内に設置すれば良い。
(target)
When forming a mixed crystal as a buffer layer using a reactive sputtering method in which a group III metal raw material and a gas containing nitrogen element are activated by plasma, for example, a mixture of metal materials including Al or the like ( There is a method of using as a target the alloy may not necessarily be formed, or a method of preparing two targets made of different materials and performing sputtering simultaneously. For example, when a film having a constant composition is formed, a mixed material target is used, and when several kinds of films having different compositions are formed, a plurality of targets may be installed in the chamber.

『半導体層の形成』
バッファ層12上には、n型半導体層14、発光層15、p型半導体層16をこの順で積層することにより、半導体層20を形成する。本実施形態の製造方法では、上述したように、n型半導体層14の下地層14aをMOCVD法によって形成した後、n型コンタクト層14bをスパッタ法で形成し、その上のn型クラッド層14c及び発光層15の各層をMOCVD法で形成し、そして、p型半導体層16をスパッタ法で形成する。
"Semiconductor layer formation"
On the buffer layer 12, the n-type semiconductor layer 14, the light emitting layer 15, and the p-type semiconductor layer 16 are laminated | stacked in this order, and the semiconductor layer 20 is formed. In the manufacturing method of the present embodiment, as described above, after the base layer 14a of the n-type semiconductor layer 14 is formed by the MOCVD method, the n-type contact layer 14b is formed by the sputtering method, and the n-type cladding layer 14c thereon is formed. The light emitting layer 15 and the light emitting layer 15 are formed by MOCVD, and the p-type semiconductor layer 16 is formed by sputtering.

本実施形態において、半導体層20を形成する際の窒化ガリウム系化合物半導体の成長方法は特に限定されず、上述したスパッタ法の他、MOCVD(有機金属化学気相成長法)、HVPE(ハイドライド気相成長法)、MBE(分子線エピタキシー法)等、窒化物半導体を成長させることが知られている全ての方法を適用できる。これらの方法の内、MOCVD法では、キャリアガスとして水素(H)または窒素(N)、III族原料であるGa源としてトリメチルガリウム(TMG)またはトリエチルガリウム(TEG)、Al源としてトリメチルアルミニウム(TMA)またはトリエチルアルミニウム(TEA)、In源としてトリメチルインジウム(TMI)またはトリエチルインジウム(TEI)、V族原料であるN源としてアンモニア(NH)、ヒドラジン(N)などが用いられる。また、ドーパントとしては、n型にはSi原料としてモノシラン(SiH)またはジシラン(Si)を、Ge原料としてゲルマンガス(GeH)や、テトラメチルゲルマニウム((CHGe)やテトラエチルゲルマニウム((CGe)等の有機ゲルマニウム化合物を利用できる。MBE法では、元素状のゲルマニウムもドーピング源として利用できる。p型にはMg原料としては、例えばビスシクロペンタジエニルマグネシウム(CpMg)またはビスエチルシクロペンタジエニルマグネシウム(EtCpMg)を用いる。 In this embodiment, the growth method of the gallium nitride-based compound semiconductor when forming the semiconductor layer 20 is not particularly limited. In addition to the above-described sputtering method, MOCVD (metal organic chemical vapor deposition), HVPE (hydride vapor phase). All methods known to grow nitride semiconductors such as a growth method) and MBE (molecular beam epitaxy method) can be applied. Among these methods, in MOCVD, hydrogen (H 2 ) or nitrogen (N 2 ) is used as a carrier gas, trimethyl gallium (TMG) or triethyl gallium (TEG) is used as a Ga source which is a group III material, and trimethyl aluminum is used as an Al source. (TMA) or triethylaluminum (TEA), trimethylindium (TMI) or triethylindium (TEI) as the In source, ammonia (NH 3 ), hydrazine (N 2 H 4 ) or the like as the N source which is a group V material. . In addition, as a dopant, for n-type, monosilane (SiH 4 ) or disilane (Si 2 H 6 ) is used as a Si raw material, germanium gas (GeH 4 ) or tetramethyl germanium ((CH 3 ) 4 Ge) is used as a Ge raw material. And organic germanium compounds such as tetraethylgermanium ((C 2 H 5 ) 4 Ge) can be used. In the MBE method, elemental germanium can also be used as a doping source. For the p-type, for example, biscyclopentadienyl magnesium (Cp 2 Mg) or bisethylcyclopentadienyl magnesium (EtCp 2 Mg) is used as the Mg raw material.

上述したような窒化ガリウム系化合物半導体は、Al、GaおよびIn以外に他のIII族元素を含有することができ、必要に応じてGe、Si、Mg、Ca、Zn、及びBe等のドーパント元素を含有することができる。さらに、意図的に添加した元素に限らず、成膜条件等に依存して必然的に含まれる不純物、並びに原料、反応管材質に含まれる微量不純物を含む場合もある。   The gallium nitride compound semiconductor as described above can contain other group III elements in addition to Al, Ga, and In, and dopant elements such as Ge, Si, Mg, Ca, Zn, and Be as necessary. Can be contained. Furthermore, it is not limited to the element added intentionally, but may include impurities that are inevitably included depending on the film forming conditions and the like, as well as trace impurities that are included in the raw materials and reaction tube materials.

「n型半導体層の形成」
本実施形態の半導体層20を形成する際、まず、n型半導体層14の下地層14aを、従来公知のMOCVD法により、バッファ層12上に積層して成膜する。次いで、下地層14a上に、n型コンタクト層14bをスパッタ法で成膜した後、n型クラッド層14cをMOCVD法によって成膜する。この際、下地層14a及びn型クラッド層14cの各層は、同じMOCVD炉を用いて成膜することができる。なお、本実施形態では、n型コンタクト層14bをスパッタ法で成膜する例を説明しているが、MOCVD法で成膜しても良い。
“Formation of n-type semiconductor layer”
When forming the semiconductor layer 20 of the present embodiment, first, the base layer 14a of the n-type semiconductor layer 14 is deposited on the buffer layer 12 by a conventionally known MOCVD method. Next, an n-type contact layer 14b is formed on the base layer 14a by sputtering, and then an n-type cladding layer 14c is formed by MOCVD. At this time, the underlayer 14a and the n-type cladding layer 14c can be formed using the same MOCVD furnace. In the present embodiment, an example in which the n-type contact layer 14b is formed by a sputtering method has been described. However, the n-type contact layer 14b may be formed by an MOCVD method.

「発光層の形成」
n型クラッド層14c上には、発光層15を、従来公知のMOCVD法によって形成する。
本実施形態で形成する、図1に例示するような発光層15は、GaN障壁層に始まりGaN障壁層に終わる積層構造を有しており、GaNからなる6層の障壁層15aと、ノンドープのIn0.2Ga0.8Nからなる5層の井戸層15bとを交互に積層して形成する。
また、本実施形態の製造方法では、n型クラッド層14cの成膜に用いるMOCVD炉と同じものを使用することにより、従来公知のMOCVD法で発光層15を成膜することができる。
`` Formation of light emitting layer ''
On the n-type cladding layer 14c, the light emitting layer 15 is formed by a conventionally known MOCVD method.
The light emitting layer 15 illustrated in FIG. 1 formed in this embodiment has a laminated structure that starts with a GaN barrier layer and ends with the GaN barrier layer, and includes six barrier layers 15a made of GaN, and a non-doped layer. The five well layers 15b made of In 0.2 Ga 0.8 N are alternately stacked.
In the manufacturing method of this embodiment, the light emitting layer 15 can be formed by a conventionally known MOCVD method by using the same MOCVD furnace used for forming the n-type cladding layer 14c.

「p型半導体層の形成」
発光層15上、つまり、発光層15の最上層となる障壁層15a上には、p型クラッド層16a及びp型コンタクト層16bからなるp型半導体層16を、MOCVD法、又はスパッタ法を用いて形成する。
本実施形態では、まず、MgをドープしたAl0.1Ga0.9Nからなるp型クラッド層16aを発光層15(最上層の障壁層15a)上に形成し、さらにその上に、MgをドープしたAl0.02Ga0.98Nからなるp型コンタクト層16bを形成する。この際、p型クラッド層16a及びp型コンタクト層16bの積層には、同じスパッタ装置を用いることができる。
なお、上述したように、p型不純物としては、Mgのみならず、例えば亜鉛(Zn)等も同様に用いることができる。
“Formation of p-type semiconductor layer”
A p-type semiconductor layer 16 composed of a p-type cladding layer 16a and a p-type contact layer 16b is formed on the light-emitting layer 15, that is, on the barrier layer 15a which is the uppermost layer of the light-emitting layer 15, by MOCVD or sputtering. Form.
In the present embodiment, first, a p-type cladding layer 16a made of Mg-doped Al 0.1 Ga 0.9 N is formed on the light emitting layer 15 (the uppermost barrier layer 15a), and further, Mg A p-type contact layer 16b made of Al 0.02 Ga 0.98 N doped with is formed. At this time, the same sputtering apparatus can be used for stacking the p-type cladding layer 16a and the p-type contact layer 16b.
As described above, not only Mg but also zinc (Zn), for example, can be used as the p-type impurity.

『透光性正極の形成』
上記方法によって各層が形成されてなる積層半導体10のp型コンタクト層16b上に、ITOからなる透光性正極17を形成する。
透光性正極17の形成方法としては、特に限定されず、この技術分野でよく知られた慣用の手段で設けることができる。また、その構造も、従来公知の構造を含めて如何なる構造のものも何ら制限なく用いることができる。
"Formation of translucent positive electrode"
A translucent positive electrode 17 made of ITO is formed on the p-type contact layer 16b of the laminated semiconductor 10 in which each layer is formed by the above method.
The method for forming the translucent positive electrode 17 is not particularly limited, and can be provided by conventional means well known in this technical field. In addition, any structure including a conventionally known structure can be used without any limitation.

また、上述したように、透光性正極17の材料は、ITOには限定されず、AZO、IZO、GZO等の材料を用いて形成することが可能である。
また、透光性正極17を形成した後、合金化や透明化を目的とした熱アニールを施す場合もあるが、施さなくても構わない。
Further, as described above, the material of the translucent positive electrode 17 is not limited to ITO, and can be formed using materials such as AZO, IZO, and GZO.
Further, after forming the translucent positive electrode 17, thermal annealing may be performed for the purpose of alloying or transparency, but it may not be performed.

『正極ボンディングパッド及び負極の形成』
積層半導体10上に形成された透光性正極17上に、さらに、正極ボンディングパッド18を形成する。
この正極ボンディングパッド18は、例えば、透光性正極17の表面側から順に、Ti、Al、Auの各材料を、従来公知の方法で積層することによって形成することができる。
"Formation of positive electrode bonding pad and negative electrode"
A positive electrode bonding pad 18 is further formed on the translucent positive electrode 17 formed on the laminated semiconductor 10.
The positive electrode bonding pad 18 can be formed, for example, by laminating Ti, Al, and Au materials in order from the surface side of the translucent positive electrode 17 by a conventionally known method.

また、負極19を形成する際は、まず、基板11上に形成されたp型半導体層16、発光層15及びn型半導体層14の一部をドライエッチング等の方法によって除去することにより、n型コンタクト層14bの露出領域14dを形成する(図2及び図3参照)。そして、この露出領域14d上に、例えば、露出領域14d表面側から順に、Ni、Al、Ti、及びAuの各材料を従来公知の方法で積層することにより、詳細な図示を省略する4層構造の負極19を形成することができる。   When forming the negative electrode 19, first, a part of the p-type semiconductor layer 16, the light emitting layer 15, and the n-type semiconductor layer 14 formed on the substrate 11 is removed by a method such as dry etching, whereby n An exposed region 14d of the mold contact layer 14b is formed (see FIGS. 2 and 3). Then, on this exposed region 14d, for example, each material of Ni, Al, Ti, and Au is sequentially laminated from the surface side of the exposed region 14d by a conventionally known method, so that a detailed illustration is omitted. The negative electrode 19 can be formed.

そして、上述のようにして、積層半導体10上に、透光性正極17、正極ボンディングパッド18及び負極19を設けたウェーハを、基板11の裏面を研削及び研磨してミラー状の面とした後、例えば、350μm角の正方形に切断することにより、発光素子チップ(発光素子1)とすることができる。   Then, as described above, after the wafer provided with the translucent positive electrode 17, the positive electrode bonding pad 18 and the negative electrode 19 on the laminated semiconductor 10 is ground and polished to form a mirror-like surface. For example, a light emitting element chip (light emitting element 1) can be obtained by cutting into a square of 350 μm square.

以上説明したような、本実施形態のIII族窒化物半導体発光素子の製造方法によれば、サファイアからなる基板11上に、少なくともIII族窒化物化合物からなるバッファ層12を積層するにあたり、スパッタ装置41のチャンバ41内において、基板加熱用の設定温度をバッファ層12の成膜温度と同じかそれ以上としてダミー放電を行ない、その後、スパッタ装置40のチャンバ41内の到達真空度を2×10−5Pa以下の条件として、金属Al原料と窒素元素を含んだガスとを用いた反応性スパッタ法を用いて、バッファ層12をAlNから形成する方法を採用している。これにより、基板11上に形成されるバッファ層12が酸素を含有し、かつ、バッファ層12中の酸素濃度を1原子%以下とすることができるので、このバッファ層12上に積層されるIII族窒化物半導体の結晶性が向上する。従って、優れた発光特性を有するIII族窒化物半導体発光素子1を製造することが可能となる。 As described above, according to the method for manufacturing a group III nitride semiconductor light emitting device of this embodiment, a sputtering apparatus is used for stacking the buffer layer 12 made of at least a group III nitride compound on the substrate 11 made of sapphire. In the chamber 41 of 41, dummy discharge is performed with the set temperature for heating the substrate equal to or higher than the film formation temperature of the buffer layer 12, and then the ultimate vacuum in the chamber 41 of the sputtering apparatus 40 is set to 2 × 10 − As a condition of 5 Pa or less, a method of forming the buffer layer 12 from AlN using a reactive sputtering method using a metal Al raw material and a gas containing a nitrogen element is employed. As a result, the buffer layer 12 formed on the substrate 11 contains oxygen, and the oxygen concentration in the buffer layer 12 can be made 1 atomic% or less. The crystallinity of the group nitride semiconductor is improved. Therefore, the group III nitride semiconductor light emitting device 1 having excellent light emission characteristics can be manufactured.

また、本実施形態の製造方法によれば、バッファ層12の形成に用いるスパッタ装置40のチャンバ41内の到達真空度を、2×10−5Pa以下の条件として、バッファ層12を形成する前にチャンバ41を吸引することで、チャンバ41内に存在する酸素含有物を低減することができる。これにより、基板11上に形成するバッファ層12の配向性をより向上させることが可能となる。またさらに、上記操作によって、スパッタ装置40のチャンバ41内を吸引して低圧とすると同時に、所定回数のダミー放電を行なうことにより、チャンバ41内の到達真空度をさらに低圧とすることができ、チャンバ41内に存在する酸素含有物をより確実に低減することができる。従って、基板11上に形成するバッファ層12の配向性をさらに向上させることが可能となる。 Further, according to the manufacturing method of the present embodiment, before the buffer layer 12 is formed, the ultimate vacuum in the chamber 41 of the sputtering apparatus 40 used for forming the buffer layer 12 is set to 2 × 10 −5 Pa or less. By sucking the chamber 41 into the chamber 41, the oxygen-containing material existing in the chamber 41 can be reduced. Thereby, the orientation of the buffer layer 12 formed on the substrate 11 can be further improved. Furthermore, by the above operation, the inside of the chamber 41 of the sputtering apparatus 40 is sucked to a low pressure, and at the same time, the ultimate vacuum in the chamber 41 can be further reduced by performing a predetermined number of dummy discharges. The oxygen-containing material existing in 41 can be more reliably reduced. Therefore, the orientation of the buffer layer 12 formed on the substrate 11 can be further improved.

[ランプ]
以上説明したような、本発明に係る製造方法によって得られるIII族窒化物半導体発光素子と蛍光体とを組み合わせることにより、当業者周知の手段によってランプを構成することができる。従来より、発光素子と蛍光体と組み合わせることによって発光色を変える技術が知られており、このような技術を何ら制限されることなく採用することが可能である。
例えば、蛍光体を適正に選定することにより、発光素子より長波長の発光を得ることも可能となり、また、発光素子自体の発光波長と蛍光体によって変換された波長とを混ぜることにより、白色発光を呈するランプとすることもできる。
また、ランプとしては、一般用途の砲弾型、携帯のバックライト用途のサイドビュー型、表示器に用いられるトップビュー型等、何れの用途にも用いることができる。
[lamp]
By combining the group III nitride semiconductor light emitting device obtained by the manufacturing method according to the present invention and the phosphor as described above, a lamp can be configured by means well known to those skilled in the art. Conventionally, a technique for changing the emission color by combining a light emitting element and a phosphor is known, and such a technique can be adopted without any limitation.
For example, it is possible to obtain light having a longer wavelength than that of the light emitting element by appropriately selecting the phosphor, and it is possible to obtain white light emission by mixing the light emitting wavelength of the light emitting element itself with the wavelength converted by the phosphor. It can also be set as the lamp which exhibits.
Further, the lamp can be used for any purpose such as a general bullet type, a side view type for a portable backlight, and a top view type used for a display.

例えば、図4に示す例のように、同一面電極型のIII族窒化物半導体発光素子1を砲弾型に実装する場合には、2本のフレームの内の一方(図4ではフレーム31)に発光素子1を接着し、また、発光素子1の負極(図3に示す符号19参照)をワイヤー34でフレーム32に接合し、発光素子1の正極ボンディングパッド(図3に示す符号18参照)をワイヤー33でフレーム31に接合する。そして、透明な樹脂からなるモールド35で発光素子1の周辺をモールドすることにより、図4に示すような砲弾型のランプ3を作成することができる。   For example, as in the example shown in FIG. 4, when mounting the same-surface electrode type group III nitride semiconductor light emitting device 1 in a shell type, one of the two frames (frame 31 in FIG. 4) The light emitting element 1 is bonded, the negative electrode of the light emitting element 1 (see reference numeral 19 shown in FIG. 3) is bonded to the frame 32 with a wire 34, and the positive electrode bonding pad of the light emitting element 1 (see reference numeral 18 shown in FIG. 3) is attached. The wire 33 is joined to the frame 31. And the bullet-type lamp 3 as shown in FIG. 4 can be produced by molding the periphery of the light emitting element 1 with a mold 35 made of a transparent resin.

なお、本発明で得られ、優れた結晶性を備えるIII族窒化物半導体の積層構造は、上述のような発光ダイオード(LED)やレーザディスク(LD)等の発光素子に備えられる半導体層の他、レーザ素子や受光素子等の光電気変換素子、又は、HBT(Heterojunction Bipolar Transistor)やHEMT(High Electron Mobility Transistor)等の電子デバイスにも用いることができる。これらの半導体素子は、各種構造のものが多数知られており、本発明に係るIII族窒化物半導体の積層構造体の素子構造は、これら周知の素子構造を含めて何ら制限されない。   In addition, the laminated structure of the group III nitride semiconductor having excellent crystallinity obtained in the present invention is not limited to the semiconductor layer provided in the light emitting element such as the light emitting diode (LED) or the laser disk (LD) as described above. It can also be used for photoelectric devices such as laser devices and light-receiving devices, or electronic devices such as HBT (Heter Junction Bipolar Transistor) and HEMT (High Electron Mobility Transistor). Many of these semiconductor elements have various structures, and the element structure of the group III nitride semiconductor multilayer structure according to the present invention is not limited at all including these known element structures.

以下に、本発明のIII族窒化物半導体発光素子の製造方法を、実施例によりさらに詳細に説明するが、本発明はこれらの実施例にのみ限定されるものではない。   Hereinafter, the method for producing a Group III nitride semiconductor light-emitting device of the present invention will be described in more detail with reference to Examples, but the present invention is not limited to these Examples.

[実施例1]
図1に、本実験例で作製したIII族窒化物化合物半導体発光素子の積層半導体の断面模式図を示す。
本例では、サファイアからなる基板11のc面上に、バッファ層12としてRFスパッタ法を用いてAlNからなる単結晶の層を形成し、その上に、下地層14aとして、反応性スパッタ法を用いてGaN(III族窒化物半導体)からなる層を形成した。
[Example 1]
FIG. 1 is a schematic cross-sectional view of a laminated semiconductor of a group III nitride compound semiconductor light-emitting device manufactured in this experimental example.
In this example, a single-crystal layer made of AlN is formed as the buffer layer 12 on the c-plane of the substrate 11 made of sapphire using RF sputtering, and a reactive sputtering method is used as the base layer 14a thereon. A layer made of GaN (Group III nitride semiconductor) was used.

『バッファ層の形成』
まず、表面を鏡面研磨した直径2インチの(0001)c面サファイアからなる基板を、フッ酸及び有機溶媒によって洗浄した後、チャンバ中へ導入した。この際、スパッタ装置としては、図5に例示するスパッタ装置40ように、高周波式の電源を有し、また、ターゲット内でマグネットの位置を動かすことができる機構を有する装置を使用した。なお、ターゲットとしては、金属Alからなるものを用いた。
そして、チャンバ内で基板11を500℃まで加熱し、窒素ガスを15sccmの流量で導入した後、チャンバ内の圧力を1.0Paに保持し、基板11側に50Wの高周波バイアスを印加し、窒素プラズマに晒すことによって基板11表面を洗浄した。
次いで、真空ポンプによってチャンバ内を吸引し、これと同時にダミー放電を計16回繰り返すことによってスパッタ装置のチャンバ内を減圧し、6.0×10−6Paまで内圧を低下させ、チャンバ内の不純物を除去した。
"Formation of buffer layer"
First, a substrate made of (0001) c-plane sapphire having a diameter of 2 inches whose surface was mirror-polished was washed with hydrofluoric acid and an organic solvent, and then introduced into the chamber. At this time, as the sputtering apparatus, an apparatus having a high-frequency power source and a mechanism capable of moving the position of the magnet in the target, such as the sputtering apparatus 40 illustrated in FIG. 5, was used. A target made of metal Al was used as the target.
Then, after heating the substrate 11 to 500 ° C. in the chamber and introducing nitrogen gas at a flow rate of 15 sccm, the pressure in the chamber is maintained at 1.0 Pa, a high frequency bias of 50 W is applied to the substrate 11 side, The surface of the substrate 11 was cleaned by exposure to plasma.
Next, the inside of the chamber is sucked by a vacuum pump, and at the same time, dummy discharge is repeated a total of 16 times to reduce the pressure in the chamber of the sputtering apparatus, and the internal pressure is reduced to 6.0 × 10 −6 Pa. Was removed.

次いで、基板11の温度はそのままに、スパッタ装置内にアルゴン及び窒素ガスを導入した。そして、2000Wの高周波バイアスを金属Alターゲット側に印加し、炉内の圧力を0.5Paに保ち、Arガスを5sccm、窒素ガスを15sccm流通させた条件下(ガス全体における窒素の比は75%)で、サファイアからなる基板11上に、AlNからなる単結晶のバッファ層12を成膜した。ターゲット内のマグネットは、基板11の洗浄時、及び成膜時の何れにおいても揺動させた。
そして、予め測定した成膜速度(0.067nm/s)に従い、規定した時間の処理により、40nmのAlN(バッファ層12)を成膜後、プラズマ動作を停止し、基板11の温度を低下させた。
Next, argon and nitrogen gas were introduced into the sputtering apparatus while keeping the temperature of the substrate 11 as it was. Then, a high frequency bias of 2000 W was applied to the metal Al target side, the pressure in the furnace was kept at 0.5 Pa, Ar gas was flowed at 5 sccm, and nitrogen gas was flowed at 15 sccm (the ratio of nitrogen in the entire gas was 75%) The single crystal buffer layer 12 made of AlN was formed on the substrate 11 made of sapphire. The magnet in the target was swung both when the substrate 11 was cleaned and when the film was formed.
Then, according to the film formation rate (0.067 nm / s) measured in advance, after the film formation of 40 nm of AlN (buffer layer 12) by the treatment for the specified time, the plasma operation is stopped and the temperature of the substrate 11 is lowered. It was.

そして、基板11上に形成したバッファ層12のX線ロッキングカーブ(XRC)を、X線測定装置(スペクトリス社製、型番:X‘part Pro MRD)を用いて測定した。この測定は、CuKα線X線発生源を光源として用いて行なった。この結果、バッファ層12のXRC半値幅は0.1°と優れた特性を示しており、バッファ層12が良好に配向していることが確認できた。
また、バッファ層12の組成について、X線光電子分光装置(XPS)を用いて測定したところ、図6(a)に示すように、バッファ層に相当するエッチング時間3〜13分の間で、酸素濃度が原子%で1%以下であることが確認できた。
And the X-ray rocking curve (XRC) of the buffer layer 12 formed on the board | substrate 11 was measured using the X-ray-measuring apparatus (Spectris company make, model number: X'part Pro MRD). This measurement was performed using a CuKα ray X-ray generation source as a light source. As a result, the XRC full width at half maximum of the buffer layer 12 showed an excellent characteristic of 0.1 °, and it was confirmed that the buffer layer 12 was well oriented.
Further, the composition of the buffer layer 12 was measured using an X-ray photoelectron spectrometer (XPS). As shown in FIG. 6A, the oxygen concentration was reduced between 3 and 13 minutes corresponding to the buffer layer. It was confirmed that the concentration was 1% or less in atomic%.

『下地層の形成』
次いで、AlN(バッファ層12)が成膜された基板11を、スパッタ装置内から取り出してMOCVD装置内に搬送し、バッファ層12上に、以下の手順でGaNからなる下地層14aを成膜した。
まず、基板11を反応炉(MOCVD装置)内に導入し、窒素ガスで置換されたグローブボックス内において、加熱用のカーボン製サセプタ上に載置した。次いで、反応炉内に窒素ガスを流通させた後、ヒータを作動させて基板温度を1150℃に昇温させ、1150℃で温度が安定したことを確認した後、アンモニアガス配管のバルブを開き、反応炉内へのアンモニアガスの流通を開始した。
"Formation of underlayer"
Next, the substrate 11 on which AlN (buffer layer 12) was formed was taken out from the sputtering apparatus and transferred into the MOCVD apparatus, and a base layer 14a made of GaN was formed on the buffer layer 12 by the following procedure. .
First, the substrate 11 was introduced into a reaction furnace (MOCVD apparatus) and placed on a carbon susceptor for heating in a glove box replaced with nitrogen gas. Next, after circulating nitrogen gas in the reactor, the heater was operated to raise the substrate temperature to 1150 ° C., and after confirming that the temperature was stable at 1150 ° C., the valve of the ammonia gas pipe was opened, Distribution of ammonia gas into the reactor was started.

次いで、TMGの蒸気を含む水素を反応炉内へ供給して、バッファ層12上に、下地層14aを構成するIII族窒化物半導体(GaN)を成膜する工程を開始した。この際のアンモニアの量は、V/III比が6000となるように調節した。このようにして、約1時間にわたってGaNを成長させた後、TMGの配管のバルブを切り替え、原料の反応炉への供給を終了してGaNの成長を停止した。そして、ヒータへの通電を停止し、基板温度を室温まで降温させた。   Next, hydrogen containing TMG vapor was supplied into the reaction furnace, and a process of forming a group III nitride semiconductor (GaN) constituting the underlayer 14a on the buffer layer 12 was started. The amount of ammonia at this time was adjusted so that the V / III ratio was 6000. In this way, after growing GaN for about 1 hour, the valve of the TMG piping was switched, the supply of the raw material to the reactor was terminated, and the growth of GaN was stopped. Then, power supply to the heater was stopped, and the substrate temperature was lowered to room temperature.

以上の工程により、基板11上に成膜された単結晶組織のAlNからなるバッファ層12の上に、アンドープで2μmの膜厚のGaNからなる下地層14aを成膜した。成膜後に反応炉内から取り出した試料は無色透明であり、GaN層(下地層14a)の表面は鏡面であった。   Through the above steps, an undoped underlayer 14a made of GaN having a thickness of 2 μm was formed on the buffer layer 12 made of AlN having a single crystal structure formed on the substrate 11. The sample taken out from the reaction furnace after film formation was colorless and transparent, and the surface of the GaN layer (underlayer 14a) was a mirror surface.

上述のようにして形成したアンドープGaNからなる下地層14aのX線ロッキングカーブ(XRC)を、X線測定装置(スペクトリス社製、型番:X‘part Pro MRD)を用いて測定した。この測定は、Cuβ線X線発生源を光源として用い、対称面である(0002)面と非対称面である(10−10)面で行った。一般的に、III族窒化物化合物半導体の場合、(0002)面のXRCスペクトル半値幅は結晶の平坦性(モザイシティ)の指標となり、(10−10)面のXRCスペクトル半値幅は転位密度(ツイスト)の指標となる。この測定の結果、本発明の製造方法で作製したアンドープGaN層は、(0002)面の測定では半値幅46arcsec、(10−10)面では220arcsecを示した。   The X-ray rocking curve (XRC) of the base layer 14a made of undoped GaN formed as described above was measured using an X-ray measurement apparatus (Spectris Co., model number: X'part Pro MRD). This measurement was performed on a (0002) plane which is a symmetric plane and a (10-10) plane which is an asymmetric plane, using a Cuβ ray X-ray generation source as a light source. In general, in the case of a group III nitride compound semiconductor, the XRC spectrum half width of the (0002) plane is an index of crystal flatness (mosaicity), and the XRC spectrum half width of the (10-10) plane is the dislocation density (twist). ). As a result of this measurement, the undoped GaN layer produced by the manufacturing method of the present invention showed a half-width of 46 arcsec in the (0002) plane measurement and 220 arcsec in the (10-10) plane.

『n型コンタクト層の形成』
次いで、下地層14aを形成した基板11をMOCVD装置内に搬送し、GaNからなるn型コンタクト層を、MOCVD法を用いて形成した。この際、n型コンタクト層にはSiをドープした。ここで、GaNの成膜に使用するMOCVD装置としては、従来公知の装置を使用した。
“Formation of n-type contact layer”
Next, the substrate 11 on which the base layer 14a was formed was transferred into an MOCVD apparatus, and an n-type contact layer made of GaN was formed using the MOCVD method. At this time, the n-type contact layer was doped with Si. Here, a conventionally known apparatus was used as the MOCVD apparatus used for forming the GaN film.

以上説明したような工程により、表面に逆スパッタを施したサファイアからなる基板11上に、単結晶組織を持つAlNのバッファ層12を形成し、その上にアンドープで2μmの膜厚のGaN層(n型下地層14a)と、5×1018cm−3のキャリア濃度を持つ2μmのSiドープのGaN層(n型コンタクト層14b)を形成した。成膜後に装置内から取り出した基板は無色透明であり、GaN層(ここではn型コンタクト層14b)の表面は鏡面であった。 Through the process described above, an AlN buffer layer 12 having a single crystal structure is formed on a substrate 11 made of sapphire whose surface has been reverse sputtered, and an undoped GaN layer (2 μm thick) ( An n-type underlayer 14a) and a 2 μm Si-doped GaN layer (n-type contact layer 14b) having a carrier concentration of 5 × 10 18 cm −3 were formed. The substrate taken out from the apparatus after film formation was colorless and transparent, and the surface of the GaN layer (here, n-type contact layer 14b) was a mirror surface.

『n型クラッド層及び発光層の形成』
上記手順で作製したサンプルのn型コンタクト層上に、MOCVD法を用いてn型クラッド層14c及び発光層15を積層した。
“Formation of n-type cladding layer and light-emitting layer”
An n-type cladding layer 14c and a light-emitting layer 15 were stacked on the n-type contact layer of the sample prepared by the above procedure using MOCVD.

「n型クラッド層の形成」
まず、SiドープGaNからなるn型コンタクト層が成長された基板を、MOCVD装置のチャンバ内へ搬送した。そして、チャンバ内を窒素で置換した状態として基板の温度を1000℃まで上昇させ、n型コンタクト層の最表面に付着した汚れを昇華させて除去した。また、この際、基板の温度が830℃以上となった時点から、アンモニアを炉内に流通させた。
“Formation of n-type cladding layer”
First, the substrate on which the n-type contact layer made of Si-doped GaN was grown was transferred into the chamber of the MOCVD apparatus. Then, the temperature of the substrate was raised to 1000 ° C. with the inside of the chamber replaced with nitrogen, and the dirt adhering to the outermost surface of the n-type contact layer was sublimated and removed. At this time, ammonia was circulated in the furnace when the temperature of the substrate reached 830 ° C. or higher.

次いで、基板の温度を740℃まで低下させた後、アンモニアをチャンバ内にそのまま流通させながら、SiH4ガスと、バブリングによって発生させたTMI及びTEGの蒸気を炉内へ流通させ、180Åの膜厚を有し、SiドープIn0.01Ga0.99Nからなるn型クラッド層14cを形成した。そして、TMI、TEG及びSiHのバルブを切り替え、これらの原料の供給を停止した。 Next, after the temperature of the substrate was lowered to 740 ° C., SiH 4 gas and vapors of TMI and TEG generated by bubbling were circulated into the furnace while ammonia was circulated as it was in the chamber. And an n-type cladding layer 14c made of Si-doped In 0.01 Ga 0.99 N was formed. Then, TMI, switching the valve of the TEG and SiH 4, and stop the supply of these raw materials.

「発光層の形成」
次いで、GaNからなる障壁層15aと、In0.2Ga0.8Nからなる井戸層15bとから構成され、多重量子井戸構造を有する発光層15を形成した。この、発光層15の形成にあたっては、SiドープIn0.01Ga0.99Nからなるn型クラッド層14c上に、まず、障壁層15aを形成し、この障壁層15a上に、In0.2Ga0.8Nからなる井戸層15bを形成した。このような積層手順を5回繰り返した後、5番目に積層した井戸層15b上に、6番目の障壁層15aを形成し、多重量子井戸構造を有する発光層15の両側に障壁層15aを配した構造とした。
`` Formation of light emitting layer ''
Next, a light emitting layer 15 composed of a barrier layer 15a made of GaN and a well layer 15b made of In 0.2 Ga 0.8 N and having a multiple quantum well structure was formed. In the formation of the light emitting layer 15, a barrier layer 15a is first formed on the n-type cladding layer 14c made of Si-doped In 0.01 Ga 0.99 N, and an In 0. forming a well layer 15b composed of 2 Ga 0.8 N. After repeating such a stacking procedure five times, a sixth barrier layer 15a is formed on the fifth stacked well layer 15b, and the barrier layers 15a are arranged on both sides of the light emitting layer 15 having a multiple quantum well structure. The structure was as follows.

すなわち、SiドープIn0.01Ga0.99Nからなるn型クラッド層14cの成長終了後、基板温度や炉内の圧力、キャリアガスの流量や種類はそのままとし、TEGのバルブを切り替え、炉内へTEGを供給することにより、GaNからなる障壁層15aを成長させた。これにより、150Åの膜厚を有する障壁層15aを形成した。 That is, after the growth of the n-type cladding layer 14c made of Si-doped In 0.01 Ga 0.99 N is completed, the substrate temperature, the pressure in the furnace, the flow rate and type of the carrier gas are kept unchanged, the TEG valve is switched, By supplying TEG inward, the barrier layer 15a made of GaN was grown. Thereby, the barrier layer 15a having a thickness of 150 mm was formed.

次いで、障壁層15aの成長を終了させた後、基板11の温度や炉内の圧力、キャリアガスの流量や種類はそのままとして、TEG及びTMIのバルブを切り替えてTEG及びTMIを炉内へ供給し、In0.2Ga0.8Nからなる井戸層15bを成長させた。これにより、20Åの膜厚を有する井戸層15bを形成した。 Next, after the growth of the barrier layer 15a is completed, the temperature of the substrate 11, the pressure in the furnace, the flow rate and type of the carrier gas are maintained, and the TEG and TMI valves are switched to supply TEG and TMI into the furnace. A well layer 15b made of In 0.2 Ga 0.8 N was grown. As a result, a well layer 15b having a thickness of 20 mm was formed.

井戸層15bの成長を終了させた後、再び障壁層15aを成長させた。そして、このような手順を5回繰り返すことにより、5層の障壁層15aと5層の井戸層15bを形成した。さらに、最後に積層した井戸層15b上に、障壁層15aを形成し、発光層15とした。   After the growth of the well layer 15b was completed, the barrier layer 15a was grown again. Then, by repeating such a procedure five times, five barrier layers 15a and five well layers 15b were formed. Further, a barrier layer 15 a is formed on the well layer 15 b that is finally stacked, thereby forming the light emitting layer 15.

『p型半導体層の形成』
上述の各工程処理によって得られたウェーハ上に、MOCVD装置を用いてp型半導体層16を成膜した。
ここで、p型半導体層16の成膜に用いるMOCVD装置としては、従来公知の装置を使用した。また、この際、p型半導体層16にはMgをドープした。
“Formation of p-type semiconductor layer”
A p-type semiconductor layer 16 was formed on the wafer obtained by each process described above using an MOCVD apparatus.
Here, as the MOCVD apparatus used for forming the p-type semiconductor layer 16, a conventionally known apparatus was used. At this time, the p-type semiconductor layer 16 was doped with Mg.

そして、最終的に、膜厚が10nmのMgドープAl0.1Ga0.9Nからなるp型クラッド層16aと、膜厚が200nmのMgドープAl0.02Ga0.98Nからなるp型コンタクト層16bとから構成されるp型半導体層16を成膜した。 Finally, a p-type cladding layer 16a made of Mg-doped Al 0.1 Ga 0.9 N with a thickness of 10 nm and a p-type cladding layer 16 made of Mg-doped Al 0.02 Ga 0.98 N with a thickness of 200 nm. A p-type semiconductor layer 16 composed of the type contact layer 16b was formed.

上述のようにして作製したLED用のエピタキシャルウェーハは、図1に示す積層半導体10のように、c面を有するサファイアからなる基板11上に、単結晶構造を有するAlN層(バッファ層12)を形成した後、基板11側から順に、2μmのアンドープGaN層(下地層14a)、5×1018cm−3の電子濃度を持つ2μmのSiドープGaN層(n型コンタクト層14b)、1×1018cm−3の電子濃度を持つ180ÅのIn0.01Ga0.99Nクラッド層(n型クラッド層14c)、GaN障壁層に始まってGaN障壁層に終わり、層厚が150Åとされた6層のGaN障壁層(障壁層15a)と、層厚が20Åとされた5層のノンドープのIn0.2Ga0.8N井戸層(井戸層15b)とからなる多重量子井戸構造(発光層15)、膜厚が10nmのMgドープAl0.1Ga0.9Nからなるp型クラッド層16aと、膜厚が200nmのMgドープAl0.02Ga0.98Nからなるp型コンタクト層16bとから構成されるMgドープAlGaN層(p型半導体層16)を積層した構造を有する。 The epitaxial wafer for LED produced as described above has an AlN layer (buffer layer 12) having a single crystal structure on a substrate 11 made of sapphire having a c-plane, like the laminated semiconductor 10 shown in FIG. After forming, in order from the substrate 11 side, a 2 μm undoped GaN layer (underlayer 14 a), a 2 μm Si doped GaN layer (n-type contact layer 14 b) having an electron concentration of 5 × 10 18 cm −3 , 1 × 10 180 cm In 0.01 Ga 0.99 N clad layer (n-type clad layer 14c) having an electron concentration of 18 cm −3 , which starts at the GaN barrier layer and ends at the GaN barrier layer, and the layer thickness is set to 150 mm And a multi-layer consisting of five non-doped In 0.2 Ga 0.8 N well layers (well layers 15b) with a layer thickness of 20 mm. A p-type cladding layer 16a made of Mg-doped Al 0.1 Ga 0.9 N having a thickness of 10 nm and a Mg-doped Al 0.02 Ga 0.98 N having a thickness of 200 nm. And a p-type contact layer 16b made of an Mg-doped AlGaN layer (p-type semiconductor layer 16).

『LEDの作製』
次いで、上記エピタキシャルウェーハ(積層半導体10)を用いてLEDを作製した。
すなわち、上記エピタキシャルウェーハのMgドープAlGaN層(p型半導体層16b)の表面に、公知のフォトリソグラフィー技術によってITOからなる透光性電極17を形成し、その上に、チタン、アルミニウム及び金を順に積層した構造を有する正極ボンディングパッド18(p電極ボンディングパッド)を形成し、p側電極とした。さらに、ウェーハに対してドライエッチングを施し、n型コンタクト層14bのn側電極(負極)を形成する領域を露出させ、この露出領域14dにNi、Al、Ti及びAuの4層が順に積層されてなる負極19(n側電極)を形成した。このような手順により、ウェーハ(図1の積層半導体10を参照)上に、図2に示すような形状を有する各電極を形成した。
"Production of LED"
Subsequently, LED was produced using the said epitaxial wafer (laminated semiconductor 10).
That is, the transparent electrode 17 made of ITO is formed on the surface of the Mg-doped AlGaN layer (p-type semiconductor layer 16b) of the epitaxial wafer by a known photolithography technique, and titanium, aluminum, and gold are sequentially formed thereon. A positive electrode bonding pad 18 (p-electrode bonding pad) having a laminated structure was formed as a p-side electrode. Further, dry etching is performed on the wafer to expose a region for forming the n-side electrode (negative electrode) of the n-type contact layer 14b, and four layers of Ni, Al, Ti, and Au are sequentially laminated on the exposed region 14d. A negative electrode 19 (n-side electrode) was formed. By such a procedure, each electrode having a shape as shown in FIG. 2 was formed on the wafer (see the laminated semiconductor 10 in FIG. 1).

そして、上述の手順でp側及びn側の各電極が形成されたウェーハについて、サファイアからなる基板11の裏面を研削及び研磨してミラー状の面とした。そして、このウェーハを350μm角の正方形のチップに切断し、各電極が上になるようにリードフレーム上に配置し、金線でリードフレームへ結線して発光素子とした(図4のランプ3を参照)。
上述のようにして作製した発光ダイオードのp側およびn側の電極間に順方向電流を流したところ、電流20mAにおける順方向電圧は3.1Vであった。また、p側の透光性電極17を通して発光状態を観察したところ、発光波長は460nmであり、発光出力は15.2mWを示した。このような発光ダイオードの特性は、作製したウェーハのほぼ全面から作製された発光ダイオードについて、ばらつきなく得られた。
And about the wafer in which each electrode of p side and n side was formed in the above-mentioned procedure, the back surface of the board | substrate 11 which consists of sapphire was ground and grind | polished, and it was set as the mirror-shaped surface. Then, this wafer was cut into a 350 μm square chip, placed on the lead frame so that each electrode was on top, and connected to the lead frame with a gold wire to form a light emitting element (the lamp 3 in FIG. reference).
When a forward current was passed between the p-side and n-side electrodes of the light emitting diode produced as described above, the forward voltage at a current of 20 mA was 3.1V. When the light emission state was observed through the p-side translucent electrode 17, the emission wavelength was 460 nm and the emission output was 15.2 mW. Such characteristics of the light-emitting diode were obtained with no variation for light-emitting diodes manufactured from almost the entire surface of the manufactured wafer.

[実施例2]
基板上に成膜するバッファ層の結晶組織を、柱状結晶の集合体からなる多結晶となるような条件を用いて成膜処理を行った点を除き、上記実施例1と同様の手順で、基板上にバッファ層を積層し、その上にアンドープGaN層(下地層)を積層した後、さらに、III族窒化物半導体からなる各層を形成することにより、図2及び図3に示すような発光素子を作成した。
[Example 2]
With the same procedure as in Example 1 above, except that the crystal structure of the buffer layer formed on the substrate was subjected to a film forming process using conditions such that the crystal structure was a polycrystal composed of columnar crystals. A buffer layer is laminated on a substrate, an undoped GaN layer (underlying layer) is laminated thereon, and then each layer made of a group III nitride semiconductor is formed, whereby light emission as shown in FIGS. A device was created.

基板上に形成したバッファ層のX線ロッキングカーブ(XRC)を、実施例1と同様の方法で測定したところ、XRC半値幅は12arcsecであった。また、バッファ層の組成について、X線光電子分光装置(XPS)を用いて測定したところ、実施例1と同様に、酸素濃度が原子%で1%以下であることが確認できた。   When the X-ray rocking curve (XRC) of the buffer layer formed on the substrate was measured by the same method as in Example 1, the XRC half-width was 12 arcsec. Further, the composition of the buffer layer was measured using an X-ray photoelectron spectrometer (XPS), and as in Example 1, it was confirmed that the oxygen concentration was 1% or less in atomic%.

そして、実施例1と同様の方法で、基板上に成膜されたバッファ層上に、反応性スパッタ法によってGaN層を成膜した。成膜後にチャンバ内から取り出した基板は無色透明であり、GaN層の表面は鏡面であった。
上述のようにして形成したアンドープGaNからなる下地層のX線ロッキングカーブ(XRC)を、実施例1と同様の方法で測定したところ、(0002)面の測定では半値幅93arcsec、(10−10)面では231arcsecを示した。
Then, a GaN layer was formed by reactive sputtering on the buffer layer formed on the substrate in the same manner as in Example 1. The substrate taken out from the chamber after film formation was colorless and transparent, and the surface of the GaN layer was a mirror surface.
When the X-ray rocking curve (XRC) of the base layer made of undoped GaN formed as described above was measured by the same method as in Example 1, the half-width of 93 arcsec, (10-10) was measured in the (0002) plane. ) Surface showed 231 arcsec.

そして、下地層の上に、実施例1と同様の方法を用いて、III族窒化物半導体からなる各層を形成し、このウェーハに、透光性電極、正極ボンディングパッド並びに負極の各電極を形成した後、基板の裏面を研削及び研磨してミラー状の面として350μm角の正方形のチップに切断し、各電極を金線でリードフレームに結線して図4のランプ3に示すような発光素子とした。
上述のようにして作製した発光ダイオードのp側およびn側の電極間に順方向電流を流したところ、電流20mAにおける順方向電圧は3.1Vであった。また、p側の透光性電極17を通して発光状態を観察したところ、発光波長は460nmであり、発光出力は15.2mWを示した。このような発光ダイオードの特性は、作製したウェーハのほぼ全面から作製された発光ダイオードについて、ばらつきなく得られた。
Then, each layer made of a group III nitride semiconductor is formed on the underlayer using the same method as in Example 1, and the translucent electrode, the positive electrode bonding pad, and the negative electrode are formed on this wafer. After that, the back surface of the substrate is ground and polished to cut into a 350 μm square chip as a mirror-like surface, and each electrode is connected to a lead frame with a gold wire, and the light emitting device as shown in the lamp 3 in FIG. It was.
When a forward current was passed between the p-side and n-side electrodes of the light emitting diode produced as described above, the forward voltage at a current of 20 mA was 3.1V. When the light emission state was observed through the p-side translucent electrode 17, the emission wavelength was 460 nm and the emission output was 15.2 mW. Such characteristics of the light-emitting diode were obtained with no variation for light-emitting diodes manufactured from almost the entire surface of the manufactured wafer.

[比較例]
基板の前処理を行なった後、真空ポンプによってチャンバ内を吸引して不純物を除去する際にダミー放電を行なわず、到達真空度を1.0×10−3Paとした点を除き、上記実施例1と同様の手順で、基板上にバッファ層を積層し、その上にアンドープGaN層(下地層)を積層した後、さらに、III族窒化物半導体からなる各層を形成することにより、図2及び図3に示すような発光素子を作成した。
[Comparative example]
After carrying out the pretreatment of the substrate, the above-described implementation is performed except that dummy discharge is not performed when the inside of the chamber is removed by a vacuum pump to remove impurities, and the ultimate vacuum is set to 1.0 × 10 −3 Pa. In the same procedure as in Example 1, a buffer layer is laminated on a substrate, an undoped GaN layer (underlying layer) is laminated thereon, and further, each layer made of a group III nitride semiconductor is formed. And the light emitting element as shown in FIG. 3 was created.

基板上に形成したバッファ層のX線ロッキングカーブ(XRC)を、実施例1と同様の方法で測定したところ、XRC半値幅は50arcsecであった。また、バッファ層の組成について、X線光電子分光装置(XPS)を用いて測定したところ、図6(b)に示すように、バッファ層に相当するエッチング時間3〜10分の間で、酸素濃度が原子%で5%であることが明らかとなった。   When the X-ray rocking curve (XRC) of the buffer layer formed on the substrate was measured by the same method as in Example 1, the XRC half-width was 50 arcsec. Further, the composition of the buffer layer was measured using an X-ray photoelectron spectrometer (XPS). As shown in FIG. 6 (b), the oxygen concentration was within an etching time of 3 to 10 minutes corresponding to the buffer layer. Was found to be 5% in atomic percent.

そして、実施例1と同様の方法で、基板上に成膜されたバッファ層上に、反応性スパッタ法によってGaN層を成膜した。成膜後にチャンバ内から取り出した基板は無色透明であり、GaN層の表面は鏡面であった。
上述のようにして形成したアンドープGaNからなる下地層のX線ロッキングカーブ(XRC)を、実施例1と同様の方法で測定したところ、(0002)面の測定では半値幅が200arcsec、(10−10)面では374arcsecであった。
Then, a GaN layer was formed by reactive sputtering on the buffer layer formed on the substrate in the same manner as in Example 1. The substrate taken out from the chamber after film formation was colorless and transparent, and the surface of the GaN layer was a mirror surface.
When the X-ray rocking curve (XRC) of the base layer made of undoped GaN formed as described above was measured in the same manner as in Example 1, the half-width was 200 arcsec, (10− 10), it was 374 arcsec.

そして、下地層の上に、実施例1と同様の方法を用いて、III族窒化物半導体からなる各層を形成し、このウェーハに、透光性電極、正極ボンディングパッド並びに負極の各電極を形成した後、基板の裏面を研削及び研磨してミラー状の面として350μm角の正方形のチップに切断し、各電極を金線でリードフレームに結線して発光素子とした(図4を参照)。
上述のようにして作製した発光ダイオードのp側およびn側の電極間に順方向電流を流したところ、電流20mAにおける順方向電圧は3.05Vであった。また、p側の透光性電極17を通して発光状態を観察したところ、発光波長は460nmであり、発光出力は14.3mWであった。
Then, each layer made of a group III nitride semiconductor is formed on the underlayer using the same method as in Example 1, and the translucent electrode, the positive electrode bonding pad, and the negative electrode are formed on this wafer. Then, the back surface of the substrate was ground and polished to cut into a 350 μm square chip as a mirror-like surface, and each electrode was connected to a lead frame with a gold wire to obtain a light emitting element (see FIG. 4).
When a forward current was passed between the p-side and n-side electrodes of the light-emitting diode produced as described above, the forward voltage at a current of 20 mA was 3.05V. Moreover, when the light emission state was observed through the p side translucent electrode 17, the light emission wavelength was 460 nm and the light emission output was 14.3 mW.

[実験例]
以下に、本発明を実証するための実験例について、図7(a)、(b)の各グラフを用いて説明する。図7(a)は、ダミー放電の回数とバッファ層中の酸素濃度の関係を示すグラフであり、図7(b)は、チャンバ内の到達真空度とバッファ層中の酸素濃度の関係を示すグラフである。
本実験例においては、基板の前処理を行なった後、真空ポンプによってチャンバ内を吸引して不純物を除去する際のダミー放電を、図7(a)に示すような回数で行い、チャンバ内の到達真空度を、図7(b)に示すような条件(No.1=2.0×10−5Pa、No.2=3.1×10−5Pa、No.3=5.1×10−5Pa、No.4=1.5×10−4Pa)に設定し、それ以外の点については、実施例1と同様の方法で基板上にバッファ層を形成したNo.1〜4の各サンプルを作製した。
[Experimental example]
Below, the experiment example for demonstrating this invention is demonstrated using each graph of Fig.7 (a), (b). FIG. 7A is a graph showing the relationship between the number of dummy discharges and the oxygen concentration in the buffer layer, and FIG. 7B shows the relationship between the ultimate vacuum in the chamber and the oxygen concentration in the buffer layer. It is a graph.
In this experimental example, after the substrate is pre-processed, dummy discharge is performed at the number of times shown in FIG. The ultimate vacuum is as shown in FIG. 7B (No. 1 = 2.0 × 10 −5 Pa, No. 2 = 3.1 × 10 −5 Pa, No. 3 = 5.1 ×). 10 −5 Pa, No. 4 = 1.5 × 10 −4 Pa), and for other points, the buffer layer was formed on the substrate in the same manner as in Example 1. Each sample of 1-4 was produced.

そして、上記No.1〜4の各サンプルについて、実施例1と同様の方法を用いて、基板上に形成したバッファ層のX線ロッキングカーブ(XRC)を測定したところ、XRC半値幅は、それぞれ、No.1:10arcsec、No.2:12arcsec、No.3:33arcsec、No.4:39arcsecであった。また、No.1〜4の各サンプルのバッファ層の組成について、XPSを用いて測定したところ、図7(b)のグラフに示すように、到達真空度を2.0×10−5Paとした条件下でバッファ層が形成されたNo.1のサンプルは、酸素濃度が1%であることが確認できた。これに対し、到達真空度がそれぞれ3.1×10−5Pa、5.1×10−5Pa、1.5×10−4Paの条件とされたNo.2〜4の各サンプルは、何れもバッファ層中の酸素濃度が2%以上であり、No.1のサンプルに比べて酸素濃度が高くなっていることが確認された。 And said No .. About each sample of 1-4, when the X-ray rocking curve (XRC) of the buffer layer formed on the board | substrate was measured using the method similar to Example 1, XRC half value width was No. 1: respectively. They were 10 arcsec, No. 2: 12 arcsec, No. 3: 33 arcsec, and No. 4: 39 arcsec. No. About the composition of the buffer layer of each sample of 1-4, when it measured using XPS, as shown to the graph of FIG.7 (b), the ultimate vacuum degree was set to 2.0x10 < -5 > Pa. It was confirmed that the sample No. 1 in which the buffer layer was formed had an oxygen concentration of 1%. On the other hand, each sample of No. 2-4 in which the ultimate vacuum was 3.1 × 10 −5 Pa, 5.1 × 10 −5 Pa, and 1.5 × 10 −4 Pa, respectively, In any case, the oxygen concentration in the buffer layer was 2% or more, and it was confirmed that the oxygen concentration was higher than that of the No. 1 sample.

上記結果のように、真空ポンプによってチャンバ内を吸引して不純物を除去する際、ダミー放電を約16回(ラン)の回数で行なうことにより、チャンバ内の到達真空度が2.0×10−5Paに達し、基板上に成膜されるバッファ層中の酸素濃度を1%以下に抑制することが可能となることが明らかとなった。 As shown in the above result, when the impurities are removed by suctioning the inside of the chamber with a vacuum pump, the ultimate vacuum in the chamber is 2.0 × 10 by performing dummy discharge about 16 times (run). It reached 5 Pa, and it became clear that the oxygen concentration in the buffer layer formed on the substrate can be suppressed to 1% or less.

以上の結果により、本発明に係るIII族窒化物半導体発光素子の製造方法が、生産性に優れるとともに、優れた発光特性を備えるIII族窒化物半導体発光素子を製造することが可能であることが明らかである。   Based on the above results, the method for producing a group III nitride semiconductor light-emitting device according to the present invention is excellent in productivity and is capable of producing a group III nitride semiconductor light-emitting device having excellent light emission characteristics. it is obvious.

1…III族窒化物半導体発光素子、10…積層半導体、11…基板、11a…表面、12…バッファ層、14…n型半導体層、14a…下地層、15…発光層、16…p型半導体層(III族窒化物半導体)、16a…p型クラッド層、16b…p型コンタクト層、3…ランプ、40…スパッタ装置、41…チャンバ DESCRIPTION OF SYMBOLS 1 ... Group III nitride semiconductor light-emitting device, 10 ... Multilayer semiconductor, 11 ... Substrate, 11a ... Surface, 12 ... Buffer layer, 14 ... N-type semiconductor layer, 14a ... Underlayer, 15 ... Light emitting layer, 16 ... P-type semiconductor Layer (Group III nitride semiconductor), 16a ... p-type cladding layer, 16b ... p-type contact layer, 3 ... lamp, 40 ... sputtering device, 41 ... chamber

Claims (3)

サファイアからなる基板上に、少なくともIII族窒化物化合物からなるバッファ層を積層し、該バッファ層上に、n型半導体層、発光層及びp型半導体層を順次積層するIII族窒化物半導体発光素子の製造方法であって、
スパッタ装置のチャンバ内において、基板加熱用の設定温度をバッファ層の成膜温度と同じかそれ以上としてダミー放電を行ない、その後、スパッタ装置のチャンバ内の到達真空度を2×10−5Pa以下の条件として、金属Al原料と窒素元素を含んだガスとを用いた反応性スパッタ法を用いて、バッファ層をAlNから形成することを特徴とするIII族窒化物半導体発光素子の製造方法。
A group III nitride semiconductor light emitting device in which a buffer layer made of at least a group III nitride compound is stacked on a substrate made of sapphire, and an n-type semiconductor layer, a light emitting layer, and a p type semiconductor layer are sequentially stacked on the buffer layer. A manufacturing method of
In the chamber of the sputtering apparatus, dummy discharge is performed with the set temperature for substrate heating equal to or higher than the film formation temperature of the buffer layer, and then the ultimate vacuum in the chamber of the sputtering apparatus is 2 × 10 −5 Pa or less. The method of manufacturing a group III nitride semiconductor light-emitting device, characterized in that the buffer layer is formed of AlN using a reactive sputtering method using a metal Al raw material and a gas containing a nitrogen element.
前記バッファ層を、RFスパッタ法によって形成することを特徴とする請求項1に記載のIII族窒化物半導体発光素子の製造方法。   The method for manufacturing a group III nitride semiconductor light-emitting device according to claim 1, wherein the buffer layer is formed by an RF sputtering method. 前記バッファ層を、前記基板の温度を400〜800℃の範囲として形成することを特徴とする請求項1または2に記載のIII族窒化物半導体発光素子の製造方法。   3. The method for producing a group III nitride semiconductor light-emitting device according to claim 1, wherein the buffer layer is formed at a temperature of the substrate in a range of 400 to 800 ° C. 4.
JP2011002985A 2011-01-11 2011-01-11 Method of manufacturing group iii nitride semiconductor light emitting device Pending JP2011082570A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2011002985A JP2011082570A (en) 2011-01-11 2011-01-11 Method of manufacturing group iii nitride semiconductor light emitting device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2011002985A JP2011082570A (en) 2011-01-11 2011-01-11 Method of manufacturing group iii nitride semiconductor light emitting device

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP2007251478A Division JP2009081406A (en) 2007-09-27 2007-09-27 Group iii nitride semiconductor light-emitting device, method for manufacturing thereof, and lamp

Publications (1)

Publication Number Publication Date
JP2011082570A true JP2011082570A (en) 2011-04-21

Family

ID=44076226

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2011002985A Pending JP2011082570A (en) 2011-01-11 2011-01-11 Method of manufacturing group iii nitride semiconductor light emitting device

Country Status (1)

Country Link
JP (1) JP2011082570A (en)

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2014141601A1 (en) * 2013-03-14 2014-09-18 キヤノンアネルバ株式会社 Film formation method, method for manufacturing semiconductor light-emitting element, semiconductor light-emitting element, and lighting apparatus
JP2014528178A (en) * 2011-09-30 2014-10-23 オスラム オプト セミコンダクターズ ゲゼルシャフト ミット ベシュレンクテル ハフツングOsram Opto Semiconductors GmbH Optoelectronic semiconductor chip manufacturing method and corresponding optoelectronic semiconductor chip
JP2015207618A (en) * 2014-04-18 2015-11-19 古河機械金属株式会社 Nitride semiconductor substrate, nitride semiconductor device, nitride semiconductor substrate manufacturing method and nitride semiconductor device manufacturing method
US9343615B2 (en) 2011-09-30 2016-05-17 Osram Opto Semiconductors Gmbh Method for producing an optoelectronic semiconductor chip and optoelectronic semiconductor chip
WO2017221863A1 (en) * 2016-06-24 2017-12-28 スタンレー電気株式会社 Group iii nitride laminate and vertical semiconductor device provided with said laminate
JP2020061526A (en) * 2018-10-12 2020-04-16 株式会社小糸製作所 Substrate for semiconductor growth, semiconductor element, semiconductor light-emitting element, and method of manufacturing semiconductor element
JP2020061510A (en) * 2018-10-12 2020-04-16 株式会社小糸製作所 Substrate for semiconductor growth, semiconductor element, semiconductor light-emitting element, and method of manufacturing semiconductor element
JP2020070221A (en) * 2018-11-02 2020-05-07 株式会社小糸製作所 Substrate for growing semiconductor, semiconductor device, semiconductor light-emitting device and manufacturing method of substrate for growing semiconductor

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6039819A (en) * 1983-08-12 1985-03-01 Nippon Telegr & Teleph Corp <Ntt> Manufacture of compound semiconductor thin film
JPS60173829A (en) * 1984-02-14 1985-09-07 Nippon Telegr & Teleph Corp <Ntt> Growing method of compound semiconductor thin-film
JPH11200031A (en) * 1997-12-25 1999-07-27 Applied Materials Inc Sputtering device and high speed evacuating method therefor
JP2001094150A (en) * 1999-09-21 2001-04-06 Toyoda Gosei Co Ltd Group iii nitride compound semiconductor element
JP2001308010A (en) * 2000-04-21 2001-11-02 Toyoda Gosei Co Ltd Method of manufacturing iii nitride compound semiconductor device

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6039819A (en) * 1983-08-12 1985-03-01 Nippon Telegr & Teleph Corp <Ntt> Manufacture of compound semiconductor thin film
JPS60173829A (en) * 1984-02-14 1985-09-07 Nippon Telegr & Teleph Corp <Ntt> Growing method of compound semiconductor thin-film
JPH11200031A (en) * 1997-12-25 1999-07-27 Applied Materials Inc Sputtering device and high speed evacuating method therefor
JP2001094150A (en) * 1999-09-21 2001-04-06 Toyoda Gosei Co Ltd Group iii nitride compound semiconductor element
JP2001308010A (en) * 2000-04-21 2001-11-02 Toyoda Gosei Co Ltd Method of manufacturing iii nitride compound semiconductor device

Cited By (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9343615B2 (en) 2011-09-30 2016-05-17 Osram Opto Semiconductors Gmbh Method for producing an optoelectronic semiconductor chip and optoelectronic semiconductor chip
JP2014528178A (en) * 2011-09-30 2014-10-23 オスラム オプト セミコンダクターズ ゲゼルシャフト ミット ベシュレンクテル ハフツングOsram Opto Semiconductors GmbH Optoelectronic semiconductor chip manufacturing method and corresponding optoelectronic semiconductor chip
US9647174B2 (en) 2011-09-30 2017-05-09 Osram Opto Semiconductors Gmbh Optoelectronic semiconductor chip
US10224463B2 (en) 2013-03-14 2019-03-05 Canon Anelva Corporation Film forming method, method of manufacturing semiconductor light-emitting device, semiconductor light-emitting device, and illuminating device
TWI601309B (en) * 2013-03-14 2017-10-01 Canon Anelva Corp Film-forming method, semiconductor light-emitting device manufacturing method, semiconductor light-emitting device, lighting device
WO2014141601A1 (en) * 2013-03-14 2014-09-18 キヤノンアネルバ株式会社 Film formation method, method for manufacturing semiconductor light-emitting element, semiconductor light-emitting element, and lighting apparatus
JP6063035B2 (en) * 2013-03-14 2017-01-18 キヤノンアネルバ株式会社 Film forming method, semiconductor light emitting device manufacturing method, semiconductor light emitting device, and lighting device
DE112014001272B4 (en) 2013-03-14 2023-03-30 Canon Anelva Corporation Layer forming method, method of manufacturing a semiconductor light-emitting device, semiconductor light-emitting device and lighting device
JP2015207618A (en) * 2014-04-18 2015-11-19 古河機械金属株式会社 Nitride semiconductor substrate, nitride semiconductor device, nitride semiconductor substrate manufacturing method and nitride semiconductor device manufacturing method
US10731274B2 (en) 2016-06-24 2020-08-04 Stanley Electric Co., Ltd. Group III nitride laminate and vertical semiconductor device having the laminate
WO2017221863A1 (en) * 2016-06-24 2017-12-28 スタンレー電気株式会社 Group iii nitride laminate and vertical semiconductor device provided with said laminate
JPWO2017221863A1 (en) * 2016-06-24 2019-04-11 スタンレー電気株式会社 Group III nitride laminate and vertical semiconductor device including the laminate
JP2020061526A (en) * 2018-10-12 2020-04-16 株式会社小糸製作所 Substrate for semiconductor growth, semiconductor element, semiconductor light-emitting element, and method of manufacturing semiconductor element
WO2020075852A1 (en) * 2018-10-12 2020-04-16 株式会社小糸製作所 Substrate for semiconductor growth, semiconductor element, semiconductor light-emitting element, and method for producing semiconductor light-emitting element
JP2020061510A (en) * 2018-10-12 2020-04-16 株式会社小糸製作所 Substrate for semiconductor growth, semiconductor element, semiconductor light-emitting element, and method of manufacturing semiconductor element
JP2020070221A (en) * 2018-11-02 2020-05-07 株式会社小糸製作所 Substrate for growing semiconductor, semiconductor device, semiconductor light-emitting device and manufacturing method of substrate for growing semiconductor
WO2020090814A1 (en) * 2018-11-02 2020-05-07 株式会社小糸製作所 Substrate for semiconductor growth, semiconductor element, semiconductor light emitting element and method for producing substrate for semiconductor growth
JP7350477B2 (en) 2018-11-02 2023-09-26 株式会社小糸製作所 Method for manufacturing semiconductor growth substrate, semiconductor element, semiconductor light emitting device, and semiconductor growth substrate

Similar Documents

Publication Publication Date Title
JP5246219B2 (en) Group III nitride semiconductor device manufacturing method and group III nitride semiconductor light emitting device manufacturing method
KR101067122B1 (en) Method of manufacturing group III nitride semiconductor, method of manufacturing group III nitride semiconductor light emitting device and group III nitride semiconductor light emitting device, and lamp
JP2009081406A (en) Group iii nitride semiconductor light-emitting device, method for manufacturing thereof, and lamp
JP4191227B2 (en) Group III nitride semiconductor light emitting device manufacturing method, group III nitride semiconductor light emitting device, and lamp
JP5471440B2 (en) Group III nitride semiconductor light emitting device manufacturing method
TWI491064B (en) Group iii nitride semiconductor light emitting device, process for producing the same, and lamp
KR101074178B1 (en) Method for manufacturing group ⅲ nitride compound semiconductor light-emitting device, group ⅲ nitride compound semiconductor light-emitting device, and lamp
WO2009148075A1 (en) Method for manufacturing iii nitride semiconductor light emitting element, iii nitride semiconductor light emitting element and lamp
JP5049659B2 (en) Group III nitride semiconductor manufacturing method, group III nitride semiconductor light emitting device manufacturing method, group III nitride semiconductor light emitting device, and lamp
JP2009277882A (en) Method of manufacturing group iii nitride semiconductor light emitting element, group iii nitride semiconductor light emitting element, and lamp
JP2008177525A (en) Method for manufacturing group iii nitride compound semiconductor light-emitting element, the group iii nitride compound semiconductor light-emitting element and lamp
JPWO2010032423A1 (en) Method for manufacturing group III nitride semiconductor light emitting device, group III nitride semiconductor light emitting device and lamp, and method for reducing variation in emission wavelength distribution of group III nitride semiconductor light emitting device wafer
JP2011082570A (en) Method of manufacturing group iii nitride semiconductor light emitting device
JP2008124060A (en) Group iii nitride compound semiconductor light-emitting element and manufacturing method thereof, and lamp
JP2009215628A (en) Method for manufacturing group iii nitride semiconductor layer, method for manufacturing group iii nitride semiconductor light-emitting element, group iii nitride semiconductor light-emitting element, and lamp
JP2008047762A (en) Group iii nitride compound semiconductor light emitting element, process for fabricating the same, and lamp
JP2008135463A (en) Manufacturing method of group iii nitride semiconductor, manufacturing method of group iii nitride semiconductor light-emitting element, group iii nitride semiconductor light-emitting element and lamp
JP2008106316A (en) Method for manufacturing group iii nitride compound semiconductor light-emitting device, group iii nitride compound semiconductor light-emitting device, and lamp
JP2009161434A (en) Method for manufacturing group iii nitride semiconductor crystal and group iii nitride semiconductor crystal
JP2008294449A (en) Method for manufacturing group iii nitride semiconductor light emitting element, group iii nitride semiconductor light emitting element and lamp
JP2009155672A (en) Method for manufacturing group-iii nitride semiconductor, method for manufacturing light-emitting device of group-iii nitride semiconductor, apparatus for manufacturing group-iii nitride semiconductor, group-iii nitride semiconductor and light-emitting device of group-iii nitride semiconductor, and lamp
JP5179055B2 (en) Group III nitride semiconductor manufacturing method, group III nitride semiconductor light emitting device manufacturing method, group III nitride semiconductor light emitting device, and lamp
JP5156305B2 (en) Group III nitride compound semiconductor light emitting device manufacturing apparatus and group III nitride compound semiconductor light emitting device manufacturing method
JP2008159954A (en) Manufacturing method of group iii nitride semiconductor, manufacturing method of group iii nitride semiconductor light-emitting element, group iii nitride semiconductor light-emitting element and lamp
JP2008198705A (en) Method for manufacturing group iii nitride semiconductor light-emitting device, group iii nitride semiconductor light-emitting device, and lamp

Legal Events

Date Code Title Description
A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20121024

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20121030

A711 Notification of change in applicant

Free format text: JAPANESE INTERMEDIATE CODE: A711

Effective date: 20130206

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20130312