JP2011028543A5 - 情報処理システム - Google Patents
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Claims (1)
- プログラムに応じた情報処理を行う情報処理システムであって、
第1の入力値と第2の入力値とに対して第1の演算を行う第1の演算器と、前記第1の入力値と前記第2の入力値とに対して第2の演算を行う第2の演算器と、前記第1の演算器が出力する第1の出力値と前記第2の演算器が出力する第2の出力値とのいずれか一方を選択信号に基づき選択して出力するセレクタと、をそれぞれ含む複数の演算ユニットを有する実行ユニットと、
演算命令をデコードして前記演算ユニット毎の前記選択信号の値を決定するデコーダと、を有し、
前記デコーダは、プログラム毎に前記演算命令に対応する前記選択信号の値を決定する情報処理システム。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009174187A JP2011028543A (ja) | 2009-07-27 | 2009-07-27 | 情報処理システム及びその情報処理方法 |
US12/795,251 US20110022823A1 (en) | 2009-07-27 | 2010-06-07 | Information processing system and information processing method thereof |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009174187A JP2011028543A (ja) | 2009-07-27 | 2009-07-27 | 情報処理システム及びその情報処理方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2011028543A JP2011028543A (ja) | 2011-02-10 |
JP2011028543A5 true JP2011028543A5 (ja) | 2012-04-05 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2009174187A Pending JP2011028543A (ja) | 2009-07-27 | 2009-07-27 | 情報処理システム及びその情報処理方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US20110022823A1 (ja) |
JP (1) | JP2011028543A (ja) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10612371B2 (en) * | 2015-04-21 | 2020-04-07 | Halliburton Energy Services, Inc. | Partially reflective materials and coatings for optical communication in a wellbore |
EP3686735B1 (en) | 2015-12-28 | 2022-05-04 | Coherent Logix, Inc. | Processor instructions to accelerate fec encoding and decoding |
TWI779772B (zh) * | 2021-08-13 | 2022-10-01 | 瑞昱半導體股份有限公司 | 訊號處理方法以及訊號處理器 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0830577A (ja) * | 1994-07-15 | 1996-02-02 | Mitsubishi Electric Corp | Simdプロセッサ |
US6138229A (en) * | 1998-05-29 | 2000-10-24 | Motorola, Inc. | Customizable instruction set processor with non-configurable/configurable decoding units and non-configurable/configurable execution units |
WO2002050665A1 (en) * | 2000-12-20 | 2002-06-27 | Koninklijke Philips Electronics N.V. | Data processing device with a configurable functional unit |
JP3856737B2 (ja) * | 2002-07-19 | 2006-12-13 | 株式会社ルネサステクノロジ | データ処理装置 |
US7949856B2 (en) * | 2004-03-31 | 2011-05-24 | Icera Inc. | Method and apparatus for separate control processing and data path processing in a dual path processor with a shared load/store unit |
JP2007004475A (ja) * | 2005-06-23 | 2007-01-11 | Fujitsu Ltd | プロセッサ及びプログラム実行方法 |
JPWO2010067522A1 (ja) * | 2008-12-11 | 2012-05-17 | 日本電気株式会社 | 演算ユニット、プロセッサ及び並列演算方法 |
-
2009
- 2009-07-27 JP JP2009174187A patent/JP2011028543A/ja active Pending
-
2010
- 2010-06-07 US US12/795,251 patent/US20110022823A1/en not_active Abandoned
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