JP2009503764A - 不揮発性メモリを自己調整式の最大プログラムループでプログラムする方法 - Google Patents
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Abstract
Description
Claims (28)
- 不揮発性記憶装置をプログラムする方法であって、
連続する電圧パルスを用いて、少なくとも第1の不揮発性記憶素子を第1検証レベルに到達するようにプログラムするステップと、
前記少なくとも第1の不揮発性記憶素子が、いつ第1検証レベルに到達したかを検出するステップと、
その検出に応答して、少なくとも第2の不揮発性記憶素子を第2検証レベルに到達するようにプログラムするときの追加電圧パルスの最大許容数を決定するステップ、
を有していることを特徴とする方法。 - (a)前記少なくとも第1の不揮発性記憶素子を第1検証レベルに到達させるのに必要な電圧パルスの数と、(b)追加電圧パルスの最大許容数、との和に基づいて追加電圧パルスの最大許容数を決定することを特徴とする請求項1に記載の方法。
- 前記少なくとも第1の不揮発性記憶素子を第1検証レベルに到達させるのに必要な電圧パルスの数に基づいて、追加電圧パルスの最大許容数を変更可能であることを特徴とする請求項1に記載の方法。
- 追加電圧パルスの最大許容数が固定されていることを特徴とする請求項1に記載の方法。
- 追加電圧パルスの最大許容数が変更可能であることを特徴とする請求項1に記載の方法。
- 時間の経過にしたがって前記少なくとも第1の不揮発性記憶素子の使用状況を追跡するステップをさらに有し、
その使用状況に基づいて、追加電圧パルスの最大許容数を変更可能であることを特徴とする請求項1に記載の方法。 - 前記使用状況を追跡するステップが、プログラミングサイクルのカウント値を維持するステップを有していることを特徴とする請求項6に記載の方法。
- 前記少なくとも第1の不揮発性記憶素子が、前記連続する電圧パルスによって第1検証レベルにプログラムされる複数の不揮発性記憶素子を有しており、
前記複数の不揮発性記憶素子の各々を第1検証レベルに到達させるのに必要な電圧パルスの数を特定するステップと、
前記複数の不揮発性記憶素子の各々を第1検証レベルに到達させるのに必要な電圧パルスの数に基づいて、前記少なくとも第2の不揮発性記憶素子を第2検証レベルに到達するようにプログラムするときの追加電圧パルスの最大許容数を決定するステップ、
をさらに有していることを特徴とする請求項1に記載の方法。 - 少なくとも第2の不揮発性記憶素子を第2検証レベルに到達するようにプログラムするときの追加電圧パルスの最大許容数を、前記複数の不揮発性記憶素子の各々を第1検証レベルに到達させるのに必要な電圧パルスの数から導き出される統計的基準値に基づいて決定することを特徴とする請求項8に記載の方法。
- 前記少なくとも第1の不揮発性記憶素子と前記少なくとも第2の不揮発性記憶素子を共通のプログラミングサイクルでプログラムすることを特徴とする請求項1に記載の方法。
- 前記少なくとも第2の不揮発性記憶素子を、前記少なくとも第1の不揮発性記憶素子をプログラムするプログラミングサイクルの後のプログラミングサイクルでプログラムすることを特徴とする請求項1に記載の方法。
- 追加電圧パルスの最大許容数が、前記少なくとも第1の不揮発性記憶素子の閾値電圧分布を電圧パルスのステップサイズで除算した値に基づくことを特徴とする請求項1に記載の方法。
- 前記少なくとも第1の不揮発性記憶素子と前記少なくとも第2の不揮発性記憶素子が、共通のブロックと共通のセグメントのうちの少なくとも一方で提供されることを特徴とする請求項1に記載の方法。
- 前記少なくとも第1の不揮発性記憶素子と前記少なくとも第2の不揮発性記憶素子が、共通のページからのデータでプログラムされることを特徴とする請求項1に記載の方法。
- 第1検証レベルと第2検証レベルのうちの少なくとも一方が、最終電圧レベル前の中間電圧レベルであることを特徴とする請求項1に記載の方法。
- 第1検証レベルと第2検証レベルのうちの少なくとも一方が、最終電圧レベルであることを特徴とする請求項1に記載の方法。
- 不揮発性記憶システムであって、
少なくとも第1の不揮発性記憶素子および少なくとも第2の不揮発性記憶素子と、
前記少なくとも第1の不揮発性記憶素子および前記少なくとも第2の不揮発性記憶素子と通信する1つ以上の管理回路を備えており、
その1つ以上の管理回路が、
データをプログラムする要求を受信し、
その要求に応答して、連続する電圧パルスを用いて、前記少なくとも第1の不揮発性記憶素子を第1検証レベルに到達するようにプログラムし、
前記少なくとも第1の不揮発性記憶素子が、いつ第1検証レベルに到達したかを検出し、
その検出に応答して、前記少なくとも第2の不揮発性記憶素子を第2検証レベルに到達するようにプログラムするときの追加電圧パルスの最大許容数を決定する、
ことを特徴とする不揮発性記憶システム。 - 前記1つ以上の管理回路が、(a)前記少なくとも第1の不揮発性記憶素子を第1検証レベルに到達させるのに必要な電圧パルスの数と、(b)追加電圧パルスの最大許容数、との和に基づいて追加電圧パルスの最大許容数を決定することを特徴とする請求項17に記載の不揮発性記憶システム。
- 前記少なくとも第1の不揮発性記憶素子を第1検証レベルに到達させるのに必要な電圧パルスの数に基づいて、追加電圧パルスの最大許容数を変更可能であることを特徴とする請求項17に記載の不揮発性記憶システム。
- 追加電圧パルスの最大許容数が固定されていることを特徴とする請求項17に記載の不揮発性記憶システム。
- 追加電圧パルスの最大許容数が変更可能であることを特徴とする請求項17に記載の不揮発性記憶システム。
- 前記1つ以上の管理回路が、
前記要求に応答して、連続する電圧パルスを用いて複数の不揮発性記憶素子を第1検証レベルに到達するようにプログラムし、
前記複数の不揮発性記憶素子の各々を第1検証レベルに到達させるのに必要な電圧パルスの数を特定し、
前記複数の不揮発性記憶素子の各々を第1検証レベルに到達させるのに必要な電圧パルスの数に基づいて、前記少なくとも第2の不揮発性記憶素子を第2検証レベルに到達するようにプログラミングするときの追加電圧パルスの最大許容数を決定する、
ことを特徴とする請求項17に記載の不揮発性記憶システム。 - 前記少なくとも第1の不揮発性記憶素子と前記少なくとも第2の不揮発性記憶素子を共通のプログラミングサイクルでプログラムすることを特徴とする請求項17に記載の不揮発性記憶システム。
- 前記少なくとも第2の不揮発性記憶素子が、前記少なくとも第1の不揮発性記憶素子をプログラムするプログラミングサイクルの後のプログラミングサイクルでプログラムすることを特徴とする請求項17に記載の不揮発性記憶システム。
- 前記少なくとも第1の不揮発性記憶素子と前記少なくとも第2の不揮発性記憶素子が、共通のブロックと共通のセグメントのうちの少なくとも一方で提供されることを特徴とする請求項17に記載の不揮発性記憶システム。
- 前記少なくとも第1の不揮発性記憶素子と前記少なくとも第2の不揮発性記憶素子が、共通のページからのデータでプログラムされることを特徴とする請求項17に記載の不揮発性記憶システム。
- 第1検証レベルと第2検証レベルのうちの少なくとも一方が、最終電圧レベル前の中間電圧レベルであることを特徴とする請求項17に記載の不揮発性記憶システム。
- 第1検証レベルと第2検証レベルのうちの少なくとも一方が、最終電圧レベルであることを特徴とする請求項17に記載の不揮発性記憶システム。
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Cited By (1)
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---|---|---|---|---|
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Families Citing this family (20)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7894269B2 (en) | 2006-07-20 | 2011-02-22 | Sandisk Corporation | Nonvolatile memory and method for compensating during programming for perturbing charges of neighboring cells |
US7652929B2 (en) * | 2007-09-17 | 2010-01-26 | Sandisk Corporation | Non-volatile memory and method for biasing adjacent word line for verify during programming |
US8416609B2 (en) | 2010-02-15 | 2013-04-09 | Micron Technology, Inc. | Cross-point memory cells, non-volatile memory arrays, methods of reading a memory cell, methods of programming a memory cell, methods of writing to and reading from a memory cell, and computer systems |
US8514630B2 (en) | 2010-07-09 | 2013-08-20 | Sandisk Technologies Inc. | Detection of word-line leakage in memory arrays: current based approach |
US8379454B2 (en) * | 2011-05-05 | 2013-02-19 | Sandisk Technologies Inc. | Detection of broken word-lines in memory arrays |
US8750042B2 (en) | 2011-07-28 | 2014-06-10 | Sandisk Technologies Inc. | Combined simultaneous sensing of multiple wordlines in a post-write read (PWR) and detection of NAND failures |
US8730722B2 (en) | 2012-03-02 | 2014-05-20 | Sandisk Technologies Inc. | Saving of data in cases of word-line to word-line short in memory arrays |
US8842477B2 (en) * | 2012-06-01 | 2014-09-23 | Spansion Llc | Method, apparatus, and manufacture for flash memory adaptive algorithm |
CN103631529A (zh) * | 2012-08-21 | 2014-03-12 | 群联电子股份有限公司 | 数据写入方法、存储器控制器与存储器存储装置 |
US9082510B2 (en) * | 2012-09-14 | 2015-07-14 | Freescale Semiconductor, Inc. | Non-volatile memory (NVM) with adaptive write operations |
KR102118979B1 (ko) | 2013-09-13 | 2020-06-05 | 삼성전자주식회사 | 불휘발성 메모리 장치 및 그것의 프로그램 방법 |
US9165683B2 (en) | 2013-09-23 | 2015-10-20 | Sandisk Technologies Inc. | Multi-word line erratic programming detection |
US9484086B2 (en) | 2014-07-10 | 2016-11-01 | Sandisk Technologies Llc | Determination of word line to local source line shorts |
US9460809B2 (en) | 2014-07-10 | 2016-10-04 | Sandisk Technologies Llc | AC stress mode to screen out word line to word line shorts |
US9514835B2 (en) | 2014-07-10 | 2016-12-06 | Sandisk Technologies Llc | Determination of word line to word line shorts between adjacent blocks |
US9443612B2 (en) | 2014-07-10 | 2016-09-13 | Sandisk Technologies Llc | Determination of bit line to low voltage signal shorts |
US9202593B1 (en) | 2014-09-02 | 2015-12-01 | Sandisk Technologies Inc. | Techniques for detecting broken word lines in non-volatile memories |
US9240249B1 (en) | 2014-09-02 | 2016-01-19 | Sandisk Technologies Inc. | AC stress methods to screen out bit line defects |
US9449694B2 (en) | 2014-09-04 | 2016-09-20 | Sandisk Technologies Llc | Non-volatile memory with multi-word line select for defect detection operations |
US9659666B2 (en) | 2015-08-31 | 2017-05-23 | Sandisk Technologies Llc | Dynamic memory recovery at the sub-block level |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0628899A (ja) * | 1992-03-27 | 1994-02-04 | Toshiba Corp | 不揮発性半導体記憶装置 |
JPH07182899A (ja) * | 1993-12-22 | 1995-07-21 | Nec Corp | 半導体記憶装置 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6000843A (en) * | 1992-07-03 | 1999-12-14 | Nippon Steel Corporation | Electrically alterable nonvolatile semiconductor memory |
JP4129170B2 (ja) * | 2002-12-05 | 2008-08-06 | シャープ株式会社 | 半導体記憶装置及びメモリセルの記憶データ補正方法 |
US7073103B2 (en) * | 2002-12-05 | 2006-07-04 | Sandisk Corporation | Smart verify for multi-state memories |
US7177199B2 (en) * | 2003-10-20 | 2007-02-13 | Sandisk Corporation | Behavior based programming of non-volatile memory |
US6888758B1 (en) * | 2004-01-21 | 2005-05-03 | Sandisk Corporation | Programming non-volatile memory |
-
2006
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Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0628899A (ja) * | 1992-03-27 | 1994-02-04 | Toshiba Corp | 不揮発性半導体記憶装置 |
JPH07182899A (ja) * | 1993-12-22 | 1995-07-21 | Nec Corp | 半導体記憶装置 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011524062A (ja) * | 2008-06-12 | 2011-08-25 | サンディスク コーポレイション | インデックスプログラミングおよび削減されたベリファイを有する不揮発性メモリおよび方法 |
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