JP2009112010A - データ処理装置及び方法 - Google Patents
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Abstract
【解決手段】データ処理装置は、送信する入力データシンボルを、OFDMシンボルの所定の数のサブキャリア信号にマッピングする。データシンボルがサブキャリア信号にインタリーブされる。アドレスのセットは、アドレス生成部によって規定される。アドレス生成部は、線形フィードバックシフトレジスタと、置換回路とを有する。線形フィードバックシフトレジスタのための生成多項式及び置換コードが、レジスタステージのコンテンツの順序を置換するために提供される。置換コードは、典型的な無線チャネルを介した通信性能を最適化するためのシミュレーション分析によって確立される。1K動作モードに、インタリーバが提供される。DVB−T2等のDVB規格を含む、約1000のサブキャリア信号にインタリーブできる。
【選択図】図5
Description
例えば、新たな1Kモードを生成するために、いくつかの要素が定義されるべきであり、そのうちの1つは1Kシンボルインタリーバ33である。図2において、ビットコンステレーションマッピング部28、シンボルインタリーバ33及びフレームビルダ32が、より詳細に示される。
図3は、シンボルをインタリーブするための本発明の実施形態の技術を説明する、シンボルインタリーバ33の部分の一例を提供する。図3では、フレームビルダ32からの入力データセルがインタリーバメモリ100に書き込まれる。データセルは、アドレス生成部102によりチャネル104を介して供給された書き込みアドレスに従って、インタリーバメモリ100に書き込まれ、アドレス生成部102によりチャネル106を介して供給された読み出しアドレスに従って、インタリーバメモリ100から読み出される。アドレス生成部102は、以下に説明するように、COFDMシンボルが奇数であるか偶数であるかに応じて、書き込みアドレス及び読み出しアドレスを生成する。COFDMシンボルが奇数であるか偶数であるかは、チャネル108から供給された信号により、選択されたモードに応じて識別される。選択されたモードは、チャネル110から供給された信号により識別される。上述のように、モードは、1Kモード、2Kモード、4Kモード、8Kモード、16Kモード、32Kモードのうちの1つであり得る。インタリーバメモリ100の例示的な実施態様を提供する図4を参照して以下に説明するように、書き込みアドレス及び読み出しアドレスは、奇数OFDMシンボルと偶数OFDMシンボルとについて別々に生成される。
偶数シンボルの場合:yH(q)=y’q(q=0,…,Nmax−1)
奇数シンボルの場合:yq=y’H(q)(q=0,…,Nmax−1)
1Kモードにおける置換関数H(q)の生成に用いられるアルゴリズムの概略ブロック図が、図5に示される。
上記で説明した、1Kモードにおけるアドレス生成部102のための生成多項式及び置換コードの選択は、以下のインタリーバの相対的な性能のシミュレーション分析によって確認される。インタリーバの相対的な性能は、連続したシンボルを分離するインタリーバの相対的な能力、すなわち「インタリーブ品質」を用いて評価されてきた。上述のように、単一のインタリーバメモリを用いるためには、インタリーブを奇数シンボル及び偶数シンボルの両方に対して効果的に実行しなければならない。インタリーバ品質の相対的な測定値は、(複数のサブキャリアにおける)距離Dを定義することによって求められる。インタリーバの入力において距離≦Dであり、インタリーバの出力において距離≧Dであるサブキャリアの数を特定するために、以下の式に示す基準Cが選択される。その後、各距離Dについてのサブキャリアの数は、その相対的な距離に関して重み付けされる。基準Cは、奇数COFDMシンボル及び偶数COFDMシンボルの両方において評価される。Cを最小とすることにより、優れた品質のインタリーバが実現される。
上記で特定した基準Cによって判断される、良好な品質を有するシンボルインタリーバを提供するために、以下の10個のコード([n]Riビット位置、n=1〜10)が設定された。
図7は、本発明の実施形態の技術と共に用いることができる受信装置の例を説明するための図である。図7に示すように、COFDM信号は、アンテナ300によって受信され、チューナ302によって復調され、アナログ−ディジタル変換部304によってディジタル形式に変換される。ガードインターバル除去処理部306は、周知の技術により、高速フーリエ変換(Fast Fourier Transform:FFT)処理部308をチャネル推定/補正処理部310と共に用いて、埋込−信号復号部311と協働して、受信されたCOFDMシンボルからデータが再生される前に、COFDMシンボルからガードインターバルを除去する。復調されたデータは、マッピング部312から再生され、シンボルデインタリーバ314に供給される。シンボルデインタリーバ314は、受信したデータシンボルを逆マッピングして、デインタリーブされたデータを有する出力データストリームを再生成するように動作する。
図4に示すように、2つのシンボルインタリーブ処理により、インタリーブ中に用いられるメモリの量を低減することができる。2つのシンボルインタリーブ処理のうち1つは偶数COFDMシンボルのための処理であり、もう1つは奇数COFDMシンボルのための処理である。図4に示す例において、奇数シンボルの書き込み順序は、偶数シンボルの読み出し順序と同じである。したがって、奇数シンボルがメモリから読み出されるときに、偶数シンボルを当該読み出された場所に書き込むことができ、その後、偶数シンボルがメモリから読み出されると、奇数シンボルを当該読み出された場所に書き込むことができる。
単一の奇数のみのインタリーバではなく、奇数のみのインタリーバのシーケンスを用いることにより、2つの奇数インタリーバを用いるインタリーバの性能をさらに向上させることができる。これは、インタリーバに入力されるあらゆるデータビットが常に同じOFDMシンボルのサブキャリアを変調してしまうことがなくなるからである
・データキャリアの数を法として、インタリーバアドレスにオフセットを追加すること、又は
・インタリーバにおいて置換コードのシーケンスを用いること
データキャリアの数を法として、インタリーバアドレスにオフセットを追加することにより、OFDMシンボルが効果的にシフト及びラップラウンドされるので、インタリーバに入力されるあらゆるデータビットが、常に同じOFDMシンボルのキャリアを変調するわけではなくなる。したがって、アドレス生成部は、オプションとして、出力チャネルH(q)上でアドレス生成部により生成されたアドレスにおいてオフセットを生成するオフセット生成部を有してもよい。
0、41、97、157
であってもよい。
図5に示すように、制御線111は、アドレス生成部102の制御部224から置換回路210に延びている。上述のように、一実施形態では、アドレス生成部は、連続したOFDMシンボルに対し、置換コードのセットからの異なる置換コードを適用することができる。インタリーバのアドレス生成部において置換コードのシーケンスを用いることにより、インタリーバに入力されるあらゆるデータビットが、OFDMシンボルにおいて常に同じサブキャリアを変調してしまう可能性が低減する。
8 4 3 2 0 11 1 5 12 10 6 7 9
7 9 5 3 11 1 4 0 2 12 10 8 6
8 4 3 2 0 11 1 5 12 10 6 7 9
7 9 5 3 11 1 4 0 2 12 10 8 6
6 11 7 5 2 3 0 1 10 8 12 9 4
5 12 9 0 3 10 2 4 6 7 8 11 1
4 3 2 1 0 5 6 7 8
3 2 5 0 1 4 7 8 6
4 3 2 1 0 5 6 7 8
3 2 5 0 1 4 7 8 6
7 5 3 8 2 6 1 4 0
1 6 8 2 5 3 4 0 7
2Kモード:
0 7 5 1 8 2 6 9 3 4*
4 8 3 2 9 0 1 5 6 7
8 3 9 0 2 1 5 7 4 6
7 0 4 8 3 6 9 1 5 2
4Kモード:
7 10 5 8 1 2 4 9 0 3 6*
6 2 7 10 8 0 3 4 1 9 5
9 5 4 2 3 10 1 0 6 8 7
1 4 10 3 9 7 2 6 5 0 8
8Kモード:
5 11 3 0 10 8 6 9 2 4 1 7*
10 8 5 4 2 9 1 0 6 7 3 11
11 6 9 8 4 7 2 1 0 10 5 3
8 3 11 7 9 1 5 6 4 0 2 10
0.5Kモード:
3 7 4 6 1 2 0 5
4 2 5 7 3 0 1 6
5 3 6 0 4 1 2 7
6 1 0 5 2 7 4 3
2Kモード:
0 7 5 1 8 2 6 9 3 4*
3 2 7 0 1 5 8 4 9 6
4 8 3 2 9 0 1 5 6 7
7 3 9 5 2 1 0 6 4 8
4Kモード:
7 10 5 8 1 2 4 9 0 3 6**
6 2 7 10 8 0 3 4 1 9 5
10 3 4 1 2 7 0 6 8 5 9
0 8 9 5 10 4 6 3 2 1 7
8Kモード:
5 11 3 0 10 8 6 9 2 4 1 7*
8 10 7 6 0 5 2 1 3 9 4 11
11 3 6 9 2 7 4 10 5 1 0 8
10 8 1 7 5 6 0 11 4 2 9 3
*これらはDVB−T規格における置換コードである
**これらはDVB−H規格における置換コードである
Claims (42)
- 送信すべき入力データシンボルを、直交周波数分割多重(Orthogonal Frequency Division Multiplexed: OFDM)シンボルの所定の数のサブキャリア信号にマッピングするデータ処理装置であって、
前記OFDMシンボルの前記サブキャリア信号にマッピングするための、所定の数の入力データシンボルをインタリーバメモリに読み込み、当該入力データシンボルを、前記読み込みの順序とは異なる、アドレスのセットによって規定された順序で前記インタリーバメモリから前記サブキャリア信号に読み出して、前記入力データシンボルを当該サブキャリア信号にインタリーブしてマッピングを実行するインタリーバと、
前記入力データシンボル毎に、当該入力データシンボルがマッピングされる前記サブキャリア信号のうちの1つを示すアドレスのセットを生成するアドレス生成部とを具備し、
前記アドレス生成部は、
所定数のレジスタ段を有し、生成多項式に従って擬似ランダムビットシーケンスを生成する線形フィードバックシフトレジスタと、
前記サブキャリア信号のうちの1つの前記アドレスを生成するために、前記レジスタ段の保持データを受信して、当該レジスタ段に存在するビットを、置換順序に従って置換する置換回路と、
アドレスチェック回路と共に動作して、前記生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成する制御部とを有し、
前記所定の最大有効アドレスは、1024以下であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
データ処理装置。 - 請求項1に記載のデータ処理装置であって、
前記所定の最大有効アドレスは、700〜1024の値である
データ処理装置。 - 請求項1に記載のデータ処理装置であって、
前記OFDMシンボルは、既知のシンボルを搬送するように構成されたパイロットサブキャリアを有し、
前記所定の最大有効アドレスは、前記OFDMシンボルに存在する前記パイロットサブキャリアの数に依存する
データ処理装置。 - 請求項1に記載のデータ処理装置であって、
前記インタリーバは、偶数OFDMシンボルについては、前記アドレス生成部によって生成された前記アドレスのセットに従って前記入力データシンボルを前記インタリーバメモリに読み込み、並び順で前記メモリから読み出すことによって、当該入力データシンボルの前記サブキャリア信号へのマッピングを実行し、奇数OFDMシンボルについては、前記入力データシンボルを並び順で前記インタリーバメモリに読み込み、前記アドレス生成部によって生成された前記アドレスのセットに従って前記インタリーバメモリから読み出すことによって、当該入力データシンボルの前記サブキャリア信号へのマッピングを実行する
データ処理装置。 - 請求項1に記載のデータ処理装置であって、
前記置換回路は、前記アドレスを生成するために、前記レジスタ段の前記ビットの順序を置換する前記置換コードを、前記OFDMシンボル毎に変更する
データ処理装置。 - 請求項5に記載のデータ処理装置であって、
前記置換回路は、連続したOFDMシンボルに対し、異なる置換コードのシーケンスを循環させる
データ処理装置。 - 請求項6又は7に記載のデータ処理装置であって、
前記OFDMシンボルの前記サブキャリア信号は、複数の動作モードのうちの任意の動作モードのOFDM信号におけるサブキャリア信号の最大数の半数以下であり、
前記入力データシンボルは、偶数OFDMシンボルにマッピングするための第1のセットの入力データシンボルと、奇数OFDMシンボルにマッピングするための第2のセットの入力データシンボルとを有し、
前記データ処理装置は、前記第1のセットの入力データシンボル及び第2のセットの入力データシンボルの両方を、奇数インタリーブ処理に従ってインタリーブし、
前記奇数インタリーブ処理は、
前記第1のセットの入力データシンボルの並び順に従って、当該第1のセットの入力データシンボルを前記インタリーバメモリの第1の部分に書き込み、
前記置換コードのシーケンスのうちの1つの置換コードにより生成された前記アドレスのセットによって規定された順序に従って、前記第1のセットの入力データシンボルを前記インタリーバメモリの第1の部分から前記偶数OFDMシンボルの前記サブキャリア信号に読み出し、
前記第2のセットの入力データシンボルの並び順に従って、当該第2のセットの入力データシンボルを前記インタリーバメモリの第2の部分に書き込み、
前記置換コードのシーケンスのうちの別の置換コードにより生成された前記アドレスのセットによって規定された順序に従って、前記第2のセットの入力データシンボルを前記インタリーバメモリの第2の部分から前記奇数OFDMシンボルの前記サブキャリア信号に読み出すことを含む
データ処理装置。 - 送信すべき入力データシンボルを、OFDMシンボルの所定の数のサブキャリア信号にマッピングするデータ処理装置を有する、OFDMを用いてデータを送信する送信装置であって、
前記データ処理装置は、
前記OFDMシンボルの前記サブキャリア信号にマッピングするための、所定の数の入力データシンボルをインタリーバメモリに読み込み、当該入力データシンボルを、前記読み込みの順序とは異なる、アドレスのセットによって規定された順序で前記インタリーバメモリから前記サブキャリア信号に読み出して、前記入力データシンボルを当該サブキャリア信号にインタリーブしてマッピングを実行するインタリーバと、
前記入力データシンボル毎に、当該入力データシンボルがマッピングされる前記サブキャリア信号のうちの1つを示すアドレスのセットを生成するアドレス生成部とを具備し、
前記アドレス生成部は、
所定数のレジスタ段を有し、生成多項式に従って擬似ランダムビットシーケンスを生成する線形フィードバックシフトレジスタと、
前記サブキャリア信号のうちの1つの前記アドレスを生成するために、前記レジスタ段の保持データを受信して、当該レジスタ段に存在するビットを、置換順序に従って置換する置換回路と、
アドレスチェック回路と共に動作して、前記生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成する制御部とを有し、
前記所定の最大有効アドレスは、1024以下であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
送信装置。 - 請求項9に記載の送信装置であって、
DVB−T(Digital Video Broadcasting-Terrestrial)規格、DVB−H(Digital Video Broadcasting-Handheld)規格、又はDVB−T2(Digital Video Broadcasting-Terrestrial2)規格を含むディジタルビデオ放送規格に従ってデータを送信する
送信装置。 - 送信すべき入力データシンボルを、OFDMシンボルの所定の数のサブキャリア信号にマッピングするマッピング方法であって、
前記OFDMシンボルの前記サブキャリア信号にマッピングするための所定の数の入力データシンボルをインタリーバメモリに読み込むステップと、
前記読み込まれた入力データシンボルを、前記読み込みの順序とは異なる、アドレスのセットによって規定された順序で前記インタリーバメモリから前記サブキャリア信号に読み出して、前記入力データシンボルを前記サブキャリア信号にインタリーブしてマッピングを実行するステップと、
前記入力データシンボル毎に、当該入力データシンボルがマッピングされる前記サブキャリア信号のうちの1つを示すアドレスのセットを生成するステップとを具備し、
前記アドレスのセットを生成するステップは、
所定数のレジスタ段を有する線形フィードバックシフトレジスタを用いて、生成多項式に従って擬似ランダムビットシーケンスを生成するステップと、
前記レジスタ段の保持データを受信し、当該レジスタ段に存在するビットを、置換回路を用いて置換順序に従って置換することで前記アドレスを生成するステップと、
生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成するステップとを含み、
前記所定の最大有効アドレスは、1024以下であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
マッピング方法。 - 請求項11に記載のマッピング方法であって、
前記所定の最大有効アドレスは、700〜1024の値である
マッピング方法。 - 請求項11に記載のマッピング方法であって、
前記OFDMシンボルは、既知のシンボルを搬送するように構成されたパイロットサブキャリアを有し、
前記所定の最大有効アドレスは、前記OFDMシンボルに存在する前記パイロットサブキャリアの数に依存する
マッピング方法。 - 請求項11に記載のマッピング方法であって、
前記入力データシンボルを前記インタリーバメモリに読み込むステップ、及びマッピングを実行するステップは、
偶数OFDMシンボルについて、前記アドレス生成部によって生成された前記アドレスのセットに従って、前記入力データシンボルを前記インタリーバメモリに読み込み、並び順に従って、前記入力データシンボルを前記インタリーバメモリから読み出すステップと、
奇数OFDMシンボルについて、並び順に従って、前記入力データシンボルを前記インタリーバメモリに読み込み、前記アドレス生成部によって生成された前記アドレスのセットに従って、前記入力データシンボルを前記インタリーバメモリから読み出すステップとを含む
マッピング方法。 - 請求項11に記載のマッピング方法であって、
前記アドレスを生成するステップは、前記アドレスを生成するために、前記レジスタ段の前記ビットの順序を置換する前記置換コードを、前記OFDMシンボル毎に変更するステップを含む
マッピング方法。 - 請求項15に記載のマッピング方法であって、
前記置換コードを前記OFDMシンボル毎に変更するステップは、連続したOFDMシンボルに対し、異なる置換コードのシーケンスを循環させるステップを含む
マッピング方法。 - 請求項16又は17に記載のマッピング方法であって、
前記OFDMシンボルの前記サブキャリア信号は、複数の動作モードのうちの任意の動作モードのOFDM信号におけるサブキャリア信号の最大数の半数以下であり、
前記マッピング方法は、さらに、
前記入力データシンボルを、偶数OFDMシンボルにマッピングするための第1のセットの入力データシンボルと、奇数OFDMシンボルにマッピングするための第2のセットの入力データシンボルとに分割するステップと、
前記第1のセットの入力データシンボル及び前記第2のセットの入力データシンボルの両方を、奇数インタリーブ処理に従ってインタリーブするステップとを具備し、
前記奇数インタリーブ処理は、
前記第1のセットの入力データシンボルの並び順に従って、当該第1のセットの入力データシンボルを前記インタリーバメモリの第1の部分に書き込み、
前記置換コードのシーケンスのうちの1つの置換コードにより生成された前記アドレスのセットによって規定された順序に従って、前記第1のセットの入力データシンボルを前記インタリーバメモリの第1の部分から前記偶数OFDMシンボルの前記サブキャリア信号に読み出し、
前記第2のセットの入力データシンボルの並び順に従って、当該第2のセットの入力データシンボルを前記インタリーバメモリの第2の部分に書き込み、
前記置換コードのシーケンスのうちの別の置換コードにより生成された前記アドレスのセットによって規定された順序に従って、前記第2のセットの入力データシンボルを前記インタリーバメモリの第2の部分から前記奇数OFDMシンボルのサブキャリア信号に読み出すことを含む
マッピング方法。 - OFDMシンボルの所定の数のサブキャリア信号を介して入力データシンボルを送信する送信方法であって、
前記所定の数のサブキャリア信号にマッピングするための、所定の数の入力データシンボルを受信するステップと、
前記前記受信された所定の数の入力データシンボルをインタリーバメモリに読み込むステップと、
前記読み込まれた入力データシンボルを、前記読み込みの順序とは異なる、アドレスのセットによって規定された順序で前記メモリから前記サブキャリア信号に読み出して、前記入力データシンボルを前記サブキャリア信号にインタリーブしてマッピングを実行するステップと、
前記入力データシンボル毎に、当該入力データシンボルがマッピングされる前記サブキャリア信号のうちの1つを示すアドレスのセットを生成するステップとを具備し、
前記アドレスのセットを生成するステップは、
所定数のレジスタ段を有する線形フィードバックシフトレジスタを用いて、生成多項式に従って擬似ランダムビットシーケンスを生成するステップと、
前記レジスタ段の保持データを受信し、当該レジスタ段に存在するビットを、置換回路を用いて、置換順序に従って置換することで前記アドレスを生成するステップと、
前記生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成するステップとを含み、
前記所定の最大有効アドレスは、1024であり、
前記線形フィードバックシフトレジスタは、13段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
送信方法。 - 請求項19に記載の送信方法であって、
前記送信は、DVB−T規格、DVB−H規格、又はDVB−T2規格を含むディジタルビデオ放送規格に従って実行される
送信方法。 - OFDMシンボルのサブキャリア信号にインタリーブされたデータシンボルを送信する際に用いられ、当該データシンボル毎に、当該データシンボルがマッピングされるサブキャリア信号を示すアドレスのセットを生成するアドレス生成装置であって、
所定数のレジスタ段を有し、生成多項式に従って擬似ランダムビットシーケンスを生成する線形フィードバックシフトレジスタと、
前記アドレスを生成するために、前記レジスタ段の保持データを受信して、当該レジスタ段に存在するビットを、置換順序に従って置換する置換回路と、
アドレスチェック回路と共に動作して、前記生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成する制御部とを具備し、
前記所定の最大有効アドレスは、1024以下であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
アドレス生成装置。 - OFDMシンボルの所定の数のサブキャリア信号から受信したデータシンボルを出力シンボルストリームにマッピングするデータ処理装置であって、
前記OFDMシンボルの前記サブキャリア信号から受信した所定の数のデータシンボルをインタリーバメモリに読み込み、当該データシンボルを、前記読み込みの順序とは異なる、アドレスのセットによって規定された順序で前記インタリーバメモリから前記出力シンボルストリームに読み出して、前記データシンボルを前記サブキャリア信号からデインタリーブしてマッピングを実行するデインタリーバと、
前記受信されたデータシンボル毎に、当該受信されたデータシンボルが前記出力シンボルストリームにマッピングされるサブキャリア信号を示すアドレスのセットを生成するアドレス生成部とを具備し、
前記アドレス生成部は、
所定数のレジスタ段を有し、生成多項式に従って擬似ランダムビットシーケンスを生成する線形フィードバックシフトレジスタと、
前記サブキャリア信号のうちの1つの前記アドレスを生成するために、前記レジスタ段の保持データを受信して、当該レジスタ段に存在するビットを、置換順序に従って置換する置換回路と、
アドレスチェック回路と共に動作して、前記生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成する制御部とを有し、
前記所定の最大有効アドレスは、1024以下であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
データ処理装置。 - 請求項22に記載のデータ処理装置であって、
前記所定の最大有効アドレスは、700〜1024の値である
データ処理装置。 - 請求項22に記載のデータ処理装置であって、
前記OFDMシンボルは、既知のシンボルを搬送するように構成されたパイロットサブキャリアを有し、
前記所定の最大有効アドレスは、前記OFDMシンボルに存在する前記パイロットサブキャリアの数に依存する
データ処理装置。 - 請求項22に記載のデータ処理装置であって、
前記デインタリーバは、偶数OFDMシンボルについては、前記サブキャリア信号から受信した前記データシンボルを並び順に従って前記インタリーバメモリに読み込み、当該データシンボルを、前記アドレス生成部によって生成された前記アドレスのセットに従って前記インタリーバメモリから前記出力シンボルストリームに読み出すことによって、前記データシンボルを前記出力シンボルストリームにマッピングし、奇数OFDMシンボルについては、前記データシンボルを、前記アドレス生成部によって生成されたアドレスのセットに従って前記インタリーバメモリに読み込み、当該データシンボルを、並び順に従って、前記インタリーバメモリから前記出力シンボルストリームに読み出すことによって、前記サブキャリア信号から受信したデータシンボルを前記出力シンボルストリームにマッピングするように構成される
データ処理装置。 - 請求項22に記載のデータ処理装置であって、
前記置換回路は、前記アドレスを生成するために、前記レジスタ段の前記ビットの順序を置換する前記置換コードを、前記OFDMシンボル毎に変更する
データ処理装置。 - 請求項26に記載のデータ処理装置であって、
前記置換回路は、連続したOFDMシンボルに対し、異なる置換コードのシーケンスを循環させる
データ処理装置。 - 請求項27又は28に記載のデータ処理装置であって、
前記OFDMシンボルの前記サブキャリア信号は、複数の動作モードのうちの任意の動作モードのOFDM信号におけるサブキャリア信号の最大数の半数以下であり、
前記入力データシンボルは、偶数OFDMシンボルから受信された第1のセットの入力データシンボルと、奇数OFDMシンボルから受信された第2のセットの入力データシンボルとを有し、
前記データ処理装置は、前記第1のセットの入力データシンボル及び第2のセットの入力データシンボルの両方を、奇数インタリーブ処理に従ってデインタリーブし、
前記奇数インタリーブ処理は、
前記置換コードのシーケンスのうちの1つの置換コードにより生成された前記アドレスのセットによって規定された順序に従って、前記偶数OFDMシンボルから受信した前記第1のセットのデータシンボルを前記インタリーバメモリの第1の部分に書き込み、
前記第1のセットのデータシンボルの並び順に従って、当該第1のセットのデータシンボルを前記インタリーバメモリの第1の部分から前記出力シンボルストリームに読み出し、
前記置換コードのシーケンスのうちの別の置換コードにより生成された前記アドレスのセットによって規定された順序に従って、前記奇数OFDMシンボルから受信した前記第2のセットのデータシンボルを前記インタリーバメモリの第2の部分に書き込み、
前記第2のセットのデータシンボルの並び順に従って、当該第2のセットのデータシンボルを前記インタリーバメモリの第2の部分から前記出力シンボルストリームに読み出すことを含む
データ処理装置。 - OFDMシンボルの所定の数のサブキャリア信号から受信したデータシンボルを、出力シンボルストリームにマッピングするデータ処理装置を有する、OFDM変調された信号からデータを受信する受信装置であって、
前記OFDMシンボルの前記サブキャリア信号から受信した所定の数のデータシンボルをインタリーバメモリに読み込み、当該データシンボルを、前記読み込みの順序とは異なる、アドレスのセットによって規定された順序で前記インタリーバメモリから前記出力シンボルストリームに読み出して、前記データシンボルを前記サブキャリア信号からデインタリーブしてマッピングを実行するデインタリーバと、
前記受信されたデータシンボル毎に、当該受信されたデータシンボルが前記出力シンボルストリームにマッピングされるサブキャリア信号を示すアドレスのセットを生成するアドレス生成部とを具備し、
前記アドレス生成部は、
所定数のレジスタ段を有し、生成多項式に従って擬似ランダムビットシーケンスを生成する線形フィードバックシフトレジスタと、
前記サブキャリア信号のうちの1つの前記アドレスを生成するために、前記レジスタ段の保持データを受信して、当該レジスタ段に存在するビットを、置換順序に従って置換する置換回路と、
アドレスチェック回路と共に動作して、前記生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成する制御部とを有し、
前記所定の最大有効アドレスは、1024以下であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
受信装置。 - 請求項30に記載の受信装置であって、
DVB−T規格、DVB−H規格、又はDVB−T2規格を含むディジタルビデオ放送規格に従って変調されたデータを受信する
受信装置。 - OFDMシンボルのサブキャリア信号にインタリーブされたデータシンボルを受信する際に用いられ、当該受信されたデータシンボル毎に、当該受信されたデータシンボルが前記インタリーバメモリから前記出力シンボルストリームにマッピングされるサブキャリア信号を示すアドレスのセットを生成するアドレス生成装置であって、
所定の数のレジスタ段を有し、生成多項式に従って擬似ランダムビットシーケンスを生成する線形フィードバックシフトレジスタと、
アドレスを生成するために、前記レジスタ段の保持データを受信して、当該レジスタ段に存在するビットを置換順序に従って置換する置換回路と、
アドレスチェック回路と共に動作して、生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成する制御部とを具備し、
前記所定の最大有効アドレスは、1024以下であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
アドレス生成部。 - OFDMシンボルの所定の数のサブキャリア信号から受信したデータシンボルを出力シンボルストリームにマッピングするマッピング方法であって、
前記OFDMシンボルの前記サブキャリア信号から受信した所定の数のデータシンボルをインタリーバメモリに読み込むステップと、
前記データシンボルを、前記読み込みの順序とは異なる、アドレスのセットによって規定された順序で前記インタリーバメモリから前記出力シンボルストリームに読み出して、前記データシンボルを前記サブキャリア信号からデインタリーブしてマッピングを実行するステップと、
受信されたデータシンボル毎に、当該受信されたデータシンボルが前記インタリーブメモリから前記出力シンボルストリームにマッピングされるサブキャリア信号を示すアドレスのセットを生成するステップとを具備し、
前記アドレスのセットを生成するステップは、
所定数のレジスタ段を有する線形フィードバックシフトレジスタを用いて、生成多項式に従って擬似ランダムビットシーケンスを生成するステップと、
前記レジスタ段の保持データを受信し、当該レジスタ段に存在するビットを、置換回路を用いて、置換順序に従って置換することで前記アドレスを生成するステップと、
前記生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成するステップとを含み、
前記所定の最大有効アドレスは、1024であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
マッピング方法。 - 請求項33に記載のマッピング方法であって、
前記所定の最大有効アドレスは、700〜1024の値である
マッピング方法。 - 請求項33に記載のマッピング方法であって、
前記OFDMシンボルは、既知のシンボルを搬送するように構成されたパイロットサブキャリアを有し、
前記所定の最大有効アドレスは、前記OFDMシンボルに存在する前記パイロットサブキャリアの数に依存する
マッピング方法。 - 請求項33に記載のマッピング方法であって、
前記データシンボルを前記インタリーバメモリに読み込むステップ、及び前記マッピングを実行するステップは、
偶数OFDMシンボルについて、並び順に従って、前記データシンボルを前記インタリーバメモリに読み込み、前記アドレス生成部によって生成されたアドレスのセットに従って、前記読み込まれたデータシンボルを前記インタリーバメモリから読み出すステップと、
奇数OFDMシンボルについて、前記アドレス生成部によって生成されたアドレスのセットに従って、前記データシンボルを前記インタリーバメモリに読み込み、並び順に従って、前記読み込まれたデータシンボルを前記インタリーバメモリから読み出すステップとを含む
マッピング方法。 - 請求項33に記載のマッピング方法であって、
前記アドレスを生成するステップは、前記アドレスを生成するために、前記レジスタ段の前記ビットの順序を置換する置換コードを、前記OFDMシンボル毎に変更するステップを含む
マッピング方法。 - 請求項37に記載のマッピング方法であって、
前記置換コードを前記OFDMシンボル毎に変更するステップは、連続したOFDMシンボルに対し、異なる置換コードのシーケンスを循環させるステップを含む
マッピング方法。 - 請求項37記載のマッピング方法であって、
前記OFDMシンボルの前記サブキャリア信号は、複数の動作モードのうちの任意の動作モードのOFDM信号におけるサブキャリア信号の最大数の半数以下であり、
前記マッピング方法は、さらに、
偶数OFDMシンボルから第1のセットのデータシンボルを受信するステップと、
奇数OFDMシンボルから第2のセットのデータシンボルを受信するステップと、
前記OFDMシンボルのサブキャリア信号から受信した前記データシンボルを、インタリーバメモリに読み込むステップと、
前記データシンボルを前記インタリーバメモリから前記出力シンボルストリームに読み出して、奇数インタリーブ処理に従ってマッピングを実行するステップとを具備し、
前記奇数インタリーブ処理は、
前記置換コードのシーケンスのうちの1つの置換コードにより生成されたアドレスのセットによって規定された順序に従って、前記偶数OFDMシンボルの前記サブキャリア信号から受信した前記第1のセットのデータシンボルを前記インタリーバメモリの第1の部分に書き込み、
前記第1のセットのデータシンボルの並び順に従って、当該第1のセットのデータシンボルを前記インタリーバメモリの第1の部分から前記出力シンボルストリームに読み出し、
前記置換コードのシーケンスのうちの別の置換コードにより生成されたアドレスのセットによって規定された順序に従って、前記偶数OFDMシンボルの前記サブキャリア信号から受信した前記第2のセットのデータシンボルを前記インタリーバメモリの第2の部分に書き込み、
前記第2のセットのデータシンボルの並び順に従って、当該第2のセットのデータシンボルを前記インタリーバメモリの第2の部分から前記出力シンボルストリームに読み出すことを含む
マッピング方法。 - OFDM変調されたシンボルからデータを受信する方法であって、
出力シンボルストリームを生成するために、前記OFDMシンボルの所定の数のサブキャリア信号から、所定の数のデータシンボルを受信するステップと、
前記OFDMシンボルの前記サブキャリア信号から受信した前記所定の数のデータシンボルをインタリーバメモリに読み込むステップと、
前記読み込まれたデータシンボルを、前記読み込みの順序とは異なる、アドレスのセットによって規定された順序で前記インタリーバメモリから前記出力シンボルストリームに読み出して、前記データシンボルを前記サブキャリア信号からデインタリーブしてマッピングを実行するステップと、
前記受信されたデータシンボル毎に、当該受信されたデータシンボルが前記出力シンボルストリームにマッピングされるサブキャリア信号を示すアドレスのセットを生成するステップとを具備し、
前記アドレスのセットを生成するステップは、
所定数のレジスタ段を有する線形フィードバックシフトレジスタを用いて、生成多項式に従って、擬似ランダムビットシーケンスを生成するステップと、
前記レジスタ段の保持データを受信し、当該レジスタ段に存在するビットを、置換回路を用いて、置換順序に従って置換することで前記アドレスを生成するステップと、
前記生成されたアドレスが所定の最大有効アドレスを超えるとき、アドレスを再生成するステップとを含み、
前記所定の最大有効アドレスは、1024以下であり、
前記線形フィードバックシフトレジスタは、9段のレジスタ段及び当該線形フィードバックシフトレジスタのための生成多項式
前記置換順序は、以下の表
マッピング方法。 - 請求項41に記載のマッピング方法であって、前記OFDMシンボルの前記サブキャリア信号から前記データシンボルを受信するステップは、DVB−T規格、DVB−H規格、又はDVB−T2規格を含むディジタルビデオ放送規格に従って実行される
マッピング方法。
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