JP2008191206A - Manufacturing method for electrooptical device - Google Patents

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Tomoki Yokota
智己 横田
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a manufacturing method for an electrooptical device which obtains a high contrast by forming a pixel electrode with high flatness. <P>SOLUTION: A stripping layer 61 is formed on a support substrate 60, and an electrode formation layer 62 with light reflectivity is formed on the stripping layer 61. Then an insulating layer 15 is provided on the electrode formation layer 62, and a thin film transistor 30 which conducts to the electrode formation layer 62 is provided on the insulating layer 15. The support substrate 60 is peeled off a stack 40 including the electrode formation layer 62 and thin film transistor 30 and the electrode formation layer 62 is divided in a predetermined pattern to form pixel electrodes. <P>COPYRIGHT: (C)2008,JPO&INPIT

Description

本発明は、電気光学装置の製造方法に関するものである。   The present invention relates to a method for manufacturing an electro-optical device.

近年、電気光学装置の一例である液晶装置は、背面からの光(バックライト)を透過して画像を表示する透過型のものと、外部からの光を取り込んだ後、反射させて画像を表示する反射型のものとがある。   In recent years, a liquid crystal device, which is an example of an electro-optical device, transmits a light from a back surface (backlight) and displays an image, and takes in light from outside and reflects it to display an image. Some of them are reflective.

通常、反射型の液晶装置では、基板上に半導体、配線層を含んだ回路部、及び画素電極を順に積層することで素子基板を形成する。このとき、反射膜として機能する画素電極は、高い反射率を実現するためにできるだけ平坦であることが望まれる。しかしながら、前記回路部は凹凸であるため、回路部を覆って形成された画素電極の平坦性が低下してしまう。   Usually, in a reflective liquid crystal device, an element substrate is formed by sequentially stacking a semiconductor, a circuit portion including a wiring layer, and a pixel electrode on a substrate. At this time, the pixel electrode functioning as a reflective film is desired to be as flat as possible in order to achieve high reflectance. However, since the circuit portion is uneven, the flatness of the pixel electrode formed so as to cover the circuit portion is deteriorated.

そこで、回路部を覆い、画素電極下に設けられる層間絶縁膜をCMP(化学的機械的研磨)法で研磨することにより、電極の平坦性を確保する技術が知られている(例えば、特許文献1参照)。一般に画素電極は層間絶縁膜に形成されたコンタクトホール内に画素電極の一部を埋設することでトランジスタに接続される。そのため、前記コンタクト部分では画素電極に窪みが生じてしまい、これによって画素電極の平坦性が低下してしまう。   Thus, a technique is known that covers the circuit portion and polishes an interlayer insulating film provided under the pixel electrode by a CMP (Chemical Mechanical Polishing) method to ensure the flatness of the electrode (for example, Patent Documents). 1). Generally, a pixel electrode is connected to a transistor by burying a part of the pixel electrode in a contact hole formed in an interlayer insulating film. For this reason, a depression is generated in the pixel electrode at the contact portion, thereby reducing the flatness of the pixel electrode.

また、コンタクトホールに起因する平坦性の低下を防止するため、コンタクトホール内に充填層を設けコンタクト部分の段差を無くし平坦性を確保する技術も知られている(例えば、特許文献2参照)。
特開平8−160463号公報 特表2002−532768号公報
In addition, in order to prevent the flatness due to the contact hole from being lowered, a technique is also known in which a filling layer is provided in the contact hole to eliminate the step at the contact portion and ensure the flatness (see, for example, Patent Document 2).
JP-A-8-160463 JP 2002-532768

しかしながら、コンタクトホール内に充填材を設ける場合、充填材の上面とコンタクトホールの上面とが一致するように充填材の量を厳密に制御することは難しく、コンタクトホールに起因する凹凸を完全に無くすことは困難であり、画素電極の平坦性を十分に高めることはできなかった。このように画素電極の平坦性が低下することで、画素電極の光反射率、ひいては画素コントラストの低下を招いてしまう。   However, when the filler is provided in the contact hole, it is difficult to strictly control the amount of the filler so that the upper surface of the filler and the upper surface of the contact hole coincide with each other, and the unevenness caused by the contact hole is completely eliminated. This is difficult, and the flatness of the pixel electrode cannot be sufficiently improved. As the flatness of the pixel electrode is thus reduced, the light reflectance of the pixel electrode, and hence the pixel contrast is reduced.

本発明はこのような事情に鑑みてなされたものであって、平坦性の高い画素電極を形成することで高コントラストを得る、電気光学装置の製造方法を提供することを目的としている。   SUMMARY An advantage of some aspects of the invention is that it provides a method of manufacturing an electro-optical device that can obtain high contrast by forming a pixel electrode with high flatness.

本発明の電気光学装置の製造方法は、支持基板上に剥離層を形成する工程と、該剥離層上に光反射性を有する電極形成層を形成する工程と、該電極形成層上に絶縁層を設け、該絶縁層上に前記電極形成層に導通する薄膜トランジスタを設ける工程と、該薄膜トランジスタの形成後、前記電極形成層及び前記薄膜トランジスタを含む積層体から前記支持基板を剥離する工程と、該剥離工程後、前記電極形成層を所定のパターン状に分割し、画素電極を形成する工程と、を備えることを特徴とする。   The electro-optical device manufacturing method of the present invention includes a step of forming a release layer on a support substrate, a step of forming an electrode-forming layer having light reflectivity on the release layer, and an insulating layer on the electrode-forming layer. Providing a thin film transistor that is electrically connected to the electrode formation layer on the insulating layer; and, after forming the thin film transistor, peeling the support substrate from the laminate including the electrode formation layer and the thin film transistor; And a step of dividing the electrode forming layer into a predetermined pattern and forming a pixel electrode after the step.

本発明の電気光学装置の製造方法によれば、薄膜トランジスタの積層工程に先んじて電極形成層の形成工程が行われ、電極形成層上に薄膜トランジスタが積層されるので、該電極形成層の形成時に薄膜トランジスタの凹凸形状が影響を及ぼすことが無くなる。よって、電極形成層は平坦性の高いものとなり、この電極形成層から構成される画素電極の平坦性が向上し、これに伴って画素電極の反射率を高めることができる。したがって、コントラストが高く、高信頼性の電気光学装置を提供できる。   According to the method for manufacturing the electro-optical device of the present invention, the electrode forming layer forming step is performed prior to the thin film transistor stacking step, and the thin film transistor is stacked on the electrode forming layer. The concave / convex shape is not affected. Therefore, the electrode formation layer has high flatness, and the flatness of the pixel electrode composed of this electrode formation layer is improved, and accordingly, the reflectance of the pixel electrode can be increased. Accordingly, an electro-optical device with high contrast and high reliability can be provided.

また、上記電気光学装置の製造方法においては、前記電極形成層として、前記薄膜トランジスタ形成時の温度よりも高い融点を有する高融点金属を用いるのが好ましい。
このようにすれば、電極形成層が薄膜トランジスタの形成時の熱により変形することで平坦性が低下してしまうのを防止できる。よって、電気光学装置の製造プロセスの信頼性をより高めることができる。
In the method of manufacturing the electro-optical device, it is preferable to use a refractory metal having a melting point higher than the temperature at which the thin film transistor is formed as the electrode forming layer.
In this way, it is possible to prevent the flatness from being deteriorated due to the electrode forming layer being deformed by heat during the formation of the thin film transistor. Therefore, the reliability of the manufacturing process of the electro-optical device can be further increased.

また、上記電気光学装置の製造方法においては、前記画素電極の形成工程において、前記電極形成層を、該電極形成層に比べて高い光反射性を有する反射膜で覆うのが好ましい。
このようにすれば、画素電極を構成する電極形成層が光反射膜で覆われるので、平坦性及び光反射性の高い画素電極が得られ、電気光学装置のコントラストをより向上させることができる。
In the electro-optical device manufacturing method, in the pixel electrode forming step, the electrode forming layer is preferably covered with a reflective film having higher light reflectivity than the electrode forming layer.
According to this configuration, since the electrode forming layer constituting the pixel electrode is covered with the light reflecting film, a pixel electrode having high flatness and high light reflecting property can be obtained, and the contrast of the electro-optical device can be further improved.

また、上記電気光学装置の製造方法においては、前記剥離層としてアモルファスシリコンを用い、該剥離層にレーザ光を照射することで前記積層体を前記支持基板から剥離するのが好ましい。
このようにすれば、レーザ光の照射により、後述するように水素(気体)が発生することで内圧が発生し、層内剥離または界面剥離が促進され、前記支持基板からの剥離工程を容易に行うことができる。
このとき、前記支持基板として、透光性材料からなるものを用いるのが好ましい。
この場合、支持基板を透過したレーザ光を剥離層の全域に照射することができ、支持基板の剥離を容易に行うことができる。
In the electro-optical device manufacturing method, it is preferable that amorphous silicon is used as the release layer, and the laminate is peeled from the support substrate by irradiating the release layer with laser light.
In this way, irradiation with laser light generates hydrogen (gas) as will be described later, thereby generating an internal pressure, facilitating delamination or interfacial delamination, and facilitating the delamination process from the support substrate. It can be carried out.
At this time, it is preferable to use a substrate made of a translucent material as the support substrate.
In this case, the entire area of the release layer can be irradiated with laser light transmitted through the support substrate, and the support substrate can be easily peeled off.

また、上記電気光学装置の製造方法においては、前記支持基板上の積層体を仮基板に接着した後に、支持基板から剥離するようにしてもよい。
このようにすれば、前記支持基板の剥離時に積層体が破損するといった不具合を防止することができる。
In the electro-optical device manufacturing method, the laminate on the support substrate may be peeled off from the support substrate after being bonded to the temporary substrate.
If it does in this way, the malfunction that a laminated body will be damaged at the time of peeling of the said support substrate can be prevented.

また、上記電気光学装置の製造方法においては、前記電極形成層を所定のパターン状に分割するに先立ち、前記電極形成層を研磨する工程を有するのが好ましい。   In addition, the electro-optical device manufacturing method preferably includes a step of polishing the electrode forming layer prior to dividing the electrode forming layer into a predetermined pattern.

このようにすれば、電極形成層の平坦性をさらに高めるとともに、例えば前記剥離層の一部が残存した場合でも、電極形成層とともに研磨され同時に除去することができるので、工程を不要に増加させることなく、高いコントラストを得る電気光学装置を提供できる。   In this way, the flatness of the electrode forming layer can be further improved, and even if a part of the release layer remains, for example, it can be polished together with the electrode forming layer and removed simultaneously, thereby increasing the number of processes unnecessarily. Therefore, an electro-optical device that obtains high contrast can be provided.

(第1実施形態)
以下、本発明の一実施形態について図面を参照して説明する。なお、以下に説明する実施形態は、本発明の一部の態様を示すものであり、本発明を限定するものではない。また、以下の説明に用いる各図面では、各層や各部材を図面上で認識可能な程度の大きさとするため、各層や各部材ごとに縮尺を適宜変更している。
(First embodiment)
Hereinafter, an embodiment of the present invention will be described with reference to the drawings. In addition, embodiment described below shows the one part aspect of this invention, and does not limit this invention. Moreover, in each drawing used for the following description, the scale is appropriately changed for each layer and each member so that each layer and each member has a size that can be recognized on the drawing.

まず、本発明の電気光学装置の製造方法の一実施形態として、薄膜トランジスタ(Thin Film Transistor, 以下、TFTと略記する)を画素スイッチング素子として用いたTFTアクティブマトリクス方式の液晶装置の製造工程を例に挙げて説明する。また、この液晶装置は、一方の基板から入射した光を他方の基板で反射させて表示をなす反射型のものである。   First, as one embodiment of a method for manufacturing an electro-optical device of the present invention, a manufacturing process of a TFT active matrix type liquid crystal device using a thin film transistor (hereinafter abbreviated as TFT) as a pixel switching element is taken as an example. I will give you a description. Further, this liquid crystal device is of a reflective type in which light incident from one substrate is reflected by the other substrate to display.

(液晶装置)
製造方法の説明に先んじて、本方法によって製造された液晶装置の構成について説明する。図1は、本実施形態に係る液晶装置の構成を示す図である。図1は、同液晶装置の平面構成図、図2は図1のH−H’線に沿う断面構成図である。
(Liquid crystal device)
Prior to the description of the manufacturing method, the configuration of the liquid crystal device manufactured by this method will be described. FIG. 1 is a diagram illustrating a configuration of a liquid crystal device according to the present embodiment. FIG. 1 is a plan configuration diagram of the liquid crystal device, and FIG. 2 is a cross-sectional configuration diagram taken along line HH ′ of FIG.

図1,2に示すように、本実施形態の液晶装置100は、TFTアレイ基板(アクティブマトリクス基板)10と、対向基板20とが平面視略矩形枠状のシール材25を介して貼り合わされ、このシール材25に囲まれた領域内に液晶層50が封入された構成になっている。本実施形態に係る液晶装置100は、上述したように反射型のものであり、具体的には対向基板20側から入射した光がTFTアレイ基板10側で反射されることにより、表示をなすものである。   As shown in FIGS. 1 and 2, in the liquid crystal device 100 of this embodiment, a TFT array substrate (active matrix substrate) 10 and a counter substrate 20 are bonded together via a sealing material 25 having a substantially rectangular frame shape in plan view. The liquid crystal layer 50 is sealed in a region surrounded by the sealing material 25. As described above, the liquid crystal device 100 according to the present embodiment is of a reflective type, and specifically displays light by reflecting light incident from the counter substrate 20 side on the TFT array substrate 10 side. It is.

シール材25の一部(図中下辺側)に液晶注入口35が形成されており、当該液晶注入口35を塞ぐように封止材34が形成されている。シール材25内周側に沿って平面視矩形枠状の周辺見切り33が形成され、この周辺見切りの内側の領域が画素表示領域18となっている。   A liquid crystal injection port 35 is formed on a part of the sealing material 25 (lower side in the figure), and a sealing material 34 is formed so as to close the liquid crystal injection port 35. A peripheral parting part 33 having a rectangular frame shape in plan view is formed along the inner peripheral side of the sealing material 25, and an area inside the peripheral parting part is a pixel display area 18.

画素表示領域18内には、画素領域19がマトリクス状に設けられている。当該画素領域19は、画素表示領域18の最小表示単位となる1画素を構成している。シール材25の外側の領域には、データ線駆動回路101及び外部回路実装端子102がTFTアレイ基板10の1辺(図示下辺)に沿って形成されており、この1辺に隣接する2辺に沿ってそれぞれ走査線駆動回路104が形成されて周辺回路を構成している。   In the pixel display area 18, pixel areas 19 are provided in a matrix. The pixel area 19 constitutes one pixel that is the minimum display unit of the pixel display area 18. In the area outside the sealing material 25, the data line driving circuit 101 and the external circuit mounting terminal 102 are formed along one side (the lower side in the drawing) of the TFT array substrate 10, and the two sides adjacent to this one side are formed. A scanning line driving circuit 104 is formed along each of them to form a peripheral circuit.

TFTアレイ基板10の残る1辺(図示上辺)には、画素表示領域18の両側の走査線駆動回路104間を接続する複数の配線105が設けられている。また、対向基板20の各角部においては、TFTアレイ基板10と対向基板20との間の電気的導通をとるための基板間導通材106が配設されている。   On the remaining one side (illustrated upper side) of the TFT array substrate 10, a plurality of wirings 105 are provided for connecting the scanning line driving circuits 104 on both sides of the pixel display region 18. In addition, an inter-substrate conductive material 106 for providing electrical continuity between the TFT array substrate 10 and the counter substrate 20 is disposed at each corner of the counter substrate 20.

図2に示すように、TFTアレイ基板10の内面側(液晶層側)には、複数の画素電極9が配列形成されており、これら画素電極9を覆うように配向膜16が形成されている。なお、TFTアレイ基板10は、例えば石英やガラスなどの光透過可能な材料からなる矩形形状からなる基板である。対向基板20の内面側には、周辺見切り33が形成され、その上に平面ベタ状の共通電極21が形成されている。そして、共通電極21を覆うように配向膜22が形成されている。前記画素電極9は後述する方法によって製造されたもので、平坦性が高く、高反射率を実現している。   As shown in FIG. 2, a plurality of pixel electrodes 9 are arranged on the inner surface side (liquid crystal layer side) of the TFT array substrate 10, and an alignment film 16 is formed so as to cover the pixel electrodes 9. . The TFT array substrate 10 is a rectangular substrate made of a light transmissive material such as quartz or glass. A peripheral parting 33 is formed on the inner surface side of the counter substrate 20, and a flat solid common electrode 21 is formed thereon. An alignment film 22 is formed so as to cover the common electrode 21. The pixel electrode 9 is manufactured by a method to be described later, and has high flatness and high reflectivity.

図3は、上記の液晶装置100の等価回路図である。
同図に示すように、液晶装置の画素表示領域18には、複数の画素領域19がマトリクス状に配置されており、これら画素領域19には、それぞれ画素電極9が配置されている。また、その画素電極9の側方にはTFT30が形成されている。TFT30は、該画素電極9への通電制御を行うスイッチング素子である。このTFT30のソース側にはデータ線6が接続されている。各データ線6には、例えばデータ線駆動素子から画像信号S1、S2、…、Snが供給されるようになっている。
FIG. 3 is an equivalent circuit diagram of the liquid crystal device 100 described above.
As shown in the figure, a plurality of pixel areas 19 are arranged in a matrix in the pixel display area 18 of the liquid crystal device, and pixel electrodes 9 are arranged in these pixel areas 19 respectively. A TFT 30 is formed on the side of the pixel electrode 9. The TFT 30 is a switching element that controls energization to the pixel electrode 9. A data line 6 is connected to the source side of the TFT 30. Each data line 6 is supplied with image signals S1, S2,..., Sn from a data line driving element, for example.

TFT30のゲート側には走査線3が接続されている。走査線3には、例えば走査線駆動素子から所定のタイミングでパルス的に走査信号G1、G2、…、Gmが供給されるようになっている。また、TFT30のドレイン側には画素電極9が接続されている。   A scanning line 3 is connected to the gate side of the TFT 30. For example, scanning signals G1, G2,..., Gm are supplied to the scanning line 3 in a pulsed manner at a predetermined timing from a scanning line driving element. A pixel electrode 9 is connected to the drain side of the TFT 30.

走査線3から供給された走査信号G1、G2、…、Gmにより、スイッチング素子であるTFT30が一定期間だけオンにされると、データ線6から供給された画像信号S1、S2、…、Snが、画素電極9を介して画素領域19に所定のタイミングで書き込まれるようになっている。   When the TFT 30 as a switching element is turned on for a certain period by the scanning signals G1, G2,..., Gm supplied from the scanning line 3, the image signals S1, S2,. The pixel region 19 is written with a predetermined timing through the pixel electrode 9.

画素領域19に書き込まれた所定レベルの画像信号S1、S2、…、Snは、画素電極9と後述する共通電極との間に形成される液晶容量で一定期間保持される。なお、保持された画像信号S1、S2、…、Snがリークするのを防止するため、画素電極9と容量線71との間に蓄積容量70が形成され、液晶容量と並列に配置されている。このように、液晶に電圧信号が印加されると、印加された電圧レベルにより液晶分子の配向状態が変化する。これにより、液晶に入射した光源光が変調されて、画像光が生成されるようになっている。   Image signals S1, S2,..., Sn written in the pixel area 19 are held for a certain period by a liquid crystal capacitor formed between the pixel electrode 9 and a common electrode described later. In order to prevent the retained image signals S1, S2,..., Sn from leaking, a storage capacitor 70 is formed between the pixel electrode 9 and the capacitor line 71 and is arranged in parallel with the liquid crystal capacitor. . Thus, when a voltage signal is applied to the liquid crystal, the alignment state of the liquid crystal molecules changes depending on the applied voltage level. As a result, the light source light incident on the liquid crystal is modulated to generate image light.

(液晶装置の製造方法)
次に、上記液晶装置100の製造方法(工程)について説明するとともに、液晶装置100の断面構造について説明する。本発明は、液晶装置100におけるTFTアレイ基板10を製造する工程に特徴を有しており、それ以外の製造工程については従来と同様であることから、その詳細な工程についての説明は省略する。なお、液晶装置100の製造工程は、各工程を後述の順に行ってもよいが、各工程の順を適宜変更してもよいし、各工程内の手順を適宜変更してもよい。
(Manufacturing method of liquid crystal device)
Next, a manufacturing method (process) of the liquid crystal device 100 will be described, and a cross-sectional structure of the liquid crystal device 100 will be described. The present invention has a feature in the process of manufacturing the TFT array substrate 10 in the liquid crystal device 100, and the other manufacturing processes are the same as those in the prior art, and thus detailed description of the processes is omitted. In addition, although the manufacturing process of the liquid crystal device 100 may be performed in the order described below, the order of the processes may be appropriately changed, and the procedure in each process may be appropriately changed.

図4,5は液晶装置100の製造工程を示す図である。
はじめに、図4(a)に示すように、支持基板60上にアモルファスシリコン層(剥離層)61を形成する。支持基板60は、本工程からTFTアレイ基板10の製造工程中に用いられる部材であり、液晶装置100の構成要素ではない。具体的には、1000℃程度に耐える石英ガラス等の透光性耐熱基板が好ましいが、石英ガラスの他、ソーダガラス、コーニング7059、日本電気ガラスOA−2等の耐熱性ガラス等も使用可能である。
4 and 5 are diagrams showing manufacturing steps of the liquid crystal device 100. FIG.
First, an amorphous silicon layer (peeling layer) 61 is formed on a support substrate 60 as shown in FIG. The support substrate 60 is a member used during the manufacturing process of the TFT array substrate 10 from this step, and is not a component of the liquid crystal device 100. Specifically, a light-transmissive heat-resistant substrate such as quartz glass that can withstand about 1000 ° C. is preferable, but heat-resistant glass such as soda glass, Corning 7059, and Nippon Electric Glass OA-2 can be used in addition to quartz glass. is there.

アモルファスシリコン(以下、アモルファスSiと称す)層61は、レーザ光等の照射光によりアモルファスSi層61内またはその界面において剥離が生ずるものである。アモルファスSi層61の組成は、非晶質シリコン(a−Si)であり、この非晶質シリコン中に水素(H)が含有されている。水素が含有されていると、レーザ光の照射により、水素(気体)が発生することで内圧が発生し、これにより層内剥離または界面剥離が促進される。水素の含有量は2at%程度以上であることが好ましく、2at%〜20at%であることがさらに好ましい。   The amorphous silicon (hereinafter referred to as amorphous Si) layer 61 is peeled off in the amorphous Si layer 61 or at the interface thereof by irradiation light such as laser light. The composition of the amorphous Si layer 61 is amorphous silicon (a-Si), and hydrogen (H) is contained in the amorphous silicon. When hydrogen is contained, an internal pressure is generated by generating hydrogen (gas) by the irradiation of the laser beam, and this promotes delamination or interfacial delamination. The hydrogen content is preferably about 2 at% or more, more preferably 2 at% to 20 at%.

アモルファスSi層61の厚さとしては、1nm〜20μm程度であるのが好ましく、10nm〜2μm程度であるのがより好ましく、20nm〜1μm程度であるのがさらに好ましい。アモルファスSi層61の厚みが薄すぎると、形成された膜厚の均一性が失われて剥離にむらが生じるからであり、アモルファスSi層61の厚みが厚すぎると、剥離に必要とされる照射光のパワー(光量)を大きくする必要があったり、また、剥離後に残されたアモルファスSi層61の残渣を除去するのに時間を要する場合がある。   The thickness of the amorphous Si layer 61 is preferably about 1 nm to 20 μm, more preferably about 10 nm to 2 μm, and further preferably about 20 nm to 1 μm. This is because if the thickness of the amorphous Si layer 61 is too thin, the uniformity of the formed film thickness is lost and uneven peeling occurs. If the thickness of the amorphous Si layer 61 is too thick, the irradiation required for peeling is required. It may be necessary to increase the light power (light quantity), and it may take time to remove the residue of the amorphous Si layer 61 left after the peeling.

なお、アモルファスSi層61は、その作用が、レーザ光などの照射光により層内剥離または界面剥離を起こすものなので、上述した組成以外にも、光エネルギーによりアブレーション(ablation)等を生じさせて、層内剥離または界面剥離を起こす材料でもよいし、光エネルギーにより含有成分を気化させて発生した気体により剥離を起こさせるものでもよいし、組成する材料自身が気化し、発生した気体により層内剥離または界面剥離を起こさせる材料でもよい。   The amorphous Si layer 61 has an effect of causing intralayer delamination or interfacial delamination by irradiation light such as laser light. Therefore, in addition to the above-described composition, the amorphous Si layer 61 causes ablation or the like by light energy, Material that causes delamination or interfacial delamination may be used, or may be caused by gas generated by vaporizing the components by light energy. In addition, the composition itself vaporizes and delamination occurs by the generated gas. Alternatively, a material that causes interface peeling may be used.

例えば、酸化ケイ素もしくはケイ酸化合物、窒化ケイ素、窒化アルミ、窒化チタン等の窒化セラミックス、有機高分子材料(光の照射によりこれらの原子間結合が切断されるもの)、金属、例えば、Al、Li、Ti、Mn、In、Sn、Y、La、Ce、Nd、Pr、GdもしくはSm、又はこれらのうち少なくとも一種を含む合金が挙げられる。   For example, silicon oxide or silicate compounds, nitride ceramics such as silicon nitride, aluminum nitride, titanium nitride, organic polymer materials (those whose interatomic bonds are broken by light irradiation), metals such as Al, Li Ti, Mn, In, Sn, Y, La, Ce, Nd, Pr, Gd, or Sm, or an alloy containing at least one of these.

アモルファスSi層61の形成方法としては、CVD法、特に低圧CVD法やプラズマCVD法を用いることができる。なお、アモルファスSi層61を他の材料から形成する場合には、均一な厚みでアモルファスSi層61を形成可能な方法であればよく、アモルファスSi層61の組成や厚み等の諸条件に応じて適宜選択することが可能である。例えば、CVD(MOCCVD、低圧CVD、ECR−CVD含む)法、蒸着、分子線蒸着(MB)、スパッタリング法、イオンドーピング法、PVD法等の各種気相成膜法、電気メッキ、浸漬メッキ(ディッピング)、無電解メッキ法等の各種メッキ法、ラングミュア・プロジェット(LB)法、スピンコート法、スプレーコート法、ロールコート法等の塗布法、各種印刷法、転写法、インクジェット法、粉末ジェット法等を用いることができる。さらに、これらのうち2種以上の方法を組み合わせてもよい。また、アモルファスSi層61をゾル−ゲル(sol−gel)法によりセラミックを用いて成膜する場合や、有機高分子材料で構成する場合には、塗布法、特にスピンコートにより成膜するのが好ましい。   As a method for forming the amorphous Si layer 61, a CVD method, particularly a low pressure CVD method or a plasma CVD method can be used. In the case where the amorphous Si layer 61 is formed from other materials, any method can be used as long as the amorphous Si layer 61 can be formed with a uniform thickness, depending on various conditions such as the composition and thickness of the amorphous Si layer 61. It is possible to select appropriately. For example, various vapor deposition methods such as CVD (including MOCCVD, low pressure CVD, ECR-CVD), vapor deposition, molecular beam vapor deposition (MB), sputtering, ion doping, PVD, electroplating, immersion plating (dipping) ), Various plating methods such as electroless plating method, Langmuir Projet (LB) method, spin coating method, spray coating method, roll coating method and other coating methods, various printing methods, transfer methods, ink jet methods, powder jet methods Etc. can be used. Furthermore, you may combine 2 or more types of methods among these. Further, when the amorphous Si layer 61 is formed using ceramic by a sol-gel method, or when the amorphous Si layer 61 is formed of an organic polymer material, the amorphous Si layer 61 is formed by a coating method, particularly by spin coating. preferable.

次に図4(b)に示すように、アモルファスSi層61上に光反射性を有する電極形成層62をCVD法やスパッタ法等を用いて形成する。この時、アモルファスSi層61上には平坦な電極形成層62が形成される。このような光反射性を有する電極形成層62としては、金属材料を例示することができる。本実施形態では、前記電極形成層62として、後述する薄膜トランジスタ形成時の温度環境よりも高い融点を有する高融点金属、具体的にはW(タングステン)を用いた。   Next, as shown in FIG. 4B, an electrode forming layer 62 having light reflectivity is formed on the amorphous Si layer 61 by using a CVD method, a sputtering method, or the like. At this time, a flat electrode forming layer 62 is formed on the amorphous Si layer 61. As the electrode forming layer 62 having such light reflectivity, a metal material can be exemplified. In the present embodiment, as the electrode forming layer 62, a refractory metal having a melting point higher than a temperature environment at the time of forming a thin film transistor described later, specifically, W (tungsten) is used.

これにより、電極形成層62が後述する薄膜トランジスタの形成時の熱によって変形してしまい、平坦性が低下するのを防止できる。よって、液晶装置の製造プロセスの信頼性をより高めることができる。   As a result, it is possible to prevent the electrode formation layer 62 from being deformed by heat at the time of forming a thin film transistor, which will be described later, and lowering the flatness. Therefore, the reliability of the manufacturing process of the liquid crystal device can be further increased.

次に図4(c)に示すように、電極形成層62上に下地保護層15を形成する。この下地保護層15は、酸化シリコン等からなり、後工程で製造される半導体層と電極形成層62との間の絶縁をなすものである。   Next, as shown in FIG. 4C, the base protective layer 15 is formed on the electrode forming layer 62. The base protective layer 15 is made of silicon oxide or the like, and serves to insulate between a semiconductor layer manufactured in a later process and the electrode forming layer 62.

次に図4(d)に示すように、下地保護膜15上に従来公知の工程によりポリシリコンからなる半導体層1を形成し、半導体層1を覆ってゲート絶縁膜14を形成する。このゲート絶縁膜14上にソース線3を形成する。このソース線3のうち、前記ゲート絶縁膜14を介して半導体層1のチャネル領域1aとして機能する領域に対向する部分がゲート電極3aとして機能する。なお、前記半導体層1中には従来同様にイオン注入が行われ、チャネル領域1a、ソース領域1b、ドレイン領域1cが形成される。ゲート電極(ソース線3)3aを覆って、酸化シリコン等からなる第一層間絶縁膜13を形成し、第一層間絶縁膜13上にドレイン電極17を形成する。なお、ドレイン電極17はコンタクトホール5,7を介して前記ドレイン領域1c及び前記電極形成層62に接続されるように形成する。   Next, as shown in FIG. 4D, the semiconductor layer 1 made of polysilicon is formed on the base protective film 15 by a conventionally known process, and the gate insulating film 14 is formed to cover the semiconductor layer 1. A source line 3 is formed on the gate insulating film 14. A portion of the source line 3 facing the region functioning as the channel region 1a of the semiconductor layer 1 through the gate insulating film 14 functions as the gate electrode 3a. It should be noted that ion implantation is performed in the semiconductor layer 1 in the same manner as in the prior art to form a channel region 1a, a source region 1b, and a drain region 1c. A first interlayer insulating film 13 made of silicon oxide or the like is formed so as to cover the gate electrode (source line 3) 3a, and a drain electrode 17 is formed on the first interlayer insulating film 13. The drain electrode 17 is formed so as to be connected to the drain region 1 c and the electrode formation layer 62 through contact holes 5 and 7.

次に図5(a)に示すように、前記ドレイン電極17を覆って、第二層間絶縁膜12を形成する。そして、コンタクトホール4を介してソース領域1bに接続されるようにしてデータ線6をパターン形成し、薄膜トランジスタ(TFT30)が形成される。   Next, as shown in FIG. 5A, a second interlayer insulating film 12 is formed so as to cover the drain electrode 17. Then, the data line 6 is patterned so as to be connected to the source region 1b through the contact hole 4, and a thin film transistor (TFT 30) is formed.

次に図5(b)に示すように、前記データ線6及び第二層間絶縁膜12を覆って、第三層間絶縁膜11を形成する。そして、第三層間絶縁膜11上にTFTアレイ基板10の基材としてガラス等の透光性材料からなる基板本体10Aを貼着する。   Next, as shown in FIG. 5B, a third interlayer insulating film 11 is formed so as to cover the data line 6 and the second interlayer insulating film 12. Then, a substrate body 10 </ b> A made of a translucent material such as glass is attached as a base material of the TFT array substrate 10 on the third interlayer insulating film 11.

なお、基板本体10Aとしては、上述したガラスに限らず、石英やホウ珪酸ガラス、ソーダライムガラス(青板ガラス)、クラウンガラス(白板ガラス)など、他の透光性材料を用いてもよい。本実施形態の液晶装置100は反射型のものであることから、基板本体10Aは透光性材料に限定されないことは当然である。   The substrate body 10A is not limited to the glass described above, and other translucent materials such as quartz, borosilicate glass, soda lime glass (blue plate glass), and crown glass (white plate glass) may be used. Since the liquid crystal device 100 of the present embodiment is of a reflective type, it is a matter of course that the substrate body 10A is not limited to a light transmissive material.

(支持基板の剥離工程)
TFT30の形成後、電極形成層62、薄膜トランジスタ(TFT30)、基板本体10Aを含む積層体40から前記支持基板60を剥離する。なお、前記積層体40を仮基板に接着した後に、支持基板から剥離するようにしてもよい。これによれば、前記支持基板60の剥離時に積層体40が破損するといった不具合を防止することができる。
(Support substrate peeling process)
After the formation of the TFT 30, the support substrate 60 is peeled from the laminate 40 including the electrode formation layer 62, the thin film transistor (TFT 30), and the substrate body 10A. The laminate 40 may be peeled off from the support substrate after being bonded to the temporary substrate. According to this, the malfunction that the laminated body 40 is damaged at the time of peeling of the said support substrate 60 can be prevented.

剥離工程では、アモルファスSi層61に対しレーザ光LAを照射する。ここで、上述したように支持基板60は光透過性基板から構成されているので、支持基板60を透過したレーザ光LAをアモルファスSi層61の全域に照射することができ、支持基板60の剥離が容易となる。   In the peeling process, the amorphous Si layer 61 is irradiated with laser light LA. Here, as described above, since the support substrate 60 is composed of a light-transmitting substrate, the entire area of the amorphous Si layer 61 can be irradiated with the laser light LA transmitted through the support substrate 60, and the support substrate 60 is peeled off. Becomes easy.

具体的には、図5(b)に示すように、アモルファスSi層61に対して、前記支持基板60の裏面側(前記積層体40の反対側)からレーザ光LAを照射する。温度条件としては550℃以下でレーザ照射を行うことが好ましい。これにより、アモルファスSi層61の原子や分子の結合が弱まり、あるいはアモルファスSi層61内の水素が分子化して結晶の結合から分離される。よって、支持基板60と積層体40との結合力が完全になくなり、支持基板60を容易に剥離することができる。   Specifically, as shown in FIG. 5B, the amorphous Si layer 61 is irradiated with laser light LA from the back surface side of the support substrate 60 (opposite side of the stacked body 40). As temperature conditions, laser irradiation is preferably performed at 550 ° C. or lower. Thereby, the bonds of atoms and molecules in the amorphous Si layer 61 are weakened, or the hydrogen in the amorphous Si layer 61 is molecularized and separated from the bonds of crystals. Therefore, the bonding force between the support substrate 60 and the laminate 40 is completely eliminated, and the support substrate 60 can be easily peeled off.

支持基板60を剥離した後、図5(c)に示すように積層体40を上下反転させる。これにより、電極形成層62が同図中で最上層に配置される。ここで、後工程のパターニングにより形成される画素電極の平坦性を向上させるため、前記電極形成層62をCMP(化学的機械的研磨)法を用いて研磨し、電極形成層62の平坦性をさらに高めるようにしてもよい。また、上記剥離工程時には、電極形成層62の表面にアモルファスSi層61の一部が残存する場合もある。この場合には、ドライエッチング又はウエットエッチング等によりアモルファスSi層61を除去しておくのが望ましい。   After the support substrate 60 is peeled off, the laminate 40 is turned upside down as shown in FIG. Thereby, the electrode formation layer 62 is arrange | positioned in the uppermost layer in the figure. Here, in order to improve the flatness of the pixel electrode formed by patterning in a later step, the electrode formation layer 62 is polished using a CMP (Chemical Mechanical Polishing) method, and the flatness of the electrode formation layer 62 is improved. You may make it raise further. In addition, during the peeling process, a part of the amorphous Si layer 61 may remain on the surface of the electrode forming layer 62. In this case, it is desirable to remove the amorphous Si layer 61 by dry etching or wet etching.

そこで、上記CMP法によって電極形成層62を研磨するとともに、残留しているアモルファスSi層61を除去するようにしてもよい。この構成によれば、電極形成層62の平坦性をさらに高めるとともに、残存したアモルファスSi層61を同時に除去することができるので、工程を不要に増加させること無く、高いコントラストを得る液晶装置を提供できる。   Therefore, the electrode forming layer 62 may be polished by the CMP method and the remaining amorphous Si layer 61 may be removed. According to this configuration, the flatness of the electrode forming layer 62 can be further improved, and the remaining amorphous Si layer 61 can be removed at the same time. Thus, a liquid crystal device that obtains high contrast without unnecessarily increasing the number of steps is provided. it can.

上記支持基板60の剥離工程後、前記電極形成層62を所定のパターン状に分割し、画素電極9を形成する。以下、画素電極9の形成工程について説明する。図6では、図4,5に比べて縮尺を縮小し、各画素領域に対応するTFT30に接続するドレイン電極17が電極形成層62に複数接続された状態を示している。   After the peeling process of the support substrate 60, the electrode forming layer 62 is divided into a predetermined pattern to form pixel electrodes 9. Hereinafter, the formation process of the pixel electrode 9 will be described. 6 shows a state in which the scale is reduced as compared with FIGS. 4 and 5, and a plurality of drain electrodes 17 connected to the TFT 30 corresponding to each pixel region are connected to the electrode formation layer 62. In FIG.

はじめに図6(a)に示すように、例えばマスクMを用いることでエッチングを行い、電極形成層62を各画素領域に対応する画素電極の形状にパターニングすることで、図6(b)に示す画素電極の基材部9aが形成される。   First, as shown in FIG. 6A, etching is performed by using, for example, a mask M, and the electrode forming layer 62 is patterned into the shape of the pixel electrode corresponding to each pixel region, so as shown in FIG. 6B. A base portion 9a of the pixel electrode is formed.

上述したように前記電極形成層62を高融点金属(W;タングステン)により形成している。本実施形態に係る液晶装置100は、反射型のものであることから、画素電極での反射率を高めるべく、画素電極の形成工程において、前記電極形成層62に比べて高い光反射性を有する反射膜でこの電極形成層62を覆うようにしている。これにより、画素電極9を構成する電極形成層62が光反射膜で覆われるので、平坦性及び光反射性の高い画素電極9が得られ、液晶装置100のコントラストを向上させることができる。   As described above, the electrode forming layer 62 is formed of a refractory metal (W: tungsten). Since the liquid crystal device 100 according to the present embodiment is of a reflective type, it has higher light reflectivity than the electrode formation layer 62 in the pixel electrode formation process in order to increase the reflectance at the pixel electrode. The electrode forming layer 62 is covered with a reflective film. Thereby, since the electrode forming layer 62 constituting the pixel electrode 9 is covered with the light reflecting film, the pixel electrode 9 having high flatness and high light reflecting property can be obtained, and the contrast of the liquid crystal device 100 can be improved.

具体的に本実施形態では、図6(c)に示すように電極形成層62をパターニングして、各画素電極に対応する基材部9aを形成した後、該基材部9aの表面にスパッタ等によりAlからなる反射膜9bを形成し、画素電極9が製造される。なお、反射膜9bの形成材料はAlの他にも、光反射性を有するAu、Ag等を例示することができる。この画素電極9は、非常に平坦性の高い基材部9aを主体として構成されているので、画素電極9自体も平坦性が高いものとなる。すなわち、画素電極9は平坦性が高く、その上面に設けられた反射膜9bによって高い反射率を備えたものとなっている。なお、上記実施形態では、電極形成層62をパターニングした後、反射膜9bを成膜しているが、電極形成層62上に反射膜9bを成膜した後、画素電極9を一括でパターニングすることで形成してもよい。   Specifically, in the present embodiment, as shown in FIG. 6C, the electrode forming layer 62 is patterned to form the base material portion 9a corresponding to each pixel electrode, and then the surface of the base material portion 9a is sputtered. The pixel electrode 9 is manufactured by forming the reflective film 9b made of Al or the like. In addition to Al, the material for forming the reflective film 9b can be exemplified by Au, Ag, etc. having light reflectivity. Since the pixel electrode 9 is mainly composed of the base portion 9a having very high flatness, the pixel electrode 9 itself has high flatness. That is, the pixel electrode 9 has high flatness, and has a high reflectance by the reflective film 9b provided on the upper surface thereof. In the above embodiment, the reflective film 9b is formed after the electrode forming layer 62 is patterned. However, after the reflective film 9b is formed on the electrode forming layer 62, the pixel electrodes 9 are patterned at once. You may form by.

画素電極9を形成した後、各画素電極9を覆うようにして配向膜を形成することでTTアレイ基板10を製造することができる。   After the pixel electrode 9 is formed, the TT array substrate 10 can be manufactured by forming an alignment film so as to cover each pixel electrode 9.

そして、従来と同様にして、対向基板20を形成し、該対向基板20とTFTアレイ基板10との間に液晶層50を充填するとともに、シール材25を介してこれら基板10,20を貼り合わせる。以上の工程により液晶装置100を製造することができる。   Then, in the same manner as in the prior art, the counter substrate 20 is formed, the liquid crystal layer 50 is filled between the counter substrate 20 and the TFT array substrate 10, and the substrates 10 and 20 are bonded together via the sealing material 25. . The liquid crystal device 100 can be manufactured through the above steps.

以上述べたように本実施形態の製造方法によれば、薄膜トランジスタ(TFT30)の積層工程に先んじて電極形成層62の形成工程が行われ、電極形成層62上にTFT30が積層されるので、該電極形成層62の形成時にTFT30の凹凸形状が影響を及ぼすことが無くなる。よって、電極形成層62は平坦性の高い層となり、この電極形成層62から構成される画素電極9の平坦性が向上し、これに伴って画素電極9の反射率を高めることができる。したがって、コントラストが高く、高信頼性の液晶装置100を提供できる。   As described above, according to the manufacturing method of the present embodiment, the electrode forming layer 62 is formed prior to the thin film transistor (TFT 30) stacking process, and the TFT 30 is stacked on the electrode forming layer 62. The uneven shape of the TFT 30 is not affected when the electrode formation layer 62 is formed. Therefore, the electrode forming layer 62 is a layer having high flatness, and the flatness of the pixel electrode 9 composed of the electrode forming layer 62 is improved. Accordingly, the reflectance of the pixel electrode 9 can be increased. Therefore, the liquid crystal device 100 with high contrast and high reliability can be provided.

図7は、上記製造工程により製造された液晶装置100の断面構造を示す図である。
図7に示すように、対向基板20はガラス等の透光性材料からなる基板本体とその液晶層50側表面に形成された共通電極21と配向膜22を主体として構成されている。また、共通電極21を覆うように、ラビング処理等の所定の配向処理が施された配向膜22が設けられている。また、TFTアレイ基板10の液晶層50側には、ラビング処理等の所定の配向処理が施された配向膜16が設けられている。なお、配向膜16、22の形成材料としては、ポリイミド等の有機材料に限定されず、SiO等の無機材料を用いてもよい。また、対向基板20の基板本体20Aの液晶層50と反対側(光入射面)に偏光子24が設けられている。
FIG. 7 is a diagram showing a cross-sectional structure of the liquid crystal device 100 manufactured by the manufacturing process.
As shown in FIG. 7, the counter substrate 20 is mainly composed of a substrate body made of a light-transmitting material such as glass, a common electrode 21 and an alignment film 22 formed on the surface of the liquid crystal layer 50 side. An alignment film 22 that has been subjected to a predetermined alignment process such as a rubbing process is provided so as to cover the common electrode 21. An alignment film 16 that has been subjected to a predetermined alignment process such as a rubbing process is provided on the liquid crystal layer 50 side of the TFT array substrate 10. The material for forming the alignment films 16 and 22 is not limited to an organic material such as polyimide, and an inorganic material such as SiO 2 may be used. Further, a polarizer 24 is provided on the opposite side (light incident surface) of the substrate body 20 </ b> A of the counter substrate 20 from the liquid crystal layer 50.

上述したように、TFTアレイ基板10と対向基板20との間には封入された液晶層50は、画素電極9からの電界が印加されていない状態で、配向膜16、22により所定の配向状態をとる。また、液晶層50としては、例えば正の誘電率異方性を有する液晶材料が用いた。なお、液晶モードとしては、TN(Twisted Nematic)モードのほか、VAN(Vertical Aligned Nematic)モード、STN(Super Twisted Nematic)モード、ECB(Electrically Controlled Birefringence)モード、OCB(Optical Compensated Bend)モード等を採用することができる。   As described above, the liquid crystal layer 50 sealed between the TFT array substrate 10 and the counter substrate 20 is in a predetermined alignment state by the alignment films 16 and 22 in a state where an electric field from the pixel electrode 9 is not applied. Take. For the liquid crystal layer 50, for example, a liquid crystal material having positive dielectric anisotropy is used. In addition to TN (Twisted Nematic) mode, VAN (Vertical Aligned Nematic) mode, STN (Super Twisted Nematic) mode, ECB (Electrically Controlled Birefringence) mode, OCB (Optical Compensated Bend) mode, etc. can do.

上述したように、TFTアレイ基板10は、支持基板60上に画素電極9を構成する基材部9aを形成した後、この基材部9a上にTFT30等を積層し、その後反転させることで製造される。したがって、図7に示したように、画素電極9の下層には、下地保護層15を介してポリシリコンからなる半導体層1が設けられている。この半導体層1は、TFT30の能動層をして機能するものであり、半導体層1内のドレイン領域1cに接続されたドレイン電極17がコンタクトホール7を介して画素電極9に電気的に接続されている。また、半導体層1の下層には、ゲート絶縁膜14を介してゲート電極3a(走査線3)が設けられている。すなわち、本実施形態に係る液晶装置100は、所謂ボトムゲート構造となっている。また、前記半導体層1のソース領域1bから下方に延出するデータ線6を備えている。データ線6とTFT30との間には、第一、第二層間絶縁膜13,12が設けられており、データ線6と基板本体10Aとの間には、第三層間絶縁膜11が設けられている。   As described above, the TFT array substrate 10 is manufactured by forming the base material portion 9 a constituting the pixel electrode 9 on the support substrate 60, laminating the TFT 30 or the like on the base material portion 9 a, and then inverting it. Is done. Therefore, as shown in FIG. 7, the semiconductor layer 1 made of polysilicon is provided below the pixel electrode 9 via the base protective layer 15. The semiconductor layer 1 functions as an active layer of the TFT 30, and the drain electrode 17 connected to the drain region 1 c in the semiconductor layer 1 is electrically connected to the pixel electrode 9 through the contact hole 7. ing. A gate electrode 3 a (scanning line 3) is provided below the semiconductor layer 1 via a gate insulating film 14. That is, the liquid crystal device 100 according to the present embodiment has a so-called bottom gate structure. A data line 6 extending downward from the source region 1b of the semiconductor layer 1 is also provided. First and second interlayer insulating films 13 and 12 are provided between the data line 6 and the TFT 30, and a third interlayer insulating film 11 is provided between the data line 6 and the substrate body 10A. ing.

なお、本発明は上記実施形態に限定されることはなく、発明の趣旨を逸脱しない範囲内において適宜変更が可能である。電気光学装置の一実施形態として、液晶装置を例に挙げて説明したが、これに限定されない。例えば、一方の基板側から入射した光を他方の基板で反射させ、反射光を用いて表示をなす電気光学装置に対しても適応することができ、この場合高い反射率を得ることができ、高コントラストの表示を得ることができる。   In addition, this invention is not limited to the said embodiment, In the range which does not deviate from the meaning of invention, it can change suitably. As an embodiment of the electro-optical device, the liquid crystal device has been described as an example, but the present invention is not limited to this. For example, light incident from one substrate side is reflected by the other substrate, and can be applied to an electro-optical device that performs display using the reflected light. In this case, a high reflectance can be obtained, A high-contrast display can be obtained.

液晶装置の概略構成を示す平面図である。It is a top view which shows schematic structure of a liquid crystal device. 図1中H−H´線矢視による液晶装置の断面図である。It is sectional drawing of the liquid crystal device by the HH 'line arrow in FIG. 液晶装置の等価回路を示す図である。It is a figure which shows the equivalent circuit of a liquid crystal device. 液晶装置の製造工程を説明するための図である。It is a figure for demonstrating the manufacturing process of a liquid crystal device. 図4に続く液晶装置の製造工程を説明するための図である。FIG. 5 is a diagram for explaining a manufacturing process for the liquid crystal device following FIG. 4. 図4に続く液晶装置の製造工程を説明するための図である。FIG. 5 is a diagram for explaining a manufacturing process for the liquid crystal device following FIG. 4. 本実施形態に係る製造方法によって得た液晶装置の側断面図である。It is a sectional side view of the liquid crystal device obtained by the manufacturing method concerning this embodiment.

符号の説明Explanation of symbols

9…画素電極、9b…反射膜、15…下地保護膜(絶縁層)、30…TFT(薄膜トランジスタ)、40…積層体、60…支持基板、61…アモルファスシリコン層(剥離層)、62…電極形成層、100…液晶装置(電気光学装置) DESCRIPTION OF SYMBOLS 9 ... Pixel electrode, 9b ... Reflective film, 15 ... Base protective film (insulating layer), 30 ... TFT (thin film transistor), 40 ... Laminated body, 60 ... Support substrate, 61 ... Amorphous silicon layer (peeling layer), 62 ... Electrode Formation layer, 100 ... Liquid crystal device (electro-optical device)

Claims (7)

支持基板上に剥離層を形成する工程と、
前記剥離層上に光反射性を有する電極形成層を形成する工程と、
前記電極形成層上に絶縁層を設け、該絶縁層上に前記電極形成層に導通する薄膜トランジスタを設ける工程と、
前記薄膜トランジスタの形成後、前記電極形成層及び前記薄膜トランジスタを含む積層体から前記支持基板を剥離する工程と、
前記該剥離工程後、前記電極形成層を所定のパターンに分割し、画素電極を形成する工程と、を備えることを特徴とする電気光学装置の製造方法。
Forming a release layer on the support substrate;
Forming an electrode forming layer having light reflectivity on the release layer;
Providing an insulating layer on the electrode forming layer, and providing a thin film transistor conducting to the electrode forming layer on the insulating layer;
After the formation of the thin film transistor, the step of peeling the support substrate from the laminate including the electrode formation layer and the thin film transistor;
And a step of dividing the electrode forming layer into a predetermined pattern and forming a pixel electrode after the peeling step.
前記電極形成層として、前記薄膜トランジスタ形成時の温度よりも高い融点を有する高融点金属を用いることを特徴とする請求項1に記載の電気光学装置の製造方法。   2. The method of manufacturing an electro-optical device according to claim 1, wherein a refractory metal having a melting point higher than a temperature at which the thin film transistor is formed is used as the electrode forming layer. 前記画素電極の形成工程において、前記電極形成層を、該電極形成層に比べて高い光反射性を有する反射膜で覆うことを特徴とする請求項1又は2に記載の電気光学装置の製造方法。   3. The method of manufacturing an electro-optical device according to claim 1, wherein, in the pixel electrode forming step, the electrode forming layer is covered with a reflective film having higher light reflectivity than the electrode forming layer. . 前記剥離層としてアモルファスシリコンを用い、該剥離層にレーザ光を照射することで前記積層体を前記支持基板から剥離することを特徴とする請求項1〜3のいずれか一項に記載の電気光学装置の製造方法。   The electro-optic according to any one of claims 1 to 3, wherein amorphous silicon is used as the release layer, and the laminate is peeled from the support substrate by irradiating the release layer with laser light. Device manufacturing method. 前記支持基板として、透光性材料からなるものを用いることを特徴とする請求項4に記載の電気光学装置の製造方法。   The method of manufacturing an electro-optical device according to claim 4, wherein the support substrate is made of a translucent material. 前記支持基板上の積層体を仮基板に接着した後に、支持基板から剥離することを特徴とする請求項1〜3のいずれか一項に記載の電気光学装置の製造方法。   The method for manufacturing an electro-optical device according to claim 1, wherein the laminate on the support substrate is bonded to a temporary substrate and then peeled off from the support substrate. 前記電極形成層を所定のパターンに分割するに先立ち、前記電極形成層を研磨する工程を有することを特徴とする請求項1〜6のいずれか一項に記載の電気光学装置の製造方法。   The method for manufacturing an electro-optical device according to claim 1, further comprising a step of polishing the electrode forming layer prior to dividing the electrode forming layer into a predetermined pattern.
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