JP2008134776A - 記憶制御装置及びその制御方法 - Google Patents
記憶制御装置及びその制御方法 Download PDFInfo
- Publication number
- JP2008134776A JP2008134776A JP2006319807A JP2006319807A JP2008134776A JP 2008134776 A JP2008134776 A JP 2008134776A JP 2006319807 A JP2006319807 A JP 2006319807A JP 2006319807 A JP2006319807 A JP 2006319807A JP 2008134776 A JP2008134776 A JP 2008134776A
- Authority
- JP
- Japan
- Prior art keywords
- controller
- storage
- data
- command
- host computer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
- G06F3/0601—Interfaces specially adapted for storage systems
- G06F3/0628—Interfaces specially adapted for storage systems making use of a particular technique
- G06F3/0662—Virtualisation aspects
- G06F3/0665—Virtualisation aspects at area level, e.g. provisioning of virtual or logical volumes
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
- G06F3/0601—Interfaces specially adapted for storage systems
- G06F3/0602—Interfaces specially adapted for storage systems specifically adapted to achieve a particular effect
- G06F3/061—Improving I/O performance
- G06F3/0611—Improving I/O performance in relation to response time
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
- G06F3/0601—Interfaces specially adapted for storage systems
- G06F3/0628—Interfaces specially adapted for storage systems making use of a particular technique
- G06F3/0655—Vertical data movement, i.e. input-output transfer; data movement between one or more hosts and one or more storage devices
- G06F3/0658—Controller construction arrangements
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
- G06F3/0601—Interfaces specially adapted for storage systems
- G06F3/0628—Interfaces specially adapted for storage systems making use of a particular technique
- G06F3/0655—Vertical data movement, i.e. input-output transfer; data movement between one or more hosts and one or more storage devices
- G06F3/0659—Command handling arrangements, e.g. command buffers, queues, command scheduling
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
- G06F3/0601—Interfaces specially adapted for storage systems
- G06F3/0668—Interfaces specially adapted for storage systems adopting a particular infrastructure
- G06F3/0671—In-line storage system
- G06F3/0673—Single storage device
- G06F3/0674—Disk device
- G06F3/0676—Magnetic disk device
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Human Computer Interaction (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Memory System Of A Hierarchy Structure (AREA)
Abstract
【解決手段】記憶制御装置に、ローカルメモリに保持したホスト計算機からのコマンドに基づいて、対応する論理ユニットに対するデータの入出力を制御する複数のコントローラを設け、ローカルメモリに、論理ユニット及びコントローラの対応関係を表す対応付け情報と、各コントローラ内のローカルメモリのアドレス情報とを格納し、コントローラが、ホスト計算機からのマンドを受信したときに、対象とする論理ユニットがいずれのコントローラと対応付けられているかを対応付け情報に基づいて判断し、他系のコントローラと対応付けられているときには、アドレス情報に基づいて、当該コマンドをそのコントローラ内のローカルメモリに転送し格納するようにした。
【選択図】図8
Description
(1−1)本実施の形態による記憶システムの構成
図1において、1は全体として本実施の形態による記憶システムを示す。この記憶システム1は、ホスト計算機2A,2Bが記憶制御装置3を介して複数の記憶装置4A〜4Dに接続されることにより構成されている。
(1−2−1)メモリ構成及びテーブル構成
次に、かかる記憶システム1の記憶制御装置3において行われるコマンド処理について説明する。
次に、記憶システム1におけるライトコマンド処理の具体的な処理内容について、図8〜図10を参照して説明する。ここでは、0系のコントローラ6Aがホスト計算機2Aからのライトコマンドを受信した場合について説明する。
次に、記憶システム1におけるリードコマンド処理について、図11〜図13を参照して説明する。ここでは、0系のコントローラ6Aがホスト計算機2Aからのリードコマンドを受信した場合について説明する。
次に、データ転送制御部11A,11B及びブリッジ13A,13Bに搭載されたアービトレーション(調停)機能について説明する。
以上のように本実施例の記憶システム1では、1系のコントローラ6Bを担当コントローラとする論理ユニットを対象としたライトコマンドやリードコマンドを0系のコントローラ6Aが受信した場合、0系のマイクロプロセッサ15Aがこのライトコマンド又はリードコマンドを1系のローカルメモリ14Bに転送して直接書き込むようにしているため、0系及び1系のコントローラ6A,6B間における当該ライトコマンド又はリードコマンドの受け渡しの際に0系及び1系のマイクロプロセッサ15A,15B間の通信が不要となる。
(2−1)本実施の形態によるライトコマンド処理及びリードコマンド処理
図14は、第2の実施の形態による記憶システム60を示す。この記憶システム60は、記憶制御装置61を構成する0系のコントローラ62A内のホスト通信制御部63Aに設けられたホスト通信プロトコルチップ63AがマルチCPUサポート機能を備えておらず、単一のマイクロプロセッサとのみデータ通信が可能な点を除いて第1の実施の形態による記憶システム1(図1)と同様に構成されている。
以上のように本実施の形態による記憶システム60では、0系及び1系のコントローラ62A,6B間において、ローカルメモリ14A,14Bを経由して必要な情報のやり取りを行なうため、0系のコントローラ62A内のホスト通信プロトコルチップ64AがマルチCPUサポート機能を備えていない場合であっても0系及び1系のコントローラ62A,6B間でライトコマンドやリードコマンドをやり取りすることができ、処理の高速化が図れる。
なお上述の第1及び第2の実施の形態においては、0系及び1系のコントローラ6A,62A,6Bのホスト通信制御部10A,62A,10Bとして、それぞれホスト計算機2A,2Bとの間で同じ通信プロトコルに従った通信を行なうホスト通信制御部10A,63A,10Bを適用するようにした場合について述べたが、本発明はこれに限らず、例えば0系のコントローラ6A,62A側にはホスト計算機2Aとの間でFCプロトコルに従った通信を行うマルチマイクロプロセッサ機能を備えるホスト通信制御部を適用し、1系のコントローラ6B側にはホスト計算機2Bとの間でiSCSIプロトコルに従った通信を行なうシングルマイクロプロセッサ機能を備えるホスト通信制御部を適用するようにしても良い。
Claims (12)
- 上位装置としてのホスト計算機と、前記ホスト計算機に対してデータを読み書きするための記憶領域でなる複数の論理ユニットを提供する記憶装置との間において、前記論理ユニットに対するデータの入出力を制御する記憶制御装置において、
前記ホスト計算機から与えられるコマンドを保持するローカルメモリを有し、当該ローカルメモリに保持した前記コマンドに基づいて、対応する前記論理ユニットに対するデータの入出力を制御する複数のコントローラと、
前記複数のコントローラ間を通信可能な状態に接続するコントローラ間接続経路と
を備え、
前記ローカルメモリには、
前記論理ユニット及び前記コントローラの対応関係を表す対応付け情報と、
自系及び他系の各前記コントローラ内の前記ローカルメモリのアドレス情報とが格納され、
前記コントローラは、
前記ホスト計算機から送信されたコマンドを受信したときに、対象とする前記論理ユニットが自系及び他系のいずれの前記コントローラと対応付けられているかを前記対応付け情報に基づいて判断し、当該論理ユニットが前記他系のコントローラと対応付けられているときには、前記アドレス情報に基づいて、当該コマンドを対応する前記他系のコントローラ内の前記ローカルメモリに転送して格納する
ことを特徴とする記憶制御装置。 - 前記ローカルメモリは、
前記自系のコントローラが受信した、当該自系のコントローラに対応付けられた前記論理ユニットを対象とする前記ホスト計算機からの前記コマンドを格納する第1の記憶領域と、前記他系のコントローラから転送された、前記自系のコントローラに対応付けられた前記論理ユニットを対象とする前記ホスト計算機からの前記コマンドを格納する第2の記憶領域とが別個に設けられた
ことを特徴とする請求項1に記載の記憶制御装置。 - 前記コントローラは、
前記ホスト計算機及び前記記憶装置間において送受されるデータを一時的に記憶するキャッシュメモリを備え、
前記キャッシュメモリには、
前記他系のコントローラのキャッシュメモリに格納されたデータが複写され、
前記コントローラは、
前記自系のコントローラの前記キャッシュメモリに複写されたデータを用いて、前記ホスト計算機と、前記自系のコントローラのキャッシュメモリとの間のデータ転送を制御する
ことを特徴とする請求項1記載の記憶制御装置。 - 前記キャッシュメモリは、
自系のコントローラが受信した前記ホスト計算機又は前記記憶装置からの前記データを格納する第1のデータ記憶領域と、前記他系のコントローラにより複写される前記データを格納する第2のデータ記憶領域とが別個に設けられた
ことを特徴とする請求項3に記載の記憶制御装置。 - 前記コントローラ間接続経路は、
PCI(Peripheral Component Interconnect)−Express規格に準拠したバスである
ことを特徴とする請求項1に記載の記憶制御装置。 - 前記コントローラは、
MSI(Message Signal Interrupt)を用いて前記他系のコントローラに必要な情報を通知する
ことを特徴とする請求項5に記載の記憶制御装置。 - 上位装置としてのホスト計算機と、前記ホスト計算機に対してデータを読み書きするための記憶領域でなる複数の論理ユニットを提供する記憶装置との間において、前記論理ユニットに対するデータの入出力を制御する記憶制御装置の制御方法において、
前記記憶制御装置は、
前記ホスト計算機から与えられるコマンドを保持するローカルメモリを有し、当該ローカルメモリに保持した前記コマンドに基づいて、対応する前記論理ユニットに対するデータの入出力を制御する複数のコントローラと、
前記複数のコントローラ間を通信可能な状態に接続するコントローラ間接続経路と
を備え、
前記ローカルメモリには、
前記論理ユニット及び前記コントローラの対応関係を表す対応付け情報と、
自系及び他系の各前記コントローラ内の前記ローカルメモリのアドレス情報とが格納され、
前記コントローラが、前記ホスト計算機から送信されたコマンドを受信したときに、対象とする前記論理ユニットが自系及び他系のいずれの前記コントローラと対応付けられているかを前記対応付け情報に基づいて判断する第1のステップと、
前記コントローラが、当該論理ユニットが前記他系のコントローラと対応付けられているときには、前記アドレス情報に基づいて、当該コマンドを対応する前記他系のコントローラ内の前記ローカルメモリに転送して格納する第2のステップと
を備えることを特徴とする記憶制御装置の制御方法。 - 前記ローカルメモリは、
前記自系のコントローラが受信した、当該自系のコントローラに対応付けられた前記論理ユニットを対象とする前記ホスト計算機からの前記コマンドを格納する第1の記憶領域と、前記他系のコントローラから転送された、前記自系のコントローラに対応付けられた前記論理ユニットを対象とする前記ホスト計算機からの前記コマンドを格納する第2の記憶領域とが別個に設けられた
ことを特徴とする請求項7に記載の記憶制御装置の制御方法。 - 前記コントローラは、
前記ホスト計算機及び前記記憶装置間において送受されるデータを一時的に記憶するキャッシュメモリを備え、
前記キャッシュメモリには、
前記他系のコントローラのキャッシュメモリに格納されたデータが複写され、
前記コントローラが、前記自系のコントローラの前記キャッシュメモリに複写されたデータを用いて、前記ホスト計算機と、前記自系のコントローラのキャッシュメモリとの間のデータ転送を制御する第3のステップと
を備えることを特徴とする請求項8記載の記憶制御装置の制御方法。 - 前記キャッシュメモリは、
自系のコントローラが受信した前記ホスト計算機又は前記記憶装置からの前記データを格納する第1のデータ記憶領域と、前記他系のコントローラにより複写される前記データを格納する第2のデータ記憶領域とが別個に設けられた
ことを特徴とする請求項9に記載の記憶制御装置の制御方法。 - 前記コントローラ間接続経路は、
PCI(Peripheral Component Interconnect)−Express規格に準拠したバスである
ことを特徴とする請求項10に記載の記憶制御装置の制御方法。 - 前記コントローラは、
MSI(Message Signal Interrupt)を用いて前記他系のコントローラに必要な情報を通知する
ことを特徴とする請求項11に記載の記憶制御装置の制御方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006319807A JP5057755B2 (ja) | 2006-11-28 | 2006-11-28 | 記憶制御装置及びその制御方法 |
US11/698,022 US7849260B2 (en) | 2006-11-28 | 2007-01-26 | Storage controller and control method thereof |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2006319807A JP5057755B2 (ja) | 2006-11-28 | 2006-11-28 | 記憶制御装置及びその制御方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2008134776A true JP2008134776A (ja) | 2008-06-12 |
JP5057755B2 JP5057755B2 (ja) | 2012-10-24 |
Family
ID=39465127
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006319807A Expired - Fee Related JP5057755B2 (ja) | 2006-11-28 | 2006-11-28 | 記憶制御装置及びその制御方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US7849260B2 (ja) |
JP (1) | JP5057755B2 (ja) |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8190815B2 (en) | 2008-08-21 | 2012-05-29 | Hitachi, Ltd. | Storage subsystem and storage system including storage subsystem |
JP2012524929A (ja) * | 2009-09-29 | 2012-10-18 | 株式会社日立製作所 | ストレージサブシステム |
JP2012531656A (ja) * | 2009-11-10 | 2012-12-10 | 株式会社日立製作所 | 複数のコントローラを備えたストレージシステム |
JP2014182755A (ja) * | 2013-03-21 | 2014-09-29 | Fujitsu Ltd | 制御装置、ストレージシステム、及び制御プログラム |
JP2015520425A (ja) * | 2012-05-18 | 2015-07-16 | 株式会社日立製作所 | 計算機システム及びその制御方法 |
JP2019204463A (ja) * | 2018-05-25 | 2019-11-28 | 株式会社日立製作所 | ストレージシステム及びその制御方法 |
Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101396976B1 (ko) * | 2007-07-26 | 2014-05-20 | 엘지전자 주식회사 | 영상기기 및 영상기기에서 디스플레이 특성 항목들을조절하는 방법 |
US8671258B2 (en) * | 2009-03-27 | 2014-03-11 | Lsi Corporation | Storage system logical block address de-allocation management |
US8463976B2 (en) * | 2009-06-23 | 2013-06-11 | Lg Electronics Inc. | Dual modem device and controlling method thereof |
WO2010150308A1 (en) * | 2009-06-23 | 2010-12-29 | Hitachi, Ltd. | Storage apparatus and method for controlling storage apparatus |
JP2012133405A (ja) * | 2009-07-24 | 2012-07-12 | Hitachi Ltd | ストレージ装置及びそのデータ転送制御方法 |
WO2011141956A1 (en) * | 2010-05-11 | 2011-11-17 | Hitachi, Ltd. | Storage device and method of controlling storage device |
US10034300B2 (en) * | 2010-06-10 | 2018-07-24 | Cisco Technology, Inc | Load based probe response scheduling |
WO2014076732A1 (en) * | 2012-11-13 | 2014-05-22 | Hitachi, Ltd. | Storage apparatus, network interface apparatus, and storage control method |
JP2015169956A (ja) * | 2014-03-04 | 2015-09-28 | 富士通株式会社 | ストレージ装置、情報処理装置、キャッシュ制御プログラム及びキャッシュ制御方法 |
US9807813B2 (en) | 2015-04-15 | 2017-10-31 | Cisco Technology, Inc. | Probe response suppression |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09146842A (ja) * | 1995-11-20 | 1997-06-06 | Hitachi Ltd | 記憶サブシステム |
JP2006285778A (ja) * | 2005-04-01 | 2006-10-19 | Hitachi Ltd | ストレージシステム及び記憶制御方法 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5790775A (en) * | 1995-10-23 | 1998-08-04 | Digital Equipment Corporation | Host transparent storage controller failover/failback of SCSI targets and associated units |
US5822251A (en) * | 1997-08-25 | 1998-10-13 | Bit Microsystems, Inc. | Expandable flash-memory mass-storage using shared buddy lines and intermediate flash-bus between device-specific buffers and flash-intelligent DMA controllers |
US5975738A (en) * | 1997-09-30 | 1999-11-02 | Lsi Logic Corporation | Method for detecting failure in redundant controllers using a private LUN |
JP4272275B2 (ja) | 1998-04-28 | 2009-06-03 | 株式会社日立製作所 | 記憶サブシステム |
AU4334099A (en) * | 1998-06-05 | 1999-12-20 | Mylex Corporation | Apparatus, system and method for n-way raid controller |
US7315911B2 (en) * | 2005-01-20 | 2008-01-01 | Dot Hill Systems Corporation | Method for efficient inter-processor communication in an active-active RAID system using PCI-express links |
JP2008134775A (ja) * | 2006-11-28 | 2008-06-12 | Hitachi Ltd | 記憶サブシステム及びこれを利用したリモートコピーシステム |
-
2006
- 2006-11-28 JP JP2006319807A patent/JP5057755B2/ja not_active Expired - Fee Related
-
2007
- 2007-01-26 US US11/698,022 patent/US7849260B2/en not_active Expired - Fee Related
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09146842A (ja) * | 1995-11-20 | 1997-06-06 | Hitachi Ltd | 記憶サブシステム |
JP2006285778A (ja) * | 2005-04-01 | 2006-10-19 | Hitachi Ltd | ストレージシステム及び記憶制御方法 |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8190815B2 (en) | 2008-08-21 | 2012-05-29 | Hitachi, Ltd. | Storage subsystem and storage system including storage subsystem |
JP2012524929A (ja) * | 2009-09-29 | 2012-10-18 | 株式会社日立製作所 | ストレージサブシステム |
JP2012531656A (ja) * | 2009-11-10 | 2012-12-10 | 株式会社日立製作所 | 複数のコントローラを備えたストレージシステム |
JP2015520425A (ja) * | 2012-05-18 | 2015-07-16 | 株式会社日立製作所 | 計算機システム及びその制御方法 |
JP2014182755A (ja) * | 2013-03-21 | 2014-09-29 | Fujitsu Ltd | 制御装置、ストレージシステム、及び制御プログラム |
JP2019204463A (ja) * | 2018-05-25 | 2019-11-28 | 株式会社日立製作所 | ストレージシステム及びその制御方法 |
Also Published As
Publication number | Publication date |
---|---|
JP5057755B2 (ja) | 2012-10-24 |
US7849260B2 (en) | 2010-12-07 |
US20080126668A1 (en) | 2008-05-29 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP5057755B2 (ja) | 記憶制御装置及びその制御方法 | |
JP2008134775A (ja) | 記憶サブシステム及びこれを利用したリモートコピーシステム | |
JP4219602B2 (ja) | 記憶制御装置および記憶制御装置の制御方法 | |
US7127557B2 (en) | RAID apparatus and logical device expansion method thereof | |
JP4958641B2 (ja) | 記憶制御装置及びその制御方法 | |
US8074017B2 (en) | On-disk caching for raid systems | |
JP5512833B2 (ja) | ストレージの仮想化機能と容量の仮想化機能との両方を有する複数のストレージ装置を含んだストレージシステム | |
WO2013046254A1 (en) | Management server and data migration method | |
US20110167189A1 (en) | Storage apparatus and its data transfer method | |
US8190815B2 (en) | Storage subsystem and storage system including storage subsystem | |
WO2012017493A1 (ja) | 計算機システム及びデータ移行方法 | |
JP2008181382A (ja) | ストレージ装置及び負荷分散方法 | |
US11782634B2 (en) | Dynamic use of non-volatile ram as memory and storage on a storage system | |
JP6649989B2 (ja) | ストレージシステム及びその制御方法 | |
JP2009211401A (ja) | ストレージ装置及びその制御方法 | |
WO2018051505A1 (ja) | ストレージシステム | |
US10831684B1 (en) | Kernal driver extension system and method | |
WO2017124948A1 (zh) | 一种数据备份的方法及装置 | |
EP2093656B1 (en) | Storage system and access instruction sending method | |
WO2016194162A1 (ja) | 計算機システム | |
JP6013609B2 (ja) | ストレージ装置及びデータ入出力方法 | |
JP6825263B2 (ja) | ストレージ制御装置、およびストレージシステム | |
US20120185554A1 (en) | Data transfer device and data transfer method | |
JP6981019B2 (ja) | ストレージ装置、ストレージシステム、ストレージ装置の制御方法、プログラム | |
JP2009217700A (ja) | ディスクアレイ装置及び物理配置最適化方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20090220 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20090812 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20110905 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20111004 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20120703 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20120731 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20150810 Year of fee payment: 3 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 Ref document number: 5057755 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
LAPS | Cancellation because of no payment of annual fees |