JP2007134594A - Common mode choke coil - Google Patents

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Kazunari Tanaka
一成 田中
Takahiro Azuma
貴博 東
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a common mode choke coil with both of common mode noise suppressing function and AC coupling function and mountable by utilizing a land provided in a high-speed digital differential line of an existing substrate. <P>SOLUTION: A coil unit 2 is formed of first and second coil conductors 21, 22 of lateral winding structure and a magnetic body 23; and a first capacitor unit 3 is formed of a first capacitor conductor 31, a second capacitor conductor 32, and a dielectric body 33. Further, a second capacitor unit 4 is formed of a first capacitor conductor 41, second capacitor conductor 42, and a dielectric body 43. In this case, the common mode choke coil 1 is structured so that the coil unit 2 is interposed between the first capacitor unit 3 and the second capacitor unit 4. Preferably, the second capacitor conductors 32, 42 of the first and second capacitor units 3, 4 are constituted so as to be hidden by the first capacitor conductors 31, 41 with respect to the coil unit 2. <P>COPYRIGHT: (C)2007,JPO&INPIT

Description

この発明は、高速差動伝送線路上のコモンモードノイズを除去するためのコモンモードチョークコイルに関するものである。   The present invention relates to a common mode choke coil for removing common mode noise on a high-speed differential transmission line.

従来、この種のコモンモードチョークコイルとしては、例えば特許文献1に開示の技術がある。
このコモンモードチョークコイルは、複数のスパイラル導体を複数の絶縁層を介して積層し、この積層体を1対の磁性体基板で挟み込んだ構成を成す。これにより、複数のスパイラル導体で1次コイルと2次コイルとを形成し、これら1次及び2次コイルに侵入してきたコモンモードノイズを、これらコイルのインピーダンスによって反射及び減衰させる。
Conventionally, as this type of common mode choke coil, for example, there is a technique disclosed in Patent Document 1.
The common mode choke coil has a configuration in which a plurality of spiral conductors are stacked via a plurality of insulating layers, and the stacked body is sandwiched between a pair of magnetic substrates. Thereby, a primary coil and a secondary coil are formed by a plurality of spiral conductors, and common mode noise that has entered the primary and secondary coils is reflected and attenuated by the impedance of these coils.

特開2005−85997号公報JP 2005-85997 A

しかし、上記した従来の技術では、次のような問題がある。
一般に、S−ATA(Serial AT Attachment )やPCI−express等の高速デジタル差動線路では、直流電気成分をカットするために、ACカップリングコンデンサの実装が必須である。ところが、このような線路を備えた既成の基板では、コモンモードノイズ等の除去を前提とした線路構成になっていないものが多い。このため、上記の如き従来のコモンモードチョークコイルをこのような既成の基板の線路に実装しなければならない場合には、ACカップリングコンデンサ用のランドの他に、コモンモードチョークコイル用のランドを線路上にさらに作成しなければならず、実装作業に多くの手間と時間を要してしまう。
However, the conventional techniques described above have the following problems.
In general, in a high-speed digital differential line such as S-ATA (Serial AT Attachment) or PCI-express, it is essential to mount an AC coupling capacitor in order to cut a DC electric component. However, many of the existing substrates equipped with such a line do not have a line configuration based on the premise of removing common mode noise or the like. For this reason, when the conventional common mode choke coil as described above must be mounted on such a line on an existing substrate, a land for the common mode choke coil is provided in addition to the land for the AC coupling capacitor. It must be further created on the track, and much labor and time are required for the mounting work.

この発明は、上述した課題を解決するためになされたもので、コモンモードノイズ除去機能とACカップリング機能とを兼ね備え、既成の基板の高速デジタル差動線路に設けられているランドを利用して実装可能なコモンモードチョークコイルを提供することを目的とする。   The present invention has been made to solve the above-described problems, and has a common mode noise removal function and an AC coupling function, and uses a land provided on a high-speed digital differential line on an existing substrate. An object is to provide a mountable common mode choke coil.

上記課題を解決するために、請求項1の発明は、第1コイル導体及び第2コイル導体とを磁性体で被覆して形成したコイル部と、互いに対向する第1キャパシタ導体及び第2キャパシタ導体を誘電体で被覆してそれぞれ形成した第1及び第2のコンデンサ部とを備えるコモンモードチョークコイルであって、第1のコンデンサ部を、コイル部の第1コイル導体に直列に接続すると共に、第2のコンデンサ部を、コイル部の第2コイル導体に直列に接続した構成とする。
かかる構成により、第1のコンデンサ部の一方の端子とコイル部の第1コイル導体の一方の端子を、高速差動伝送路の一方の線路の1対のランドにそれぞれ接続し、第2のコンデンサ部の一方の端子とコイル部の第2コイル導体の一方の端子を、高速差動伝送路の他方の線路の1対のランドにそれぞれ接続することができる。すると、高速差動伝送路に侵入したコモンモードノイズが、第1コイル導体及び第2コイル導体とを磁性体で被覆した構造のコイル部によって反射及び減衰される。また、上記一方又は他方の線路上の電気的な直流成分は、第1キャパシタ導体及び第2キャパシタ導体を誘電体で被覆した構造の第1又は第2のコンデンサ部のACカップリング機能によってカットされる。
In order to solve the above-mentioned problems, the invention of claim 1 is directed to a coil portion formed by coating a first coil conductor and a second coil conductor with a magnetic material, and a first capacitor conductor and a second capacitor conductor facing each other. A common mode choke coil comprising first and second capacitor portions formed by coating with a dielectric, respectively, wherein the first capacitor portion is connected in series to the first coil conductor of the coil portion, and The second capacitor unit is connected in series to the second coil conductor of the coil unit.
With this configuration, one terminal of the first capacitor unit and one terminal of the first coil conductor of the coil unit are respectively connected to a pair of lands on one line of the high-speed differential transmission path, and the second capacitor One terminal of the second portion and one terminal of the second coil conductor of the coil portion can be connected to a pair of lands on the other line of the high-speed differential transmission path, respectively. Then, the common mode noise that has entered the high-speed differential transmission path is reflected and attenuated by the coil portion having a structure in which the first coil conductor and the second coil conductor are covered with a magnetic material. In addition, the electrical DC component on the one or the other line is cut by the AC coupling function of the first or second capacitor portion having a structure in which the first capacitor conductor and the second capacitor conductor are covered with a dielectric. The

請求項2の発明は、請求項1に記載のコモンモードチョークコイルにおいて、コイル部を第1のコンデンサ部上に積層し、第2のコンデンサ部をコイル部の上に積層して、コイル部を第1及び第2のコンデンサ部の間に介在させた構成とする。
かかる構成により、第1のコンデンサ部と第2のコンデンサ部との間や各コンデンサ部とコイル部との間に発生する不要な浮遊容量が低減される。
The invention of claim 2 is the common mode choke coil according to claim 1, wherein the coil portion is laminated on the first capacitor portion, the second capacitor portion is laminated on the coil portion, and the coil portion is It is configured to be interposed between the first and second capacitor portions.
With such a configuration, unnecessary stray capacitance generated between the first capacitor unit and the second capacitor unit or between each capacitor unit and the coil unit is reduced.

請求項3の発明は、請求項2に記載のコモンモードチョークコイルにおいて、第1及び第2コイル導体の磁極が第1及び第2のコンデンサ部側を向かないように、第1及び第2コイル導体を横巻構造にした構成とする。
かかる構成により、第1及び第2コイル導体の磁界が、第1及び第2のコンデンサ部によって妨げられずに、一方の磁極から他方の磁極までループする。
According to a third aspect of the present invention, in the common mode choke coil according to the second aspect, the first and second coils are arranged so that the magnetic poles of the first and second coil conductors do not face the first and second capacitor portions. The conductor has a horizontal winding structure.
With this configuration, the magnetic fields of the first and second coil conductors are looped from one magnetic pole to the other magnetic pole without being blocked by the first and second capacitor portions.

請求項4の発明は、請求項2又は請求項3のいずれかに記載のコモンモードチョークコイルにおいて、第1キャパシタ導体は、等間隔で積層され且つ同一縁部が接続された複数の導体板で成り、第2キャパシタ導体は、第1キャパシタ導体の複数の導体板と交互に配され延出した各端部が誘電体から露出した複数の導体板で成り、第1のコンデンサ部は、コイル部の第1コイル導体の一方端部に接続された第1キャパシタ導体と、各導体板がコイル部に対して第1キャパシタ導体の各導体板の下側に隠れる第2キャパシタ導体とで成り、第2のコンデンサ部は、コイル部の第2コイル導体の一方端部に接続された第1キャパシタ導体と、各導体板がコイル部に対して第1キャパシタ導体の各導体板の上側に隠れる第2キャパシタ導体とで成る構成とした。
かかる構成により、第1のコンデンサ部の第2キャパシタ導体がコイル部に対して第1キャパシタ導体の各導体板の下側に隠れ、第2のコンデンサ部の第2キャパシタ導体がコイル部に対して第1キャパシタ導体の各導体板の上側に隠れるので、不要な浮遊容量が第1のコンデンサ部の第2キャパシタ導体と第2のコンデンサ部の第1キャパシタ導体との間や、第2のコンデンサ部の第2キャパシタ導体と第1のコンデンサ部の第1キャパシタ導体との間においても生ぜず、この結果、静電結合の抑制をより高めることができる。
According to a fourth aspect of the present invention, in the common mode choke coil according to the second or third aspect, the first capacitor conductor is a plurality of conductor plates that are stacked at equal intervals and connected at the same edge. And the second capacitor conductor is composed of a plurality of conductor plates each of which is alternately arranged and extended with a plurality of conductor plates of the first capacitor conductor and exposed from the dielectric, and the first capacitor portion includes a coil portion. A first capacitor conductor connected to one end of the first coil conductor, and a second capacitor conductor in which each conductor plate is hidden below each conductor plate of the first capacitor conductor with respect to the coil portion. The second capacitor portion includes a first capacitor conductor connected to one end of the second coil conductor of the coil portion, and a second capacitor plate hidden on the upper side of each conductor plate of the first capacitor conductor with respect to the coil portion. Consisting of capacitor conductor It was formed.
With this configuration, the second capacitor conductor of the first capacitor portion is hidden under the respective conductor plates of the first capacitor conductor with respect to the coil portion, and the second capacitor conductor of the second capacitor portion is hidden with respect to the coil portion. Since it is hidden above each conductor plate of the first capacitor conductor, unnecessary stray capacitance is generated between the second capacitor conductor of the first capacitor section and the first capacitor conductor of the second capacitor section, or in the second capacitor section. This also does not occur between the second capacitor conductor and the first capacitor conductor of the first capacitor section, and as a result, the suppression of electrostatic coupling can be further enhanced.

以上詳しく説明したように、この発明のコモンモードチョークコイルによれば、高速差動伝送路に侵入したコモンモードノイズを減衰させるコモンモードノイズ除去機能と電気的な直流成分をカットするACカップリング機能との両機能を兼ね備えているので、既成の基板の高速差動線路に設けられているランドを利用して実装することができ、上記した従来のコモンモードチョークコイルのように、ACカップリングコンデンサ用のランドの他に、コモンモードチョークコイル用のランドをさらに線路上に作成する必要がなく、この結果、実装作業の省力化と短時間化とを図ることができるという優れた効果がある。   As described above in detail, according to the common mode choke coil of the present invention, the common mode noise elimination function that attenuates the common mode noise that has entered the high-speed differential transmission path and the AC coupling function that cuts the electrical DC component. Can be mounted using a land provided on a high-speed differential line on an existing substrate, and an AC coupling capacitor like the above-described conventional common mode choke coil. There is no need to create a land for the common mode choke coil on the line in addition to the land for use, and as a result, there is an excellent effect that the labor of the mounting work can be saved and the time can be shortened.

特に、請求項2の発明によれば、コイル部を第1及び第2のコンデンサ部の間に介在させて、第1のコンデンサ部と第2のコンデンサ部との間や各コンデンサ部とコイル部との間に発生する不要な浮遊容量を低減するので、線路間の静電結合が抑制され、線路間のインピーダンスの変動が減少する。この結果、伝送する信号の高周波成分が反射することなく線路上を伝達し、信号波形のひずみがほとんどない高品質の信号を伝送することができるという効果がある。   In particular, according to the invention of claim 2, the coil portion is interposed between the first and second capacitor portions, and between the first capacitor portion and the second capacitor portion, or between each capacitor portion and the coil portion. Since unnecessary stray capacitance generated between the lines is reduced, electrostatic coupling between the lines is suppressed, and fluctuations in impedance between the lines are reduced. As a result, there is an effect that it is possible to transmit a high-quality signal with almost no distortion of the signal waveform by transmitting on the line without reflection of the high-frequency component of the signal to be transmitted.

また、請求項3の発明によれば、コイル部の第1及び第2コイル導体を横巻構造にして、磁界が第1及び第2のコンデンサ部によって妨げられずに、一方の磁極から他方の磁極までループするようにしたので、コモンモードノイズの抑制効果をさらに高めることができるという効果がある。   According to a third aspect of the present invention, the first and second coil conductors of the coil portion are horizontally wound so that the magnetic field is not hindered by the first and second capacitor portions and from one magnetic pole to the other. Since the loop to the magnetic pole is made, the effect of suppressing the common mode noise can be further enhanced.

さらに、請求項4の発明によれば、不要な浮遊容量が第1のコンデンサの第2キャパシタ導体とコイル部2との間や、第2のコンデンサ部の第2キャパシタ導体とコイル部2との間に生じない構造にしたので、線路間の静電結合の抑制をより高めることができ、より高品質の信号伝送を可能にする。   Furthermore, according to the invention of claim 4, unnecessary stray capacitance is generated between the second capacitor conductor of the first capacitor and the coil part 2, or between the second capacitor conductor of the second capacitor part and the coil part 2. Since the structure does not occur in the middle, the suppression of electrostatic coupling between lines can be further increased, and higher-quality signal transmission is possible.

以下、この発明の最良の形態について図面を参照して説明する。   The best mode of the present invention will be described below with reference to the drawings.

図1は、この発明の一実施例に係るコモンモードチョークコイルの斜視図であり、図2は、図1に示したコモンモードチョークコイルの内部を透過して示す斜視図であり、図3は、コモンモードチョークコイルの等価回路図である。   FIG. 1 is a perspective view of a common mode choke coil according to an embodiment of the present invention, FIG. 2 is a perspective view showing the inside of the common mode choke coil shown in FIG. 1, and FIG. FIG. 3 is an equivalent circuit diagram of a common mode choke coil.

図1に示すように、この実施例のコモンモードチョークコイル1は、コイル部2を第1のコンデンサ部3上に積層し、第2のコンデンサ部4をこのコイル部2の上に積層した構造を成す。すなわち、コモンモードチョークコイル1は、コイル部2を第1及び第2のコンデンサ部3,4の間に介在させたチップ体であり、その外側に4つの外部電極5−1〜5−4を有している。   As shown in FIG. 1, the common mode choke coil 1 of this embodiment has a structure in which a coil portion 2 is laminated on a first capacitor portion 3 and a second capacitor portion 4 is laminated on the coil portion 2. Is made. That is, the common mode choke coil 1 is a chip body in which the coil portion 2 is interposed between the first and second capacitor portions 3 and 4, and four external electrodes 5-1 to 5-4 are provided outside thereof. Have.

コイル部2は、コモンモードノイズを除去するためのコイル部分であり、図2に示すように、第1コイル導体21と第2コイル導体22とこれら第1及び第2コイル導体21,22を被覆した磁性体23とで形成されている。なお、図2において、第1コイル導体21と第2コイル導体22との区別を容易にするため、第2コイル導体22を示す線を第1コイル導体21を示す線よりも太く表現しているが、第1コイル導体21と第2コイル導体22との実際の線径は同じである。   The coil part 2 is a coil part for removing common mode noise. As shown in FIG. 2, the coil part 2 covers the first coil conductor 21, the second coil conductor 22, and the first and second coil conductors 21 and 22. The magnetic body 23 is formed. In FIG. 2, in order to easily distinguish the first coil conductor 21 and the second coil conductor 22, the line indicating the second coil conductor 22 is expressed thicker than the line indicating the first coil conductor 21. However, the actual wire diameters of the first coil conductor 21 and the second coil conductor 22 are the same.

第1コイル導体21は、外端部21aを磁性体23の側面(図2の右側面)に露出させたスパイラル状の導体であり、第2コイル導体22も、その外端部22aを磁性体23の側面(図2の右側面)に露出させたスパイラル状の導体である。
図4は、第1コイル導体21と第2コイル導体22とを分離して示す斜視図である。
図4に示すように、第1コイル導体21(第2コイル導体22)は、磁極21A,21B(22A,22B)が横向きの横巻構造を成し、矢印で示すように、第1コイル導体21が第2コイル導体22の間隙に入り込んで、第1及び第2コイル導体21,22全体が二重巻線状態を成す。すなわち、図2に示すように、第1及び第2コイル導体21,22の磁極21A,21B及び22A,22B(図2の右,左の磁極)が第1及び第2のコンデンサ部3,4側を向かないように、第1及び第2コイル導体21,22の巻方向を横方向に設定している。
The first coil conductor 21 is a spiral conductor in which the outer end 21a is exposed on the side surface (right side in FIG. 2) of the magnetic body 23, and the second coil conductor 22 also has the outer end 22a connected to the magnetic body. This is a spiral conductor exposed on the side surface of 23 (the right side surface in FIG. 2).
FIG. 4 is a perspective view showing the first coil conductor 21 and the second coil conductor 22 separately.
As shown in FIG. 4, the first coil conductor 21 (second coil conductor 22) has a horizontal winding structure in which the magnetic poles 21A and 21B (22A and 22B) are horizontally oriented. 21 enters the gap between the second coil conductors 22, and the entire first and second coil conductors 21 and 22 form a double winding state. That is, as shown in FIG. 2, the magnetic poles 21A, 21B and 22A, 22B (the right and left magnetic poles in FIG. 2) of the first and second coil conductors 21 and 22 are the first and second capacitor portions 3, 4 respectively. The winding direction of the first and second coil conductors 21 and 22 is set to the lateral direction so as not to face the side.

第1のコンデンサ部3は、線路上の直流成分をカットするための部分であり、対向するように組み込まれた第1キャパシタ導体31及び第2キャパシタ導体32と、これら第1及び第2キャパシタ導体31,32を被覆した誘電体33とで構成されている。   The first capacitor unit 3 is a part for cutting a DC component on the line, and includes a first capacitor conductor 31 and a second capacitor conductor 32 which are incorporated so as to face each other, and the first and second capacitor conductors. It is comprised with the dielectric 33 which coat | covered 31 and 32. FIG.

図5は、第1キャパシタ導体31と第2キャパシタ導体32とを分離して示す斜視図である。
図5に示すように、第1キャパシタ導体31は、3枚の同形の導体板31a〜31cを等間隔で積層し、これら3枚の導体板31a〜31cの同一縁部を縦状の導体板31dで接続して形成した。
一方、第2キャパシタ導体32は、3枚の同形の導体板32a〜32cを等間隔で積層し、これら3枚の導体板32a〜32cを第1キャパシタ導体31の導体板31a〜31cの間に配して形成した。具体的には、第2キャパシタ導体32の各導体板32c(32b,32a)が、コイル部2(図2参照)に対して第1キャパシタ導体31の導体板31c(31b,31a)の下側に位置するように、導体板32a〜32cを導体板31a〜31cと交互に配した。
そして、図2に示すように、第1キャパシタ導体31の導体板31cを、第1コイル導体21の一方端部21bに接続し、第2キャパシタ導体32の導体板32a〜32cの延出端部32a′〜32c′を誘電体33の側面に露出させている。
すなわち、図3に示すように、第1のコンデンサ部3を、コイル部2の第1コイル導体21と直列に接続した。
FIG. 5 is a perspective view showing the first capacitor conductor 31 and the second capacitor conductor 32 separately.
As shown in FIG. 5, the first capacitor conductor 31 is formed by laminating three identical conductor plates 31a to 31c at equal intervals, and the same edge portion of the three conductor plates 31a to 31c is a vertical conductor plate. Connected at 31d.
On the other hand, the second capacitor conductor 32 is formed by laminating three identical conductor plates 32 a to 32 c at equal intervals, and the three conductor plates 32 a to 32 c are disposed between the conductor plates 31 a to 31 c of the first capacitor conductor 31. Formed. Specifically, each conductor plate 32c (32b, 32a) of the second capacitor conductor 32 is below the conductor plate 31c (31b, 31a) of the first capacitor conductor 31 with respect to the coil portion 2 (see FIG. 2). The conductor plates 32a to 32c are alternately arranged with the conductor plates 31a to 31c so as to be positioned at the positions.
Then, as shown in FIG. 2, the conductor plate 31 c of the first capacitor conductor 31 is connected to one end portion 21 b of the first coil conductor 21, and the extended end portions of the conductor plates 32 a to 32 c of the second capacitor conductor 32. 32 a ′ to 32 c ′ are exposed on the side surface of the dielectric 33.
That is, as shown in FIG. 3, the first capacitor unit 3 was connected in series with the first coil conductor 21 of the coil unit 2.

このような第1キャパシタ導体31と第2キャパシタ導体32とにおいては、不要な浮遊容量の発生を抑制するための工夫がされている。
図6は、第1のコンデンサ部3の要部を示す平面図である。
図6に示すように、第1キャパシタ導体31の各導体板31c(31b,31a)の幅w1を第2キャパシタ導体32の各導体板32c(32b,32a)の幅w2よりも広く設定して、各導体板32c(32b,32a)を各導体板31c(31b,31a)の下側に隠し、延出端部32c′(32b′,32a′)だけを露出させた。
The first capacitor conductor 31 and the second capacitor conductor 32 are devised to suppress the generation of unnecessary stray capacitance.
FIG. 6 is a plan view showing a main part of the first capacitor unit 3.
As shown in FIG. 6, the width w1 of each conductor plate 31c (31b, 31a) of the first capacitor conductor 31 is set wider than the width w2 of each conductor plate 32c (32b, 32a) of the second capacitor conductor 32. Each conductive plate 32c (32b, 32a) was concealed below each conductive plate 31c (31b, 31a), and only the extended end portion 32c ′ (32b ′, 32a ′) was exposed.

図2に示す第2のコンデンサ部4も、線路上の直流成分をカットするための部分であり、互いに対向するように組み込まれた第1キャパシタ導体41及び第2キャパシタ導体42と、これら第1及び第2キャパシタ導体41,42を被覆した誘電体43とで構成されている。   The second capacitor unit 4 shown in FIG. 2 is also a part for cutting the DC component on the line, and the first capacitor conductor 41 and the second capacitor conductor 42 incorporated so as to face each other, And a dielectric 43 covering the second capacitor conductors 41, 42.

第1キャパシタ導体41も、図5に示すように、等間隔で積層された3枚の導体板41a〜41cの同一縁部を縦状の導体板41dで接続することで形成し、第2キャパシタ導体42も、等間隔で積層された3枚の導体板42a〜42cを第1キャパシタ導体41の導体板41a〜41cの間に配して形成した。具体的には、第2キャパシタ導体42の各導体板42a(42b,42c)が、コイル部2に対して第1キャパシタ導体41の導体板41a(41b,41c)の上側に位置するように、導体板42a〜42cを導体板41a〜41cと交互に配した。
そして、図2に示すように、第1キャパシタ導体41の導体板41aを、第2コイル導体22の一方端部22bに接続し、第2キャパシタ導体42の導体板42a〜42cの延出端部42a′〜42c′を誘電体43の側面に露出させている。
すなわち、図3に示すように、第2のコンデンサ部4を、コイル部2の第2コイル導体22と直列に接続した。
As shown in FIG. 5, the first capacitor conductor 41 is also formed by connecting the same edge portions of three conductor plates 41a to 41c laminated at equal intervals by a vertical conductor plate 41d, and the second capacitor The conductor 42 is also formed by arranging three conductor plates 42 a to 42 c laminated at equal intervals between the conductor plates 41 a to 41 c of the first capacitor conductor 41. Specifically, the conductor plates 42a (42b, 42c) of the second capacitor conductor 42 are positioned above the conductor plates 41a (41b, 41c) of the first capacitor conductor 41 with respect to the coil portion 2. The conductor plates 42a to 42c are arranged alternately with the conductor plates 41a to 41c.
Then, as shown in FIG. 2, the conductor plate 41 a of the first capacitor conductor 41 is connected to one end 22 b of the second coil conductor 22, and the extended ends of the conductor plates 42 a to 42 c of the second capacitor conductor 42. 42 a ′ to 42 c ′ are exposed on the side surface of the dielectric 43.
That is, as shown in FIG. 3, the second capacitor unit 4 was connected in series with the second coil conductor 22 of the coil unit 2.

このような第1キャパシタ導体41と第2キャパシタ導体42とにおいても、不要な浮遊容量の発生を抑制するための工夫がされている。
図7は、第2のコンデンサ部4の要部を示す平面図である。
図7に示すように、第1キャパシタ導体41の各導体板41c(41b,41a)の幅w1を第2キャパシタ導体42の各導体板42c(42b,42a)の幅w2よりも広く設定して、各導体板42c(42b,42a)を各導体板41c(41b,41a)の上側に隠し、延出端部42c′(42b′,42a′)だけを露出させた。
The first capacitor conductor 41 and the second capacitor conductor 42 are also devised to suppress the generation of unnecessary stray capacitance.
FIG. 7 is a plan view showing a main part of the second capacitor unit 4.
As shown in FIG. 7, the width w1 of each conductor plate 41c (41b, 41a) of the first capacitor conductor 41 is set wider than the width w2 of each conductor plate 42c (42b, 42a) of the second capacitor conductor 42. Each of the conductor plates 42c (42b, 42a) was hidden on the upper side of each of the conductor plates 41c (41b, 41a), and only the extended end portions 42c ′ (42b ′, 42a ′) were exposed.

図2において、外部電極5−1は、第1コイル導体21の外端部21aに接続するように取り付けられ、外部電極5−2は、第2キャパシタ導体32の導体板32a′〜32c′に接続するように取り付けられている。
また、外部電極5−3は、第2コイル導体22の外端部22aに接続するように取り付けられ、外部電極5−4は、第2キャパシタ導体42の導体板42a′〜42c′に接続するように取り付けられている。
In FIG. 2, the external electrode 5-1 is attached so as to be connected to the outer end 21 a of the first coil conductor 21, and the external electrode 5-2 is connected to the conductor plates 32 a ′ to 32 c ′ of the second capacitor conductor 32. Installed to connect.
The external electrode 5-3 is attached so as to be connected to the outer end 22a of the second coil conductor 22, and the external electrode 5-4 is connected to the conductor plates 42a 'to 42c' of the second capacitor conductor 42. It is attached as follows.

次に、コモンモードチョークコイル1の製造方法について説明する。
図8は、第1のコンデンサ部3の層構造を示す斜視図であり、図9は、コイル部2の層構造を示す斜視図であり、図10は、第2のコンデンサ部4の層構造を示す斜視図であり、図11は、コイル部2と第1及び第2のコンデンサ部3,4との一体化工程を示す斜視図である。
先ず、第1のコンデンサ部3を形成するには、図8に示すように、誘電体シート33a〜33fを順次積層しながら、導体板32a,31a,32b,31b,32c,31cを誘電体シート33a〜33fの表面にパターン印刷する。この際、誘電体シート33c〜33fには、導体板31a〜31cの縁部と等しい長さのスルーホール31d1〜31d4を穿設しておく。最後に、第1コイル導体21の一方端部21bとの接続用のスルーホール33g′を有した誘電体シート33gを最上位に積層する。
このようにして、図11に示すように、導体板31a〜31c及び導体板31dとで成る第1キャパシタ導体31と、導体板32a〜32cで成る第2キャパシタ導体32とを有した焼成前の第1のコンデンサ部3を形成する。
Next, a method for manufacturing the common mode choke coil 1 will be described.
8 is a perspective view showing the layer structure of the first capacitor unit 3, FIG. 9 is a perspective view showing the layer structure of the coil unit 2, and FIG. 10 is the layer structure of the second capacitor unit 4. FIG. 11 is a perspective view showing an integration process of the coil part 2 and the first and second capacitor parts 3 and 4.
First, in order to form the first capacitor portion 3, as shown in FIG. 8, the conductor plates 32a, 31a, 32b, 31b, 32c, 31c are made to be dielectric sheets while the dielectric sheets 33a to 33f are sequentially laminated. Pattern printing is performed on the surfaces 33a to 33f. At this time, through holes 31d1 to 31d4 having the same length as the edges of the conductor plates 31a to 31c are formed in the dielectric sheets 33c to 33f. Finally, a dielectric sheet 33g having a through hole 33g ′ for connection to the one end portion 21b of the first coil conductor 21 is laminated on the top.
In this manner, as shown in FIG. 11, the first capacitor conductor 31 composed of the conductor plates 31a to 31c and the conductor plate 31d and the second capacitor conductor 32 composed of the conductor plates 32a to 32c are provided before firing. The first capacitor unit 3 is formed.

次いで、コイル部2を形成する。具体的には、図9に示すように、第1コイル導体21の外端部21aと複数の部分導体21′とを最下層の磁性体シート23aにパターン印刷すると共に、第2コイル導体22の複数の部分導体22′を複数の部分導体21′の間に交互にパターン印刷する。そして、複数のスルーホール21hと複数のスルーホール22hとを有した複数の磁性体シート23bをかかる磁性体シート23a上に積層する。しかる後、第2コイル導体22の外端部22aと複数の部分導体22′とを磁性体シート23cにパターン印刷すると共に、第1コイル導体21の複数の部分導体21′を複数の部分導体22′の間に交互にパターン印刷する。そして、この磁性体シート23を磁性体シート23b上に積層した後、磁性体シート23dを最上位に積層する。この際、磁性体シート23aには、第1のコンデンサ部3の誘電体シート33gのスルーホール33g′と連通して第1コイル導体21の一方端部21bを構成するためのスルーホール23a′を穿設すると共に、磁性体シート23dには、第2のコンデンサ部4の誘電体シート43aのスルーホール43a′と連通して第2コイル導体22の一方端部22bを構成するためのスルーホール23d′を穿設する。これにより、磁性体シート23a上の部分導体21′と磁性体シート23c上の部分導体21′の端部同士が、スルーホール21hを通じて連結されて、第1コイル導体21が形成される。また、磁性体シート23a上の部分導体22′と磁性体シート23c上の部分導体22′の端部同士が、スルーホール22hを通じて連結されて、第2コイル導体22が形成される。
このようにして、図11に示すように、第1コイル導体21と第2コイル導体22とを有した焼成前のコイル部2を形成する。
Next, the coil part 2 is formed. Specifically, as shown in FIG. 9, the outer end 21a and the plurality of partial conductors 21 'of the first coil conductor 21 are pattern-printed on the lowermost magnetic sheet 23a, and the second coil conductor 22 A plurality of partial conductors 22 'are alternately printed between the plurality of partial conductors 21'. Then, a plurality of magnetic sheets 23b having a plurality of through holes 21h and a plurality of through holes 22h are laminated on the magnetic sheet 23a. Thereafter, the outer end portion 22a of the second coil conductor 22 and the plurality of partial conductors 22 'are pattern-printed on the magnetic sheet 23c, and the plurality of partial conductors 21' of the first coil conductor 21 are printed on the plurality of partial conductors 22. The pattern is printed alternately between the ′. Then, after laminating the magnetic sheet 23 on the magnetic sheet 23b, the magnetic sheet 23d is laminated on the top. At this time, the magnetic sheet 23a is provided with a through hole 23a ′ for communicating with the through hole 33g ′ of the dielectric sheet 33g of the first capacitor unit 3 to form one end portion 21b of the first coil conductor 21. A through hole 23d is formed in the magnetic sheet 23d to form one end 22b of the second coil conductor 22 in communication with the through hole 43a 'of the dielectric sheet 43a of the second capacitor unit 4. ′ Is drilled. As a result, the end portions of the partial conductor 21 'on the magnetic sheet 23a and the partial conductor 21' on the magnetic sheet 23c are connected through the through hole 21h to form the first coil conductor 21. Further, the end portions of the partial conductor 22 'on the magnetic sheet 23a and the partial conductor 22' on the magnetic sheet 23c are connected to each other through the through hole 22h to form the second coil conductor 22.
Thus, as shown in FIG. 11, the coil part 2 before baking which has the 1st coil conductor 21 and the 2nd coil conductor 22 is formed.

さらに、第2のコンデンサ部4を形成する。すなわち、図10に示すように、誘電体シート43a〜43fを順次積層しながら、導体板41a,42a,41b,42b,41c,42cを誘電体シート43a〜43fの表面にパターン印刷する。この際、誘電体シート43b〜43eには、導体板41a〜41cの縁部と等しい長さのスルーホール41d1〜41d4を穿設し、誘電体シート43aには、第2コイル導体22の一方端部22bとの接続用のスルーホール43a′を穿設しておく。最後に、誘電体シート43gを最上位に積層する。このようにして、図11に示すように、導体板41a〜41c及び導体板41dとで成る第1キャパシタ導体41と、導体板42a〜42cで成る第2キャパシタ導体42とを有した焼成前の第2のコンデンサ部4を形成する。   Further, the second capacitor portion 4 is formed. That is, as shown in FIG. 10, the conductor sheets 41a, 42a, 41b, 42b, 41c, and 42c are pattern printed on the surfaces of the dielectric sheets 43a to 43f while sequentially laminating the dielectric sheets 43a to 43f. At this time, through holes 41d1 to 41d4 having the same length as the edges of the conductor plates 41a to 41c are formed in the dielectric sheets 43b to 43e, and one end of the second coil conductor 22 is formed in the dielectric sheet 43a. A through hole 43a 'for connection with the portion 22b is drilled. Finally, the dielectric sheet 43g is laminated on the top. In this way, as shown in FIG. 11, the first capacitor conductor 41 composed of the conductor plates 41a to 41c and the conductor plate 41d and the second capacitor conductor 42 composed of the conductor plates 42a to 42c have the pre-fired condition. A second capacitor portion 4 is formed.

最後に、焼成前の第1のコンデンサ部3とコイル部2と第2のコンデンサ部4とを下から順に積み重ねて一体型にし、しかる後、焼成して、コイル部2と第1及び第2のコンデンサ部3,4で構成されたチップ体を得る。そして、外部電極5−1〜5−4をこのチップ体に形成することで、図1及び図2に示したコモンモードチョークコイル1を製造する。   Finally, the first capacitor part 3, the coil part 2, and the second capacitor part 4 before firing are stacked in order from the bottom to be integrated, and then fired to produce the coil part 2 and the first and second parts. A chip body composed of the capacitor portions 3 and 4 is obtained. Then, by forming the external electrodes 5-1 to 5-4 on the chip body, the common mode choke coil 1 shown in FIGS. 1 and 2 is manufactured.

次に、この実施例のコモンモードチョークコイルが示す作用及び効果について説明する。
図12は、差動伝送線路を搭載した基板を示す斜視図であり、図13は、コモンモードチョークコイル1を差動伝送路のランドに実装した状態を示す斜視図であり、図14は、コモンモードチョークコイル1を各差動伝送路に実装した状態を示す斜視図である。
図12に示す基板100は、S−ATAやPCI−express等の高速デジタル差動線路110,120を搭載している基板であり、チップコントローラ等のIC130とコネクタ131とを備えている。かかる高速デジタル差動線路110,120において、高速デジタル差動線路110は、信号出力用の伝送路であり、信号D+用の線路111と信号D-用の線路112とで構成される。また、高速デジタル差動線路120は、信号入力用の伝送路であり、線路121,122で構成される。
このような高速デジタル差動線路110(120)においては、通常、破線で示すACカップリングコンデンサ200を実装するためのランド111a,111b、112a,112b(121a,121b、122a,122b)が各線路111,112(121,122)に形成されている。
Next, the operation and effect of the common mode choke coil of this embodiment will be described.
12 is a perspective view showing a substrate on which a differential transmission line is mounted, FIG. 13 is a perspective view showing a state in which the common mode choke coil 1 is mounted on a land of the differential transmission path, and FIG. It is a perspective view which shows the state which mounted the common mode choke coil 1 in each differential transmission path.
A substrate 100 shown in FIG. 12 is a substrate on which high-speed digital differential lines 110 and 120 such as S-ATA and PCI-express are mounted, and includes an IC 130 such as a chip controller and a connector 131. In the high-speed digital differential lines 110 and 120, the high-speed digital differential line 110 is a signal output transmission line, and includes a signal D + line 111 and a signal D- line 112. The high-speed digital differential line 120 is a transmission line for signal input, and is composed of lines 121 and 122.
In such a high-speed digital differential line 110 (120), lands 111a, 111b, 112a, and 112b (121a, 121b, 122a, and 122b) for mounting the AC coupling capacitor 200 indicated by a broken line are normally provided for each line. 111, 112 (121, 122).

この実施例のコモンモードチョークコイル1は、このような既成の基板100の高速デジタル差動線路110(120)に設けられているランド111a,111b、112a,112b(121a,121b、122a,122b)を利用して、実装することができる。具体的には、図13に示すように、外部電極5−1,5−2を線路111のランド111a,111b上に半田付けすると共に、外部電極5−3,5−4を線路112のランド112a,112b上に半田付けする。これにより、図3に示すコイル部2の第1コイル導体21と第1のコンデンサ部3とが線路111に直列に接続され、第2コイル導体22と第2のコンデンサ部4とが線路112に直列に接続された状態になる。   The common mode choke coil 1 according to this embodiment has lands 111a, 111b, 112a, 112b (121a, 121b, 122a, 122b) provided on the high-speed digital differential line 110 (120) of such an existing substrate 100. Can be implemented using. Specifically, as shown in FIG. 13, the external electrodes 5-1 and 5-2 are soldered onto the lands 111a and 111b of the line 111, and the external electrodes 5-3 and 5-4 are connected to the lands of the line 112. Solder onto 112a, 112b. Thereby, the first coil conductor 21 and the first capacitor unit 3 of the coil unit 2 shown in FIG. 3 are connected in series to the line 111, and the second coil conductor 22 and the second capacitor unit 4 are connected to the line 112. Connected in series.

したがって、線路111上の高周波信号D+は、第1コイル導体21及び第1のコンデンサ部3を通過し、線路112上の高周波信号D-は、第2コイル導体22及び第2のコンデンサ部4を通過する。
このとき、上記したように、コイル部2を第1及び第2のコンデンサ部3,4の間に介在させているので、不要な浮遊容量が第1及び第2のコンデンサ部3,4間や各コンデンサ部3(4)とコイル部2との間にほとんど生じない。さらに、図6(図7)に示したように、第2キャパシタ導体32(42)を、コイル部2に対して第1キャパシタ導体31(41)の内側に隠れるように設定しているので、浮遊容量の発生は、さらに厳格に抑制される。このため、線路111,112間の静電結合はほとんど生ぜず、信号波形の歪みがない高品質の信号D+,D-が伝送される。
Therefore, the high-frequency signal D + on the line 111 passes through the first coil conductor 21 and the first capacitor unit 3, and the high-frequency signal D− on the line 112 passes through the second coil conductor 22 and the second capacitor unit 4. Pass through.
At this time, as described above, since the coil unit 2 is interposed between the first and second capacitor units 3 and 4, unnecessary stray capacitance is generated between the first and second capacitor units 3 and 4. It hardly occurs between each capacitor part 3 (4) and the coil part 2. Further, as shown in FIG. 6 (FIG. 7), the second capacitor conductor 32 (42) is set so as to be hidden inside the first capacitor conductor 31 (41) with respect to the coil part 2, The generation of stray capacitance is more strictly suppressed. For this reason, electrostatic coupling between the lines 111 and 112 hardly occurs, and high-quality signals D + and D− with no distortion of the signal waveform are transmitted.

そして、コモンモードノイズが線路111,112に侵入した場合には、これらのノイズは第1及び第2コイル導体21,22を磁性体23で被覆したコイル部2によって反射及び減衰される。しかも、図4に示したように、コイル部2の第1及び第2コイル導体21,22を、横巻構造にしたので、コイル部2からの磁界が第1及び第2のコンデンサ部3,4によって妨げられることなく、一方の磁極から他方の磁極までループする。この結果、コモンモードノイズの除去をより確実に実行することができる。   When common mode noise enters the lines 111 and 112, these noises are reflected and attenuated by the coil portion 2 in which the first and second coil conductors 21 and 22 are covered with the magnetic body 23. Moreover, as shown in FIG. 4, the first and second coil conductors 21 and 22 of the coil unit 2 have a horizontal winding structure, so that the magnetic field from the coil unit 2 is applied to the first and second capacitor units 3 and 3. Loop from one pole to the other without being obstructed by 4. As a result, common mode noise can be removed more reliably.

コモンモードチョークコイル1を、図14に示すように、高速デジタル差動線路110,120の双方に実装することで、入出力双方の信号を高品質で伝送することができると共に、コモンモードノイズや直流成分を効率よく除去することができる。   As shown in FIG. 14, by mounting the common mode choke coil 1 on both of the high-speed digital differential lines 110 and 120, both input and output signals can be transmitted with high quality, and common mode noise and The direct current component can be removed efficiently.

なお、この発明は、上記実施例に限定されるものではなく、発明の要旨の範囲内において種々の変形や変更が可能である。
例えば、上記実施例では、コイル部2の第1コイル導体21及び第2コイル導体22を横巻構造にしたコモンモードチョークコイルについて説明したが、これらのコイル導体を縦巻構造にしたコモンモードチョークコイルを、この発明の範囲から除外する意ではない。
また、上記実施例では、第1及び第2のコンデンサ部3(4)の第1及び第2キャパシタ導体31,32(41,42)を複数の導体板31a〜31c(41a〜41c)と導体板32a〜32c(42a〜42c)との組合せで構成したコモンモードチョークコイルについて説明したが、1枚の導体板で成る第1キャパシタ導体31(41)と1枚の導体板で成る第2キャパシタ導体32(42)とで第1のコンデンサ部3(第2のコンデンサ部4)を構成したコモンモードチョークコイルを、この発明の範囲から除外する意ではない。
In addition, this invention is not limited to the said Example, A various deformation | transformation and change are possible within the range of the summary of invention.
For example, in the above embodiment, the common mode choke coil in which the first coil conductor 21 and the second coil conductor 22 of the coil unit 2 are horizontally wound has been described. However, the common mode choke in which these coil conductors are vertically wound is described. The coil is not intended to be excluded from the scope of the present invention.
Moreover, in the said Example, the 1st and 2nd capacitor conductors 31 and 32 (41, 42) of the 1st and 2nd capacitor | condenser part 3 (4) are made into several conductor board 31a-31c (41a-41c) and a conductor. The common mode choke coil constituted by the combination of the plates 32a to 32c (42a to 42c) has been described, but the first capacitor conductor 31 (41) composed of one conductor plate and the second capacitor composed of one conductor plate. The common mode choke coil that forms the first capacitor part 3 (second capacitor part 4) with the conductor 32 (42) is not intended to be excluded from the scope of the present invention.

この発明の一実施例に係るコモンモードチョークコイルの斜視図である。1 is a perspective view of a common mode choke coil according to an embodiment of the present invention. 図1に示したコモンモードチョークコイルの内部を透過して示す斜視図である。It is a perspective view which permeate | transmits and shows the inside of the common mode choke coil shown in FIG. コモンモードチョークコイルの等価回路図である。It is an equivalent circuit diagram of a common mode choke coil. 第1コイル導体と第2コイル導体とを分離して示す斜視図である。It is a perspective view which isolate | separates and shows a 1st coil conductor and a 2nd coil conductor. 第1キャパシタ導体と第2キャパシタ導体とを分離して示す斜視図である。It is a perspective view which isolate | separates and shows a 1st capacitor conductor and a 2nd capacitor conductor. 第1のコンデンサ部の要部を示す平面図である。It is a top view which shows the principal part of a 1st capacitor | condenser part. 第2のコンデンサ部の要部を示す平面図である。It is a top view which shows the principal part of a 2nd capacitor | condenser part. 第1のコンデンサ部の層構造を示す斜視図である。It is a perspective view which shows the layer structure of a 1st capacitor | condenser part. コイル部の層構造を示す斜視図である。It is a perspective view which shows the layer structure of a coil part. 第2のコンデンサ部の層構造を示す斜視図である。It is a perspective view which shows the layer structure of a 2nd capacitor | condenser part. コイル部と第1及び第2のコンデンサ部との一体化工程を示す斜視図である。It is a perspective view which shows the integration process of a coil part and the 1st and 2nd capacitor | condenser part. 差動伝送線路を搭載した基板を示す斜視図である。It is a perspective view which shows the board | substrate carrying a differential transmission line. コモンモードチョークコイルを差動伝送路のランドに実装した状態を示す斜視図である。It is a perspective view which shows the state which mounted the common mode choke coil in the land of the differential transmission path. コモンモードチョークコイルを各差動伝送路に実装した状態を示す斜視図である。It is a perspective view which shows the state which mounted the common mode choke coil in each differential transmission path.

符号の説明Explanation of symbols

1…コモンモードチョークコイル、 2…コイル部、 3…第1のコンデンサ部、 4…第2のコンデンサ部、 5−1〜5−4…外部電極、 21…第1コイル導体、 21a,22a…外端部、 21b,22b…一方端部、 22…第2コイル導体、 23…磁性体、 31,41…第1キャパシタ導体、 31a〜31c,31d,32a〜32c,41a〜41c,41d,42a〜42c…導体板、 32,42…第2キャパシタ導体、 32a′〜32c′,42a′〜42c′…延出端部、 33,43…誘電体。   DESCRIPTION OF SYMBOLS 1 ... Common mode choke coil, 2 ... Coil part, 3 ... 1st capacitor | condenser part, 4 ... 2nd capacitor | condenser part, 5-1-5-4 ... External electrode, 21 ... 1st coil conductor, 21a, 22a ... Outer end portion, 21b, 22b ... one end portion, 22 ... second coil conductor, 23 ... magnetic body, 31, 41 ... first capacitor conductor, 31a-31c, 31d, 32a-32c, 41a-41c, 41d, 42a ˜42c... Conductor plate, 32, 42... Second capacitor conductor, 32a 'to 32c', 42a 'to 42c' ... extended end portion, 33, 43 ... dielectric.

Claims (4)

第1コイル導体及び第2コイル導体とを磁性体で被覆して形成したコイル部と、互いに対向する第1キャパシタ導体及び第2キャパシタ導体を誘電体で被覆してそれぞれ形成した第1及び第2のコンデンサ部とを備えるコモンモードチョークコイルであって、
上記第1のコンデンサ部を、上記コイル部の第1コイル導体に直列に接続すると共に、上記第2のコンデンサ部を、上記コイル部の第2コイル導体に直列に接続した、
ことを特徴とするコモンモードチョークコイル。
A coil portion formed by coating the first coil conductor and the second coil conductor with a magnetic material, and first and second electrodes formed by coating the first capacitor conductor and the second capacitor conductor facing each other with a dielectric material, respectively. A common mode choke coil comprising a capacitor portion of
The first capacitor unit is connected in series to the first coil conductor of the coil unit, and the second capacitor unit is connected in series to the second coil conductor of the coil unit.
A common mode choke coil.
請求項1に記載のコモンモードチョークコイルにおいて、
上記コイル部を上記第1のコンデンサ部上に積層し、上記第2のコンデンサ部を当該コイル部の上に積層して、当該コイル部を上記第1及び第2のコンデンサ部の間に介在させた、
ことを特徴とするコモンモードチョークコイル。
The common mode choke coil according to claim 1,
The coil section is stacked on the first capacitor section, the second capacitor section is stacked on the coil section, and the coil section is interposed between the first and second capacitor sections. The
A common mode choke coil.
請求項2に記載のコモンモードチョークコイルにおいて、
上記第1及び第2コイル導体の磁極が上記第1及び第2のコンデンサ部側を向かないように、上記第1及び第2コイル導体を横巻構造にした、
ことを特徴とするコモンモードチョークコイル。
The common mode choke coil according to claim 2,
The first and second coil conductors have a lateral winding structure so that the magnetic poles of the first and second coil conductors do not face the first and second capacitor portions.
A common mode choke coil.
請求項2又は請求項3のいずれかに記載のコモンモードチョークコイルにおいて、
上記第1キャパシタ導体は、等間隔で積層され且つ同一縁部が接続された複数の導体板で成り、
上記第2キャパシタ導体は、当該第1キャパシタ導体の複数の導体板と交互に配され延出した各端部が誘電体から露出した複数の導体板で成り、
上記第1のコンデンサ部は、上記コイル部の第1コイル導体の一方端部に接続された上記第1キャパシタ導体と、各導体板が上記コイル部に対して当該第1キャパシタ導体の各導体板の下側に隠れる上記第2キャパシタ導体とで成り、
上記第2のコンデンサ部は、上記コイル部の第2コイル導体の一方端部に接続された上記第1キャパシタ導体と、各導体板が上記コイル部に対して当該第1キャパシタ導体の各導体板の上側に隠れる上記第2キャパシタ導体とで成る、
ことを特徴とするコモンモードチョークコイル。
In the common mode choke coil according to claim 2 or 3,
The first capacitor conductor is composed of a plurality of conductor plates laminated at equal intervals and connected at the same edge,
The second capacitor conductor is composed of a plurality of conductor plates each of which is alternately arranged and extended with a plurality of conductor plates of the first capacitor conductor and exposed from a dielectric.
The first capacitor section includes the first capacitor conductor connected to one end of the first coil conductor of the coil section, and each conductor plate of the first capacitor conductor with respect to the coil section. The second capacitor conductor hidden underneath,
The second capacitor portion includes the first capacitor conductor connected to one end of the second coil conductor of the coil portion, and each conductor plate of the first capacitor conductor with respect to the coil portion. The second capacitor conductor hidden on the upper side of
A common mode choke coil.
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