JP2006279391A - 固体撮像装置 - Google Patents
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Abstract
【課題】光学像を電気信号に変換する固体撮像装置において低歪出力を図ること。
【解決手段】フォトダイオードに発生させた電荷の通過/非通過の切り替えを行う第1のスイッチング部と、リセット電圧の伝送/非伝送の切り替えを行う第2のスイッチング部と、第1のスイッチング部を通過した電荷の蓄積または第2のスイッチング部から伝送されたリセット電圧の充電を行う静電容量と、静電容量に発生した電圧に応じた信号を出力するソースフォロア回路と、この出力された信号の伝送/非伝送の切り替えを行う第3のスイッチング部と、第2のスイッチング部により静電容量に充電がされて該静電容量に発生したリセット電圧に応じた信号を、ソースフォロア回路を介し第3のスイッチング部を介して順次、複数の撮像画素について読み出し保存するための画素ごとのメモリとを具備し、通常の読出し時にこのメモリに記憶された分の減算を行う。
【選択図】図1
【解決手段】フォトダイオードに発生させた電荷の通過/非通過の切り替えを行う第1のスイッチング部と、リセット電圧の伝送/非伝送の切り替えを行う第2のスイッチング部と、第1のスイッチング部を通過した電荷の蓄積または第2のスイッチング部から伝送されたリセット電圧の充電を行う静電容量と、静電容量に発生した電圧に応じた信号を出力するソースフォロア回路と、この出力された信号の伝送/非伝送の切り替えを行う第3のスイッチング部と、第2のスイッチング部により静電容量に充電がされて該静電容量に発生したリセット電圧に応じた信号を、ソースフォロア回路を介し第3のスイッチング部を介して順次、複数の撮像画素について読み出し保存するための画素ごとのメモリとを具備し、通常の読出し時にこのメモリに記憶された分の減算を行う。
【選択図】図1
Description
本発明は、光学像を電気信号に変換する固体撮像装置に係り、特に、低歪出力化に適する固体撮像装置に関する。
固体撮像素子には、大別してCCD型センサとCMOS型センサとがある。CCD型は、撮像面に結像された各画素の光学情報が時間的な同時性を保って電気信号となり、本質的にシャッター機能を有している。これに対して、CMOS型は、通常、各行ごとに順次光学情報を電気信号に変換しており、各フィールドまたはフレームを構成する電気信号には光学像では保持されていた時間的な同時性がない。CMOS型においても、各画素の光学情報に対応した電荷を全画素で一旦同時に保持しておき、この保持された電荷情報をその後順次読み出すことで、光学像と時間的同時性のある電気信号を得ることができる。このような機能構成は、例えば下記特許文献1に記載されている。
時間的同時性が得られない画像ひずみのほかに、CMOS型センサでは、各画素のソースフォロア回路におけるしきい電圧がばらつくことによる固定ノイズが知られている。また、フォトダイオードに発生する電荷の充電用容量の値があまり大きくできないことに起因して、その容量素子で発生するリーク電流も低歪化を図るうえでは低減が必要である。
特開2002−64751号公報
本発明は、上記の事情を考慮してなされたもので、光学像を電気信号に変換する固体撮像装置において、低歪出力が可能な固体撮像装置を提供することを目的とする。
上記の課題を解決するため、本発明に係る固体撮像素子は、複数の撮像画素がマトリックス状に配置され、前記配置された複数の撮像画素それぞれに入光量に応じた電荷を発生させ、該発生させた電荷に応じた信号をそれぞれ画素選択信号に従って読み出す固体撮像装置であって、前記電荷を発生させるフォトダイオードと、前記フォトダイオードに接続され、前記フォトダイオードに発生させた電荷の通過/非通過の切り替えを転送ゲート信号に従い行う第1のスイッチング部と、リセット電圧の伝送/非伝送の切り替えをリセット信号に従い行う第2のスイッチング部と、前記第1、第2のスイッチング部に接続され、前記第1のスイッチング部を通過した電荷の蓄積、または前記第2のスイッチング部から伝送された前記リセット電圧の充電を行う静電容量と、該静電容量に接続され、前記静電容量に発生した電圧に応じた信号を出力するソースフォロア回路と、前記ソースフォロア回路に接続され、前記出力された信号の伝送/非伝送の切り替えを前記画素選択信号に従って行う第3のスイッチング部と、前記第2のスイッチング部により前記静電容量に充電がされて該静電容量に発生した前記リセット電圧に応じた信号を、前記ソースフォロア回路を介しかつ前記画素選択信号に従い前記第3のスイッチング部を介して順次、前記複数の撮像画素について読み出し保存するための画素ごとのメモリと、前記第2のスイッチング部により前記静電容量に充電がされたあと前記第1のスイッチング部により前記静電容量に電荷が蓄積されて該静電容量に発生した電圧に応じた信号であって、前記ソースフォロア回路を介しかつ前記画素選択信号に従い前記第3のスイッチング部を介して順次、前記複数の撮像画素について読み出されたものの値から、前記画素ごとのメモリに保存された、対応する画素における信号の値を減算する減算部とを具備することを特徴とする。
すなわち、第1、第2のスイッチング部により、静電容量には、通常の入光量に応じた電荷の蓄積のほか、リセット信号によりリセット電圧が充電できるようになっている。このリセット電圧に応じた信号は、ソースフォロア回路を介しかつ画素選択信号に従い第3のスイッチング部を介して複数の撮像画素について画素ごとのメモリに保存される。この保存された信号は、したがって、撮像画素からの読み出し時に各画素の静電容量で生じたリーク電流が込みにされた値の信号である。よって、第2のスイッチング部により静電容量に充電がされたあと第1のスイッチング部により静電容量に電荷が蓄積されて該静電容量に発生した電圧に応じた信号(すなわち通常の入光量に応じた信号)が、ソースフォロア回路および第3のスイッチング部を介して読み出され、この読み出された値から上記の保存された信号値を減算することにより、各画素で生じたリーク電流の値を打ち消すことができる。ゆえに、低歪出力が可能になる。
本発明によれば、光学像を電気信号に変換する固体撮像装置において、低歪出力が可能になる。
本発明の実施態様として、前記第2のスイッチング部により前記静電容量に充電がされて該静電容量に発生した前記リセット電圧に応じた前記信号であって、前記ソースフォロア回路を介して前記画素選択信号に従い前記第3のスイッチング部を介して得られるものが基準電圧と等しくなるように前記リセット電圧を生成するリセット電圧生成部をさらに具備する、としてもよい。これにより、各画素のソースフォロア回路におけるしきい電圧がばらつくことによる固定ノイズを効果的に抑制することができる。
また、実施態様として、前記リセット電圧生成部は、前記複数の撮像画素の各列ごとに一つずつ設けられる、とすることができる。各列に一つずつ設けることで構成を簡素化できる。
また、実施態様として、前記静電容量は、接合容量またはトランジスタゲート容量である、とすることができる。このような容量はその値が小さいが、MIM構造や、絶縁物を誘電物質に多結晶シリコンの電極層を有する構造の容量をわざわざ作り込む必要がなく、画素大きさを抑制する点で例えばCMOS型センサでは現実的である。
また、実施態様として、前記画素選択信号は、前記複数の撮像画素の横方向の並びごとに共通に供給される、とすることができる。横方向並びごとに共通にすることで構成を簡素化できる。
また、実施態様として、前記リセット信号は、前記複数の撮像画素すべてに共通に供給される、とすることができる。共通に供給することで構成を簡素化できる。
以上を踏まえ、以下では本発明の実施形態を図面を参照しながら説明する。図1は、本発明の一実施形態に係る固体撮像装置の構成を示す等価回路・ブロック図(1画素分)である。図1に示すように、この固体撮像装置は、撮像画素10を有し、さらに電流源21、演算増幅回路22、A/D変換回路23、メモリ24、減算部25、列選択回路26を有する。撮像画素10は縦横にマトリックス状に配置されており、電流源21、演算増幅回路22、A/D変換回路23、メモリ24、減算部25の部分は、列方向の撮像画素10の集まりに対してひとつずつ設けられる。列選択回路26は、この固体撮像装置にひとつ設けられる。
撮像素子10は、フォトダイオード11、MOSトランジスタ12、13、15、16、(以下、「MOSトランジスタ」の代わりに単に「トランジスタ」という。)、静電容量14を有する。フォトダイオード11は、一端がグラウンドに接続され、他端が第1のスイッチング部としてのトランジスタ12に接続されている。フォトダイオード11は、入光量に応じた電荷を発生する光電変換部本体である。トランジスタ12のゲートには転送ゲート信号が所定のタイミングで印加される。転送ゲート信号が印加されたときフォトダイオード11に発生した電荷はトランジスタ12を通過して静電容量14に蓄積される(それ以外は非通過)。
トランジスタ12のフォトダイオード11の側と反対の側には、第2のスイッチング部としてのトランジスタ13が接続されている。トランジスタ13のゲートにはリセット信号が所定のタイミングで印加される。リセット信号が印加されたときリセット電圧がトランジスタ13を介して静電容量14に伝送・充電される(それ以外は非伝送)。
静電容量14は、トランジスタ12、13に一端が接続されている。これにより、フォトダイオード11に発生した電荷がトランジスタ12を介し転送されたとき、これに応じた電圧を発生させる。実体的には、トランジスタ12、13との接続におけるそれらの端子に寄生的に生じている接合容量およびトランジスタ15の入力ゲート容量などの容量であり、特に素子として形成されたものではない。素子(例えばMIM構造など)として形成すると比較的大きな面積を占めCMOS型センサでは現実性があまりない。なお、上記でも述べたが、トランジスタ13がリセット信号によりオンすると静電容量14は、リセット電圧に充電される。
以上の構成により、静電容量14の一端のノードはFD(floating diffusion)のノードになる。このような構成により、転送ゲート信号によって全画素一括で静電容量14への電荷転送を可能とし、画面ごとに時間的な同一性のある出力が得られるようになっている。
トランジスタ15は、そのゲートに静電容量14の一端が接続され、これにより静電容量14に発生した電圧をバッファリングしてそのソースに出力するもの(ソースフォロア回路)である。そのソースには、第3のスイッチング部としてのトランジスタ16が接続されている。トランジスタ16のゲートには所定のタイミングで画素選択信号が印加される。画素選択信号が印加されたとき、トランジスタ15、トランジスタ16、電流源21の電流路が形成され、静電容量14に発生した電圧に応じた信号が伝送されて(それ以外は非伝送)、A/D変換回路23に入力される。
電流源21は、トランジスタ15、トランジスタ16を縦続する電流を発生するための電流源であり、列方向の撮像素子10の集まりに対してひとつずつある。すなわち、画素選択信号の印加されている撮像素子10から選択的に出力信号を取り出すように構成されている。
演算増幅回路22は、その非反転入力端子に供給された基準電圧と、撮像素子10(画素選択信号が印加され選択されている撮像素子10)の出力信号の電圧とが等しくなるようにリセット電圧を発生するものである(リセット電圧生成部)。このようにリセット電圧を発生することで、ソースフォロア回路であるトランジスタ15でのしきい電圧の画素ごとのばらつきによらず、一定した基準の出力信号を得ることができる。発生されたリセット電圧は、上記で述べたように、ゲートにリセット信号が印加され得るトランジスタ13に供給される。
A/D変換回路23は、撮像素子10の出力信号をA/D変換するものである。変換で得られたディジタル信号は、メモリ24に蓄え保存されるかまたは減算部25に供給される。メモリ24に蓄えられるのは、静電容量14にトランジスタ13を介してリセット電圧のみが充電され、それが読み出された場合である。減算部25に供給されるのは、静電容量14にトランジスタ13を介してリセット電圧が充電されさらにトランジスタ12を介してフォトダイオード11から入光量に応じて発生させた電荷が転送され、それが読み出された場合である。後者の場合、減算部25の減算側入力には、メモリ24に蓄えられた信号が読み出されて供給される。減算部25における減算は、減算する側とされる側の両信号が同一の撮像素子10からのものであるようにしてなされる。
列選択信号26は、各列のディジタル信号を集約し、これらをマルチプレクスして最終的なディジタルの映像出力信号として出力するものである。
なお、図1に示す構成では演算増幅回路22を列ごとにひとつずつ設けているが、別の構成も可能である。例えば、各撮像画素10ごとにひとつずつとすることや、各列を複数に分割してその分割された複数の画素10ごとにひとづずつとする構成も可能である。例えば配線を含めてもっとも簡素な構成になるように、どのような構成にするか考慮すればよい。
転送ゲート信号、リセット信号は、全部の撮像素子10でそれぞれ同一のタイミングで供給されるように配線する。その場合に、配線の中間では例えば各行ごとまたは各列ごとのまとまりで配線がされるようにしてもよい。画素選択信号は、各行ごとのまとまりで同一の信号が供給されるように配線する。この場合の画素選択信号は、出力する行の選択のための信号とすべきだからである。
また、図1に示す構成では、A/D変換回路23を設けて、メモリ24をディジタルメモリ、減算部25をディジタル値での減算としているが、原理的には、メモリ24および減算部25をアナログ信号メモリおよび減算回路とすることも可能である。この場合、A/D変換回路23は、アナログの減算部25の後段に設ける。
図2は、図1中に示した撮像画素10の構成を模式的に示す断面図である。図2において、図1中に示したものと同一または同一相当のものには同一符号を付してある。
図2中に示す半導体基板31とN領域32との接合部分が、フォトダイオード11(図1)に相当しており、図示するように埋め込み型のダイオードである。転送ゲート信号が印加されるゲート12aは、トランジスタ12(図1)のゲートに相当しており、基板31とN領域32との接合によるダイオードと、N+領域33との間を隔てるゲート部である。リセット信号が印加されるゲート13aは、トランジスタ13(図1)のゲートに相当しており、N+領域33とN+領域34との間を隔てるゲート部である。
N+領域33は、トランジスタ15のゲートに電気的接続がされ、N+領域34には、リセット電圧が供給される。図1中に示した静電容量14は、主に、基板31とN+領域33との接合による接合容量とトランジスタ15の入力ゲート容量とからなっている。これらの構成により、転送ゲート信号が印加されたときには、基板31とN領域32との接合によるダイオード(フォトダイオード11)に発生した電荷がN+領域33に転送される。また、リセット信号が印加されたときには、リセット電圧がN+領域33に発生する。
図3は、図2の撮像素子の構成に基づいてその各部の動作中電位を示す説明図である。図3において、すでに説明した図中に示した構成要素と同一または同一相当のものには同一符号を付してある。
まず、図3(a)に示すように、トランジスタ13を伝送状態としてリセット電圧41を領域33に発生させる(図示していないが、この直前にフォトダイオード11に発生している電荷をトランジスタ12を通過状態(オン)として領域33に転送させておくとその後の動作に都合がよい)。そして、領域33に発生した電圧に応じた信号の出力(読出し)を次に行う。
読出しは画素選択信号により順次なされるが、最初の方に読み出される撮像画素は、図3(b)に示すように、リセット電圧41とさほど変わらない電圧の出力となる。最後近くになって読み出される撮像画素は、図3(c)に示すように、静電容量14に発生するリーク電流などによる電圧分42が加算された電圧の読出しとなる。図3(b)から同(c)のように順次出力される期間(ダミー読出し期間)の信号は、すでに述べたように撮像画素ごとにメモリ24(図1)に保存される。なお、図3(b)から同(c)の時間経過は1フレームまたは1フィールドの時間に相当し、この間にフォトダイオード11には入光量に応じた電荷43が発生する。
次に、図3(d)に示すように、再び、トランジスタ13を伝送状態としてリセット電圧41を領域33に発生させる。続いて、図3(e)に示すように、トランジスタ12をオンさせてフォトダイオード11に発生させた電荷43を領域33に転送し、入光量に応じた電圧分43Aを領域33に発生させる。
そして次に、領域33に発生した電圧に応じた信号の読出しを行う。読出しは画素選択信号により順次なされるが、最初の方に読み出される撮像画素は、図3(f)に示すように、リセット電圧41と入光量に応じた電圧分43Aとのみからなる電圧の出力となる。最後近くになって読み出される撮像画素は、図3(g)に示すように、静電容量14に発生するリーク電流などによる電圧分42がさらに加算された電圧の読出しとなる。なお、図3(f)から同(g)の時間経過は1フレームまたは1フィールドの時間に相当し、この間にフォトダイオード11には入光量に応じた電荷43が発生する。
図3(f)から同(g)のように順次出力される期間(信号読出し期間)の信号は、すでに述べたように減算部25(図1)で画素ごとのメモリ24からのその相当する画素の読出し信号の分が差し引かれる。すなわち、このような減算部25での減算により、静電容量14に発生するリーク電流などによる電圧分42が相殺され、減算部25の出力に低歪出力を得ることができる。なお、図3(g)に続いては、図3(d)のリセット動作に戻り以下同様に動作を行う。
次に、本発明に係る別の実施形態に係る固体撮像装置について図4を参照して説明する。図4は、本発明の別の実施形態に係る固体撮像装置の構成を示すブロック図であり、すでに説明した図中の構成要素と同一または同一相当のものには同一符号を付してある。その部分の説明は省略する。行選択回路51は、行選択信号を出力することで、行方向の撮像画素10を一括して読出し状態にするものである。所定のタイミングで、各行ごとの選択信号が出力される。
この実施形態と図1に示した実施形態との違いは、A/D変換を列選択回路26Aの後段で行うようにしたことである。すなわち、図4に示す実施形態においては、列選択回路26Aはアナログ回路である。A/D変換回路23Aは、アナログの映像信号出力をA/D変換する。変換で得られたディジタル信号は、フレームメモリまたはフィールドメモリであるメモリ24Aに蓄え保存されるかまたは減算部25Aに供給される。
メモリ24Aに蓄えられるのは、静電容量14(図1参照)にトランジスタ13(同)を介してリセット電圧のみが充電され、それが読み出された場合である。減算部25Aに供給されるのは、静電容量14(図1参照)にトランジスタ13(同)を介してリセット電圧が充電されさらにトランジスタ12(同)を介してフォトダイオード11(同)から入光量に応じて発生させた電荷が転送され、それが読み出された場合である。後者の場合、減算部25Aの減算側入力には、メモリ24Aに蓄えられた信号が読み出されて供給される。減算部25Aにおける減算は、減算する側とされる側の両信号が同一の撮像素子10からのものであるようにしてなされる。すなわち、このような減算部25Aでの減算により、静電容量14(図1参照)に発生するリーク電流などによる電圧分42(同)が相殺され、減算部25Aの出力に低歪出力を得ることができる。
10…撮像画素、11…フォトダイオード、12…トランジスタ(第1のスイッチング部)、12a…ゲート、13…トランジスタ(第2のスイッチング部)、13a…ゲート、14…静電容量、15…トランジスタ(ソースフォロア回路)、16…トランジスタ(第3のスイッチング部)、21…電流源、22…演算増幅回路、23…A/D変換回路、23A…A/D変換回路、24…メモリ(1列分)、24A…メモリ(1フレーム/フィールド分)、25…減算部、25A…減算部、26…列選択回路、26A…列選択回路、31…半導体基板、32…N領域、33…N+領域、34…N+領域、41…リセット電圧、42…リーク電流などによる電圧分、43…入光量により蓄積された電荷、43A…入光量に応じた電圧分、51…行選択回路。
Claims (6)
- 複数の撮像画素がマトリックス状に配置され、前記配置された複数の撮像画素それぞれに入光量に応じた電荷を発生させ、該発生させた電荷に応じた信号をそれぞれ画素選択信号に従って読み出す固体撮像装置であって、
前記電荷を発生させるフォトダイオードと、
前記フォトダイオードに接続され、前記フォトダイオードに発生させた電荷の通過/非通過の切り替えを転送ゲート信号に従い行う第1のスイッチング部と、
リセット電圧の伝送/非伝送の切り替えをリセット信号に従い行う第2のスイッチング部と、
前記第1、第2のスイッチング部に接続され、前記第1のスイッチング部を通過した電荷の蓄積、または前記第2のスイッチング部から伝送された前記リセット電圧の充電を行う静電容量と、
前記静電容量に接続され、該静電容量に発生した電圧に応じた信号を出力するソースフォロア回路と、
前記ソースフォロア回路に接続され、前記出力された信号の伝送/非伝送の切り替えを前記画素選択信号に従って行う第3のスイッチング部と、
前記第2のスイッチング部により前記静電容量に充電がされて該静電容量に発生した前記リセット電圧に応じた信号を、前記ソースフォロア回路を介しかつ前記画素選択信号に従い前記第3のスイッチング部を介して順次、前記複数の撮像画素について読み出し保存するための画素ごとのメモリと、
前記第2のスイッチング部により前記静電容量に充電がされたあと前記第1のスイッチング部により前記静電容量に電荷が蓄積されて該静電容量に発生した電圧に応じた信号であって、前記ソースフォロア回路を介しかつ前記画素選択信号に従い前記第3のスイッチング部を介して順次、前記複数の撮像画素について読み出されたものの値から、前記画素ごとのメモリに保存された、対応する画素における信号の値を減算する減算部と
を具備することを特徴とする固体撮像装置。 - 前記第2のスイッチング部により前記静電容量に充電がされて該静電容量に発生した前記リセット電圧に応じた前記信号であって、前記ソースフォロア回路を介して前記画素選択信号に従い前記第3のスイッチング部を介して得られるものが基準電圧と等しくなるように前記リセット電圧を生成するリセット電圧生成部をさらに具備することを特徴とする請求項1記載の固体撮像装置。
- 前記リセット電圧生成部が、前記複数の撮像画素の各列ごとに一つずつ設けられることを特徴とする請求項2記載の固体撮像素子。
- 前記静電容量が、接合容量およびトランジスタゲート容量であることを特徴とする請求項1記載の固体撮像素子。
- 前記画素選択信号が、前記複数の撮像画素の横方向の並びごとに共通に供給されることを特徴とする請求項1記載の固体撮像素子。
- 前記リセット信号が、前記複数の撮像画素すべてに共通に供給されることを特徴とする請求項1記載の固体撮像素子。
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