JP2006155434A - Pciバスコントローラ及びその動作制御方法並びにプログラム - Google Patents
Pciバスコントローラ及びその動作制御方法並びにプログラム Download PDFInfo
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Abstract
【解決手段】 リフレッシュ回路24を設けて、コンフィグレーションレジスタ11の内容を、1ビットエラー検出及び訂正機能を有するECC回路23を介して読出し、これを当該レジスタ11へ再書き込み(リフレッシュ)制御する。このリフレッシュ制御動作を、カウンタ回路26による周期的タイミングの発生毎に、一定周期で繰り返して行うことにより、コンフィグレーションレジスタ11の内容が放射線により変化しても、常に正しいデータにリフレッシュされることになる。
【選択図】 図1
Description
2 PCIバス
3 ローカルバス
11 コンフィグレーションレジスタ
12 PCIバスアクセス制御回路
23 ECC回路
24 リフレッシュ回路
25 バスアービター回路
26 カウンタ回路
Claims (8)
- PCIバスに接続されるデバイスの特性、種類、動作方式などの情報を設定したコンフィグレーションレジスタを有するPCIコントローラであって、前記レジスタの出力のエラー検出および訂正をなすエラー検出訂正手段と、前記レジスタの情報を前記エラー検出訂正手段を介して読み出した後に前記レジスタに再書き込みを、定期的に行うリフレッシュ手段とを含むことを特徴とするPCIコントローラ。
- 前記PCIバスからのアクセスに応答して、前記レジスタの情報を前記エラー検出訂正手段を介して導出するようにしたことを特徴とする請求項1記載のPCIコントローラ。
- 前記PCIバスからのアクセスと前記リフレッシュ手段のリフレッシュとの調停をなす手段を、更に含むことを特徴とする請求項1または2記載のPCIコントローラ。
- 人工衛星搭載用機器に適用したことを特徴とする請求項1〜3いずれか記載のPCIコントローラ。
- PCIバスに接続されるデバイスの特性、種類、動作方式などの情報を設定したコンフィグレーションレジスタを有するPCIバスコントローラの動作制御方法であって、前記レジスタの情報を読み出してエラー検出および訂正をなす第一のステップと、前記エラー検出および訂正後に、前記レジスタに再書き込みをなす第二のステップと、前記第一および第二のステップを定期的に実行する第三のステップとを含むことを特徴とする動作制御方法。
- 前記PCIバスからのアクセスに応答して、前記レジスタの情報を読み出してエラー検出および訂正を行って導出するステップを、更に含むことを特徴とする請求項5記載の動作制御方法。
- 前記PCIバスからのアクセスと前記第三のステップとの調停をなすステップを、更に含むことを特徴とする請求項5または6記載の動作制御方法。
- PCIバスに接続されるデバイスの特性、種類、動作方式などの情報を設定したコンフィグレーションレジスタを有するPCIバスコントローラの動作制御方法をコンピュータによ実行させるためのプログラムであって、前記レジスタの情報を読み出してエラー検出および訂正をなす第一の処理と、前記エラー検出および訂正後に、前記レジスタに再書き込みをなす第二の処理と、前記第一および第二の処理を定期的に実行する第三の処理とを含むことを特徴とするプログラム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2004347943A JP2006155434A (ja) | 2004-12-01 | 2004-12-01 | Pciバスコントローラ及びその動作制御方法並びにプログラム |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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WO2023223823A1 (ja) * | 2022-05-18 | 2023-11-23 | ソニーセミコンダクタソリューションズ株式会社 | データ処理装置、データ処理方法、およびプログラム |
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2004
- 2004-12-01 JP JP2004347943A patent/JP2006155434A/ja active Pending
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