JP2006032411A - Inscribed conductivity region compound for silicon carbide semiconductor device and manufacturing method thereof - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To provide an inscribed conductive region compound for a silicon carbide semiconductor device and a manufacturing method thereof wherein the reduction of effective areas of first and second conductive regions due to overlapping between them and the occurrence of asymmetry in electric characteristics of the compound are excluded. <P>SOLUTION: The inscribed conductive region compound for the silicon carbide semiconductor device comprises the first conductive region 2 formed on an SiC substrate 1, and second conductive regions 3a, 3b closely in contact with the first conductive region 2 and formed in a way of enclosing or clamping the first conductive region 2. The manufacturing method thereof is configured with the steps of forming a first mask for ion implantation on the SiC substrate 1, applying selective ion implantation to the SiC substrate 1 through openings of the first mask to form the first conductive region 2, forming a second mask for ion implantation in self-alignment to the first mask on the SiC substrate 1, and applying selective ion implantation to the SiC substrate 1 through openings of the second mask to form the second conductive regions 3a, 3b. <P>COPYRIGHT: (C)2006,JPO&NCIPI

Description

本発明は、炭化珪素半導体装置の内接伝導領域複合体およびその製造方法に係る。   The present invention relates to an inscribed conductive region composite of a silicon carbide semiconductor device and a method for manufacturing the same.

半導体炭化珪素(SiC)は、pn接合の形成が可能で、珪素(Si)や砒化ガリウム(GaAs)等の他の半導体材料に比べて、禁制帯幅Egが広く、3C−SiCで2.23eV、6H−SiCで2.93eV、4H−SiCで3.26eV程度の値が報告されている。また、SiCは、熱的、化学的、機械的に安定で、耐放射線性にも優れているので、発光素子や高周波デバイスは勿論のこと、高温、大電力、放射線照射等の過酷な条件で高い信頼性と安定性を示す電力用半導体装置(パワーデバイス)として様々な産業分野での適用が期待されている。   Semiconductor silicon carbide (SiC) can form a pn junction, and has a wider forbidden band Eg than other semiconductor materials such as silicon (Si) and gallium arsenide (GaAs), and is 2.23 eV in 3C-SiC. A value of about 2.93 eV for 6H-SiC and about 3.26 eV for 4H-SiC has been reported. In addition, SiC is thermally, chemically and mechanically stable and has excellent radiation resistance, so it can be used not only for light-emitting elements and high-frequency devices, but also in harsh conditions such as high temperature, high power, and radiation irradiation. Application in various industrial fields is expected as a power semiconductor device (power device) exhibiting high reliability and stability.

Si半導体装置と同様に、SiC半導体装置でも、導電型、不純物種、不純物濃度、深さの異なる2つ以上の伝導領域から構成される複合体(伝導領域複合体と略称する)が重要な構成要素である。このような重要な伝導領域複合体のひとつに第1伝導領域が第2伝導領域に平面的に包囲されるか、あるいは、挟持される伝導領域複合体がある。このような伝導領域複合体を「内接伝導領域複合体」あるいは単に「伝導複合体」と称することにする。なお、「AがBに挟持される」とは、AがBに挟まれた形で存在することを意味する。この場合に、Bは単連結であっても複数部分に分かれていてもよい。   Similar to Si semiconductor devices, in SiC semiconductor devices, a composite composed of two or more conductive regions having different conductivity types, impurity species, impurity concentrations, and depths (abbreviated as a conductive region composite) is important. Is an element. One such conductive region composite is a conductive region composite in which the first conductive region is planarly surrounded or sandwiched by the second conductive region. Such a conduction region composite is referred to as “inscribed conduction region composite” or simply “conduction composite”. Note that “A is sandwiched between B” means that A is present between B. In this case, B may be a single connection or may be divided into a plurality of parts.

このような内接伝導領域複合体の典型例として、縦型パワーMOSFETのn+ソース領域とp+べースコンタクト領域の構造を挙げることができる(nやpに付されている“+”の表記は高不純物濃度または高キャリア濃度を意味し、以下も同様である)。その具体的例は下記非特許文献1に記載されている。   As a typical example of such an inscribed conduction region composite, the structure of an n + source region and a p + base contact region of a vertical power MOSFET can be cited (the notation “+” attached to n and p is high). Meaning impurity concentration or high carrier concentration, and so on). Specific examples thereof are described in Non-Patent Document 1 below.

特開平10−308510号公報JP-A-10-308510 「マテリアルズ・サイエンス・フォーラム、433−436巻、2003年、669〜672ぺージ」の図1(a)。FIG. 1A of “Materials Science Forum, 433-436, 2003, pages 669-672”.

上記の内接伝導領域複合体を製造する場合に、半導体基板の表面にイオン注入用の第1マスクを形成し、この第1マスクの開口部を通して前記基板への選択イオン注入を行って前記第1(または第2)伝導領域を形成し、前記基板の表面にイオン注入用の第2マスクを形成し、この第2マスクの開口部を通して前記基板への選択イオン注入を行って前記第2(または第1)伝導領域を形成し、前記第1伝導領域にイオン注入された不純物および前記第2伝導領域にイオン注入された不純物を活性化させる。   In manufacturing the above inscribed conductive region composite, a first mask for ion implantation is formed on the surface of the semiconductor substrate, and selective ion implantation is performed on the substrate through the opening of the first mask. 1 (or second) conductive region is formed, a second mask for ion implantation is formed on the surface of the substrate, and selective ion implantation is performed on the substrate through the opening of the second mask to perform the second ( Alternatively, a first) conductive region is formed, and the impurity ion-implanted into the first conductive region and the impurity ion-implanted into the second conductive region are activated.

従来技術においては、前記第1マスクの形成および前記第2マスクの形成において、互いに独立したフォトリソグラフィ工程が使われている。そこで、第1マスクおよび第2マスクを形成する際、機械的、人為的要因によって、上記2つのフォトリソグラフィ工程における位置合わせにそれぞれ誤差が生じるため、第1伝導領域の位置と第2伝導領域の位置とが相対的にずれ、第1伝導領域と第2伝導領域との間には共通部分と間隙とが生じ、その結果として、(1)第1伝導領域と第2伝導領域の有効面積がともに減少する、(2)複合体の電気特性に非対称性が現われ、意図した電気特性が得られない、(3)所望の有効面積を確保するためには、第1伝導領域と第2伝導領域の設計面積を合わせ誤差の分だけ大きく設計しなくてはならない、という問題があった。   In the prior art, independent photolithography processes are used in forming the first mask and the second mask. Therefore, when the first mask and the second mask are formed, errors occur in the alignment in the two photolithography processes due to mechanical and artificial factors. Therefore, the positions of the first conductive region and the second conductive region are different. The position is relatively shifted, and a common portion and a gap are formed between the first conduction region and the second conduction region. As a result, (1) the effective area of the first conduction region and the second conduction region is increased. (2) Asymmetry appears in the electrical properties of the composite and the intended electrical properties cannot be obtained. (3) To secure a desired effective area, the first conductive region and the second conductive region There is a problem that the design area must be designed to be larger by the error.

本発明は、このような従来の内接伝導領域複合体およびその製造方法における上記問題に鑑みてなされたものであり、本発明が解決しようとする課題は、第1伝導領域と第2伝導領域との重なりによる両領域の有効面積の減少と複合体の電気特性における非対称性の出現とを排除した、炭化珪素半導体装置の内接伝導領域複合体およびその製造方法を提供することである。   The present invention has been made in view of the above problems in such a conventional inscribed conductive region composite and a method for manufacturing the same, and the problem to be solved by the present invention is the first conductive region and the second conductive region. An inscribed conductive region composite of a silicon carbide semiconductor device and a method of manufacturing the same are provided, which eliminates the reduction of the effective area of both regions due to the overlap with each other and the appearance of asymmetry in the electrical characteristics of the composite.

半導体炭化珪素基板への選択イオン注入によって第1伝導領域を形成し、前記第1伝導領域に密接し該領域を包囲するか挟持するように、前記基板への選択イオン注入によって第2伝導領域を形成してなる、炭化珪素半導体装置の内接伝導領域複合体であって、前記第1伝導領域と前記第2伝導領域との間には共通部分も間隙も無い、炭化珪素半導体装置の内接伝導領域複合体を構成する。   A first conduction region is formed by selective ion implantation into a semiconductor silicon carbide substrate, and a second conduction region is formed by selective ion implantation into the substrate so as to be in close contact with and surround or sandwich the region. An inscribed conductive region composite of a silicon carbide semiconductor device, wherein the inscribed conductive region complex of the silicon carbide semiconductor device has no common part and no gap between the first conductive region and the second conductive region. A conductive region composite is constructed.

本発明の実施によって、第1伝導領域と第2伝導領域との重なりによる両領域の有効面積の減少と複合体の電気特性における非対称性の出現とを排除した、炭化珪素半導体装置の内接伝導領域複合体およびその製造方法を提供することが可能となる。   Implementation of the present invention eliminates the reduction in effective area of both regions due to the overlap between the first conduction region and the second conduction region and the appearance of asymmetry in the electrical characteristics of the composite. It becomes possible to provide a region complex and a method for producing the same.

つぎに、図面を参照して、本発明の実施の形態を説明する。但し、図面は模式的なものであり、厚みと平面寸法との関係、各層の厚みの比率等は現実のものとは異なることに留意すべきである。従って、具体的な厚みや寸法は以下の説明を参酌して判断すべきものである。また図面相互間においても互いの寸法の関係や比率が異なる部分が含まれていることは勿論である。   Next, an embodiment of the present invention will be described with reference to the drawings. However, it should be noted that the drawings are schematic, and the relationship between the thickness and the planar dimensions, the ratio of the thickness of each layer, and the like are different from the actual ones. Accordingly, specific thicknesses and dimensions should be determined in consideration of the following description. Moreover, it is a matter of course that portions having different dimensional relationships and ratios are included between the drawings.

図1(1)〜(4)は、本発明に係る様々なSiC半導体装置で望まれる上記内接伝導領域複合体の理想的平面構造である。図中、1は、半導体炭化珪素基板である、所望の伝導型のSiC基板、2はSiC基板1の表面の微小域に選択イオン注入で形成された第1伝導領域、3a、3bはこの第1伝導領域を包囲(図1(1)〜(3))するか挟持(図1(4))し、かつ近接するように選択イオン注入で設けられた第2伝導領域である。ここで第2伝導領域3a、3bは同時に形成されたものである。   FIGS. 1 (1) to 1 (4) are ideal planar structures of the inscribed conductive region composites desired in various SiC semiconductor devices according to the present invention. In the figure, 1 is a SiC substrate of a desired conductivity type, which is a semiconductor silicon carbide substrate, 2 is a first conduction region formed by selective ion implantation in a minute region of the surface of the SiC substrate 1, and 3a and 3b are the first conductivity regions. This is a second conduction region which is provided by selective ion implantation so as to surround (see FIGS. 1 (1) to (3)) or sandwich (FIG. 1 (4)) and to be close to one conduction region. Here, the second conductive regions 3a and 3b are formed simultaneously.

第1伝導領域2と第2伝導領域3a、3bとは、少なくとも、導電型(p型、n型の区別)、イオン注入された不純物種、不純物濃度、不純物注入深さのいずれかが異なっているとし、さらに、第1伝導領域は、第2伝導領域を形成する際のイオン注入を被らず、同様に、第2伝導領域も第1伝導領域を形成する際のイオン注入を受けずに形成されているものとする。   The first conductive region 2 and the second conductive regions 3a and 3b are different in at least one of conductivity type (p-type and n-type distinction), ion-implanted impurity species, impurity concentration, and impurity implantation depth. Furthermore, the first conduction region does not suffer from ion implantation when forming the second conduction region, and similarly, the second conduction region also does not receive ion implantation when forming the first conduction region. It shall be formed.

図2は、図1に示したSiC半導体装置を線分AAで切断したときの理想的断面構造を模式図的に示している。図中、Lは第1伝導領域2の幅、L3aとL3bは第2伝導領域3a、3bの左片と右片の幅である。L3aとL3bはおなじ大きさを求められる場合が多いが、必ずしもそうとは限らない。 FIG. 2 schematically shows an ideal cross-sectional structure when the SiC semiconductor device shown in FIG. 1 is cut along a line AA. In the figure, L 2 is the first conductive region 2 of the width, the L 3a and L 3b is the width of the second conductive region 3a, 3b left piece and the right piece. L 3a and L 3b are often required to have the same size, but this is not always the case.

従来技術においては、それぞれ独立した位置決めに基づく第1伝導領域2の形成と第2伝導領域3a、3bの形成とを行っているので、第1伝導領域2と第2伝導領域3a、3bとの相互位置関係は、図1および2に示したように理想的なものとはならず、両領域の間に重なりと間隙が生じ、すでに説明した問題(1)〜(3)が生じる。   In the prior art, since the first conductive region 2 and the second conductive regions 3a and 3b are formed based on the independent positioning, the first conductive region 2 and the second conductive regions 3a and 3b are formed. The mutual positional relationship is not ideal as shown in FIGS. 1 and 2, and an overlap and a gap are generated between the two regions, and the problems (1) to (3) described above are generated.

これに対して、本発明においては、以下に説明する内接伝導領域複合体の製造方法によって、図1および2に示したように理想的な相対位置関係を有する内接伝導領域複合体を製造し、提供することができる。   On the other hand, in the present invention, an inscribed conductive region composite having an ideal relative positional relationship as shown in FIGS. 1 and 2 is manufactured by a method for manufacturing the inscribed conductive region composite described below. And can be provided.

(第1の実施形態)
本発明の第1の実施形態を、図3〜図4に示す工程断面図を参照しながら説明する。
(First embodiment)
A first embodiment of the present invention will be described with reference to process cross-sectional views shown in FIGS.

ここでは、SiC基板1を4H−SiC基板、第1伝導領域2を高不純物濃度のp+領域、第2伝導領域3a、3bを高不純物濃度のn+領域として、具体的製造条件を挙げて説明することにする。   Here, the SiC substrate 1 is a 4H-SiC substrate, the first conductive region 2 is a high impurity concentration p + region, and the second conductive regions 3a and 3b are high impurity concentration n + regions. I will decide.

(1A)まず、厚さ約1.5μmのSiO膜を、化学的気相成長(CVD)法で4H−SiC基板1の表面全面に堆積し、p+領域(第1伝導領域2)形成予定領域の上に堆積したSiO膜を周知のフォトリソグラフィ法と反応性イオン・エッチング技術(RIE)で選択的に除去し、図3(a)に示すように、その領域に開口部を有する、イオン注入用の第1マスクである、第1イオン注入マスク20を形成する。 (1A) First, a SiO 2 film having a thickness of about 1.5 μm is deposited on the entire surface of the 4H—SiC substrate 1 by chemical vapor deposition (CVD) to form a p + region (first conductive region 2). The SiO 2 film deposited on the region is selectively removed by a well-known photolithography method and reactive ion etching technique (RIE), and an opening is formed in the region, as shown in FIG. A first ion implantation mask 20 which is a first mask for ion implantation is formed.

(1B)つづいて、第1イオン注入マスク20およびその開口部におけるSiC基板1の全表面に、再びCVD法で薄いSiO膜からなる第1イオン注入スルー膜(非常に薄いため表示を省略)を堆積する。後述のAl(アルミニウムイオン)の注入条件では、第1イオン注入スルー膜の厚みは15〜25nmである。 (1B) Subsequently, a first ion implantation through film made of a thin SiO 2 film by CVD again on the entire surface of the SiC substrate 1 in the first ion implantation mask 20 and its opening (not shown because it is very thin) To deposit. Under the Al + (aluminum ion) implantation conditions described later, the thickness of the first ion implantation through film is 15 to 25 nm.

第1イオン注入スルー膜を堆積した後、SiC基板1全面にp型不純物イオンAlをSiCの結晶性を損なわないようにイオン注入し、図3(b)に示すように、第1イオン注入マスク20の開口部に、Alイオン注入層(第1イオン注入層21)を形成する。このイオン注入は、加熱したSiC基板1に、加速エネルギーとドーズ量を変えながら多段に注入することが好ましい。例えば、Alを、SiC基板1に多段イオン注入する場合の条件の一例を示すと:
◎p+領域(=第1伝導領域)イオン注入条件
イオン種Al
注入温度750℃
加速条件 30keV 1.0×1015/cm
50keV 1.0×1015/cm
70keV 2.0×1015/cm
100keV 3.0×1015/cm
となる。
After the first ion-implanted through film is deposited, p-type impurity ions Al + are ion-implanted on the entire surface of the SiC substrate 1 so as not to impair the crystallinity of SiC, and as shown in FIG. An Al ion implantation layer (first ion implantation layer 21) is formed in the opening of the mask 20. This ion implantation is preferably performed in multiple stages while changing the acceleration energy and the dose amount to the heated SiC substrate 1. For example, an example of conditions for performing multi-stage ion implantation of Al + into the SiC substrate 1 is as follows:
◎ p + region (= first conduction region) ion implantation condition ion species Al +
Injection temperature 750 ° C
Acceleration conditions 30 keV 1.0 × 10 15 / cm 2
50 keV 1.0 × 10 15 / cm 2
70 keV 2.0 × 10 15 / cm 2
100 keV 3.0 × 10 15 / cm 2
It becomes.

(1C)上記Alイオン注入が終了したところで、SiC基板1を十分に洗浄し、乾燥させる。その後、後述する第1イオン注入マスク20の再エッチング(RIE)において十分な耐性を有する、イオン注入用の第2マスクのマスク材である、第2イオン注入マスク材22、たとえば、多結晶シリコンを基板表面全面に等角写像的に厚く成膜すると、図3(c)のような、第1イオン注入マスク20の開口部が第1イオン注入マスク材22で完全に埋設された構造になる。このような目的に適した他の材料としては減圧CVD法やプラズマCVD法で成膜したSi膜を挙げることができる。 (1C) When the Al ion implantation is completed, the SiC substrate 1 is sufficiently washed and dried. Thereafter, a second ion implantation mask material 22, for example, polycrystalline silicon, which is a mask material for a second mask for ion implantation, having sufficient resistance in re-etching (RIE) of the first ion implantation mask 20 described later. When a thick film is formed in conformal mapping on the entire surface of the substrate, the opening of the first ion implantation mask 20 is completely embedded with the first ion implantation mask material 22 as shown in FIG. As another material suitable for such a purpose, a Si 3 N 4 film formed by a low pressure CVD method or a plasma CVD method can be given.

(1D)つづいて、プラズマエッチング装置で、基板1の表面に堆積した第1イオン注入マスク材22のエッチバックを行い、第1イオン注入マスク(SiO)20が露出したところで、エッチングを終了する。第2イオン注入マスク材22が多結晶シリコンである場合のエッチャントガスとしては、CF+O(4%)混合ガスを用いることができる。図3(d)に示すように、第1イオン注入マスク20の開口部に第2イオン注入マスク材22が充填され、それが、第1イオン注入マスク20および第1イオン注入層21に精密に自已整合した、イオン注入用の第2マスクの構成要素である第2イオン注入マスク23となっている。 (1D) Subsequently, the first ion implantation mask material 22 deposited on the surface of the substrate 1 is etched back by the plasma etching apparatus, and the etching is terminated when the first ion implantation mask (SiO 2 ) 20 is exposed. . As the etchant gas when the second ion implantation mask material 22 is polycrystalline silicon, a CF 4 + O 2 (4%) mixed gas can be used. As shown in FIG. 3D, the opening of the first ion implantation mask 20 is filled with the second ion implantation mask material 22, which precisely forms the first ion implantation mask 20 and the first ion implantation layer 21. A self-aligned second ion implantation mask 23 which is a constituent element of the second mask for ion implantation is formed.

上では、第2イオン注入マスク材(多結晶シリコン)22をエッチバックするのにプラズマエッチングを用いたが、このほかに、化学的機械的研磨法(CMP)を用いてエッチバックし、図3(d)と同様の構造を形成してもよい。この多結晶シリコンのCMPには少量のKOHを添加した有機アミン系の溶液に砥粒として1%以下のアルミナ粒子を懸濁したスラリーを用いると良好な結果が得られる。   In the above, plasma etching is used to etch back the second ion implantation mask material (polycrystalline silicon) 22, but in addition to this, etching back is performed using chemical mechanical polishing (CMP). A structure similar to (d) may be formed. In this polycrystalline silicon CMP, good results can be obtained by using a slurry in which 1% or less of alumina particles are suspended as abrasive grains in an organic amine solution to which a small amount of KOH is added.

(1E)第2イオン注入マスク23が形成されたところで、フォトリソグラフィによって図4(e)に示すようなフォトレジストマスク24を形成する。フォトレジストマスク24は、n+領域(すなわち第2伝導領域3a、3b)が形成される予定の領域の全てと第2イオン注入マスク23の領域の全てまたは大半を晒すように定義している。   (1E) When the second ion implantation mask 23 is formed, a photoresist mask 24 as shown in FIG. 4E is formed by photolithography. The photoresist mask 24 is defined so as to expose all of the regions where the n + regions (that is, the second conductive regions 3a and 3b) are to be formed and all or most of the regions of the second ion implantation mask 23.

(1F)つぎに、フォトレジストマスク24をマスクとして、基板1表面の第1イオン注入マスク(SiO)20の再RIEを行う。このとき、第2イオン注入マスク(多結晶シリコン)23がエッチングされないエッチャントガスを使用することが肝要である。もし、第2イオン注入マスク23が多結晶シリコンである場合には、CF+H混合ガス系のエッチャントガスを使用するとよい。エッチングが終了したら、フォトレジストマスク24を灰化する。基板1は図4(f)の構造になる。ここで、25は第1イオン注入マスク20のマスク材であるSiOを素材として形成され、イオン注入用の第2マスクの構成要素となる第3イオン注入マスクである。 (1F) Next, using the photoresist mask 24 as a mask, re-RIE of the first ion implantation mask (SiO 2 ) 20 on the surface of the substrate 1 is performed. At this time, it is important to use an etchant gas that does not etch the second ion implantation mask (polycrystalline silicon) 23. If the second ion implantation mask 23 is polycrystalline silicon, a CF 4 + H 2 mixed gas etchant gas may be used. When the etching is completed, the photoresist mask 24 is ashed. The substrate 1 has the structure shown in FIG. Here, reference numeral 25 denotes a third ion implantation mask which is formed by using SiO 2 which is a mask material of the first ion implantation mask 20 as a constituent element of the second mask for ion implantation.

(1G)つぎに、基板表面全面に厚みが20〜30nmのSiOからなる第2イオン注入スルー膜(非表示)をCVD法で堆積したのち、基板1表面に向けてn型の不純物P(リン)を選択イオン注入すると、第2イオン注入領層26が形成される(図4(g))。この時使用されるイオン注入用の第2マスクは、図4(f)、(g)から明らかなように、第2イオン注入マスク(多結晶シリコン)23と第3イオン注入マスク(SiO)25の両方から構成される。 (1G) Next, after depositing a second ion-implanted through film (not shown) made of SiO 2 having a thickness of 20 to 30 nm on the entire surface of the substrate by the CVD method, an n-type impurity P ( When phosphorus is selectively ion-implanted, a second ion-implanted region layer 26 is formed (FIG. 4G). As is apparent from FIGS. 4F and 4G, the second mask for ion implantation used at this time is a second ion implantation mask (polycrystalline silicon) 23 and a third ion implantation mask (SiO 2 ). 25.

このPイオンの注入は、加熱したSiC基板1に、加速エネルギーとドーズ量を変えながら多段に注入することが好ましい。以下は注入条件の一例である。◎n+領域(=第2伝導領域)イオン注入条件
イオン種P(リン)
注入温度500℃
加速条件 40keV 5.0×1014/cm
70keV 6.0×1014/cm
100keV 1.0×1015/cm
160keV 2.0×1015/cm
This P + ion implantation is preferably performed in multiple stages while changing the acceleration energy and the dose amount to the heated SiC substrate 1. The following is an example of injection conditions. ◎ n + region (= second conduction region) ion implantation condition ion species P + (phosphorus)
Injection temperature 500 ° C
Acceleration conditions 40 keV 5.0 × 10 14 / cm 2
70 keV 6.0 × 10 14 / cm 2
100 keV 1.0 × 10 15 / cm 2
160 keV 2.0 × 10 15 / cm 2 .

(1H)第2イオン注入が終了したところで、基板1をフッ酸と硝酸の混合溶液に浸漬して、基板表面からイオン注入マスク(23と25)と第2イオン注入スルー膜を完全に除去する。そして、乾燥してから、基板1を常圧Ar雰囲気で1700℃、1分の急速加熱処理を行うと、イオン注入された不純物であるAlとPが活性化されて、Alイオン注入層(第1イオン注入層22)はp+領域(第1伝導領域2)に、Pイオン注入層(第2イオン注入層26)はn+領域(第2伝導領域3a、3b)となり、図2に示した所望のpn領域構造体が完成する。   (1H) When the second ion implantation is completed, the substrate 1 is immersed in a mixed solution of hydrofluoric acid and nitric acid to completely remove the ion implantation mask (23 and 25) and the second ion implantation through film from the substrate surface. . Then, after drying, if the substrate 1 is subjected to a rapid heat treatment at 1700 ° C. for 1 minute in an atmospheric pressure Ar atmosphere, Al and P, which are ion-implanted impurities, are activated, and an Al ion-implanted layer (first layer) The 1 ion implantation layer 22) becomes a p + region (first conduction region 2), and the P ion implantation layer (second ion implantation layer 26) becomes an n + region (second conduction regions 3a and 3b). The pn region structure is completed.

以上の構造および製造方法の詳細な説明から明らかなように、本発明に係る内接伝導領域複合体においては、第1伝導領域2へのイオン注入と第2伝導領域3a、3bへのイオン注入とが重ならず、しかも、間隙も空けずに行われ、その結果として、第1伝導領域2と第2伝導領域3a、3bとは、共通部分を持たず、間隙をも持たないようになる。また、第1伝導領域2と第2伝導領域3a、3bとが不純物種において相違している場合には、第1伝導領域2は第2伝導領域3a、3bのイオン注入不純物を含まず、第2伝導領域3a、3bは第1伝導領域2のイオン注入不純物を含まない。   As is clear from the detailed description of the structure and the manufacturing method described above, in the inscribed conduction region composite according to the present invention, ion implantation into the first conduction region 2 and ion implantation into the second conduction regions 3a and 3b. And the first conductive region 2 and the second conductive regions 3a and 3b have no common part and no gap as a result. . In addition, when the first conductive region 2 and the second conductive regions 3a and 3b are different in impurity species, the first conductive region 2 does not include the ion-implanted impurities of the second conductive regions 3a and 3b. The two conduction regions 3a and 3b do not contain the ion implantation impurity of the first conduction region 2.

本実施形態において製造された、本発明に係る炭化珪素半導体装置の内接伝導領域複合体であるpn領域構造体においては、前述の従来技術の問題が解決されている。すなわち、第1伝導領域2と第2伝導領域3a、3bとは、共通部分を持っていないので、第1伝導領域と第2伝導領域とが重なることによって、それぞれが正常に動作する面積(有効面積)が減少するという問題、すなわち、前述の従来技術の問題(1)が解決される。これと同様の理由で、所望の有効面積を確保するためには、第1伝導領域と第2伝導領域の設計面積を合わせ誤差の分だけ大きく設計しなくてはならない、という従来技術の問題(3)も解決される。さらに、2つの領域が設計通りに形成されているので、構造の非対称性によって電気特性に非対称性が表れて意図した電気特性が得られない、という従来技術の問題(2)も解決される。   In the pn region structure which is the inscribed conduction region composite body of the silicon carbide semiconductor device according to the present invention manufactured in the present embodiment, the above-described problems of the conventional technology are solved. That is, since the first conduction region 2 and the second conduction regions 3a and 3b do not have a common part, the first conduction region and the second conduction region overlap each other, so that each area operates normally (effective The problem that the area is reduced, that is, the problem (1) of the above-described prior art is solved. For the same reason, in order to secure a desired effective area, there is a problem in the prior art that the design areas of the first conduction region and the second conduction region must be designed to be larger by the error. 3) is also solved. Further, since the two regions are formed as designed, the problem (2) of the prior art that the asymmetry appears in the electrical characteristics due to the asymmetry of the structure and the intended electrical characteristics cannot be obtained is solved.

(第2の実施形態)
本発明の第2の実施形態は、上記第1の実施形態と同様に、上記従来の内接伝導領域複合体の問題(1)〜(3)をすべて解決できる極めて有用な技術である。
(Second Embodiment)
The second embodiment of the present invention is a very useful technique that can solve all the problems (1) to (3) of the conventional inscribed conductive region composite as in the first embodiment.

以下、図5〜図6に示す工程断面図を参照しながら、本発明に係る内接伝導領
域複合体であるpn領域構造体の製造方法を説明する。ここでは、SiC基板を4H−SiC基板、第1伝導領域2を高不純物濃度のp+領域、第2伝導領域を高不純物濃度のn+領域として、具体的製造条件を挙げて説明することにする。
Hereinafter, the manufacturing method of the pn region structure which is the inscribed conductive region composite according to the present invention will be described with reference to the process cross-sectional views shown in FIGS. Here, the SiC substrate is a 4H-SiC substrate, the first conductive region 2 is a high impurity concentration p + region, and the second conductive region is a high impurity concentration n + region.

(2A)まず、厚さ約1.5μmのSiO膜を、化学的気相成長(CVD)法で4H−SiC基板1の表面全面に堆積し、n+領域(第2伝導領域3a、3b)形成予定領域の上にあるSiO膜を周知のフォトリソグラフィ法と反応性イオン・エッチング技術(RIE)で選択的に除去し、図5(a)に示すように、その領域に開口部を有する、イオン注入用の第1マスクである、第1イオン注入マスク30を形成する。 (2A) First, a SiO 2 film having a thickness of about 1.5 μm is deposited on the entire surface of the 4H—SiC substrate 1 by a chemical vapor deposition (CVD) method, and an n + region (second conductive regions 3a, 3b). The SiO 2 film on the region to be formed is selectively removed by a well-known photolithography method and reactive ion etching technique (RIE), and an opening is formed in that region as shown in FIG. Then, a first ion implantation mask 30 which is a first mask for ion implantation is formed.

(2B)つづいて、基板1の表面に再びCVD法で薄いSiO膜からなるイオン注入スルー膜を堆積した後、基板1全面にn型不純物P(リン)イオンをSiCの結晶性を損なわないようにイオン注入し、図5(b)に示すように、第1イオン注入マスク30の開口部に、第1イオン注入層31を形成する。後述のP(リンイオン)の注入条件では、このイオン注入スルー膜の厚みは20〜30nmである。なお、このイオン注入スルー膜は非常に薄いので、以下、図中には表示しない。 (2B) Subsequently, after depositing an ion-implanted through film made of a thin SiO 2 film on the surface of the substrate 1 again by the CVD method, n-type impurity P (phosphorus) ions are not impaired on the entire surface of the substrate 1 without damaging the crystallinity of SiC. The first ion implantation layer 31 is formed in the opening of the first ion implantation mask 30 as shown in FIG. Under the conditions of P + (phosphorus ion) implantation described later, the thickness of this ion implanted through film is 20 to 30 nm. Since this ion-implanted through film is very thin, it is not shown in the figure below.

上記イオンの注入は、加熱した基板1に、加速エネルギーとドーズ量を変えながら多段に注入することが好ましい。以下は注入条件の一例である。
◎n+領域(=第2伝導領域)イオン注入条件
イオン種P(リン)
注入温度500℃
加速条件 40keV 5.0×1014/cm
70keV 6.0×1014/cm
100keV 1.0×1015/cm
160keV 2.0×1015/cm
The ion implantation is preferably performed in multiple stages on the heated substrate 1 while changing the acceleration energy and the dose amount. The following is an example of injection conditions.
◎ n + region (= second conduction region) ion implantation condition ion species P + (phosphorus)
Injection temperature 500 ° C
Acceleration conditions 40 keV 5.0 × 10 14 / cm 2
70 keV 6.0 × 10 14 / cm 2
100 keV 1.0 × 10 15 / cm 2
160 keV 2.0 × 10 15 / cm 2 .

(2C)Pイオン注入が終了したところで、基板1を十分に洗浄し、乾燥させる。その後、イオン注入用のマスクのマスク材である第2イオン注入マスク材32を、基板1表面に、図5(c)に示すように、等角写像的に厚く成膜する。この第2イオン注入マスク材32は後述する第1イオン注入マスク30の再エッチング(RIE)を行う際に、エッチャントガスに対して十分な耐性を有する材料が選ばれる。たとえば、減圧CVDやプラズマCVDで堆積した多結晶シリコンやSiなどが該当するが、これに限定されるものではない。成膜が終了すると、図5(c)のように、第1イオン注入マスク30の開口部が第2イオン注入マスク材32で完全に埋設された構造になる。 (2C) When the P ion implantation is completed, the substrate 1 is sufficiently washed and dried. Thereafter, a second ion implantation mask material 32, which is a mask material for the mask for ion implantation, is formed on the surface of the substrate 1 to be thick in conformal mapping as shown in FIG. As the second ion implantation mask material 32, a material having sufficient resistance to an etchant gas is selected when re-etching (RIE) of the first ion implantation mask 30 described later. For example, polycrystalline silicon deposited by low pressure CVD or plasma CVD, Si 3 N 4, and the like are applicable, but the present invention is not limited to this. When the film formation is completed, the opening of the first ion implantation mask 30 is completely embedded with the second ion implantation mask material 32 as shown in FIG.

(2D)つづいて、プラズマエッチング装置で基板1の表面に堆積した第2イオン注入マスク材32のエッチバックを行い、図5(d)に示すように、第1イオン注入マスク(SiO)30が露出したところで、エッチングを終了する。第2イオン注入マスク材32が多結晶シリコンである場合のエッチャントガスとしては、CF+O(4%)混合ガスを用いることができる。図5(d)に示すように、第1イオン注入マスク30の開口部に第2イオン注入マスク材32が充填され、それが、第1イオン注入マスク30および第1イオン注入層31に精密に自已整合した、イオン注入用の第2マスクの構成要素である第2イオン注入マスク33となっている。 (2D) Subsequently, the second ion implantation mask material 32 deposited on the surface of the substrate 1 is etched back by the plasma etching apparatus, and the first ion implantation mask (SiO 2 ) 30 as shown in FIG. Etching is terminated when is exposed. As the etchant gas when the second ion implantation mask material 32 is polycrystalline silicon, a mixed gas of CF 4 + O 2 (4%) can be used. As shown in FIG. 5D, the opening of the first ion implantation mask 30 is filled with the second ion implantation mask material 32, and this is precisely applied to the first ion implantation mask 30 and the first ion implantation layer 31. The second ion implantation mask 33 is a self-aligned second ion implantation mask which is a component of the second mask for ion implantation.

上では、第2イオン注入マスク材32をエッチバックするのにプラズマエッチングを用いたが、このほかに化学的機械的研磨法(CMP)を用いてエッチバックして、図5(d)と同様の構造を形成してもよい。第2イオン注入マスク材32が多結晶シリコンである場合のCMPには、少量のKOHを添加した有機アミン系の溶液に砥粒として1%以下のアルミナ粒子を懸濁したスラリーを用いると良好な結果が得られる。   In the above, plasma etching is used to etch back the second ion implantation mask material 32, but in addition to this, etching back is performed using a chemical mechanical polishing method (CMP), as in FIG. 5D. The structure may be formed. For CMP when the second ion implantation mask material 32 is polycrystalline silicon, it is preferable to use a slurry in which 1% or less of alumina particles are suspended as abrasive grains in an organic amine-based solution to which a small amount of KOH is added. Results are obtained.

(2E)第2イオン注入マスク33が形成されたところで、フォトリソグラフィで図6(e)のような形状のフォトレジストマスク34を基板1の表面に形成する。図から判るように、フォトレジストマスク34は、p+領域(すなわち第1伝導領域2)となる領域の全てと第2イオン注入マスク33の領域の概ね半分を晒すように定義している。このフォトリソグラフィでは、フォトレジストマスク34の開口部端が第2イオン注入マスク33の上面の位置ならどこにあってもよく、またそのことが、後述するように、第1伝導領域の位置精度には影響を与えないので、精密な合わせを特に必要としない。   (2E) When the second ion implantation mask 33 is formed, a photoresist mask 34 having a shape as shown in FIG. 6E is formed on the surface of the substrate 1 by photolithography. As can be seen from the figure, the photoresist mask 34 is defined so as to expose all of the region to be the p + region (that is, the first conductive region 2) and approximately half of the region of the second ion implantation mask 33. In this photolithography, the end of the opening of the photoresist mask 34 may be located anywhere on the upper surface of the second ion implantation mask 33, and this is necessary for the positional accuracy of the first conductive region, as will be described later. Since it does not affect, no precise alignment is required.

(2F)つぎに、RIEを行い、基板1表面の第1イオン注入マスク(SiO)30の、第2イオン注入マスク33に挟持された部分を選択的に除去し、第3のイオン注入マスク(SiO)35を形成する。このとき、表面が露出している第2イオン注入マスク(多結晶シリコン)33がエッチングされないエッチャントガスを使用することが重要なポイントである。もし、第2イオン注入マスク33が多結晶シリコンである場合にはCF+H混合ガス系のエッチャントガスを使用するとよい。エッチングが終了し、フォトレジストマスク34を灰化除去すると、基板1は図6(f)の構造になる。 (2F) Next, RIE is performed to selectively remove a portion of the first ion implantation mask (SiO 2 ) 30 on the surface of the substrate 1 sandwiched between the second ion implantation masks 33, and a third ion implantation mask. (SiO 2 ) 35 is formed. At this time, it is important to use an etchant gas that does not etch the second ion implantation mask (polycrystalline silicon) 33 whose surface is exposed. If the second ion implantation mask 33 is polycrystalline silicon, a CF 4 + H 2 mixed gas type etchant gas may be used. When the etching is completed and the photoresist mask 34 is removed by ashing, the substrate 1 has the structure shown in FIG.

(2G)つぎに、基板表面全面に、厚みが15〜25nmのSiOからなるイオン注入スルー膜をCVD法で堆積したのち、基板1表面に向けてp型の不純物Al(アルミニウム)をイオン注入すると、図6(g)に示したように、所望の位置に第2イオン注入層36が正確に形成される。この時使用されるイオン注入用の第2マスクは、第2イオン注入マスク(多結晶シリコン)33と第3のイオン注入マスク(SiO)35とを構成要素とする。 (2G) Next, an ion-implanted through film made of SiO 2 having a thickness of 15 to 25 nm is deposited on the entire surface of the substrate by CVD, and then p-type impurity Al (aluminum) is ion-implanted toward the surface of the substrate 1 Then, as shown in FIG. 6G, the second ion implantation layer 36 is accurately formed at a desired position. The second mask for ion implantation used at this time has a second ion implantation mask (polycrystalline silicon) 33 and a third ion implantation mask (SiO 2 ) 35 as components.

このAlのイオン注入は、加熱したSiC基板1に、加速エネルギーとドーズ量を変えながら多段に注入することが好ましい。注入条件の一例を挙げると:
◎p+領域(=第1伝導領域)イオン注入条件
イオン種Al
注入温度750℃
加速条件 30keV 1.0×1015/cm
50keV 1.0×1015/cm
70keV 2.0×1015/cm
100keV 3.0×1015/cm
となる。
The ion implantation of Al + is preferably performed in multiple stages while changing the acceleration energy and the dose amount to the heated SiC substrate 1. An example of injection conditions is:
◎ p + region (= first conduction region) ion implantation condition ion species Al +
Injection temperature 750 ° C
Acceleration conditions 30 keV 1.0 × 10 15 / cm 2
50 keV 1.0 × 10 15 / cm 2
70 keV 2.0 × 10 15 / cm 2
100 keV 3.0 × 10 15 / cm 2
It becomes.

(2H)第2イオン注入が終了したところで、基板1をフッ酸と硝酸の混合溶液に浸漬して、基板表面からイオン注入マスク33と35と第2イオン注入スルー膜を完全に除去する。水洗し、乾燥してから、基板1を常圧Ar雰囲気で1700℃、1分の急速加熱処理を行うと、イオン注入された不純物AlとPが活性化されて、第2イオン注入層36はp+領域(第1伝導領域2)に、第1イオン注入層31はn+領域(第2伝導領域3a、3b)となり、図2に示した所望のpn領域構造体が完成する。   (2H) When the second ion implantation is completed, the substrate 1 is immersed in a mixed solution of hydrofluoric acid and nitric acid to completely remove the ion implantation masks 33 and 35 and the second ion implantation through film from the substrate surface. When the substrate 1 is subjected to a rapid heat treatment at 1700 ° C. for 1 minute in an atmospheric pressure Ar atmosphere after being washed with water and dried, the ion-implanted impurities Al and P are activated, and the second ion-implanted layer 36 becomes In the p + region (first conduction region 2), the first ion implantation layer 31 becomes an n + region (second conduction regions 3a, 3b), and the desired pn region structure shown in FIG. 2 is completed.

以上の構造および製造方法の詳細な説明から明らかなように、本発明に係る内接伝導領域複合体においては、第1伝導領域2へのイオン注入と第2伝導領域3a、3bへのイオン注入とが重ならず、しかも、間隙も空けずに行われ、その結果として、第1伝導領域2と第2伝導領域3a、3bとは、共通部分を持たず、間隙をも持たないようになる。したがって、2つの領域が重なることによって、それぞれが正常に動作する面積(有効面積)が減少するという問題、すなわち、前述の従来技術の問題(1)が解決される。これと同様の理由で、所望の有効面積を確保するためには、第1伝導領域と第2伝導領域の設計面積を合わせ誤差の分だけ大きく設計しなくてはならない、という従来技術の問題(3)も解決される。さらに、2つの領域が設計通りに形成されているので、構造の非対称性によって電気特性に非対称性が表れて意図した電気特性が得られない、という従来技術の問題(2)も解決される。特に、本実施形態においては、フォトレジストマスク34の開口部端が第2イオン注入マスク33の上面の位置ならどこにあってもよく、その位置がイオン注入の範囲に影響を与えないので、フォトレジストマスク34の形成に精密な合わせを特に必要としない、という特徴もある。   As is clear from the detailed description of the structure and the manufacturing method described above, in the inscribed conduction region composite according to the present invention, ion implantation into the first conduction region 2 and ion implantation into the second conduction regions 3a and 3b. And the first conductive region 2 and the second conductive regions 3a and 3b have no common part and no gap as a result. . Therefore, the problem that the area (effective area) in which each of the two regions operates normally decreases due to the overlap of the two regions, that is, the above-described problem (1) of the conventional technology is solved. For the same reason, in order to secure a desired effective area, there is a problem in the prior art that the design areas of the first conduction region and the second conduction region must be designed to be larger by the error. 3) is also solved. Further, since the two regions are formed as designed, the problem (2) of the prior art that the asymmetry appears in the electrical characteristics due to the asymmetry of the structure and the intended electrical characteristics cannot be obtained is solved. In particular, in the present embodiment, the opening end of the photoresist mask 34 may be located anywhere on the upper surface of the second ion implantation mask 33, and the position does not affect the ion implantation range. There is also a feature that precise alignment is not particularly required for forming the mask 34.

本発明に係るSiC半導体装置の内接伝導領域複合体の平面構造を示す図である。It is a figure which shows the planar structure of the inscribed conduction | electrical_connection area composite body of the SiC semiconductor device which concerns on this invention. 本発明に係るSiC半導体装置の内接伝導領域複合体の断面構造を模式的に示す図である。It is a figure which shows typically the cross-section of the inscribed conduction | electrical_connection area composite body of the SiC semiconductor device which concerns on this invention. 本発明の第1の実施形態の製造方法を説明する図である。It is a figure explaining the manufacturing method of the 1st Embodiment of this invention. 本発明の第1の実施形態の製造方法を説明する図である。It is a figure explaining the manufacturing method of the 1st Embodiment of this invention. 本発明の第2の実施形態の製造方法を説明する図である。It is a figure explaining the manufacturing method of the 2nd Embodiment of this invention. 本発明の第2の実施形態の製造方法を説明する図である。It is a figure explaining the manufacturing method of the 2nd Embodiment of this invention.

符号の説明Explanation of symbols

1…SiC基板、2…第1伝導領域、3a、3b…第2伝導領域、20…第1イオン注入マスク、21…第1イオン注入層、22…第2イオン注入マスク材、23…第2イオン注入マスク、24…フォトレジストマスク、25…第3イオン注入マスク、26…第2イオン注入層、30…第1イオン注入マスク、31…第1イオン注入層、32…第2イオン注入マスク材、33…第2イオン注入マスク、34…フォトレジストマスク、35…第3イオン注入マスク、36…第2イオン注入層。
DESCRIPTION OF SYMBOLS 1 ... SiC substrate, 2 ... 1st conduction region, 3a, 3b ... 2nd conduction region, 20 ... 1st ion implantation mask, 21 ... 1st ion implantation layer, 22 ... 2nd ion implantation mask material, 23 ... 2nd Ion implantation mask, 24 ... Photoresist mask, 25 ... Third ion implantation mask, 26 ... Second ion implantation layer, 30 ... First ion implantation mask, 31 ... First ion implantation layer, 32 ... Second ion implantation mask material 33 ... Second ion implantation mask, 34 ... Photoresist mask, 35 ... Third ion implantation mask, 36 ... Second ion implantation layer.

Claims (5)

半導体炭化珪素基板の表面の限定された部分への選択イオン注入で形成された第1伝導領域と、前記第1伝導領域に密接し該領域を包囲するか挟持するように、前記基板の表面の限定された部分への選択イオン注入で形成された第2伝導領域とからなリ、前記第1伝導領域と前記第2伝導領域との間には共通部分も間隙も無いことを特徴とする、炭化珪素半導体装置の内接伝導領域複合体。   A first conductive region formed by selective ion implantation into a limited portion of the surface of the semiconductor silicon carbide substrate; and a surface of the substrate so as to be in close contact with the first conductive region and to surround or sandwich the region. The second conductive region formed by selective ion implantation into a limited portion is characterized in that there is no common portion and no gap between the first conductive region and the second conductive region. Inscribed conductive region composite of silicon carbide semiconductor device. 前記第1伝導領域と前記第2伝導領域とは導電型、不純物種、不純物濃度、不純物注入深さのうちの少なくとも1つにおいて相違していることを特徴とする請求項1記載の炭化珪素半導体装置の内接伝導領域複合体。   2. The silicon carbide semiconductor according to claim 1, wherein the first conductive region and the second conductive region differ in at least one of conductivity type, impurity species, impurity concentration, and impurity implantation depth. Inscribed conduction region composite of the device. 前記第1伝導領域と前記第2伝導領域とは不純物種において相違し、前記第1伝導領域は前記第2伝導領域のイオン注入不純物を含まず、前記第2伝導領域は前記第1伝導領域のイオン注入不純物を含まないことを特徴とする請求項1記載の炭化珪素半導体装置の内接伝導領域複合体。   The first conduction region and the second conduction region are different in impurity species, the first conduction region does not include ion-implanted impurities of the second conduction region, and the second conduction region is the first conduction region. 2. The inscribed conductive region composite body of a silicon carbide semiconductor device according to claim 1, which does not contain an ion implantation impurity. 半導体炭化珪素基板の表面の限定された部分への選択イオン注入で形成された第1伝導領域と、前記第1伝導領域に密接し該領域を包囲するか挟持するように、前記基板の表面の限定された部分への選択イオン注入で形成された第2伝導領域とからなる、炭化珪素半導体装置の内接伝導領域複合体を製造する、炭化珪素半導体装置の内接伝導領域複合体の製造方法であって、
少なくとも、前記基板の表面にイオン注入用の第1マスクを形成する工程と、前記第1マスクの開口部を通して前記基板への選択イオン注入を行って前記第1伝導領域を形成する工程と、前記基板の表面に前記第1マスクに自己整合させてイオン注入用の第2マスクを形成する工程と、前記第2マスクの開口部を通して前記基板への選択イオン注入を行って前記第2伝導領域を形成する工程と、前記第1伝導領域にイオン注入された不純物および前記第2伝導領域にイオン注入された不純物を活性化させる工程とを有することを特徴とする炭化珪素半導体装置の内接伝導領域複合体の製造方法。
A first conductive region formed by selective ion implantation into a limited portion of the surface of the semiconductor silicon carbide substrate; and a surface of the substrate so as to be in close contact with the first conductive region and to surround or sandwich the region. Manufacturing method of inscribed conductive region composite of silicon carbide semiconductor device, manufacturing inscribed conductive region composite of silicon carbide semiconductor device, comprising second conductive region formed by selective ion implantation to limited portion Because
Forming at least a first mask for ion implantation on a surface of the substrate; performing selective ion implantation on the substrate through an opening of the first mask to form the first conductive region; and Forming a second mask for ion implantation in self-alignment with the first mask on the surface of the substrate; and performing selective ion implantation into the substrate through the opening of the second mask to form the second conductive region. And a step of activating the impurity ion-implanted into the first conductive region and the impurity ion-implanted into the second conductive region. A method for producing a composite.
半導体炭化珪素基板の表面の限定された部分への選択イオン注入で形成された第1伝導領域と、前記第1伝導領域に密接し該領域を包囲するか挟持するように、前記基板の表面の限定された部分への選択イオン注入で形成された第2伝導領域とからなる、炭化珪素半導体装置の内接伝導領域複合体を製造する、炭化珪素半導体装置の内接伝導領域複合体の製造方法であって、
少なくとも、前記基板の表面にイオン注入用の第1マスクを形成する工程と、前記第1マスクの開口部を通して前記基板への選択イオン注入を行って前記第2伝導領域を形成する工程と、前記基板の表面に前記第1マスクに自己整合させてイオン注入用の第2マスクを形成する工程と、前記第2マスクの開口部を通して前記基板への選択イオン注入を行って前記第1伝導領域を形成する工程と、前記第1伝導領域にイオン注入された不純物および前記第2伝導領域にイオン注入された不純物を活性化させる工程とを有することを特徴とする炭化珪素半導体装置の内接伝導領域複合体の製造方法。
A first conductive region formed by selective ion implantation into a limited portion of the surface of the semiconductor silicon carbide substrate and a surface of the substrate so as to be in close contact with the first conductive region and surround or sandwich the region; Manufacturing method of inscribed conductive region composite of silicon carbide semiconductor device, manufacturing inscribed conductive region composite of silicon carbide semiconductor device, comprising second conductive region formed by selective ion implantation into limited portion Because
At least a step of forming a first mask for ion implantation on the surface of the substrate; a step of performing selective ion implantation into the substrate through an opening of the first mask to form the second conductive region; Forming a second mask for ion implantation in self-alignment with the first mask on the surface of the substrate; and performing selective ion implantation into the substrate through an opening of the second mask to form the first conductive region. And a step of activating the impurity ion-implanted into the first conductive region and the impurity ion-implanted into the second conductive region. A method for producing a composite.
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2011013364A1 (en) * 2009-07-28 2011-02-03 パナソニック株式会社 Method for producing semiconductor element
US8125005B2 (en) 2006-05-18 2012-02-28 Panasonic Corporation Semiconductor element and method for manufacturing same
DE112010003053T5 (en) 2009-07-24 2012-06-21 Mitsubishi Electric Corporation A method of manufacturing a silicon carbide semiconductor device

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8125005B2 (en) 2006-05-18 2012-02-28 Panasonic Corporation Semiconductor element and method for manufacturing same
DE112010003053T5 (en) 2009-07-24 2012-06-21 Mitsubishi Electric Corporation A method of manufacturing a silicon carbide semiconductor device
US8367536B2 (en) 2009-07-24 2013-02-05 Mitsubishi Electric Corporation Method for manufacturing silicon carbide semiconductor device
DE112010003053B4 (en) * 2009-07-24 2013-10-10 Mitsubishi Electric Corporation A method of manufacturing a silicon carbide semiconductor device
WO2011013364A1 (en) * 2009-07-28 2011-02-03 パナソニック株式会社 Method for producing semiconductor element
CN102203925A (en) * 2009-07-28 2011-09-28 松下电器产业株式会社 Method for producing semiconductor element
US8222107B2 (en) 2009-07-28 2012-07-17 Panasonic Corporation Method for producing semiconductor element

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