JP2005536907A - シグマ−デルタ変換を用いたイメージ排斥回路 - Google Patents
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不適用
-sin(RF-LO); 及び
-sin(RF+LO)
である。
cos(RF-LO); 及び
cos(RF+LO)
である。
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2 1 0 0 0 1 1 1 1
3 1 0 0 0 1 1 1 1
4 1 0 0 0 1 1 1 1
5 1 0 0 0 1 1 1 1
6 1 0 0 0 1 1 1 1
7 1 0 0 1 1 1 1 1
8 1 0 0 0 1 1 1 1
9 1 0 0 1 1 1 1 1
10 1 0 0 0 1 1 1 1
11 1 0 0 1 1 1 1 1
12 1 0 0 1 1 1 1 1
13 1 0 0 1 1 1 1 1
14 1 0 1 0 1 1 1 1
15 1 0 0 1 1 1 1 1
16 1 0 0 1 1 1 1 1
17 1 0 1 0 1 1 1 1
18 1 0 1 0 1 1 1 1
19 1 0 1 0 1 1 1 1
20 1 0 0 1 1 1 1 1
21 1 0 1 1 1 1 1 1
22 1 0 1 0 1 1 1 1
23 1 0 1 0 1 1 1 1
24 1 0 1 0 1 1 1 0
25 1 0 1 1 1 1 1 1
26 1 0 1 0 1 1 1 0
27 1 0 1 1 1 1 1 1
28 1 0 1 1 1 1 1 0
29 1 0 1 1 1 1 1 1
30 1 0 1 1 1 1 1 0
31 1 0 1 1 1 1 1 0
32 1 0 1 1 1 1 1 0
33 1 1 0 0 1 1 1 0
34 1 0 1 1 1 1 1 0
35 1 1 0 0 1 1 1 0
36 1 0 1 1 1 1 1 0
37 1 1 0 0 1 1 1 0
38 1 1 0 0 1 1 1 0
39 1 1 0 0 1 1 0 1
40 1 1 0 0 1 1 1 0
41 1 1 0 0 1 1 0 1
42 1 1 0 0 1 1 1 0
43 1 1 0 1 1 1 0 1
44 1 1 0 0 1 1 0 1
45 1 1 0 1 1 1 0 1
46 1 1 0 0 1 1 1 0
47 1 1 0 1 1 1 0 1
48 1 1 0 1 1 1 0 1
49 1 1 0 0 1 1 0 0
50 1 1 0 1 1 1 0 1
51 1 1 0 1 1 1 0 1
52 1 1 1 0 1 1 0 0
53 1 1 0 1 1 1 0 1
54 1 1 0 1 1 1 0 0
55 1 1 0 1 1 1 0 1
56 1 1 1 0 1 1 0 0
57 1 1 0 1 1 1 0 0
58 1 1 1 0 1 1 0 0
59 1 1 0 1 1 1 0 0
60 1 1 1 0 1 1 0 0
61 1 1 1 0 1 1 0 0
62 1 1 1 0 1 0 1 1
63 1 1 1 0 1 1 0 0
64 1 1 1 0 1 0 1 1
65 1 1 1 0 1 1 0 0
66 1 1 1 0 1 0 1 1
67 1 1 1 0 1 0 1 1
68 1 1 1 0 1 0 1 1
69 1 1 1 1 1 0 1 1
70 1 1 1 0 1 0 1 1
71 1 1 1 1 1 0 1 1
72 1 1 1 0 1 0 1 0
73 1 1 1 1 1 0 1 1
74 1 1 1 0 1 0 1 0
75 1 1 1 1 1 0 1 0
76 1 1 1 1 1 0 1 0
77 1 1 1 1 1 0 1 1
78 1 1 1 1 1 0 0 1
79 1 1 1 1 1 0 1 0
80 1 1 1 1 1 0 1 0
81 1 1 1 1 1 0 1 0
82 1 1 1 1 1 0 0 1
83 1 1 1 1 1 0 0 1
84 1 1 1 1 1 0 1 0
85 1 1 1 1 1 0 0 1
86 1 1 1 1 1 0 0 1
87 1 1 1 1 1 0 0 1
88 1 1 1 1 1 0 0 0
89 1 1 1 1 1 0 0 1
90 1 1 1 1 1 0 0 0
91 1 1 1 1 1 0 0 1
92 1 1 1 1 1 0 0 0
93 1 1 1 1 1 0 0 0
94 1 1 1 1 1 0 0 0
95 1 1 1 1 1 0 0 0
96 1 1 1 1 1 0 0 0
97 1 1 1 1 1 0 0 0
98 1 1 1 1 0 1 1 1
Claims (10)
- ディジタル化された通信信号の同相及び直角信号成分をダウン変換するためのデジタル中間周波数ダウン変換回路において、ディジタル信号の同相及び直角信号成分を処理するための方法であって、
一組の単純なロジックを介して同相及び直角信号成分から形成される単一の直列ディジタル・ビット・ストリームを処理して、ダウン変換された同相及び直角成分のディジタル表現を生成する段階と、
実質的にイメージ・アーチファクトの無いベースバンド信号のディジタル表現を得るような態様で、ダウン変換された同相及び直角成分のディジタル表現を再構成フィルタと再結合する段階と、
を含む方法。 - 基準信号として、ソース・ディジタル・オシレータから長さにおいて4ビットの過サンプリング・ディジタル・ワードを用いる段階と、
ディジタル信号ミキサに前記基準信号を供給して、重大な位相または振幅エラー無しで正弦波ミキシング信号として少なくとも16レベルの正確さを達成する段階と、
クロックに従って、ディジタル化された直列ビット・ストリームを、基準信号を表す4ビット幅テーブルの出力とミキシングする段階と、
ディジタル的に結合された信号を得るために、同相及び直角信号をディジタル的に再結合する段階と、
抵抗の許容誤差によって影響されないダウン変換された信号を生成するために、結合された信号をディジタル再構成フィルタにバイナリで重み付けする段階と、
をさらに含む請求項1に記載の方法。 - ディジタル化された通信信号の同相及び直角信号成分をダウン変換するためのディジタルIFダウン変換回路において、ディジタル信号の同相及び直角信号成分のためのプロセッサであって、
同相及び直角信号成分から形成される単一の直列ディジタル・ビット・ストリームを処理して、ダウン変換された同相及び直角成分のディジタル表現を生成するロジックと、
実質的にイメージ・アーチファクトの無いベースバンド信号のディジタル表現を得るような態様で、ダウン変換された同相及び直角成分のディジタル表現を再結合するためのディジタル再構成フィルタと、
を備えたプロセッサ。 - ディジタル信号ミキサに、長さにおいて4ビットの過サンプリングされたディジタル・ワードを供給して、重大な位相または振幅エラー無しで、正弦波ミキシング信号のための少なくとも16レベルの正確さを達成するソース・ディジタル・オシレータをさらに含む請求項3に記載の回路。
- ディジタル的に再結合された信号をバイナリで重み付けして抵抗の許容誤差によって影響されないダウン変換された信号を生成するために、ディジタル再構成フィルタの入力に結合された抵抗手段をさらに含む請求項1に記載の回路。
- 受信されたRF信号のイメージ排斥処理を行う方法であって、
アナログI及びQ信号を生成するために、受信されたRF信号のダウン変換を行う段階と、
アナログI信号及びアナログQ信号の各々に対して、
過サンプリングされたディジタル信号を得るためにアナログ信号を過サンプリングする段階と、
過サンプリングされた周期的ディジタル基準信号を生成する段階と、
該ディジタル信号をディジタル基準信号と論理的に結合して、イメージが相殺されたディジタル・ベースバンド信号を生成する段階と、
を含む方法。 - ディジタル・ベースバンド信号をアナログ・ベースバンド信号に変換する段階を含む請求項6に記載の方法。
- ディジタル化された通信信号の同相及び直角信号成分を第1の中間周波数にダウン変換するために第1の局部発振器を用いる第1の周波数ダウン変換回路と、
同相ディジタル・ビット・ストリーム及び直角位相ディジタル・ビット・ストリームを発生するためのシグマ・デルタ変換器と、
ディジタル同相及び直角位相の第2の局部発振器と、
それぞれの単一の直列ディジタル・ビット・ストリーム同相信号及び単一の直列ディジタル・ビット・ストリーム直角位相信号を一組のロジック・ゲートを介してミキシングして、ダウン変換された同相及び直角成分のディジタル表現を生成するためのミキシング回路と、
同相信号及び直角位相信号における値に従って、ダウン変換された同相及び直角成分のディジタル表現を結合するためのロジック・ゲートの出力と直列の重み付け抵抗と、
実質的にイメージ・アーチファクトが無い前記ダウン変換された同相及び直角成分から同相及び直角位相ベースバンド信号を回復する再構成フィルタと、
を備えたイメージ排斥回路装置。 - 前記ミキシング回路は、各上位ビットごとに、
第1の入力として同相ディジタル・ビット・ストリームを、第2の入力として高精度の正弦関数ビット・ストリーム及び高精度の余弦関数ビット・ストリームを受信するように結合された第1及び第2の排他的ORゲートと、
第1の入力として直角位相ディジタル・ビット・ストリームを、第2の入力として高精度の正弦関数ビット・ストリームを受信するように結合された第3及び第4の排他的ORゲートと、
同相チャンネルのための第1及び第2のXORゲートの出力を論理的に加えるための第1のORゲートと、
同相チャンネルのための第1及び第2のXORゲートの出力を論理的に乗算するための第1のANDゲートと、
直角位相チャンネルのための第3及び第4のXORゲートの出力を論理的に加えるための第2のORゲートと、
直角位相チャンネルのための第3及び第4のXORゲートの出力を論理的に乗算するための第2のANDゲートと、
を備える請求項8に記載のイメージ排斥回路装置。 - 再構成フィルタは、
第1及び第2のANDゲート並びに第1及び第2のORゲートの各々の各出力のための重み付け抵抗であって、その対応のビットのためのバイナリの重み付けを限定する前記重み付け抵抗と、
第1のANDゲート及び第1のORゲートの第1の結合ノードにおける第1の低域フィルタ手段と、
第2のANDゲート及び第2のORゲートの第2の結合ノードにおける第2の低域フィルタ手段と、
を備え、同相チャンネルの前記重み付け抵抗の各々は、前記第1の低域フィルタに接続され、そして直角位相チャンネルの前記重み付け抵抗の各々は、前記第2のフィルタに接続されて、ベースバンドにおけるそれぞれのアナログI及びQチャンネル信号を生じる請求項9に記載のイメージ排斥回路装置。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US10/023,309 US7149261B2 (en) | 2001-12-15 | 2001-12-15 | Image reject circuit using sigma-delta conversion |
PCT/US2002/039976 WO2003052923A2 (en) | 2001-12-15 | 2002-12-16 | Frequency-down-converter using sigma-delta modulators |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2005536907A true JP2005536907A (ja) | 2005-12-02 |
Family
ID=21814331
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003553704A Withdrawn JP2005536907A (ja) | 2001-12-15 | 2002-12-16 | シグマ−デルタ変換を用いたイメージ排斥回路 |
Country Status (6)
Country | Link |
---|---|
US (2) | US7149261B2 (ja) |
EP (1) | EP1483829A2 (ja) |
JP (1) | JP2005536907A (ja) |
KR (1) | KR20040066903A (ja) |
AU (1) | AU2002357219A1 (ja) |
WO (1) | WO2003052923A2 (ja) |
Families Citing this family (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7136430B2 (en) | 2003-03-31 | 2006-11-14 | Nortel Networks Limited | Digital receiver and method |
US6987953B2 (en) * | 2003-03-31 | 2006-01-17 | Nortel Networks Limited | Digital transmitter and method |
TWI294208B (en) * | 2005-11-15 | 2008-03-01 | Realtek Semiconductor Corp | Harmonic elimination mixer |
KR101287843B1 (ko) * | 2006-11-01 | 2013-07-18 | 엘지전자 주식회사 | 단말기 및 구도화면 제공방법 |
US8538366B2 (en) | 2007-06-29 | 2013-09-17 | Silicon Laboratories Inc | Rotating harmonic rejection mixer |
US7860480B2 (en) | 2007-06-29 | 2010-12-28 | Silicon Laboratories Inc. | Method and apparatus for controlling a harmonic rejection mixer |
WO2009006189A2 (en) * | 2007-06-29 | 2009-01-08 | Silicon Laboratories Inc. | A rotating harmonic rejection mixer |
US8260244B2 (en) * | 2007-06-29 | 2012-09-04 | Silicon Laboratories Inc. | Rotating harmonic rejection mixer |
US8503962B2 (en) * | 2007-06-29 | 2013-08-06 | Silicon Laboratories Inc. | Implementing a rotating harmonic rejection mixer (RHRM) for a TV tuner in an integrated circuit |
US7756504B2 (en) * | 2007-06-29 | 2010-07-13 | Silicon Laboratories Inc. | Rotating harmonic rejection mixer |
US8374302B2 (en) | 2008-08-06 | 2013-02-12 | Nxp B.V. | Device for and a method of processing data signals |
US8571512B2 (en) | 2012-01-05 | 2013-10-29 | Silicon Laboratories Inc. | Implementing a passive rotating harmonic rejection mixer (RHRM) for a TV tuner in an integrated circuit |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5357544A (en) * | 1992-07-21 | 1994-10-18 | Texas Instruments, Incorporated | Devices, systems, and methods for composite signal decoding |
US5828955A (en) | 1995-08-30 | 1998-10-27 | Rockwell Semiconductor Systems, Inc. | Near direct conversion receiver and method for equalizing amplitude and phase therein |
DE69731354T2 (de) * | 1996-05-09 | 2005-10-27 | Koninklijke Philips Electronics N.V. | Empfänger, demodulator und demodulationsverfahren |
US6452958B1 (en) * | 1996-07-30 | 2002-09-17 | Agere Systems Guardian Corp | Digital modulation system using extended code set |
US6233287B1 (en) | 1997-04-04 | 2001-05-15 | Motorola, Inc. | Method and apparatus for mixing signals |
GB9711903D0 (en) * | 1997-06-10 | 1997-08-06 | Philips Electronics Nv | Receiver for independent sideband signals |
US6804497B2 (en) * | 2001-01-12 | 2004-10-12 | Silicon Laboratories, Inc. | Partitioned radio-frequency apparatus and associated methods |
CA2371090A1 (en) * | 1999-05-07 | 2000-11-16 | Morphics Technology Inc. | Programmable digital intermediate frequency transceiver |
WO2000072438A1 (en) * | 1999-05-25 | 2000-11-30 | Nokia Networks Oy | Linearisation and modulation device |
US6674812B1 (en) * | 1999-12-20 | 2004-01-06 | Agere Systems Inc. | High IF frequencies with a lower frequency logic based FSK modulation selecting a harmonic alias and demodulation using sub-sampling techniques |
US7352411B2 (en) * | 2000-12-15 | 2008-04-01 | Broadcom Corporation | Digital IF demodulator |
-
2001
- 2001-12-15 US US10/023,309 patent/US7149261B2/en not_active Expired - Lifetime
-
2002
- 2002-12-16 JP JP2003553704A patent/JP2005536907A/ja not_active Withdrawn
- 2002-12-16 KR KR10-2004-7009211A patent/KR20040066903A/ko not_active Application Discontinuation
- 2002-12-16 EP EP02805136A patent/EP1483829A2/en not_active Withdrawn
- 2002-12-16 WO PCT/US2002/039976 patent/WO2003052923A2/en not_active Application Discontinuation
- 2002-12-16 AU AU2002357219A patent/AU2002357219A1/en not_active Abandoned
-
2006
- 2006-11-13 US US11/598,035 patent/US7418062B2/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
US20070053469A1 (en) | 2007-03-08 |
US7149261B2 (en) | 2006-12-12 |
US20030138062A1 (en) | 2003-07-24 |
AU2002357219A8 (en) | 2003-06-30 |
EP1483829A2 (en) | 2004-12-08 |
WO2003052923A3 (en) | 2003-11-06 |
US7418062B2 (en) | 2008-08-26 |
WO2003052923A2 (en) | 2003-06-26 |
AU2002357219A1 (en) | 2003-06-30 |
KR20040066903A (ko) | 2004-07-27 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20050826 |
|
RD02 | Notification of acceptance of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7422 Effective date: 20061017 |
|
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20061027 |
|
A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A711 Effective date: 20061207 |
|
RD02 | Notification of acceptance of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7422 Effective date: 20061207 |
|
A761 | Written withdrawal of application |
Free format text: JAPANESE INTERMEDIATE CODE: A761 Effective date: 20070712 |