JP2005527906A - 分離式電源管理状態を提供する方法および装置 - Google Patents

分離式電源管理状態を提供する方法および装置 Download PDF

Info

Publication number
JP2005527906A
JP2005527906A JP2004507977A JP2004507977A JP2005527906A JP 2005527906 A JP2005527906 A JP 2005527906A JP 2004507977 A JP2004507977 A JP 2004507977A JP 2004507977 A JP2004507977 A JP 2004507977A JP 2005527906 A JP2005527906 A JP 2005527906A
Authority
JP
Japan
Prior art keywords
power state
power
acpi
state
extended configuration
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2004507977A
Other languages
English (en)
Other versions
JP4422017B2 (ja
Inventor
ヒコック,ゲリー,ディー
Original Assignee
エヌヴィディア コーポレイション
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by エヌヴィディア コーポレイション filed Critical エヌヴィディア コーポレイション
Publication of JP2005527906A publication Critical patent/JP2005527906A/ja
Application granted granted Critical
Publication of JP4422017B2 publication Critical patent/JP4422017B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/26Power supply means, e.g. regulation thereof
    • G06F1/32Means for saving power
    • G06F1/3203Power management, i.e. event-based initiation of a power-saving mode

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Power Sources (AREA)
  • Charge And Discharge Circuits For Batteries Or The Like (AREA)
  • Control Of Electric Motors In General (AREA)

Abstract

分離式電源管理状態を提供する新規な方法および装置。本発明は、電源管理状態についてのオペレーティングシステムの関与範囲をホストリソースのハードウェアの実際の状態についてのオペレーティングシステムの関与範囲から切り離すものである。すなわち、ホストオペレーティングシステム(200)が「オフ」であってもホストコンピュータ(100)のリソース(230)は作動し機能し続けることができ、かつホストシステムおよびユーザーにとっては電力の節約になるものである。

Description

本発明は、分離式電源管理状態を提供する新規なシステムに関する。より具体的には、本発明は、コンピュータシステムやネットワーク等のシステムに、オペレーティングシステム(OS)がスリープモードまたはスリープ状態にあるときでもホストシステムのリソースが作動しつづけられるようにするひとつ以上の代替電源管理状態を提供する。
開示内容の背景
現在、コンピュータシステムやネットワークは、電源管理機能を実行できる設計となっている。コンピュータシステムやネットワークが企業や家庭の場に急増し続けている中で、こうしたコンピュータシステムやネットワークの多くがアイドル状態にある、すなわちユーザーや他の装置からの命令を待っていることが多いということがわかっている。エネルギーの消費を抑えるために電源管理機能が備えられ、ユーザーが時間等のパラメータを定義すると、コンピュータシステムは、エネルギーを節約するために電源管理状態やスリープモードに入る。
この問題への取り組みとして、OSPM(Operating System−directed Configuration and Power Management)を可能にする業界標準インタフェースを確立するため、ACPI(拡張構成および電源インタフェース)の仕様が開発された。ACPIの目的のひとつは、コンピュータのオペレーティングシステムにおける電源管理を一元化し、それによって電源管理状態にある安価なハードウェアでも非常に複雑な電源管理ポリシーをサポートできるようにすることである。
OSにおける集中的な電源管理にはいくつかの利点があるものの、ネットワーク環境にコンピューティングデバイスが急速に広がりつつあるなかでは、特にリアルタイムの応答が重んじられる場合には、不都合も生じている。例えば、家庭にあるコンピュータがコンピュータ、例えば複数のビデオおよび/またはストリームを格納したホストコンピュータやDVDドライブを有するホストコンピュータのそれぞれのリソースを共有できる形でネットワーク化できるような場合である。格納されているビデオおよび/またはストリーム、あるいはDVDドライブにアクセスするには、リモートコンピュータはホストコンピュータのOSに要求を送信しなければならない。運悪く、ホストコンピュータが「オン」になってからしばらく時間が経過していると、OS電源管理の機能が働いてシステムを省電力状態に移行させてしまっている可能性がある。リモートコンピュータの要求に応じるには、ホストコンピュータは作動状態に復旧もしくは復帰しなければならず、それにはかなりの時間が必要な場合もある。
従って、コンピュータシステムやネットワーク等のシステムに、オペレーティングシステム(OS)がスリープモードまたはスリープ状態にあるときでもホストシステムのリソースが作動しつづけられるようにするひとつ以上の代替電源管理状態を提供する新規な分離式電源管理アプローチが必要とされている。
発明の概要
本発明は、分離式電源管理状態を提供する新規な方法および装置である。より具体的には、本発明は、電源管理状態についてのオペレーティングシステムの関与範囲をホストリソースのハードウェアの実際の状態についてのオペレーティングシステムの関与範囲から切り離すものである。すなわち、ホストオペレーティングシステムが「オフ」であってもホストコンピュータのリソースは作動し機能し続けることができ、かつホストシステムおよびユーザーにとっては電力の節約になるというものである。
オペレーティングシステムの機能は一般に、ユーザーをさまざまな用途のホストリソースに接続することである。しかしながら、ホストリソースが、オペレーティングシステムの関与なしにユーザーやその他の外部クライアント(ネットワークを介した操作等)に応じられる場合がある(例えばCDやDVDの再生等)。
本発明の一実施形態では、分離式電源管理は、状態が保存/復元される場合にOSの干渉なしにBIOSを呼び出すことができるようにすることによって、電源管理(PM)状態に移行する際および電源管理状態から抜け出す際に、BIOSを介して実行される。このアプローチの下では、システムが一時的に「オフ」状態にあっても、ホストコンピュータの周辺機器の状態管理と制御がリアルタイムに実現できる。オペレーティングシステムが起動またはある状態に復旧するのを待たなければならないというのでは、リアルタイムの応答が必要な用途には役に立たない。
さらに、新しい電源供給技術と新しいCPUの電圧/周波数の技術によって、コンピューティングシステムのシステムファンは、こうした簡単な作業をごくたまにしか行わないときには作動させる必要がない場合もある。また、システムが自らを危険にさらさぬよう、標準的なハードウェア監視方法を採用することもできる。この新規なアプローチが提供するのは、見かけ上システムが「オフ」になった状態とそれに伴う電力の節約であり、同時にホストコンピュータのリソースを作動可能な状態に維持することによるホストコンピュータの有用性の拡大である。この新規な方法は他にも種々多様な用途に応用できるものであり、上記のネットワーク環境は説明のために示した例に過ぎない。
本発明の教示するところは、図面と以下の詳細な説明によって用意に理解されよう。
また、理解を容易にするため、可能な場合には各図に共通な同一要素は同じ符号で表されている。
詳細説明
図1は、本発明の分離式電源管理状態を提供するシステム100のブロック図である。特に、図1は、汎用コンピュータを用いて実施した本発明のシステム100を示している。コンピュータシステム100は、プロセッサ(CPU)110、ランダムアクセスメモリ(RAM)および/または読み出し専用メモリ(ROM)等のメモリ120、複数の電源状態制御レジスタ140、種々の入出力装置130(例えば、テープドライブ、フロッピードライブ、ハードディスクドライブ、コンパクトディスク(CD)ドライブ、デジタルビデオディスク(DVD)ドライブ等を含むが、これらに限定されない記憶装置)、受信機、送信機、スピーカー、ディスプレイ、マイク等の音声信号入力装置、キーボード、キーパッド、マウス、A/Dコンバータ等)および、基本入出力システム(BIOS)150を備えている。
簡単に述べるならば、電源状態制御レジスタ140に記憶されているデータや命令は、コンピュータシステム100に分離式電源管理を提供するために用いられる。電源状態制御レジスタ140は、通信チャンネルを介してCPU110に接続されるひとつ以上の物理的デバイス(レジスタ等)として実施されることは理解されよう。あるいは、電源状態制御レジスタ140は、一例としてはひとつ以上のソフトウェアプリケーション(またはソフトウェアと例えば特定用途向けIC(ASIC)を用いたハードウェアとの組み合わせでもよい)であり、その場合ソフトウェアは記憶媒体(磁気または光学的ドライブまたはディスケット等)から読み込まれてコンピュータのメモリ120内のCPUによって実行される。または、電源状態制御レジスタ140は、制御ビットを有するフィールドプログラマブルゲートアレイ(FPGA)であってもよい。従って、本発明の電源状態制御レジスタ140(それに関連する方法とデータ構造を含む)は、RAMメモリ、磁気あるいは光学的ドライブまたはディスケット等のコンピュータ可読媒体に格納できる。
より具体的には、電源状態制御レジスタ140は、本発明のOS制御標準レジスタ140a(例えば標準ACPIレジスタ)と電源状態抽象化レジスタ140bを備えている。すなわち、OS制御標準レジスタ140aは、電源管理用のイベントモデルを形成するACPI状態/イネーブルレジスタである。それに対し、電源状態抽象化レジスタ140bは、本発明においては標準レジスタに記憶された状態を他のシステムまたは装置が定義する状態へと抽象化するのに用いられる。
BIOS150は、コンピュータがディスクからのアクセスプログラムなしで実行できることを判断する内蔵ソフトウェアとして理解される。パーソナルコンピュータでは、BIOSはキーボード等の入出力装置、ディスプレイ画面、ディスクドライブ、シリアル通信、その他多数の機能を制御するのに必要なコードを全て含んでいる。BIOSは、通常はROMチップ(例えばROM BIOSとして知られている)としてコンピュータ内に備えられている。これにより、BIOSは常に使用可能で、ディスクの不具合によって損傷を受けることがない。また、コンピュータが起動することを可能にする。しかし、本発明では、BIOS150は、電源状態制御レジスタ140と協働して以下に詳細に説明する分離式電源管理アプローチを提供する。
また、ホストシステム100は、ネットワーク内に備えられている。従って、ホストシステム100は、パス105上の外部のクライアントからそのリソースへのアクセス要求を受信することがある。
図2は、分離式電源管理状態を提供するコンピュータシステム100のソフトウェアコンポーネントとハードウェアコンポーネントの関係を示すブロック図である。通常、ソフトウェアプリケーション210は、ホストオペレーティングシステム220を介してホストリソースと通信する。電源管理機能が求められる場合には、ホストOS220は、電源状態制御レジスタ140と通信してシステムが電源管理状態へと移行するよう導く。電源状態制御レジスタ140は、BIOS150と協働してホストリソース、例えばディスクドライブ、CDドライブ、DVDドライブ等のハードウェア装置をある特定の電源管理状態に移行させる。しかし、ACPI完全対応システムとは異なり、電源状態制御レジスタ140は、BIOS150と協働してホストOS140の要求には選択的に従うに過ぎない。場合によっては、ハードウェア装置はOSが導く電源管理状態には移行されず、作動状態のままとされる。しかし、ホストOSにはこの不履行は通知されず、実際には、ハードウェア装置の作動状態は、ホストOSには秘密にされる。
より具体的には、コンピュータシステム(より正確には、そのオペレーティングシステム)は、ある形式の電源管理ポリシーで、例えばACPIまたは他の電源管理規格に従って実現されることが多い。こうした電源管理規格の目的は、コンピュータのオペレーティングシステムにおける電源管理を一元化し、それによって電源管理状態にある安価なハードウェアでも非常に複雑な電源管理ポリシーをサポートできるようにすることである。例えば、ACPIは複数のグローバル状態(Gx状態、すなわち、GO:稼働、G1:スリーピング、G2:ソフトオフ、G3:メカニカルオフ)、複数のスリーピング状態(Sx状態)および複数のプロセッサの電源状態(Cx状態)を規定している。端的に言えば、グローバル状態はシステム全体に適用されるもので、ユーザー可視であり、スリーピング状態は、グローバル状態G1の中の状態の種類である。Sx状態は、ACPIにおいては次のように定義されている。
スリーピング状態S1(スタンバイ):スリーピング状態S1は、復帰待ち時間が短いスリーピング状態である。この状態では、システムコンテキスト(CPUやチップセット)は失われず、ハードウェアは全システムコンテキストを維持する。
スリーピング状態S2:スリーピング状態S2は、復帰待ち時間が短いスリーピング状態である。この状態はスリーピング状態S1と類似しているが、CPUおよびシステムのキャッシュコンテキストは失われる(OSはキャッシュおよびCPUのコンテキストを維持する責任を負う)。復帰イベント後のプロセッサのリセットベクトルから制御が開始される。
スリーピング状態S3(RAMへのサスペンド):スリーピング状態S3は、復帰待ち時間が短いスリーピング状態で、システムメモリを除く全てのシステムコンテキストが失われる。この状態では、CPU、キャッシュ、およびチップセットのコンテキストは失われる。ハードウェアはメモリコンテキスト維持し、CPUおよびL2構成設定のコンテキストの一部を復元する。復帰イベント後のプロセッサのリセットベクトルから制御が開始される。
スリーピング状態S4(ディスクへのサスペンド):スリーピング状態S4は、ACPIにサポートされた消費電力が最も小さく、復帰待ち時間がもっとも長いスリーピング状態である。消費電力を最小に抑えるため、ハードウェアプラットフォームが全装置の電源をオフにしたものとみなされる。プラットフォームコンテキストは維持される。
ソフトオフ状態S5:S5の状態はS4の状態と類似しているが、OSはコンテキストを全く保存しない。システムは「ソフト」オフ状態になり、復帰するには完全に起動させる必要がある。ソフトウェアは異なる状態値を用いてS5とS4の状態を区別し、BIOSにおける保存されたメモリイメージからの復帰であるかどうかを識別するための初期起動動作を可能にする。
プロセッサの電源状態は、グローバル稼動状態G0におけるプロセッサの電力消費および温度管理状態である。簡単に言えば、ACPIにおいてはCx状態は以下のように定義されている。
プロセッサの電源状態C0:この状態にあるとき、プロセッサは命令を実行している。
プロセッサの電源状態C1:このプロセッサの電源状態は、待ち時間が最も短い。この状態のハードウェア待ち時間は、オペレーティングソフトウェアがこれを用いるかどうか決める際に待ち時間を考慮しない程度に短くなければならない。プロセッサを非実行電源状態にすること以外、ソフトウェア可視効果はない。
プロセッサの電源状態C2:C2状態は、C1状態より電力節約効果が高い。この状態にとっての最長のハードウェア待ち時間は、ACPIのシステムファームウェアを介して与えられ、オペレーティングソフトウェアはこの情報を、C2状態に代えてC1状態を用いる時期を判断するのに用いる。プロセッサを非実行電源状態にすること以外、ソフトウェア可視効果はない。
プロセッサの電源状態C3:C3状態は、C1およびC2状態より電力節約効果が高い。この状態にとっての最長のハードウェア待ち時間は、ACPIのシステムファームウェアを介して提供され、オペレーティングソフトウェアはこの情報を、C3状態に代えてC2状態を用いる時期を判断するのに用いる。C3状態にあるとき、プロセッサのキャッシュは状態を維持するが、スヌープは無視する。オペレーティングソフトウェアは、キャッシュが一貫性を確実に維持することに責任を負う。
Gx、Sx、Cx状態の定義は、ACPI規格に詳細に定められており、参照により本開示に含まれる。
ACPIにおいて定義されているように、スリーピング状態が異なれば省電力の程度が異なり、それに伴ってシステムを復帰させる際の待ち時間も異なる。例えば、システムを復帰させるのに必要な時間は、1分以上(例えば最も節電できるS5の状態)のこともあれば、数秒(例えば最も節電効果の低いS1状態)のこともある。さらに重要なのは、システムがスリープ状態にあるときには、そのリソースにアクセスするにはまずコンピュータシステムを復帰させなければならない、すなわち、コンピュータシステム100のOSと通信しなければならないということである。従って、省電力という要求と、省電力によってもたらされる待ち時間というペナルティを受けずにホストコンピュータのリソースにアクセスするという要求とのあいだには、大きな隔たりがある。
この隔たりを埋めるために、本発明は分離式電源管理アプローチを提供する。そこでは、ホストコンピュータのオペレーティングシステムは、その省電力ポリシーが実施されているものと錯覚させられるのである。本発明のもうひとつの観点は、OSPM(Operating System−Directed Configuration and Power Management)を推進するためのACPIの仕様とは正反対に、ハードウェアの状態をホストオペレーティングシステムには意図的に秘密にすることである。すなわち、ホストオペレーティングシステムがACPI規格に定義されているようにシステムをあらかじめ決められたあるスリーピング状態へと導こうとすると、システムはその要求を本発明の電源状態制御レジスタ140に記憶された命令に従って変換する。オペレーティングシステムの電源管理要求は、場合によっては実行されるが、場合よっては部分的にまたは完全に無視される。オペレーティングシステムの電源管理要求がどのように変換されるかは、以下表1を参照して説明する。
Figure 2005527906
本発明の一実施形態においては、8つの電源状態制御レジスタ140が配置されている。この8つの32ビット電源状態制御レジスタは、システムの各電源状態がどのように実行されるかを制御する。BIOS150は、必要に応じてこれらを変更できるが、最低限これらのレジスタを、コンピュータシステムがメカニカルパワーオフの状態からオンにされるたびにセットアップする。表1では、これら8つのレジスタを(MCP_ACPl_xx_CTL)と表している。各電源状態制御レジスタに対し、表1では、オペレーティングシステムが要求する状態(例えばプロセッサの電源状態Cxやスリーピング状態Sx)、状態の説明、本発明によって実施される実際の状態を示している。
C0やC1等のプロセッサの電源状態やS2等のスリーピング状態等、表1に示されていない状態もある。こうした状態では、省電力作用が働かないためである。実際、当業者であればわかることだが、本発明では8つの電源状態制御レジスタを配置しているが、ある特定の態様を実施するための要件を満たすのに必要な電源管理状態の数はいくつであっても構わないし、それに対処するために電源状態制御レジスタをいくつ配置しても構わない。
表1の第1段目は、オペレーティングシステムが、クロックは停止され、キャッシュはスヌープ可能のままであるC2の状態を要求する場合である。このOSの要求に対し、本発明は要求に従いプロセッサの電源状態をC2に設定する。
表1の第2段目は、オペレーティングシステムが、CPUはスリープモードになりキャッシュはスヌープ不可になるC3の状態を要求する場合である。このOSの要求に対し、本発明は要求に従わず、プロセッサの電源状態をC2に設定する。
表1の第3段目は、オペレーティングシステムが、CPUが電圧/周波数の変更を要求する可能性があるC4の状態またはVID/FIDを要求する場合である。このOSの要求に対し、本発明は要求に従わず、プロセッサの電源状態をC2に設定する。または、本発明は部分的に要求に従い、プロセッサの電源状態をC2に設定するが、電圧/周波数を変更させるようにしてもよい。
表1の第4段目は、オペレーティングシステムが、システムがスタンバイとなるS1の状態を要求する場合である。このOSの要求に対し、本発明は要求に従い、スリーピング状態をS1に設定する。
表1の第5段目は、オペレーティングシステムが、システムがSTR(RAMへのサスペンド)状態に入る、すなわち、CPUはその状態を全てRAMメモリに保存するS3の状態を要求する場合である。このOSの要求に対し、本発明は要求に従わず、スリーピング状態をS1に設定する。
表1の第6段目は、オペレーティングシステムが、システムがSTD(ディスクへのサスペンド)状態に入る、すなわち、CPUはその状態を全てディスク保存するS3の状態を要求する場合である。このOSの要求に対し、本発明は要求に従わず、スリーピング状態をS1に設定する。
表1の第7段目は、オペレーティングシステムが、システムがソフトオフ状態に入るS5の状態を要求する場合である。このOSの要求に対し、本発明は要求に従い、スリーピング状態をS5に設定する。
表1の第8段目は、オペレーティングシステムが要求する状態がシステム固有の状態の場合である。8番目のレジスタは、システム固有の状態を扱う、または状態の拡張を可能にする追加のまたはオプションのレジスタである。
こうした電源状態制御レジスタ140は、実際には電源遮断用状態機械を駆動する。すなわち、各状態用のレジスタに基づかない状態機械が、各レジスタに記憶された命令に従って、何をすべきか決定する。32ビットの各レジスタに記憶されている情報を以下表2に示す。
Figure 2005527906
各電源状態制御レジスタの第31ビットは予約されている。この特定のビットは、後に特定の目的に応じて使用される。
第30〜28ビットは、システム管理アクションフィールド(SMAF)を定義する。このフィールドは、オプションで現在行われている作業について、CPUに通知するのに用いられる。
第27ビットは、PME_WAKフィールドを定義する。このフィールドは、システムが電源管理イベント(PME)イベントまたはPMEの入力で復帰するかどうかを定義するのに用いられる。PMEは、Sx状態において、システムを復帰させなければならないという信号を伝えるのに用いられる。一実施形態においては、PME_WAKフィールドは、Sx状態に対しては1に、Cx状態に対しては0に設定される。
第26ビットは、SMI_WAKフィールドを定義する。このフィールドは、システムがシステム管理割り込み(SMI)イベントで復帰するかどうかを定義するのに用いられる。SMIは、SMMルーチンに制御を渡し、OSから制御を受け取ることが望ましい場合に用いられる。このフィールドはACPI規格に定義されていない代替機能のためにCPUを復帰させるのに用いられる。例えば、SMI#復帰イベントをPMEの代用として用いてもよい。
第25ビットは、IRQ_WAKフィールドを定義する。このフィールドは、システムが割り込みイベントで復帰するかどうかを定義するのに用いられる。すなわち、このフィールドは、ACPI規格に定義されていない代替機能のためにCPUを復帰させるのに用いられる。例えば、CPUを割り込みで復帰させる場合等である。
第24ビットは、ARB_REQ_WAKフィールドを定義する。このフィールドは、システムがBus Master Requestイベントで復帰するかどうかを定義するのに用いられる。Bus Master Requestイベントは、CPUではないバスマスターのいずれかがバスを使用する必要がある場合である。ACPI規格では、キャッシュがシステムメモリにフラッシュされていない場合にこれをC3で用いる。これによりCPUが復帰し、そのキャッシュはスヌープ可能になる。すなわち、このフィールドは、ACPI規格に定義されていない代替機能のためにCPUを復帰させるのに用いられる。
第23〜22ビットは、レジュームディレイ(RSM_DLY)フィールドを定義する。このフィールドは、CPUが復帰するのが早すぎないよう、CPUが復帰するまでに経過すべき時間の長さを定義するのに使用される。このフィールドは、省電力操作を実施したことによる作用、例えば、電源を急激に入切すると電力供給装置がロックするようなことに対処するのに用いることができる。
第21〜19ビットは、電力供給レールを制御するSLP_S5_DLYフィールドを定義する。特に、このフィールドは、PCIリセット(PCI_RST#)の起動からSLP_S5#の起動までの遅れを制御する。この場合、SLP_S5#は、通常はメインメモリ電源をオフにするために採用されている。
第18〜16ビットは、電力供給レールを制御するSLP_S3_DLYフィールドを定義する。特に、このフィールドは、PCIリセット(PCI_RST#)の起動からSLP_S3#の起動までの遅れを制御する。この場合、SLP_S3#は、通常はメイン電源供給レールをオフにする、すなわち、CPUへの電力をオフにするために採用されている。
第15〜13ビットは、電力供給レールを制御するPCIRST_DLYフィールドを定義する。特に、このフィールドは、SLP_S3#の起動からPCIリセット(PCI_RST#)の起動までの遅れを制御する。この場合、PCI_RST#は、システム論理を全てリセットするために採用されている。すなわち、このフィールドは、システムをリセットすべきかどうかを定義する。
第12〜10ビットは、電力供給レールを制御するSLP_S1_DLYフィールドを定義する。特に、このフィールドは、LDT_STP#の起動からSLP_S1#の起動までの遅れを制御する。この場合、SLP_S1#は、通常はマザーボードが休眠中かどうかを示すLEDに電力を供給するために採用されている。LDT_STP#は、CPUバスを切断すべきかどうかを命令するピンである。LDTは、Hyper Transport Busとしても知られている。これは、AMDが設計したポイントツーポイントバスである。LDT_STP#ピンは、このバスプロトコルを「停止」させる。
第9ビットは、CPU SLP#の起動を制御するCPUSLP_ENフィールドを定義する。注目すべきは、ACPIは、2つのビットフィールド、すなわちSleep Enable(SLP_EN)とSleep Type(SLP_TYPx)を介して制御されるスリーピング/復帰論理を定義している点である。望ましいスリープ状態のタイプは、SLP_TYPxフィールドにプログラムされ、SLP_ENがアサートされるとすぐにハードウェアはシステムを定義されたスリーピング状態に順序付ける。
第8〜6ビットは、Stop Grant Specialサイクル(STPCLK#のアサートに対するCPUの応答)の起動からLDT_STP#の起動までの遅れを制御するLDTSTP_DLYフィールドを定義する。LDT_STP#は、LDT Busを切断するのに用いられる。
第5〜3ビットは、電源管理命令からSTPCLK#の起動までの遅れを制御するSTPCLK_DLYフィールドを定義する。この場合、STPCLK#は、CPUをStop Grant状態にするのに用いられる。
第2ビットは、アービタが使用不能であっても装置が非同期アクセスを実現するためにシステムメモリにアクセスできるようにするのに用いられるアービタオーバーライド(ARB_OVR)フィールドを定義する。特に、ACPI規格に従う標準PM2_CNT_BLKレジスタブロックは、アービタ無効化機能用のシングルビットを含んでいる。すなわち、後者のビットは前者のビットを無効にするために用いられる。
第1ビットはシステム管理割り込み(SMI)有効化フィールドを定義する。このフィールドはSMI#が発生されるかどうかを判断する。
第0ビットは、ステートイネーブル(ST−EN)フィールドを定義する。このビットは、いずれにせよ作動されるSMIビットを除く、このレジスタ内の残りのビットが実行されるように設定されなければならない。
表2において各電源状態制御レジスタ140用に定義されたフィールドは、特定の実施形態における例にすぎない。当業者には、こうしたフィールドは、部分的に(すなわち上記フィールドの一部のみを実施する)、上記とは異なる順序で、異なるサイズで、あるいは上記とは異なるパラメータを用いて実施されうることは理解されよう。
さらに、各電源状態制御レジスタ140における上記フィールドの多くは(種々のパラメータを含む)、ACPI対応のシステムに配置されていることを前提に実施される。しかし、当業者には、本発明は他の電源管理規格に適合するシステムにも配置できるように変更できることは理解されよう。
また、本発明は、上記のように状態抽象化レジスタを用いて実施されているが、これに限られるものではない。すなわち、すなわち、抽象化は固定論理に記憶することもできるし、必要なときにROMから読み出すこともできる。本発明の主たるアプローチは、標準レジスタを別のシステムまたは装置が定義した状態へと抽象化することである。
本発明の利点の一つは、電源状態制御レジスタ140は、例えばACPIのような特定の電源管理規格に従っているとホストOSが推定するシステムに設置可能であるという点である。こうしたことで、本発明を用いて代替電源管理スキームを実施でき、その際にホストOSを変更する必要がない。これは、重要な利点である。なぜなら、コンピューティングシステムの製造業者は、非互換性の問題を考慮することなく標準のオペレーティングシステムを使用したまま代替電源管理スキームを要求することもできるからである。
表3aは、プロセッサの電源状態(Cx)およびスリーピング状態(Sx)に合致した電源状態制御レジスタの各ビットに対する標準的な設定を示している。換言すれば、これらの設定はACPIに対応している。
Figure 2005527906
一方、表3bは、プロセッサの電源状態(Cx)およびスリーピング状態(Sx)に合致した電源状態制御レジスタの各ビットに対する修正された設定を示している。換言すれば、これらの修正された設定は、表1に示した実際に実施される状態を生じることになる。
Figure 2005527906
最後に、表4および表5は、遅れ表の例である。本発明では複数の遅れ値を有する起動遅れの表4とPCI_RST起動遅れの表5を示しているが、用途によっては他の遅れ値を導入することもできる。
Figure 2005527906
Figure 2005527906
本発明の教示を含む種々の実施形態を示し説明したが、当業者であれば本発明の教示を含む更なる実施形態を用意に考案できるであろう。請求項において、方法のクレームの要素は特定の順序で記載されているが、たとえ請求項の要素が数字順またはアルファベット順に列挙されていても、本発明を実施する順序を意味するものではない。
本発明の分離式電源管理状態を提供するシステムのブロック図である。 分離式電源管理状態を提供するコンピュータシステムのソフトウェアコンポーネントとハードウェアコンポーネントの関係を示すブロック図である。

Claims (47)

  1. ホストオペレーティングシステム(OS)を有するホストコンピュータの複数のホストリソースの電源状態を管理する方法であって、
    ホストオペレーティングシステムから命令を受信して前記ホストリソースの少なくとも一つに対して第一の電源状態を設定するステップと、
    少なくとも一つの電源状態抽象化装置を参照して、前記ホストリソースの前記少なくとも一つに対して前記第一の電源状態を第二の電源状態に変換するステップと
    を含み、
    前期第一の電源状態と第二の電源状態は異なるものである、方法。
  2. 更に、前記ホストオペレーティングシステムからの命令に反して、前記ホストリソースの前記少なくとも一つが前記第二の電源状態に設定されるようにするステップを含む請求項1に記載の方法。
  3. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うS4である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うS1である、請求項1に記載の方法。
  4. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うS3である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うS1である、請求項1に記載の方法。
  5. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うC4である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うC2である、請求項1に記載の方法。
  6. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うC3である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うC2である、請求項1に記載の方法。
  7. 前記設定されるようにするステップは、前記ホストリソースの前記少なくとも一つが前記第二の電源状態に設定されるようにするものであり、その場合、前記第二の電源状態は、前記ホストオペレーティングシステムからの命令に部分的にのみ反するものである、請求項2に記載の方法。
  8. 前記ホストリソースの前記少なくとも一つが記憶装置である、請求項1に記載の方法。
  9. 前記記憶装置はディスクドライブである、請求項8に記載の方法。
  10. 前記記憶装置はランダムアクセスメモリ(RAM)である、請求項8に記載の方法。
  11. 前記ホストリソースの前記少なくとも一つは、コンパクトディスク(CD)プレーヤーである、請求項1に記載の方法。
  12. 前記ホストリソースの前記少なくとも一つは、デジタルビデオディスク(DVD)プレーヤーである、請求項1に記載の方法。
  13. 前記少なくとも一つの電源状態抽象化装置は、レジスタである、請求項1に記載の方法。
  14. ホストオペレーティングシステム(OS)(220)を有するホストコンピュータの複数のホストリソースの電源状態を管理する装置であって、
    ホストオペレーティングシステムから命令を受信して前記ホストリソースの少なくとも一つに対して第一の電源状態(140)を設定する手段(150)と、
    少なくとも一つの電源状態抽象化装置と、
    前記少なくとも一つの電源状態抽象化装置(140)を参照して、前記複数のホストリソースの前記少なくとも一つに対して前記第一の電源状態を第二の電源状態に変換する手段(140)と
    を備え、
    前期第一の電源状態と第二の電源状態は異なるものである、装置。
  15. 更に、前記ホストオペレーティングシステムからの命令に反して、前記ホストリソースの前記少なくとも一つが前記第二の電源状態に設定されるようにする手段(140)を備える、請求項14に記載の装置。
  16. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うS4である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うS1である、請求項14に記載の装置。
  17. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うS3である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うS1である、請求項14に記載の装置。
  18. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うC4である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うC2である、請求項14に記載の装置。
  19. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うC3である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うC2である、請求項14に記載の装置。
  20. 前記第二の電源状態は、前記ホストオペレーティングシステムからの命令に部分的にのみ反するものである、請求項15に記載の装置。
  21. 前記ホストリソースの前記少なくとも一つが記憶装置である、請求項14に記載の装置。
  22. 前記記憶装置はディスクドライブである、請求項21に記載の装置。
  23. 前記記憶装置はランダムアクセスメモリ(RAM)である、請求項21に記載の装置。
  24. 前記ホストリソースの前記少なくとも一つは、コンパクトディスク(CD)プレーヤーである、請求項14に記載の装置。
  25. 前記ホストリソースの前記少なくとも一つは、デジタルビデオディスク(DVD)プレーヤーである、請求項14に記載の装置。
  26. 前記少なくとも一つの電源状態抽象化装置は、レジスタである、請求項14に記載の装置。
  27. ホストオペレーティングシステム(OS)(220)を有するホストコンピュータの複数のホストリソースの電源状態を管理する装置であって、
    少なくとも一つの電源状態抽象化装置(140)と、
    ホストオペレーティングシステムから命令を受信して、前記ホストリソースの少なくとも一つに対して第一の電源状態を設定し前記少なくとも一つの電源状態抽象化装置を参照して、前記ホストリソースの前記少なくとも一つに対して前記第一の電源状態を第二の電源状態に変換するBIOS(150)と
    を備え、
    前期第一の電源状態と第二の電源状態は異なるものである、装置。
  28. 前記BIOSは、前記ホストオペレーティングシステムからの命令に反して、前記ホストリソースの前記少なくとも一つが前記第二の電源状態に設定されるようにする、請求項27に記載の装置。
  29. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うS4である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うS1である、請求項27に記載の装置。
  30. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うS3である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うS1である、請求項27に記載の装置。
  31. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うC4である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うC2である、請求項27に記載の装置。
  32. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うC3である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うC2である、請求項27に記載の装置。
  33. 前記第二の電源状態は、前記ホストオペレーティングシステムからの命令に部分的にのみ反するものである、請求項28に記載の装置。
  34. 前記ホストリソースの前記少なくとも一つが記憶装置である、請求項27に記載の装置。
  35. 前記記憶装置はディスクドライブである、請求項34に記載の装置。
  36. 前記記憶装置はランダムアクセスメモリ(RAM)である、請求項34に記載の装置。
  37. 前記ホストリソースの前記少なくとも一つは、コンパクトディスク(CD)プレーヤーである、請求項27に記載の装置。
  38. 前記ホストリソースの前記少なくとも一つは、デジタルビデオディスク(DVD)プレーヤーである、請求項27に記載の装置。
  39. 前記少なくとも一つの電源状態抽象化装置は、レジスタである、請求項27に記載の装置。
  40. 複数の命令またはコントロールビットが記憶されたコンピュータ可読媒体であって、その複数の命令は、プロセッサまたはハードウェア装置に収容された制御ビットによって実行される場合には、そのプロセッサまたはハードウェア装置に、
    ホストオペレーティングシステム(220)から命令を受信して前記ホストリソースの少なくとも一つに対して第一の電源状態を設定するステップと、
    少なくとも一つの電源状態抽象化装置(140)を参照して、前記複数のホストリソースの前記少なくとも一つに対して前記第一の電源状態を第二の電源状態に変換するステップと
    を実行させる命令を含み、前期第一の電源状態と第二の電源状態は異なるものである、コンピュータ可読媒体。
  41. 更に、前記ホストオペレーティングシステムからの命令に反して、前記ホストリソースの前記少なくとも一つが前記第二の電源状態に設定されるようにするステップを含む、請求項40に記載のコンピュータ可読媒体。
  42. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うS4である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うS1である、請求項40に記載のコンピュータ可読媒体。
  43. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うS3である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うS1である、請求項40に記載のコンピュータ可読媒体。
  44. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うC4である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うC2である、請求項40に記載のコンピュータ可読媒体。
  45. 前記第一の電源状態がACPI(拡張構成および電源インタフェース)の仕様に従うC3である場合には、前記第二の電源状態は前記ACPI(拡張構成および電源インタフェース)の仕様に従うC2である、請求項40に記載のコンピュータ可読媒体。
  46. 前記設定されるようにするステップは、前記ホストリソースの前記少なくとも一つが前記第二の電源状態に設定されるようにするものであり、その場合、前記第二の電源状態は、前記ホストオペレーティングシステムからの命令に部分的にのみ反するものである、請求項40に記載のコンピュータ可読媒体。
  47. 前記ホストリソースの前記少なくとも一つが記憶装置である、請求項40に記載のコンピュータ可読媒体。
JP2004507977A 2002-05-28 2003-05-23 分離式電源管理状態を提供する方法および装置 Expired - Lifetime JP4422017B2 (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US10/156,706 US6848057B2 (en) 2002-05-28 2002-05-28 Method and apparatus for providing a decoupled power management state
PCT/US2003/016521 WO2003100589A1 (en) 2002-05-28 2003-05-23 Method and apparatus for providing a decoupled power management state

Publications (2)

Publication Number Publication Date
JP2005527906A true JP2005527906A (ja) 2005-09-15
JP4422017B2 JP4422017B2 (ja) 2010-02-24

Family

ID=29582319

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2004507977A Expired - Lifetime JP4422017B2 (ja) 2002-05-28 2003-05-23 分離式電源管理状態を提供する方法および装置

Country Status (7)

Country Link
US (1) US6848057B2 (ja)
EP (1) EP1508081B1 (ja)
JP (1) JP4422017B2 (ja)
AT (1) ATE437393T1 (ja)
AU (1) AU2003233694A1 (ja)
DE (1) DE60328483D1 (ja)
WO (1) WO2003100589A1 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013546087A (ja) * 2010-12-22 2013-12-26 インテル・コーポレーション プラットフォームのレジューム時間を改善する方法および装置

Families Citing this family (29)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6675303B1 (en) * 1999-09-29 2004-01-06 2Micro International Limited PC card controller with advanced power management reset capabilities
KR100424484B1 (ko) * 2001-07-05 2004-03-24 엘지전자 주식회사 중앙 처리 장치용 전원 공급기
US7058829B2 (en) 2002-08-14 2006-06-06 Intel Corporation Method and apparatus for a computing system having an active sleep mode CPU that uses the cache of a normal active mode CPU
US7117379B2 (en) * 2002-08-14 2006-10-03 Intel Corporation Method and apparatus for a computing system having an active sleep mode
JP4078644B2 (ja) * 2003-01-08 2008-04-23 ソニー株式会社 情報処理装置および方法、並びにプログラム
US7080271B2 (en) 2003-02-14 2006-07-18 Intel Corporation Non main CPU/OS based operational environment
US7254730B2 (en) * 2003-02-14 2007-08-07 Intel Corporation Method and apparatus for a user to interface with a mobile computing device
US7114090B2 (en) 2003-02-14 2006-09-26 Intel Corporation Computing system with operational low power states
TW591372B (en) * 2003-05-15 2004-06-11 High Tech Comp Corp Power control method of portable electronic device, portable electronic device and electronic system
US7437575B2 (en) * 2003-05-29 2008-10-14 Dell Products L.P. Low power mode for device power management
JP4833560B2 (ja) * 2004-02-17 2011-12-07 マイクロソフト コーポレーション 常時動作可能なコンピューティングデバイス
US20050182978A1 (en) 2004-02-17 2005-08-18 Anderson Jason M. Always ready computing device
US9146600B2 (en) 2006-10-11 2015-09-29 Texas Instruments Incorporated Array and peripheral power control decoded from circuitry and registers
US7949794B2 (en) 2006-11-02 2011-05-24 Intel Corporation PCI express enhancements and extensions
TWI358025B (en) * 2007-04-17 2012-02-11 Via Tech Inc Methods and systems for centralized dynamic link c
US8086885B2 (en) * 2007-12-14 2011-12-27 Nokia Corporation Runtime control of system performance
US8286014B2 (en) 2008-03-25 2012-10-09 Intel Corporation Power management for a system on a chip (SoC)
US7783819B2 (en) 2008-03-31 2010-08-24 Intel Corporation Integrating non-peripheral component interconnect (PCI) resources into a personal computer system
US7861027B2 (en) 2008-05-30 2010-12-28 Intel Corporation Providing a peripheral component interconnect (PCI)-compatible transaction level protocol for a system on a chip (SoC)
US20100318824A1 (en) * 2009-06-10 2010-12-16 Seagate Technology Llc Storage device with advanced power management
US9285856B2 (en) * 2010-12-21 2016-03-15 Qualcomm Incorporated Method and system for rapid entry into and for rapid exiting from sleep states for processors of a portable computing device
US9104499B2 (en) 2010-12-21 2015-08-11 Qualcomm Incorporated System for minimizing resource latency between processor application states in a portable computing device by scheduling resource state set transitions
US10042650B2 (en) * 2011-03-23 2018-08-07 Lenovo (Beijing) Co., Ltd. Computer startup method, startup apparatus, state transition method and state transition apparatus
US8954980B2 (en) 2011-11-11 2015-02-10 Qualcomm Incorporated Conserving power through work load estimation for a portable computing device using scheduled resource set transitions
WO2013077891A1 (en) * 2011-11-22 2013-05-30 Intel Corporation Collaborative processor and system performance and power management
US9229524B2 (en) * 2012-06-27 2016-01-05 Intel Corporation Performing local power gating in a processor
US20170177068A1 (en) * 2015-12-17 2017-06-22 Intel Corporation Systems, methods and devices for standby power savings
US10108252B2 (en) * 2016-03-03 2018-10-23 Dell Products L.P. Method and system for intelligent load line control of information handling systems
US10372184B2 (en) 2016-06-28 2019-08-06 Renesas Electronics America Inc. Method and apparatus for implementing power modes in microcontrollers using power profiles

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6092209A (en) * 1994-10-04 2000-07-18 Intel Corporation Method and apparatus for managing power consumption of peripheral devices of personal computers
US5919264A (en) * 1997-03-03 1999-07-06 Microsoft Corporation System and method for using data structures to share a plurality of power resources among a plurality of devices
JP3943665B2 (ja) * 1997-09-01 2007-07-11 株式会社東芝 スリープ制御方法、およびイベント通知方法
US6065122A (en) * 1998-03-13 2000-05-16 Compaq Computer Corporation Smart battery power management in a computer system
US6131166A (en) 1998-03-13 2000-10-10 Sun Microsystems, Inc. System and method for cross-platform application level power management
US6199134B1 (en) 1998-03-13 2001-03-06 Compaq Computer Corporation Computer system with bridge logic that asserts a system management interrupt signal when an address is made to a trapped address and which also completes the cycle to the target address
US6122748A (en) * 1998-03-31 2000-09-19 Compaq Computer Corporation Control of computer system wake/sleep transitions
US6360327B1 (en) * 1999-03-12 2002-03-19 Compaq Information Technologies Group, L.P. System with control registers for managing computer legacy peripheral devices using an advanced configuration power interface software power management system
US6681336B1 (en) * 1999-06-18 2004-01-20 Kabushiki Kaisha Toshiba System and method for implementing a user specified processing speed in a computer system and for overriding the user specified processing speed during a startup and shutdown process

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2013546087A (ja) * 2010-12-22 2013-12-26 インテル・コーポレーション プラットフォームのレジューム時間を改善する方法および装置
KR101524961B1 (ko) * 2010-12-22 2015-06-01 인텔 코포레이션 플랫폼의 재개 시간을 개선하기 위한 방법 및 장치

Also Published As

Publication number Publication date
EP1508081A1 (en) 2005-02-23
US20030226043A1 (en) 2003-12-04
WO2003100589A1 (en) 2003-12-04
JP4422017B2 (ja) 2010-02-24
US6848057B2 (en) 2005-01-25
ATE437393T1 (de) 2009-08-15
EP1508081B1 (en) 2009-07-22
DE60328483D1 (ja) 2009-09-03
AU2003233694A1 (en) 2003-12-12
EP1508081A4 (en) 2006-01-11

Similar Documents

Publication Publication Date Title
JP4422017B2 (ja) 分離式電源管理状態を提供する方法および装置
US9092251B2 (en) Method of managing virtual machines using a virtual machine monitor
US6829713B2 (en) CPU power management based on utilization with lowest performance mode at the mid-utilization range
US6760850B1 (en) Method and apparatus executing power on self test code to enable a wakeup device for a computer system responsive to detecting an AC power source
US7596709B2 (en) CPU power management based on utilization with lowest performance mode at the mid-utilization range
US8793697B2 (en) Method and system for scheduling requests in a portable computing device
US8631414B2 (en) Distributed resource management in a portable computing device
US7093116B2 (en) Methods and apparatus to operate in multiple phases of a basic input/output system (BIOS)
US7334138B2 (en) Windows-driven power management for peripheral devices in a computer system
JPH0850523A (ja) コンピュータシステムにおける消費電力管理方法及び装置
US8745629B2 (en) System and method of controlling power in an electronic device
US7694164B2 (en) Operating system-independent method and system of determining CPU utilization
US7096299B2 (en) Method and apparatus for transferring system context information between mobile computer and base station
US20130275791A1 (en) Method and System for Tracking and Selecting Optimal Power Conserving Modes of a PCD
TW594466B (en) Power management method for microprocessor
JP3880331B2 (ja) セルリフレッシュ可能なメモリ・デバイスの内容を保存する方法およびリフレッシュ制御回路
US20070234023A1 (en) Computer platform system control unit data programming control method and system
JP2009070389A (ja) 処理装置のためのコントローラ
US7272731B2 (en) Information handling system having reduced power consumption
TW546560B (en) Method of achieving computer power saving through memory throttling
WO2024093491A9 (zh) 一种性能调控方法及电子设备
JP2003345474A (ja) コンピュータシステムおよびデータ転送制御方法
JP2007148977A (ja) 入出力処理装置及び同入出力処理装置を有するコンピュータシステム

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20060509

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20081125

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20090224

RD03 Notification of appointment of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7423

Effective date: 20090224

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20090714

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20091008

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20091104

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20091203

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121211

Year of fee payment: 3

R150 Certificate of patent or registration of utility model

Ref document number: 4422017

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121211

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20131211

Year of fee payment: 4

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

EXPY Cancellation because of completion of term