JP2005519490A5 - - Google Patents
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Claims (23)
- 一連のデータパケットと関連PIDとを各々含み、1つ以上の宛先に各々転送される、複数のMPEG入力データストリームを処理する方法であって、
前記入力データストリームの各々に対する複数のPIDエイリアスを含むPIDエイリアステーブルを生成することと、
少なくとも1つのPIDを各入力データストリームから取り除くことによってフィルタされたデータストリームを生成することと、
前記フィルタされたデータストリームの各々に対して宛先を決定することと、
前記フィルタされたデータストリームが読み出されて、決定されたそれぞれの宛先に転送されるように、前記フィルタされたデータストリームをバッファすることとを含む方法。 - 前記PIDエイリアステーブルはPIDの全範囲を網羅し、
10の入力データストリームが存在し、
12のフィルタされたデータストリームが存在する、請求項1記載の方法。 - N個のフィルタされたデータストリームが存在し、前記フィルタされたデータストリームをバッファすることはワゴンホイールメモリ構造を占有することを含み、ワゴンホイールメモリ構造を占有することは、
2N個のタイムスロットを有するワゴンホイールメモリ構造を設けることによって前記N個のフィルタされたデータストリームの各々に対応するライトサイクル及びリードサイクルを収容することと、
前記N個のフィルタされたデータストリームの各々によって前記ワゴンホイールメモリ構造のライトサイクルタイムスロットを順次占有することとを含む、請求項1記載の方法。 - 前記ワゴンホイールメモリ構造の各リードサイクルタイムスロット及び各ライトサイクルタイムスロットに対するポインタを維持することをさらに含む、請求項3記載の方法。
- 前記フィルタされたデータストリームを前記ワゴンホイールメモリ構造から回収することと、
前記回収されたデータストリームを、バックプレーンを介して第1ボードから第2ボードにマスタークロックレートでシリアルに転送することとを含む、請求項4記載の方法。 - 前記フィルタされたデータストリームを回収することは、前記ワゴンホイールメモリ構造からN個のデータストリームを回収するように、前記フィルタされたデータストリームを前記ワゴンホイールメモリ構造の各リードサイクルタイムスロットから読み出すことを含む、請求項5記載の方法。
- M個の宛先の内の少なくとも1つ宛のデジタルデータパケットを含むMPEG入力データストリームを転送する方法であって、
関連PIDを各々有し、複数のデータパケットを各々含む複数の入力データストリームを受信することと、
第1及び第2メモリモジュールを有するラウンドロビンメモリ方式に前記入力データストリームを供給することと、
複数のPIDエイリアスを前記入力データストリームの各々に関連付けるために前記第1メモリモジュールを使用することと、
前記入力データストリームをバッファするために前記第2メモリモジュールを使用することと、
前記第2メモリモジュールから前記バッファしたデータストリームを読み出すことと、
前記第2メモリモジュールから読み出したデータストリームを前記M個の宛先の内の少なくとも1つに送信することとを含む、方法。 - 前記入力データストリームの各々が、その固有のデータレートで供給され、前記方法は、前記入力データストリームを共通クロック周波数に同期させることをさらに含む、請求項6記載の方法。
- 前記共通クロック周波数が27MHzである、請求項8記載の方法。
- 前記入力データストリームから少なくとも1つのPIDをフィルタすることと、
残りの各PIDの宛先を決定することとをさらに含み、前記宛先が11枚のボードのいずれかに搭載されている5つのプロセッサのいずれかである、請求項8記載の方法。 - 前記第2メモリモジュールからN個のデータストリームを回収するように、前記第2メモリモジュールの各リードサイクルタイムスロットから前記フィルタされたデータストリームを読み出すことを含み、
送信することは、前記N個の回収されたデータストリームをM個の宛先の内の少なくとも1つにシリアルに転送することを含む、請求項10記載の方法。 - 前記第2メモリモジュールを使用することは、N個の転送ストリームの各PIDに対して前記宛先を決定した後に、前記フィルタされた入力データストリームをワゴンホイールメモリ構造に供給することを含む、請求項10記載の方法。
- N個の入力データストリームが存在し、
前記第2メモリモジュールが、前記N個の入力データストリームの各々に対応するライトサイクル及びリードサイクルを収容することの可能な2N個のタイムスロットを有するワゴンホイールメモリ構造であり、
前記第2メモリモジュールを使用することは、前記N個の入力データストリームの各々によって前記ワゴンホイールメモリ構造のライトサイクルタイムスロットを占有することを含む、請求項12記載の方法。 - 前記N個の入力データストリームの各リードサイクル及び各ライトサイクルに対するポインタを維持することをさらに含む、請求項13記載の方法。
- 前記回収されたデータストリームを低電圧差動信号に変換することと、
前記M個の宛先に前記低電圧差動信号をシリアルに送信することとをさらに含む、請求項14記載の方法。 - 通信可能に相互にリンクされた複数の宛先に、関連PIDを有する複数のMPEG入力データストリームを転送する装置であって、
前記入力データストリームの各々に対する複数のPIDエイリアスを含むPIDエイリアステーブルを生成する手段と、
少なくとも1つのPIDを各入力データストリームから取り除くことによってフィルタされたデータストリームを生成する手段と、
前記フィルタされたデータストリームの各々に対して宛先を決定する手段と、
前記フィルタされたデータストリームが読み出されて、決定されたそれぞれの宛先に転送されるように、前記フィルタされたデータストリームをバッファする手段と、を備える装置。 - 前記バッファする手段がワゴンホイールメモリ構造を有する、請求項16記載の装置。
- N個のフィルタされたデータストリームが存在し、
前記ワゴンホイールメモリ構造が、前記N個のフィルタされたデータストリームの各々に対応するライトサイクル及びリードサイクルを収容可能な2N個のタイムスロットを含む、請求項17記載の装置。 - 前記ワゴンホイールメモリ構造は、前記ワゴンホイールメモリ構造の各リードサイクルタイムスロット及び各ライトサイクルタイムスロットに対するポインタをさらに有する、請求項18記載の装置。
- 前記フィルタされたデータストリームを前記ワゴンホイールメモリ構造から回収する手段と、
前記回収されたデータストリームをシリアルに転送する手段と、をさらに備える、請求項19記載の装置。 - 前記装置は、前記入力データストリームをシャーシ内のいずれか1つ以上の宛先にルーティングする機能を有するトランスポートマルチプレクサである、請求項16記載の装置。
- 前記宛先は1つの処理ボードに在る、請求項21記載の装置。
- 前記宛先は、バックプレーンを介して通信可能に相互にリンクされた異なるボードに在る、請求項21記載の装置。
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