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電圧制御器（１５０）であって、
ルックアップテーブル（３０２）を含んでおり、デジタル誤差信号に基づいてデジタル制御信号（１５４）を確定するための補償器（３００）と、
前記確定されたデジタル制御信号に応答して電源制御信号（１５６）を供給するように動作する変調器（４００）とを備え、変換器電圧（１０４）を基準電圧（１０６）と比較し、前記比較された電圧間の差を示す前記デジタル誤差信号（１５２）を生成するように動作する遅延線アナログ／デジタル変換器（７００）を特徴とする電圧制御器。 A voltage controller (150),
A compensator (300) including a look-up table (302) and determining a digital control signal (154) based on the digital error signal;
A modulator (400) operative to provide a power control signal (156) in response to the established digital control signal, comparing the converter voltage (104) with a reference voltage (106), and A voltage controller characterized by a delay line analog-to-digital converter (700) that operates to generate the digital error signal (152) indicative of the difference between the compared voltages. 受動電子部品を含まないことを特徴とする請求項１に記載の制御器。   The controller according to claim 1, wherein the controller does not include passive electronic components. 前記比較器は完全にデジタル論理ゲートを用いて実施されることを特徴とする請求項１に記載の制御器。   The controller of claim 1, wherein the comparator is implemented entirely using digital logic gates. 制御器内のすべてのエネルギー蓄積部品はデジタル論理ゲートであることを特徴とする請求項１に記載の制御器。   The controller of claim 1, wherein all energy storage components in the controller are digital logic gates. 前記遅延線ＡＤＣは遅延セルアレイ（７４０）を備えることを特徴とする請求項１に記載の制御器。   The controller of claim 1, wherein the delay line ADC comprises a delay cell array (740). 前記遅延線ＡＤＣは、前記比較された電圧間の前記差を示す温度計符号出力（７７２）を供給するように動作することを特徴とする請求項１に記載の制御器。   The controller of claim 1, wherein the delay line ADC is operative to provide a thermometer sign output (772) indicative of the difference between the compared voltages. 前記遅延線ＡＤＣを通る試験信号伝播の程度は前記温度計符号を確立する（ｅｓｔａｂｌｉｓｈ）ことを特徴とする請求項６に記載の制御器。   The controller of claim 6, wherein the degree of test signal propagation through the delay line ADC establishes the thermometer code. 前記遅延線ＡＤＣは、前記温度計符号を前記デジタル誤差信号に変換するように動作する符号化器（７３０）を備えることを特徴とする請求項６に記載の制御器。   The controller of claim 6, wherein the delay line ADC comprises an encoder (730) that operates to convert the thermometer code into the digital error signal. 前記変調器はデジタルパルス幅変調器であることを特徴とする請求項１に記載の制御器。   The controller of claim 1, wherein the modulator is a digital pulse width modulator. 前記変調器は、前記電源制御信号についてパルスオン期間の第１成分を確定するように動作するカウンタ（４０６）を備えることを特徴とする請求項１に記載の制御器。   The controller of claim 1, wherein the modulator comprises a counter (406) that operates to determine a first component of a pulse-on period for the power control signal. 前記変調器は、前記電源制御信号についてパルスオン期間の第２成分を確定するように動作する遅延線（４０２）を備えることを特徴とする請求項１に記載の制御器。   The controller of claim 1, wherein the modulator comprises a delay line (402) that operates to determine a second component of a pulse-on period for the power control signal. 前記変調器は、
前記電源制御信号についてパルスオン期間の第１成分を確定するように動作するカウンタと、
前記電源制御信号についてパルスオン期間の第２成分を確定するように動作する遅延線を備えることを特徴とする請求項１に記載の制御器。 The modulator is
A counter that operates to determine a first component of a pulse-on period for the power control signal;
The controller according to claim 1, further comprising a delay line that operates to determine a second component of a pulse-on period for the power control signal. アナログ／デジタル変換器（ＡＤＣ）（７００）であって、入力電圧を有し、
遅延セルのアレイ（７４０）であって、それぞれが前記入力電圧によって電源供給される、遅延セルのアレイと、
前記遅延セルアレイに結合した信号タップアレイ（７８０）とを特徴とするアナログ／デジタル変換器（ＡＤＣ）。 An analog / digital converter (ADC) (700) having an input voltage,
An array of delay cells (740), each of which is powered by said input voltage; and
An analog / digital converter (ADC) comprising a signal tap array (780) coupled to the delay cell array. 前記遅延セルはデジタル論理ゲートであることを特徴とする請求項１３に記載のＡＤＣ。   The ADC of claim 13, wherein the delay cell is a digital logic gate. 受動アナログ部品を含まないことを特徴とする請求項１３に記載のＡＤＣ。   14. The ADC of claim 13, wherein the ADC is free of passive analog components. 前記遅延セルアレイを通る試験信号の伝播速度は、前記入力電圧の大きさにほぼ比例することを特徴とする請求項１３に記載のＡＤＣ。   14. The ADC according to claim 13, wherein the propagation speed of the test signal through the delay cell array is substantially proportional to the magnitude of the input voltage. 前記信号タップアレイは、前記遅延セルそれぞれに結合した信号タップ（７２８）を備えることを特徴とする請求項１６に記載のＡＤＣ。   The ADC of claim 16, wherein the signal tap array comprises a signal tap (728) coupled to each of the delay cells. 前記信号タップのステータスは、前記遅延セルアレイを通る前記信号の伝播速度を示すことを特徴とする請求項１７に記載のＡＤＣ。   The ADC of claim 17, wherein the status of the signal tap indicates a propagation speed of the signal through the delay cell array. 温度計符号（７７２）を前記信号タップアレイからデジタル誤差信号に変換する符号化器をさらに備えることを特徴とする請求項１３に記載のＡＤＣ。   14. The ADC of claim 13, further comprising an encoder that converts a thermometer code (772) from the signal tap array to a digital error signal. コンデンサを含まないか、または誘導子を含まないことを特徴とする請求項１３に記載のＡＤＣ。   14. The ADC of claim 13, wherein the ADC is free of capacitors or free of inductors. コンデンサを含まないか、誘導子を含まないか、または抵抗を含まないことを特徴とする請求項１３に記載のＡＤＣ。   14. The ADC of claim 13, wherein the ADC is free of capacitors, free of inductors, or free of resistors. 電圧制御器（１５０）であって、
アナログ電圧（１０４）をアナログ基準電圧（１０６）と比較し、前記出力電圧と前記基準電圧の差を示すデジタル誤差信号（１５２）を供給するように動作する電圧比較器（７００）と、
前記供給された誤差信号に基づいてデジタル制御信号を確定するように動作する補償器（３００）と、
前記確定されたデジタル制御信号に基づいて電源制御信号を供給するように動作する変調器（４００）とを備え、前記比較器、前記補償器、および前記変調器は、完全にデジタル論理ゲートを用いて実施されることを特徴とする電圧制御器。 A voltage controller (150),
A voltage comparator (700) operable to compare an analog voltage (104) with an analog reference voltage (106) and provide a digital error signal (152) indicative of a difference between the output voltage and the reference voltage;
A compensator (300) operative to determine a digital control signal based on the supplied error signal;
A modulator (400) that operates to provide a power control signal based on the determined digital control signal, wherein the comparator, the compensator, and the modulator use a fully digital logic gate. A voltage controller characterized by being implemented. 前記デジタル論理ゲートのすべては標準ライブラリセルに対応することを特徴とする請求項２２に記載の電圧制御器。   The voltage controller of claim 22, wherein all of the digital logic gates correspond to standard library cells. 前記デジタル論理ゲートのすべては、ＨＤＬ（ｈａｒｄｗａｒｅ ｄｅｓｃｒｉｐｔｉｏｎ ｌａｎｇｕａｇｅ）に適合していることを特徴とする請求項２２に記載の電圧制御器。   23. The voltage controller according to claim 22, wherein all of the digital logic gates are adapted to a HDL (hardware description language). 受動電子部品を含まないことを特徴とする請求項２２に記載の電圧制御器。   The voltage controller according to claim 22, wherein the voltage controller does not include passive electronic components. アナログエネルギー蓄積部品を含まないことを特徴とする請求項２２に記載の電圧制御器。   The voltage controller of claim 22, wherein the voltage controller does not include an analog energy storage component. コンデンサを含まないか、誘導子を含まないか、または抵抗を含まないことを特徴とする請求項２２に記載の電圧制御器。   23. The voltage controller of claim 22, comprising no capacitor, no inductor, or no resistor. 電圧を制御する方法であって、
変換器出力電圧を基準電圧と比較するステップ（７００）と、
前記比較の結果を示すデジタル誤差信号を生成するステップと、
前記生成された誤差信号を示す電源制御信号（１５６）を供給するステップとを含み、前記比較するステップ、前記生成するステップ、および前記供給するステップは、完全にデジタル論理ゲートを用いて実行されることを特徴とする方法。 A method for controlling voltage,
Comparing the converter output voltage with a reference voltage (700);
Generating a digital error signal indicative of the result of the comparison;
Providing a power control signal (156) indicative of the generated error signal, wherein the comparing step, the generating step, and the supplying step are performed entirely using digital logic gates. A method characterized by that. 前記比較するステップは、前記変換器出力電圧を用いて複数の遅延セルのアレイ（７４０）に電源供給するステップを含むことを特徴とする請求項２８に記載の方法。   29. The method of claim 28, wherein the comparing step includes powering an array (740) of a plurality of delay cells using the converter output voltage. 前記比較するステップは、遅延セルのアレイを通る試験信号伝播の程度を測定するステップを含み、前記遅延セルは前記変換器出力電圧によって電源供給されることを特徴とする請求項２８に記載の方法。   29. The method of claim 28, wherein the comparing step includes measuring a degree of test signal propagation through an array of delay cells, the delay cells being powered by the converter output voltage. . 前記供給するステップは、制御アルゴリズムに従って前記生成された誤差信号からデジタル制御信号を確定するステップを含むことを特徴とする請求項２８に記載の方法。   29. The method of claim 28, wherein the providing step includes determining a digital control signal from the generated error signal according to a control algorithm. 前記確定するステップは、前記生成された誤差信号の値に基づいてルックアップテーブルエントリを選択するステップを含むことを特徴とする請求項３１に記載の方法。   The method of claim 31, wherein the determining step includes selecting a lookup table entry based on the value of the generated error signal. 前記供給するステップは、制御アルゴリズムに従って前記生成された誤差信号からデューティ比を確定するステップを含むことを特徴とする請求項２８に記載の方法。   29. The method of claim 28, wherein the providing step includes determining a duty ratio from the generated error signal according to a control algorithm. 電圧を制御する方法（１５０）であって、
調整器出力電圧（１０４）を受け取るステップと、
前記受け取った出力電圧をデジタル誤差信号（１５２）に変換するステップと、
前記デジタル誤差信号に基づいて前記調整器出力電圧を調整するステップとを含み、前記変換するステップは遅延線を用いて実行されることを特徴とする方法。 A method of controlling voltage (150), comprising:
Receiving a regulator output voltage (104);
Converting the received output voltage into a digital error signal (152);
Adjusting the regulator output voltage based on the digital error signal, the converting step being performed using a delay line. 前記変換するステップは、
前記受け取った変換器出力電圧（１０４）を用いて遅延セルアレイ（７４０）に電源供給するステップと、
前記電源供給された遅延セルアレイを通る試験信号の伝播速度を測定するステップと、
前記測定された試験信号を示す前記デジタル誤差信号を生成するステップとを含むことを特徴とする請求項３４に記載の方法。 The converting step includes:
Powering the delay cell array (740) using the received converter output voltage (104);
Measuring the propagation speed of a test signal through the powered delay cell array;
35. The method of claim 34, comprising generating the digital error signal indicative of the measured test signal. 前記変換するステップは前記遅延線ＡＤＣを較正するステップをさらに含むことを特徴とする請求項３５に記載の方法。   36. The method of claim 35, wherein the converting step further comprises calibrating the delay line ADC. 前記較正するステップは、
前記遅延線ＡＤＣを使用して、基準電圧を基準変換誤差値に変換するステップと、
前記基準変換誤差値を前記デジタル誤差信号に加算するステップ（１１１４）であって、それによって、補正されたデジタル誤差信号（１１５２）を供給する、加算するステップとを含むことを特徴とする請求項３６に記載の方法。 The step of calibrating comprises:
Converting a reference voltage into a reference conversion error value using the delay line ADC;
Adding the reference conversion error value to the digital error signal (1114), thereby providing and adding a corrected digital error signal (1152). 36. The method according to 36. 前記較正するステップは、
基準電圧（１０６）を用いて、前記遅延セルアレイに電源供給するステップと、
前記基準電圧で電源供給された遅延セルアレイを通る試験信号の伝播速度を測定するステップと、
前記測定された試験信号伝播速度を示す基準変換誤差値（１１０８）を生成するステップと、
前記基準変換誤差値を前記生成されたデジタル誤差信号に加算するステップ（１１１４）とを含むことを特徴とする請求項３６に記載の方法。 The step of calibrating comprises:
Powering the delay cell array using a reference voltage (106);
Measuring the propagation speed of a test signal through a delay cell array powered by the reference voltage;
Generating a reference conversion error value (1108) indicative of the measured test signal propagation speed;
37. The method of claim 36, comprising adding (1114) the reference conversion error value to the generated digital error signal. 前記調整するステップは、制御アルゴリズムに従って、前記生成されたデジタル誤差信号に基づいてデジタル制御信号を確定するステップを含むことを特徴とする請求項３４に記載の方法。   The method of claim 34, wherein the adjusting step includes determining a digital control signal based on the generated digital error signal according to a control algorithm. 電圧制御器（１５０）であって、
変換器出力電圧源（１０４）と、
前記出力電圧に応答して、前記出力電圧と以前に格納された基準電圧の差を示すデジタル誤差信号（１５２）を生成するようにするアナログ／デジタル変換器（ＡＤＣ）（７００）と、
前記デジタル誤差信号に応答して、デジタル制御信号を生成するようにするデジタル電子計算器（３００）と、
前記生成されたデジタル制御信号に応答して、電源制御信号に対するパルスオン期間を生成するようにするパルス幅変調器（４００）とを備え、前記ＡＤＣは遅延線を含むことを特徴とする電圧制御器。 A voltage controller (150),
A converter output voltage source (104);
An analog-to-digital converter (ADC) (700) adapted to generate a digital error signal (152) indicative of a difference between the output voltage and a previously stored reference voltage in response to the output voltage;
A digital electronic calculator (300) adapted to generate a digital control signal in response to the digital error signal;
And a pulse width modulator (400) configured to generate a pulse-on period for a power control signal in response to the generated digital control signal, wherein the ADC includes a delay line. . 前記遅延線ＡＤＣは、能動基準電圧源と前記以前に格納された基準電圧の間の比較に応答して、基準変換誤差値を生成するようにすることを特徴とする請求項４０に記載の電圧制御器。   41. The voltage of claim 40, wherein the delay line ADC is adapted to generate a reference conversion error value in response to a comparison between an active reference voltage source and the previously stored reference voltage. Controller. 前記遅延線ＡＤＣは、前記基準変換誤差値を格納するレジスタ（１１０６）を備えることを特徴とする請求項４１に記載の電圧制御器。   The voltage controller of claim 41, wherein the delay line ADC comprises a register (1106) for storing the reference conversion error value. 前記遅延線ＡＤＣは、前記デジタル誤差信号および前記基準変換誤差値に応答して、前記デジタル誤差信号および前記基準変換誤差値の合計値を生成するようにする電圧比較回路（１１１４）を備えることを特徴とする請求項４２に記載の電圧制御器。   The delay line ADC includes a voltage comparison circuit (1114) configured to generate a total value of the digital error signal and the reference conversion error value in response to the digital error signal and the reference conversion error value. 43. A voltage controller according to claim 42, characterized in that:
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