JP2005501352A5 - - Google Patents

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JP2005501352A5
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Claims (7)

  1. 1つ以上のコンピュータから隔てられて配置される1つ以上のコンピュータ周辺装置およびモニタ該1つ以上のコンピュータを動作可能にリンクするデータリンクであって、
    複数のマスタ状態デバイスであって、各々が、該1つ以上のコンピュータのうちの1つを該データリンクに動作可能にリンクするマスタトランシーバを含み、かつ、各々が、該複数のマスタ状態デバイスに接続されているコンピュータからコンピュータデータを受信するように構成、かつ、適応される、複数のマスタ状態デバイスと、
    1つ以上のスレーブ状態デバイスであって、各々が、1つ以上の周辺装置およびモニタを該データリンクに動作可能にリンクするスレーブトランシーバを含み、かつ、各々が、該1つ以上のスレーブ状態デバイスに接続されている周辺装置から周辺データを受信するように構成されており、かつ、適応されている、1つ以上のスレーブ状態デバイスと、
    マトリクススイッチであって、
    選択されマスタ状態デバイスと選択され1つ以上のスレーブ状態デバイスとの間にスイッチ可能パスを提供するクロスポイント接続回路と、
    該スイッチ可能パスの確立を制御する、該スイッチ可能パスの外にあるプロセッサと
    を備えるマトリクススイッチと
    を備え、
    該選択されマスタ状態デバイスは、利用可能なコンピュータデータの下流送信を互いに独立して合図し、かつ対応する利用可能な周辺デタの上流送信の受領を互いに独立して待機することにより、該選択された1つ以上のスレーブ状態デバイスと自己同期通信する、データリンク。
  2. 周辺データパケットのストリームは、マウスデータ、マウスクロック、キーボードデータおよびキーボードクロックからなる群のうちの1つを含む、請求項1に記載のデータリンク。
  3. 前記周辺データパケットのストリームのうちの少なくとも1つは、非同期データをさらに含む、請求項2に記載のデータリンク。
  4. 前記1つ以上のコンピュータ周辺装置は、キーボードおよびマウスを備える、請求項1に記載のデータリンク。
  5. 1つ以上のコンピュータから隔てられて配置される1つ以上のコンピュータ周辺装置に該1つ以上のコンピュータを動作可能にリンクするデータリンクを備えるシステムにおいて、該データリンクは、(a)複数のマスタ状態デバイスと、(b)1つ以上のスレーブ状態デバイスと、(c1)選択されたマスタ状態デバイスと選択された1つ以上のスレーブ状態デバイスとの間にスイッチ可能パスを提供するクロスポイント接続回路と(c2)該スイッチ可能パスの確立を制御する、該スイッチ可能パスの外にあるプロセッサとを有する(c)マトリクススイッチとを有し、
    該データリンクにおいて、第1のコンピュータと第1の周辺装置との間に第1のパスを形成することであって、該第1のコンピュータおよび該第1の周辺装置の各々が該データリンク動作可能に接続されている、ことと、該データリンクにおいて、第2のコンピュータと第2の周辺装置との間に第2のパスを形成することであって、該第2のコンピュータおよび該第2の周辺装置の各々が該データリンクに動作可能に接続されている、ことと、
    該1つ以上のコンピュータのうちの第1のコンピュータに対応するマスタ状態デバイスにおいて、該第1のコンピュータからコンピュータデータを受信することと、
    該1つ以上のコンピュータ周辺装置のうちの第1のコンピュータ周辺装置に対応するスレーブ状態デバイスにおいて、該第1の周辺装置から周辺装置データを受信することと、
    該1つ以上のコンピュータのうちの第2のコンピュータに対応する別のマスタ状態デバイスにおいて、該第2のコンピュータから該コンピュータデータを受信することと、
    該1つ以上のコンピュータ周辺装置のうちの第2のコンピュータ周辺装置に対応する別のスレーブ状態デバイスにおいて、該第2のコンピュータ周辺装置から第2の周辺装置データのストリームを受信することと、
    コンピュータデータの下流送信を互いに独立して合図し、かつ、周辺データの上流送信の受領を互いに独立して待機することにより、該第1のコンピュータと該第2のコンピュータおよび該第1のコンピュータ周辺装置と該第2のコンピュータ周辺装置との間でそれぞれ自己同期通信することと
    を包含する、方法。
  6. 前記第1および第2の周辺データのストリームは、マウスデータ、マウスクロック、キーボードデータおよびキーボードクロックからなる群のうちの1つを含む、請求項5に記載の方法。
  7. 前記第1および第2の周辺デバイスは、マウスおよびキーボードからなる群から選択される、請求項5に記載の方法。
JP2003524097A 2001-08-22 2002-08-20 自己同期半二重マトリクススイッチ Pending JP2005501352A (ja)

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