JP2005285114A - プロセッサの性能を強化する方法及び装置 - Google Patents
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Abstract
【解決手段】最適処理周波数が各プロセッサの個別動作特性に基づきプロセッサに対してセットされる。プロセッサに供給される電源電圧は、そのプロセッサに指定された最高値まで手動で又はソフトウェア制御の下に上昇される。これがプロセッサを最高可能周波数で動作させる。プロセッサ・クロックをその最高動作周波数に適当にセットすることができるようにプロセッサ・クロック周波数がマザーボード・クロック周波数に対して変動させられる。プロセッサが適正に機能する際の最高クロック周波数を判定するために近似方法が使用される。熱的に誘導される半導体降服を防止するために、追加ヒート・シンクが遂行され及び(又は)熱管理方式が使用される。プロセッサへの最適動作周波数及び最適電源電圧を決定するために電源電圧がまたクロック速度と一緒に制御されることがある。
【選択図】図1
Description
(本発明の分野)
本発明は、マイクロ・プロセッサ・チップの処理速度を最適化する装置及び方法に関する。
(関連技術の説明)
周知のように、プロセッサ・チップの性能の尺度は、そのプロセッサ・チップの動作周波数である。高クロック周波数で動作するプロセサ・チップは、低クロック周波数で動作する同等のプロセサ・チップよりも短時間により多くの情報を処理する能力を有する。それゆえ、プロセサ・チップを、そのプロセッサの内部遅延、熱破壊に起因して又は熱的に誘導される自動停止に起因してそのプロセッサを誤動作させることなく、又は熱的に誘導される運転停止に起因する性能の劣化を起こさせることなく、その特定のプロセサ・チップが動作することができる最高クロック周波数で、ランさせることが望ましい。
多くの場合、プロセサ・チップは、そのプロセッサが上述の故障又は保護上の停止を生じることなく維持することができる最高動作周波数よりもかなり低いクロック周波数で動作するコンピュータ・システム内に実現される。これは、多くの理由から起こることがある。例えば、プロセサ・チップは、典型的に、2つないし3つの速度階級(例えば、66MHz、100MHz等)に類別されるので、標準クロック速度階級より高いクロック速度で実際にランする能力を有する多くのプロセサ・チップは、単に、所与のコンピュータに対するクロック速度階級に適合するために低クロック速度にセットされる。更に、処理チップ製造業者は、時には、1つの速度階級(例えば、100MHz)以上で動作する能力を有するチップを過剰に生産するが、しかし、市場計画と協調するために、これらの製造業者は、故意にそのプロセッサを低速度階級で市場に出し、市場圧力が高速度階級を要求するまで速度を下げたままにする。最終的に、時には、処理チップは、低電圧条件下でのみ試験される。技術的に周知のように、高電源電圧がマイクロプロセサ・チップに印加されると、このチップは、典型的に、この処理チップが動作することのできる最高クロック速度を増すように働く。これは、より高い電圧がプロセッサ電子回路全体を通して容量性時間遅延の短縮をもたらすゆえである。しかしながら、熱的考慮、電源ニーズ及び結局、電圧によって誘導される半導体降服に起因して、電源電圧は、多くの処理チップ上でしばしば低く維持される。それゆえ、遥かに高いクロック速度でランする能力を有する或る処理チップは、時には、試験が実施された条件に起因してより低いクロック速度階級に分類される。
プロセッサの性能を強化する1つの既知の方法は、マザーボード・クロックを使用禁止し、かつ、より高い周波数クロック源を追加することである。しかしながら、このような実現は、通常、マザーボード上のシステム構成要素の全て(例えば、メモリ、マザーボード・バス、入出力装置等)が高められたクロック速度で動作することを要求する。したがって、システム構成要素の1つが高クロック速度で動作する能力を有さないならば、性能を改善するために、このような実施例を使用することはできない。
それゆえ、個々の処理チップの性能を最適化するために、プロセサ・チップのクロック速度性能を強化する装置及び方法をアフタサービス製造業者又は個々のPC所有者によって実現することができるとしたならば、望ましいことである。
コンピュータ・システム内で可変周波数プロセサ・チップの性能を強化する方法において、プロセサ・チップが指定最高電圧レベルを有し、かつデジタル制御される電源電圧によって附勢される。この方法は、次のステップを含む。すなわち、電源電圧を指定最高電圧レベルにセットするために複数のデジタル電源制御値を印加するステップ、プロセサ・チップが動作するクロック速度を初期周波数にセットするために第1のデジタル値をプロセサ・チップに印加するステップ、プロセサ・チップがこの周波数にセットされているときコンピュータ・システムが適正に動作するかどうか判定するステップ、及びプロセサ・チップが初期周波数にセットされているときコンピュータ・システムが適正に動作しないならば、処理チップが適正に動作する最高クロック速度が見付かるまでクロック速度を低下させるように異なるデジタル値をプロセサ・チップに印加するステップ。プロセサ・チップが初期周波数にセットされているときコンピュータ・システムが適正に動作するならば、コンピュータ・システムが適正に動作する最高クロック速度が見付けられるまでクロック速度を上昇させるようにデジタル値が印加される。
好適実施例では、クロック速度を上昇又は低下させるために逐次近似が使用される。
他の好適実施例では、本方法は、プロセサ・チップの温度を監視し、かつ、その温度がしきい値を超えるとプロセッサ温度が安全値に復帰するような時間までプロセッサの動作周波数を低下させるために中断を生じるステップを更に含み、この時間にプロセッサは、その元のクロック速度でランすることを許される。
他の態様では、本発明の好適実施例は、可変周波数プロセサ・チップの性能を強化する方法であって、プロセサ・チップがデジタル制御される電源電圧によって附勢される。この方法は、次のステップを含む。すなわち、電源電圧をプロセサ・チップの動作範囲内の電圧レベルにセットするために複数のデジタル電源制御値を電源に印加するステップ、プロセサ・チップが動作するクロック速度を初期周波数にセットするために第1の複数のデジタル周波数制御値をプロセサ・チップに印加するステップ、プロセサ・チップが初期周波数で適正に動作するかどうか判定するステップ、及びプロセサ・チップが適正に動作する最高クロック速度を決定するために電源電圧と一緒にクロック速度を制御するように異なるデジタル周波数制御値をプロセサ・チップに印加するステップを含む。
好適実施例では、クロック速度を上昇又は低下させるために逐次近似が使用される。
他の好適実施例では、本方法は、プロセサ・チップの温度を監視しかつその温度がしきい値を超えるとプロセッサ温度が安全値に復帰するような時間までプロセッサの動作周波数を低下させるために中断を生じるステップを更に含み、この時間にプロセッサは、その元のクロック速度でランすることを許される。
なお他の好適実施例では、本方法は、プロセッサの冷却を増すことを含む。特定実施例では、ヒート・シンク又はファンがプロセッサの冷却を増すために使用される。
図1は、本発明の教示により構成されたコンピュータ・システム100の極めて簡単化されたブロック図である。コンピュータ・システム100は、本発明を図解するに当たって明確の目的のために図1に示されていない追加電子回路を典型的に含むことは、当業者の承知する所である。コンピュータ・システム100は、中央処理装置(CPU)110を含み、この装置は、例えば、INTELから入手可能なP6マイクロ・プロセサ・チップを含んでよい。CPU又はプロセッサ110はマイクロ・プロセッサ・バス130及びコア論理135を経由してマザーボード上のメモリ、入出力(I/O)装置等120のような、他のシステムと連絡する。プロセッサ110は、また電源制御レジスタ140を含み、このレジスタは、CPU電源145の調整電圧を制御するために通常使用される電圧制御値を記憶する。
本発明の1つの好適実施例によれば、CPU電源145を制御するために使用されるCPUの電源制御レジスタからの線路は、遮断され、CPU電源145の制御は、スイッチのアレイ又は別個マイクロ・コントローラのような外部制御装置によって施される。
プロセッサ110は、内部周波数変換器160を含み、この変換器は、マザーボード・システム構成要素に供給されるクロック周波数から内部クロック周波数を発生する。周波数変換器160は、線路167を経由して発振器165からクロック入力を受信する。
周波数変換器160は、CPU110のピン上の電圧レベルをラッチすることによって、製造業者のCPUハードウェア仕様によって定義されたようにリセットの際に決定された周波数で動作する。これらのピンは、マルチプレクサ141によって駆動される。リセットが表明されないとき、これらのピンは、コア論理135によって制御される。リセット中、これらのピンは、スイッチ又はハード・ワイヤ・ジャンパのどちらかであり得る周波数制御ハードウェア143によって制御される。
特定のいくつかの応用の場合、SMIに起因するプロセッサ110の停止又は速度低下が高電源電圧に対してプロセッサ110を実際に低有効速度でランさせる結果を招くことが判る。これらの応用では、プロセッサ110がそのチップの個別特性に対する最適許容クロック速度でランすることができるように平衡を見付けなければならない。それゆえ、本発明の1つの態様によれば、電源電圧ばかりでなくプロセッサ110に供給されるクロック速度を制御する方法は、プロセッサ110が動作することのできる最適クロック周波数を見付ける。更に、このようにして、プロセッサ110の動作寿命期間を短縮する危険を伴うことなく、各個のプロセッサにとっての最高クロック速度を利用することができる。
プロセッサ110の最適クロック速度を、プロセッサ110の内部自己試験を使用して周波数コントローラ143の制御の下に電力投入中、決定することができる。いったん、この最適クロック速度が決定されると、プロセッサ110は、マザーボード上のシステム構成要素120及び135と一緒に正常に動作する。本発明は、プロセッサ・クロック周波数とマザーボード・クロック周波数との間の可変関係を活用する。プロセッサ・クロック周波数をマザーボード動作周波数に対して変動させることができるので、マザーボード・システム構成要素120及び135のクロック速度に影響することなく、どのようなクロック速度でもプロセッサ110に対して定義してよい。
位相ロック・ループ220の出力222は、分周回路230を経由して位相ロック・ループ220の第2の入力232にフィードバックされる。分周回路230は、第2の3ビット・レジスタ240内に記憶された値に等しいスケーラ値だけ位相ロック・ループ220の出力信号222の周波数を分周する。3ビット・スケーラ値は、3ビット・バス242を経由して分周器230に入力として供給される。
位相ロック・ループ220は、その第1の入力に印加される信号の位相及び周波数とその第2の入力に印加される信号の位相及び周波数との同等性を維持することを追及するので、位相ロック・ループ220によって供給される出力信号222の周波数は、信号167の入力周波数をB(Bは、第2のレジスタ240に記憶された3ビット値に等しい)で倍周した上でAで分周したものに等しい。位相ロック・ループ220によって供給される出力周波数222が入力周波数167のA分のBである限り、この位相ロック・ループの第1の入力202及び第2の入力232の両方に印加される信号の周波数は、入力周波数をAで分周したものに等しい。ここで注意を要するのは、A及びBが3ビット2進カウンタである実施例では、A及びBは、典型的に1から8の値(10進法の)の範囲にあることである。更に、理解すべきことは、foutmax=fin×8かつfoutmin=fin+8である。A及びBの両方にとって8つの可能な値があるから、したがって、8×8=64の可能な比がある。このようにして、プロセッサ・クロックをスケーラ値B及びAによって定義可能などんな比にもセットすることができ、そのためマザーボード・クロック周波数は・プロセッサ・クロック周波数から減結合される。カウンタ制御レジスタ210及び240は、典型的に、プロセッサ内のハードウェア内に実現されるルックアップ・テーブル260からの出力である。レジスタ250は、このルックアップ・テーブルからの記述項を選択するのに使用される。周波数変換器の動作にとって必要ではないが、このルックアップ・テーブルは、比を定義するのに要求されるピンの数を減少させるために通常、含まれる。レジスタ250、210、240が全て3ビット・レジスタである実施例では、64の可能な比が8つの比からなる副集合に減少させられる。ルックアップ・テーブル記述項は、典型的には、周波数選択レジスタ250に記憶された値によって選択される。このレジスタは、図1に示されたようにCPU110上のI/Oピン142を経由してリセット時間にロードされる。
その後、活動ブロック310内に表示されたように、CPU110の動作電圧が最高定格値にセットされる。すなわち、CPU110の製造業者が仕様書を提供するが、この仕様にCPU110が動作することのできる最高動作電圧値が指示される。技術上周知のように、動作電圧値の上昇は、典型的にCPU110の動作速度の上昇を招くから、CPU110の動作電圧を最高定格値にセットすることによって、CPU110の性能を強化することができる。
いったんCPU110の動作電圧が最高定格値にセットされると、周波数制御値の全ての比におけるCPU性能が活動ブロック315内に表示されたように特徴付けられる。すなわち、Aの可能な値とBの可能な値(図2参照)の各々毎に、CPU110が自己診断試験を通過するかどうか判定する試験が行われ、もし通過するならば、SEMANTEC CORPORATIONから入手可能な周知のNOTRTONユーテリティのような標準ベンチ・マーキング・ソフトウェアを使用して、その比に対する性能得点が判定される。第1表は、例証CPU110について比コード(すなわち、図2の周波数選択レジスタ250にロードされたコード)によって指定された、周波数制御値を特徴付ける表である。
活動ブロック315内に表示されたようにいったんCPU110の性能が周波数制御値の全ての比において特徴付けられると、最適CPU性能に相当する比をセットするために、最高性能得点を与える周波数制御値が周波数選択レジスタ250にロードされる。例えば、第1表に掲げられた例証値から、1.34なる正規化性能得点を有する比コードN+3が最高得点を与える周波数制御値に相当する。それゆえ、N+3なる値がCPU110の動作速度を決定するために周波数選択レジスタ250にロードされることになる。
その後、活動ブロック325内に表示されたように、CPU110の故障率を判定するために故障追跡記録が維持される。故障追跡記録は、1つの実施例においてCPU110が処理誤りを冒す回数の記録である。判定ブロック330内に表示されたように、故障率が特定のしきい値より高いと判定されるならば、周波数制御比値は、次に最高な性能得点(例えば、第1の表内の値N+2)を与える値にセットされる。この後、本発明は、新故障追跡記録を維持するために活動ブロック325に再び入る。いったん故障率が許容可能であると判定されるならば、CPU110は、現在、周波数制御値によって提供される動作速度にセットされたままであり、かつ本方法の終了が終了ブロック340内に表示される。もちろん、注意を要するのは、故障追跡記録の維持は、本発明の方法で単一ステップとして図3に描かれているが、故障率が許容可能なしきい値を超えるとき必ず周波数制御値が調整されるように、有利上、CPU110の動作を通して連続的に計算される。
Claims (5)
- 可変周波数プロセッサの性能を強化する方法であって、前記プロセッサがデジタル制御電源から供給電圧を受け、前記プロセッサの動作周波数がデジタル周波数制御値により決定され、前記方法は、
前記電源に第1のデジタル電源制御値を印加し前記電源を前記プロセッサの動作範囲内の初期電圧レベルに設定するステップと、
前記プロセッサに第1のデジタル周波数制御値を印加し前記プロセッサが初期周波数で動作するクロック速度を設定するステップと、
初期周波数および初期電圧レベルで動作する前記プロセッサの性能値を決定するステップと、および
前記プロセッサに複数のデジタル周波数制御値を印加し前記電源に複数のデジタル電源制御値を印加する関係においてクロック速度を制御し前記電源を制御し前記プロセッサの最適性能値を決定するステップと、
を含む前記方法。 - 請求項1記載の方法であって、前記プロセッサは、コンピュータ・システムの一部であり、前記方法は、さらに、コンピュータ・システムが適正に動作する最大クロック速度が見出されるまで複数のデジタル周波数制御値を印加しクロック速度を増加することにより前記プロセッサが初期周波数に設定されるとき適正に動作するコンピュータ・システムに応答するステップを含む前記方法。
- 請求項1記載の方法であって、前記プロセッサは、コンピュータ・システムの一部であり、前記方法は、さらに、コンピュータ・システムが適正に動作する最大クロック速度が見出されるまで複数のデジタル周波数制御値を印加しクロック速度を減少することにより前記プロセッサが初期周波数に設定されるとき不適当に動作するコンピュータ・システムに応答するステップを含む前記方法。
- 請求項1から3のいずれかに記載の方法であって、クロック速度を増加または減少するために逐次近似が使用される前記方法。
- 可変周波数プロセッサの性能を強化する装置であって、電源制御装置および前記プロセッサの周波数を可変する手段を含み、前記装置は、請求項1から4のいずれかの方法を実施する前記装置。
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