JP2005168229A - 電源供給装置 - Google Patents
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Abstract
【構成】シリーズレギュレータおよびスイッチングレギュレータを備えて負荷電流の大きさにより両者を選択して切り換えるものであり、2種類のレギュレータが負荷に電流を供給するPチャネルMOSFETと少なくとも位相補償回路を除く誤差増幅器等を共有することにより、回路規模の増大を抑制することができる。
【選択図】 図2
Description
図6に制御信号”DCDC CTL”によりPWM/PFMパルス発生回路51が切り換わるときの各部電圧波形を示す。図6において(a)は制御信号”DCDC CTL”を、(b)はPWM/PFMパルス発生回路51の出力であるPチャネルMOSFET50の駆動パルスを、(c)は(b)の駆動パルスに対応した電源出力VOのリップルをそれぞれ示す図である。制御信号”DCDC CTL”がH(ハイレベル)である前半はPWM方式の動作を示し、制御信号”DCDC CTL”がL(ローレベル)である後半はPFM方式の動作を示している。上述のスリープモードや待ち受けモードなど消費電流を絞るときは、制御信号”DCDC CTL”をLにしてPFM方式を選択することになるが、図6に示すようにPFM方式では低負荷時の効率を上げることはできても出力電圧の変動(リップル)を小さくすることができず、PチャネルMOSFET50のスイッチング周波数が低くなるため却ってPWM方式よりリップルが大きくなってしまうことがあるという問題がある。すなわち、PFM方式では、スリープモードや待ち受けモードのときに高い効率とリップルの少ない安定した出力を両立させることができない。
DC/DCコンバータ62は誤差増幅器69,2つの制御信号”DCDC CTL”と”SYNC/ASYNC CTL”が接続されたパルス幅変調回路70,スイッチング素子であるPチャネルMOSFET71,同期整流方式用のNチャネルMOSFET72,ショットキーダイオード73,インダクタ74およびコンデンサ75からなる。誤差増幅器69は基準電圧Vrefとフィードバック信号Vsの差を増幅してパルス幅変調回路70に入力する。パルス幅変調回路70は、周期は一定であるが1周期内のHとLの割合(デューティ)が誤差増幅器70の出力により変化する方形波パルスをPチャネルMOSFET71のゲートに出力する。すなわち、(Vref−Vs)が大きい(小さい)ほど1周期内のPチャネルMOSFET71がオン(導通)する期間が長く(短く)なるような方形波パルスを発生し、インダクタ74に蓄積するエネルギを大きく(小さく)することにより出力電圧VOを一定に保つ。NチャネルMOSFET72のゲートにもパルス幅変調回路70から方形波パルスが出力される。基本的にはPチャネルMOSFET71とNチャネルMOSFET72のゲートに出力される方形波パルスは同相であるが、PチャネルMOSFET71とNチャネルMOSFET72が同時にオンして貫通電流が流れることがないように、両方オフの期間であるデッドタイムを設ける。制御信号”DCDC CTL”はパルス幅変調回路70の出力を制御するもので、”DCDC CTL”がHであればパルス幅変調回路70は上記のとおりの出力を行い、LであればPチャネルMOSFET71とNチャネルMOSFET72のゲートにそれぞれHおよびLを出力して2つのMOSFET7182をオフさせる。制御信号”SYNC/ASYNC CTL”はパルス幅変調回路70のNチャネルMOSFET72のゲートに対する出力を制御するもので、”SYNC/ASYNC CTL”がLであればパルス幅変調回路70は上記のとおりの出力を行い、HであればNチャネルMOSFET72のゲートにLを出力してNチャネルMOSFET72をオフさせる。ショットキーダイオード73は制御信号”SYNC/ASYNC CTL”によりNチャネルMOSFET72がオフされている場合に、PチャネルMOSFET71がオフしたときにインダクタ74に流れる電流を転流させるためのものである。インダクタ74およびコンデンサ75は、PチャネルMOSFET71とNチャネルMOSFET72の各ドレインおよびショットキーダイオード73のカソードとの共通接続点の電位を平滑してDC/DCコンバータ62としての出力を生成するためのフィルタである。図7に示される電源システムは、図示しない負荷への電流の大きさに基づき、これも図示しない制御回路が制御信号”LDO CTL”と”DCDC CTL”によりLDO61とDC/DCコンバータ62の切り換えを行なう。すなわち、負荷電流が小さいときは”LDO CTL”をH、”DCDC CTL”をLとしてPチャネルMOSFET68を動作状態、PチャネルMOSFET71とNチャネルMOSFET72をオフとする。また、負荷電流が大きいときは”LDO CTL”をL、”DCDC CTL”をHとしてPチャネルMOSFET68をオフ、PチャネルMOSFET71とNチャネルMOSFET72を動作状態とする。
共有となっている抵抗63,64を除き、シリーズレギュレータとスイッチングレギュレータという2つの異なる回路をそのまま準備する必要があり、回路規模が増大してしまうという問題がある。特に大容量のPチャネルMOSFETを68と71の2つ必要とするのはコストアップの大きな要因となる。
本発明は上記の点に鑑みてなされたものであり、その目的は、上記の課題を解決し、回路規模の増大を抑えてLDO(低ドロップアウトレギュレータ)などのシリーズレギュレータおよびスイッチングレギュレータを備えることができ、2つのレギュレータを負荷電流の大きさにより選択して切り換える電源供給装置を提供することにある。
そこで、上記課題を解決するために、請求項1に係る発明は、出力端子、直流電源の第1の電極と第2の電極間に直列接続されたPチャネルMOSFETおよびアノードが前記第2の電極側に接続されたダイオード、前記PチャネルMOSFETおよび前記ダイオードとの接続点と出力端子間に接続されたインダクタ、出力端子と前記第2の電極間に接続されたコンデンサ、出力端子と前記第2の電極間に直列接続されて互いの接続点の電位をフィードバック信号とする第1および第2の抵抗、基準電圧と前記フィードバック信号とから誤差信号を生成する誤差増幅器、前記誤差信号の大きさにより時比率が変化する方形波を生成するパルス幅変調回路、前記方形波が入力されてそのトライステート出力が前記PチャネルMOSFETのゲートに接続されるトライステートバッファ回路、前記第1の電極と第2の電極間に直列接続された第3の抵抗,第4の抵抗,第1のNチャネルMOSFETおよび第2のNチャネルMOSFETを有する電源供給装置であって、前記第3の抵抗と第4の抵抗の接続点から前記PチャネルMOSFETのゲートに結線がなされ、前記第2のNチャネルMOSFETのゲートには前記誤差信号が印加され、前記トライステートバッファ回路の制御端子および前記第1のNチャネルMOSFETのゲートにはスタンバイ信号が入力され、スタンバイ信号により前記トライステートバッファ回路の出力が高インピーダンスでかつ前記第1のNチャネルMOSFETが導通している状態および前記トライステートバッファ回路の出力が高インピーダンスではなくかつ前記第1のNチャネルMOSFETが遮断している状態とを切り換えることを特徴とする。
請求項3に係る発明は、出力端子、直流電源の第1の電極と第2の電極間に直列接続されたPチャネルMOSFETおよび第1のNチャネルMOSFET、該PチャネルMOSFETおよび第1のNチャネルMOSFETの接続点と出力端子間に接続されたインダクタ、出力端子と前記第2の電極間に接続されたコンデンサ、出力端子と前記第2の電極間に直列接続されて互いの接続点の電位をフィードバック信号とする第1および第2の抵抗、基準電圧と前記フィードバック信号とから誤差信号を生成する誤差増幅器、前記誤差信号の大きさにより時比率が変化する第1および第2の方形波を生成するパルス幅変調回路、それぞれ前記第1および第2の方形波が入力されてそのトライステート出力がそれぞれ前記PチャネルMOSFETおよび前記第1のNチャネルMOSFETのゲートに接続されるトライステートバッファ回路および出力信号固定用制御端子付バッファ回路、前記第1の電極と第2の電極間に順に直列接続された第3の抵抗,第4の抵抗,第2のNチャネルMOSFETおよび第3のNチャネルMOSFETを有する電源供給装置であって、前記第3の抵抗と第4の抵抗の接続点から前記PチャネルMOSFETのゲートに結線がなされ、前記第3のNチャネルMOSFETのゲートには前記誤差信号が印加され、前記トライステートバッファ回路および前記出力信号固定用制御端子付バッファ回路の制御端子および前記第2のNチャネルMOSFETのゲートにはスタンバイ信号が入力され、スタンバイ信号により前記トライステートバッファ回路の出力が高インピーダンスでかつ前記出力信号固定用制御端子付バッファ回路の出力がローレベルに固定されかつ前記第2のNチャネルMOSFETが導通している状態および前記トライステートバッファ回路の出力が高インピーダンスではなくかつ前記出力信号固定用制御端子付バッファ回路の出力がローレベルに固定されずかつ前記第2のNチャネルMOSFETが遮断している状態とを切り換えることを特徴とする。
PチャネルMOSFET5はそのソースが電源であるバッテリーBATに接続され、そのドレインがダイオード6のカソードに接続されていて、ダイオード6のアノードは接地電位(GND)に接続されている。PチャネルMOSFET5とダイオード6の接続部からインダクタ7を介して電源出力VOが出力される。電源出力VOとGNDの間にコンデンサ8および直列接続された抵抗9,10が並列に接続されている。抵抗9,10はその接続点において出力電圧を抵抗分割したフィードバック信号Vsを生成し、フィードバック信号Vsは誤差増幅器2にフィードバックされる。誤差増幅器2は演算増幅器16および位相補償回路17からなる。誤差増幅器2は基準電圧Vrefとフィードバック信号Vsの差を増幅してパルス幅変調回路3に入力する。パルス幅変調回路3は、周期は一定であるが1周期内のHとLの割合(デューティ)が誤差増幅器2の出力により変化する方形波パルスをトライステートバッファ回路4に出力する。トライステートバッファ回路4はNANDゲート18,インバータ19,NORゲート20,PチャネルMOSFET21およびNチャネルMOSFET22からなる。インバータ19にはスタンバイ信号”STANDBY SIG”が入力されその出力はNANDゲート18に入力される。NANDゲート18にはパルス幅変調回路3から出力される方形波パルスおよびインバータ19の出力が入力されその出力はPチャネルMOSFET21のゲートに接続される。NORゲート20にはパルス幅変調回路3から出力される方形波パルスおよびスタンバイ信号”STANDBY SIG”が入力されその出力はNチャネルMOSFET22のゲートに接続される。PチャネルMOSFET21とNチャネルMOSFET22は電源であるバッテリーBATおよびGND間に直列に接続され、その接続部の電位はトライステートバッファ回路4の出力としてPチャネルMOSFET5のゲートに入力されている。トライステートバッファ回路4は、スタンバイ信号”STANDBY SIG”がL(ローレベル)のときパルス幅変調回路3より入力される方形波パルスをそのまま出力し、スタンバイ信号”STANDBY SIG”がH(ハイレベル)のとき出力がハイインピーダンスとなるという動作を行なう。抵抗11,12およびNチャネルMOSFET13,14はBATおよびGND間に直列に接続されていて、抵抗11,12の接続部はPチャネルMOSFET5のゲートにも接続されている。NチャネルMOSFET13のゲートにはスタンバイ信号”STANDBY SIG”が、NチャネルMOSFET14のゲートには誤差増幅器2の出力がそれぞれ入力されている。なお、NチャネルMOSFET13とNチャネルMOSFET14のゲートへの入力は入れ替えてもよい。
スタンバイ信号”STANDBY SIG”がHの場合はトライステートバッファ回路4の出力がハイインピーダンスとなるので、本実施例は基準電圧1(Vref),誤差増幅器2,PチャネルMOSFET5,ダイオード6,インダクタ7,コンデンサ8,抵抗9,10,11,12,およびNチャネルMOSFET13,14からなるシリーズレギュレータを構成する。誤差増幅器2,抵抗11,12,およびNチャネルMOSFET13,14からなる回路部分が図7に示す従来例のLDO61における差動増幅器67に相当する(但し、制御信号”LDO CTL”はない)。抵抗11,12,およびNチャネルMOSFET13,14からなる回路が誤差増幅器2の出力の位相を反転させるものになっているため、誤差増幅器2の正反入力が差動増幅器67の正反入力と逆になっている。このシリーズレギュレータは、PチャネルMOSFET5のドレインと出力(VO)の間にインダクタ7とコンデンサ8からなるローパスフィルタが挿入されているものになっている。このローパスフィルタは通常のシリーズレギュレータにはないものであり、ローパスフィルタということから高速応答、すなわち負荷が大きく変動した時の対応に制限を与えうるものであるが、本実施例では問題ない。すなわち、本実施例は負荷が軽いもしくは実質的に無負荷と見なせる状態でスタンバイ信号”STANDBY SIG”をHにしてシリーズレギュレータを構成させるものであり、基本的に負荷電流が小さく、そこで負荷電流が変動したとしてもその影響は無視できるから、ローパスフィルタが存在することに問題はない。
スタンバイ信号”STANDBY SIG”がLの場合、PチャネルMOSFET5およびNチャネルMOSFET26のゲートにはパルス幅変調回路3aより出力される方形波パルスがそのまま印加され、NチャネルMOSFET13がオフされることにより、同期型スイッチングレギュレータが構成される。また、トランスミッションゲート23がオンし、トランスミッションゲート24がオフすることにより位相補償回路17aが演算増幅器16に適用される。
2 誤差増幅器
3,3a パルス幅変調回路
4 トライステートバッファ回路
5,21 PチャネルMOSFET
6 ダイオード
7 インダクタ
8 コンデンサ
9,10,11,12 抵抗
13,14,22,26 NチャネルMOSFET
15 電源出力VO用端子
16 演算増幅器
17,17a,17b 位相補償回路
18 NANDゲート
19,25,28 インバータ
20,29 NORゲート
23,24 トランスミッションゲート
27 出力信号固定用制御端子付バッファ回路
Claims (5)
- 出力端子、直流電源の第1の電極と第2の電極間に直列接続されたPチャネルMOSFETおよびアノードが前記第2の電極側に接続されたダイオード、前記PチャネルMOSFETおよび前記ダイオードとの接続点と出力端子間に接続されたインダクタ、出力端子と前記第2の電極間に接続されたコンデンサ、出力端子と前記第2の電極間に直列接続されて互いの接続点の電位をフィードバック信号とする第1および第2の抵抗、基準電圧と前記フィードバック信号とから誤差信号を生成する誤差増幅器、前記誤差信号の大きさにより時比率が変化する方形波を生成するパルス幅変調回路、前記方形波が入力されてそのトライステート出力が前記PチャネルMOSFETのゲートに接続されるトライステートバッファ回路、前記第1の電極と第2の電極間に直列接続された第3の抵抗,第4の抵抗,第1のNチャネルMOSFETおよび第2のNチャネルMOSFETを有し、前記第3の抵抗と第4の抵抗の接続点から前記PチャネルMOSFETのゲートに結線がなされ、前記第2のNチャネルMOSFETのゲートには前記誤差信号が印加され、前記トライステートバッファ回路の制御端子および前記第1のNチャネルMOSFETのゲートにはスタンバイ信号が入力され、スタンバイ信号により前記トライステートバッファ回路の出力が高インピーダンスでかつ前記第1のNチャネルMOSFETが導通している状態および前記トライステートバッファ回路の出力が高インピーダンスではなくかつ前記第1のNチャネルMOSFETが遮断している状態とを切り換えることを特徴とする電源供給装置。
- 請求項1に記載の電源供給装置において、前記第1のNチャネルMOSFETおよび前記第2のNチャネルMOSFETの接続順序が入れ替わっていることを特徴とする電源供給装置。
- 出力端子、直流電源の第1の電極と第2の電極間に直列接続されたPチャネルMOSFETおよび第1のNチャネルMOSFET、該PチャネルMOSFETおよび第1のNチャネルMOSFETの接続点と出力端子間に接続されたインダクタ、出力端子と前記第2の電極間に接続されたコンデンサ、出力端子と前記第2の電極間に直列接続されて互いの接続点の電位をフィードバック信号とする第1および第2の抵抗、基準電圧と前記フィードバック信号とから誤差信号を生成する誤差増幅器、前記誤差信号の大きさにより時比率が変化する第1および第2の方形波を生成するパルス幅変調回路、それぞれ前記第1および第2の方形波が入力されてそのトライステート出力がそれぞれ前記PチャネルMOSFETおよび前記第1のNチャネルMOSFETのゲートに接続されるトライステートバッファ回路および出力信号固定用制御端子付バッファ回路、前記第1の電極と第2の電極間に順に直列接続された第3の抵抗,第4の抵抗,第2のNチャネルMOSFETおよび第3のNチャネルMOSFETを有し、前記第3の抵抗と第4の抵抗の接続点から前記PチャネルMOSFETのゲートに結線がなされ、前記第3のNチャネルMOSFETのゲートには前記誤差信号が印加され、前記トライステートバッファ回路および前記出力信号固定用制御端子付バッファ回路の制御端子および前記第2のNチャネルMOSFETのゲートにはスタンバイ信号が入力され、スタンバイ信号により前記トライステートバッファ回路の出力が高インピーダンスでかつ前記出力信号固定用制御端子付バッファ回路の出力がローレベルに固定されかつ前記第2のNチャネルMOSFETが導通している状態および前記トライステートバッファ回路の出力が高インピーダンスではなくかつ前記出力信号固定用制御端子付バッファ回路の出力がローレベルに固定されずかつ前記第2のNチャネルMOSFETが遮断している状態とを切り換えることを特徴とする電源供給装置。
- 請求項3に記載の電源供給装置において、前記第2のNチャネルMOSFETおよび前記第3のNチャネルMOSFETの接続順序が入れ替わっていることを特徴とする電源供給装置。
- 第1の位相補償回路または第2の位相補償回路を前記スタンバイ信号により切り換えて前記誤差増幅器に適用することを特徴とする請求項1ないし4のいずれかに記載の電源供給装置。
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