JP2005129917A - Semiconductor device and its manufacturing method - Google Patents
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Abstract
Description
本発明は、柔軟性を有するフィルム状の基板上に半導体素子を実装した半導体装置及びその製造方法に関する。 The present invention relates to a semiconductor device in which a semiconductor element is mounted on a flexible film-like substrate and a method for manufacturing the same.
携帯電話やデジタルカメラに用いられるフィルム状の基板であるフィルム基板には、半導体素子が実装されて樹脂でモールドされている。半導体素子をフィルム基板に実装する方法としては、TAB(Tape Automated Bonding)方式が知られている。 TAB方式においては、フィルム基板に素子を実装するための孔を形成し、そのフィルム基板の表面に金属箔をラミネートし、その金属箔をエッチングすることにより前記孔の内部に突出する複数のフィンガーリードを形成している。これらのフィンガーリードに対して半導体素子のバンプ電極を溶着して、半導体素子がフィルム基板に実装されている。 A semiconductor element is mounted on a film substrate, which is a film substrate used for a mobile phone or a digital camera, and is molded with resin. As a method for mounting a semiconductor element on a film substrate, a TAB (Tape Automated Bonding) method is known. In the TAB method, a plurality of finger leads projecting into the holes are formed by forming holes for mounting elements on the film substrate, laminating a metal foil on the surface of the film substrate, and etching the metal foil. Is forming. The bump electrodes of the semiconductor element are welded to these finger leads, and the semiconductor element is mounted on the film substrate.
上記のような構成の従来の半導体装置において、半導体素子のバンプ電極をフィルム基板のフィンガーリードに溶着するとき、フィンガーリードが半導体素子のコーナーに接触して傷付けられたり、場合によっては短絡するという問題があった。このような問題を解決するため、半導体素子に絶縁膜を設けたものがあった。図20は特許文献1に開示された半導体装置の断面図である。図20に示す半導体装置は、TAB方式により半導体素子101がフィルム基板103に実装された状態を示している。この半導体装置は、フィルム基板103に形成された孔100の内部に突出したフィンガーリード104に半導体素子101のバンプ電極105が熱圧着により固着されている。半導体素子101のバンプ電極側に形成されている絶縁膜102は、半導体素子101を形成するための半導体ウェハーに絶縁樹脂をスピンコーティングにより塗布し、乾燥して形成されている。このとき、半導体ウェハーに形成されているバンプ電極105は絶縁膜102により覆われているため、絶縁膜102の全表面がハーフエッチングされる。この結果、絶縁膜102の膜厚の中間位置まで除去されて、バンプ電極105は絶縁膜102の上方に突出する。このときの絶縁膜102の膜厚はバンプ電極の80〜90%に設定されている。このように絶縁層102が形成された半導体ウェハーにはエッチングにより切断用の溝が形成される。この溝に沿って半導体ウェハーが切断されて、個々の半導体素子101が作成される。
In the conventional semiconductor device having the above-described configuration, when the bump electrode of the semiconductor element is welded to the finger lead of the film substrate, the finger lead contacts the corner of the semiconductor element and is damaged or sometimes short-circuited. was there. In order to solve such a problem, some semiconductor elements are provided with an insulating film. FIG. 20 is a cross-sectional view of the semiconductor device disclosed in
上記のように半導体素子101のバンプ電極側に絶縁膜102が形成されているため、バンプ電極105にフィンガーリード104を溶着するとき、フィンガーリード104が半導体素子101の端部に直接接触して短絡することが防止されている。このように半導体素子101がフィルム基板103に実装された後、バンプ電極105とフィンガーリード104の接合部分が樹脂106によりモールディングされる。
図20に示す従来の半導体装置においては、フィルム基板103に半導体素子101を実装するための孔100が形成されており、この孔100に樹脂106が充填されてモールディングされている。しかし、最近の半導体装置においては、半導体素子101を実装するための孔100がフィルム基板103に形成されておらず、フィルム基板上に形成された電極に半導体素子101のバンプ電極104を直接接続する構成のものもある。このような構成の半導体装置は、フィルム基板上に形成された電極に半導体素子101のバンプ電極105を配置して、熱圧着により電極とバンプ電極104とを接続している。このように構成された半導体素子101とフィルム基板103との間に樹脂を充填して半導体装置が製造されている。
In the conventional semiconductor device shown in FIG. 20, a
上記のように、半導体素子101とフィルム基板103との間に樹脂を充填して半導体装置を製造する場合、モールディングの樹脂が半導体素子とフィルム基板との間の空間に空洞や気泡等を有することなく隈なく充填される必要がある。もし、樹脂内部に空洞や気泡等が存在した場合には、長期の使用時における腐食、破損、断線等の原因となる。
As described above, when a semiconductor device is manufactured by filling a resin between the
しかし、従来の半導体装置においては、半導体素子101とフィルム基板103との間に、例えば実装時の短絡等を防止するために絶縁膜を形成した場合、半導体素子101の絶縁膜102とフィルム基板103との間にはわずかな隙間しかなく、この隙間に気泡が全く無い状態で樹脂を隈なく充填することは困難であった。特に、電極間ピッチが細くなり、充填スペ−スが狭くなるにつれて、このようなスペースに樹脂を充填する場合には、樹脂内に空洞や気泡が生じるおそれが多分にあった。
However, in the conventional semiconductor device, when an insulating film is formed between the
本発明は、従来の構成における問題点に鑑みてなされたものであり、フィルム基板上に形成された電極と半導体素子の端部が実装時に接触することを確実に防止することができるとともに、フィルム基板上に実装された半導体素子に対して樹脂のモールディングを確実に、且つ高精度に行うことができる構成を有する半導体装置及びその製造方法を提供することを目的とする。 The present invention has been made in view of the problems in the conventional configuration, and can reliably prevent an electrode formed on a film substrate and an end of a semiconductor element from contacting each other during mounting, and a film. It is an object of the present invention to provide a semiconductor device having a configuration capable of reliably and highly accurately molding a resin on a semiconductor element mounted on a substrate and a manufacturing method thereof.
本発明の半導体装置は、柔軟な樹脂材で形成されたフィルム基板、
前記フィルム基板の少なくとも一方の面に形成され、金属膜の電極パターンで構成された電極、
前記電極に接続されたバンプ電極を有する半導体素子、
前記半導体素子における前記電極と対向する面に形成され、前記半導体素子と前記電極との直接接触を防止する絶縁保護部、及び
前記半導体素子と前記フィルム基板との間の空間内に少なくとも形成され、前記電極と前記バンプ電極とを封止する封止部、を具備するよう構成されている。このように構成された発明は、フィルム基板上に形成された電極と半導体素子の端部が実装時に接触することが確実に防止されており、そしてフィルム基板上に実装された半導体素子に対して樹脂のモールディングを確実に、且つ高精度に行うことができるため、信頼性の高い半導体装置を提供することができる。
The semiconductor device of the present invention is a film substrate formed of a flexible resin material,
An electrode formed on at least one surface of the film substrate and configured with an electrode pattern of a metal film,
A semiconductor element having a bump electrode connected to the electrode;
Formed on a surface of the semiconductor element facing the electrode, and is formed at least in a space between the semiconductor element and the film substrate, and an insulating protection part for preventing direct contact between the semiconductor element and the electrode; A sealing part for sealing the electrode and the bump electrode is provided. In the invention configured as described above, the electrode formed on the film substrate and the end of the semiconductor element are reliably prevented from contacting during mounting, and the semiconductor element mounted on the film substrate is prevented. Since resin molding can be performed reliably and with high accuracy, a highly reliable semiconductor device can be provided.
他の観点の発明の半導体装置は、柔軟な樹脂材で形成されたフィルム基板、
前記フィルム基板の少なくとも一方の面に形成され、金属膜の電極パターンで構成された電極、
前記電極に接続されたバンプ電極を有し、前記電極と対向する面における外縁部分のコーナが鈍角により形成された半導体素子、及び
前記半導体素子と前記フィルム基板との間に形成され、前記電極と前記バンプ電極とを封止する封止部、を具備するよう構成されている。この発明の半導体装置は、フィルム基板上に形成された電極と半導体素子の端部が実装時に接触することが確実に防止されており、且つフィルム基板上に実装された半導体素子に対して樹脂のモールディングを確実に、高精度に行うことができるため、信頼性の高い装置となる。
なお、本発明の半導体装置においては、前記半導体素子の上に柔軟な電磁シールドの効果を有する材料で形成されたシートカバーを密着して設けることにより、信頼性の高い半導体装置を容易に製造することができる。
A semiconductor device according to another aspect of the invention is a film substrate formed of a flexible resin material,
An electrode formed on at least one surface of the film substrate and configured with an electrode pattern of a metal film,
A semiconductor device having a bump electrode connected to the electrode, wherein a corner of an outer edge portion on a surface facing the electrode is formed at an obtuse angle, and formed between the semiconductor device and the film substrate; and And a sealing portion for sealing the bump electrode. In the semiconductor device according to the present invention, the electrode formed on the film substrate and the end of the semiconductor element are reliably prevented from coming into contact with each other, and the resin of the semiconductor element mounted on the film substrate is prevented. Since molding can be performed reliably and with high accuracy, the device is highly reliable.
In the semiconductor device of the present invention, a highly reliable semiconductor device is easily manufactured by providing a sheet cover made of a material having a flexible electromagnetic shielding effect on the semiconductor element. be able to.
本発明の半導体装置の製造方法は、半導体素子におけるバンプ電極を有する面にレジストを塗布する工程、
前記半導体素子の所望領域をマスキングして紫外線を照射し、現像、洗浄、そして硬化の各処理を順次行い、絶縁保護部を形成する工程、
前記半導体素子が電極を有するフィルム基板上の所望の位置に配置され、加圧加熱により前記バンプ電極と前記電極とを接続する工程、及び
前記半導体素子と前記フィルム基板との間に樹脂を注入して封止部を形成する工程、を有する。この発明の製造方法により、フィルム基板上に形成された電極と半導体素子の端部が実装時に接触することを確実に防止することができるとともに、フィルム基板上に実装された半導体素子に対して樹脂のモールディングを確実に、且つ高精度に行うことができる。
The method for manufacturing a semiconductor device of the present invention includes a step of applying a resist to a surface having a bump electrode in a semiconductor element,
Masking a desired region of the semiconductor element, irradiating with ultraviolet rays, sequentially performing development, cleaning, and curing processes to form an insulating protection portion;
The semiconductor element is disposed at a desired position on the film substrate having an electrode, and a step of connecting the bump electrode and the electrode by pressure heating, and injecting a resin between the semiconductor element and the film substrate Forming a sealing portion. According to the manufacturing method of the present invention, the electrode formed on the film substrate and the end portion of the semiconductor element can be reliably prevented from contacting each other during mounting, and the resin with respect to the semiconductor element mounted on the film substrate can be prevented. Can be reliably and accurately performed.
他の観点の発明の半導体装置の製造方法は、半導体素子におけるバンプ電極を有する面の所望の位置に樹脂を塗布する工程、
前記半導体素子の所望の位置に塗布された樹脂を加熱処理して絶縁保護部を形成する工程、
前記半導体素子が電極を有するフィルム基板上の所望の位置に配置され、加圧加熱により前記バンプ電極と前記電極とを接続する工程、
前記半導体素子と前記フィルム基板との間に樹脂を注入して封止部を形成する工程、を有する。この発明の製造方法により、フィルム基板上に形成された電極と半導体素子の端部が実装時に接触することを確実に防止することができるとともに、フィルム基板上に実装された半導体素子に対して樹脂のモールディングを確実に、且つ高精度に行うことができる。
発明の新規な特徴は添付の請求の範囲に特に記載したものに他ならないが、構成及び内容の双方に関して本発明は、他の目的や特徴と合わせて図面と共に以下の詳細な説明を読むことにより、より良く理解され評価されるであろう。
According to another aspect of the invention, there is provided a method for manufacturing a semiconductor device, comprising: applying a resin to a desired position on a surface having a bump electrode in a semiconductor element;
A step of heat-treating a resin applied to a desired position of the semiconductor element to form an insulation protection portion;
The semiconductor element is disposed at a desired position on the film substrate having an electrode, and the bump electrode and the electrode are connected by pressure heating,
And a step of injecting a resin between the semiconductor element and the film substrate to form a sealing portion. According to the manufacturing method of the present invention, the electrode formed on the film substrate and the end portion of the semiconductor element can be reliably prevented from contacting each other at the time of mounting, and the resin is applied to the semiconductor element mounted on the film substrate. Can be reliably and accurately performed.
The novel features of the invention are nonetheless specifically set forth in the appended claims, but the invention, both in terms of structure and content, should be read in conjunction with the drawings and in the following detailed description in conjunction with the drawings. Will be better understood and appreciated.
本発明によれば、フィルム基板上に形成された電極と半導体素子の端部が実装時に接触することを確実に防止することができるとともに、フィルム基板上に実装された半導体素子に対して樹脂のモールディングを確実に、且つ高精度に行うことができる。また、本発明は、高密度実装基板に対しても適用できる汎用性の高い半導体装置及び半導体装置の製造方法を提供することができる。 ADVANTAGE OF THE INVENTION According to this invention, while being able to prevent reliably the electrode formed on the film board | substrate and the edge part of a semiconductor element contacting at the time of mounting, resin of the semiconductor element mounted on the film board | substrate is made. Molding can be performed reliably and with high accuracy. In addition, the present invention can provide a highly versatile semiconductor device that can be applied to a high-density mounting substrate and a method for manufacturing the semiconductor device.
以下、本発明に係る半導体装置及び半導体装置の製造方法の好適な実施の形態を添付の図面を参照しつつ説明する。 DESCRIPTION OF EXEMPLARY EMBODIMENTS Hereinafter, preferred embodiments of a semiconductor device and a method for manufacturing a semiconductor device according to the invention will be described with reference to the accompanying drawings.
《実施の形態1》
図1は本発明に係る実施の形態1の半導体装置の構成を示す断面図である。
実施の形態1において、フィルム基板1はその表面に電極3を有するフィルム状の柔軟な樹脂材で形成された基板である。半導体素子2Aは半導体ウェハーから切り出された半導体チップである。電極3は、フィルム基板1上に形成された金属膜の電極パターンであり、パターンエッチングにより形成されている。半導体素子2Aの背面に形成されているバンプ電極4は、半導体ウェハーから半導体チップを切り出す前に、メッキ法により作製されたものであり、突起状の金(Au)である。半導体素子2Aの各端子はフィルム基板1の金(Au)メッキの施された電極に溶着され、接続されている。なお、バンプ電極4は所望の厚みを有するよう金(Au)スタッドバンプにより形成することも可能である。
図1に示すように、実施の形態1の半導体装置は、フィルム基板1上に形成された電極3に半導体素子2Aのバンプ電極4が接続されている。半導体素子2Aとフィルム基板1との間にはエポキシ系の樹脂である封止部6がモールディングされて、フィルム基板1上の電極3と半導体素子2Aのバンプ電極4との接合部分が確実に封止されている。
FIG. 1 is a cross-sectional view showing the configuration of the semiconductor device according to the first embodiment of the present invention.
In
As shown in FIG. 1, in the semiconductor device of the first embodiment,
実施の形態1における半導体素子2Aにおいて、そのバンプ電極4が形成されている背面の端部には絶縁樹脂で構成された絶縁保護部5Aが形成されている。この絶縁保護部5Aは、半導体素子2Aがフィルム基板1上に実装されるときや、モールディング工程において半導体素子2Aの端部が電極部分に直接接触することを防止するものである。
なお、フィルム基板1としては、例えばポリイミドフィルムで形成された厚みが0.01mmから0.2mmの範囲内の柔軟なシートが用いられる。このようなシート以外でも、一般的な基板として使用されるフィルム基板なら良い。封止部6を形成する樹脂としては、フェノ−ル系、又はアクリル系樹脂を用いても良い。これ以外の樹脂でも電気的絶縁性があれば良い。
In the
As the
図2は実施の形態1における半導体素子2Aのバンプ電極4が形成された面を示す背面図である。図2に示すように、実施の形態1における半導体素子2Aにおいて、複数のバンプ電極4が形成された面の外縁部分には絶縁保護部5Aが形成されている。
次に、図2に示した半導体素子2Aにおける絶縁保護部5Aの製造方法について説明する。
図3は実施の形態1の半導体装置における半導体素子2Aの製造方法を説明する図である。図4は実施の形態1の半導体装置の製造工程におけるモールディング工程を示す図である。
FIG. 2 is a rear view showing the surface on which the
Next, a method for manufacturing the
FIG. 3 is a diagram illustrating a method of manufacturing the
図3の(A)は半導体チップである半導体素子2A上に複数のバンプ電極4が形成されている状態を示す。
図3の(B)は図3の(A)の半導体素子2Aにポジ型のレジスト5aをスピンコーティングにより塗布した状態を示す。実施の形態1においては、ポジ型のレジスト5aとしてアクリル系の紫外線硬化型樹脂を用いた。なお、レジスト5aの塗布方法としては、スピンコーティングに限定されるものではなく、一般的に用いられるスプレー法などの塗布方法が利用できる。
FIG. 3A shows a state in which a plurality of
FIG. 3B shows a state in which a positive resist 5a is applied to the
次に、図3の(C)に示すように、半導体素子2Aの端部をマスキングして紫外線が照射され、現像、洗浄、そして硬化処理が施される。その結果、図3の(D)に示すように、半導体素子2Aにおいて、バンプ電極4が形成されている部分のレジスト5aは除去され、バンプ電極4が形成されている面(背面)における端部のみに絶縁樹脂で形成された絶縁保護部5Aが作製される。この絶縁保護部5Aは、厚みが1〜5μmの範囲内となるよう形成される。このように形成された半導体素子2Aは、フィルム基板1上の所望の位置に配置される。そして、電極3上に半導体素子2Aのバンプ電極4が位置決めされ、加圧加熱することにより、バンプ電極4が溶けて電極3に接続される。
Next, as shown in FIG. 3C, the edge of the
実施の形態1においては、半導体素子2Aの背面にある絶縁保護部5Aの表面からフィルム基板1の表面までのギャップは少なくとも10μm以上、好ましくは10〜15μmの範囲内の数値である。このように半導体素子2Aとフィルム基板1との間に所望のギャップを有しているため、図4に示すモールディング工程において、半導体素子2Aとフィルム基板1との間に樹脂をスムーズに注入することができ、信頼性の高い封止部6を確実に形成することができる。また、このモールディング工程においても、半導体素子2Aの端部(コーナー)がフィルム基板1上の電極3に接触しても、その端部が絶縁保護部5Aにより被覆されているため電極3が傷付けられることがない。
In the first embodiment, the gap from the surface of the
なお、実施の形態1においては、フィルム基板1の片面にのみ半導体素子2Aを実装する例で説明したが、フィルム基板1の両面に半導体素子を実装した場合でも、実施の形態1における構成が適用できる。フィルム基板1の両面に半導体素子が実装される場合には、製造時の半導体装置を固定するためのステージの構造を変更する必要がある。この場合、フィルム基板上の半導体素子に対応する部分に掘りこみ部を形成する必要がある。
In the first embodiment, the example in which the
《実施の形態2》
以下、本発明に係る実施の形態2の半導体装置について説明する。実施の形態2の半導体装置において、前述の実施の形態1の半導体装置と異なる点は、半導体素子に形成される絶縁保護部の形状及びその製造方法である。実施の形態2の半導体装置においては、膜形状ではなく、略半球状の絶縁保護部が形成されている。実施の形態2の説明においては、実施の形態1と同じ機能、構成を有するものには同じ符号を付して、それらの詳細な説明は実施の形態1の説明を適用する。
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The semiconductor device according to the second embodiment of the present invention will be described below. The semiconductor device according to the second embodiment is different from the semiconductor device according to the first embodiment in the shape of the insulating protection portion formed in the semiconductor element and the manufacturing method thereof. In the semiconductor device of the second embodiment, a substantially hemispherical insulating protection part is formed instead of a film shape. In the description of the second embodiment, components having the same functions and configurations as those of the first embodiment are denoted by the same reference numerals, and the description of the first embodiment is applied to the detailed description thereof.
実施の形態2の半導体装置は、実施の形態1と同様に、フィルム基板1上に形成された電極3に半導体素子2Bのバンプ電極4が接続されている(図1参照)。半導体素子2Bとフィルム基板1との間にはエポキシ系の樹脂の封止部6がモールディングされて、フィルム基板1上の電極3と半導体素子2Bのバンプ電極4との接合部分が確実に封止されている。
In the semiconductor device of the second embodiment, the
実施の形態2における半導体素子2Bにおいて、複数のバンプ電極4が形成されている背面には絶縁樹脂で構成された複数の絶縁保護部5Bが形成されている。この絶縁保護部5Bは、半導体素子2Bがフィルム基板1上に実装されるときやモールディング工程において、半導体素子2Bの端部が電極部分に直接接触することを防止するものである。
In the
図5は実施の形態2における半導体素子2Bのバンプ電極4が形成された四角形状の背面を示している。図5に示すように、実施の形態2における半導体素子2Bにおいて、複数のバンプ電極4が形成された背面の四隅には絶縁保護部5Bが形成されている。
次に、図5に示した半導体素子2Bにおける絶縁保護部5Bの製造方法について説明する。図6は実施の形態2の半導体装置における半導体素子2Bの製造方法を説明する図である。
FIG. 5 shows a quadrangular back surface on which the
Next, a method for manufacturing the
図6の(A)は半導体チップである半導体素子2B上に複数のバンプ電極4が形成されている状態を示す。
図6の(B)は図6の(A)の半導体素子2Bにエポキシ系の絶縁樹脂をディスペンサー10により塗布する工程を示す。なお、絶縁樹脂はゴム系の樹脂でも良い。例えば、スチレンゴム系などの弾性材料である。エポキシ系の絶縁樹脂をディスペンサー10により塗布する工程において、半導体素子2Bがステージ上にセットされる。このステージには、半導体素子2Bを固定するための吸引孔が設けられており、フィルム基板1が吸引されて半導体素子2Bがステージ上に固定される。固定された半導体素子2Bに対して、ディスペンサー10により半導体素子2の背面の所望の位置に絶縁樹脂が塗布される。このとき塗布される絶縁樹脂が半導体素子2Bの側面を流れてステージを汚すことがないよう、ステージの載置面が半導体素子2Bと同じ大きさ、若しくは半導体素子2Bより小さなステージを用いると良い。
FIG. 6A shows a state in which a plurality of
6B shows a process of applying an epoxy-based insulating resin to the
次に、図6の(C)に示す樹脂硬化工程において、半導体素子2Bは加熱されているステージ上に配置され、例えば150〜200℃で約5分間、加熱される。このように加熱処理された半導体素子2Bの端部には略半球状の絶縁保護部5Bが形成される。この絶縁保護部5Bは、厚みが5〜30μmの範囲内となるよう形成される。このように形成された半導体素子2Bは、フィルム基板1上の所望の位置に配置される。そして、半導体素子2Bのバンプ電極4が電極3上に位置決めされ、加圧加熱することにより、バンプ電極4が溶けて電極3に接続される。この電極3とバンプ電極4との接続工程において、半導体素子2Bの端部(コーナー)がフィルム基板1上の電極3に直接に接触することがなく、電極3が傷付けられたり、破損することが防止されている。
Next, in the resin curing step shown in FIG. 6C, the
実施の形態2においては、絶縁保護部5Bが半導体素子2Bの背面における四隅にのみ形成されているため、モールディング工程において、半導体素子2Bとフィルム基板1との間に樹脂を容易に注入することができる。この結果、半導体素子2Bとフィルム基板1との間の隙間に空洞や気泡のない封止部6を確実に形成することができる。また、このモールディング工程において、半導体素子2Bの端部がフィルム基板1上の電極3に接触することが防止されている。実施の形態2における絶縁保護部5Bは、弾性変形する樹脂により形成されているため、半導体素子2Bにおけるバンプ電極4が形成された面からフィルム基板1の表面までの距離を所望の値、例えば少なくとも10μm以上、好ましくは10〜15μm範囲内の所望の値となるよう容易に設定することができる。このように実施の形態2における半導体素子2Bは、フィルム基板1との間に所望のギャップを有しており、且つ絶縁保護部5Bが樹脂注入を阻害する位置に形成されていないため、モールディング工程において、半導体素子2Bとフィルム基板1との間に樹脂を容易に、かつ確実に注入することが可能となる。
In the second embodiment, since the insulating
《実施の形態3》
以下、本発明に係る実施の形態3の半導体装置について説明する。実施の形態3の半導体装置において、前述の実施の形態1の半導体装置と異なる点は、半導体素子に形成される絶縁保護部の形状及びその製造方法である。実施の形態3の説明においては、実施の形態1と同じ機能、構成を有するものには同じ符号を付して、それらの詳細な説明は実施の形態1の説明を適用する。
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The semiconductor device according to the third embodiment of the present invention will be described below. The semiconductor device according to the third embodiment is different from the semiconductor device according to the first embodiment in the shape of the insulating protection portion formed in the semiconductor element and the manufacturing method thereof. In the description of the third embodiment, components having the same functions and configurations as those of the first embodiment are denoted by the same reference numerals, and the description of the first embodiment is applied to the detailed description thereof.
実施の形態3の半導体装置は、実施の形態1と同様に、フィルム基板1上に形成された電極3に半導体素子2Cのバンプ電極4が接続されている。半導体素子2Cとフィルム基板1との間にはエポキシ系の樹脂の封止部6がモールディングされて、フィルム基板1上の電極3と半導体素子2Cのバンプ電極4との接合部分が確実に封止されている。
In the semiconductor device according to the third embodiment, the
実施の形態3における半導体素子2Cにおいて、複数のバンプ電極4が形成されている背面には絶縁樹脂で構成された複数の絶縁保護部5Cが形成されている。この絶縁保護部5Cは、半導体素子2Cがフィルム基板1上に実装されるときや、モールディング工程において、半導体素子2Cの端部が電極部分に直接接触することを防止するものである。
In the
図7は実施の形態3における半導体素子2Cのバンプ電極4が形成された四角形状の背面を示している。図7に示すように、実施の形態3における半導体素子2Cにおいて、複数のバンプ電極4が形成された背面の端部(コーナー)に4つの絶縁保護部5Cが形成されている。
次に、図7に示した半導体素子2Cにおける絶縁保護部5Cの製造方法について説明する。図8は実施の形態3の半導体装置における半導体素子2Cの製造方法を説明する図である。
図8の(A)は半導体チップである半導体素子2C上に複数のバンプ電極4が形成されている状態を示す。
図8の(B)は図8の(A)の半導体素子2Cにエポキシ系の絶縁樹脂をディスペンサー10により半導体素子2Cの端部に塗布する工程を示す。なお、絶縁樹脂はゴム系の樹脂でも良く、例えばスチレン系樹脂などである。
FIG. 7 shows a quadrangular back surface on which the
Next, a method for manufacturing the insulating
FIG. 8A shows a state in which a plurality of
FIG. 8B shows a step of applying an epoxy-based insulating resin to the end portion of the
次に、図8の(C)に示す樹脂硬化工程において、加熱されているステージ上に配置され、例えば150〜200℃で約5分間、加熱される。このように加熱処理された半導体素子2Cの背面には、端部に略半球状の絶縁保護部5Cが4箇所形成される。この絶縁保護部5Cは、厚みが5〜30μmの範囲内で、四角い背面の各辺の略中間位置に1箇所形成されている。このように形成された半導体素子2Cは、フィルム基板1上の所望の位置に配置される。そして、半導体素子2Cのバンプ電極4が電極3上に位置決めされ、加圧加熱することにより、バンプ電極4が溶けて電極3に接続される。この電極3とバンプ電極4との接続工程において、半導体素子2Cの端部(コーナー)がフィルム基板1上の電極3に直接に接触することがなく、電極3が傷付けられたり、破損することが防止されている。なお、実施の形態3においては、絶縁保護部5Cが半導体素子2Cの背面における各辺に1箇所だけ設けた例で説明したが、半導体素子の形状に応じて複数箇所に設けても良い。
Next, in the resin curing step shown in FIG. 8C, the resin is placed on a heated stage and heated at, for example, 150 to 200 ° C. for about 5 minutes. Four substantially hemispherical insulating
実施の形態3においては、絶縁保護部5Cが半導体素子2Cの背面における必要最小個数にのみ形成されているため、モールディング工程において、半導体素子2Cとフィルム基板1との間に樹脂を容易に注入することができる。この結果、半導体素子2Cとフィルム基板1との間の隙間に空洞や気泡のない封止部6を確実に形成することができる。また、このモールディング工程においても、半導体素子2Cの端部がフィルム基板1上の電極3に接触することが防止されている。実施の形態3における絶縁保護部5Cは、弾性変形する樹脂により形成されているため、半導体素子2Cにおけるバンプ電極4が形成された面からフィルム基板1の表面までの距離を所望の距離、例えば少なくとも10μm以上、好ましくは10〜15μmの範囲内の所望の値となるよう容易に設定することができる。このように実施の形態3における半導体素子2Cは、フィルム基板1との間に所望のギャップを有しており、且つ絶縁保護部5Cが樹脂注入を阻害するような位置に形成されていないため、モールディング工程において、半導体素子2Cとフィルム基板1との間に樹脂を容易に、かつ確実に注入することが可能となる。
In the third embodiment, since the insulating
《実施の形態4》
以下、本発明に係る実施の形態4の半導体装置について説明する。実施の形態4の半導体装置において、前述の実施の形態1の半導体装置と異なる点は、半導体素子に形成される絶縁保護部の形状及びその製造方法である。実施の形態4の説明においては、実施の形態1と同じ機能、構成を有するものには同じ符号を付して、それらの詳細な説明は実施の形態1の説明を適用する。
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The semiconductor device according to the fourth embodiment of the present invention will be described below. The semiconductor device according to the fourth embodiment is different from the semiconductor device according to the first embodiment in the shape of the insulating protection portion formed in the semiconductor element and the manufacturing method thereof. In the description of the fourth embodiment, components having the same functions and configurations as those of the first embodiment are denoted by the same reference numerals, and the description of the first embodiment is applied to the detailed description thereof.
実施の形態4の半導体装置は、実施の形態1と同様に、フィルム基板1上に形成された電極3に半導体素子2Dのバンプ電極4が接続されている。半導体素子2Dとフィルム基板1との間にはエポキシ系の樹脂の封止部6がモールディングされて、フィルム基板1上の電極3と半導体素子2Dのバンプ電極4との接合部分が確実に封止されている。
実施の形態4における半導体素子2Dにおいて、複数のバンプ電極4が形成されている背面には絶縁樹脂で構成された絶縁保護部5Dが形成されている。この絶縁保護部5Dは、半導体素子2Dがフィルム基板1上に実装されるときや、モールディング工程において半導体素子2Dの端部が電極部分に直接接触することを防止するものである。
In the semiconductor device according to the fourth embodiment, the
In the
図9は実施の形態4における半導体素子2Dのバンプ電極4が形成された背面を示している。図9に示すように、実施の形態4における半導体素子2Dにおいて、複数のバンプ電極4が形成された面に膜状の絶縁保護部5Dが形成されている。実施の形態4における絶縁保護部5Dは、半導体素子2Dの背面におけるバンプ電極4以外の領域を覆うよう形成されている。
次に、図9に示した半導体素子2Dにおける絶縁保護部5Dの製造方法について説明する。図10は実施の形態4の半導体装置における半導体素子2Dの製造方法を説明する図である。
FIG. 9 shows the back surface on which the
Next, a method for manufacturing the
図10の(A)は半導体チップである半導体素子2D上に複数のバンプ電極4が形成されている状態を示す。
図10の(B)は図10の(A)の半導体素子2Dにポジ型のレジスト5dをスピンコーティングにより塗布した状態を示す。実施の形態4においては、ポジ型のレジスト5dとしてアクリル系の紫外線硬化型樹脂を用いた。ここで用いるレジスト5dの材料は、封止部6の材料であるエポキシ系樹脂に対して濡れ性の良いものが選ばれる。このようにエポキシ系樹脂に対して濡れ性の良い材料を選ぶことにより、封止部6の樹脂による封止性能が向上する。なお、レジスト5dの塗布方法としては、スピンコーティングに限定されるものではなく、一般的に用いられる塗布方法が利用できる。
FIG. 10A shows a state in which a plurality of
FIG. 10B shows a state in which a positive resist 5d is applied to the
次に、図10の(C)に示すように、半導体素子2Dにおけるバンプ電極4が形成されている部分をマスキングして紫外線を照射し、現像、洗浄、そして硬化処理が施される。その結果、図10の(D)に示すように、半導体素子2Dの背面において、バンプ電極4が形成されている部分のレジスト5dは除去され、残りの面に絶縁樹脂で形成された絶縁保護部5Dが形成される。この絶縁保護部5Dは、厚みが1〜5μmの範囲内となるよう形成される。このように形成された半導体素子2Dは、フィルム基板1上の所望の位置に配置される。そして、半導体素子2Dのバンプ電極4が電極3上に位置決めされ、加圧加熱することにより、バンプ電極4が溶けて電極3に接続される。この電極3とバンプ電極4との接続工程において、半導体素子2Dの端部(コーナー)がフィルム基板1上の電極3に直接に接触することがなく、電極3が傷付けられたり、破損することが防止されている。
Next, as shown in FIG. 10C, the portion of the
実施の形態4においては、半導体素子2Dの背面にある絶縁保護部5Dの表面からフィルム基板1の表面までの距離は少なくとも10μm以上、好ましくは10〜15μmの範囲内のギャップを有している。このように半導体素子2Dとフィルム基板1との間が所望のギャップを有しているため、モルディング工程において、半導体素子2Dとフィルム基板1との間に樹脂を容易に注入することができる。この結果、半導体素子2Dとフィルム基板1との間の隙間に空洞や気泡のない封止部6を確実に形成することができる。また、このモールディング工程において、半導体素子2Dの端部がフィルム基板1上の電極3に接触しても、その端部は絶縁保護部5Dにより被覆されているため電極3が傷付けられることが防止されている。
In
《実施の形態5》
以下、本発明に係る実施の形態5の半導体装置について説明する。実施の形態5の半導体装置において、前述の実施の形態1の半導体装置と異なる点は、半導体素子に形成される絶縁保護部の形状及びその製造方法である。実施の形態5の説明においては、実施の形態1と同じ機能、構成を有するものには同じ符号を付して、それらの詳細な説明は実施の形態1の説明を適用する。
<< Embodiment 5 >>
The semiconductor device according to the fifth embodiment of the present invention will be described below. The semiconductor device according to the fifth embodiment differs from the semiconductor device according to the first embodiment in the shape of the insulating protection portion formed in the semiconductor element and the manufacturing method thereof. In the description of the fifth embodiment, components having the same functions and configurations as those of the first embodiment are denoted by the same reference numerals, and the description of the first embodiment is applied to the detailed description thereof.
実施の形態5の半導体装置は、実施の形態1と同様に、フィルム基板1上に形成された電極3に半導体素子2Eのバンプ電極4が接続されている。半導体素子2Eとフィルム基板1との間にはエポキシ系の樹脂の封止部6がモールディングされて、フィルム基板1上の電極3と半導体素子2Eのバンプ電極4との接合部分が確実に封止されている。
実施の形態5における半導体素子2Eにおいて、複数のバンプ電極4が形成されている背面には絶縁樹脂で構成された絶縁保護部5Eが形成されている。この絶縁保護部5Eは、半導体素子2Eがフィルム基板1上に実装されるときや、モールディング工程において半導体素子2Eの端部が電極部分に直接接触することを防止するものである。
In the semiconductor device according to the fifth embodiment, the
In the
図11は実施の形態5における半導体素子2Eのバンプ電極4が形成された背面を示している。図11に示すように、実施の形態5における半導体素子2Eにおいて、複数のバンプ電極4が形成された面に膜状の絶縁保護部5Eが形成されている。実施の形態5における絶縁保護部5Eは、半導体素子2Eの背面におけるバンプ電極4に近接した領域で、その背面における端部(コーナー)とバンプ電極4との間の領域に形成されている。
次に、図11に示した半導体素子2Eにおける絶縁保護部5Eの製造方法について説明する。図12は実施の形態5の半導体装置における半導体素子2Eの製造方法を説明する図である。
FIG. 11 shows the back surface on which the
Next, a method for manufacturing the
図12の(A)は半導体チップである半導体素子2E上に複数のバンプ電極4が形成されている状態を示す。
図12の(B)は図12の(A)の半導体素子2Eにポジ型のレジスト5eをスピンコーティングにより塗布した状態を示す。実施の形態5においては、ポジ型のレジスト5eとしてアクリル系の紫外線硬化型樹脂を用いた。なお、レジスト5eの塗布方法としては、スピンコーティングに限定されるものではなく、一般的に用いられる塗布方法が利用できる。
FIG. 12A shows a state in which a plurality of
FIG. 12B shows a state in which a positive resist 5e is applied to the
次に、図12の(C)に示すように、半導体素子2Eの背面におけるバンプ電極4から外側の領域を除いた部分をマスキングして紫外線を照射し、現像、洗浄、そして硬化処理が施される。その結果、図11及び図12の(D)に示すように、半導体素子2Eの背面において、バンプ電極4から外側の領域に絶縁樹脂で形成された絶縁保護部5Eが形成される。この絶縁保護部5Eは、厚みが1〜5μmの範囲内となるよう形成されている。このように形成された半導体素子2Eは、フィルム基板1上の所望の位置に配置される。そして、半導体素子2Eのバンプ電極4が電極3上に位置決めされ、加圧加熱することにより、バンプ電極4が溶けて電極3に接続される。この電極3とバンプ電極4との接続工程において、半導体素子2Eの端部(コーナー)がフィルム基板1上の電極3に直接に接触することがなく、電極3が傷付けられたり、破損することが防止されている。
Next, as shown in FIG. 12C, the portion of the back surface of the
実施の形態5において、半導体素子2Eの背面にある絶縁保護部5Eの表面からフィルム基板1の表面までの距離は少なくとも10μm以上、好ましくは10〜15μmの範囲内のギャップを有している。このように半導体素子2Eとフィルム基板1との間が所望のギャップを有しているため、モルディング工程においても、半導体素子2Eとフィルム基板1との間に樹脂を容易に注入することができる。この結果、半導体素子2Eとフィルム基板1との間の隙間に空洞や気泡のない封止部6を確実に形成することができる。また、このモールディング工程において、半導体素子2Eにおけるバンプ電極4近傍の端部が、フィルム基板1の反り返りによりフィルム基板1上の電極3に接触しても、その端部は絶縁保護部5Eにより被覆されているため電極3が傷付けられることがない。
In Embodiment 5, the distance from the surface of the
なお、上記の実施の形態5においては、絶縁保護部5Eを各バンプ電極4に近接して形成した例で説明したが、絶縁保護部5Eは全てのバンプ電極4に対応して形成する必要は無く、その半導体素子の形状に応じて形成位置をさらに少ない個数に限定しても良い。
In the fifth embodiment, the example in which the
《実施の形態6》
以下、本発明に係る実施の形態6の半導体装置について説明する。実施の形態6の半導体装置において、前述の実施の形態1の半導体装置と異なる点は、半導体素子の形状及びその製造方法である。実施の形態6の説明においては、実施の形態1と同じ機能、構成を有するものには同じ符号を付して、それらの詳細な説明は実施の形態1の説明を適用する。
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The semiconductor device according to the sixth embodiment of the present invention will be described below. The semiconductor device of the sixth embodiment is different from the semiconductor device of the first embodiment in the shape of the semiconductor element and the manufacturing method thereof. In the description of the sixth embodiment, components having the same functions and configurations as those of the first embodiment are denoted by the same reference numerals, and the description of the first embodiment is applied to the detailed description thereof.
図13は本発明に係る実施の形態6の半導体装置の構成を示す断面図である。前述の実施の形態1から5においては、半導体素子の背面部分に絶縁保護部を形成して、電極3と半導体素子2との直接的な接触を無くし、電極の破損等を防止した構成である。なお、図13においては、封止部6を形成する前の段階を示しており、フィルム基板1が湾曲した状態を示す。実施の形態6の半導体装置においては、図13に示すように、半導体素子2Fのコーナー部7が鈍角となるよう形成されている。このコーナー部7は、半導体素子2Fにおいて、フィルム基板1に対向する面、すなわちバンプ電極4が設けられている面の外縁部分に形成されている。このようにコーナー部7を形成することにより、電極3と半導体素子2Fとの接触が抑制され、且つもし電極3と半導体素子2Fのコーナー部7が接触した場合であっても、電極3において傷付き破損することが起こりにくい構成である。
FIG. 13 is a sectional view showing the configuration of the semiconductor device according to the sixth embodiment of the present invention. In the above-described first to fifth embodiments, an insulating protection portion is formed on the back surface portion of the semiconductor element to eliminate direct contact between the
半導体素子2Fのコーナー部7の断面形状は、図14の(a)に示すように、略曲面形状である。但し、少なくとも、図14の(b)に示すように、半導体素子における背面と側面の間の略直角の角が切断されている形状でも良い。すなわち、コーナー部7の断面形状は、少なくとも90°を超える鈍角を持つ形状であれば良い。
The cross-sectional shape of the
次に、半導体素子2Fのコーナー部7の作成方法について説明する。
半導体素子2Fにおいてコーナー部7を形成する方法として、研磨による形成方法があるが、半導体素子2Fは脆く割れやすい構造であるため、実施の形態6においては、以下の形成方法を用いた。
図15は実施の形態6の半導体装置におけるコーナー部7の形成方法を示す図である。半導体ウェハー15を切断する場合において、図15の(a)に示すように、切欠き8を形成する。この切欠き8の形成方法は、ダイシング(切断)工程のダイヤモンドブレードの形状に左右され、半導体ウェハー15上の切断位置を示す線をダイシング(切断)することでなされる。このとき、半導体ウェハー15は、水平面のステージ上に固定されて、鉛直上に配置されたダイシングブレ−ドにより切削される。このとき用いられるダイヤモンドを有する刃先の形状は、切欠き8の形状に応じて設定される。
Next, a method for creating the
As a method for forming the
FIG. 15 is a diagram illustrating a method of forming the
次に、図15の(b)に示すように、上記のように形成された切欠き8にそって前記のダイシングブレ−ドよりも細いブレ−ドを用いて半導体ウェハー15は切断される。このように切断されて形成された半導体チップである半導体素子2Fにおいては、そのコーナー部7が斜行した面で切断されている。この結果、コーナー部7には鋭角部分が無く鈍角を有する断面形状となる。
次に、半導体装置におけるコーナー部7の別の形成方法について説明する。この形成方法においては、半導体ウェハー15をエッチングによりダイシング(切断)して半導体素子2Fを形成する。図16は半導体ウェハー15をエッチングにより切断する方法を示す図である。図16の(A)において、半導体ウェハー15の全面にレジスト12が塗布される。ここで用いるレジスト12の材料としては、例えば紫外線硬化型樹脂が好ましい。なお、図16においては省略しているが、半導体ウェハー15には金メッキによるバンプ電極が形成されている。次に、半導体ウェハー15に対して、切断する位置に対向した部分が開口したレジストパターンが配置され、露光される。このレジストパターンを配置して露光する処理は、半導体ウェハー15の両面に対して行われる(図16の(B))。このとき、現像、洗浄、硬化の各処理が順次行われる。
Next, as shown in FIG. 15B, the
Next, another method for forming the
次に、図16の(C)に示すように、露光処理された半導体ウェハー15は、フッ酸系のエッチング液20に浸漬され、半導体ウェハー15の所望の位置がエッチングされる。図16の(D)はエッチング液20により溶融され切断された半導体ウェハー15の状態を示す図である。このとき用いられるエッチング液20は、等方性エッチング液が用いられている。その後、レジスト12が除去されて、半導体ウェハー15は所望の位置で切断された状態(図16の(E))となる。このように切断された半導体ウェハー15は、その切断面が鋭角な部分のない滑らかな形状となる。なお、上記においては、露光処理された半導体ウェハー15をエッチング液20に浸漬した例で説明したが、露光処理された半導体ウェハー15に対してエッチング液のシャワーをかける方法で切断しても良い。バンプ電極は、金メッキにより作製した例で説明したが、切断後の半導体ウェハーに対してバンプボンダー装置により作製しても良い。
Next, as shown in FIG. 16C, the exposed
上記のように、実施の形態6における半導体素子2Fにおいては、コーナー部7が鈍角で形成されているため、フィルム基板1上の電極3とコーナー部7が接触しても、電極3が半導体素子2Fにより傷付けられることが防止されている。
また、実施の形態6においては、簡単な製造工程を追加するだけで、信頼性の高い半導体装置を製造することが可能となる。実施の形態6の半導体装置の製造方法は、高密度実装のフィルム基板に適用することが可能であり、高性能機器の製造コストの抑制効果がある。
さらに、実施の形態6における半導体素子2Fにコーナー部7が形成されているため、樹脂をモールディングして封止部を形成する工程において、樹脂の注入を容易に、且つ確実に行うことが可能となる。
As described above, in
In the sixth embodiment, a highly reliable semiconductor device can be manufactured only by adding a simple manufacturing process. The semiconductor device manufacturing method of the sixth embodiment can be applied to a high-density mounting film substrate, and has an effect of suppressing the manufacturing cost of high-performance equipment.
Furthermore, since the
《実施の形態7》
以下、本発明に係る実施の形態7の半導体装置について説明する。実施の形態7の半導体装置は、フィルム基板上の半導体素子の上部にカバーシート20が設けられている。実施の形態7においては、前述の実施の形態1から6において説明した半導体素子を用いることが可能である。実施の形態7の説明においては、実施の形態1と同じ機能、構成を有するものには同じ符号を付して、それらの詳細な説明は実施の形態1の説明を適用する。
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The semiconductor device according to the seventh embodiment of the present invention will be described below. In the semiconductor device of the seventh embodiment, a
図17は本発明に係る実施の形態7の半導体装置を示す斜視図である。図18は実施の形態7の半導体装置の構成を示す断面図である。
実施の形態7の半導体装置において、フィルム基板1上に電極3が形成されており、その電極3上にバンプ電極4を介して、半導体素子2Gが接続されている。実施の形態7の半導体装置においては、半導体素子2Gの上に、シートカバー20が設けられている。このシートカバー20は、電磁シールドの効果を有する材料で形成されており、厚みは0.1mmから1.0mmの範囲内に設定されている。なお、電磁シールドの効果を有する材料としては、例えば銅箔がラミネートされた絶縁性樹脂がある。
FIG. 17 is a perspective view showing a semiconductor device according to the seventh embodiment of the present invention. FIG. 18 is a cross-sectional view showing the configuration of the semiconductor device of the seventh embodiment.
In the semiconductor device of the seventh embodiment, an
図17に示すように、実施の形態7において用いた半導体素子2Gは、その平面形状が長方形である。この長方形の半導体素子2Gに対してその両側の短辺側部分を覆うようシートカバー20がフィルム基板1に固着されている。一方、半導体素子2Gにおける長辺側部分はシートカバー20から露出した状態である。
実施の形態7の半導体装置の製造においては、例えば前述の実施の形態1から6において説明した半導体素子2Gを、電極3を有するフィルム基板1上に配置して、加熱圧着して、半導体素子2Gを所望の電極3にバンプ電極4を介して接続する。その後、シートカバー20を半導体素子2Gの上面に配置する。このように配置されたシートカバー20は、固着治具13により加熱押圧される。このときの状態を図19に示す。図19に示すように、シートカバー20における固着部分とフィルム電極1との間には接着剤14が塗布されている。実施の形態7の半導体装置においては、半導体素子2Gの長手方向の両側でシートカバー20が接着剤14によりフィルム基板1に固着される。
As shown in FIG. 17, the
In the manufacture of the semiconductor device of the seventh embodiment, for example, the
上記のようにシートカバー20が半導体素子2Gに対して所望の位置に固着された後、半導体素子2Gのバンプ電極4と電極3との接合部分を覆うように樹脂がシートカバー20の長手部分から半導体素子2Gの長辺側内部へ注入される。樹脂が注入されて半導体装置の封止部6が形成される。
After the
実施の形態7においては、シートカバー20が設けられているため、製造過程において、フィルム基板1が曲がった時でも、半導体素子2Gとフィルム基板1の電極3との接触が発生しにくく、発生しても衝撃を有するような激しい接触とはならない。この結果、半導体装置の製造時において、電極3が接触により傷付くことが防止され、信頼性の高い半導体装置を提供することが可能となる。
また、シートカバー20は電磁シールド効果を有しているため、実施の形態7の半導体装置を用いた製品の性能をさらに高くすることが可能となる。
なお、シートカバー20の材料としては、フィルム状の絶縁性樹脂がよく、フィルム基板1の材料と同じ材料でも良い。ただし、シートカバー20の材料は、フィルム基板1より柔軟性のあるフィルムを用いると、フィルム基板1の曲がりが滑らかになり、製品への汎用性がさらに広くなる。
In the seventh embodiment, since the
Further, since the
The material of the
また、シートカバー20としては柔軟性を有するように、フィルム基板1と同じ材料の場合には、より薄い材料を用いると良い。例えば、フィルム基板1が、80μmの厚みの場合、シートカバー20は、3分の2以下が好ましい。特に好ましいのは、半分以下の40μm程度の厚みにすれば、フィルム基板1の曲がりがスムーズであり、且つ半導体素子2Gとフィルム基板1の電極3との接触が発生しにくく、もし発生しても電極3を傷付けるような激しい衝突とはならない。
また、フィルム基板1の材料がポリイミドであるならば、シートカバー20の材料は、ポリエチレンなどの柔軟なシート材を選択するのが好ましい。ただし、耐熱性などの特性からの制限がある場合には、同じ種類のフィルムで上記のように、薄いものを用いると良い。
Further, in the case of the same material as the
If the material of the
なお、シートカバー20の形状は、半導体素子2Gより大きい必要があるが、あらかじめ、フィルム基板1の曲がる方向が決まっている場合には、その方向にのみ、半導体素子2Gより大きい形状として、その方向の両側で固着するよう構成すれば良い。
また、半導体素子2のコーナー部分を含む部分を覆うように、シートカバーを設けても良い。さらに、半導体素子2が複数実装されている場合において、シートカバーは個々に設置しても、全体をまとめて設置することも可能である。製造コストなどを考慮して、必要な半導体素子にのみシートカバーを設置しても良い。
シートカバー20の固着方法としては、粘着剤が予め塗布されているシート状のものを所望の形状に切断して、半導体素子の上面より貼り付ける方法でも良い。または、半導体素子の上面及びフィルム基板の所望の位置に予め接着剤を塗布して、その上より切断されたシートカバー20を貼り付けても良い。
The shape of the
Further, a sheet cover may be provided so as to cover a portion including the corner portion of the
As a method for fixing the
以上のように、各実施の形態において詳細に説明したところから明らかなように、本発明によれば、フィルム基板上に形成された電極と半導体素子の端部が実装時に接触することを確実に防止することができるとともに、フィルム基板上に実装された半導体素子に対して樹脂のモールディングを確実に、且つ高精度に行うことができる。また、本発明は、高密度実装基板に対しても適用できる汎用性の高い半導体装置及び半導体装置の製造方法を提供するものである。
発明をある程度の詳細さをもって好適な形態について説明したが、この好適形態の現開示内容は構成の細部において変化してしかるべきものであり、各要素の組合せや順序の変化は請求された発明の範囲及び思想を逸脱することなく実現し得るものである。
As described above, as is clear from the detailed description in each embodiment, according to the present invention, it is ensured that the electrode formed on the film substrate and the end of the semiconductor element are in contact with each other during mounting. In addition to being able to prevent this, resin molding can be reliably and highly accurately performed on the semiconductor element mounted on the film substrate. In addition, the present invention provides a highly versatile semiconductor device that can be applied to a high-density mounting substrate and a method for manufacturing the semiconductor device.
Although the invention has been described in its preferred form with a certain degree of detail, the present disclosure of this preferred form should vary in the details of construction, and combinations of elements and changes in order may vary from claimed invention. It can be realized without departing from the scope and spirit.
本発明は、柔軟性を有するフィルム状の基板上に半導体素子を確実に実装した半導体装置を提供でき、電子機器の分野において有用である。 The present invention can provide a semiconductor device in which a semiconductor element is reliably mounted on a flexible film-like substrate, and is useful in the field of electronic equipment.
1 フィルム基板
2A 半導体素子
3 電極
4 バンプ電極
5A 絶縁保護部
6 封止部6
DESCRIPTION OF
Claims (17)
前記フィルム基板の少なくとも一方の面に形成され、金属膜の電極パターンで構成された電極、
前記電極に接続されたバンプ電極を有する半導体素子、
前記半導体素子における前記電極と対向する面に形成され、前記半導体素子と前記電極との直接接触を防止する絶縁保護部、及び
前記半導体素子と前記フィルム基板との間の空間内に少なくとも形成され、前記電極と前記バンプ電極とを封止する封止部、
を具備する半導体装置。 A film substrate made of a flexible resin material,
An electrode formed on at least one surface of the film substrate and configured with an electrode pattern of a metal film,
A semiconductor element having a bump electrode connected to the electrode;
Formed on a surface of the semiconductor element facing the electrode, and is formed at least in a space between the semiconductor element and the film substrate, and an insulating protection part for preventing direct contact between the semiconductor element and the electrode; A sealing portion for sealing the electrode and the bump electrode;
A semiconductor device comprising:
前記フィルム基板の少なくとも一方の面に形成され、金属膜の電極パターンで構成された電極、
前記電極に接続されたバンプ電極を有し、前記電極と対向する面における外縁部分のコーナが鈍角により形成された半導体素子、及び
前記半導体素子と前記フィルム基板との間に形成され、前記電極と前記バンプ電極とを封止する封止部、
を具備する半導体装置。 A film substrate made of a flexible resin material,
An electrode formed on at least one surface of the film substrate and configured with an electrode pattern of a metal film,
A semiconductor device having a bump electrode connected to the electrode, wherein a corner of an outer edge portion on a surface facing the electrode is formed at an obtuse angle, and formed between the semiconductor device and the film substrate; and A sealing portion for sealing the bump electrode;
A semiconductor device comprising:
前記半導体素子の所望領域をマスキングして紫外線を照射し、現像、洗浄、そして硬化の各処理を順次行い、絶縁保護部を形成する工程、
前記半導体素子が電極を有するフィルム基板上の所望の位置に配置され、加圧加熱により前記バンプ電極と前記電極とを接続する工程、及び
前記半導体素子と前記フィルム基板との間に樹脂を注入して封止部を形成する工程、
を有する半導体装置の製造方法。 Applying a resist to the surface of the semiconductor element having the bump electrode;
Masking a desired region of the semiconductor element, irradiating with ultraviolet rays, sequentially performing development, cleaning, and curing processes to form an insulating protection portion;
The semiconductor element is disposed at a desired position on the film substrate having an electrode, and a step of connecting the bump electrode and the electrode by pressure heating, and injecting a resin between the semiconductor element and the film substrate Forming a sealing portion,
A method for manufacturing a semiconductor device comprising:
前記半導体素子の所望の位置に塗布された樹脂を加熱処理して絶縁保護部を形成する工程、
前記半導体素子が電極を有するフィルム基板上の所望の位置に配置され、加圧加熱により前記バンプ電極と前記電極とを接続する工程、及び
前記半導体素子と前記フィルム基板との間に樹脂を注入して封止部を形成する工程、
を有する半導体装置の製造方法。 Applying a resin to a desired position on the surface of the semiconductor element having the bump electrode;
A step of heat-treating a resin applied to a desired position of the semiconductor element to form an insulation protection portion;
The semiconductor element is disposed at a desired position on the film substrate having an electrode, and a step of connecting the bump electrode and the electrode by pressure heating, and injecting a resin between the semiconductor element and the film substrate Forming a sealing portion,
A method for manufacturing a semiconductor device comprising:
前記半導体ウェハーに対して、切断する位置と対向する部分が開口したレジストパターンが配置され、露光、現像、洗浄、硬化の各処理が順次行わわれる露光工程、及び
前記半導体ウェハーがエッチング液に浸漬され、前記半導体ウェハーの所望の位置で切断される切断工程、
により製造された半導体素子を用いた請求項13から16のいずれか一項に記載の半導体装置の製造方法。
A coating process for coating a resist on the entire surface of a semiconductor wafer;
An exposure process in which a resist pattern having an opening at a portion opposite to a cutting position is disposed on the semiconductor wafer, and exposure, development, cleaning, and curing processes are sequentially performed; and the semiconductor wafer is immersed in an etching solution. A cutting process in which the semiconductor wafer is cut at a desired position;
The method for manufacturing a semiconductor device according to claim 13, wherein the semiconductor element manufactured by the method is used.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004284522A JP2005129917A (en) | 2003-09-30 | 2004-09-29 | Semiconductor device and its manufacturing method |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
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JP2004284522A JP2005129917A (en) | 2003-09-30 | 2004-09-29 | Semiconductor device and its manufacturing method |
Publications (1)
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ID=34655628
Family Applications (1)
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JP2004284522A Pending JP2005129917A (en) | 2003-09-30 | 2004-09-29 | Semiconductor device and its manufacturing method |
Country Status (1)
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JP (1) | JP2005129917A (en) |
Cited By (1)
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JP2015536044A (en) * | 2012-09-27 | 2015-12-17 | オスラム オプト セミコンダクターズ ゲゼルシャフト ミット ベシュレンクテル ハフツングOsram Opto Semiconductors GmbH | Method for dividing region of semiconductor layer and optoelectronic semiconductor chip |
-
2004
- 2004-09-29 JP JP2004284522A patent/JP2005129917A/en active Pending
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