JP2003515986A - Ｍｐｅｇビデオ・ストリームの継ぎ目を生じないスイッチング - Google Patents

Ｍｐｅｇビデオ・ストリームの継ぎ目を生じないスイッチング

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JP2003515986A
JP2003515986A JP2001540525A JP2001540525A JP2003515986A JP 2003515986 A JP2003515986 A JP 2003515986A JP 2001540525 A JP2001540525 A JP 2001540525A JP 2001540525 A JP2001540525 A JP 2001540525A JP 2003515986 A JP2003515986 A JP 2003515986A
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Abstract

(57)【要約】 【課題】 スイッチングの方法と、柔軟性に富み、実施が実現なその方法に対応したデバイスとを提供すること。 【解決手段】 スイッチング・デバイスSWは、最終的に圧縮データ出力ストリームOSになる、第一圧縮データ入力ストリームIS1から第二圧縮データ入力ストリームIS2にスイッチングすることを可能にする。本スイッチング・デバイスは、第一と第二入力ストリームのデータを記憶するためのバッファ・システムBS、およびスイッチング要求SWRに応じて、転換デバイスCOMを用い、第一入力ストリームから第二入力ストリームにスイッチングするためのバッファ・システムにおける入力ストリームの記憶をコントロールする手段CONTを有する。トランスコーディング・システムTSは、転換デバイスの出口でデータストリームを受取り、継ぎ目なしに出力ストリームを供給する。トランスコーディング・システムの使用は、出力ストリームをデコーディングするデコーダのバッファのアンダーフローまたはオーバーフローを回避することを可能にする。さらに、上記トランスコーディング・システムは、第一入力ストリームのビット伝送速度R1および第二入力ストリームのビット伝送速度R2と必ずしも同じではないビット伝送速度Rで出力ストリームをエンコーディングすることを可能にする。

Description

【発明の詳細な説明】
【０００１】
【発明が属する技術分野】
本発明は、第一圧縮データ入力ストリームから第二圧縮データ入力ストリーム
にスイッチングして、圧縮データ出力ストリームを得るための方法およびこれを
可能にするデバイスに関する。
【０００２】 本発明は、例えば、MPEG圧縮ビデオ信号のスイッチングおよび編集に有用とす
ることが出来る。
【０００３】
【従来の技術】
この種の方法およびデバイスは、国際特許出願WO 99/05870において開示され
ている。この出願は、エンコーディングまたはデコーディング・システムにおい
て、エンコーディングされた第一のビデオシーケンスからエンコーディングされ
た第二のビデオシーケンスにスイッチングする改良された方法に関するものであ
る。デコーディングされたバッファのアンダーフローおよびオーバーフローを避
けるために、入力ストリームのトランスコーディングが、スイッチポイントの時
間位置をシフトさせ、かつトランスコーダの出力で、同一の入口点をもつストリ
ームと、同じデコーダ・バッファ特性とを得るために使用される。
【０００４】 前述した方法はいくつかの重要な欠点を持っている。この従来技術によれば、
各トランスコーダの出力ビット伝送速度は入力ビット伝送速度と等しく、そのた
め、スイッチング方法の柔軟性は損なわれる。さらに、この方法は、第二のビデ
オシーケンスのスイッチング直後の最初の画像が画像内符号化された画像（Iピ
クチャ）になることを暗黙に定義している。
【０００５】 最後に、この従来技術の問題点の解決策は、スイッチング・デバイスが2つの
トランスコーダを必要とするため、実行するにはやや複雑で高価である。
【０００６】
【課題を解決するための手段】
本発明の目的は、スイッチングの方法と、柔軟性に富み、実施が実現なその方
法に対応したデバイスとを提供することである。
【０００７】 本発明は、この目的のために、
【発明が属する技術分野】に記載された、 − 前記第一および前記第二入力ストリームに含まれている前記データを記憶す るためのバッファ・システムと、 − スイッチ要求に応じて、転換デバイスを使用して、前記第一入力ストリーム から前記第二入力ストリームへスイッチングを行うために、前記バッファ・ システム内の前記入力ストリームの記憶を制御するためのコントロール手段 と、 − 前記転換デバイスの出力から、継ぎ目なしに前記出力ストリームを提供する ためのトランスコーディング・システムと を有するスイッチング・デバイスに関する。
【０００８】 本発明によると、ビット伝送速度R1でエンコーディングされた第一圧縮データ
ストリームから、ビット伝送速度R2でエンコーディングされた第二圧縮データス
トリームへのスイッチングにおいて、スイッチングに起因する出力ストリームを
、トランスコーディング・システムを使用することにより、R1ともR2とも異なる
ビット伝送速度Rで再びエンコーディングすることが可能になる。したがって、
このようなスイッチング・デバイスは、柔軟性に富む。
【０００９】 本発明のスイッチング・デバイスは、また、 − 前記バッファ・システムが、前記第一および第二入力ストリームのデータを それぞれ記憶するための第一バッファおよび第二バッファを有し、 − 前記トランスコーディング・システムが、1つのトランスコーダを有し、 − 前記転換デバイスが、当該第一バッファが前記第一入力ストリームのM枚の 画像の組の送信を完了し、当該第二バッファが、前記制御手段によって一枚 のIピクチャを送信するよう制御されたときに、前記第一バッファ出力から 前記第二バッファ出力にスイッチングするよう制御され、そして − 当該スイッチング・デバイスが、当該Iピクチャを含む前記第二入力ストリ ームのM枚の画像の組のための前方予測を行うことなくBピクチャを生成する ための手段を有する ことを特徴とする。
【００１０】 このスイッチング・デバイスは、一つしかトランスコーダを使用しないため、
これの実施はより簡単に、かつ安価になる。
【００１１】 最後に、本発明のスイッチング・デバイスは、 − 前記バッファ・システムが、前記第一および第二入力ストリームのデータを それぞれ記憶するための前記第一バッファおよび前記第二バッファを有し、 − 前記トランスコーディング・システムが、各入力ストリームに関連して、 第一のデコーディング手段および第二のデコーディング手段を有し、 − 前記第一バッファが、前記第一入力ストリームのM枚の画像の組を送信完了 した時に、前記の第一の手段によってデコーディングした後の前記第一入力 ストリームから、前記の第二の手段によってデコーディングした後の前記第 二入力ストリームにスイッチするよう制御され、前記第二バッファは前記の 制御手段によって一枚のIピクチャまたはデコーディング・エンコーディン グ手段を用いてIピクチャに再エンコーディングされた一枚のPピクチャを送 信するよう制御される前記転換デバイスを有し、そして − 当該スイッチング・デバイスが、当該Iピクチャを含む前記第二入力ストリ ームのM枚の画像の組の前方予測を行うことなくBピクチャを生成する手段を 有する ことを特徴とする。
【００１２】 このようなスイッチング・デバイスにより、一枚のPピクチャから始まる、第
二の圧縮ビデオ・ストリームへのスイッチングが可能となる。したがって、シス
テムの柔軟性が増加する。
【００１３】 これらおよび他の本発明の態様は、以下に記載される実施例を参照することに
より、明らかになるであろう。
【００１４】
【発明を実施するための形態】
本発明を、添付図面を参照し、実施例を用いて、説明する。
【００１５】 本発明は、圧縮データ信号のスイッチングおよび編集のための、より高い性能
のデバイスに関する。本発明は、より厳密には、MPEG信号に関するものであるが
、また、例えば、国際電気通信連合（ITU）規格H-261またはH-263に定められる
任意のタイプの圧縮データにも適用可能である。本発明のスイッチング・デバイ
スの原理は、図1に示される。
【００１６】 本発明のスイッチング・デバイスSWは、最終的に圧縮データ出力ストリームOS
になるように、第一圧縮データ入力ストリームIS1から第二圧縮データ入力スト
リームIS2にスイッチングすることを可能にする。
【００１７】 本スイッチング・デバイスは、第一と第二入力ストリームのデータを記憶する
ためのバッファ・システムBS、およびスイッチング要求SWRに応じて、転換デバ
イスCOMを用い、第一入力ストリームから第二入力ストリームにスイッチングす
るためのバッファ・システムにおける入力ストリームの記憶をコントロールする
手段CONTを有する。
【００１８】 トランスコーディング・システムTSは、転換デバイスの出力側でデータストリ
ームを受取り、継ぎ目なしに出力ストリームを供給する。トランスコーディング
・システムの使用は、出力ストリームをデコーディングするデコーダのバッファ
のアンダーフローまたはオーバーフローを回避することを可能にする。さらに、
上記トランスコーディング・システムは、第一入力ストリームのビット伝送速度
R1および第二入力ストリームのビット伝送速度R2と必ずしも同じではないビット
伝送速度Rで出力ストリームをエンコーディングすることを可能にする。
【００１９】 以下、本発明におけるMPEGビデオデータ・スイッチングについて、より詳細に
説明する。図2は、MPEGビデオ・ストリームのスイッチング・デバイスの実施例1
に対応するブロック図である。この実施例1の場合、スイッチング・デバイスは
、 − 第一および第二入力ストリームそれぞれのデータを記憶するための第一バッ ファBUF1および第二バッファBUF2、 − 転換デバイスCOM、および − トランスコーダTRANS を有する。
【００２０】 第一ビデオ入力ストリームから第二ビデオ入力ストリームへのスイッチング操
作は、第二の入力ストリームが、送信順で、過去を参照しない画像（画像内符号
化されたIピクチャ）から始まる場合、また、第一入力ストリームの最後に表示
された画像が、表示順で、未来を参照しない（予測画像（Pピクチャ）またはIピ
クチャ）場合に、これを実行することができる。
【００２１】 さらに、双方向画像（Bピクチャ）が続いて順に送信されるが、第二入力スト
リームの最初に挿入された画像には、前方予測が行われない。すなわち、第二入
力ストリームの最初に挿入された一連の画像（GOP）は、クローズドGOPでなけれ
ばならない。この目的のために、本発明のスイッチング装置は、また、スイッチ
ングの後に送信された第二入力ストリームの最初のM（二枚の連続するIまたはP
ピクチャの距離）枚の画像の組に対する予測なしに、Bピクチャを生成するため
の手段を有する。
【００２２】 第一の結果として、第二入力ストリームがクローズドGOPで始まらない場合、I
ピクチャに続く最初のBピクチャは、 − 排出されるか、または、 − 第一入力ストリームの表示順で最後の絵を凍結することにより、または第二 入力ストリームの最初のIピクチャを凍結することにより得られた一様な色 （UC）の画像により置き換えられるであろう。
【００２３】 第二の結果として、転換デバイスは、前記第二バッファが一枚のIピクチャを
送信する準備ができていて、当該第一バッファがM枚の画像の組を送信した時に
、第一バッファの出力から第二バッファの出力にスイッチングする。この目的の
ために、これらの二つのバッファは、少なくともN（連続する二枚のIピクチャの
間の距離）枚の画像分の長さを持ち、また、コントローラにより制御される書き
込みポインタを用いて書き込まれ、かつコントローラにより制御される読み出し
ポインタを用いて読み出される。スイッチ要求に応じて、第一バッファの現在の
M枚の画像の組（送信順でPkBk-2Bk-1またはIkBk-2Bk-1、および表示順でBk-2Bk- 1 PkまたはBk-2Bk-1Ik）の読み出しが、まず完了し、次いで、第二バッファの読
み出しポインタを現在のIピクチャにセットした状態で、転換デバイスが、第二
バッファにスイッチングされる。
【００２４】 本発明のトランスコーダは、入力ストリームをデコーディングするための可変
長デコーディング・ブロックVLDと逆量子化ブロックDQとを有する。その逆量子
化ブロックDQには、このストリームの再コーディングを行うための量子化ブロッ
クQおよび可変長コード・ブロックVLC、ならびにバッファBUFが、直列に接続さ
れている。このバッファのオーバーフローまたはアンダーフローを防ぐために、
調整REGが実行される。ここで、バッファの占有は、DCT係数量子化へのフィード
バックによって制御される。ビット伝送速度R1でコード化されたビデオシーケン
スからビット伝送速度R2で別にコード化されていたビデオシーケンスにスイッチ
ングされるとき、スイッチング・ポイントにおけるそれぞれのデコーダ・バッフ
ァの遅れは一致しない。トランスコーダの役割は、継ぎ目なく出力ストリームOS
を提供するために、これらのバッファ遅れの間の差を補正することである。さら
に、ユーザは、出力ストリームのコード化ビット伝送速度Rを選ぶことができる
。
【００２５】 この実施例1では、最初の画像が、第一入力ストリームに含まれている前の画
像を参照してはならないので、第二入力ストリームの最初の画像は、Iピクチャ
でなくてはならない。さらに、スイッチング操作は可逆的である。すなわち、ス
イッチング要求に応じて、第二入力ストリームから第一入力ストリームへのスイ
ッチングも行うこともできる。
【００２６】 図2のトランスコーダは、主として再量子化手段を含む単純なトランスコーダ
である。図3および図4は、動き補償手段を使用した、より複雑なトランスコーダ
を有するスイッチング・デバイスを示す。このような動き補償手段は、再量子化
手段のみが使用される場合に生じるP/Bのエラードリフトを修正するために使用
される。図3において、トランスコーダは、 − 逆量子化ブロックDQに直列に接続された可変長デコーディング・ブロックVL Dを有するデコーディング・チャンネルと、 − 可変長コード・ブロックVLCに直列に接続され、その出力が追加された逆量 子化ブロックDQmにも接続されている量子化ブロックQを有する、エンコーデ ィング・デコーディング・チャンネルと、 − デコーディング・チャンネルとエンコーディング・デコーディング・チャン ネルとの間に接続されたインターフェース・サブアセンブリとを 有し、このインターフェース・サブアセンブリは、 ・ 正の入力がデコーディング・チャンネルの出力を受取り、その出力がQ ブロックの入力に接続される第一の減算器s1と、 ・ 正の入力がDQmブロックの出力を受取り、負の入力が第一の減算器の出 力に接続される第二の減算器s2と、 ・ 動き補償が、送信順で前の画像に対応するマクロ・ブロックに対する現 在の画像の個々のマクロ・ブロックの運動を表す運動ベクトルから実行 されていて、全てが、第二の減算器の出力と第一の減算器の負の入力と の間に直列に接続されている、逆離散コサイン変換ブロックIDCT、フレ ームメモリMEM、動き補償ブロックMCおよび離散コサイン変換ブロックD CTと を有する。
【００２７】 図4において、トランスコーダはより精巧で、 − 逆量子化ブロックDQおよび逆離散コサイン変換ブロックIDCTに直列に接続さ れた、可変長デコーディング・ブロックVLDを有するデコーディング・チャ ンネルと、 − 量子化ブロックQおよび可変長コード・ブロックVLCに直列に接続している離 散コサイン変換ブロックDCTを有し、量子化ブロックの出力がまた追加され た逆離散コサイン変換ブロックIDCTmに続く追加された逆量子化ブロックDQm に接続された、エンコーディング・デコーディング・チャンネルと、 − デコーディング・チャンネルとエンコーディング・デコーディング・チャン ネルとの間に接続されるインターフェース・サブアセンブリとを 有し、このインターフェース・サブアセンブリは、 ・ 正の入力がデコーディング・チャンネルの出力を受取り、その出力が DCTブロックの入力に接続される、第一の減算器s1と、 ・ 正の入力がIDCTmブロックの出力を受取り、その負の入力が第一の減 算器の出力に接続される、第二の減算器s2と、 ・ 第二の減算器の出力と第一の減算器の負の入力の間の間に直列接続さ れたフレームメモリMEM、および動き補償ブロックMCとを 有する。
【００２８】 図5は、スイッチング・デバイスの実施例2に対応するブロック図である。実施
例2においては、スイッチング・デバイスは、 − 第一バッファBUF1および第二バッファBUF2を有し、少なくとも画像M枚分の 長さを持つバッファ・システムと、 − ・ その第一のバッファの出力にその入力が対応し、第一の逆量子化ブロ ックDQ1に直列に接続されている可変長デコーディング・ブロックVLD 1を有する、第一のデコーディング・チャンネル、 ・ その第二バッファの出力にその入力が相当し、第二の逆量子化ブロッ クDQ2に直列に接続している第二の可変長デコーディング・ブロックV LD2を有する、第二のデコーディング・チャンネル、および ・ 可変長コーディングブロックVLCおよびバッファBUFに直列に接続され ている量子化ブロックQを有し、エンコーディング出力ストリームOS と量子化ブロックへのフィードバックによってバッファ占有を制御す るための調整手段REGを提供するエンコーディング・チャンネル、 を有するトランスコーディング・システムと、 − 逆量子化ブロックDQ1およびDQ2の出力が入力であり、第一入力ストリームか ら第二入力ストリームにスイッチングされる前のDQ2ブロックの出口に接続 された第一の転換デバイスCOM1、および三つの入力、すなわち逆量子化ブロ ックDQ1の出力A、逆量子化ブロックDQ2の出力B、エンコーディング・チャン ネルの入力Cを持つ第二の転換デバイスCOM2を有する転換デバイスと、 − ・ 逆離散コサイン変換ブロックIDCTa、 ・ その第一の入力がIDCTaブロックの出力および、その正の入力が加算器 の出力である減算器sの出力である加算器a、 ・ 入力側は加算器の出力に、出力側は加算器の第二の入力および減算器の 負の入力に接続された、直列に接続されたフレームメモリMEMa、および ・ 動き補償ブロックMCa、および、減算器の出力を受取り、転換デバイスC OM2の第三の入力Cに出力する、離散コサイン変換ブロックDCTa を有するデコーダとを、 有する。
【００２９】 前の機構と比較すると、デコーダが追加されており、当該第二入力ストリーム
のPピクチャで第一入力ストリームから第二入力ストリームにスイッチングする
ことが可能になる。この目的のために、このデコーダは、第一入力ストリームか
ら第二入力ストリームにスイッチングする前に到着する第二入力ストリームのP
ピクチャをすべてデコーディングする。このステップの間、第一入力ストリーム
はトランスコードされる。ユーザが第二入力ストリームにスイッチングしたいと
望むと、IDCTaブロックの出口で提供される最後に解読されたPピクチャは、加算
器の出口で提供されるIピクチャに再エンコーディングされる。さらに、この新
しいIピクチャに続くBピクチャは、動き補償手段MCaおよび減算器によって、後
方向きのベクトルのみを持っているBピクチャに変換される。前方予測を行わな
いBピクチャは、例えば以前に実施例1で記述されたような一様な色の画像である
。
【００３０】 この結果として、スイッチング要求に応じて、第一バッファ内の現在のM枚の
画像の組の読み取りが、最初に完了する。その後、転換デバイスCOM2は、入力A
から入力Cにスイッチングされ、デコーダは、すでにIピクチャとして再エンコー
ディング化されていたデコーディングされたPピクチャと、M枚の画像の組の残り
とを送信出来る状態になる。最後に、転換デバイスCOM2はCからBにスイッチング
され、第二バッファの読込みポインタは第二のM枚の画像の組の初めにセットさ
れる。
【００３１】 この実施例2の場合、第二入力ストリームの最初の画像がIピクチャまたはPピ
クチャである可能性がある。さらに、スイッチング操作は可逆的である。すなわ
ち、スイッチング要求に応じて、スイッチングの前に、転換デバイスCOM1をDQ1
ブロックの出力に接続し、転換デバイスCOM2を入力Bにセットして、第二入力ス
トリームから第一入力ストリームへのスイッチングを行うこともできる。
【００３２】 図5のトランスコーダは、主として再量子化ステップを含む単純なトランスコ
ーダである。図6および7は、動き補償手段を用いたより複雑なトランスコーダを
有するスイッチング・デバイスを示す。
【００３３】 図6において、トランスコーダは、 − ・ その正の入力は第2の整流子の出力を受取り、その出力がQブロックの入 力に接続される、第一の減算器s1、 ・ その正の入力はQブロックの出力に接続され、逆量子化ブロックDQmの出 力を受取り、その負の入力が第一の減算器の出力に接続される、第二の 減算器s2、 ・ 全てが、第二の減算器の出力と第一の減算器の負の入力の間に直列に接 続されている、逆離散コサイン変換ブロックIDCT、フレームメモリMEM 、動き補償ブロックMCおよび離散コサイン変換ブロックDCT を有する、第二の転換デバイスとエンコーディング・チャンネルの間に接続 されたインターフェース・サブアセンブリ を有する。
【００３４】 図7において、トランスコーダは、 − 図5において記述された2本のデコーディング・チャンネルに加えて、DQ1ま たはDQ2ブロックの出力と第二の転換デバイスの入力AまたはBの間にそれぞ れ接続されている、逆の離散コサイン変換ブロックIDCT1またはIDCT2をもつ デコーディング・チャンネルと、 − 図5において記述されたエンコーディング・チャンネルに加えて、Qブロック の前に離散コサイン変換ブロックDCTを持つエンコーディング・チャンネル と、 − Qブロックの出力に接続され、余分な逆離散コサイン変換ブロックIDCTmが後 続する余分な逆量子化ブロックDQmを有する第三のデコーディング・チャン ネルと、 − ・ その正の入力は第二の転換デバイスの出力を受取り、その出力がDCTブ ロックの入力に接続される、第一の減算器s1、 ・ その正の入力はIDCTmブロックの出力を受取り、その負の入力が第一の 減算器の出力に接続される、第二の減算器s2、 ・ 第二の減算器の出力と第一の減算器の負の入力の間に直列に接続されて いるフレームメモリMEM、および動き補償ブロックMC、 を有する、第二の転換デバイスとエンコーディング・チャンネルとの間に接 続されたインターフェース・サブアセンブリとを 有するトランスコーダである。
【図面の簡単な説明】
【図１】本発明のスイッチング・デバイスに対応するブロック図である。
【図２】再量子化手段だけを用いるトランスコーダを有する、実施例1のスイッ
チング・デバイスに対応するブロック図である。
【図３】動き補償手段を用いるトランスコーダを有する、 実施例1のスイッチン
グ・デバイスに対応するブロック図である。
【図４】改良された動き補償手段を用いるトランスコーダを有する、実施例1の
スイッチング・デバイスに対応するブロック図である。
【図５】 再量子化手段だけを用いたトランスコーディング・システムを有する
、実施例2のスイッチング・デバイスに対応するブロック図である。
【図６】動き補償手段を用いるトランスコーダを有する、実施例2のスイッチン
グ・デバイスに対応するブロック図である。
【図７】改良された動き補償手段を用いるトランスコーダを有する、実施例2の
スイッチング・デバイスに対応するブロック図である。
【符号の説明】
SW スイッチング・デバイス IS1 第一圧縮データ入力ストリーム IS2 第二圧縮データ入力ストリーム OS 圧縮データ出力ストリーム BS バッファ・システム SWR スイッチ要求 COM 転換デバイス CONT コントロール手段 TS トランスコーディング・システム BUF1 第一バッファ BUF2 第二バッファ VLC 可変長コーディング・ブロック VLD 可変長デコーディング・ブロック Q 量子化ブロック DQ 逆量子化ブロック REG 調整手段 TRANS トランスコーダ MEM フレームメモリ MC 動き保証ブロック DCT 離散コサイン変換ブロック IDCT 逆離散コサイン変換ブロック s 減算器 a 加算器 R ビット伝送速度 GOP 一連の画像
───────────────────────────────────────────────────── フロントページの続き Ｆターム(参考） 5C059 MA00 MA05 MA23 MC11 ME01 RB02 SS06 UA02 UA05 UA33 UA34 UA38 【要約の続き】 ステムは、第一入力ストリームのビット伝送速度R1およ び第二入力ストリームのビット伝送速度R2と必ずしも同 じではないビット伝送速度Rで出力ストリームをエンコ ーディングすることを可能にする。

Claims (6)

    【特許請求の範囲】
  1. 【請求項１】 第一圧縮データ入力ストリームから第二圧縮データ入力ストリームへスイッチ
    ングして圧縮データ出力ストリームを発生するためのスイッチング・デバイスで
    あって、 − 前記第一および前記第二入力ストリームに含まれている前記データを記憶す るためのバッファ・システムと、 − スイッチ要求に応じて、転換デバイスを使用して、前記第一入力ストリーム から前記第二入力ストリームへスイッチングを行うために、前記バッファ・ システム内の前記入力ストリームの記憶を制御するためのコントロール手段 と、 − 前記転換デバイスの出力から、継ぎ目なしに前記出力ストリームを提供する ためのトランスコーディング・システムと を有するスイッチング・デバイス。
  2. 【請求項２】 − 前記バッファ・システムが、前記第一および第二入力ストリームのデータを それぞれ記憶するための第一バッファおよび第二バッファを有し、 − 前記トランスコーディング・システムが、1つのトランスコーダを有し、 − 前記転換デバイスが、当該第一バッファが前記第一入力ストリームのM枚の 画像の組の送信を完了し、当該第二バッファが、前記制御手段によって一枚 のIピクチャを送信するよう制御されたときに、前記第一バッファ出力から 前記第二バッファ出力にスイッチングするように制御され、そして − 当該スイッチング・デバイスが、当該Iピクチャを含む前記第二入力ストリ ームのM枚の画像の組のための前方予測を行うことなくBピクチャを生成する ための手段を有する 請求項1に記載のスイッチング・デバイス。
  3. 【請求項３】 − 前記バッファ・システムが、前記第一および第二入力ストリームのデータを それぞれ記憶するための前記第一バッファおよび前記第二バッファを有し、
    − 前記トランスコーディング・システムが、各入力ストリームに関連して、第 一のデコーディング手段および第二のデコーディング手段を有し、 − 前記第一バッファが、前記第一入力ストリームのM枚の画像の組を送信完了 した時に、前記の第一の手段によってデコーディングした後の前記第一入力 ストリームから、前記の第二の手段によってデコーディングした後の前記第 二入力ストリームにスイッチするよう制御され、前記第二バッファは前記の 制御手段によって一枚のIピクチャまたはデコーディング・エンコーディン グ手段を用いてIピクチャに再エンコーディングされた一枚のPピクチャを送 信するよう制御される前記転換デバイスを有し、そして − 当該スイッチング・デバイスが、当該Iピクチャを含む前記第二入力ストリ ームのM枚の画像の組の前方予測を行うことなくBピクチャを生成する手段を 有する 請求項1に記載のスイッチング・デバイス。
  4. 【請求項４】 第一圧縮データ入力ストリームから第二圧縮データ入力ストリームへスイッチ
    ングして圧縮されたデータ出力ストリームを得る方法であって、 − 前記第一および前記第二入力ストリームに含まれる前記データを記憶するバ ッファリング・ステップと、 − 前記バッファリングステップの間に、スイッチング要求に応じて前記第一入 力ストリームから前記第二入力ストリームへスイッチングを行うための、前 記入力ストリームの記憶のコントロール・テップと、 − 継ぎ目なしに前記出力ストリームを提供するために、前記コントロール・ス テップによって提供されるストリームのトランスコーディング・ステップと
    を有するスイッチング方法。
  5. 【請求項５】 − 前記トランスコーディングステップが、1本のトランスコーディング・チャ ンネルを有し、 − 前記トランスコーディングステップが、前記バッファリングステップが前記 第一入力ストリームのM枚の画像の組の送信を完了したとき、前記バッファ リング・ステップが一枚のIピクチャを送信するよう制御されており、スイ ッチング要求に応じて、前記第一入力ストリームから前記第二入力ストリー ムにスイッチングすることを可能にし、そして − 当該スイッチング方法が、当該Iピクチャを含む前記第二入力ストリームのM 枚の画像の組のための前方予測を行うことなくBピクチャを生成する1ステッ プと を有する請求項4に記載のスイッチング方法。
  6. 【請求項６】 − 前記トランスコーディング・ステップが、前記第一入力ストリームをデコー ディングする第一のサブステップ、および前記第二入力ストリームをデコー ディングする第二のサブステップを有し、 − 前記コントロール・ステップが、前記バッファリング・ステップが前記第一 入力ストリームのM枚の画像の組の送信を完了した時に、前記バッファリン グ・ステップが、一枚のIピクチャ、またはデコーディング・エンコーディ ング・ステップを用いてIピクチャに再エンコーディングされたPピクチャを 送信するよう制御されており、スイッチング要求に応じて、前記第一入力ス トリームから前記第二入力ストリームにスイッチングすることを可能にし、 そして − 当該スイッチング方法が、当該Iピクチャを含む前記第二入力ストリームのM 枚の画像の組のための前方予測を行うことなくBピクチャを生成するステッ プと を有する請求項4に記載のスイッチング方法。
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