JP2003308061A - 画像表示装置 - Google Patents
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- JP2003308061A JP2003308061A JP2002112252A JP2002112252A JP2003308061A JP 2003308061 A JP2003308061 A JP 2003308061A JP 2002112252 A JP2002112252 A JP 2002112252A JP 2002112252 A JP2002112252 A JP 2002112252A JP 2003308061 A JP2003308061 A JP 2003308061A
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Abstract
(57)【要約】
【課題】 従来の画像表示装置では書き込みと読み出し
が非同期なので、フレームメモリへの映像信号を書き込
み中に読み出しを行うと表示するフレームの切替がきれ
いに行えず、フレームの途中で表示が切り替わる問題が
発生していた。 【解決手段】 映像信号が書き込まれ且つ読み出される
フレームメモリと該フレームメモリからの前記映像信号
をＤＡ変換してディスプレイに画像表示する画像表示装
置において、前記フレームメモリを外部同期信号で制御
し、前記外部同期信号およびイネーブル信号があるとき
に前記画像信号の書き込み間欠的に行い、前記外部同期
信号毎に記憶された前記映像信号の読み出しを行うこと
を特徴としている。
が非同期なので、フレームメモリへの映像信号を書き込
み中に読み出しを行うと表示するフレームの切替がきれ
いに行えず、フレームの途中で表示が切り替わる問題が
発生していた。 【解決手段】 映像信号が書き込まれ且つ読み出される
フレームメモリと該フレームメモリからの前記映像信号
をＤＡ変換してディスプレイに画像表示する画像表示装
置において、前記フレームメモリを外部同期信号で制御
し、前記外部同期信号およびイネーブル信号があるとき
に前記画像信号の書き込み間欠的に行い、前記外部同期
信号毎に記憶された前記映像信号の読み出しを行うこと
を特徴としている。
Description
【０００１】
【発明の属する技術分野】本発明は画像表示装置に関
し、特に薄膜トランジスタ（TFT）を用いてエレクトロ
ルミネッセンス（ＥＬ）素子を駆動するアクティブ型の
有機ＥＬをディスプレイとして用いた画像表示装置に関
する。
し、特に薄膜トランジスタ（TFT）を用いてエレクトロ
ルミネッセンス（ＥＬ）素子を駆動するアクティブ型の
有機ＥＬをディスプレイとして用いた画像表示装置に関
する。
【０００２】
【従来の技術】図７を参照して、従来の画像表示装置を
説明する。
説明する。
【０００３】１はフレームメモリ、２は内部発振器、３
はＤＡＣ、４は有機ＥＬ等のディスプレイである。この
フレームメモリ１への映像信号の書き込みは外部同期信
号および外部クロック信号により制御されており、２０
フレーム／秒で行われている。
はＤＡＣ、４は有機ＥＬ等のディスプレイである。この
フレームメモリ１への映像信号の書き込みは外部同期信
号および外部クロック信号により制御されており、２０
フレーム／秒で行われている。
【０００４】一方、フレームメモリ１からの映像信号の
読み出しは内部発振器２から作られる内部同期信号およ
び内部クロック信号により制御されており、ディスプレ
イの駆動にあった６０フレーム／秒のフレーム周波数で
行われている。フレームメモリ１から読み出された映像
信号はＤＡＣ３でアナログ信号に変換されて、有機ＥＬ
等のディスプレイ４で画像表示される。
読み出しは内部発振器２から作られる内部同期信号およ
び内部クロック信号により制御されており、ディスプレ
イの駆動にあった６０フレーム／秒のフレーム周波数で
行われている。フレームメモリ１から読み出された映像
信号はＤＡＣ３でアナログ信号に変換されて、有機ＥＬ
等のディスプレイ４で画像表示される。
【０００５】従って、上述した従来の画像表示装置で
は、書き込みは外部クロック信号で制御して行われ、読
み出しは内部クロック信号で制御して行われるので、書
き込みと読み出しが非同期のシステムとなっている。
は、書き込みは外部クロック信号で制御して行われ、読
み出しは内部クロック信号で制御して行われるので、書
き込みと読み出しが非同期のシステムとなっている。
【０００６】
【発明が解決しようとする課題】しかしながら、従来の
画像表示装置では書き込みと読み出しが非同期なので、
フレームメモリ１への映像信号を書き込み中に読み出し
を行うと表示するフレームの切替がきれいに行えず、フ
レームの途中で次のフレームに切り替わる問題が発生し
ていた。
画像表示装置では書き込みと読み出しが非同期なので、
フレームメモリ１への映像信号を書き込み中に読み出し
を行うと表示するフレームの切替がきれいに行えず、フ
レームの途中で次のフレームに切り替わる問題が発生し
ていた。
【０００７】
【課題を解決するための手段】本発明は上記課題を解決
するためになされたものであり、映像信号が書き込まれ
且つ読み出されるフレームメモリと該フレームメモリか
らの前記映像信号をＤＡ変換してディスプレイに画像表
示する画像表示装置において、前記フレームメモリを外
部同期信号で制御し、前記外部同期信号およびイネーブ
ル信号があるときに前記画像信号の書き込み間欠的に行
い、前記外部同期信号毎に記憶された前記映像信号の読
み出しを行うことを特徴としている。
するためになされたものであり、映像信号が書き込まれ
且つ読み出されるフレームメモリと該フレームメモリか
らの前記映像信号をＤＡ変換してディスプレイに画像表
示する画像表示装置において、前記フレームメモリを外
部同期信号で制御し、前記外部同期信号およびイネーブ
ル信号があるときに前記画像信号の書き込み間欠的に行
い、前記外部同期信号毎に記憶された前記映像信号の読
み出しを行うことを特徴としている。
【０００８】
【発明の実施の形態】図１を参照して、本発明の画像表
示装置を説明する。
示装置を説明する。
【０００９】１１はフレームメモリ、１３はＤＡＣ、１
４は有機ＥＬ等のディスプレイである。本発明では、こ
のフレームメモリ１１への映像信号の書き込みおよび読
み出しは外部同期信号および外部クロック信号により制
御されているのが特徴である。
４は有機ＥＬ等のディスプレイである。本発明では、こ
のフレームメモリ１１への映像信号の書き込みおよび読
み出しは外部同期信号および外部クロック信号により制
御されているのが特徴である。
【００１０】フレームメモリ１１は有機ＥＬ等のディス
プレイ１４の水平方向の画素数と垂直方向の行数に対応
するメモリ領域を有する画像メモリである。フレームメ
モリとしてはＳＲＡＭ、ＤＲＡＭ、フラッシュメモリ等
が使用可能であるが、動作速度、動作電圧の観点からＳ
ＲＡＭが最適である。後述する外部同期信号よりもリフ
レッシュ期間が十分に長ければＤＲＡＭでも良い。
プレイ１４の水平方向の画素数と垂直方向の行数に対応
するメモリ領域を有する画像メモリである。フレームメ
モリとしてはＳＲＡＭ、ＤＲＡＭ、フラッシュメモリ等
が使用可能であるが、動作速度、動作電圧の観点からＳ
ＲＡＭが最適である。後述する外部同期信号よりもリフ
レッシュ期間が十分に長ければＤＲＡＭでも良い。
【００１１】ＤＡＣ１３はフレームメモリ１１からの映
像信号の読み出しに際して、デジタル信号の映像信号を
アナログ映像信号に変換して有機ＥＬ等のディスプレイ
１４に出力して画像の表示を行う。
像信号の読み出しに際して、デジタル信号の映像信号を
アナログ映像信号に変換して有機ＥＬ等のディスプレイ
１４に出力して画像の表示を行う。
【００１２】有機ＥＬ等のディスプレイ１４は図４から
図６を参照して説明する。
図６を参照して説明する。
【００１３】図４は、１画素当たりの回路構成を示して
おり、有機ＥＬ素子３０と、ドレインに表示信号Dataが
印加され、ゲートに印加される選択信号Scanによりオン
オフするスイッチング用の第１のＴＦＴ３１と、ＴＦＴ
３１のオン時に供給される表示信号Dataにより充電さ
れ、ＴＦＴ３１のオフ時には充電電圧Vhを保持するコン
デンサ３２と、ドレインが駆動電源電圧COMに接続さ
れ、ソースが有機ＥＬ素子３０の陽極に接続されると共
に、ゲートにコンデンサ３２からの保持電圧Vhが供給さ
れることにより有機ＥＬ素子３０を駆動する第２のＴＦ
Ｔ３３とによって構成されている。
おり、有機ＥＬ素子３０と、ドレインに表示信号Dataが
印加され、ゲートに印加される選択信号Scanによりオン
オフするスイッチング用の第１のＴＦＴ３１と、ＴＦＴ
３１のオン時に供給される表示信号Dataにより充電さ
れ、ＴＦＴ３１のオフ時には充電電圧Vhを保持するコン
デンサ３２と、ドレインが駆動電源電圧COMに接続さ
れ、ソースが有機ＥＬ素子３０の陽極に接続されると共
に、ゲートにコンデンサ３２からの保持電圧Vhが供給さ
れることにより有機ＥＬ素子３０を駆動する第２のＴＦ
Ｔ３３とによって構成されている。
【００１４】選択信号Scanは、選択された１水平走査期
間（１Ｈ）中Ｈレベルになり、これによってＴＦＴ３１
がオンすると、表示信号Dataがコンデンサ３２の一端に
供給され、表示信号Dataに応じた電圧Vhがコンデンサ３
２に充電される。この電圧Vhは、ScanがＬレベルになっ
てＴＦＴ３１がオフになっても、１垂直走査（１Ｖ）期
間コンデンサ３２に保持され続ける。そして、この電圧
VhがＴＦＴ３３のゲートに供給されているので、電圧Vh
に応じた輝度でＥＬ素子が発光するように制御される。
間（１Ｈ）中Ｈレベルになり、これによってＴＦＴ３１
がオンすると、表示信号Dataがコンデンサ３２の一端に
供給され、表示信号Dataに応じた電圧Vhがコンデンサ３
２に充電される。この電圧Vhは、ScanがＬレベルになっ
てＴＦＴ３１がオフになっても、１垂直走査（１Ｖ）期
間コンデンサ３２に保持され続ける。そして、この電圧
VhがＴＦＴ３３のゲートに供給されているので、電圧Vh
に応じた輝度でＥＬ素子が発光するように制御される。
【００１５】そこで、このようなアクティブ型のＥＬ表
示装置において、ＲＧＢの３原色毎に発光層に異なる発
光材料を使用することによりカラー表示を実現する構成
について、以下説明する。
示装置において、ＲＧＢの３原色毎に発光層に異なる発
光材料を使用することによりカラー表示を実現する構成
について、以下説明する。
【００１６】図５は構成を示す平面図、図６は図５にお
けるＣ−Ｃ線に沿った断面図であり、ＲＧＢの３画素を
示している。
けるＣ−Ｃ線に沿った断面図であり、ＲＧＢの３画素を
示している。
【００１７】図５、６において、５０は表示信号Dataを
供給するドレインライン、５１は電源電圧COMを供給す
る電源ライン、５２は選択信号Scanを供給するゲートラ
インであり、５３が図４の第１のＴＦＴ３１、５４が図
４のコンデンサ３２、５５が図４の第２のＴＦＴ３３、
５６が画素電極を構成するＥＬ素子３０の陽極を表して
いる。陽極５６は平坦化絶縁膜６０上に各画素毎に分離
して形成されており、その上にホール輸送層６１，発光
層６２，電子輸送層６３，陰極６４が順に積層されるこ
とにより、ＥＬ素子が形成されている。そして、陽極５
６から注入されたホールと陰極６４から注入された電子
とが発光層６２の内部で再結合することにより光が放た
れ、この光が図６の矢印で示すように透明な陽極側から
外部へ放射される。また、ホール輸送層６１，発光層６
２，電子輸送層６３は陽極５６とほぼ同様の形状に画素
毎に分離して形成され、発光層６２はＲＧＢ毎に異なる
発光材料を使用することにより、ＲＧＢの各光が各ＥＬ
素子から発光される。陰極６４は、各画素に共通の電圧
を印加するので、各画素にわたって延在している。発光
層６２同士の間は隔壁６８によって仕切られている。
尚、６５は透明なガラス基板、６６はゲート絶縁膜、６
７は層間絶縁膜である。
供給するドレインライン、５１は電源電圧COMを供給す
る電源ライン、５２は選択信号Scanを供給するゲートラ
インであり、５３が図４の第１のＴＦＴ３１、５４が図
４のコンデンサ３２、５５が図４の第２のＴＦＴ３３、
５６が画素電極を構成するＥＬ素子３０の陽極を表して
いる。陽極５６は平坦化絶縁膜６０上に各画素毎に分離
して形成されており、その上にホール輸送層６１，発光
層６２，電子輸送層６３，陰極６４が順に積層されるこ
とにより、ＥＬ素子が形成されている。そして、陽極５
６から注入されたホールと陰極６４から注入された電子
とが発光層６２の内部で再結合することにより光が放た
れ、この光が図６の矢印で示すように透明な陽極側から
外部へ放射される。また、ホール輸送層６１，発光層６
２，電子輸送層６３は陽極５６とほぼ同様の形状に画素
毎に分離して形成され、発光層６２はＲＧＢ毎に異なる
発光材料を使用することにより、ＲＧＢの各光が各ＥＬ
素子から発光される。陰極６４は、各画素に共通の電圧
を印加するので、各画素にわたって延在している。発光
層６２同士の間は隔壁６８によって仕切られている。
尚、６５は透明なガラス基板、６６はゲート絶縁膜、６
７は層間絶縁膜である。
【００１８】続いて、図１および図２を参照して本発明
の画像表示装置の映像信号の書き込みおよび読み出し動
作の説明をする。
の画像表示装置の映像信号の書き込みおよび読み出し動
作の説明をする。
【００１９】このフレームメモリ１１への映像信号の書
き込みは外部同期信号および外部クロック信号により制
御されており、イネーブル信号がある時に間欠的に行わ
れる。一方、フレームメモリ１１からの映像信号の読み
出しはタイミングコントローラ１８が作成する内部同期
信号および内部クロック信号により制御されており、デ
ィスプレイの駆動にあった６０フレーム／秒のフレーム
周波数で行われている。フレームメモリ１１から読み出
された映像信号はＤＡＣ３でアナログ信号に変換され
て、有機ＥＬ等のディスプレイ１４で画像表示される。
書き込みと読み出しが同期するシステムとなっているの
が特徴である。
き込みは外部同期信号および外部クロック信号により制
御されており、イネーブル信号がある時に間欠的に行わ
れる。一方、フレームメモリ１１からの映像信号の読み
出しはタイミングコントローラ１８が作成する内部同期
信号および内部クロック信号により制御されており、デ
ィスプレイの駆動にあった６０フレーム／秒のフレーム
周波数で行われている。フレームメモリ１１から読み出
された映像信号はＤＡＣ３でアナログ信号に変換され
て、有機ＥＬ等のディスプレイ１４で画像表示される。
書き込みと読み出しが同期するシステムとなっているの
が特徴である。
【００２０】まず、映像信号の書き込み動作の説明をす
ると、外部から垂直同期信号Vsync、水平同期信号Hsyn
c、ドットクロック信号Dotclkとデジタル映像信号であ
る画像データが入力されている。垂直同期信号Vsync、
水平同期信号Hsync、ドットクロック信号Dotclkはライ
トアドレス制御回路に入力され、フレームメモリ１１の
対応する領域のアドレスを生成して、フレームメモリ１
１にフレーム単位の画像データの書き込みを行う。すな
わち、垂直同期信号Vsyncの立ち上がりによりフレーム
パルスを発生させて、水平同期信号Hsyncに同期して１
Ｈ期間の画像データを書き込み、画素の行数分の１Ｈ期
間の画像データを次々に書き込んで１フレーム分の画像
データの書き込みを完了する。
ると、外部から垂直同期信号Vsync、水平同期信号Hsyn
c、ドットクロック信号Dotclkとデジタル映像信号であ
る画像データが入力されている。垂直同期信号Vsync、
水平同期信号Hsync、ドットクロック信号Dotclkはライ
トアドレス制御回路に入力され、フレームメモリ１１の
対応する領域のアドレスを生成して、フレームメモリ１
１にフレーム単位の画像データの書き込みを行う。すな
わち、垂直同期信号Vsyncの立ち上がりによりフレーム
パルスを発生させて、水平同期信号Hsyncに同期して１
Ｈ期間の画像データを書き込み、画素の行数分の１Ｈ期
間の画像データを次々に書き込んで１フレーム分の画像
データの書き込みを完了する。
【００２１】図２を参照すれば、垂直同期信号Vsyncの
１パルスが１フレームに対応しており、イネーブル信号
は垂直同期信号Vsyncの３パルスに対して最初のパルス
で出力される。このイネーブル信号がある期間にライト
アドレス回路１５からのライトアドレスがセレクタ回路
１７を通り、フレームメモリ１１に入力され、フレーム
メモリ１１の対応する領域に画像データが書き込まれ
る。
１パルスが１フレームに対応しており、イネーブル信号
は垂直同期信号Vsyncの３パルスに対して最初のパルス
で出力される。このイネーブル信号がある期間にライト
アドレス回路１５からのライトアドレスがセレクタ回路
１７を通り、フレームメモリ１１に入力され、フレーム
メモリ１１の対応する領域に画像データが書き込まれ
る。
【００２２】画像データはイネーブル信号のない２パル
ス期間の垂直同期信号Vsyncでは書き込まれず、画像デ
ータが２０フレーム／秒で生成されるのに合わせて、間
欠的な書き込みが行われる。
ス期間の垂直同期信号Vsyncでは書き込まれず、画像デ
ータが２０フレーム／秒で生成されるのに合わせて、間
欠的な書き込みが行われる。
【００２３】次に、映像信号の読み出し動作の説明をす
ると、外部からの垂直同期信号Vsync、水平同期信号Hsy
nc、ドットクロック信号Do tclkはリードアドレス回路
１６にも入力され、フレームメモリ１１の対応する領域
のアドレスを生成して、フレームメモリ１１にフレーム
単位の画像データの読み出しを行う。すなわち、垂直同
期信号Vsyncの立ち上がりによりフレームパルスを発生
させて、水平同期信号Hsyncに同期して１Ｈ期間の画像
データを読み出し、画素の行数分の１Ｈ期間の画像デー
タを次々に読み出し、１フレーム分の画像の読み出しを
行う。
ると、外部からの垂直同期信号Vsync、水平同期信号Hsy
nc、ドットクロック信号Do tclkはリードアドレス回路
１６にも入力され、フレームメモリ１１の対応する領域
のアドレスを生成して、フレームメモリ１１にフレーム
単位の画像データの読み出しを行う。すなわち、垂直同
期信号Vsyncの立ち上がりによりフレームパルスを発生
させて、水平同期信号Hsyncに同期して１Ｈ期間の画像
データを読み出し、画素の行数分の１Ｈ期間の画像デー
タを次々に読み出し、１フレーム分の画像の読み出しを
行う。
【００２４】図２を参照すれば、垂直同期信号Vsyncの
１パルスが１フレームに対応しており、垂直同期信号Vs
ync毎に１フレームの画像データが出力される。リード
アドレス回路１６からのリードアドレスがセレクタ回路
１７を通り、フレームメモリ１１に入力され、フレーム
メモリ１１の対応する領域に画像データが読み出され
る。従って、イネーブル信号がある時にフレームメモリ
１１に書き込まれた画像データは垂直同期信号Vsync毎
に同じ画像データが３回読み出される。従って、書き込
みと読み出しが同じ外部から垂直同期信号Vsync、水平
同期信号Hsync、ドットクロック信号Dotclkで制御され
るので、各フレームの切替ずれが発生せず、綺麗な連続
表示を行える。
１パルスが１フレームに対応しており、垂直同期信号Vs
ync毎に１フレームの画像データが出力される。リード
アドレス回路１６からのリードアドレスがセレクタ回路
１７を通り、フレームメモリ１１に入力され、フレーム
メモリ１１の対応する領域に画像データが読み出され
る。従って、イネーブル信号がある時にフレームメモリ
１１に書き込まれた画像データは垂直同期信号Vsync毎
に同じ画像データが３回読み出される。従って、書き込
みと読み出しが同じ外部から垂直同期信号Vsync、水平
同期信号Hsync、ドットクロック信号Dotclkで制御され
るので、各フレームの切替ずれが発生せず、綺麗な連続
表示を行える。
【００２５】
【発明の効果】本発明によれば、映像信号が書き込まれ
且つ読み出されるフレームメモリと該フレームメモリか
らの前記映像信号をＤＡ変換してディスプレイに画像表
示する画像表示装置において、前記フレームメモリを外
部同期信号で制御し、前記外部同期信号およびイネーブ
ル信号があるときに前記画像信号の書き込みを間欠的に
行い、前記外部同期信号毎に記憶された前記映像信号の
読み出しを行うことにより、外部同期信号に合わせてフ
レームメモリを駆動でき、表示フレームの切換にずれが
なく、綺麗な連続表示を可能にする。
且つ読み出されるフレームメモリと該フレームメモリか
らの前記映像信号をＤＡ変換してディスプレイに画像表
示する画像表示装置において、前記フレームメモリを外
部同期信号で制御し、前記外部同期信号およびイネーブ
ル信号があるときに前記画像信号の書き込みを間欠的に
行い、前記外部同期信号毎に記憶された前記映像信号の
読み出しを行うことにより、外部同期信号に合わせてフ
レームメモリを駆動でき、表示フレームの切換にずれが
なく、綺麗な連続表示を可能にする。
【００２６】また、間欠的に書き込みを行うのでイネー
ブル信号のない期間は書き込みを停止でき、画像データ
を作るシステム側のＩＣの消費電力を低減できる。
ブル信号のない期間は書き込みを停止でき、画像データ
を作るシステム側のＩＣの消費電力を低減できる。
【図１】本発明の画像表示装置を説明するブロック図で
ある。
ある。
【図２】本発明の画像表示装置を更に具体的に説明する
ブロック図である。
ブロック図である。
【図３】本発明の画像表示装置の動作原理を説明するパ
ルス波形図である。
ルス波形図である。
【図４】本発明の画像表示装置に用いる有機ＥＬパネル
を説明する回路図である。
を説明する回路図である。
【図５】本発明の画像表示装置に用いる有機ＥＬパネル
を説明する上面図である。
を説明する上面図である。
【図６】本発明の画像表示装置に用いる有機ＥＬパネル
を説明する断面図である。
を説明する断面図である。
【図７】従来の画像表示装置を説明するブロック図であ
る。
る。
─────────────────────────────────────────────────────
フロントページの続き
Ｆターム(参考） 3K007 AB17 BA06 BB07 DB03 GA00
5C080 AA06 BB05 DD08 DD09 EE26
FF11 GG02 JJ02 JJ03 JJ04
JJ06
5C082 BB15 BB22 BC03 CA85 DA54
DA55 DA64 DA65 EA18 MM02
Claims (2)
- 【請求項１】 映像信号が書き込まれ且つ読み出される
フレームメモリと該フレームメモリからの前記映像信号
をＤＡ変換してディスプレイに画像表示する画像表示装
置において、前記フレームメモリを外部同期信号で制御
し、前記外部同期信号およびイネーブル信号があるとき
に前記画像信号の書き込みを間欠的に行い、前記外部同
期信号毎に記憶された前記映像信号の読み出しを行うこ
とを特徴とする画像表示装置。 - 【請求項２】 前記外部同期信号は垂直同期信号、水平
同期信号およびドットクロック信号とで構成され、これ
らをライトアドレス回路あるいはリードアドレス回路に
入力することを特徴とする請求項１に記載の画像表示装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2002112252A JP2003308061A (ja) | 2002-04-15 | 2002-04-15 | 画像表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2002112252A JP2003308061A (ja) | 2002-04-15 | 2002-04-15 | 画像表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2003308061A true JP2003308061A (ja) | 2003-10-31 |
Family
ID=29394810
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2002112252A Pending JP2003308061A (ja) | 2002-04-15 | 2002-04-15 | 画像表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2003308061A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2013076855A (ja) * | 2011-09-30 | 2013-04-25 | Mitsubishi Electric Corp | 映像信号処理装置 |
| CN103680402A (zh) * | 2013-09-11 | 2014-03-26 | 富顺光电科技股份有限公司 | 一种基于leon3软核cpu的异步全彩led显示控制系统 |
| JP2018205457A (ja) * | 2017-06-01 | 2018-12-27 | 株式会社Ｊｏｌｅｄ | 表示パネルの制御装置、表示装置および表示パネルの駆動方法 |
-
2002
- 2002-04-15 JP JP2002112252A patent/JP2003308061A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2013076855A (ja) * | 2011-09-30 | 2013-04-25 | Mitsubishi Electric Corp | 映像信号処理装置 |
| CN103680402A (zh) * | 2013-09-11 | 2014-03-26 | 富顺光电科技股份有限公司 | 一种基于leon3软核cpu的异步全彩led显示控制系统 |
| CN103680402B (zh) * | 2013-09-11 | 2015-12-23 | 富顺光电科技股份有限公司 | 一种基于leon3软核cpu的异步全彩led显示控制系统及其控制方法 |
| JP2018205457A (ja) * | 2017-06-01 | 2018-12-27 | 株式会社Ｊｏｌｅｄ | 表示パネルの制御装置、表示装置および表示パネルの駆動方法 |
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