JP2003063046A - Driving arrangement of printer - Google Patents

Driving arrangement of printer

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JP2003063046A
JP2003063046A JP2001252436A JP2001252436A JP2003063046A JP 2003063046 A JP2003063046 A JP 2003063046A JP 2001252436 A JP2001252436 A JP 2001252436A JP 2001252436 A JP2001252436 A JP 2001252436A JP 2003063046 A JP2003063046 A JP 2003063046A
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Japan
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output
printer
transistor
circuit
data
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JP2001252436A
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Japanese (ja)
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Katsuya Ogura
勝也 小倉
Kenzo Kanedo
健三 鐘堂
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Rohm Co Ltd
Original Assignee
Rohm Co Ltd
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Publication date
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Abstract

PROBLEM TO BE SOLVED: To easily and inexpensively provide a driving arrangement of a printer having stable print quality and minimal failure. SOLUTION: The driving arrangement of the printer which prints characters and images consisting of a plurality of dots based on control signals and data from a control device is provided with a plurality of latch circuits storing data, a plurality of gate circuits outputting the output from a plurality of respective latch circuits based on control signals, and a plurality of output transistors driving respective resistor elements for formation of a plurality of dots in accordance with the output from the gate circuits. In the plurality of gate circuits, the driving capabilities of MOS transistors operating based on the control signals in the MOS transistors composing of the gate circuits are formed smaller than driving capabilities of MOS transistors being operated based on data.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】本発明はプリンタの駆動装置
に関し、詳しくはその回路構成に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a printer drive device, and more particularly to a circuit configuration thereof.

【0002】[0002]

【従来の技術】図3は、サーマルプリンタの駆動装置と
して、従来から用いられている駆動装置200とその応
用回路を示している。図3において、R1乃至Rnは発
熱体としての抵抗、E1は各抵抗に電流を流すための外
部電源、DO1乃至DOnは各抵抗につながる出力端
子、SIはシリアルデータの入力端子、CKはクロック
信号の入力端子、ENは制御信号の入力端子、L1乃至
Lnはシリアルデータのラッチ回路、NG1乃至NGn
はNORゲート回路、T1乃至TnはNチャネル型のM
OSトランジスタ(以下「NMOS」と略す)からなる
出力トランジスタを示している。また、点線で接続を示
すコンデンサC1乃至Cnは、各ゲート回路NGnの出
力の拡散容量や各出力トランジスタTnの入力ゲート容
量や配線容量等からなる寄生容量を示している。尚、ラ
ッチ回路(L)とゲート回路(NG)と出力トランジス
タ(T)とからなるドット毎の単位回路をBL1乃至B
Lnとして点線で囲っている。
2. Description of the Related Art FIG. 3 shows a driving device 200 and its application circuit which have been conventionally used as a driving device for a thermal printer. In FIG. 3, R1 to Rn are resistors as heating elements, E1 is an external power supply for flowing a current through each resistor, DO1 to DOn are output terminals connected to each resistor, SI is an input terminal for serial data, and CK is a clock signal. , EN is a control signal input terminal, L1 to Ln are serial data latch circuits, and NG1 to NGn.
Is a NOR gate circuit, T1 to Tn are N-channel type M
An output transistor including an OS transistor (hereinafter abbreviated as “NMOS”) is shown. Capacitors C1 to Cn, which are connected by dotted lines, represent parasitic capacitances such as the diffusion capacitance of the output of each gate circuit NGn, the input gate capacitance of each output transistor Tn, and the wiring capacitance. It should be noted that the dot unit circuits each including a latch circuit (L), a gate circuit (NG), and an output transistor (T) are BL1 to B.
It is surrounded by a dotted line as Ln.

【0003】そして、クロック信号CKは各ラッチ回路
Lのクロック入力Cにそれぞれ接続され、シリアルデー
タ入力SIはラッチ回路L1のデータ入力Dに接続さ
れ、ラッチ回路Lm(mはn以下の自然数)のデータ出
力Qはラッチ回路L(m+1)のデータ入力Dに接続さ
れるとともに各ゲート回路NGmの一方の入力に接続さ
れ、各ゲート回路NGmの他方の入力には制御信号の入
力端子ENがそれぞれ接続され、各ゲート回路NGmの
出力は各出力トランジスタTmのゲート入力に接続さ
れ、各出力トランジスタTmのソースは基準電位(GN
D)に接続され、そのドレインは各出力端子DOmにそ
れぞれ接続されている。
The clock signal CK is connected to the clock input C of each latch circuit L, the serial data input SI is connected to the data input D of the latch circuit L1, and the latch circuit Lm (m is a natural number of n or less). The data output Q is connected to the data input D of the latch circuit L (m + 1) and to one input of each gate circuit NGm, and the control signal input terminal EN is connected to the other input of each gate circuit NGm. The output of each gate circuit NGm is connected to the gate input of each output transistor Tm, and the source of each output transistor Tm has a reference potential (GN
D), and its drain is connected to each output terminal DOm.

【0004】このような構成により、各ラッチ回路Ln
に記憶されたシリアルデータに基づいて必要な抵抗Rn
に所定の電流を流して発熱させることにより印字が行わ
れるようになっている。尚、シリアルデータの転送や階
調表示等の動作については、本発明と直接は関係しない
ので、特開平5−57945号の第9図等に示された同
様なプリンタ装置に用いる発熱体通電制御回路の説明を
参考とすることで、説明を省略する。
With such a configuration, each latch circuit Ln
The required resistance Rn based on the serial data stored in
Printing is performed by causing a predetermined current to flow to generate heat. Since operations such as serial data transfer and gradation display are not directly related to the present invention, heating element energization control used in a similar printer device shown in FIG. 9 of JP-A-5-57945 is used. The description of the circuit is omitted by referring to the description of the circuit.

【0005】[0005]

【発明が解決しようとする課題】ところで、上述したサ
ーマルプリンタの駆動装置は、外部電源E1により印加
される電圧(約24V)が駆動装置200に印加する電
源電圧(VDD=約5V)に比べて高電圧なので、各出力
端子DOnと電源電圧VDDとの間に保護ダイオード等の
保護回路を設けることはできなかった。従って、多数の
出力トランジスタを導通(オン状態)させてそれらの出
力端子DOnを低レベルにした後に制御信号ENを高レ
ベルにすることにより各出力端子を一斉に非導通(オフ
状態)にして各端子電圧を高レベルにした場合に、今ま
で各抵抗に流れていた電流が同時且つ急激に遮断される
ことにより各出力端子DOnの電圧が電源E1よりも大
幅に高い電圧(約35V)に持ち上がってしまうことが
ある。これにより、出力トランジスタTnの特性が劣化
したり電流制御が不能な状態に陥ったりすることがあ
り、印字ムラを生じて印刷品位が低下してしまうことが
ある。また、最悪の場合には、出力トランジスタが破壊
して正常な印字を行えなくなってしまうことさえもあっ
た。
By the way, in the above-described drive device for the thermal printer, the voltage (about 24 V) applied by the external power source E1 is higher than the power supply voltage (VDD = about 5 V) applied to the drive device 200. Since it is a high voltage, it is impossible to provide a protection circuit such as a protection diode between each output terminal DOn and the power supply voltage VDD. Therefore, by making a large number of output transistors conductive (ON state) and setting their output terminals DOn to a low level and then making the control signal EN high level, all output terminals are made non-conductive (OFF state) at the same time. When the terminal voltage is set to a high level, the currents flowing through the resistors are simultaneously and rapidly cut off, so that the voltage at each output terminal DOn rises to a voltage (about 35V) significantly higher than the power source E1. It may happen. As a result, the characteristics of the output transistor Tn may be deteriorated or the current may not be controlled, which may result in uneven printing and deteriorate the printing quality. Further, in the worst case, the output transistor may be destroyed and normal printing may not be performed.

【0006】そこで本発明はこれらの問題を解決し、印
刷品位の安定した故障の少ないプリンタの駆動装置を容
易且つ安価に提供することを目的とする。
SUMMARY OF THE INVENTION Therefore, an object of the present invention is to solve these problems, and to provide a printer driving device with stable printing quality and less troubles easily and at low cost.

【0007】[0007]

【課題を解決するための手段】上述の問題を解決するた
めに、請求項1の記載に係わるプリンタの駆動装置は、
制御装置からの制御信号及びデータに基づいて複数のド
ットからなる文字や画像を印刷するためのプリンタの駆
動装置であって、該プリンタの駆動装置は、前記データ
を記憶する複数のラッチ回路と、該複数のラッチ回路の
出力を前記制御信号に基づいて前記出力トランジスタに
それぞれ出力する複数のゲート回路と、該ゲート回路か
らの出力に応じて前記複数のドットの形成素子をそれぞ
れ駆動する複数の出力トランジスタと、を有し、前記複
数のゲート回路は、該ゲート回路を構成するMOSトラ
ンジスタの内前記制御信号に基づいて動作するMOSト
ランジスタの駆動能力が前記データに基づいて動作する
MOSトランジスタの駆動能力よりも小さいことを特徴
とする。また、請求項2に記載のプリンタの駆動装置
は、請求項1に記載のものにおいて、前記制御信号に基
づいて動作するMOSトランジスタは、前期複数のゲー
ト回路に共通に設けられた駆動能力の小さい共通トラン
ジスタを含むことを特徴とする。
In order to solve the above-mentioned problems, a driving device for a printer according to a first aspect of the present invention comprises:
A drive device for a printer for printing a character or an image composed of a plurality of dots based on a control signal and data from a control device, wherein the drive device for the printer comprises a plurality of latch circuits for storing the data, A plurality of gate circuits that respectively output the outputs of the plurality of latch circuits to the output transistors based on the control signal, and a plurality of outputs that respectively drive the plurality of dot forming elements according to the outputs from the gate circuits. A plurality of gate circuits, the drive capability of a MOS transistor that operates based on the control signal among the MOS transistors that form the gate circuit, and the drive capability of a MOS transistor that operates based on the data. It is characterized by being smaller than. A printer driving device according to a second aspect of the present invention is the printer driving device according to the first aspect, wherein the MOS transistor that operates based on the control signal has a small driving capability that is commonly provided to a plurality of gate circuits. It is characterized by including a common transistor.

【0008】[0008]

【作用】 本発明のような構成をとることにより、制御
信号により多数の出力状態が一斉に変化するような場合
には、各ゲート回路の出力の駆動能力がシリアルデータ
に基づいて変化しているときの出力の駆動能力よりも小
さくなり、各ゲート回路NGnのオン抵抗と各寄生容量
Cnとの時定数が大きくなって、各出力トランジスタT
nが緩やかにオフ状態になるようになる。即ち、制御信
号により多数の出力端子の出力状態が一斉に変化する場
合には、ラッチしたシリアルデータに基づいて出力状態
が個々に変化しているときよりも緩やかに変化するよう
になるとともに、外部電源の電圧の持ち上がりを抑えら
れるようになる。
With the configuration of the present invention, when a large number of output states are changed all at once by a control signal, the output driving capability of each gate circuit is changed based on the serial data. The output driving power becomes smaller than the output driving capacity at that time, the time constant between the ON resistance of each gate circuit NGn and each parasitic capacitance Cn becomes large, and each output transistor T
n is gradually turned off. That is, when the output states of a large number of output terminals are changed all at once by the control signal, the output states are changed more slowly than when the output states are individually changed based on the latched serial data. The rise of the power supply voltage can be suppressed.

【0009】[0009]

【発明の実施の形態】以下、本発明の実施の形態につい
て図面を参照しながら詳細に説明する。図1は本発明に
よる実施形態例として、サーマルプリンタ用の駆動装置
100とその応用回路を示し、図2は図1中の各信号の
タイミングチャートを示している。図1で、100は本
発明の構成を用いた駆動装置、R1乃至Rnは個々に電
流が流れて発熱することによりドットを印字する抵抗、
E1は各抵抗の一端に高電圧(E1(V))を印加する外
部電源を示している。更に、駆動装置100の構成は、
DO1乃至DOnはR1乃至Rnの各抵抗の一端にそれ
ぞれつながる出力端子、SIは図示しない制御装置から
のシリアルデータを受けるためのデータ入力端子、CK
はシリアルデータSIを転送するタイミング信号となる
クロック信号の入力端子、ENは各データの出力を一斉
にオン/オフ制御するための制御入力端子、L1乃至L
nはシリアルデータを記憶し保持するラッチ回路、G1
乃至Gnは各ラッチ回路Lnのデータを制御入力ENに
応じて出力するゲート回路、T1乃至Tnは各ゲート回
路Gnの出力に応じて導通することにより各出力端子D
Onにつながる抵抗に電流を流すNMOSからなる出力
トランジスタを示している。尚、ラッチ回路Lとゲート
回路Gと出力トランジスタTとからなるドット毎の単位
回路をB1乃至Bnとして点線で示しており、印字装置
の構成に応じて数10乃至数100の場合がある。
BEST MODE FOR CARRYING OUT THE INVENTION Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. FIG. 1 shows a driving device 100 for a thermal printer and its application circuit as an embodiment of the present invention, and FIG. 2 shows a timing chart of each signal in FIG. In FIG. 1, 100 is a driving device using the configuration of the present invention, R1 to Rn are resistors for printing dots by individually flowing current and generating heat,
E1 indicates an external power supply that applies a high voltage (E1 (V)) to one end of each resistor. Further, the configuration of the driving device 100 is
DO1 to DOn are output terminals connected to one ends of the resistors R1 to Rn, SI is a data input terminal for receiving serial data from a control device (not shown), and CK
Is an input terminal for a clock signal that serves as a timing signal for transferring the serial data SI, EN is a control input terminal for collectively turning on / off the output of each data, and L1 to L
n is a latch circuit that stores and holds serial data, G1
To Gn are gate circuits that output the data of each latch circuit Ln according to the control input EN, and T1 to Tn are conductive according to the output of each gate circuit Gn, so that each output terminal D
The output transistor which consists of NMOS which sends a current to the resistance connected to On is shown. It should be noted that the unit circuits for each dot, which are composed of the latch circuit L, the gate circuit G, and the output transistor T, are shown by dotted lines as B1 to Bn, and may be several tens to several hundreds depending on the configuration of the printer.

【0010】更に、各ゲート回路Gnは、各ラッチ回路
Lnからの出力が接続されたPMOS12及びNMOS
13と、制御信号ENが接続されたPMOS11及びN
MOS14とがNOR回路のように接続されている。別
の言い方をすれば、各ゲート回路GnのNMOS14の
ソース側がNMOSからなる共通トランジスタGTを介
して基準電位(GND)に接続されている以外はNOR
型のゲート回路構成となっている。この点が、図1の駆
動装置100が、図3の従来の駆動装置200と異なっ
ている点となっている。
Further, each gate circuit Gn includes a PMOS 12 and an NMOS to which the output from each latch circuit Ln is connected.
13 and the PMOS 11 and N to which the control signal EN is connected
The MOS 14 is connected like a NOR circuit. In other words, it is NOR except that the source side of the NMOS 14 of each gate circuit Gn is connected to the reference potential (GND) via the common transistor GT made of NMOS.
Type gate circuit configuration. In this respect, the drive device 100 of FIG. 1 is different from the conventional drive device 200 of FIG.

【0011】尚、各MOSトランジスタ11乃至14は
他のロジック回路を構成するトランジスタと同様もしく
はより大きな駆動能力を有する大きさ、例えば、チャネ
ル幅(W)/チャネル長(L)=4μm/2μm(以下
「W/L」と略す)を有するが、共通トランジスタGT
は駆動能力が非常に小さい(出力オン抵抗値が高い)大
きさ(W/L=4μm/190μm程度)としている。
Each of the MOS transistors 11 to 14 has a size having a driving capability similar to or larger than that of a transistor forming another logic circuit, for example, channel width (W) / channel length (L) = 4 μm / 2 μm ( (Hereinafter abbreviated as "W / L"), but the common transistor GT
Has a very small driving capability (high on-resistance of output) (W / L = 4 μm / 190 μm).

【0012】そして、クロック入力端子CKからの信号
線は各ラッチ回路Lnのクロック入力Cにそれぞれ接続
され、データ入力端子SIからの信号線はラッチ回路L
1のデータ入力Dに接続され、ラッチ回路Lm(1≦m
≦nの自然数)のデータ出力Qは次段のラッチ回路L
(m+1)のデータ入力Dに接続されるとともに各ゲー
ト回路Gmの一方の入力に接続され、各ゲート回路Gm
の出力は各出力トランジスタTmのゲート入力にそれぞ
れ接続され、各出力トランジスタTmのソースは基準電
位に接続され、そのドレインは各出力端子DOmにそれ
ぞれ接続されている。また、各ゲート回路Gmの他方の
入力及び共通トランジスタGTのゲートには制御入力端
子ENからの信号が入力されている。
The signal line from the clock input terminal CK is connected to the clock input C of each latch circuit Ln, and the signal line from the data input terminal SI is connected to the latch circuit Ln.
1 is connected to the data input D of the latch circuit Lm (1 ≦ m
The data output Q of a natural number of ≦ n) is the latch circuit L of the next stage.
The gate circuit Gm is connected to the data input D of (m + 1) and is also connected to one input of each gate circuit Gm.
Is connected to the gate input of each output transistor Tm, the source of each output transistor Tm is connected to the reference potential, and its drain is connected to each output terminal DOm. A signal from the control input terminal EN is input to the other input of each gate circuit Gm and the gate of the common transistor GT.

【0013】このような構成により、通常の動作では、
クロック信号CKに同期してシリアルデータSIを各ラ
ッチ回路に記憶した後、各ゲート回路Gnにより制御入
力端子ENからの信号に基づいて各ラッチ回路Lnの出
力データに応じて出力トランジスタTnをオン状態にす
ることにより、シリアルデータSIに応じた抵抗Rnに
のみ電流を流して発熱させるようになっている。
With this configuration, in normal operation,
After storing the serial data SI in each latch circuit in synchronization with the clock signal CK, each gate circuit Gn turns on the output transistor Tn according to the output data of each latch circuit Ln based on the signal from the control input terminal EN. By doing so, the current is passed only through the resistor Rn corresponding to the serial data SI to generate heat.

【0014】次に、制御入力端子ENからの制御信号に
基づいて各出力トランジスタを一斉に非導通(オフ状態
=高インピーダンス出力)状態にする場合には、各ゲー
ト回路Gnの出力オン抵抗に共通トランジスタGTのオ
ン抵抗が含まれるので出力オン抵抗が大幅に増大するこ
とになり、各寄生容量(C1〜Cn)との時定数が増大
することになる。従って、図2に制御信号ENと各ラッ
チ回路LnのQ出力と各出力DOnの各部の波形を示す
ように、各出力DOnの波形はシリアルデータに基づい
て出力が変化する場合の波形(点線)に比べて大幅に緩
やかに立ち上がるようになるとともに、その持ち上がり
電圧の最高値が低く抑えられるようになる。具体的に言
えば、共通トランジスタGTがW/L=4μm/190
μm程度の大きさなので数MΩのオン抵抗を有するよう
になり、各寄生容量Cnの値が数10pF乃至数100
pFと小さくても比較的大きな時定数となり、充分な遅
延時間tdを得られるようになる。
Next, when all the output transistors are made non-conductive (OFF state = high impedance output) all together based on the control signal from the control input terminal EN, the output ON resistance of each gate circuit Gn is common. Since the on-resistance of the transistor GT is included, the output on-resistance greatly increases, and the time constant with each parasitic capacitance (C1 to Cn) increases. Therefore, as shown in FIG. 2 showing the waveforms of the control signal EN, the Q output of each latch circuit Ln, and each part of each output DOn, the waveform of each output DOn is a waveform when the output changes based on the serial data (dotted line). Compared with, the voltage rises significantly more slowly, and the maximum value of the rising voltage becomes low. Specifically, the common transistor GT has W / L = 4 μm / 190
Since it has a size of about μm, it has an on-resistance of several MΩ, and the value of each parasitic capacitance Cn is several tens of pF to several hundreds.
Even with a small pF, the time constant becomes a relatively large time constant, and a sufficient delay time td can be obtained.

【0015】また、上述のように、共通トランジスタG
T以外のロジック用の各トランジスタの大きさ(W/
L)が他のロジック回路に用いるトランジスタの大きさ
と同じであれば、数の多いゲート回路Gnの大きさの増
加は殆どなく、共通トランジスタGTの分だけの面積増
加で済むので、駆動装置100のチップサイズを殆ど変
えないで済むようになる。逆に、チップサイズを大きく
しても構わないのであれば、共通トランジスタGTの駆
動能力に相当するNMOSを各ゲート回路Gnの中のN
MOS14と一体化させたNOR回路構成にしても構わ
ない。言い換えれば、W/L=4μm/190μm程度
の大きさでソースが基準電位に接続されたNMOS14
がゲート回路の数分必要になり、各ゲート回路Gnの大
きさが大幅に大きくなって駆動装置100のチップサイ
ズが大きくなってしまう。また、この構成の場合は、各
NMOS14のオン抵抗値のばらつきや各寄生容量Cn
のばらつきが大きくなり、前述の時定数(遅延時間)の
ばらつきも大きくなってしまうので、前述のような実施
形態の方が好適である。
Further, as described above, the common transistor G
Size of each transistor for logic other than T (W /
If L) is the same as the size of the transistor used in another logic circuit, the size of the large number of gate circuits Gn hardly increases, and the area can be increased by the amount of the common transistor GT. The chip size will be almost unchanged. On the contrary, if it is acceptable to increase the chip size, an NMOS corresponding to the driving capability of the common transistor GT is used as N in each gate circuit Gn.
A NOR circuit configuration integrated with the MOS 14 may be used. In other words, the NMOS 14 having a size of W / L = 4 μm / 190 μm and a source connected to the reference potential
Are required for the number of gate circuits, and the size of each gate circuit Gn is significantly increased, resulting in an increase in the chip size of the driving device 100. Further, in the case of this configuration, variations in the on-resistance value of each NMOS 14 and each parasitic capacitance Cn
The above-mentioned embodiment is more preferable because the above-mentioned variation in time constant (delay time) also increases.

【0016】以上は、出力トランジスタとしてNMOS
トランジスタを用いた場合のみを示したが、PMOSト
ランジスタやバイポーラトランジスタを出力トランジス
タとして用いる場合でも、同様にして出力トランジスタ
を駆動するゲート回路のうち制御信号に基づいて動作す
るトランジスタの駆動能力のみを小さくすれば、同様な
効果を得ることができる。また、本説明では、1つの駆
動装置100のみについて説明したが、実際には、多数
の駆動装置100を用いてプリンタの駆動回路が構成さ
れている。また、図示する回路以外のものが、駆動装置
100に含まれていても構わないし、シリアルデータを
シフトレジスタを用いて一度に各ラッチ回路Lnに送る
構成でも構わない。この場合、制御入力端子ENからの
信号だけではなく、各シリアルデータで一斉にオフ状態
に変化することもあり、この場合には共通トランジスタ
GTの効果を得ることができないので、外部の制御装置
のプログラムにおいて、シリアルデータで一度に変更す
るデータ数を一定数以下に制限するようにする必要があ
る。更に、本説明では、サーマルプリンタの駆動装置の
場合についてのみ説明したが、インクジェットプリンタ
やバブルジェット(登録商標)プリンタ等の駆動装置と
しても用いることができる。
The above is an NMOS as an output transistor.
Although only the case where a transistor is used is shown, even when a PMOS transistor or a bipolar transistor is used as an output transistor, only the driving capability of the transistor that operates based on the control signal in the gate circuit that similarly drives the output transistor is reduced. Then, the same effect can be obtained. Although only one driving device 100 has been described in the present description, the driving circuit of the printer is actually configured using a large number of driving devices 100. In addition, circuits other than the illustrated circuits may be included in the driving device 100, or serial data may be sent to each latch circuit Ln at once using a shift register. In this case, not only the signal from the control input terminal EN but also the serial data may be turned off all at once. In this case, the effect of the common transistor GT cannot be obtained. In the program, it is necessary to limit the number of serial data to be changed at one time to a certain number or less. Further, in the present description, only the case of the driving device of the thermal printer has been described, but it can be used as a driving device of an inkjet printer, a bubble jet (registered trademark) printer, or the like.

【0018】[0018]

【発明の効果】以上説明したように本発明によれば、請
求項1の記載に係わるプリンタの駆動装置は、制御信号
の入力端子ENからの信号により多数の出力状態が一斉
に変化する時に、各出力トランジスタの出力変化が緩や
かになるので、電源E1の電圧の変化が緩やかになると
ともに、その電圧値の持ち上がりが少なくなり、駆動装
置の劣化や破損がなくなり特性が安定すると言う効果が
ある。更に、請求項2に記載のプリンタの駆動装置は、
制御信号に基づいて動作するMOSトランジスタが複数
のゲート回路に共通に設けられているので、上述の効果
をチップサイズを殆ど大きくすることもなく、抵抗値や
寄生容量のばらつきが抑えられることにより遅延時間の
ばらつきを少なく構成できるという効果がある。
As described above, according to the present invention, in the printer driving device according to the first aspect, when a large number of output states change all at once by a signal from the control signal input terminal EN, Since the output change of each output transistor becomes gradual, the voltage change of the power supply E1 becomes gradual, and the rise of the voltage value becomes small, so that there is an effect that the drive device is not deteriorated or damaged and the characteristics are stable. Further, the printer driving device according to claim 2 is
Since the MOS transistor that operates based on the control signal is provided in common to the plurality of gate circuits, the above-mentioned effects are hardly delayed in the chip size and variation in the resistance value and the parasitic capacitance is suppressed. There is an effect that the time variation can be reduced.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の実施の形態例を示す回路図、FIG. 1 is a circuit diagram showing an embodiment of the present invention,

【図2】動作タイミングを示す説明図、FIG. 2 is an explanatory diagram showing operation timing,

【図3】従来のサーマルプリントヘッドを示す回路図で
ある。
FIG. 3 is a circuit diagram showing a conventional thermal printhead.

【符号の説明】[Explanation of symbols]

Gn :ゲート回路 Ln :ラッチ回路 Tn :出力トランジスタ GT :共通トランジスタ Bn :駆動回路(ドット単位) SI :シリアルデータ入力 CK :クロック入力 EN :制御入力 100 :駆動装置(半導体集積装置) Rn :ドット形成素子(発熱体) E1 :(発熱体用)電源 Gn: Gate circuit Ln: Latch circuit Tn: Output transistor GT: Common transistor Bn: Drive circuit (dot unit) SI: Serial data input CK: Clock input EN: Control input 100: Driving device (semiconductor integrated device) Rn: dot forming element (heating element) E1: Power source (for heating element)

───────────────────────────────────────────────────── フロントページの続き Fターム(参考) 2C065 CZ01 5J056 AA05 BB12 BB44 CC14 DD13 DD28 EE11 FF01 FF07 FF08 HH01 HH02    ─────────────────────────────────────────────────── ─── Continued front page    F-term (reference) 2C065 CZ01                 5J056 AA05 BB12 BB44 CC14 DD13                       DD28 EE11 FF01 FF07 FF08                       HH01 HH02

Claims (2)

【特許請求の範囲】[Claims] 【請求項1】 制御装置からの制御信号及びデータに基
づいて複数のドットからなる文字や画像を印刷するプリ
ンタの駆動装置であって、 該プリンタの駆動装置は、前記データを記憶する複数の
ラッチ回路と、該複数のラッチ回路の出力を前記制御信
号に基づいてそれぞれ出力する複数のゲート回路と、該
ゲート回路からの出力に応じて前記複数のドットの形成
素子をそれぞれ駆動する複数の出力トランジスタと、を
有し、前記複数のゲート回路は、該ゲート回路を構成す
るMOSトランジスタの内前記制御信号に基づいて動作
するMOSトランジスタの駆動能力が前記データに基づ
いて動作するMOSトランジスタの駆動能力よりも小さ
いことを特徴とするプリンタの駆動装置。
1. A drive device of a printer for printing a character or an image composed of a plurality of dots based on a control signal and data from a control device, wherein the drive device of the printer comprises a plurality of latches for storing the data. Circuit, a plurality of gate circuits that respectively output the outputs of the plurality of latch circuits based on the control signal, and a plurality of output transistors that respectively drive the plurality of dot forming elements according to the outputs from the gate circuits. The plurality of gate circuits has a driving capability of a MOS transistor that operates based on the control signal among the MOS transistors that form the gate circuit, and a driving capability of a MOS transistor that operates based on the data. A driving device for a printer, which is also small.
【請求項2】 前記制御信号に基づいて動作するMOS
トランジスタは、前期複数のゲート回路に共通に設けら
れた駆動能力の小さい共通トランジスタを含むことを特
徴とする請求項1に記載のプリンタの駆動装置。
2. A MOS that operates based on the control signal.
The driving device for a printer according to claim 1, wherein the transistor includes a common transistor having a small driving capability, which is commonly provided to the plurality of gate circuits.
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