JP2002313861A - パターン検査装置およびパターン検査方法 - Google Patents
パターン検査装置およびパターン検査方法Info
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- JP2002313861A JP2002313861A JP2001112539A JP2001112539A JP2002313861A JP 2002313861 A JP2002313861 A JP 2002313861A JP 2001112539 A JP2001112539 A JP 2001112539A JP 2001112539 A JP2001112539 A JP 2001112539A JP 2002313861 A JP2002313861 A JP 2002313861A
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Abstract
な欠陥を正確に検出することができるパターン検査装置
およびパターン検査方法を提供することを目的とする。 【解決手段】 パターン検査装置は、基板支持テーブル
11と、アクチュエータ12、13を介して基板支持テ
ーブル11を駆動するためのテーブル駆動部14と、カ
メラ15と、画像処理部20と、キーボード18および
CRT19に接続された制御部17とを備える。また、
画像処理部20は、チップ比較検査を実行するチップ比
較検査部21と、セル比較検査を実行するセル比較検査
部23と、画像メモリ22、24と、チップ比較検査部
21による検査結果とセル比較検査部23による検査結
果とを統合して最終的な欠陥の有無を判定する統合判定
部25と、領域メモリ26とを備える。
Description
の基板に対し、当該基板上に形成された多数のチップに
おけるパターンを検査する検査装置およびパターン検査
方法に関する。
内には、例えばメモリにおける電荷蓄積部分のように同
一の形状を有するパターンが繰り返して形成される繰り
返しパターン領域と、それ以外のパターンが形成される
ランダムパターン領域とが存在する。そして、このよう
なチップ内のパターンを検査する際には、繰り返しパタ
ーン領域とランダムパターン領域とに対し、各々、異な
る検査方法が用いられている。
しては、隣接または近接する複数のチップ間で対応する
パターン同士を比較することによりパターンの欠陥を検
出するチップ比較検査が採用される。このチップ比較検
査は、ダイ比較検査あるいはランダム比較検査とも呼称
される検査方法である。このチップ比較検査は、半導体
ウエハ上の比較的離隔した2つの位置に配置されたパタ
ーンを比較検査することから、その許容誤差を比較的大
きくとる必要がある。
は、同一チップ内における隣接または近接する繰り返し
パターンを相互に比較することによりパターンの欠陥を
検出するセル比較検査が採用される(特公平6−562
93号公報参照)。このセル比較検査は、アレイ比較検
査とも呼称される検査方法である。このセル比較検査
は、比較するパターンが距離的に近いことから、精度の
高い検査を実行することが可能となる。
プにおける繰り返しパターン領域とランダムパターン領
域との両方の領域に対してパターン検査を行う場合にお
いては、ダイ比較検査を行うパターン検査装置と、セル
比較検査を行うパターン検査装置との両方のパターン検
査装置が使用される。また、ダイ比較検査とセル比較検
査の両方の検査モードを備えた検査装置を使用し、繰り
返しパターン領域またはランダムパターン領域に各々対
応させてモードを切り換えることにより検査を行う場合
もある。
プを撮像した画像に対してセル比較を行うことにより、
その画像領域におけるセル比較可能部分とセル比較不可
能部分とを設定し、セル比較可能部分に対してはセル比
較検査を行い、セル比較不可能部分に対してはチップ比
較検査を行うパターン欠陥検査方法が開示されている。
を利用して欠陥を検出する動作を示す説明図である。
ーンAと繰り返しパターンBとを比較するとともに、繰
り返しパターンBと繰り返しパターンCとを比較する。
そして、繰り返しパターンAと繰り返しパターンBとの
比較結果101と、繰り返しパターンBと繰り返しパタ
ーンCとの比較結果102とのANDをとることによ
り、繰り返しパターンBに固有の欠陥100を検出す
る。
ーン内に形成された微細な欠陥に対しては精度の高い検
査結果を得ることができるが、繰り返しパターンの2周
期以上に亘る欠陥を検出することができないという問題
がある。
返しパターン上に存在した場合等において、図5に示す
ように、繰り返しパターンBおよび繰り返しパターンC
の両方が欠陥となった場合においては、繰り返しパター
ンAと繰り返しパターンBとの比較結果103と、繰り
返しパターンBと繰り返しパターンCとの比較結果10
4とのANDををとっても、繰り返しパターンBには欠
陥は存在しないと認識されることになる。
ような繰り返しパターンの2周期以上に亘るような比較
的大きな欠陥が検出できないことになる。
6550号に記載されたパターン欠陥検査方法において
も同様に生ずる現象である。すなわち、上述した特許第
2976550号に記載されたパターン欠陥検査方法に
おいては、このような繰り返しパターンの2周期以上に
亘るような比較的大きな欠陥がセル比較可能部分とセル
比較不可能部分とを設定する際に存在した場合には、こ
の大きな欠陥部分をセル比較可能部分と認識することに
なり、また、このような繰り返しパターンの2周期以上
に亘るような比較的大きな欠陥がセル比較検査時に存在
した場合においては、欠陥が存在しないものと認識する
ことになる。
れたものであり、繰り返しパターン領域に発生した比較
的大きな欠陥を正確に検出することができるパターン検
査装置およびパターン検査方法を提供することを目的と
する。
は、基板上に形成された多数のチップにおける繰り返し
パターン領域の繰り返しパターンを検査する検査装置で
あって、繰り返しパターン領域に対し、同一チップ内に
おける繰り返しパターンを相互に比較するセル比較と、
複数のチップ間で対応するパターン同士を比較するチッ
プ比較とを実行することによりパターンの欠陥を検出す
ることを特徴とする。
れた多数のチップにおけるパターンを検査する検査装置
であって、基板を支持する基板支持手段と、前記チップ
の画像を撮影するための撮影手段と、前記基板支持手段
と前記撮像手段とを相対的に移動させる移動手段と、前
記撮影手段により撮影したチップの画像を記憶する画像
記憶手段と、前記撮影手段により撮影したチップ上の領
域に対し、繰り返しパターンが形成された繰り返しパタ
ーン領域とランダムパターンが形成されたランダムパタ
ーン領域とを設定する領域設定手段と、前記領域設定手
段により設定した繰り返しパターン領域とランダムパタ
ーン領域とを記憶する領域記憶手段と、前記領域記憶手
段に記憶した繰り返しパターン領域に対して、同一チッ
プ内における繰り返しパターンを相互に比較することに
よりパターンの欠陥を検出するセル比較を実行するセル
比較検査手段と、前記領域記憶手段に記憶した繰り返し
パターン領域とランダムパターン領域とに対して、複数
のチップ間で対応するパターン同士を比較することによ
りパターンの欠陥を検出するチップ比較を実行するチッ
プ比較検査手段と、を備えたことを特徴とする。
れた多数のチップにおけるパターンを検査する検査方法
であって、チップ上の領域に対し、繰り返しパターンが
形成された繰り返しパターン領域とランダムパターンが
形成されたランダムパターン領域とを設定する領域設定
工程と、前記領域設定工程で設定した繰り返しパターン
領域に対しては、同一チップ内における繰り返しパター
ンを相互に比較することによりパターンの欠陥を検出す
るセル比較と、複数のチップ間で対応するパターン同士
を比較することによりパターンの欠陥を検出するチップ
比較との両方を実行するとともに、前記領域設定工程で
設定したランダムパターン領域に対しては、複数のチッ
プ間で対応するパターン同士を比較することによりパタ
ーンの欠陥を検出するチップ比較を実行する欠陥検出工
程と、から成ることを特徴とする。
のパターン検査方法において、前記領域設定工程におい
ては、チップ上のパターンを撮影することによりこのパ
ターンを表示装置上に拡大表示し、この拡大表示された
パターンを利用して繰り返しパターンが形成された繰り
返しパターン領域とランダムパターンが形成されたラン
ダムパターン領域とを設定する。
面に基づいて説明する。図1はこの発明に係るパターン
検査装置の概要図である。
らなる基板Wを支持する基板支持テーブル11と、この
基板支持テーブル11をX方向に移動させるためのアク
チュエータ12と、基板支持テーブル11をY方向に移
動させるためのアクチュエータ13と、これらのアクチ
ュエータ12、13を介して基板支持テーブル11を駆
動するためのテーブル駆動部14と、基板支持テーブル
11に支持された基板Wに形成されたチップの画像を撮
影するカメラ15と、後述する画像処理部20と、パタ
ーン検査装置全体を制御する制御部17とを備える。ま
た、制御部17には、後述する領域設定時に、領域設定
手段として機能するキーボード18と、拡大表示手段と
して機能するCRT19とが接続されている。
を実行するチップ比較検査部21と、チップ比較検査時
にカメラ15で撮影した画像を一時的に記憶する画像メ
モリ22と、セル比較検査を実行するセル比較検査部2
3と、セル比較検査時にカメラ15で撮影した画像を一
時的に記憶する画像メモリ24と、チップ比較検査部2
1による検査結果とセル比較検査部23による検査結果
とを統合して最終的な欠陥の有無を判定する統合判定部
25と、キーボード18等を利用して設定された繰り返
しパターン領域およびランダムパターン領域を記憶する
領域メモリ26とを備える。画像処理部20におけるチ
ップ比較検査部21、画像メモリ22、セル比較検査部
23および画像メモリ24は、A/D変換器16を介し
てカメラ15と接続されている。
影した画像を一時的に記憶する画像メモリ22とセル比
較検査時にカメラ15で撮影した画像を一時的に記憶す
る画像メモリ24とを個別に設けるかわりに、単一の画
像メモリを利用して画像を一時的に記憶するようにして
もよい。
において基板Wのパターンを検査する際には、最初に、
繰り返しパターンが形成された繰り返しパターン領域と
ランダムパターンが形成されたランダムパターン領域と
を設定する領域設定工程を実行する。
により、基板Wの表面に形成されたチップ上のパターン
を撮影して、このチップ上のパターンの画像をCRT1
9上に拡大表示する。
大表示されたチップ31上のパターンの画像を模式的に
示す説明図である。
は、ランダムパターンが形成された領域32と、繰り返
しパターンが形成された領域33、34とが形成されて
いるものとする。
がこの拡大表示画面を確認しながら、これらの領域をラ
ンダムパターンが形成されたランダムパターン領域32
と繰り返しパターンが形成された繰り返しパターン領域
33、34として設定する。この領域設定工程において
は、制御部17に接続されたキーボード18を利用して
領域設定がなされる。この領域設定工程で設定されたラ
ンダムパターン領域32と繰り返しパターン領域33、
34とは、画像処理部20における領域メモリ26に記
憶される。
キーボード18や図示しないマウス等を使用して実行し
てもよく、また、例えば、特許第2976550号に記
載されているような方式を使用して制御部17により自
動的に実行するように構成してもよい。
パターン領域32と繰り返しパターン領域33、34に
基づいて、チップ比較検査を行うべき領域とセル比較検
査を行うべき領域とが決定される。すなわち、図3
(a)に示すように、この検査方式決定工程において
は、最初に、ランダムパターン領域32に対してはチッ
プ比較検査を行うためのフラグ(図3に示す符号1)が
立てられ、繰り返しパターン領域33、34に対しては
セル比較を行うためのフラグ(図3に示す符号1)が立
てられる。そして、図3(b)に示すように、セル比較
検査を行うべきフラグをコピーすることにより、繰り返
しパターン領域33、34に対応してチップ比較を行う
ためのフラグが立てられる。そして、これらの情報は、
画像処理部20における領域メモリ26に記憶される。
7により自動的に実行するように構成してもよく、ま
た、オペレータがキーボード18や図示しないマウス等
を使用して実行してもよい。
実行する。このパターン検査工程においては、検査方式
決定工程で設定し領域メモリ26に記憶されたチップ比
較検査を行うべき領域とセル比較検査を行うべき領域と
の情報に基づいてチップ比較検査部21とセル比較検査
部23とが制御され、繰り返しパターン領域33、34
に対してはセル比較検査とチップ比較検査との両方が実
行されるとともに、ランダムパターン領域32に対して
はチップ比較検査が実行される。
ムパターン領域32および繰り返しパターン領域33、
34に対し、チップ比較検査部21においてチップ比較
検査が実行される。このチップ比較検査部21において
は、カメラ15により撮影し画像メモリ22に記憶され
た一つ前のチップ31におけるある領域のパターンの画
像と、カメラ15により撮影した現在のチップ31にお
ける対応する領域のパターンの画像との比較を順次連続
して実行することにより、欠陥の有無が検査される。
繰り返しパターン領域33、34に対し、セル比較検査
部23においてセル比較検査が実行される。このセル比
較検査部23においては、カメラ15により撮影し画像
メモリ24に記憶された一つ前の繰り返しパターンの画
像と、カメラ15により撮影した現在の繰り返しパター
ンの画像との比較を順次連続して実行することにより、
欠陥の有無が検査される。
に比較的大きな欠陥が生じていた場合においては、図5
に示すように、セル比較検査部23におけるセル比較検
査では欠陥を検出できない。しかしながら、このような
比較的大きな欠陥は、チップ比較検査部21におけるチ
ップ比較検査時に検出される。このとき、このような比
較的大きな欠陥は、その許容誤差を比較的大きくとる必
要があるチップ比較検査時においても、確実に検出する
ことが可能であり、検出ミスが生ずることはない。
は、テーブル駆動部14によりアクチュエータ12、1
3を介して基板支持テーブル11を駆動し、そこに支持
された基板Wをカメラ15に対して相対的に移動させる
ことにより、基板Wの表面におけるチップ31の形成領
域全域に対して実行される。
査結果とセル比較検査部23による検査結果とが、統合
判定部25において統合され、基板Wに形成されたチッ
プ全体に対する検査結果が判定される。なお、この統合
判定部25においては、チップ比較検査部21による検
査結果とセル比較検査部23による検査結果とのORを
とることにより結果の統合を実行する。
してCRT19上に表示される。
ン検査装置によれば、繰り返しパターン領域33、34
に対してセル比較検査とチップ比較検査との両方を行
い、また、ランダムパターン領域32に対してはチップ
比較検査を行うことから、繰り返しパターン領域33、
34に比較的大きな欠陥が生じていた場合においても、
この欠陥を正確に検出することが可能となる。
域設定工程において、ランダムパターンが形成されたラ
ンダムパターン領域32と繰り返しパターンが形成され
た繰り返しパターン領域33、34との両方の領域を設
定しているが、繰り返しパターン領域33、34のみを
設定し、その他の領域は全てランダムパターン領域とし
て認識させるようにしてもよい。このような構成を採用
した場合においては、チップ31上の全領域に対してチ
ップ比較検査が実行され、さらに、チップ31における
繰り返しパターン領域33、34に対してセル比較検査
が実行されることになる。
しパターン領域に対し、同一チップ内における繰り返し
パターンを相互に比較するセル比較と、複数のチップ間
で対応するパターン同士を比較するチップ比較とを実行
することによりパターンの欠陥を検出することから、繰
り返しパターン領域に発生した比較的大きな欠陥を正確
に検出することが可能となる。
れば、繰り返しパターン領域に対してはセル比較とチッ
プ比較との両方を実行するとともに、ランダムパターン
領域に対してはチップ比較を実行することから、繰り返
しパターン領域とランダムパターン領域との欠陥を検査
するに際し、繰り返しパターン領域に発生した比較的大
きな欠陥を正確に検出することが可能となる。
のパターンを撮影することによりこのパターンを表示装
置上に拡大表示し、この拡大表示されたパターンを利用
して繰り返しパターンが形成された繰り返しパターン領
域とランダムパターンが形成されたランダムパターン領
域とを設定することから、繰り返しパターン領域とラン
ダムパターン領域とを容易に設定することが可能とな
る。
る。
パターンの画像を模式的に示す説明図である。
を行うべき領域とを示す説明図である。
示す説明図である。
示す説明図である。
Claims (4)
- 【請求項1】 基板上に形成された多数のチップにおけ
る繰り返しパターン領域の繰り返しパターンを検査する
検査装置であって、 繰り返しパターン領域に対し、同一チップ内における繰
り返しパターンを相互に比較するセル比較と、複数のチ
ップ間で対応するパターン同士を比較するチップ比較と
を実行することによりパターンの欠陥を検出することを
特徴とするパターン検査装置。 - 【請求項2】 基板上に形成された多数のチップにおけ
るパターンを検査する検査装置であって、 基板を支持する基板支持手段と、 前記チップの画像を撮影するための撮影手段と、 前記基板支持手段と前記撮像手段とを相対的に移動させ
る移動手段と、 前記撮影手段により撮影したチップの画像を記憶する画
像記憶手段と、 前記撮影手段により撮影したチップ上の領域に対し、繰
り返しパターンが形成された繰り返しパターン領域とラ
ンダムパターンが形成されたランダムパターン領域とを
設定する領域設定手段と、 前記領域設定手段により設定した繰り返しパターン領域
とランダムパターン領域とを記憶する領域記憶手段と、 前記領域記憶手段に記憶した繰り返しパターン領域に対
して、同一チップ内における繰り返しパターンを相互に
比較することによりパターンの欠陥を検出するセル比較
を実行するセル比較検査手段と、 前記領域記憶手段に記憶した繰り返しパターン領域とラ
ンダムパターン領域とに対して、複数のチップ間で対応
するパターン同士を比較することによりパターンの欠陥
を検出するチップ比較を実行するチップ比較検査手段
と、 を備えたことを特徴とするパターン検査装置。 - 【請求項3】 基板上に形成された多数のチップにおけ
るパターンを検査する検査方法であって、 チップ上の領域に対し、繰り返しパターンが形成された
繰り返しパターン領域とランダムパターンが形成された
ランダムパターン領域とを設定する領域設定工程と、 前記領域設定工程で設定した繰り返しパターン領域に対
しては、同一チップ内における繰り返しパターンを相互
に比較することによりパターンの欠陥を検出するセル比
較と、複数のチップ間で対応するパターン同士を比較す
ることによりパターンの欠陥を検出するチップ比較との
両方を実行するとともに、前記領域設定工程で設定した
ランダムパターン領域に対しては、複数のチップ間で対
応するパターン同士を比較することによりパターンの欠
陥を検出するチップ比較を実行する欠陥検出工程と、 から成ることを特徴とするパターン検査方法。 - 【請求項4】 請求項2に記載のパターン検査方法にお
いて、 前記領域設定工程においては、チップ上のパターンを撮
影することによりこのパターンを表示装置上に拡大表示
し、この拡大表示されたパターンを利用して繰り返しパ
ターンが形成された繰り返しパターン領域とランダムパ
ターンが形成されたランダムパターン領域とを設定する
パターン検査方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001112539A JP3808320B2 (ja) | 2001-04-11 | 2001-04-11 | パターン検査装置およびパターン検査方法 |
US10/109,869 US7113629B2 (en) | 2001-04-11 | 2002-04-01 | Pattern inspecting apparatus and method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2001112539A JP3808320B2 (ja) | 2001-04-11 | 2001-04-11 | パターン検査装置およびパターン検査方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2002313861A true JP2002313861A (ja) | 2002-10-25 |
JP3808320B2 JP3808320B2 (ja) | 2006-08-09 |
Family
ID=18963938
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2001112539A Expired - Lifetime JP3808320B2 (ja) | 2001-04-11 | 2001-04-11 | パターン検査装置およびパターン検査方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3808320B2 (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2008111758A1 (en) * | 2007-03-13 | 2008-09-18 | Intekplus Co., Ltd | Apparatus for inspection of semiconductor device and method for inspection by the same |
JP2009188280A (ja) * | 2008-02-08 | 2009-08-20 | Hitachi High-Technologies Corp | レビュー装置,検査領域設定支援システム、および、欠陥の画像得方法 |
JP2012063209A (ja) * | 2010-09-15 | 2012-03-29 | Hitachi High-Technologies Corp | 欠陥検査方法及びその装置 |
JP2014181966A (ja) * | 2013-03-18 | 2014-09-29 | Nuflare Technology Inc | 検査方法および検査装置 |
US11041815B2 (en) | 2016-05-23 | 2021-06-22 | Hitachi High-Tech Corporation | Inspection information generation device, inspection information generation method, and defect inspection device |
-
2001
- 2001-04-11 JP JP2001112539A patent/JP3808320B2/ja not_active Expired - Lifetime
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WO2008111758A1 (en) * | 2007-03-13 | 2008-09-18 | Intekplus Co., Ltd | Apparatus for inspection of semiconductor device and method for inspection by the same |
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---|---|
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