JP2002110795A - 半導体素子のプラグ形成方法 - Google Patents
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Abstract
率を向上し、半導体基板の表面傷付けを低減し得る半導
体素子のプラグ形成方法を提供する。 【解決手段】基板上の絶縁膜102を選択的にエッチン
グしてコンタクトホール103を形成し、前記コンタク
トホール103の内部及び前記絶縁膜102の上面に導
電層104を形成し、前記絶縁膜102の上面が露出さ
れるように前記導電層104に化学的機械研磨を施し
て、前記コンタクトホール103の内部に導電層プラグ
104aを形成した後、SC−1化学溶液を用いて表面
洗浄を施して、該導電層プラグ104aの上面に酸化膜
105を形成し、前記導電層プラグ104a及び絶縁膜
102の表面を洗浄する。
Description
グ形成方法に関するもので、詳しくは、半導体素子の製
造時に発生する半導体基板の表面傷付けを減らし得るプ
ラグ形成方法に関するものである。
ザインルールが減少し、コンタクトホール又はビアホー
ルの縦横比が増大されて、層間接触の信頼性を向上する
ために、一般に、コンタクトホール又はビアホールにプ
ラグを形成している。そして、このような半導体素子の
プラグ形成方法として、絶縁層をエッチングしてコンタ
クトホール又はビアホールを形成する工程と、前記絶縁
層の上面及び前記コンタクトホール又はビアホールの内
部に電導性物質層を形成する工程と、前記絶縁層の上面
が露出されるまで前記電導性物質層を化学的機械研磨す
る工程と、前記化学的機械研磨工程中に発生した残留汚
染物を除去する洗浄工程と、を順次行うようになってい
た。
来の半導体素子のプラグ形成方法においては、化学的機
械研磨工程が終了した後、半導体基板を洗浄装置にロー
ディングするまでの相当な時間の間、半導体基板が大気
中に露出されるようになるため、該半導体基板の上面に
大気中の汚染物が強く吸着する現象が生じて、前記洗浄
工程の効率が低下し、半導体基板の表面傷付けが非常に
多く発生するという問題点があった。
半導体基板の上面は絶縁層及び導電性物質層、例えば、
ポリシリコン層の表面が大気中に露出される状態とな
る。このとき、前記ポリシリコン層の表面は、疎水性状
態となって急速な乾燥現象が発生し、化学的機械研磨工
程中に発生された残留汚染物及び大気中の汚染物が半導
体基板の表面に強く吸着される。このようになると、前
記洗浄工程を施しても汚染物を除去することが難しく、
洗浄工程の効率が低下して、半導体基板の表面傷付けが
増大される。
に鑑みてなされたもので、化学的機械研磨工程と洗浄工
程との間に、半導体基板の表面を親水性状態に変化させ
る工程を追加して行い、洗浄工程の効率を向上して、半
導体基板の表面傷付けを低減し得る半導体素子のプラグ
形成方法を提供することを目的とする。
るため、本発明に係る半導体素子のプラグ形成方法にお
いては、半導体基板の上面に形成された絶縁膜を選択的
にエッチングしてコンタクトホールを形成する工程と、
前記コンタクトホールの内部及び前記絶縁膜の上面に導
電層を形成する工程と、前記絶縁膜の上面が露出される
ように前記導電層に化学的機械研磨を施して、前記コン
タクトホールの内部に導電層プラグを形成する工程と、
前記導電層プラグの上面に酸化膜を形成する工程と、前
記導電層プラグ及び絶縁膜の表面を洗浄する工程と、を
順次行う。
形成される。そして、前記酸化膜の形成工程では、前記
導電層プラグの上面に対してSC−1化学溶液を用いて
洗浄を施すこととする。即ち、前記酸化膜の形成工程で
は、前記導電層プラグの表面を疎水性状態から親水性状
態に変化させるものである。
記導電層プラグの上面に酸化膜を形成する工程が同時に
行われることとする。このとき、前記導電層プラグの形
成工程では、化学的機械研磨工程用添加剤としてSC−
1化学溶液が添加されたスラリーを利用して前記化学的
機械研磨工程を施すこととする。
て図面を用いて説明する。まず、本発明の第1実施形態
においては、図1(A)に示したように、第1導電層1
01を有する半導体基板100を準備する。前記第1導
電層101は、半導体基板100の内部に形成された不
純物領域又は半導体基板100の上面に形成された導電
膜であっても良い。
基板100の上面に絶縁層102を形成する。次に、図
1(B)に示したように、前記第1導電層101の上面
が露出されるように、前記絶縁層102を選択的にエッ
チングして、コンタクトホール103を形成する。
コンタクトホール103が完全に埋められるように、前
記コンタクトホール103の内部及び前記絶縁層102
の上面に、ポリシリコン等からなる第2導電層104を
形成する。その後、図1(D)に示したように、前記絶
縁層102の上面が露出されるように、前記第2導電層
104に対して化学的機械研磨工程を施し、前記コンタ
クトホール103の内部に前記第2導電層104からな
る導電層プラグ104aを形成する。
(D)に示した半導体基板100の上面全体に対し、S
C−1(Standard Cleaning−1)化学溶液を用いて表面
洗浄を施して、導電層プラグ104aの上面に酸化膜1
05を形成する。前記SC−1化学溶液は、RCA社に
より開発された湿式洗浄液であり、NH 4OH:H
2O2:H2Oが1:1:5〜1:2:7の比率で混合さ
れた70〜80℃の化学溶液であって、強い酸化性を有
するので、有機汚染物及びパーティクルを効率的に除去
することができる。
層プラグ104aの上面を、疎水性状態から親水性状態
に変化させて、前記半導体基板100が大気に露出され
る際、汚染物が導電層プラグ104aの上面に強く吸着
する現象を防止することが可能となる。この後、従来と
同様に、導電層プラグ及び絶縁膜の表面に発生した残留
汚染物を除去する洗浄工程を行う。
は、前記化学的機械研磨工程と洗浄工程間に、SC−1
化学溶液を用いて表面処理を施す工程を追加して行い、
ウェーハ表面を酸化させる。これにより、半導体基板1
00の表面が疎水性状態から親水性状態に変化されて、
半導体基板表面の急激な乾燥化を防止することが可能と
なって、半導体基板の表面に粒子(パーティクル)が強
く吸着される現象を防止することができ、洗浄工程時
に、半導体基板の表面の汚染物が容易に除去されて洗浄
工程の効率が高くなり、傷付けの発生を最小限に抑制す
ることができる。
成方法の第2実施形態について説明する。本発明に係る
第2実施形態においては、図1(D)に示した化学的機
械研磨工程時に、化学的機械研磨工程用スラリーにSC
−1化学溶液を少量添加して化学的機械研磨を施すと同
時に、半導体基板100の表面を酸化して親水性状態に
させる。
SC−1化学溶液を用いる表面処理を省いて、簡便に洗
浄工程の効率を向上させることができる。尚、前記化学
的機械研磨工程では、シリカなどの超微粒子研磨剤を用
いて被研磨膜を機械的に研磨すると共に、化学物質を利
用して化学反応を起こして被研磨膜を除去する。
れるスラリーは、SiO2などの微粒子をKOH、NH4
OHなどの化学溶液に懸濁させて利用する。現在広く用
いられているポリシリコン層の化学的機械研磨工程用ス
ラリーは、KOHを安定剤として使用し、数〜数百nmの
粒子を有するシリカを懸濁させて利用している。さら
に、前記スラリーには、スラリー内の粒子の分散性を促
進させる分散剤、化学溶液を均一に混合させる懸濁液、
化学的機械研磨工程中に発生する気泡を抑制し除去する
消泡剤、pH変動を防止するバッファー溶液及びその他
の特殊な目的で添加される添加剤などが含まれる。
として、SC−1化学溶液を少量添加しながらも、第1
実施形態と同様な効果を得た。
体素子のプラグ形成方法においては、化学的機械研磨工
程中又は工程終了後に、半導体基板の表面に酸化膜を形
成することにより、洗浄工程の効率を向上し、半導体基
板の表面傷付けを減らし得るという効果がある。
工程を示す断面図である。
Claims (6)
- 【請求項1】半導体基板の上面に形成された絶縁膜を選
択的にエッチングしてコンタクトホールを形成する工程
と、 前記コンタクトホールの内部及び前記絶縁膜の上面に導
電層を形成する工程と、 前記絶縁膜の上面が露出されるように前記導電層に化学
的機械研磨を施して、前記コンタクトホールの内部に導
電層プラグを形成する工程と、 前記導電層プラグの上面に酸化膜を形成する工程と、 前記導電層プラグ及び絶縁膜の表面を洗浄する工程と、
を順次行うことを特徴とする半導体素子のプラグ形成方
法。 - 【請求項2】前記導電層は、ポリシリコンから形成され
ることを特徴とする請求項1に記載の半導体素子のプラ
グ形成方法。 - 【請求項3】前記酸化膜の形成工程では、前記導電層プ
ラグの上面に対してSC−1化学溶液を用いて洗浄を施
すことを特徴とする請求項1又は2に記載の半導体素子
のプラグ形成方法。 - 【請求項4】前記酸化膜の形成工程では、前記導電層プ
ラグの表面を疎水性状態から親水性状態に変化させるこ
とを特徴とする請求項1に記載の半導体素子のプラグ形
成方法。 - 【請求項5】前記導電層プラグの形成工程と、前記導電
層プラグの上面に酸化膜を形成する工程が同時に行われ
ることを特徴とする請求項1に記載の半導体素子のプラ
グ形成方法。 - 【請求項6】前記導電層プラグの形成工程では、化学的
機械研磨工程用添加剤としてSC−1化学溶液が添加さ
れたスラリーを利用して前記化学的機械研磨工程を施す
ことを特徴とする請求項1又は5に記載の半導体素子の
プラグ形成方法。
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