JP2001337119A - Pulse edge detection circuit - Google Patents

Pulse edge detection circuit

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JP2001337119A
JP2001337119A JP2000158076A JP2000158076A JP2001337119A JP 2001337119 A JP2001337119 A JP 2001337119A JP 2000158076 A JP2000158076 A JP 2000158076A JP 2000158076 A JP2000158076 A JP 2000158076A JP 2001337119 A JP2001337119 A JP 2001337119A
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pulse
pulse signal
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Takao Minami
孝男 南
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Jeol Ltd
Jeol Engineering Co Ltd
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NIPPON DENSHI ENG
Jeol Ltd
Jeol Engineering Co Ltd
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    • GPHYSICS
    • G01MEASURING; TESTING
    • G01TMEASUREMENT OF NUCLEAR OR X-RADIATION
    • G01T1/00Measuring X-radiation, gamma radiation, corpuscular radiation, or cosmic radiation
    • G01T1/16Measuring radiation intensity
    • G01T1/17Circuit arrangements not adapted to a particular type of detector
    • G01T1/171Compensation of dead-time counting losses
    • GPHYSICS
    • G01MEASURING; TESTING
    • G01TMEASUREMENT OF NUCLEAR OR X-RADIATION
    • G01T1/00Measuring X-radiation, gamma radiation, corpuscular radiation, or cosmic radiation
    • G01T1/02Dosimeters

Abstract

PROBLEM TO BE SOLVED: To provide a pulse edge detection circuit capable of surely and easily detecting superposed pulse signals. SOLUTION: The pulse edge detection circuit comprises a delay line 1 for delaying an input pulse signal, a limiter 3 for limiting the delayed input pulse signal, and a comparator 4 for comparing the limited delayed input pulse signal with the original input pulse signal and outputting an edge detection signal. Thus, by outputting rectangular-wave signals which are synchronized with the rise and fall of the pulse signal, detection of the superposed pulses is made possible.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】この発明は、重畳したパルス
を検出できるようにしたパルスエッジ検出回路に関す
る。
[0001] 1. Field of the Invention [0002] The present invention relates to a pulse edge detection circuit capable of detecting a superimposed pulse.

【0002】[0002]

【従来の技術】一般に、電子プローブマイクロアナライ
ザ(EPMA)や蛍光X線分析器などの試料分析装置に
おける試料分析のための放射線計測においては、一次線
照射による試料からの放射線の発生を半導体検出器で検
出し、チャージセンシティブアンプを用いて電気信号に
変換することが行われている。チャージセンシティブア
ンプは入射した放射線のエネルギーに比例した波高をも
つ階段波信号を出力し、この階段波信号はパルスプロセ
ッサにより、階段波の波高に比例するピークをもつ単独
パルスに成形されるようになっている。
2. Description of the Related Art Generally, in radiation measurement for sample analysis in a sample analyzer such as an electron probe microanalyzer (EPMA) or a fluorescent X-ray analyzer, the generation of radiation from a sample by primary beam irradiation is detected by a semiconductor detector. And converts it into an electric signal using a charge-sensitive amplifier. The charge-sensitive amplifier outputs a staircase wave signal having a wave height proportional to the energy of the incident radiation, and the staircase wave signal is shaped into a single pulse having a peak proportional to the wave height of the staircase wave by a pulse processor. ing.

【0003】放射線計測用パルスプロセッサは大別し
て、スロー・アンプとファースト・アンプと呼ばれる2
つの波形成形回路を備えており、スロー・アンプは放射
線のエネルギーを計測する目的に用いられるSN比のよ
いパルスを生成するためのもので、比較的大きい時定数
を用いる必要があり、プロセスタイムは長くなってい
る。一方、ファースト・アンプは放射線の発生を検出し
てパイルアップ(パルスの重畳)を監視するために用い
られるパルスや、スロー・アンプの制御のためのタイミ
ングパルスを生成するもので、このパルスは放射線が近
接して発生しても確実に検出を行えるように、時定数を
小さくしてプロセスタイムを出来る限り短くしている。
本発明は、このパルスプロセッサのファースト・アンプ
が出力するようなパルスの検出手法に関するものであ
る。
[0003] Radiation measurement pulse processors are roughly classified into two types, slow amplifiers and fast amplifiers.
It has two waveform shaping circuits, the slow amplifier is for generating a pulse with a good S / N ratio used for the purpose of measuring the energy of radiation, and it is necessary to use a relatively large time constant. It is getting longer. On the other hand, the first amplifier generates a pulse used to monitor the pile-up (superposition of pulses) by detecting the generation of radiation and a timing pulse for controlling a slow amplifier. The time constant is reduced so that the process time can be shortened as much as possible so that detection can be performed reliably even if the error occurs in close proximity.
The present invention relates to a method for detecting a pulse output from a first amplifier of the pulse processor.

【0004】次に、ファースト・アンプが出力するパル
スの一例を図5の(A)〜(D)に基づいて説明する。
ここではファースト・アンプが三角波パルスを出力して
くるものとして説明する。また、このパルスを検出する
一般的な弁別回路を図6に示す。この弁別回路は入力さ
れたパルス信号Vinのレベルを閾値により監視するもの
で、コンパレータ101 と、閾値を設定するための電圧源
R とで構成されている。図5の(A)は図5の(B)
〜(D)に示すファースト・アンプから出力されるパル
ス信号を説明するためのパルス発生位置を実線及び点線
で示している。図5の(A)において、(イ)のパルス
が発生した後に間隔をおいて(ニ)のパルスを生じる放
射線が発生すると、ファースト・アンプの出力は図5の
(B)に示すように独立した(イ)と(ニ)のパルスと
なる。このパルス出力を図6に示した弁別回路の入力信
号Vinとして入力するとVout で示す出力が得られ、
(イ)と(ニ)の2つの放射線によるパルスの発生を認
識することができる。
Next, an example of a pulse output from the first amplifier will be described with reference to FIGS.
Here, description will be made assuming that the first amplifier outputs a triangular wave pulse. FIG. 6 shows a general discrimination circuit for detecting this pulse. This discrimination circuit monitors the level of the input pulse signal Vin based on a threshold value, and includes a comparator 101 and a voltage source V R for setting the threshold value. (A) of FIG. 5 is (B) of FIG.
The pulse generation positions for explaining the pulse signals output from the first amplifier shown in FIG. In FIG. 5A, when radiation causing the pulse of FIG. 5D is generated after the pulse of FIG. 5A is generated, the output of the first amplifier becomes independent as shown in FIG. 5B. Pulses (a) and (d) are obtained. When this pulse output is input as the input signal Vin of the discrimination circuit shown in FIG. 6, an output indicated by Vout is obtained.
It is possible to recognize the generation of a pulse due to the two radiations (a) and (d).

【0005】[0005]

【発明が解決しようとする課題】しかしながら、上記構
成の弁別回路を用いてパルス検出を行う場合、図5の
(A)において、(イ)のパルスが発生した後に(ロ)
のパルスが一部重なって生じるように放射線が接近して
発生すると、ファースト・アンプの出力は図5の(C)
に示すように、(イ)と(ロ)のパルスが重畳された形
となる。このパルス信号Vinを図6に示す弁別回路に入
力すると、Vout に示すような出力が得られる。すなわ
ち、この場合は(イ)と(ロ)の2つの放射線によるパ
ルスが発生しているにも関わらず、1つのパルスが発生
しているものとしか認識できないことになる。また図5
の(イ)のパルスが発生した後に(ハ)のパルスを生じ
る放射線が発生すると、ファースト・アンプの出力は図
5の(D)に示すように、(イ)と(ハ)のパルスが同
様に一部重畳された形となる。したがって、このパルス
信号Vinを図6の弁別回路に入力するとVout で示す出
力が得られ、この場合も同様に、(イ)と(ハ)の2個
の放射線によるパルスが発生しているにも関わらず、1
個のパルスとしか認識できないことになる。このよう
に、図6に示した弁別回路によるパルスの検出方式で
は、パルスが重畳している場合、複数のパルスの重なり
が検出できないため単一のパルスとして誤認してしまう
という問題点があった。
However, when pulse detection is performed using the discrimination circuit having the above-described configuration, the pulse shown in FIG.
When the radiation is generated close to each other so that the pulses of the first and second pulses are partially overlapped, the output of the first amplifier becomes (C) of FIG.
As shown in (1), the pulses (a) and (b) are superimposed. When this pulse signal Vin is input to the discrimination circuit shown in FIG. 6, an output as shown by Vout is obtained. In other words, in this case, it can be recognized that only one pulse is generated despite the generation of two radiation pulses (a) and (b). FIG.
When the radiation causing the pulse (c) is generated after the pulse (a) is generated, the output of the first amplifier is the same as the pulse (a) and (c) as shown in (D) of FIG. Is partially superimposed. Therefore, when this pulse signal Vin is input to the discrimination circuit shown in FIG. 6, an output indicated by Vout is obtained. In this case, similarly, even when pulses due to two radiations (a) and (c) are generated. Regardless, 1
That is, only pulses can be recognized. As described above, the pulse detection method using the discrimination circuit shown in FIG. 6 has a problem that when pulses are superimposed, an overlap of a plurality of pulses cannot be detected, and the pulse is erroneously recognized as a single pulse. .

【0006】本発明は、従来の弁別回路によるパルス検
出方式における上記問題点を解消するためになされたも
ので、重畳した各パルス信号を確実に且つ容易に検出で
きるようにしたパルスエッジ検出回路を提供することを
目的とする。
SUMMARY OF THE INVENTION The present invention has been made to solve the above-described problem in the conventional pulse detection system using a discriminating circuit, and has a pulse edge detection circuit capable of reliably and easily detecting each superimposed pulse signal. The purpose is to provide.

【0007】[0007]

【課題を解決するための手段】上記問題点を解決するた
め、本発明は、入力パルス信号を遅延させるための遅延
回路と、遅延入力パルス信号の足切りをするためのリミ
ッタと、足切りされた遅延入力パルス信号と元の入力パ
ルス信号を比較しエッジ検出信号を出力するコンパレー
タとでパルスエッジ検出回路を構成するものである。
SUMMARY OF THE INVENTION In order to solve the above problems, the present invention provides a delay circuit for delaying an input pulse signal, a limiter for reducing a delay input pulse signal, and a limiter for reducing a delay input pulse signal. A pulse edge detection circuit is constituted by a comparator that compares the delayed input pulse signal with the original input pulse signal and outputs an edge detection signal.

【0008】このように構成することにより、重畳パル
ス信号に複数のピークが存在する限り、重畳した各パル
スの立ち上がり及び立ち下がりを検出することができ、
これを放射線計測におけるファースト・アンプ出力に適
用することにより、近接して発生した放射線を見逃すこ
となく確実にパイルアップの検出を行うことが可能とな
る。
With this configuration, as long as a plurality of peaks are present in the superimposed pulse signal, the rising and falling of each superimposed pulse can be detected.
By applying this to the output of the first amplifier in radiation measurement, it is possible to reliably detect pile-up without overlooking radiation generated in close proximity.

【0009】[0009]

【発明の実施の形態】次に、実施の形態について説明す
る。図1は、本発明に係るパルスエッジ検出回路の実施
の形態を示す回路構成図である。図1において、1は入
力パルス信号を遅延させるための遅延線、2は緩衝用バ
ッファアンプ、3はダイオードと電圧源VL とからなる
入力パルス信号の足切り、つまり低レベル部分を切除す
るためのリミッタ、4は遅延パルス信号と元の入力パル
ス信号とを比較するためのコンパレータである。なお、
回路上のRは遅延線1とのインピーダンスマッチング用
の抵抗である。
Next, an embodiment will be described. FIG. 1 is a circuit configuration diagram showing an embodiment of a pulse edge detection circuit according to the present invention. In FIG. 1, 1 is a delay line for delaying an input pulse signal, 2 is a buffer amplifier for buffering, and 3 is a cut-off of an input pulse signal composed of a diode and a voltage source VL , that is, for removing a low level portion. And 4 are comparators for comparing the delayed pulse signal with the original input pulse signal. In addition,
R on the circuit is a resistor for impedance matching with the delay line 1.

【0010】次に、このように構成されたパルスエッジ
検出回路の動作を、図2に示すタイミング図を参照しな
がら説明する。ここでは、図5の(C)に示した重畳パ
ルス信号に対応するパルス信号が入力されるものとす
る。入力されたパルス信号は、遅延線1により一定時
間遅延させられ、その遅延入力パルス信号は、バッフ
ァアンプ2を通った後リミッタ3により適当な足切り処
理がなされ、その足切り遅延入力パルス信号はコンパ
レータ4の反転入力端子へ入力される。また、コンパレ
ータ4の非反転入力端子には元の入力パルス信号が入
力される。この結果、コンパレータ4の出力端子からは
入力パルス信号の立ち上がりと立ち下がりに同期した矩
形波信号が出力される。
Next, the operation of the pulse edge detection circuit thus configured will be described with reference to the timing chart shown in FIG. Here, it is assumed that a pulse signal corresponding to the superimposed pulse signal shown in FIG. 5C is input. The input pulse signal is delayed for a predetermined time by the delay line 1. The delayed input pulse signal passes through the buffer amplifier 2 and is subjected to an appropriate truncation process by the limiter 3. The signal is input to the inverting input terminal of the comparator 4. The original input pulse signal is input to the non-inverting input terminal of the comparator 4. As a result, a rectangular wave signal synchronized with the rise and fall of the input pulse signal is output from the output terminal of the comparator 4.

【0011】また、このような構成のパルスエッジ検出
回路に、図5の(D)に示した重畳パルス信号に対応す
るパルス信号を入力すると、図3に示すように、入力さ
れた重畳パルス信号は遅延線1で一定時間遅延させら
れた後、リミッタ3で足切りがなされ、足切りされた遅
延入力パルス信号がコンパレータ4の反転入力端子に
入力される。そして、この反転入力端子に入力された遅
延入力重畳パルス信号はコンパレータ4の非反転入力
端子に入力された元の入力重畳パルス信号と比較さ
れ、信号と信号が交差する点で極性を反転する、2
つの重畳したパルス信号の立ち上がりと立ち下がりに同
期した矩形波信号が出力される。図5の(B)に示し
た重なりのないパルス信号に対応するパルス信号を入力
した場合も、当然のことながら同様に図4に示すように
2つのパルス信号の立ち上がりと立ち下がりに同期した
矩形波信号が出力される。
When a pulse signal corresponding to the superimposed pulse signal shown in FIG. 5D is input to the pulse edge detection circuit having such a configuration, as shown in FIG. Is delayed by the delay line 1 for a predetermined time, then cut off by the limiter 3, and the cut-off delayed input pulse signal is input to the inverting input terminal of the comparator 4. Then, the delayed input superimposed pulse signal input to the inverting input terminal is compared with the original input superimposed pulse signal input to the non-inverting input terminal of the comparator 4, and the polarity is inverted at the point where the signal and the signal cross. 2
A rectangular wave signal synchronized with the rise and fall of the two superposed pulse signals is output. When a pulse signal corresponding to the non-overlapping pulse signal shown in FIG. 5B is input, naturally, a rectangle synchronized with the rising and falling edges of the two pulse signals similarly as shown in FIG. A wave signal is output.

【0012】このように2つのパルスが重畳した状態の
パルス信号が入力された場合でも、図2及び図3に示す
ように、コンパレータの出力信号は、全て2個の矩形
波信号を生じていることから、図5の(C),(D)に
示すように従来の判別回路では検出できなかった重畳パ
ルスの検出が可能となることがわかる。
Even when a pulse signal in which two pulses are superimposed is input as described above, as shown in FIGS. 2 and 3, the output signals of the comparator all generate two rectangular wave signals. Thus, as shown in FIGS. 5C and 5D, it is possible to detect a superimposed pulse that could not be detected by the conventional discriminating circuit.

【0013】また、本発明に係るパルスエッジ検出回路
におけるコンパレータの出力信号の立ち上がり又は立ち
下がりエッジは、入力信号のエッジの始まりに同期して
いるため、出力信号の立ち上がり又は立ち下がりエッ
ジは、例えばピークホールドあるいはバレー(谷)ホー
ルドのトリガー信号として用いることができる。
Further, since the rising or falling edge of the output signal of the comparator in the pulse edge detection circuit according to the present invention is synchronized with the start of the edge of the input signal, the rising or falling edge of the output signal may be, for example, It can be used as a trigger signal for peak hold or valley hold.

【0014】なお、上記実施の形態においては、2つの
パルスが重畳している場合について説明を行ったが、本
発明は3つ以上のパルスが重畳している場合において
も、対応するパルスのピークが存在している場合は重畳
している各パルスを検出することが可能である。また、
本発明は放射線計測におけるパルスの検出のみならず、
一般的な入力パルス信号の検出に適用することができ
る。
In the above embodiment, the case where two pulses are superimposed has been described. However, the present invention is applicable to the case where three or more pulses are superimposed even when the corresponding pulse peaks. Is present, it is possible to detect each superimposed pulse. Also,
The present invention is not limited to pulse detection in radiation measurement,
It can be applied to detection of general input pulse signals.

【0015】[0015]

【発明の効果】以上実施の形態に基づいて説明したよう
に、本発明によれば、パルスが重畳している重畳パルス
信号が入力される場合でも、複数のピークが存在する限
り、複数のピークの立ち上がり及び立ち下がりエッジを
検出することができる。これによりパルスの重なりを検
出することができるため、放射線計測のパルスプロセッ
サのファースト・アンプ出力に適用すると、近接して発
生した放射線を見逃すことなく確実にパイルアップの検
出を行うことが可能となる。また、ファースト・アンプ
出力は単位時間当たりの放射線発生計数にも利用される
ため、計数誤差を小さくすることができる。更に、パル
スの立ち上がりあるいは立ち下がりを検出することがで
きるため、ピークホールドあるいはバレーホールド回路
のトリガー信号として利用することもできる。
As described above, according to the present invention, according to the present invention, even when a superimposed pulse signal on which a pulse is superimposed is input, a plurality of peaks are provided as long as the plurality of peaks exist. Rising and falling edges can be detected. This makes it possible to detect pulse overlap, so if it is applied to the output of the first amplifier of a pulse processor for radiation measurement, it is possible to reliably detect pileup without overlooking radiation generated in close proximity. . In addition, the output of the first amplifier is also used for counting radiation generation per unit time, so that a counting error can be reduced. Further, since the rise or fall of the pulse can be detected, it can be used as a trigger signal for a peak hold or valley hold circuit.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明に係るパルスエッジ検出回路の実施の形
態を示す回路構成図である。
FIG. 1 is a circuit configuration diagram showing an embodiment of a pulse edge detection circuit according to the present invention.

【図2】図1に示した実施の形態の動作を説明するため
のタイミング図である。
FIG. 2 is a timing chart for explaining the operation of the embodiment shown in FIG. 1;

【図3】同じく他の動作態様を説明するためのタイミン
グ図である。
FIG. 3 is a timing chart for explaining another operation mode.

【図4】同じく更に他の動作態様を説明するためのタイ
ミング図である。
FIG. 4 is a timing chart for explaining still another operation mode.

【図5】従来のパルス検出態様を説明するためのタイミ
ング図である。
FIG. 5 is a timing chart for explaining a conventional pulse detection mode.

【図6】従来のパルス検出に用いる弁別回路を示す回路
構成図である。
FIG. 6 is a circuit configuration diagram showing a conventional discrimination circuit used for pulse detection.

【符号の説明】[Explanation of symbols]

1 遅延線 2 バッファー・アンプ 3 リミッタ 4 コンパレータ 1 delay line 2 buffer amplifier 3 limiter 4 comparator

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】 入力パルス信号を遅延させるための遅延
回路と、遅延入力パルス信号の足切りをするためのリミ
ッタと、足切りされた遅延入力パルス信号と元の入力パ
ルス信号を比較しエッジ検出信号を出力するコンパレー
タとで構成したことを特徴とするパルスエッジ検出回
路。
1. A delay circuit for delaying an input pulse signal, a limiter for cutting off the delayed input pulse signal, and edge detection by comparing the cut-off delayed input pulse signal with the original input pulse signal. A pulse edge detection circuit comprising a comparator for outputting a signal.
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