JP2000333083A5 - - Google Patents

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【請求項１】 複数の受光素子が２次元状に配列されて形成された少なくとも一つの受光素子アレイと、
前記受光素子アレイの所定の受光素子または受光素子群に対応して設けられ、対応する受光素子または受光素子群から順次読み出された出力信号をアナログ・デジタル変換する複数のＡ／Ｄ変換器を有し、当該複数のＡ／Ｄ変換器が１次元状に配列されて構成されるＡ／Ｄ変換器アレイと、
前記受光素子アレイの各受光素子と１対１に対応して設けられ、前記Ａ／Ｄ変換器アレイから転送された対応する受光素子の出力信号に相当するデジタル信号について所定の演算を行う複数の演算素子を有し、当該複数の演算素子を２次元状に配列して、並列演算処理を行う演算素子アレイと、
前記Ａ／Ｄ変換器アレイの出力信号又は前記演算素子アレイからの出力信号を基にして前記各出力信号のフレームレートより低いフレームレートの画像信号に変換して出力する信号変換器と、
前記信号変換器の画像信号変換を制御する信号変換制御部と、
前記各構成要素を制御する制御回路と、
を備えていることを特徴とする高速視覚センサ装置。
【００１２】
【課題を解決するための手段】
上記課題を解決するため、本発明に係る高速視覚センサ装置は、（１）複数の受光素子が２次元状に配列されて形成された少なくとも一つの受光素子アレイと、（２）受光素子アレイの所定の受光素子または受光素子群に対応して設けられ、対応する受光素子または受光素子群から順次読み出された出力信号をアナログ・デジタル変換する複数のＡ／Ｄ変換器を有し、当該複数のＡ／Ｄ変換器が１次元状に配列されて構成されるＡ／Ｄ変換器アレイと、（３）受光素子アレイの各受光素子と１対１に対応して設けられ、Ａ／Ｄ変換器アレイから転送された対応する受光素子の出力信号に相当するデジタル信号について所定の演算を行う複数の演算素子を有し、当該複数の演算素子を２次元状に配列して、並列演算処理を行う演算素子アレイと、（４）Ａ／Ｄ変換器アレイの出力信号又は演算素子アレイからの出力信号を基にして各出力信号のフレームレートより低いフレームレートの画像信号に変換して出力する信号変換器と、（５）信号変換器の画像信号変換を制御する信号変換制御部と、（６）各構成要素を制御する制御回路と、を備えていることを特徴とする。
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