JP2000209874A - インバ―タの力率補正装置 - Google Patents
インバ―タの力率補正装置Info
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Abstract
能を行う回路をマイクロプロセッサの内部に追加して、
力率補正を簡単に行い得るインバータの力率補正装置を
提供する。 【解決手段】 商用交流電源100と、商用交流電源1
00を整流する整流部と、該整流部の出力電圧を平滑化
する平滑用キャパシタ120と、前記整流部の出力を入
力して前記商用交流電源のゼロ点を検出し、それに応じ
て所定パルス幅を有するスイッチ制御信号を出力するマ
イクロプロセッサ300と、該マイクロプロセッサ30
0から出力されるスイッチ制御信号によりオン/オフさ
れるスイッチング素子Q2と、前記平滑用キャパシタ1
20の直流出力電圧を可変周波数及び可変電圧に変換す
るインバータ130と、を包含するインバータの力率補
正装置である。
Description
補正装置に係るもので、詳しくは、家電製品などで大容
量の平滑用キャパシタを使用して発生する力率を改善す
るために使用されている従来のアナログ形態の力率補正
ICを使用することによる回路の複雑化、コストの増加
などの問題点を解決し得るインバータの力率補正装置に
関するものである。
性の面から家電製品の多くの部分でインバータ装置が使
用され、例えば、インバータ駆動モータを適用した洗濯
機及び冷蔵庫なども開発されて発売されつつある。従来
のインバータ装置においては、図4に示したように、商
用交流電源100と、該商用交流電源100を整流する
ブリッジダイオード111と、前記整流された直流電圧
を平滑化する平滑用キャパシタ120及びチョークコイ
ル112と、前記平滑化された直流電圧をパルス幅変調
(Pulse Width Modulation)により可変周波数及び可変
電圧に変換するインバータ130と、該インバータ13
0の制御により駆動されるモータ140と、を備えて構
成されていた。
ず、商用電源(大韓民国内では220V/60Hz)を
直流に変換した後、スイッチング素子を利用して所望の
電圧及び周波数に変換させるべきであるが、このように
直流に変換させる過程で、ダイオードを経由して整流さ
れた直流電圧を平滑化(smoothing )するためには大容
量のキャパシタが必要である。
とシステムの力率が減少するので、それを防止するため
の方法の1例として、力率補正装置を適用したインバー
タ装置を使用していた。即ち、従来インバータ装置の入
力電圧及び電流の波形を示した図5に示したように、商
用交流電源100の電流波形において、時間tはチョー
クコイル112及び平滑用キャパシタ120の時定数に
より決定され、通常、商用電源周期の1/5以下である
が、力率制御が理想的である場合(即ち、力率が1であ
るとき)、電流波形は電圧と同一位相を有し、商用電源
の最大電流振幅よりも小さいピーク電流を有するため、
ノイズ及び無効電力が減少するなどの効果がある。
に、従来の力率補正装置を適用したインバータ装置にお
いては、図6及び図7に示したように、商用交流電源1
00と、該商用交流電源100を整流するブリッジダイ
オード111と、前記整流された直流電圧を平滑化する
平滑用キャパシタ120及びチョークコイル220と、
前記平滑化された直流電圧をパルス幅変調(PWM)に
より可変周波数及び可変電圧に変換するインバータ13
0と、該インバータ130の制御により駆動されるモー
タ140と、を有するインバータ装置と;複数個の抵抗
R1〜R13、複数個のダイオードD1、D2、複数個
のキャパシタC1〜C3、アナログ力率補正IC210
及びスイッチング素子Q1を有する力率補正部200
と;を包含して構成されていた。
正装置を適用したインバータ装置の動作について説明す
る。先ず、印加された商用交流電源100はブリッジダ
イオード111により直流電圧に整流された後、各抵抗
R1、R2により分圧されてアナログ力率補正IC21
0の第3端子に入力される。
は前記アナログ力率補正IC210の第5端子(Ide
t)に入力されて、比較器211で予め決定された電圧
レベルと比較される。一方、前記インバータ130の両
端の電圧は各抵抗R11〜R13により分圧され、該分
圧された電圧は前記アナログ力率補正IC210の第1
端子に入力されて、前記比較器219で予め決定された
電圧レベル2.5Vと比較される。
圧は前記アナログ力率補正IC210の第4端子に入力
されて、比較器216でマルチプレクサ217の出力と
比較される。また、前記アナログ力率補正IC210
は、第8端子を介して入力電圧を受けて、力率制御の
際、入力電圧と入力電流との位相を一致させる。
0は、前記各入力端子を介して各信号を受けた後、図7
に示したようにセルフスタータ(SELF−START
ER)212、NORゲート215、NANDゲート2
13、214などを経由してスイッチQ1を制御する制
御信号を第7端子を介して出力し、前記制御信号はスイ
ッチQ1のゲートに印加されてスイッチング動作を行っ
て、入力電圧と入力電流との位相を一致させる。
正装置の動作を示した波形図で、図8(A)に示したよ
うに、前記ブリッジダイオード111の出力電圧はサイ
ン波の形態を有し、前記比較器216の各入力信号Vm
o、Vcsにより、前記スイッチ制御信号は図8(B)
に示したようになる。即ち、前記スイッチQ1は前記サ
イン波の低い部分ではデューティが大きくなり、サイン
波の高い部分ではデューティが小さくなる制御信号に従
ってスイッチング動作を行い、よって、全体的に入力電
流と入力電圧との位相を一致させる機能を有するように
なっていた。
来の力率補正装置を適用したインバータ装置において
は、図7に示したように部品の数が多くて回路が複雑に
なり、更に、チョークコイルには補助巻線が必要になる
ため製造費用が上昇するという不都合な点があった。
なされたもので、従来のアナログ力率補正ICの代わり
に力率補正機能を行う回路をマイクロプロセッサの内部
に追加して、力率補正を簡単に行い得るインバータの力
率補正装置を提供することを目的とする。
るため、本発明に係るインバータの力率補正装置におい
ては、商用交流電源を整流する整流部と、整流された商
用交流電源の入力を受けて負荷を駆動するインバータ
と、を有するインバータ装置において、前記整流部の出
力を受けて商用交流電源のゼロ点を検出した後、予め計
算して格納された前記整流部の出力であるアナログ波形
のデータを前記ゼロ点に同期させて所定パルス幅を有す
るスイッチ制御信号を出力するマイクロプロセッサと、
前記スイッチ制御信号によりオン/オフされるスイッチ
と、を備えて構成されている。
て、図面を用いて説明する。本発明に係るインバータの
力率補正装置においては、図1に示したように、商用交
流電源100と、ブリッジダイオード111及びチョー
クコイル112により構成されて前記商用交流電源を整
流する整流部と、該整流部の出力電圧を平滑化する平滑
用キャパシタ120と、前記整流部の出力を入力して商
用交流電源のゼロ点を検出し、それに応じた所定パルス
幅を有するスイッチ制御信号を出力するマイクロプロセ
ッサ300と、該マイクロプロセッサ300から出力さ
れるスイッチ制御信号によりオン/オフされるスイッチ
ング素子Q2と、前記平滑用キャパシタ120の直流出
力電圧をパルス幅変調(PWM)により可変周波数及び
可変電圧に変換するインバータ130と、該インバータ
130の制御により駆動されるモータ140と、を備え
て構成されている。
おいては、図3に示したように、前記ブリッジダイオー
ド111を経由して入力される電圧のゼロ点を検出する
比較器310と、商用交流電源の周波数(通常50Hz
または60Hz)に従ってアナログサイン波の大きさを
ディジタル化した値を格納するROM340と、前記マ
イクロプロセッサ300内部の基準クロックに同期して
所定周期毎にインタラプト信号を出力するインタラプト
タイマー320と、前記比較器310の出力及び前記イ
ンタラプトタイマー320の出力により前記ROM34
0のアドレスを指定するスタックポインタ330と、前
記ROM340から出力されるデータ中、上位値の入力
を受けてスイッチ制御信号のオフタイムを決定する上位
レジスタ350と、前記ROM340から出力されるデ
ータ中、下位値の入力を受けてスイッチ制御信号のオン
タイムを決定する下位レジスタ360と、前記基準クロ
ックに同期して前記上位レジスタ350から決定したス
イッチ制御信号のオフタイム値を出力するオフタイマー
370と、前記基準クロックに同期して前記下位レジス
タ360から決定したスイッチ制御信号のオンタイム値
を出力するオンタイマー380と、前記オンタイマー3
80またはオフタイマー370から出力される値に応じ
たスイッチ制御信号を出力するRSフリップフロップ3
90と、を備えて構成されている。
正装置の基本動作を示した波形図であって、図2(A)
は商用交流電源を整流したブリッジダイオード111の
出力を示した波形図、図2(B)は前記図2(A)のサ
イン波形からゼロ電圧を検出した波形図、図2(C)は
前記ゼロ点に同期して、ゼロ点近傍ではパルス幅が大き
くなり、入力電圧が大きくなるときはパルス幅が小さく
なるスイッチ制御信号を示した図で、前記スイッチ制御
信号は従来の力率補正装置のスイッチ制御信号と同様で
ある。
インバータの力率補正装置の動作に対し、図面に基づい
て説明する。先ず、図2(A)に示したように、ブリッ
ジダイオード111の出力電圧がマイクロプロセッサ3
00内部の比較器310に入力されると、該比較器31
0はゼロ電圧を検出し、前記マイクロプロセッサ300
は内部の基準クロックによりゼロ点の検出間隔をカウン
トする。世界的に使用される商用交流電源の周波数は、
通常、50Hz〜60Hzであるため、前記カウントし
た結果が55Hz以上であると商用電源の周波数を60
Hzに認識し、また、55Hz以下であると商用電源の
周波数を50Hzに認識する。
用電源の周波数によって予め計算されてROM340に
格納され、ここで、該格納されたデータはアナログサイ
ン波の大きさをディジタル化したものである。次いで、
インタラプトタイマー320は基準クロックに同期して
所定周期毎にインタラプト信号をスタックポインタ33
0に出力し、該スタックポインタ330は前記比較器3
10の出力をクリア信号CLRとして、前記インタラプ
トタイマー320の出力をクロック信号CLKとして、
それぞれ入力されて、前記ROM340のアドレスを指
定する信号を出力する。
信号の入力を受けて該当アドレスのスイッチ制御信号を
出力し、該スイッチ制御信号は上位値及び下位値に分か
れてそれぞれ上位レジスタ350及び下位レジスタ36
0に入力される。次いで、前記上位レジスタ350は前
記スイッチ制御信号の上位値の入力を受けてオフタイマ
ー370に出力し、前記下位レジスタ360は前記スイ
ッチ制御信号の下位値の入力を受けてオンタイマー38
0に出力する。
タイマー380は、入力される上位値及び下位値に従っ
てスイッチ制御信号のオフタイム及びスイッチ制御信号
のオンタイムをそれぞれ決定した後、基準クロックに同
期してRSフリップフロップ390に出力し、該RSフ
リップフロップ390は前記スイッチ制御信号を前記ス
イッチング素子Q2のゲート端子に出力して、該スイッ
チング素子Q2を駆動するようになっている。
バータの力率補正装置においては、アナログ形態の力率
補正ICを単一チップ化の容易なディジタル素子を使用
してマイクロプロセッサに一体化させるため、回路構成
が簡単で、部品の数が低下し、更に、チョークコイルに
補助巻線を追加しないため費用を低減し得るという効果
がある。
た回路図である。
形を示した波形図である。
る。
形図である。
を示した回路図である。
ある。
形図である。
Claims (3)
- 【請求項1】 商用交流電源を整流する整流部と、整流
された商用交流電源の入力を受けて負荷を駆動するイン
バータと、を有するインバータ装置において、 前記整流部の出力を受けて商用交流電源のゼロ点を検出
した後、予め計算して格納された前記整流部の出力であ
るアナログ波形のデータを前記ゼロ点に同期させて所定
パルス幅を有するスイッチ制御信号を出力するマイクロ
プロセッサと、 前記スイッチ制御信号によりオン/オフされるスイッチ
と、を備えて構成されることを特徴とするインバータの
力率補正装置。 - 【請求項2】 前記マイクロプロセッサは、 整流された商用交流電源のゼロ点を検出する比較器と、 前記整流部の出力であるアナログ波形の大きさをディジ
タル化したデータを格納するROMと、 前記マイクロプロセッサの基準クロックに同期して所定
周期毎にインタラプト信号を出力するインタラプトタイ
マーと、 前記比較器の出力及び前記インタラプトタイマーの出力
により前記ROMのアドレスを指定するスタックポイン
タと、 前記ROMから出力されるデータ中、上位値の入力を受
けて前記スイッチ制御信号のオフタイムを決定する上位
レジスタと、 前記ROMから出力されるデータ中、下位値の入力を受
けて前記スイッチ制御信号のオンタイムを決定する下位
レジスタと、 前記基準クロックに同期して、前記上位レジスタにより
決定された前記スイッチ制御信号のオフタイム値を出力
するオフタイマーと、 前記基準クロックに同期して、前記下位レジスタにより
決定された前記スイッチ制御信号のオンタイム値を出力
するオンタイマーと、 前記オンタイマーまたはオフタイマーから出力される値
に従って前記スイッチ制御信号を出力するRSフリップ
フロップと、を備えて構成されることを特徴とする請求
項1に記載のインバータの力率補正装置。 - 【請求項3】 前記ROMは、商用交流電源の周波数に
従って前記整流部の出力であるアナログ波形の大きさを
ディジタル化したデータを格納することを特徴とする請
求項2に記載のインバータの力率補正装置。
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