JP2000150503A - GaAsやGaNに基づく半導体基体上に酸化物層を含む物品 - Google Patents
GaAsやGaNに基づく半導体基体上に酸化物層を含む物品Info
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Abstract
(57)【要約】
【課題】 GaAsに基づく半導体及びGaNに基づく
半導体基体上にキャパシタンスが高く、かつ漏れ電流の
小さい酸化物層を有する物品を提供する。 【解決手段】 我々は厚さが5nm以下の単結晶、単一
ドメインの酸化物層がGaAsに基づく半導体基板の
(100)面上に成長できることを発見した。類似した
エピタキシャル酸化物がGaN及びGaNに基づく半導
体上に成長できる。酸化物とは、典型的にはMn2O3構
造(例えばGd2O3)の希土類酸化物である。酸化物/
半導体界面は低い界面状態密度で高品質で、酸化物層は
低い漏れ電流かつ高いブレークダウン電圧である。酸化
物層が薄くかつ誘電率が高いので単位領域当たりのキャ
パシタンスが高いMOS構造となる。このような構造に
よって有利なGaAsに基づくMOS−FETが形成さ
れる。
半導体基体上にキャパシタンスが高く、かつ漏れ電流の
小さい酸化物層を有する物品を提供する。 【解決手段】 我々は厚さが5nm以下の単結晶、単一
ドメインの酸化物層がGaAsに基づく半導体基板の
(100)面上に成長できることを発見した。類似した
エピタキシャル酸化物がGaN及びGaNに基づく半導
体上に成長できる。酸化物とは、典型的にはMn2O3構
造(例えばGd2O3)の希土類酸化物である。酸化物/
半導体界面は低い界面状態密度で高品質で、酸化物層は
低い漏れ電流かつ高いブレークダウン電圧である。酸化
物層が薄くかつ誘電率が高いので単位領域当たりのキャ
パシタンスが高いMOS構造となる。このような構造に
よって有利なGaAsに基づくMOS−FETが形成さ
れる。
Description
【0001】
【産業上の利用分野】本発明は、例えば電界効果トラン
ジスタ(FET)のようなGaAsやGaNに基づく半
導体基体上に酸化物層を含む物品に関する。
ジスタ(FET)のようなGaAsやGaNに基づく半
導体基体上に酸化物層を含む物品に関する。
【0002】
【従来の技術】GaAsトランジスタ及び回路は、とり
わけそのGaAsの相対的に高い移動度、半絶縁GaA
s基板の有用性や比較的製作プロセスの単純さ故に、例
えば無線通信装置といったものに利用されている。
わけそのGaAsの相対的に高い移動度、半絶縁GaA
s基板の有用性や比較的製作プロセスの単純さ故に、例
えば無線通信装置といったものに利用されている。
【0003】GaAsに基づくMOS−FETに対して
より多くの努力がなされてきた。例えば初期の研究報告
としてのT.Mimura 等のIEEE Transactions on Electron
Devices,Vol.ED-27(6),p.1147(june 1980)を参照され
たい。その論文の著者は達成された結果の主な点として
今のところ見込みはあるが、「デバイスの直流や低周波
数での動作において変則的な振る舞いを起こすことを含
め、いくつか技術的な問題が残っており、疑いなくこれ
らの問題はGaAsのMOSシステムにおける高い表面
状態密度に関連している。」と(p.1154で)結論づけて
いる。また、A.Colquhoun等のIEEE Transactions on El
ectron Devices,Vol.ED 25(3),p.375(March 1978) とH.
Takagi等のIEEE Transactions on Electron Devices,Vo
l.ED 25(5),p.551 (May 1978)を参照されたい。前者で
はチャネルの厚さを決定するエッチングされたノッチを
含むデバイスが発表された。そのような非平面構造は繰
り返して製造することが比較的困難であり、平面状のM
OS−FETに比べると期待は薄い。
より多くの努力がなされてきた。例えば初期の研究報告
としてのT.Mimura 等のIEEE Transactions on Electron
Devices,Vol.ED-27(6),p.1147(june 1980)を参照され
たい。その論文の著者は達成された結果の主な点として
今のところ見込みはあるが、「デバイスの直流や低周波
数での動作において変則的な振る舞いを起こすことを含
め、いくつか技術的な問題が残っており、疑いなくこれ
らの問題はGaAsのMOSシステムにおける高い表面
状態密度に関連している。」と(p.1154で)結論づけて
いる。また、A.Colquhoun等のIEEE Transactions on El
ectron Devices,Vol.ED 25(3),p.375(March 1978) とH.
Takagi等のIEEE Transactions on Electron Devices,Vo
l.ED 25(5),p.551 (May 1978)を参照されたい。前者で
はチャネルの厚さを決定するエッチングされたノッチを
含むデバイスが発表された。そのような非平面構造は繰
り返して製造することが比較的困難であり、平面状のM
OS−FETに比べると期待は薄い。
【0004】三浦等によって指摘されたように、初期の
デバイスは高い界面状態密度を含んではいるが、それは
ゲート酸化物とGaAsとの間の低い界面品質の影響を
受けていた。最近になってこの問題に対して相当な努力
が向けられてきた。
デバイスは高い界面状態密度を含んではいるが、それは
ゲート酸化物とGaAsとの間の低い界面品質の影響を
受けていた。最近になってこの問題に対して相当な努力
が向けられてきた。
【0005】例えばGd3Ga5O12の高純度単結晶から
電子線蒸着によるGa2O3膜の形成がアメリカ特許第5,
451,548号に開示された。また、アメリカ特許第5,550,0
89号、アメリカ特許出願第08/408,678号と第08/741,010
号では低いミッドギャップの界面状態密度を持つGaA
s/Ga2O3構造が開示された。また、M.Passlack等は
Applied Pysics Letters,Vol.69(3),p.302(July 1996)
で、分子線エピタキシーを製造されたGaAs/Ga2
O/SiO2構造の低い界面状態密度の熱力学的、光化
学的安定性を報告した。他の適切な出版物としてM.Pass
lack等のApplied Physics Letters,Vol.68(8),p.1099(F
eb.1996) やM.Hong等のJ. of Vacuum Science and Tech
nology B,Vol.14(3),p.2297,(May/June 1996)がある。
電子線蒸着によるGa2O3膜の形成がアメリカ特許第5,
451,548号に開示された。また、アメリカ特許第5,550,0
89号、アメリカ特許出願第08/408,678号と第08/741,010
号では低いミッドギャップの界面状態密度を持つGaA
s/Ga2O3構造が開示された。また、M.Passlack等は
Applied Pysics Letters,Vol.69(3),p.302(July 1996)
で、分子線エピタキシーを製造されたGaAs/Ga2
O/SiO2構造の低い界面状態密度の熱力学的、光化
学的安定性を報告した。他の適切な出版物としてM.Pass
lack等のApplied Physics Letters,Vol.68(8),p.1099(F
eb.1996) やM.Hong等のJ. of Vacuum Science and Tech
nology B,Vol.14(3),p.2297,(May/June 1996)がある。
【0006】この連続した出願のもとで、全体としてG
axAyOzの組成である酸化物層を伴いGaAsに基づ
く半導体(Gaは実質的に3+酸化状態であり、AはG
aの1ないしそれ以上に正に荷電した、3+の酸化状態
にあるGaを安定化するために採用された安定化元素
で、xは0以上、zはGaとAの両方が実質的に完全に
酸化される条件を満たすために選択され、かつy/(x
+y)が0.1より大きい)について開示してきた。一
つの実施例は、xが0、AがGdの酸化物Gd2O3であ
る。
axAyOzの組成である酸化物層を伴いGaAsに基づ
く半導体(Gaは実質的に3+酸化状態であり、AはG
aの1ないしそれ以上に正に荷電した、3+の酸化状態
にあるGaを安定化するために採用された安定化元素
で、xは0以上、zはGaとAの両方が実質的に完全に
酸化される条件を満たすために選択され、かつy/(x
+y)が0.1より大きい)について開示してきた。一
つの実施例は、xが0、AがGdの酸化物Gd2O3であ
る。
【0007】米国特許第09/122,558号(Chen等によって
1998年7月24日提出)及び第09/156,719号(Hong
等によって1998年9月18日提出)によって前述の
Ga xAyOzの組成のゲート酸化物を有するGaAsに
基づくMOS−FETの製作方法が開示された。
1998年7月24日提出)及び第09/156,719号(Hong
等によって1998年9月18日提出)によって前述の
Ga xAyOzの組成のゲート酸化物を有するGaAsに
基づくMOS−FETの製作方法が開示された。
【0008】
【発明が解決しようとする課題】MOS構造は基本的に
は、酸化物の誘電率に比例し、かつ酸化物層の厚みに反
比例するキャパシタンスを伴う平面キャパシタである。
単位面積当たりのキャパシタンスが増加したGaAsの
MOS構造を得るためには、従来の漏れ電流が許容でき
る程度に低くなるように利用されてきた酸化物層よりも
薄い構造を利用することが望ましい。本出願はそのよう
なGaAsに基づくMOS構造を開示する。
は、酸化物の誘電率に比例し、かつ酸化物層の厚みに反
比例するキャパシタンスを伴う平面キャパシタである。
単位面積当たりのキャパシタンスが増加したGaAsの
MOS構造を得るためには、従来の漏れ電流が許容でき
る程度に低くなるように利用されてきた酸化物層よりも
薄い構造を利用することが望ましい。本出願はそのよう
なGaAsに基づくMOS構造を開示する。
【0009】ここで記載された全ての特許、特許出願及
び科学技術論文はこの特許出願の引用文献として組み入
れられた。
び科学技術論文はこの特許出願の引用文献として組み入
れられた。
【0010】
【課題を解決するための手段】これからさらに詳しく述
べるように、この連続した出願のもとで、GaAsに基
づく半導体基体上に新しい誘電体層を含む物品、及び物
品の製作方法を開示している。
べるように、この連続した出願のもとで、GaAsに基
づく半導体基体上に新しい誘電体層を含む物品、及び物
品の製作方法を開示している。
【0011】さらに明確には、物品はGaAs半導体上
に酸化物層を含み、界面を形成している。物品はさらに
金属コンタクトを各酸化物層および半導体上に含む。界
面に関係づけられるミッドギャップ界面状態密度が20
℃でせいぜい1x1011cm -2eV-1である。
に酸化物層を含み、界面を形成している。物品はさらに
金属コンタクトを各酸化物層および半導体上に含む。界
面に関係づけられるミッドギャップ界面状態密度が20
℃でせいぜい1x1011cm -2eV-1である。
【0012】重要なことに、酸化物層はすべてGaxAy
Ozの組成をしており、そこでGaは実質的に3+の酸
化状態にあり、Aは3+の酸化状態にあるGaを安定化
するための1以上の正に荷電した安定化元素であり、x
は0以上、y/(x+y)は0.1以上、そしてzはG
aとAを実質的に完全に酸化するための必要性を満たす
十分な数である。ここで少なくとも80%(好ましくは
少なくとも90%)のそれぞれの元素が酸化される、す
なわちその元素が最も高い酸化状態にあるなら、Gaと
Aはそれぞれ本質的に完全に酸化されたと考えられる。
Gaの最も高い酸化状態は3+である。Aの最も高い酸
化状態はAに依存している。例えばもしAがアルカリ土
類元素ならばその状態は2+であり、もしAがSc、Y
や希土類元素ならばその状態は常にではないが、しばし
ば3+である。
Ozの組成をしており、そこでGaは実質的に3+の酸
化状態にあり、Aは3+の酸化状態にあるGaを安定化
するための1以上の正に荷電した安定化元素であり、x
は0以上、y/(x+y)は0.1以上、そしてzはG
aとAを実質的に完全に酸化するための必要性を満たす
十分な数である。ここで少なくとも80%(好ましくは
少なくとも90%)のそれぞれの元素が酸化される、す
なわちその元素が最も高い酸化状態にあるなら、Gaと
Aはそれぞれ本質的に完全に酸化されたと考えられる。
Gaの最も高い酸化状態は3+である。Aの最も高い酸
化状態はAに依存している。例えばもしAがアルカリ土
類元素ならばその状態は2+であり、もしAがSc、Y
や希土類元素ならばその状態は常にではないが、しばし
ば3+である。
【0013】本発明の物品作成方法はGaAsの半導体
を準備し、その物体の主表面の一部が実質的に原子レベ
ルで清浄で整列するように半導体を処理し、半導体を汚
染にほとんどさらすことなく実質的に原子レベルで清浄
で配列した表面に酸化物層を形成し金属コンタクトを形
成するステップを含むものである。
を準備し、その物体の主表面の一部が実質的に原子レベ
ルで清浄で整列するように半導体を処理し、半導体を汚
染にほとんどさらすことなく実質的に原子レベルで清浄
で配列した表面に酸化物層を形成し金属コンタクトを形
成するステップを含むものである。
【0014】重要なことに、第1の形成ステップは酸化
物層が全体としてGaxAyOzの組成であるような酸化
物層を形成することを含み、ここでGaは実質的に3+
にイオン化された状態であり、Aは3+にイオン化され
た状態のGaを安定化するための正に荷電した一ないし
それ以上の安定化元素であり、xはゼロ以上であり、y
/(x+y)が0.1以上であって、かつzはGaおよ
びAが実質的に完全に酸化される条件を十分に満たす。
物層が全体としてGaxAyOzの組成であるような酸化
物層を形成することを含み、ここでGaは実質的に3+
にイオン化された状態であり、Aは3+にイオン化され
た状態のGaを安定化するための正に荷電した一ないし
それ以上の安定化元素であり、xはゼロ以上であり、y
/(x+y)が0.1以上であって、かつzはGaおよ
びAが実質的に完全に酸化される条件を十分に満たす。
【0015】物品の好ましい実施例では、酸化物はGa
とAの両方を含み、安定化元素AはSc、Yあるいは
(原子番号55−71)の希土類元素である。もう一つ
の好ましい実施例では酸化物層は実質的にGaのない安
定化元素の酸化物層である。
とAの両方を含み、安定化元素AはSc、Yあるいは
(原子番号55−71)の希土類元素である。もう一つ
の好ましい実施例では酸化物層は実質的にGaのない安
定化元素の酸化物層である。
【0016】本発明の方法の好ましい実施例で酸化物層
は、一つは(たいてい粉状の)Ga 2O3を含む堆積源
で、他のものは典型的にはこれもまた粉状の(例えばG
d2O3といった)安定化元素の酸化物といった二つ(か
それ以上)の堆積源から同時に堆積され形成される。も
う一つの好ましい実施例では酸化物層はGd2O3といっ
た安定化元素の酸化物を含む単一の堆積源からの堆積に
よって形成される。
は、一つは(たいてい粉状の)Ga 2O3を含む堆積源
で、他のものは典型的にはこれもまた粉状の(例えばG
d2O3といった)安定化元素の酸化物といった二つ(か
それ以上)の堆積源から同時に堆積され形成される。も
う一つの好ましい実施例では酸化物層はGd2O3といっ
た安定化元素の酸化物を含む単一の堆積源からの堆積に
よって形成される。
【0017】我々は今回GaAs半導体基板上に単結
晶、単一ドメイン形態でGd2O3をエピタキシャル成長
できるという驚くべき発見をした。単結晶酸化物層は典
型的には5nmより薄いとても薄い層厚でさえも漏れ電
流が少なく、都合の良いことにゲート酸化物として利用
できる。「GaAsに基づく半導体」の意味する物は、
GaAsやInGaAsのようなIII/V族三元合金
およびAlInGaAsのようなGaやAs含有III
/V族四元合金である。さらに我々はGd2O3がGaN
やGaNに基づく半導体上に単結晶、単一ドメイン形態
で成長されうる事を発見した。
晶、単一ドメイン形態でGd2O3をエピタキシャル成長
できるという驚くべき発見をした。単結晶酸化物層は典
型的には5nmより薄いとても薄い層厚でさえも漏れ電
流が少なく、都合の良いことにゲート酸化物として利用
できる。「GaAsに基づく半導体」の意味する物は、
GaAsやInGaAsのようなIII/V族三元合金
およびAlInGaAsのようなGaやAs含有III
/V族四元合金である。さらに我々はGd2O3がGaN
やGaNに基づく半導体上に単結晶、単一ドメイン形態
で成長されうる事を発見した。
【0018】前述の発見によって、単位面積当たりのキ
ャパシタンスの増加したMOS構造の製作が可能とな
る。キャパシタンスの増加は第一に、従来可能であった
ものより薄い酸化物層を利用する技術のためである。
ャパシタンスの増加したMOS構造の製作が可能とな
る。キャパシタンスの増加は第一に、従来可能であった
ものより薄い酸化物層を利用する技術のためである。
【0019】我々は最近、本発明はGd2O3の利用に限
られるのではなく、希土類元素の相互の類似性が知られ
ていることに照らして、立方体構造Mn2O3型の酸化物
として与えられる他の希土類元素もまた利用されるもの
と信じている。
られるのではなく、希土類元素の相互の類似性が知られ
ていることに照らして、立方体構造Mn2O3型の酸化物
として与えられる他の希土類元素もまた利用されるもの
と信じている。
【0020】さらに特定すると、我々の発明は半導体基
板上に酸化物層を伴う平面単結晶半導体基板を含む物品
において実施される。
板上に酸化物層を伴う平面単結晶半導体基板を含む物品
において実施される。
【0021】重要なことに、半導体基板はGaAsに基
づくIII/V族半導体からなる一群から選択され、酸
化物はMn2O3型の立方体構造をもち、かつX2O3の組
成(ここでXは希土類元素、一つないしそれ以上のY,
La,Pr,Nd,Sm,Eu,Gd,Tb,Dy,H
o,Er,Tm,Yb及びLuで典型的にはY)酸化物
層は好ましくは5nmより薄い単結晶、単一ドメインの
層である。「単一ドメイン」の単結晶層とは全体を通し
てここでは同じ結晶方位をもつ結晶層を意味する。
づくIII/V族半導体からなる一群から選択され、酸
化物はMn2O3型の立方体構造をもち、かつX2O3の組
成(ここでXは希土類元素、一つないしそれ以上のY,
La,Pr,Nd,Sm,Eu,Gd,Tb,Dy,H
o,Er,Tm,Yb及びLuで典型的にはY)酸化物
層は好ましくは5nmより薄い単結晶、単一ドメインの
層である。「単一ドメイン」の単結晶層とは全体を通し
てここでは同じ結晶方位をもつ結晶層を意味する。
【0022】
【実施例】我々の知る限り、従来技術のGaAsに基づ
くMOS構造はアモルファスな酸化物層を含んでいた。
実際、我々は従来に単結晶酸化物層によってこのような
構造を形成するいかなる提案にも気付かなかった。
くMOS構造はアモルファスな酸化物層を含んでいた。
実際、我々は従来に単結晶酸化物層によってこのような
構造を形成するいかなる提案にも気付かなかった。
【0023】一般的に類似した特徴は異なる図で同じ添
字によって示した。図は寸法を示していない。図1には
典型的な電子デバイスであるGaAsに基づくMOS−
FETの概要を描写した。添字140−147はそれぞ
れGaAs基板(典型的にはp形)、ソース領域(典型
的にはn形)、ドレイン領域(典型的にはn形)、ドレ
インコンタクト、ソースコンタクト、ゲート酸化物、ゲ
ートコンタクトおよびフィールド酸化物を指している。
140と145との間の界面に関連した界面状態密度は
1011/cm2eV以下であり典型的には再結合速度は
104cm/s以下である。
字によって示した。図は寸法を示していない。図1には
典型的な電子デバイスであるGaAsに基づくMOS−
FETの概要を描写した。添字140−147はそれぞ
れGaAs基板(典型的にはp形)、ソース領域(典型
的にはn形)、ドレイン領域(典型的にはn形)、ドレ
インコンタクト、ソースコンタクト、ゲート酸化物、ゲ
ートコンタクトおよびフィールド酸化物を指している。
140と145との間の界面に関連した界面状態密度は
1011/cm2eV以下であり典型的には再結合速度は
104cm/s以下である。
【0024】この連続した出願のもとで、GaAsに基
づくMOS−FET構造の製作プロセスを詳細に開示し
てきた。このプロセスは組成が全体としてGaxAyOz
(X≧0で他の記号は前述の通り)である酸化物層を伴
うような構造を製作するために利用される。出願を通し
て酸化物層の厚さは典型的には約5−150nmの範囲
であることもまた明らかにされている。このプロセスの
重要な側面は基板の表面状態である。表面は本質的に原
子レベルで清浄でありかつ整列、すなわち表面は再構成
されなければならない。
づくMOS−FET構造の製作プロセスを詳細に開示し
てきた。このプロセスは組成が全体としてGaxAyOz
(X≧0で他の記号は前述の通り)である酸化物層を伴
うような構造を製作するために利用される。出願を通し
て酸化物層の厚さは典型的には約5−150nmの範囲
であることもまた明らかにされている。このプロセスの
重要な側面は基板の表面状態である。表面は本質的に原
子レベルで清浄でありかつ整列、すなわち表面は再構成
されなければならない。
【0025】このように製作されたMOS−FETは集
積回路を形成するために、他のMOS−FETを含む他
の電子デバイスに望むように電気的に接続される。例と
して相補形MOS−FETはインバータを提供するため
に図2のように接続される。図2において添字231は
nチャネルエンハンスメント形GaAsMOS−FET
を、232はpチャネルエンハンスメント形GaAsM
OS−FETを示している。その回路自体は慣例的なも
のではあるが、我々の知る限りにおいてGaAsのMO
S−FET技術を使ったものとしては新規なものであ
る。図2の接続は本発明による代表的な回路である。
積回路を形成するために、他のMOS−FETを含む他
の電子デバイスに望むように電気的に接続される。例と
して相補形MOS−FETはインバータを提供するため
に図2のように接続される。図2において添字231は
nチャネルエンハンスメント形GaAsMOS−FET
を、232はpチャネルエンハンスメント形GaAsM
OS−FETを示している。その回路自体は慣例的なも
のではあるが、我々の知る限りにおいてGaAsのMO
S−FET技術を使ったものとしては新規なものであ
る。図2の接続は本発明による代表的な回路である。
【0026】当業者には自明のことであるが、上述のプ
ロセスは同じ基板上にGaAsの平面的なn形およびp
形MOS−FETを製作するために適しているだけでな
く、このようなMOS−FETとGaAs(金属−半導
体)MES−FETを結合するためにも使われる。ME
S−FETを製作するために典型的にはゲート酸化物は
それぞれのゲート領域から除去され、ふさわしい金属
(例えばTi/Pt/Au)がショットキーバリアコン
タクトを提供するためにゲート領域に堆積される。Ga
Asに基づくMES−FETは良く知られており、詳細
な説明は必要ない。しかし我々の知る限り、GaAsの
MES−FETとGaAsのMOS−FET(相補形エ
ンハンスメント形GaAsのMOS−FETを含む)と
を統合する技術は従来に存在していなかった。
ロセスは同じ基板上にGaAsの平面的なn形およびp
形MOS−FETを製作するために適しているだけでな
く、このようなMOS−FETとGaAs(金属−半導
体)MES−FETを結合するためにも使われる。ME
S−FETを製作するために典型的にはゲート酸化物は
それぞれのゲート領域から除去され、ふさわしい金属
(例えばTi/Pt/Au)がショットキーバリアコン
タクトを提供するためにゲート領域に堆積される。Ga
Asに基づくMES−FETは良く知られており、詳細
な説明は必要ない。しかし我々の知る限り、GaAsの
MES−FETとGaAsのMOS−FET(相補形エ
ンハンスメント形GaAsのMOS−FETを含む)と
を統合する技術は従来に存在していなかった。
【0027】GaAsに基づくMOS−FETは連続し
た出願のもとで説明されているように製作される。製作
されたデバイス(40x50μm2ゲート領域)は検査
され、次のような特徴を持つことが見つけられた。
た出願のもとで説明されているように製作される。製作
されたデバイス(40x50μm2ゲート領域)は検査
され、次のような特徴を持つことが見つけられた。
【0028】図3に示されたようにゲート酸化物はブレ
ークダウン電圧は3.6x106Vol/cmである。
相互コンダクタンスは0.3mS/mmである。図4は
典型的なMOS−FETのドレインI−V特性で、図5
はドレイン電流とゲート電圧を示した図である。
ークダウン電圧は3.6x106Vol/cmである。
相互コンダクタンスは0.3mS/mmである。図4は
典型的なMOS−FETのドレインI−V特性で、図5
はドレイン電流とゲート電圧を示した図である。
【0029】単結晶GGG(ガドリニウム、ガリウム、
ガーネット;Gd3Ga5O12)からの電子線蒸着によっ
て膜中には少量(例えば0.1%)のGdのみが存在す
るほとんど純粋なGa2O3の薄い膜の堆積が可能である
と技術的に考えられていることは様々な引用文献(例え
ば、米国特許第5,550,089号及び第5,597,768号;M.Pass
lack等のApplied Physics Letters,Vol.69(3),pp.302-3
04)から明かである。
ガーネット;Gd3Ga5O12)からの電子線蒸着によっ
て膜中には少量(例えば0.1%)のGdのみが存在す
るほとんど純粋なGa2O3の薄い膜の堆積が可能である
と技術的に考えられていることは様々な引用文献(例え
ば、米国特許第5,550,089号及び第5,597,768号;M.Pass
lack等のApplied Physics Letters,Vol.69(3),pp.302-3
04)から明かである。
【0030】更にGdの存在は望まれないものであり理
想的には膜は純粋なGa酸化物であるべきだと信じられ
ている。例えば米国特許第5,597,768号のcol.1の39-45
行目に「主な問題はGd2O3のいくつか(特許に従えば
約0.1%)がバルクのトラップ濃度を増加させる欠陥
を形成する不純物として薄膜に取り込まれることであ
る。増加された欠陥と同様に増加されたバルクのトラッ
プ濃度は薄膜が用いられたデバイスの性能を低下させ
る。」と開示されているので参照せよ。Ga2O3薄膜中
の不純物のレベルを低下させるために、その'768の特許
ではGa2O3とGa 2O3の昇華温度を超える700度よ
りも高い融点を持つ、もう一つの酸化物を含む異なった
堆積源材料の利用を教示している。そんな材料の一つが
MgGa2O4であり、MgOとGa2O3を含むと述べら
れている。「GGGの代わりにMgGa2O4を利用する
ことによって、酸化膜の望まれない種の取り込みを劇的
に減らせることや、重要なことに酸化膜の低いバルクの
トラップ濃度が実現される」と述べられている。'768特
許のcol.318-21行を参照されたい。しかしながら'768
特許はいかなる実験データも与えてはいない。
想的には膜は純粋なGa酸化物であるべきだと信じられ
ている。例えば米国特許第5,597,768号のcol.1の39-45
行目に「主な問題はGd2O3のいくつか(特許に従えば
約0.1%)がバルクのトラップ濃度を増加させる欠陥
を形成する不純物として薄膜に取り込まれることであ
る。増加された欠陥と同様に増加されたバルクのトラッ
プ濃度は薄膜が用いられたデバイスの性能を低下させ
る。」と開示されているので参照せよ。Ga2O3薄膜中
の不純物のレベルを低下させるために、その'768の特許
ではGa2O3とGa 2O3の昇華温度を超える700度よ
りも高い融点を持つ、もう一つの酸化物を含む異なった
堆積源材料の利用を教示している。そんな材料の一つが
MgGa2O4であり、MgOとGa2O3を含むと述べら
れている。「GGGの代わりにMgGa2O4を利用する
ことによって、酸化膜の望まれない種の取り込みを劇的
に減らせることや、重要なことに酸化膜の低いバルクの
トラップ濃度が実現される」と述べられている。'768特
許のcol.318-21行を参照されたい。しかしながら'768
特許はいかなる実験データも与えてはいない。
【0031】我々の継続的な研究(ラザフォード後方散
乱分光法(RBS)と堆積超薄膜のAuger分析)か
ら(例えば界面状態密度が1010cm-2eV-1の範囲で
特には1x1011cm-2eV-1かそれより低く、低い漏
れ電流で高いブレークダウン電圧の)デバイスの品質の
酸化物薄膜をGaAsとGaAsの半導体に作成する新
しい試みを導くような結果が得られている。
乱分光法(RBS)と堆積超薄膜のAuger分析)か
ら(例えば界面状態密度が1010cm-2eV-1の範囲で
特には1x1011cm-2eV-1かそれより低く、低い漏
れ電流で高いブレークダウン電圧の)デバイスの品質の
酸化物薄膜をGaAsとGaAsの半導体に作成する新
しい試みを導くような結果が得られている。
【0032】我々は特に'768の特許が教示したものと対
照的に望ましい酸化物薄膜が実質的量のGd(あるいは
他の適当な金属元素)からなることを発見した。実際、
我々は純粋なGa2O3粉末(これは純粋なGa酸化物で
ある)からの蒸着によって形成された膜が一般的にデバ
イスに利用できる品質ではなく、純粋なGd2O3(これ
は実質的に純粋なGd酸化物である)からの蒸着によっ
て形成された膜は低い界面状態密度で一般的にデバイス
として利用できる品質であることを発見した。このこと
は図6で例示されており、MOSコンデンサの決められ
た領域に慣例的な金属コンタクトを持つGaAs上の酸
化物超薄膜(16.5nm−40nm)のI−V(電流
ー電圧)特性のデータを示した。図6からただちに理解
されるように40nmの厚さのGa2O3膜は正のバイア
スが印可されたとき相対的に漏れ電流はあるが、負のバ
イアスが印可されたときブレークダウン電圧が実質的に
ゼロであり、このことは多くのデバイスへの適用に適し
てはいない、一方18.5nmの厚さのGd2O3膜は+
/−3Vの時僅かに10ー 8A/cm2の電流を流す。中
間組成の(Gdの組成が膜の全金属の原子組成が6、1
4、20%)膜は中間のブレークダウン電圧を示してい
る。
照的に望ましい酸化物薄膜が実質的量のGd(あるいは
他の適当な金属元素)からなることを発見した。実際、
我々は純粋なGa2O3粉末(これは純粋なGa酸化物で
ある)からの蒸着によって形成された膜が一般的にデバ
イスに利用できる品質ではなく、純粋なGd2O3(これ
は実質的に純粋なGd酸化物である)からの蒸着によっ
て形成された膜は低い界面状態密度で一般的にデバイス
として利用できる品質であることを発見した。このこと
は図6で例示されており、MOSコンデンサの決められ
た領域に慣例的な金属コンタクトを持つGaAs上の酸
化物超薄膜(16.5nm−40nm)のI−V(電流
ー電圧)特性のデータを示した。図6からただちに理解
されるように40nmの厚さのGa2O3膜は正のバイア
スが印可されたとき相対的に漏れ電流はあるが、負のバ
イアスが印可されたときブレークダウン電圧が実質的に
ゼロであり、このことは多くのデバイスへの適用に適し
てはいない、一方18.5nmの厚さのGd2O3膜は+
/−3Vの時僅かに10ー 8A/cm2の電流を流す。中
間組成の(Gdの組成が膜の全金属の原子組成が6、1
4、20%)膜は中間のブレークダウン電圧を示してい
る。
【0033】我々はインシツで二つの異なった種、例え
ば一つにGa2O3粉末と他のものにGd2O3粉末を用い
てGd(あるいは他の適当な金属原子)の組成が少なく
とも全金属組成原子の10原子%、好ましくは少なくと
も20原子%に成るように堆積速度が与えられた協調堆
積によって作成された酸化物薄膜が一般的にデバイスの
品質を満たすことを発見してきた。
ば一つにGa2O3粉末と他のものにGd2O3粉末を用い
てGd(あるいは他の適当な金属原子)の組成が少なく
とも全金属組成原子の10原子%、好ましくは少なくと
も20原子%に成るように堆積速度が与えられた協調堆
積によって作成された酸化物薄膜が一般的にデバイスの
品質を満たすことを発見してきた。
【0034】GaAs基板は堆積がインシツで行われサ
ンプルを大気にさらすことなしに前述のように(原子レ
ベルで本質的に清浄で整列した)準備されたことが理解
されるだろう。
ンプルを大気にさらすことなしに前述のように(原子レ
ベルで本質的に清浄で整列した)準備されたことが理解
されるだろう。
【0035】前述の実験的事実は混合酸化物膜(前記に
よって決定されたx、y、zのGa xAyOzの組成を持
つ)においてGaイオンが3+の酸化状態にされる条件
と一致している。このことは安定化元素と酸素組成を適
切に選ぶことによってなされる。
よって決定されたx、y、zのGa xAyOzの組成を持
つ)においてGaイオンが3+の酸化状態にされる条件
と一致している。このことは安定化元素と酸素組成を適
切に選ぶことによってなされる。
【0036】Gaが1+、2+、3+の酸化状態で存在
し、3+状態のGaを安定化できる正に荷電した元素
(「安定化体」と呼ぶ)があることが知られている。G
aの安定化体の中でGdはポーリングの電気陰性度1.
1を持っている。他のGaに対して可能な安定化体はS
c、Yや他の希土類、アルカリ土類やアルカリ金属元素
がある。Gaに対する安定化原素の提供に加えて、Ga
とその安定化元素が本質的に十分に酸化されるという条
件を満たすために堆積膜に十分な量の酸素元素が存在す
ることも必要である。
し、3+状態のGaを安定化できる正に荷電した元素
(「安定化体」と呼ぶ)があることが知られている。G
aの安定化体の中でGdはポーリングの電気陰性度1.
1を持っている。他のGaに対して可能な安定化体はS
c、Yや他の希土類、アルカリ土類やアルカリ金属元素
がある。Gaに対する安定化原素の提供に加えて、Ga
とその安定化元素が本質的に十分に酸化されるという条
件を満たすために堆積膜に十分な量の酸素元素が存在す
ることも必要である。
【0037】前述の説明は指導的目的だけのものであっ
て本発明の範囲を制限するものではない。
て本発明の範囲を制限するものではない。
【0038】本特許出願の発明の好ましい実施例として
酸化膜は得られる膜が全体を通してGaxAyOzの組成
を持つように堆積パラメーターを選択して(例えば電子
線蒸着源といった)二つ以上の別の堆積源から堆積する
ことによって形成される。ここでAはx>0でGaの酸
化状態を3+で安定化させるための1以上に正に荷電し
た安定化元素である。さらにy/(x+y)が0.1と
等しいかより大きいとき、好ましくは0.2以上のとき
zはGaとAが実質的に完全に酸化されると言う条件を
満たすために選択される。
酸化膜は得られる膜が全体を通してGaxAyOzの組成
を持つように堆積パラメーターを選択して(例えば電子
線蒸着源といった)二つ以上の別の堆積源から堆積する
ことによって形成される。ここでAはx>0でGaの酸
化状態を3+で安定化させるための1以上に正に荷電し
た安定化元素である。さらにy/(x+y)が0.1と
等しいかより大きいとき、好ましくは0.2以上のとき
zはGaとAが実質的に完全に酸化されると言う条件を
満たすために選択される。
【0039】他の好ましい実施例として酸化膜はGa酸
化物の堆積することなしにAの酸化物の堆積によって形
成される。zはAが実質的に完全に酸化されるように選
択され、前記膜の全体としての組成はAOzである。
化物の堆積することなしにAの酸化物の堆積によって形
成される。zはAが実質的に完全に酸化されるように選
択され、前記膜の全体としての組成はAOzである。
【0040】(x=0でx>0の場合の)例としてAは
Sc、Y、(原子番号55−71)の希土類金属、アル
カリ土類(Be,Mg,Ca,Sr,Baなど)及びア
ルカリ金属元素(Li,Na,K,Rb,Csなど)を
含むグループから選択される。
Sc、Y、(原子番号55−71)の希土類金属、アル
カリ土類(Be,Mg,Ca,Sr,Baなど)及びア
ルカリ金属元素(Li,Na,K,Rb,Csなど)を
含むグループから選択される。
【0041】アルカリ金属元素は湿気に対する不安定さ
や半導体デバイスの製造プロセスの条件の違いのために
一般に好まれない。現在のところ、好まれる安定化元素
はSc、Y、(原子番号57ー71の)希土類とアルカ
リ土類金属元素で、Sc,Y,La,Nd,Gd,D
y,Ho,Er及びLuが最も好まれている。
や半導体デバイスの製造プロセスの条件の違いのために
一般に好まれない。現在のところ、好まれる安定化元素
はSc、Y、(原子番号57ー71の)希土類とアルカ
リ土類金属元素で、Sc,Y,La,Nd,Gd,D
y,Ho,Er及びLuが最も好まれている。
【0042】混合酸化膜においてGa(およびA)が実
質的に完全に酸化される条件とは全てのGaの100%
が3+にイオン化された状態にあることを意味している
わけではないことは理解されるであろう。もし全てのG
aの80%以上が3+の状態にあり、80%以上のAが
完全に酸化されているならば、典型的には許容できる結
果が得られる。
質的に完全に酸化される条件とは全てのGaの100%
が3+にイオン化された状態にあることを意味している
わけではないことは理解されるであろう。もし全てのG
aの80%以上が3+の状態にあり、80%以上のAが
完全に酸化されているならば、典型的には許容できる結
果が得られる。
【0043】図7にn型(2x1017cm-3)のGaA
sの(100)面上のGd2O3の19nmの厚さのフィ
ルムに対するC−V(キャパシタンスー電圧)データを
示した。MOS型コンデンサの電極領域は4.4x10
-5cm2である。図7は低周波での蓄積と反転をはっき
りと示している。このデータはMOS−FETを含むデ
バイスの応用にこの酸化膜が適していることを証明して
いる。
sの(100)面上のGd2O3の19nmの厚さのフィ
ルムに対するC−V(キャパシタンスー電圧)データを
示した。MOS型コンデンサの電極領域は4.4x10
-5cm2である。図7は低周波での蓄積と反転をはっき
りと示している。このデータはMOS−FETを含むデ
バイスの応用にこの酸化膜が適していることを証明して
いる。
【0044】図8はGaとGdが全金属数の約22%で
あるGdを含む32nmの厚さの混合酸化膜に対する同
様のデータである。データはまた、実質的には図7と同
様に蓄積と反転を示している。
あるGdを含む32nmの厚さの混合酸化膜に対する同
様のデータである。データはまた、実質的には図7と同
様に蓄積と反転を示している。
【0045】好ましい実施例として物品は反転チャネル
を持つ平面状のエンハンスメント型MOS−FETを含
んでいる。
を持つ平面状のエンハンスメント型MOS−FETを含
んでいる。
【0046】例1 MOS−FETはこの連続した出願のもとに開示された
方法に実質的に従って製作される。Gd及びGa含有酸
化膜は、Ga2O3粉を含む蒸着源及びGd2O3を含む堆
積源から、金属全体の22%のGdを含む組成の膜が得
られるように選択された堆積速度で、同時電子線蒸着に
よって堆積される。MOS−FETは実質的に図3−5
に示された特徴を持つ。
方法に実質的に従って製作される。Gd及びGa含有酸
化膜は、Ga2O3粉を含む蒸着源及びGd2O3を含む堆
積源から、金属全体の22%のGdを含む組成の膜が得
られるように選択された堆積速度で、同時電子線蒸着に
よって堆積される。MOS−FETは実質的に図3−5
に示された特徴を持つ。
【0047】例2 酸化膜がGd2O3であることを除いて、実質的に例1に
従って製作されたMOS−FETである。MOS−FE
Tは実質的に例1のデバイスと同様の性能である。
従って製作されたMOS−FETである。MOS−FE
Tは実質的に例1のデバイスと同様の性能である。
【0048】この連続した特許出願のもとのGaAsに
基づくMOS構造はすばらしい特徴を示すが、もし更な
る改善が得られるならば望ましいことである。我々はこ
のことに、Gd2O3(及びMg2O3型構造を持つ他の立
方体酸化物)が低い漏れ電流、かつ高いブレークダウン
電圧を持つとても薄い(例えば5nmより薄い)層で、
(100)GaAs上にエピタキシャル単結晶、単一ド
メイン形の状態で堆積できるという驚くべき発見を通し
て成功した。これは厚さ1.5nmのエピタキシャルG
d2O3膜が約10-9A/cm2の漏れ電流(0Vの時)
を持つことを表した図14によって示されている。MO
S−FETの単位領域当たりのキャパシタンスは誘電体
層の厚さに反比例するので、5nmより薄い酸化膜を伴
う本発明に従うMOS構造が実質的により厚い酸化膜
(例えば18.5nm)を伴う従来技術に基づく類似し
た構造より単位領域当たりのキャパシタンスが著しく大
きいことは明白である。
基づくMOS構造はすばらしい特徴を示すが、もし更な
る改善が得られるならば望ましいことである。我々はこ
のことに、Gd2O3(及びMg2O3型構造を持つ他の立
方体酸化物)が低い漏れ電流、かつ高いブレークダウン
電圧を持つとても薄い(例えば5nmより薄い)層で、
(100)GaAs上にエピタキシャル単結晶、単一ド
メイン形の状態で堆積できるという驚くべき発見を通し
て成功した。これは厚さ1.5nmのエピタキシャルG
d2O3膜が約10-9A/cm2の漏れ電流(0Vの時)
を持つことを表した図14によって示されている。MO
S−FETの単位領域当たりのキャパシタンスは誘電体
層の厚さに反比例するので、5nmより薄い酸化膜を伴
う本発明に従うMOS構造が実質的により厚い酸化膜
(例えば18.5nm)を伴う従来技術に基づく類似し
た構造より単位領域当たりのキャパシタンスが著しく大
きいことは明白である。
【0049】再構成(100)GaAs上へのGd2O3
の成長は前述の単結晶Ga5Gd3O 12の蒸着に類似した
条件下で複数チャンバーのUHVのなかで行われる。例
えばM.Hong等のJ. of Crystal Growth,Vol.150,pp.277-
284,1995及びこの連続した特許出願のもとを参照された
い。
の成長は前述の単結晶Ga5Gd3O 12の蒸着に類似した
条件下で複数チャンバーのUHVのなかで行われる。例
えばM.Hong等のJ. of Crystal Growth,Vol.150,pp.277-
284,1995及びこの連続した特許出願のもとを参照された
い。
【0050】Ga5Gd3O12の蒸着によって形成された
酸化物混合膜はアモルファスであるが、Gd2O3(典型
的には固められた粉の形態)の蒸着によって形成された
膜は、疑いなく単結晶(100)GaAs基板にエピタ
キシャル成長された単結晶である。酸化膜はGaAs
(100)面上に(110)配向で成長される。
酸化物混合膜はアモルファスであるが、Gd2O3(典型
的には固められた粉の形態)の蒸着によって形成された
膜は、疑いなく単結晶(100)GaAs基板にエピタ
キシャル成長された単結晶である。酸化膜はGaAs
(100)面上に(110)配向で成長される。
【0051】
【外1】
【0052】図12にはそれぞれ18.5、3.5及び
1.5nmのGd2O3膜の表面垂直(110)に沿った
X線回折パターンを示した。図13にはこれらのピーク
のおよそθ角のロッキングスキャン像が示されている。
これらや他の測定がMn2O3構造を持つ酸化物層に行わ
れた。最も薄い膜(たとえば1.5nm)が非常に鋭い
要素としてロッキングスキャンに現れ、これは格子の弾
性ひずみを示し、面内エピタキシャル条件の完全さが確
かめられた。膜の厚さ(例えば5nmないしそれ以上)
が成長するにつれてミスフィット転移の生成によるひず
みを緩和するためにエネルギー的にさらに好ましくな
る。
1.5nmのGd2O3膜の表面垂直(110)に沿った
X線回折パターンを示した。図13にはこれらのピーク
のおよそθ角のロッキングスキャン像が示されている。
これらや他の測定がMn2O3構造を持つ酸化物層に行わ
れた。最も薄い膜(たとえば1.5nm)が非常に鋭い
要素としてロッキングスキャンに現れ、これは格子の弾
性ひずみを示し、面内エピタキシャル条件の完全さが確
かめられた。膜の厚さ(例えば5nmないしそれ以上)
が成長するにつれてミスフィット転移の生成によるひず
みを緩和するためにエネルギー的にさらに好ましくな
る。
【0053】我々のX線での研究によって前述の条件下
で、Gd2O3が(100)GaAs上に単結晶、単一ド
メインで形成できることが証明された。長方対称の(1
10)Gd2O3面を正方対称の(100)GaAs面へ
調整する事による2回回転対称の退化を考慮に入れる
と、これは異常なことである。単一ドメインの達成によ
ってGaAs表面に(2X4)再構成が引き起こされ、
2回回転対称の退化が取り除かれ、単一の変形成長が好
まれる。さらに我々はGaによって安定化された(4x
6)再構成GaAs表面上の単一ドメインGd2O3のエ
ピタキシャル成長を確認した。
で、Gd2O3が(100)GaAs上に単結晶、単一ド
メインで形成できることが証明された。長方対称の(1
10)Gd2O3面を正方対称の(100)GaAs面へ
調整する事による2回回転対称の退化を考慮に入れる
と、これは異常なことである。単一ドメインの達成によ
ってGaAs表面に(2X4)再構成が引き起こされ、
2回回転対称の退化が取り除かれ、単一の変形成長が好
まれる。さらに我々はGaによって安定化された(4x
6)再構成GaAs表面上の単一ドメインGd2O3のエ
ピタキシャル成長を確認した。
【0054】単結晶Gd2O3膜は電気的に良く絶縁され
ており、0バイアス時に10ー 9ないし10ー 10A/cm2
の範囲のとても低い漏れ電流密度を示す。図14には2
6ないし1.5nmの範囲の厚さの酸化膜を伴う一連の
Gd2O3に対する印可電圧への漏れ電流密度依存を示し
た図である。正電圧バイアスとはGaAs基板に関して
正となるように上部の電極に相当する。ブレークダウン
電界は体系的に3ないし13MV/cmまで増加し、漏
れ電流密度はGd2O3の厚さが26nmないし3.5n
mまで減少するにつれて大きさで一桁だけ増加してい
る。
ており、0バイアス時に10ー 9ないし10ー 10A/cm2
の範囲のとても低い漏れ電流密度を示す。図14には2
6ないし1.5nmの範囲の厚さの酸化膜を伴う一連の
Gd2O3に対する印可電圧への漏れ電流密度依存を示し
た図である。正電圧バイアスとはGaAs基板に関して
正となるように上部の電極に相当する。ブレークダウン
電界は体系的に3ないし13MV/cmまで増加し、漏
れ電流密度はGd2O3の厚さが26nmないし3.5n
mまで減少するにつれて大きさで一桁だけ増加してい
る。
【0055】我々はまた、基板温度が約600℃以上で
成長されたGd2O3膜が高い漏れ電流で、かつ低いブレ
ークダウン電界を示すことを確認した。しかし、一度単
結晶Gd2O3膜がGaAs基板上におよそ200℃−5
00℃の範囲の成長温度で形成されると膜は後の高温
(例えば850℃)のプロセスにさらされたときに熱力
学的に安定である。当業者には周知のように、この熱力
学的安定性はデバイスのプロセスを容易にする。
成長されたGd2O3膜が高い漏れ電流で、かつ低いブレ
ークダウン電界を示すことを確認した。しかし、一度単
結晶Gd2O3膜がGaAs基板上におよそ200℃−5
00℃の範囲の成長温度で形成されると膜は後の高温
(例えば850℃)のプロセスにさらされたときに熱力
学的に安定である。当業者には周知のように、この熱力
学的安定性はデバイスのプロセスを容易にする。
【0056】前述の説明は一般にGaAsに基づく半導
体かGaNに基づく半導体のいづれかのうえに成長され
たGd2O3のエピタキシャル層に関している。しかし、
希土類元素は全て非常に類似した化学的特性を持つこと
が知られている。我々は、所定の調査によってGd2O3
の他の希土類酸化物と同様にYもまたGaAsやGaN
に基づく半導体上にエピタキシャル成長できることを証
明できると信じている。特に出願人はY及びX2O3の組
成の酸化物を形成し、かつ結晶構造がMn2O3形である
希土類元素がGaAsやGaNに基づく半導体上にエピ
タキシャル成長できると期待している。Yと同様に希土
類元素La,Pr,Nd,Sm,Eu,Gd,Tb,D
y,Ho,Er,Tm,Yb及びLuが好まれる。
体かGaNに基づく半導体のいづれかのうえに成長され
たGd2O3のエピタキシャル層に関している。しかし、
希土類元素は全て非常に類似した化学的特性を持つこと
が知られている。我々は、所定の調査によってGd2O3
の他の希土類酸化物と同様にYもまたGaAsやGaN
に基づく半導体上にエピタキシャル成長できることを証
明できると信じている。特に出願人はY及びX2O3の組
成の酸化物を形成し、かつ結晶構造がMn2O3形である
希土類元素がGaAsやGaNに基づく半導体上にエピ
タキシャル成長できると期待している。Yと同様に希土
類元素La,Pr,Nd,Sm,Eu,Gd,Tb,D
y,Ho,Er,Tm,Yb及びLuが好まれる。
【0057】単結晶GaAsに基づくIII/V族半導
体あるいはGaNに基づく半導体(例えばAlGaNや
InGaN)上にGd2O3(同様にY及び様々な希土類
酸化物)の単結晶、単一ドメイン層を成長する能力によ
ってさらに複雑な構造のエピタキシャル成長が可能とな
り、そのような全ての構造が意図される。例えば、エピ
タキシャルGaAs/Gd2O3/GaAs構造はすぐに
獲得され、かつ有利なことに半導体デバイス製作に利用
される。
体あるいはGaNに基づく半導体(例えばAlGaNや
InGaN)上にGd2O3(同様にY及び様々な希土類
酸化物)の単結晶、単一ドメイン層を成長する能力によ
ってさらに複雑な構造のエピタキシャル成長が可能とな
り、そのような全ての構造が意図される。例えば、エピ
タキシャルGaAs/Gd2O3/GaAs構造はすぐに
獲得され、かつ有利なことに半導体デバイス製作に利用
される。
【0058】
【発明の効果】本発明によれば、GaAsに基づく半導
体及びGaNに基づく半導体上にキャパシタンスが高
く、かつ漏れ電流の小さい酸化物層を形成することがで
きる。
体及びGaNに基づく半導体上にキャパシタンスが高
く、かつ漏れ電流の小さい酸化物層を形成することがで
きる。
【図1】主にMOS−FETのような典型的なデバイス
を示す図である。
を示す図である。
【図2】相補形MOS−FETを含む回路を示す線図で
ある。
ある。
【図3】典型的なエンハンスメント形pチャネルGaA
s MOS−FETの電気特性を示す図である。
s MOS−FETの電気特性を示す図である。
【図4】典型的なエンハンスメント形pチャネルGaA
s MOS−FETの電気特性を示す図である。
s MOS−FETの電気特性を示す図である。
【図5】典型的なエンハンスメント形pチャネルGaA
s MOS−FETの電気特性を示す図である。
s MOS−FETの電気特性を示す図である。
【図6】様々な酸化物組成のGaAs/酸化物/金属構
造からの測定データを示す図である。
造からの測定データを示す図である。
【図7】様々な酸化物組成のGaAs/酸化物/金属構
造からの測定データを示す図である。
造からの測定データを示す図である。
【図8】様々な酸化物組成のGaAs/酸化物/金属構
造からの測定データを示す図である。
造からの測定データを示す図である。
【図9】
【外2】
【図10】
【外3】
【図11】
【外4】
【図12】18.5nm、3.5nm及び1.5nmの
(110)配向Gd2O3膜の(440)ブラッグ反射の
X線θ−2θスキャンを示す図である。
(110)配向Gd2O3膜の(440)ブラッグ反射の
X線θ−2θスキャンを示す図である。
【図13】18.5nm、3.5nm及び1.5nmの
(110)配向Gd2O3膜に対するθアングルについて
のこれらのピークのロッキングスキャンを示す図であ
る。
(110)配向Gd2O3膜に対するθアングルについて
のこれらのピークのロッキングスキャンを示す図であ
る。
【図14】それぞれ26.0、18.5、14.0、
3.5及び1.5nmの厚さのGd2O3膜に対する、漏
れ電流密度と印可電界の関係を示した図である。
3.5及び1.5nmの厚さのGd2O3膜に対する、漏
れ電流密度と印可電界の関係を示した図である。
【符号の説明】 140 GaAs基板 141 ソース領域 142 ドレイン領域 143 ドレインコンタクト 144 ソースコンタクト 145 ゲート酸化物 146 ゲートコンタクト 147 フィールド酸化物 231 nチャネルエンハンスメント形MOS−FET 232 pチャネルエンハンスメント形MOS−FET
───────────────────────────────────────────────────── フロントページの続き (72)発明者 アーメット レフィック コアタン アメリカ合衆国 07059 ニュージャーシ ィ,ウォーレン,クリスティ ドライヴ 56 (72)発明者 ジュエイナイ レイニエン クオ アメリカ合衆国 07060 ニュージャーシ ィ,ウォッチュング,ノッチンガム ドラ イヴ 40 (72)発明者 ジョセフ パータス マナーツ アメリカ合衆国 07901 ニュージャーシ ィ,サミット,ブリアント パークウェイ 29
Claims (6)
- 【請求項1】 配向した平面単結晶半導体基板、および
前記半導体基板上に酸化物層を含む物品であって、 a)前記半導体が、GaAsに基づく半導体およびGa
Nに基づく半導体からなる一群から選択され、 b)前記酸化物層が、Mn2O3形の立方体結晶構造を有
し、かつXはYおよび希土類元素からなる一群から選択
されたX2O3の組成を有する酸化物からなる一群から選
択され、および c)前記酸化物層が、前記単結晶半導体基板にエピタキ
シャル成長され、かつ5nmより薄い厚さの単結晶、単
一ドメインの酸化物層である、 ことを特徴とする物品。 - 【請求項2】 請求項1記載の物品において、前記半導
体基板が(100)に配向したGaAs基板であること
を特徴とする物品。 - 【請求項3】 請求項1記載の物品において、前記酸化
物層がY、Sc、La、Nd、Gd、Dy、Ho,Er
およびLuの酸化物からなる一群から選択されることを
特徴とする物品。 - 【請求項4】 請求項2記載の物品において、前記酸化
物層がGd2O3である物品。 - 【請求項5】 請求項1記載の物品において、前記物品
がゲート酸化物として前記酸化物層を伴う電界効果トラ
ンジスターを含む物品。 - 【請求項6】 請求項1記載の物品において、さらに前
記酸化物層上にエピタキシャル成長された単結晶半導体
層を含む物品。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US09/190193 | 1998-11-12 | ||
US09/190,193 US6469357B1 (en) | 1994-03-23 | 1998-11-12 | Article comprising an oxide layer on a GaAs or GaN-based semiconductor body |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2000150503A true JP2000150503A (ja) | 2000-05-30 |
Family
ID=22700368
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11321934A Pending JP2000150503A (ja) | 1998-11-12 | 1999-11-12 | GaAsやGaNに基づく半導体基体上に酸化物層を含む物品 |
Country Status (4)
Country | Link |
---|---|
US (1) | US6469357B1 (ja) |
EP (1) | EP1001468A1 (ja) |
JP (1) | JP2000150503A (ja) |
KR (1) | KR20000035392A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2008041277A1 (fr) | 2006-09-29 | 2008-04-10 | Fujitsu Limited | Dispositif à semi-conducteur a base de composé et processus de fabrication correspondant |
Families Citing this family (39)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6392257B1 (en) | 2000-02-10 | 2002-05-21 | Motorola Inc. | Semiconductor structure, semiconductor device, communicating device, integrated circuit, and process for fabricating the same |
US6693033B2 (en) | 2000-02-10 | 2004-02-17 | Motorola, Inc. | Method of removing an amorphous oxide from a monocrystalline surface |
US6477285B1 (en) | 2000-06-30 | 2002-11-05 | Motorola, Inc. | Integrated circuits with optical signal propagation |
US6410941B1 (en) | 2000-06-30 | 2002-06-25 | Motorola, Inc. | Reconfigurable systems using hybrid integrated circuits with optical ports |
US6501973B1 (en) | 2000-06-30 | 2002-12-31 | Motorola, Inc. | Apparatus and method for measuring selected physical condition of an animate subject |
US6427066B1 (en) | 2000-06-30 | 2002-07-30 | Motorola, Inc. | Apparatus and method for effecting communications among a plurality of remote stations |
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