EP0296015A1 - Dispositif de test de l'impédance d'une ligne de puissance et son application au test d'amorces de moyens pyrotechniques - Google Patents
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- EP0296015A1 EP0296015A1 EP88401366A EP88401366A EP0296015A1 EP 0296015 A1 EP0296015 A1 EP 0296015A1 EP 88401366 A EP88401366 A EP 88401366A EP 88401366 A EP88401366 A EP 88401366A EP 0296015 A1 EP0296015 A1 EP 0296015A1
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- 238000012360 testing method Methods 0.000 title claims abstract description 67
- 238000010304 firing Methods 0.000 title claims description 15
- 238000005259 measurement Methods 0.000 claims abstract description 30
- 239000006185 dispersion Substances 0.000 description 5
- 238000010586 diagram Methods 0.000 description 4
- 230000006870 function Effects 0.000 description 4
- 238000010438 heat treatment Methods 0.000 description 4
- 238000002955 isolation Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 230000005693 optoelectronics Effects 0.000 description 3
- 238000013475 authorization Methods 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 2
- 238000005474 detonation Methods 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 239000008188 pellet Substances 0.000 description 2
- 230000001960 triggered effect Effects 0.000 description 2
- 239000000470 constituent Substances 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 230000002950 deficient Effects 0.000 description 1
- 238000001514 detection method Methods 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000000977 initiatory effect Effects 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 229920006395 saturated elastomer Polymers 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 238000006467 substitution reaction Methods 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
- 238000012546 transfer Methods 0.000 description 1
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Classifications
-
- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F42—AMMUNITION; BLASTING
- F42D—BLASTING
- F42D1/00—Blasting methods or apparatus, e.g. loading or tamping
- F42D1/04—Arrangements for ignition
- F42D1/045—Arrangements for electric ignition
- F42D1/05—Electric circuits for blasting
-
- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F42—AMMUNITION; BLASTING
- F42C—AMMUNITION FUZES; ARMING OR SAFETY MEANS THEREFOR
- F42C21/00—Checking fuzes; Testing fuzes
Definitions
- the invention relates to a device for testing the impedance of a power line and its application to testing primers of pyrotechnic means with electric ignition.
- this defect can have serious consequences and it is advisable to ensure beforehand that the impedance of the power line does not exceed a predetermined value and, correlatively, that its electrical continuity is well ensured.
- EP-A-0061 860 describes an apparatus and a method for testing a detonating module, the firing of which is ensured by supplying it with an alternating current of given intensity via a transformer.
- the test current must also be alternating and of sufficient intensity to allow precise measurement of the impedance of the detonating module.
- a test under an alternating current of given frequency and constant amplitude would require an electrical power source of excessive capacity and size for a device. reil supposed to be portable.
- the apparatus therefore includes a capacitor which, when testing a detonating module, is preloaded to a predetermined voltage. The discharge of the capacitor generates between the terminals of the transformer primary a voltage peak which is representative of the impedance of the detonating module.
- Such a primer comprises in known manner the assembly of an electrical charge, that is to say a heating resistor, and a small pyrotechnic pellet capable of detonating in the event of sufficient heating. It is noted that excessive heating, but less than the minimum heating causing the detonation, can gradually create a kind of chemical fatigue of the pellet, which then introduces dri ves of its detonation characteristics relative to those it initially had. Such deterioration is hereinafter called "phlegmatization”.
- French patent application No. 87 02923 filed on March 4, 1987 by the Applicant describes a device and a method for the selective firing of cartridges for aircraft or other apparatus.
- This device includes modular chargers each containing several cartridges and electronic circuits ensuring the management of cartridge loading and the selective distribution of firing orders to the primers of the different cartridges.
- these circuits construct firing tables containing only the addresses of the cartridges whose firing line comprising a power stage and a primer is correct. Each firing line must therefore have been tested during the initialization of the device and / or prior to the firing order of the cartridge.
- FIG. 1 shows a simplified electrical circuit comprising a start symbolized by a load resistance Rc, a power stage T2 consisting of two transistors mounted in Darlington circuit between a current supply source SC and the load Rc, and a switching tranistor T1 allowing the selection of the firing line from the electronic circuits of the aforementioned selective firing device.
- the base of transistor T1 is attacked via a resistor Rb1, its emitter is connected to ground via a resistor Re and its collector is connected to the base of the Darlington circuit T2 via of a resistance Rb2.
- the impedance of the firing line can be determined by measuring the voltage Vm at its terminals when a direct test current Im is injected into it by the current source SC.
- Vm 2Vbe + Vce1 + Rb2Ib2 + ReIe (input circuit)
- Im being the intensity at the source SC:
- Im ( ⁇ T2 + 1)
- Ib2
- Ic Im - Ib2 (4)
- Ie Ib1 _ Ib2 (e)
- ⁇ T2 being the current gain of the Darlington circuit.
- Vm (input) 2Vbe + Vcelsat + Rb2Ib2 + Re (Ib1 + Ib2)
- Vm (output) Vce2sat + RccIc, hence: (7)
- Rcc being the value of the load resistance which, for a given current Ic, brings the transistor T2 to saturation.
- the minimum current which must pass through a primer of the aforementioned type to ensure its ignition is 3A. If the available electrical voltage is 24V, we see that a firing channel can only be declared operational if the value of the firing line impedance is at most equal to 8 ⁇ .
- the invention aims to provide a device for testing a power line which overcomes this difficulty.
- a device for testing the direct current of the impedance of at least one power line comprising an electrical load connected to a power stage capable of supplying it with a high nominal direct current, characterized in that it includes: constant current generating means able to circulate in said line a direct test current of low value compared to the nominal current, an electrical dipole connected in said power line and capable of generating a constant offset voltage bringing the power stage to saturation when the load is traversed by the direct test current, means for measuring the voltage drop across the power line, and means for exploiting the result of said voltage measurement.
- FIG. 1 is an electrical diagram of a power stage according to the state of the art
- FIG. 2 is a diagram similar to that of FIG. 1 showing a power stage modified in accordance with the invention:
- - Figure 3 is a graph illustrating the original effect obtained by means of the modified circuit of Figure 2;
- - Figure 4A is a block diagram of a device for testing a plurality of selectively addressable power lines:
- - Figure 4B is a view similar to Figure 4A of a test device according to an alternative embodiment;
- - Figure 5 is a more detailed block diagram of the test circuit proper of Figures 4A and 4B.
- the power stage 10 in FIG. 2 is similar to that in FIG. 1. It includes a Darlington T2 circuit made up of two PNP transistors.
- the emitter of T2 is connected to a current supply source SC and its base is connected to the collector of a switching transistor T1 via a resistor Rb2.
- the emitter of transistor T1 is connected to ground via a resistor Re and its base is attacked by an addressing circuit (not shown) through a resistor Rb1.
- the collector of T2 is connected to the electrical load Rc via a power diode D.
- the saturation of the circuit T2 is reached for a lower value R′cc of the load Rc: the output voltage of the power stage then has the shape represented by the curve V ′ m in dashed lines.
- the minimum value of the offset voltage VD was 0.1 V.
- this value must be greater to ensure that the measurement under low direct current takes place in the linear variation zone of Vm as a function of Rc.
- the offset voltage introduced by the dipole interposed in the collector circuit of T2 remains substantially unchanged when this line is crossed by the high nominal current (at least 3 amperes) intended to ensure the ignition of the primer Rc.
- a power diode is particularly well suited, since it generates an offset voltage of the order of 0.6 to 0.8 V for currents ranging from a few tens of milliamps to several amps.
- the invention is not limited to this type of component and any other electrical dipole capable of generating a substantially constant offset voltage of the desired order of magnitude would be perfectly suitable.
- diode D could be connected, not between the circuit T2 and the load Rc, but between the load Rc and the ground.
- This second configuration has the advantage of requiring only a single diode for testing a certain number of power lines in parallel, by means of a single test circuit 20 as shown in FIG. 4A.
- diode Di associated with each load Rci if, for example, the overall configuration of the circuits does not make it possible to have a good common ground.
- the diode Di can be connected between the power stage and the load as shown in FIG. 4B, or between the load and the ground.
- this configuration can also be justified if the manufacturing technology used (hybrid circuits for example) allows the power stage 10i and the corresponding diode Di to be integrated into the same substrate.
- FIGS. 4A and 4B differ only in the position and the number of diodes used, they will be the subject of a common description.
- the test circuit 20 comprising the current source SC, is connected in parallel to all the stages of power 10 l ... 10i ... 10n which should be tested. It will be assumed below that the power stages 10i, the charges Rci and the diodes Di have the same intrinsic characteristics in each power line Ll .... Li .... Ln and that the same current is circulated there. continuous test Im.
- the test circuit 20 has an input E for test control and an output S for reading the response to the test.
- the blocks 21 and 22 shown for the record respectively represent a circuit for generating the nominal direct current for supplying the loads Rci and a circuit for addressing the power stages 10 l ... 10i ... 10n .
- the addressing circuit 22 selects the address of the input Ai of the power stage 10i which should be tested or supplied under the nominal current.
- the test circuit 20 comprises the current source SC and a circuit for measuring the voltage Vm.
- the test is triggered by applying an appropriate command to the input E and by selecting the address of the power stage forming part of the power line Ll .... Li .... Ln whose l should be measured. 'impedance. This is provided by measuring the voltage Vm between point P and ground.
- the measured voltage Vm is compared with a predetermined threshold value and the result of this comparison may or may not validate the power line tested.
- the circuits generating a threshold and comparison value can be part of the test circuit 20 or be external to it.
- the output S then delivers a signal capable of taking one or the other of two logical states depending on the result of the comparison.
- ⁇ Vce2sat is the variation of the saturation voltage of circuit T2 for the variation of current ⁇ Im
- ⁇ VD is the variation of the offset voltage of diode D for the variation of current ⁇ Im.
- ⁇ Vce2 and ⁇ VD are a function of the components used and will be determined once and for all.
- the variation of the saturation voltage of the power transistor (T2) Vce2sat is 15 ⁇ 5 mV for a variation ⁇ Im of 15 mA, in the temperature range between -55 and + 100 ° C.
- the variation of the forward voltage of the ⁇ VD diode in the same conditions is 15 mV ⁇ 5 mV.
- FIG. 5 shows a test circuit by differential measurement applicable in particular to the testing of cartridge primers in the context of the device which is the subject of the above-mentioned French patent application No. 87 02923.
- the test circuit 20 comprises at the input an optoelectronic isolation circuit 201 to which the test trigger commands are applied to its input E.
- the output of the isolation circuit 201 attacks the trigger input of a first monostable circuit 202 having a time constant of 40 ⁇ s, an input of an AND gate 203 and the trigger input of a second monostable circuit 204 having a time constant of 65 ⁇ s.
- the inverted output Q of the first monostable 202 attacks the second input of the AND gate 203 and its non-inverted output Q drives a first current source 205 generating a first direct measurement current of 35 mA, as well as an authorization input d '' an analog memory 206.
- the output of the prote ET 203 drives a second current source 207 generating a second direct measurement current of 50 mA, as well as the authorization input of a measurement circuit 208.
- the current sources 205 and 207 are connected in parallel to the different power stages of the lines to be tested (only one of which has been shown for the sake of simplicity) by means of a diode 214. Similarly, the generator circuit 21 firing current is con connected to these same power stages via a diode 215.
- the diodes 214 and 215 together play the role of an OR gate.
- the outputs of the analog memory 206 and of the measurement circuit 208 are applied to a measurement comparator 209 whose output is connected to a logic memory 210.
- the clock input of the logic memory 210 is attacked by the output of a read circuit 211 itself controlled by the monostable circuit 204.
- the result of the measurement present at the output Q of the logic memory 210 is transmitted to the output S of the test circuit 20 via an optoelectronic isolation circuit 212 and an adapter output circuit 213.
- a test of the power line Li is triggered by selecting the input Ai of the power stage 10i and by applying a test command signal to the input E.
- Cellui transmitted by the circuit d isolation 201 (photocoupler), causes the generation of a 40 ⁇ s pulse by the monostable circuit 202. This pulse controls the current source 205 which circulates a direct current of 35 mA in the power line Li. Simultaneously, this 40 ⁇ s pulse applied to analog memory 206 authorizes the latter to memorize the voltage developed at point P.
- the Q output of the monostable circuit 202 changes to "0" and its Q output changes to "1".
- the output of the AND gate 203 also changes to "1" and the current source 207 circulates a direct current of 50 mA in the power line Li.
- the level "1" at the output of the AND gate 203 also allows the circuit 208 to measure the voltage at point P.
- Comparator 209 compares to a predetermined threshold value the difference ⁇ Vm between the voltages generated at point P by the currents of 50 and 35 mA respectively or, which is equivalent, compares the output of the measuring circuit 208 at the sum of the threshold value and the memorized value present at the output of the analog memory 206.
- ⁇ Vm is greater than the threshold value, that is to say if the impedance of the load Rci is greater than the predetermined admitted value, the output of the comparator takes the logic value "0". Otherwise, it takes the logical value "1". Alternatively, one can naturally adapt a reverse logic.
- the monostable circuit 204 causes the emission of a pulse by the read circuit 211.
- the logic state of the comparator 209 applied to the input D of the logic memory 20 is transferred to its output Q. This logic state is transmitted to the output S via the optoelectronic output circuit 212 and the adapter output circuit 213.
- the output S of the test circuit 20 is in state “1" if the power line Li associated with the primer Rci is operational and in state "0" if the latter is defective.
- the invention allows, with good precision, a low resistance measurement across a power stage, this by overcoming the dispersion (intrinsic and related to temperature) of the characteristics of the constituent components. the measurement line.
- the measurement performed corresponds to the total impedance, line (L), transistor plus load (Rc). It would be possible, knowing the impedance of the line (cable L) without load and an approximate value of the dynamic impedances of the power transistor, to obtain a measurement of the load resistance with good accuracy.
- the device described also makes it possible to use only one test circuit for any number of lines to be tested, which ensures a significant gain in components compared to a solution using a circuit. test per line. This results in better reliability of the device and a reduced cost.
- the purpose of the test carried out by means of the device described may be to ensure that the impedance of the line is not less, but more than a predetermined value. If the load is supplied by a voltage source instead of a current source, the power line impedance test will then protect it or the source against overcurrents.
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Abstract
- des moyens générateurs de courant constant (205, 207) aptes à faire circuler dans ladite ligne (Li) un courant continue de test (Im) de faible valeur par rapport au courant nominal,
- un dipôle électrique (Di) connecté dans ladite ligne de puissance et apte à engendrer une tension constante de décalage portant l'étage de puissance (10i) à saturation lorsque la charge (Rci) est parcourue par le courant continu de test,
- des moyens de mesure (206, 208) de la chute de tension aux bornes de la ligne de puissance, et
- des moyens (209-213) d'exploitation du résultat de ladite mesure de tension.
Description
- L'invention concerne un dispositif de test de l'impédance d'une ligne de puissance et son application au test d'amorces de moyens pyrotechniques à mise à feu électrique.
- Il existe de nombreux circuits électroniques dans lesquels une charge électrique doit pouvoir être alimentée sous un courant nominal élevé, par exemple de quelques ampères à quelques dizaines d'ampères, par l'intermédiaire d'un étage de puissance. Si l'impédance de la ligne de puissance constituée par la connexion série de l'étage de puissance avec la charge électrique est trop élevée, la source d'alimentation électrique en courant ou en tension ne sera pas toujours en mesure de faire circuler dans la charge le courant nominal ou, à tout le moins, un courant minimal susceptible de provoquer l'effet recherché par l'alimentation de la charge.
- Dans un certain nombre d'applications ce défaut peut avoir de graves conséquences et il convient de s'assurer préalablement que l'impédance de la ligne de puissance ne dépasse pas une valeur prédéterminée et, corrélativement, que sa continuité électrique est bien assurée.
- EP-A-0061 860 décrit un appareil et un procédé pour tester un module détonant dont la mise à feu est assurée en l'alimentant sous un courant alternatif d'intensité donné par l'intermédiaire d'un transformateur.
- Le courant de test doit être également alternatif et d'une intensité suffisante pour permettre une mesure précise de l'impédance du module détonant. Un test sous un courant alternatif de fréquence donnée et d'amplitude constante nécessiterait une source d'alimentation électrique de capacité et d'encombrement excessifs pour un appa reil censé être portable. L'appareil comporte en conséquence un condensateur qui, lors du test d'un module détonant, est préchargé à une tension prédéterminée. La décharge du condensateur engendre entre les bornes du primaire du transformateur un pic de tension qui est représentatif de l'impédance du module détonant.
- Toutefois, la solution décrite à ce document n'est pas transposable au test -----> de lignes de puissances électriques -----> alimentées en courant continu. Or, en dehors de toute considération de capacité ou d'encombrement de la source d'alimentation électrique, il n'est pas toujours possible de tester une ligne de puissance sous un courant continu élevé, soit par ce que la charge est un organe consommable (par exemple une amorce d'un élément pyrotechnique), soit encore parce que l'effet direct ou indirect (électrique, magnétique, thermique, mécanique, etc...) qui en résulterait est incompatible, pour des raisons de sécurité ou autres, avec les conditions du test. D'autre part, la charge électrique ne peut pas toujours être testée indépendamment de l'étage de puissance, ne serait-ce qu'en raison de son inaccessibilité.
- Ces différentes contraintes font qu'il est nécessaire de disposer d'un dispositif permettant de tester sous un faible courant continu l'impédance d'une ligne de puissance comprenant une charge électrique connectée à un étage de puissance susceptible de l'alimenter sous un courant continu nominal élevé.
- Cette nécessité, et les difficultés rencontrées, seront illustrées à propos du test d'une amorce de cartouche à mise à feu électrique. Une telle amorce comporte de façon connue l'assemblage d'une charge électrique, c'est-à-dire une résistance de chauffe, et d'une petite pastille pyrotechnique apte à détoner en cas d'échauffement suffisant. On note que des échauffements excessifs, mais inférieurs à l'échauffement minimal provoquant la détonation, peuvent créer peu à peu une sorte de fatigue chimique de la pastille, ce qui introduit alors des déri ves de ses caractéristiques de détonation relativement à celles qu'elle avait initialement. Une telle détérioration est appelée ci-après "flegmatisation".
- La demande de brevet français No. 87 02923 déposée le 4 mars 1987 par la Demanderesse décrit un dispositif et un procédé de tir sélectif de cartouches pour aéronef ou autre appareil. Ce dispositif comprend des chargeurs modulaires contenant chacun plusieurs cartouches et des circuits électroniques assurant la gestion du chargement en cartouches et la distribution sélective des ordres de mise à feu aux amorces des différentes cartouches. A cet effet, ces circuits construisent des tables de tir contenant uniquement les adresses des cartouches dont la ligne de tir comprenant un étage de puissance et une amorce est correcte. Chaque ligne de tir doit donc avoir été testée lors de l'initiallisation du dispositif et/ou préalablement à l'ordre de mise à feu de la cartouche.
- On a représenté à la figure 1 un circuit électrique simplifié comprenant une amorce symbolisée par une résistance de charge Rc, un étage de puissance T2 constitué de deux transistors montés en circuit de Darlington entre une source d'alimentation en courant SC et la charge Rc, et un tranistor de commutation T1 permettant la sélection de la ligne de tir à partir des circuits électroniques du dispositif de tir sélectif précité. La base du transistor T1 est attaquée par l'intermédiaire d'une résistance Rb1, son émetteur est connecté à la masse par l'intermédiaire d'une résistance Re et son collecteur est connecté à la base du circuit de Darlington T2 par l'intermédiaire d'une résistance Rb2.
- L'impédance de la ligne de tir pourra être déterminée en mesurant la tension Vm à ses bornes lorsqu'un courant continu de test Im lui est injecté par la source de courant SC. On a :
Vm = Vr + Vce2 = RcIc + Vce2 (circuit de sortie) (1)
Vm = 2Vbe + Vce1 + Rb2Ib2 + ReIe (circuit d'entrée) (2)
avec, Im étant l'intensité à la source SC :
Im = (β T2 + 1) Ib2 (3)
Ic = Im - Ib2 (4)
Ie = Ib1 _ Ib2 (e) - β T2 étant le gain en courant du circuit de Darlington.
- Pour que la mesure de Vm soit significative, il faut que ses variations soient fonction de la valeur de la résistance de la charge (amorce) Rc. Cela signifie que le test (mesure de Vm) ne pourra se faire que lorsque le transistor T2 (circuit de Darlington) est saturé. On a alors :
Vm (entrée) = 2Vbe + Vcelsat + Rb2Ib2 + Re(Ib1+Ib2) (6)
Vm (sortie) = Vce2sat + RccIc, d'où : (7) - Rcc étant la valeur de la résistance de charge qui, pour un courant Ic donné, porte le transistor T2 à saturation.
- Dans un exemple spécifique de réalisation où l'on utilise une amorce de type "1A1W 5 minutes non feu", le courant de test maximal autorisé permettant d'éviter la flegmatisation de l'amorce est une courant continu de 50 mA. Si l'on utilise pour les transistgors T1 et T2 les composants 2N2222A et BDX64C dont les caractéristiques fournies par les constructeurs sont les suivantes :
Vce1sat = 0,1V 2VbcT2 = 1,2V
Vce2sat = 0,8V β T2 = 100
et dans cet exemple
- Si l'on reporte ces valeurs dans l'expression 8, on obtient : Rcc # 10Ω.
- Or, le courant minimal qui doit traverser une amorce du type précité pour assurer sa mise à feu est de 3A. Dans le cas où la tension électrique disponible est de 24V, on constate qu'une voie de tir ne pourra être déclarée opérationnelle que si la valeur de l'impédance de la ligne de tir est au plus égale à 8Ω.
- Le résultat précédent permet de conclure qu'il sera impossible, sous un courant continu de 50 mA, de mesurer une valeur inférieure à 8Ω pour ce cype de montage.
- L'invention vise à fournir un dispositif de test d'une ligne de puissance qui permette de surmonter cette difficulté.
- A cet effet, elle a pour objet un dispositif de test en courant continu de l'impédance d'au moins une ligne de puissance comprenant une charge électrique connectée à un étage de puissance susceptible de l'alimenter sous un courant continu nominal élevé, caractérisé en ce qu'il comprend :
- des moyens générateurs de courant constant aptes à faire circuler dans ladite ligne un courant continu de test de faible valeur par rapport au courant nominal,
- un dipôle électrique connecté dans ladite ligne de puissance et apte à engendrer une tension constante de décalage portant l'étage de puissance à saturation lorsque la charge est parcourue par le courant continu de test,
- des moyens de mesure de la chute de tension aux bornes de la ligne de puissance, et
- des moyens d'exploitation du résultat de ladite mesure de tension. - D'autres caractéristiques et avantages de l'invention résulteront de la description qui va suivre d'un mode de réalisation donné uniquement à titre d'exemple et illustré par les dessins annexés sur lesquels :
- la figure 1 est un schéma électrique d'un étage de puissance suivant l'état de la technique ;
- la figure 2 est un schéma analogue à celui de la figure 1 représentant un étage de puissance modifié conformément à l'invention :
- la figure 3 est un graphique illustrant l'effet original obtenu au moyen du circuit modifié de la figure 2 ;
- la figure 4A est un schéma synoptique d'un dispositif permettant le test d'une pluralité de lignes de puissance adressables sélectivement :
- la figure 4B est une vue analogue à la figure 4A d'un dispositif de test suivant une variante de réalisation ; et
- la figure 5 est un schéma synoptique plus détaillé du circuit de test proprement dit des figures 4A et 4B. - L'étage du puissance 10 de la figure 2 est similaire à celui de la figure 1. Il comprend un circuit de Darlington T2 constitué de deux transistors PNP. L'émetteur de T2 est connecté à une source d'alimentation en courant SC et sa base est connectée au collecteur d'un transistor de commutation T1 par l'intermédiaire d'une résistance Rb2. L'émetteur du transistor T1 est connecté à la masse par l'intermédiaire d'une résistance Re et sa base est attaquée par un circuit d'adressage (non représenté) à travers une résistance Rb1.
- A la différence du circuit de la figure 1, le collecteur de T2 est connecté à la charge électrique Rc par l'intermédiaire d'une diode de puissance D.
- Les courants et tensions présents en différents points du circuit ont été représentés sur la figure 2 et l'on supposera que les composants électriques utilisés sont identiques à ceux de circuit de la figure 1.
-
- Si l'on reporte les valeurs numériques précitées dans l'expression 10, on constate qu'il est désormais possible, pour une résistance Rcc d'environ 8Ω, d'obtenir la saturation du circuit T2 si la tension de déclage VD est au moins égale à 0,1V environ.
- Ce phénomène sera meiux compris en examinant le graphique de la figure 3 où l'on a tracé, pour un courant continue Ic donné, l'évolution de la tension Vm de sortie de l'étage de puissance et de la tension RcIc aux bornes de la charge Rc en fonction de l'impédance de cette dernière.
- En l'absence de la diode D, la tension de sortie Vm reste constante tant que Rc est inférieure à une valeur Rcc telle que la différence entre la tension Vm et la tension RcIc est égale à la tension de saturation Vce2sat de T2. Pour les valeurs supérieures de Rc, Vm varie linéairement avec Rc.
- En présence d'une tension de décalage VD, la saturation du circuit T2 est atteinte pour une valeur inférieure R′cc de la charge Rc : la tension de sortie de l'étage de puissance présente alors l'allure représentée par la courbe V′m en traits mixtes.
- La mesure de la tension de sortie Vm, V′m n'étant le reflet de l'impédance de la ligne de puissance que lorsque la saturation de T2 est atteinte, on observe que pour un courant Ic donné, le circuit modifié de la figure 2 permet une telle mesure pour des valeurs plus faibles de la résistance de charge Rc.
- Dans l'exemple numérique précité, on a calculé que la valeur minimale de la tension de décalage VD était de 0,1 V. En réalité, compte tenu de la dispersion intrinsèque des caractéristiques des composants et de leur dispersion liée à la température, cette valeur devra être supérieure pour assurer que la mesure sous faible courant continu a bien lieu dans la zone de variation linéaire de Vm en fonction de Rc. De plus, pour que la mesure effectuée sous le faible courant de mesure Im soit une image fidèle de l'impédance de la ligne de puissance, il est nécessaire que la tension de décalage introduite par le dipôle intercalé dans le circuit collecteur de T2 demeure sensiblement inchangée lorsque cette ligne est parcourue par le courant nominal élevé (au moins 3 ampères) destiné à assurer la mise à feu de l'amorce Rc.
- C'est la raison pour laquelle une diode de puissance est particulièrement bien adaptée, car elle engendre une tension de décalage de l'ordre de 0,6 à 0,8 V pour des courants allant de quelques dizaines de milliampères à plusieurs ampères. Néanmoins, l'invention n'est pas limitée à ce type de composant et tout autre dipôle électrique susceptible d'engendrer une tension de décalage sensiblement constante de l'ordre de grandeur voulu serait parfaitement approprié.
- On notera également que la diode D pourrait être connectée, non pas entre le circuit T2 et la charge Rc, mais entre la charge Rc et la masse.
- Cette seconde configuration présente l'avantage de ne nécessiter qu'une seule diode pour le test d'un certain nombre de lignes de puissance en parallèle, au moyen d'un circuit de test unique 20 comme représenté à la figure 4A.
- Toutefois, il peut être préférable de prévoir une diode Di associée à chaque charge Rci si, par exemple, la configuration d'ensemble des circuits ne permet pas de disposer d'une bonne masse commune. La diode Di peut être connectée entre l'étage de puissance et la charge comme représenté à la figure 4B, ou entre la charge et la masse. Malgré la multiplication du nombre de diodes Di, cette configuration peut également se justifier si la technologie de fabrication utilisée (circuits hybrides par exemple) permet d'intégrer dans le même substrat l'étage de puissance 10i et la diode correspondante Di.
- Les dispositifs des figures 4A et 4B ne diffèrent que par la position et le nombre de diodes utilisées, ils feront l'objet d'une description commune.
- Le circuit de test 20, comprenant la source de courant SC, est connecté en parallèle à tous les étages de puissance 10l...10i... 10n qu'il convient de tester. On supposera dans la suite que les étages de puissance 10i, les charges Rci et les diodes Di ont les mêmes caractéristiques intrinsèques dans chaque ligne de puissance Ll....Li....Ln et qu'on y fait ciruler le même courant continu de test Im. Le circuit de test 20 présente une entrée E de commande de test et une sortie S de lecture de la réponse au test.
- Les blocs 21 et 22 représentés pour mémoire figurent respectivement un circuit générateur du courant continu nominal d'alimentation des charges Rci et un circuit d'adressasge des étages de puissance 10l...10i...10n. Le circuit d'adressage 22 sélectionne l'adresse de l'entrée Ai de l'étage de puissance 10i qu'il convient de tester ou d'alimenter sous le courant nominal.
- Dans une forme de réalisation particulèrement simple de l'invention, le circuit de test 20 comprend la source de courant SC et un circuit de mesure de la tension Vm. Le test est déclenché en appliquant une commande appropriée à l'entrée E et en sélectionnant l'adresse de l'étage du puissance faisant partie de la ligne de puissance Ll....Li....Ln dont il convient de mesurer l'impédance. Celle-ci est fournie par la mesure de la tension Vm entre le point P et la masse.
- De préférence, la tension mesurée Vm est comparée à une valeur de seuil prédéterminée et le résultat de cette comparaison permet ou non de valider la ligne de puissance testée. Les circuits générateurs d'une valeur de seuil et de comparaison peuvent faire partie du circuit de test 20 ou être extérieurs à celui-ci. Dans le premier cas, la sortie S délivre alors un signal susceptible de prendre l'un ou l'autre de deux états logiques suivant le résultat de la comparaison.
- Les opérations d'alimentation de la charge sous le courant continu de test Im, de mesure de la tension Vm et éventuellement de comparaison sont répétées pour chaque ligne de puissance à tester.
- Néanmoins, la dispersion intrinsèque des caractéristiqaues des composants ainsi que leur dispersion liée à la température fait que la précision de la mesure obtenue par cette forme simplifiée de réalisation ne sera pas suffisante dans certaines applications. On pourra alors recourir à un circuit de test mettant en oeuvre une mesure différentielle et dont un exemple de réalisation est donné à la figure 5.
- Cette mesure sera effectuée par une variation du courant continu de test Im dans un temps très court (quelques microsecondes), ce qui permettra de considérer la température des composatns comme constante. Si l'on reprend l'étage de puissance de la figure 2, on a le système d'équation suivant :
Vm1 = (Vce2sat)1 + VD1 + RcIm1
Vm2 = (Vce2sat)2 + VD2 + RcIm2 - Si on choisit Im2>Im1, on a :
ΔIm = Im2 - Im1, est la variation connue du courant de test,
ΔVm = Vm2 - Vm1, est la variation de la tension Vm mesurée aux bornes de la ligne de puissance testée,
ΔVce2sat est la variation de la tension de saturation du circuit T2 pour la variation de courant ΔIm,
ΔVD est la variation de la tension de décalage de la diode D pour la variation de courant ΔIm.
ΔVce2 et ΔVD sont fonction des composants utilisés et seront à déterminer une fois pour toutes. - A titre d'exemple, pour les valeurs numériques envisagées précédemment à propose des figures 1 et 2, le bon fonctionnement de l'étage de puissance 10 est assuré pour des courants compris entre 35 et 50 mA, ce qui conduit à adoter ΔIm = 15 mA. La variation de la tension de saturation du transistor de puissance (T2)Vce2sat est de 15±5 mV pour une variation ΔIm de 15 mA, dans la gamme des températures comprises entre -55 et +100°C. La variation de la tension directe de la diode ΔVD dans les mêmes conditions est de 15 mV ± 5 mV.
- Il en résulte que le seuil de détection pour une valeur de la charge égale à 8Ω est :
ΔVm = 8x15x10⁻³ + (15 + 15) x 10⁻³
soit ΔVm = 150 mV. -
- On se reportera maintenant à la figure 5 qui monre un circuit de test par mesure différentielle applicable notamment au test d'amorces de cartouches dans le cadre du dispositif objet de la demande de brevet français No. 87 02923 précitée.
- Le circuit de test 20 comporte en entrée un circuit d'isolement optoélectronique 201 auquel sont appliquées les commandes de déclenchement de test sur son entrée E. La sortie du circuit d'isolement 201 attaque l'entrée de déclenchement d'un premier circuit monostable 202 ayant une constante de temps de 40 µs, une entrée d'une porte ET 203 et l'entrée de déclenechement d'un deuxième circuit monostable 204 ayant une constante de temps de 65 µs.
- La sortie inversée Q du premier monostable 202 attaque la deuxième entrée de la porte ET 203 et sa sortie non inversée Q pilote une première source de courant 205 engendrant un premier courant continu de mesure de 35 mA, ainsi qu'une entrée d'autorisation d'une mémoire analogique 206.
- La sortie de la prote ET 203 pilote une deuxième source de courant 207 engendrant un second courant continu de mesure de 50 mA, ainsi que l'entrée d'autorisation d'un circuit de mesure 208.
- Les sources de courant 205 et 207 sont connectées en parallèle aux différents étages de puissance des lignes à tester (dont une seule a été représentée dans un but de simplicité) par l'intermédiaire d'une diode 214. De même, le circuit 21 générateur du courant de tir est con necté à ces mêmes étages de puissance par l'intermédiaire d'une diode 215. Les diodes 214 et 215 jouent ensemble le rôle d'une porte OU.
- Les sorties de la mémoire analogique 206 et du circuit de mesure 208 sont appliquées à un comparateur de mesure 209 dont la sortie est connectée à une mémoire logique 210.
- L'entrée d'horloge de la mémoire logique 210 est attaquée par la sortie d'un circuit de lecture 211 lui-même piloté par le circuit monostable 204.
- Le résultat de la mesure présent à la sortie Q de la mémoire logique 210 est transmis à la sortie S du circuit de test 20 par l'intermédiaire d'un circuit d'isolement optoélectronique 212 et d'un circuit de sortie adaptateur 213.
- En fonctionnement, un test de la ligne de puissance Li est déclenché en sélectionnant l'entrée Ai de l'étage de puissance 10i et en appliquant un signal de commande de test à l'entrée E. Cellui-ci, transmis par le circuit d'isolement 201 (photocoupleur), provoque la génération d'une impulsion de 40 µs par le circuit monostable 202. Cette impulsion commande la source de courant 205 qui fait circuler un courant continu de 35 mA dans la ligne de puissance Li. Simultanément, cette impulsion de 40µs appliquée à la mémoire analogique 206 autorise cette dernière à mémoriser la tension dévoloppée au point P.
- Au bout de 40µs, la sortie Q du circuit monostable 202 passe à "0" et sa sortie Q passe à "1".
- La sortie de la porte ET 203 passe également à "1" et la source de courant 207 fait circuler un courant continu de 50 mA dans la ligne de puissance Li. Le niveau "1" à la sortie de la porte ET 203 autorise également le circuit 208 à mesurer la tension au point P. Le comparateur 209 compare à une valeur de seuil prédéterminé la différence ΔVm entre les tensions engendrées au point P par les courants de 50 et 35 mA respectivement ou, ce qui est équivalent, compare la sortie du circuit de mesure 208 à la somme de la valeur de seuil et de la valeur mémorisée présente à la sortie de la mémoire analogique 206. Bien entendu, on peut encore retrancher la valeur de seuil de la sortie du circuit de mesure 208 et comparer cette différence à la sortie de la mémoire analogique 206.
- Si ΔVm est supérieur à la valeur de seuil, c'est-à-dire si l'impédance de la charge Rci est supérieure à la valeur admise prédéterminée, la sortie du comparateur prend la valeur logique "0". Dans le cas contraire, elle prend la valeur logique "1". En variante, on peut naturellement adapter une logique inversée.
- Au bout de 65µs, le circuit monostable 204 provoque l'émission d'une impulsion par le circuit de lecture 211. L'état logique du comparateur 209 appliqué à l'entrée D de la mémoire logique 20 est transféré à sa sortie Q. Cet état logique est transmis à la sortie S par l'intermédiaire du circuit de sortie optoélectronique 212 et du circuit de sortie adaptateur 213.
- La sortie S du circuit de test 20 est à l'état "1" si la ligne de puissance Li associée à l'amorce Rci est opérationnelle et à l'état "0" si celle-ci est défectueuse.
- Il résulte de ce qui précède que l'invention permet, avec une bonne précision, une mesure de résistance faible à travers un étage de puissance, ceci en s'affranchissant de la dispersion (intrinsèque et liée à la température) des caractéristiques des composants constituant la ligne de mesure.
- Actuellement la mesure effectuée correspond à l'impédance totale, ligne (L), transistor plus charge (Rc). Il serait possible, connaissant l'impédance de la ligne (câble L) hors charge et une valeur approximative des impédances dynamique du transistor de puissance, d'obtenir une mesure de la résistance de charge avec une bonne précision.
- Le dispositif décrit permet également de n'utiliser qu'un seul circuit de test pour un nombre quelconque de lignes à tester, ce qui assure un gain important de composants par rapport à une solution faisant appel à un circuit de test par ligne. Il en résulte une meilleure fiabilité du dispositif et un coût réduit.
- Par ailleurs, il est possible de tester des lignes de puissance de caractéristiques différentes au moyen d'un même circuit de test, en adaptant le seuil de comparaison et/ou l'intensité du courant continu de mesure à chaque ligne de puissance adressée. A cet effet, on peut utiliser, par exemple, un générateur de courant programmable et/ou un circuit qui appliquera au comparateur 209 une valeur de seuil fonction de la ligne de puissance Li sélectionnée.
- On notera enfin que le test effectué au moyen du dispositif décrit peut avoir pour objet de s'assurer que l'impédance de la ligne est, non pas inférieure, mais supérieure à une valeur prédéterminée. Si la charge est alimentée par une source de tension au lieu d'une source de courant, le test de l'impédance de la ligne de puissance permettra alors de protéger celle-ci ou la source contre des surintensités.
- Il va de soi que les modes de réalisation décrits ne sont que des exemples et qu'on pourrait les modifier, notamment par substitution d'équivalents techniques, sans sortir pour cela du cadre de l'invention.
Claims (12)
- des moyens générateurs de courant constant (SC ; 205, 207) aptes à faire circuler dans ladite ligne (Li) un courant continue de test (Im) de faible valeur par rapport au courant nominal,
- un dipôle électrique (D ; Di) connecté dans ladite ligne de puissance et apte à engendrer une tension constante de décalage (VD) portant l'étage de puissance (10 ; 10i) à saturation lorsque la charge (Rc, Rci) est parcourue par le courant continu de test,
- des moyens de mesure (206, 208) de la chute de tension aux bornes de la ligne de puissance, et
- des moyens (209-213) d'exploitation du résultat de ladite mesure de tension.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR8708266A FR2616548B1 (fr) | 1987-06-15 | 1987-06-15 | Dispositif de test de l'impedance d'une ligne de puissance et son application au test d'amorces de moyens pyrochniques |
FR8708266 | 1987-06-15 |
Publications (2)
Publication Number | Publication Date |
---|---|
EP0296015A1 true EP0296015A1 (fr) | 1988-12-21 |
EP0296015B1 EP0296015B1 (fr) | 1992-01-29 |
Family
ID=9352014
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
EP19880401366 Expired - Lifetime EP0296015B1 (fr) | 1987-06-15 | 1988-06-06 | Dispositif de test de l'impédance d'une ligne de puissance et son application au test d'amorces de moyens pyrotechniques |
Country Status (4)
Country | Link |
---|---|
EP (1) | EP0296015B1 (fr) |
DE (1) | DE3868150D1 (fr) |
ES (1) | ES2029893T3 (fr) |
FR (1) | FR2616548B1 (fr) |
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- 1988-06-06 DE DE8888401366T patent/DE3868150D1/de not_active Expired - Fee Related
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FR2616548B1 (fr) | 1989-12-01 |
ES2029893T3 (es) | 1992-10-01 |
FR2616548A1 (fr) | 1988-12-16 |
DE3868150D1 (de) | 1992-03-12 |
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Legal Events
Date | Code | Title | Description |
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Free format text: ORIGINAL CODE: 0009012 |
|
AK | Designated contracting states |
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|
17P | Request for examination filed |
Effective date: 19890329 |
|
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|
GRAA | (expected) grant |
Free format text: ORIGINAL CODE: 0009210 |
|
AK | Designated contracting states |
Kind code of ref document: B1 Designated state(s): DE ES GB IT SE |
|
REF | Corresponds to: |
Ref document number: 3868150 Country of ref document: DE Date of ref document: 19920312 |
|
GBT | Gb: translation of ep patent filed (gb section 77(6)(a)/1977) | ||
ITF | It: translation for a ep patent filed | ||
REG | Reference to a national code |
Ref country code: ES Ref legal event code: FG2A Ref document number: 2029893 Country of ref document: ES Kind code of ref document: T3 |
|
PLBE | No opposition filed within time limit |
Free format text: ORIGINAL CODE: 0009261 |
|
STAA | Information on the status of an ep patent application or granted ep patent |
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|
26N | No opposition filed | ||
EAL | Se: european patent in force in sweden |
Ref document number: 88401366.5 |
|
PGFP | Annual fee paid to national office [announced via postgrant information from national office to epo] |
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|
PGFP | Annual fee paid to national office [announced via postgrant information from national office to epo] |
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|
PGFP | Annual fee paid to national office [announced via postgrant information from national office to epo] |
Ref country code: DE Payment date: 20000725 Year of fee payment: 13 |
|
PG25 | Lapsed in a contracting state [announced via postgrant information from national office to epo] |
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PG25 | Lapsed in a contracting state [announced via postgrant information from national office to epo] |
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|
GBPC | Gb: european patent ceased through non-payment of renewal fee |
Effective date: 20010606 |
|
EUG | Se: european patent has lapsed |
Ref document number: 88401366.5 |
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PG25 | Lapsed in a contracting state [announced via postgrant information from national office to epo] |
Ref country code: DE Free format text: LAPSE BECAUSE OF NON-PAYMENT OF DUE FEES Effective date: 20020403 |
|
REG | Reference to a national code |
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|
PG25 | Lapsed in a contracting state [announced via postgrant information from national office to epo] |
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