DE3806983C2 - Circuit arrangement for generating voltages of different polarities - Google Patents

Circuit arrangement for generating voltages of different polarities

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Description

Die Erfindung bezieht sich auf eine Schaltungsanordnung zum Erzeugen von Spannungen unterschiedlicher Polarität gemäß dem Oberbegriff des Patentanspruchs 1.The invention relates to a circuit arrangement for Generating voltages of different polarity according to the Preamble of claim 1.

Spannungen unterschiedlicher Polarität, insbesondere erdfreie Spannungen werden beispielsweise bei einer Fernschreib-Hoch­ pegelübertragungstechnik verwendet. Dort gibt es zwei grund­ sätzlich verschiedene Systeme, nämlich Einfachstromsysteme und Doppelstromsysteme. Bei einem Einfachstromsystem wird beispielsweise eine Spannung von 120 V ein- und ausgeschal­ tet, wobei üblicherweise ein Strom von 40 mA zu schalten ist. Bei einem Doppelstromsystem wird dagegen zwischen Spannungen von +60 V und -60 V umgeschaltet, wobei üblicherweise ein Strom von 20 mA zu schalten ist.Voltages of different polarity, especially floating For example, tensions are high at a teletype level transmission technology used. There are two reasons various systems, namely single current systems and dual flow systems. With a single current system for example, a voltage of 120 V on and off tet, usually a current of 40 mA is to be switched. In contrast, in a double-current system there is a difference between voltages switched from +60 V and -60 V, usually one Current of 20 mA is to be switched.

Es ist bereits bekannt, zum Erzeugen der Spannungen unter­ schiedlicher Polarität zwei Spannungsquellen vorzusehen und diese unter Verwendung eines elektronischen Relais oder eines Schalters an den Ausgängen der Schaltungsanordnung abzugeben. In vielen Fällen ist es jedoch notwendig, diese Spannungen individuell erdfrei zur Verfügung zu stellen, um beispiels­ weise bei der Fernschreibübertragungstechnik durch Nebenspre­ chen entstehende Geräuschspannungen zu begrenzen. In diesem Fall benötigt man für jeden Ausgang außer dem elektronischen Relais oder Schalter einen eigenen Übertrager, der die be­ treffenden Spannungen erdfrei zur Verfügung stellt.It is already known to generate the stresses below to provide two voltage sources of different polarity and this using an electronic relay or To deliver switch at the outputs of the circuit arrangement. In many cases, however, this tension is necessary to provide individually floating, for example wise in telex transmission technology by secondary speech limit the resulting noise voltages. In this Case is needed for every output except the electronic one Relay or switch has its own transformer, which be makes available voltages available floating.

Aus der Druckschrift "Eliminating current spiking form dc-to-dc converters" von Carlo Venditti; Elektronics, Band 47, Heft 3, 7. Febr. 1974, Seiten 102 bis 104, ist darüber hinaus ein Gegentakt-Gleichspannungswandler bekannt, bei dem zur Vermei­ dung von Stromspitzen zwei in dem Gleichspannungswandler ge­ genphasig betriebene Transistoren mit Hilfe einer logischen Standardschaltung in bezug auf ein Taktsignal verzögert an­ gesteuert werden.From the publication "Eliminating current spiking form dc-to-dc converters "by Carlo Venditti; Elektronics, volume 47, booklet  3, Feb. 7, 1974, pages 102 to 104, is also a Push-pull DC-DC converter known in which to avoid Formation of two current peaks in the DC / DC converter transistors operated in phase with the help of a logic Standard circuit delayed with respect to a clock signal to be controlled.

Ferner ist aus der AT-272 408 eine Schaltungsanordnung zur Gleichrichtung einer Signalwechselspannung bekannt, bei der zwischen dem Mittelpunkt von Sekundärwicklungen eines Trans­ formators und den Wicklungsenden jeweils Schalttransistoren angeordnet sind, die im aufgesteuerten Zustand in beiden Richtungen leitend sind.Furthermore, from AT-272 408 a circuit arrangement for Rectification of an AC signal known in the between the center of secondary windings of a trans formators and the winding ends of switching transistors are arranged in the open state in both Directions are conductive.

Der Erfindung liegt daher die Aufgabe zugrunde, eine Schal­ tungsanordnung zum Erzeugen von Spannungen unterschiedli­ cher Polarität anzugeben, die einen geringen Aufwand erfor­ dert und die dennoch die betreffenden Spannungen erdfrei zur Verfügung stellt.The invention is therefore based on the object of a scarf arrangement for generating voltages differ  to specify polarity that requires little effort changes and yet the voltages concerned are floating provides.

Erfindungsgemäß wird die Aufgabe bei der Schaltungsanordnung der eingangs genannten Art durch die im kennzeichnenden Teil des Patentanspruchs 1 angegebenen Merkmale gelöst.According to the invention the task in the circuit arrangement of the type mentioned at the outset by the in the characterizing Part of claim 1 specified features solved.

Die Schaltungsanordnung gemäß der Erfindung hat den Vorteil, daß sie nur einen einzigen Übertrager erfordert und damit sehr einfach herstellbar ist.The circuit arrangement according to the invention has the advantage that it requires only a single transmitter and so that it is very easy to manufacture.

Die Spannungen sind in ihrer Polarität durch ein Steuersignal veränderbar, wenn die Impuls-Pausen-Verhältnisse der vom Oszillator abgegebenen Signale durch das Steuersignal entsprechend verändert werden. Das Steuersignal kann beispielsweise einem Fernschreibsignal zugeordnet sein, so daß die Spannungen für die Erzeugung eines Doppelstromsignals bei der Fernschreib-Hochpegelübertragungstechnik verwendbar sind.The voltages are polarized by a control signal changeable if the pulse-pause ratios of the signals output by the oscillator by the control signal be changed accordingly. The control signal can, for example be assigned to a teletype signal so that the voltages for generating a double current signal usable in telex high-level transmission technology are.

Die vom Taktgeber abgegebenen Gegentaktsignale lassen sich auf einfache Weise aus von einem Oszillator abgegebenen Taktimpulsen unter Verwendung von Verknüpfungsgliedern erzeugen. Diese Verknüpfungsglieder sind vorteilhafterweise als Antivalenzglieder ausgebildet.The push-pull signals emitted by the clock can be in a simple manner from an oscillator Generate clock pulses using logic gates. These links are advantageous trained as antivalence members.

Die Gegentaktsignale werden vorzugsweise den beiden Schaltern mit Verzögerung zugeführt, um ein gleichzeitiges Schalten der beiden Schalter zu verhindern.The push-pull signals are preferably the two switches fed with delay to a simultaneous To prevent switching of the two switches.

Die auf der Sekundärseite vorgesehene Gleichrichterschaltung wird zweckmäßigerweise aus zwei gesteuerten Gleichrichtern gebildet, die zu beiden Seiten der Sekundärwicklung angeschlossen sind und an denen die Spannungen abgegeben werden. Die Ansteuerung der Schalter erfolgt über eine Diode und einen Widerstand von der jeweils anderen Seite der Sekundärwicklung. Parallel zu den gesteuerten Gleichrichtern sind Dioden derart angeschlossen, daß deren Durchlaßrichtung jeweils derjenigen der Transistoren entgegengesetzt ist.The rectifier circuit provided on the secondary side expediently consists of two controlled rectifiers formed on either side of the secondary winding are connected and to which the voltages are delivered become. The switches are controlled via a Diode and a resistor from the other side  the secondary winding. Parallel to the controlled rectifiers diodes are connected in such a way that their forward direction opposite that of the transistors is.

Um sicherzustellen, daß erst nach dem Überschreiten einer vorgegebenen Spannung an der Sekundärwicklung die Gleichrichter geschaltet werden, ist es vorteilhaft, daß in Serie mit den ansteuernden Dioden Zenerdioden vorgesehen sind.To ensure that only after a predetermined voltage on the secondary winding the rectifier are switched, it is advantageous that in series Zener diodes are provided with the driving diodes.

Die gesteuerten Gleichrichter in der Schaltungsanordnung sind vorteilhafterweise als Transistoren ausgebildet.The controlled rectifiers in the circuit arrangement are advantageously designed as transistors.

Ein Ausführungsbeispiel der Schaltungsanordnung gemäß der Erfindung wird im folgenden anhand einer Zeichnung näher erläutert. Es zeigtAn embodiment of the circuit arrangement according to the In the following, the invention is illustrated by a drawing explained. It shows

Fig. 1 ein Schaltbild der Schaltungsanordnung, Fig. 1 is a circuit diagram of the circuit arrangement,

Fig. 2 ein Schaltbild eines Taktgebers zum Erzeugen von Gegentaktsignalen in Abhängigkeit von einem Steuersignal und Fig. 2 is a circuit diagram of a clock generator for generating push-pull signals as a function of a control signal and

Fig. 3 ein Zeitdiagramm von Signalen an verschiedenen Punkten der in den Fig. 1 und 2 dargestellten Schaltungsanordnungen. Fig. 3 is a timing diagram of signals at various points in the circuit arrangements shown in Figs. 1 and 2.

Die in Fig. 1 dargestellte Schaltungsanordnung erzeugt aus einer Betriebsspannung UB erdfreie Spannungen ±U unterschiedlicher Polaritäten. Die Schaltungsanordnung enthält einen Übertrager Ü mit einer Primärwicklung PR und einer Sekundärwicklung SE. Der Mittelabgriff der Primärwicklung PR ist mit einem Anschluß +UB der Betriebsspannung UB verbunden. Die Anschlüsse der Primärwicklung PR werden über zwei gesteuerte Schalter, die als Transistoren T1 und T2 ausgebildet sind und mit dem anderen Anschluß der Betriebsspannung -UB verbunden sind, gegentaktig angesteuert. Zu diesem Zweck erzeugt ein Taktgeber TG Gegentaktsignale S1 und S2, die zueinander invertiert sind und über Widerstände R1 und R2 bzw. R3 und R5 den Basen der Transistoren T1 und T2 zugeführt werden. Die Steuerkreise der Transistoren T1 und T2 sind über Kondensatoren C1 und C2 mit dem Anschluß -UB verbunden. Diese Kondensatoren C1 und C2 zusammen mit den Widerständen R2 und R5 verzögern die Gegentaktsignale S1 und S2 derart, daß sichergestellt ist, daß im Übergangsbereich nicht beide Transistoren T1 und T2 gleichzeitig schalten. Das Gegentaktsignal S1 weist ein ungleiches Impuls-Pausenverhältnis auf und das Gegentaktsignal S2 entspricht immer dem invertierten Gegentaktsignal S1. In Abhängigkeit von den Impuls-Pausenverhältnissen der Gegentaktsignale S1 und S2 werden in der Primärwicklung PR unterschiedliche Magnetisierungen erzeugt, so daß entsprechend diesen Impuls-Pausenverhältnissen Spannungen mit unterschiedlicher Polarität auf der Sekundärseite abgegeben werden.The circuit arrangement shown in FIG. 1 generates floating voltages ± U of different polarities from an operating voltage UB. The circuit arrangement contains a transformer Ü with a primary winding PR and a secondary winding SE. The center tap of the primary winding PR is connected to a connection + UB of the operating voltage UB. The connections of the primary winding PR are driven by two controlled switches, which are designed as transistors T1 and T2 and are connected to the other connection of the operating voltage -UB. For this purpose, a clock generator TG generates push-pull signals S1 and S2, which are inverted with respect to one another and fed to the bases of the transistors T1 and T2 via resistors R1 and R2 or R3 and R5. The control circuits of the transistors T1 and T2 are connected to the terminal -UB via capacitors C1 and C2. These capacitors C1 and C2 together with the resistors R2 and R5 delay the push-pull signals S1 and S2 in such a way that it is ensured that in the transition region both transistors T1 and T2 do not switch simultaneously. The push-pull signal S1 has an uneven pulse-pause ratio and the push-pull signal S2 always corresponds to the inverted push-pull signal S1. Depending on the pulse-pause ratios of the push-pull signals S1 and S2, different magnetizations are generated in the primary winding PR, so that voltages with different polarity are emitted on the secondary side in accordance with these pulse-pause ratios.

Unter Verwendung eines Steuersignals S, das dem Taktgeber TG zugeführt wird, können die Impuls-Pausenverhältnisse der Gegentaktsignale S1 und S2 vertauscht werden, so daß auf der Sekundärseite gleichgroße positive und negative Spannungen ±U in Abhängigkeit von der Fremdsteuerung durch das Steuersignal S erzeugt werden.Using a control signal S, the clock TG is fed, the pulse-pause ratios of the Push-pull signals S1 and S2 are interchanged, so that on the secondary side of equal positive and negative voltages ± U depending on the external control by the Control signal S are generated.

Auf der Sekundärseite ist eine Gleichrichterschaltung vorgesehen, die zwei gesteuerte Gleichrichter in Form von Transistoren T3 und T4 und als weitere Elemente zwei Dioden D1 und D2 enthält. Die Transistoren T3 und T4 sind zu beiden Seiten der Sekundärwicklung SE angeschlossen und antiparallel zu den Transistoren T3 und T4 sind die Dioden D1 und D2 angeschlossen, und zwar derart, daß deren Durchlaßrichtung der Durchlaßrichtung der zugeordneten Transistoren entgegengesetzt ist. Die Ansteuerung der Transistoren T3 und T4 erfolgt über die jeweils andere Seite der Sekundärwicklung SE, und zwar über Dioden D3 bzw. D4 und einen Widerstand R4. A rectifier circuit is provided on the secondary side, the two controlled rectifiers in the form of Transistors T3 and T4 and two diodes as further elements Contains D1 and D2. The transistors T3 and T4 are both Side of the secondary winding SE connected and anti-parallel to the transistors T3 and T4 are the diodes D1 and D2 connected, in such a way that their forward direction the forward direction of the assigned transistors is opposite. The control of the transistors T3 and T4 occurs over the other side of the secondary winding SE, namely via diodes D3 and D4 and a resistor R4.  

Um sicherzustellen, daß erst beim Überschreiten einer vorgegebenen Spannung Signale den Transistoren T3 bzw. T4 zugeführt werden, sind in Serie mit den Dioden D3 und D4 noch Zenerdioden D5 bzw. D6 vorgesehen. Durch diese wird erreicht, daß im Übergangsbereich die Transistoren T3 und T4 nicht gleichzeitig leitend werden.To ensure that only when a predetermined one is exceeded Voltage signals are supplied to the transistors T3 and T4 are still in series with diodes D3 and D4 Zener diodes D5 and D6 are provided. Through this is achieved that the transistors T3 and T4 in the transition region not become a manager at the same time.

Durch die unsymmetrische Ansteuerung der Transistoren T1 und T2 durch die Gegentaktsignale S1 und S2 mit den ungleichen Impuls-Pausenverhältnissen enthält jeweils einer der beiden Transistoren T1 oder T2 einen ausreichend langen Impuls, um die volle Leistung übertragen zu können. Der jeweils andere Transistor T2 bzw. T1 enthält aber nur einen kurzen Impuls, um die Magnetisierung des Übertragers Ü zu kompensieren. Wenn beispielsweise der Basis des Transistors T1 ein Impuls mit einer langen Impulsdauer zugeführt wird, wird bei entsprechender Polung der Sekundärwicklung SE der Transistor T3 leitend und er liefert eine negative Spannung an den mit seinem Kollektor verbundenen Ausgang B. Der Strom fließt dabei über die Diode D2 zum Ausgang A, über einen angeschlossenen Verbraucher zu dem Ausgang B und über den Transistor T3 zurück zur Sekundärwicklung SE. Der Transistor T3 wird dabei über die Zenerdiode D5 und die Diode D3 sowie den Widerstand R4 leitend gesteuert. Während des nachfolgenden kurzen Impulses des Gegentaktsignales S2 wird der Transistor T2 leitend, so daß über die Zenerdiode D6 und die Diode D4 sowie den Widerstand R4 der Transistor T4 kurzzeitig leitend gesteuert wird und ein Strom von der Sekundärwicklung SE über die Diode D1 und den Verbraucher zurück über den Transistor T4 zur Sekundärwicklung SE fließt. In entsprechender Weise wird bei einer Vertauschung der Impuls-Pausenverhältnisse durch das Steuersignal S an dem Ausgang A eine negative Spannung erzeugt und an dem Ausgang B eine positive Spannung erzeugt.Due to the asymmetrical control of the transistors T1 and T2 by the push-pull signals S1 and S2 with the unequal Impulse-pause ratios contain one of each a sufficiently long pulse for both transistors T1 or T2, to be able to transfer the full power. The each other transistor T2 or T1 contains only one short pulse to magnetize the transmitter Ü compensate. For example, if the base of the transistor T1 a pulse with a long pulse duration is supplied, with appropriate polarity of the secondary winding SE Transistor T3 conductive and it supplies a negative voltage to the output B connected to its collector Current flows through the diode D2 to the output A, over a connected consumer to output B and over the transistor T3 back to the secondary winding SE. The transistor T3 is via the Zener diode D5 and the diode D3 and the resistor R4 controlled. During the subsequent short pulse of the push-pull signal S2 the transistor T2 conductive, so that the Zener diode D6 and the diode D4 and the resistor R4 of the transistor T4 is briefly controlled and a current from the secondary winding SE back via the diode D1 and the consumer flows through the transistor T4 to the secondary winding SE. In a corresponding manner, if the pulse-pause ratios are interchanged by the control signal S on the Output A generates a negative voltage and at the output B generates a positive voltage.

Das in Fig. 2 dargestellte Schaltbild zeigt eine Ausführungsform des Taktgebers TG. Die Gegentaktsignale S1 und S2 können auf verschiedenartige Weise, gesteuert durch das Steuersignal S erzeugt werden. Bei dem in Fig. 2 dargestellten Schaltbild erzeugt ein Oszillator OS Taktimpulse CT mit einem ungleichen Impuls-Pausenverhältnis. Diese Taktimpulse CT werden durch einen Inverter I invertiert und als Taktimpulse CT1 abgegeben. Diese invertierten Taktimpulse CT1 werden gemeinsam mit dem Steuersignal S einem Verknüpfungsglied G1 zugeführt, das als Antivalenzglied ausgebildet ist und das an seinem Ausgang die Steuersignale S1 abgibt. In entsprechender Weise werden die Taktimpulse CT gemeinsam mit dem Steuersignal S einem Verknüpfungsglied G2 zugeführt, das ebenfalls als Antivalenzglied ausgebildet ist und an seinem Ausgang die Steuersignale S2 abgibt.The circuit diagram shown in Fig. 2 shows an embodiment of the clock generator TG. The push-pull signals S1 and S2 can be generated in various ways, controlled by the control signal S. In the circuit diagram shown in FIG. 2, an oscillator OS generates clock pulses CT with an uneven pulse-pause ratio. These clock pulses CT are inverted by an inverter I and output as clock pulses CT1. These inverted clock pulses CT1 are supplied together with the control signal S to a logic element G1 which is designed as an antivalence element and which outputs the control signals S1 at its output. In a corresponding manner, the clock pulses CT are supplied together with the control signal S to a logic element G2, which is also designed as an antivalence element and outputs the control signals S2 at its output.

Bei dem in Fig. 3 dargestellten Zeitdiagramm wird davon ausgegangen, daß die Taktimpulse CT und die Taktimpulse CT1 zueinander invertiert sind. Das Steuersignal S hat zum Zeitpunkt t1 den Binärwert 0 und damit entsprechen die folgenden durch das Antivalenzglied G1 erzeugten Gegentaktsignale S1 den Taktimpulsen CT1. Die durch das Antivalenzglied G2 erzeugten Gegentaktsignale S2 entsprechen dann den Taktimpulsen CT. Die Spannung U, die an der Sekundärseite abgegeben wird, ist, bei entsprechender Polung der Sekundärwicklung SE, wie oben angegeben, damit negativ und weist den Wert -U auf. Dieser Zustand wird bis zum Zeitpunkt t2 beibehalten.In the illustrated in Fig. 3 timing diagram, it is assumed that the clock pulses CT and the clock pulses are inverted to each other CT1. The control signal S has the binary value 0 at the time t1 and thus the following push-pull signals S1 generated by the antivalence element G1 correspond to the clock pulses CT1. The push-pull signals S2 generated by the antivalence element G2 then correspond to the clock pulses CT. The voltage U, which is output on the secondary side, is, with appropriate polarity of the secondary winding SE, as indicated above, negative and has the value -U. This state is maintained until time t2.

Zum Zeitpunkt t2 ändert das Steuersignal S seinen Binärwert von 0 nach 1 und damit werden die an den Antivalenzgliedern G1 und G2 anliegenden invertierten Taktimpulse CT1 bzw. die Taktimpulse CT invertiert als Gegentaktsignale S1 bzw. S2 abgegeben und die Polarität der Spannung U ändert sich dementsprechend.At time t2, the control signal S changes its binary value from 0 to 1 and thus the inverted clock pulses CT1 and the clock pulses CT present at the antivalence elements G1 and G2 are output inverted as push-pull signals S1 and S2 and the polarity of the voltage U changes accordingly.

Zum Zeitpunkt t3 nimmt das Steuersignal S wieder den Binärwert 0 an, so daß wieder ähnliche Verhältnisse vorhanden sind wie nach dem Zeitpunkt t1 und vor dem Zeitpunkt t2. At time t3, the control signal S takes the binary value again 0 so that similar conditions are available again are like after time t1 and before time t2.  

Durch eine Fremdsteuerung der Primärseite des Übertragers Ü durch die unsymmetrischen Gegentaktsignale S1 und S2 ist es damit möglich, auf der Sekundärseite Spannungen ±U mit unterschiedlicher Polarität zu erzeugen, je nachdem, welchen Binärwert das Steuersignal S annimmt.By external control of the primary side of the transformer Ü through the unbalanced push-pull signals S1 and S2 it is thus possible on the secondary side voltages ± U with different Generate polarity, whichever Binary value the control signal S accepts.

Das Steuersignal S ist vorzugsweise einem Fernschreibsignal zugeordnet und da die Polaritäten der Spanungen ±U den Binärwerten des Steuersignals S entsprechen, können die Spannungen ±U für die Erzeugung von Doppelstromsignalen bei Hochpegelübertragungsstrecken verwendet werden.The control signal S is preferably a teletype signal assigned and since the polarities of the voltages ± U the binary values of the control signal S, the voltages ± U for the generation of double current signals at High-level transmission links are used.

Claims (9)

1. Schaltungsanordnung zum Erzeugen von Spannungen unter­ schiedlicher Polarität, bei der ein Übertrager vorgesehen ist, dessen Primärwicklung mit einer Mittelanzapfung versehen ist und über zwei gesteuerte Schalter durch in einem Taktge­ ber erzeugte Gegentaktsignale angesteuert wird und an dessen Sekundärwicklung die Spannungen über eine Gleichrichterschal­ tung abgegeben werden, dadurch gekennzeichnet, daß die von dem Taktgeber (TG) an die beiden gesteuerten Schalter (T1, T2) abgegebenen Gegentaktsignale (S1, S2) unterschiedliche Impuls-Pausenverhältnisse aufweisen und zueinander invertiert sind und daß die an der Sekundärwicklung angeschlossene Gleichrichterschaltung zwei gesteuerte Gleichrichteranord­ nungen (T3, D1; T4, D2) aufweist, die durch an der Sekundär­ wicklung (SE) erzeugte Spannungen derart steuerbar sind, daß jeweils ein geschlossener Verbraucherstromkreis gebildet wird, dessen Polarität von den Impuls-Pausen­ verhältnissen abhängt. 1.Circuit arrangement for generating voltages under different polarity, in which a transformer is provided, the primary winding of which is provided with a center tap and is controlled by two controlled switches by push-pull signals generated in a clock, and on the secondary winding of which the voltages are emitted via a rectifier circuit are characterized in that the push-pull signals (S1, S2) emitted by the clock generator (TG) to the two controlled switches (T1, T2) have different pulse-pause ratios and are inverted to one another and that the rectifier circuit connected to the secondary winding has two controlled rectifier arrangements tions (T3, D1; T4, D2), which can be controlled by voltages generated on the secondary winding (SE) in such a way that a closed consumer circuit is formed, the polarity of which depends on the pulse-pause conditions. 2. Schaltungsanordnung nach Anspruch 1, dadurch gekennzeichnet, daß die beiden Gegentaktsignale (S1, S2) durch ein am Taktgeber (TG) anliegendes Steuersignal (S) gleichzeitig invertierbar sind.2. Circuit arrangement according to claim 1, characterized characterized in that the two push-pull signals (S1, S2) by one connected to the clock generator (TG) Control signal (S) are invertible at the same time. 3. Schaltungsanordnung nach Anspruch 1 oder Anspruch 2, dadurch gekennzeichnet, daß das Steuersignal (S) einem Fernschreibsignal zugeordnet ist.3. Circuit arrangement according to claim 1 or claim 2, characterized in that the Control signal (S) is assigned to a teletype signal. 4. Schaltungsanordnung nach einem der Ansprüche 1 bis 3, dadurch gekennzeichnet, daß der Taktgeber (TG) einen Oszillator (OS) aufweist, der Taktimpulse (CT) mit konstanter Folgefrequenz und ungleichem Impuls-Pausenverhältnis erzeugt und Verknüpfungsglieder (G1, G2) aufweist, die in Abhängigkeit von den Momentanwerten des Steuersignals (S) als Gegentaktsignale (S1, S2) die invertierten bzw. nichtinvertierten Taktimpulse (CT1 bzw. CT) invertiert oder nichtinvertiert abgeben. 4. Circuit arrangement according to one of claims 1 to 3, characterized in that the Clock generator (TG) has an oscillator (OS), the clock pulses (CT) with constant repetition frequency and uneven pulse-pause ratio generates and links (G1, G2), which is a function of the instantaneous values the inverted control signal (S) as push-pull signals (S1, S2) or non-inverted clock pulses (CT1 or CT) deliver inverted or non-inverted.   5. Schaltungsanordnung nach Anspruch 4, dadurch gekennzeichnet, daß die Verknüpfungsglieder (G1, G2) als Antivalenzglieder ausgebildet sind.5. Circuit arrangement according to claim 4, characterized characterized in that the links (G1, G2) are designed as antivalence elements. 6. Schaltungsanordnung nach einem der Ansprüche 1 bis 5, dadurch gekennzeichnet, daß den gesteuerten Schaltern (T1, T2) auf der Primärseite des Übertrager (Ü) die Gegentaktsignale (S1, S2) unterschiedlich verzögert zugeführt werden. 6. Circuit arrangement according to one of claims 1 to 5, characterized in that the controlled switches (T1, T2) on the primary side of the Transducer (Ü) the push-pull signals (S1, S2) differently can be supplied with a delay.   7. Schaltungsanordnung nach einem der Ansprüche 1 bis 6, dadurch gekennzeichnet, daß die zwei an der Sekundärwicklung (SE) angeschlossene gesteuerten Gleichrichteranordnungen (T3, D1; T4, D2) jeweils einen Transistor (T3, T4) mit einer in bezug auf die Stromdurchlaßrichtung antiparallel geschal­ teten Diode (D1, D2) enthalten, wobei an den Transistoren (T3, T4) die Spannungen (±U) abgegeben werden und wobei die Transistoren (T3, T4) jeweils über Dioden (D3, D4) und einen Widerstand (R4) von dem jeweils anderen Anschluß der Sekun­ därwicklung (SE) gesteuert werden.7. Circuit arrangement according to one of claims 1 to 6, characterized in that the two on the secondary winding (SE) connected controlled rectifier arrangements (T3, D1; T4, D2) each have a transistor (T3, T4) with a with respect to the direction of current transmission antiparallel teten diode (D1, D2) included, being on the transistors (T3, T4) the voltages (± U) are given and where the Transistors (T3, T4) each via diodes (D3, D4) and one Resistor (R4) from the other connection of the second därwicklung (SE) can be controlled. 8. Schaltungsanordnung nach Anspruch 7, dadurch gekennzeich­ net, daß in Serie mit den die gesteuerten Gleichrichteran­ ordnungen (T3, D1; T4, D2) ansteuernden Dioden (D3, D4) Ze­ nerdioden (D5, D6) vorgesehen sind.8. Circuit arrangement according to claim 7, characterized in net that in series with the controlled rectifiers orders (T3, D1; T4, D2) driving diodes (D3, D4) Ze ner diodes (D5, D6) are provided. 9. Schaltungsanordnung nach Anspruch 6, dadurch gekennzeich­ net, daß als gesteuerte Schalter (T1, T2) Transistoren vorge­ sehen sind.9. Circuit arrangement according to claim 6, characterized in net that as a controlled switch (T1, T2) pre-transistors are seen.
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