DE102018120637A1 - Leiterplatte und verfahren zur herstellung einer leiterplatte mit mindestens einem in die leiterplatte integrierten optoelektronischen bauelement - Google Patents
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Abstract
Ein Verfahren zur Herstellung einer Leiterplatte (100) umfasst folgende Schritte: Anordnen mindestens eines optoelektronischen Bauelements (11-13) auf einer ersten Metallschicht (10), Pressen einer ersten elektrisch isolierenden Schicht (26) auf das mindestens eine optoelektronische Bauelement (11-13), und Erzeugen von mindestens einer Aussparung (30) in der ersten Metallschicht (10) und/oder der ersten elektrisch isolierenden Schicht (26), wodurch das mindestens eine optoelektronische Bauelement (11-13) zumindest teilweise freigelegt wird.
Description
- Die vorliegende Erfindung betrifft eine Leiterplatte und ein Verfahren zur Herstellung einer Leiterplatte mit mindestens einem in die Leiterplatte integrierten optoelektronischen Bauelement.
- Displays können Arrays aus optoelektronischen Bauelementen, wie beispielsweise LEDs, aufweisen. Üblicherweise werden die optoelektronischen Bauelemente auf Substraten, wie beispielsweise Leiterplatten, angeordnet. Die Substrate enthalten Metallisierungsschichten, um die optoelektronischen Bauelemente miteinander zu koppeln und elektrisch ansteuern zu können.
- Der vorliegenden Erfindung liegt unter anderem die Aufgabe zugrunde, ein Verfahren anzugeben, mit dem sich in kostengünstiger Weise eine Vorrichtung mit mindestens einem optoelektronischen Bauelement schaffen lässt. Ferner soll eine derartige Vorrichtung angegeben werden.
- Eine Aufgabe der Erfindung wird gelöst durch ein Verfahren mit den Merkmalen des Anspruchs 1. Eine Aufgabe der Erfindung wird ferner gelöst durch eine Leiterplatte mit den Merkmalen des Anspruchs 11. Bevorzugte Ausführungsformen und Weiterbildungen der Erfindung sind in den abhängigen Ansprüchen angegeben.
- Ein Verfahren zur Herstellung einer Leiterplatte mit mindestens einem in die Leiterplatte integrierten optoelektronischen Bauelement umfasst das Anordnen mindestens eines optoelektronischen Bauelements auf einer ersten Metallschicht. Anschließend wird eine erste elektrisch isolierende Schicht auf das mindestens eine optoelektronische Bauelement gepresst. Ferner wird mindestens eine Aussparung in der ersten Metallschicht und/oder der ersten elektrisch isolierenden Schicht erzeugt. Durch die mindestens eine Aussparung wird das mindestens eine optoelektronische Bauelement zumindest teilweise freigelegt.
- Die mit dem in der vorliegenden Anmeldung beschriebenen Verfahren hergestellte Leiterplatte (englisch: printed circuit board, PCB) umfasst die erste elektrisch isolierende Schicht, das mindestens eine optoelektronische Bauelement sowie die erste Metallschicht, die insbesondere strukturiert werden kann. Darüber hinaus kann die Leiterplatte weitere Komponenten umfassen.
- Das mindestens eine optoelektronische Bauelement kann Licht im sichtbaren Bereich, Ultraviolett (UV)-Licht und/oder Infrarot (IR)-Licht emittieren.
- Weiterhin kann das mindestens eine optoelektronische Bauelement ein optoelektronisches Halbleiterbauelement, insbesondere ein Halbleiterchip, sein. Beispielsweise kann das mindestens eine optoelektronische Bauelement als Licht emittierende Diode (englisch: light emitting diode, LED), als organische Licht emittierende Diode (englisch: organic light emitting diode, OLED), als Licht emittierender Transistor oder als organischer Licht emittierender Transistor ausgebildet sein. Das mindestens eine optoelektronische Bauelement kann außerdem Teil einer integrierten Schaltung sein.
- Neben dem mindestens einen optoelektronischen Bauelement können weitere Halbleiterbauelemente und/oder andere Komponenten in die Leiterplatte integriert sein.
- Die erste Metallschicht kann eine Metallfolie sein, die üblicherweise bei der Herstellung von Leiterplatten verwendet wird. Beispielsweise kann die erste Metallschicht aus Kupfer oder einem anderen geeigneten Metall oder einer geeigneten Metalllegierung bestehen. Die erste Metallschicht kann während der Anordnung des mindestens einen optoelektronischen Bauelements auf der ersten Metallschicht unstrukturiert sein.
- Das mindestens eine optoelektronische Bauelement kann mit Hilfe eines elektrisch nicht leitenden Klebstoffs auf der ersten Metallschicht fixiert werden.
- Die erste elektrisch isolierende Schicht kann aus einem Polymer, einem faserverstärkten Kunststoff, einem Laminat, einem Glasfasergewebe oder einem anderen geeigneten Material bestehen, das üblicherweise bei der Herstellung von Leiterplatten eingesetzt wird.
- Während des Pressens der ersten elektrisch isolierenden Schicht auf das mindestens eine optoelektronische Bauelement kann ein geeigneter Druck aufgebracht werden. Ferner kann die elektrisch isolierenden Schicht während des Pressens auf das mindestens eine optoelektronische Bauelement erhitzt sein. Durch das Pressen der elektrisch isolierenden Schicht auf das mindestens eine optoelektronische Bauelement wird das mindestens eine optoelektronische Bauelement in die elektrisch isolierende Schicht integriert, d. h., direkt nach dem Pressvorgang können eine Hauptoberfläche und eine oder mehrere Seitenflächen, insbesondere sämtliche Seitenflächen des mindestens einen optoelektronischen Bauelements von dem Material der ersten elektrisch isolierenden Schicht bedeckt sein.
- Die mindestens eine Aussparung kann in der ersten Metallschicht und/oder der ersten elektrisch isolierenden Schicht mittels eines geeigneten Verfahrens erzeugt werden. Beispielsweise kann die mindestens eine Aussparung durch einen Laserstrahl erzeugt werden, mit dem Material der ersten Metallschicht und/oder der ersten elektrisch isolierenden Schicht abgetragen wird, um das mindestens eine optoelektronische Bauelement zumindest teilweise freizulegen. Alternativ ist es auch denkbar, ein anderes geeignetes Verfahren zur Erzeugung der mindestens einen Aussparung einzusetzen, beispielsweise ein Ätzverfahren.
- Weiterhin können mit dem zum Erzeugen der mindestens einen Aussparung eingesetzten Verfahren auch ein oder mehrere Durchgangslöcher in der ersten elektrisch isolierenden Schicht erzeugt werden. Das oder die Durchgangslöcher befinden sich seitlich neben dem mindestens einen optoelektronischen Bauelement und erstrecken sich von der Oberseite bis zur Unterseite der elektrisch isolierenden Schicht.
- Mit dem hier beschriebenen Verfahren lässt sich die Leiterplatte mit dem darin integrierten mindestens einen optoelektronischen Bauelement in kostengünstiger Weise herstellen. Es ist nicht erforderlich, zunächst die Leiterplatte herzustellen und danach das mindestens eine optoelektronische Bauelement auf die Leiterplatte zu montieren. Stattdessen wird die Montage des mindestens einen optoelektronischen Bauelements in das Leiterplatten-Herstellungsverfahren integriert. Das Umformen, Kontaktieren und Freilegen des mindestens einen optoelektronischen Bauelements kann mit Hilfe von Standardprozessschritten erfolgen, die zur Herstellung einer Leiterplatte ohnehin eingesetzt werden. Komplexe Schritte, wie beispielsweise das Erstellen von Bonddrähten, das Vergießen von Halbleiterchips, das schwarze oder weiße Einfassen von Halbleiterchips sowie das Montieren und Kontaktieren von Halbleiterchips auf der Leiterplatte, können eingespart werden. Weiterhin kann die Infrastruktur, welche eine Leiterplatte bietet, genutzt werden. Beispielsweise können mehrere optoelektronische Bauelemente mit Hilfe der Metallisierungsebenen der Leiterplatte miteinander elektrisch gekoppelt werden. Es kann ein CoB (chip on board)-Modul in einem sehr kostengünstigen Prozessfluss gefertigt werden.
- Die mit dem hier beschriebenen Verfahren hergestellten Leiterplatten können in vielen LED-Anwendungen, beispielsweise in LED-Displays, eingesetzt werden. Weiterhin können die Leiterplatten in Beleuchtungsvorrichtungen, z. B. in Ambientebeleuchtungen, insbesondere für Fahrzeuge, oder in Blitzlichtern, eingesetzt werden. Auch Anwendungen in Hinterleuchtungen sind denkbar, z. B. bei Hintergrundbeleuchtungen von Bildschirmen oder Schalterhinterleuchtungen. Es ist auch der Einsatz in komplexeren Modulen vorstellbar, z. B. in pixelierten Lichtquellen oder in Kacheln von Videowänden.
- Durch das Erzeugen der mindestens einen Aussparung kann eine Oberfläche des mindestens einen optoelektronischen Bauelements, durch die das von dem mindestens einen optoelektronischen Bauelement erzeugte Licht zumindest zum Teil austritt, teilweise oder vollständig freigelegt werden.
- Es kann vorgesehen sein, dass zusammen mit der ersten elektrisch isolierenden Schicht eine zweite Metallschicht auf das mindestens eine optoelektronische Bauelement gepresst wird. Nach dem Aufbringen der zweiten Metallschicht befinden sich die erste elektrisch isolierende Schicht und das in die erste elektrisch isolierende Schicht integrierte mindestens eine optoelektronische Bauelement zwischen der ersten Metallschicht und der zweiten Metallschicht.
- Die zweite Metallschicht kann eine Metallfolie sein, die üblicherweise bei der Herstellung von Leiterplatten verwendet wird. Beispielsweise kann die zweite Metallschicht aus Kupfer oder einem anderen geeigneten Metall oder einer geeigneten Metalllegierung bestehen. Die zweite Metallschicht kann beim Aufbringen auf das mindestens eine optoelektronische Bauelement unstrukturiert sein. Die zweite Metallschicht kann in einem späteren Verfahrensschritt strukturiert werden. Weiterhin kann sich die mindestens eine Aussparung durch die zweite Metallschicht erstrecken. In diesem Fall wird zur Herstellung der mindestens einen Aussparung die zweite Metallschicht an der oder den entsprechenden Stellen entfernt.
- Gemäß einer Ausgestaltung weist das mindestens eine optoelektronische Bauelement eine erste Hauptoberfläche und eine der ersten Hauptoberfläche gegenüberliegende zweite Hauptoberfläche auf. Die beiden Hauptoberflächen sind durch Seitenflächen miteinander verbunden. Das mindestens eine optoelektronische Bauelement wird mit seiner ersten Hauptoberfläche auf der ersten Metallschicht angeordnet. Licht, das von dem mindestens einen optoelektronischen Bauelement erzeugt wird, tritt an der zweiten Hauptoberfläche und insbesondere auch an den Seitenflächen aus.
- Das mindestens eine optoelektronische Bauelement kann ein Halbleiterchip vom sogenannten Flip-Chip-Typ sein, der alle seine elektrischen Kontaktelemente auf der ersten Hauptoberfläche hat, die nach der Montage in Richtung der ersten Metallschicht weist. Weiterhin kann das mindestens eine optoelektronische Bauelement ein Saphirchip vom Flip-Chip-Typ sein. Ein Saphir-Flip-Chip weist ein oder mehrere Schichten aus Halbleitermaterial auf, in denen Licht erzeugt wird. Oberhalb der Halbleiterschichten befindet sich eine Schicht aus Aluminiumoxid, Al2O3, durch die das Licht emittiert wird.
- Durch das Erzeugen der mindestens einen Aussparung kann die zweite Hauptoberfläche des mindestens einen optoelektronischen Bauelements, durch die zumindest ein Teil des von dem mindestens einen optoelektronischen Bauelement erzeugten Lichts emittiert wird, teilweise oder vollständig freigelegt werden. Weiterhin kann Material der ersten elektrisch isolierenden Schicht, das sich seitlich von der zweiten Hauptoberfläche befindet, entfernt werden. In anderen Worten kann die mindestens eine Aussparung die zweite Hauptoberfläche überragen. Folglich ist in diesem Fall die Basisfläche der mindestens einen Aussparung größer als die zweite Hauptoberfläche des mindestens einen optoelektronischen Bauelements. Dies ermöglicht einen ungehinderten Austritt des emittierten Lichts und verhindert Abschattungseffekte.
- Gemäß einer Ausgestaltung enthält die erste elektrisch isolierende Schicht Licht absorbierendes bzw. schwarzes Material. Beispielsweise kann die erste elektrisch isolierende Schicht Rußpartikel oder andere schwarze Partikel als Licht absorbierendes Material enthalten. Dadurch kann ein guter Schwarzeindruck der Leiterplatte erzielt werden.
- Licht absorbierend bedeutet in diesem Zusammenhang, dass das Licht absorbierende Material zumindest einen Teil des von dem mindestens einen optoelektronischen Bauelement emittierten Lichts oder zumindest Licht in einem bestimmten Wellenlängenbereich im Wesentlichen absorbiert.
- Alternativ zu der vorstehenden Ausgestaltung kann die erste elektrisch isolierende Schicht Licht reflektierendes Material enthalten. Beispielsweise kann die erste elektrisch isolierende Schicht Titandioxid, TiO2, bzw. Partikel aus Titandioxid als Licht reflektierendes Material enthalten. Bei Volumenemittern, bei denen das Licht nicht nur an einer Hauptoberfläche, sondern auch an den Seitenflächen austritt, z. B. bei Saphirchips, kann diese Ausgestaltung vorteilhaft sein, um auch das an den Seitenflächen austretenden Licht in die gewünschte Richtung zu lenken.
- Reflektierend bedeutet in diesem Zusammenhang, dass das reflektierende Material zumindest für einen Teil des von dem mindestens einen optoelektronischen Bauelement emittierten Lichts oder zumindest für Licht in einem bestimmten Wellenlängenbereich im Wesentlichen reflektierend ist.
- Um einen hohen Kontrast zu erzeugen, kann auf die erste elektrisch isolierende Schicht mit dem darin enthaltenen Licht reflektierenden Material eine weitere Schicht aufgebracht werden, wobei die weitere Schicht Licht absorbierendes Material, z. B. Rußpartikel, enthält. Die weitere Schicht kann beispielsweise unter Anwendung von Druck und Hitze auf die darunter liegenden Schichten laminiert werden. In den nachfolgenden Schritten kann die weitere Schicht strukturiert werden, um die mindestens eine Aussparung zu erzeugen. Zwischen der ersten elektrisch isolierenden Schicht und der weiteren Schicht kann sich außerdem die zweite Metallschicht befinden.
- Eine erste strukturierte Metallisierungsschicht kann auf das mindestens eine optoelektronische Bauelement, die erste Metallschicht und/oder die erste elektrisch isolierende Schicht aufgebracht werden. Die erste strukturierte Metallisierungsschicht kann insbesondere zur Umverdrahtung der elektrischen Kontaktelemente des mindestens einen optoelektronischen Bauelements ausgelegt sein. Ferner können durch die erste strukturierte Metallisierungsschicht mehrere optoelektronische Bauelement miteinander gekoppelt werden.
- Die erste strukturierte Metallisierungsschicht kann galvanisch erzeugt werden. Die erste strukturierte Metallisierungsschicht kann zumindest teilweise auf der ersten Metallschicht und/oder der zweiten Metallschicht erzeugt werden. Dabei können die erste Metallschicht und/oder die zweite Metallschicht strukturiert werden. Ferner kann sich die erste strukturierte Metallisierungsschicht durch Durchgangslöcher in der ersten elektrisch isolierenden Schicht erstrecken, um Durchkontaktierungen (englisch: vertical interconnect access, via) zu erzeugen, durch welche insbesondere die erste Metallschicht und die zweite Metallschicht elektrisch miteinander verbunden werden.
- Auf die erste strukturierte Metallisierungsschicht kann eine zweite elektrisch isolierende Schicht aufgebracht bzw. laminiert werden. Weiterhin kann eine zweite strukturierte Metallisierungsschicht auf die zweite elektrisch isolierende Schicht aufgebracht werden. Durchkontaktierungen in der zweiten elektrisch isolierenden Schicht können die erste strukturierte Metallisierungsschicht mit der zweiten strukturierten Metallisierungsschicht elektrisch verbinden. In entsprechender Weise können weitere Lagen hergestellt werden, die jeweils eine elektrisch isolierende Schicht, eine strukturierte Metallisierungsschicht und Durchkontaktierungen durch die elektrisch isolierende Schicht enthalten. Es lassen sich beliebig viele derartige Lagen kombinieren. Die beschriebenen Lagen können erforderlich sein, um ein ausreichend hohes Bauteil zu schaffen und Anforderungen an die Bauteilhöhe zu erfüllen und/oder um eine gewünschte Umverdrahtung der elektrischen Kontaktelemente des mindestens einen optoelektronischen Bauelements zu realisieren. Weiterhin kann ein sogenannter Fan-Out-Bereich geschaffen werden, der es ermöglicht, die externen Kontaktelemente der Leiterplatte außerhalb des Umrisses des mindestens einen optoelektronischen Bauelements zu platzieren, um beispielsweise die Kontaktabstände zu vergrößern oder ein gewünschtes Muster der externen Kontaktelemente zu schaffen.
- Eine Leiterplatte umfasst eine erste elektrisch isolierende Schicht, mindestens ein in die erste elektrisch isolierende Schicht integriertes optoelektronisches Bauelement, eine erste strukturierte Metallisierungsschicht, die sich auf der ersten elektrisch isolierenden Schicht und dem mindestens einen optoelektronischen Bauelement erstreckt, und mindestens eine Aussparung in der ersten elektrisch isolierenden Schicht, durch die das mindestens eine optoelektronische Bauelement zumindest teilweise freigelegt ist.
- Die Leiterplatte kann die oben im Zusammenhang mit dem Verfahren zur Herstellung der Leiterplatte beschriebenen Ausgestaltungen aufweisen.
- Die mindestens eine Aussparung kann eine Oberfläche des mindestens einen optoelektronischen Bauelements zumindest teilweise freilegen, durch die zumindest ein Teil des von dem mindestens einen optoelektronischen Bauelement erzeugten Lichts austritt.
- Weiterhin kann die mindestens eine Aussparung größer sein als die Oberfläche des mindestens einen optoelektronischen Bauelements, durch die das von dem mindestens einen optoelektronischen Bauelement erzeugte Licht austritt.
- Die erste elektrisch isolierende Schicht kann Licht absorbierendes Material aufweisen.
- Alternativ kann die erste elektrisch isolierende Schicht Licht reflektierendes Material aufweisen. Ferner kann eine weitere Schicht, die Licht absorbierendes Material aufweist, auf die erste elektrisch isolierende Schicht aufgebracht sein.
- Eine zweite elektrisch isolierende Schicht kann auf die erste strukturierte Metallisierungsschicht aufgebracht sein und eine zweite strukturierte Metallisierungsschicht kann auf die zweite elektrisch isolierende Schicht aufgebracht sein. Durchkontaktierungen in der zweiten elektrisch isolierenden Schicht können die erste strukturierte Metallisierungsschicht mit der zweiten strukturierten Metallisierungsschicht elektrisch verbinden.
- Ein Display, d. h. ein optisches Anzeigegerät, kann ein oder mehrere der vorstehend beschriebenen Leiterplatten umfassen. Ferner kann eine in dem Display enthaltene Leiterplatte mit dem oben beschriebenen Verfahren hergestellt werden.
- Eine in das Display integrierte Leiterplatte kann eine Pixel-Matrix aufweisen. Jedes der Pixel kann drei Subpixel mit einem jeweiligen optoelektronischen Bauelement aufweisen, wobei die Subpixel Licht mit den Farben rot, grün bzw. blau emittieren.
- Im Folgenden werden Ausführungsbeispiele der Erfindung unter Bezugnahme auf die beigefügten Zeichnungen näher erläutert. In diesen zeigen schematisch:
-
1A bis1E Darstellungen eines Ausführungsbeispiels eines Verfahren zur Herstellung einer Leiterplatte mit mehreren in die Leiterplatte integrierten LED-Halbleiterchips; -
2A bis2D Darstellungen eines Ausführungsbeispiels eines Verfahren zur Herstellung einer Leiterplatte mit mehreren in die Leiterplatte integrierten LED-Halbleiterchips und einer ersten elektrisch isolierenden Schicht mit Licht absorbierendem Material; -
3A bis3D Darstellungen eines Ausführungsbeispiels eines Verfahren zur Herstellung einer Leiterplatte mit mehreren in die Leiterplatte integrierten LED-Halbleiterchips und einer ersten elektrisch isolierenden Schicht mit Licht reflektierendem Material sowie einer darüber angeordneten weiteren Schicht mit Licht absorbierendem Material; -
4A bis4E Darstellungen eines Ausführungsbeispiels eines Verfahren zur Herstellung einer Leiterplatte mit mehreren in die Leiterplatte integrierten LED-Halbleiterchips und einer zusätzlichen Umverdrahtungslage; und -
5A und5B Darstellungen eines Ausführungsbeispiels einer Leiterplatte mit einer Pixel-Matrix. - In der folgenden ausführlichen Beschreibung wird auf die beigefügten Zeichnungen Bezug genommen, die einen Teil dieser Beschreibung bilden und in denen zur Veranschaulichung spezifische Ausführungsbeispiele gezeigt sind, in denen die Erfindung ausgeübt werden kann. Da Komponenten von Ausführungsbeispielen in einer Anzahl verschiedener Orientierungen positioniert werden können, dient die Richtungsterminologie zur Veranschaulichung und ist auf keinerlei Weise einschränkend. Es versteht sich, dass andere Ausführungsbeispiele benutzt und strukturelle oder logische Änderungen vorgenommen werden können, ohne von dem Schutzumfang abzuweichen. Es versteht sich, dass die Merkmale der hierin beschriebenen verschiedenen Ausführungsbeispiele miteinander kombiniert werden können, sofern nicht spezifisch anders angegeben. Die folgende ausführliche Beschreibung ist deshalb nicht in einschränkendem Sinne aufzufassen. In den Figuren sind identische oder ähnliche Elemente mit identischen Bezugszeichen versehen, soweit dies zweckmäßig ist.
-
1A bis1E zeigen schematisch ein Ausführungsbeispiel eines Verfahrens zur Herstellung einer Leiterplatte mit mindestens einem in die Leiterplatte integrierten optoelektronischen Bauelement.1E zeigt schematisch ein Ausführungsbeispiel einer mit dem Verfahren hergestellten Leiterplatte. - In
1A wird eine erste Metallschicht in Form einer Kupferfolie10 bereitgestellt. -
1B zeigt, dass mehrere optoelektronische Bauelemente auf der Kupferfolie10 platziert werden. In dem vorliegenden Ausführungsbeispiel werden drei LED-Halbleiterchips11 ,12 und13 auf der Kupferfolie10 mittels eines elektrisch nicht leitenden Klebstoffs15 fixiert. - Jeder der LED-Halbleiterchips
11 ,12 und13 hat eine erste Hauptoberfläche21 , eine der ersten Hauptoberfläche21 gegenüberliegende zweite Hauptoberfläche22 sowie vier Seitenflächen23 , welche die erste und die zweite Hauptoberfläche21 ,22 miteinander verbinden. Die LED-Halbleiterchips11 ,12 und13 sind Flip-Chip-Halbleiterchips, deren elektrische Kontaktelemente24 ausschließlich auf der ersten Hauptoberfläche21 angeordnet sind. Die erste Hauptoberfläche21 weist nach der Montage in Richtung der Kupferfolie10 . Der elektrisch nicht leitende Klebstoff15 befindet sich zwischen den elektrischen Kontaktelementen24 der LED-Halbleiterchips11 ,12 und13 und der Kupferfolie10 . - In dem vorliegenden Ausführungsbeispiel ist der LED-Halbleiterchip
11 dazu ausgebildet, grünes Licht zu emittieren. Die LED-Halbleiterchips12 und13 sind dazu ausgebildet, rotes bzw. blaues Licht zu emittieren. Die LED-Halbleiterchips11 ,12 und13 können als Oberflächenemitter ausgebildet sein, die Licht nur an der zweiten Hauptoberfläche22 emittieren, sie können aber auch Volumenemitter sein, die Licht an der zweiten Hauptoberfläche22 und zusätzlich an den Seitenflächen23 emittieren. In dem vorliegenden Ausführungsbeispiel sind die LED-Halbleiterchips11 ,12 und13 Saphir-Flip-Chips. - Die LED-Halbleiterchips
11 ,12 und13 werden mit einer ersten elektrisch isolierenden Schicht26 , die aus einem geeigneten Polymer besteht, und einer zweiten Metallschicht in Form einer Kupferfolie27 verpresst, wie in1C gezeigt ist. Die erste elektrisch isolierenden Schicht26 und die darüber angeordnete Kupferfolie27 werden unter Aufbringung von Druck und Wärme auf die LED-Halbleiterchips11 ,12 und13 gepresst. Nach diesem Schritt sind die zweiten Hauptoberflächen22 sowie die Seitenflächen23 der LED-Halbleiterchips11 ,12 und13 von der ersten elektrisch isolierenden Schicht26 bedeckt. - In
1D werden mehrere Aussparungen30 mit einem Laser in die Kupferfolien10 und27 sowie die erste elektrisch isolierende Schicht26 eingebracht. Dadurch werden die ersten und zweiten Hauptoberflächen21 und22 der LED-Halbleiterchips11 ,12 und13 freigelegt. Ferner wird die Kupferfolie27 im Bereich zwischen den LED-Halbleiterchips11 ,12 und13 entfernt. In dem vorliegenden Ausführungsbeispiel wird die erste elektrisch isolierende Schicht26 seitlich von den LED-Halbleiterchips11 ,12 und13 nicht entfernt. - Weiterhin werden mittels des Lasers Durchgangslöcher
31 seitlich neben den LED-Halbleiterchips11 ,12 und13 erzeugt, die sich vollständig durch die Kupferfolie10 , die erste elektrisch isolierende Schicht26 und die Kupferfolie27 erstrecken. - Schließlich wird, wie
1E zeigt, eine erste strukturierte Metallisierungsschicht32 auf den elektrischen Kontaktelementen24 der LED-Halbleiterchips11 ,12 und13 , den Kupferfolien10 und27 sowie in den Durchgangslöchern31 abgeschieden. Die erste strukturierte Metallisierungsschicht32 wird galvanisch erzeugt und kann aus einer oder mehreren Metallschichten, insbesondere aus Kupfer, bestehen. Durch das Abscheiden von Metall in den Durchgangslöchern31 werden Durchkontaktierungen erzeugt. -
1E zeigt die mit dem vorstehend beschriebenen Verfahren hergestellte Leiterplatte100 im Querschnitt. Die zweiten Hauptoberflächen22 der LED-Halbleiterchips11 ,12 und13 sind freigelegt, so dass eine Emission des erzeugten Lichts gegen Luft gegeben ist. - Durch die erste strukturierte Metallisierungsschicht
32 können externe Kontaktelemente an der Unter- und Oberseite der Leiterplatte100 gebildet werden, über welche die LED-Halbleiterchips11 ,12 und13 elektrisch von extern angesteuert werden können. - Das Herstellungsverfahren ermöglicht es, eine großflächige Leiterplatte
100 bzw. mehrere Leiterplatten100 gleichzeitig herzustellen. Falls erforderlich, können die Leiterplatten100 nach der Herstellung, beispielsweise durch Sägen, vereinzelt werden. -
2A bis2D zeigen schematisch ein weiteres Ausführungsbeispiel eines Verfahrens zur Herstellung einer Leiterplatte.2C zeigt die mit dem Verfahren hergestellte Leiterplatte200 im Querschnitt. - Das in
2A bis2D dargestellte Verfahren ist eine Weiterbildung des in1A bis1E dargestellten Verfahrens und daher teilweise identisch mit dem in1A bis1E dargestellten Verfahren. -
2A zeigt die mit der ersten elektrisch isolierenden Schicht26 sowie der Kupferfolie27 verpressten LED-Halbleiterchips11 ,12 und13 . Im Unterschied zu1C enthält die erste elektrisch isolierende Schicht26 in2A schwarzes bzw. Licht absorbierendes Material bzw. Füllstoff. Dieses Material kann beispielsweise aus Rußpartikeln bestehen. - In
2B ist gezeigt, dass mehrere Aussparungen30 mit einem Laser in die Kupferfolie10 sowie die erste elektrisch isolierende Schicht26 eingebracht werden. Die Kupferfolie27 wird entfernt. Genauso wie in1D werden die ersten und zweiten Hauptoberflächen21 und22 der LED-Halbleiterchips11 ,12 und13 freigelegt. Zusätzlich wird das Material der ersten elektrisch isolierenden Schicht26 nicht nur direkt oberhalb der LED-Halbleiterchips11 ,12 und13 abgetragen, sondern auch seitlich neben den LED-Halbleiterchips11 ,12 und13 , um Abschattungseffekte zu vermeiden. Folglich sind die Basisflächen der Aussparungen30 oberhalb der LED-Halbleiterchips11 ,12 und13 größer als die zweiten Hauptoberflächen22 der LED-Halbleiterchips11 ,12 und13 . - In
2C wird analog zum Ausführungsbeispiel gemäß1A bis1E die erste strukturierte Metallisierungsschicht32 abgeschieden. - In
2D ist ein Ausschnitt aus der fertiggestellten Leiterplatte200 vergrößert dargestellt, mit dem ein Maß verdeutlicht werden soll, um die Dimensionen der Aussparungen30 oberhalb der LED-Halbleiterchips11 ,12 und13 bestimmen zu können. In2D ist die Höhe der Aussparung30 mit h bezeichnet und die Breite des seitlich neben der Seitenfläche23 des LED-Halbleiterchips11 befindlichen Bereichs, in dem das Material der ersten elektrisch isolierenden Schicht26 zur Ausbildung der Aussparung30 entfernt wurde, ist mitz bezeichnet. Ferner ist in2D ein Lichtstrahl33 gezeigt, der die Ausbreitung von Licht angibt, das am äußersten Rand der zweiten Hauptoberfläche22 des LED-Halbleiterchips11 emittiert wird und gerade noch über die Oberkante der Aussparung30 in die Umgebung abgestrahlt wird. -
- Wenn ein kritischer Wert für den Winkel
α vorgegeben ist, können mit Hilfe von Gleichung (1) Werte für die Höheh und die Breitez bestimmt werden. Falls außerdem die Höhe h vorgeben ist, kann die Breitez direkt bestimmt werden. - Beispielsweise wird bei Videowand-Anwendungen üblicherweise ein Betrachtungswinkel von 150° gefordert. Dementsprechend beträgt für den Winkel
α der kritische Wert 15°. Mit diesem Wert und Gleichung (1) können Werte für die Höhe h bzw. die Breitez ermittelt werden. -
3A bis3D zeigen schematisch ein weiteres Ausführungsbeispiel eines Verfahrens zur Herstellung einer Leiterplatte.3D zeigt die mit dem Verfahren hergestellte Leiterplatte300 im Querschnitt. - Das in
3A bis3D dargestellte Verfahren ist eine Weiterbildung des in1A bis1E dargestellten Verfahrens. Im Folgenden werden nur die Unterschiede zu dem in1A bis1E dargestellten Verfahren beschrieben. -
3A zeigt die mit der ersten elektrisch isolierenden Schicht26 sowie der Kupferfolie27 verpressten LED-Halbleiterchips11 ,12 und13 . Im Unterschied zu1C enthält die erste elektrisch isolierende Schicht26 in2A weißes bzw. Licht reflektierendes Material bzw. Füllstoff. Dieses Material kann beispielsweise aus Titandioxid bestehen und dient dazu, das eigentlich die Seitenflächen23 der LED-Halbleiterchips11 ,12 und13 verlassende Licht zu reflektieren. - Wie in
3B gezeigt ist, wird, um einen hohen Kontrast zu realisieren, auf die Kupferfolie27 eine weitere Schicht35 auflaminiert, die schwarzes bzw. Licht absorbierendes Material, z. B. Rußpartikel, enthält. - Bei der in
3C dargestellten Laserbearbeitung wird auch die weitere Schicht35 mitstrukturiert, um die Aussparungen30 oberhalb der LED-Halbleiterchips11 ,12 und13 zu erzeugen. - In
3D wird die erste Metallisierungsschicht32 abgeschieden und strukturiert, wie bereits weiter oben beschrieben wurde. -
4A bis4E zeigen schematisch ein weiteres Ausführungsbeispiel eines Verfahrens zur Herstellung einer Leiterplatte, das eine Weiterbildung des in2A bis2D gezeigten Verfahrens darstellt.4E zeigt die mit dem Verfahren hergestellte Leiterplatte400 im Querschnitt. -
4A zeigt die mit der ersten elektrisch isolierenden Schicht26 sowie der Kupferfolie27 verpressten LED-Halbleiterchips11 ,12 und13 , wobei die erste elektrisch isolierende Schicht26 schwarzes bzw. Licht absorbierendes Material bzw. Füllstoff, z. B. Rußpartikel, enthält. - In
4B werden Aussparungen30 mit Hilfe eines Laserstrahls erzeugt, um die ersten Hauptoberflächen21 der LED-Halbleiterchips11 ,12 und13 freizulegen. - In
4C wird galvanisch die erste Metallisierungsschicht32 auf den ersten Hauptoberflächen21 der LED-Halbleiterchips11 ,12 und13 sowie der Kupferfolie10 erzeugt und strukturiert. - In
4D werden eine zweite elektrisch isolierende Schicht36 sowie eine weitere Kupferfolie37 auf die erste Metallisierungsschicht32 laminiert. Die zweite elektrisch isolierende Schicht36 kann wie die erste elektrisch isolierende Schicht26 schwarzes bzw. Licht absorbierendes Material bzw. Füllstoff enthalten. -
4E zeigt, dass mittels eines Laserstrahls Aussparungen30 in der ersten elektrisch isolierenden Schicht26 und außerdem Durchgangslöcher in der zweiten elektrisch isolierenden Schicht36 erzeugt werden. Ferner wird eine zweite Metallisierungsschicht38 , beispielsweise aus Kupfer, auf die zweite elektrisch isolierende Schicht36 aufgebracht und strukturiert. Die zweite Metallisierungsschicht38 erstreckt sich in die Durchgangslöcher in der zweiten elektrisch isolierenden Schicht36 , wodurch Durchkontaktierungen39 geschaffen werden, welche die erste und die zweite strukturierte Metallisierungsschicht32 und38 elektrisch miteinander verbinden. - Durch die zweite elektrisch isolierende Schicht
36 , die zweite strukturierte Metallisierungsschicht38 und eventuell weitere derartige Schichten kann ein Fan-Out-Bereich geschaffen werden, der es ermöglicht, externe Kontaktelemente40 der Leiterplatte400 außerhalb der Umrisse der LED-Halbleiterchips11 ,12 und13 anzuordnen. Die Abstände benachbarter externer Kontaktelemente40 können mindestens 250 µm betragen, um für Standardlötprozesse geeignet zu sein. -
5A und5B zeigen eine Leiterplatte500 im Querschnitt bzw. in einer Draufsicht. Die Leiterplatte500 kann in einem Display eingesetzt werden. - Die Leiterplatte
500 enthält eine Pixel-Matrix mit einer Vielzahl von Pixeln50 . Jedes der Pixel50 umfasst drei Subpixel, wobei die Subpixel jeweils aus den LED-Halbleiterchips11 ,12 bzw.13 gebildet werden, die Licht mit den Farben rot, grün bzw. blau emittieren. - Die Leiterplatte
500 kann mit dem in2A bis2D dargestellten Verfahren hergestellt werden. - Bezugszeichenliste
-
- 10
- Kupferfolie
- 11
- LED-Halbleiterchip
- 12
- LED-Halbleiterchip
- 13
- LED-Halbleiterchip
- 15
- Klebstoff
- 21
- erste Hauptoberfläche
- 22
- zweite Hauptoberfläche
- 23
- Seitenfläche
- 24
- Kontaktelement
- 26
- erste elektrisch isolierende Schicht
- 27
- Kupferfolie
- 30
- Aussparung
- 31
- Durchgangsloch
- 32
- erste strukturierte Metallisierungsschicht
- 33
- Lichtstrahl
- 35
- Schicht
- 36
- zweite elektrisch isolierende Schicht
- 37
- Kupferfolie
- 38
- zweite strukturierte Metallisierungsschicht
- 39
- Durchkontaktierung
- 40
- Kontaktelement
- 50
- Pixel
- 100
- Leiterplatte
- 200
- Leiterplatte
- 300
- Leiterplatte
- 400
- Leiterplatte
- 500
- Leiterplatte
Claims (18)
- Verfahren zur Herstellung einer Leiterplatte (100-500) mit mindestens einem in die Leiterplatte (100-500) integrierten optoelektronischen Bauelement (11-13), mit folgenden Schritten: Anordnen mindestens eines optoelektronischen Bauelements (11-13) auf einer ersten Metallschicht (10), Pressen einer ersten elektrisch isolierenden Schicht (26) auf das mindestens eine optoelektronische Bauelement (11-13), und Erzeugen von mindestens einer Aussparung (30) in der ersten Metallschicht (10) und/oder der ersten elektrisch isolierenden Schicht (26), wodurch das mindestens eine optoelektronische Bauelement (11-13) zumindest teilweise freigelegt wird.
- Verfahren nach
Anspruch 1 , wobei durch das Erzeugen der mindestens einen Aussparung (30) eine Oberfläche (22) des mindestens einen optoelektronischen Bauelements (11-13) zumindest teilweise freigelegt wird, durch die von dem mindestens einen optoelektronischen Bauelement (11-13) erzeugtes Licht austritt. - Verfahren nach
Anspruch 1 oder2 , wobei zusammen mit der ersten elektrisch isolierenden Schicht (26) eine zweite Metallschicht (27) auf das mindestens eine optoelektronische Bauelement (11-13) gepresst wird. - Verfahren nach einem der vorhergehenden Ansprüche, wobei das mindestens eine optoelektronische Bauelement (11-13) eine erste Hauptoberfläche (21) und eine der ersten Hauptoberfläche (21) gegenüberliegende zweite Hauptoberfläche (22) aufweist, wobei das mindestens eine optoelektronische Bauelement (11-13) mit seiner ersten Hauptoberfläche (21) auf der ersten Metallschicht (10) angeordnet wird und von dem mindestens einen optoelektronischen Bauelement (11-13) erzeugtes Licht an der zweiten Hauptoberfläche (22) austritt.
- Verfahren nach
Anspruch 4 , wobei durch das Erzeugen der mindestens einen Aussparung (30) die zweite Hauptoberfläche (22) des mindestens einen optoelektronischen Bauelements (11-13) zumindest teilweise freigelegt wird und ferner Material der ersten elektrisch isolierenden Schicht (26), das sich seitlich von der zweiten Hauptoberfläche (22) befindet, entfernt wird. - Verfahren nach einem der vorhergehenden Ansprüche, wobei die erste elektrisch isolierende Schicht (26) Licht absorbierendes Material aufweist.
- Verfahren nach einem der
Ansprüche 1 bis5 , wobei die erste elektrisch isolierende Schicht (26) Licht reflektierendes Material aufweist. - Verfahren nach
Anspruch 7 , wobei eine weitere Schicht (35), die Licht absorbierendes Material aufweist, auf die erste elektrisch isolierende Schicht (26) aufgebracht wird. - Verfahren nach einem der vorhergehenden Ansprüche, wobei eine erste strukturierte Metallisierungsschicht (32) auf das mindestens eine optoelektronische Bauelement (11-13), die erste Metallschicht (10) und/oder die erste elektrisch isolierende Schicht (26) aufgebracht wird.
- Verfahren nach
Anspruch 9 , wobei eine zweite elektrisch isolierende Schicht (36) auf die erste strukturierte Metallisierungsschicht (32) aufgebracht wird und eine zweite strukturierte Metallisierungsschicht (38) auf die zweite elektrisch isolierende Schicht (36) aufgebracht wird, wobei Durchkontaktierungen (39) in der zweiten elektrisch isolierenden Schicht (36) die erste strukturierte Metallisierungsschicht (32) mit der zweiten strukturierten Metallisierungsschicht (38) elektrisch verbinden. - Leiterplatte (100-500) umfassend: eine erste elektrisch isolierende Schicht (26), mindestens ein in die erste elektrisch isolierende Schicht (26) integriertes optoelektronisches Bauelement (11-13), eine erste strukturierte Metallisierungsschicht (32), die sich auf der ersten elektrisch isolierenden Schicht (26) und dem mindestens einen optoelektronischen Bauelement (11-13) erstreckt, und mindestens eine Aussparung (30) in der ersten elektrisch isolierenden Schicht (26), durch die das mindestens eine optoelektronische Bauelement (11-13) zumindest teilweise freigelegt ist.
- Leiterplatte (100-500) nach
Anspruch 11 , wobei die mindestens eine Aussparung (30) eine Oberfläche (22) des mindestens einen optoelektronischen Bauelements (11-13) zumindest teilweise freilegt, durch die von dem mindestens einen optoelektronischen Bauelement (11-13) erzeugtes Licht austritt. - Leiterplatte (200, 400, 500) nach
Anspruch 12 , wobei die mindestens eine Aussparung (30) größer ist als die Oberfläche (22) des mindestens einen optoelektronischen Bauelements (11-13), durch die das von dem mindestens einen optoelektronischen Bauelement (11-13) erzeugte Licht austritt. - Leiterplatte (200, 400, 500) nach einem der
Ansprüche 11 bis13 , wobei die erste elektrisch isolierende Schicht (26) Licht absorbierendes Material aufweist. - Leiterplatte (300) nach einem der
Ansprüche 11 bis13 , wobei die erste elektrisch isolierende Schicht (26) Licht reflektierendes Material aufweist. - Leiterplatte (300) nach
Anspruch 15 , wobei eine weitere Schicht (35), die Licht absorbierendes Material aufweist, auf die erste elektrisch isolierende Schicht (26) aufgebracht ist. - Leiterplatte (400) nach einem der
Ansprüche 11 bis16 , wobei eine zweite elektrisch isolierende Schicht (36) auf die erste strukturierte Metallisierungsschicht (32) aufgebracht ist und eine zweite strukturierte Metallisierungsschicht (38) auf die zweite elektrisch isolierende Schicht (36) aufgebracht ist, wobei Durchkontaktierungen (39) in der zweiten elektrisch isolierenden Schicht (36) die erste strukturierte Metallisierungsschicht (32) mit der zweiten strukturierten Metallisierungsschicht (38) elektrisch verbinden. - Display mit einer oder mehreren Leiterplatten (100-500) nach einem der
Ansprüche 11 bis17 .
Priority Applications (3)
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US17/270,732 US20210217941A1 (en) | 2018-08-23 | 2019-08-13 | Printed Circuit Board and Method of Manufacturing a Printed Circuit Board with at Least One Optoelectronic Component Integrated into the Printed Circuit Board |
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Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20150380602A1 (en) * | 2013-02-22 | 2015-12-31 | Osram Opto Semiconductore Gmbh | Method of producing optoelectronic components and optoelectronic components |
US20180053882A1 (en) * | 2016-08-17 | 2018-02-22 | Epistar Corporation | Light-emitting device and manufacturing method thereof |
US20180076364A1 (en) * | 2013-03-28 | 2018-03-15 | Toshiba Hokuto Electronics Corporation | Light-emitting device with improved flexural resistance and electrical connection between layers, production method therefor, and device using light-emitting device |
Family Cites Families (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7683393B2 (en) * | 2004-12-07 | 2010-03-23 | Ngk Spark Plug Co., Ltd. | Wiring substrate for mounting light emitting element |
DE102008049188A1 (de) * | 2008-09-26 | 2010-04-01 | Osram Opto Semiconductors Gmbh | Optoelektronisches Modul mit einem Trägersubstrat und einer Mehrzahl von strahlungsemittierenden Halbleiterbauelementen und Verfahren zu dessen Herstellung |
US8338231B2 (en) * | 2010-03-29 | 2012-12-25 | Infineon Technologies Ag | Encapsulated semiconductor chip with external contact pads and manufacturing method thereof |
US20120061700A1 (en) * | 2010-09-09 | 2012-03-15 | Andreas Eder | Method and system for providing a reliable light emitting diode semiconductor device |
JP6724634B2 (ja) * | 2016-07-28 | 2020-07-15 | 日亜化学工業株式会社 | 発光装置の製造方法 |
EP3439440B1 (de) * | 2017-08-04 | 2024-03-20 | AT & S Austria Technologie & Systemtechnik Aktiengesellschaft | In einem komponententräger eingebettete komponente mit exponierter seitenwand |
-
2018
- 2018-08-23 DE DE102018120637.2A patent/DE102018120637A1/de not_active Ceased
-
2019
- 2019-08-13 US US17/270,732 patent/US20210217941A1/en not_active Abandoned
- 2019-08-13 WO PCT/EP2019/071714 patent/WO2020038777A1/de active Application Filing
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20150380602A1 (en) * | 2013-02-22 | 2015-12-31 | Osram Opto Semiconductore Gmbh | Method of producing optoelectronic components and optoelectronic components |
US20180076364A1 (en) * | 2013-03-28 | 2018-03-15 | Toshiba Hokuto Electronics Corporation | Light-emitting device with improved flexural resistance and electrical connection between layers, production method therefor, and device using light-emitting device |
US20180053882A1 (en) * | 2016-08-17 | 2018-02-22 | Epistar Corporation | Light-emitting device and manufacturing method thereof |
Also Published As
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