CS272940B1 - Circuit connection for backing store blocking - Google Patents

Description

(57) Řešení ee týká zapojení obvodu pro blokování zálohované paměti. Podstata spočívá především v tom, že báze tranzistoru je spojena se středem odporového děliče, jehož první krajní vývod je spojen se společnou svorkou. Přitom kolektor tranzistoru je spojen s uvolňovacím vstupem zálohované paměti a emitor je spojen s ovládacím vstupem.

272	940
(11) ,
(13)	Bl
(51)	Int. Cl.5 H 04 K 3/00

CS 272 940 Bl

Vynález se týká zapojení obvodu pro blokováni zálohované paměti, vhodného zejména pro řídící mikroprocesorové systémy.

U řídících mikroprocesorových systémů se často vyskytuje potřeba zachovat alespoň část obsahu paměti i při vypnutí napájení systému. Pro tento účel mají paměťové obvody napájecí napětí zálohované např. akumulátorem nebo galvanickým článkem. Při vypnutí napájení systému, stejně jako nějakou dobu po jeho zapnutí, se však systém může chovat zcela nedefinovaně, proto je třeba v této době zálohovanou paměť zablokovat, aby nedošlo k přepsání jejího obsahu. 3e běžně známé zapojení obvodu pro blokování zálohované paměti, kde uvolňovací vstup zálohované pamětí je spojen s kolektorem tranzistoru, jehož emitor je spojen s ovládacím vstupem a jehož báze je spojena s výstupem kontrolního obvodu. Kontrolní obvod (např. Texas Instruments TL7705A) bývá vzhledem ke své spotřebě napájen z nezálohovaného napájecího zdroje.

Toto uspořádání má však nevýhodu, že i sám kontrolní obvod se při poklesu svého napájecího napětí pod určitou úroveň chová nedefinovaně. Často doporučované napájení kontrolního obvodu přes diodu spolu se zablokováním jeho napájení kondenzátorem řeší problém jen při dostatečně rychlém poklesu napájecího napětí při vypnutí, navíc zhoršuje situaci při zapnutí napájení.

Uvedené nevýhody jsou podle nového řešení odstraněny zapojením obvodu pro blokování zálohované paměti, jehož podstata spočívá v tom, že báze tranzistoru je spojena se středem odporového děliče, jehož první krajní vývod je spojen se společnou svorkou. Přitom kolektor tranzistoru je spojen s uvolňovacím vstupem.zálohované paměti a emitor je spojen s ovládacím vstupem.

Výhodou zapojení obvodu pro blokování zálohované paměti podle nového řešení je, že jednoduchým způsobem řeší problém nedefinovaného chování kontrolního obvodu při nízkém napájecím napětí a spolehlivě pracuje při libovolném průběhu nárůstu a poklesu napájecího napětí.

Další výhody a význaky nového řešení jsou patrny z výkresu, který schematicky znázorňuje příkladné provedení zapojení obvodu pro blokování zálohované paměti a z následujícího popisu funkce.

Na výkresu je uvolňovací vstup 21 zálohované paměti 2 spojené se zálohovanou napáječi svorkou 5. spojen jednak přes odpor £ se zálohovanou napájecí svorkou £, jednak s kolektorem tranzistoru £, jehož emitor je spojen s ovládacím vstupem £ a báze je spojena se středem 63 odporového děliče £ tvořeného prvním odporem 68 a druhým odporem 69. První krajní vývod 61 odporového děliče £ je spojen se společnou svorkou £ a druhý krajní vývod 62 je spojen jednak s výstupem 54 kontrolního obvodu £, jednak přes pomocný odpor 55 s nezálohovanou napájecí svorkou £. Napájecí svorka 52 a vstupní svorka 53 kontrolního obvodu £ jsou spojeny s nezálohovanou napájecí svorkou £. Společná svorka 51 kontrolního obvodu £ je spojena se společnou svorkou 7_.

Zapojení obvodu pro blokování zálohované paměti pracuje v závislosti na napájecím napětí. Pokud má napětí na nezálohované napájecí svorce £ jmenovitou hodnotu, je výstup 54 kontrolního obvodu £ rozpojen a ze středu £3 odporového děliče £ je na bázi tranzistoru £ přivedeno takové napětí, že signál prochází ze vstupní svorky £ na uvolňovací vstup 21 zálohované paměti £. Když napětí na nezálohované napájecí svorce £ poklesne na hodnotu, na kterou je nastaven kontrolní obvod £, sepne jeho výstup 54 a na středu £3 odporového děliče.

£ je téměř nulové napětí. Tranzistor £ se proto nemůže otevřít. Přes odpor £ je na uvolňovací vstup 21 zálohované paměti £ přivedena logická úroveň H a tím je zabráněno jakékoliv ’ komunikaci se zálohovanou pamětí 2. Při dalším poklesu napětí na nezálohované napájecí svorce £ se kontrolní obvod £ dostane do nedefinovaného stavu a jeho výstup 54 může rozepnout. Napětí na druhém krajním vývodu 62 odporového děliče £ je však již tak nízké, že napětí přivedené ze středu 63 odporového děliče £ na bázi tranzistoru £ nestačí k jeho otevl ření a zálohovaná pamět 2 zůstane zablokována. Stejným způsobem je pomocí odporového děliče

CS 272 940 Bl zálohovaná paměť Ϊ. blokována při nárůstu napájecího napětí do té doby, než napájecí napětí dosáhne hodnoty dostatečné pro správnou činnost kontrolního obvodu 2·

- Pokud je výstup 54 kontrolního obvodu 5_ typu s tzv. otevřeným kolektorem a pokud není třeba napájet z něj další obvody, lze s výhodou použít jiné varianty zapojení obvodu pro blokování zálohované paměti podle vynálezu, kde druhý krajný vývod 62 odporového děliče 6_ je spojen s nezálohovanou napájecí svorkou 8. a výstup 54 kontrolního obvodu 2 je spojen se středem 63 odporového děliče 6.·

Zapojení obvodu pro blokování zálohované paměti podle tohoto řešení je využitelné zejména v oboru mikroprocesorových řídících systémů.

Claims (3)

1. PŘEDMĚT VYNÁLEZU

   1. Zapojení obvodu pro blokování zálohované paměti, kde uvolňovací vstup zálohované paměti je spojen s kolektorem tranzistoru, jehož emitor je spojen s ovládacím vstupem, vyznačené tím, že báze tranzistoru (3) je spojena se středem (63) odporového děliče (6), jehož první krajní vývod (61) je spojen se společnou svorkou (7).
2. 2. Zapojení obvodu pro blokování zálohované paměti podle bodu 1, vyznačené tím, že druhý krajní vývod (62) odporového děliče (6) je spojen s výstupem (54) kontrolního obvodu (5).
3. 3. 'Zapojení obvodu pro blokování zálohované paměti podle bodu 1, vyznačené tím, že druhý krajní vývod (62) odporového děliče (6) je spojen s nezálohovanou napájecí svorkou (8) a výstup (54) kontrolního obvodu (5) je spojen se středem (63) odporového děliče (6).