CS270460B1 - Zapojení vysilače přenosového systému binárních informaci - Google Patents

Abstract

Zapojeni sestává ze zdroje hodinových impulsů, desítkového a dvojkového čítače, převodníků, invertorů, logických členů a diodového kodéru. Zdroj hodinových impulsů je epojen s desítkovým čítačem spojeným s prvním převodníkem, který je spojen s dvojkovým čítačem a s prvním a druhým invertorem. Dvojkový čitač je epojen s druhým převodníkem, připojeným přes přizpůsobovací Invertory, svodové rezistory, pracovní logické členy a pracovní invertory k diodovému kodéru. První a druhý invertor jsou spojeny přes logické členy a rezistory s tranzistory napojenými na přenosové výstupy a napájecí svorky. Svodové rezistory jsou spojeny se vstupy binární informace.

Description

Vynález ee týká zapojení vysílače přenosového systému binárních informací, obsahujícího zdroj hodinových impulsů, desítkový a dvojkový čítač, převodníky, invertory, logické členy a diodový kodér.

Přenosové systémy současné konstrukce Jsou řešeny na bázi mikroprocesorů. V nepříznivém prostředí důlních provozů však bývají tyto systémy často poruchové. Jejich případné opravy může provádět jen vysoce kvalifikovaný pracovník. Pořizovací cena Je vysoká.

Uvedené nedostatky odstraňuje zapojení vysílač· přenosového systému binárních informací podle vynálezu, obsahující zdroj hodinových impulsů, desítkový a dvojkový čítač, převodníky, Invertory, logické členy a diodový kodér. Podstata vynálezu spočívá v lom, že výstup zdroje hodinových Impulsů Je spojen se vstupem desítkového čítače, jehož první výstup je napojen na první vstup prvního převodníku. Druhý vstup prvního převodníku Je propojen a druhým výstupem desítkového čítače, jehož třetí výstup je spojen se třetím vstupem prvního převodníku, čtvrtý výstup desítkového čítače Je spojen se čtvrtým vstupem prvního převodníku, Jehož první výstup je propojen se vstupem dvojkového čítače. První výstup dvojkového čítače Je spojen s prvním vstupem druhého převodníku, jehož druhý vstup je spojen s druhým výstupem dvojkového čítače. Třetí výstup dvojkového čítače Je spojen se třetím vstupem druhého převodníku a čtvrtý výstup dvojkového čítače Je propojen se čtvrtým vetupem druhého převodníku, jehož první až n-tý výstup Je spojen vždy se vstupem odpovídajícího prvního až n-tého přizpůsobovacího invertoru. Výstupy přizpůsobovacích Invertorů Jsou spojeny vždy s prvním vstupem odpovídajícího prvního až n-tého pracovního logického Sienu. Druhé vstupy pracovních logických členů Jsou napojeny na příslušný první až n-tý svodový rezistor a na první až n-tý vstup binární informace. Výstupy prvního až n-tého pracovního logického členu Jsou napojeny vždy na vstup příslušného prvního až n-tého pracovního invertoru. Výstupy pracovních invertorů jsou napojeny na odpovídající první až n-tý vstup diodového kodéru. Druhý výstup prvního převodníku je spojen se vstupem prvního invertoru a třetí výstup prvního převodníku J· spojen se vstupem druhého invertoru, Jehož výstup je propojen s prvním vstupem třetího logického členu a s prvním vstupem čtvrtého logického Členu. Druhý vstup čtvrtého logického členu je napojen na první výstup diodového kodéru a současně na první vývod prvního zatěžovacího rezlstoru. Výstup čtvrtého logického členu je spojen se vstupem čtvrtého invertoru, Jehož výstup je přes čtvrtý srážecí rezistor a druhou Zenerovu diodu připojen k bázi čtvrtého tranzistoru. Emitor čtvrtého tranzistoru Je napojen na druhou napájecí svorku a Jeho kolektor je spojen s prvním přenosovým výstupem. Druhý vstup třetího logického členu je propojen s druhým výstupem diodového kodéru a současně s prvním vývodem druhého zatěžovacího rezlstoru. Výstup třetího logického členu je spojen se vstupem třetího Invertoru, Jehož výstup Je přes třetí srážecí rezistor a první Zenerovu diodu napojen na bázi třetího tranzistoru, Jehož emitor Je spojen a druhou napájecí svorkou. Kolektor třetího tranzistoru Je připojen na druhý přenosový výstup. Výstup prvního invertoru Je spojen s prvním vstupem prvního logického členu a současně s prvním vstupem druhého logického členu, Jehož druhý výstup Je napojen na třetí výstup diodového kodéru a na první vývod třetího zatěžovacího rezlstoru. Výstup druhého logického členu Je přes druhý srážecí rezistor spojen s bází druhého tranzistoru, jehož emitor je spojen s první napájecí svorkou a jehož kolektor je připojen na druhý přenosový výstup. První přenosový výstup Je spojen s kolektorem prvního tranzistoru, Jehož emitor Je napojen na první napájecí svorku a Jehož báze Je přes první srážecí rezistor spojena s výstupem prvního logického členu. Druhý vstup prvního logického členu Je připojen ke čtvrtému výstupu diodového kodéru a současně k jednomu z vývodů čtvrtého zatěžovacího rezlstoru.

Přenosový systém se zapojením vysílače podle vynálezu lze napojit na běžné telefonní linky bez požadavku odstínění kabelů a je Imunní k cizímu rušení a nedochází ani k rušení ostatních přenosových linek v kabelech. Přenosový systém pracuje spolehlivě, má nízkou pořizovací cenu použitých součástí, malé výrobní náklady, je snadno opravitelný a jeho obsluha je velmi Jednoduchá.

Na připojeném' výkresu je zobrazen příklad zapojení vysílače přenosového systému binárních informací podle vynálezu.

CŠ 27o46o Bl

Zapojení vysílače přenosového systému binárních informací obsahuje zdroj χ hodinových impulsu, jehož výstup 1,1 je spojen se vstupem 2,1 desítkového čítačs 2^ jehož první výstup 2,2 je napojen na první vstup 3,2 prvního převodníku ,3. Druhý vstup 3,3 prvního převodníku 3 je propojen s druhým výstupem 2,3 desítkového čítače 2, Jehož třetí výstup 2,4 je spojen se třetím vstupem 3,4 prvního převodníku 3. čtvrtý výstup 2,5 desítkového čítače 2 je spojen se čtvrtým vstupem 3,5 prvního převodníku 3, jehož první výstup 3,1 Je propojen se vstupem 4,1 dvojkového čítače 4, První výstup 4,2 dvojkového čítače 4 Je spojen s prvním vstupem 5,1 druhého převodníku 5, jehož druhý vstup 5,2 je spojen s druhým výstupem 4,3 dvojkového čítače 4, jehož třetí výstup 4,4 je spojen ee třetím vstupem 5,3 druhého převodníku 5. Čtvrtý výstup 4,5 dvojkového čítače 4_ je spojen se čtvrtým vstupem 5,4 druhého převodníku 5, Jehož první až n-tý výetup 5,5,1 a 5,5,n je spojen vždy se vstupem 6,1,1 až 6,n,l odpovídajícího prvního až n-tého přizpůsobovacího invertoru 6,1 až 6,n. První výstupy 6,1,2 až 6,n,2 prvního až n-tého přizpůsobovacího invertoru 6,1 až 6,n Jsou spojeny vždy s prvním vstupem 8,1,1 až β,η,ι odpovídajícího prvního až n-tého pracovního logického členu 8,1 až 8,n, jejichž druhé vstupy 8,1,2 až 8,n,2 jsou napojeny na příslušný první až n-tý svodový rezistor 7,1 až 7,n a na první až n-tý vstup A.1 až A.n binární informace. Výstupy 8.1.3 až 8.n.3 prvního až n-tého pracovního logického členu 8,1 až 8,n Jsou napojeny vždy na vstup 9,1,1 až 9,n,l příslušného prvního až n-tého pracovního invertoru 9,1 až 9,n. jejichž výstupy 9,1,2 až 9,n,2 Jsou napojeny na odpovídající první až n-tý vstup lo,5.1 až lo,n,5 diodového kodéru lo. Druhý výstup 3,6 prvního převodníku 3 Je spojen se vstupem 12,1 prvního invertoru 12. Třetí výetup 3,7 prvního převodníku χ je spojen se vstupem 13,1 druhého Invertoru 13, Jehož výstup 13,2 Js propojen s prvním vstupem 16,1 třetího logického členu 16 a s prvním vstupem 17,1 čtvrtého logického členu 17, Druhý vstup 17,2 čtvrtého logického členu 17 Je napojen na první výstup lo.l diodového kodéru lo a současné na první vývod prvního zatéžovacího registru 11,1, Výstup 17,3 čtvrtého logického členu 17 Je spojen se vstupem 19,1 čtvrtého invertoru 19, jehož výstup 19,2 je přes čtvrtý srážecí rezistor 23 a druhou Zenerovu diodu 25 připojen k bázi čtvrtého tranzistoru 29, Emltor čtvrtého tranzistoru 29 Je napojen na druhou napájecí svorku F. Kolektor čtvrtého tranzistoru 29 Je spojen s prvním přenosovým výstupem B. Druhý vstup 16,2 třetího logického členu 16 je propojen s druhým výstupem 10.2 diodového kodéru lo a současné s prvním vývodem druhého zatéžovacího rezistoru 11.2. Výstup 16.3 třstího logického členu 16 je spojen se vstupem 18.1 třetího invertoru 18, jehož výstup 18.2 Je přes třetí srážecí rezistor 22 a první Zenerovu diodu 24 napojen na bázi třetího tranzistoru 28. Emltor třetího tranzistoru 28 Je spojen s druhou napájecí svorkou F. Kolektor třetího tranzistoru 28 Je připojen na druhý přenosový výstup C. Výstup 12,2 prvního invertoru 12 Je propojen s prvním vstupem 14.1 prvního logického členu 14 a současné s prvním vstupem 15.1 druhého logického členu 15, jehož druhý vstup 15.2 je napojen na třetí výstup lo.3 diodového kodéru lo a na první vývod třetího zatéžovacího rezistoru 11,3, Výstup 15.3 druhého logického členu 15 Je přes druhý srážecí rezistor 21 spojen s bází druhého tranzistoru 27, Jehož emitor je spojen e první napájecí svorkou E a kolektor druhého tranzistoru 27 Je připojen na druhý přenosový výstup C. První přenosový výstup B je spojen s kolektorem prvního tranzistoru 26, Jehož emitor je napojen na první napájecí svorku E a jehož báze je přes první srážecí rezistor 2o spojena s výstupem 14,3 prvního logického členu 14. Druhý vstup 14.2 prvního logického členu 14 Je připojen ke čtvrtému výstupu 10,4 diodového kodéru lo a současné k Jednomu z vývodů čtvrtého zatéžovacího rezistoru 11,4. Zapojení Je opatřeno uzemňovací svorkou D.

Signál ze zdroje _1 hodinových impulsů js přiváděn na vstup 2,1 desítkového čítače 2. Výstupní BCD kód z desítkového čítače 2 je převeden prvním převodníkem 3 na kód jedna z deseti. Z prvního výstupu 3,1 prvního převodníku .3 Je signál veden do dvojkového čítače 4 a dále do druhého převodníku 5 jedna ze šestnácti, kde je dekódován. Pro potřebu dvouvstupého prvního až n-tého pracovního logického členu 8.1 až 8,n Je signál z dvojkového čítače 4 invertován prvním až n—tým přizpůsobovacím invertorem 6.1 až 6.n, Do druhého vstupu 8.1,2 až 8,n,2 prvního až n-tého pracovního logického členu 8,1 až 841 Je vedena binární informace Jako logická 1 z prvního až n-tého vstupu A.1 až Α,η, První až n-tý svodový rezistor 7,1 až 7,n

CS 27o46o Bl slouží pro zajištění správně činnosti prvního až n-tého pracovního logického členu 8.1 až 8,n, Informace z prvního až n-tého pracovního logického členu 8.1 až 8.n je invertována prvním až n-tým pracovním Invertorem 9.1 až 9.n pro potřebu diodového kodéru lo, složeného z běžných diod. Odtud je kód veden na první až čtvrtý logický člen 14 až 17, do kterých je současně veden Invertovaný signál z prvního Invertoru 12 a druhého Invertoru 13, přiváděný do nich z prvního převodníku 3. První až čtvrtý zaiěžovací rezistor 11.1 až 11.4 slouží k zajištění činnosti prvního až čtvrtého logického členu 14 až 17. Výstupní signál prvního logického Elenu 14 je veden do prvního tranzistoru 26 a výstupní signál druhého logického Sienu 15 js veden do druhého tranzistoru 27, První tranzistor 26 a druhý tranzistor 27 jsou typu PNP a Jsou napájeny kladným napětím do emitoru z první napájecí svorky E a zapojeny na první přenosový výstup B a druhý přenosový výstup C . Výstupní signály z třetího logického členu 16 a čtvrtého logického členu 17 jsou Invertovány třetím Invertorem 18 a čtvrtým Invertorem 19 a přes třetí srážecí rezistor 22 a čtvrtý srážecí rezistor 23 a první Zenerovu diodu 24 a druhou Zenerovu diodu 25 vedeny do třetího tranzistoru 28 a čtvrtého tranzistoru 29 typu PNP. Třetí tranzistor 28 a čtvrtý tranzistor 29 Jsou napájeny záporným napětím do emltorů z druhé napájecí svorky F a zapojeny do prvního přenosového vstupu B a druhého přenosového výstupu C.

Přenosový systém, jehož součástí je zapojení vysílače podle vynálezu se v důlním provozu využívá k signalizaci a k ovládání servošoupat, trolejí, separátního větrání a čerpacích stanic.

Claims (1)

1. Zapojení vysílače přenosového systému binárních informací, vyznačující se tím, že výstup (1,1) zdroje (1) hodinových Impulsů Je spojen se vstupem (2.1) desítkového čítače (2), jehož první výstup (2.2) Je napojen na první vstup (3,2) prvního převodníku (3), Jehož druhý vstup (3.3) je propojen s druhým výstupem (2.3) desítkového čítače (2), jehož třetí výstup (2.4) je spojen se třetím vstupem (3.4) a Jehož čtvrtý výstup (2.6) Jo spojen se čtvrtým vstupem (3.5) prvního převodníku (3), jehož první výstup (3.1) Jo propojen se vstupem (4.1) dvojkového čítače (4), jehož první výstup (4.2) Jo spojen s prvním vstupem (5.1) druhého převodníku (5), jehož druhý vstup (5.2) je spojen s druhým výstupem (4.3) dvojkového čítače (4), Jehož třetí výstup (4.4) Je spojen se třetím vstupem (5.3) a jehož čtvrtý výstup (4.5) je spojen se čtvrtým vstupem (5.4) druhého převodníku (s), Jehož první až n-tý výstup (s.5,1 až 5.8.n) Jo spojen vždy ee vstupem (6.1.1 až G.n.l) prvního až n-tého přizpůsobovacího Invertoru (6.1 až 6.n), jejichž výstupy (6,1,2 až 6,n,2) Jsou spojony vždy a prvním vstupem (0.1.1 až B.n.l) odpovídajícího prvního až n-tého pracovního logického členu (θ.1 až O.n), Jejichž druhé vstupy (n.1.2 až H.n.2) Jsou napojeny na příslušný první až n-tý svodový rezistor (7,1 až 7,n) a na první až n-tý vstup (AI až An) binární informace, a jejichž výstupy (8,1,3 až 8.n.3) jsou napojeny vždy na vstup (9,1.1 až 9,n.l) příslušného prvního až n-tého pracovního Invertoru (9,1 až 9,n), Jejichž výstupy (9.1.2 až 9.n.2) jsou napojeny na odpovídající první až n-tý vstup (10,5.1 až lo. 5.n) diodového kodéru (lo), přičemž druhý výstup (3.6) prvního převodníku (3) Je spojen se vstupem (12.1) prvního invertoru (12) a třetí výstup (3.7) prvního převodníku (3) Je spojen se vstupem (13.1) druhého invertoru (13), Jehož výstup (13.2) Je propojen s prvním vstupem (16.1) třetího logického členu (16) as prvním vstupem (17.1) čtvrtého logického členu (17), Jehož druhý vstup (17.2) Je napojen na první výstup (lo.l) diodového kodéru (lo) a současně na první vývod prvního zatěžovacího rezistoru (11.1), kdežto výstup (17.3) čtvrtého logického členu (17) Je spojen se vstupem (19.1) čtvrtého Invertoru (19), Jehož výstup (19.2) Je přes čtvrtý srážecí rezistor (23) a druhou Zenerovu diodu (25) připojen k bázi čtvrtého tranzistoru (29), jehož emitor Je napojen na druhou napájecí svorku (f) a Jehož kolektor je spojen s prvním přenosovým výstupem (b), zatímco druhý vstup (16.2) třetího ibgického členu (16) Je propojen s druhým výstupem (10.2) diodového kodéru (lo) a současně s prvním vývodem druhého zatěžo4

   CS 27o46o Bl vacího režie toru (11.2) a svým výstupem (16.3) je třetí logický Sien (16) spojen se vstupem (18.1) třetího invertoru (18). jehož výstup (18.2) js přes třetí srážecí rezistor (22) a první Zenerovu diodu (24) napojen na bázi třetího tranzistoru (28), jehož emltor js spojen s druhou napájecí svorkou (F) a jehož kolektor je připojen na druhý přenosový výstup (c), přičemž výstup (12.2) prvního invertoru (12) je spojen s prvním vstupem (14.1) prvního logického členu (14) a současné s prvním vstupem (15.1) druhého logického členu (15), jehož druhý vstup (15.2) je napojen ná třetí výstup (lo.3) diodového kodéru (lo) a na první vývod třetího zatéžovacího rezistoru (11.3) a jehož výstup (15.3) je přes druhý srážecí rezistor (21) spojen s bází druhého tranzistoru (27), jehož emitor je spojen s první napájecí svorkou (E) a jehož kolektor je připojen na druhý přenosový výstup (c), kdežto první přenosový výstup (b) je spojen s kolektorem prvního tranzistoru (26), jehož emitor je napojen na první napájecí svorku (e) a Jehož báze je přes první srážecí rezistor (2o) spojena s výstupem (14.3) prvního logického členu (14), jehož druhý vstup (14.2) je připojen ke čtvrtému výstupu (lo,4) diodového kodéru (lo) a současné k jednomu z vývodů čtvrtého zatéžovacího rezistoru (11.4).