CN2651853Y - 条形码解码器 - Google Patents
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Abstract
本实用新型主要涉及一种条形码解码器,CPU系统、数据存储电路、程序存储器、输入输出电路、功能控制电路、接口电路,所述的功能控制电路中有一触发电路由一个开关、电阻和电容构成,开关的一端接地,另一端与CPU联结;接口电路与CPU系统之间连接一个缓存电路,由于采用了以上的技术方案,使得条形码解码器的解码速度快,识别效果好,设置功能强大。
Description
技术领域
本实用新型主要涉及一种条形码解码器。
背景技术
在目前的条码枪的生产领域中,在解码器的解码速度较低,使用设置功能有限。
发明内容
本实用新型的目的是提供一种新型条形码解码器,克服上述所述的缺陷,使得条形码解码器的解码速度加快,功能设置方面大大增强。
本实用新型是通过如下技术方案实现的:CPU系统、数据存储电路、程序存储器、输入输出电路、功能控制电路、接口电路,所述的功能控制电路中有一触发电路由一个开关、电阻和电容构成,开关的一端接地,另一端与CPU联结;接口电路与CPU系统之间连接一个缓存电路。
上述的条形码解码器,所述的存储电路由数据锁存器和数据暂存器构成。
上述的条形码解码器,所述的输入输出电路由键盘口输入输出电路和串行口输入输出电路并联组成,一端与接口电路连接,另一端与外部设备连接。
上述的条形码解码器,所述的程序存储器为可擦写存储器。
上述的条形码解码器,所述的CPU系统主要由型号为80C32的IC组成。
上述的条形码解码器,所述的数据锁存器主要由型号为74HC373的IC构成。
上述的条形码解码器,所述的数据暂存器主要由型号为62256的IC构成。
上述的条形码解码器,所述的缓存电路由一个型号为74HC373的IC和两个74HC27的IC连接构成,一74HC27的IC的引脚1、2相连并接地,引脚13与CPU系统连接,引脚7、14与接口电路连接,引脚12与另一74HC27的IC的引脚3、4连接,另一74HC27的IC的引脚5与CPU连接,引脚7接地,引脚14连接电源,引脚6与74HC373的IC的引脚LE连接。
由于采用了以上的技术方案,使得条形码解码器的解码速度快,识别效果好,设置功能强大。
附图说明
图1是本实用新型条形码解码器的功能结构图;
图2是本实用新型条形码解码器的电路图。
具体实施方式
下面结合附图对本实用新型作进一步详述:
见图1~2,系统加电,条形码解码器启动,当按下开关SW1,触发电路31触发,所述的触发电路由一个开关SW1、电阻R3和电容C7构成,开关SW1的一端接地,另一端与CPU系统连接,CPU系统1在触发电路31作用下开始工作,CPU系统1发出一条指令通过接口电路5数据接收端J1,再送至条码引擎系统,引擎系统开始采取信号,采集后的数据信号再经数据接收端J1,数据信号先经过缓存电路7缓存,再传送至CPU系统1,所述的缓存电路7由一个型号为74HC373的IC和两个74HC27的IC连接构成,所述的缓存电路由一个型号为74HC373的IC和两个74HC27的IC连接构成,一74HC27的IC的引脚1、2相连并接地,引脚13与CPU系统连接,引脚7、14与接口电路连接,引脚12与另一74HC27的IC的引脚3、4连接,另一74HC27的IC的引脚5与CPU连接,引脚7接地,引脚14连接电源,引脚6与74HC373的IC的引脚LE连接,当CPU系统1得到数据信号后,开始进行译码处理工作,所述的CPU系统1译码处理工作是这样进行的:CPU系统1启动程序存储器4中的指令进行数据处理,所述的程序存储器4最好为可擦写的FLASH ROM或EEP ROM,方便存入各程序的条码规格设定和参数设定,CPU系统1处理数据后输出到数据存储电路2中,所述的数据存储电路由数据锁存器21和数据暂存器22并联组成,首先将传输出来的一部分数据通过数据锁存器21锁存,后传输出来的数据送至数据暂存器22等待同步输出,所述的数据锁存器21主要由型号为74HC373的IC组成,数据暂存器22主要由型号为62256的IC组成。当所有数据处理完后,在功能控制电路3的作用下,将处理后的数据再回送至CPU系统1,CPU系统1得到程序存储器4中的程序指令后将数据通过缓存电路7送至接口电路5,再通过输入输出电路6送往各智能系统,所述的输入输出电路由键盘口输入输出电路61和串行口输入输出电路62并联组成,一端与接口电路5连接,另一端与外部设备8。这样可以根据不同的需要连接上不同的外部设备来使用。
由于采用了以上的技术方案,使得条形码解码器的的解码速度快,识别效果好,设置功能强大。
Claims (8)
1、一种条形码解码器,包括CPU系统、数据存储电路、程序存储器、输入输出电路、功能控制电路、接口电路,其特征是:所述的功能控制电路中有一触发电路由一个开关、电阻和电容构成,开关的一端接地,另一端与CPU联结;接口电路与CPU系统之间连接一个缓存电路。
2、根据权利要求1所述的条形码解码器,其特征是,所述的输入输出电路由键盘口输入输出电路和串行口输入输出电路并联组成,一端与CPU系统连接,另一端与接口电路连接。
3、根据权利要求1所述的条形码解码器,其特征是,所述的程序存储器为可擦写存储器。
4、根据权利要求1所述的条形码解码器,其特征是,所述的存储电路由数据锁存器和数据暂存器构成。
5、根据权利要求1所述的条形码解码器,其特征是,所述的CPU系统主要由型号为80C32的IC组成。
6、根据权利要求4所述的条形码解码器,其特征是,所述的数据锁存器主要由型号为74HC373的IC构成。
7、根据权利要求4所述的条形码解码器,其特征是,所述的数据暂存器主要由型号为62256的IC构成。
8、根据权利要求1所述的条形码解码器,其特征是,所述的缓存电路由一个型号为74HC373的IC和两个74HC27的IC连接构成,一74HC27的IC的引脚1、2相连并接地,引脚13与CPU系统连接,引脚7、14与接口电路连接,引脚12与另一74HC27的IC的引脚3、4连接,另一74HC27的IC的引脚5与CPU连接,引脚7接地,引脚14连接电源,引脚6与74HC373的IC的引脚LE连接。
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CN101908132A (zh) * | 2010-06-01 | 2010-12-08 | 福建新大陆电脑股份有限公司 | 条码解码方法及装置 |
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