CN215006630U - 一种用于PCIe速率切换的时钟触发板、装置、系统 - Google Patents
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Abstract
本实用新型提供一种用于PCIe速率切换的时钟触发板、装置、系统，所述系统包括计算机、待测物和时钟触发板；所述待测物包括待测板和兼容性负载板；所述待测板和兼容性负载板连接；待测板上设置有PCIe phy芯片；兼容性负载板设置有切换信号接收孔；切换信号接收孔与切换信号发送孔通信连接；切换信号接收孔与PCIe phy芯片通信连接；所述计算机与微处理器通信连接，来控制微处理器发送触发信号到时钟发生器；时钟发生器通过切换信号发送孔与切换信号接收孔通信连接发送时钟信号控制PCIe phy芯片切换速率。
Description
技术领域
本实用新型涉及PCIe速率切换设计技术领域，具体涉及一种用于PCIe速率切换的时钟触发板、装置、系统。
背景技术
PCIe为服务器中不可或缺的高速串行扩展总线，是由英特尔在2001年提出PCIe拥有更快的速率，所以几乎取代了以往所有的内部总线.随着计算器产业蓬勃发展，PCIe速率也由原来2.5GT/s发展至今日PCIe 5.032GT/s。
目前针对服务器PCIe信号完整性验证需要将PCIe标准测试治具CLB(兼容性负载卡)插入服务器中来获得服务器时钟及数据信号，其中时钟信号经过CLB处理后可以透过人工按压按钮触发来切换PCIe速率。每按一次按钮PCIe phy芯片的速率就会做一次改变。
工程师需人工操作CLB按钮来切换速率从而获取各速率的PCIe信号，从2.5GT/s到16GT/s，整个获取流程冗长需要不停手动切换PCIe速率。若要获取完整的PCIe速率必续按压触发按钮多达几十次，若不慎按错，需按照速率顺序重新按压按钮做一次循环，这还是未考虑PCIe5.0的状况，若加入PCIe5.0速率，预期循环会更多，因此工程师需要花费大量人工做重复性工作。
发明内容
针对工程师需人工操作CLB按钮来切换速率从而获取各速率的PCIe信号，操作循环次数多，分时费力的问题，本实用新型提供一种用于PCIe速率切换的时钟触发板、装置、系统。
本实用新型的技术方案是：
第一方面，本实用新型技术方案提供一种用于PCIe速率切换的时钟触发板，包括板卡本体，所述的板卡本体上设置有微处理器和用于发送时钟信号到待测板的切换信号发送孔；
所述微处理器连接有用于产生时钟信号的时钟发生器；
所述时钟发生器与切换信号发送孔连接。
优选地，所述板卡本体上还设置有用于连接到外部计算机的USB接口；所述USB接口与微处理器连接。使用时，通过USB接口连接到外部的用于给微处理器发指令的计算机。
优选地，所述时钟发生器包括谐振器；
所述微处理器通过GPIO信号或I2C信号与谐振器连接。根据谐振器的规格，微处理器选用不同的而控制信号。
第二方面，本实用新型提供一种PCIe速率切换装置，包括待测物和时钟触发板；所述待测物包括待测板和兼容性负载板；所述待测板和兼容性负载板连接；所述时钟触发板为第一方面所述的一种用于PCIe速率切换的时钟触发板；
待测板上设置有PCIe phy芯片；
兼容性负载板设置有切换信号接收孔；切换信号接收孔与切换信号发送孔通信连接；切换信号接收孔与PCIe phy芯片通信连接；时钟发生器通过切换信号发送孔与切换信号接收孔通信连接发送时钟信号控制PCIe phy芯片切换速率。
额外的时钟触发板可以独立运作自动切换PCIe速率，减少PCIe速率切换过程中工程师大量人工重复性工作，同时避免速率切换错误，时钟信号亦不会被待测物限制。
第三方面，本实用新型技术方案提供一种PCIe速率切换系统，包括计算机、待测物和时钟触发板；所述的时钟触发板为第一方面所述的用于PCIe速率切换的时钟触发板；所述待测物包括待测板和兼容性负载板；所述待测板和兼容性负载板连接；待测板上设置有PCIe phy芯片；
兼容性负载板设置有切换信号接收孔；切换信号接收孔与切换信号发送孔通信连接；切换信号接收孔与PCIe phy芯片通信连接；
所述计算机与微处理器通信连接，来控制微处理器发送触发信号到时钟发生器；时钟发生器通过切换信号发送孔与切换信号接收孔通信连接发送时钟信号控制PCIe phy芯片切换速率。
优选地，当时钟触发板设置有USB接口时，计算机通过USB接口与时钟触发板的微处理器通信连接。
将时钟触发板的切换信号发送孔连接到兼容性负载板的切换信号接收孔，透过USB接口将时钟触发板连接到计算机，机算机下命令给微处理器触发谐振器，谐振器发出时钟信号给PCIe phy芯片告知切换PCIe速率。
从以上技术方案可以看出，本实用新型具有以下优点：在切换PCIe速率过程中，工程师使用CTB取代手动切换，将可节省工程师宝贵时间。设定好所要获取的速率后，CTB就会自动切换到指定数率，大大减少工程师手动操作错误所衍生出的时间浪费。此重复性工作被CTB取代后，工程师也可以将精力运用到更有价值的研发工作上，如此可以大大提高工程师产值。
此外，本实用新型设计原理可靠，结构简单，具有非常广泛的应用前景。
由此可见，本实用新型与现有技术相比，具有突出的实质性特点和显著地进步，其实施的有益效果也是显而易见的。
附图说明
为了更清楚地说明本实用新型实施例或现有技术中的技术方案，下面将对实施例或现有技术描述中所需要使用的附图作简单地介绍，显而易见地，对于本领域普通技术人员而言，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1是本实用新型实施例提供的用于PCIe速率切换的时钟触发板结构示意连接图；
图2是本实用新型实施例三提供的一种PCIe速率切换装置结构示意连接图；
图3是本实用新型实施例四提供的一种PCIe速率切换系统结构示意连接图。
具体实施方式
为了使本技术领域的人员更好地理解本实用新型中的技术方案，下面将结合本实用新型实施例中的附图，对本实用新型实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本实用新型一部分实施例，而不是全部的实施例。基于本实用新型中的实施例，本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例，都应当属于本实用新型保护的范围。
实施例一
如图1所示，本实用新型技术方案提供一种用于PCIe速率切换的时钟触发板，包括板卡本体，所述的板卡本体上设置有微处理器和用于发送时钟信号到待测板的切换信号发送孔101；
所述微处理器连接有用于产生时钟信号的时钟发生器；
所述时钟发生器与切换信号发送孔101连接。将时钟发生器产生的时钟信号通过切换信号发送孔101发出到待测物。
实施例二
本实用新型技术方案提供一种用于PCIe速率切换的时钟触发板，与实施例一的不同之处：
所述板卡本体上还设置有用于连接到外部计算机的USB接口102；所述USB接口102与微处理器通信连接。使用时，通过USB接口102连接到外部的用于给微处理器发指令的计算机。
本实施例中，所述时钟发生器包括OSC谐振器；
所述微处理器通过GPIO信号或I2C信号与OSC谐振器连接。根据谐振器的规格，微处理器选用不同的而控制信号。
实施例三
如图2所示，本实用新型提供一种PCIe速率切换装置，包括待测物2和时钟触发板1；所述待测物2包括待测板和兼容性负载板201；所述待测板和兼容性负载板201连接；所述时钟触发板1为实施例一所述的一种用于PCIe速率切换的时钟触发板；
待测板上设置有PCIe phy芯片203；
兼容性负载板201设置有切换信号接收孔202；切换信号接收孔202与切换信号发送孔101通信连接；切换信号接收孔202与PCIe phy芯片203通信连接；时钟发生器通过切换信号发送孔101与切换信号接收孔202通信连接发送时钟信号控制PCIe phy芯片切换速率。
额外的时钟触发板1可以独立运作自动切换PCIe速率，减少PCIe速率切换过程中工程师大量人工重复性工作，同时避免速率切换错误，时钟信号亦不会被待测物限制。
实施例四
如图3所示，本实用新型技术方案提供一种PCIe速率切换系统，包括计算机、待测物2和时钟触发板1；所述的时钟触发板1为实施例二所述的用于PCIe速率切换的时钟触发板；所述待测物2包括待测板和兼容性负载板201；所述待测板和兼容性负载板201连接；待测板上设置有PCIe phy芯片203；
兼容性负载板201设置有切换信号接收孔202；切换信号接收孔202与切换信号发送孔101通信连接；切换信号接收孔202与PCIe phy芯片203通信连接；本实施例中，时钟发生器为谐振器OSC；
本实施例中，计算机通过USB接口102与时钟触发板1的微处理器通信连接，来控制微处理器发送触发信号到谐振器OSC；谐振器OSC通过切换信号发送孔101与切换信号接收孔202通信连接发送时钟信号控制PCIe phy芯片203切换速率。
将时钟触发板1的切换信号发送孔101连接到兼容性负载板201的切换信号接收孔202，透过USB接口102将时钟触发板1连接到计算机，机算机下命令给微处理器触发谐振器OSC，谐振器OSC发出时钟信号给PCIe phy芯片203告知切换PCIe速率。
PCIe：Peripheral Component Interconnect Express高速串行计算机扩展总线
CLB：Compliance Load Board兼容性负载卡
CTB：Clock Toggle Block时钟信号触发板
DUT：Device Under Test待测物
OSC：Oscillator谐振器
GPIO：General-purpose input/output通用型输出输出端口
I2C：Inter-Integrated Circuit集成电路总线
USB：Universal Serial Bus通用串行总线
尽管通过参考附图并结合优选实施例的方式对本实用新型进行了详细描述，但本实用新型并不限于此。在不脱离本实用新型的精神和实质的前提下，本领域普通技术人员可以对本实用新型的实施例进行各种等效的修改或替换，而这些修改或替换都应在本实用新型的涵盖范围内/任何熟悉本技术领域的技术人员在本实用新型揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本实用新型的保护范围之内。因此，本实用新型的保护范围应以所述权利要求的保护范围为准。
Claims (6)
1.一种用于PCIe速率切换的时钟触发板，其特征在于，包括板卡本体，所述的板卡本体上设置有微处理器和用于发送时钟信号到待测板的切换信号发送孔；
所述微处理器连接有用于产生时钟信号的时钟发生器；
所述时钟发生器与切换信号发送孔连接。
2.根据权利要求1所述的一种用于PCIe速率切换的时钟触发板，其特征在于，所述板卡本体上还设置有用于连接到外部计算机的USB接口；所述USB接口与微处理器连接。
3.根据权利要求1所述的一种用于PCIe速率切换的时钟触发板，其特征在于，所述时钟发生器包括谐振器；
所述微处理器通过GPIO信号或I2C信号与谐振器连接。
4.一种PCIe速率切换装置，其特征在于，包括待测物和时钟触发板；所述待测物包括待测板和兼容性负载板；所述待测板和兼容性负载板连接；所述时钟触发板为权利要求1-3任一项所述的一种用于PCIe速率切换的时钟触发板待测板上设置有PCIe phy芯片；
兼容性负载板设置有切换信号接收孔；切换信号接收孔与切换信号发送孔通信连接；切换信号接收孔与PCIe phy芯片通信连接；时钟发生器通过切换信号发送孔与切换信号接收孔通信连接发送时钟信号控制PCIe phy芯片切换速率。
5.一种PCIe速率切换系统，其特征在于，包括计算机、待测物和时钟触发板；所述的时钟触发板为权利要求1-3任一项所述的用于PCIe速率切换的时钟触发板；所述待测物包括待测板和兼容性负载板；所述待测板和兼容性负载板连接；待测板上设置有PCIe phy芯片；
兼容性负载板设置有切换信号接收孔；切换信号接收孔与切换信号发送孔通信连接；切换信号接收孔与PCIe phy芯片通信连接；
所述计算机与微处理器通信连接，来控制微处理器发送触发信号到时钟发生器；时钟发生器通过切换信号发送孔与切换信号接收孔通信连接发送时钟信号控制PCIe phy芯片切换速率。
6.根据权利要求5所述的一种PCIe速率切换系统，其特征在于，当时钟触发板设置有USB接口时，计算机通过USB接口与时钟触发板的微处理器通信连接。
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